KR930000747Y1 - Vtr의 콘트롤 펄스 보상회로 - Google Patents

Vtr의 콘트롤 펄스 보상회로 Download PDF

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Abstract

내용 없음.

Description

VTR의 콘트롤 펄스 보상회로
제1도는 본 고안의 회로도.
제2도는 본 고안에 의한 콘트롤펄스 보상 스위칭 신호 발생 파형도.
제3도는 본 고안에 의한 콘트롤 펄스 보상 파형도.
* 도면의 주요부분에 대한 부호의 설명
5 : 콘트롤 펄스 감지부 FF1: 플립플롭
SW1: 아나로그 스위치 MM1: 단안정멀티 바이브레이터
NOR : 노아게이트
본 고안은 VTR의 서어브 제어계에 있어서, 콘트롤 펄스가 인가되지 못한경우 이를 보상해주어 화면을 안정화 시키도록 하는 VTR의 콘트롤 펄스 보상회로에 관한 것이다.
VTR에서 비데오 테이프를 재생시킬때에 콘트롤 펄스가 기록되어있는 콘트롤 트랙의 산화층이 파괴되어 버리는 경우가 발생하게 되어 이를 읽지 못하게 되므로써 서어보 제어계에 콘트롤 펄스을 인가시켜 주지 못하여 화면이 흔들리는 경우가 발생되는 것이었다.
즉 콘트롤 펄스를 읽어내지 못하면 서어보제어계에서 모터의 속도제어를 명확히 해주지못하여 이때의 화면이 흔들리게 되거나 또는 화면을 볼 수 없게되는 경우가 발생되는 것이었다.
이와같이 종래에는 여러가지 요인에 의하여 콘트롤 펄스를 읽어내지 못하면 즉시 화면이 무너져 버리게 되므로 본 고안에서는 콘트롤 펄스를 읽어내지 못할경우 콘트롤 펄스를 보상시켜 주어 화면이 즉시 무너지게 되는 현상을 없애 주도록 하였다.
즉 본 고안은 콘트롤 펄스 입력을 감지하여 콘트롤 펄스가 빠지게 될 경우 그 시간만큼 지연된 콘트롤 펄스를 출력시켜 본래의 신호와 합성시킴으로써 빠진 콘트롤 신호가 보상된 완벽한 형태의 콘트롤 신호로 서어보 제어계에 인가시켜 주어 VTR은 화면이 무너지지 않고 정상적인 구동을 하도록 한 것이다.
이를 첨부 도면에 의하여 상세히 설명하면 다음과 같다.
읽어낸 콘트롤 펄스는 아니로그 스위치(SW1)에 인가됨과 동시에 콘트롤 펄스 감지부(5)에 인가되어 콘트롤펄스의 빠짐을 감지하게 구성한다.
즉 콘트롤 펄스 감지부(5)는 콘트롤 펄스가 저항(R1)과 콘덴서(C1)가 연결된 단안정 멀티바이브레이터(MM1)의 트리거단자(T)에 인가되어 부트리거일때만 출력단자(Ql)로 하이레벨을 출력시켜 노아게이트(NOR)에 인가되게 하여 콘트롤 펄스가 입력되는 노아게이트(NOR)에서 콘트롤 신호가 빠졌을 경우에만 하이레벨의 스위칭 신호를 출력시키도록 구성한다.
그리고 노아게이트(NOR)의 스위칭 신호는 아나로그 스위치(SW1)에 인가되게 구성하여 콘트롤 신호가 빠지지 않았을 경우에는 입력 콘트롤 펄스가 아니로그 스위치(SW1)를 통한후 서어보 제어계에 인가됨과 동시에 플립플롭(FFl)의 입력단자(D)에 인가되게 구성하고 클럭단자(CK)로 헤드 스위칭 펄스가 인가되는 플립플롭(FF1)의 출력단자(Q)출력은 아나로그 스위치(SW1)에 인가되게 구성한 것이다.
즉 본 고안은 콘트롤 펄스과 플립플롭(FF1))에서 지연시킨 콘트롤 펄스를 콘트롤 펄스 감지부(5)에서 아나로그 스위치(SW1)을 절환시킴으로써 콘트롤 펄스가 빠져도 이를 보상시킨 콘트롤 펄스를 뒷단의 서어보 제어계에 인가시키는 것이다.
이와같이 구성된 본 고안에서 먼저 제2도를 참고로하여 콘트롤 펄스 감지부(5)에서 스위칭 신호를 출력시키는 동작을 살펴본다.
제2도의 (a)는 읽혀진 콘트롤 펄스인데 점선으로 표시한 부분이 어떤 요인에 의하여 산화막 층이 파괴되어 한주기의 콘트롤 펄스가 빠진 부분이다.
이러한 콘트롤 펄스가 콘트롤 펄스 감지부(5)의 단안정 멀티바이브레이터(MM1)의 트리거 단자(T)에 인가되게 되면 단안정 멀티바이브레이터(MMl)위 출력단자(Q)에서는 입력 콘트롤 펄스가 부트리거될때 저항(R1)과 콘덴서(C1)에 의해 T1 0.7R1:C1의 시정수를 갖는 제2도의 (b)에서와 같은 펄스를 출력시키게 된다.
즉 콘트롤 펄스 감지부(5)의 단안정 멀티바이브레이터(MMl)에서는 트리거 입력으로 인가되는 콘트롤 펄스가 부트리거 될때 T1 0.7R1:C1의 시정수를 갖는 제2도의 (b)에서와 같은 펄스를 출력시키게 된다.
이같은 제2도의 (b)에서와 같은 출력 펄스는 본래의 콘트롤 펄스(제2도의(a)참조)와 노아게이트(NOR)의 입력측에 인가되어 노아게이트(NOR)의 출력측으로는 제2도의 (a)에서 콘트롤 펄스가 빠진 점선 부분에서만 제2도의(c)에서와 같은 하나의 스위칭 펄스를 출력시키게 된다.
즉 콘트롤 펄스 감지부(5)의 노아게이트(NOR)의 출력측으로는 콘트롤 펄스가 빠진 부분에서만 제2도의 (c)에서와 같이 하이레벨의 스위칭 펄스가 출력되게 되며 이렇게 스위칭 펄스가 하이레벨로 인가될 경우에는 아나로그 스위치(SW1)를 도면의 표시와 반대로 접속시켜 주고 노아게이트(NOR)의 콘트롤 펄스가 로우레벨로 인가될때(즉 정상적인 콘트롤 펄스인가시)에는 아나로그 스위치(SW1)를 도면의 표시와 같이 접속시켜 주게된다.
이와같이 콘트롤 펄스 감지부(5)에서는 읽혀진 콘트롤 펄스중 빠진 부분에서만 하이벨의 스위칭 펄스를 출력시켜 아나로그 스위치(SW1)를 절환시켜 주게되는 것이다.
그리고 아나로그 스위치(SW1)를 통과한 콘트롤 펄스는 D-플립플롭(FFl)에서 30HZ의 헤드 스위칭 펄스의 1주기동안 지연된후 아나로그 스위치(SW1)에 인가되게 되며 따라서 아나로그 스위치(SW1)에서는 콘트롤 펄스와 풀립풀롭(FF1)에서 지연시킨 콘트롤 펄스를 콘트롤 펄스 감지부(5)의 스위칭 펄스로 절환시켜 주어 출력시키는 것이다.
즉 입력 콘트롤 펄스는 제3도의 (a)에서와 같이 입력되게 되고 이때 점선으로 표시된 콘트롤 펄스가 빠진 부분에서는 콘트롤 펄스 감지부(5)에서 제3도(c)에서와 같이 스위칭 펄스를 출력시키게 된다.
이때 아나로그 스위치(SW1)는 콘트롤 펄스 감지부(5)의 스위칭 펄스가 로우 레벨이면 도면과 같이 접속되고 하이레벨이면 반대로 접속시키게 된다.
그리고 플립플롭(FFl)에서는 제3도의 (a)에서와 같은 콘트롤 펄스를 제3도의 (f)에서와 같은 헤드 스위칭 펄스의 한주기 동안 지연시켜 제3도의(d)에서와 같이 1주기 지연된 콘트롤 펄스를 아나로그 스위치(SW1)에 인가시키게 된다.
따라서 콘트롤 펄스가 빠지지 않은 부분에서는 입력 콘트롤 펄스가 아나로그 스위치(SW1)를 통하여 출력되게 되고 콘트롤 펄스가 빠진 부분에서는 콘트롤 펄스 감지부(5)에서 아나로그 스위치(SW1)를 절환시켜 풀립풀롭(FF1)에서 헤드 스위칭 펄스의 1주기 동안 지연시켜 콘트롤 펄스가 출력되게 하므로써 뒷단의 서어보 제어게에는 완벽한 형태의 콘트롤 펄스가 제3도의(e)에서와 같이 인가되게 되는 것이다.
그러므로 콘트롤 펄스가 빠짐으로 인하여 화면이 무너지게 되는 단점을 해소시켜 주게되는 것이다.
이와같이 본 고안은 정상적인 콘트롤 펄스는 아니로그 스위치(SW1)를 통하여 그대로 출력되게 하고 콘트롤펄스가 빠졌을 경우에도 콘트롤 펄스 감지부(5)의 스위칭 펄스에 의해 아나로그 스위치(SW1)의 출력측으로는 지연된 콘트롤 펄스와 콘트롤 펄스가 빠진 본래의 콘트롤 펄스가 합성된 신호가 출력되게 되므로써 뒷단의 서어보 제어계에는 제3도의 (e)에서와 같은 콘트롤 펄스가 인가되는 것이다.
따라서 본 고안은 콘트롤 펄스가 빠진 부분에서도 콘트롤 펄스를 보상해 주게되므로 화면을 안정화시켜 줄수있는 효과가 있는 것이다.

Claims (2)

  1. 입력 콘트롤 펄스중의 빠진 콘트롤 펄스 기간동안 스위칭 신호를 출력시키는 콘트롤 펄스 감지부(5)와, 상기 콘트롤 펄스 감지부(5)의 스위칭 신호로 입력 콘트롤 펄스와 지연소자에게 지연시킨 콘트롤 펄스를 선택하여 출력시키는 스위칭 소자와, 상기 스위칭 소자를 통과한 콘트롤 펄스를 헤드 스위칭 펄스의 한주기 동안 지연시키는 지연소자로 구성된 VTR의 콘트롤 펄스 보상회로.
  2. 제1항에 있어서, 콘트롤 펄스 감지부(5)는 입력 콘트롤 펄스가 트리거 신호로 인가되고 부트리거되는 단안정 멀티바이브레이터(MMl)와, 상기 단안정 멀티바이브레이터(MMl)의 출력신호와 입력 콘트롤 펄스가 입력되어 스위칭 신호를 출력시키는 노아게이트(NOR)로 구성된 VTR의 콘트롤 펄스 보상회로
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