KR920005240Y1 - Synchronous signal switching circuit - Google Patents
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- H03K17/002—Switching arrangements with several input- or output terminals
- H03K17/007—Switching arrangements with several input- or output terminals with several outputs only
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Abstract
내용 없음.No content.
Description
도면은 본 고안의 회로도이다.The figure is a circuit diagram of the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
11,12,13,14 : 인버터 21,22 : 3상 인버터11, 12, 13, 14: inverter 21, 22: three-phase inverter
31,32 : 다이오드31,32: Diode
본 고안은 동기신호 스위칭회로에 관한 것으로, 더 상세히는 정펄스신호와 부펄스 신호를 회로에서 검색하여 부신호로 일정하게 출력할 수 있는 회로에 관한 것이다.The present invention relates to a synchronous signal switching circuit, and more particularly, to a circuit capable of constantly outputting a positive pulse signal and a negative pulse signal from the circuit to the negative signal.
통상 모니터에서 동기신호는 컴퓨터가 그 밖의 신호원에 따라 정펄스동기신호와 부펄스동기신호 두가지가 있어, 이 펄스에 따라 모니터의 동기입력단을 변환시켜야 한다.In the normal monitor, there are two types of sync signal, the normal pulse signal and the negative pulse signal, depending on the signal source of the computer.
지금까지는 동기신화의 정펄스와 부펄스를 신호원 사양(Specification)을 보고, 외부에서 그 펄스에 맞는 회로로 스위치를 전환하는 방식을 사용하였다.Until now, the method of switching the pulse from the external source to the circuit for the pulse and the pulse of the synchronizing myths has been used.
이러한 종래의 방식은 신호원을 일일이 체크하여야 하므로 사용자의 불편이 크고, 또 외부에 수동으로 조작할 수 있는 스위치를 부착하여야 하므로 제품의 코스트가 높아졌다.In this conventional method, since the user must check the signal source one by one, inconvenience of the user is large, and the externally manually operated switch must be attached to the cost of the product.
따라서 본 고안의 목적은 상기한 종래기술의 단점을 개선하여 동기 입력단에서 펄스를 검출하여 한 종류의 펄스를 출력하게 하는 회로를 제공하고자 한다.Accordingly, an object of the present invention is to provide a circuit for outputting one type of pulse by detecting a pulse at a synchronous input terminal by improving the disadvantages of the prior art.
상기와 같은 목적을 달성하기 위해, 본 고안은 다수의 표준인버터, 3상인버터, 다이오드 및 하나의 적분회로로 구성되어 정 또는 부펄스의 동기신호가 입력되면 인버터를 통하여 적분회로에 인가되어, 정펄스일때는 다른 인버터에 로우, 부펄스일때는 이 다른 인버터에 하이 전압이 인가되어 이 신호 3상 인버터들을 제어하여 출력단에서 항상 일정한 종류의 펄스의 동기신호가 출력되도록 하였다.In order to achieve the above object, the present invention consists of a plurality of standard inverter, three-phase inverter, a diode and one integrating circuit, when a positive or negative pulse synchronization signal is input to the integrating circuit through the inverter, In the case of a pulse, a low voltage is applied to the other inverter, and in the case of a pulse, a high voltage is applied to the other inverter to control the signal three-phase inverters so that a certain type of pulse synchronization signal is always output at the output terminal.
이하 도면에 의거 본 고안을 상세히 설명한다.Hereinafter, the present invention will be described in detail with reference to the drawings.
본 고안의 회로는 컴퓨터나 모니터신호원에서 정 또는 부의 펄스가 인가되는 입력단자(Vin)에 인버터(11,12)와 3상인버터(21) 입력단이 연결되고, 인버터(11)의 출력단은 3상 인버터(22)의 입력단에, 상기 3상인버터(21)의 출력단은 다이오드(32)의 애노드에 각각 연결된다. 또 상기 3상인버터(22)의 출력단은 다이오드(31)의 애노드에 연결되고 다이오드(31,32)의 캐소드는 부하저항(R2)를 통하여 출력된다. 한편 인버터(12)의 출력단은 콘덴서(C)와 저항(R1)으로 구성된 적분회로에 연결되고, 위 저항(R1)은 인버터(13)를 거쳐 3상인버터(21)의 콘트를 단자와 인버터(14)의 입력단에 연결되고, 인버터(14)의 출력단은 상기 3상인버터(22)의 출력콘트롤단자에 연결되어 있다.In the circuit of the present invention, the input terminal (Vin) to which positive or negative pulses are applied from a computer or a monitor signal source is connected to the inputs of the inverters 11 and 12 and the three-phase inverter 21, and the output terminal of the inverter 11 is 3 At the input of the phase inverter 22, the output of the three-phase inverter 21 is connected to the anode of the diode 32, respectively. In addition, the output terminal of the three-phase inverter 22 is connected to the anode of the diode 31 and the cathode of the diodes 31 and 32 is output through the load resistor (R2). On the other hand, the output terminal of the inverter 12 is connected to the integrating circuit consisting of a capacitor (C) and a resistor (R1), the upper resistor (R1) via the inverter 13 controls the control of the three-phase inverter (21) terminal and inverter ( 14 is connected to the output terminal of the inverter 14 is connected to the output control terminal of the three-phase inverter (22).
이러한 구성의 본 고안의 회로는 다음과 같이 동작한다.The circuit of the present invention of such a configuration operates as follows.
만일 정펄스동기신호가 본 고안의 입력단에 인가되면 인버터(11)를 거친 A점에서 반전된 부펄스가 3상인버터(22)를 거쳐 B점에서는 정펄스가 된다. 또한 3상인버터(21)를 거친 입력신호는 C점에 부의 펄스가 된다. 한편 인버터(12)를 거친 입력신호가 적분회로(C,R1)를 거쳐 인버터(13)에 5V의 DC전압을 인가한다. 이는 적분회로의 저항(R1)과 콘덴서(C)의 시정수를 충분히 크게 하여 실현한다. 따라서 인버터(13)를 거친 DC전압은 로우가 되어 3상인버터(21)를 인에이블시켜 C점에서 부펄스가 출력된다.If the positive pulse synchronous signal is applied to the input terminal of the present invention, the negative pulse inverted at point A through the inverter 11 becomes a constant pulse at point B via the three-phase inverter 22. In addition, the input signal passing through the three-phase inverter 21 becomes a negative pulse at the point C. On the other hand, the input signal passing through the inverter 12 applies a DC voltage of 5V to the inverter 13 via the integration circuits C and R1. This is achieved by sufficiently increasing the time constants of the resistor R1 and the capacitor C of the integrating circuit. Therefore, the DC voltage passing through the inverter 13 becomes low, and the three-phase inverter 21 is enabled to output a negative pulse at point C.
한편 인버터(14)를 거친 하이전압은 3상인버터(22)를 하이 임피던스상태로 하여 B점에서는 신호가 출력되지 않게 한다. 따라서 출력단(Vout)에는 C점의 부펄스만이 출력된다.On the other hand, the high voltage passed through the inverter 14 causes the three-phase inverter 22 to be in a high impedance state so that no signal is output at the point B. Therefore, only the negative pulse at the point C is output to the output terminal Vout.
다음 부펄스가 입력단(Vin)에 인가되면 B점은 부펄스, C점은 정펄스가 나타난다.When the next negative pulse is applied to the input terminal (Vin), point B is negative and point C is positive.
이때 인버터(12)를 통과한 정펄스는 상기 적분회로를 통과하여 인버터(13)에 로우전압을 인가하여 E점은 하이, F점은 로우가 되어 3상인버터(22)는 인에이블되고, 3상인버터(21)은 하이임피던스가 되어 따라서 출력단(Vout)에는 B점의 부의 펄스만이 출력되고, C점의 정펄스는 출력되지 않는다.At this time, the positive pulse passing through the inverter 12 passes through the integrating circuit and applies a low voltage to the inverter 13 so that the E point is high and the F point is low, and the three-phase inverter 22 is enabled. The phase inverter 21 becomes high impedance, so only the negative pulse of point B is output to the output terminal Vout, and the positive pulse of point C is not output.
위에서와 같이 본 고안의 회로에 의하면 그 입력단에 정 또는 부펄스의 동기신호, 어느 것이 인가되더라도 출력은 항상 부펄스의 동기신호가 출력되어 컴퓨터나 모니터 신호원이 정펄스동기신호인가 부펄스동기신호인가를 체크할 필요없이 항상 부펄스만을 출력시킬 수 있으며, 동시에 외부변화 스위치가 필요없게 된다.As described above, according to the circuit of the present invention, the output signal is always outputted as a negative pulse synchronization signal, regardless of whether a positive or negative pulse synchronization signal is applied to the input terminal. Only the negative pulse can be output at any time without checking the authorization, and at the same time, no external change switch is required.
Claims (1)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019890019200U KR920005240Y1 (en) | 1989-12-18 | 1989-12-18 | Synchronous signal switching circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019890019200U KR920005240Y1 (en) | 1989-12-18 | 1989-12-18 | Synchronous signal switching circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR910013278U KR910013278U (en) | 1991-07-30 |
| KR920005240Y1 true KR920005240Y1 (en) | 1992-07-30 |
Family
ID=19293382
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019890019200U KR920005240Y1 (en) | 1989-12-18 | 1989-12-18 | Synchronous signal switching circuit |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR920005240Y1 (en) |
-
1989
- 1989-12-18 KR KR2019890019200U patent/KR920005240Y1/en not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR910013278U (en) | 1991-07-30 |
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