KR920000913Y1 - Voltage changing power supply circuit - Google Patents
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Abstract
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Description
제1도는 본 고안의 따른 회로도.1 is a circuit diagram according to the present invention.
제2도는 제1도에 따른 전압발생특성도.2 is a characteristic diagram of voltage generation according to FIG.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for the main parts of the drawings
10 : 정류부 20 : 기동부10: rectifying unit 20: starting unit
30 : 드라이브부 40 : 스위칭제어부30: drive unit 40: switching control unit
50 : 출력전압제어부 T1, T2 : 제1, 제2트랜스포머50: output voltage controller T1, T2: first and second transformer
본 고안은 전압변환 전원회로에 관한 것으로, 특히 수평주파수에 따른 전압변환 제어회로에 관한 것이다.The present invention relates to a voltage conversion power supply circuit, and more particularly to a voltage conversion control circuit according to the horizontal frequency.
통상적으로 영상신호를 디스플레이하는 모니터(Monitor) 또는 그밖의 전자기기에는 소망하는 곳에 소정의 전원을 공급하기 위한 전원제어회로를 내장하고 있게된다.Typically, a monitor or other electronic device displaying an image signal has a power control circuit for supplying predetermined power to a desired place.
특히 영상신호를 디스플레이하는 모니터 또는 TV등과 같은 전원전압이 고정입력되게 되어있어, 수평주파수가 단일의 것이 아닐 경우에 문제가 되어왔다. 예를 들면 CGA, EGA, VGA와 같은 신호를 입력하여 디스플레이하도록 하는 멀티 모니터(수평주파수를 멀티로 입력하여 자동변환하는 모니터)인 경우 상기 모드(Mode)에 해당하는 FBT의 일차측 전압을 제공할 수 없었다.In particular, since a power supply voltage such as a monitor or a TV displaying a video signal is fixedly input, there has been a problem when the horizontal frequency is not a single one. For example, in the case of a multi-monitor (a monitor that automatically inputs and converts a horizontal frequency into multi) to input and display signals such as CGA, EGA, and VGA, the primary voltage of the FBT corresponding to the mode may be provided. Could not.
따라서 본 고안의 목적은 수평주파수에 따라 발생되는 소정의 전압에 의해 FBT의 일차측에 공급되는 전압을 변환되도록하는 전압변환회로를 제공함에 있다.Accordingly, an object of the present invention is to provide a voltage conversion circuit for converting a voltage supplied to a primary side of an FBT by a predetermined voltage generated according to a horizontal frequency.
이하 본 고안을 첨부한 도면을 참조하여 상세히 설명한다.Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.
제1도는 본 고안에 따른 회로도로서, 소정 교류전원의 입력을 일차측 및 이차측의 권선비에 따른 권선비로 유기출력하는 제1트랜스포머(T1)와, 상기 제1트랜스포머 (T1)의 이차측 출력 일단에 접속되어 상기 유기출력전압을 정류출력하는 정류다이오드 (D1)와 상기 정류다이오드(D1)의 출력단과 접지단에 접속되어 상기 정류전압을 평활하는 캐패시터(C1)으로 구성된 정류평활부(10)와, 상기 정류다이오드 (D1)의 출력단에 일차권선(Na)의 일측이 접속되고, 상기 일차권선(Na)에 전류통로 형성시 소정 권선비를 각각 가지는 이차측의 제1, 제2권선(Nb)(Nc)으로 이를 유기출력하는 제2트랜스포머(T2)와, 콜렉터가 상기 제2트랜스포머(T2)의 일차권선(Na)의 타측에 접속되고 에미터가 상기 이차권선(Nb)(Nc)의 공통접속노드에 접속되어 베이스에 소정 드라이브 입력시 상기 제2트랜스를 드라이브하는 트랜지스터(Q1)와 상기트랜지스터(Q1)의 에미터로부터 베이스로 접속되어진 다이오드(D2)로 구성된 드라이브부 (30)와, 상기 제1트랜스포머(T1)의 출력을 정류하는 정류다이오드(D1)의 출력단과 상기 드라이브부 (30)내 트랜지스터(Q1)의 베이스에 접속된 저항(R1)과 상기 저항(R1)과 상기 제2트랜스포머(T2)의 이차측 제2권선(Nc)의 출력단자 사이에 직렬 접속된 저항(R2) 및 캐패시터(C3)와, 상기 저항(R22), 캐패시터(C3)와 병렬 접속된 저항(R3) 및 캐패시터 (C2)로 구성되어 소정 시정수에 의한 전압으로 상기 드라이브부 (30)내의 트랜지스터(Q1)을 스위칭하는 기동부(20)와, 상기 제2트랜스포머(T2)의 이차측 제1권선 (Nb)양단에 직렬접속되어 상기 이차측 제1권선(Nb)의 출력을 소정 제1전압으로 분압하는 저항(R6) 및 저항(R7)과, 상기 제2트랜스포머(T2)의 이차측 제1권선 (Nb)양단에 직렬접속되어 소정레벨의 제2전압으로 분압출력하는 저항(R5) 및 제너다이오드 (ZD1)와, 상기 드라이브부(30)의 트랜지스터(Q1)의 에미터와 베이스에 콜렉터와 에미터가 접속되며 소정 제어 입력에 의해 상기 트랜지스터(Q1)의 스위칭을 제어하는 트랜지스터(Q2)와 콜렉터가 상기 트랜지스터(Q2)의 베이스에 접속되고 에미터가 상기 제너다이오드(ZD1)와 저항(R5)의 접속노드에 접속되어 상기 제1전압에 의해 동작되어 상기 트랜지스터 (Q2)를 제어하는 트랜지스터(Q3)로 구성된 스위칭 제어부(40)와, 상기 제2트랜스포머(T2)의 이차측 제1권선(Nb)의 양단사이에 직렬 접속된 저항(R8), 캐패시터(C8), 저항(R10)과 상기 저항(R8)과 캐패시터(C8) 접속단자에는 콜렉터가 접속되고 에미터는 접지에 일측이 접속된 캐패시터(C6)의 타측에 접속되며 사이 저항(R9)과 (R10)의 접속노드에 베이스가 접속되어 상기 베이스의 입력신호에 따라 동작되어 소정전압신호를 상기 스위칭부(40)의 저항(R6)(R7)의 접속노드에 입력하는 트랜지스터(Q4)와 피제어전압 입력단자(K)와 상기 트랜지스터(Q4) 베이스사이에 직렬 접속되어진 저항 (R11)과 가변저항(VR1)으로 구성된 제어부(50)로 구성된다.FIG. 1 is a circuit diagram according to the present invention, and includes a first transformer T1 for organically outputting an input of a predetermined AC power at a winding ratio according to a winding ratio of a primary side and a secondary side, and an output end of a secondary side of the first transformer T1. A rectification diode D1 connected to the rectifier diode D1 for rectifying and outputting the organic output voltage, and a rectifier smoothing part 10 including a capacitor C1 connected to an output terminal of the rectifying diode D1 and a ground terminal to smooth the rectified voltage; One side of the primary winding Na is connected to an output terminal of the rectifying diode D1, and the first and second windings Nb on the secondary side each having a predetermined turns ratio when forming a current path in the primary winding Na ( The second transformer T2 which organically outputs it to Nc) and the collector are connected to the other side of the primary winding Na of the second transformer T2, and the emitter is connected to the secondary windings Nb and Nc in common. Connected to the node and the predetermined drive input to the base A rectifier diode for rectifying the output of the first transformer T1 and the drive unit 30 comprising a transistor Q1 for driving two transistors, a diode D2 connected to the base from an emitter of the transistor Q1. Of the second winding of the secondary side of the resistor R1 and the resistor R1 and the second transformer T2 connected to the output terminal of D1 and the base of the transistor Q1 in the drive section 30; A resistor (R2) and a capacitor (C3) connected in series between the output terminals, and a resistor (R3) and a capacitor (C2) connected in parallel with the resistor (R22), the capacitor (C3) and the voltage by a predetermined time constant In this case, the starter 20 for switching the transistor Q1 in the drive unit 30 and the secondary side first winding Nb of the second transformer T2 are connected in series to each other. A resistor R6 and a resistor R7 for dividing the output of Nb to a predetermined first voltage, and the second transformer ( A resistor R5 and Zener diode ZD1 connected in series across the first winding Nb of the secondary side of T2 and divided by a second voltage having a predetermined level, and the transistor Q1 of the drive unit 30. The collector and the emitter are connected to the emitter and the base, and the transistor Q2 and the collector, which control the switching of the transistor Q1 by a predetermined control input, are connected to the base of the transistor Q2, and the emitter is connected to the zener diode. A switching controller 40 comprising a transistor Q3 connected to a connection node of the ZD1 and the resistor R5 and operated by the first voltage to control the transistor Q2, and the second transformer T2. The collector is connected to the resistor R8, the capacitor C8, the resistor R10 and the resistor R8 and the capacitor C8 connecting terminals connected in series between both ends of the first winding Nb of the secondary side. Is connected to the other side of the capacitor (C6) that one side is connected to the ground The base is connected to the connection node between the resistors R9 and R10 and operated according to the input signal of the base to input a predetermined voltage signal to the connection node of the resistors R6 and R7 of the switching unit 40. The control unit 50 includes a resistor R11 and a variable resistor VR1 connected in series between the transistor Q4, the controlled voltage input terminal K, and the base of the transistor Q4.
상기 제2도중 미설명부호 C5와 C9는 평활 캐패시터이고, C4, C7은 노이즈 제어용이다. 그리고 K1은 제2트랜스포머(T2)의 이차측 제1권선(Nb)의 출력단자이다.In FIG. 2, reference numerals C5 and C9 are smoothing capacitors, and C4 and C7 are for noise control. K1 is an output terminal of the first winding Nb of the secondary side of the second transformer T2.
이때 상기 단자 K1은 도시하지 않은 FBT의 일차측 전원전압으로 공급되는 단자이며, K2는 상기 FBT의 차측으로 부터 피이드 백되는 전원입력단자이다.At this time, the terminal K1 is a terminal supplied with the primary side power voltage of the FBT (not shown), and K2 is a power input terminal fed back from the secondary side of the FBT.
제2도는 제1도의 회로동작에 의한 출력상태를 설명하기 위한 것으로, VK1은 K1의 출력전압이고, VK2는 K2의 입력전압이다.2 is for explaining the output state by the circuit operation of FIG. 1, where VK1 is an output voltage of K1 and VK2 is an input voltage of K2.
상기 제2도를 보면 전압 VK2의 감소에 따라서 VK의 전압이 증가됨을 알 수 있다.Referring to FIG. 2, it can be seen that the voltage of VK increases as the voltage VK2 decreases.
이하 본 고안의 동작예를 상세히 설명한다.Hereinafter, an operation example of the present invention will be described in detail.
지금 제1트랜스포머(T1)의 일차측에 소정레벨의 교류전원(AC)가 입력되면, 제2트랜스포머(T1)의 이차측에는 소정 권선비에 따른 전압이 출력된다.When the AC power AC having a predetermined level is input to the primary side of the first transformer T1, the voltage corresponding to the predetermined turns ratio is output to the secondary side of the second transformer T1.
상기 제1트랜스포머(T1)의 출력전압은 정류다이오드(D1)에 의해 정류되어진 후 캐패시터(C1)에 의해 평활되어 제2트랜스포머(T2)의 일차권선이 입력된다. 또 상기 전압은 저항(R1)과 (R2)(R3)를 통해 캐패시터(C3) 및 (C2)에 충전된다.The output voltage of the first transformer T1 is rectified by the rectifying diode D1 and then smoothed by the capacitor C1 so that the primary winding of the second transformer T2 is input. The voltage is charged to capacitors C3 and C2 through resistors R1 and R2 and R3.
상기 캐패시터(C2)에 소정 레벨은 전압이 충전되면 이는 트랜지스터(Q1)의 베이스로 입력되며, 이로인해 상기 트랜지스터(Q1)은 ˝턴온˝스위칭되어진다. 이때 상기한 제2트랜스포머(T2)의 일차권선에 입력되는 소정전압의 전류패스는 트랜지스터 (Q1)의 콜렉터-에미터간을 통해 흐르게되어 전류루프가 형성된다.When the capacitor C2 is charged at a predetermined level, it is input to the base of the transistor Q1, which causes the transistor Q1 to be switched on. At this time, the current path of the predetermined voltage input to the primary winding of the second transformer T2 flows through the collector-emitter of the transistor Q1 to form a current loop.
따라서 상기 트랜지스터(Q1)은 ˝온˝스위칭에 의해 상기 제2트랜스포머(T2)가 구동되며, 이로인해 상기 제1트랜스포머(T2)의 이차측 제1권선(Nb) 및 제2권선 (Nc)에는 소정전압이 유기출력된다.Therefore, the second transformer T2 is driven by the on-on switching of the transistor Q1, and thus, the second transformer T2 is connected to the first winding Nb and the second winding Nc of the first transformer T2. The predetermined voltage is organically output.
이때 상기한 트랜지스터(Q1)을 구동하기 위한 전압은 캐패시터(C2)양단에 걸리게 되며 이 전압을Nd라 하면 하기 식(1)과 같다.At this time, the voltage for driving the transistor (Q1) is applied across the capacitor (C2), and when the voltage is Nd as shown in the following equation (1).
* KV1은 단자K1의 출력전압이다.* KV1 is the output voltage of terminal K1.
상기한 제2트랜스포머(T2)의 구동에 의해 단자K1 라인과 K3라인사이에는 소정전압KV이 출력되며, 이는 저항(R6)과 (R7)에 의해 하기식(2)와 같이 분압된다.The predetermined voltage KV is output between the terminal K1 line and the K3 line by the driving of the second transformer T2, which is divided by the resistors R6 and R7 as shown in Equation 2 below.
따라서 트랜지스터(Q3)은 상기식(2)와 같이 분압입력되는 전압에 의해 턴온되며, 이로인해 트랜지스터(Q2)의 베이스에는 상기 트랜지스터(Q3)의 콜렉터로 부터 출력되는 소정 상태의 신호에 의해 ˝온˝된다.Therefore, the transistor Q3 is turned on by the voltage input by the divided voltage as in Equation (2), so that the base of the transistor Q2 is turned on by a signal of a predetermined state output from the collector of the transistor Q3. do.
상기 트랜지스터(Q2)의 턴온에 의해 상기한 스위칭 트랜지스터(Q1)은 오프된다.The switching transistor Q1 is turned off by turning on the transistor Q2.
이때 기동부(20)은 캐패시터(C2)에는 소정전압이 충전되기시작하고, 저항 (R6)(R7)의 분압은 점점 적어지게 되어 트랜지스터(Q3)가 오프된다. 따라서 트랜지스터(Q2)가 오프되며, 상기 트랜지스터(Q2)의 오프에 의해 트랜지스퍼머(Q1)은 캐패시터(C2)의 전압에 의해 다시 ˝온˝된다.At this time, the starter 20 starts to charge the capacitor C2 with a predetermined voltage, and the partial pressure of the resistors R6 and R7 decreases gradually, so that the transistor Q3 is turned off. Therefore, transistor Q2 is turned off, and by turning off transistor Q2, transistor Q1 is turned on again by the voltage of capacitor C2.
그러므로 상기 스위칭 트랜지스터(Q1)은 기동부(20)과 스위칭부(40)의 제어에 이해 스위칭되는데 출력단자 K1-K3의 전압이 하기식(3)과 같도록 스위칭된다.Therefore, the switching transistor Q1 is switched under the control of the starter 20 and the switch 40. The voltage of the output terminals K1-K3 is switched to be equal to the following equation (3).
단자 K1-K3의 전압은 VK1이다.The voltage at terminals K1-K3 is VK1.
VZD : 제너다이오드의 전압VZD: Zener Diode Voltage
VBEQ3 : 트랜지스터(Q3)의 베이스-에미터간의 전압VBEQ3: Voltage between base-emitter of transistor Q3
이때 상기 VK1의 전압은 저항(R6) 또는 (R7)을 가변하여 트랜지스터(Q3)의 베이스로 입력되는 전압을 가변함으로써 가변할 수 있다.In this case, the voltage of the VK1 may be varied by varying the voltage input to the base of the transistor Q3 by varying the resistor R6 or R7.
상기의 동작에 의해 제2트랜스포머(T2)의 이차측 제1권선(Nb)로 부터 출력되는 전압VK1은 평활 패시터(C5)와 (C9)에 의해 평활되어진 후 도시하지 않은 FBT의 일차측 전원전압으로 입력된다.By the above operation, the voltage VK1 output from the secondary side first winding Nb of the second transformer T2 is smoothed by the smoothing capacitors C5 and C9, and then the primary side power supply of the FBT (not shown). The voltage is input.
상기한 VK1의 전압을 입력하는 FBT회로는 공지된 바와같이 상기한 전압을 입력수평주파수에 따라 전압변환하여 소정의 주사빔을 발생키위한 고전압을 출력하는 회로이다.The FBT circuit for inputting the voltage of VK1 is a circuit for outputting a high voltage for generating a predetermined scanning beam by converting the voltage according to the input horizontal frequency as is known.
예를 들면 수평주파수가 15.8KHz이고 FBT의 전원이 52V인 경우 소정의 고전압을 출력하고, 18.53V의 피이드 백전압(A)을 출력한다.For example, when the horizontal frequency is 15.8 KHz and the power supply of the FBT is 52 V, a predetermined high voltage is output and a feed back voltage A of 18.53 V is output.
수평주파수가 22KHz이고 FBT의 전원이 52V인 경우 18.50V을 피이드백 전압(B)으로 이차측에서 출력하며, 수평주파수가 30.47KHz이고 52가 FBT의 전원으로 인가되는 경우 18.43V(C)가 FBT의 이차측으로 부터 피이드백출력된다.When the horizontal frequency is 22KHz and the FBT is 52V, 18.50V is output from the secondary side as the feedback voltage (B). When the horizontal frequency is 30.47KHz and 52 is applied as the power of FBT, 18.43V (C) is FBT. The feedback is output from the secondary side of.
다라서 종래의 FBT회로는 입력수정 주파수가 증가하면 피이드백 전압은 감소된다.Therefore, in the conventional FBT circuit, the feedback voltage decreases as the input correction frequency increases.
상기와 같은FBT으로 부터 피이드 백되어지는 피이드백 전압이 제1도의 단자K2로 입력되면, 이는 저항(R11)과 가변저항(VR1)과 저항(R10)에 의해 하기 4식과 같이 저항분압되어 트랜지스터(Q4)의 베이스에 입력된다.When the feedback voltage fed back from the FBT is inputted to the terminal K2 of FIG. 1, it is divided by the resistor R11, the variable resistor VR1, and the resistor R10 as shown in the following four equations. It is input to the base of Q4).
KV2는 단자 K2로 입력되는 전압으로 FBT의 피이드 백전압이다(피제어전압)KV2 is the voltage input to terminal K2 and is the feed back voltage of FBT (controlled voltage).
따라서 상기 트랜지스터(Q4)는 저항(R11), 가변저항(VR1), 저항(R10)의 입력에 의해 동작되어 저항(R8)을 통해 입력되는 전압을 콜렉터-에미터를 통해 전술한 저항(R6)(R7)의 접속노드에 입력된다.Accordingly, the transistor Q4 is operated by inputs of the resistor R11, the variable resistor VR1, and the resistor R10 to receive the voltage input through the resistor R8 through the collector-emitter and the resistor R6 described above. It is input to the connection node of R7.
이때 상기 트랜지스터(Q4)는 단자 K2로 입력되는 VK2전압에 따라 동작되어 베이스에 입력되는 전압에 비례하여 증가되는 제어전압을 전술한 저항(R6)(R7)의 저항분압전압에 충접시킨다.At this time, the transistor Q4 is operated in accordance with the voltage VK2 input to the terminal K2 to bring the control voltage increased in proportion to the voltage input to the base to the resistance divided voltage of the resistors R6 and R7 described above.
즉 제어부(50)는 입력단자 K2로 입력되는 전압 VK2가 크면 큰 제어전압을 출력하고 적어지면 적온량의 제어전압을 제2식과 같은 전압에 중첩시키는 전자 가변저항으로 동작된다.That is, the controller 50 operates as an electronic variable resistor that outputs a large control voltage when the voltage VK2 input to the input terminal K2 is large and superimposes the control voltage of the temperature on the same voltage as that of the second equation when the voltage VK2 is large.
그러므로 트랜지스터(Q3)의 베이스에 입력되는 신호는 전술한 제(2)식의 전압과 상기 트랜지스터(Q4)의 출력전압이 중첩되어 입력된다.Therefore, the signal input to the base of the transistor Q3 is inputted by overlapping the above-described voltage of formula (2) with the output voltage of the transistor Q4.
따라서 전술한 제3식과 같은 전압은 하기식(5)와 같이 출력된다.Therefore, the voltage similar to the above-described third equation is output as shown in Equation 5 below.
상기 4식에서 Req는 V전압에 따라 가변되며, Va전압은 전술한 제4식에 의한 전압으로 VK2, 저항(R10), 가변저항(VR1), 저항(R11)에 따라 가변된다.In the equation 4, Req is variable according to the V voltage, and the Va voltage is variable according to VK2, resistor R10, variable resistor VR1, and resistor R11 as the voltage according to the fourth equation.
따라서 도시하지 않은 FBT의 수평주파수 입력이 증가되어 단자K2에 입력되는 피제어전압VK2가 가감되면 전술한 트랜지스터(Q4)의 에미터로 부터 출력되는 전압이 증가되어 트랜지스터(Q3)의 동작을 제어하여 트랜지스터(Q2)의 온, 오프 동작속도를 제어함으로써 수평주파수에 따라 변화되어지는 FBT의 피이드 백전압인 제어진압 VK2에 의해 단자K1의 출력전압 VK을 제어 제2도와 같이 출력전압KV1은 조절하게 된다.Therefore, when the horizontal frequency input of the FBT (not shown) is increased and the controlled voltage VK2 inputted to the terminal K2 is decreased, the voltage output from the emitter of the above-described transistor Q4 is increased to control the operation of the transistor Q3. By controlling the on and off operation speed of the transistor Q2, the output voltage KV1 of the terminal K1 is controlled by the control suppression VK2, which is a feedback back voltage of the FBT, which is changed according to the horizontal frequency. .
즉 FBT의 피이드 백전압인 피제어전압 KV2가 제2도와 같이 KV2MIN에서 VK2MAX로 증가되면 단자K1으로 출력되는 전압VK1은 VK1MAX에서 VKMIN으로 된다. 이와 반대로 VK2가 MAX에서 감소되면 VK1이 KV1MIN에서 KV1MAX로 증가된다.That is, when the controlled voltage KV2, which is the feed back voltage of the FBT, is increased from KV2MIN to VK2MAX as shown in FIG. 2, the voltage VK1 output from the terminal K1 becomes VKMIN from VK1MAX. Conversely, when VK2 decreases in MAX, VK1 increases from KV1MIN to KV1MAX.
상술한 바와같이 본 고안은 FBT의 일차측에 인가되는 전압을 수평주파수에 따라 상기 FBT의 이차측에서 피이드 백출력되는 전압으로 제어출력함으로, 입력 수평주파수에 따른 FBT의 일차측 전원을 항시 자동공급할 수 있어 수평주파수를 멀티화하여 고해상도의 영상을 실현할 수 있다.As described above, the present invention controls and outputs the voltage applied to the primary side of the FBT to a voltage fed back from the secondary side of the FBT according to the horizontal frequency, thereby automatically supplying the primary side power of the FBT according to the input horizontal frequency at all times. Therefore, the horizontal frequency can be multiplexed to realize a high resolution image.
Claims (3)
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| KR2019890006081U KR920000913Y1 (en) | 1989-05-10 | 1989-05-10 | Voltage changing power supply circuit |
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| KR900021360U KR900021360U (en) | 1990-12-15 |
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| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019890006081U KR920000913Y1 (en) | 1989-05-10 | 1989-05-10 | Voltage changing power supply circuit |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR920000913Y1 (en) |
-
1989
- 1989-05-10 KR KR2019890006081U patent/KR920000913Y1/en not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR900021360U (en) | 1990-12-15 |
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