KR910005607A - 평활 필터 - Google Patents

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KR910005607A
KR910005607A KR1019900012159A KR900012159A KR910005607A KR 910005607 A KR910005607 A KR 910005607A KR 1019900012159 A KR1019900012159 A KR 1019900012159A KR 900012159 A KR900012159 A KR 900012159A KR 910005607 A KR910005607 A KR 910005607A
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KR1019900012159A
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Inventor
에스. 펄로프 로날드
엘. 가버릭 티모디
Original Assignee
존 지. 웨브
내쇼날 세미컨덕터 코포레이션
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    • H04—ELECTRIC COMMUNICATION TECHNIQUE
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    • H04—ELECTRIC COMMUNICATION TECHNIQUE
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    • H04L12/00—Data switching networks
    • H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
    • H04L12/42—Loop networks
    • H04L12/427—Loop networks with decentralised control
    • H04L12/433—Loop networks with decentralised control with asynchronous transmission, e.g. token ring, register insertion

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Communication Control (AREA)

Abstract

내용 없음

Description

평활 필터
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 따른 평활 필터를 예시하는 흐름도,
제5도는 제4도에 도시된 흐름도의 논리이행을 예시하는 논리 다이어그램.

Claims (24)

  1. 복수개의 트리앰블 정보문자의 시퀀스를 포함하는 일련의 정보문자로 이루어진 정보 프레임이 데이타 전송 네트 워크에 있는 송신 스테이션으로 부터 전송되는 데이타 전송 네트 워크에 있어서, 상기 시퀀스에 포함되는 프리앰블 정보문자의 수를 제어하는 방법은, (a)초기 프리앰블 정보문자로서 정보문자를 식별하는 단계, (b)바로 전 프레임의 프리앰블이 확장되어진 경우에, 초기 프리엠블 정보문자를 삭제하는 단계,(c)다음으로 이어지는 정보문자가 프리앰블 정보문자인 경우에, 계수기를 증분시키는 단계, (d)상기 계수기가 프리세트 임계치에 도달할 때까지 프리앰블 정보문자의 시퀀스를 식별하도록(c)단계를 반복하여, 프리앰블 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내는 단계를 순차적으로 포함하는 방법.
  2. 제1항에 있어서, 상기 계수기가 이미 선택된 수에 도달하지 않는 경우에, 프리앰블 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스 이하가 처리되어지는 것을 나타내므로 프리앰블 정보문자를 삽입하는 단계를 포함하는 방법.
  3. 복수개의 IDLE 바이트에 대한 연속적이 시퀀스로 이루어진 초기 프리앰블을 포함하는 일련의 정보바이트로 이루어진 정보 프레임이 송신기능으로 부터 수신기능으로 전송되는 FDDT 네트 워크에 있어서, 상기 프리앰블을 확장시키거나 축소시키는 방법은, (a)초기 IDLE 바이트로서 정보 바이트를 식별하여 새로운 프리앰블의 개시를 나타내는 단계,(b)바로 전 프레임이 프리앰블이 확장되어진 경우에 초기 IDLE 바이트를 삭제함으로써 새로운 프리블을 축소시키는 단계, (c)다음으로 이어지는 정보바이트가 IDLE바이트인 경우, 계수기를 증분시키는 단계, (d)상기 계수기가 프리세트 한계치에 도달할 때까지 IDLE 바이트의 시퀀스를 식별하도록 (c)단계를 반복하여, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내는 단계를 순차적으로 포함하는 방법.
  4. 제3항에 있어서, 상기 계수기가 상기 프리세트 한계치에 도달하지 않을 경우에, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스 이하가 처리되어지는 것을 나타내므로 IDLE 바이트를 삽입시킴에 위하여 상기 프리앰블을 확장시키는 단계를 포함하는 방법.
  5. 복수개의 프리앰블 정보문자에 대한 연속적인 시퀀스로 이루어진 초기 프리앰블을 포함하는 일련의 정보 바이트로 이루어진 정보 프레임이 데이타 전송 네트워크의 송신 스테이션으로 부터 상기 데이타 전송 네트워크의 수신 스테이션으로 전송되는 데이타 전송 네트워크에 있어서, 상기 시퀀스에 포함된 프리앰블 정보문자의 수를 제어하느 장치는 (a)초기 프리앰블 정보문자로서 정보문자를 식별하는 수단 (b)바로 전 프레임의 프리앰블이 확장되어진 경우에 초기 프리앰블 정무분자를 삭제하는 수단, (c)다음으로 이어지는 정보문자가 프리앰블 정보문자인지를 식별하도록 상기 다음으로 이어지는 정보문자를 조사하는 수단, (d)계수기, (e)상기 다음으로 이어지느 수신 정보문자가 프리앰블 정보문자인 경우 상기 계수기를 증분시키는 수단 (f)상기 계수기가 프리세트 한계치에 도달할 때까지, 프리앰블 정보문자의 시퀀스를 식별하도록 정보문자를 반복적으로 조사하여, 프리앰블 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내는 수단을 포함하는 장치.
  6. 제5항에 있어서, 상기 계수기가 상기 프리세트 한계치에 도달하지 않을 경우에 프리앰블 정보문자를 삽입하여, 프리앰블 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스 이하가 처리되어지는 것을 나타내는 수단을 더우기 포함하는 장치.
  7. 복수개의 IDLE바이트에 대한 연속적인 시퀀스로 이루어진 초기 프리앰블을 포함하는 일련의 정보바이트로 이루어진 정보 프레임이 송신 기능으로 부터 수신기능으로 전송되는 FDDI 네트 원크에 있어서, 상기 프리앰블을 확장시키거나 축소하는 회로는, (a)초기 IDLE 바이트로서 정보 바이트를 식별하여, 새로운 프리앰블의 개시를 나타내는 수단, (b)바로 전 프레임의 프리앰블이 확장되어진 경우에, 초기 IDLE 바이트를 삭제시킴으로써 상기 새로운 프리앰블을 축소시키는 수단, (c)다음으로 이어지는 정보바이트가 IDLE 바이트인지를 식별하도록 상기 다음으로 이어지는 정보 바이트를 조사하는 수단, (d)계수기, (e) 상기 다음으로 이어지는 정보바이트가 ILDE 바이트인 경우 상기 계수기를 증분시키는 수단 (f)상기 계수기가 프리세트 한계치에 도달할 때까지, IDLE 바이트의 시퀀스를 식별하도록 정보 바이트를 반복적으로 조사하여, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 나타내는 수단을 포함하는 회로.
  8. 제7항에 있어서, 상기 계수기가 상기 프리세트 한계치에 도달하지 않을 경우에, IDLE 바이트를 삽입시킴으로써 상기 프리앰블을 확장하므로, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스 이하가 처리되어지는 것을 나타내는 수단을 더우기 포함하는 회로.
  9. 복수개의 프리앰블 정보문자에 대한 시퀀스를 포함하는 일련의 정보문자로 이루어진 정보 프레임이 데이타 전송 네트 워크에 있는 송신 스테이션으로 부터 상기 데이타 전송 네트 워크에 있는, 송신 스테이션으로 부터 상기 데이타 전송 네트워크에 는 수신 스테이션으로 부터 상기 데이타 전송 네트워크에 있는 수송 스테이션으로 전송되는 데이타 전송네트워크에 있어서, 상기 시퀀스에 포함된 프리앰블 정보문자의 수를 제어하는 방법은, (a) 초기 프리앰블 정보문자로서 정보문자를 식별하는 단계, (b)초기 프리앰블 정보문자에 바로전 프레임이 프레임부분인 경우에 상기 초기 프리앰브 ㄹ정보문자 바로전의 정보문자를 삭제하는 단계, (c)상기 다음으로 이어지는 정보분자가 프리앰블 정보문자인 경우에, 계수기를증분시키는 단계, (d)상기 계수기가 프리세트 한계치에 도달할 때까지 프리앰블 정보문자의 시퀀스를 식별하도록 (c)단계를 반복하여, 프리앰블 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내는 단계를 순차적으로 포함하는 방법.
  10. 제9항에 있어서, 상기 계수기가 상기 미리 선택된 수에 도달하지 않는 경우에, 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스 이하가 처리되어지는 것을 나타내므로 프리앰블 정보문자를 삽입하는 단계를 포함하는 방법.
  11. 복수개의 IDLE 바이트에 대한 연속적이 시퀀스로 이루어진 초기 프리앰블을 포함하는 일련의 정보 바이트로 이루어진 정보 프레임이 송신 기능으로 부터 전송되는 FDDT 네트 워크에 있어서, 상기 프리앰블을 확장시키거나 축소시키는 방법은 (a)초기 IDLE 바이트로서 정보 바이트를 식별하는 단계, (b) 상기 초기 IDLE 바이트 이전의 프레임이 프레임 부분일 경우에, 상기 초기 IDLE 바이트 바로전의 정보바이트를 삭제하는 단계, (c) 상기 다음으로 이어지는 정보 바이트가 IDLE 바이트인 경우에, 계수기를 증분시키는 단계, (d) 상기 계수기가 프리세트 한계치에 도달할 때까지 IDLE 바이트의 시퀀스를 식별하도록 (c) 단계를 반복하여, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되는 것을 나타내는 단계를 순차적으로 포함하는 방법.
  12. 제11항에 있어서, 상기 계수기가 상기 프리세트 임계치에 도달하지 않은 경우에, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스 이하가 처리되어지는 것을 나타내므로, IDLE 바이트를 삽입시킴으로써 상기 프리앰블을 확장하는 단계를 포함하는 방법.
  13. 복수개의 트리앰블 정보문자에 대한 시퀀스를 포함하는 일련의 정보문자로 이루어진 정보프레임이 데이타 전송 네트워크에 있는 송신 스테이션으로 부터 상기 데이타 전송 네트워크에 있는 수신 스테이션으로 전송되는 데이타 전송 네트워크에 있어서, 상기 시퀀스에 포함되는 프리앰블 정보 문자의 수를 제어하는 장치는, (a) 초기 프리앰블 정보문자로서 정보문자를 식별하는 수단, (b) 바로 전 프레임이 프레임 부분인 경우에 상기 초기 프리앰블 정보문자의 바로전 정보문자를 삭제하는 수단, (c) 다음으로 이어지는 정보문자가 프리앰블 정보문자인 지를 식별하도록 상기 다음으로 이어지는 정보문자를 조사하는 수단, (d) 계수수 (e) 상기 다음으로 이어지는 정보문자가 프리앰블 정보문자인 경우에 상기 계수기를 증분시키는 수단, (f) 상기 계수기가 프리세트 임계치에 도달할때까지 프리앰블 정보문자에 대한 시퀀스를 식별하도록 정보문자를 반복적으로 조사하여, 프리앰블 정보문자의 미리 선택된 수에 대한 연속적이 시퀀스가 처리되어지는 것을 나타내는 수단을 포함하는 장치.
  14. 제13항에 있어서, 상기 계수기가 상기 프리세트 임계치에 도달하지 않은 경우에 프리앰블 정보문자를 삽입시켜서 프리앰블 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스이하가 처리되어지는 것을 나타내는 수단을 더우기 포함하는 방법.
  15. 복수개의 IDLE 바이트에 대한 연속적인 시퀀스로 이루어진 초기 프리앰블을 포함하는 일련의 정보 바이트로 이루어진 정보 프레임이 송신기능으로 부터 수신 기능으로 전송되는 FDDT 네트 워크에 있어서, 상기 프리앰블을 확장시키거나 축소하는 회로는, (a) 초기 IDLE 바이트로서 정보 바이트를 식별하여, 새로운 프리앰블의 개시를 나타내는 수단, (b) 바로 전의 프레임이 프레임임 부분인 경우 상기 초기 IDLE바이트 바로전의 정보바이트를 삭제하는 수단, (c) 다음으로 이어지는 정보바이트가 IDLE 바이트인지를 식별하도록 상기 다음으로 이어지는 정보 바이트를 조사하는 수단, (d) 계수기, (e) 상기 다음으로 이어지는 정보 바이트가 IDLE 바이트인 경우 상기 계수기를 증분시키는 수단, (f) 상기 계수기가 프리세트 임계치에 도달할 때까지 IDLE 바이트의 시퀀스를 식별하도록 정보 바이트를 반복적으로 조사하여 IDLE바이트의 미리 절정된 수에 대한 연속적인 시퀀스가 처리되어지는 나타내는 수단을 포함하는 회로.
  16. 제15항에 있어서, 상기 계수기가 상기 프리세트 임계치에 도달하지 않은 경우에 IDLE 바이트를 삽입시킴으로써 상기 프리앰블을 확장하여, IDLE바이트의 미리 선택된 수에 대한 연속적인 시퀀스 이하가 처리되어지는 것을 나타내는 수단을 더우기 포함하는 방법.
  17. 복수개의프리앰블 정보문자의 시퀀스르 포함하는 일련의 정보문자로 이루어진 정보 프레임이 데이타 전송 네트 워크에 있는 송신 스테이션으로 부터 상기 데이타 전송 네트 워크에 있는 수신 스테이션으로 전송되는 데이타 전송 네트워크에 있어서, 상기 시퀀스에 포함된 프리앰블 정보문자의 수를 제어하는 방법은, (a) 프리앰블 정보문자를 식별하지 않지만 계수기의 리세트를 유지하는 단계, (b) 초기 프리앰블 정보문자의 식별에 따라 상기 계수기를 해제하는 단계, (c) 바로전의 프레임이 프레임 부분인지를 결정하는 단계, (d) 바로전 프레임의 프리앰블이 확장되어지고 상기바로전 프레임이 프레임 부분이 아닌 경우에, 상기 초기 프리앰블 정보문자를 삭제하는 단계, (e)바로전 프레임이 프리앰블이 확장되어지고 상기 바로전의 프레임이 프레임 부분인 경우에, 상기 프레임 부분의 마지막 정보문자를 삭제하는 단계, (f) 다음으로 이어지는 정보문자가 프리앰블 정보문자인 경우에, 상기 계수기를 증분시키는 단계, (g) 상기 계수기가 프리세트 임계치에 도달할 때까지 프리앰블 정보문자의 시퀀스를 식별하도록 (f) 단계를 반복하여 프리앰블 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내는 단계를 포함하는 방법.
  18. 제17항에 있어서, 상기 계수기가 상기 프리세트 임계치에 도달하지 않은 경우에, 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내므로 프리앰블 정보문자를 삽입시키는 단계를 포함하는 방법.
  19. 복수개의 IDLE 바이트에 대한 연속적인 시퀀스로 이루어진 초기 프리앰블을 포함하는 일련의 정보 바이트로 이루어진 정보 프레임이 송신기능으로 부터 수신 기능으로 전송되는 FDDI 네트 워크에 있어서, 상기 프리앰블을 확장시키거나 축소하는 방법은, (a) IDLE 바이트를 식별하지 않지만 계수기의 리세트를 유지시키는 단계, (b) 초기 IDLE바이트의 식별에 따라 상기 계수기를 해제하는 단계, (c) 바로전의 프레임이 프레임 부분인지를 결정하는 단계, (d) 바로전 프레임의 프리앰블이 확장되어지고, 상기 바로전의 프레임이 프레임 부분이 아닌 경우에 상기 초기 IDLE 바이트를 삭제하는 단계, (e)바로전 프레임의 프리앰블이 확장되어지고 상기 바로전의 프레임이프레임 부분인 경우에 상기 프레임 부분의 마지막 정보문자를 삭제하는 단계, (f) 다음으로 이어지는 정보분자가 IDLE 바이트인 경우에, 상기 계수기를 증분시키는 단계, (g) 상기 계수기가 프리세트 임계치에 도달할 때까지 IDLE 바이트의 시퀀스를 식별하도록 (f) 단계를 반복하여, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내는 단계를 포함하는 방법.
  20. 제19항에 있어서, 상기 계수기가 상기 프리세트 임계치에 도달하지 않은 경우에, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스 이하가 처리되어지는 것을 나타내므로, IDLE 바이트를 삽입시킴으로써 상기 프리앰블을 확장하는 단계를 포함하는 방법.
  21. 복수개의 프리앰블 정보문자에 대한 시퀀스를 포함하는 일련의 정보문자로 이루어진 정보 프레임이 데이타 전송 네트 워크에 있는 송신 스테이션으로 부터 상기 데이타 전송 네트 워크에 있는 수신 스테이션으로 전송되는 데이타 전송네트워크에 있어서, 상기 시퀀스에 포함된 프리앰블 정보문자의 수를 제어하는 장치는, (a) 계수기, (b) 프리앰블 정보문자를 식별하지 않지만 상기 계수기의 리세트를 유지하는 수단, (c) 초기 프리앰블 정보문자의 식별에 따라 상기 계수기를 해제하는 수단, (d) 바로전 프레임이 프레임 부분인지를 결정하는 수단, (e) 바로전 프레임의 프리앰블이 확장되어지고 상기 바로전 프레임이 부분이 아닌 경우에 상기 초기 프리앰블 정보분자를 삭제하는 수단, (f) 바로전 프레임의 프리앰블이 확장되어지고 상기 바로전의 프레임이 프레임 부분인 경우에 상기 프레임 부분의 마지막 정보분자를 삭제하는 수단, (g) 다음으로 이루어지는 정보문자가 프리앰블정보문자인 경우에 상기 계수기를 증분시키는 수단, (h) 상기 계수기가 프리세트 임계치에 도달할 때까지 프리앰블 정보분자의 시퀀스를 식별하도록 정보분자를 반복적으로 조사하여, 프리앰블 정보문자의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내는 수단을 포함하는 장치.
  22. 제21항에 있어서, 상기 계수기가 상기 프리세트 임계치에 도달하지 않은 경우에, 프리앰블 정보문자를 삽입하여, 프리앰블 정보 캐릭터의 미리 선택된 수에 대한 연속적인 시퀀스이하가 처리되어지는 것을 나타내는 수단을 더우기 포함하는 장치.
  23. 복수개의 IDLE 바이트의 연속적인 시퀀스로 이루어진 초기 프리앰블을 포함하는 일련의 정보 바이트로 이루어진 정보 프레임이 송신기능으로 부터 수신 기능으로 전송되는 FDDI 네트 워크에 있어서, 상기 프리앰블을 확장하거나 축소하는 회로는 (a) 계수기, (b) IDLE바이트를 식별하지 않지만 상기 계수기의 리세트를 유지하는 수단, (c) 초기 IDLE 바이트의 식별에 따라 상기 계수기를 해제하는 수단, (d) 바로전의 프레임이 프레임 부분인지를 결정하는 수단, (e) 바로전 프레임의 프리앰블이 확장되어지고 상기 바로전의 프레임 부분인 경우에 상기 초기 바이트를 삭제하는 수단, (f) 바로전 프레임의 프리앰블이 확장되어지고 상기 바로전의 프레임이 프레임 부분인 경우에 상기 프레임 부분의 마지막 정보분자를 삭제하는 수단, (g) 다음으로 이루어지는 정보 문자가 IDLE 바이트인 경우에 상기 계수기를 증분시키는 수단, (h) 상기 계수기가 프리세트 임계치에 도달할 때까지 IDLE 바이트의 시퀀스를 식별하도록 정보분자를 반복적으로 조사하여, IDLE 바이트의 미리 선택된 수에 대한 연속적인 시퀀스가 처리되어지는 것을 나타내는수단을 포함하는 회로.
  24. 제23항에 있어서, 상기 계수기가 상기 미리 선택된 임계치에 도달하지 않은 경우에 IDLE 바이트를 삽입시킴으로써 상기 프리앰블을 확장하여, IDLE 바이트의 밀 선택된 수에 대한 연속적인 시퀀스이하가 처리되어지는 것을 나타내는 수단을 더우기 포함하는 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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