KR890008735Y1 - Multi line detective circuit using controller - Google Patents
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Description
제1도는 본 고안의 회로의 블럭도.1 is a block diagram of a circuit of the present invention.
제2도는 본 고안의 상세한 회로도.2 is a detailed circuit diagram of the present invention.
제3도는 제2도의 주요 부분에 대한 입출력 파형도이다.3 is an input / output waveform diagram for the main part of FIG.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
1 : 클럭펄스 발생부 2 : 콘트롤러1: Clock pulse generator 2: Controller
3 : 분주기 4 : 디코더부3: Divider 4: Decoder
5 : 라인 드라이브단 6 : 카운터5: Line drive stage 6: Counter
7 : 멀티플렉서부 8 : 키보드7: multiplexer section 8: keyboard
9 : 라인넘버표시부 10 : 라인 상태 표시부9: line number display unit 10: line status display unit
본 고안은 콘트롤러를 사용한 복수라인 검사회로에 관한 것으로서, 특히 코넥터와 코넥터 사이에 연결된 다수의 라인 접속상태를 자동으로 검사하고 이에 따라 외부에 표시할수 있는 회로에 관한 것이다.The present invention relates to a multi-line inspection circuit using a controller, and more particularly, to a circuit capable of automatically inspecting a state of connection of a plurality of lines connected between a connector and a connector and accordingly displaying it externally.
일반적으로 코넥터와 코넥터사이에 연결된 라인은 한쪽의 코넥터단자와 다른쪽의 코넥터 단자에 일대 일로 대응되어야 한다.In general, a line connected between a connector and a connector should correspond one-to-one to one connector terminal and the other connector terminal.
그런데 코넥터와 코넥터 사이에 연결된 라인이 단선이 되거나 혹은 단락 및 교차가 되었을 경우에 코넥터에 접속된 기기들의 회로 소자 파괴로 인해서 오동작을 하였다.However, when the line connected between the connector and the connector is disconnected or short-circuited and crossed, the device malfunctions due to the destruction of the circuit elements of the devices connected to the connector.
따라서 코넥터에 접속된 기기들의 오동작을 방지하는 수단으로서는 코넥터와 코넥터에 연결된 라인의 접속이 정확하게 접속되었는가를 검사하여야 한다.Therefore, as a means of preventing the malfunction of the devices connected to the connector, it should be checked whether the connection of the connector and the line connected to the connector is correctly connected.
그러므로 종래에는 코넥터에 연결된 라인의 접속상태를 체크하기 위해서 테스트 혹은 스위치의 "온", "오프"에 의한 라인의 도통 시험으로 단락, 단선, 교차를 검사하여야 하므로 수많은 라인을 일일이 하나씩 채크하는데 따른 작업자의 피로감과 작업 능률저하 및 부정확등이 있는 단점이 있다.Therefore, in order to check the connection status of the line connected to the connector, a short-circuit, disconnection, and crossover must be checked by the test of the line or the conduction test of the line by the "on" or "off" of the switch. There are disadvantages such as fatigue, work efficiency deterioration and inaccuracy.
따라서 본 고안은 상기와 같은 종래의 제반 결점을 해소코저 안출한 것으로서, 코넥터와, 코넥터 사이에 연결된 다수 라인의 단선, 단락, 교차 상태를 자동으로 검사고 이를 외부에 표시할수 있는 회로를 제공하는데 그 주목적이 있다.Accordingly, the present invention solves the above-mentioned general drawbacks, and provides a circuit that automatically checks the disconnection, short circuit, and crossover state of a connector and a plurality of lines connected between the connector and displays it externally. There is a main purpose.
본 고안의 다른 목적은 라인의 접속상태를 검사하는데 시간 절약 및 정확성을 부여할수 있는 회로를 제공하는데 있다.Another object of the present invention is to provide a circuit that can save time and accuracy in checking the connection state of a line.
이하 첨부된 도면에 의거하여 본 고안의 목적을 달성할수 있는 실시예를 상세히 설명하면 다음과 같다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.
제1도는 본 고안의 회로의 블럭도이며, 제2도는 본 고안의 상세한 회로도로써, 클럭펄스를 발생하여 주변기기에 클럭펄스를 공급하는 클럭펄스 발생부(1)와, 키보드(8)에서 체크하고자 하는 라인수에 해당되는 데이터를 받아 주변 시스템을 콘트롤 하는 콘트롤러(2)와 상기 클럭펄스 발생부(1)에서 방생하는 클럭펄스를 코넥터와 코넥터에 연결된 라인수에 해당되는 클럭펄스를 분주하는 분주기(3)와 분주된 클럭펄스를 받아 체크하고자하는 라인을 선택하는 디코더부(4)와 디코더부(4)에서 출력되는 데이터를 입력으로 하여 라인을 체크하도록 드라이브하는 라인 드라이브단(5)과 전기한 클럭펄스 발생부(1)에서 발생하는 클럭펄스를 임의의 시간동안 카운트하는 카운터(6)와 카운트된 출력을 받아 라인 드라이브단(5)에서 선택한 하나의 라인에 대해서 상대코넥터에 연결된 전라인을 확인하는 멀티플렉서브(7)와, 멀티플렉서부(7)에서 진라인을 스캔하여 각종 에러(Error)상태를 인터럽트(Interrrupt)신호로 하여 이에 해당하는 데이터를 출력하는 콘트롤러(2)의 출력을 받아서 라인 체그상태를 외부에 표시하는 라인 상태 표시부(10)와 체크하는 라인의 넘버와 체크하는 각 라인의 넘버를 상태에 따라서 표시하는 라인 넘버 표시부(9)로 구성된다.FIG. 1 is a block diagram of a circuit of the present invention, and FIG. 2 is a detailed circuit diagram of the present invention, which is intended to be checked by a clock pulse generator 1 and a keyboard 8 for generating a clock pulse and supplying a clock pulse to a peripheral device. A divider that divides the clock pulse corresponding to the number of lines connected to the connector and the controller to control the peripheral system by receiving data corresponding to the number of lines, and the clock pulse generated by the clock pulse generator 1. (3) and the decoder unit 4 which selects the line to be checked by receiving the divided clock pulses, and the line drive stage 5 which drives to check the line by inputting data output from the decoder unit 4 as an input. A counter 6 for counting a clock pulse generated by one clock pulse generator 1 for a predetermined time and a counted output are received relative to one line selected by the line drive stage 5. The multiplexer 7 which checks all the lines connected to the connector, and the controller 2 which scans the true line from the multiplexer unit 7 and outputs data corresponding to various error states as an interrupt signal. And a line number display section 9 for displaying the line stag state externally, and a line number display section 9 for displaying the line number to be checked and the number of each line to be checked according to the state.
제3도는 제2도의 주요부분에 대한 입출력 파형도로 디코더부(4)에서 라인을 선택하는 주기와 멀티플렉서부(7)에서 라인을 스캔하는 주기를 나타내는 파형도이다.FIG. 3 is an input / output waveform diagram for the main part of FIG. 2, which is a waveform diagram showing a cycle of selecting a line in the decoder unit 4 and a cycle of scanning a line in the multiplexer unit 7. FIG.
상기와 같은 구성을 가진 본 고안의 회로동작을 도면 제2도를 인용하여 설명한다.The circuit operation of the present invention having the configuration as described above will be described with reference to FIG.
먼저, 측정자가 측정하고자 하는 코넥터를 라인드라이브단(5)의 출력단자와 멀티플랙서부(7)의 입력단자에 연결한 후 키보드(8)에 라인수에 해당되는 데이터를 입력시킨다.First, the measurer connects the connector to be measured to the output terminal of the line drive stage 5 and the input terminal of the multiplexer unit 7 and then inputs data corresponding to the number of lines to the keyboard 8.
상기 키보드(8)에서 라인수에 해당되는 데이터가 입력되면 이를 콘트롤러(2)(마이컴)가 감지하여 출력단자(PA4-PA7)(PA0-PA3)에서 출력되는 데이터가 라인 넘버 표시부(9)의 구동부인 디코더(A)및 디코더(B)를 통하여 표시부(C)에 키보드(8)에서 입력된 데이터를 표시한다.When data corresponding to the number of lines is input from the keyboard 8, the controller 2 (microcom) detects the data and outputs the data from the output terminals PA4-PA7 and PA0-PA3 to the line number display unit 9. The data input from the keyboard 8 is displayed on the display unit C through the decoders A and B as driving units.
즉, 콘트롤러(2)의 출력(PA4-PA7)은 디코더(A)에 입력되고 그 출력은 3개의 표시기에 동시에 가하여진다.That is, the outputs PA4-PA7 of the controller 2 are input to the decoder A and the outputs are simultaneously applied to the three indicators.
이들중 하나가 사용되므로 그 선택은 콘트롤러(2)의 또다른 출력(PA0-PA3)이 제2의 디코더(B)를 거쳐 이 디코더 출력에 연결된 표시기만을 구동된다.Since one of these is used, the selection drives only the indicator to which another output PA0-PA3 of the controller 2 is connected to this decoder output via a second decoder B.
이와 같이 키보드(8)의 입력을 감지하는 콘트롤러(2)에서 상응하는 데이터를 출력하여 라인넘버표시부(9)를 구동하는 것은 통상적인 것이다.As such, it is common to drive the line number display unit 9 by outputting corresponding data from the controller 2 that senses the input of the keyboard 8.
상기와 같이 키보드(8)에서데이터가 입력되면 콘트롤러(2)이 출력단자(PC0-PC2)에서 각각 "하이"펄스가 출력되어 앤드게이트(AND)에 입력된다.When data is input from the keyboard 8 as described above, the controller 2 outputs "high" pulses from the output terminals PC0-PC2, respectively, and is input to the AND gate AND.
따라서 클럭펄스 발생부(1)에서 발생되는 클럭펄스(fc)가 앤드게이트(AND)를 텅하여 콘트롤러(2)의 TIMER단자에 인가되면 콘트롤러(2)의 출력단자(PC3)에서는클럭펄스 발생부(1)에서 출력되는 클럭펄스(fc)가 분주기(3)에 인가되어 앤드게이트(AND)가 분주기에서 결정되는 분주값에 의해서 분주되어 디코더부(4)에 입력이 된다.Therefore, when the clock pulse fc generated by the clock pulse generator 1 is applied to the TIMER terminal of the controller 2 with the AND gate AND turned on, the clock pulse generator generates an output terminal PC3 of the controller 2. The clock pulse fc output from (1) is applied to the divider 3, and the AND gate AND is divided by the divider value determined by the divider, and is input to the decoder unit 4.
디코더부(4)에서는 코넥터와 코넥터에 연결된 라인에 해당되는 펄스 즉, 제3도의 A와 같은 라인선택 주기가 출력되어 라인 드라이브단(5)에 입력되어 라인을 드라이브한다.In the decoder unit 4, a pulse corresponding to a connector and a line connected to the connector, that is, a line selection period as shown in A of FIG. 3 is output and input to the line drive stage 5 to drive the line.
이때 상기한 콘트롤러(2)의 출력단자(PC2)및 출력단자(PC3)에서 각각 출력되는 "하이"펄스와 클럭펄스(fc)를 리세트신호와 클리어신호로 제어되는 카운터(6)에서 일정 시간 동안 카운트한 값을 받아 코넥터에 연결된 전 라인을 제3도의 B와 같은 펄스를 가지고 스캔하여 이에 따른 데이터를 인버터(I)를 거쳐 콘트롤러(2)의 인터럽트단자(INT)에 인가된다.At this time, the "high" pulse and the clock pulse fc output from the output terminal PC2 and the output terminal PC3 of the controller 2 are controlled by the reset signal and the clear signal for a predetermined time. After receiving the counted value, all the lines connected to the connector are scanned with pulses such as B of FIG. 3 and the corresponding data is applied to the interrupt terminal INT of the controller 2 via the inverter I.
즉, 멀티플렉서(7)는 이에 연결된 카운터(6)에 의해 128개중 하나의 라인을 선택하는데, 디코더(5)에서 선택되는 각각의 라인에 대해 상기 멀티플렉서(7)는 128회의 순차검색을 수행할때 서로 연결이 된 경우에는 (즉, 단선이 아닌 경우) 멀티 플렉서 출력이 하이가 되어 콘트롤러(2)의 인터럽트단자에 연결된다.That is, the multiplexer 7 selects one line out of 128 by the counter 6 connected thereto, and the multiplexer 7 performs 128 sequential searches for each line selected by the decoder 5. When connected to each other (ie not disconnected), the multiplexer output goes high and is connected to the interrupt terminal of the controller 2.
이때 콘트롤러는 인터럽트가 발생된 경우가 아니므로 그 출력단자(PA0-PA7)를 통해 라인넘버표시부(9)의 표시부(D),(E)에 라인 번호를 출력한다. 그러나 멀티플렉서의 출력이 로우인 경우에는 단선인 경우이므로 이때에는 인터럽트가 발생되어 콘트롤러(2)의 출력단자(PC6)에서 "하이"펄스가 출력되어 트랜지스터(Q2)를 "온"시키고 발광다이오드(LED1)를 점증시키는 한편 콘트롤러(2)의 출력단자(PC5)에는 주기적인 펄스가 출력되어 부저(BU)를 울린다.At this time, since the controller does not generate an interrupt, the controller outputs a line number to the display units D and E of the line number display unit 9 through the output terminals PA0-PA7. However, when the output of the multiplexer is low, it is a disconnection. At this time, an interrupt is generated, and a "high" pulse is output from the output terminal PC6 of the controller 2 to "turn on" the transistor Q2, and the light emitting diode LED1. ) Is increased and a periodic pulse is output to the output terminal PC5 of the controller 2 to ring the buzzer BU.
이때 단선 라인은 라인 검사가 진행시 라인 드라이브단(5)의 출력단자에 접속된 라인을 표시하는 라인 넘버표시부(9)의 표시부(D)에서 단선 라인 번호를 알수 있다.At this time, the disconnection line can be found in the display portion D of the line number display section 9 which displays the line connected to the output terminal of the line drive stage 5 when the line inspection is in progress.
그리고 단락 상태는 디코더부(4)에서 선택된 1개의 라인에 대해서 멀태 플렉서부(7)의 출력단자에 여러번 "하이"신호가 출력되는 경우로써 라인 드라이브단(5)에서 선택된 하나의 라인에 대하여 멀티플렉서부(7)에 연결된 라인중에 하나 이상의 라인이 접속되어 있으므로 이때 발생하는 신호가 콘트롤러(2)의 인터럽트(INT)단자에 인가된다.The short circuit state is a case where a "high" signal is output several times to the output terminal of the multiplier unit 7 for one line selected by the decoder unit 4, and the multiplexer for one line selected by the line drive stage 5 is output. Since at least one of the lines connected to the unit 7 is connected, a signal generated at this time is applied to the interrupt (INT) terminal of the controller 2.
이 경우에는 콘트롤러는 128개중 1개의 검색 기준에 대해 128개중 다수개의 검색이 된 것으로 판정될 수 있으므로 단락인 경우로 판정하여 상기 콘투롤러(2)의 출력단자(PC0)에 로우를 출력토록하므로써 클럭펄스발생부(1)에서 발생하는 클럭펄스(fc)가 콘트롤러(2)의 타이머 단자(TIMER)에 인가되는 것을 중지하고 단락라인 넘버표시부(9)의 표시부(D) 및 표시부(E)에서 표시한다.In this case, since the controller can be determined that a plurality of 128 searches have been made for one of the 128 search criteria, the controller is determined to be a short-circuit and outputs a row to the output terminal PC0 of the controller 2. The clock pulse fc generated by the pulse generator 1 stops being applied to the timer terminal TIMER of the controller 2 and is displayed on the display unit D and the display unit E of the short line number display unit 9. do.
상기의 단락라인을 검출하여 표시되게하는 수단은 인터럽트 발생시 콘트롤러에서 출력되는 펄스의 수를 체크하므로써 이루어진다.The means for detecting and displaying the short line is made by checking the number of pulses output from the controller when an interrupt occurs.
한편, 콘트롤러(2)의 출력단자(PC5)에서 주기적인 펄스가 출력되어 부저(BU)를 울리며, 콘트롤러(2)의 출력단자(PC7)에서 "하이"펄스가 출력되어 발광다이오드(LED2)를 점등시킨다.On the other hand, a periodic pulse is output from the output terminal PC5 of the controller 2 to ring the buzzer BU, and a "high" pulse is output from the output terminal PC7 of the controller 2 to emit the light emitting diode LED2. Lights up.
그리고 라인 드라이브단(5)과 멀티플렉서부(7)에 연결된 라인에서 교차된 라인이 있으면 상기 멀티플렉서(7)에서 출력된 "하이"신호가 콘트롤러(2)의 인터럽트(INT)단자에 인가되어 콘트롤러(2)에서는 디코더부(4)에서 카운트된 라인넘버와 멀티플렉서부(7)에서 체크중인 라인 넘버를 서로 비교하여 다르면 교차 상태가 되는 것으로 전술한 단락상태와 같이 콘트롤러(2)의 출력단자(PC0)에 "로우"신호를 출력하여 콘트롤러(2)의 타이머 단자(TIMER)에 클럭펄스 발생부(1)에서 출력되는 클럭펄스(fc)가 입력되지 않으므로 이때 라인 넘버 표시부(9)의 표시부(D),(E)에 의해서 교차상태를 알수 있다.When there is a line intersecting in the line connected to the line drive terminal 5 and the multiplexer unit 7, the "high" signal output from the multiplexer 7 is applied to the interrupt (INT) terminal of the controller 2 so that the controller ( In 2), the line number counted by the decoder unit 4 and the line number checked by the multiplexer unit 7 are compared with each other, so that they are in a crossing state. The output terminal PC0 of the controller 2 is similar to the short circuit state described above. The clock pulse fc output from the clock pulse generator 1 is not input to the timer terminal TIMER of the controller 2 by outputting a "low" signal to the display unit D of the line number display unit 9 at this time. The intersection state can be known by, (E).
즉, 디코더부(4)에서 선택된 하나의 라인에 대해 멀티플렉서부(7)는 128번 스탠하여 전라인을 검사하고 에러상태를 발광다이오드(LED1),(LED2) 및 부저(BU)를 구동시켜 외부에 교차 라인상태를 표시한다.That is, the multiplexer unit 7 stands for 128 lines for the one line selected by the decoder unit 4 to inspect all the lines and drives the error state to drive the light emitting diodes LED1, LED2 and the buzzer BU. Indicate the cross line status.
상술한 바와 같이 동작하는 본 고안의 회로 동작에 의하면 코넥터와 코넥터 사이에 접속한 라인의 에러상태를 자동으로 체크할수 있다.According to the circuit operation of the present invention operating as described above, it is possible to automatically check the error state of the line connected between the connector and the connector.
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR2019860005889U KR890008735Y1 (en) | 1986-04-29 | 1986-04-29 | Multi line detective circuit using controller |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR2019860005889U KR890008735Y1 (en) | 1986-04-29 | 1986-04-29 | Multi line detective circuit using controller |
Publications (2)
Publication Number | Publication Date |
---|---|
KR870017036U KR870017036U (en) | 1987-11-30 |
KR890008735Y1 true KR890008735Y1 (en) | 1989-11-30 |
Family
ID=19251208
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR2019860005889U KR890008735Y1 (en) | 1986-04-29 | 1986-04-29 | Multi line detective circuit using controller |
Country Status (1)
Country | Link |
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KR (1) | KR890008735Y1 (en) |
-
1986
- 1986-04-29 KR KR2019860005889U patent/KR890008735Y1/en not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR870017036U (en) | 1987-11-30 |
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