KR860002606Y1 - Reset circuit - Google Patents
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Abstract
내용 없음.No content.
Description
제1도는 본 고안의 회로도.1 is a circuit diagram of the present invention.
제2도는 본 고안의 회로도중 인버터를 등가회로도 구성한 회로도.2 is a circuit diagram of an equivalent circuit diagram of an inverter of the circuit diagram of the present invention.
제3도는 본 고안의 작용을 표시하는 각부 타이밍 챠트.3 is a timing chart showing the operation of the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
1 : 제너 다이오드 2 : 인버터1: Zener Diode 2: Inverter
3 : 다이오드 R1, R2, R3, R4: 저항3: diode R 1 , R 2 , R 3 , R 4 : resistance
C0: 캐폐시터C 0 : Capacitor
본 고안은 마이크로 컴퓨터 등에 있어서 전원 투입 및 차단시 입력신호의 불확실에 의한 마이크로 컴퓨터의 오동작을 방지하려는 리세트 회로에 관한 것이다.The present invention relates to a reset circuit to prevent a malfunction of the microcomputer due to the uncertainty of the input signal when the power is turned on and off in the microcomputer.
종래에 알려진 마이크로 컴퓨터 등에서의 리세트 회로는 다이오드나 콘덴서 등의 회로 구성으로 전원의 투입 또는 차단시에 리세트 동작을 수행하고 있었으나, 전원변동이나 외부적 잡음에 의해 마이크로 컴퓨터내의 논리 동작이 오동작을 유발시키는 경우가 많았다.Conventionally, a reset circuit in a microcomputer or the like performs a reset operation when a power supply is turned on or off by a circuit configuration such as a diode or a capacitor, but a logic operation in the microcomputer is malfunctioning due to power fluctuations or external noise. It was often caused.
일예로, 마이크로 컴퓨터의 리세트단에서 요구하는 입력논리가 전원의 투입 및 차단 동작에 따른 전원 안정화를 이루기 어려울 경우나 외부적 서지, 노이즈 전압에 의해 그 동작이 불안정하여 리세트 동작이 자주 일어나거나 또는 리세트 동작이 일어나지 않아 마이크로 컴퓨터의 입력논리를 자주 변화 시키거나 또는, 전혀 변화시키지 못하게 되므로써 이에 의해 제어되는 주변장치의 오동작을 유발시키게 되는 것이었다.For example, when the input logic required at the reset stage of the microcomputer is difficult to achieve power stabilization due to power on and off, or the operation is unstable due to external surge or noise voltage, the reset operation occurs frequently. In other words, the reset operation did not occur so that the input logic of the microcomputer was frequently changed or not changed at all, thereby causing a malfunction of the peripheral device.
본 고안은 종래의 이러한 단점을 완전 해소하고자 안출한 것으로써, 이는 리세트 회로를 제너 다이오드와 인버터를 포함한 구성으로 하므로써 외부적 요인에 의한 오동작을 방지하면서 그 동작에 신뢰성을 부여하도록한 목적이 있는 것이다.The present invention has been devised to completely eliminate these disadvantages of the prior art, which is intended to provide reliability to the operation while preventing malfunction due to external factors by the reset circuit including the zener diode and the inverter. will be.
이하에서 이를 상세히 설명하면 다음과 같다.This will be described in detail below.
즉, 제1도와 같이 전원단(Vcc)에 제너 다이오드(1)와 인버터(2)를 직렬 접속하고, 이와 병렬로 저항(R1), 캐페시터(C0)를 연결하며, 인버터(2)의 출력은 저항(R1)과 캐페시터(C0)사이의 다이오드(3)를 거쳐 마이크로 컴퓨터(4)의 리세트단(RT)에 연결시킨 구성이다.That is, as shown in FIG. 1, the Zener diode 1 and the inverter 2 are connected in series to the power supply terminal Vcc, and the resistor R 1 and the capacitor C 0 are connected in parallel with each other. The output is configured to be connected to the reset terminal RT of the microcomputer 4 via the diode 3 between the resistor R 1 and the capacitor C 0 .
한편, 제2도에서는 제너 다이오드(1)와 연결된 인버터(2)를 트렌지스터(T)와 저항(R3,R4)으로 구성시킨 일예를 표시한다.2 shows an example in which the inverter 2 connected to the zener diode 1 is composed of the transistor T and the resistors R 3 and R 4 .
미설명 부호 R2는 전압 분배 저항이다.Reference numeral R 2 is a voltage divider resistor.
이러한 구성의 본 고안은 전원의 투입시 제너다이오드(1)에 의한 정전압 작용과 함께 기준전압이 설정되어 인버터(2)에 가해지게 되는데, 이때 입력레벨이 제너다이오드(1) 기준전압인 제너 전압(VZ)에 이르지 못하면 제너다이오드(1)는 개방 상태가 되고, 이에 따라 인버터(2) 출력 또한 개방 상태가 되어, 전류는 저항(R1) 및 다이오드(3)를 거쳐 직접 마이크로 컴퓨터(MIC)의 리세트단(RT)에 리세트 전류를 가하고, 상기 제너다이오드(1)가 제너전압(VZ)에 이르러서 인버터(2) 출력이 논리레벨 Low로 되어서 마이크로 컴퓨터(MIC)의 입력이 차단된다. 그러므로, 이는 제3(b)도와 같이 인버터(2)의 입력논리가 제너전압(VZ)이상의 정상치에 이르지 못할때는 그 출력이 개방된 상태에 있다가, 제너전압(VZ) 이상에서 인버터(2)의 입력논리가 논리레벨 high로 되므로써 그 출력이 Low로 되어 제3(c)도와 같이 c점에서 리세트 펄스가 발생하는 것이고, 전원 차단시에는 이와 반대로 인버터(2)의 입력논리가 제너전압(VZ) 이하에서 Low로 떨어지므로 캐폐시터(C0)의 충전전위에 의해 마이크로 컴퓨터(MIC)의 리세트 단자(RST)에 리세트 펄스를 가하게 되는 것이다.According to the present invention having the above configuration, when the power is turned on, the reference voltage is set and applied to the inverter 2 together with the constant voltage action by the zener diode 1, wherein the input level is the zener voltage (Zerner diode 1). If it does not reach V Z ), the zener diode 1 is open, and thus the output of the inverter 2 is also open, so that the current flows directly through the resistor R 1 and the diode 3 to the microcomputer (MIC). A reset current is applied to the reset stage RT of the input signal, the zener diode 1 reaches the zener voltage V Z , and the output of the inverter 2 becomes the logic level low, thereby blocking the input of the microcomputer MIC. . Therefore, when the input logic of the inverter 2 does not reach the normal value above the zener voltage V Z as shown in FIG. 3 (b), the output is in an open state, and the inverter (above the zener voltage V Z ) 2) As the input logic of 2) becomes the logic level high, the output becomes Low and reset pulse is generated at point c as shown in Fig. 3 (c). Since the voltage falls below the voltage V Z , the reset pulse is applied to the reset terminal RST of the microcomputer MIC by the charging potential of the capacitor C 0 .
이와같이, 제너전압에 의해 잡혀진 전위치 이상, 이하로 인버터 동작이 수행되도록 하고, 이에 의해 리세트 펄스가 발생되도록 하므로써 외부적 잡음이나 전원의 이상에 의해 마이크로 컴퓨터의 오동작을 방지할수 있는 것이다.In this way, the inverter operation is performed above or below the previous position held by the zener voltage, and the reset pulse is generated thereby, thereby preventing malfunction of the microcomputer due to external noise or abnormal power supply.
한편, 제2도에서는 상기와 동일한 작용을 하는 실시에 회로 구성으로써, 트랜지스터(T)의 베이스-에미터간의 동작 전압 레벨에서 인버터(2)로써의 역할을 하행하는 것이다.On the other hand, in FIG. 2, the circuit structure is implemented in the same operation as described above, and serves as the inverter 2 at the operating voltage level between the base and the emitter of the transistor T. In FIG.
이러한 본 고안은 마이크로 컴퓨터 등의 리세트 회로에 있어서 제너 다이오드와 인버터를 이용한 입력 논리로써 리세트 펄스를 발생시키도록 하므로써 이러한 회로의 신뢰성을 얻을수 있는 유익한 특징이 있는 것이다.The present invention has an advantageous feature that the reliability of such a circuit can be obtained by generating the reset pulse as an input logic using a zener diode and an inverter in a reset circuit such as a microcomputer.
Claims (1)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019840010985U KR860002606Y1 (en) | 1984-11-01 | 1984-11-01 | Reset circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019840010985U KR860002606Y1 (en) | 1984-11-01 | 1984-11-01 | Reset circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR860006516U KR860006516U (en) | 1986-06-21 |
| KR860002606Y1 true KR860002606Y1 (en) | 1986-10-08 |
Family
ID=70158264
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019840010985U KR860002606Y1 (en) | 1984-11-01 | 1984-11-01 | Reset circuit |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR860002606Y1 (en) |
-
1984
- 1984-11-01 KR KR2019840010985U patent/KR860002606Y1/en active Pre-grant Review Request
Also Published As
| Publication number | Publication date |
|---|---|
| KR860006516U (en) | 1986-06-21 |
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