KR20240036493A - 무선 통신에서의 페이징 방법 - Google Patents

무선 통신에서의 페이징 방법 Download PDF

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KR20240036493A
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Abstract

무선 통신을 위한 시스템들, 장치들 및 방법들이 설명되고, 보다 구체적으로는, 페이징 동안 전력 소비를 감소시키는 것에 관한 기법들에 대해 설명된다. 본 방법은 무선 디바이스에서, 페이징 메시지(paging message)와 연관된 페이징 구성 정보를 수신하는 단계 및 페이징 구성 정보에 기초하여 페이징 메시지에 대해 모니터링하는 단계를 포함한다. 페이징 구성 정보는 페이징 표시 채널 및 페이징 오케이션(paging occasion)을 표시할 수 있다. 본 방법은 무선 디바이스가 페이징 메시지에 대해 모니터링하는 시간을 감소시킴으로써 페이징 동안의 전력 소비를 감소시킬 수 있다.

Description

무선 통신에서의 페이징 방법
본 문헌은 일반적으로 무선 통신에 관한 것이다.
무선 통신 기술은 세계를 점점 더 연결되고 네트워화된 사회로 이끌고 있다. 무선 통신의 급속한 성장 및 기술의 진보는 용량과 연결성에 대한 더 큰 수요로 이어졌다. 에너지 소비, 디바이스 비용, 스펙트럼 효율 및 레이턴시와 같은 다른 양태들도 또한 다양한 통신 시나리오들의 요구를 충족시키는 데 중요하다. 기존의 무선 네트워크들과 비교하여, 차세대 시스템들 및 무선 통신 기법들은 증가된 수의 사용자들 및 디바이스들에 대한 지원을 제공할 뿐만 아니라, 점점 증가하는 모바일 사회를 지원할 필요가 있다.
본 문헌은 5G(5th Generation), NR(new radio), 4G(4th Generation), 및 LTE(long term evolution) 통신 시스템들을 포함하는 모바일 통신 기술에 있어서 페이징(paging) 동안 전력 소비를 감소시키기 위한 방법들, 시스템들, 및 디바이스들에 관한 것이다.
하나의 예시적인 양태에서, 무선 통신 방법이 개시된다. 본 방법은 무선 디바이스에서, 페이징 메시지와 연관된 페이징 구성 정보를 수신하는 단계 및 페이징 구성 정보에 기초하여 페이징 메시지에 대해 모니터링하는 단계를 포함한다.
다른 예시적인 양태에서, 무선 통신 방법이 개시된다. 본 방법은 네트워크 디바이스에 의해, 페이징 메시지와 연관된 페이징 구성 정보를 송신하는 단계 및 페이징 구성 정보에 따라 페이징 메시지를 송신하는 단계를 포함한다.
또 다른 예시적인 양태에서, 상술된 방법들은 프로세서 실행가능 코드의 형태로 구현되고, 컴퓨터 판독가능 프로그램 매체에 저장된다.
또 다른 예시적인 실시예에서, 위에서 설명된 방법들을 수행하도록 구성되거나 동작가능한 디바이스가 개시된다.
상기한 양태들 및 다른 양태들 및 이들의 구현예들이 도면들, 설명, 및 청구범위에서 더 상세히 설명된다.
도 1은 기지국(base station, BS) 및 사용자 장비(user equipment, UE)를 포함하는 무선 통신 시스템의 예를 도시한다.
도 2는 예시적인 페이징 사이클을 도시한다.
도 3은 페이징 표시를 포함하는 예시적인 페이징 사이클을 도시한다.
도 4는 예시적인 페이징 조기 표시(paging early indication, PEI)를 도시한다.
도 5는 예시적인 비트 필드 구조를 도시한다.
도 6은 예시적인 비트 필드 구조를 도시한다.
도 7은 예시적인 비트 필드 구조를 도시한다.
도 8은 예시적인 비트 필드 구조를 도시한다.
도 9는 예시적인 비트 필드 구조를 도시한다.
도 10은 예시적인 방법을 도시한다.
도 11은 예시적인 방법을 도시한다.
도 12는 본원에서 개시된 기술의 방법들 및/또는 기법들을 구현하기 위해 사용될 수 있는 장치의 일부분의 블록도이다.
섹션 표제들은 본 문헌에서 단지 가독성을 향상시키기 위해 사용되고, 각 섹션에서의 개시되는 실시예들 및 기법들의 범위를 단지 해당 섹션에 제한하지 않는다. 특정 특징들이 5세대(5G) 무선 프로토콜의 예를 사용하여 설명된다. 그러나, 개시되는 기법들의 적용가능성은 단지 5G 무선 시스템들에 제한되지 않는다.
도 1은 BS(120) 및 하나 이상의 사용자 장비(UE)(111, 112 및 113)를 포함하는 무선 통신 시스템(예를 들어, LTE(long term evolution), 5G 또는 NR 셀룰러 네트워크)의 예를 도시한다. 일부 실시예들에서, 업링크 송신(131, 132, 133)은 업링크 제어 정보(uplink control information, UCI), 보다 상위 계층 시그널링(예를 들어, UE 보조 정보 또는 UE 능력), 또는 업링크 정보를 포함할 수 있다. 일부 실시예들에서, 다운링크 송신(141, 142, 143)은 DCI 또는 보다 상위 계층 시그널링 또는 다운링크 정보를 포함할 수 있다. UE는 예를 들어, 스마트폰, 태블릿, 모바일 컴퓨터, M2M(machine to machine) 디바이스, 단말, 모바일 디바이스, IoT(Internet of Things) 디바이스 등일 수 있다.
본 문헌은 개시되는 기법들 및 실시예들의 범위를 특정 섹션들로 제한하기 위해서가 아니라 쉬운 이해를 가능하게 하기 위해 섹션 제목 및 부제목을 사용한다. 따라서, 상이한 섹션들에서 개시되는 실시예들은 서로 함께 사용될 수 있다. 뿐만 아니라, 본 문헌은 단지 이해를 용이하게 하기 위해 3GPP NR 네트워크 아키텍처 및 5G 프로토콜로부터의 예들을 사용하고, 개시되는 기법들 및 실시예들은 3GPP 프로토콜들과 상이한 통신 프로토콜들을 사용하는 다른 무선 시스템들에서 실시될 수 있다.
페이징 사이클의 페이징 오케이션(Paging Occasion, PO) 동안, 라디오 리소스 제어(radio resource control, RRC) 유휴 상태(RRC_Idle) 또는 RRC 비활성 상태(RRC_Inactive)의 사용자 장비(UE)는 해당 특정 UE에 대해 어떠한 페이징 메시지도 표시되지 않는다 하더라도, ― 페이징 메시지를 스케줄링하는 ― 물리적 다운링크 제어 채널(Physical Downlink Control Channel, PDCCH)을 모니터링한다. 유사하게, 물리적 다운링크 공유 채널(physical downlink shared channel, PDSCH)도 해당 UE에 대한 페이징 메시지를 반송(carry)하지 않을 수 있다. 그렇다 하더라도, UE는 페이징 사이클 동안 PDCCH 또는 PDSCH를 수신 및 디코딩해야 한다. 이러한 동작은 일부 불필요한 전력을 소비한다.
하나의 PO 동안, 예를 들어, 네트워크가 다수의 페이징 메시지들을 한 번에 스케줄링하는 경우, PDCCH는 UE가 PDSCH 상의 페이징 메시지를 갖는다는 것을 표시할 수 있지만, 대응하는 PDSCH의 콘텐츠는 UE에 대한 실제 페이징 메시지를 포함하지 않는다. 이러한 상황 또한 불필요하게 전력을 소비할 것이다.
5G에서, 불연속 수신(Discontinuous Reception, DRX)은 UE가 BS로부터 신호 또는 채널을 연속적으로 수신할 것을 요구하지 않는 기술이다. UE는 일정 시기 동안 신호를 간헐적으로 수신하고 다른 시기 동안에는 수신을 중지할 수 있다. 하나의 DRX 사이클은 DRX 사이클의 하나의 ON 지속기간(DRX-ON) 및 하나의 OFF 지속기간(DRX-OFF)을 포함한다. RRC_Connected 상태의 UE의 경우, 이러한 UE는 연결 모드(connected mode)에서 DRX를 적용할 것이다(C-DRX). RRC_Idle 또는 RRC_Inactive 상태의 UE의 경우, 이러한 UE는 유휴 모드(idle mode)에 대해 DRX를 적용할 것이다(I-DRX).
RRC_Idle 또는 RRC_Inactive 상태의 UE의 경우, UE는 각 페이징 사이클의 PO 동안 가능한 페이징을 모니터링한다. 일례에서, PDCCH는 UE에 대한 페이징 메시지를 스케줄링하지 않는다. 다른 예에서, PDCCH는 UE에 대한 페이징 메시지를 스케줄링하지만, UE가 PDSCH를 수신하지 않는다. 또 다른 예에서, PDCCH는 페이징 메시지를 스케줄링하지만, PDSCH가 이러한 특정 UE에 대한 페이징 메시지를 반송하지 않는다. 이러한 상황들 각각에서, UE의 전력 소비를 감소시키기 위한 방법들이 필요하다.
PO를 수신하기 전에, RRC_Idle 또는 RRC_Inactive 상태의 UE는 ― 동기화(SYNC) 및 자동 이득 제어(automatic gain control, AGC)에 사용될 수 있는 ― 동기화 신호 블록(synchronization signal block, SSB) 신호를 검출한다. 통상적으로, SSB의 주기는 20 ms이다. PO가 SSB로부터 그 주기에 비해 멀리(이를테면 19 ms) 떨어져 있을 때, UE는 PO 전에 SYNC 및 AGC를 수행하기 위한 SSB를 수신하기 위해 조기에 웨이크업해야 하며, 이는 에너지를 낭비한다.
이 때문에, 페이징은 RRC_Idle 또는 RRC_Inactive 상태의 UE와 RRC_Connected 상태의 UE들에 대한 채널 상태 정보 기준 신호(channel state information reference signal, CSI-RS)들의 구성 정보를 공유함으로써 개선될 것이다. 현재, RRC_Idle 또는 RRC_Inactive 상태의 UE는 RRC_Connected UE들에 대해 구성된 CSI-RS들에 대해 알지 못한다. 그러나, CSI-RS의 구성 정보를 공유하는 것은 많은 시그널링 오버헤드를 초래할 수 있다. 이에 따라, CSI-RS 구성 정보를 전달하는 것의 오버헤드를 감소시키기 위한 방법들이 필요하다.
UE가 페이징 메시지를 수신할지 여부를 더 정확하게 알 수 있게 함에 따라, 불필요한 페이징 및 UE 전력 소비를 감소시키는 방법들이 도입된다.
도 2는 예시적인 페이징 사이클을 도시한다. 현재 NR에서, RRC_Idle 또는 RRC_Inactive 상태의 UE는 매 페이징 사이클마다 페이징 메시지를 수신한다. 페이징 메시지는 PDSCH 상에서 반송되며, 이 페이징 메시지는 대응하는 PDCCH(또한 "페이징-PDCCH")에 의해 스케줄링된다. 그러나, 페이징 메시지는 UE에 적용되지 않을 수 있다. 즉, 페이징 메시지는 이 UE의 5세대 시스템 임시 모바일 가입 식별자(5th Generation System Temporary Mobile Subscription Identifier, 5G-S-T MSI)를 포함하지 않는다. 이러한 경우에 대해, 오경보가 발생한다. 이러한 오경보는 이 UE의 에너지를 낭비할 것이다. 오경보가 방지될 수 있다면, UE는 전력을 절감할 수 있다.
도 3은 페이징 표시를 포함하는 예시적인 페이징 사이클을 도시한다. UE가 페이징 메시지를 수신하기 전에, 페이징 표시 정보(또한 "페이징 구성 정보")는 UE가 페이징-PDCCH를 스킵하는 것을 포함하여, 페이징 메시지의 수신을 스킵할 수 있다는 것을 UE에 통지할 수 있으며, 이에 따라 오경보를 방지할 수 있다. 페이징 표시 정보는 페이징 표시 채널 및 페이징 오케이션을 표시할 수 있다. 페이징 표시 정보는 페이징 조기 표시(PEI) 신호/채널, 이를테면 웨이크업 신호(wake-up signal)/채널(WUS) 및/또는 페이징 스케줄링 채널, 이를테면 페이징-PDCCH 상에서 반송될 수 있다.
예 1
도 4는 예시적인 PEI를 도시한다. PEI, 이를테면 WUS가 PDCCH에 기초한다면, PO 및/또는 PO 그룹의 표시를 위한 몇몇 비트가 있을 수 있다. 도 4에서 도시된 바와 같이, 하나의 PEI는 하나의 PO 또는 다수의 PO들을 표시할 수 있다. 각 PO는 다수의 PO 그룹들을 포함할 수 있다.
하나의 PEI는 PO들 및 PO 그룹들을 표시하기 위한 N*M 비트(여기서 N은 PEI와 연관된 PO의 수이고, M은 PO 내의 PO 그룹의 수임)를 가질 수 있다. N 및 M의 값은 보다 상위 계층, 예를 들어, RRC 계층에 의해 구성될 수 있다. 결과적으로, PEI는 여러 종류의 비트 필드 구조들을 가질 수 있다.
구조 1
도 5는 예시적인 비트 필드 구조(500)를 도시한다. 이 구조는 N개의 PO를 표시하고, 각 PO에서의 M개의 PO 그룹에 대해 N*M 비트를 사용한다. 이러한 구조를 이용하면, PO 내의 각 그룹은 1 비트를 가질 수 있다. 이에 따라, 각 PO 및 PO 내의 각 그룹이 별개로 표시될 수 있다. 예를 들어, N=4개의 PO들이 있고 PO 내에 M=8개의 그룹들이 있다면, PO 표시를 위해 N*M = 4*8 = 32 비트가 있을 것이다. 일부 실시예들에서, 비트가 "1"이라면, 연관된 PO 그룹이 페이징되고, 비트가 "0"이라면, PO 그룹은 페이징되지 않는다. 또한, 이러한 표시 비트들 이후에 P 비트 순환 중복 검사(cyclic redundancy check, CRC)(예를 들어, P=8 또는 P=16이면 1%의 타겟 오경보율(False Alarm Rate)에 충분함)가 첨부될 수 있다.
혼란을 일으키지 않는다면, 그룹은 서브그룹과 동일할 수 있다는 것에 유의해야 한다.
일부 실시예들에서, 상이한 PO들은 상이한 수의 그룹(즉, 그룹들에 대한 상이한 수의 비트)을 가질 수 있다. 예를 들어, PO 1은 4개의 그룹들(즉, 4 비트)을 가질 수 있는 한편, PO 2는 8개의 그룹들(즉, 8 비트)을 가질 수 있다. 또한, 상이한 그룹도 또한 상이한 수의 비트를 가질 수 있다.
페이징 오케이션은 하나 이상의 모니터링 오케이션(monitoring occasion, MO)을 포함할 수 있다. 하나의 MO는 하나의 페이징-PDCCH를 포함할 수 있다. PEI/WUS와 유사하게, 도 5에서 도시된 비트 필드 구조를 포함하여, 페이징 표시 정보가 또한 페이징-PDCCH에 포함될 수 있다.
일부 실시예들에서, 비트는 제i 그룹과 연관될 수 있고, 비트 "1"은 제i 그룹이 어드레싱 또는 페이징된다는 것을 나타낼 수 있으며, 여기서 i=1,2,...,M이다.
일부 실시예들에서, 페이징-PDCCH가 PO들 및/또는 PO 그룹들의 표시를 위한 비트들을 반송할 수 있다. PO 상의 페이징-PDCCH는 본원에서 개시된 구조들과 같은 PO들 및/또는 PO 그룹들의 표시를 위한 비트 구조를 반송할 수 있다. 일부 실시예들에서, PEI/WUS와 PO 상의 페이징-PDCCH 둘 모두가 PO들 및/또는 PO 그룹들의 표시를 위한 비트들을 반송할 수 있다. 일부 실시예들에서, PEI/WUS와 페이징-PDCCH는 동시에 PO들 및/또는 PO 그룹들의 표시를 위한 비트들을 반송할 수 있다.
구조 2
도 6은 예시적인 비트 필드 구조(600)를 도시한다. 이 구조는 N개의 PO를 표시하며, 그룹 표시를 위해 유연한 N+N*M 비트를 이용한다. 이 구조에서, N개의 PO와 연관된 블록(602)을 구성하는 처음 N 비트는 항상 존재하지만, 후자의 N*M 비트는 존재하지 않을 수 있다. 블록(602)에서의 제i 비트가 "1"이라면, 제i PO에 대응하는 M 비트의 블록이 있을 수 있으며, 여기서 i=1,2,...,N이다. 그렇지 않고, 예를 들어, 블록(602)의 제i 비트가 "0"이라면, 제i 비트에 대응하는 M 비트 블록은 존재하지 않는다. 예를 들어, 블록(602)에서의 제1 비트가 "1"(예를 들어, PO 1 내의 적어도 하나의 그룹이 페이징될 것)이라면, 도 6에서 도시된 바와 같이, PO 1에 대한 M 비트의 블록(604)이 있을 수 있다. 그렇지 않다면, 이와 같은 M 비트의 블록은 존재하지 않는다. 예를 들어, N=3 PO들이고 M=4 PO 그룹들이라면, 이 블록 구조에는 3 또는 7 또는 11 또는 15 비트가 있을 수 있다(즉, N+1=4 비트 필드 길이 가능).
예를 들어, 블록에서의 제1 비트가 "0"(예를 들어, PO 1 내의 적어도 하나의 그룹이 페이징될 것)이라면, PO 1에 대한 M 비트의 블록이 있을 수 있다. 그렇지 않다면, M 비트의 블록은 존재하지 않는다.
이러한 구조를 이용하면, 비트 필드 길이의 오버헤드가 감소될 수 있는 한편/있으면서, PEI/WUS의 커버리지가 개선될 수 있다.
일부 실시예들에서, 이러한 구조는 고정될 수 있다. 즉, 블록(602)에서의 제i 비트가 "1"인지 여부에 관계없이, 제i PO에 대한 대응하는 M 비트의 블록이 항상 존재한다. 일부 실시예들에서, 블록(602)에서의 비트 "0"에 대응하는 M 비트 블록은 디코딩할 때 가상 CRC로서의 역할을 할 수 있다(예를 들어, 이들 M 비트는 모두 제로로 설정될 수 있다).
일부 실시예들에서, 블록(602)에서의 비트들의 상태들, 이를테면 비트들의 십진법(decimal) 값이 대응하는 제i 블록이 어드레싱되는지 여부를 결정할 수 있다. i=1, 2, ..., N. 이는 고정된 구조일 수 있다. 예를 들어, M=4개의 페이징 그룹들이 있고, 블록(602)의 길이가 N=log2(M)=2라면, "10"의 값은 이들 2 비트의 십진법 값이 2이기 때문에 처음 2개의 PO들이 페이징될 것인 한편, 임의의 다른 PO들은 어드레싱되지 않는다는 것을 표시할 수 있다.
이러한 유연한 구조에서, 블록의 수(즉, N) 및 그룹의 수(즉, M)는 보다 상위 계층(예를 들어, RRC 계층)에 의해 구성될 수 있다. 대안적으로, N 또는 M의 값은 어떤 조건에 기초하여 변경될 수 있다. 예를 들어, 페이징 프레임(paging frame)당 PO의 수가 4라면, 제1 PO에서, N 및 M은 변경되지 않을 수 있지만, 제2, 제3, 및 제4 PO들에서, N 및 M은 각각 원래 값의 1/2, 1/4, 및 1/8로서 변경될 수 있다. 즉, N 및/또는 M의 서브세트가 선택된다. 이러한 구조를 이용하면, 총 비트 수가 감소될 수 있어, PEI/WUS의 커버리지를 개선한다.
구조 3
도 7은 예시적인 비트 필드 구조(700)를 도시한다. 구조(700)는 2N개의 PO를 표시하며, 그룹 표시를 위해 유연한 N + M*2N 비트를 이용할 수 있다.
도 6에서 도시된 구조(600)와 유사하게, 블록(702)을 구성하기 위한 처음 N 비트는 항상 존재하지만, 후자의 M 비트의 블록은 존재하지 않을 수 있다. 표시된 2N개까지의 PO가 있을 수 있으므로, 2N개까지의 M 비트 블록이 있을 수 있다. 비트들의 십진법 값과 같은 코드 포인트가 PO들 또는 그룹들을 표시할 수 있다. 일부 실시예들에서, 제1 블록(702)의 십진법 값이 1보다 크거나 1과 같다면, PO 1에 대응하는 M 비트의 블록이 있을 수 있다. 제1 블록(702)의 십진법 값이 2보다 크거나 같다면, PO 2에 대응하는 M 비트의 또 다른 블록이 있을 수 있다. 이는 2N개의 PO까지 더 높은 수들에 대해 계속될 수 있다.
일부 실시예들에서는, 제1 블록(702)의 십진법 값이 제로 PO들을 표시할 수 있다. 일부 실시예들에서는, 제로인 제1 블록(702)의 십진법 값이 모든 PO들을 표시할 수 있다. 일부 실시예들에서는, 어떤 미리 결정된 값(예를 들어, 2)보다 큰 십진법 값이 모든 PO들을 표시할 것이다.
플로팅 구조(또는 유연한 구조)(700)는 또한 고정될 수도 있다. 즉, 제1 블록(702)에서의 비트들의 십진법 값이 무엇인지에 관계없이, 그 다음의 블록들이 항상 존재한다.
구조 4
도 8은 예시적인 비트 필드 구조(800)를 도시한다. 구조(800)는 N개의 PO를, 그룹 표시를 위해 N*log2(M) 비트를 사용하여 표시할 수 있다.
도 7의 구조(700)와 마찬가지로, 구조(800)는 PO 내의 그룹들을 표시하기 위해 비트들의 십진법 값과 같은 코드 포인트를 사용한다. 일부 실시예들에서, 비트들의 십진법 값이 제로라면, 그룹들(예를 들어, UE 그룹 또는 PO 그룹) 중 어떠한 그룹도 표시되지 않을 것이다. 일부 실시예들에서, 모든 비트들이 "1"이라면, 모든 그룹들이 표시될 수 있다. 다른 경우들에 대해, PO 그룹은 코드 포인트에 따라 다음과 같이 어드레싱 또는 표시될 수 있다:
예를 들어, M=8개의 PO 그룹들이 있다면, 각 PO에 대해 3 비트를 사용하여 PO 그룹들을 표시하기 위해 다음의 테이블이 사용될 수 있다.
이 테이블에, "제7 그룹이 표시될 것"에 대응하는 어떠한 엔트리도 없다는 것에 유의한다. 일부 실시예들에서는, 이와 같은 엔트리를 포함하도록 테이블이 구성될 수 있다. 표시될 수 있는 2N개 초과의 PO 그룹 조합이 있을 수 있으므로, PO 그룹들을 표시하는 다른 조합들이 구성될 수 있다.
이 구조를 이용하면, 그룹당 log2(M) 비트만 사용된다. 비트 오버헤드가 감소될 수 있어, 기지국 커버리지를 개선한다.
구조 5
일부 실시예들에서, N개의 PO는 그룹 표시를 위해 M 비트를 사용하여 표시될 수 있다(즉, 총 M 비트). 이는 모든 N개의 PO가 동일한 표시 콘텐츠를 갖는 경우 그러할 수 있다. 이는 이들 N개의 PO가 하나의 UE 또는 UE 식별정보(UE ID)와 연관될 때 또는 이들 N개의 PO가 그룹 내 UE 또는 그룹 내 UE ID와 연관되는 경우 적용될 수 있다. 일부 실시예들에서, "1"의 제i 비트는 모든 PO들에 대해 제i 그룹이 어드레싱 또는 페이징됨을 나타내며, 여기서 i=1,2,...,M이다. 이러한 구조는, 기능 축소(reduced capability, RedCap) UE가 낮은 비용, 낮은 복잡도, 또는 낮은 전력 소비를 요구하기 때문에, RedCap UE들에 유용할 수 있다. 그룹들을 표시하기 위해 M 비트만 사용함으로써, 이러한 구조는 데이터 프로세싱을 덜 요구한다.
구조 6
일부 실시예들에서, N 비트는 그룹 표시를 위한 M 비트와 함께, N개의 PO를 표시할 수 있다(즉, 총 N+M 비트). 처음 N 비트는 N개의 PO 중 어느 것이 어드레싱될 것인지를 표시할 수 있다. 다음 M 비트는 처음 N 비트에 의해 어드레싱된 모든 PO들에 대한 M개의 PO 그룹을 표시할 수 있다. 즉, 어드레싱된 PO들 각각은 각각 PO 그룹들의 동일한 시퀀스를 표시할 것이다. 예를 들어, M=3이고 M 비트가 "101"을 판독한다면, 처음 N 비트에 의해 표시된 각 PO에 대해 제1 및 제3 그룹들이 표시될 것이다.
구조 7
일부 실시예들에서, M개의 그룹을 갖는 N개의 PO는 총 ceil(log2(N))+M 비트로 표시될 수 있다. 이러한 방법을 이용하면, 하나의 PO 또는 다수의 PO들이 어드레싱될 수 있다. 예를 들어, N=4라면, 처음 ceil(log2(N))=2 비트는 몇 개의 PO가 어드레싱되는지를 표시할 수 있다. 이는 어드레싱되는 PO의 수를 결정하기 위해 이들 비트의 십진법 값을 사용하고 1을 추가하여 이루어질 수 있다. 예를 들어, 이들 2 비트가 "01"이라면, 처음 두 개의 PO들이 어드레싱된다. 이어서, 다음 M 비트는 상기한 구조 6과 유사하게, 어드레싱된 모든 PO들에 대한 PO 그룹들을 표시할 수 있다.
하나의 PEI/WUS와 연관된 PO의 수는 파라미터들의 구성에 따라 조절될 수 있다. 일부 실시예들에서, 하나의 PEI/WUS와 연관된 PO의 수는 페이징 프레임(PF)에서의 페이징 오케이션(PO)의 수로서 설정될 수 있다. 예를 들어, PF에서의 PO의 수가 2라면, 하나의 PEI/WUS와 연관된 PO의 수는 2로 설정될 수 있다.
일부 실시예들에서, 하나의 PEI/WUS와 연관된 PO의 수는 페이징 사이클에서의 총 페이징 프레임의 수와 연관될 수 있다. 예를 들어, 페이징 사이클에 총 8개의 페이징 프레임들이 있다면, 하나의 PEI/WUS와 연관된 PO의 수가 그 값(즉, 8)으로 설정될 수 있다.
일부 실시예들에서, 하나의 PEI/WUS와 연관된 PO의 수는 페이징 사이클에서의 PF의 총 수 및 PF에서의 PO의 수와 연관될 수 있다. 예를 들어, 페이징 사이클에 4개의 PF들이 있고, PF에 4개의 PO들이 있다면, 하나의 PEI/WUS와 연관된 PO의 수는 이들의 곱(즉, 4*4=16)일 수 있다.
이 방법을 이용하면, 각 PO 및 각 UE 그룹이 효과적으로 표시될 수 있다. 이로 인해, (표시되지 않은 UE는 PO를 수신하지 않고 슬립으로 갈 수 있기 때문에) UE의 전력 소비가 절감될 수 있다.
예 2
PO/그룹을 표시하는 것에 더하여, PEI/WUS는 또한 CSI-RS 리소스 또는 추적 기준 신호(tracking reference signal, TRS)의 가용성을 표시할 수 있다. 일부 구현에서, 리소스 오버헤드를 감소시키고 UE 전력 절감을 보조하기 위해, CSI-RS 리소스는 RRC_Connected 모드의 UE로부터 공유될 수 있다.
도 9는 예시적인 비트 필드 구조(900)를 도시한다. PEI/WUS가 PDCCH에 기초하면, 구조(900)는 CSI-RS 리소스 가용성을 표시하기 위해 사용될 수 있다. 구조(900)에서, 페이징 표시를 위힌 하나 이상의 블록(902) 후에 하나 이상의 Q 비트(910)가 배치된다. 대안적으로, CSI-RS 표시를 위한 Q 비트(910)가 페이징 표시를 위한 하나 이상의 블록 전에 배치될 수 있다.
이러한 구조를 이용하면, Q 비트(들) CSI-RS 표시에서의 각 비트는 어느 CSI-RS 세트가 이용가능한지 여부를 별개로 표시할 수 있다. Q 비트(들) CSI-RS 표시에서의 비트 "1"은 대응하는 CSI-RS 세트가 이용가능하다는 것을 표시할 수 있다. 예를 들어, Q=4이고 이들 Q 비트가 "1011"이라면, 제1, 제3 및 제4 CSI-RS 세트는 이용가능한 한편, 제2 CSI-RS세트는 이용불가능하다.
Q개보다 많은 CSI-RS 세트가 표시되어야 한다면, 미리 정의된 연산이 적용될 수 있다. 예를 들어, Q개보다 많은 CSI-RS 세트가 표시되어야 한다면, 모듈로 연산(modulo operation)이 적용될 수 있다. 예를 들어, 제k CSI-RS 리소스 세트가 Q 비트의 제q 비트(이때 q = 1 + mod((k-1,Q)임)에 의해 표시될 수 있다. 예를 들어, Q=4이고 표시될 6개의 CSI-RS(CSI-RS 리소스) 세트가 있다면, 제1 비트는 제1 및 제5 CSI-RS 세트의 가용성을 표시할 수 있다. 제2 비트는 제2 및 제6 CSI-RS 세트의 가용성을 표시할 수 있다. 이 방법을 이용하면, 비트 폭이 감소될 수 있다.
일부 실시예들에서, Q 비트(910)의 코드 포인트가 어느 CSI-RS 리소스 세트가 이용가능한지를 표시할 수 있다. 예를 들어, Q=2이라면, 다음의 테이블이 적용될 수 있다.
테이블에서 제시된 것들 이외의 상이한 수/조합들의 CSI-RS 리소스들에 대해 다른 테이블들이 적용될 수 있다는 것에 유의한다.
일부 실시예들에서, CSI-RS 리소스들의 가용성은 페이징 표시를 위한 블록들의 특정 패턴으로 표시될 수 있다. 예를 들어, 페이징 표시를 위한 모든 블록들이 모두 비트 "0"이라면, 모든 CSI-RS 리소스들은 이용불가능할 수 있다. 페이징 표시를 위한 모든 블록(들)이 모두 비트 "1"이라면, 모든 CSI-RS 리소스들은 이용가능할 수 있다. 이 방법을 이용하면, CSI-RS 리소스들의 가용성의 표시를 위해 추가적인 오버헤드가 필요하지 않다. 이로 인해, PEI/WUS의 커버리지가 개선될 수 있다.
일부 실시예들에서, 구성 또는 브로드캐스트되는 CSI-RS 리소스가 없다면, PEI/WUS에는 Q 비트(910)가 없다. 일부 실시예들에서, 구성된 CSI-RS 리소스가 없다면, 이들 Q 비트(910)는 존재하지만 리저브(reserve)된다. 일부 실시예들에서, 구성된 CSI-RS 리소스가 없다면, Q 비트(910)는 일부 디폴트 값(예를 들어, 모두 "0")으로 설정된다.
PEI/WUS가 CSI-RS, 보조 동기화 신호(secondary synchronization signal, SSS), 또는 복조 기준 신호demodulation reference signal, DM-RS)와 같은 기준 신호에 기초한다면, CSI-RS 리소스들의 가용성은 시퀀스 생성을 통해 표시될 수 있다. 일부 실시예들에서, 상이한 초기 시드(seed)들이 어느 CSI-RS 리소스 세트가 이용가능한지를 표시할 수 있다. 예를 들어, 제1 초기 시드(예를 들어, x0)에서의 [1, 1, 0, 0, 0, 0, 0]의 초기 시드는 제1 및 제2 CSI-RS 리소스 세트가 이용가능한 한편, 다른 리소스 세트들은 이용불가능하다는 것을 표시할 수 있다. 제2 초기 시드(예를 들어, x1, 7 비트 또는 31 비트를 가짐) 또한 CSI-RS 리소스의 가용성을 나타낼 수 있다.
일부 실시예들에서, PEI/WUS와 페이징-PDCCH 둘 모두가 CSI-RS 가용성의 표시를 위한 비트들을 반송할 수 있다. 일부 실시예들에서, 표시된 CSI-RS 오케이션의 가용성이 PEI/WUS의 오케이션과 충돌한다면, 표시된 CSI-RS 오케이션이 무효(예를 들어, 이용불가능하거나 부재)일 수 있다. 대안적으로, 표시된 CSI-RS 오케이션의 가용성이 PEI/WUS의 오케이션과 충돌하면, 표시된 CSI-RS 리소스가 무효일 수 있다. 표시된 CSI-RS 오케이션이 시스템 정보를 반송하는 PDSCH와 중첩한다면, 표시된 CSI-RS 오케이션이 무효일 수 있다. 표시된 CSI-RS 오케이션이 SSB 또는 SSB 버스트와 중첩한다면, 표시된 CSI-RS 오케이션이 무효일 수 있다.
일부 실시예들에서, 최대 T=4개의 CSI-RS 리소스 또는 오케이션이 PEI/WUS에 의해 표시될 수 있다(즉, Q≤4). 일부 실시예들에서, 최대 T=8개의 CSI-RS 리소스가 PEI/WUS에 의해 표시될 수 있다(즉, Q≤8). 이들 CSI-RS 리소스들은 주기적일 수 있다. 표시된 CSI-RS 리소스의 수가 T보다 크다면, PEI/WUS는 T개의 CSI-RS 리소스만을 표시할 수 있다.
일부 실시예들에서, 최대 V개(여기서 V는 SSB 인덱스의 수)의 주기적인 CSI-RS 리소스가 PEI/WUS에 의해 표시될 수 있다. 예를 들어, 주파수 범위(frequency range) 1(FR1)에 대해 V=8이고, 주파수 범위 2(FR2)에 대해 V=64이다. 표시된 CSI-RS 리소스의 수가 V개보다 크다면, 이들은 차례로 표시될 수 있다(예를 들어, 먼저 처음 V개의 CSI-RS 리소스에 대해 표시되며, 이어서 다른 V CSI-RS 리소스들에 대해 표시됨).
일부 실시예들에서, (예를 들어, PEI/WUS 또는 페이징-PDCCH에 의해) 표시될 CSI-RS 리소스의 수가 어떤 값(예를 들어, V=8)보다 작거나 같다면, 모든 CSI-RS 리소스가 예를 들어, V=8 비트를 가질 수 있는 비트맵을 통해, 표시될 수 있다. 표시될 CSI-RS 리소스의 수가 그 값보다 크거나 같다면, 모든 CSI-RS 리소스가 이를테면 V=8 비트의 동일한 엔트리들, 즉 2^V=256개의 엔트리들을 가질 수 있는 코드 포인트를 통해, 표시될 수 있다. 256개의 엔트리들 중에서, W=64개는 유효한 엔트리들로서 구성될 수 있는 한편, 다른 엔트리들은 리저브된다.
이러한 방법을 이용하면, PEI/WUS 및/또는 PO의 페이징-PDCCH를 수신한 후, RRC_Idle 또는 RRC_Inactive 상태의 UE는 CSI-RS 오케이션 또는 리소스가 이용가능한지 또는 이용불가능한지를 알 수 있다. 이를 알면, RRC_Idle 또는 RRC_Inactive 상태의 UE는 공유된 CSI-RS를 수신하지만 이후에 SSB를 수신하기를 기다리지 않을 수 있다. 이로 인해, RRC_Idle 또는 RRC_Inactive 상태의 UE는 슬립할 시간이 더 많으며, 이는 전력 소비를 감소시킨다.
예 3
주파수 도메인에서의 5G-NR의 제어 리소스 세트(Control Resource Set, CORESET)는 W=6개의 물리적 리소스 블록(physical resource block, PRB)들로 구성되고, 리소스 엘리먼트 그룹(resource element group, REG)은 심볼 내의 PRB이다. 예를 들어, CORESET의 시간 도메인 지속기간이 하나의 심볼이라면, 제어 채널 엘리먼트(control channel element, CCE)에는 AL*6개(여기서 AL은 어그리게이션 레벨(예를 들어, 1, 2, 4, 8, 16)임)의 PRB들이 있다.
CCE 대 REG 맵핑은 인터리빙(interleaving)되거나 인터리빙되지 않을 수 있다. CORESET 제로(CORESET 0)를 제외하고, 이는 인터리빙된다.
PEI/WUS가 SSS에 기초한다면, PEI/WUS 시퀀스의 길이는 127개의 리소스 엘리먼트(resource element, RE)들일 수 있다. PRB는 하나의 심볼 내의 12개의 RE들, 또는 12개의 서브캐리어(subcarrier, SC)들을 갖는다. 이에 따라, PEI/WUS는 ceil(127/12) =11개의 PRB들 및 2개의 CCE들을 점유할 것이다. SSS 기반 PEI/WUS가 127x2=254개의 RE들(또는 255개의 RE들)의 길이를 갖는다면, 이는 4개의 CCE들을 점유할 것이다.
일부 실시예들에서, PEI/WUS의 길이가 점유된 CCE들에서 RE의 수의 정확한 배수가 아니라면, PEI/WUS 또는 RE는 이를테면 제로로 패딩될 수 있다. 예를 들어, PEI/WUS 시퀀스의 길이가 L=127 RE이고, PEI/WUS가 N=2개의 CCE들을 점유한다면, 최저 RE 인덱스를 갖는 floor((N*W*SC - L)/2)=8개의 RE들이 제로(즉, 패딩)로 채워질 수 있다. 대안적으로, PEI/WUS 시퀀스의 길이가 L=127 RE이고, PEI/WUS가 N=2개의 CCE들을 점유한다면, 최고 RE 인덱스를 갖는 ceil((N*W*SC - L)/2)=9개의 RE들이 제로로 채워질 수 있다. 대안적으로, PEI/WUS 시퀀스의 길이가 L=127 RE이고, PEI/WUS가 N=2개의 CCE들을 점유한다면, 최고 CCE 인덱스를 갖는 CCE에서 최고 RE 인덱스를 갖는 ceil ((N*W*SC - L)/2)=9개의 RE가 제로로 채워질 수 있다. 대안적으로, SSS 기반 PEI/WUS의 길이가 하나 이상의 CCE의 RE의 수의 배수가 아니라면, SSS 기반 PEI/WUS의 양단에 제로 패딩이 적용될 수 있다. 예를 들어, PEI/WUS의 길이가 하나 이상의 CCE의 RE의 수와 일치할 때까지 SSS 기반 PEI/WUS의 양단에 제로 패딩이 적용될 수 있다. 대안적으로, SSS 기반 PEI/WUS의 길이가 하나 이상의 CCE의 RE의 수의 배수가 아니라면, SSS 기반 PEI/WUS에 할당된 CCE들의 RE들의 양단에 제로 패딩이 적용될 수 있다.
SSS 기반 PEI/WUS는 인터리브 방식으로 CORESET 리소스를 점유할 수 있다. 예를 들어, SSS 기반 PEI/WUS는 CORESET 제로 리소스를 다음과 같이 점유할 수 있다:
단계 1: SSS 기반 PEI/WUS에 대한 시퀀스 을 다음과 같이 생성한다:
여기서 및 는 셀 ID에 기초하거나 보다 상위 계층에 의해 구성될 수 있다.
초기 시드들은 다음과 같을 수 있다:
은 커버 시퀀스, 이를테면 길이 K=128이고 그 엘리먼트들로서 이진수 +1 및-1을 갖는 (1+mod(Cell_ID, H))번째 Walsh 코드이고, 이고, H=127이다. 커버 시퀀스를 이용하면, 또 다른 셀의 SSS의 오검출이 방지될 수 있다.
또한, SSS 기반 PEI/WUS의 길이는 144 또는 132와 같은 다른 값으로 변경될 수 있다. 길이가 0≤n<144 또는 0≤n<132이라면, 길이는 2개의 CCE들의 RE의 수와 일치하도록 변경될 수 있다. 이는 2개의 CCE들 내의 모든 RE들이 완전히 이용될 수 있게 한다. 이 길이는 또한 4와 같은 상이한 수의 CCE에 대해 조정될 수 있다.
단계 2: 다음의 하위 단계들에 따라 인터리브 PRB 패턴을 생성한다.
단계 2-1: 매 W=6개의 REG마다 REG 번들 인덱스를 생성한다. REG는 먼저 시간에 의해 넘버링될 수 있으며, 이어서 최저 RB 인덱스로부터 시작하여 RB 인덱스에 의해 넘버링될 수 있다. REG 번들 인덱스는 0부터 까지 넘버링될 수 있으며, 여기서 NRB는 CORESET에 할당된 RB의 수이고, NSym은 CORESET에 할당된 시간 도메인에서의 심볼의 수이다.
단계 2-2: REG 번들 인덱스를 R*C 직사각형 인터리버(여기서 R=2행이고, 열임)에, 제1 행으로부터 시작하여 열별로 기입한다.
단계 2-3: CCE 인덱스를 R*C 직사각형 인터리버로부터, 제1 열로부터 시작하여 행별로 판독한다.
예를 들어, CORESET이 24개의 RB들 및 1 심볼 지속기간을 가질 수 있는 경우, 다음의 테이블에서 제시된 바와 같이, CCE#0은 RB{0,1,2,3,4,5}를 가질 수 있고, CCE#1은 RB{12,13,14,15,16,17}를 가질 수 있고, CCE#2는 RB{6,7,8,9,10,11}를 가질 수 있고, CCE#3은 RB{18,19,20,21,22,23}를 가질 수 있다. SSS 기반 PEI/WUS가 송신될 때, 이는 CCE#0 및 CCE#1 상에 맵핑될 수 있다. 즉, 이 SSS 기반 PEI/WUS에 대해 RB{0,1,2,3,4,5,12,13,14,15,16,17}이 사용될 수 있다. 대안적으로, 이 SSS 기반 PEI/WUS는 RB{6,7,8,9,10,11, 18,19,20,21,22,23}에 대응하는 CCE 2 및 CCE 3 상에 맵핑될 수 있다. 일부 실시예들에서, SSS 기반 PEI/WUS는 CCE 0 및 CCE 1로부터 CCE 2 및 CCE 3까지 반복적으로 송신될 수 있다.
또한, 위에서 설명된 바와 같은 단계 1이 단계 2 후에 수행될 수 있다.
24개의 RB들 및 2 심볼 지속기간을 갖는 CORESET의 경우, CCE 대 RB 맵핑은 다음의 테이블에서와 같이 예시될 수 있다. 하나의 SSS 기반 PEI/WUS가 송신된다면, 이는 CCE 0 및 CCE 1 상에 맵핑될 수 있어서, RB{0,1,2,6,7,8}이 이러한 SSS 기반 PEI/WUS에 대해 사용될 수 있다. 하나의 SSS 기반 PEI/WUS가 4개의 CCE를 점유한다면, CCE 0-3 또는 CCE 4-7이 사용될 수 있다.
24개의 RB들 및 3 심볼 지속기간을 갖는 CORESET의 경우, CCE 대 RB 맵핑은 다음의 테이블에서와 같이 예시될 수 있다. 하나의 SSS 기반 PEI/WUS가 송신된다면, 이는 CCE 0, CCE 1 상에 맵핑될 수 있다(즉 CCE 0 및 1이 할당될 수 있음). UE는 이러한 타겟 CCE들에 대해 블라인드 검출을 수행할 수 있다. 이러한 맵핑을 이용하면, 이 SSS 기반 PEI/WUS에 대해 RB{0,1,4,5}가 사용될 수 있다.
단계 3: 인터리빙 패턴에 따라 시퀀스를 RE 상에 맵핑한다. 일부 실시예들에서, 시퀀스는 REG 인덱스에 따라 맵핑될 수 있다. 시퀀스는 할당된 CCE 또는 타겟 CCE 둘 모두에 대해, 먼저 주파수 도메인에서 맵핑될 수 있고, 이어서 시간 도메인에서 맵핑될 수 있다. 이러한 맵핑은 UE 블라인드 검출을 위한 타겟 CCE, 디코딩될 CCE, 또는 UE 검출을 위한 CCE에 대해 적용될 수 있다.
일부 실시예들에서, 주파수 도메인 제1 맵핑은 디코딩될 CCE의 후보 수의 CCE, 이를테면 4개의 CCE들에 적용될 수 있다. 예를 들어, 두 개의 심볼들을 갖는 네 개의 CCE들 및 길이 127 RE의 SSS 기반 PEI/WUS에 대해, 제1 PEI/WUS가 제1 심볼 상에 맵핑될 수 있는 한편, 제2 PEI/WUS가 제2 심볼 상에 맵핑될 수 있다. 일부 실시예들에서, 시퀀스는 먼저 주파수 도메인에서 맵핑될 수 있고, 이어서 시간 도메인에서 반복될 수 있다. 일부 실시예들에서, 시퀀스는 먼저 할당된 RB의 RB 인덱스에 따라, 이어서 REG 인덱스에 따라 맵핑될 수 있다. 일부 실시예들에서, 시퀀스는 먼저 할당된 RB의 RB 인덱스에 따라, 이어서 두 번째로 시간에 따라 맵핑될 수 있다. 예를 들어, 24개의 RB들 및 2 심볼 지속기간을 갖는 CORESET에 대해, CCE 0 및 1이 하나의 PEI/WUS에 할당된다면, 이 PEI/WUS의 시퀀스는 {제1 심볼에서의 RB 0, 제1 심볼에서의 RB 1, 제1 심볼에서의 RB 2, 제1 심볼에서의 RB 6, 제1 심볼에서의 RB 7, 제1 심볼에서의 RB 8, 제2 심볼에서의 RB 0, 제2 심볼에서의 RB 1, 제2 심볼에서의 RB 2, 제2 심볼에서의 RB 6, 제2 심볼에서의 RB 7, 제2 심볼에서의 RB 8}로서 맵핑될 수 있다. REG 인덱스를 기초로, 맵핑은 {REG 0, REG 2, REG 4, REG 12, REG 14, REG 16, REG 1, REG 3, REG 5, REG 13, REG 15, REG 17}에 대응한다.
CORESET(예를 들어, CORESET 제로)가 하나보다 많은 심볼(예를 들어, 두 개의 심볼들)로 구성된다면, 하나의 SSS 기반 PEI/WUS는 하나의 심볼 상의 RE들을 점유할 수 있다. 유사하게, CORESET(예를 들어, CORESET 제로)가 하나보다 많은 심볼(예를 들어, 2개의 심볼들)로 구성된다면, 하나의 SSS 기반 PEI/WUS는 하나의 심볼 상의 REG들을 점유할 수 있다. 예를 들어, CORESET 제로가 두 개의 심볼들을 가진다면, 길이 127을 갖는 하나의 SSS 기반 PEI/WUS는 이 CORESET의 제1 심볼 상의 REG들인 {REG 0, REG 2, REG 4, REG 12, REG 14, REG 16, REG 24, REG 26, REG 28, REG 36, REG 38, REG 40}을 점유할 수 있다. 단지 하나의 심볼을 프로세싱함으로써, UE는 전력 소비를 감소시킬 수 있다.
일부 실시예들에서, CORESET(예를 들어, CORESET 제로)가 세 개보다 많은 심볼들로 구성될 수 있다면, SSS 기반 PEI/WUS는 하나의 심볼 상의 REG들 또는 RE들을 점유할 수 있다. 일부 실시예들에서, CORESET(예를 들어, CORESET 제로)가 하나보다 많은 심볼(예를 들어, 두 개 이상의 심볼들)로 구성된다면, 하나의 SSS 기반 PEI/WUS는 하나의 심볼 상의 REG들 또는 RE들을 점유할 수 있고 다른 심볼들에 대해 되풀이할 수 있다. 예를 들어, CORESET 제로가 두 개의 심볼들을 가진다면, 길이 127을 갖는 SSS 기반 PEI/WUS는 REG{0, 2, 4, 12, 14, 16, 24, 26, 28, 36, 38, 40}을 점유할 수 있고, REG{1, 3, 5, 13, 15, 17, 25, 27, 29, 37, 39, 41}에 대해 되풀이할 수 있다. 이에 따라, UE는 이들 두 개의 심볼들을 별개 수신하고 이들을 함께 조합하여 성능을 개선할 수 있다. 또한, REG{1, 3, 5, 13, 15, 17, 25, 27, 29, 37, 39, 41}는 또 다른 SSS 기반 PEI/WUS 또는 다른 타입의 PEI/WUS, CSI-RS 기반 PEI/WUS에 할당될 수 있다.
유사하게, 맵핑 규칙들은 또한 CSI-RS 기반 PEI/WUS에 대해서도 적용될 수 있다. 맵핑 규칙은 길이가 144 RE의 배수인 CSI-RS 기반 PEI/WUS에 대해 적용될 수 있다. 대안적으로, 맵핑 규칙은 또한 길이가 72 RE의 배수인 CSI-RS 기반 PEI/WUS에 대해서도 적용될 수 있다. 일부 실시예들에서, CSI-RS 기반 PEI/WUS에 대한 시퀀스 은 다음과 같다:
여기서 의사 랜덤 시퀀스 는 다음과 같이 정의된다: 의사 랜덤 시퀀스 생성기는 각 직교 주파수 분할 다중화(OFDM) 심볼의 시작에서
로 초기화될 수 있으며, 여기서 는 라디오 프레임 내의 슬롯 번호이고, 은 슬롯 내의 OFDM 심볼 번호이고, 는 보다 상위 계층에 의해 구성되는 것이다. Hadamard(m)은 Hadamard 시퀀스(예를 들어, 길이 J=256(또는 J=128 또는 J=512)이고 그 엘리먼트들로서 이진수 +1 및-1을 갖는 (1+mod(Cell_ID*PO_Index, H))번째 Hadamard 코드들, H=72, 144, 또는 288). 는 셀 ID이다. PO_Index=1,… , Number_of_PO_Configured이다. 이때, Number_of_PO_Configured는 보다 상위 계층에 의해 {1,2,4}로부터 구성된 PO의 수이다.
일부 실시예들에서, 상기한 Hadamard 시퀀스는 위에서 예시된 바와 같은 Walsh 시퀀스로 대체될 수 있다. 예를 들어, Hadamard 시퀀스는 위에서 예시된 바와 같이 이진수 +1 및-1을 갖는 Walsh 시퀀스로 대체될 수 있다.
의사 랜덤 시퀀스들은 길이-31 Gold 시퀀스에 의해 정의될 수 있다. 길이 의 출력 시퀀스 (여기서 임)은
이며, 여기서 = 1600이고, 제1 m-시퀀스 은 로 초기화될 수 있다. 제2 m-시퀀스 의 초기화는 시퀀스의 적용에 따른 값으로 로 표기된다.
CSI-RS 기반 PEI/WUS는 PDCCH와 연관된 DM-RS 상에, 이를테면 DM-RS 위치 상에 맵핑될 수 있다. CSI-RS 기반 PEI/WUS는 CORESET 제로 상의 PDCCH와 연관된 DM-RS 상에 맵핑될 수 있다. CSI-RS 기반 PEI/WUS는 PDCCH에 대한 DM-RS의 하나의 심볼 또는 다수의 심볼들 상에 맵핑될 수 있다. 유사하게, SSS 기반 PEI/WUS 또한 PDCCH와 연관된 DM-RS 상에 맵핑될 수 있다.
UE가 PDCCH 기반 PEI/WUS와 같은 PEI/WUS를 검출할 때, UE는 탐색 공간의 CCE 상에서 PEI/WUS를 탐색할 수 있다. 일부 실시예들에서, 랜덤 액세스 응답(random access response, RAR), 메시지 2(Msg2), 메시지 B(MsgB), 또는 빔 복구(beam recovery)에 대한 탐색 공간이 PEI/WUS에 대한 탐색 공간과 충돌할 때, PEI/WUS는 드롭된다. 일부 실시예들에서, UE는 PEI/WUS에 대한 탐색 공간과 RAR, Msg2, MsgB, 또는 빔 복구에 대한 탐색 공간 사이의 충돌, 이를테면 CCE 충돌 또는 동일한 CCE 상의 충돌을 예상하도록 구성되지 않는다.
PDCCH 기반 PEI/WUS와 같은 PEI/WUS는 하나 모니터링 오케이션 또는 다수의 모니터링 오케이션들을 가질 수 있다. PEI/WUS는 송신을 위한 시간 윈도우(예를 들어, 10개의 슬롯들)를 가질 수 있다. UE는 시간 윈도우 내에서 PEI/WUS를 모니터링하도록 구성될 수 있다. 일부 실시예들에서, UE는 시간 윈도우 이외에서 PEI/WUS를 예상하도록 구성되지 않는다. 이러한 제한을 이용하면, UE의 전력 소비가 절감될 수 있다.
일부 실시예들에서, 시퀀스 기반 PEI/WUS(예를 들어, SSS 기반 PEI/WUS 또는 CSI-RS 기반 PEI/WUS)가 CORESET(예를 들어, CORESET 제로) 또는 탐색 공간 상에 맵핑된다면, CCE(또는 REG, RE, RB, 또는 심볼) 상의 DM-RS는/어떠한 DM-RS도 시퀀스 기반 PEI/WUS에 할당되지 않는다. 예를 들어, 시퀀스 기반 PEI/WUS에 할당된 CCE(또는 REG, RE, RB, 또는 심볼) 상의 DM-RS는 시퀀스 기반 PEI/WUS에 의해 무시(override)될 수 있다.
일부 실시예들에서, 표시된 CSI-RS 오케이션은 CORESET과 중첩된다면, 무효(invalid)일 수 있다. 예를 들어, PEI/WUS에 의한 표시된 CSI-RS 오케이션(들)이 CORESET 스케줄링 페이징 메시지와 중첩된다면, 표시된 CSI-RS 오케이션은 무효일 것이다. 다른 예에서, CORESET 제로와 중첩되는 표시된 CSI-RS 오케이션은 무효일 것이다. 다른 예에서, 페이징 메시지를 스케줄링하는 CORESET 제로와 중첩되는 표시된 CSI-RS 오케이션은 무효일 것이다. 또 다른 예에서, PEI/WUS를 송신하는, CORESET 제로와 중첩되는 표시된 CSI-RS 오케이션은 무효일 것이다.
이러한 방법을 이용하면, 하나의 SSS 기반 PEI/WUS는 상호 간섭 없이 CORESET 0 상의 PDCCH와 공존할 수 있다. CORESET 0의 리소스가 PDCCH에 의해 점유되지 않는다면, 이용가능한 리소스는 SSS 기반 PEI/WUS에 제공될 수 있다.
예 4
RRC_Connected 상태의 UE에 대해, BS가 UE를 위한 CSI-RS 또는 TRS 리소스들을 전용 시그널링을 통해 구성할 수 있다. 전용 시그널링은 크기가 매우 클 수 있다. 시그널링은 다음의 테이블의 파라미터들과 같은 많은 파라미터들을 포함하기 때문에, 시그널링 오버헤드가 높다. 이 표는 단지 하나의 CSI-RS 리소스 세트에 대한 것이고, UE는 수개의 CSI-RS 리소스 세트들을 가질 수 있다는 것에 유의해야 한다.
CSI-RS 또는 TRS가 이를테면 SYNC/AGC를 위해, RRC_Idle 또는 RRC_Inactive 상태의 UE에 대해 공유될 때, 공유된 CSI-RS 또는 TRS의 구성 정보는 시스템 정보 블록(system information block, SIB)에서 브로드캐스트될 수 있다. 그러나, 이러한 파라미터들이 SIB에서 브로드캐스트된다면, 시그널링 오버헤드가 높을 것이다. 그 결과, 다음의 테이블에서 제시된 바와 같이, 파라미터가 구성되지 않는다면, 디폴트 값이 적용될 수 있다.
또한, SIB는 최대 길이를 갖는다(예를 들어, X=1728 비트). 이로 인해, 공유된 CSI-RS 리소스의 구성 정보를 브로드캐스트하기 위한 SIB가 X 비트보다 커야 한다면, 디폴트 값이 적용될 수 있다. 예를 들어, 모든 CSI-RS 파라미터들이 디폴트 값으로서 설정될 수 있다. 일부 실시예들에서, SIB가 최대 길이를 초과한다면, RRC_Idle 또는 RRC_Inactive 상태 하의 UE에 대해서는 CSI-RS 리소스가 공유되지 않을 것이다. 일부 실시예들에서, UE는 X 비트보다 큰 길이를 갖는 공유된 CSI-RS 리소스의 구성 정보를 반송하는 SIB를 예상하지 않도록 설정된다.
대안적으로, 공유된 CSI-RS 리소스의 구성 정보를 브로드캐스트하기 위한 SIB의 크기가 X 비트보다 크다면, SIB는 동일한 크기를 갖는 수개의 부분들로 세그먼트화될 것이다.
일부 실시예들에서, 공유된 CSI-RS 리소스의 구성 정보를 포함하는 두 개 이상의 필드들이 시그널링 오버헤드를 감소시키기 위해 조합될 수 있다. 또한, 공유된 CSI-RS 리소스의 구성 정보의 둘 이상의 필드들이 시그널링 오버헤드를 감소시키기 위해 공동으로(jointly) 표시될 수 있다. 예를 들어, "startingRB" 필드는 ceil(log2(274))=9 비트를 가질 수 있으며, "nrofRBs" 필드 또한 ceil(log2(274))=9 비트를 가질 수 있다. 이에 따라, 이들 두 필드는 18 비트를 포함한다. 이들 두 필드가 이를테면 리소스 표시자 값(resource indicator value, RIV)를 사용하여, 함께 조합된다면, ceil(log2(274*(274+1)/2))= 16 비트를 조합하여 포함할 수 있음에 따라, 비트를 절감하고 CSI-RS 리소스를 공유하기 위한 시그널링 오버헤드를 감소시킬 수 있다.
예 5
RRC_Idle/RRC_Inactive 상태의 UE에 대해, 유일한 기준 신호는 SSB이다. 이로 인해, 이에 대해 CSI-RS는 존재하지 않는다. RRC_Connected 상태의 단말에 대해서는, 하나 이상의 CSI-RS 리소스 또는 리소스 세트가 구성될 수 있다. 이들 CSI-RS 리소스는 이를테면 SIB를 통한 브로드캐스트를 통해, RRC_Idle/RRC_Inactive 상태의 UE에 대해 공유될 수 있다.
각 CSI-RS 리소스에 대해, 준 코-로케이션(quasi-co-location, QCL) 정보(예를 들어, 빔 방향)가 다음의 데이터 필드에 포함될 수 있다. QCL 정보는 QCL 타입 및 SSB에 대한 QCL 인덱스를 포함할 수 있다.
고주파 대역(예를 들어, FR2)에 대해서는, 구성되는 CSI-RS 리소스들이 많을 수 있다(예를 들어, 64개 이상의 리소스들). 각 CSI-RS 리소스의 QCL 정보가 브로드캐스트된다면, 많은 시그널링 오버헤드가 있을 것이다. 이로 인해, 시그널링 오버헤드를 감소시키기 위한 방법이 필요하다.
일부 실시예들에서, 구성된 CSI-RS 리소스의 수가 어떤 값(예를 들어, 네 개의 리소스들 또는 네 개의 리소스 세트들)보다 작거나 같다면, 각 CSI-RS 리소스의 QCL 정보는 별도로 표시되거나 브로드캐스트될 수 있다. QCL 타입은 프로토콜에서 고정될 수 있거나(예를 들어, QCL 타입 C, 또는 QCL 타입 D), 또는 시그널링 오버헤드를 감소시키기 위해, QCL 타입은 생략될 수 있다. SSB에 대한 QCL 인덱스는 PEI/WUS 및/또는 페이징-PDCCH에서 표시될 수 있다.
구성된 CSI-RS 리소스의 수가 어떤 값(예를 들어, 여덟 개의 리소스들 또는 여덟 개의 리소스 세트들)보다 크다면, 이들 CSI-RS 리소스들은 수개의 그룹들로 분할되고, 그룹 관련 정보(예를 들어, 어느 CSI-RS 리소스 또는 CSI-RS 리소스 세트가 그룹에 속하는지)가 브로드캐스트된다. 대안적으로, 각 그룹의 각 QCL 정보가 표시된다.
대안적으로, 공유 RS 리소스 (세트)의 수가 작다면(예를 들어, 단지 두 개의 RS 리소스들), 공유 RS 리소스 (세트)가 직접 표시될 수 있다. 예를 들어, 제1 공유 RS 리소스가 SSB 인덱스 0과 연관되고, 제2 공유 RS 리소스가 SSB 인덱스 1과 연관된다.
공유 CSI-RS 또는 TRS 리소스들이 많다면, 시그널링 오버헤드를 감소시키기 위해, 리소스 ID가 SSB 인덱스와 같은 어떤 특징에 따라 수개의 그룹들로 분할될 수 있다. 예를 들어, X=6개의 SSB 인덱스들이 있고 각각 Y=4개의 공유 RS 리소스들을 가진다면, 24개의 총 공유 RS 리소스들이 있다. 이들 24개의 RS 리소스들의 QCL 정보를 6개의 인덱스들을 사용하여 표시하기 위해 RS 리소스들을 SSB 인덱스에 의해 그룹화하는 것이 사용될 수 있다.
많은 CSI-RS 리소스들이 거의 동일한 파라미터들로 구성된다면, 시그널링 오버헤드는 여전히 높을 것이다. 시그널링 오버헤드를 감소시키기 위해, 동일한 파라미터들은 한 번만 표현될 수 있다. 달리 말하면, 공통 파라미터들이 모든 CSI-RS 리소스들에 대해 한 번 구성될 수 있으므로, 다른 CSI-RS 리소스들은 파라미터들을 개별적으로 구성하지 않는다. 또한, 구성되지 않는다면, 공통 파라미터들에 디폴트 값이 적용될 수 있다. 이러한 방법을 이용하면, CSI-RS 리소스들의 QCL 정보를 브로드캐스트하기 위한 시그널링 오버헤드가 감소될 수 있다.
예 6
PEI/WUS의 성능을 개선하기 위해, PEI/WUS는 적은 비트(예를 들어, K=3 비트)를 가질 수 있다. 그러나, 어드레싱될 상태들은 비트 수에 너무 클 수 있다(예를 들어, 255개의 조합들). 이로 인해, 소수의 비트로 추가 조합들을 나타내기 위한 방법들이 필요하다. 예가 다음의 테이블에 나와 있다. 테이블은 3 비트를 사용하지만, 상이한 수의 비트 및/또는 그룹에 대해 유사한 테이블들이 구성될 수 있다는 것에 유의한다.
첫째로, 보다 상위 계층이 어느 동작을 적용할지를 표시하기 위해 사용될 하나 이상의 테이블을 구성할 수 있다. 보다 상위 계층 구성 정보는 상기의 페이징 표시 채널이 (예를 들어, 상기한 예에서의 비트 구조를 적용하여) 직접 표시하는지를 포함할 수 있다. 보다 상위 계층 구성 정보는 또한 상기한 테이블과 같은, 다수의 엔트리들을 갖는 구성 테이블, 구성 엔티티, 또는 구성 인스턴스, 구성 세트, 또는 맵핑 관계를 포함할 수 있다. 예를 들어, 보다 상위 계층 구성 정보는 다수의 값들 및 그 대응하는 동작(예를 들어, 동작 1에 대한 값 0, 동작 2에 대한 값 1, 동작 3에 대한 값 2)을 갖는 구성 엔티티를 포함할 수 있다. 예를 들어, 상기한 테이블이 사용된다. 이 테이블로 다른 파라미터들이 공동으로 적용될 수 있다.
테이블은 그룹에 대한 페이징 확률을 표시하기 위해 사용될 수 있다. 예를 들어, 제1 그룹은 가장 높은 페이징 확률을 가질 수 있으며, 뒤이어 제2 그룹, 제3 그룹 등이 이어질 수 있다. 이러한 방법을 이용하면, 상대적으로 높은 페이징 확률을 갖는 그룹이 직접 어드레싱될 수 있다. 예를 들어, 상대적으로 높은 페이징 확률을 갖는 그룹은 다른 그룹들과 연관된 엔트리들과 별개의 독립적인 엔트리에서 어드레싱될 수 있다.
둘째로, PEI/WUS는 어느 엔트리가 어드레싱되는지를 표시할 수 있다. 예를 들어, 상기한 테이블에서 엔트리 4가 어드레싱된다면, 제4 그룹이 페이징된다.
기지국이 테이블을 다음과 같이 표시할 수 있다. 구성된 다수의 테이블들이 있다면, SIB가 어느 테이블이 적용되는지를 표시할 수 있다. 테이블이 표시되지 않는다면, 디폴트 테이블이 적용될 수 있다. 대안적으로, 구성된 테이블이 없다면, 디폴트 동작(예를 들어, "모든 그룹들을 어드레싱함")이 적용될 수 있다.
상이한 조건들 또는 UE들, 이를테면 상이한 UE 카테고리들/디바이스 타입들에 따라 상이한 테이블들이 적용될 수 있다. 예를 들어, RedCap UE에 대해서는 제1 테이블이 적용될 수 있는 한편, 비 RedCap UE에 대해서는 아래의 테이블이 적용될 수 있다.
유사하게, CSI-RS 가용성 표시 또한 상기한 방법을 이용할 수 있다. 또한, 페이징 그룹들과 CSI-RS 리소스 가용성은 다음의 테이블에서와 같이 공동으로 표시될 수 있다:
구성 테이블은 다음 테이블로서 적응적으로 확장될 수 있으며, 여기서 "N/A"는 "이용가능하지 않음(not available)"을 의미한다. 이러한 구성 테이블을 이용하면, 상이한 수의 엔트리가 지원될 수 있다. 예를 들어, 한 때에, 8개의 페이징 그룹들이 구성될 때, "8개의 엔트리"를 갖는 열이 적용될 수 있다. 다른 때에, 4개의 페이징 그룹들이 구성될 때, "4개의 엔트리"를 갖는 열이 적용될 수 있다. 즉, 큰 테이블에 작은 테이블이 임베드될 수 있다. 대안적으로, 가변 수의 엔트리를 지원하는 구성 엔티티가 사용될 수 있다.
이러한 방법을 이용하면, 적은 비트로, 가장 중요한 수개의 조합들이 표시될 수 있다. 많은 경우들에서, 그룹들의 모든 조합들을 표시할 필요는 없을 수 있다는 것에 유의해야 한다.
예 7
페이징-PDCCH에는 수개의 "리저브드 비트들"(6 비트 이상)이 있다. 이들 "리저브드 비트들"은 페이징 그룹, 이를테면 UE 그룹, 및/또는 CSI-RS 리소스 가용성을 표시하기 위해 사용될 수 있다. 그룹들/페이징 그룹들의 표시를 논의할 때, 동일한 원리들이 CSI-RS 리소스 가용성을 표시하기 위해 적용될 수 있다는 것에 유의한다.
첫째로, 보다 상위 계층은 (예를 들어, SIB를 통해) "리저브드 비트들"의 몇 비트가 페이징 그룹 표시 및/또는 CSI-RS 리소스 가용성 표시를 위해 사용되는지를 구성할 수 있다. 예를 들어, 3 비트가 페이징 그룹 표시를 위해 사용될 수 있다. 2, 4, 5 등이 또한 사용될 수 있다.
둘째로, "리저브드 비트들"의 의미가 결정된다. 요구되는 비트의 수가 "리저브드 비트들"의 수보다 작거나 같다면, 처음 수 개의 비트들(또는 마지막 수 개의 비트들)이 표시를 위해 사용될 수 있는 한편, 다른 비트들은 여전히 리저브된다. 표시는 페이징 표시 및/또는 CSI-RS 또는 TRS 리소스 가용성 표시를 포함한다. 예를 들어, 네 개의 페이징 그룹들이 있다면, 2 비트가 페이징 표시를 위해 사용될 수 있다. "리저브드 비트들"의 처음 2 비트가 페이징 그룹 표시를 위해 사용된다면, 나머지 리저브드 비트들은 "리저브드 비트들"로서 유지될 수 있다. 대안적으로, 나머지 리저브드 비트들은 알려진 값(예를 들어, 모두 0)으로서 설정될 수 있다.
일부 실시예들에서는, 그룹들의 상이한 조합들을 어드레싱하기 위해 리저브드 비트들을 사용하는 것이 바람직할 수 있다.
요구되는 비트의 수가 "리저브드 비트들"의 수보다 크다면, "리저브드 비트들" 각각은 하나의 그룹을 나타낼 수 있는 한편, 모두 "1"인 모든 "리저브드 비트들"은 모든 그룹들이 어드레싱되는 것을 나타낸다. 예를 들어, 페이징 표시를 위한 2개의 리저브드 비트들이 있지만, 둘보다 많은 그룹들이 있을 때 상기한 테이블이 적용될 수 있다.
보다 상위 계층 또는 SIB는 몇 개의 페이징 그룹이 구성되는지를 표시할 수 있다. 보다 상위 계층 또는 SIB는 또한 몇 개의 "리저브드 비트들"이 사용될 것인지를 표시할 수 있다.
또한, 다수의 테이블들이 구성될 수 있다. SIB는 어느 테이블이 적용되는지를 표시할 수 있다. SIB 표시가 없다면, 제1 테이블이 디폴트로 적용될 수 있다.
모든 "리저브드 비트들"이 이용된다면, 맵핑 테이블이 여전히 사용될 수 있다. 예를 들어, 3 비트가 페이징 그룹 표시를 위해 사용되고 또 다른 3 비트가 CSI-RS 리소스 가용성 표시를 위해 사용된다면, 페이징 그룹 표시를 위한 8개의 엔트리들을 갖는 테이블 및 CSI-RS 리소스 가용성 표시를 위한 8개의 엔트리들을 갖는 또 다른 테이블이 사용될 수 있다.
이러한 방법들은 가장 중요한 조합들의 선택을 표시함으로써 ― 그렇지 않으면 더욱 많은 비트들을 요구할 수 있는 ― 페이징 그룹들을 표시하기 위해 소수의 비트들을 사용한다. 그룹의 모든 조합들을 표시할 필요는 없을 수 있다는 것에 유의해야 한다. 이러한 방식으로, "리저브드 비트들"은 소수의 비트이더라도 페이징 및 CSI-RS 표시에 효과적으로 이용될 수 있다.
예 8
일부 UE들은 PEI/WUS를 지원할 수 있는 한편, 일부 UE들은 PEI/WUS를 지원하지 않을 것이다. 그러나, 대부분의 UE들은 페이징-PDCCH를 지원하도록 구성된다. 그 결과, 페이징 그룹 표시 및 CSI-RS 리소스 가용성 표시를 포함하는 구성 정보를 PEI/WUS와 PDCCH 사이에 분배하는 것은 어느 하나 단독보다 많은 UE들의 표시를 가능하게 할 수 있다.
제1 예에서, PEI/WUS와 페이징-PDCCH 둘 모두 상에서(예를 들어, 예 7에서 설명된 바와 같이 "리저브드 비트들" 상에서) 동일한 콘텐츠가 송신될 수 있다. PEI/WUS를 지원하는 UE는 PEI/WUS를 이용하여 페이징 그룹 표시 및 CSI-RS 리소스 가용성 표시를 얻을 수 있다. 이로 인해, UE는 하나의 신호를 수신함으로써 더 많은 전력을 절감할 수 있다. UE가 PEI/WUS의 수신을 놓친다면, UE는 페이징 그룹 표시 및 CSI-RS 리소스 가용성 표시를 수신하기 위해 페이징-PDCCH를 이용할 수 있다. 또한, UE가 PEI/WUS와 페이징-PDCCH 둘 모두를 수신할 수 있다면, 표시 정보의 신뢰성이 개선될 수 있다.
제2 예에서, PEI/WUS 및 페이징-PDCCH 상에서 페이징 그룹 표시들 및 CSI-RS 리소스 가용성 표시 정보의 서브세트가 반송될 수 있다. 예를 들어, 페이징 그룹 표시가 PEI/WUS 상에서 반송될 수 있는 한편, CSI-RS 리소스 가용성 표시가 페이징-PDCCH 상에서 반송된다. 다른 예에서, 페이징 그룹 표시가 3 비트를 요구하고 CSI-RS 리소스 가용성 표시가 또한 3 비트를 요구한다면, PEI/WUS는 페이징 그룹 표시의 3 비트 및 CSI-RS 리소스 가용성 표시의 1 비트를 반송할 수 있는 한편, 페이징-PDCCH는 CSI-RS 리소스 가용성 표시의 2 비트를 반송할 수 있다. 이로 인해, PEI/WUS에 대한 페이징 그룹 표시들 및 CSI-RS 리소스 가용성 표시 정보의 서브세트는 3+1 비트인 한편, 페이징-PDCCH에 대한 페이징 그룹 표시 및 CSI-RS 리소스 가용성 표시 정보의 서브세트는 ― 이 경우 CSI-RS 리소스 가용성 정보를 포함하는 ― 2 비트이다. 채널당 몇 비트가 페이징 또는 CSI-RS 표시를 위해 사용되는지에 따라 다른 비트 분배가 구성될 수 있다.
다른 예에서, PEI/WUS가 구성된다면, CSI-RS 리소스 가용성 표시 정보의 서브세트(예를 들어, 1 비트)가 PEI/WUS 상에서 반송될 수 있는 한편, CSI-RS 리소스 가용성 표시 정보의 나머지는 페이징-PDCCH 상에서 반송된다. PEI/WUS 상에서 반송되는 CSI-RS 리소스 가용성 표시 정보의 1 비트는 CSI-RS 리소스를 직접 표시하기보다는, 페이징-PDCCH 상의 CSI-RS 리소스 가용성 표시 정보에 대한 임의의 변화가 있는지 여부를 표시할 수 있다. 대안적으로, PEI/WUS 상에서 반송되는 CSI-RS 리소스 가용성 표시 정보의 단일 비트 이외의 다른 서브세트들이 페이징-PDCCH 상의 CSI-RS 리소스 가용성 표시 정보에 대한 임의의 변화가 있는지 여부를 표시할 수 있다.
일부 실시예들에서, PEI/WUS 상에서 반송되는 CSI-RS 리소스 가용성 표시 정보의 서브세트는 CSI-RS 리소스 가용성 표시 정보가 페이징-PDCCH 상에 존재하는지 여부를 표시할 수 있다. 유사하게, 페이징-PDCCH 상에서 반송되는 CSI-RS 리소스 가용성 표시 정보의 서브세트는 CSI-RS 리소스 가용성 표시 정보가 PEI/WUS 상에 존재하는지 여부를 표시할 수 있다.
PEI/WUS 상에서 반송되는 페이징 그룹 표시의 서브세트는 페이징 그룹 표시가 페이징-PDCCH 상에 존재하는지 여부를 표시할 수 있다. 유사하게, 페이징-PDCCH 상에서 반송되는 페이징 그룹 표시의 서브세트는 페이징 그룹 표시가 PEI/WUS 상에 존재하는지 여부를 표시할 수 있다.
보다 상위 계층은 (예를 들어, SIB를 통해) PEI/WUS 및 페이징-PDCCH 상의 페이징 그룹 표시 및 CSI-RS 리소스 가용성 표시 정보의 서브세트를 표시할 수 있다. 예를 들어, SIB가 PEI/WUS 상의 4개의 페이징 그룹들(예를 들어, 그룹당 1 비트씩, 4 비트) 및 PEI/WUS 상의 2 CSI-RS 리소스 가용성(예를 들어, CSI-RS 리소스당 1 비트씩, 2 비트)을 표시할 수 있는 한편, 또 다른 6 CSI-RS 리소스 가용성은 페이징-PDCCH 상에서 반송될 수 있다.
일부 실시예들에서, 페이징 그룹 표시와 CSI-RS 리소스 가용성 표시에 대한 다음의 맵핑 테이블이 있다.
페이징 그룹 및/또는 CSI-RS 리소스 가용성의 서브세트가 PEI/WUS 상에서 송신될 수 있다. 대안적으로, 페이징 그룹 및/또는 CSI-RS 리소스 가용성의 서브세트가 PO의 페이징-PDCCH 상에서 송신된다. 예를 들어, 페이징 그룹 및 제1 CSI-RS 리소스 가용성은 PEI/WUS 상에서 표시되는 한편, 다른 CSI-RS 리소스 가용성은 페이징-PDCCH 상에서 표시된다.
페이징-PDCCH 표시들과 PEI/WUS(예를 들어, PDCCH 기반 PEI) 표시 둘 모두는 (예를 들어, SIB, 또는 보다 상위 계층 시그널링을 통해) 예를 들어, 복제가 인에이블될 수 있다. 대안적으로, PEI/WUS(예를 들어, PDCCH 기반 PEI) 표시가 구성된다면 페이징-PDCCH 표시는 디스에이블될 수 있다. 대안적으로, 페이징-PDCCH 표시는 PEI/WUS(예를 들어, PDCCH 기반 PEI) 표시에 의해 디스에이블되거나 인에이블될 수 있다. 대안적으로, 페이징-PDCCH 표시들 및 PEI/WUS 표시들 중 하나 또는 둘 모두는 보다 상위 계층에 의해 구성될 수 있다. 대안적으로, 페이징-PDCCH 표시들 및 PEI/WUS 표시들 중 어느 하나 또는 둘 모두는 SIB에서 브로드캐스트될 수 있다.
이러한 방법들은 페이징 그룹 및/또는 CSI-RS 리소스 가용성을 표시할 때 보다 큰 유연성을 허용한다.
예 9
PDCCH 또는 PDCCH 기반 PEI/WUS를 수반하는 CORESET에서, DM-RS는 PDCCH 또는 PDCCH 기반 PEI/WUS와 함께 송신될 것이다. 이로 인해, UE 측에서, UE가 타겟 후보 CCE 상에서 DM-RS를 검출하지 않는다면, 이 UE는 PDCCH 또는 PDCCH 기반 PEI/WUS가 송신되지 않는다고 가정할 수 있다. 일부 실시예들에서, UE가 타겟 후보 CCE 상에서 DM-RS를 검출하지 않는다면, 이 UE는 PDCCH 기반 PEI/WUS가 존재하지 않는다고 가정할 수 있다.
UE가 타겟 후보 CCE 상에서 DM-RS를 검출하지 않는다면, UE는 다른 액션들을 수행할 수 있다. 예를 들어, UE가 타겟 후보 CCE 상에서 DM-RS를 검출하지 않는다면, 이 UE는 CSI-RS 가용성의 상태가 변경되지 않는다고 가정할 수 있다. 다른 예에서, UE가 타겟 후보 CCE 상에서 DM-RS를 검출하지 않고 모든 CSI-RS 가용성의 상태들이 공동으로 인코딩된다면, 이 UE는 CSI-RS 가용성의 상태가 변경되지 않는다고 가정할 수 있다. 대안적으로, UE가 타겟 후보 CCE 상에서 DM-RS를 검출하지 않고 코드 포인트가 모든 CSI-RS 가용성 상태를 나타낸다면, 이 UE는 CSI-RS 가용성의 상태가 변경되지 않는다고 가정할 수 있다.
DM-RS 검출에 대해 검출 임계치가 정의될 수 있다. 예를 들어, 검출 임계치는 Th=-125dBm일 수 있다. UE가 DM-RS를 검출 임계치 미만의 전력으로 수신한다면, 이 UE는 PDCCH 기반 PEI/WUS가 존재하지 않는다고(또는 위에서 설명된 다른 가정들/액션들 중 임의의 것을) 가정할 수 있다. 예를 들어, UE가 DM-RS를 -130dBm의 전력으로 수신한다면, 이 UE는 PDCCH 기반 PEI/WUS가 없다고 가정할 수 있다.
이러한 방법을 이용하면, CORESET에서의 PDCCH를 디코딩하지 않고 DM-RS를 검출함으로써, UE는 PDCCH 기반 PEI/WUS 및/또는 CSI-RS 가용성의 존재를 결정할 수 있다.
예 10
이 예에서, DM-RS는 (예를 들어, 이의 초기화 시드 상에서, 상기한 상세한 예 참조) 1 비트 또는 다수의 비트들을 반송할 수 있다. DM-RS 상의 비트들은 PDCCH에서의 비트들(예를 들어, 다운링크 제어 정보(downlink control information, DCI)과 공동으로 인코딩될 수 있다.
예를 들어, 어드레싱될 N=8개의 그룹들이 있다면, 어느 그룹이 어드레싱될 것인지를 표시하기 위해 다음의 테이블이 적용될 수 있다. 이 예에서, 코드 포인트 플러스 제1 그룹이 어드레싱될 것이다. 이 동작은 예를 들어, PO와 연관될 수 있다.
일부 실시예들에서, 어느 그룹이 어드레싱될 것인지를 표시하기 위해 다음의 테이블이 적용될 수 있다.
상기한 테이블들에서의 "리저브드 상태(들)"는 CSI-RS 가용성을 표시할 수 있다. 예를 들어, 코드 포인트 값 10은 CSI-RS 리소스 중 어느 것도 이용가능하지 않음을 나타낼 수 있다. 다른 예에서, 코드 포인트 값 11은 모든 CSI-RS 리소스 (세트)가 이용가능함을 나타낼 수 있다.
DM-RS와 DCI의 공동 비트들 중 하나 이상의 비트는 CSI-RS 가용성을 표시할 수 있다. 예를 들어, 최상위 비트(most significant bit, MSB)가 CSI-RS 리소스 가용성을 나타낼 수 있다(예를 들어, CSI-RS 리소스 중 어느 것도 이용가능하지 않은 경우 "0", 한편 모든 CSI-RS 리소스 (세트)가 이용가능한 경우 "1").
다른 예에서, DM-RS는 웨이크업 표시, 즉 어느 페이징 그룹이 어드레싱될 것인지를 표시할 수 있는 한편, DCI에서의 비트들이 CSI-RS 리소스 가용성을 표시할 수 있다.
다른 예에서는, DM-RS가 CSI-RS 리소스 가용성을 표시할 수 있는 한편, DCI에서의 비트들은 웨이크업/페이징 표시들을 표시할 수 있다.
예 11
다수의 PO들의 동작은 DCI에서의 비트들과 DM-RS에서의 비트들의 조합, 이를테면 공동으로 인코딩된 비트들로서 공동으로 표현될 수 있다. 예를 들어, DCI에서의 비트들과 DM-RS에서의 비트들의 공동 비트들에서의 첫 번째 4 비트가 제1 PO의 동작을 표시할 수 있고, DCI에서의 비트들과 DM-RS에서의 비트들의 공동 비트들에서의 두 번째 4 비트는 제2 PO의 동작을 표시할 수 있다.
일부 실시예들에서, DM/RS는 어느 PO가 어드레싱되는지를 표시할 수 있다. 예를 들어, DM-RS의 1 비트가 PO에 대응한다. 대안적으로, DM-RS의 일부 비트들의 코드 포인트가 어느 PO가 어드레싱(웨이크업)되는지를 표시할 수 있다. DM-RS에서의 일부 비트들의 코드 포인트는 어드레싱되는 하나 이상의 PO의 하나 이상의 그룹을 표시할 수 있다.
유사하게, DCI에서의 비트(들)가 DM-RS에서의 비트들 대신에 사용될 수 있다. 예를 들어, 각 PO에 대한 페이징 그룹 표시 정보에 대해, 하나 이상의 그룹 또는 서브그룹을 어드레싱하는 비트 블록이 DCI에 있을 수 있다. 본 문헌에서 설명된 바와 같이, 비트 블록은 비트맵, 코드 포인트, 또는 공동 인코딩을 사용하여 그룹들 또는 서브그룹들을 어드레싱할 수 있다.
예를 들어, 예 10에서와 유사한 "리저브드 상태(들)"가 CSI-RS 가용성을 표시할 수 있다.
다른 예에서, DM-RS와 DCI의 공동 비트들에서 하나 이상의 비트가 CSI-RS 가용성을 표시할 수 있다.
다른 예에서, DM-RS는 웨이크업 표시, 즉 어느 페이징 그룹이 어드레싱될 것인지를 표시할 수 있는 한편, DCI에서의 비트들이 CSI-RS 리소스 가용성을 표시할 수 있다.
다른 예에서는, DM-RS가 CSI-RS 리소스 가용성을 표시할 수 있는 한편, DCI에서의 비트들은 웨이크업/페이징 표시들을 표시할 수 있다.
예 12
페이징 표시 또는 CSI-RS 리소스 가용성 표시는 PDCCH 기반 PEI의 비트 스크램블링 코드로 반송될 수 있다. PDCCH 기반 PEI의 인코딩 및 레이트 매칭 후에, 가 얻어지며, 이때 i = 0,1,2, …, M-1(여기서 M은 레이트 매칭 후의 비트의 수임)이다. 는 상기한 예들에서 설명된 와 같은 스크램블링 시퀀스 에 의해 스크램블링될 것이다. 비트 스크램블링 연산은 와 같을 수 있으며, 여기서 는 모듈러-2 플러스 또는 XOR 연산이고 는 스크램블링된 비트이다.
페이징 표시 정보 및/또는 CSI-RS 리소스 가용성 표시는 스크램블링 시퀀스 를 생성하기 위해 사용될 수 있다. 예를 들어, 스크램블링 시퀀스 는 초기화 시드 로 초기화될 수 있으며, 여기서 는 라디오 네트워크 임시 ID(예를 들어, 이는 페이징 RNTI, 0x FFFE의 값 또는 제로로서 구성될 수 있음)이고, 는 보다 상위 계층에 의해 구성된 파라미터(예를 들어, 제로)이고, 은 페이징 그룹 표시(예를 들어, 8 비트를 갖는 값, 이를테면 100)이고, 는 CSI-RS 리소스 가용성 표시(예를 들어, 12 비트를 갖는 값, 이를테면 200. 이 값은 상이한 수의 비트를 갖는, 예 6에서 논의된 것들과 유사한 테이블의 엔트리 또는 코드 포인트일 수 있음)이다. 또한, 및 는 또한 초기화 시드에 없을 수 있다.
PDCCH 기반 PEI/WUS를 디코딩한 후, UE는 및/또는 의 값을 얻을 수 있다. 이로 인해, 이 UE는 어느 그룹이 어드레싱될지 그리고/또는 CSI-RS 리소스 가용성을 알 수 있다. 이 방법은 UE가 어느 그룹이 페이징될지 그리고/또는 어느 CSI-RS 리소스들이 이용가능할지를 결정할 수 있게 한다. 이로 인해, 이는 슬립을 최대화함으로써 UE의 전력 소비를 절감할 수 있다.
도 10은 예시적인 방법(1000)을 도시한다. 1002에서, 페이징 구성 정보가 수신된다. 페이징 구성 정보는 페이징 메시지와 연관될 수 있다. 예를 들어, 페이징 구성은 페이징 표시 채널 및/또는 페이징 오케이션을 포함할 수 있다. 페이징 구성 정보는 하나 이상의 그룹에 대한 페이징 확률을 표시할 수 있다. 일부 실시예들에서, 페이징 확률은 구성 엔티티의 엔트리에 포함될 수 있다. 페이징 구성 정보는 CSI-RS 리소스 가용성 정보를 더 포함할 수 있다. 1004에서, 수신된 페이징 구성 정보에 기초하여, 페이징 메시지가 모니터링된다.
페이징 구성 정보에 기초하여 페이징 메시지에 대해 모니터링하는 단계를 포함하는, 무선 통신 방법.
도 11은 예시적인 방법(1100)을 도시한다. 1102에서, 페이징 메시지와 연관된 페이징 구성 정보가 송신된다. 페이징 구성은 페이징 표시 채널 및 페이징 오케이션을 포함할 수 있다. 페이징 구성 정보는 하나 이상의 그룹에 대한 페이징 확률을 표시할 수 있다. 일부 실시예들에서, 페이징 확률은 구성 엔티티의 엔트리에 포함될 수 있다. 페이징 구성 정보는 CSI-RS 리소스 가용성 정보를 더 포함할 수 있다. 1104에서, 페이징 구성 정보에 따라 페이징 메시지가 송신된다.
일부 실시예들은 바람직하게는 본 명세서에서 설명된 바와 같은 다음 솔루션들을 포함할 수 있다.
예를 들어, 아래에 나열되는 솔루션들은 본원에서 설명된 바와 같은 페이징을 위해 무선 디바이스 구현예들에 의해 사용될 수 있다:
1. 무선 디바이스에서, 페이징 메시지와 연관된 페이징 구성 정보를 수신하는 단계(1002); 및 페이징 구성 정보에 기초하여 페이징 메시지에 대해 모니터링하는 단계(1004)를 포함하는, 무선 통신 방법(예를 들어, 도 10의 방법(1000)).
2. 제1 솔루션에 있어서, 페이징 구성 정보는 페이징 표시 채널 및 페이징 오케이션을 표시하는 것인, 무선 통신 방법.
3. 제1 솔루션에 있어서, 페이징 구성 정보에 따라 페이징 메시지를 수신하는 단계를 더 포함하는, 무선 통신 방법.
4. 제1 솔루션에 있어서, 페이징 구성 정보는 하나 이상의 그룹과 연관된 구성 엔티티를 포함하는 것인(예를 들어, 비트 필드 구조들(도 5 내지 도 9의 500, 600, 700, 800, 또는 900), 무선 통신 방법.
5. 제4 솔루션에 있어서, 구성 엔티티의 엔트리는 하나 이상의 그룹의 페이징 확률을 포함하는 것인, 무선 통신 방법.
6. 제5 솔루션에 있어서, 엔트리는 단일 그룹의 페이징 확률을 포함하고, 단일 그룹의 페이징 확률은 제2 그룹의 페이징 확률보다 높은 것인, 무선 통신 방법.
7. 제4 솔루션에 있어서, 구성 엔티티는 가변 수의 엔트리 또는 복수의 미리 정의된 구성 서브 엔티티들을 포함하는 것인, 무선 통신 방법.
8. 제4 솔루션에 있어서, 구성 엔티티는 디바이스 타입과 연관되는 것인, 무선 통신 방법.
9. 제1 솔루션 내지 제8 솔루션 중 어느 하나에 있어서,
페이징 구성 정보는 채널 상태 정보 기준 신호(CSI-RS) 리소스 가용성 정보를 포함하는 것인, 무선 통신 방법.
10. 제9 솔루션에 있어서, 페이징 표시 채널이 구성되고, 페이징 표시 채널 상에서 CSI-RS 리소스 가용성 정보의 서브세트가 반송되는 것인, 무선 통신 방법.
11. 제10 솔루션에 있어서, CSI-RS 리소스 가용성 정보의 서브세트는 페이징-PDCCH 상의 CSI-RS 리소스 가용성의 변화를 표시하는 것인, 무선 통신 방법.
12. 제1 솔루션에 있어서, 페이징 구성 정보는 N개의 페이징 오케이션 및 M개의 그룹을 표시하고 비트 구조(예를 들어, 도 6의 비트 구조(600))를 포함하며, 비트 구조는: N 비트 ― N 비트 각각은 N개의 페이징 오케이션 중 하나와 각각 연관됨 ― 의 제1 블록; 및 M 비트의 복수의 블록들 ― M 비트의 복수의 블록들 각각은 제1 블록의 N 비트 중 하나와 연관되고, 제1 블록의 연관된 비트가 특정 값을 갖는 경우에만 존재함 ― 을 포함하는 것인, 무선 통신 방법.
13. 제1 솔루션에 있어서, 페이징 구성 정보는 N개의 페이징 오케이션을 표시하고 비트 구조(예를 들어, 도 5의 비트 구조(500))를 포함하며, 비트 구조는: 각 M 비트의 N개의 블록들 ― N개의 블록들 각각은 N개의 페이징 오케이션 중 하나와 연관되며, M 비트 각각은 그룹과 연관됨 ― 을 포함하는 것인, 무선 통신 방법.
14. 제1 솔루션에 있어서, 페이징 구성 정보는 비트 구조(예를 들어, 도 9의 비트 구조(900))를 포함하며, 비트 구조는: 페이징 표시와 연관된 복수의 블록들; 및 CSI-RS 리소스 세트의 가용성을 표시하는 Q 비트를 포함하는 것인, 무선 통신 방법.
15. 제14 솔루션에 있어서, Q 비트 각각은 대응하는 CSI-RS 리소스 세트가 이용가능한지 여부를 표시하는 것인, 무선 통신 방법.
16. 제14 솔루션에 있어서, CSI-RS 리소스의 가용성은 Q 비트를 포함하는 코드 포인트에 의해 표시되는 것인, 무선 통신 방법.
17. 제14 솔루션에 있어서, 페이징 구성 정보는 Q개의 CSI-RS 리소스 세트보다 크다는 것을 표시하는 것이며, 방법은: Q 비트에 대해 미리 정의된 연산을 수행하는 단계를 더 포함하는, 무선 통신 방법.
18. 제17 솔루션에 있어서, 미리 정의된 연산은 모듈로 연산이고, 제k CSI-RS 리소스 세트가 Q 비트의 제q 비트에 의해 표시되며, q = 1 + mod((k-1,Q)인 것인, 무선 통신 방법.
19. 제1 솔루션에 있어서, 페이징 구성 정보는 보조 동기화 신호(SSS)에 기초하고, 제어 리소스 세트(CORESET) 리소스를 인터리브 방식으로 점유하는 것인, 무선 통신 방법.
20. 제19 솔루션에 있어서, 페이징 구성 정보는 먼저 주파수 도메인에서 맵핑되고, 그 다음 시간 도메인에서 맵핑되는 것인, 무선 통신 방법.
21. 제19 솔루션에 있어서, CORESET 리소스는 다수의 제어 채널 엘리먼트(CCE)들을 포함하며, 각 CCE는 다수의 리소스 엘리먼트(RE)들을 포함하고, SSS 기반 구성 정보의 길이가 각 CCE에서의 리소스 엘리먼트의 수의 배수와 동일하지 않은 것이며, 방법은: 구성 정보의 각 말단에 하나 이상의 제로를 추가하는 단계를 더 포함하는, 무선 통신 방법.
22. 제19 솔루션에 있어서, CORESET 리소스는 다수의 제어 채널 엘리먼트(CCE)들을 포함하며, 각 CCE는 다수의 리소스 엘리먼트(RE)들을 포함하고, SSS 기반 구성 정보의 길이가 각 CCE에서의 리소스 엘리먼트의 수의 배수와 동일하지 않은 것이며, 방법은: 하나 이상의 RE를 제로로서 설정하는 단계를 더 포함하는, 무선 통신 방법.
23. 제19 솔루션에 있어서, CCE 번호가 자신의 리소스 블록(RB) 인덱스, 리소스 엘리먼트 그룹(REG) 인덱스, 또는 REG 번들 인덱스에 따라 인터리빙되는 것인, 무선 통신 방법.
24. 제1 솔루션에 있어서, 페이징 구성 정보는 CSI-RS 구성 정보를 포함하는 것인, 무선 통신 방법.
25. 제24 솔루션에 있어서, CSI-RS 구성 정보는 디폴트 값을 포함하는 것인, 무선 통신 방법.
26. 제24 솔루션에 있어서, CSI-RS 구성 정보는 하나의 필드로 조합될 수 있는 복수의 필드들을 포함하는 것인, 무선 통신 방법.
27. 제24 솔루션에 있어서, CSI-RS 구성 정보는 구성된 CSI-RS 리소스의 수에 기초하여 준 코-로케이션(QCL) 정보를 표시하는 것인, 무선 통신 방법.
28. 제1 솔루션에 있어서,
복조 기준 신호(DM-RS)를 검출함으로써 페이징 구성 정보의 존재를 결정하는 단계를 더 포함하는, 무선 통신 방법.
29. 제28 솔루션에 있어서, 페이징 구성 정보의 존재는 검출된 DM-RS가 임계값을 초과할 때 결정되는 것인, 무선 통신 방법.
30. 제28 솔루션에 있어서, 다운링크 제어 정보(DCI)에서의 비트들과 DM-RS에서의 비트들은 공동으로 인코딩되고, 공동으로 인코딩된 비트들은 페이징 그룹을 표시하는 것인, 무선 통신 방법.
31. 제31 솔루션에 있어서, 공동으로 인코딩된 비트들은 코드 포인트에 기초하여 페이징 그룹을 표시하는 것인, 무선 통신 방법.
32. 제28 솔루션에 있어서, 다운링크 제어 정보(DCI)에서의 비트들과 DM-RS에서의 비트들은 공동으로 인코딩되고, 공동으로 인코딩된 비트들은 CSI-RS 가용성을 표시하는 것인, 무선 통신 방법.
33. 제1 솔루션에 있어서, 페이징 구성 정보는 비트 스크램블링 시퀀스로 수신되는 것인, 무선 통신 방법.
34. 제24 솔루션에 있어서, CSI-RS 구성 정보는 비트 스크램블링 시퀀스로 수신되는 것인, 무선 통신 방법.
35. 네트워크 디바이스에 의해, 페이징 메시지와 연관된 페이징 구성 정보를 송신하는 단계; 및 페이징 구성 정보에 따라 페이징 메시지를 송신하는 단계를 포함하는, 무선 통신 방법.
36. 제35 솔루션에 있어서, 페이징 구성 정보는 페이징 표시 채널 및 페이징 오케이션을 표시하는 것인, 무선 통신 방법.
37. 제35 솔루션에 있어서, 페이징 구성 정보는 하나 이상의 그룹과 연관된 구성 엔티티를 포함하는 것인, 무선 통신 방법.
38. 제35 솔루션에 있어서, 구성 엔티티의 엔트리는 하나 이상의 그룹의 페이징 확률을 포함하는 것인, 무선 통신 방법.
39. 제38 솔루션에 있어서, 엔트리는 단일 그룹의 페이징 확률을 포함하고, 단일 그룹의 페이징 확률은 제2 그룹의 페이징 확률보다 높은 것인, 무선 통신 방법.
40. 제35 솔루션 내지 제39 솔루션 중 어느 하나에 있어서,
페이징 구성 정보는 채널 상태 정보 기준 신호(CSI-RS) 리소스 가용성 정보를 포함하는 것인, 무선 통신 방법.
41. 제35 솔루션에 있어서, 페이징 구성 정보는 N개의 페이징 오케이션 및 M개의 그룹을 표시하고 비트 구조를 포함하며, 비트 구조는:
N 비트 ― N 비트 각각은 N개의 페이징 오케이션 중 하나와 각각 연관됨 ― 의 제1 블록; 및 M 비트의 복수의 블록들 ― M 비트의 복수의 블록들 각각은 제1 블록의 N 비트 중 하나와 연관되고, 제1 블록의 연관된 비트가 특정 값을 갖는 경우에만 존재함 ― 을 포함하는 것인, 무선 통신 방법.
42. 제35 솔루션에 있어서, 페이징 구성 정보는 N개의 페이징 오케이션을 표시하고 비트 구조를 포함하며, 비트 구조는: 각 M 비트의 N개의 블록들 ― N개의 블록들 각각은 N개의 페이징 오케이션 중 하나와 연관되며, M 비트 각각은 그룹과 연관됨 ― 을 포함하는 것인, 무선 통신 방법.
43. 제35 솔루션에 있어서, 페이징 구성 정보는 보조 동기화 신호(SSS)에 기초하고, 제어 리소스 세트(CORESET) 리소스를 인터리브 방식으로 점유하는 것인, 무선 통신 방법.
44. 제35 솔루션에 있어서, 페이징 구성 정보는 CSI-RS 구성 정보를 포함하는 것인, 무선 통신 방법.
45. 제44 솔루션에 있어서, CSI-RS 구성 정보는 디폴트 값을 포함하는 것인, 무선 통신 방법.
46. 제44 솔루션에 있어서, CSI-RS 구성 정보는 하나의 필드로 조합될 수 있는 복수의 필드들을 포함하는 것인, 무선 통신 방법.
47. 제44 솔루션에 있어서, CSI-RS 구성 정보는 구성된 CSI-RS 리소스의 수에 기초하여 준 코-로케이션(QCL) 정보를 표시하는 것인, 무선 통신 방법.
48. 제1 솔루션 내지 제47 솔루션 어느 하나의 방법을 구현하도록 구성된 프로세서를 포함하는 무선 통신 장치.
49. 프로세서에 의해 실행될 때, 프로세서로 하여금 제1 솔루션 내지 제47 솔루션 어느 하나에 기재된 방법을 구현하게 하는 코드가 저장되어 있는 컴퓨터 판독가능 매체.
도 12는 본원에서 개시된 기술의 일부 실시예들에 따른, 장치의 일부분의 블록도이다. 네트워크 디바이스 또는 기지국 또는 무선 디바이스(또는 UE)와 같은 장치(1205)는 본 문헌에서 제시된 기법들 중 하나 이상을 구현하는 마이크로프로세서와 같은 프로세서 전자장치(1210)를 포함할 수 있다. 장치(1205)는 안테나(들)(1220)와 같은 하나 이상의 통신 인터페이스를 통해 무선 신호들을 발신하고/하거나 수신하기 위한 송수신기 전자장치(1215)를 포함할 수 있다. 장치(1205)는 데이터를 송신하고 수신하기 위한 다른 통신 인터페이스들을 포함할 수 있다. 장치(1205)는 데이터 및/또는 명령어들과 같은 정보를 저장하도록 구성된 하나 이상의 메모리(명시적으로 도시되지 않음)를 포함할 수 있다. 일부 구현예들에서, 프로세서 전자장치(1210)는 송수신기 전자장치(1215)의 적어도 일부분을 포함할 수 있다. 일부 실시예들에서, 개시된 기법들, 모듈들 또는 기능들의 적어도 일부가 장치(1205)를 사용하여 구현된다.
본원에서 설명된 실시예들의 일부는 네트워크화된 환경에서 컴퓨터에 의해 실행되는 프로그램 코드와 같은 컴퓨터 실행가능 명령어를 포함하는 컴퓨터 판독가능 매체에서 구현되는 컴퓨터 프로그램 제품에 의해 일 실시예에서 구현될 수 있는 방법들 또는 프로세스들의 일반적인 맥락에서 설명된다. 컴퓨터 판독가능 매체는 ROM(Read Only Memory), RAM(Random Access Memory), CD(compact disc), DVD(digital versatile disc) 등을 포함하지만 이에 제한되지 않는 탈착식 및 비탈착식 저장 디바이스들을 포함할 수 있다. 따라서, 컴퓨터 판독가능 매체는 비일시적인 저장 매체를 포함할 수 있다. 일반적으로, 프로그램 모듈은 특정 작업들을 수행하거나 특정 추상 데이터 타입들을 구현하는 루틴, 프로그램, 객체, 컴포넌트, 데이터 구조 등을 포함할 수 있다. 컴퓨터 실행가능 또는 프로세서 실행가능 명령어, 연관 데이터 구조 및 프로그램 모듈은 본원에서 개시된 방법들의 단계를 실행하기 위한 프로그램 코드의 예들을 나타낸다. 이러한 실행가능 명령어들 또는 연관 데이터 구조들의 특정 시퀀스는 이러한 단계들 또는 프로세스들에서 설명된 기능들을 구현하기 위한 대응하는 동작들의 예들을 나타낸다.
개시된 실시예들의 일부는 하드웨어 회로, 소프트웨어,또는 이들의 조합을 사용하여 디바이스 또는 모듈로서 구현될 수 있다. 예를 들어, 하드웨어 회로 구현은 예를 들어, 인쇄 회로 기판의 일부로서 집적되는 개별 아날로그 및/또는 디지털 컴포넌트들을 포함할 수 있다. 대안적으로,또는 추가적으로, 개시된 컴포넌트 또는 모듈은 ASIC(Application Specific Integrated Circuit) 및/또는 FPGA(Field Programmable Gate Array) 디바이스로서 구현될 수 있다. 일부 구현예들은 추가적으로 또는 대안적으로 본 출원의 개시된 기능들과 연관된 디지털 신호 프로세싱의 동작 요구에 최적화된 아키텍처를 갖는 특수 마이크로프로세서인 DSP(digital signal processor) 포함할 수 있다. 유사하게, 각 모듈 내의 다양한 컴포넌트들 또는 서브 컴포넌트들은 소프트웨어, 하드웨어 또는 펌웨어로 구현될 수 있다. 모듈들 및/또는 모듈들 내의 컴포넌트들 간의 연결성은 적절한 프로토콜들을 사용하는 인터넷, 유선, 또는 무선 네트워크들을 통한 통신을 포함하지만 이에 제한되지 않는, 당업계에 알려져 있는 연결 방법들 및 매체들 중 어느 하나를 사용하여 제공될 수 있다.
본 문헌이 많은 특정 사항들을 포함하고 있지만, 이것들은 청구되는 발명 또는 청구될 수 있는 것의 범위에 대한 제한으로서 해석되어서는 안 되고, 특정 실시예들에 특정한 특징들에 대한 설명인 것으로서 해석되어야 한다. 또한, 본 문헌에서 개별 실시예들의 맥락에서 설명되는 특정 특징들은 단일 실시예와에서 조합하여 구현될 수도 있다. 반대로, 단일의 실시예의 상황에서 설명되는 다양한 특징들은 또한 다수의 실시예들에서 별개로 또는 임의의 적절한 하위 조합으로 구현될 수도 있다. 또한, 위에서 특징들이 특정 조합들로 작용하는 것으로서 설명될 수 있고, 처음에 이와 같이 청구될 수도 있지만, 일부 경우들에서는 청구된 조합으로부터의 하나 이상의 특징이 그 조합으로부터 삭제될 수 있고, 청구된 조합은 하위 조합 또는 하위 조합의 변형에 관한 것일 수 있다. 유사하게, 동작들이 도면들에서 특정 순서로 도시되어 있지만, 이는 바람직한 결과들을 달성하는 데, 이와 같은 동작들이 도시된 특정 순서 또는 순차적 순서로 수행되거나, 모든 예시된 동작들이 수행될 것을 요구하는 것으로서 이해되어서는 안 된다.
단지 몇몇 구현예들 및 예들이 설명되어 있고, 본 개시에서 설명되고 예시된 것에 기초하여 다른 구현, 향상 및 변형이 이루어질 수 있다.

Claims (49)

  1. 무선 통신 방법으로서,
    무선 디바이스에서, 페이징 메시지(paging message)와 연관된 페이징 구성 정보를 수신하는 단계; 및
    상기 페이징 구성 정보에 기초하여 상기 페이징 메시지에 대해 모니터링하는 단계
    를 포함하는, 무선 통신 방법.
  2. 제1항에 있어서,
    상기 페이징 구성 정보는 페이징 표시 채널 및 페이징 오케이션(paging occasion)을 표시하는 것인, 무선 통신 방법.
  3. 제1항에 있어서,
    상기 페이징 구성 정보에 따라 상기 페이징 메시지를 수신하는 단계를 더 포함하는, 무선 통신 방법.
  4. 제1항에 있어서,
    상기 페이징 구성 정보는 하나 이상의 그룹과 연관된 구성 엔티티를 포함하는 것인, 무선 통신 방법.
  5. 제4항에 있어서,
    상기 구성 엔티티의 엔트리는 상기 하나 이상의 그룹의 페이징 확률(paging probability)을 포함하는 것인, 무선 통신 방법.
  6. 제5항에 있어서,
    상기 엔트리는 단일 그룹(single group)의 페이징 확률을 포함하고, 상기 단일 그룹의 페이징 확률은 제2 그룹의 페이징 확률보다 높은 것인, 무선 통신 방법.
  7. 제4항에 있어서,
    상기 구성 엔티티는 가변 수의 엔트리 또는 복수의 미리 정의된 구성 서브 엔티티들을 포함하는 것인, 무선 통신 방법.
  8. 제4항에 있어서,
    상기 구성 엔티티는 디바이스 타입과 연관되는 것인, 무선 통신 방법.
  9. 제1항 내지 제8항 중 어느 한 항에 있어서,
    상기 페이징 구성 정보는 채널 상태 정보 기준 신호(channel state information reference signal, CSI-RS) 리소스 가용성 정보를 포함하는 것인, 무선 통신 방법.
  10. 제9항에 있어서,
    페이징 표시 채널이 구성되고, 상기 페이징 표시 채널 상에서 상기 CSI-RS 리소스 가용성 정보의 서브세트가 반송(carry)되는 것인, 무선 통신 방법.
  11. 제10항에 있어서,
    상기 CSI-RS 리소스 가용성 정보의 서브세트는 페이징-PDCCH 상의 CSI-RS 리소스 가용성의 변화를 표시하는 것인, 무선 통신 방법.
  12. 제1항에 있어서,
    상기 페이징 구성 정보는 N개의 페이징 오케이션 및 M개의 그룹을 표시하고 비트 구조를 포함하며,
    상기 비트 구조는:
    N 비트 ― 상기 N 비트 각각은 상기 N개의 페이징 오케이션 중 하나와 각각 연관됨 ― 의 제1 블록; 및
    M 비트의 복수의 블록들 ― 상기 M 비트의 복수의 블록들 각각은 상기 제1 블록의 상기 N 비트 중 하나와 연관되고, 상기 제1 블록의 상기 연관된 비트가 특정 값을 갖는 경우에만 존재함 ―
    을 포함하는 것인, 무선 통신 방법.
  13. 제1항에 있어서,
    상기 페이징 구성 정보는 N개의 페이징 오케이션을 표시하고 비트 구조를 포함하며,
    상기 비트 구조는:
    각 M 비트의 N개의 블록들 ― 상기 N개의 블록들 각각은 상기 N개의 페이징 오케이션 중 하나와 연관되며, 상기 M 비트 각각은 그룹과 연관됨 ―
    을 포함하는 것인, 무선 통신 방법.
  14. 제1항에 있어서,
    상기 페이징 구성 정보는 비트 구조를 포함하며,
    상기 비트 구조는:
    페이징 표시와 연관된 복수의 블록들; 및
    CSI-RS 리소스 세트의 가용성을 표시하는 Q 비트
    를 포함하는 것인, 무선 통신 방법.
  15. 제14항에 있어서,
    상기 Q 비트 각각은 대응하는 CSI-RS 리소스 세트가 이용가능한지 여부를 표시하는 것인, 무선 통신 방법.
  16. 제14항에 있어서,
    상기 CSI-RS 리소스의 가용성은 상기 Q 비트를 포함하는 코드 포인트에 의해 표시되는 것인, 무선 통신 방법.
  17. 제14항에 있어서,
    상기 페이징 구성 정보는 Q개의 CSI-RS 리소스 세트보다 크다는 것을 표시하는 것이며,
    상기 방법은:
    상기 Q 비트에 대해 미리 정의된 연산을 수행하는 단계를 더 포함하는, 무선 통신 방법.
  18. 제17항에 있어서,
    상기 미리 정의된 연산은 모듈로 연산(modulo operation)이고,
    제k CSI-RS 리소스 세트가 상기 Q 비트의 제q 비트에 의해 표시되며, q = 1 + mod((k-1,Q)인 것인, 무선 통신 방법.
  19. 제1항에 있어서,
    상기 페이징 구성 정보는 보조 동기화 신호(secondary synchronization signal, SSS)에 기초하고, 제어 리소스 세트(Control Resource Set, CORESET) 리소스를 인터리브(interleaved) 방식으로 점유하는 것인, 무선 통신 방법.
  20. 제19항에 있어서,
    상기 페이징 구성 정보는 먼저 주파수 도메인에서 맵핑되고, 그 다음 시간 도메인에서 맵핑되는 것인, 무선 통신 방법.
  21. 제19항에 있어서,
    상기 CORESET 리소스는 다수의 제어 채널 엘리먼트(control channel element, CCE)들을 포함하며, 각 CCE는 다수의 리소스 엘리먼트(resource element, RE)들을 포함하고, 상기 SSS 기반 구성 정보의 길이가 각 CCE에서의 리소스 엘리먼트의 수의 배수와 동일하지 않은 것이며,
    상기 방법은:
    상기 구성 정보의 각 말단에 하나 이상의 제로를 추가하는 단계를 더 포함하는, 무선 통신 방법.
  22. 제19항에 있어서,
    상기 CORESET 리소스는 다수의 제어 채널 엘리먼트(CCE)들을 포함하며, 각 CCE는 다수의 리소스 엘리먼트(RE)들을 포함하고, 상기 SSS 기반 구성 정보의 길이가 각 CCE에서의 리소스 엘리먼트의 수의 배수와 동일하지 않은 것이며,
    상기 방법은:
    하나 이상의 RE를 제로로서 설정하는 단계를 더 포함하는, 무선 통신 방법.
  23. 제19항에 있어서,
    CCE 번호가 자신의 리소스 블록(RB) 인덱스, 리소스 엘리먼트 그룹(resource element group, REG) 인덱스, 또는 REG 번들 인덱스에 따라 인터리빙되는 것인, 무선 통신 방법.
  24. 제1항에 있어서,
    상기 페이징 구성 정보는 CSI-RS 구성 정보를 포함하는 것인, 무선 통신 방법.
  25. 제24항에 있어서,
    상기 CSI-RS 구성 정보는 디폴트 값을 포함하는 것인, 무선 통신 방법.
  26. 제24항에 있어서,
    상기 CSI-RS 구성 정보는 하나의 필드로 조합될 수 있는 복수의 필드들을 포함하는 것인, 무선 통신 방법.
  27. 제24항에 있어서,
    상기 CSI-RS 구성 정보는 구성된 CSI-RS 리소스의 수에 기초하여 준 코-로케이션(quasi-co-location, QCL) 정보를 표시하는 것인, 무선 통신 방법.
  28. 제1항에 있어서,
    복조 기준 신호(demodulation reference signal, DM-RS)를 검출함으로써 상기 페이징 구성 정보의 존재를 결정하는 단계를 더 포함하는, 무선 통신 방법.
  29. 제28항에 있어서,
    상기 페이징 구성 정보의 존재는 상기 검출된 DM-RS가 임계값을 초과할 때 결정되는 것인, 무선 통신 방법.
  30. 제28항에 있어서,
    다운링크 제어 정보(downlink control information, DCI)에서의 비트들과 DM-RS에서의 비트들은 공동으로 인코딩(jointly encoding)되고, 상기 공동으로 인코딩된 비트들은 페이징 그룹을 표시하는 것인, 무선 통신 방법.
  31. 제31항에 있어서,
    상기 공동으로 인코딩된 비트들은 코드 포인트에 기초하여 상기 페이징 그룹을 표시하는 것인, 무선 통신 방법.
  32. 제28항에 있어서,
    다운링크 제어 정보(DCI)에서의 비트들과 DM-RS에서의 비트들은 공동으로 인코딩되고, 상기 공동으로 인코딩된 비트들은 CSI-RS 가용성을 표시하는 것인, 무선 통신 방법.
  33. 제1항에 있어서,
    상기 페이징 구성 정보는 비트 스크램블링 시퀀스로 수신되는 것인, 무선 통신 방법.
  34. 제24항에 있어서,
    상기 CSI-RS 구성 정보는 비트 스크램블링 시퀀스로 수신되는 것인, 무선 통신 방법.
  35. 무선 통신 방법으로서,
    네트워크 디바이스에 의해, 페이징 메시지와 연관된 페이징 구성 정보를 송신하는 단계; 및
    상기 페이징 구성 정보에 따라 상기 페이징 메시지를 송신하는 단계
    를 포함하는, 무선 통신 방법.
  36. 제35항에 있어서,
    상기 페이징 구성 정보는 페이징 표시 채널 및 페이징 오케이션을 표시하는 것인, 무선 통신 방법.
  37. 제35항에 있어서,
    상기 페이징 구성 정보는 하나 이상의 그룹과 연관된 구성 엔티티를 포함하는 것인, 무선 통신 방법.
  38. 제35항에 있어서,
    상기 구성 엔티티의 엔트리는 상기 하나 이상의 그룹의 페이징 확률을 포함하는 것인, 무선 통신 방법.
  39. 제38항에 있어서,
    상기 엔트리는 단일 그룹의 페이징 확률을 포함하고, 상기 단일 그룹의 페이징 확률은 제2 그룹의 페이징 확률보다 높은 것인, 무선 통신 방법.
  40. 제35항 내지 제39항 중 어느 한 항에 있어서,
    상기 페이징 구성 정보는 채널 상태 정보 기준 신호(CSI-RS) 리소스 가용성 정보를 포함하는 것인, 무선 통신 방법.
  41. 제35항에 있어서,
    상기 페이징 구성 정보는 N개의 페이징 오케이션 및 M개의 그룹을 표시하고 비트 구조를 포함하며,
    상기 비트 구조는:
    N 비트 ― 상기 N 비트 각각은 상기 N개의 페이징 오케이션 중 하나와 각각 연관됨 ― 의 제1 블록; 및
    M 비트의 복수의 블록들 ― 상기 M 비트의 복수의 블록들 각각은 상기 제1 블록의 상기 N 비트 중 하나와 연관되고, 상기 제1 블록의 상기 연관된 비트가 특정 값을 갖는 경우에만 존재함 ―
    을 포함하는 것인, 무선 통신 방법.
  42. 제35항에 있어서,
    상기 페이징 구성 정보는 N개의 페이징 오케이션을 표시하고 비트 구조를 포함하며,
    상기 비트 구조는:
    각 M 비트의 N개의 블록들 ― 상기 N개의 블록들 각각은 상기 N개의 페이징 오케이션 중 하나와 연관되며, 상기 M 비트 각각은 그룹과 연관됨 ―
    을 포함하는 것인, 무선 통신 방법.
  43. 제35항에 있어서,
    상기 페이징 구성 정보는 보조 동기화 신호(SSS)에 기초하고, 제어 리소스 세트(CORESET) 리소스를 인터리브 방식으로 점유하는 것인, 무선 통신 방법.
  44. 제35항에 있어서,
    상기 페이징 구성 정보는 CSI-RS 구성 정보를 포함하는 것인, 무선 통신 방법.
  45. 제44항에 있어서,
    상기 CSI-RS 구성 정보는 디폴트 값을 포함하는 것인, 무선 통신 방법.
  46. 제44항에 있어서,
    상기 CSI-RS 구성 정보는 하나의 필드로 조합될 수 있는 복수의 필드들을 포함하는 것인, 무선 통신 방법.
  47. 제44항에 있어서,
    상기 CSI-RS 구성 정보는 구성된 CSI-RS 리소스의 수에 기초하여 준 코-로케이션(QCL) 정보를 표시하는 것인, 무선 통신 방법.
  48. 제1항 내지 제47항 어느 한 항의 방법을 구현하도록 구성된 프로세서를 포함하는 무선 통신 장치.
  49. 프로세서에 의해 실행될 때, 상기 프로세서로 하여금 제1항 내지 제47항 중 어느 한 항에 기재된 방법을 구현하게 하는 코드가 저장되어 있는 컴퓨터 판독가능 매체.
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