KR20230140302A - Display apparatus and manufacturing method of the same - Google Patents
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Abstract
본 명세서의 실시예에 따른 표시 장치는, 복수의 서브 픽셀들을 포함하는 기판, 복수의 서브 픽셀들 각각에 위치한 제1 전극, 제1 전극 상에 배치된 나노 패턴들, 제1 전극 및 나노 패턴들 상에 배치된 유기층, 및 유기층 상에 배치된 제2 전극을 포함할 수 있다.A display device according to an embodiment of the present specification includes a substrate including a plurality of subpixels, a first electrode located on each of the plurality of subpixels, nanopatterns disposed on the first electrode, a first electrode, and nanopatterns. It may include an organic layer disposed on the organic layer, and a second electrode disposed on the organic layer.
Description
본 명세서는 표시 장치 및 그 제조 방법에 관한 것이다.This specification relates to a display device and a method of manufacturing the same.
정보화 사회가 발전함에 따라 화상을 표시하기 위한 표시 장치에 대한 요구가 다양한 형태로 증가하고 있다. 이에 따라, 근래에는 액정 표시 장치(Liquid Crystal Display; LCD), 유기 발광 표시 장치(Organic Light Emitting Display; OLED), 마이크로 엘이디 표시 장치(Micro Light Emitting Diode; Micro LED Display), 양자점 표시 장치(Quantum Dot Display; QD) 등과 같은 표시 장치가 활용되고 있다.As the information society develops, the demand for display devices for displaying images is increasing in various forms. Accordingly, in recent years, Liquid Crystal Display (LCD), Organic Light Emitting Display (OLED), Micro Light Emitting Diode (Micro LED Display), and Quantum Dot display devices have been developed. Display devices such as Display (QD) are being used.
표시 장치는 발광소자를 이용하여 광을 출력하는 표시 장치이며, 발광소자들이 구비된 표시 패널을 포함한다.A display device is a display device that outputs light using light-emitting elements and includes a display panel provided with light-emitting elements.
표시 패널은 빛이 방출되는 방향에 따라서 상부 발광(top emission) 방식, 하부 발광(bottom emission) 방식, 또는 양면 발광(dual emission) 방식 등으로 나누어질 수 있다.Display panels can be divided into a top emission method, a bottom emission method, or a dual emission method, depending on the direction in which light is emitted.
이 중 상부 발광 방식의 표시 패널의 경우, 발광소자의 애노드에 반사 전극을 포함한다. 이러한 상부 발광 표시 패널에서는 외부로부터 입사된 외부광이 애노드의 반사 전극에 의해 반사되어 시감 특성을 저하시키는 문제가 있다.Among these, in the case of a top-emitting display panel, a reflective electrode is included at the anode of the light-emitting element. In such a top emitting display panel, there is a problem in that external light incident from the outside is reflected by the reflective electrode of the anode, thereby deteriorating the viewing characteristics.
이상 설명한 배경기술의 내용은 본 명세서의 발명자가 본 명세서의 도출을 위해 보유하고 있었거나, 본 명세서의 도출 과정에서 습득한 기술 정보로서, 반드시 본 명세서의 명세서 전에 일반 공중에게 공개된 공지기술이라 할 수는 없다.The content of the background technology described above is technical information that the inventor of this specification possessed for the derivation of this specification or was acquired in the process of deriving this specification, and must be regarded as known technology disclosed to the general public before the specification of this specification. It is impossible.
본 명세서는 외부광에 의한 반사 현상을 방지할 수 있는 표시 장치 및 그 제조 방법을 제공하는 것을 과제로 한다.The object of this specification is to provide a display device that can prevent reflection by external light and a manufacturing method thereof.
위에서 언급된 본 명세서의 과제 외에도, 본 명세서의 다른 특징 및 이점들이 이하에서 기술되거나, 그러한 기술 및 설명으로부터 본 명세서의 기술적 사상이 속하는 기술분야에서 통상의 지식을 가진 자에게 명확하게 이해될 수 있을 것이다.In addition to the tasks of the present specification mentioned above, other features and advantages of the present specification are described below, or can be clearly understood by those skilled in the art from such descriptions and descriptions. will be.
본 명세서의 실시예에 따른 표시 장치는, 복수의 서브 픽셀들을 포함하는 기판, 복수의 서브 픽셀들 각각에 위치한 제1 전극, 제1 전극 상에 배치된 나노 패턴들, 제1 전극 및 나노 패턴들 상에 배치된 유기층, 및 유기층 상에 배치된 제2 전극을 포함할 수 있다.A display device according to an embodiment of the present specification includes a substrate including a plurality of subpixels, a first electrode located on each of the plurality of subpixels, nanopatterns disposed on the first electrode, a first electrode, and nanopatterns. It may include an organic layer disposed on the organic layer, and a second electrode disposed on the organic layer.
본 명세서의 실시예에 따른 표시 장치의 제조 방법은, 기판 상에 제1 전극을 형성하는 단계, 제1 전극 상에 보호 물질 패턴을 형성하는 단계, 보호 물질 패턴을 이용하여 나노 패턴들을 형성하는 단계, 제1 전극 및 나노 패턴들을 덮는 유기층을 형성하는 단계, 및 유기층을 덮는 제2 전극을 형성하는 단계를 포함할 수 있다.A method of manufacturing a display device according to an embodiment of the present specification includes forming a first electrode on a substrate, forming a protective material pattern on the first electrode, and forming nanopatterns using the protective material pattern. , forming an organic layer covering the first electrode and the nanopatterns, and forming a second electrode covering the organic layer.
본 명세서에 따른 표시 장치 및 그 제조 방법은 애노드 전극 위에 나노 패턴을 형성함으로써, 나노 패턴과 유기층 사이의 굴절률 차이에 의해 외부광에 의한 반사율을 저감시킬 수 있다.The display device and its manufacturing method according to the present specification can reduce reflectance by external light due to a difference in refractive index between the nanopattern and the organic layer by forming a nanopattern on the anode electrode.
위에서 언급된 본 명세서의 효과 외에도, 본 명세서의 다른 특징 및 이점들이 이하에서 기술되거나, 그러한 기술 및 설명으로부터 본 명세서가 속하는 기술분야에서 통상의 지식을 가진 자에게 명확하게 이해될 수 있을 것이다.In addition to the effects of the present specification mentioned above, other features and advantages of the present specification are described below, or can be clearly understood by those skilled in the art from such descriptions and descriptions.
도 1은 본 명세서의 실시예에 따른 표시 장치를 개략적으로 나타낸 도면이다.
도 2는 도 1의 선 I-I'의 단면도이다.
도 3은 본 명세서의 일 실시예에 따른 도 2의 A부분의 발광 소자를 나타낸 도면이다.
도 4는 본 명세서의 다른 실시예에 따른 도 2의 A부분의 발광 소자를 나타낸 도면이다.
도 5a 내지 도 5c는 본 명세서의 실시예에 따른 나노 패턴의 형상을 설명하기 위한 도면이다.
도 6a 내지 도 6c는 본 명세서의 실시예에 따른 나노 패턴에 의한 반사 저감 현상을 설명하기 위한 도면이다.
도 7 내지 도 10은 본 명세서의 일 실시예에 따른 나노 패턴을 형성하는 방법을 설명하기 위한 제조 공정도들이다.
도 11 내지 도 15는 본 명세서의 다른 실시예에 따른 나노 패턴을 형성하는 방법을 설명하기 위한 제조 공정도들이다.
도 16은 본 명세서의 실시예에 따른 나노 패턴을 형성하는 방법을 설명하기 위한 이미지들이다.
도 17 내지 도 32는 본 명세서의 실시예에 따른 나노 패턴 형성 이후의 표시 장치를 제조하는 방법을 설명하기 위한 제조 공정도들이다.1 is a diagram schematically showing a display device according to an embodiment of the present specification.
Figure 2 is a cross-sectional view taken along line II' in Figure 1.
FIG. 3 is a diagram showing a light emitting device in part A of FIG. 2 according to an embodiment of the present specification.
FIG. 4 is a diagram showing a light emitting device in part A of FIG. 2 according to another embodiment of the present specification.
5A to 5C are diagrams for explaining the shape of a nanopattern according to an embodiment of the present specification.
FIGS. 6A to 6C are diagrams for explaining a reflection reduction phenomenon caused by nanopatterns according to an embodiment of the present specification.
7 to 10 are manufacturing process diagrams for explaining a method of forming a nanopattern according to an embodiment of the present specification.
11 to 15 are manufacturing process diagrams for explaining a method of forming a nanopattern according to another embodiment of the present specification.
16 are images for explaining a method of forming a nanopattern according to an embodiment of the present specification.
17 to 32 are manufacturing process diagrams for explaining a method of manufacturing a display device after nanopattern formation according to an embodiment of the present specification.
본 명세서의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 다양한 예들을 참조하면 명확해질 것이다. 그러나 본 명세서는 이하에서 개시되는 다양한 예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 명세서의 다양한 예들은 본 명세서의 개시가 완전하도록 하며, 본 명세서의 기술적 사상이 속하는 기술분야에서 통상의 지식을 가진 자에게 본 명세서의 기술적 사상의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 명세서의 예는 청구항의 범주에 의해 정의될 뿐이다.The advantages and features of the present specification and methods for achieving them will become clear by referring to the various examples described in detail below along with the accompanying drawings. However, the present specification is not limited to the various examples disclosed below and will be implemented in various different forms, and the various examples in the present specification only serve to ensure that the disclosure of the present specification is complete and that the technical idea of the present specification pertains to the technical field. It is provided to fully inform those skilled in the art of the scope of the technical idea of the present specification, and examples of the present specification are only defined by the scope of the claims.
본 명세서의 다양한 예를 설명하기 위한 도면에 개시된 형상, 크기, 비율, 각도, 개수 등은 예시적인 것이므로 본 명세서의 도면에 도시된 사항에 한정되는 것은 아니다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다. 또한, 본 명세서의 예를 설명함에 있어서, 관련된 공지 기술에 대한 구체적인 설명이 본 명세서의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명은 생략한다.The shapes, sizes, ratios, angles, numbers, etc. disclosed in the drawings for explaining various examples of the present specification are illustrative and are not limited to the matters shown in the drawings of the present specification. Like reference numerals refer to like elements throughout the specification. Additionally, when describing examples of the present specification, if it is determined that detailed descriptions of related known technologies may unnecessarily obscure the gist of the present specification, the detailed descriptions will be omitted.
본 명세서에서 언급된 '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 '~만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 구성 요소를 단수로 표현한 경우에 특별히 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함한다.When 'includes', 'has', 'consists of', etc. mentioned in this specification are used, other parts may be added unless 'only' is used. When a component is expressed in the singular, the plural is included unless specifically stated otherwise.
구성 요소를 해석함에 있어서, 별도의 명시적 기재가 없더라도 오차 범위를 포함하는 것으로 해석한다.When interpreting a component, it is interpreted to include the margin of error even if there is no separate explicit description.
위치 관계에 대한 설명일 경우, 예를 들어, '~상에', '~상부에', '~하부에', '~옆에' 등으로 두 부분의 위치 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다.In the case of a description of a positional relationship, for example, if the positional relationship of two parts is described as 'on top', 'on the top', 'on the bottom', 'next to', etc., 'immediately' Alternatively, there may be one or more other parts placed between the two parts, unless 'directly' is used.
시간 관계에 대한 설명일 경우, 예를 들어, '~후에', '~에 이어서', '~다음에', '~전에' 등으로 시간적 선후 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 연속적이지 않은 경우도 포함할 수 있다.In the case of a description of a temporal relationship, for example, if a temporal relationship is described as 'after', 'successfully after', 'after', 'before', etc., 'immediately' or 'directly' Unless used, non-consecutive cases may also be included.
제 1, 제 2 등이 다양한 구성요소들을 서술하기 위해서 사용되나, 이들 구성요소들은 이들 용어에 의해 제한되지 않는다. 이들 용어들은 단지 하나의 구성요소를 다른 구성요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제 1 구성요소는 본 명세서의 기술적 사상 내에서 제 2 구성요소일 수도 있다.Although first, second, etc. are used to describe various components, these components are not limited by these terms. These terms are merely used to distinguish one component from another. Accordingly, the first component mentioned below may also be the second component within the technical idea of the present specification.
"제1 수평 축 방향", "제2 수평 축 방향" 및 "수직 축 방향"은 서로 간의 관계가 수직으로 이루어진 기하학적인 관계만으로 해석되어서는 아니 되며, 본 명세서의 구성이 기능적으로 작용할 수 있는 범위 내에서보다 넓은 방향성을 가지는 것을 의미할 수 있다.“First horizontal axis direction”, “second horizontal axis direction”, and “vertical axis direction” should not be interpreted as only geometric relationships in which the relationship between each other is vertical, and the scope within which the configuration of the present specification can function functionally It can mean having a broader direction than within.
"적어도 하나"의 용어는 하나 이상의 관련 항목으로부터 제시 가능한 모든 조합을 포함하는 것으로 이해되어야 한다. 예를 들어, "제 1 항목, 제 2 항목 및 제 3 항목 중에서 적어도 하나"의 의미는 제 1 항목, 제 2 항목 또는 제 3 항목 각각 뿐만 아니라 제 1 항목, 제 2 항목 및 제 3 항목 중에서 2개 이상으로부터 제시될 수 있는 모든 항목의 조합을 의미할 수 있다.The term “at least one” should be understood to include all possible combinations from one or more related items. For example, “at least one of the first, second, and third items” means each of the first, second, or third items, as well as two of the first, second, and third items. It can mean a combination of all items that can be presented from more than one.
본 명세서의 여러 예들의 각각 특징들이 부분적으로 또는 전체적으로 서로 결합 또는 조합 가능하고, 기술적으로 다양한 연동 및 구동이 가능하며, 각 예들이 서로에 대하여 독립적으로 실시 가능할 수도 있고 연관 관계로 함께 실시할 수도 있다.Each feature of the various examples of the present specification can be partially or entirely combined or combined with each other, and various technological interconnections and operations are possible, and each example can be implemented independently of each other or together in a related relationship. .
이하에서는 본 명세서의 실시예에 따른 표시 장치 및 그 제조 방법의 바람직한 예를 첨부된 도면을 참조하여 상세히 설명한다. 각 도면의 구성요소들에 참조부호를 부가함에 있어서, 동일한 구성요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가질 수 있다. 그리고, 첨부된 도면에 도시된 구성요소들의 스케일은 설명의 편의를 위해 실제와 다른 스케일을 가지므로, 도면에 도시된 스케일에 한정되지 않는다.Hereinafter, a preferred example of a display device and its manufacturing method according to an embodiment of the present specification will be described in detail with reference to the attached drawings. In adding reference numerals to components in each drawing, identical components may have the same reference numerals as much as possible even if they are shown in different drawings. Additionally, the scale of the components shown in the attached drawings has a different scale from the actual scale for convenience of explanation, and is therefore not limited to the scale shown in the drawings.
도 1은 본 명세서의 실시예에 따른 표시 장치를 개략적으로 나타낸 도면이고, 도 2는 도 1의 선 I-I'의 단면도이다.FIG. 1 is a diagram schematically showing a display device according to an embodiment of the present specification, and FIG. 2 is a cross-sectional view taken along line II' of FIG. 1.
도 1을 참조하면, 본 명세서의 실시예에 따른 표시 장치(100)는 표시 패널(110), 영상 처리부(120), 타이밍 제어부(130), 데이터 구동부(140), 스캔 구동부(150), 및 전원 공급부(160)를 포함할 수 있다.Referring to FIG. 1, a
표시 패널(110)은 데이터 구동부(140)로부터 공급된 데이터신호(DATA)와 스캔 구동부(150)로부터 공급된 스캔 신호 그리고 전원 공급부(160)로부터 공급된 전원에 대응하여 영상을 표시할 수 있다.The
표시 패널(110)은 복수의 게이트 라인(GL)과 복수의 데이터 라인(DL)의 교차영역마다 배치된 복수의 픽셀(PX, Pixel)을 포함할 수 있다. 복수의 픽셀(PX) 각각은 복수의 서브 픽셀(SP)을 포함할 수 있다. 서브 픽셀(SP)의 구조는 표시 장치(100)의 종류에 따라 다양하게 변경될 수 있다.The
표시 패널(110)은 복수의 픽셀(PX)이 배치되어 영상을 표시하는 표시 영역(AA)과 표시 영역(AA) 주변의 비표시 영역(NA)으로 구분할 수 있다. 스캔 구동부(150)는 표시 패널(110)의 비표시 영역(NA)에 실장될 수 있다. 또한, 비표시 영역(NA)에는 패드 영역을 포함할 수 있다.The
영상 처리부(120)는 외부로부터 공급된 데이터신호(DATA)와 더불어 데이터 인에이블 신호(DE) 등을 출력할 수 있다. 영상 처리부(120)는 데이터 인에이블 신호(DE) 외에도 수직 동기신호, 수평 동기신호 및 클럭신호 중 하나 이상을 출력할 수 있으나 이 신호들은 설명의 편의상 생략 도시한다.The
타이밍 제어부(130)는 영상 처리부(120)로부터 구동신호와 더불어 데이터신호(DATA)를 공급받을 수 있다. 구동 신호는 데이터 인에이블 신호(DE)를 포함할 수 있다. 또는, 구동 신호는 수직 동기신호, 수평 동기신호 및 클럭신호를 포함할 수 있다. 타이밍 제어부(130)는 구동신호에 기초하여 데이터 구동부(140)의 동작 타이밍을 제어하기 위한 데이터 타이밍 제어신호(DDC)와 스캔 구동부(150)의 동작 타이밍을 제어하기 위한 게이트 타이밍 제어신호(GDC)를 출력할 수 있다.The
데이터 구동부(140)는 타이밍 제어부(130)로부터 공급된 데이터 타이밍 제어신호(DDC)에 응답하여 타이밍 제어부(130)로부터 공급되는 데이터신호(DATA)를 샘플링하고 래치하여 감마 기준전압으로 변환하여 출력할 수 있다.The
데이터 구동부(140)는 데이터 라인들(DL)을 통해 데이터신호(DATA)를 출력할 수 있다. 데이터 구동부(140)는 IC(Integrated Circuit) 형태로 구현될 수 있다. 예를 들어, 데이터 구동부(140)는 표시 패널(110)의 비표시 영역(NA)에 배치된 패드 영역과 연성 회로 필름을 통해 전기적으로 연결될 수 있다.The
스캔 구동부(150)는 타이밍 제어부(130)로부터 공급된 게이트 타이밍 제어신호(GDC)에 응답하여 스캔 신호를 출력할 수 있다. 스캔 구동부(150)는 게이트 라인들(GL)을 통해 스캔 신호를 출력할 수 있다. 스캔 구동부(150)는 IC(Integrated Circuit) 형태로 구현되거나 표시 패널(110)에 게이트 인 패널(Gate In Panel; GIP) 방식으로 구현될 수 있다.The
전원 공급부(160)는 표시 패널(110)을 구동하기 위한 고전위전압 및 저전위전압 등을 출력할 수 있다. 전원 공급부(160)는 고전위전압을 제1 전원 라인(EVDD)(구동 전원 라인 또는 픽셀 전원 라인)을 통해 표시 패널(110)에 공급할 수 있고, 저전위전압을 제2 전원 라인(EVSS)(보조 전원 라인 또는 공통 전원 라인)을 통해 표시 패널(110)에 공급할 수 있다.The
다시 도 1에서 하나의 픽셀(PX)를 확대하여 나타낸 부분을 참조하면, 하나의 픽셀(PX)은 서로 인접하는 복수의 서브 픽셀(SP)을 포함할 수 있다. 복수의 서브 픽셀(SP)은 제1 서브 픽셀(SP1), 제2 서브 픽셀(SP2) 및 제3 서브 픽셀(SP3)을 포함할 수 있다. 예를 들어, 서브 픽셀들(SP1, SP2, SP3)은 구조에 따라 상부 발광(top emission) 방식, 하부 발광(bottom emission) 방식, 또는 양면 발광(dual emission) 방식으로 형성될 수 있다. 서브 픽셀들(SP1, SP2, SP3)은 특정한 종류의 컬러필터가 형성되거나, 컬러필터가 형성되지 않고 자체의 색상을 발광할 수 있는 단위를 의미한다. 각각의 서브 픽셀(SP1, SP2, SP3)은 자발광소자인 발광소자(예컨대, 유기발광소자) 및 발광소자를 구동하기 위한 박막 트랜지스터(TR)을 포함할 수 있다.Referring again to the enlarged portion of one pixel (PX) in FIG. 1, one pixel (PX) may include a plurality of subpixels (SP) adjacent to each other. The plurality of subpixels SP may include a first subpixel SP1, a second subpixel SP2, and a third subpixel SP3. For example, the subpixels SP1, SP2, and SP3 may be formed in a top emission method, a bottom emission method, or a dual emission method depending on the structure. The subpixels SP1, SP2, and SP3 refer to units that can emit their own color with or without a specific type of color filter. Each subpixel SP1, SP2, and SP3 may include a light-emitting device that is a self-light emitting device (eg, an organic light-emitting device) and a thin film transistor (TR) for driving the light-emitting device.
예를 들어, 제1 서브 픽셀(SP1)은 적색 광을 방출할 수 있고, 제2 서브 픽셀(SP2)은 녹색 광을 방출할 수 있고, 제3 서브 픽셀(SP3)은 청색 광을 방출할 수 있다. 하지만, 본 명세서가 반드시 이에 한정되지는 않으며, 백색 광을 방출하는 서브 픽셀을 더 포함할 수도 있다. 또는, 적색(red) 광, 녹색(green) 광, 청색(blue) 광, 황색(yellow) 광, 자홍색(magenta) 광, 및 청록색(cyan) 광 중에서 적어도 두 개 이상의 광을 방출하는 서브 픽셀들로 구성될 수도 있다. 또한, 서브 픽셀들(SP1, SP2, SP3)의 컬러 타입, 배치 타입, 및 배치 순서 등은 발광 특성, 소자의 수명, 및 장치의 스펙 등에 따라 다양한 형태로 구성될 수 있다.For example, the first subpixel SP1 may emit red light, the second subpixel SP2 may emit green light, and the third subpixel SP3 may emit blue light. there is. However, the present specification is not necessarily limited to this, and may further include a subpixel that emits white light. Or, subpixels that emit at least two lights among red light, green light, blue light, yellow light, magenta light, and cyan light. It may be composed of: Additionally, the color type, arrangement type, and arrangement order of the subpixels SP1, SP2, and SP3 may be configured in various ways depending on light emission characteristics, device lifespan, and device specifications.
도 2를 참조하면, 본 명세서의 실시예에 따른 표시 장치(100)는 복수의 서브 픽셀(SP1, SP2, SP3)을 포함하는 기판(101) 상에 회로층(102)(또는 박막 트랜지스터 어레이층), 평탄화층(103)(또는 오버코트층), 발광소자(200), 및 뱅크층(105) 등을 포함할 수 있다.Referring to FIG. 2, the
기판(101)은 베이스 기판으로서, 유리(glass) 또는 플라스틱(plastic) 재질로 이루어질 수 있다. 예를 들어, 기판(101)은 PI(Polyimide), PET(polyethylene terephthalate), PEN(polyethylene naphthalate), PC(polycarbonate) 등의 플라스틱 재질로 형성되어, 유연한(flexible) 특성을 가질 수 있다.The
회로층(102)에는 각종 신호 라인들, 박막 트랜지스터(TR), 스토리지 커패시터 등을 포함하는 회로 소자가 복수의 서브 픽셀(SP1, SP2, SP3) 별로 형성될 수 있다. 신호 라인들로는 게이트 라인(GL), 데이터 라인(DL), 제1 전원 라인(EVDD)(구동 전원 라인 또는 픽셀 전원 라인), 제2 전원 라인(EVSS)(보조 전원 라인 또는 공통 전원 라인), 및 레퍼런스 라인 등이 포함될 수 있고, 박막 트랜지스터로(TR)는 구동 박막 트랜지스터, 스위칭 박막 트랜지스터, 및 센싱 박막 트랜지스터 등이 포함될 수 있다. 예를 들어, 회로층(102)에는 적어도 두 개의 절연막들 및 적어도 두 개의 절연막들 사이에 금속 또는 액티브층들을 포함할 수 있다. 예를 들면, 회로층(102)에는 광차단층과, 버퍼층과, 박막 트랜지스터(TR)를 구성하는 액티브층, 게이트 전극, 소스 전극 및 드레인 전극과, 게이트 절연막과, 층간 절연막과, 패시베이션층 등을 포함할 수 있으나, 본 명세서가 이에 한정되지는 않는다.In the
평탄화층(103)은 회로층(102)의 상단면을 평탄화시키는 기능을 수행할 수 있다. 평탄화층(103)은 유기 절연 물질로 이루어질 수 있다. 예를 들어, 평탄화층(103)은 포토아크릴(photo acryl), 폴리이미드(polyimide), 벤조사이클로부틴계 수지(benzocyclobutene resin), 및 아크릴레이트계 수지(acrylate) 등의 유기물중 적어도 하나의 물질로 이루어질 수 있다.The
평탄화층(103) 상에는 발광소자(200)를 구성하는 제1 전극(201)(애노드 전극 또는 픽셀 전극), 유기층(202)(발광층 또는 유기 발광층), 제2 전극(203)(캐소드 전극 또는 공통 전극)이 순차적으로 적층될 수 있다.On the
제1 전극(201)(애노드 전극 또는 픽셀 전극)은 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 대응하는 위치에 배치될 수 있다. 제1 전극(201)은 평탄화층(103) 및 회로층(102)을 관통하는 컨택홀을 통해 박막 트랜지스터(TR)의 드레인 전극에 연결될 수 있다. 예를 들어, 제1 전극(201)은 회로층(102)에 배치된 구동 박막 트랜지스터에 연결될 수 있다.The first electrode 201 (anode electrode or pixel electrode) may be disposed at a position corresponding to each of the plurality of subpixels SP1, SP2, and SP3. The
제1 전극(201)은 금속, 그 합금, 금속과 산화물 금속의 조합으로 형성될 수 있다. 예를 들어, 제1 전극(201)은 투명 도전막으로 이루어진 투명 전극층 및 반사효율이 높은 불투명 도전막으로 이루어진 반사 전극층을 포함하는 다층 구조로 형성될 수 있다. 제1 전극(201)의 투명 전극층으로는 인듐-틴-옥사이드(Indium Tin Oxide; ITO) 또는 인듐-징크-옥사이드(Indium Zinc Oxide; IZO)와 같은 일함수 값이 비교적 큰 재질로 이루어지고, 반사 전극층으로는 은(Ag), 알루미늄(Al), 구리(Cu), 몰리브덴(Mo), 티타늄(Ti), 니켈(Ni), 크롬(Cr), 또는 텅스텐(W)으로 이루어진 군에서 선택된 어느 하나 또는 이들의 합금의 단층이나 다층으로 이루어질 수 있다. 예를 들면, 제1 전극(201)은 투명 전극층, 반사 전극층 및 투명 전극층이 순차적으로 적층된 구조로 형성되거나, 투명 전극층 및 반사 전극층이 순차적으로 적층된 구조로 형성될 수 있다. 하지만, 본 명세서가 이에 한정되지는 않는다.The
제1 전극(201) 및 평탄화층(103) 상에는 뱅크층(105)이 배치될 수 있다. 뱅크층(105)은 제1 전극(201)의 가장자리 부분을 덮고 제1 전극(201)의 개구부를 정의할 수 있다. 예를 들어, 뱅크층(105)은 실리콘 산화막(SiOx), 실리콘 질화막(SiNx), 실리콘 산질화막(SiOxNy) 등의 무기물로 이루어질 수 있다. 또는, 뱅크층(105)은 폴리이미드(polyimide), 아크릴레이트(acrylate), 벤조사이클로부틴계 수지(benzocyclobutene series resin) 등의 유기물로 이루어질 수 있다. 본 명세서의 실시예에 따르면, 뱅크층(105)은 에칭에 대해 상대적으로 강한 무기물로 이루어질 수 있으나, 이에 한정되지는 않는다. 뱅크층(105)에 의해 노출된 제1 전극(201)의 개구부는 발광 영역으로 정의될 수 있다.A
제1 전극(201) 및 뱅크층(105) 상에는 유기층(202)(발광층 또는 유기 발광층)이 배치될 수 있다. 유기층(202)은 복수의 서브 픽셀(SP1, SP2, SP3) 각각의 제1 전극(201)의 개구부와, 뱅크층(105)의 측면과, 뱅크층(105)의 상부면의 적어도 일부에 배치될 수 있다. 예를 들어, 유기층(202)은 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 대응하는 위치에 배치될 수 있고, 뱅크층(105)의 상부면 상에서 서로 이격될 수 있다. 또한, 유기층(202)은 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 대응하여 서로 다른 색상의 광을 방출하는 유기물질로 이루어질 수 있다. 예를 들면, 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 배치된 유기층(202)은 적색 광, 녹색 광 및 청색 광을 방출하는 유기물질로 이루어질 수 있으나, 반드시 이에 한정되는 것은 아니다.An organic layer 202 (light-emitting layer or organic light-emitting layer) may be disposed on the
유기층(202) 및 뱅크층(105) 상에는 제2 전극(203)(캐소드 전극 또는 공통 전극)이 배치될 수 있다. 제2 전극(203)은 복수의 서브 픽셀(SP1, SP2, SP3)에 공통적으로 형성되는 공통층일 수 있다. 예를 들어, 제2 전극(203)은 광을 투과시킬 수 있는 인듐-틴-옥사이드(Indium Tin Oxide; ITO) 또는 인듐-징크-옥사이드(Indium Zinc Oxide; IZO)와 같은 투명 금속물질(transparent conductive material; TCP)로 이루어질 수 있고, 또는 광이 투과될 수 있을 정도로 얇은 두께를 갖는 은(Ag), 알루미늄(Al), 마그네슘(Mg), 칼슘(Ca) 또는 이들의 합금과 같은 반투과 금속물질(semi-transmissive conductive material)로 이루어질 수도 있다.A second electrode 203 (cathode electrode or common electrode) may be disposed on the
본 명세서의 실시예에 따르면, 표시 장치(100)의 전면으로 입사되는 외부광에 의한 반사 현상을 방지하기 위하여, 발광소자(200)에는 랜덤하게 배치된 나노 패턴들을 포함할 수 있다. 반사 방지를 위한 나노 패턴들은 제1 전극(201)과 제2 전극(203) 사이에 배치될 수 있다. 본 명세서의 실시예에 따른 나노 패턴들은 제1 전극(201) 상에 배치되고, 제1 전극(201) 및 나노 패턴들 상에 유기층(202)이 배치되고, 유기층(202) 상에 제2 전극(203)이 배치됨으로써, 외부로부터 입사되는 외부광이 나노 패턴들에 의해 난반사되도록 하여 외부광의 반사율을 저감시킬 수 있다.According to an embodiment of the present specification, in order to prevent reflection caused by external light incident on the front of the
도 3은 본 명세서의 일 실시예에 따른 도 2의 A부분의 발광소자를 나타낸 도면이다.FIG. 3 is a diagram showing a light emitting device in part A of FIG. 2 according to an embodiment of the present specification.
도 3을 도 2에 결부하여 참조하면, 본 명세서의 일 실시예에 따른 표시 장치(100)는 제1 전극(201) 상에 배치된 나노 패턴들(300)을 포함할 수 있다. 나노 패턴들(300)은 제1 전극(201)의 상면(201a) 상에 직접 접촉되게 배치될 수 있다.Referring to FIG. 3 in conjunction with FIG. 2 , the
제1 전극(201)은 평탄화층(103) 상에 배치되고, 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 대응하는 위치에 배치될 수 있다. 제1 전극(201) 및 평탄화층(103) 상에는 뱅크층(105)이 배치될 수 있다. 뱅크층(105)은 제1 전극(201)의 가장자리 부분을 덮고 제1 전극(201)의 상면(201a)을 노출시키는 제1 전극(201)의 개구부(201b)를 정의할 수 있다.The
제1 전극(201) 및 뱅크층(105) 상에는 유기층(202)(발광층 또는 유기 발광층)이 배치될 수 있다. 그리고, 유기층(202) 상에는 제2 전극(203)(캐소드 전극 또는 공통 전극)이 배치될 수 있다.An organic layer 202 (light-emitting layer or organic light-emitting layer) may be disposed on the
본 명세서의 일 실시예에 따른 나노 패턴들(300)은 제1 전극(201)의 개구부(201b)에 의해 노출된 제1 전극(201)의 상면(201a) 상에 랜덤하게 배치될 수 있다. 나노 패턴들(300)은 제1 전극(201) 상에서 형상과 배치가 랜덤하게 형성될 수 있다. 나노 패턴들(300)은 제1 전극(201)과 상이한 물질로 이루어질 수 있다. 예를 들어, 나노 패턴들(300)은 표시 장치(100)의 제조 공정에서 사용되는 보호 물질로 이루어질 수 있다. 예를 들면, 보호 물질은 표시 장치(100)의 유기층을 패터닝하는 공정에서 유기층의 에칭 스톱퍼의 기능을 수행하거나, 또는 패턴 마스크의 기능을 수행할 수 있는 물질일 수 있다. 보호 물질은 수계 고분자 물질 또는 불소계 고분자 물질을 포함할 수 있다. 예를 들면, 보호 물질의 수계 고분자 물질로는 폴리에틸렌글리콜(PEG), 폴리비닐알콜(PVA) 또는 폴리비닐아세테이트(PVAc)과 같은 친수성 유기 물질일 수 있고, 불소계 고분자 물질로는 탄소-탄소의 결합이 사슬구조로 연속적으로 이루어지면서, 작용기(또는 기능기)에 다량의 불소(F)를 함유한 불소중합체(floropolymer) 물질일 수 있다.
본 명세서의 일 실시예에 따르면, 제1 전극(201) 상에 보호 물질 패턴을 형성하고, 제1 전극(201) 상에 형성된 보호 물질 패턴을 드라이 에칭하는 것에 의해 형상과 배치가 랜덤한 나노 패턴들(300)을 형성할 수 있다. 예를 들어, 드라이 에칭 공정에는 플라즈마(plasma) 처리를 포함할 수 있다.According to an embodiment of the present specification, a protective material pattern is formed on the
나노 패턴(300)은 3차원 구조의 랜덤한 원형 또는 원기둥형으로 형성될 수 있다. 본 명세서에서 랜덤한 원형 또는 원기둥형이란 원형 또는 원기둥형의 형태에서 불규칙하게 일부 영역이 함몰되거나 돌출된 형태를 의미할 수 있다. 나노 패턴(300)은 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하일 수 있다. 또한, 나노 패턴(300)은 제1 전극(201)과 접하는 면의 장방향 길이가 제1 전극(201)과 접하는 면을 제외한 다른 차원에서의 장방향 길이보다 작을 수 있다. 예를 들어, 나노 패턴(300)은 난반사에 유리하여 반사율을 저감시킬 수 있는 나방눈(moth-eye) 형상을 포함할 수 있다. 나노 패턴들(300)은 랜덤한 형상과 배치에 의해 입사되는 외부광이 난반사되도록 유도함으로써, 제1 전극(201)을 통해 반사되는 외부광의 반사율을 저감시킬 수 있다.The
본 명세서의 일 실시예에 따르면, 나노 패턴들(300)이 배치된 제1 전극(201)과, 뱅크층(105) 상에는 유기층(202)(발광층 또는 유기 발광층)이 배치될 수 있다. 유기층(202)은 제1 전극(201)의 개구부(201b)에 의해 노출된 제1 전극(201)의 상면(201a)과, 뱅크층(105)의 측면과, 뱅크층(105)의 상부면의 적어도 일부에 배치될 수 있다. 유기층(202)은 제1 전극(201)의 상면(201a) 상에 배치된 나노 패턴들(300)을 덮을 수 있다. 유기층(202)은 나노 패턴들(300)을 완전히 덮고, 제1 전극(201)과 함께 나노 패턴들(300)을 둘러쌀 수 있다. 유기층(202)은 나노 패턴들(300)과 상이한 물질로 이루어질 수 있다. 또한, 나노 패턴들(300)과 유기층(202)은 서로 상이한 굴절율을 가질 수 있다. 예를 들어, 나노 패턴(300)은 유기층(202)의 굴절율보다 높은 굴절율을 가질 수 있다.According to an embodiment of the present specification, an organic layer 202 (light-emitting layer or organic light-emitting layer) may be disposed on the
본 명세서의 일 실시예에 따르면, 유기층(202) 및 뱅크층(105) 상에는 제2 전극(203)(캐소드 전극 또는 공통 전극)이 배치될 수 있다. 제2 전극(203)은 유기층(202)의 상면과, 뱅크층(105)의 상부면을 덮도록 배치될 수 있다. 제2 전극(203)은 복수의 서브 픽셀(SP1, SP2, SP3)에 공통적으로 형성되는 공통층일 수 있다. 또한, 제2 전극(203)은 광을 투과시킬 수 있는 투명 전극 또는 불투명 전극일 수 있다.According to an embodiment of the present specification, a second electrode 203 (cathode electrode or common electrode) may be disposed on the
본 명세서의 일 실시예에 따르면, 제1 전극(201) 상에 유기층(202)의 굴절율보다 높은 굴절율을 가진 나노 패턴(300)이 배치되게 되면, 제1 전극(201) 상의 유기층(202)의 전체적인 굴절율이 나노 패턴(300)에 의해 점진적 또는 불규칙하게 변화될 수 있다. 이는 입사되는 외부광이 가시광선(visible light)의 파장(wavelength)보다 작은 크기를 가진 나노 패턴(300)을 인식하지 못한 채, 굴절율이 큰 매질 즉, 나노 패턴(300) 쪽으로 진행하게 되며, 나노 패턴(300)의 구조적 특성에 의해 굴절율이 점진적 또는 불규칙하게 변화되므로, 반사의 발생을 억제할 수 있다.According to an embodiment of the present specification, when the
도 4는 본 명세서의 다른 실시예에 따른 도 2의 A부분의 발광 소자를 나타낸 도면이다.FIG. 4 is a diagram showing a light emitting device in part A of FIG. 2 according to another embodiment of the present specification.
도 4를 도 2에 결부하여 참조하면, 본 명세서의 다른 실시예에 따른 표시 장치(100)는 제1 전극(201) 및 뱅크층(105)의 적어도 일부 상에 배치된 나노 패턴들(300)을 포함할 수 있다. 나노 패턴들(300)은 제1 전극(201)의 상면(201a) 및 뱅크층(105) 상에 직접 접촉되게 배치될 수 있다.Referring to FIG. 4 in conjunction with FIG. 2 , the
제1 전극(201)은 평탄화층(103) 상에 배치되고, 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 대응하는 위치에 배치될 수 있다. 제1 전극(201) 및 평탄화층(103) 상에는 뱅크층(105)이 배치될 수 있다. 뱅크층(105)은 제1 전극(201)의 가장자리 부분을 덮고 제1 전극(201)의 상면(201a)을 노출시키는 제1 전극(201)의 개구부(201b)를 정의할 수 있다.The
제1 전극(201) 및 뱅크층(105) 상에는 유기층(202)(발광층 또는 유기 발광층)이 배치될 수 있다. 그리고, 유기층(202) 상에는 제2 전극(203)(캐소드 전극 또는 공통 전극)이 배치될 수 있다.An organic layer 202 (light-emitting layer or organic light-emitting layer) may be disposed on the
본 명세서의 다른 실시예에 따른 나노 패턴들(300)은 제1 전극(201)의 개구부(201b)에 의해 노출된 제1 전극(201)의 상면(201a), 뱅크층(105)의 상부면(105a)의 적어도 일부, 및 뱅크층(105)의 측면(105b) 상에 랜덤하게 배치될 수 있다. 나노 패턴들(300)은 제1 전극(201), 뱅크층(105)의 상부면(105a) 및 뱅크층(105)의 측면(105b) 상에서 형상과 배치가 랜덤하게 형성될 수 있다. 나노 패턴들(300)은 제1 전극(201) 및 뱅크층(105)과 상이한 물질로 이루어질 수 있다. 예를 들어, 나노 패턴들(300)은 표시 장치(100)의 제조 공정에서 사용되는 보호 물질로 이루어질 수 있다. 예를 들면, 보호 물질은 표시 장치(100)의 유기층을 패터닝하는 공정에서 유기층의 에칭 스톱퍼의 기능을 수행하거나, 또는 패턴 마스크의 기능을 수행할 수 있는 물질일 수 있다. 보호 물질은 수계 고분자 물질 또는 불소계 고분자 물질을 포함할 수 있다. 예를 들면, 보호 물질의 수계 고분자 물질로는 폴리에틸렌글리콜(PEG), 폴리비닐알콜(PVA) 또는 폴리비닐아세테이트(PVAc)과 같은 친수성 유기 물질일 수 있고, 불소계 고분자 물질로는 탄소-탄소의 결합이 사슬구조로 연속적으로 이루어지면서, 작용기(또는 기능기)에 다량의 불소(F)를 함유한 불소중합체(floropolymer) 물질일 수 있다.
본 명세서의 다른 실시예에 따르면, 제1 전극(201), 뱅크층(105)의 측면(105b) 및 뱅크층(105)의 상부면(105a)의 적어도 일부 상에 보호 물질 패턴을 형성하고, 보호 물질 패턴을 드라이 에칭하는 것에 의해 형상과 배치가 랜덤한 나노 패턴들(300)을 형성할 수 있다. 예를 들어, 드라이 에칭 공정에는 플라즈마(plasma) 처리를 포함할 수 있다.According to another embodiment of the present specification, a protective material pattern is formed on at least a portion of the
나노 패턴(300)은 3차원 구조의 랜덤한 원형 또는 원기둥형으로 형성될 수 있다. 본 명세서에서 랜덤한 원형 또는 원기둥형이란 원형 또는 원기둥형의 형태에서 불규칙하게 일부 영역이 함몰되거나 돌출된 형태를 의미할 수 있다. 나노 패턴(300)은 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하일 수 있다. 또한, 나노 패턴(300)은 제1 전극(201), 뱅크층(105)의 상부면(105a) 및 뱅크층(105)의 측면(105b) 중 적어도 하나와 접하는 면의 장방향 길이가 상기 적어도 하나의 접하는 면을 제외한 다른 차원에서의 장방향 길이보다 작을 수 있다. 예를 들어, 나노 패턴(300)은 난반사에 유리하여 반사율을 저감시킬 수 있는 나방눈(moth-eye) 형상을 포함할 수 있다. 나노 패턴들(300)은 랜덤한 형상과 배치에 의해 입사되는 외부광이 난반사되도록 유도함으로써, 제1 전극(201)을 통해 반사되는 외부광의 반사율을 저감시킬 수 있다.The
본 명세서의 다른 실시예에 따르면, 나노 패턴들(300)이 배치된 제1 전극(201) 및 뱅크층(105) 상에는 유기층(202)(발광층 또는 유기 발광층)이 배치될 수 있다. 유기층(202)은 제1 전극(201)의 개구부(201b)에 의해 노출된 제1 전극(201)의 상면(201a)과, 뱅크층(105)의 측면(105b)과, 뱅크층(105)의 상부면(105a)의 적어도 일부에 배치될 수 있다. 유기층(202)은 제1 전극(201)의 상면(201a), 뱅크층(105)의 측면(105b) 및 뱅크층(105)의 상부면(105a) 상에 배치된 나노 패턴들(300)을 덮을 수 있다. 예를 들어, 뱅크층(105)의 상부면(105a) 상의 나노 패턴들(300)은 뱅크층(105)에 의해 덮힌 제1 전극(201)의 가장자리 부분과 중첩되는 부분까지 배치될 수 있다. 그리고, 유기층(202)은 뱅크층(105)의 상부면(105a) 상에 배치된 나노 패턴들(300)을 완전히 덮을 수 있는 부분까지 배치될 수 있다. 유기층(202)은 나노 패턴들(300)을 완전히 덮고, 제1 전극(201) 및 뱅크층(105)과 함께 나노 패턴들(300)을 둘러쌀 수 있다. 유기층(202)은 나노 패턴들(300)과 상이한 물질로 이루어질 수 있다. 또한, 나노 패턴들(300)과 유기층(202)은 서로 상이한 굴절율을 가질 수 있다. 예를 들어, 나노 패턴(300)은 유기층(202)의 굴절율보다 높은 굴절율을 가질 수 있다.According to another embodiment of the present specification, an organic layer 202 (light-emitting layer or organic light-emitting layer) may be disposed on the
본 명세서의 다른 실시예에 따르면, 유기층(202) 및 뱅크층(105) 상에는 제2 전극(203)(캐소드 전극 또는 공통 전극)이 배치될 수 있다. 제2 전극(203)은 유기층(202)의 상면과, 뱅크층(105)의 상부면(105a)을 덮도록 배치될 수 있다. 제2 전극(203)은 복수의 서브 픽셀(SP1, SP2, SP3)에 공통적으로 형성되는 공통층일 수 있다. 또한, 제2 전극(203)은 광을 투과시킬 수 있는 투명 전극 또는 불투명 전극일 수 있다.According to another embodiment of the present specification, the second electrode 203 (cathode electrode or common electrode) may be disposed on the
본 명세서의 다른 실시예에 따르면, 제1 전극(201) 및 뱅크층(105)의 적어도 일부 상에 유기층(202)의 굴절율보다 높은 굴절율을 가진 나노 패턴(300)이 배치되게 되면, 제1 전극(201) 및 뱅크층(105) 상의 유기층(202)의 전체적인 굴절율이 나노 패턴(300)에 의해 점진적 또는 불규칙하게 변화될 수 있다. 이는 입사되는 외부광이 가시광선(visible light)의 파장(wavelength)보다 작은 크기를 가진 나노 패턴(300)을 인식하지 못한 채, 굴절율이 큰 매질 즉, 나노 패턴(300) 쪽으로 진행하게 되며, 나노 패턴(300)의 구조적 특성에 의해 굴절율이 점진적 또는 불규칙하게 변화되므로, 반사의 발생을 억제할 수 있다.According to another embodiment of the present specification, when the
도 5a 내지 도 5c는 본 명세서의 실시예에 따른 나노 패턴의 형상을 설명하기 위한 도면이다.5A to 5C are diagrams for explaining the shape of a nanopattern according to an embodiment of the present specification.
도 5a 내지 도 5c를 참조하면, 본 명세서의 실시예에 따른 나노 패턴(300)은 3차원 구조의 랜덤한 원형 또는 원기둥형으로 형성될 수 있다.Referring to FIGS. 5A to 5C , the
도 5a에 도시된 바와 같이, 나노 패턴(300)은 3차원 구조의 랜덤한 원형으로 형성될 수 있다. 본 명세서에서 랜덤한 원형이란 원형의 형태에서 불규칙하게 일부 영역이 함몰되거나 돌출된 형태를 의미할 수 있다. 나노 패턴(300)은 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하일 수 있다. 예를 들어, 나노 패턴(300)은 X차원, Y차원 및 Z차원 중 적어도 하나의 차원에서의 장방향 길이가 10㎚ 이하일 수 있다. 나노 패턴(300)이 랜덤한 원형의 경우, X차원, Y차원 및 Z차원에서의 장방향 길이가 대략적으로 서로 유사할 수 있다. 나노 패턴(300)은 X-Y차원의 평면 상에 접할 수 있고, X-Y차원의 평면과 접하는 면의 장방향 길이가 X차원, Y차원 및 Z차원에서의 장방향 길이보다 작을 수 있다.As shown in FIG. 5A, the
도 5b 및 도 5c에 도시된 바와 같이, 나노 패턴(300)은 3차원 구조의 랜덤한 원기둥형(또는 타원형)으로 형성될 수 있다. 본 명세서에서 랜덤한 원기둥형이란 원기둥형의 형태에서 불규칙하게 일부 영역이 함몰되거나 돌출된 형태를 의미할 수 있다. 나노 패턴(300)은 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하일 수 있다. 예를 들어, 나노 패턴(300)은 도 5b와 같이, X차원 또는 Y차원에서의 장방향 길이가 가장 길 수 있고, X차원 또는 Y차원에서의 장방향 길이가 10㎚ 이하일 수 있다. 나노 패턴(300)은 X-Y차원의 평면 상에 접할 수 있고, X-Y차원의 평면과 접하는 면의 장방향 길이가 X차원 또는 Y차원에서의 장방향 길이보다 작을 수 있다. 또한, 나노 패턴(300)은 도 5c와 같이, Z차원에서의 장방향 길이가 가장 길 수 있고, Z차원에서의 장방향 길이가 10㎚ 이하일 수 있다. 나노 패턴(300)은 X-Y차원의 평면 상에 접할 수 있고, X-Y차원의 평면과 접하는 면의 장방향 길이가 Z차원에서의 장방향 길이보다 작을 수 있다.As shown in FIGS. 5B and 5C, the
본 명세서의 실시예에 따른 나노 패턴(300)은 표시 장치(100)의 제조 공정에서 사용되는 보호 물질로 이루어질 수 있다. 보호 물질은 표시 장치(100)의 유기층과 근접하더라도 데미지(damage)가 발생되지 않는 물질일 수 있다. 예를 들어, 보호 물질은 표시 장치(100)의 유기층을 패터닝하는 공정에서 유기층의 에칭 스톱퍼의 기능을 수행하거나, 또는 패턴 마스크의 기능을 수행할 수 있는 물질일 수 있다. 또한, 나노 패턴(300)은 보호 물질을 드라이 에칭하는 것에 의해 형성될 수 있고, 드라이 에칭 공정에는 플라즈마(plasma) 처리를 포함할 수 있다. 나노 패턴(300)은 플라즈마 처리에 의해 보호 물질이 변성되어 강도가 상승한 보호 물질의 잔류물일 수 있다. 예를 들어, 나노 패턴(300)은 플라즈마 변성에 의해 도전성을 가질 수도 있다. 나노 패턴(300)은 드라이 에칭의 공정 조건에 따라 형상, 크기 및 분포 밀도 등이 제어될 수 있다.The
도 6a 내지 도 6c는 본 명세서의 실시예에 따른 나노 패턴에 의한 반사 저감 현상을 설명하기 위한 도면이다. 도 6a는 제1 전극(201) 상에 나노 패턴 구조가 배치되지 않는 경우의 광 경로를 나타낸 것이고, 도 6b는 제1 전극(201) 상에 반구 형태의 패턴(300')이 배치되는 경우의 광 경로를 나타낸 것이고, 도 6c는 제1 전극(201) 상에 본 명세서의 실시예에 따른 나노 패턴(300)이 배치되는 경우의 광 경로를 나타낸 것이다.FIGS. 6A to 6C are diagrams for explaining a reflection reduction phenomenon caused by nanopatterns according to an embodiment of the present specification. Figure 6a shows the optical path when the nano-pattern structure is not placed on the
도 6a를 참조하면, 제1 전극(201)과 같은 반사판 상에 나노 패턴 구조가 배치되지 않는 경우, 입사되는 외부광(L1)은 제1 전극(201)에서 반사(R1) 즉, 전반사되어 다시 외부로 향하게 되는 광 경로를 가질 수 있다.Referring to FIG. 6A, when the nano-pattern structure is not disposed on a reflector such as the
도 6b를 참조하면, 제1 전극(201)과 같은 반사판 상에 반구형 패턴(300')이 배치될 수 있다. 본 명세서에서 반구형 패턴(300')은 제1 전극(201)과 접하는 면의 장방향 길이가 다른 차원에서의 장방향 길이보다 가장 긴 형태를 의미할 수 있다. 제1 전극(201) 상에 반구형 패턴(300')이 배치되는 경우, 입사되는 외부광(L2)은 반구형 패턴(300')의 계면에서 제1 굴절(r1)이 이루어지고, 1차 굴절된 광이 제1 전극(201)에서 반사(R2)되어 외부로 향하게 되고, 다시 반구형 패턴(300')의 계면에서 제2 굴절(r2)이 이루어지면서 외부로 향하게 되는 광 경로를 가질 수 있다. 이는 2중의 굴절 현상을 가지기 때문에, 패턴 구조가 없는 것보다는 반사율이 저감될 수 있다.Referring to FIG. 6B, a hemispherical pattern 300' may be disposed on the same reflector as the
도 6c를 참조하면, 제1 전극(201)과 같은 반사판 상에 본 명세서의 실시예에 따른 나노 패턴(300)이 배치될 수 있다. 본 명세서의 실시예에 따른 나노 패턴(300)은 제1 전극(201)과 접하는 면의 장방향 길이(a1)가 제1 전극(201)과 접하는 면을 제외한 다른 차원에서의 장방향 길이(a2)보다 작을 수 있다. 제1 전극(201) 상에 나노 패턴(300)이 배치되는 경우, 입사되는 외부광(L3)은 나노 패턴(300)의 일 측의 계면에서 제1 굴절(r1)이 이루어지고, 1차 굴절된 광이 나노 패턴(300)의 다른 측의 계면에서 제2 굴절(r2)이 이루어지고, 2차 굴절된 광이 제1 전극(201)에서 반사(R3)되어 외부로 향하게 되고, 다시 나노 패턴(300)의 또 다른 측의 계면에서 제3 굴절(r3)이 이루어지면서 외부로 향하게 되는 광 경로를 가질 수 있다. 이는 3중의 굴절 현상을 가지기 때문에, 광의 난반사를 유도할 수 있고, 난반사되는 광 경로에 의해 반사율이 크게 저감될 수 있다.Referring to FIG. 6C, a
이하에서는 도 7 내지 도 32를 참조하여 본 명세서의 실시예에 따른 표시 장치의 제조 방법에 대해 보다 구체적으로 설명하도록 한다.Hereinafter, a method of manufacturing a display device according to an embodiment of the present specification will be described in more detail with reference to FIGS. 7 to 32.
도 7 내지 도 10은 본 명세서의 일 실시예에 따른 나노 패턴을 형성하는 방법을 설명하기 위한 제조 공정도들이고, 도 11 내지 도 15는 본 명세서의 다른 실시예에 따른 나노 패턴을 형성하는 방법을 설명하기 위한 제조 공정도들이고, 도 16은 본 명세서의 실시예에 따른 나노 패턴을 형성하는 방법을 설명하기 위한 이미지들이고, 도 17 내지 도 32는 본 명세서의 실시예에 따른 나노 패턴 형성 이후의 표시 장치를 제조하는 방법을 설명하기 위한 제조 공정도들이다.FIGS. 7 to 10 are manufacturing process diagrams for explaining a method of forming a nanopattern according to an embodiment of the present specification, and FIGS. 11 to 15 illustrate a method of forming a nanopattern according to another embodiment of the present specification. These are manufacturing process diagrams for the following, Figure 16 is an image for explaining a method of forming a nano pattern according to an embodiment of the present specification, and Figures 17 to 32 show a display device after forming a nano pattern according to an embodiment of the present specification. These are manufacturing process charts to explain the manufacturing method.
먼저, 도 7 내지 도 10을 도 2에 결부하여 설명하면, 본 명세서의 일 실시예에 따른 나노 패턴을 형성하는 방법은 도 3에 도시된 본 명세서의 일 실시예에 따른 발광 소자의 형태로 제조하기 위한 방법에 관한 것이다.First, if FIGS. 7 to 10 are described in conjunction with FIG. 2, the method of forming a nanopattern according to an embodiment of the present specification is manufactured in the form of a light emitting device according to an embodiment of the present specification shown in FIG. 3. It's about how to do it.
도 7에 도시된 바와 같이, 기판(101) 상에는 회로층(102)과 평탄화층(103)을 형성하고, 평탄화층(103) 상에는 제1 전극(201)을 형성할 수 있다. 또는, 평탄화층(103) 상에는 제1 전극(201) 및 뱅크층(105)을 형성할 수 있다.As shown in FIG. 7, a
제1 전극(201)은 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 대응하는 위치에 배치될 수 있다. 예를 들어, 제1 전극(201)은 투명 도전막으로 이루어진 투명 전극층 및 반사효율이 높은 불투명 도전막으로 이루어진 반사 전극층을 포함하는 다층 구조로 형성될 수 있다. 제1 전극(201)의 투명 전극층으로는 인듐-틴-옥사이드(Indium Tin Oxide; ITO) 또는 인듐-징크-옥사이드(Indium Zinc Oxide; IZO)와 같은 일함수 값이 비교적 큰 재질로 이루어지고, 반사 전극층으로는 은(Ag), 알루미늄(Al), 구리(Cu), 몰리브덴(Mo), 티타늄(Ti), 니켈(Ni), 크롬(Cr), 또는 텅스텐(W)으로 이루어진 군에서 선택된 어느 하나 또는 이들의 합금의 단층이나 다층으로 이루어질 수 있다. 예를 들면, 제1 전극(201)은 투명 전극층, 반사 전극층 및 투명 전극층이 순차적으로 적층된 구조로 형성되거나, 투명 전극층 및 반사 전극층이 순차적으로 적층된 구조로 형성될 수 있다. 하지만, 본 명세서가 반드시 이에 한정되지는 않는다.The
제1 전극(201) 및 평탄화층(103) 상에는 뱅크층(105)을 형성할 수 있다. 뱅크층(105)은 제1 전극(201)의 가장자리 부분을 덮고 제1 전극(201)의 개구부를 정의할 수 있다. 예를 들어, 뱅크층(105)은 실리콘 산화막(SiOx), 실리콘 질화막(SiNx), 실리콘 산질화막(SiOxNy) 등의 무기물로 이루어질 수 있다. 또는, 뱅크층(105)은 폴리이미드(polyimide), 아크릴레이트(acrylate), 벤조사이클로부틴계 수지(benzocyclobutene series resin) 등의 유기물로 이루어질 수 있다. 본 명세서의 실시예에 따르면, 뱅크층(105)은 유기물로 이루어질 수 있으나, 애노드와 캐소드 간의 누설 전류 방지가 추가될 필요가 있고, 에칭에 대해 상대적으로 강한 특성이 요구되기에 무기물로 이루어질 수 있다. 뱅크층(105)에 의해 노출된 제1 전극(201)의 개구부는 복수의 서브 픽셀(SP1, SP2, SP3) 각각의 발광 영역으로 정의될 수 있다. 하지만, 본 명세서가 반드시 이에 한정되지는 않는다.A
도 8에 도시된 바와 같이, 제1 전극(201)을 포함하는 기판(101)의 전면에는 보호 물질층(SL)을 형성할 수 있다. 또는, 제1 전극(201) 및 뱅크층(105)을 포함하는 기판(101)의 전면에는 보호 물질층(SL)을 형성할 수 있다. 보호 물질층(SL)은 제1 전극(201) 및 뱅크층(105) 상에 비평탄 구조로 형성될 수 있다.As shown in FIG. 8, a protective material layer SL may be formed on the entire surface of the
보호 물질층(SL)은 표시 장치(100)의 제조 공정에서 사용되는 물질로 이루어질 수 있다. 보호 물질층(SL)은 표시 장치(100)의 유기층과 근접하더라도 데미지(damage)가 발생되지 않는 물질일 수 있다. 예를 들어, 보호 물질층(SL)은 표시 장치(100)의 유기층을 패터닝하는 공정에서 유기층의 에칭 스톱퍼의 기능을 수행하거나, 또는 패턴 마스크의 기능을 수행할 수 있는 물질일 수 있다. 보호 물질층(SL)은 수계 고분자 물질 또는 불소계 고분자 물질을 포함할 수 있다. 예를 들면, 보호 물질층(SL)의 수계 고분자 물질로는 폴리에틸렌글리콜(PEG), 폴리비닐알콜(PVA) 또는 폴리비닐아세테이트(PVAc)과 같은 친수성 유기 물질일 수 있고, 불소계 고분자 물질로는 탄소-탄소의 결합이 사슬구조로 연속적으로 이루어지면서, 작용기(또는 기능기)에 다량의 불소(F)를 함유한 불소중합체(floropolymer) 물질일 수 있다.The protective material layer SL may be made of a material used in the manufacturing process of the
보호 물질층(SL)은 스핀 코팅(spin coating) 또는 슬릿 코팅(slit coating) 기법 등을 이용하여 형성될 수 있다. 또한, 보호 물질층(SL)은 대략적으로 1.0㎛ 내지 2.0㎛의 두께로 형성될 수 있다. 또한, 제1 전극(201) 상의 보호 물질층(SL)의 두께와 뱅크층(105) 상의 보호 물질층(SL)의 두께 차이는 대략적으로 0.2㎛ 이내로 형성될 수 있다. 하지만, 본 명세서가 반드시 이에 한정되는 것은 아니며, 보호 물질층(SL)의 두께는 드라이 에칭 공정에 의해 두께의 조절이 가능한 수준으로 형성될 수 있다.The protective material layer SL may be formed using spin coating or slit coating techniques. Additionally, the protective material layer SL may be formed to have a thickness of approximately 1.0 μm to 2.0 μm. Additionally, the difference between the thickness of the protective material layer SL on the
도 9에 도시된 바와 같이, 보호 물질층(SL)이 형성된 후, 제1 드라이 에칭(DE_1) 공정을 진행하여 제1 전극(201) 상에 보호 물질 패턴(SL_P)을 형성할 수 있다. 보호 물질 패턴(SL_P)은 제1 전극(201) 및 뱅크층(105) 상에 형성된 보호 물질층(SL)을 제1 드라이 에칭(DE_1)하여 제1 전극(201)의 개구부에 의해 노출된 제1 전극(201) 상에 보호 물질층(SL)의 물질 일부를 잔류시켜 형성할 수 있다.As shown in FIG. 9 , after the protective material layer SL is formed, a first dry etching process DE_1 may be performed to form a protective material pattern SL_P on the
제1 드라이 에칭(DE_1)은 산소(O2), 불소계 가스(SF6) 또는 아르곤(Ar)의 단독 또는 혼합 가스를 이용하여 에칭 레이트를 빠르게 진행시켜 보호 물질층(SL)의 전체적인 두께를 감소시키고, 제1 전극(201) 상에만 나노 패턴을 형성하기 위한 보호 물질 패턴(SL_P)을 형성할 수 있다. 또한, 제1 드라이 에칭(DE_1)은 뱅크층(105)의 데미지(damage)가 최소화될 수 있는 조건으로 진행될 수 있다. 제1 드라이 에칭(DE_1)의 조건에 따라 보호 물질 패턴(SL_P)의 두께를 조절하여 나노 패턴의 크기를 제어할 수 있다. 보호 물질 패턴(SL_P)은 표면의 거칠기가 고르게 형성될 수 있다.The first dry etching (DE_1) uses oxygen (O 2 ), fluorine-based gas (SF 6 ), or argon (Ar) alone or in a mixed gas to quickly proceed with the etching rate, thereby reducing the overall thickness of the protective material layer (SL). And, a protective material pattern (SL_P) for forming a nano pattern can be formed only on the
도 10에 도시된 바와 같이, 보호 물질 패턴(SL_P)이 형성된 후, 제2 드라이 에칭(DE_1) 공정을 진행하여 제1 전극(201) 상에 나노 패턴(300)을 형성할 수 있다. 나노 패턴(300)은 제1 전극(201) 상에 형성된 보호 물질 패턴(SL_P)를 제2 드라이 에칭(DE_2)하여 제1 전극(201) 상의 보호 물질 패턴(SL_P)이 변성되어 3차원 구조의 랜덤한 원형 또는 원기둥형의 형태로 형성될 수 있다.As shown in FIG. 10, after the protective material pattern (SL_P) is formed, a second dry etching (DE_1) process may be performed to form the
제2 드라이 에칭(DE_2)은 제1 드라이 에칭(DE_1)에서 포함되었던 불소계 가스(SF6)를 제외시키고, 산소(O2), 질소(N2), 산소(O2) 및 질소(N2), 또는 아르곤(Ar)의 단독 또는 혼합 가스를 이용하는 플라즈마(plasma) 처리에 의해서 보호 물질 패턴(SL_P)의 표면 거칠기를 증가시켜 잔류하는 물질을 변성시킴으로써, 제1 전극(201) 상에 형상과 배치가 랜덤한 나노 패턴들(300)을 형성할 수 있다.The second dry etching (DE_2) excludes the fluorine-based gas (SF 6 ) included in the first dry etching (DE_1), and uses oxygen (O 2 ), nitrogen (N 2 ), oxygen (O 2 ), and nitrogen (N 2 ), or by increasing the surface roughness of the protective material pattern (SL_P) by plasma treatment using argon (Ar) alone or mixed gas to denature the remaining material, forming a shape and shape on the
본 명세서의 일 실시예에 따른 나노 패턴(300)은 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하일 수 있다. 또한, 나노 패턴(300)은 제1 전극(201)과 접하는 면의 장방향 길이가 제1 전극(201)과 접하는 면을 제외한 다른 차원에서의 장방향 길이보다 작을 수 있다. 예를 들어, 나노 패턴(300)은 난반사에 유리하여 반사율을 저감시킬 수 있는 나방눈(moth-eye) 형상을 포함할 수 있다. 나노 패턴들(300)은 랜덤한 형상과 배치에 의해 입사되는 외부광이 난반사되도록 유도함으로써, 제1 전극(201)을 통해 반사되는 외부광의 반사율을 저감시킬 수 있다.The
다음으로, 도 11 내지 도 15를 도 2에 결부하여 설명하면, 본 명세서의 다른 실시예에 따른 나노 패턴을 형성하는 방법은 도 4에 도시된 본 명세서의 다른 실시예에 따른 발광 소자의 형태로 제조하기 위한 방법에 관한 것이다. 이하의 설명에서 도 7 내지 도 10에 도시된 본 명세서의 일 실시예에 따른 나노 패턴을 형성하는 방법과 중복되는 설명은 생략하거나 간략히 한다.Next, when FIGS. 11 to 15 are described in connection with FIG. 2, the method of forming a nanopattern according to another embodiment of the present specification is in the form of a light emitting device according to another embodiment of the present specification shown in FIG. 4. It relates to a method for manufacturing. In the following description, descriptions that overlap with the method of forming a nanopattern according to an embodiment of the present specification shown in FIGS. 7 to 10 will be omitted or simplified.
도 11에 도시된 바와 같이, 기판(101) 상에는 회로층(102)과 평탄화층(103)을 형성하고, 평탄화층(103) 상에는 제1 전극(201)을 형성할 수 있다. 또는, 평탄화층(103) 상에는 제1 전극(201) 및 뱅크층(105)을 형성할 수 있다.As shown in FIG. 11, a
도 12에 도시된 바와 같이, 제1 전극(201)을 포함하는 기판(101)의 전면에는 보호 물질층(SL) 및 포토레지스트층(PR)을 형성할 수 있다. 또는, 제1 전극(201) 및 뱅크층(105)을 포함하는 기판(101)의 전면에는 보호 물질층(SL) 및 포토레지스트층(PR)을 형성할 수 있다. 보호 물질층(SL) 및 포토레지스트층(PR)은 제1 전극(201) 및 뱅크층(105) 상에 비평탄 구조로 형성될 수 있다.As shown in FIG. 12, a protective material layer (SL) and a photoresist layer (PR) may be formed on the entire surface of the
보호 물질층(SL) 상에 형성된 포토레지스트층(PR)은 포지티브 타입 또는 네거티브 타입의 포토레지스트 물질 중 하나를 선택하여 형성할 수 있다. 본 명세서의 다른 실시예에 따르면, 포토레지스트층(PR)은 네거티브 타입의 포토레지스트 물질로 형성될 수 있으나, 반드시 이에 한정되지는 않는다.The photoresist layer (PR) formed on the protective material layer (SL) can be formed by selecting either a positive type or a negative type photoresist material. According to another embodiment of the present specification, the photoresist layer PR may be formed of a negative type photoresist material, but is not necessarily limited thereto.
도 13에 도시된 바와 같이, 보호 물질층(SL) 및 포토레지스트층(PR)이 형성된 후, 보호 물질층(SL)의 표면 일부를 노출시키는 포토레지스트 패턴(PR_P)을 형성할 수 있다. 포토레지스트 패턴(PR_P)은 제1 전극(201)과, 제1 전극(201)을 중심으로 뱅크층(105)의 측면 및 뱅크층(105)의 상부면의 적어도 일부에 중첩되는 부분에 배치될 수 있다. 포토레지스트 패턴(PR_P)이 배치되는 부분은 이후에 나노 패턴들(300)이 형성되는 부분에 대응될 수 있다. 포토레지스트 패턴(PR_P)은 포토레지스트층(PR) 상에서 포토레지스트 패턴(PR_P)이 위치할 부분을 자외선(UV)등과 같은 광에 노출시키는 노광 공정을 진행하고, 현상액을 이용하여 노광된 부분을 제외한 나머지 부분들을 제거하여 형성될 수 있다.As shown in FIG. 13, after the protective material layer SL and the photoresist layer PR are formed, a photoresist pattern PR_P that exposes a portion of the surface of the protective material layer SL may be formed. The photoresist pattern PR_P is disposed in a portion overlapping the
도 14에 도시된 바와 같이, 포토레지스트 패턴(PR_P)이 형성된 후, 제1 드라이 에칭(DE_1) 공정을 진행하여 제1 전극(201), 뱅크층(105)의 측면 및 뱅크층(105)의 상부면의 적어도 일부 상에 보호 물질 패턴(SL_P)을 형성할 수 있다. 보호 물질 패턴(SL_P)은 제1 전극(201) 및 뱅크층(105) 상에 형성된 보호 물질층(SL)과, 보호 물질층(SL) 상에 부분적으로 형성된 포토레지스트 패턴(PR_P)을 제1 드라이 에칭(DE_1)하여 제1 전극(201), 뱅크층(105)의 측면 및 뱅크층(105)의 상부면의 적어도 일부 상에 보호 물질층(SL)의 물질 일부를 잔류시켜 형성할 수 있다.As shown in FIG. 14, after the photoresist pattern (PR_P) is formed, the first dry etching (DE_1) process is performed to remove the
제1 드라이 에칭(DE_1)은 산소(O2), 불소계 가스(SF6) 또는 아르곤(Ar)의 단독 또는 혼합 가스를 이용하여 에칭 레이트를 빠르게 진행시켜 포토레지스트 패턴(PR_P)의 제거와 함께 보호 물질층(SL)의 전체적인 두께를 감소시키고, 포토레지스트 패턴(PR_P)에 의한 에칭 지연으로 제1 전극(201), 뱅크층(105)의 측면 및 뱅크층(105)의 상부면의 적어도 일부 상에 나노 패턴을 형성하기 위한 보호 물질 패턴(SL_P)을 형성할 수 있다. 또한, 제1 드라이 에칭(DE_1)은 뱅크층(105)의 데미지(damage)가 최소화될 수 있는 조건으로 진행될 수 있다. 제1 드라이 에칭(DE_1)의 조건에 따라 보호 물질 패턴(SL_P)의 두께를 조절하여 나노 패턴의 크기를 제어할 수 있다. 보호 물질 패턴(SL_P)은 표면의 거칠기가 고르게 형성될 수 있다.The first dry etching (DE_1) uses oxygen (O 2 ), fluorine-based gas (SF 6 ), or argon (Ar) alone or in a mixed gas to quickly proceed with the etching rate to remove and protect the photoresist pattern (PR_P). The overall thickness of the material layer (SL) is reduced, and the etching delay due to the photoresist pattern (PR_P) causes at least a portion of the
도 15에 도시된 바와 같이, 보호 물질 패턴(SL_P)이 형성된 후, 제2 드라이 에칭(DE_1) 공정을 진행하여 제1 전극(201), 뱅크층(105)의 측면 및 뱅크층(105)의 상부면의 적어도 일부 상에 나노 패턴(300)을 형성할 수 있다. 나노 패턴(300)은 제1 전극(201), 뱅크층(105)의 측면 및 뱅크층(105)의 상부면의 적어도 일부 상에 형성된 보호 물질 패턴(SL_P)를 제2 드라이 에칭(DE_2)하여 제1 전극(201), 뱅크층(105)의 측면 및 뱅크층(105)의 상부면의 적어도 일부 상의 보호 물질 패턴(SL_P)이 변성되어 3차원 구조의 랜덤한 원형 또는 원기둥형의 형태로 형성될 수 있다.As shown in FIG. 15, after the protective material pattern (SL_P) is formed, the second dry etching (DE_1) process is performed to remove the
제2 드라이 에칭(DE_2)은 제1 드라이 에칭(DE_1)에서 포함되었던 불소계 가스(SF6)를 제외시키고, 산소(O2), 질소(N2), 산소(O2) 및 질소(N2), 또는 아르곤(Ar)의 단독 또는 혼합 가스를 이용하는 플라즈마(plasma) 처리에 의해서 보호 물질 패턴(SL_P)의 표면 거칠기를 증가시켜 잔류하는 물질을 변성시킴으로써, 제1 전극(201), 뱅크층(105)의 측면 및 뱅크층(105)의 상부면의 적어도 일부 상에 형상과 배치가 랜덤한 나노 패턴들(300)을 형성할 수 있다.The second dry etching (DE_2) excludes the fluorine-based gas (SF 6 ) included in the first dry etching (DE_1), and uses oxygen (O 2 ), nitrogen (N 2 ), oxygen (O 2 ), and nitrogen (N 2 ), or by increasing the surface roughness of the protective material pattern (SL_P) by plasma treatment using argon (Ar) alone or a mixed gas to denature the remaining material, the
본 명세서의 다른 실시예에 따른 나노 패턴(300)은 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하일 수 있다. 또한, 나노 패턴(300)은 제1 전극(201), 뱅크층(105)의 상부면 및 뱅크층(105)의 측면 중 적어도 하나와 접하는 면의 장방향 길이가 상기 적어도 하나의 접하는 면을 제외한 다른 차원에서의 장방향 길이보다 작을 수 있다. 예를 들어, 나노 패턴(300)은 난반사에 유리하여 반사율을 저감시킬 수 있는 나방눈(moth-eye) 형상을 포함할 수 있다. 나노 패턴들(300)은 랜덤한 형상과 배치에 의해 입사되는 외부광이 난반사되도록 유도함으로써, 제1 전극(201)을 통해 반사되는 외부광의 반사율을 저감시킬 수 있다.The
도 16을 참조하면, 본 명세서의 실시예에 따른 나노 패턴은 드라이 에칭의 공정 조건의 조절을 통해 형성될 수 있다. 도 16에서 a1, b1, c1은 드라이 에칭의 공정 시간에 따른 기판 표면을 10K의 스케일로 촬영한 이미지이고, a2, b2, c1은 드라이 에칭의 공정 시간에 따른 기판의 단면을 20K의 스케일로 촬영한 이미지이다.Referring to FIG. 16, a nanopattern according to an embodiment of the present specification can be formed by adjusting dry etching process conditions. In Figure 16, a1, b1, and c1 are images of the substrate surface taken at a 10K scale according to the dry etching process time, and a2, b2, and c1 are images of a cross section of the substrate according to the dry etching process time taken at a 20K scale. It is one image.
도 16의 a1 및 a2에 나타난 바와 같이, 드라이 에칭의 시간을 제1 시간으로 진행할 경우, 기판 상의 물질이 대부분 제거되어 물질의 표면 거칠기가 고른 상태이고, 나노 패턴 구조가 형성되지 않을 수 있다.As shown in a1 and a2 of FIG. 16, when the dry etching time is set to the first time, most of the material on the substrate is removed, the surface roughness of the material is even, and a nano-pattern structure may not be formed.
도 16의 b1 및 b2에 나타난 바와 같이, 드라이 에칭의 기간을 제1 시간보다 짧은 제2 시간으로 진행할 경우, 기판 상의 물질이 a1 및 a2의 경우보다 적게 제거되나, 물질의 표면 거칠기가 고른 상태이고, 나노 패턴 구조가 형성되지 않을 수 있다.As shown in b1 and b2 of Figure 16, when the dry etching period is performed for a second time shorter than the first time, less material on the substrate is removed than in the case of a1 and a2, but the surface roughness of the material is even. , a nanopattern structure may not be formed.
도 16의 c1 및 c2에 나타난 바와 같이, 드라이 에칭의 시간을 제2 시간보다 짧은 제3 시간으로 진행할 경우, 기판 상의 물질의 표면 거칠기가 증가되고, 3차원 구조의 형태를 갖는 나노 패턴 구조가 형성될 수 있다. 이와 같이, 드라이 에칭의 공정 조건의 조절을 통해 나노 패턴의 형성을 제어할 수 있음을 알 수 있다. 예를 들어, 드라이 에칭은 동일한 압력 및 가스 분위기 하에서 공정 시간을 조절하는 것에 의해 나노 패턴의 형성을 제어할 수 있음을 알 수 있다.As shown in c1 and c2 of Figure 16, when the dry etching time is performed to a third time shorter than the second time, the surface roughness of the material on the substrate increases, and a nano-pattern structure having a three-dimensional structure is formed. It can be. In this way, it can be seen that the formation of nanopatterns can be controlled by adjusting the dry etching process conditions. For example, it can be seen that dry etching can control the formation of nanopatterns by adjusting the process time under the same pressure and gas atmosphere.
다음으로, 도 17 내지 도 32를 도 2에 결부하여 설명하면, 본 명세서의 실시예에 따른 나노 패턴 형성 이후의 표시 장치를 제조하기 위한 방법에 관한 것이다. 본 명세서의 실시예에 따르면, 복수의 서브 픽셀(SP1, SP2, SP3) 각각의 유기층을 드라이 에칭 방식으로 패터닝할 수 있다.Next, FIGS. 17 to 32 will be described in connection with FIG. 2 , and will relate to a method for manufacturing a display device after nanopattern formation according to an embodiment of the present specification. According to an embodiment of the present specification, the organic layer of each of the plurality of subpixels SP1, SP2, and SP3 may be patterned using a dry etching method.
도 17에 도시된 바와 같이, 나노 패턴들(300)이 형성된 후, 제1 전극(201), 뱅크층(105) 및 나노 패턴(300)을 포함하는 기판(101)의 전면에는 제1 유기층(202a)을 형성할 수 있다. 제1 유기층(202a)은 복수의 서브 픽셀(SP1, SP2, SP3)에 대응하는 위치에 공통적으로 배치될 수 있다. 제1 유기층(202a)은 이후에 제1 서브 픽셀(SP1)에 대응하는 유기층 패턴으로 형성될 수 있다. 제1 유기층(202a)은 진공 증착 방식으로 형성될 수 있다. 제1 유기층(202a)은 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 대응하는 제1 전극(201)과, 뱅크층(105) 상에 형성될 수 있다.As shown in FIG. 17, after the
도 18에 도시된 바와 같이, 제1 유기층(202a)이 형성된 후, 제1 유기층(202a)을 포함하는 기판(101)의 전면에는 제1 보호 물질층(SL1) 및 제1 포토레지스트층(PR1)이 차례로 형성될 수 있다. 제1 보호 물질층(SL1) 및 제1 포토레지스트층(PR1)은 제1 유기층(202a) 상에 비평탄 구조로 형성될 수 있다. As shown in FIG. 18, after the first
제1 보호 물질층(SL1)은 제1 유기층(202a)을 패터닝하는 과정에서 유기층의 에칭 스톱퍼의 기능을 수행할 수 있다. 제1 보호 물질층(SL1)은 수계 고분자 물질 또는 불소계 고분자 물질을 포함할 수 있다. 예를 들면, 보호 물질층(SL)의 수계 고분자 물질로는 폴리에틸렌글리콜(PEG), 폴리비닐알콜(PVA) 또는 폴리비닐아세테이트(PVAc)과 같은 친수성 유기 물질일 수 있고, 불소계 고분자 물질로는 탄소-탄소의 결합이 사슬구조로 연속적으로 이루어지면서, 작용기(또는 기능기)에 다량의 불소(F)를 함유한 불소중합체(floropolymer) 물질일 수 있다. 본 명세서의 실시예에 따르면, 제1 보호 물질층(SL1)은 수계 고분자 물질로 형성될 수 있으나, 반드시 이에 한정되지는 않는다.The first protective material layer SL1 may function as an etching stopper for the organic layer during the patterning process of the first
제1 포토레지스트층(PR1)은 포지티브 타입 또는 네거티브 타입의 포토레지스트 물질 중 하나를 선택하여 형성할 수 있다. 본 명세서의 다른 실시예에 따르면, 제1 포토레지스트층(PR1)은 네거티브 타입의 포토레지스트 물질로 형성될 수 있으나, 반드시 이에 한정되지는 않는다.The first photoresist layer PR1 may be formed by selecting either a positive type or a negative type photoresist material. According to another embodiment of the present specification, the first photoresist layer PR1 may be formed of a negative type photoresist material, but is not necessarily limited thereto.
도 19에 도시된 바와 같이, 제1 보호 물질층(SL1) 및 제1 포토레지스트층(PR1)이 형성된 후, 제1 보호 물질층(SL1)의 표면 일부를 커버하는 제1 포토레지스트 패턴(PR1_P)을 형성할 수 있다. 제1 포토레지스트 패턴(PR1_P)은 제1 서브 픽셀(SP1)에 대응하는 제1 유기층(202a) 패턴이 형성될 위치에 배치될 수 있다. 제1 포토레지스트 패턴(PR1_P)은 제1 포토레지스트층(PR1) 상에서 제1 포토레지스트 패턴(PR1_P)이 위치할 부분을 자외선(UV)등과 같은 광에 노출시키는 노광 공정을 진행하고, 현상액을 이용하여 노광된 부분을 제외한 나머지 부분들을 제거하여 형성될 수 있다.As shown in FIG. 19, after the first protective material layer SL1 and the first photoresist layer PR1 are formed, the first photoresist pattern PR1_P covers a portion of the surface of the first protective material layer SL1. ) can be formed. The first photoresist pattern PR1_P may be disposed at a location where the first
도 20에 도시된 바와 같이, 제1 포토레지스트 패턴(PR1_P)이 형성된 후, 제1 포토레지스트 패턴(PR1_P)을 마스크 패턴으로 한 드라이 에칭 공정을 진행하여 제1 보호 물질 패턴(SL1_P) 및 제1 보호 물질 패턴(SL1_P)에 의해 보호되는 제1 유기층(202a)을 제외한 나머지 부분의 제1 보호 물질층(SL1) 및 제1 유기층(202a)를 제거하여 제1 서브 픽셀(SP1)에 대응하는 제1 유기층(202a)을 패터닝할 수 있다. 이때, 제2 서브 픽셀(SP2) 및 제3 서브 픽셀(SP3)에 대응하는 제1 전극(201) 상에는 나노 패턴들(300)이 제거되지 않고 잔류될 수 있다.As shown in FIG. 20, after the first photoresist pattern PR1_P is formed, a dry etching process is performed using the first photoresist pattern PR1_P as a mask pattern to form the first protective material pattern SL1_P and the first protective material pattern SL1_P. The remaining portion of the first protective material layer SL1 and the first
도 21에 도시된 바와 같이, 제1 유기층(202a)이 패터닝된 후, 제1 보호 물질 패턴(SL1_P)을 포함하는 기판(101)의 전면에는 제2 유기층(202b)을 형성할 수 있다. 제2 유기층(202a)은 복수의 서브 픽셀(SP1, SP2, SP3)에 대응하는 위치에 공통적으로 배치될 수 있다. 제2 유기층(202b)은 이후에 제2 서브 픽셀(SP2)에 대응하는 유기층 패턴으로 형성될 수 있다. As shown in FIG. 21, after the first
제2 유기층(202b)의 형성 전에는 이전 공정에서 발생된 이물질 또는 잔여물 등을 제거하는 플라즈마 처리를 수행할 수 있다. 예를 들어, 플라즈마 처리 공정은 산소(O2), 질소(N2), 산소(O2) 및 질소(N2), 또는 아르곤(Ar)의 단독 또는 혼합 가스를 플라즈마화시켜 진행할 수 있다.Before forming the second
도 22에 도시된 바와 같이, 제2 유기층(202b)이 형성된 후, 제1 유기층(202a) 상에 위치한 제1 보호 물질 패턴(SL1_P)을 제거할 수 있다. 제1 보호 물질 패턴(SL1_P)은 DI(de-ionized) 용액을 이용하여 제거될 수 있다. DI 용액은 제1 보호 물질 패턴(SL1_P)의 내부로 침투하여 제1 유기층(202a)으로부터 박리시켜 제거할 수 있다. 또한, 제1 보호 물질 패턴(SL1_P)의 상부에 배치된 제2 유기층(202b)은 제1 보호 물질 패턴(SL1_P)이 제거되는 과정에서 함께 제거될 수 있다. 이때, 제거된 제1 보호 물질 패턴(SL1_P)의 가장자리 부분에는 제2 유기층(202b)의 돌출 패턴(202b_t)이 형성될 수 있다. As shown in FIG. 22, after the second
도 23에 도시된 바와 같이, 제1 유기층(202a) 패턴 및 제2 유기층(202b)을 포함하는 기판(101)의 전면에는 제2 보호 물질층(SL2) 및 제2 포토레지스트층(PR2)이 차례로 형성될 수 있다. 제2 보호 물질층(SL2) 및 제2 포토레지스트층(PR2)은 제1 유기층(202a) 패턴 및 제2 유기층(202b) 상에 비평탄 구조로 형성될 수 있다. 제2 보호 물질층(SL2)은 제1 보호 물질층(SL1)과 동일한 물질일 수 있다. 또한, 제2 포토레지스트층(PR2)은 제1 포토레지스트층(PR1)과 동일한 물질일 수 있다.As shown in FIG. 23, a second protective material layer (SL2) and a second photoresist layer (PR2) are formed on the front surface of the
도 24에 도시된 바와 같이, 제2 보호 물질층(SL2) 및 제2 포토레지스트층(PR2)이 형성된 후, 제2 보호 물질층(SL2)의 표면 일부를 커버하는 제2 포토레지스트 패턴(PR2_P)을 형성할 수 있다. 제2 포토레지스트 패턴(PR2_P)은 제1 서브 픽셀(SP1)에 대응하는 제1 유기층(202a) 패턴 및 제2 서브 픽셀(SP2)에 대응하는 제2 유기층(202b) 패턴이 형성될 위치에 배치될 수 있다. 제2 포토레지스트 패턴(PR2_P)은 제2 포토레지스트층(PR2) 상에서 제2 포토레지스트 패턴(PR2_P)이 위치할 부분을 자외선(UV)등과 같은 광에 노출시키는 노광 공정을 진행하고, 현상액을 이용하여 노광된 부분을 제외한 나머지 부분들을 제거하여 형성될 수 있다.As shown in FIG. 24, after the second protective material layer SL2 and the second photoresist layer PR2 are formed, a second photoresist pattern PR2_P covers a portion of the surface of the second protective material layer SL2. ) can be formed. The second photoresist pattern PR2_P is disposed at a location where the first
도 25에 도시된 바와 같이, 제2 포토레지스트 패턴(PR2_P)이 형성된 후, 제2 포토레지스트 패턴(PR2_P)을 마스크 패턴으로 한 드라이 에칭 공정을 진행하여 제2 보호 물질 패턴(SL2_P) 및 제2 보호 물질 패턴(SL2_P)에 의해 보호되는 제1 유기층(202a) 및 제2 유기층(202b)을 제외한 나머지 부분의 제2 보호 물질층(SL2)과 제1 유기층(202a) 및 제2 유기층(202b)을 제거하여 제1 서브 픽셀(SP1)에 대응하는 제1 유기층(202a)과 제2 서브 픽셀(SP2)에 대응하는 제2 유기층(202b)을 패터닝할 수 있다. 이때, 제1 유기층(202a)과 제2 유기층(202b)은 뱅크층(105) 상에서 서로 이격되게 패터닝될 수 있고, 제2 유기층(202b)의 돌출 패턴(202b_t)이 제거될 수 있다. 또한, 제3 서브 픽셀(SP3)에 대응하는 제1 전극(201) 상에는 나노 패턴들(300)이 제거되지 않고 잔류될 수 있다.As shown in FIG. 25, after the second photoresist pattern PR2_P is formed, a dry etching process is performed using the second photoresist pattern PR2_P as a mask pattern to form the second protective material pattern SL2_P and the second protective material pattern SL2_P. The second protective material layer (SL2), the first organic layer (202a), and the second organic layer (202b) except for the first organic layer (202a) and the second organic layer (202b) protected by the protective material pattern (SL2_P) By removing, the first
도 26에 도시된 바와 같이, 제1 유기층(202a) 및 제2 유기층(202b)이 패터닝된 후, 제2 보호 물질 패턴(SL2_P)을 포함하는 기판(101)의 전면에는 제3 유기층(202c)을 형성할 수 있다. 제3 유기층(202c)은 복수의 서브 픽셀(SP1, SP2, SP3)에 대응하는 위치에 공통적으로 배치될 수 있다. 제3 유기층(202c)은 이후에 제3 서브 픽셀(SP3)에 대응하는 유기층 패턴으로 형성될 수 있다. As shown in FIG. 26, after the first
제3 유기층(202c)의 형성 전에는 이전 공정에서 발생된 이물질 또는 잔여물 등을 제거하는 플라즈마 처리를 수행할 수 있다. 예를 들어, 플라즈마 처리 공정은 산소(O2), 질소(N2), 산소(O2) 및 질소(N2), 또는 아르곤(Ar)의 단독 또는 혼합 가스를 플라즈마화시켜 진행할 수 있다.Before forming the third
도 27에 도시된 바와 같이, 제3 유기층(202c)이 형성된 후, 제1 유기층(202a) 및 제2 유기층(202b) 상에 위치한 제2 보호 물질 패턴(SL2_P)을 제거할 수 있다. 제2 보호 물질 패턴(SL2_P)은 DI(de-ionized) 용액을 이용하여 제거될 수 있다. DI 용액은 제2 보호 물질 패턴(SL2_P)의 내부로 침투하여 제1 유기층(202a) 및 제2 유기층(202b)으로부터 박리시켜 제거할 수 있다. 또한, 제2 보호 물질 패턴(SL2_P)의 상부에 배치된 제3 유기층(202c)은 제2 보호 물질 패턴(SL2_P)이 제거되는 과정에서 함께 제거될 수 있다. 이때, 제거된 제2 보호 물질 패턴(SL2_P)의 가장자리 부분에는 제3 유기층(202c)의 제1 돌출 패턴(202c_t1)이 형성될 수 있다. 또한, 인접한 제2 보호 물질 패턴(SL2_P) 사이 부분에는 제3 유기층(202c)의 제2 돌출 패턴(202c_t2)이 형성될 수 있다.As shown in FIG. 27, after the third
도 28에 도시된 바와 같이, 제1 유기층(202a) 패턴, 제2 유기층(202b) 패턴 및 제3 유기층(202c) 패턴을 포함하는 기판(101)의 전면에는 제3 보호 물질층(SL3) 및 제3 포토레지스트층(PR3)이 차례로 형성될 수 있다. 제3 보호 물질층(SL3) 및 제3 포토레지스트층(PR3)은 제1 유기층(202a) 패턴, 제2 유기층(202b) 및 제3 유기층(202c) 상에 비평탄 구조로 형성될 수 있다. 제3 보호 물질층(SL3)은 제1 또는 제2 보호 물질층(SL1, SL2)과 동일한 물질일 수 있다. 또한, 제3 포토레지스트층(PR3)은 제1 또는 제2 포토레지스트층(PR2, PR3)과 동일한 물질일 수 있다.As shown in FIG. 28, a third protective material layer SL3 and The third photoresist layer PR3 may be formed sequentially. The third protective material layer SL3 and the third photoresist layer PR3 may be formed in a non-flat structure on the first
도 29에 도시된 바와 같이, 제3 보호 물질층(SL3) 및 제3 포토레지스트층(PR3)이 형성된 후, 제3 보호 물질층(SL3)의 표면 일부를 커버하는 제3 포토레지스트 패턴(PR3_P)을 형성할 수 있다. 제3 포토레지스트 패턴(PR3_P)은 제1 서브 픽셀(SP1)에 대응하는 제1 유기층(202a) 패턴, 제2 서브 픽셀(SP2)에 대응하는 제2 유기층(202b) 패턴 및 제3 서브 픽셀(SP3)에 대응하는 제3 유기층(202c) 패턴이 형성될 위치에 배치될 수 있다. 제3 포토레지스트 패턴(PR3_P)은 제3 포토레지스트층(PR3) 상에서 제3 포토레지스트 패턴(PR3_P)이 위치할 부분을 자외선(UV)등과 같은 광에 노출시키는 노광 공정을 진행하고, 현상액을 이용하여 노광된 부분을 제외한 나머지 부분들을 제거하여 형성될 수 있다.As shown in FIG. 29, after the third protective material layer SL3 and the third photoresist layer PR3 are formed, the third photoresist pattern PR3_P covers a portion of the surface of the third protective material layer SL3. ) can be formed. The third photoresist pattern PR3_P includes a first
도 30에 도시된 바와 같이, 제3 포토레지스트 패턴(PR3_P)이 형성된 후, 제3 포토레지스트 패턴(PR3_P)을 마스크 패턴으로 한 드라이 에칭 공정을 진행하여 제3 보호 물질 패턴(SL3_P) 및 제3 보호 물질 패턴(SL3_P)에 의해 보호되는 제1 유기층(202a), 제2 유기층(202b) 및 제3 유기층(202c)을 제외한 나머지 부분의 제3 보호 물질층(SL3)과 제3 유기층(202c)을 제거하여 제1 서브 픽셀(SP1)에 대응하는 제1 유기층(202a)과, 제2 서브 픽셀(SP2)에 대응하는 제2 유기층(202b)과, 제3 서브 픽셀(SP3)에 대응하는 제3 유기층(202c)을 패터닝할 수 있다. 이때, 제1 유기층(202a)과 제2 유기층(202b)은 뱅크층(105) 상에서 서로 이격되게 패터닝될 수 있고, 제2 유기층(202b)과 제3 유기층(202c)은 뱅크층(105) 상에서 서로 이격되게 패터닝될 수 있고, 제3 유기층(202c)의 제1 및 제2 돌출 패턴(202c_t1, 202c_t2)이 제거될 수 있다.As shown in FIG. 30, after the third photoresist pattern (PR3_P) is formed, a dry etching process is performed using the third photoresist pattern (PR3_P) as a mask pattern to form the third protective material pattern (SL3_P) and the third protective material pattern (SL3_P). The third protective material layer (SL3) and the third organic layer (202c) except for the first organic layer (202a), the second organic layer (202b), and the third organic layer (202c) protected by the protective material pattern (SL3_P) is removed to form the first
도 31에 도시된 바와 같이, 제1 유기층(202a), 제2 유기층(202b) 및 제3 유기층(202c)이 패터닝된 후, 제1 유기층(202a), 제2 유기층(202b) 및 제3 유기층(202c) 상에 위치한 제3 보호 물질 패턴(SL3_P)을 제거할 수 있다. 제3 보호 물질 패턴(SL3_P)은 DI(de-ionized) 용액을 이용하여 제거될 수 있다. DI 용액은 제3 보호 물질 패턴(SL3_P)의 내부로 침투하여 제1 유기층(202a), 제2 유기층(202b) 및 제3 유기층(202c)으로부터 박리시켜 제거할 수 있다. As shown in FIG. 31, after the first
도 32에 도시된 바와 같이, 제1 유기층(202a) 패턴, 제2 유기층(202b) 패턴 및 제3 유기층(202c) 패턴과 뱅크층(105) 상에는 제2 전극(203)이 공통적으로 형성될 수 있다. 이로써, 복수의 서브 픽셀(SP1, SP2, SP3) 각각에 대응하는 위치에 제1 전극(201), 제1 전극(201) 상의 나노 패턴(300), 유기층(202a, 202b, 202c) 및 제2 전극(203)이 순차적으로 적층되어 발광 소자(200)를 구성하게 된다. 이후의 공정으로 제2 전극(203) 상에는 봉지층 등이 더 형성되어 표시 장치의 제조가 완료될 수 있다.As shown in FIG. 32, the
본 명세서의 실시예에 따른 표시 장치 및 표시 장치의 제조 방법은 아래와 같이 설명될 수 있다.A display device and a method of manufacturing the display device according to an embodiment of the present specification can be described as follows.
본 명세서의 실시예에 따른 표시 장치는, 복수의 서브 픽셀들을 포함하는 기판, 복수의 서브 픽셀들 각각에 위치한 제1 전극, 제1 전극 상에 배치된 나노 패턴들, 제1 전극 및 나노 패턴들 상에 배치된 유기층, 및 유기층 상에 배치된 제2 전극을 포함할 수 있다.A display device according to an embodiment of the present specification includes a substrate including a plurality of subpixels, a first electrode located on each of the plurality of subpixels, nanopatterns disposed on the first electrode, a first electrode, and nanopatterns. It may include an organic layer disposed on the organic layer, and a second electrode disposed on the organic layer.
본 명세서의 실시예에 따른 표시 장치에 따르면, 나노 패턴은 유기층에 의해 덮힐 수 있다.According to the display device according to an embodiment of the present specification, the nanopattern may be covered by an organic layer.
본 명세서의 실시예에 따른 표시 장치에 따르면, 나노 패턴과 유기층은 서로 상이한 굴절율을 가질 수 있다.According to the display device according to an embodiment of the present specification, the nanopattern and the organic layer may have different refractive indices.
본 명세서의 실시예에 따른 표시 장치에 따르면, 나노 패턴의 굴절율은 유기층의 굴절율보다 높을 수 있다.According to the display device according to an embodiment of the present specification, the refractive index of the nanopattern may be higher than the refractive index of the organic layer.
본 명세서의 실시예에 따른 표시 장치에 따르면, 나노 패턴은 3차원 구조의 랜덤한 원형 또는 원기둥형일 수 있다.According to the display device according to an embodiment of the present specification, the nanopattern may have a random circular or cylindrical shape with a three-dimensional structure.
본 명세서의 실시예에 따른 표시 장치에 따르면, 나노 패턴은 나방눈(moth-eye) 형상을 포함할 수 있다.According to the display device according to an embodiment of the present specification, the nanopattern may include a moth-eye shape.
본 명세서의 실시예에 따른 표시 장치에 따르면, 나노 패턴은 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하일 수 있다.According to the display device according to an embodiment of the present specification, the length of at least one dimension of the nanopattern in the three-dimensional structure may be 10 nm or less.
본 명세서의 실시예에 따른 표시 장치에 따르면, 나노 패턴은 제1 전극과 접하는 면의 장방향 길이가 제1 전극과 접하는 면을 제외한 다른 차원에서의 장방향 길이보다 작을 수 있다.According to the display device according to an embodiment of the present specification, the longitudinal length of the surface in contact with the first electrode of the nanopattern may be smaller than the longitudinal length in other dimensions excluding the surface in contact with the first electrode.
본 명세서의 실시예에 따른 표시 장치에 따르면, 복수의 서브 픽셀들 각각에 대응하는 제1 전극의 개구부를 정의하는 뱅크층을 더 포함하고, 나노 패턴은 개구부에 의해 노출된 제1 전극 상에 랜덤하게 배치될 수 있다.According to the display device according to an embodiment of the present specification, the display device further includes a bank layer defining an opening of a first electrode corresponding to each of a plurality of subpixels, and the nanopattern is randomly formed on the first electrode exposed by the opening. It can be placed like this.
본 명세서의 실시예에 따른 표시 장치에 따르면, 복수의 서브 픽셀들 각각에 대응하는 제1 전극의 개구부를 정의하는 뱅크층을 더 포함하고, 나노 패턴은 개구부에 의해 노출된 제1 전극, 뱅크층의 상부면의 적어도 일부, 및 뱅크층의 측면 상에 랜덤하게 배치될 수 있다.According to the display device according to an embodiment of the present specification, the display device further includes a bank layer defining an opening of a first electrode corresponding to each of a plurality of subpixels, and the nano pattern includes the first electrode and the bank layer exposed by the opening. may be randomly disposed on at least a portion of the upper surface of and on the sides of the bank layer.
본 명세서의 실시예에 따른 표시 장치에 따르면, 나노 패턴은 제1 전극, 뱅크층의 상부면, 및 뱅크층의 측면 중 적어도 하나와 접하는 면의 장방향 길이가 적어도 하나의 접하는 면을 제외한 다른 차원에서의 장방향 길이보다 작을 수 있다.According to a display device according to an embodiment of the present specification, the nanopattern has a long direction length of a surface in contact with at least one of the first electrode, the upper surface of the bank layer, and the side surface of the bank layer in other dimensions except for at least one contact surface. It may be smaller than the longitudinal length in .
본 명세서의 실시예에 따른 표시 장치에 따르면, 제1 전극은 반사 전극이고, 제2 전극은 투명 또는 반투명 전극일 수 있다.According to the display device according to an embodiment of the present specification, the first electrode may be a reflective electrode, and the second electrode may be a transparent or translucent electrode.
본 명세서의 실시예에 따른 표시 장치의 제조 방법은, 기판 상에 제1 전극을 형성하는 단계, 제1 전극 상에 보호 물질 패턴을 형성하는 단계, 보호 물질 패턴을 이용하여 나노 패턴들을 형성하는 단계, 제1 전극 및 나노 패턴들을 덮는 유기층을 형성하는 단계, 및 유기층을 덮는 제2 전극을 형성하는 단계를 포함할 수 있다.A method of manufacturing a display device according to an embodiment of the present specification includes forming a first electrode on a substrate, forming a protective material pattern on the first electrode, and forming nanopatterns using the protective material pattern. , forming an organic layer covering the first electrode and the nanopatterns, and forming a second electrode covering the organic layer.
본 명세서의 실시예에 따른 표시 장치의 제조 방법에 따르면, 보호 물질 패턴은 수계 고분자 물질 또는 불소계 고분자 물질을 포함할 수 있다.According to the method of manufacturing a display device according to an embodiment of the present specification, the protective material pattern may include a water-based polymer material or a fluorine-based polymer material.
본 명세서의 실시예에 따른 표시 장치의 제조 방법에 따르면, 나노 패턴들을 형성하는 단계는, 보호 물질 패턴을 드라이 에칭하여 제1 전극 상에 랜덤하게 배치된 나노 패턴들을 형성할 수 있다.According to the method of manufacturing a display device according to an embodiment of the present specification, the step of forming nanopatterns may include dry etching the protective material pattern to form nanopatterns randomly arranged on the first electrode.
본 명세서의 실시예에 따른 표시 장치의 제조 방법에 따르면, 드라이 에칭은 플라즈마 처리를 포함할 수 있다.According to the method of manufacturing a display device according to an embodiment of the present specification, dry etching may include plasma processing.
본 명세서의 실시예에 따른 표시 장치의 제조 방법에 따르면, 나노 패턴들은 플라즈마 처리에 의해 보호 물질 패턴이 변성되어 3차원 구조의 랜덤한 원형 또는 원기둥형을 가지며, 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하일 수 있다.According to the method of manufacturing a display device according to an embodiment of the present specification, the nanopatterns have a random circular or cylindrical shape in a three-dimensional structure by denaturing the protective material pattern by plasma treatment, and have a length of at least one dimension in the three-dimensional structure. may be 10 nm or less.
본 명세서의 실시예에 따른 표시 장치의 제조 방법에 따르면, 제1 전극의 개구부를 정의하는 뱅크층을 형성하는 단계를 더 포함하고, 보호 물질 패턴을 형성하는 단계는, 제1 전극 및 뱅크층 상에 비평탄 구조의 보호 물질층을 형성하고, 보호 물질층을 드라이 에칭하여 개구부에 의해 노출된 제1 전극 상에 보호 물질 패턴을 형성할 수 있다.According to the method of manufacturing a display device according to an embodiment of the present specification, the method further includes forming a bank layer defining an opening of the first electrode, and forming a protective material pattern includes forming a protective material pattern on the first electrode and the bank layer. A protective material layer of a non-flat structure may be formed, and the protective material layer may be dry etched to form a protective material pattern on the first electrode exposed by the opening.
본 명세서의 실시예에 따른 표시 장치의 제조 방법에 따르면, 제1 전극의 개구부를 정의하는 뱅크층을 형성하는 단계를 더 포함하고, 보호 물질 패턴을 형성하는 단계는, 제1 전극 및 뱅크층 상에 비평탄 구조의 보호 물질층 및 보호 물질층의 표면 일부를 노출시키는 포토레지스트 패턴을 형성하고, 보호 물질층 및 포토레지스트 패턴을 드라이 에칭하여 개구부에 의해 노출된 제1 전극, 뱅크층의 상부면의 적어도 일부, 및 뱅크층의 측면 상에 보호 물질 패턴을 형성할 수 있다.According to the method of manufacturing a display device according to an embodiment of the present specification, the method further includes forming a bank layer defining an opening of the first electrode, and forming a protective material pattern includes forming a protective material pattern on the first electrode and the bank layer. A non-flat protective material layer and a photoresist pattern exposing a portion of the surface of the protective material layer are formed, and the protective material layer and the photoresist pattern are dry etched to expose the first electrode and the upper surface of the bank layer exposed by the opening. A protective material pattern may be formed on at least a portion of and on the side of the bank layer.
본 명세서의 실시예에 따른 표시 장치의 제조 방법에 따르면, 나노 패턴들을 형성하는 단계는, 보호 물질 패턴을 드라이 에칭하여 개구부에 의해 노출된 제1 전극, 뱅크층의 상부면의 적어도 일부, 및 뱅크층의 측면 상에 랜덤하게 배치된 나노 패턴들을 형성할 수 있다.According to the method of manufacturing a display device according to an embodiment of the present specification, the step of forming nanopatterns includes dry etching the protective material pattern to expose the first electrode, at least a portion of the upper surface of the bank layer, and the bank exposed by the opening. Randomly placed nanopatterns can be formed on the side of the layer.
이상에서 설명한 본 명세서는 전술한 실시 예 및 첨부된 도면에 한정되는 것이 아니고, 본 명세서의 기술적 사항을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 명세서가 속하는 기술 분야에서 통상의 지식을 가진 자에게 있어 명백할 것이다. 그러므로, 본 명세서의 범위는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 명세서의 범위에 포함되는 것으로 해석되어야 한다.The present specification described above is not limited to the above-described embodiments and the accompanying drawings, and it is common in the technical field to which this specification pertains that various substitutions, modifications, and changes are possible without departing from the technical details of the present specification. It will be clear to those who have the knowledge of. Therefore, the scope of the present specification is indicated by the claims described later, and all changes or modified forms derived from the meaning and scope of the claims and their equivalent concepts should be interpreted as being included in the scope of the present specification.
100: 표시 장치
110: 표시 패널
200: 발광소자
300: 나노 패턴100: display device 110: display panel
200: light emitting device 300: nano pattern
Claims (20)
상기 복수의 서브 픽셀들 각각에 위치한 제1 전극;
상기 제1 전극 상에 배치된 나노 패턴들;
상기 제1 전극 및 상기 나노 패턴들 상에 배치된 유기층; 및
상기 유기층 상에 배치된 제2 전극을 포함하는, 표시 장치.A substrate including a plurality of subpixels;
a first electrode located in each of the plurality of subpixels;
Nanopatterns disposed on the first electrode;
an organic layer disposed on the first electrode and the nanopatterns; and
A display device comprising a second electrode disposed on the organic layer.
상기 나노 패턴은 상기 유기층에 의해 덮히는, 표시 장치.According to paragraph 1,
The display device wherein the nanopattern is covered by the organic layer.
상기 나노 패턴과 상기 유기층은 서로 상이한 굴절율을 가진, 표시 장치.According to paragraph 1,
The display device wherein the nanopattern and the organic layer have different refractive indices.
상기 나노 패턴의 굴절율은 상기 유기층의 굴절율보다 높은, 표시 장치.According to paragraph 3,
A display device wherein the refractive index of the nanopattern is higher than the refractive index of the organic layer.
상기 나노 패턴은 3차원 구조의 랜덤한 원형 또는 원기둥형인, 표시 장치.According to paragraph 1,
The display device wherein the nanopattern is a random circular or cylindrical shape with a three-dimensional structure.
상기 나노 패턴은 나방눈(moth-eye) 형상을 포함하는, 표시 장치.According to clause 5,
A display device wherein the nanopattern includes a moth-eye shape.
상기 나노 패턴은 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하인, 표시 장치.According to paragraph 1,
The display device wherein the nanopattern has a length of at least one dimension of 10 nm or less in a three-dimensional structure.
상기 나노 패턴은 상기 제1 전극과 접하는 면의 장방향 길이가 상기 제1 전극과 접하는 면을 제외한 다른 차원에서의 장방향 길이보다 작은, 표시 장치.According to paragraph 1,
A display device wherein the longitudinal length of the surface of the nanopattern in contact with the first electrode is smaller than the longitudinal length in other dimensions except for the surface in contact with the first electrode.
상기 복수의 서브 픽셀들 각각에 대응하는 상기 제1 전극의 개구부를 정의하는 뱅크층을 더 포함하고,
상기 나노 패턴은 상기 개구부에 의해 노출된 상기 제1 전극 상에 랜덤하게 배치된, 표시 장치.According to paragraph 1,
Further comprising a bank layer defining an opening of the first electrode corresponding to each of the plurality of subpixels,
The nanopattern is randomly disposed on the first electrode exposed by the opening.
상기 복수의 서브 픽셀들 각각에 대응하는 상기 제1 전극의 개구부를 정의하는 뱅크층을 더 포함하고,
상기 나노 패턴은 상기 개구부에 의해 노출된 상기 제1 전극, 상기 뱅크층의 상부면의 적어도 일부, 및 상기 뱅크층의 측면 상에 랜덤하게 배치된, 표시 장치.According to paragraph 1,
Further comprising a bank layer defining an opening of the first electrode corresponding to each of the plurality of subpixels,
The nanopattern is randomly disposed on the first electrode exposed by the opening, at least a portion of an upper surface of the bank layer, and a side surface of the bank layer.
상기 나노 패턴은 상기 제1 전극, 상기 뱅크층의 상부면, 및 상기 뱅크층의 측면 중 적어도 하나와 접하는 면의 장방향 길이가 상기 적어도 하나의 접하는 면을 제외한 다른 차원에서의 장방향 길이보다 작은, 표시 장치.According to clause 10,
The nanopattern has a longitudinal length of a surface in contact with at least one of the first electrode, an upper surface of the bank layer, and a side surface of the bank layer, which is smaller than the longitudinal length in other dimensions except for the at least one contact surface. , display device.
상기 제1 전극은 반사 전극이고, 상기 제2 전극은 투명 또는 반투명 전극인, 표시 장치.According to paragraph 1,
The display device wherein the first electrode is a reflective electrode and the second electrode is a transparent or translucent electrode.
상기 제1 전극 상에 보호 물질 패턴을 형성하는 단계;
상기 보호 물질 패턴을 이용하여 나노 패턴들을 형성하는 단계;
상기 제1 전극 및 상기 나노 패턴들을 덮는 유기층을 형성하는 단계; 및
상기 유기층을 덮는 제2 전극을 형성하는 단계를 포함하는, 표시 장치의 제조 방법.forming a first electrode on a substrate;
forming a protective material pattern on the first electrode;
forming nanopatterns using the protective material pattern;
forming an organic layer covering the first electrode and the nanopatterns; and
A method of manufacturing a display device, comprising forming a second electrode covering the organic layer.
상기 보호 물질 패턴은 수계 고분자 물질 또는 불소계 고분자 물질을 포함하는, 표시 장치의 제조 방법.According to clause 13,
The method of manufacturing a display device, wherein the protective material pattern includes a water-based polymer material or a fluorine-based polymer material.
상기 나노 패턴들을 형성하는 단계는,
상기 보호 물질 패턴을 드라이 에칭하여 상기 제1 전극 상에 랜덤하게 배치된 상기 나노 패턴들을 형성하는, 표시 장치의 제조 방법.According to clause 13,
The step of forming the nanopatterns is,
A method of manufacturing a display device, wherein the protective material pattern is dry-etched to form the nanopatterns randomly disposed on the first electrode.
상기 드라이 에칭은 플라즈마 처리를 포함하는, 표시 장치의 제조 방법.According to clause 15,
A method of manufacturing a display device, wherein the dry etching includes plasma processing.
상기 나노 패턴들은 상기 플라즈마 처리에 의해 상기 보호 물질 패턴이 변성되어 3차원 구조의 랜덤한 원형 또는 원기둥형을 가지며, 상기 3차원 구조에서 적어도 하나의 차원 길이가 10㎚ 이하인, 표시 장치의 제조 방법.According to clause 16,
The nanopatterns have a random circular or cylindrical shape with a three-dimensional structure due to denaturation of the protective material pattern by the plasma treatment, and at least one dimension in the three-dimensional structure has a length of 10 nm or less.
상기 제1 전극의 개구부를 정의하는 뱅크층을 형성하는 단계를 더 포함하고,
상기 보호 물질 패턴을 형성하는 단계는,
상기 제1 전극 및 상기 뱅크층 상에 비평탄 구조의 보호 물질층을 형성하고,
상기 보호 물질층을 드라이 에칭하여 상기 개구부에 의해 노출된 상기 제1 전극 상에 상기 보호 물질 패턴을 형성하는, 표시 장치의 제조 방법.According to clause 13,
further comprising forming a bank layer defining an opening of the first electrode,
The step of forming the protective material pattern is,
Forming a protective material layer with a non-flat structure on the first electrode and the bank layer,
Dry etching the protective material layer to form the protective material pattern on the first electrode exposed by the opening.
상기 제1 전극의 개구부를 정의하는 뱅크층을 형성하는 단계를 더 포함하고,
상기 보호 물질 패턴을 형성하는 단계는,
상기 제1 전극 및 상기 뱅크층 상에 비평탄 구조의 보호 물질층 및 상기 보호 물질층의 표면 일부를 노출시키는 포토레지스트 패턴을 형성하고,
상기 보호 물질층 및 상기 포토레지스트 패턴을 드라이 에칭하여 상기 개구부에 의해 노출된 상기 제1 전극, 상기 뱅크층의 상부면의 적어도 일부, 및 상기 뱅크층의 측면 상에 상기 보호 물질 패턴을 형성하는, 표시 장치의 제조 방법.According to clause 13,
further comprising forming a bank layer defining an opening of the first electrode,
The step of forming the protective material pattern is,
Forming a non-flat protective material layer and a photoresist pattern exposing a portion of the surface of the protective material layer on the first electrode and the bank layer,
dry etching the protective material layer and the photoresist pattern to form the protective material pattern on the first electrode exposed by the opening, at least a portion of an upper surface of the bank layer, and a side surface of the bank layer, Method of manufacturing a display device.
상기 나노 패턴들을 형성하는 단계는,
상기 보호 물질 패턴을 드라이 에칭하여 상기 개구부에 의해 노출된 상기 제1 전극, 상기 뱅크층의 상부면의 적어도 일부, 및 상기 뱅크층의 측면 상에 랜덤하게 배치된 상기 나노 패턴들을 형성하는, 표시 장치의 제조 방법.According to clause 19,
The step of forming the nanopatterns is,
A display device that dry-etches the protective material pattern to form the first electrode exposed by the opening, at least a portion of an upper surface of the bank layer, and the nanopatterns randomly disposed on a side of the bank layer. Manufacturing method.
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