KR20220093541A - 무한 확장 표시장치와 그 구동방법 - Google Patents

무한 확장 표시장치와 그 구동방법 Download PDF

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Abstract

본 명세서의 실시예에 따른 무한 확장 표시장치는 제1 해상도의 영상 데이터를 출력하는 세트 보드; 및 캐스 캐이딩 방식의 인터페이스 회로를 통해 서로 연결되어 상기 영상 데이터를 표시하며, 주문형 직접 회로를 각각 내장한 복수의 표시 유닛들을 포함하고, 상기 표시 유닛들은 상기 인터페이스 회로의 연결에 따른 유닛 배열 좌표 정보를 생성하는 슬레이브 표시 유닛들과, 상기 유닛 배열 좌표 정보를 기반으로 상기 제1 해상도의 영상 데이터를 스케일링한 후에 상기 슬레이브 표시 유닛들로 전송하는 마스터 표시 유닛을 구비한다.

Description

무한 확장 표시장치와 그 구동방법{Infinitely Expandable Display Device And Driving Method Of The Same}
이 명세서는 확장성이 가능한 무한 확장 표시장치에 관한 것이다.
최근 옥내외 디지털 광고와 같은 다양한 분야에서 대형 디스플레이가 활용되고 있다. 대형 디스플레이에 대한 수요를 충족시키기 위하여 확장성이 가능한 표시장치가 제안되고 있다. 무한 확장 표시장치는 다수의 표시 유닛들을 연결하여 단일 화면을 구성하는 것으로서, 필요에 따라 화면 크기를 증가시킬 수 있는 장점이 있다.
무한 확장 표시장치의 화면 크기는 표시 유닛들의 연결 개수에 의해 결정되며, 표시 유닛들에서 재현되는 영상 데이터는 세트 보드로부터 공급된다. 표시 유닛들의 연결 개수가 바뀌는 경우 세트 보드와 표시 유닛들 간의 해상도 매칭 과정이 반드시 필요하다. 만약, 표시 유닛들의 연결 개수에 맞게 세트 보드의 출력 해상도가 변경되지 않으면, 화면 잘림 현상 등이 생기고 정상적인 영상 재현이 불가능하다.
따라서, 본 명세서에 개시된 실시예는 전술한 문제점을 해결하기 위한 것으로서, 세트 보드의 출력 해상도에 대한 변경 없이도 표시 유닛들에서 정상적인 영상이 재현될 수 있도록 한 무한 확장 표시장치와 그 구동방법을 제공한다.
본 명세서의 실시예에 따른 무한 확장 표시장치는 제1 해상도의 영상 데이터를 출력하는 세트 보드; 및 캐스 캐이딩 방식의 인터페이스 회로를 통해 서로 연결되어 상기 영상 데이터를 표시하며, 주문형 직접 회로를 각각 내장한 복수의 표시 유닛들을 포함하고, 상기 표시 유닛들은 상기 인터페이스 회로의 연결에 따른 유닛 배열 좌표 정보를 생성하는 슬레이브 표시 유닛들과, 상기 유닛 배열 좌표 정보를 기반으로 상기 제1 해상도의 영상 데이터를 스케일링한 후에 상기 슬레이브 표시 유닛들로 전송하는 마스터 표시 유닛을 구비한다.
본 명세서의 실시예에 따라 주문형 직접 회로를 각각 내장하며 캐스 캐이딩 방식의 인터페이스 회로를 통해 서로 연결된 복수의 표시 유닛들을 갖는 무한 확장 표시장치의 구동 방법은, 세트 보드에서 제1 해상도의 영상 데이터를 상기 표시 유닛들로 출력하는 단계; 상기 표시 유닛들 중의 슬레이브 표시 유닛들에서 상기 인터페이스 회로의 연결에 따른 유닛 배열 좌표 정보를 생성하는 단계; 및 상기 표시 유닛들 중의 마스터 표시 유닛에서 상기 유닛 배열 좌표 정보를 기반으로 상기 제1 해상도의 영상 데이터를 스케일링한 후에 상기 슬레이브 표시 유닛들로 전송하는 단계를 포함한다.
본 실시예는 다음과 같은 효과가 있다.
본 명세서의 실시예에 따른 무한 확장 표시장치는 세트 보드와 표시 유닛들 간에 해상도 미스 매칭이 생기는 경우 세트 보드가 아닌 표시 유닛들 중 어느 하나에서 입력 영상을 스케일링한다. 이에 따라, 본 실시예는 세트 보드의 출력 해상도에 대한 변경 없이도 표시 유닛들에서 정상적인 영상이 재현되도록 할 수 있음은 물론이거니와, 세트 보드와 표시 유닛들을 연결하는 인터페이스 회로의 밴드 폭을 최소화할 수 있다.
본 명세서에 따른 효과는 이상에서 예시된 내용에 의해 제한되지 않으며, 더욱 다양한 효과들이 본 명세서 내에 포함되어 있다.
도 1은 본 명세서의 실시예에 따른 무한 확장 표시장치를 개략적으로 보여주는 도면이다.
도 2는 도 1에 도시된 무한 확장 표시장치의 구동 단위에 따른 일 예시 해상도를 보여주는 도면이다.
도 3은 무한 확장 표시장치에서 일 표시 유닛의 구성을 보여주는 도면이다.
도 4는 무한 확장 표시장치에서 일 표시 유닛의 패널 구동 회로 구성을 보여주는 도면이다.
도 5 및 도 6은 무한 확장 표시장치에서 일 표시 유닛의 백 커버 구성에 대한 예시 도면들이다.
도 7은 본 명세서의 비교예로서 세트 보드와 표시 유닛들 간의 해상도 미스 매칭으로 인해 생기는 화면 잘림 현상을 보여주는 도면이다.
도 8은 본 명세서의 실시예로서 세트 보드와 표시 유닛들 간에 해상도 미스 매칭이 생기더라도 정상적인 화면이 재현되는 것을 보여주는 도면이다.
도 9 및 도 10은 해상도 미스 매칭을 보상할 수 있는 표시 유닛들의 연결 구성을 보여주는 도면들이다.
도 11은 해상도 미스 매칭을 보상할 수 있는 표시 유닛들의 동작 순서를 보여주는 도면이다.
도 12 내지 도 14는 2유닛(가로) * 2유닛(세로) 크기의 표시 유닛들에 대한 유닛 배열 좌표 정보가 생성되는 원리를 보여주는 도면들이다.
도 15는 3유닛(가로) * 2유닛(세로) 크기의 표시 유닛들에 대한 유닛 배열 좌표 정보가 생성되는 원리를 보여주는 도면이다.
도 16은 본 명세서의 실시예가 적용되기 전의 화면 표시 상태를 보여준다.
도 17은 본 명세서의 실시예가 적용된 후의 화면 표시 상태를 보여준다.
본 명세서의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나, 본 명세서는 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 명세서의 개시가 완전하도록 하며, 본 명세서가 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 명세서는 청구항의 범주에 의해 정의될 뿐이다.
본 명세서의 실시예를 설명하기 위한 도면에 개시된 형상, 크기, 비율, 각도, 개수 등은 예시적인 것이므로 본 명세서가 도시된 사항에 한정되는 것은 아니다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다. 본 명세서 상에서 언급된 '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 ' ~ 만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 구성 요소를 단수로 표현한 경우에 특별히 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함한다.
구성 요소를 해석함에 있어서, 별도의 명시적 기재가 없더라도 오차 범위를 포함하는 것으로 해석한다.
위치 관계에 대한 설명일 경우, 예를 들어, ' ~ 상에', ' ~ 상부에', ' ~ 하부에', ' ~ 옆에' 등으로 두 부분의 위치 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다.
제1, 제2 등이 다양한 구성요소들을 서술하기 위해서 사용될 수 있으나, 이 구성요소들은 이들 용어에 의해 제한되지 않는다. 이들 용어들은 단지 하나의 구성요소를 다른 구성요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제1 구성요소는 본 명세서의 기술적 사상 내에서 제2 구성요소일 수도 있다.
이하, 첨부된 도면을 참조하여 본 명세서의 실시예를 상세히 설명한다. 이하의 설명에서, 본 명세서와 관련된 공지 기능 혹은 구성에 대한 구체적인 설명이 본 명세서의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우, 그 상세한 설명을 생략한다.
도 1은 본 명세서의 실시예에 따른 무한 확장 표시장치를 개략적으로 보여주는 도면이다. 도 2는 도 1에 도시된 무한 확장 표시장치의 구동 단위에 따른 일 예시 해상도를 보여주는 도면이다. 도 3은 무한 확장 표시장치에서 일 표시 유닛의 구성을 보여주는 도면이다. 도 4는 무한 확장 표시장치에서 일 표시 유닛의 패널 구동 회로 구성을 보여주는 도면이다. 그리고, 도 5 및 도 6은 무한 확장 표시장치에서 일 표시 유닛의 백 커버 구성에 대한 예시 도면들이다.
도 1에 따른 본 명세서의 실시예에 따른 무한 확장 표시장치는 세트 보드와 캐비넷을 포함한다.
캐비넷은 인터페이스 회로를 통해 서로 연결된 복수의 표시 유닛들을 구비하여 대형 화면을 구성한다. 대형 화면의 전체 해상도는 표시 유닛들의 단위 해상도의 총합으로 결정된다. 예컨대, 도 2와 같이, 480*270의 단위 해상도를 갖는 16개의 표시 유닛들로 캐비넷이 구성된 경우, 캐비넷의 전체 해상도는 1920*1080이 된다.
표시 유닛들은 전계 발광 표시형, 액정 표시형 등으로 구현될 수 있으며, 본 명세서의 기술적 사상은 표시 유닛의 구현 방식에 의해 제한되지 않는다. 다만, 설명의 편의상 본 실시예에서는 표시 유닛이 전계 발광 표시형으로 구현된 예를 중심으로 설명한다.
제로 베젤(zero bezel)이 가능하도록, 캐비넷에서 표시 유닛들 간의 간격(즉, 심 사이즈)은 픽셀들 간의 간격(즉, 픽셀 피치)보다 작게 설계된다. 제로 베젤에 의해 화면의 시인성과 가독성이 좋아진다.
표시 유닛들은 캐스 캐이딩 방식의 인터페이스 회로를 통해 서로 연결되어 세트 보드에서 생성된 영상 데이터를 순차적으로 전달한다. 표시 유닛들을 연결하는 인터페이스 회로는 통신 인터페이스의 복잡성과 제조 비용이 줄어들도록, 무선 방식으로 구현될 수 있다. 여기서, 인터페이스 회로는 단방향 인터페이스 회로일 수도 있고, 양방향 인터페이스 회로일 수도 있다.
각 표시 유닛은 픽셀들이 형성된 표시패널과, 표시패널을 구동하기 위한 패널 구동회로를 포함한 전계 발광 표시장치가 된다. 패널 구동회로는 주문형 집적회로(Application Specific Integrated Circuit, 이하 ASIC)와, 데이터 드라이버와, 게이트 드라이버 등을 포함한다. ASIC은 각 표시 유닛에 개별적으로 내장된다.
표시 유닛들은 한 개의 마스터 표시 유닛과, 복수 개의 슬레이브 표시 유닛들로 이루어진다. 마스터 표시 유닛의 ASIC은 영상 스케일러를 내장함으로써, 표시 유닛들의 물리적인 해상도 도출 및 영상 스케일링 동작을 수행한다. 이를 통해, 세트 보드와 표시 유닛들 간에 해상도 미스 매칭이 생기는 경우 세트 보드의 출력 해상도에 대한 변경 없이도 표시 유닛들에서 정상적인 영상이 재현될 수 있다.
슬레이브 표시 유닛들의 각 ASIC은 상기 물리적인 해상도를 도출하는 데 기반이 되는 유닛 배열 좌표 정보를 생성한다. 유닛 배열 좌표 정보는 첫 번째 슬레이브 표시 유닛에서 마지막 번째 슬레이브 표시 유닛까지 캐스캐이딩 방식으로 전달되면서 업데이트된다. 마지막 번째 슬레이브 표시 유닛에서 최종 업데이트된 유닛 배열 좌표 정보가 피드백 루프를 통해 마스터 표시 유닛으로 피드백된다.
표시패널의 기판 앞면에는 도 3과 같은 픽셀 어레이가 형성된다. 픽셀 어레이에는 다수의 서브픽셀들이 배치됨과 아울러, 다수의 서브 픽셀들로 구동 전압을 공급해주기 위한 신호 배선들이 배치될 수 있다. 이러한 신호 배선들은 데이터 전압(Vdata)을 전달하기 위한 데이터 라인들(DL)과, 게이트 신호(SCAN,SEN)를 전달하기 위한 게이트 라인들(GL1,GL2)과, 기준전압(VREF)을 공급함과 아울러 픽셀 구동 특성(Vsen)을 센싱하기 위한 리드 아웃 라인들(RL)을 포함할 수 있다. 또한, 픽셀 어레이에 배치되는 신호 배선들은 고전위 픽셀전압(EVDD)을 전달하기 위한 구동전압 라인을 더 포함할 수 있다. 픽셀 어레이 상에서 데이터 라인들(DL)과 리드 아웃 라인들(RL)은 제1 방향으로 연장되도록 배치될 수 있으며, 게이트 라인들(GL1,GL2)은 제1 방향과 교차되는 제2 방향으로 연장되도록 배치될 수 있다. 이러한 신호 배선들은 각 서브 픽셀의 픽셀 회로에 연결됨과 아울러, 패널 구동회로에 연결될 수 있다. 한편, 픽셀 어레이로는 저전위 픽셀전압(EVSS)이 공급될 수 있다. 여기서 저전위 픽셀전압(EVSS)은 모든 서브 픽셀들에 인가되는 일종의 공통 전압일 수 있다. 저전위 픽셀전압(EVSS)은 영상 기입을 위한 디스플레이 모드에 비해 구동 특성 검출을 위한 센싱 모드에서 더 높게 인가될 수 있다.
복수의 서브 픽셀들이 하나의 픽셀을 구성할 수 있다. 예컨대, 제1 방향으로 이웃한 R(적색),W(백색),G(녹색),B(청색) 서브 픽셀들이 하나의 픽셀을 구성할 수 있다. 다만, R,G,B서브 픽셀들이 하나의 픽셀을 구성할 수도 있으며, 이 경우 W 서브 픽셀은 픽셀 어레이에서 생략될 수 있다. R,W,G,B서브 픽셀들은 발광 소자를 구성하는 발광 물질만 다를 뿐이고, 나머지 픽셀 회로의 구성면에서 실질적으로 서로 동일하다.
일 서브 픽셀은 도 3과 같이 발광 소자(OLED), 구동 TFT(DT), 스위치 TFT들(ST1,ST2), 및 스토리지 커패시터(Cst)를 포함한다. 구동 TFT(DT)와 스위치 TFT들(ST1,ST2)은 NMOS로 구현될 수 있으나 이에 한정되지 않는다.
발광 소자(OLED)는 구동 TFT(DT)로부터 입력되는 픽셀 전류에 대응되는 세기로 발광하는 발광 소자이다. 발광 소자(OLED)는 유기 발광층을 포함한 유기발광다이오드로 구현되거나 또는, 무기 발광층을 포함한 무기발광다이오드로 구현될 수도 있다. 발광 소자(OLED)의 애노드 전극은 제2 노드(N2)에 접속되고, 캐소드 전극은 저전위 픽셀 전압(EVSS)의 입력단에 접속된다.
구동 TFT(DT)는 게이트-소스 간 전압에 대응하여 픽셀 전류를 생성하는 구동 소자이다. 구동 TFT(DT)의 게이트전극은 제1 노드(N1)에 접속되고, 제1 전극(드레인전극)은 고전위 픽셀 전압(EVDD)의 입력단에 접속되며, 제2 전극(소스전극)은 제2 노드(N2)에 접속된다.
스위치 TFT들(ST1,ST2)은 구동 TFT(DT)의 게이트-소스 간 전압을 설정하고, 구동 TFT(DT)의 제2 전극과 리드 아웃 라인(RL)을 연결하는 스위치 소자들이다.
제1 스위치 TFT(ST1)는 데이터라인(DL)과 제1 노드(N1) 사이에 접속되어 제1 게이트라인(GL1)으로부터의 제1 게이트신호(SCAN)에 따라 턴 온 된다. 제1 스위치 TFT(ST1)는 디스플레이 모드 및 센싱 모드 각각에서 셋업 시에 턴 온 된다. 제1 스위치 TFT(ST1)가 턴 온 될 때, 디스플레이용 또는 센싱용 데이터전압(Vdata)이 제1 노드(N1)에 인가된다. 제1 스위치 TFT(ST1)의 게이트전극은 제1 게이트라인(GL1)에 접속되고, 제1 전극은 데이터 라인(DL)에 접속되며, 제2 전극은 제1 노드(N1)에 접속된다.
제2 스위치 TFT(ST2)는 리드 아웃 라인(RL)과 제2 노드(N2) 사이에 접속되어 제2 게이트라인(GL2)으로부터의 제2 게이트신호(SEN)에 따라 턴 온 된다. 제2 스위치 TFT(ST2)는 디스플레이 모드 및 센싱 모드 각각에서 셋업 시에 턴 온 되어, 기준전압(VREF)을 제2 노드(N2)에 인가한다. 또한, 제2 스위치 TFT(ST2)는 센싱 모드에서 상기 셋업 이후의 센싱 동작 중에도 턴 온 되어 구동 TFT(DT)의 소스노드 전압(또는 소스 전압)을 리드 아웃 라인(RL)에 전달한다. 그러면, 리드 아웃 라인(RL)의 기생 커패시터(Cp)에는 상기 소스 전압에 대응되는 센싱 전압(Vsen)이 저장된다. 제2 스위치 TFT(ST2)의 게이트전극은 제2 게이트라인(GL2)에 접속되고, 제1 전극은 리드 아웃 라인(RL)에 접속되며, 제2 전극은 제2 노드(N2)에 접속된다.
스토리지 커패시터(Cst)는 제1 노드(N1)와 제2 노드(N2) 사이에 접속되어 구동 TFT(DT)의 게이트-소스 간 전압을 일정 기간 동안 유지한다. 디스플레이 모드에서 구동 TFT(DT)의 게이트-소스 간 전압은 디스플레이용 데이터전압(Vdata)과 기준전압(VREF) 간의 차전압으로 셋 업 되고, 센싱 모드에서 구동 TFT(DT)의 게이트-소스 간 전압은 센싱용 데이터전압(Vdata)과 기준전압(VREF) 간의 차전압으로 셋 업 된다.
디스플레이 모드에서 구동 TFT(DT)의 게이트-소스 간 전압에 상당하는 픽셀 전류가 구동 TFT(DT)에 흐르며, 이러한 픽셀 전류에 의해 발광 소자(OLED)가 발광한다. 센싱 모드에서 구동 TFT(DT)의 게이트-소스 간 전압에 상당하는 픽셀 전류가 구동 TFT(DT)에 흐르며, 이러한 픽셀 전류에 의해 구동 TFT(DT)의 소스 노드 전압이 변한다. 구동 TFT(DT)의 구동 특성에 따라 상기 소스 노드 전압이 달라지므로, 소스 노드 전압에 대응되는 센싱 전압(Vsen)을 통해 구동 TFT(DT)의 구동 특성 변화가 검출될 수 있다. 한편, 센싱 모드에서 저전위 픽셀전압(EVSS)은 발광 소자(OLED)의 동작점 전압보다 높게 인가되기 때문에, 구동 TFT(DT)의 픽셀 전류는 발광 소자(OLED)로는 흐르지 않고, 리드 아웃 라인(RL)으로만 흐른다. 따라서, 소스 노드 전압이 빠른 시간 내에 센싱 전압(Vsen)으로 반영되기 때문에, 센싱의 신뢰성이 높아질 수 있다.
이러한 서브 픽셀의 구성 및 동작은 일 예시일 뿐이므로, 본 명세서의 기술적 사상은 이에 한정되지 않는다. 예를 들어, 제1 및 제2 게이트신호들(SCAN,SEN)과 제1 및 제2 게이트 라인들(GL1,GL2)은 각각 하나로 단일화 될 수 있다. 또한 서브 픽셀의 구성은 더블 레이트 드라이빙(Double Rate Driving) 방식에 맞게 설계될 수도 있다.
각 표시 유닛에서, ASIC은 도 4와 같이 콘트롤 인쇄회로기판(C-PCB)에 실장되어 표시패널의 기판 뒷면에 위치할 수 있다. 콘트롤 인쇄회로기판(C-PCB)은 접속 케이블(CBL)을 통해 소스 인쇄회로기판(S-PCB)에 연결된다. 소스 인쇄회로기판(S-PCB)에는 데이트 드라이버(DIC)가 실장된 도전성 필름(COF)이 접합된다. 따라서, ASIC과 데이트 드라이버(DIC)는 전기적으로 서로 연결되며, 이들 사이에 신호 공급 경로가 형성된다. 콘트롤 인쇄회로기판(C-PCB)에는 ASIC을 인터페이스 회로에 연결하기 위한 제1 연결 단자(LCNT)와 제2 연결 단자(RCNT)가 구비된다. 제1 연결 단자(LCNT)와 제2 연결 단자(RCNT)는 도 5 및 도 6의 백 커버에 마련된 백 커버 단자들(BC-LCNT, BC-RCNT)에 체결됨으로써, ASIC을 인터페이스 회로(즉, 신호 송신/수신 단자들(TX,RX))에 연결시킨다. 콘트롤 인쇄회로기판(C-PCB)에는 인터페이스 회로의 연결시에 특정의 논리 조합 정보를 나타내는 복수의 연결 확인 핀들(CCP)이 접속된다. 연결 확인 핀들(CCP)은 ASIC과 제1 및 제2 연결 단자들(LCNT,RCNT) 사이에 접속될 수 있다. 슬레이브 표시 유닛들의 각 ASIC은 연결 확인 핀들(CCP)의 논리 조합 정보를 기반으로 좌표 가산치를 도출하고, 이전 유닛의 좌표 정보에 상기 도출된 좌표 가산치를 더함으로써, 현재 유닛의 좌표 정보를 생성할 수 있다.
도 5의 백 커버에는 무선 방식의 단방향 인터페이스 회로가 구현될 수 있도록 신호 수신 단자(RX)와 신호 송신 단자(TX)가 1개씩 설치되어 있다. 신호 수신 단자(RX)는 이웃한 표시 유닛에 구비된 신호 송신 단자(TX)와 무선으로 연결된다. 그리고, 신호 송신 단자(TX)는 이웃한 또 다른 표시 유닛에 구비된 신호 수신 단자(RX)와 무선으로 연결된다. 백 커버 단자들(BC-LCNT, BC-RCNT)은 파워 소켓에 전기적으로 연결됨과 아울러, 내부 케이블을 통해 신호 수신 단자(RX)와 신호 송신 단자(TX) 중 어느 하나에 더 연결되어 있다. 파워 소켓에는 외부로부터 입력 전원이 공급된다. 파워 소켓에 공급된 입력 전원은 백 커버 단자들(BC-LCNT, BC-RCNT)과 내부 케이블을 통해 신호 수신 단자(RX)와 신호 송신 단자(TX)에 공급된다. 그리고, 파워 소켓에 공급된 입력 전원은 백 커버 단자들(BC-LCNT, BC-RCNT)과 제1 및 제2 연결 단자들(LCNT,RCNT)을 통해 ASIC에 공급됨과 아울러, 전원 회로에 더 공급될 수 있다. 전원 회로는 콘트롤 인쇄회로기판(C-PCB)에 실장되고, 입력 전원을 가공하여 데이터 드라이버(DIC)의 동작 전압, 게이트 드라이버의 동작 전압, 및 픽셀의 동작 전압(EVDD,VREF) 등을 생성한다. 전원 회로에서 생성된 각종 동작 전압은 접속 케이블(CBL)과 소스 인쇄회로기판(S-PCB)를 통해 데이터 드라이버(DIC)에 공급된다.
도 6의 백 커버에는 무선 방식의 양방향 인터페이스 회로가 구현될 수 있도록 신호 수신 단자(RX,RX1)와 신호 송신 단자(TX,TX1)가 2개씩 설치되어 있다. 신호 수신 단자(RX)는 이웃한 표시 유닛에 구비된 신호 송신 단자(TX)와 무선으로 연결되고, 신호 송신 단자(TX)는 이웃한 또 다른 표시 유닛에 구비된 신호 수신 단자(RX)와 무선으로 연결된다. 그리고, 다른 신호 수신 단자(RX1)는 이웃한 표시 유닛에 구비된 다른 신호 송신 단자(TX1)와 무선으로 연결되고, 다른 신호 송신 단자(TX1)는 이웃한 또 다른 표시 유닛에 구비된 다른 신호 수신 단자(RX1)와 무선으로 연결된다. 백 커버 단자들(BC-LCNT, BC-RCNT)은 파워 소켓에 전기적으로 연결됨과 아울러, 내부 케이블을 통해 신호 수신 단자(RX)와 신호 송신 단자(TX) 중 어느 하나에 더 연결되어 있다. 파워 소켓에 공급된 입력 전원은 백 커버 단자들(BC-LCNT, BC-RCNT)과 내부 케이블을 통해 신호 수신 단자(RX,RX1)와 신호 송신 단자(TX,TX1)에 공급된다. 그리고, 파워 소켓에 공급된 입력 전원은 백 커버 단자들(BC-LCNT, BC-RCNT)과 제1 및 제2 연결 단자들(LCNT,RCNT)을 통해 ASIC에 공급됨과 아울러, 전원 회로에 더 공급될 수 있다. 전원 회로는 콘트롤 인쇄회로기판(C-PCB)에 실장되고, 입력 전원을 가공하여 데이터 드라이버(DIC)의 동작 전압, 게이트 드라이버의 동작 전압, 및 픽셀의 동작 전압(EVDD,VREF) 등을 생성한다. 전원 회로에서 생성된 각종 동작 전압은 접속 케이블(CBL)과 소스 인쇄회로기판(S-PCB)를 통해 데이터 드라이버(DIC)에 공급된다.
양방향 인터페이스 회로는 제1 전송 방향을 따라 활성화된 후에 제1 전송 방향과 반대되는 제2 전송 방향을 따라 활성화된다. 양방향 인터페이스 회로가 제1 전송 방향으로 활성화되는 동안, 도 6의 백 커버에서 백 커버 단자들(BC-LCNT, BC-RCNT)은 내부 케이블을 통해 신호 수신 단자(RX)와 신호 송신 단자(TX)에 연결된다. 반면에, 양방향 인터페이스 회로가 제2 전송 방향으로 활성화되는 동안, 도 6의 백 커버에서 백 커버 단자들(BC-LCNT, BC-RCNT)은 내부 케이블을 통해 다른 신호 수신 단자(RX1)와 다른 신호 송신 단자(TX1)에 연결된다.
세트 보드에서 출력된 영상 데이터가 이웃한 표시 유닛으로부터 신호 수신 단자(RX)로 전달된다. 신호 수신 단자(RX)로 전달된 영상 데이터는 내부 케이블과 백 커버 단자들(BC-LCNT, BC-RCNT)과 제1 및 제2 연결 단자들(LCNT,RCNT)을 통해 ASIC으로 공급된다. ASIC은 표시패널의 단위 해상도에 맞게 상기 영상 데이터를 단위 영상 데이터로 가공한 후, 단위 영상 데이터를 메모리에 저장한다. 그리고, ASIC은 가공하고 남은 영상 데이터를 제1 및 제2 연결 단자들(LCNT,RCNT)과 백 커버 단자들(BC-LCNT, BC-RCNT)과 내부 케이블을 통해 신호 송신 단자(TX)에 공급한다. 그러면, 신호 송신 단자(TX)는 상기 가공하고 남은 영상 데이터를 이웃한 또 다른 표시 유닛으로 전달한다.
ASIC은 단위 영상 데이터와 함께, 그에 동기되는 타이밍 제어신호들을 데이터 드라이버(DIC)에 공급한다.
데이터 드라이버(DIC)는 데이터전압(Vdata)을 생성하는 디지털-아날로그 컨버터(DAC)와 센싱 회로(SENU)와 아날로그-디지털 컨버터(ADC)를 포함한다. 디지털-아날로그 컨버터(DAC)는 디스플레이 모드에서 ASIC에서 공급된 영상 데이터를 타이밍 제어신호에 맞춰 디스플레이용 데이터전압(Vdata)로 생성한 후, 데이터라인들(DL)에 공급한다. 디지털-아날로그 컨버터(DAC)는 센싱 모드에서 미리 설정된 센싱용 데이터전압(Vdata)을 생성한 후, 데이터라인들(DL)에 공급한다.
센싱 회로(SENU)는 디스플레이 모드에서 기준전압(VREF)을 리드 아웃 라인들(RL)에 공급한다. 센싱 회로(SENU)는 센싱 모드에서 기준전압(VREF)을 리드 아웃 라인들(RL)에 공급한 후, 리드 아웃 라인들(RL)에 충전된 센싱 전압(Vsen)을 샘플링한다. 센싱 회로(SENU)는 리드 아웃 라인(RL)과 기준전압(VREF) 입력 단자 사이에 접속된 기준전압 스위치(SPRE)와, 리드 아웃 라인(RL)과 아날로그-디지털 컨버터(ADC) 사이에 접속된 샘플링 스위치(SAM)를 포함한다. 기준전압 스위치(SPRE)는 디스플레이 모드/센싱 모드의 셋 업 구간에서만 온 되고, 샘플링 스위치(SAM)는 센싱 모드의 샘플링 구간에서만 온 된다.
아날로그-디지털 컨버터(ADC)는 센싱 모드에서 샘플링 스위치(SAM)가 온 될 때 생성되는 샘플링 전압을 디지털 처리하여 센싱 결과 데이터(SDATA)를 출력한다. 센싱 결과 데이터(SDATA)는 구동 명령 신호에 따른 수행 결과 신호일 수 있다.
게이트 드라이버는 데이터 드라이버(DIC)를 통해 동작 전압과 타이밍 제어신호를 전달 받을 수 있다. 게이트 드라이버는 표시패널의 픽셀 어레이 바깥의 비 표시영역에 내장될 수 있다. 게이트 드라이버는 타이밍 제어신호에 맞춰 제1 및 제2 게이트신호들(SCAN,SEN)을 생성하여 제1 및 제2 게이트라인들(GL1,GL2)에 공급한다. 제1 및 제2 게이트신호들(SCAN,SEN)은 디스플레이 모드에서 디스플레이용 데이터전압(Vdata)이 기입될 픽셀 라인을 선택하는 역할을 하고, 센싱 모드에서 센싱 대상 픽셀 라인을 선택하는 역할을 한다. 여기서, 픽셀 라인은 제2 방향으로 이웃한 픽셀들과 신호 라인들의 집합체를 의미한다.
도 7은 본 명세서의 비교예로서 세트 보드와 표시 유닛들 간의 해상도 미스 매칭으로 인해 생기는 화면 잘림 현상을 보여주는 도면이다. 그리고, 도 8은 본 명세서의 실시예로서 세트 보드와 표시 유닛들 간에 해상도 미스 매칭이 생기더라도 정상적인 화면이 재현되는 것을 보여주는 도면이다.
도 7의 비교예에 따르면, 4유닛(가로) * 4유닛(세로)의 화면 크기를 갖는 캐비넷에서 4번째 행을 구성하는 4개의 표시 유닛들의 연결이 해제될 때, 세트 보드의 출력 영상 일부가 캐비넷에서 표현되지 못하고 화면 잘림 현상이 나타난다.
이에 반해, 도 8의 실시예에 따르면, 4유닛(가로) * 4유닛(세로)의 화면 크기를 갖는 캐비넷에서 4번째 행을 구성하는 4개의 표시 유닛들의 연결이 해제되더라도 축소된 화면 크기에 맞게 세트 보드의 출력 영상이 캐비넷 내에서 다운 스케일링 되기 때문에, 화면 잘림 현상이 없어진다. 본 명세서의 실시예에 따르면, 세트 보드에서 출력되는 영상의 해상도는 화면 크기의 변경(증가 또는 감소)에 무관하게 원 상태로 고정되고, 캐비넷 내의 특정 표시 유닛(즉, 마스터 표시 유닛)에서 해상도 미스 매칭을 보상하는 동작(즉, 변경된 화면 크기에 맞는 영상 스케일링 동작)이 이뤄진다.
세트 보드와 캐비넷을 연결하는 인터페이스 회로의 밴드 폭을 고려할 때, 영상 스케일링 동작은 세트 보드에서 수행될 수 없고, 마스터 표시 유닛에서 수행되어야 한다. 영상 스케일링 동작이 마스터 표시 유닛에서 수행되면, 인터페이스 회로의 밴드 폭이 획기적으로 줄어드는 장점이 있다.
도 9 및 도 10은 해상도 미스 매칭을 보상할 수 있는 표시 유닛들의 연결 구성을 보여주는 도면들이다.
도 9를 참조하면, 본 명세서의 일 실시예에 따른 무한 확장 표시장치의 경우, 표시 유닛들이 캐스 캐이딩 방식에 따른 단방향 통신 방식으로 서로 연결되어 있다. 세트 보드로부터 전송된 영상 데이터와 센싱 명령 신호 등은 표시 유닛[1,1]에서 표시 유닛[3,3]까지의 캐스 캐이딩 순서에 따른 신호 전송 방향으로 순차적으로 전달되면서 처리된다.
이러한 단방향 통신 방식에 따르면, 각 표시 유닛은 1개의 신호 수신 단자(RX)와 1개의 신호 송신 단자(TX)를 구비하므로, 표시 유닛들 간의 통신 인터페이스가 간소화되고 제조 비용이 절감될 수 있다. 또한, 표시 유닛들 간의 통신 인터페이스가 근거리 무선 통신 방식으로 구현되면, 상기 간소화 효과와 함께 화면 확장의 편의성이 높아질 수 있다. 근거리 무선 통신 방식은 적외선 방식으로 구현될 수 있으나, 본 실시예는 이에 한정되지 않는다.
도 10을 참조하면, 본 명세서의 일 실시예에 따른 무한 확장 표시장치의 경우, 표시 유닛들이 캐스 캐이딩 방식에 따른 양방향 통신 방식으로 서로 연결될 수도 있다. 세트 보드로부터 전송된 영상 데이터와 센싱 명령 신호 등은 표시 유닛[1,1]에서 표시 유닛[3,3]까지의 캐스 캐이딩 순서에 따른 신호 전송 방향으로 순차적으로 전달되면서 처리된다. 이러한 양방향 통신 방식에 따르면, 각 표시 유닛은 2개의 신호 수신 단자들(RX)과 2개의 신호 송신 단자들(TX)을 구비할 수 있다.
도 9 및 도 10에서, 세트 보드는 세트 인터페이스 회로를 통해 표시 유닛[1,1]과 연결된다. 세트 인터페이스 회로는 유선 또는 무선 인터페이스 회로로 구현될 수 있다. 세트 인터페이스 회로와 단방향/양방향 인터페이스 회로는 고속 및 대용량 인터페이싱이 가능한 V-by-One(Vx1) 방식으로 구현됨이 바람직하다. 다만, 이에 한정되지 않고, 세트 인터페이스 회로는 다른 직렬 통신 방식, 예컨대 SPI(Serial Peripheral Interface), I2C, CAN, UART 등으로 대체될 수도 있다.
도 9 및 도 10에서, 표시 유닛[1,1]은 스케일러를 포함하는 마스터 표시 유닛이 되고, 표시 유닛들[1,2] 내지 [3,3]은 인터페이스 회로의 연결에 따른 유닛 배열 좌표 정보를 생성하는 슬레이브 표시 유닛들이 된다.
슬레이브 표시 유닛들은 인터페이스 회로의 신호 전송 방향에 따라 첫 번째 슬레이브 표시 유닛과 마지막 번째 슬레이브 표시 유닛을 포함하는 데, 표시 유닛[1,2]가 첫 번째 슬레이브 표시 유닛이 되고, 표시 유닛[3,3]이 마지막 번째 슬레이브 표시 유닛이 된다. 유닛 배열 좌표 정보는, 표시 유닛[1,2] 에서 표시 유닛[3,3] 까지 각 슬레이브 표시 유닛의 좌표 정보가 캐스캐이딩 방식으로 전달되면서 순차적으로 업데이트된 결과이다.
각 슬레이브 표시 유닛은 상기 캐스캐이딩 방식으로 전달될 현재 유닛의 좌표 정보를 생성하기 위해 좌표 계산부, 인터페이스 회로의 연결을 위한 인터페이스 연결 단자(LCNT,RCNT), 및 연결 확인 핀들(도 4, CCP 참조)을 포함할 수 있다. 좌표 계산부는 해당 ASIC 내에 포함될 수 있다. 연결 확인 핀들(도 4, CCP 참조)은 인터페이스 회로의 연결시에 특정의 논리 조합 정보를 나타낸다. 좌표 계산부는 인터페이스 회로를 통해 이전 유닛의 좌표 정보를 수신하고, 연결 확인 핀들의 상기 논리 조합 정보를 기반으로 좌표 가산치를 도출한다. 좌표 계산부는 이전 유닛의 좌표 정보에 좌표 가산치를 더하여 현재 유닛의 좌표 정보를 생성하고, 현재 유닛의 좌표 정보를 인터페이스 회로를 통해 다음 유닛으로 전송한다. 이러한 방식으로 표시 유닛[1,2] 에서 표시 유닛[3,3]까지 각 슬레이브 표시 유닛의 좌표 정보가 캐스캐이딩 방식으로 전달되면서 순차적으로 업데이트된다.
표시 유닛[3,3]은 피드백 루프를 통해 표시 유닛[1,1]에 연결되어, 최종 업데이트 결과인 유닛 배열 좌표 정보(예컨대, [3,3])를 표시 유닛[1,1]으로 피드백 시킨다. 표시 유닛[1,1]의 ASIC은 유닛 배열 좌표 정보(예컨대, [3,3])를 기반으로 표시 유닛들의 물리적인 해상도를 도출한다. 예를 들어, 유닛 배열 좌표 정보 [3,3]는 연결된 표시 유닛들의 화면 크기(즉, 캐비넷의 행렬수)가 3유닛(가로) * 3유닛(세로)라는 것을 의미하기 때문에, 표시 유닛[1,1]의 ASIC은 메모리에 미리 저장되어 있는 단일 유닛의 단위 해상도 정보를 참조하여, 상기 화면 크기에 해당되는 물리적인 해상도를 계산할 수 있다. 표시 유닛[1,1]의 ASIC은 세트 보드로부터 수신한 영상 데이터를 표시 유닛들의 물리적 해상도에 맞게 스케일링하고, 스케일링 된 영상 데이터를 슬레이브 표시 유닛들로 전송한다.
한편, 표시 유닛들에서 좌표 정보를 생성하여 전달하는 동작은 파워 온 시퀀스(Power on sequence), 및/또는 파워 오프 시퀀스(Power off sequence)에서 이뤄질 수 있다. 따라서, 특정 목적을 위해 표시 유닛들의 물리적 위치가 서로 바뀌더라도, 바뀐 위치에 맞게 좌표 정보와 단위 영상 데이터가 재할당되기 때문에 동일 화면이 표시될 수 있다. 한편, 파워 온 시퀀스 기간과 파워 오프 시퀀스 기간에서 AC 전원은 온 되고 DC 전원은 오프 되어 있으므로, 좌표 정보의 생성과 관련된 동작은 화면 재생이 이뤄지지 않은 상태에서 이뤄질 수 있다.
도 11은 해상도 미스 매칭을 보상할 수 있는 표시 유닛들의 동작 순서를 보여주는 도면이다.
도 11을 참조하면, 마스터 표시 유닛은 슬레이브 표시 유닛들로부터 피드백 받은 유닛 배열 좌표 정보를 통해 캐비넷의 행렬수를 확인하고, 캐비넷의 전체 해상도를 계산한다. 그리고, 마스터 표시 유닛은 세트 보드로부터 수신한 입력 영상의 해상도를 확인한 후, 입력 영상의 해상도가 캐비넷의 전체 해상도와 불일치하면, 입력 영상의 해상도를 캐비넷의 전체 해상도에 맞게 스케일링한 후, 스케일링 된 영상 데이터를 슬레이브 표시 유닛들로 전송한다(S31~S34).
도 11을 참조하면, 슬레이브 표시 유닛들 각각은 스케일링 된 영상 데이터를 해당 좌표 정보에 맞게 단위 영상 데이터로 분리하고, 분리된 영상 데이터를 해당 좌표 영상으로 출력한다(S35,S36).
도 12 내지 도 14는 2유닛(가로) * 2유닛(세로) 크기의 표시 유닛들에 대한 유닛 배열 좌표 정보가 생성되는 원리를 보여주는 도면들이다.
도 12에서, 표시 유닛[1,1]은 마스터 표시 유닛이고, 표시 유닛들[1,2],[2,2],[2,1]은 슬레이브 표시 유닛이다. 마스터 표시 유닛과 달리 슬레이브 표시 유닛은, 이전 유닛으로부터 수신된 좌표 정보를 현재 유닛의 좌표 정보로 업데이트한 후에 다음 유닛으로 전달한다. 마스터 표시 유닛은 마지막 번째 슬레이브 표시 유닛으로부터 최종 업데이트된 좌표 정보, 즉 유닛 배열 좌표 정보를 피드백 받는다. 여기서, 이전 유닛, 현재 유닛, 마지막 번째 슬레이브 표시 유닛 등은 인터페이스 회로의 신호 전송 방향에 따라 정해지는 것이다.
각 표시 유닛에는 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)과, 보조 핀들(Vx1R #1, Vx1R #2, BCNT)이 구비되어 있다. 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)은 모두 로직 로우 전압(0V, L)에 연결된다. 보조 핀들(Vx1R #1, Vx1R #2, BCNT) 중에서, Vx1R #2은 로직 로우 전압에 연결되고, Vx1R #1과 BCNT는 로직 하이 전압(3.3V, H)에 연결된다.
2유닛(가로) * 2유닛(세로) 크기의 표시 유닛들이 체결될 때, 현재 유닛의 연결 확인 핀들(Vx1L #1, Vx1L #2)은 이전 유닛의 보조 핀들(Vx1R #1, Vx1R #2)에 연결된다. 이때, Vx1L #1은 Vx1R #1에 연결되고, Vx1L #2는 Vx1R #2에 연결된다.
현재 유닛이 이전 유닛과 동일 행에서 체결될 때, 연결 확인 핀(TCNT)은 보조 확인 핀(BCNT)와 미 연결된다. 반면에, 현재 유닛이 이전 유닛과 다른 행에서 체결될 때, 연결 확인 핀(TCNT)은 보조 확인 핀(BCNT)와 연결된다.
도 12 내지 도 14를 참조하여 표시 유닛들에서 유닛 좌표 정보가 캐스캐이딩 방식으로 전달되면서 업데이트되는 원리를 설명하면 다음과 같다.
표시 유닛[1,1]은 마스터 표시 유닛이기 때문에, 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보가 “LLL”이 되고, 좌표 정보는 [1,1]이 된다.
표시 유닛[1,2]는 표시 유닛[1,1]에 연결되어 좌표 정보[1,1]를 수신한다. 표시 유닛[1,2]에서 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “HLL”이 된다. Vx1L #1 및 Vx1L #2이 각각 로직 하이 전압(H) 및 로직 로우 전압(L)이므로, 표시 유닛[1,2]는 표시 유닛[1,1]과 연결되었다는 것을 확인한다. 그리고, TCNT가 로직 로우 전압(L)이므로, 표시 유닛[1,2]는 표시 유닛[1,1]과 동일 행에서 연결되었다는 것(즉, 비 반전 연결 되었다는 것)을 확인한다. 표시 유닛[1,2]는 논리 조합 정보 “HLL”를 기반으로 좌표 가산치 [0,1]를 도출하고, 이전 유닛의 좌표 정보[1,1]에 좌표 가산치 [0,1]을 더하여 현재 유닛의 좌표 정보 [1,2]를 생성한다.
표시 유닛[2,2]는 표시 유닛[1,2]에 연결되어 좌표 정보[1,2]를 수신한다. 표시 유닛[2,2]에서 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “HHH”가 된다. Vx1L #1 및 Vx1L #2이 모두 로직 하이 전압(H)이므로, 표시 유닛[2,2]는 표시 유닛[2,1]과 연결되었다는 것을 확인한다. 그리고, TCNT가 로직 하이 전압(H)이므로, 표시 유닛[2,2]는 표시 유닛[2,1]과 다른 행에서 연결되었다는 것(즉, 반전 연결 되었다는 것)을 확인한다. 표시 유닛[2,2]는 논리 조합 정보 “HHH”를 기반으로 좌표 가산치 [1,0]을 도출하고, 이전 유닛의 좌표 정보[1,2]에 좌표 가산치 [1,0]을 더하여 현재 유닛의 좌표 정보 [2,2]를 생성한다.
표시 유닛[2,1]는 표시 유닛[2,2]에 연결되어 좌표 정보[2,2]를 수신한다. 표시 유닛[2,1]에서 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “HLL”이 된다. Vx1L #1 및 Vx1L #2이 각각 로직 하이 전압(H) 및 로직 로우 전압(L)이므로, 표시 유닛[2,1]는 표시 유닛[2,2]과 연결되었다는 것을 확인한다. 그리고, TCNT가 로직 로우 전압(L)이므로, 표시 유닛[2,1]는 표시 유닛[2,2]과 동일 행에서 연결되었다는 것(즉, 비 반전 연결 되었다는 것)을 확인한다. 표시 유닛[2,1]는 논리 조합 정보 “HLL”를 기반으로 좌표 가산치 [0,-1]를 도출하고, 이전 유닛의 좌표 정보[2,2]에 좌표 가산치 [0,-1]을 더하여 현재 유닛의 좌표 정보 [2,1]를 생성한다.
도 15는 3유닛(가로) * 2유닛(세로) 크기의 표시 유닛들에 대한 유닛 배열 좌표 정보가 생성되는 원리를 보여주는 도면이다.
도 15를 참조하면, 표시 유닛[1,1]에서 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “LLL”이 되고, 좌표 정보는 [1,1]이 된다.
표시 유닛[1,2]는 표시 유닛[1,1]에 연결되어 좌표 정보[1,1]를 수신한다. 표시 유닛[1,2]이 표시 유닛[1,1]에 연결될 때, 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “HLL”이 된다. 표시 유닛[1,2]는 논리 조합 정보 “HLL”를 기반으로 좌표 가산치 [0,1]를 도출하고, 이전 유닛의 좌표 정보[1,1]에 좌표 가산치 [0,1]을 더하여 현재 유닛의 좌표 정보 [1,2]를 생성한다.
표시 유닛[1,3]는 표시 유닛[1,2]에 연결되어 좌표 정보[1,2]를 수신한다. 표시 유닛[1,3]이 표시 유닛[1,2]에 연결될 때, 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “HLL”이 된다. 표시 유닛[1,3]는 논리 조합 정보 “HLL”를 기반으로 좌표 가산치 [0,1]를 도출하고, 이전 유닛의 좌표 정보[1,2]에 좌표 가산치 [0,1]을 더하여 현재 유닛의 좌표 정보 [1,3]를 생성한다.
표시 유닛[2,3]는 표시 유닛[1,3]에 연결되어 좌표 정보[1,3]를 수신한다. 표시 유닛[2,3]이 표시 유닛[1,3]에 연결될 때, 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “HHH”가 된다. 표시 유닛[2,3]는 논리 조합 정보 “HHH”를 기반으로 좌표 가산치 [1,0]을 도출하고, 이전 유닛의 좌표 정보[1,3]에 좌표 가산치 [1,0]을 더하여 현재 유닛의 좌표 정보 [2,3]를 생성한다.
표시 유닛[2,2]는 표시 유닛[2,3]에 연결되어 좌표 정보[2,3]를 수신한다. 표시 유닛[2,2]이 표시 유닛[2,3]에 연결될 때, 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “HLL”이 된다. 표시 유닛[2,2]는 논리 조합 정보 “HLL”를 기반으로 좌표 가산치 [0,-1]를 도출하고, 이전 유닛의 좌표 정보[2,3]에 좌표 가산치 [0,-1]을 더하여 현재 유닛의 좌표 정보 [2,2]를 생성한다.
표시 유닛[2,1]는 표시 유닛[2,2]에 연결되어 좌표 정보[2,2]를 수신한다. 표시 유닛[2,1]이 표시 유닛[2,2]에 연결될 때, 연결 확인 핀들(Vx1L #1, Vx1L #2, TCNT)의 논리 조합 정보는 “HLL”이 된다. 표시 유닛[2,1]는 논리 조합 정보 “HLL”를 기반으로 좌표 가산치 [0,-1]를 도출하고, 이전 유닛의 좌표 정보[2,2]에 좌표 가산치 [0,-1]을 더하여 현재 유닛의 좌표 정보 [2,1]를 생성한다.
도 16은 본 명세서의 실시예가 적용되기 전의 화면 표시 상태를 보여준다. 그리고, 도 17은 본 명세서의 실시예가 적용된 후의 화면 표시 상태를 보여준다.
도 16과 같이 본 명세서의 실시예가 적용되지 않으면, 세트 보드로부터의 입력 영상은 캐비넷의 물리적 해상도와 상관없이 원본 해상도를 유지한다. 예를 들어, 입력 영상의 해상도가 960*540이고, 캐비넷의 물리적 해상도가 1920*1080인 경우, 캐비넷에서 입력 영상의 해상도를 벗어나는 영역은 블랙으로 표시된다. 이는 사용자의 시감을 떨어뜨린다.
반면에, 도 17과 같이 본 명세서의 실시예가 적용되면, 캐비넷 내의 마스터 표시 유닛에서 캐비넷의 물리적 해상도에 맞게 입력 영상의 해상도를 스케일링한다. 예를 들어, 입력 영상의 해상도가 960*540이고, 캐비넷의 물리적 해상도가 1920*1080인 경우, 입력 영상의 해상도는 1920*1080으로 업 스케일링 된다. 그 결과, 캐비넷의 화면 크기에 맞게 입력 영상이 표현될 수 있게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.
ASIC : 주문형 집적회로 CCP : 연결 확인핀
LCNT,RCNT: 연결 단자

Claims (15)

  1. 제1 해상도의 영상 데이터를 출력하는 세트 보드; 및
    캐스 캐이딩 방식의 인터페이스 회로를 통해 서로 연결되어 상기 영상 데이터를 표시하며, 주문형 직접 회로를 각각 내장한 복수의 표시 유닛들을 포함하고,
    상기 표시 유닛들은,
    상기 인터페이스 회로의 연결에 따른 유닛 배열 좌표 정보를 생성하는 슬레이브 표시 유닛들과,
    상기 유닛 배열 좌표 정보를 기반으로 상기 제1 해상도의 영상 데이터를 스케일링한 후에 상기 슬레이브 표시 유닛들로 전송하는 마스터 표시 유닛을 구비하는 무한 확장 표시장치.
  2. 제 1 항에 있어서,
    상기 마스터 표시 유닛의 제1 주문형 집적 회로는,
    상기 유닛 배열 좌표 정보를 기반으로 상기 표시 유닛들의 물리적인 제2 해상도를 도출하고, 상기 제1 해상도의 영상 데이터를 상기 제2 해상도에 맞게 스케일링하는 무한 확장 표시장치.
  3. 제 1 항에 있어서,
    상기 슬레이브 표시 유닛들은,
    상기 인터페이스 회로의 신호 전송 방향에 따른 첫 번째 슬레이브 표시 유닛과 마지막 번째 슬레이브 표시 유닛을 포함하며,
    상기 유닛 배열 좌표 정보는, 상기 첫 번째 슬레이브 표시 유닛에서 상기 마지막 번째 슬레이브 표시 유닛까지 각 슬레이브 표시 유닛의 좌표 정보가 캐스캐이딩 방식으로 전달되면서 업데이트된 결과인 무한 확장 표시장치.
  4. 제 3 항에 있어서,
    상기 마지막 번째 슬레이브 표시 유닛에서 업데이트된 상기 유닛 배열 좌표 정보는 피드백 루프를 통해 상기 마스터 표시 유닛으로 피드백되는 무한 확장 표시장치.
  5. 제 1 항에 있어서,
    상기 슬레이브 표시 유닛들 각각은,
    제2 주문형 집적 회로;
    상기 인터페이스 회로의 연결을 위한 인터페이스 연결 단자; 및
    상기 인터페이스 연결 단자와 상기 제2 주문형 직접 회로 사이에 접속된 복수의 연결 확인 핀들을 포함한 무한 확장 표시장치.
  6. 제 1 항에 있어서,
    상기 연결 확인 핀들은,
    상기 인터페이스 회로의 연결시에 특정의 논리 조합 정보를 나타내는 무한 확장 표시장치.
  7. 제 5 항에 있어서,
    상기 제2 주문형 직접 회로는,
    상기 인터페이스 회로를 통해 이전 유닛의 좌표 정보를 수신하고,
    상기 연결 확인 핀들의 상기 논리 조합 정보를 기반으로 좌표 가산치를 도출하고,
    상기 이전 유닛의 좌표 정보에 상기 좌표 가산치를 더하여 현재 유닛의 좌표 정보를 생성하고,
    상기 현재 유닛의 좌표 정보를 상기 인터페이스 회로를 통해 다음 유닛으로 전송하는 무한 확장 표시장치.
  8. 제 1 항에 있어서,
    상기 인터페이스 회로는 단방향 인터페이스 회로인 무한 확장 표시장치.
  9. 제 1 항에 있어서,
    상기 인터페이스 회로는 양방향 인터페이스 회로인 무한 확장 표시장치.
  10. 제 8 항 또는 제 9 항에 있어서,
    상기 인터페이스 회로는 근거리 무선 통신 방식으로 구현된 무한 확장 표시장치.
  11. 제 10 항에 있어서,
    상기 인터페이스 회로는 V-by-One(Vx1) 방식으로 구현된 무한 확장 표시장치.
  12. 주문형 직접 회로를 각각 내장하며 캐스 캐이딩 방식의 인터페이스 회로를 통해 서로 연결된 복수의 표시 유닛들을 갖는 무한 확장 표시장치의 구동 방법에 있어서,
    세트 보드에서 제1 해상도의 영상 데이터를 상기 표시 유닛들로 출력하는 단계;
    상기 표시 유닛들 중의 슬레이브 표시 유닛들에서 상기 인터페이스 회로의 연결에 따른 유닛 배열 좌표 정보를 생성하는 단계; 및
    상기 표시 유닛들 중의 마스터 표시 유닛에서 상기 유닛 배열 좌표 정보를 기반으로 상기 제1 해상도의 영상 데이터를 스케일링한 후에 상기 슬레이브 표시 유닛들로 전송하는 단계를 포함한 무한 확장 표시장치의 구동 방법.
  13. 제 12 항에 있어서,
    상기 마스터 표시 유닛에서 상기 유닛 배열 좌표 정보를 기반으로 상기 제1 해상도의 영상 데이터를 스케일링하는 단계는,
    상기 유닛 배열 좌표 정보를 기반으로 상기 표시 유닛들의 물리적인 제2 해상도를 도출하는 단계; 및
    상기 제1 해상도의 영상 데이터를 상기 제2 해상도에 맞게 스케일링하는 단계를 포함한 무한 확장 표시장치의 구동 방법.
  14. 제 12 항에 있어서,
    상기 슬레이브 표시 유닛들에서 상기 인터페이스 회로의 연결에 따른 유닛 배열 좌표 정보를 생성하는 단계는,
    상기 인터페이스 회로를 통해 이전 유닛의 좌표 정보를 수신하는 단계;
    각 상기 슬레이브 표시 유닛에 구비된 연결 확인 핀들의 논리 조합 정보를 기반으로 좌표 가산치를 도출하는 단계;
    상기 이전 유닛의 좌표 정보에 상기 좌표 가산치를 더하여 현재 유닛의 좌표 정보를 생성하는 단계; 및
    상기 현재 유닛의 좌표 정보를 상기 인터페이스 회로를 통해 다음 유닛으로 전송하는 단계를 포함한 무한 확장 표시장치의 구동 방법.
  15. 제 12 항에 있어서,
    상기 유닛 배열 좌표 정보는,
    상기 인터페이스 회로의 신호 전송 방향에 따른 첫 번째 슬레이브 표시 유닛에서 마지막 번째 슬레이브 표시 유닛까지 캐스캐이딩 방식으로 전달되면서 업데이트되는 무한 확장 표시장치의 구동 방법.
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