KR20210132185A - 뉴 라디오(nr) 다운링크(dl) 포지셔닝 기준 신호(prs) 설계 리소스 할당 및 nr 포지셔닝에서의 맵핑 - Google Patents
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Abstract
무선 시스템에서 다운링크(DL) 포지셔닝 기준 신호(PRS)들을 송신하기 위한 디바이스들 및 방법들이 제공된다. DL PRS 리소스 풀은 복수의 DL PRS 리소스 세트들로 구성되고 이들로 분할된다. DL PRS 리소스 풀은 무선 통신 시스템에서 복수의 gNB들에 의한 DL PRS 송신에 전용되는 주기적으로 반복된 양의 리소스들을 포함한다. 복수의 DL PRS 리소스 세트들은 복수의 gNB들 중 하나 이상의 gNB에 대응한다. DL PRS들은 복수의 DL PRS 리소스 세트들 내의 구성된 DL PRS 리소스들 상의 송신을 위해 인코딩된다.
Description
관련 출원에 대한 상호 참조
본 출원은 2019년 4월 1일자로 출원된 미국 가출원 제62/827,755호의 이익을 주장하며, 그 가출원은 이에 의해 그 전체가 본 명세서에 참조로서 포함된다.
기술분야
본 출원은 대체적으로 무선 통신 시스템들에 관한 것으로, 더 구체적으로는, 사용자 장비 포지셔닝에 관한 것이다.
무선 이동 통신 기술은 다양한 표준들 및 프로토콜들을 사용하여 기지국과 무선 모바일 디바이스 사이에서 데이터를 송신한다. 무선 통신 시스템 표준들 및 프로토콜들은 3GPP(3rd Generation Partnership Project) LTE(long term evolution); WiMAX(worldwide interoperability for microwave access)로서 산업 그룹들에 일반적으로 알려져 있는 IEEE(Institute of Electrical and Electronics Engineers) 802.16 표준; 및 Wi-Fi로서 산업 그룹들에 일반적으로 알려져 있는 무선 로컬 영역 네트워크(wireless local area network, WLAN)들에 대한 IEEE 802.11 표준을 포함할 수 있다. LTE 시스템들의 3GPP 무선 액세스 네트워크(radio access network, RAN)들에서, 기지국은 E-UTRAN(Evolved Universal Terrestrial Radio Access Network) 노드 B(또한, 진화된 노드 B, 향상된 노드 B, eNodeB, 또는 eNB로 일반적으로 표기됨) 및/또는 E-UTRAN의 무선 네트워크 제어기(Radio Network Controller, RNC)와 같은 RAN 노드를 포함할 수 있으며, 이는 사용자 장비(user equipment, UE)로서 알려져 있는 무선 통신 디바이스와 통신한다. 제5 세대(5G) 무선 RAN들에서, RAN 노드들은 5G 노드, 뉴 라디오(new radio, NR) 노드 또는 g 노드 B(gNB)를 포함할 수 있다.
RAN들은 RAN 노드와 UE 사이에서 통신하기 위해 무선 액세스 기술(radio access technology, RAT)을 사용한다. RAN들은 GSM(global system for mobile communications), GERAN(enhanced data rates for GSM evolution (EDGE) RAN), UTRAN(Universal Terrestrial Radio Access Network), 및/또는 E-UTRAN을 포함할 수 있는데, 이들은 코어 네트워크를 통해 통신 서비스들에 대한 액세스를 제공한다. RAN들 각각은 특정 3GPP RAT에 따라 동작한다. 예를 들어, GERAN은 GSM 및/또는 EDGE RAT를 구현하고, UTRAN은 UMTS(universal mobile telecommunication system) RAT 또는 다른 3GPP RAT를 구현하고, E-UTRAN은 LTE RAT를 구현한다.
UE 또는 모바일 사용자의 포지션에 대한 지식은 내비게이션, 방향 찾기, 자산 추적, 인터넷 서비스, 및 위치 기반 디지털 서비스들과 같은 많은 소비자 애플리케이션들에 유용하다. 네트워크에서의 UE 포지션 정보는 또한 법 집행 및 비상 서비스들에 유용하다. 모바일 디바이스의 포지션 위치는 다양한 시스템들로부터 수집된 정보에 기초하여 추정될 수 있다. 무선 네트워크에서, 송신 디바이스(예컨대, 기지국 디바이스)는 포지셔닝 기준 신호(positioning reference signal, PRS)를 송신할 수 있다. 상이한 기지국 디바이스들에 의해 송신되는 PRS들을 획득(수신)하는 모바일 디바이스는, 예를 들어 관찰된 도착 시간 차이(observed time difference of arrival, OTDOA) 기법들을 적용함으로써, 모바일 디바이스의 포지션 위치 추정치를 계산하는 데 사용될 수 있는 신호 기반 측정치들을 획득할 수 있다.
임의의 특정 요소 또는 동작의 논의를 용이하게 식별하기 위해, 도면 번호 내의 최상위 숫자 또는 숫자들은 그 요소가 먼저 도입된 도면 번호를 지칭한다.
도 1은 일 실시 형태에 따른 예시적인 구조를 예시한다.
도 2는 일 실시 형태에 따른 다운링크(downlink, DL) PRS 풀(pool) 구조를 예시한다.
도 3은 일 실시 형태에 따른 DL PRS 맵핑의 물리적 리소스 블록(physical resource block, PRB) 맵핑 패턴을 예시한다.
도 4는 일 실시 형태에 따른 DL PRS 맵핑 패턴을 예시한다.
도 5는 일 실시 형태에 따른 DL PRS 맵핑 패턴 결정을 예시한다.
도 6은 일 실시 형태에 따른 자기상관 통계치(autocorrelation statistic)를 예시한다.
도 7은 일 실시 형태에 따른 상호상관 통계치(cross correlation statistic)를 예시한다.
도 8은 일 실시 형태에 따른 무선 시스템에서 DL PRS들을 송신하기 위한 방법을 예시한다.
도 9는 일 실시 형태에 따른 시스템을 예시한다.
도 10은 일 실시 형태에 따른 기반구조 장비를 예시한다.
도 11은 일 실시 형태에 따른 플랫폼을 예시한다.
도 12는 일 실시 형태에 따른 디바이스를 예시한다.
도 13은 일 실시 형태에 따른 예시적인 인터페이스들을 예시한다.
도 14는 일 실시 형태에 따른 컴포넌트들을 예시한다.
도 1은 일 실시 형태에 따른 예시적인 구조를 예시한다.
도 2는 일 실시 형태에 따른 다운링크(downlink, DL) PRS 풀(pool) 구조를 예시한다.
도 3은 일 실시 형태에 따른 DL PRS 맵핑의 물리적 리소스 블록(physical resource block, PRB) 맵핑 패턴을 예시한다.
도 4는 일 실시 형태에 따른 DL PRS 맵핑 패턴을 예시한다.
도 5는 일 실시 형태에 따른 DL PRS 맵핑 패턴 결정을 예시한다.
도 6은 일 실시 형태에 따른 자기상관 통계치(autocorrelation statistic)를 예시한다.
도 7은 일 실시 형태에 따른 상호상관 통계치(cross correlation statistic)를 예시한다.
도 8은 일 실시 형태에 따른 무선 시스템에서 DL PRS들을 송신하기 위한 방법을 예시한다.
도 9는 일 실시 형태에 따른 시스템을 예시한다.
도 10은 일 실시 형태에 따른 기반구조 장비를 예시한다.
도 11은 일 실시 형태에 따른 플랫폼을 예시한다.
도 12는 일 실시 형태에 따른 디바이스를 예시한다.
도 13은 일 실시 형태에 따른 예시적인 인터페이스들을 예시한다.
도 14는 일 실시 형태에 따른 컴포넌트들을 예시한다.
본 명세서에 개시된 소정 실시 형태들에서, 장치, 방법들, 및 시스템들은 NR 다운링크(DL) PRS 리소스 풀, 리소스 세트 및 단일 리소스, NR DL PRS 리소스 요소 맵핑 규칙, 및 DL PRS 시퀀스 생성기에 대한 설계를 제공한다. 소정의 그러한 실시 형태들은 NR 시스템들에서 높은 정확도 좌표 추정을 갖는 포지셔닝 서비스들을 지원할 수 있는 플렉시블 DL PRS 리소스 풀 할당을 구성하는 것을 목표로 한다. 다중레벨 리소스 구성은 플렉시블 측정 보고 구조를 제공하는데, 이는 DL 기반 포지셔닝 동작을 최적화한다. 스케줄링 절차 및 시퀀스 생성과 함께 리소스 요소 맵핑의 개시된 실시 형태들은 PRS 검출을 위해 그리고 대략적인/미세한 포지셔닝 추정을 위해 수신기 복잡성을 개선하거나 최적화하도록 구성된다.
소정 실시 형태들은, NR DL PRS의 구성을 위한 설계 옵션들을 포함하고/하거나, DL PRS 풀에 대한 메커니즘들을 제공하고/하거나, 리소스 세트 및 리소스 구성을 제공하고/하거나, DL PRS 시퀀스 생성을 위한 설계를 제공하고/하거나, 다른 DL 송신들과의 DL PRS 송신의 다중화 메커니즘들을 제공하고/하거나, DL PRS에 대한 준-병치(quasi-colocation, QCL) 가정 및 NR 시스템에서의 DL 포지셔닝을 위한 스케줄링 태양의 세부사항들을 제공한다.
NR DL PRS 설계 태양들
리소스 할당
소정 실시 형태들에서, DL PRS에 대한 전체 리소스 할당은 DL PRS 리소스, DL PRS 리소스 세트, 및 DL PRS 리소스 세트들의 풀에서 구조화될 수 있다. 예를 들어, 도 1은 일 실시 형태에 따른 DL PRS 송신들의 구성을 위한 예시적인 구조(100)를 예시한다. 예시적인 구조(100)는 다수의 셀들에 대응할 수 있는 복수의 gNB들(102)(3개로 도시되어 있음), 복수의 gNB들(102)에 대한 DL PRS 리소스 풀(104) 또는 DL PRS 리소스 세트들의 목록, 및 복수의 gNB들(102) 중 하나 이상의 gNB(110)에 전용되는 DL PRS 리소스 세트(106)(DL PRS 리소스 세트 0으로 도시됨) 및 DL PRS 리소스 세트(108)(DL PRS 리소스 세트 N으로 도시됨)를 포함하는 복수의 DL PRS 리소스 세트들을 포함한다.
하기에 논의되는 바와 같이, DL PRS 리소스 세트 0, ..., DL PRS 리소스 세트 N은 각각, 송신 수신 포인트(transmission reception point, TRP)들/안테나들에 대한 각자의 DL PRS 리소스 기회들에 대해 사용될 수 있는 DL PRS 리소스들의 조합이다. 도 1에 도시된 바와 같이, 예를 들어 DL PRS 리소스 세트(106)(DL PRS 리소스 세트 0)는 DL PRS 리소스 기회(112)(DL PRS 리소스 기회 0으로 도시됨), ..., DL PRS 리소스 기회(114)(DL PRS 리소스 기회 N으로 도시됨)에 대해 사용되어, DL 송신(TX) 빔 스위핑(sweeping)(예컨대, TX 빔들 1, 2, 3, …, N으로 예시됨)으로 TRP(120)를 도울 수 있다. 유사하게, DL PRS 리소스 세트(108)(DL PRS 리소스 세트 N)는 DL PRS 리소스 기회(116)(DL PRS 리소스 기회 K로 도시됨), ..., DL PRS 리소스 기회(118)(DL PRS 리소스 기회 K+ M으로 도시됨)에 대해 사용될 수 있다. 이러한 예에서, DL PRS 리소스 기회 K는 TRP(122)(TRP(K)로 도시됨)를 지원하는 데 사용될 수 있고, DL PRS 리소스 기회 K+ M은 TRP(124)(TRP(K+ M)로 도시됨)를 지원하는 데 사용될 수 있다.
예시적인 구조(100)는 빔포밍의 지원, 분산된 안테나, 이웃 셀들의 지원 등을 포함하는 다양한 배치 시나리오들에서 PRS 송신 설정들을 설명하는 데 유연성을 제공한다. 예시적인 구조(100)는 CSI-RS 구성과 다소 유사할 수 있는데, 이는 본 명세서에서 추가로 확장되고 DL PRS 특정 컴포넌트들을 도입하도록 향상된다.
DL PRS 리소스 풀
도 2는 일 실시 형태에 따른 DL PRS 리소스 풀(104)에 사용될 수 있는 DL PRS 풀 구조(200)를 예시한다. DL PRS 리소스 풀(104)은 복수의 gNB들(102)에 의한 DL PRS 송신을 위해 전용되는 시스템에서 주기적으로 반복된 양의 리소스들(202)이다. 도 2에 도시된 바와 같이, DL PRS 리소스 풀(104)의 구성은 풀 식별자(ID) 및 DL PRS 풀 대역폭(204), DL PRS 풀 주기성 및 시간 오프셋(DL PRS 풀 주기(206) 및 DL PRS 리소스 풀 시간 오프셋(208)으로 표현됨), DL PRS 풀 슬롯 패턴(210), 및 DL PRS 풀 심볼 패턴(212)을 포함하는 속성들 중 하나 또는 이들의 조합을 포함할 수 있다.
옵션들 중 하나 또는 이들의 조합은 DL PRS 풀 대역폭(204)에 사용되는 대역폭들의 표시를 위해 사용될 수 있다. 일 실시 형태에서, 예를 들어, 표시는 기준 포인트(예컨대, 기준 포인트 A)에 대하여 PRS 리소스 풀에 대한 시작 및 종료 물리적 리소스 블록(physical resource block, PRB)을 포함할 수 있다. 다른 예시적인 실시 형태로서, 표시는 기준 포인트(예컨대, 기준 포인트 A)에 대한 PRB 오프셋 및 DL PRS 리소스 풀에 대한 할당된 PRB들의 수를 포함할 수 있다. 또 다른 예시적인 실시 형태에서, 표시는 기준 포인트(예컨대, 기준 포인트 A)에 대하여 비트맵으로서 정의되는 PRB 할당 패턴을 포함할 수 있다.
DL PRS 리소스 풀 구성은 DL PRS 풀 주기성 및 시간 오프셋을 정의할 수 있다. 주기성(DL PRS 풀 주기(206)로 표현됨)은 2개의 연속적인 DL PRS 풀들의 리소스(202)들 사이의 시간을 정의한다. 주기성 오프셋(DL PRS 리소스 풀 시간 오프셋(208)으로 표현됨)은 시스템 프레임 번호(SFN) = 0과 관련하여 슬롯들에서 정의될 수 있다.
DL PRS 리소스 풀 구성은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 어느 슬롯들이 구성되는지를 나타내는 DL PRS 풀 슬롯 패턴(210)을 정의할 수 있다. 도 2에서, 예를 들어, (슬롯(214)과 같은) 음영처리된 슬롯들이 DL PRS 송신을 위해 구성된다. 슬롯 패턴은 DL PRS 송신을 위한 비연속적 슬롯들을 할당하는 데 사용될 수 있다. 슬롯 패턴은, 예를 들어 주기성 및 오프셋에 의해 나타내어진 슬롯에 대하여 정의될 수 있다.
DL PRS 리소스 풀 구성은 또한, 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 슬롯 내의 어느 심볼들이 구성되는지를 나타내는 DL PRS 풀 슬롯 패턴(212)을 정의할 수 있다. 도 2에서, 예를 들어, (심볼(216)과 같은) 음영처리된 심볼들은 DL PRS 송신을 위해 구성된다.
소정 실시 형태들에서, 도 2에 도시된 바와 같은 DL PRS 풀 구조(200)가 별도로 정의되지 않을 수 있다. 그러한 실시 형태들에서, 도 2에 도시되고 상기에서 논의된 것은 DL PRS 리소스 세트 및/또는 DL PRS 리소스 구성의 일부일 수 있고, 이는 하기에 기술된다.
DL PRS 리소스 세트
DL PRS 리소스 풀(104)은 DL PRS 리소스 세트들(도 1에 DL PRS 리소스 세트(106), ..., DL PRS 리소스 세트(108)로 도시됨)로 분할될 수 있는데, 이는 하나 이상의 gNB(110)에 전용될 수 있다. 리소스 세트들로부터의 DL PRS 리소스 풀(104)의 집합은 DL PRS 신호들의 시간 송신에 국소화된 관점에서 편리하다. DL PRS 리소스 세트들은 하기의 속성들 중 하나 또는 이들의 조합을 가질 수 있다: 구성된 DL PRS 리소스 세트가 어느 셀에 속하는지를 나타내는 셀 ID; 구성된 DL PRS 리소스 세트를 식별하는 리소스 세트 ID; 주어진 DL PRS 리소스 세트에 대응하는 DL PRS 리소스들을 나타내기 위한 DL PRS 리소스 ID들의 목록; 리소스 세트가 주기적인지 또는 반지속적인지를 나타내기 위한 리소스 세트 유형(비주기적 유형은, 그것이 지원되는 경우, 구성된 하나의 리소스만을 갖고 반지속적으로 지원될 수 있음에 유의함); 동일한 공간 TX 필터가 세트 내의 DL PRS 리소스들 전체에 걸쳐 적용되는지 여부를 나타내기 위한 동일한 TX 안테나 포트(들)(반복) 필드 - 이는 수신(RX) 안테나 트레이닝을 위해 사용될 수 있음 -; 및/또는 주어진 DL PRS 송신 기회가 DL PRS 송신을 위해 사용되는지 또는 아닌지 여부를 나타내기 위한 DL PRS 송신 기회들의 활성화/비활성화를 위한 뮤팅 비트맵(muting bitmap).
DL PRS 리소스
DL PRS 리소스 세트는 DL PRS 리소스들의 조합일 수 있다. 각각의 리소스는 고정된 공간 필터를 이용하여 주어진 송신 포인트로부터 DL PRS의 송신을 위한 시간-주파수 리소스들을 나타낸다. 따라서, 리소스 세트는 gNB/TRP에서 빔포밍을 지원할 수 있거나(예컨대, 주파수 범위 2(FR2) 내의 상이한 공간 필터들) 또는 지리적으로 분산된 셀들에 대한 세트 리소스들(예컨대, TRP들/gNB들)을 포함할 수 있다. DL PRS 리소스들은 다음의 속성들 중 하나 또는 이들의 조합을 가질 수 있다: DL PRS 리소스의 각각의 심볼에 대한 리소스 요소 맵핑 패턴을 정의하는 리소스 요소 맵핑 패턴(예컨대, 도 3 참조) - 여기서, 각각의 맵핑 패턴은 고유한 수의 점유된 심볼들을 포함할 수 있음; 정의된 DL PRS 리소스 요소 맵핑 패턴의 주파수 시프트를 가리키는 주파수 시프트; DL PRS 송신에 사용된 송신 빔을 나타내는 TX 빔 ID; DL PRS 리소스 당 안테나 포트들의 수(예컨대, 1개 또는 2개)를 나타내는 포트들 필드의 수, 고유 리소스 ID; DL PRS 리소스가 DL PRS 풀 내에서 시작하는 제1 직교 주파수 분할 다중화(orthogonal frequency division multiplexing, OFDM) 심볼을 가리키는 시간 필드에서의 오프셋; 단일 DL PRS 리소스의 지속기간을 나타내기 위한 리소스 지속기간(기회들의 개념은 기회들 전체에 걸쳐 DL PRS 뮤팅 패턴들, 예컨대 NR DL PRS 송신을 위한 N PRS_RES 개의 연속적인 패턴들(N PRS_RES ≥ 1) - 여기서, N PRS_RES 은 DL PRS 리소스들 또는 DL PRS 리소스 세트들 전체에 걸친 공통 파라미터일 수 있음 - 을 포함하는 다양한 DL PRS 송신 스케줄들을 적용하는 데 사용될 수 있음에 유의함); 의사 랜덤 DL PRS 시퀀스(들)를 생성하는 데 사용된 시퀀스 ID; 및/또는 주어진 DL PRS 신호 리소스가 임의의 기준 신호들과 준-병치되는지(quasi-collocated) 여부를 나타내는 준-병치(quasi-collocation) 정보(예컨대, 송신 구성 표시자(transmission configuration indicator, TCI) 상태 ID).
리소스 요소 맵핑 패턴
도 3은 일 실시 형태에 따른 DL PRS 맵핑의 PRB 맵핑 패턴(300)을 예시한다. 리소스 요소 패턴은 DL PRS에 대한 주파수에서 comb-N comb 구조를 지원하고, 여기서 N comb = {1, 2, 3, 4}이다. 단일의 DL PRS 리소스 점유에서의 시간 점유는 N PRS_OCC ·N comb 개의 연속적인 심볼들로 이루어진다. 도 3은 comb-N 패턴들의 적합한 세트들을 도시한다. 그러나, 당업자는 본 명세서에서의 개시 내용으로부터, 다른 세트들의 comb-N 패턴들이 또한 사용될 수 있음을 인식할 것이다.
소정 실시 형태들에서, DL PRS 신호 송신을 위해 사용된 빔들의 수는 시스템에서 NPRS_BEAM으로서 정의된다. 각각의 빔에는 고유 DL PRS 리소스가 할당될 수 있고, 점유된 시간 심볼들의 총 수는 N comb· N PRS_OCC · NPRS_BEAM과 동일하다. 각각의 DL PRS 리소스에 대해, 송신 빔이 정의된다. 도 4는 2개 및 4개의 빔들을 갖는 예시적인 DL PRS 맵핑 패턴(400)을 예시한다.
도 5는 DL PRS 맵핑 패턴 결정(500) 또는 구성의 일례를 예시하고, 여기서 소정 실시 형태들은 다음의 파라미터들을 정의한다: 전술되었던 시스템-특정 파라미터들(N PRS_RES , N comb , N PRS_BEAM ); gNB에 대한 의사 랜덤 리소스 선택 절차를 가능하게 할 수 있는 Δ 및 N PRS_ID (패턴 선택을 위해 또한 사용될 수 있는 전술된 파라미터)과 같은 gNB 특정 파라미터들; comb 주파수 패턴에 대한 주파수 시프트(502); PRS 시간 오프셋(504); 랜덤화 파라미터; 및/또는 송신 빔 ID.
comb 주파수 패턴에 대한 주파수 시프트(502)는 다음의 파라미터들 중 하나 또는 이들의 조합에 의존할 수 있다: N PRS_ID , N comb , Δ. 일례로서, 주파수 시프트 계산을 위해 다음의 수학식이 사용될 수 있다:
PRS 풀 내의 PRS 리소스 세트로부터 제1 PRS 리소스에 대한 시간 오프셋(504)은 다음의 파라미터들 중 하나 또는 이들의 조합에 의존할 수 있다: N PRS_ID , N comb , Δ, N PRS_ RES , 및 N PRS_SET_NUM (DL PRS 리소스 풀 내의 DL PRS 리소스 세트들의 총 수). 일례로서, 시간 시프트 계산을 위해 다음의 수학식이 사용될 수 있다:
랜덤화 파라미터는 다음의 파라미터들 중 하나 또는 이들의 조합에 의존하는, 다음의 수학식에 따라 계산될 수 있다: SFN, N POOL_PERIOD (미리정의된 PRS 풀 주기), Δ PRS_init (gNB-특정 파라미터 초기 델타 값), 및 Δ PRS_init = {0,1,.. N comb· N PRS_POOL }. 일례로서, 랜덤화 파라미터 계산을 위해 다음의 수학식이 사용될 수 있다:
현재 DL PRS 리소스에 대한 송신 빔 ID는 다음의 파라미터들 중 하나 또는 이들의 조합에 의존하고: N comb , Δ, N PRS_BEAM , 및 N PRS_res_id (DL PRS 리소스 ID), Tx 빔 ID 계산을 위해 일례로서 다음의 수학식이 사용될 수 있다:
DL PRS 안테나 포트들의 수
소정의 무선 시스템 구현예들에서, 단일 포트 DL PRS 물리적 구조가 지원될 수 있다. 그러나, 본 명세서에 개시된 소정 실시 형태들은 DL PRS에 대한 2개의 안테나 포트들을 지원한다. 하나 이상의 포트를 추가하는 것은 필요한 더 많은 스펙트럼 리소스들을 반드시 암시하지는 않고, RX 프로세싱에 많은 복잡성을 추가하지 않는다. 그러나, 추가적인 포트를 추가하는 것은 TX 다이버시티 지원으로 인해 성능에 이익을 얻을 수 있다. 특히, 2개 포트 송신은 타이밍 추정 정확도를 개선시킬 수 있다.
레거시 UE들/DL PRS 송신과 공존
소정의 무선 시스템 구현예들(예컨대, 3GPP Rel. 15)에서, 상위 호환성(forward compatibility)의 메커니즘들, 예컨대 PDSCH에 대한 RateMatchPattern 등이 개발되어 왔다. 이러한 메커니즘은, UE가 레이트-매칭을 행할 것으로 예상되는, 리소스 슬롯들 및 심볼 및 PRB들을 나타낸다. 소정 실시 형태들에 따라, 적절한 RateMatchPattern(들)을 Rel. 15 UE들에 구성함으로써, DL PRS 송신과의 충돌을 회피하는 것이 가능하다. 다른 실시 형태는, 다른 DL 송신이 회피되는(구성되지 않는) 슬롯들에 DL PRS 송신들을 할당한다.
NR DL PRS 시퀀스 설계
소정 실시 형태들은 DL PRS 신호들에 대한 시퀀스 생성 절차를 제공한다. 제공된 통계치들(도 6 및 도 7 참조)에 따라, DL PRS 시퀀스 생성 절차에 대해 3GPP TS 38.211, V15.4.0의 섹션 5.2.1로부터 의사 랜덤 시퀀스 생성기를 재사용하는 것이 제안된다. 도 6은 자기상관 통계치(600)에 대한 예시적인 그래프들을 예시하고, 도 7은 교차상관 통계치(700)에 대한 예시적인 그래프들을 예시한다. 따라서, 각각의 슬롯 인덱스 
에 대한 DL PRS 신호 및 슬롯 
내의 심볼 인덱스는 다음의 형태를 가질 수 있다:
방정식의 일례로서, 다음의 수학식이 사용될 수 있다:
DL 송신들과의 DL PRS 다중화
다양한 옵션들이 사용되거나 조합되어 DL PRS 및 DL 송신들을 다중화할 수 있다. 일 실시 형태에서, 예를 들어, DL PRS 신호들과 다른 DL 신호들/채널들과의 시간 분할 다중화(time division multiplexing, TDM) 송신이 3GPP 주파수 범위 1(FR1) 및 FR2 둘 모두에서 바람직할 수 있다. 이것은 UE 측에서 동적 범위 및 채널-내 선택성 문제들을 회피하는 것을 도와서, 더 예측가능한 성능 및 정확한 측정들로 이어질 수 있다. 소정 구현예들이 DL PRS 송신을 위한 전용 리소스들의 할당을 사용할 수 있지만, DL PRS 송신들이 다른 DL 신호들/채널들과의 TDM이라는 것을 더 명확히 하는 것이 유리할 수 있다. 다른 실시 형태들에서, 다른 DL 신호들/채널들과 DL PRS의 주파수 분할 다중화(FDM) 송신은 FR1 및 FR2 둘 모두에서 바람직하지 않고, 적어도 FR2에 대해 배제될 수 있다. 다른 신호들과 DL-PRS의 FDM은 UE 동적 범위에 부정적인 영향을 주고, 광대역 빔 관리를 고려하여 예측불가능한 결과들을 초래할 수 있다.
DL BWP들과 DL PRS 관계
소정 실시 형태들에서, NR DL PRS 구성은 UE에 구성된 DL 대역폭부(bandwidth part, BWP)들에 의해 제한되지 않는다. 동시에, 사양 관점으로부터, DL BWP들 중 하나를 NR DL PRS와 연관시키고("포지셔닝 DL BWP") 그것을 UE에 구성하는 것이 더 쉬울 수 있다. 이러한 접근법은 DL PRS 구성에 어떠한 제약들도 부과하지 않는다. UE 관점으로부터, 그것은 "포지셔닝 DL BWP" 내에서만 DL PRS 신호들의 프로세싱을 암시할 수 있다. (PRS와 연관된) 구성된 DL BWP들 중 하나는, 소정 실시 형태들에서, 항상 NR DL PRS 구성 파라미터들과 정렬될 수 있다. UE DL PRS 프로세싱 대역폭이 구성된 DL PRS의 대역폭보다 작은 경우, gNB는 UE 프로세싱 능력들에 따라 "포지셔닝" DL BWP를 구성할 수 있다.
DL PRS를 프로세싱하기 위해, UE(포지셔닝에 관심이 있음)는, 필요한 경우, 활성 DL BWP와 "포지셔닝" DL BWP 사이에서 스위칭할 필요가 있을 수 있다. UE는, "포지셔닝" DL BWP가 활성 DL BWP 내에 할당되는 경우, 스위칭할 필요가 없을 수 있다. DL BWP 스위칭의 가정들은 DL PRS 프로세싱을 위해 재사용된다.
DL PRS 준-병치 태양들
서빙 셀로부터의 DL PRS는 다른 기준 신호들(예컨대, NR Rel.15/16)과 준-병치에 의해 연관될 수 있다. 그러한 목적을 위해, 소정 실시 형태들에 따라, 준-병치 시그널링이 사용될 수 있다. 적용가능하다면, DL PRS QCL의 다음의 옵션들 중 하나 또는 이들의 조합이 적용된다: DL PRS 리소스 세트 내의 DL PRS 리소스(들)는 QCL 유형-A를 사용하여 서로 준-병치된 것으로서 구성됨; DL PRS 리소스 세트 내의 DL PRS 리소스(들)는 QCL 유형-A 및/또는 QCL 유형-D를 사용하여 추적(예컨대, 추적 기준 신호(tracking reference signal, TRS))하기 위해 CSI-RS와 준-병치된 것으로서 구성됨; DL PRS 리소스 세트 내의 DL PRS 리소스(들)는 QCL 유형-D를 사용하여 빔 관리(beam management, BM)를 위해 CSI-RS와 준-병치된 것으로서 구성됨; 및/또는 DL PRS 리소스 세트 내의 DL PRS 리소스(들)는 QCL 유형-C 및/또는 유형-D를 사용하여 동기화 신호 블록(synchronization signal block, SSB)(예컨대, SSB 인덱스)과 준-병치된 것으로서 구성됨.
DL PRS 송신 스케줄
소정 실시 형태들에서, 전용 NR DL PRS 리소스들에 대한 송신은 DL TX 빔 스위핑 및 할당된 DL PRS 리소스들에 대한 DL PRS 송신의 온/오프를 지원한다. 이러한 기능은 간섭 제한된 시나리오들에서 가능한 한 많은 TRP들에 대한 신호 위치 파라미터들의 정확한 측정을 가능하게 하는 데 유용하다. 온/오프 동작을 가능하게 하기 위해, 기회의 개념이 DL PRS 리소스 내에 도입되었고, 여기서 기회는 심볼들의 연속적인 수를 결정한다(전체 리소스는 다수의 기회들에 의해 표현됨).
실시 형태들은 2가지 유형들의 배치 시나리오들, 즉 1) 향상된 포지셔닝 영역, 및 2) 기본 배치들(포지셔닝 관점으로부터 최적화되지 않음)을 포함할 수 있다. 향상된 포지셔닝 영역들에서, 적절한 양의 스펙트럼 리소스들뿐만 아니라 최적화된 PRS 송신 스케줄이 UE들에 구성될 수 있다. 기본 배치들에서, DL PRS 리소스에 대한 랜덤화된 송신은 포지셔닝 성능을 개선시키도록 지원되어야 한다. 따라서, PRS 송신에 관하여, 적어도 2개의 동작 모드들이 NR에 의해 지원되어야 한다.
NR 포지셔닝을 위해, 여러 유형들의 랜덤화가 가능하고 지원된다. 다음의 옵션들 중 하나 또는 이들의 조합이 소정 실시 형태들에 따라 사용될 수 있다: 공간 랜덤화(DL PRS 송신을 위한 빔(들)이 랜덤하게 할당됨); 시간 랜덤화(DL PRS 송신을 위한 시간 리소스(들)가 랜덤하게 할당됨); 주파수 랜덤화(DL PRS 송신을 위한 주파수 리소스(들)가 랜덤하게 할당됨); 및/또는 코드 랜덤화(DL PRS 송신을 위한 시퀀스(들)가 랜덤하게 할당됨).
소정 실시 형태들에서, 적어도 2개의 DL PRS 송신 모드들, 즉 PRS 송신 모드 1 및 PRS 송신 모드 2가 NR에 의해 지원된다. PRS 송신 모드 1은 미리정의된 PRS 송신 스케줄(PTM1)에 기초하고, 주어진 PRS 리소스 상의 PRS 송신 패턴은 UE로 시그널링된다(예컨대, 미리구성됨).
PRS 송신 모드 2는 의사 랜덤 PRS 송신 스케줄(PTM2)에 기초한다. PRS 송신 모드 2에서, 주어진 PRS 리소스 상의 PRS 송신은 (예컨대, PRS 송신 PPRS_TX의 (미리)구성된 확률에 따라) 확률적으로 제어된다. 게다가, 또는 다른 실시 형태들에서, 공간 (빔), 시간, 주파수, 및 코드 랜덤화 기법들이 전용 리소스들 상의 DL PRS 송신을 위해 적용된다.
도 8은 일 실시 형태에 따른, 무선 시스템에서 DL PRS를 송신하기 위한 방법(800)의 흐름도이다. 블록(802)에서, 방법(800)은 무선 통신 시스템에서 복수의 gNB들에 의한 DL PRS 송신에 전용되는 주기적으로 반복된 양의 리소스들을 포함하는 DL PRS 리소스 풀을 구성한다. 블록(804)에서, 방법(800)은 DL PRS 리소스 풀을 복수의 gNB들 중 하나 이상의 gNB에 대응하는 복수의 DL PRS 리소스 세트들로 분할한다. 블록(806)에서, 방법(800)은 복수의 DL PRS 리소스 세트들 내의 구성된 DL PRS 리소스들 상의 송신을 위해 DL PRS들을 인코딩한다.
소정의 그러한 실시 형태들에서, DL PRS 리소스 풀을 구성하는 것은, 고유 DL PRS 풀 ID, DL PRS 풀 대역폭, 2개의 연속적인 DL PRS 풀들 사이의 시간을 정의하는 DL PRS 풀 주기성, 및 DL PRS 풀 시간 오프셋을 포함하는 하나 이상의 파라미터들을 구성하는 것을 포함한다. DL PRS 풀 시간 오프셋은 미리결정된 SFN에 대하여 슬롯들에서 정의될 수 있다.
소정 실시 형태들에서, DL PRS 리소스 풀을 구성하는 것은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 어느 슬롯들이 구성되는지를 나타내도록 DL PRS 풀 슬롯 패턴을 구성하는 것을 포함한다. DL PRS 풀 슬롯 패턴을 구성하는 것은 DL PRS 리소스 풀 내의 각각의 PRS 할당된 슬롯을 나타내는 비트맵 패턴을 포맷하는 것을 포함할 수 있다.
소정 실시 형태들에서, DL PRS 리소스 풀을 구성하는 것은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 슬롯 내의 어느 심볼들이 구성되는지를 나타내도록 DL PRS 풀 심볼 패턴을 구성하는 것을 포함한다. DL PRS 풀 심볼 패턴을 구성하는 것은 DL PRS 송신을 위해 이용가능한 각각의 슬롯 내의 각각의 할당된 심볼을 나타내는 비트맵 패턴을 포맷하는 것을 포함할 수 있다.
도 9는 다양한 실시 형태들에 따른 네트워크의 시스템(900)의 예시적인 아키텍처를 예시한다. 하기의 설명은 3GPP 기술 규격들에 의해 제공되는 바와 같은 LTE 시스템 표준들 및 5G 또는 NR 시스템 표준들과 함께 동작하는 예시적인 시스템(900)에 대해 제공된다. 그러나, 예시적인 실시 형태들은 이와 관련하여 제한되지 않으며 기술된 실시 형태들은 본 명세서에 기술된 원리들로부터 이익을 얻는 다른 네트워크들, 예컨대 미래의 3GPP 시스템들(예컨대, 6G(Sixth Generation) 시스템들), IEEE 802.16 프로토콜들(예컨대, WMAN(wireless metropolitan area networks), WiMAX 등) 등에 적용할 수 있다.
도 9에 의해 도시된 바와 같이, 시스템(900)은 UE(902) 및 UE(904)를 포함한다. 이러한 예에서, UE(902) 및 UE(904)는 스마트폰들(예컨대, 하나 이상의 셀룰러 네트워크들에 접속가능한 핸드헬드 터치스크린 모바일 컴퓨팅 디바이스들)로서 예시되지만, 또한 임의의 모바일 또는 비모바일 컴퓨팅 디바이스, 예컨대, 소비자 전자 디바이스들, 셀룰러 폰들, 스마트폰들, 피처 폰들, 태블릿 컴퓨터들, 웨어러블 컴퓨터 디바이스(wearable computer device)들, PDA(personal digital assistant)들, 페이저(pager)들, 무선 핸드셋들, 데스크톱 컴퓨터들, 랩톱 컴퓨터들, IVI(in-vehicle infotainment), ICE(in-car entertainment) 디바이스들, IC(Instrument Cluster), HUD(head-up display) 디바이스들, OBD(onboard diagnostic) 디바이스들, DME(dashtop mobile equipment), MDT(mobile data terminal)들, EEMS(Electronic Engine Management System), ECU(electronic/engine control unit)들, ECM(electronic/engine control module)들, 임베디드 시스템들, 마이크로제어기들, 제어 모듈들, EMS(engine management systems), 네트워킹된 또는 "스마트" 기기들, MTC 디바이스들, M2M, IoT 디바이스들 등을 포함할 수 있다.
일부 실시 형태들에서, UE(902) 및/또는 UE(904)는 IoT UE들일 수 있는데, 이는 짧은 수명의 UE 접속들을 활용하는 저전력 IoT 애플리케이션들에 대해 설계된 네트워크 액세스 계층을 포함할 수 있다. IoT UE는 PLMN, ProSe 또는 D2D 통신, 센서 네트워크들, 또는 IoT 네트워크들을 통해 MTC 서버 또는 디바이스와 데이터를 교환하기 위한 MTC 또는 M2M과 같은 기술들을 활용할 수 있다. 데이터의 M2M 또는 MTC 교환은 데이터의 기계 개시 교환(machine-initiated exchange)일 수 있다. IoT 네트워크는 IoT UE들을 상호접속시키는 것을 설명하는데, IoT UE들은 짧은 수명의 접속들을 이용하는 (인터넷 기반구조 내의) 고유하게 식별가능한 임베디드 컴퓨팅 디바이스들을 포함할 수 있다. IoT UE들은 IoT 네트워크의 접속들을 용이하게 하기 위해 백그라운드 애플리케이션들(예컨대, 킵 얼라이브(keep-alive) 메시지들, 상태 업데이트들 등)을 실행시킬 수 있다.
UE(902) 및 UE(904)는 액세스 노드 또는 무선 액세스 노드((R)AN(916)으로 도시됨)와 접속하도록, 예를 들어 이와 통신가능하게 커플링하도록 구성될 수 있다. 실시 형태들에서, (R)AN(916)은 NG RAN 또는 SG RAN, E-UTRAN, 또는 레거시(legacy) RAN, 예컨대 UTRAN 또는 GERAN일 수 있다. 본 명세서에 사용되는 바와 같이, 용어 "NG RAN" 등은 NR 또는 SG 시스템에서 동작하는 (R)AN(916)을 지칭할 수 있고, 용어 "E-UTRAN" 등은 LTE 또는 4G 시스템에서 동작하는 (R)AN(916)을 지칭할 수 있다. UE(902) 및 UE(904)는 접속들(또는 채널들)(접속(906) 및 접속(908)으로 각각 도시됨)을 활용하고, 이들 각각은 물리적 통신 인터페이스 또는 계층(이하에서 더욱 상세히 논의됨)을 포함한다.
이러한 예에서, 접속(906) 및 접속(908)은 통신 커플링을 가능하게 하기 위한 에어 인터페이스들이고, 셀룰러 통신 프로토콜들, 예컨대, GSM 프로토콜, CDMA 네트워크 프로토콜, PTT 프로토콜, POC 프로토콜, UMTS 프로토콜, 3GPP LTE 프로토콜, SG 프로토콜, NR 프로토콜, 및/또는 본 명세서에서 논의된 다른 통신 프로토콜들 중 임의의 것과 부합할 수 있다. 실시 형태들에서, UE(902) 및 UE(904)는 ProSe 인터페이스(910)를 통해 통신 데이터를 직접 교환할 수 있다. ProSe 인터페이스(910)는 대안적으로 사이드링크(sidelink, SL) 인터페이스(110)로 지칭될 수 있고, PSCCH, PSSCH, PSDCH, 및 PSBCH를 포함하지만 이로 제한되지 않는 하나 이상의 로직 채널들을 포함할 수 있다.
UE(904)는 접속(914)을 통해 AP(912)(또한 "WLAN 노드", "WLAN", "WLAN 종단", "WT" 등으로도 지칭됨)에 액세스하도록 구성되는 것으로 도시되어 있다. 접속(914)은, 임의의 IEEE 802.11 프로토콜과 부합하는 접속과 같은, 로컬 무선 접속을 포함할 수 있고, 여기서 AP(912)는 Wi-Fi®(wireless fidelity) 라우터를 포함할 것이다. 이러한 예에서, AP(912)는 무선 시스템의 코어 네트워크에 접속되지 않으면서 인터넷에 접속될 수 있다(아래에서 더 상세히 설명됨). 다양한 실시 형태들에서, UE(904), (R)AN(916), 및 AP(912)는 LWA 동작 및/또는 LWIP 동작을 활용하도록 구성될 수 있다. LWA 동작은, UE(904)가 LTE 및 WLAN의 무선 리소스들을 활용하기 위해 RAN 노드(918) 또는 RAN 노드(920)에 의해 구성되는 RRC_CONNECTED에 있는 것을 수반할 수 있다. LWIP 동작은, UE(904)가 접속(914)을 통해 전송되는 패킷들(예컨대, IP 패킷들)을 인증하고 암호화하기 위해 IPsec 프로토콜 터널링을 통해 WLAN 무선 리소스들(예컨대, 접속(914))을 사용하는 것을 수반할 수 있다. IPsec 터널링은 원래의 IP 패킷들 전체를 캡슐화하고 새로운 패킷 헤더를 추가함으로써, IP 패킷들의 원래의 헤더를 보호하는 것을 포함할 수 있다.
(R)AN(916)은 접속(906) 및 접속(908)을 가능하게 하는, RAN 노드(918) 및 RAN 노드(920)와 같은 하나 이상의 AN 노드들을 포함할 수 있다. 본 명세서에 사용되는 바와 같이, 용어 "액세스 노드", "액세스 포인트" 등은 네트워크와 하나 이상의 사용자들 사이의 데이터 및/또는 음성 접속성을 위한 무선 기저대역 기능들을 제공하는 장비를 설명할 수 있다. 이러한 액세스 노드들은 BS, gNB들, RAN 노드들, eNB들, NodeB들, RSU들, TRxP들 또는 TRP들 등으로 지칭될 수 있고, 지리적 영역(예컨대, 셀) 내의 커버리지를 제공하는 지상 스테이션들(예컨대, 지상 액세스 포인트들) 또는 위성 스테이션들을 포함할 수 있다. 본 명세서에 사용되는 바와 같이, 용어 "NG RAN 노드" 등은 NR 또는 SG 시스템(예컨대, gNB)에서 동작하는 RAN 노드를 지칭할 수 있고, 용어 "E-UTRAN 노드" 등은 LTE 또는 4G 시스템(900)(예컨대, eNB)에서 동작하는 RAN 노드를 지칭할 수 있다. 다양한 실시 형태들에 따르면, RAN 노드(918) 또는 RAN 노드(920)는 매크로셀 기지국과 같은 전용 물리적 디바이스, 및/또는 매크로셀들에 비해 더 작은 커버리지 영역들, 더 작은 사용자 수용량, 또는 더 높은 대역폭을 갖는 펨토셀들, 피코셀들 또는 다른 유사 셀들을 제공하기 위한 저전력(low power, LP) 기지국 중 하나 이상으로서 구현될 수 있다.
일부 실시 형태들에서, RAN 노드(918) 또는 RAN 노드(920)의 전부 또는 일부들은 가상 네트워크의 일부로서 서버 컴퓨터들에서 실행되는 하나 이상의 소프트웨어 엔티티들로서 구현될 수 있는데, 이는 CRAN 및/또는 vBBUP(virtual baseband unit pool)로 지칭될 수 있다. 이들 실시 형태들에서, CRAN 또는 vBBUP는, RRC 및 PDCP 계층들이 CRAN/vBBUP에 의해 동작되고 다른 L2 프로토콜 엔티티들이 개별 RAN 노드들(예컨대, RAN 노드(918) 또는 RAN 노드(920))에 의해 동작되는 PDCP 분할과 같은 RAN 기능 분할; RRC, PDCP, RLC, 및 MAC 계층들이 CRAN/vBBUP에 의해 동작되고, PHY 계층이 개별 RAN 노드들(예컨대, RAN 노드(918) 또는 RAN 노드(920))에 의해 동작되는 MAC/PHY 분할; 또는 RRC, PDCP, RLC, MAC 계층들 및 PHY 계층의 상부 부분들이 CRAN/vBBUP에 의해 동작되고 PHY 계층의 하부 부분들이 개별 RAN 노드들에 의해 동작되는 "하부 PHY" 분할을 구현할 수 있다. 이러한 가상화된 프레임워크는 RAN 노드(918) 또는 RAN 노드(920)의 프리드-업(freed-up) 프로세서 코어들이 다른 가상화된 애플리케이션들을 수행할 수 있게 한다. 일부 구현예들에서, 개별 RAN 노드는 개별 F1 인터페이스들(도 9에 의해 도시되지 않음)을 통해 gNB-CU에 접속되는 개별 gNB-DU들을 표현할 수 있다. 이들 구현예들에서, gNB-DU들은 하나 이상의 원격 라디오 헤드들 또는 RFEM들을 포함할 수 있고, gNB-CU는 (R)AN(916)(도시되지 않음)에 위치되는 서버에 의해 또는 CRAN/vBBUP와 유사한 방식으로 서버 풀에 의해 동작될 수 있다. 추가적으로 또는 대안적으로, RAN 노드(918) 또는 RAN 노드(920) 중 하나 이상은 차세대 eNB들(ng-eNB들)일 수 있고, 이는 E-UTRA 사용자 평면 및 제어 평면 프로토콜 종단부들을 UE(902) 및 UE(904)를 향해 제공하고 NG 인터페이스(아래에서 논의됨)를 통해 SGC에 접속되는 RAN 노드들이다. V2X 시나리오들에서, RAN 노드(918) 또는 RAN 노드(920) 중 하나 이상은 RSU들이거나 그들로서 작용할 수 있다.
용어 "노변 유닛(Road Side Unit)" 또는 "RSU"는 V2X 통신들에 사용되는 임의의 운송 기반구조 엔티티를 지칭할 수 있다. RSU는 적합한 RAN 노드 또는 정지식(또는 비교적 정지식) UE에서 또는 그에 의해 구현될 수 있고, 여기서 UE에서 또는 그에 의해 구현되는 RSU는 "UE-형 RSU"로 지칭될 수 있고, eNB에서 또는 그에 의해 구현되는 RSU는 "eNB-형 RSU"로 지칭될 수 있고, gNB에서 또는 그에 의해 구현되는 RSU는 "gNB-형 RSU"로 지칭될 수 있는 등등이다. 일례에서, RSU는 통과 차량 UE들(vUE들)에 대한 접속성 지원을 제공하는, 노변 상에 위치된 무선 주파수 회로부와 커플링된 컴퓨팅 디바이스이다. RSU는 또한 교차 맵 기하구조, 트래픽 통계, 매체들뿐만 아니라 진행 중인 차량 및 보행자 트래픽을 감지하고 제어하기 위한 애플리케이션들/소프트웨어를 저장하기 위한 내부 데이터 저장 회로부를 포함할 수 있다. RSU는 충돌 회피, 트래픽 경고들 등과 같은 고속 이벤트들에 필요한 매우 낮은 레이턴시 통신들을 제공하기 위해 5.9 ㎓ DSRC(Direct Short Range Communications) 대역에서 동작할 수 있다. 추가적으로 또는 대안적으로, RSU는 셀룰러 V2X 대역에서 동작하여 전술된 낮은 레이턴시 통신들뿐만 아니라 다른 셀룰러 통신 서비스들을 제공할 수 있다. 부가적으로 또는 대안적으로, RSU는 Wi-Fi 핫스팟(2.4 ㎓ 대역)으로서 동작할 수 있고 그리고/또는 하나 이상의 셀룰러 네트워크들에 대한 연결을 제공하여 업링크 및 다운링크 통신들을 제공할 수 있다. 컴퓨팅 디바이스(들) 및 RSU의 무선 주파수 회로부의 일부 또는 전부는 실외 설치에 적합한 내후성 인클로저(weatherproof enclosure) 내에 패키징될 수 있고, 유선 연결(예를 들어, 이더넷)을 트래픽 신호 제어기 및/또는 백홀 네트워크에 제공하기 위한 네트워크 인터페이스 제어기를 포함할 수 있다.
RAN 노드(918) 및/또는 RAN 노드(920)는 에어 인터페이스 프로토콜을 종단할 수 있고, UE(902) 및 UE(904)에 대한 제1 접촉 포인트일 수 있다. 일부 실시 형태들에서, RAN 노드(918) 및/또는 RAN 노드(920)는 무선 베어러 관리, 업링크 및 다운링크 동적 무선 리소스 관리 및 데이터 패킷 스케줄링, 및 이동성 관리와 같은 무선 네트워크 제어기(RNC) 기능들을 포함하지만 이들로 제한되지 않는 (R)AN(916)에 대한 다양한 논리적 기능들을 이행할 수 있다.
실시 형태들에서, UE(902) 및 UE(904)는 OFDMA 통신 기법(예컨대, 다운링크 통신들의 경우) 또는 SC-FDMA 통신 기법(예컨대, 업링크 및 ProSe 또는 사이드링크 통신들의 경우)과 같은, 그러나 이들로 제한되지 않는, 다양한 통신 기법들에 따라 멀티캐리어 통신 채널을 통해 서로 또는 RAN 노드(918) 및/또는 RAN 노드(920)와 OFDM 통신 신호들을 사용하여 통신하도록 구성될 수 있지만, 실시 형태들의 범주가 이러한 점에서 제한되지는 않는다. OFDM 신호들은 복수의 직교 서브캐리어들을 포함할 수 있다.
일부 실시 형태들에서, 다운링크 리소스 그리드는 RAN 노드(918) 및/또는 RAN 노드(920)로부터 UE(902) 및 UE(904)로의 다운링크 송신들을 위해 사용될 수 있는 한편, 업링크 송신들은 유사한 기법들을 활용할 수 있다. 그리드는, 리소스 그리드 또는 시간 주파수 리소스 그리드로 지칭되는 시간 주파수 그리드일 수 있고, 이는 각각의 슬롯 내의 다운링크에서의 물리적 리소스이다. 그러한 시간 주파수 평면 표현은 OFDM 시스템들에 대해 통상적인 관행이며, 이는 무선 리소스 할당에 대해 그것을 직관적으로 만든다. 리소스 그리드의 각각의 컬럼(column) 및 각각의 로우(row)는 하나의 OFDM 심볼 및 하나의 OFDM 서브캐리어에 각각 대응한다. 시간 도메인에서의 리소스 그리드의 지속기간은 무선 프레임 내의 하나의 슬롯에 대응한다. 리소스 그리드에서의 최소 시간 주파수 유닛은 리소스 요소로 표기된다. 각각의 리소스 그리드는 다수의 리소스 블록들을 포함하는데, 이들은 리소스 요소들에 대한 소정의 물리적 채널들의 맵핑을 설명한다. 각각의 리소스 블록은 리소스 요소들의 집합체를 포함하고; 주파수 도메인에서, 이것은 현재 할당될 수 있는 최소량의 리소스들을 표현할 수 있다. 그러한 리소스 블록들을 사용하여 전달되는 여러 개의 상이한 물리적 다운링크 채널들이 존재한다.
다양한 실시 형태들에 따르면, UE(902) 및 UE(904)와, RAN 노드(918) 및/또는 RAN 노드(920)는 허가 매체(또한 "허가 스펙트럼" 및/또는 "허가 대역"으로 지칭됨) 및 비허가 공유 매체(또한 "비허가 스펙트럼" 및/또는 "비허가 대역"으로 지칭됨)를 통해 데이터를 통신(예를 들어, 송신 및 수신)한다. 허가 스펙트럼은 대략 400 ㎒ 내지 대략 3.8 ㎓의 주파수 범위에서 동작하는 채널들을 포함할 수 있는 반면, 비허가 스펙트럼은 5 ㎓ 대역을 포함할 수 있다.
비허가 스펙트럼에서 동작하기 위해, UE(902) 및 UE(904)와, RAN 노드(918) 또는 RAN 노드(920)는 LAA, eLAA, 및/또는 feLAA 메커니즘들을 사용하여 동작할 수 있다. 이들 구현예들에서, UE(902) 및 UE(904)와, RAN 노드(918) 또는 RAN 노드(920)는 비허가 스펙트럼에서 송신하기 전에 비허가 스펙트럼 내의 하나 이상의 채널들이 이용가능하지 않거나 달리 점유되는지 여부를 결정하기 위해 하나 이상의 알려진 매체 감지 동작들 및/또는 캐리어 감지 동작들을 수행할 수 있다. 매체/캐리어 감지 동작들은 LBT(listen-before-talk) 프로토콜에 따라 수행될 수 있다.
LBT는, 장비(예를 들어, UE(902) 및 UE(904)와, RAN 노드(918) 또는 RAN 노드(920) 등)가 매체(예를 들어, 채널 또는 캐리어 주파수)를 감지하고 매체가 유휴 상태(idle)로 감지될 때(또는 매체 내의 특정 채널이 점유되지 않은 것으로 감지될 때) 송신하는 메커니즘이다. 매체 감지 동작은 CCA를 포함할 수 있는데, 이는 채널이 점유되거나 클리어(clear)한지를 결정하기 위해 채널 상의 다른 신호들의 존재 또는 부재를 결정하도록 적어도 ED를 활용한다. 이러한 LBT 메커니즘은 셀룰러/LAA 네트워크들이 비허가 스펙트럼 내의 기존 시스템들과 그리고 다른 LAA 네트워크들과 공존할 수 있게 한다. ED는 일정 기간 동안 의도된 송신 대역을 가로질러 RF 에너지를 감지하는 것 및 감지된 RF 에너지를 미리정의된 또는 구성된 임계치와 비교하는 것을 포함할 수 있다.
전형적으로, 5 ㎓ 대역 내의 기존 시스템들은 IEEE 802.11 기술들에 기초한 WLAN들이다. WLAN은 CSMA/CA로 불리는 경합 기반 채널 액세스 메커니즘을 이용한다. 여기서, WLAN 노드(예컨대, UE(902), AP(912) 등과 같은 이동국(MS))가 송신하고자 할 때, WLAN 노드는 송신 전에 CCA를 먼저 수행할 수 있다. 추가적으로, 하나 초과의 WLAN 노드가 채널을 유휴 상태로 감지하고 동시에 송신하는 상황들에서 충돌들을 피하기 위해 백오프 메커니즘이 사용된다. 백오프 메커니즘은 CWS 내에서 랜덤으로 도출되는 카운터일 수 있고, 이는 충돌의 발생 시 지수적으로 증가되고, 송신이 성공할 때 최소 값으로 리셋된다. LAA를 위해 설계된 LBT 메커니즘은 WLAN의 CSMA/CA와 다소 유사하다. 일부 구현예들에서, PDSCH 또는 PUSCH 송신들을 각각 포함하는 DL 또는 UL 송신 버스트(burst)들에 대한 LBT 절차는, X와 Y ECCA 슬롯들 사이에서 길이가 가변적인 LAA 경합 윈도우를 가질 수 있고, 여기서 X 및 Y는 LAA를 위한 CWS들에 대한 최소 값 및 최대 값이다. 일례에서, LAA 송신을 위한 최소 CWS는 9 마이크로초(μs)일 수 있지만; CWS 및 MCOT(예를 들어, 송신 버스트)의 크기는 정부 규제 요건들에 기초할 수 있다.
LAA 메커니즘들은 LTE 어드밴스드 시스템들의 CA 기술들을 기반으로 구축된다. CA에서, 각각의 집성된 캐리어는 CC로 지칭된다. CC는 1.4, 3, 5, 10, 15 또는 20 ㎒의 대역폭을 가질 수 있고, 최대 5개의 CC들이 집성될 수 있고, 따라서 최대 집성된 대역폭은 100 ㎒이다. FDD 시스템들에서, 집성된 캐리어들의 수는 DL 및 UL에 대해 상이할 수 있는데, 여기서 UL CC들의 수는 DL 컴포넌트 캐리어들의 수 이하이다. 일부 경우들에서, 개별 CC들은 다른 CC들과는 상이한 대역폭을 가질 수 있다. TDD 시스템들에서, CC들의 수뿐만 아니라 각각의 CC의 대역폭들은 통상적으로 DL 및 UL에 대해 동일하다.
CA는 또한 개별 CC들을 제공하기 위한 개별 서빙 셀(serving cell)들을 포함한다. 서빙 셀들의 커버리지는, 예를 들어, 상이한 주파수 대역들 상의 CC들이 상이한 경로 손실을 경험할 것이기 때문에 상이할 수 있다. 1차 서비스 셀 또는 PCell은 UL 및 DL 둘 모두에 대한 PCC를 제공할 수 있고, RRC 및 NAS 관련 활동들을 핸들링할 수 있다. 다른 서빙 셀들은 SCell들로 지칭되고, 각각의 SCell은 UL 및 DL 둘 모두에 대한 개별 SCC를 제공할 수 있다. SCC들은 요구에 따라 추가되고 제거될 수 있는 한편, PCC를 변경하는 것은 UE(902)가 핸드오버를 겪을 것을 요구할 수 있다. LAA, eLAA, 및 feLAA에서, SCell들 중 일부 또는 전부는 비허가 스펙트럼에서 동작할 수 있고("LAA SCell들"로 지칭됨), LAA SCell들은 허가 스펙트럼에서 동작하는 PCell에 의해 보조된다. UE가 하나 초과의 LAA SCell로 구성될 때, UE는 동일한 서브프레임 내에서 상이한 PUSCH 시작 포지션들을 나타내는 UL 승인들을 구성된 LAA SCell들 상에서 수신할 수 있다.
PDSCH는 사용자 데이터 및 상위 계층 시그널링을 UE(902) 및 UE(904)에 전달한다. PDCCH는, 다른 것들 중에서, PDSCH 채널과 관련된 전송 포맷 및 리소스 할당들에 관한 정보를 전달한다. 그것은 또한 업링크 공유 채널에 관련된 전송 포맷, 리소스 할당, 및 HARQ 정보에 관해 UE(902) 및 UE(904)에 통지할 수 있다. 전형적으로, 다운링크 스케줄링(셀 내의 UE(904)에 제어 및 공유 채널 리소스 블록들을 할당하는 것)은 UE(902) 및 UE(904) 중 임의의 것으로부터 피드백되는 채널 품질 정보에 기초하여 RAN 노드(918) 또는 RAN 노드(920) 중 임의의 것에서 수행될 수 있다. 다운링크 리소스 할당 정보는 UE(902) 및 UE(904) 각각에 대해 사용되는(예를 들어, 그에 할당되는) PDCCH 상에서 전송될 수 있다.
PDCCH는 CCE들을 사용하여 제어 정보를 전달한다. 리소스 요소들에 맵핑되기 전에, PDCCH 복소값 심볼들은 먼저 쿼드러플릿(quadruplet)들로 조직화될 수 있는데, 이들은 이어서 레이트 매칭을 위해 서브 블록 인터리버(sub-block interleaver)를 사용하여 치환될 수 있다. 각각의 PDCCH는 이들 CCE들 중 하나 이상을 사용하여 송신될 수 있고, 여기서 각각의 CCE는 REG들로 알려진 4개의 물리적 리소스 요소들의 9개의 세트들에 대응할 수 있다. 4개의 직교 위상 시프트 키잉(Quadrature Phase Shift Keying, QPSK) 심볼들이 각각의 REG에 맵핑될 수 있다. PDCCH는, DCI의 크기 및 채널 조건에 따라, 하나 이상의 CCE들을 사용하여 송신될 수 있다. 상이한 수들의 CCE들(예컨대, 집성 레벨, L = 1, 2, 4, 또는 8)로 LTE에서 정의된 4개 이상의 상이한 PDCCH 포맷들이 존재할 수 있다.
일부 실시 형태들은 전술된 개념들의 확장인, 제어 채널 정보를 위한 리소스 할당에 대한 개념들을 사용할 수 있다. 예를 들어, 일부 실시 형태들은 제어 정보 송신을 위해 PDSCH 리소스들을 사용하는 EPDCCH를 활용할 수 있다. EPDCCH는 하나 이상의 ECCE들을 사용하여 송신될 수 있다. 상기와 유사하게, 각각의 ECCE는 EREG들로 알려진 4개의 물리적 리소스 요소들의 9개의 세트들에 대응할 수 있다. ECCE는 일부 상황들에서 다른 수들의 EREG들을 가질 수 있다.
RAN 노드(918) 또는 RAN 노드(920)는 인터페이스(922)를 통해 서로 통신하도록 구성될 수 있다. 시스템(900)이 LTE 시스템인 실시 형태들에서(예컨대, 코어 네트워크(core network, CN)(930)가 EPC일 때), 인터페이스(922)는 X2 인터페이스일 수 있다. X2 인터페이스는 EPC에 접속하는 2개 이상의 RAN 노드들(예컨대, 2개 이상의 eNB들 등) 사이에서, 그리고/또는 EPC에 접속하는 2개의 eNB들 사이에서 정의될 수 있다. 일부 구현예들에서, X2 인터페이스는 X2 사용자 평면 인터페이스(X2-U) 및 X2 제어 평면 인터페이스(X2-C)를 포함할 수 있다. X2-U는 X2 인터페이스를 통해 전송되는 사용자 데이터 패킷들에 대한 흐름 제어 메커니즘들을 제공할 수 있고, eNB들 사이의 사용자 데이터의 전달에 관한 정보를 통신하는 데 사용될 수 있다. 예를 들어, X2-U는 MeNB로부터 SeNB에 전송되는 사용자 데이터에 대한 특정 시퀀스 번호 정보; 사용자 데이터에 대한 SeNB로부터 UE(902)로의 PDCP PDU들의 성공적인 순차적 전달에 관한 정보; UE(902)로 전달되지 않았던 PDCP PDU들의 정보; UE 사용자 데이터로 송신하기 위한 SeNB에서의 현재 최소 원하는 버퍼 크기에 관한 정보 등을 제공할 수 있다. X2-C는, 소스로부터 타깃 eNB들로의 콘텍스트 전송들, 사용자 평면 전송 제어 등을 포함하는 인트라-LTE(intra-LTE) 액세스 이동성 기능; 부하 관리 기능; 뿐만 아니라 인터-셀(inter-cell) 간섭 조정 기능을 제공할 수 있다.
시스템(900)이 SG 또는 NR 시스템인 실시 형태들에서(예컨대, CN(930)이 SGC일 때), 인터페이스(922)는 Xn 인터페이스일 수 있다. Xn 인터페이스는 SGC에 접속하는 2개 이상의 RAN 노드들(예컨대, 2개 이상의 gNB들 등) 사이에서, SGC에 접속하는 RAN 노드(918)(예컨대, gNB)와 eNB 사이에서, 그리고/또는 5GC(예컨대, CN(930))에 접속하는 2개의 eNB들 사이에서 정의된다. 일부 구현예들에서, Xn 인터페이스는 Xn 사용자 평면(Xn-U) 인터페이스 및 Xn 제어 평면(Xn-C) 인터페이스를 포함할 수 있다. Xn-U는 사용자 평면 PDU들의 비-보장된 전달을 제공하고 데이터 포워딩 및 흐름 제어 기능을 지원/제공할 수 있다. Xn-C는 관리 및 에러 핸들링 기능, Xn-C 인터페이스를 관리하는 기능; 하나 이상의 RAN 노드(918) 또는 RAN 노드(920) 사이의 접속 모드에 대한 UE 이동성을 관리하기 위한 기능을 포함하는 접속 모드(예컨대, CM-CONNECTED)에서의 UE(902)에 대한 이동성 지원을 제공할 수 있다. 이동성 지원은 오래된(소스) 서빙 RAN 노드(918)로부터 새로운(타깃) 서빙 RAN 노드(920)로의 콘텍스트 전송; 및 오래된(소스) 서빙 RAN 노드(918)와 새로운(타깃) 서빙 RAN 노드(920) 사이의 사용자 평면 터널들의 제어를 포함할 수 있다. Xn-U의 프로토콜 스택은 인터넷 프로토콜(IP) 전송 계층 상에 구축된 전송 네트워크 계층, 및 사용자 평면 PDU들을 전달하기 위한 UDP 및/또는 IP 계층(들)의 상부 상의 GTP-U 계층을 포함할 수 있다. Xn-C 프로토콜 스택은 애플리케이션 계층 시그널링 프로토콜(Xn 애플리케이션 프로토콜(Xn-AP)로 지칭됨) 및 SCTP 상에 구축되는 전송 네트워크 계층을 포함할 수 있다. SCTP는 IP 계층의 상부 상에 있을 수 있고, 애플리케이션 계층 메시지들의 보장된 전달을 제공할 수 있다. 전송 IP 계층에서, 포인트-투-포인트(point-to-point) 송신은 시그널링 PDU들을 전달하는 데 사용된다. 다른 구현예들에서, Xn-U 프로토콜 스택 및/또는 Xn-C 프로토콜 스택은 본 명세서에 도시되고 설명된 사용자 평면 및/또는 제어 평면 프로토콜 스택(들)과 동일하거나 유사할 수 있다.
(R)AN(916)은 코어 네트워크, 이러한 실시 형태에서는 CN(930)에 통신가능하게 커플링되는 것으로 도시된다. CN(930)은 하나 이상의 네트워크 요소들(932)을 포함할 수 있는데, 이들은 (R)AN(916)을 통해 CN(930)에 접속되는 고객들/가입자들(예컨대, UE(902) 및 UE(904)의 사용자들)에게 다양한 데이터 및 전기통신 서비스들을 제공하도록 구성된다. CN(930)의 컴포넌트들은 기계 판독가능 또는 컴퓨터 판독가능 매체(예컨대, 비일시적 기계 판독가능 저장 매체)로부터 명령어들을 판독하고 실행하기 위한 컴포넌트들을 포함하는 하나의 물리적 노드 또는 별개의 물리적 노드들에서 구현될 수 있다. 일부 실시 형태들에서, NFV는 하나 이상의 컴퓨터 판독가능 저장 매체들에 저장된 실행가능 명령어들을 통해 전술된 네트워크 노드 기능들 중 임의의 것 또는 전부를 가상화하기 위해 활용될 수 있다(이하에서 추가로 상세히 설명됨). CN(930)의 로직 인스턴스화(logical instantiation)는 네트워크 슬라이스로 지칭될 수 있고, CN(930)의 일부분의 로직 인스턴스화는 네트워크 서브슬라이스로 지칭될 수 있다. NFV 아키텍처들 및 기반구조들은, 산업 표준 서버 하드웨어, 저장 하드웨어, 또는 스위치들의 조합을 포함하는 물리적 리소스들 상으로, 대안적으로는 사설 하드웨어에 의해 수행되는 하나 이상의 네트워크 기능들을 가상화하는 데 사용될 수 있다. 다시 말하면, NFV 시스템들은 하나 이상의 EPC 컴포넌트들/기능들의 가상 또는 재구성가능 구현예들을 실행하는 데 사용될 수 있다.
대체적으로, 애플리케이션 서버(934)는 코어 네트워크와의 IP 베어러 리소스들(예컨대, UMTS PS 도메인, LTE PS 데이터 서비스들 등)을 사용하는 애플리케이션들을 제공하는 요소일 수 있다. 애플리케이션 서버(934)는 또한 EPC를 통해 UE(902) 및 UE(904)에 대한 하나 이상의 통신 서비스들(예컨대, VoIP 세션들, PTT 세션들, 그룹 통신 세션들, 소셜 네트워킹 서비스들 등)을 지원하도록 구성될 수 있다. 애플리케이션 서버(934)는 IP 통신 인터페이스(936)를 통해 CN(930)과 통신할 수 있다.
실시 형태들에서, CN(930)은 SGC일 수 있고, (R)AN(116)은 NG 인터페이스(924)를 통해 CN(930)과 접속될 수 있다. 실시 형태들에서, NG 인터페이스(924)는 2개의 부분들, 즉 RAN 노드(918) 또는 RAN 노드(920)와 UPF 사이에서 트래픽 데이터를 전달하는 NG 사용자 평면(NG-U) 인터페이스(926), 및 RAN 노드(918) 또는 RAN 노드(920)와 AMF들 사이의 시그널링 인터페이스인 S1 제어 평면(NG-C) 인터페이스(928)로 분할될 수 있다.
실시 형태들에서, CN(930)은 SG CN일 수 있는 한편, 다른 실시 형태들에서, CN(930)은 EPC일 수 있다. CN(930)이 EPC인 경우, (R)AN(116)은 S1 인터페이스(924)를 통해 CN(930)과 접속될 수 있다. 실시 형태들에서, S1 인터페이스(924)는 2개의 부분들, 즉, RAN 노드(918) 또는 RAN 노드(920)와 S-GW 사이에서 트래픽 데이터를 전달하는 S1 사용자 평면(S1-U) 인터페이스(926), 및 RAN 노드(918) 또는 RAN 노드(920)와 MME들 사이의 시그널링 인터페이스인 S1-MME 인터페이스(928)로 분할될 수 있다.
도 10은 다양한 실시 형태들에 따른 기반구조 장비(1000)의 일례를 예시한다. 기반구조 장비(1000)는 기지국, 무선 헤드, RAN 노드, AN, 애플리케이션 서버, 및/또는 본 명세서에서 논의되는 임의의 다른 요소/디바이스로서 구현될 수 있다. 다른 예들에서, 기반구조 장비(1000)는 UE에서 또는 UE에 의해 구현될 수 있다.
기반구조 장비(1000)는 애플리케이션 회로부(1002), 기저대역 회로부(1004), 하나 이상의 무선 프론트 엔드 모듈(radio front end module, RFEM)(1006), 메모리 회로부(1008), 전력 관리 집적 회로부(power management integrated circuitry, PMIC(1010)로 도시됨), 전력 티(tee) 회로부(1012), 네트워크 제어기 회로부(1014), 네트워크 인터페이스 접속기(1020), 위성 포지셔닝 회로부(1016), 및 사용자 인터페이스 회로부(1018)를 포함한다. 일부 실시 형태들에서, 디바이스 기반구조 장비(1000)는, 예를 들어 메모리/저장소, 디스플레이, 카메라, 센서, 또는 입/출력(I/O) 인터페이스와 같은 추가적인 요소들을 포함할 수 있다. 다른 실시 형태들에서, 후술되는 컴포넌트들은 하나 초과의 디바이스에 포함될 수 있다. 예를 들어, 상기 회로부들은 CRAN, vBBU, 또는 다른 유사한 구현예들을 위해 하나 초과의 디바이스에 개별적으로 포함될 수 있다. 애플리케이션 회로부(1002)는, 하나 이상의 프로세서들(또는 프로세서 코어들), 캐시 메모리, 및 LDO(low drop-out) 전압 레귤레이터들, 인터럽트 제어기들, 직렬 인터페이스들, 예컨대 SPI, I2C, 또는 범용 프로그래밍가능 직렬 인터페이스 모듈, RTC(real time clock), 간격 및 감시(watchdog) 타이머들을 포함하는 타이머-카운터들, 범용 입/출력(I/O 또는 IO), SD(Secure Digital) MMC(MultiMediaCard) 또는 유사물과 같은 메모리 카드 제어기들, USB(Universal Serial Bus) 인터페이스들, MIPI(Mobile Industry Processor Interface) 인터페이스들, 및 JTAG(Joint Test Access Group) 테스트 액세스 포트들 중 하나 이상과 같은, 그러나 이들로 제한되지 않는 회로부를 포함한다. 애플리케이션 회로부(1002)의 프로세서들(또는 코어들)은 메모리/저장 요소들과 커플링되거나 이를 포함할 수 있고, 메모리/저장소에 저장된 명령어들을 실행시켜 다양한 애플리케이션들 또는 운영 체제들이 기반구조 장치(1000) 상에서 실행될 수 있게 하도록 구성될 수 있다. 일부 구현예들에서, 메모리/저장 요소들은 임의의 적합한 휘발성 및/또는 비휘발성 메모리, 예컨대 DRAM(dynamic random access memory), SRAM(static random-access memory), EPROM(erasable programmable read-only memory), EEPROM(electrically erasable programmable read-only memory), 플래시 메모리, 솔리드 스테이트 메모리, 및/또는 임의의 다른 유형의 메모리 디바이스 기술, 예컨대 본 명세서에서 논의되는 것들을 포함할 수 있는 온-칩 메모리 회로부일 수 있다.
애플리케이션 회로부(1002)의 프로세서(들)는, 예를 들어, 하나 이상의 프로세서 코어들(CPU들), 하나 이상의 애플리케이션 프로세서들, 하나 이상의 그래픽 처리 유닛(graphics processing unit, GPU)들, 하나 이상의 감소된 명령어 세트 컴퓨팅(reduced instruction set computing, RISC) 프로세서들, 하나 이상의 아콘 RISC 기계(Acorn RISC Machine, ARM) 프로세서들, 하나 이상의 복합 명령어 세트 컴퓨팅(complex instruction set computing, CISC) 프로세서들, 하나 이상의 디지털 신호 프로세서(digital signal processor, DSP)들, 하나 이상의 FPGA(field-programmable gate array)들, 하나 이상의 PLD(programmable logic device)들, 하나 이상의 ASIC(application specific integrated circuit)들, 하나 이상의 마이크로프로세서들 또는 제어기들, 또는 이들의 임의의 적합한 조합을 포함할 수 있다. 일부 실시 형태들에서, 애플리케이션 회로부(1002)는 본 명세서의 다양한 실시 형태들에 따라 동작하기 위한 특수 목적 프로세서/제어기일 수 있거나, 이를 포함할 수 있다. 예들로서, 애플리케이션 회로부(1002)의 프로세서(들)는 하나 이상의 Intel Pentium®, Core®, 또는 Xeon® 프로세서(들); AMD(Advanced Micro Devices) Ryzen® 프로세서(들), APU(Accelerated Processing Unit)들, 또는 Epyc® 프로세서들; ARM Holdings, Ltd.로부터 허가된 ARM-기반 프로세서(들), 예컨대, ARM Cortex-A계 프로세서들 및 Cavium(TM), Inc.에 의해 제공되는 ThunderX2®; MIPS Technologies, Inc.로부터의 MIPS-기반 설계, 예컨대, MIPS Warrior P-클래스 프로세서들; 등을 포함할 수 있다. 일부 실시 형태들에서, 기반구조 장비(1000)는 애플리케이션 회로부(1002)를 이용하지 못할 수 있고, 대신에, 예를 들어, EPC 또는 5GC로부터 수신된 IP 데이터를 프로세싱하기 위한 특수 목적 프로세서/제어기를 포함할 수 있다.
일부 구현예들에서, 애플리케이션 회로부(1002)는 마이크로프로세서들, 프로그래밍가능 프로세싱 디바이스들 등일 수 있는 하나 이상의 하드웨어 가속기들을 포함할 수 있다. 하나 이상의 하드웨어 가속기들은, 예를 들어, 컴퓨터 비전(computer vision, CV) 및/또는 딥 러닝(deep learning, DL) 가속기들을 포함할 수 있다. 예들로서, 프로그래밍가능 프로세싱 디바이스들은 하나 이상의 FPD(field-programmable device)들, 예컨대, FPGA들 등; PLD들, 예컨대, CPLD(complex PLD)들, HCPLD(high-capacity PLD)들 등; ASIC들, 예컨대, 구조화된 ASIC들 등; 프로그래밍가능 SoC(PSoC)들; 등일 수 있다. 그러한 구현예들에서, 애플리케이션 회로부(1002)의 회로부는 로직 블록들 또는 로직 구조(logic fabric), 및 본 명세서에서 논의되는 다양한 실시 형태들의 절차들, 방법들, 기능들 등과 같은 다양한 기능들을 수행하도록 프로그래밍될 수 있는 다른 상호접속된 리소스들을 포함할 수 있다. 그러한 실시 형태들에서, 애플리케이션 회로부(1002)의 회로부는 로직 블록들, 로직 구조, 데이터 등을 룩업 테이블(look-up-table, LUT)들 등에 저장하기 위해 사용되는 메모리 셀들(예컨대, EPROM, EEPROM, 플래시 메모리, 정적 메모리(예컨대, SRAM, 안티-퓨즈들 등))을 포함할 수 있다. 기저대역 회로부(1004)는, 예를 들어, 하나 이상의 집적 회로들을 포함하는 솔더-다운 기판, 메인 회로 보드에 솔더링된 단일 패키징 집적 회로, 또는 2개 이상의 집적 회로들을 포함하는 멀티-칩 모듈로서 구현될 수 있다.
사용자 인터페이스 회로부(1018)는 기반구조 장비(1000)와의 사용자 상호작용을 가능하게 하도록 설계된 하나 이상의 사용자 인터페이스들 또는 기반구조 장비(1000)와의 주변 컴포넌트 상호작용을 가능하게 하도록 설계된 주변 컴포넌트 인터페이스들을 포함할 수 있다. 사용자 인터페이스들은 하나 이상의 물리적 또는 가상 버튼들(예컨대, 리셋 버튼), 하나 이상의 표시자들(예컨대, LED(light emitting diode)들), 물리적 키보드 또는 키패드, 마우스, 터치패드, 터치스크린, 스피커들 또는 다른 오디오 방출 디바이스들, 마이크로폰들, 프린터, 스캐너, 헤드셋, 디스플레이 스크린 또는 디스플레이 디바이스 등을 포함할 수 있지만, 이들로 제한되지 않는다. 주변 컴포넌트 인터페이스들은 비휘발성 메모리 포트, USB 포트, 오디오 잭(jack), 전력 공급원 인터페이스 등을 포함할 수 있지만, 이들로 제한되지 않는다.
무선 프론트 엔드 모듈(RFEM)(1006)은 밀리미터파(mmWave) RFEM 및 하나 이상의 서브-mmWave RFIC(radio frequency integrated circuit)들을 포함할 수 있다. 일부 구현예들에서, 하나 이상의 서브-mmWave RFIC들은 mmWave RFEM으로부터 물리적으로 분리될 수 있다. RFIC들은 하나 이상의 안테나들 또는 안테나 어레이들에 대한 접속부들을 포함할 수 있고, RFEM은 다수의 안테나들에 접속될 수 있다. 대안적인 구현예들에서, mmWave 및 서브-mmWave 무선 기능들 둘 모두는 mmWave 안테나들 및 서브-mmWave 둘 모두를 통합하는 동일한 물리적 무선 프론트 엔드 모듈(1006)에서 구현될 수 있다.
메모리 회로부(1008)는 DRAM 및/또는 SDRAM(synchronous dynamic random access memory)을 포함하는 휘발성 메모리, 및 고속 전기 소거가능 메모리(일반적으로, 플래시 메모리로 지칭됨), PRAM(phase change random access memory), MRAM(magnetoresistive random access memory) 등을 포함하는 비휘발성 메모리(nonvolatile memory, NVM) 중 하나 이상을 포함할 수 있고, Intel® 및 Micron®로부터의 3차원(3D) XPOINT(cross-point) 메모리들을 포함할 수 있다. 메모리 회로부(1008)는 솔더 다운 패키징된 집적 회로들, 소켓형 메모리 모듈들, 및 플러그인(plug-in) 메모리 카드들 중 하나 이상으로서 구현될 수 있다.
PMIC(1010)는 전압 조절기들, 서지(surge) 보호기들, 전력 알람 검출 회로부, 및 배터리 또는 커패시터(capacitor)와 같은 하나 이상의 백업 전원들을 포함할 수 있다. 전력 알람 검출 회로부는 전압 저하(brown out)(전압 부족) 및 서지(과전압) 조건들 중 하나 이상을 검출할 수 있다. 전력 티 회로부(1012)는 단일 케이블을 사용하여 기반구조 장비(1000)에 전력 공급 및 데이터 접속 둘 모두를 제공하기 위해 네트워크 케이블로부터 인출되는 전기 전력을 제공할 수 있다.
네트워크 제어기 회로부(1014)는 이더넷(Ethernet), GRE 터널들을 통한 이더넷, MPLS(Multiprotocol Label Switching)를 통한 이더넷, 또는 일부 다른 적합한 프로토콜과 같은 표준 네트워크 인터페이스 프로토콜을 사용하여 네트워크에 대한 접속을 제공할 수 있다. 네트워크 접속은 전기(통상 "구리 상호접속"으로 지칭됨), 광학, 또는 무선일 수 있는 물리적 접속부를 사용하여 네트워크 인터페이스 접속기(1020)를 통해 기반구조 장비(1000)에/로부터 제공될 수 있다. 네트워크 제어기 회로부(1014)는 전술한 프로토콜들 중 하나 이상을 사용하여 통신하기 위한 하나 이상의 전용 프로세서들 및/또는 FPGA들을 포함할 수 있다. 일부 구현예들에서, 네트워크 제어기 회로부(1014)는 동일하거나 상이한 프로토콜들을 사용하여 다른 네트워크들에 대한 접속을 제공하기 위해 다수의 제어기들을 포함할 수 있다.
포지셔닝 회로부(1016)는 GNSS(global navigation satellite system)의 포지셔닝 네트워크에 의해 송신/브로드캐스트되는 신호들을 수신 및 디코딩하기 위한 회로부를 포함한다. 내비게이션 위성 콘스텔레이션(navigation satellite constellation)들(또는 GNSS)의 예들은 미국의 GPS(Global Positioning System), 러시아의 GLONASS(Global Navigation System), 유럽 연합의 갈릴레오(Galileo) 시스템, 중국의 베이더우(BeiDou) 내비게이션 위성 시스템, 지역 내비게이션 시스템 또는 GNSS 증강 시스템(예컨대, NAVIC(Navigation with Indian Constellation), 일본의 QZSS(Quasi-Zenith Satellite System), 프랑스의 DORIS(Doppler Orbitography and Radio-positioning Integrated by Satellite) 등) 등을 포함한다. 포지셔닝 회로부(1016)는 내비게이션 위성 콘스텔레이션 노드들과 같은 포지셔닝 네트워크의 컴포넌트들과 통신하기 위해 다양한 하드웨어 요소들(예컨대, OTA 통신을 용이하게 하기 위한 스위치들, 필터들, 증폭기들, 안테나 요소들 등과 같은 하드웨어 디바이스들을 포함함)을 포함한다. 일부 실시 형태들에서, 포지셔닝 회로부(1016)는 마스터 타이밍 클록을 사용하여 GNSS 보조 없이 포지션 추적/추정을 수행하는 Micro-PNT(Micro-Technology for Positioning, Navigation, and Timing) IC를 포함할 수 있다. 포지셔닝 회로부(1016)는 또한 포지셔닝 네트워크의 노드들 및 컴포넌트들과 통신하기 위해, 기저대역 회로부(1004) 및/또는 무선 프론트 엔드 모듈(1006)의 일부이거나 그와 상호작용할 수 있다. 포지셔닝 회로부(1016)는 또한 포지션 데이터 및/또는 시간 데이터를 애플리케이션 회로부(1002)에 제공할 수 있고, 이는 데이터를 사용하여 다양한 기반구조와 동작들을 동기화하는 등을 할 수 있다. 도 10에 의해 도시된 컴포넌트들은, ISA(industry standard architecture), EISA(extended ISA), PCI(peripheral component interconnect), PCix(peripheral component interconnect extended), PCie(PCI express), 또는 임의의 수의 다른 기술들과 같은 임의의 수의 버스 및/또는 상호접속(IX) 기술들을 포함할 수 있는 인터페이스 회로부를 사용하여 서로 통신할 수 있다. 버스/IX는, 예를 들어, SoC 기반 시스템에서 사용되는 독점적 버스일 수 있다. 다른 버스/IX 시스템들, 예컨대 무엇보다도 I2C 인터페이스, SPI 인터페이스, 포인트-투-포인트 인터페이스들, 및 전력 버스가 포함될 수 있다.
도 11은 다양한 실시 형태들에 따른 플랫폼(1100)의 일례를 예시한다. 실시 형태들에서, 컴퓨터 플랫폼(1100)은 본 명세서에서 논의되는 UE들, 애플리케이션 서버들, 및/또는 임의의 다른 요소/디바이스로서 사용하기에 적합할 수 있다. 플랫폼(1100)은 예에 도시된 컴포넌트들의 임의의 조합들을 포함할 수 있다. 플랫폼(1100)의 컴포넌트들은 컴퓨터 플랫폼(1100)에 적응된 집적 회로(integrated circuit, IC)들, 그의 일부분들, 이산적인 전자 디바이스들, 또는 다른 모듈들, 로직, 하드웨어, 소프트웨어, 펌웨어, 또는 이들의 조합으로서, 또는 달리 더 큰 시스템의 섀시(chassis) 내에 통합된 컴포넌트들로서 구현될 수 있다. 도 11의 블록도는 컴퓨터 플랫폼(1100)의 컴포넌트들의 높은 레벨 뷰(view)를 도시하도록 의도된다. 그러나, 도시된 컴포넌트들 중 일부는 생략될 수 있고, 추가적인 컴포넌트들이 존재할 수 있고, 도시된 컴포넌트들의 상이한 배열이 다른 구현예들에서 발생할 수 있다.
애플리케이션 회로부(1102)는 하나 이상의 프로세서들(또는 프로세서 코어들), 캐시 메모리, 및 LDO들, 인터럽트 제어기들, 직렬 인터페이스들, 예컨대 SPI, I2C 또는 범용 프로그래밍가능 직렬 인터페이스 모듈, RTC, 간격 및 감시 타이머들을 포함하는 타이머-카운터들, 범용 I/O, SD MMC 또는 유사물과 같은 메모리 카드 제어기들, USB 인터페이스들, MIPI 인터페이스들, 및 JTAG 테스트 액세스 포트들 중 하나 이상과 같은, 그러나 이들로 제한되지 않는 회로부를 포함한다. 애플리케이션 회로부(1102)의 프로세서들(또는 코어들)은 메모리/저장 요소들과 커플링되거나 이를 포함할 수 있고, 메모리/저장소에 저장된 명령어들을 실행시켜서 다양한 애플리케이션들 또는 운영 체제들이 플랫폼(1100) 상에서 실행될 수 있게 하도록 구성될 수 있다. 일부 구현예들에서, 메모리/저장 요소들은 임의의 적합한 휘발성 및/또는 비휘발성 메모리, 예컨대 DRAM, SRAM, EPROM, EEPROM, 플래시 메모리, 솔리드 스테이트 메모리, 및/또는 임의의 다른 유형의 메모리 디바이스 기술, 예컨대 본 명세서에서 논의되는 것들을 포함할 수 있는 온-칩 메모리 회로부일 수 있다.
애플리케이션 회로부(1102)의 프로세서(들)는, 예를 들어, 하나 이상의 프로세서 코어들, 하나 이상의 애플리케이션 프로세서들, 하나 이상의 GPU들, 하나 이상의 RISC 프로세서들, 하나 이상의 ARM 프로세서들, 하나 이상의 CISC 프로세서들, 하나 이상의 DSP, 하나 이상의 FPGA들, 하나 이상의 PLD들, 하나 이상의 ASIC들, 하나 이상의 마이크로프로세서들 또는 제어기들, 멀티스레드형 프로세서, 초저전압 프로세서, 임베디드 프로세서, 일부 다른 공지된 프로세싱 요소, 또는 이들의 임의의 적합한 조합을 포함할 수 있다. 일부 실시 형태들에서, 애플리케이션 회로부(1102)는 본 명세서의 다양한 실시 형태들에 따라 동작하기 위한 특수 목적 프로세서/제어기일 수 있거나, 이를 포함할 수 있다.
예들로서, 애플리케이션 회로부(1102)의 프로세서(들)는 Intel® 아키텍처 Core™ 기반 프로세서, 예컨대 Quark™, Atom™, i3, i5, i7, 또는 MCU-클래스 프로세서, 또는 Intel® Corporation으로부터 입수가능한 다른 그러한 프로세서를 포함할 수 있다. 애플리케이션 회로부(1102)의 프로세서들은 또한 어드밴스드 마이크로 디바이스(Advanced Micro Device, AMD)들 Ryzen® 프로세서(들) 또는 가속 프로세싱 유닛(APU)들; Apple® Inc.로부터의 AS-A9 프로세서(들), Qualcomm® Technologies, Inc.로부터의 Snapdragon™ 프로세서(들), Texas Instruments, Inc.® OMAP™(Open Multimedia Applications Platform) 프로세서(들); MIPS Technologies, Inc.로부터의 MIPS-기반 설계, 예컨대, MIPS Warrior M-클래스, Warrior I-클래스, 및 Warrior P-클래스 프로세서들; ARM Holdings, Ltd로부터 허가된 ARM-기반 설계, 예컨대 ARM Cortex-A, Cortex-R, 및 Cortex-M계 프로세서들; 등 중 하나 이상일 수 있다. 일부 구현예들에서, 애플리케이션 회로부(1102)는 Intel® Corporation으로부터의 Edison™ 또는 Galileo™ SoC 보드들과 같은, 애플리케이션 회로부(1102) 및 다른 컴포넌트들이 단일 집적 회로 또는 단일 패키지에 형성된 SoC(system on a chip)의 일부일 수 있다.
추가적으로 또는 대안적으로, 애플리케이션 회로부(1102)는 FPGA들 등과 같은 하나 이상의 FPD들; PLD들, 예컨대, CPLD들, HCPLD들 등; ASIC들, 예컨대, 구조화된 ASIC들 등; 프로그래밍가능 SoC(PSoC)들; 등과 같은, 그러나 이로 제한되지 않는 회로부를 포함할 수 있다. 그러한 실시 형태들에서, 애플리케이션 회로부(1102)의 회로부는 로직 블록들 또는 로직 구조, 및 본 명세서에서 논의되는 다양한 실시 형태들의 절차들, 방법들, 기능들 등과 같은 다양한 기능들을 수행하도록 프로그래밍될 수 있는 다른 상호접속된 리소스들을 포함할 수 있다. 그러한 실시 형태들에서, 애플리케이션 회로부(1102)의 회로부는 로직 블록들, 로직 구조, 데이터 등을 룩업 테이블(LUT)들 등에 저장하기 위해 사용되는 메모리 셀들(예컨대, EPROM, EEPROM, 플래시 메모리, 정적 메모리(예컨대, SRAM, 안티-퓨즈들 등))을 포함할 수 있다.
기저대역 회로부(1104)는, 예를 들어, 하나 이상의 집적 회로들을 포함하는 솔더-다운 기판, 메인 회로 보드에 솔더링된 단일 패키징 집적 회로, 또는 2개 이상의 집적 회로들을 포함하는 멀티-칩 모듈로서 구현될 수 있다.
무선 프론트 엔드 모듈(RFEM)(1106)은 밀리미터파(mmWave) RFEM 및 하나 이상의 서브-mmWave RFIC들을 포함할 수 있다. 일부 구현예들에서, 하나 이상의 서브-mmWave RFIC들은 mmWave RFEM으로부터 물리적으로 분리될 수 있다. RFIC들은 하나 이상의 안테나들 또는 안테나 어레이들에 대한 접속부들을 포함할 수 있고, RFEM은 다수의 안테나들에 접속될 수 있다. 대안적인 구현예들에서, mmWave 및 서브-mmWave 무선 기능들 둘 모두는 mmWave 안테나들 및 서브-mmWave 둘 모두를 통합하는 동일한 물리적 무선 프론트 엔드 모듈(1106)에서 구현될 수 있다.
메모리 회로부(1108)는 주어진 양의 시스템 메모리를 제공하기 위해 사용되는 임의의 수 및 유형의 메모리 디바이스들을 포함할 수 있다. 예들로서, 메모리 회로부(1108)는 RAM, DRAM 및/또는 SDRAM을 포함하는 휘발성 메모리 및 고속 전기 소거가능 메모리(일반적으로 플래시 메모리로 지칭됨), PRAM, MRAM 등을 포함하는 NVM 중 하나 이상을 포함할 수 있다. 메모리 회로부(1108)는 LPDDR2, LPDDR3, LPDDR4 등과 같은 JEDEC(Joint Electron Devices Engineering Council) LPDDR(low power double data rate)-기반 설계에 따라 개발될 수 있다. 메모리 회로부(1108)는 솔더 다운 패키징 집적 회로들, SDP(single die package), DDP(dual die package) 또는 Q17P(quad die package), 소켓형 메모리 모듈들, microDIMM들 또는 MiniDIMM들을 포함하는 DIMM(dual inline memory module)들 중 하나 이상으로 구현될 수 있고/있거나, BGA(ball grid array)를 통해 마더보드 상에 솔더링될 수 있다. 저전력 구현예들에서, 메모리 회로부(1108)는 애플리케이션 회로부(1102)와 연관된 온-다이 메모리(on-die memory) 또는 레지스터들일 수 있다. 데이터, 애플리케이션들, 운영 체제들 등과 같은 정보의 영구적 저장을 제공하기 위해, 메모리 회로부(1108)는 하나 이상의 대량 저장 디바이스들을 포함할 수 있으며, 이는, 다른 것들 중에서, 특히, SSDD(solid state disk drive), HDD(hard disk drive), 마이크로 HDD, 저항 변화 메모리들, 상변화 메모리들, 홀로그래픽 메모리들, 또는 화학적 메모리들을 포함할 수 있다. 예를 들어, 컴퓨터 플랫폼(1100)은 Intel® 및 Micron®로부터의 3차원(3D) XPOINT 메모리들을 포함할 수 있다.
착탈식 메모리(1114)는 휴대용 데이터 저장 디바이스들을 플랫폼(1100)과 커플링하는 데 사용되는 디바이스들, 회로부, 인클로저들/하우징들, 포트들, 또는 리셉터클(receptacle)들 등을 포함할 수 있다. 이들 휴대용 데이터 저장 디바이스들은 대량 저장 목적을 위해 사용될 수 있고, 예를 들어 플래시 메모리 카드들(예를 들어, SD 카드들, 마이크로SD 카드들, xD 픽처 카드들 등), 및 USB 플래시 드라이브들, 광학 디스크들, 외부 HDD들 등을 포함할 수 있다.
플랫폼(1100)은 또한, 외부 디바이스들을 플랫폼(1100)과 접속시키는 데 사용되는 인터페이스 회로부(도시되지 않음)를 포함할 수 있다. 인터페이스 회로부를 통해 플랫폼(1100)에 접속된 외부 디바이스들은 센서들(1110) 및 전자 기계 컴포넌트들(EMCs로 도시됨)(1112)뿐만 아니라, 착탈식 메모리(1114)에 커플링된 착탈식 메모리 디바이스들을 포함한다.
센서들(1110)은 그의 환경에서 이벤트들 또는 변화들을 검출하고 검출된 이벤트들에 관한 정보(센서 데이터)를 일부 다른 디바이스, 모듈, 서브시스템 등으로 전송하는 것이 목적인 디바이스들, 모듈들, 또는 서브시스템들을 포함한다. 그러한 센서들의 예들은, 특히, 가속도계들, 자이로스코프들, 및/또는 자력계들을 포함하는 IMU(inertia measurement unit)들; 3-축 가속도계들, 3-축 자이로스코프들, 및/또는 자력계들을 포함하는 MEMS(microelectromechanical systems) 또는 NEMS(nanoelectromechanical systems); 레벨 센서들; 흐름 센서들; 온도 센서들(예컨대, 서미스터(thermistor)들); 압력 센서들; 기압 센서들; 중력계들; 고도계들; 이미지 캡처 디바이스들(예컨대, 카메라들 또는 렌즈리스 애퍼처들); LiDAR(light detection and ranging) 센서들; 근접 센서들(예를 들어, 적외선 방사선 검출기 등), 깊이 센서들, 주변 광 센서들, 초음파 송수신기들; 마이크로폰들 또는 다른 유사한 오디오 캡처 디바이스들; 등을 포함한다.
EMC들(1112)은 플랫폼(1100)이 그의 상태, 포지션, 및/또는 배향을 변경하거나 메커니즘 또는 (서브)시스템을 이동 또는 제어할 수 있게 하는 것이 목적인 디바이스들, 모듈들, 또는 서브시스템들을 포함한다. 부가적으로, EMC들(1112)은 EMC들(1112)의 현재 상태를 표시하기 위해 메시지들/시그널링을 생성하여 플랫폼(1100)의 다른 컴포넌트들에 전송하도록 구성될 수 있다. EMC들(1112)의 예들은 하나 이상의 전력 스위치들, EMR(electromechanical relay)들 및/또는 SSR(solid state relay)들을 포함하는 중계기들, 액추에이터들(예컨대, 밸브 액추에이터들 등), 가청음 생성기, 시각적 경고 디바이스, 모터들(예를 들어, DC 모터들, 스테퍼 모터들 등), 휠들, 스러스터(thruster)들, 프로펠러들, 클로(claw)들, 클램프들, 후크들, 및/또는 다른 유사한 전기-기계적 컴포넌트들을 포함한다. 실시 형태들에서, 플랫폼(1100)은 하나 이상의 캡처된 이벤트들 및/또는 서비스 제공자 및/또는 다양한 클라이언트들로부터 수신된 명령어들 또는 제어 신호들에 기초하여 하나 이상의 EMC들(1112)을 동작시키도록 구성된다. 일부 구현예들에서, 인터페이스 회로부는 플랫폼(1100)을 포지셔닝 회로부(1122)와 접속시킬 수 있다. 포지셔닝 회로부(1122)는 GNSS의 포지셔닝 네트워크에 의해 송신/브로드캐스트되는 신호들을 수신 및 디코딩하기 위한 회로부를 포함한다. 내비게이션 위성 콘스텔레이션들(또는 GNSS)의 예들은 미국의 GPS, 러시아의 GLONASS, 유럽 연합의 갈릴레오 시스템, 중국의 베이더우 내비게이션 위성 시스템, 지역 내비게이션 시스템 또는 GNSS 증강 시스템(예를 들어, NAVIC, 일본의 QZSS, 프랑스의 DORIS 등) 등을 포함한다. 포지셔닝 회로부(1122)는 내비게이션 위성 콘스텔레이션 노드들과 같은 포지셔닝 네트워크의 컴포넌트들과 통신하기 위해 다양한 하드웨어 요소들(예컨대, OTA 통신을 용이하게 하기 위한 스위치들, 필터들, 증폭기들, 안테나 요소들 등과 같은 하드웨어 디바이스들을 포함함)을 포함한다. 일부 실시 형태들에서, 포지셔닝 회로부(1122)는 GNSS 보조 없이 포지션 추적/추정을 수행하기 위해 마스터 타이밍 클록을 사용하는 마이크로-PNT IC를 포함할 수 있다. 포지셔닝 회로부(1122)는 또한 포지셔닝 네트워크의 노드들 및 컴포넌트들과 통신하기 위해, 기저대역 회로부(1104) 및/또는 무선 프론트 엔드 모듈(1106)의 일부이거나 그와 상호작용할 수 있다. 포지셔닝 회로부(1122)는 또한 위치 데이터 및/또는 시간 데이터를 애플리케이션 회로부(1102)에 제공할 수 있으며, 이는 데이터를 사용하여 턴-바이-턴(turn-by-turn) 내비게이션 애플리케이션들 등을 위해 다양한 기반구조(예를 들어, 무선 기지국들)와 동작들을 동기화할 수 있다.
일부 구현예들에서, 인터페이스 회로부는 플랫폼(1100)을 근접장 통신 회로부(Near-Field Communication circuitry)(NFC 회로부로 도시됨)(1120)와 접속시킬 수 있다. NFC 회로부(1120)는 RFID(radio frequency identification) 표준들에 기초하여 비접촉식 단거리 통신들을 제공하도록 구성되며, 여기서 NFC 회로부(1120)와 플랫폼(1100) 외부의 NFC-인에이블형 디바이스들(예를 들어, "NFC 터치포인트") 사이의 통신을 가능하게 하기 위해 자기장 유도가 사용된다. NFC 회로부(1120)는 안테나 요소와 커플링된 NFC 제어기 및 NFC 제어기와 커플링된 프로세서를 포함한다. NFC 제어기는 NFC 제어기 펌웨어 및 NFC 스택을 실행시킴으로써 NFC 회로부(1120)에 NFC 기능들을 제공하는 칩/IC일 수 있다. NFC 스택은 NFC 제어기를 제어하도록 프로세서에 의해 실행될 수 있고, NFC 제어기 펌웨어는 근거리 RF 신호들을 방출하기 위해 안테나 요소를 제어하도록 NFC 제어기에 의해 실행될 수 있다. RF 신호들은, 저장된 데이터를 NFC 회로부(1120)로 송신하거나, 또는 플랫폼(1100)에 근접한 다른 활성 NFC 디바이스(예를 들어, 스마트폰 또는 NFC-인에이블형 POS 단말)와 NFC 회로부(1120) 사이의 데이터 전송을 개시하기 위해 수동 NFC 태그(예컨대, 스티커 또는 손목밴드 내에 임베드된 마이크로칩)에 전력을 공급할 수 있다.
드라이버 회로부(1124)는 플랫폼(1100) 내에 임베드되거나, 플랫폼(1100)에 연결되거나, 또는 이와 달리 플랫폼(1100)과 통신가능하게 커플링된 특정 디바이스들을 제어하도록 동작하는 소프트웨어 및 하드웨어 요소들을 포함할 수 있다. 드라이버 회로부(1124)는, 플랫폼(1100)의 다른 컴포넌트들이 플랫폼(1100) 내에 존재하거나 그에 접속될 수 있는 다양한 입/출력(I/O) 디바이스들과 상호작용하거나 그들을 제어하도록 허용하는 개별 드라이버들을 포함할 수 있다. 예를 들어, 드라이버 회로부(1124)는 디스플레이 디바이스에 대한 액세스를 제어 및 허용하기 위한 디스플레이 드라이버, 플랫폼(1100)의 터치스크린 인터페이스에 대한 액세스를 제어 및 허용하기 위한 터치스크린 드라이버, 센서들(1110)의 센서 판독들을 획득하고 센서들(1110)에 대한 액세스를 제어 및 허용하기 위한 센서 드라이버들, EMC들(1112)의 액추에이터 포지션들을 획득하고/하거나 EMC들(1112)에 대한 액세스를 제어 및 허용하기 위한 EMC 드라이버들, 임베디드 이미지 캡처 디바이스에 대한 액세스를 제어 및 허용하기 위한 카메라 드라이버, 하나 이상의 오디오 디바이스들에 대한 액세스를 제어 및 허용하기 위한 오디오 드라이버들을 포함할 수 있다.
전력 관리 집적 회로부(PMIC(1116)로 도시됨)(또한 "전력 관리 회로부"로 지칭됨)는 플랫폼(1100)의 다양한 컴포넌트들에 제공되는 전력을 관리할 수 있다. 특히, 기저대역 회로부(1104)에 관련하여, PMIC(1116)는 전원 선택, 전압 스케일링, 배터리 충전, 또는 DC-대-DC 변환을 제어할 수 있다. PMIC(1116)는, 플랫폼(1100)이 배터리(1118)에 의해 전력을 공급받을 수 있을 때, 예를 들어 디바이스가 UE에 포함될 때 종종 포함될 수 있다.
일부 실시 형태들에서, PMIC(1116)는 플랫폼(1100)의 다양한 절전 메커니즘들을 제어할 수 있거나, 이와 달리 이들의 일부일 수 있다. 예를 들어, 플랫폼(1100)이, 디바이스가 트래픽을 곧 수신할 것으로 예상함에 따라 RAN 노드에 여전히 접속되어 있는, RRC_Connected 상태에 있다면, 디바이스는 일정 기간의 비활동 이후에 DRX(Discontinuous Reception) 모드로 알려진 상태에 진입할 수 있다. 이러한 상태 동안, 플랫폼(1100)은 짧은 시간 간격들 동안 전원 차단(power down)될 수 있고 따라서 절전할 수 있다. 연장된 기간 동안 데이터 트래픽 활동이 없다면, 플랫폼(1100)은, 디바이스가 네트워크로부터 접속해제되고 채널 품질 피드백, 핸드오버 등과 같은 동작들을 수행하지 않는, RRC_Idle 상태로 전환될 수 있다. 플랫폼(1100)은 초저전력(very low power) 상태로 되고, 디바이스가 또다시 네트워크를 리스닝하기 위해 주기적으로 웨이크업하고 이어서 또다시 전원 차단되는, 페이징을 수행한다. 플랫폼(1100)은 이러한 상태에서 데이터를 수신하지 않을 수 있고; 데이터를 수신하기 위해서는, 그것은 다시 RRC_Connected 상태로 전이되어야 한다. 부가적인 절전 모드는, 디바이스가 페이징 간격(몇 초 내지 수 시간의 범위에 있음)보다 긴 기간들 동안 네트워크에 이용가능하지 않게 허용할 수 있다. 이러한 시간 동안, 디바이스는 전적으로 네트워크에 접근불가(unreachable)하고 완전히 전원 차단될 수 있다. 이러한 시간 동안 전송되는 임의의 데이터는 큰 지연을 초래하며, 지연이 용인가능하다고 가정된다.
배터리(1118)는 플랫폼(1100)에 전력을 공급할 수 있지만, 일부 예들에서, 플랫폼(1100)은 고정된 위치에 배치되어 장착될 수 있고, 전기 그리드에 커플링된 전력 공급원을 가질 수 있다. 배터리(1118)는 리튬 이온 배터리, 금속-공기 배터리, 예컨대 아연-공기 배터리, 알루미늄-공기 배터리, 리튬-공기 배터리 등일 수 있다. V2X 애플리케이션들에서와 같은 일부 구현예들에서, 배터리(1118)는 전형적인 납-산(lead-acid) 자동차 배터리일 수 있다.
일부 구현예들에서, 배터리(1118)는 배터리 관리 시스템(Battery Management System, BMS) 또는 배터리 모니터링 집적 회로부를 포함하거나 또는 그와 커플링된 "스마트 배터리"일 수 있다. BMS는 배터리(1118)의 충전 상태(state of charge, SoCh)를 추적하기 위해 플랫폼(1100) 내에 포함될 수 있다. BMS는 배터리(1118)의 건강 상태(state of health, SoH) 및 기능 상태(state of function, SoF)와 같은, 실패 예측들을 제공하기 위한, 배터리(1118)의 다른 파라미터들을 모니터링하는 데 사용될 수 있다. BMS는 배터리(1118)의 정보를 애플리케이션 회로부(1102) 또는 플랫폼(1100)의 다른 컴포넌트들에 전달할 수 있다. BMS는 또한, 애플리케이션 회로부(1102)가 배터리(1118)의 전압 또는 배터리(1118)로부터의 전류 흐름을 직접 모니터링하도록 허용하는 아날로그-디지털 변환기(analog-to-digital convertor, ADC)를 포함할 수 있다. 송신 주파수, 네트워크 동작, 감지 주파수 등과 같은 배터리 파라미터들은 플랫폼(1100)이 수행할 수 있는 액션들을 결정하는 데 사용될 수 있다.
전력 블록, 또는 전기 그리드에 커플링된 다른 전력 공급원은 BMS와 커플링되어 배터리(1118)를 충전할 수 있다. 일부 예들에서, 전력 블록은, 예를 들어 컴퓨터 플랫폼(1100) 내의 루프 안테나를 통해 무선으로 전력을 획득하기 위해 무선 전력 수신기로 대체될 수 있다. 이들 예들에서, 무선 배터리 충전 회로가 BMS에 포함될 수 있다. 선택된 특정 충전 회로들은 배터리(1118)의 크기, 및 이에 따라 요구되는 전류에 종속할 수 있다. 충전은, 무엇보다도 항공연료 연합(Airfuel Alliance)에 의해 공표된 항공연료 표준, 무선 전력 콘소시엄에 의해 공표된 Qi 무선 충전 표준, 또는 무선 전력 연합에 의해 공표된 레젠스(Rezence) 충전 표준을 사용하여 수행될 수 있다.
사용자 인터페이스 회로부(1126)는 플랫폼(1100) 내에 존재하거나 그에 접속된 다양한 입/출력(I/O) 디바이스들을 포함하고, 플랫폼(1100)과의 사용자 상호작용을 가능하게 하도록 설계된 하나 이상의 사용자 인터페이스들 및/또는 플랫폼(1100)과의 주변 컴포넌트 상호작용을 가능하게 하도록 설계된 주변 컴포넌트 인터페이스들을 포함한다. 사용자 인터페이스 회로부(1126)는 입력 디바이스 회로부 및 출력 디바이스 회로부를 포함한다. 입력 디바이스 회로부는, 특히, 하나 이상의 물리적 또는 가상 버튼들(예컨대, 리셋 버튼), 물리적 키보드, 키패드, 마우스, 터치패드, 터치스크린, 마이크로폰들, 스캐너, 헤드셋 등을 포함하는 입력을 수용하기 위한 임의의 물리적 또는 가상 수단을 포함한다. 출력 디바이스 회로부는 정보, 예컨대 센서 판독들, 액추에이터 포지션(들), 또는 다른 유사한 정보를 나타내거나 이와 달리 정보를 전달하기 위한 임의의 물리적 또는 가상 수단을 포함한다. 출력 디바이스 회로부는, 그 중에서도, 이진 상태 표시자들(예컨대, LED들)과 같은 하나 이상의 간단한 시각적 출력부들/표시자들 및 다문자 시각적 출력부들, 또는 디스플레이 디바이스들 또는 터치스크린들(예를 들어, LCD(Liquid Crystal Displays), LED 디스플레이들, 양자 점 디스플레이들, 프로젝터들 등)과 같은 더 복합한 출력부들을 포함하는 임의의 수의 오디오 또는 시각적 디스플레이 및/또는 이들의 조합들을 포함할 수 있고, 이때 문자들, 그래픽들, 멀티미디어 객체들 등의 출력부는 플랫폼(1100)의 동작으로부터 발생되거나 생성된다. 출력 디바이스 회로부는 또한 스피커들 또는 다른 오디오 방출 디바이스들, 프린터(들) 등을 포함할 수 있다. 일부 실시 형태들에서, 센서들(1110)은 입력 디바이스 회로부(예컨대, 이미지 캡처 디바이스, 모션 캡처 디바이스 등)로서 사용될 수 있고, 하나 이상의 EMC들은 출력 디바이스 회로부(예컨대, 햅틱 피드백을 제공하기 위한 액추에이터 등)로서 사용될 수 있다. 다른 예에서, 안테나 요소와 커플링된 NFC 제어기 및 프로세싱 디바이스를 포함하는 NFC 회로부는 전자 태그들을 판독하고/하거나 다른 NFC-인에이블형 디바이스와 접속하기 위해 포함될 수 있다. 주변 컴포넌트 인터페이스들은, 비휘발성 메모리 포트, USB 포트, 오디오 잭, 전력 공급원 인터페이스 등을 포함할 수 있지만, 이에 제한되는 것은 아니다.
도시되지 않지만, 플랫폼(1100)의 컴포넌트들은 ISA, EISA, PCI, PCix, PCie, TTP(Time-Trigger Protocol) 시스템, 플렉스레이 시스템(FlexRay system), 또는 임의의 수의 다른 기술들을 포함한 임의의 수의 기술들을 포함할 수 있는 적합한 버스 또는 상호접속(IX) 기술을 사용하여 서로 통신할 수 있다. 버스/IX는 예를 들어, SoC 기반 시스템에서 사용되는 독점적 버스/IX일 수 있다. 다른 버스/IX 시스템들, 예컨대 무엇보다도 I2C 인터페이스, SPI 인터페이스, 포인트-투-포인트 인터페이스들, 및 전력 버스가 포함될 수 있다.
도 12는 일부 실시 형태들에 따른 디바이스(1200)의 예시적인 컴포넌트들을 예시한다. 일부 실시 형태들에서, 디바이스(1200)는 적어도 도시된 바와 같이 함께 커플링되는, 애플리케이션 회로부(1202), 기저대역 회로부(1204), 무선 주파수(RF) 회로부(RF 회로부(1220)로서 도시됨), 프론트 엔드 모듈(FEM) 회로부(FEM 회로부(1230)로서 도시됨), 하나 이상의 안테나들(1232), 및 PMC(power management circuitry)(PMC(1234)로서 도시됨)를 포함할 수 있다. 예시된 디바이스(1200)의 컴포넌트들은 UE 또는 RAN 노드에 포함될 수 있다. 일부 실시 형태들에서, 디바이스(1200)는 더 적은 요소들을 포함할 수 있다(예를 들어, RAN 노드는 애플리케이션 회로부(1202)를 이용하지 않을 수 있고, 그 대신에 EPC로부터 수신되는 IP 데이터를 프로세싱하기 위한 프로세서/제어기를 포함할 수 있다). 일부 실시 형태들에서, 디바이스(1200)는, 예를 들어, 메모리/저장소, 디스플레이, 카메라, 센서, 또는 입출력(I/O) 인터페이스와 같은 추가적인 요소들을 포함할 수 있다. 다른 실시 형태들에서, 아래에 설명되는 컴포넌트들은 하나 초과의 디바이스에 포함될 수 있다(예컨대, 상기 회로부들은 C-RAN(Cloud-RAN) 구현예들을 위해 하나 초과의 디바이스에 개별적으로 포함될 수 있다).
애플리케이션 회로부(1202)는 하나 이상의 애플리케이션 프로세서들을 포함할 수 있다. 예를 들어, 애플리케이션 회로부(1202)는 하나 이상의 단일-코어 또는 멀티-코어 프로세서들과 같은, 그러나 이에 제한되지 않는 회로부를 포함할 수 있다. 프로세서(들)는 범용 프로세서들 및 전용 프로세서들(예를 들어, 그래픽 프로세서들, 애플리케이션 프로세서들 등)의 임의의 조합을 포함할 수 있다. 프로세서들은 메모리/저장소와 커플링될 수 있거나 이를 포함할 수 있고, 메모리/저장소에 저장된 명령어들을 실행하여 다양한 애플리케이션들 또는 운영 체제들이 디바이스(1200) 상에서 실행될 수 있게 하도록 구성될 수 있다. 일부 실시 형태들에서, 애플리케이션 회로부(1202)의 프로세서들은 EPC로부터 수신되는 IP 데이터 패킷들을 프로세싱할 수 있다.
기저대역 회로부(1204)는 하나 이상의 단일 코어 또는 멀티-코어 프로세서들과 같은, 그러나 이에 제한되지 않는 회로부를 포함할 수 있다. 기저대역 회로부(1204)는 RF 회로부(1220)의 수신 신호 경로로부터 수신되는 기저대역 신호들을 프로세싱하기 위한 그리고 RF 회로부(1220)의 송신 신호 경로에 대한 기저대역 신호들을 생성하기 위한 하나 이상의 기저대역 프로세서들 또는 제어 로직을 포함할 수 있다. 기저대역 회로부(1204)는 기저대역 신호들의 생성 및 프로세싱을 위해 그리고 RF 회로부(1220)의 동작들을 제어하기 위해 애플리케이션 회로부(1202)와 인터페이싱할 수 있다. 예를 들어, 일부 실시 형태들에서, 기저대역 회로부(1204)는 3G(third generation) 기저대역 프로세서(3G 기저대역 프로세서(1206)), 4G(fourth generation) 기저대역 프로세서(4G 기저대역 프로세서(1208)), 5G(fifth generation) 기저대역 프로세서(5G 기저대역 프로세서(1210)), 또는 다른 기존의 세대들, 개발 중인 또는 향후 개발될 세대들(예를 들어, 2G(second generation), 6G(sixth generation) 등)에 대한 다른 기저대역 프로세서(들)(1212)를 포함할 수 있다. 기저대역 회로부(1204)(예를 들어, 기저대역 프로세서들 중 하나 이상)는 RF 회로부(1220)를 통해 하나 이상의 무선 네트워크들과의 통신을 가능하게 하는 다양한 무선 제어 기능들을 처리할 수 있다. 다른 실시 형태들에서, 예시된 기저대역 프로세서들의 기능 중 일부 또는 전부는, 메모리(1218)에 저장되고 중앙 프로세싱 유닛(CPU)(1214)을 통해 실행되는 모듈들에 포함될 수 있다. 무선 제어 기능들은 신호 변조/복조, 인코딩/디코딩, 무선 주파수 시프트 등을 포함할 수 있지만, 이들로 제한되지 않는다. 일부 실시 형태들에서, 기저대역 회로부(1204)의 변조/복조 회로부는 고속 푸리에 변환(Fast-Fourier Transform, FFT), 프리코딩, 또는 콘스텔레이션 맵핑/디맵핑 기능을 포함할 수 있다. 일부 실시 형태들에서, 기저대역 회로부(1204)의 인코딩/디코딩 회로부는 콘볼루션(convolution), 테일바이팅 콘볼루션(tail-biting convolution), 터보(turbo), 비터비(Viterbi), 또는 저밀도 패리티 검사(Low Density Parity Check, LDPC) 인코더/디코더 기능을 포함할 수 있다. 변조/복조 및 인코더/디코더 기능의 실시 형태들은 이러한 예들로 제한되지 않고, 다른 실시 형태들에서는, 다른 적합한 기능을 포함할 수 있다.
일부 실시 형태들에서, 기저대역 회로부(1204)는 하나 이상의 오디오 DSP(들)(1216)와 같은 DSP를 포함할 수 있다. 하나 이상의 오디오 DSP(들)(1216)는 압축/압축해제 및 에코 제거를 위한 요소들을 포함할 수 있고, 다른 실시 형태들에서 다른 적합한 프로세싱 요소들을 포함할 수 있다. 기저대역 회로부의 컴포넌트들은 단일 칩, 단일 칩셋에서 적합하게 조합되거나, 또는 일부 실시 형태들에서 동일한 회로 보드 상에 배치될 수 있다. 일부 실시 형태들에서, 기저대역 회로부(1204) 및 애플리케이션 회로부(1202)의 구성 컴포넌트들 중 일부 또는 전부는, 예를 들어, SOC 상에서와 같이, 함께 구현될 수 있다.
일부 실시 형태들에서, 기저대역 회로부(1204)는 하나 이상의 무선 기술들과 호환가능한 통신을 제공할 수 있다. 예를 들어, 일부 실시 형태들에서, 기저대역 회로부(1204)는 EUTRAN 또는 다른 WMAN, WLAN, 또는 WPAN(wireless personal area network)과의 통신을 지원할 수 있다. 기저대역 회로부(1204)가 하나 초과의 무선 프로토콜의 무선 통신을 지원하도록 구성되는 실시 형태들은 다중 모드 기저대역 회로부로 지칭될 수 있다.
RF 회로부(1220)는 비-고체 매체(non-solid medium)를 통한 변조된 전자기 방사를 사용하여 무선 네트워크들과의 통신을 가능하게 할 수 있다. 다양한 실시 형태들에서, RF 회로부(1220)는 무선 네트워크와의 통신을 용이하게 하기 위해 스위치들, 필터들, 증폭기들 등을 포함할 수 있다. RF 회로부(1220)는 FEM 회로부(1230)로부터 수신되는 RF 신호들을 하향 변환(down-convert)하고 기저대역 신호들을 기저대역 회로부(1204)에 제공하기 위한 회로부를 포함할 수 있는 수신 신호 경로를 포함할 수 있다. RF 회로부(1220)는 또한, 기저대역 회로부(1204)에 의해 제공되는 기저대역 신호들을 상향 변환(up-convert)하고 RF 출력 신호들을 송신을 위해 FEM 회로부(1230)에 제공하기 위한 회로부를 포함할 수 있는 송신 신호 경로를 포함할 수 있다.
일부 실시 형태들에서, RF 회로부(1220)의 수신 신호 경로는 믹서 회로부(mixer circuitry)(1222), 증폭기 회로부(1224) 및 필터 회로부(1226)를 포함할 수 있다. 일부 실시 형태들에서, RF 회로부(1220)의 송신 신호 경로는 필터 회로부(1226) 및 믹서 회로부(1222)를 포함할 수 있다. RF 회로부(1220)는 또한, 수신 신호 경로 및 송신 신호 경로의 믹서 회로부(1222)에 의한 사용을 위해 주파수를 합성하기 위한 합성기 회로부(1228)를 포함할 수 있다. 일부 실시 형태들에서, 수신 신호 경로의 믹서 회로부(1222)는 합성기 회로부(1228)에 의해 제공되는 합성된 주파수에 기초하여 FEM 회로부(1230)로부터 수신되는 RF 신호들을 하향 변환하도록 구성될 수 있다. 증폭기 회로부(1224)는 하향 변환된 신호들을 증폭시키도록 구성될 수 있고, 필터 회로부(1226)는 출력 기저대역 신호들을 생성하기 위해 하향 변환된 신호들로부터 원하지 않는 신호들을 제거하도록 구성된 LPF(low-pass filter) 또는 BPF(band-pass filter)일 수 있다. 출력 기저대역 신호들은 추가적인 프로세싱을 위해 기저대역 회로부(1204)에 제공될 수 있다. 일부 실시 형태들에서, 출력 기저대역 신호들은 제로 주파수 기저대역 신호들일 수 있지만, 이것은 요건이 아니다. 일부 실시 형태들에서, 수신 신호 경로의 믹서 회로부(1222)는 수동 믹서들을 포함할 수 있지만, 실시 형태들의 범주가 이러한 점에서 제한되지 않는다.
일부 실시 형태들에서, 송신 신호 경로의 믹서 회로부(1222)는 FEM 회로부(1230)에 대한 RF 출력 신호들을 생성하기 위해 합성기 회로부(1228)에 의해 제공되는 합성된 주파수에 기초하여 입력 기저대역 신호들을 상향 변환하도록 구성될 수 있다. 기저대역 신호들은 기저대역 회로부(1204)에 의해 제공될 수 있고, 필터 회로부(1226)에 의해 필터링될 수 있다.
일부 실시 형태들에서, 수신 신호 경로의 믹서 회로부(1222) 및 송신 신호 경로의 믹서 회로부(1222)는 2개 이상의 믹서들을 포함할 수 있고, 각각, 직교 하향변환 및 상향변환을 위해 배열될 수 있다. 일부 실시 형태들에서, 수신 신호 경로의 믹서 회로부(1222) 및 송신 신호 경로의 믹서 회로부(1222)는 2개 이상의 믹서들을 포함할 수 있고 이미지 제거(image rejection)(예를 들어, 하틀리(Hartley) 이미지 제거)를 위해 배열될 수 있다. 일부 실시 형태들에서, 수신 신호 경로의 믹서 회로부(1222) 및 송신 신호 경로의 믹서 회로부(1222)는, 각각, 직접 하향변환 및 직접 상향변환을 위해 배열될 수 있다. 일부 실시 형태들에서, 수신 신호 경로의 믹서 회로부(1222) 및 송신 신호 경로의 믹서 회로부(1222)는 슈퍼-헤테로다인(super-heterodyne) 동작을 위해 구성될 수 있다.
일부 실시 형태들에서, 출력 기저대역 신호들 및 입력 기저대역 신호들은 아날로그 기저대역 신호들일 수 있지만, 실시 형태들의 범주는 이러한 점에서 제한되지 않는다. 일부 대안적인 실시 형태들에서, 출력 기저대역 신호들 및 입력 기저대역 신호들은 디지털 기저대역 신호들일 수 있다. 이러한 대안적인 실시 형태들에서, RF 회로부(1220)는 ADC 및 디지털-아날로그 변환기(digital-to-analog converter, DAC) 회로부를 포함할 수 있고, 기저대역 회로부(1204)는 RF 회로부(1220)와 통신하기 위한 디지털 기저대역 인터페이스를 포함할 수 있다.
일부 듀얼 모드 실시 형태들에서, 각각의 스펙트럼에 대한 신호들을 프로세싱하기 위해 개별 무선 IC 회로부가 제공될 수 있지만, 실시 형태들의 범주는 이러한 점에서 제한되지 않는다.
일부 실시 형태들에서, 합성기 회로부(1228)는 프랙셔널-N 합성기(fractional-N synthesizer) 또는 프랙셔널 N/N+1 합성기일 수 있지만, 다른 유형들의 주파수 합성기들이 적합할 수 있으므로 실시 형태들의 범주가 이러한 점에서 제한되지 않는다. 예를 들어, 합성기 회로부(1228)는 델타-시그마 합성기, 주파수 체배기, 또는 주파수 분주기를 갖는 위상 고정 루프를 포함하는 합성기일 수 있다.
합성기 회로부(1228)는 주파수 입력 및 분주기 제어 입력에 기초하여 RF 회로부(1220)의 믹서 회로부(1222)에 의한 사용을 위해 출력 주파수를 합성하도록 구성될 수 있다. 일부 실시 형태들에서, 합성기 회로부(1228)는 프랙셔널 N/N+1 합성기일 수 있다.
일부 실시 형태들에서, 주파수 입력은 VCO(voltage controlled oscillator)에 의해 제공될 수 있지만, 그것은 요건이 아니다. 분주기 제어 입력은 원하는 출력 주파수에 따라 기저대역 회로부(1204) 또는 애플리케이션 회로부(1202)(예를 들어, 애플리케이션 프로세서) 중 어느 하나에 의해 제공될 수 있다. 일부 실시 형태들에서, 분주기 제어 입력(예를 들어, N)은 애플리케이션 회로부(1202)에 의해 표시되는 채널에 기초하여 룩업 테이블로부터 결정될 수 있다.
RF 회로부(1220)의 합성기 회로부(1228)는 분주기, DLL(delay-locked loop), 멀티플렉서 및 위상 누산기를 포함할 수 있다. 일부 실시 형태들에서, 분주기는 DMD(dual modulus divider)일 수 있고, 위상 누산기는 DPA(digital phase accumulator)일 수 있다. 일부 실시 형태들에서, DMD는 프랙셔널 분주비를 제공하기 위해 (예를 들어, 캐리아웃(carry out)에 기초하여) N 또는 N+1 중 어느 하나에 의해 입력 신호를 분주하도록 구성될 수 있다. 일부 예시적인 실시 형태들에서, DLL은 캐스케이딩되고(cascaded) 튜닝가능한 지연 요소들의 세트, 위상 검출기, 전하 펌프, 및 D형 플립 플롭을 포함할 수 있다. 이러한 실시 형태들에서, 지연 요소들은 VCO 주기를 Nd개의 동등한 위상 패킷들로 나누도록 구성될 수 있고, 여기서 Nd는 지연 라인에 있는 지연 요소들의 수이다. 이러한 방식으로, DLL은 지연 라인을 통한 총 지연이 하나의 VCO 사이클이라는 점을 보장하는 것을 돕기 위해 네거티브 피드백을 제공한다.
일부 실시 형태들에서, 합성기 회로부(1228)는 출력 주파수로서 캐리어 주파수를 생성하도록 구성될 수 있는 반면, 다른 실시 형태들에서, 출력 주파수는 캐리어 주파수의 배수(예를 들어, 캐리어 주파수의 2배, 캐리어 주파수의 4배)일 수 있고, 서로에 대해 다수의 상이한 위상들을 갖는 캐리어 주파수에서 다수의 신호들을 생성하기 위해 직교 생성기 및 분주기 회로부와 함께 사용될 수 있다. 일부 실시 형태들에서, 출력 주파수는 LO 주파수(fLO)일 수 있다. 일부 실시 형태들에서, RF 회로부(1220)는 IQ/폴라 변환기(IQ/polar converter)를 포함할 수 있다.
FEM 회로부(1230)는, 하나 이상의 안테나들(1232)로부터 수신되는 RF 신호들에 대해 동작하도록, 수신된 신호들을 증폭시키도록, 그리고 수신된 신호들의 증폭된 버전들을 추가 프로세싱을 위해 RF 회로부(1220)에 제공하도록 구성된 회로부를 포함할 수 있는 수신 신호 경로를 포함할 수 있다. FEM 회로부(1230)는 또한, 하나 이상의 안테나들(1232) 중 하나 이상에 의한 송신을 위해 RF 회로부(1220)에 의해 제공되는 송신을 위한 신호들을 증폭시키도록 구성된 회로부를 포함할 수 있는 송신 신호 경로를 포함할 수 있다. 다양한 실시 형태들에서, 송신 또는 수신 신호 경로들을 통한 증폭은 RF 회로부(1220)에서만, FEM 회로부(1230)에서만, 또는 RF 회로부(1220) 및 FEM 회로부(1230) 둘 모두에서 행해질 수 있다.
일부 실시 형태들에서, FEM 회로부(1230)는 송신 모드와 수신 모드 동작 사이에서 스위칭하기 위한 TX/RX 스위치를 포함할 수 있다. FEM 회로부(1230)는 수신 신호 경로 및 송신 신호 경로를 포함할 수 있다. FEM 회로부(1230)의 수신 신호 경로는 수신된 RF 신호들을 증폭하고 증폭된 수신된 RF 신호들을 출력으로서 (예컨대, RF 회로부(1220)에) 제공하기 위한 LNA를 포함할 수 있다. FEM 회로부(1230)의 송신 신호 경로는 (예를 들어, RF 회로부(1220)에 의해 제공되는) 입력 RF 신호들을 증폭시키기 위한 전력 증폭기(power amplifier, PA), 및 (예를 들어, 하나 이상의 안테나들(1232) 중 하나 이상에 의한) 후속 송신을 위해 RF 신호들을 생성하기 위한 하나 이상의 필터들을 포함할 수 있다.
일부 실시 형태들에서, PMC(1234)는 기저대역 회로부(1204)에 제공되는 전력을 관리할 수 있다. 특히, PMC(1234)는 전원 선택, 전압 스케일링, 배터리 충전, 또는 DC-DC 변환을 제어할 수 있다. PMC(1234)는, 디바이스(1200)가 배터리에 의해 전력을 공급받을 수 있을 때, 예를 들어, 디바이스(1200)가 UE에 포함될 때 종종 포함될 수 있다. PMC(1234)는 바람직한 구현 크기 및 방열 특성들을 제공하면서 전력 변환 효율을 증가시킬 수 있다.
도 12는 PMC(1234)가 기저대역 회로부(1204)에만 커플링된 것을 도시한다. 그러나, 다른 실시 형태들에서, PMC(1234)는, 부가적으로 또는 대안적으로, 애플리케이션 회로부(1202), RF 회로부(1220), 또는 FEM 회로부(1230)와 같은, 그러나 이들로 제한되지 않는 다른 컴포넌트들과 커플링되고 이들에 대한 유사한 전력 관리 동작들을 수행할 수 있다.
일부 실시 형태들에서, PMC(1234)는 디바이스(1200)의 다양한 절전 메커니즘들을 제어할 수 있거나, 다른 방식으로 이들의 일부일 수 있다. 예를 들어, 디바이스(1200)가, 디바이스가 트래픽을 곧 수신할 것으로 예상함에 따라 RAN 노드에 여전히 연결되어 있는 RRC_Connected 상태에 있다면, 디바이스는 일정 기간의 비활동 이후에 DRX 모드로 알려진 상태에 진입할 수 있다. 이러한 상태 동안, 디바이스(1200)는 짧은 시간 간격들 동안 전원 차단될 수 있고 따라서 절전할 수 있다.
연장된 시간 기간 동안 데이터 트래픽 활동이 없다면, 디바이스(1200)는, 디바이스가 네트워크로부터 연결해제되고 채널 품질 피드백, 핸드오버 등과 같은 동작들을 수행하지 않는 RRC_Idle 상태로 전환될 수 있다. 디바이스(1200)는 초저전력 상태로 되고, 디바이스는 그것이 또다시 네트워크를 리스닝하기 위해 주기적으로 웨이크업하고 이어서 또다시 전원 차단되는 페이징을 수행한다. 디바이스(1200)는 이 상태에서 데이터를 수신하지 않을 수 있고, 데이터를 수신하기 위해, 그것은 다시 RRC_Connected 상태로 전환된다.
부가적인 절전 모드는, 디바이스가 페이징 간격(몇 초 내지 수 시간의 범위에 있음)보다 긴 기간들 동안 네트워크에 이용가능하지 않게 허용할 수 있다. 이러한 시간 동안, 디바이스는 전적으로 네트워크에 접근불가하고 완전히 전원 차단될 수 있다. 이러한 시간 동안 전송되는 임의의 데이터는 큰 지연을 초래하며, 지연이 용인가능하다고 가정된다.
애플리케이션 회로부(1202)의 프로세서들 및 기저대역 회로부(1204)의 프로세서들은 프로토콜 스택의 하나 이상의 인스턴스들의 요소들을 실행하는 데 사용될 수 있다. 예를 들어, 기저대역 회로부(1204)의 프로세서들은, 단독으로 또는 조합하여, 계층 3, 계층 2, 또는 계층 1 기능을 실행하는 데 사용될 수 있는 반면, 애플리케이션 회로부(1202)의 프로세서들은 이러한 계층들로부터 수신되는 데이터(예컨대, 패킷 데이터)를 이용하고 계층 4 기능(예컨대, TCP(transmission communication protocol) 및 UDP(user datagram protocol) 계층들)을 추가로 실행할 수 있다. 본 명세서에서 언급되는 바와 같이, 계층 3은 아래에서 더 상세히 설명되는 무선 자원 제어(RRC) 계층을 포함할 수 있다. 본 명세서에서 언급되는 바와 같이, 계층 2는 아래에서 더 상세히 설명되는 매체 액세스 제어(MAC) 계층, 무선 링크 제어(RLC) 계층, 및 패킷 데이터 수렴 프로토콜(PDCP) 계층을 포함할 수 있다. 본 명세서에서 언급되는 바와 같이, 계층 1은, 아래에서 더 상세히 설명되는, UE/RAN 노드의 물리적(PHY) 계층을 포함할 수 있다.
도 13은 일부 실시 형태들에 따른, 기저대역 회로부의 예시적인 인터페이스들(1300)을 예시한다. 위에서 논의된 바와 같이, 도 12의 기저대역 회로부(1204)는 3G 기저대역 프로세서(1206), 4G 기저대역 프로세서(1208), 5G 기저대역 프로세서(1210), 다른 기저대역 프로세서(들)(1212), CPU(1214), 및 상기 프로세서들에 의해 이용되는 메모리(1218)를 포함할 수 있다. 도시된 바와 같이, 프로세서들 각각은 메모리(1218)로/로부터 데이터를 전송/수신하기 위한 각자의 메모리 인터페이스(1302)를 포함할 수 있다.
기저대역 회로부(1204)는, 메모리 인터페이스(1304)(예를 들어, 기저대역 회로부(1204) 외부의 메모리로/로부터 데이터를 전송/수신하기 위한 인터페이스), 애플리케이션 회로부 인터페이스(1306)(예를 들어, 도 12의 애플리케이션 회로부(1202)로/로부터 데이터를 전송/수신하기 위한 인터페이스), RF 회로부 인터페이스(1308)(예를 들어, 도 12의 RF 회로부(1220)로/로부터 데이터를 전송/수신하기 위한 인터페이스), 무선 하드웨어 접속 인터페이스(1310)(예를 들어, NFC 컴포넌트들, Bluetooth® 컴포넌트들(예를 들어, Bluetooth® Low Energy), Wi-Fi® 컴포넌트들, 및 다른 통신 컴포넌트들로/로부터 데이터를 전송/수신하기 위한 인터페이스), 및 전력 관리 인터페이스(1312)(예를 들어, PMC(1234)로/로부터 전력 또는 제어 신호들을 전송/수신하기 위한 인터페이스)와 같은, 다른 회로부들/디바이스들에 통신가능하게 커플링되기 위한 하나 이상의 인터페이스들을 추가로 포함할 수 있다.
도 14는 기계 판독가능 또는 컴퓨터 판독가능 매체(예컨대, 비일시적 기계 판독가능 저장 매체)로부터 명령어들을 판독하고 본 명세서에서 논의된 방법론들 중 임의의 하나 이상을 수행할 수 있는, 일부 예시적인 실시 형태들에 따른, 컴포넌트들(1400)을 예시하는 블록도이다. 구체적으로, 도 14는, 각각이 버스(1422)를 통해 통신가능하게 커플링될 수 있는, 하나 이상의 프로세서들(1412)(또는 프로세서 코어들), 하나 이상의 메모리/저장 디바이스들(1418), 및 하나 이상의 통신 리소스들(1420)을 포함한 하드웨어 리소스들(1402)의 도식적 표현을 도시한다. 노드 가상화(예컨대, NFV)가 활용되는 실시 형태들의 경우, 하나 이상의 네트워크 슬라이스들/서브슬라이스들이 하드웨어 리소스들(1402)을 활용하기 위한 실행 환경을 제공하기 위해 하이퍼바이저(hypervisor)(1404)가 실행될 수 있다.
프로세서들(1412)(예를 들어, 중앙 프로세싱 유닛(CPU), RISC 프로세서, CISC 프로세서, GPU, 기저대역 프로세서와 같은 디지털 신호 프로세서(DSP), ASIC, RFIC, 다른 프로세서, 또는 이들의 임의의 적합한 조합)은, 예를 들어, 프로세서(1414) 및 프로세서(1416)를 포함할 수 있다.
메모리/저장 디바이스들(1418)은 메인 메모리, 디스크 저장소, 또는 이들의 임의의 적합한 조합을 포함할 수 있다. 메모리/저장 디바이스들(1418)은 DRAM, SRAM, EPROM, EEPROM, 플래시 메모리, 솔리드 스테이트 저장소 등과 같은 임의의 유형의 휘발성 또는 비휘발성 메모리를 포함할 수 있지만, 이들로 제한되지 않는다.
통신 리소스들(1420)은 네트워크(1410)를 통해 하나 이상의 주변기기 디바이스들(1406) 또는 하나 이상의 데이터베이스들(1408)과 통신하기 위한 상호접속 또는 네트워크 인터페이스 컴포넌트들 또는 다른 적합한 디바이스들을 포함할 수 있다. 예를 들어, 통신 리소스들(1420)은 (예를 들어, USB를 통해 커플링하기 위한) 유선 통신 컴포넌트들, 셀룰러 통신 컴포넌트들, NFC 컴포넌트들, Bluetooth® 컴포넌트들(예를 들어, Bluetooth® Low Energy), Wi-Fi® 컴포넌트들, 및 다른 통신 컴포넌트들을 포함할 수 있다.
명령어들(1424)은 프로세서들(1412) 중 적어도 임의의 것으로 하여금 본 명세서에서 논의되는 방법론들 중 임의의 하나 이상을 수행하게 하기 위한 소프트웨어, 프로그램, 애플리케이션, 애플릿, 앱, 또는 다른 실행가능 코드를 포함할 수 있다. 명령어들(1424)은 프로세서들(1412)(예컨대, 프로세서의 캐시 메모리 내의 것), 메모리/저장 디바이스들(1418), 또는 이들의 임의의 적합한 조합 중 적어도 하나 내에, 전체적으로 또는 부분적으로 상주할 수 있다. 추가로, 명령어들(1424)의 임의의 일부분이 주변기기 디바이스들(1406) 또는 데이터베이스들(1408)의 임의의 조합으로부터 하드웨어 리소스들(1402)로 전송될 수 있다. 그에 따라, 프로세서들(1412)의 메모리, 메모리/저장 디바이스들(1418), 주변기기 디바이스들(1406), 및 데이터베이스들(1408)은 컴퓨터 판독가능 및 기계 판독가능 매체들의 예들이다.
하나 이상의 실시 형태들에 대해, 선행 도면들 중 하나 이상에서 설명되는 컴포넌트들 중 적어도 하나는 하기의 실시예 섹션에서 설명되는 바와 같은 하나 이상의 동작들, 기법들, 프로세스들, 및/또는 방법들을 수행하도록 구성될 수 있다. 예를 들어, 선행하는 도면들 중 하나 이상과 관련하여 전술된 바와 같은 기저대역 회로부는 아래에 기술되는 실시예들 중 하나 이상에 따라 동작하도록 구성될 수 있다. 다른 예를 들어, 선행하는 도면들 중 하나 이상과 관련하여 전술된 바와 같은 UE, 기지국, 네트워크 요소 등과 연관된 회로부는 실시예 섹션에서 아래에 기술되는 실시예들 중 하나 이상에 따라 동작하도록 구성될 수 있다.
실시예 섹션
다음 실시예들은 추가적인 실시 형태들에 관한 것이다.
실시예 1A는 무선 시스템에서 DL PRS들을 위한 리소스들을 할당하기 위한 장치이다. 본 장치는, 기저대역 프로세서 및 명령어들을 저장하는 메모리를 포함하고, 명령어들은, 기저대역 프로세서에 의해 실행될 때, 장치를, 무선 통신 시스템에서 복수의 기지국들에 의한 DL PRS 송신에 전용되는 주기적으로 반복된 양의 리소스들을 포함하는 DL PRS 리소스 풀을 구성하도록; DL PRS 리소스 풀을 복수의 기지국들 중 하나 이상의 기지국에 대응하는 복수의 DL PRS 리소스 세트들로 분할하도록; 그리고, DL PRS들의 송신을 위해 복수의 DL PRS 리소스 세트들 내의 구성된 DL PRS 리소스들을 생성하도록 구성한다.
실시예 2A는 실시예 1A의 장치를 포함하고, 여기서 DL PRS 리소스 풀을 구성하는 것은, 고유 DL PRS 풀 식별자(ID); DL PRS 풀 대역폭; 2개의 연속적인 DL PRS 풀들 사이의 시간을 정의하는 DL PRS 풀 주기성; 및 DL PRS 풀 시간 오프셋을 포함하는 하나 이상의 파라미터들을 구성하는 것을 포함한다.
실시예 3A는 실시예 A2의 장치를 포함하고, 여기서 DL PRS 풀 시간 오프셋은 미리결정된 시스템 프레임 번호(SFN)에 대하여 슬롯들에서 정의된다.
실시예 4A는 실시예 1A 내지 실시예 3A 중 어느 하나의 장치를 포함하고, 여기서 DL PRS 리소스 풀을 구성하는 것은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 어느 슬롯들이 구성되는지를 나타내도록 DL PRS 풀 슬롯 패턴을 구성하는 것을 포함한다.
실시예 5A는 실시예 4A의 장치를 포함하고, 여기서 DL PRS 풀 슬롯 패턴을 구성하는 것은 DL PRS 리소스 풀 내의 각각의 PRS 할당된 슬롯을 나타내도록 비트맵 패턴을 포맷하는 것을 포함한다.
실시예 6A는 실시예 1A 내지 실시예 3A 중 어느 하나의 장치를 포함하고, 여기서 DL PRS 리소스 풀을 구성하는 것은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 슬롯 내의 어느 심볼들이 구성되는지를 나타내도록 DL PRS 풀 심볼 패턴을 구성하는 것을 포함한다.
실시예 7A는 실시예 6A의 장치를 포함하고, 여기서 DL PRS 풀 심볼 패턴을 구성하는 것은 DL PRS 송신을 위해 이용가능한 각각의 슬롯 내의 각각의 할당된 심볼을 나타내도록 비트맵 패턴을 포맷하는 것을 포함한다.
실시예 8A는 실시예 2A의 장치를 포함하고, 여기서 DL PRS 풀 대역폭을 구성하는 것은 기준 포인트에 대하여 DL PRS 리소스 풀에 대한 시작 및 종료 물리적 리소스 블록(PRB)을 나타내는 것; 기준 포인트에 대한 PRB 오프셋 및 DL PRS 리소스 풀에 대한 할당된 PRB들의 수를 나타내는 것; 또는 기준 포인트에 대하여 비트맵으로서 정의되는 PRB 할당 패턴을 나타내는 것 중 하나를 포함한다.
실시예 9A는 실시예 1A의 장치를 포함하고, 여기서 DL PRS 리소스 풀을 구성하는 것은, 구성된 DL PRS 리소스 세트를 식별하기 위한 리소스 세트 식별자(ID); 구성된 DL PRS 리소스 세트가 어느 셀에 속하는지를 나타내기 위한 셀 ID; 구성된 DL PRS 리소스 세트 내의 DL PRS 리소스들을 나타내기 위한 DL PRS 리소스 ID들의 목록; 리소스 세트 유형; 동일한 공간 송신(TX) 필터가, 구성된 DL PRS 리소스 세트 내의 DL PRS 리소스들 전체에 걸쳐 적용되는지 여부를 나타내기 위한 동일한 TX 안테나 포트 필드; 및 DL PRS 송신 기회들의 활성화 및/또는 비활성화를 위한 뮤팅 비트맵을 포함하는 하나 이상의 파라미터들을 구성하는 것을 포함한다.
실시예 10A는 실시예 1A의 장치를 포함하고, 여기서 구성된 DL PRS 리소스들은, 리소스 요소 맵 패턴; 정의된 DL PRS 리소스 요소 맵핑 패턴의 주파수 시프트; DL PRS 송신을 위해 사용되는 송신 빔을 나타내기 위한 송신(TX) 빔 식별자(ID); 안테나 포트들의 수; 리소스 ID; 구성된 DL PRS 리소스가 DL PRS 리소스 풀 내에서 시작하는 제1 직교 주파수 분할 다중화(OFDM) 심볼을 가리키는 시간에서의 오프셋; 리소스 지속기간; 하나 이상의 의사 랜덤 DL PRS 시퀀스들을 생성하기 위한 시퀀스 ID; 및 준-병치 정보(TCI) 상태 ID를 포함하는 그룹으로부터 선택된 하나 이상의 파라미터들을 포함한다.
실시예 11A는 실시예 10A의 장치를 포함하고, 여기서 리소스 요소 맵 패턴은 고유 주파수 시프트들에 대응하는 comb-N 주파수 할당 패턴들을 포함하는 N개의 연속적인 심볼들에 기초하고, 여기서 N의 값 = {1,2,3,4}이다.
실시예 12A는 무선 시스템에서 다운링크(DL) 포지셔닝 기준 신호(PRS)들을 송신하기 위한 방법이다. 본 방법은, 무선 통신 시스템에서 복수의 g node B(gNB)들에 의한 DL PRS 송신에 전용되는 주기적으로 반복된 양의 리소스들을 포함하는 DL PRS 리소스 풀을 구성하는 단계; DL PRS 리소스 풀을 복수의 gNB들 중 하나 이상의 gNB에 대응하는 복수의 DL PRS 리소스 세트들로 분할하는 단계; 및 복수의 DL PRS 리소스 세트들 내의 구성된 DL PRS 리소스들 상의 송신을 위해 DL PRS들을 인코딩하는 단계를 포함한다.
실시예 13A는 실시예 12A의 방법을 포함하고, 여기서 DL PRS 리소스 풀을 구성하는 단계는, 고유 DL PRS 풀 식별자(ID); DL PRS 풀 대역폭; 2개의 연속적인 DL PRS 풀들 사이의 시간을 정의하는 DL PRS 풀 주기성; 및 DL PRS 풀 시간 오프셋을 포함하는 하나 이상의 파라미터들을 구성하는 단계를 포함한다.
실시예 14A는 실시예 13A의 방법을 포함하고, 여기서 DL PRS 풀 시간 오프셋은 미리결정된 시스템 프레임 번호(SFN)에 대하여 슬롯들에서 정의된다.
실시예 15A는 실시예 12A 내지 실시예 14A 중 어느 하나의 방법을 포함하고, 여기서 DL PRS 리소스 풀을 구성하는 단계는 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 어느 슬롯들이 구성되는지를 나타내도록 DL PRS 풀 슬롯 패턴을 구성하는 단계를 포함한다.
실시예 16A는 실시예 15A의 방법을 포함하고, 여기서 DL PRS 풀 슬롯 패턴을 구성하는 단계는 DL PRS 리소스 풀 내의 각각의 PRS 할당된 슬롯을 나타내는 비트맵 패턴을 포맷하는 단계를 포함한다.
실시예 17A는 실시예 12A 내지 실시예 14A 중 어느 하나의 방법을 포함하고, 여기서 DL PRS 리소스 풀을 구성하는 단계는 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 슬롯 내의 어느 심볼들이 구성되는지를 나타내도록 DL PRS 풀 심볼 패턴을 구성하는 단계를 포함한다.
실시예 18A는 실시예 17A의 방법을 포함하고, 여기서 DL PRS 풀 심볼 패턴을 구성하는 단계는 DL PRS 송신을 위해 이용가능한 각각의 슬롯 내의 각각의 할당된 심볼을 나타내는 비트맵 패턴을 포맷하는 단계를 포함한다.
실시예 19A는 실시예 13A의 방법을 포함하고, 여기서 DL PRS 풀 대역폭을 구성하는 단계는 기준 포인트에 대하여 DL PRS 리소스 풀에 대한 시작 및 종료 물리적 리소스 블록(PRB)의 표시를 제공하는 단계; 기준 포인트에 대한 PRB 오프셋 및 DL PRS 리소스 풀에 대한 할당된 PRB들의 수의 표시를 제공하는 단계; 또는 기준 포인트에 대하여 비트맵으로서 정의되는 PRB 할당 패턴의 표시를 제공하는 단계 중 하나를 포함한다.
실시예 20A는 실시예 12A의 방법을 포함하고, 여기서 DL PRS 리소스 풀을 구성하는 단계는, 구성된 DL PRS 리소스 세트를 식별하기 위한 리소스 세트 식별자(ID); 구성된 DL PRS 리소스 세트가 어느 셀에 속하는지를 나타내기 위한 셀 ID; 구성된 DL PRS 리소스 세트 내의 DL PRS 리소스들을 나타내기 위한 DL PRS 리소스 ID들의 목록; 리소스 세트 유형; 동일한 공간 송신(TX) 필터가, 구성된 DL PRS 리소스 세트 내의 DL PRS 리소스들 전체에 걸쳐 적용되는지 여부를 나타내기 위한 동일한 TX 안테나 포트 필드; 및 DL PRS 송신 기회들의 활성화 및/또는 비활성화를 위한 뮤팅 비트맵을 포함하는 하나 이상의 파라미터들을 구성하는 단계를 포함한다.
실시예 21A는 실시예 12A의 방법을 포함하고, 여기서 구성된 DL PRS 리소스들은, 리소스 요소 맵핑 패턴; 정의된 DL PRS 리소스 요소 맵핑 패턴의 주파수 시프트; DL PRS 송신을 위해 사용되는 송신 빔을 나타내기 위한 송신(TX) 빔 식별자(ID); 안테나 포트들의 수; 리소스 ID; 구성된 DL PRS 리소스가 DL PRS 리소스 풀 내에서 시작하는 제1 직교 주파수 분할 다중화(OFDM) 심볼을 가리키는 시간에서의 오프셋; 리소스 지속기간; 하나 이상의 의사 랜덤 DL PRS 시퀀스들을 생성하기 위한 시퀀스 ID; 및 준-병치 정보(TCI) 상태 ID를 포함하는 그룹으로부터 선택된 하나 이상의 파라미터들을 포함한다.
실시예 22A는 실시예 21A의 방법을 포함하고, 여기서 리소스 요소 맵핑 패턴은 고유 주파수 시프트들에 대응하는 comb-N 주파수 할당 패턴들을 포함하는 N개의 연속적인 심볼들에 기초하고, 여기서 N의 값 = {1,2,3,4}이다.
실시예 1B는 NR DL PRS 구성의 방법을 포함할 수 있고, NR DL PRS 구성은, NR DL PRS 리소스 풀의 구성; NR DL PRS 리소스 세트의 구성; NR DL PRS 리소스의 구성; NR DL PRS 리소스 요소 맵핑 패턴의 구성; NR DL PRS 시퀀스의 구성; 및/또는 NR DL PRS BWP의 구성으로 이루어진다.
실시예 2B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스 풀은 다음의 파라미터들 중 하나 또는 이들의 조합이도록 구성된다: DL PRS 풀 Id, 고유 식별자; DL PRS 풀 대역폭; DL PRS 풀 주기성 - 주기성은 2개의 연속적인 DL PRS 풀들 사이의 시간을 정의함 -; DL PRS 풀 시간 오프셋 - 오프셋은 SFN = 0에 대하여 슬롯들에서 정의됨 -; DL PRS 풀 슬롯 패턴 - 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 어느 슬롯들이 구성되는지를 나타냄 -; 및/또는 DL PRS 풀 심볼 패턴 - 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 슬롯 내의 어느 심볼들이 구성되는지를 나타냄 -.
실시예 3B는 실시예 2B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 DL PRS 풀 대역폭이 구성되고, 다음의 규칙들 중 하나 또는 이들의 조합이 NR DL PRS에 대한 대역폭 결정을 위해 사용된다: 기준 포인트 A에 대하여 PRS 리소스 풀에 대한 시작 및 종료 PRB의 표시; 기준 포인트 A에 대한 PRB 오프셋 및 DL PRS 리소스 풀에 대한 할당된 PRB들의 수의 표시; 기준 포인트 A에 대하여 비트맵으로서 정의되는 PRB 할당 패턴의 표시.
실시예 4B는 실시예 3B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 DL PRS 풀 대역폭은 기준 포인트 A에 대해 상대적으로 구성되고, 이러한 기준 포인트 A는 포지셔닝 DWP 내의 포인트로서 정의되고 시스템에서 미리정의된다.
실시예 5B는 실시예 2B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 DL PRS 풀 슬롯 패턴이 구성되고, 이는 NR DL PRS 리소스 풀 내의 각각의 할당된 슬롯을 나타내는 비트맵 패턴으로 이루어진다.
실시예 6B는 실시예 2B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 DL PRS 풀 심볼 패턴이 구성되고, 이는 다음의 방법들 중 하나 또는 이들의 조합에 의해 정의된다: 비트맵 패턴은 NR DL PRS 송신을 위해 이용가능한 각각의 슬롯 내의 각각의 할당된 심볼을 나타냄 - 이러한 패턴은 미리정의되거나 상위 계층들을 통해 시그널링됨 -; ND DL PRS 송신에 사용되지 않는 각각의 슬롯의 시작에서의 심볼들의 수를 나타냄 - 이러한 수는 미리정의되거나 상위 계층들을 통해 시그널링됨 -.
실시예 7B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스 풀이 인에이블되는 경우에, NR DL PRS 리소스 세트가 구성되고, NR DL PRS 리소스는 NR DL PRS 리소스 풀 내의 한 세트의 리소스들로서 정의되고, PRS 리소스 풀로부터의 모든 구성 파라미터들이 PRS 리소스 세트에 적용된다.
실시예 8B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스 풀이 인에이블되는 경우에, NR DL PRS 리소스 세트가 구성되고, NR DL PRS 리소스는 독립적으로 정의되고, PRS 리소스 풀로부터의 모든 구성 파라미터들이 PRS 리소스 세트에 적용된다.
실시예 9B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스 세트가 구성되고, 다음의 파라미터들 중 하나 또는 이들의 조합이 PRS 리소스 풀을 정의한다: 구성된 DL PRS 리소스 세트가 어느 셀에 속하는지를 나타내는 셀 ID; 구성된 DL PRS 리소스 세트를 식별하는, 리소스 세트 ID; 주어진 DL PRS 리소스 세트를 구성하는 DL PRS 리소스들을 나타내는, DL PRS 리소스 ID들의 목록; 리소스 세트 유형(예컨대, 주기적 또는 반지속적); 동일한 공간 TX 필터가 세트 내의 모든 DL PRS 리소스들 전체에 걸쳐 적용되는지 여부를 나타내는, 동일한 TX 안테나 포트(들)(반복); 주어진 DL PRS 송신 기회가 DL PRS 송신을 위해 사용되는지 또는 아닌지 여부를 나타내는, DL PRS 송신 기회들의 활성화/비활성화를 위한 뮤팅 비트맵.
실시예 10B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스가 구성되고, DL PRS 리소스는 DL PRS 리소스 세트로부터의 일정 리소스로서 정의된다.
실시예 11B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스가 구성되고, 다음의 파라미터들 중 하나 또는 이들의 조합이 PRS 리소스를 정의한다: DL PRS 리소스의 각각의 심볼에 대한 리소스 요소 맵핑 패턴을 정의하는, 리소스 요소 맵핑 패턴; 정의된 DL PRS 리소스 요소 맵핑 패턴의 주파수 시프트를 가리키는, 주파수 시프트; DL PRS 송신을 위해 사용되는 송신 빔을 나타내는, Tx 빔 ID; DL PRS 리소스당 안테나 포트들의 수(예컨대, 1개 또는 2개)를 나타내는, 포트들의 수; 리소스 ID; DL PRS 리소스가 DL PRS 풀 내에서 시작하는 제1 OFDM 심볼을 가리키는, 시간에서의 오프셋; 단일 DL PRS 리소스의 지속기간일 수 있는, 리소스 지속기간(기회들의 개념은 기회들 전체에 걸친 DL PRS 뮤팅 패턴들을 포함하는 다양한 DL PRS 송신 스케줄들에 적용될 수 있음); 의사 랜덤 DL PRS 시퀀스(들)를 생성하는 데 사용된 시퀀스 ID; 및/또는 준-병치 정보(TCI 상태 ID).
실시예 12B는 실시예 11B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스는 리소스 요소 맵핑 패턴으로 구성되고, 리소스 요소 맵핑 패턴은, 각각 고유 주파수 시프트를 갖는 comb-N 주파수 할당 패턴들을 포함하는 N개의 연속적인 심볼들에 기초한다. N의 값 = {1,2,3,4}이다.
실시예 13B는 실시예 11B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스가 구성되고, 각각의 고유한 NR DL PRS 리소스에 대해 할당된 리소스들의 총량은 동일하다.
실시예 14B는 실시예 11B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스가 구성되고, 이는 적어도 다음의 UE 특정 구성 파라미터에 의해 구성가능하다: NPRS_ID는 NR DL PRS 구성에 대해 전용됨; Δ는 PRS 풀의 상이한 기간들에서 미리정의된 NR DL PRS 랜덤화를 수행하는 데 사용되는 파라미터임.
실시예 15B는 실시예 14B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 UE 특정 구성 파라미터 Δ는 미리정의된 NR DL PRS 랜덤화에 대해 사용되고, 이는 적어도 다음의 파라미터들에 의존한다: SFN, DL PRS 리소스 세트에서의 Tx 빔의 수, N, DL PRS 리소스 풀 주기 및 ΔPRS_init - gNB-특정 파라미터 초기 델타 값. 일례로서, 랜덤화 파라미터 계산을 위해 다음의 수학식이 사용될 수 있다:
실시예 16B는 실시예 11B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스는 주파수 시프트로 구성되고, 이는 시스템 특정 파라미터들에 의존한다: N; 및 UE-특정 파라미터들: 
, 
. 일례로서, 시간 시프트 계산을 위해 다음의 수학식이 사용될 수 있다: 
.
실시예 17B는 실시예 11B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스는 시간 오프셋으로 구성되고, 이는 시스템 특정 파라미터들에 의존한다: N, NPRS_RES 및 NPRS_SET_NUM - DL PRS 리소스 풀 내의 DL PRS 리소스 세트들의 총 수; 및 UE-특정 파라미터들: 
, 
. 일례로서, 시간 시프트 계산을 위해 다음의 수학식이 사용될 수 있다:
실시예 18B는 실시예 11B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스는 Tx 빔 Id로 구성되고, 이는 시스템 특정 파라미터들에 의존한다: N, NPRS_BEAM - PRS 리소스 세트 내의 Tx 빔들의 수 및 NPRS_res_id - DL PRS 리소스 Id; 및 UE-특정 파라미터들: 
. 일례로서, Tx 빔 Id 계산을 위해 다음의 수학식이 사용될 수 있다: 
실시예 19B는 실시예 11B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 리소스는 1 또는 2일 수 있는 Tx 안테나들의 수로 구성된다.
실시예 20B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS BWP가 구성되고, 이는 '포지셔닝 BWP'로서 시스템에서 별개로 정의되고 UE 상에서 별개로 구성될 수 있다. UE 관점으로부터, 그것은 '포지셔닝 DL BWP' 내에서만 DL PRS 신호들의 프로세싱을 암시할 수 있다.
실시예 21B는 실시예 20B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 포지셔닝 BWP가 정의되고, 이는 항상 NR DL PRS 구성 파라미터들과 정렬된다. UE DL PRS 프로세싱 대역폭이 구성된 DL PRS의 대역폭보다 작은 경우에, gNB는 UE 프로세싱 능력들에 따라 '포지셔닝' DL BWP를 구성한다.
실시예 22B는 실시예 20B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 포지셔닝 BWP가 정의되고, '포지셔닝' DL BWP가 활성 DL BWP 내에 할당되는 경우, UE는 스위칭할 필요가 없다. DL BWP 스위칭의 가정들은 DL PRS 프로세싱을 위해 재사용된다.
실시예 23B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS가 구성되고, 서빙 셀로부터의 NR DL PRS가 다른 기준 신호들(예컨대, NR Rel.15/16)과의 준-병치에 의해 연관될 수 있다. 그러한 목적을 위해, 준-병치 시그널링이 사용될 수 있다. 적용가능하다면, DL PRS QCL의 다음의 옵션들 중 하나 또는 이들의 조합이 적용된다: DL PRS 리소스 세트 내의 DL PRS 리소스(들)는 QCL 유형-A를 사용하여 서로 준-병치된 것으로서 구성됨; DL PRS 리소스 세트 내의 DL PRS 리소스(들)는 QCL 유형-A 및/또는 QCL 유형-D를 사용하여 추적(TRS)하기 위해 CSI-RS와 준-병치된 것으로서 구성됨; DL PRS 리소스 세트 내의 DL PRS 리소스(들)는 QCL 유형-D를 사용하여 빔 관리(BM)를 위해 CSI-RS와 준-병치된 것으로서 구성됨; DL PRS 리소스 세트 내의 DL PRS 리소스(들)는 QCL 유형-C 및/또는 QCL 유형-D를 사용하여 SSB(SSB 인덱스)와 준-병치된 것으로서 구성됨.
실시예 24B는 실시예 1B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 NR DL PRS 구성이 기술되고, ND DL PRS 리소스 스케줄링이 지원이고, 2개의 DL PRS 송신 스케줄링 모드들이 NR에 의해 지원된다: PRS 송신 모드 1: 미리정의된 PRS 송신 스케줄(PTM1)에 기초함, 여기서 주어진 PRS 리소스 상의 PRS 송신 패턴은 UE로 시그널링됨(예컨대, 미리구성됨); PRS 송신 모드 2: 의사 랜덤 PRS 송신 스케줄(PTM2)에 기초함, 여기서 주어진 PRS 리소스 상의 PRS 송신은 (예컨대, PRS 송신 PPRS_TX의 (미리)구성된 확률에 따라) 확률적으로 제어되고, 공간 (빔), 시간, 주파수 및 코드 랜덤화 기법들이 전용된 리소스들 상의 DL PRS 송신을 위해 적용됨.
실시예 26B는 실시예 25B의 방법 또는 본 명세서의 일부 다른 실시예를 포함할 수 있고, 여기서 의사 랜덤 NR DL PRS 리소스 스케줄링이 인에이블되고, 이는 다음의 옵션들 중 하나 또는 이들의 조합에 의해 정의된다: 공간 랜덤화(DL PRS 송신을 위한 빔(들)이 랜덤하게 할당됨); 시간 랜덤화(DL PRS 송신을 위한 시간 리소스(들)가 랜덤하게 할당됨); 주파수 랜덤화(DL PRS 송신을 위한 주파수 리소스(들)가 랜덤하게 할당됨); 및/또는 코드 랜덤화(DL PRS 송신을 위한 시퀀스(들)가 랜덤하게 할당됨).
실시예 1C는 상기 실시예들 중 어느 하나에서 기술되거나 그와 관련된 방법, 또는 본 명세서에 기술된 임의의 다른 방법 또는 프로세스의 하나 이상의 요소들을 수행하기 위한 수단을 포함하는 장치를 포함할 수 있다.
실시예 2C는 명령어들을 포함하는 하나 이상의 비일시적 컴퓨터 판독가능 매체들을 포함할 수 있으며, 명령어들은, 전자 디바이스로 하여금, 전자 디바이스의 하나 이상의 프로세서들에 의한 명령어들의 실행 시에, 상기 실시예들 중 임의의 것에서 설명되거나 그에 관련된 방법, 또는 본 명세서에 설명된 임의의 다른 방법 또는 프로세스의 하나 이상의 요소들을 수행하게 한다.
실시예 3C는 상기 실시예들 중 임의의 것에서 설명되거나 그에 관련된 방법, 또는 본 명세서에 설명된 임의의 다른 방법 또는 프로세스의 하나 이상의 요소들을 수행하기 위한 로직, 모듈들, 또는 회로부를 포함하는 장치를 포함할 수 있다.
실시예 4C는 상기 실시예들 중 임의의 것, 또는 그의 일부들 또는 부분들에서 설명되거나 그에 관련된 바와 같은 방법, 기법, 또는 프로세스를 포함할 수 있다.
실시예 5C는 하나 이상의 프로세서들, 및 명령어들을 포함하는 하나 이상의 컴퓨터 판독가능 매체들을 포함하는 장치를 포함할 수 있으며, 명령어들은, 하나 이상의 프로세서들에 의해 실행될 때, 하나 이상의 프로세서들로 하여금, 상기 실시예들 중 임의의 것, 또는 그의 일부들에서 설명되거나 그에 관련된 바와 같은 방법, 기법들, 또는 프로세스를 수행하게 한다.
실시예 6C는 상기 실시예들 중 임의의 것, 또는 그의 일부들 또는 부분들에서 설명되거나 그에 관련된 바와 같은 신호를 포함할 수 있다.
실시예 7C는 상기 실시예들 중 임의의 것, 또는 그의 일부들 또는 부분들에서 설명되거나 그에 관련되거나, 또는 본 개시내용에서 달리 설명된 바와 같은 데이터그램, 패킷, 프레임, 세그먼트, 프로토콜 데이터 유닛(PDU), 또는 메시지를 포함할 수 있다.
실시예 8C는 상기 실시예들 중 임의의 것, 또는 그의 일부들 또는 부분들에서 설명되거나 그에 관련되거나, 또는 본 개시내용에서 달리 설명된 바와 같은 데이터로 인코딩된 신호를 포함할 수 있다.
실시예 9C는 상기 실시예들 중 임의의 것, 또는 그의 일부들 또는 부분들에서 설명되거나 그에 관련되거나, 또는 본 개시내용에서 달리 설명된 바와 같은 데이터그램, 패킷, 프레임, 세그먼트, PDU, 또는 메시지로 인코딩된 신호를 포함할 수 있다.
실시예 10C는 컴퓨터 판독가능 명령어들을 반송하는 전자기 신호를 포함할 수 있으며, 여기서 하나 이상의 프로세서들에 의한 컴퓨터 판독가능 명령어들의 실행은, 하나 이상의 프로세서들로 하여금, 상기 실시예들 중 임의의 것, 또는 그의 일부들에서 설명되거나 그에 관련된 바와 같은 방법, 기법들, 또는 프로세스를 수행하게 한다.
실시예 11C는 명령어들을 포함하는 컴퓨터 프로그램을 포함할 수 있으며, 여기서 프로세싱 요소에 의한 프로그램의 실행은, 프로세싱 요소로 하여금, 상기 실시예들 중 임의의 것, 또는 그의 일부들에서 설명되거나 그에 관련된 바와 같은 방법, 기법들, 또는 프로세스를 수행하게 한다.
실시예 12C는 본 명세서에 도시되고 기술된 바와 같은 무선 네트워크 내의 신호를 포함할 수 있다.
실시예 13C는 본 명세서에 도시되고 설명된 바와 같은 무선 네트워크에서 통신하는 방법을 포함할 수 있다.
실시예 14C는 본 명세서에 도시되고 설명된 바와 같은 무선 통신을 제공하기 위한 시스템을 포함할 수 있다.
실시예 15C는 본 명세서에 도시되고 설명된 바와 같은 무선 통신을 제공하기 위한 디바이스를 포함할 수 있다.
위에서 설명된 실시예들 중 임의의 것은 달리 명확하게 나타내지 않으면, 임의의 다른 실시예(또는 실시예들의 조합)와 조합될 수 있다. 하나 이상의 구현예들의 전술한 설명은 예시 및 설명을 제공하지만, 총망라하거나 또는 실시 형태들의 범주를 개시된 정확한 형태로 제한하도록 의도되지 않는다. 수정들 및 변형들이 위의 교시들을 고려하여 가능하거나 다양한 실시 형태들의 실시로부터 획득될 수 있다.
본 명세서에 설명된 시스템들 및 방법들의 실시 형태들 및 구현예들은, 컴퓨터 시스템에 의해 실행될 기계 실행가능 명령어들로 구현될 수 있는 다양한 동작들을 포함할 수 있다. 컴퓨터 시스템은 하나 이상의 범용 또는 특수 목적 컴퓨터들(또는 다른 전자 디바이스들)을 포함할 수 있다. 컴퓨터 시스템은 동작들을 수행하기 위한 특정 로직을 포함하는 하드웨어 컴포넌트들을 포함할 수 있거나, 하드웨어, 소프트웨어, 및/또는 펌웨어의 조합을 포함할 수 있다.
본 명세서에 설명된 시스템들이 특정 실시 형태들의 설명들을 포함한다는 것을 인식해야 한다. 이들 실시 형태들은 단일 시스템들로 조합되거나, 다른 시스템들로 부분적으로 조합되거나, 다수의 시스템들로 분할되거나 또는 다른 방식들로 분할 또는 조합될 수 있다. 부가적으로, 일 실시 형태의 파라미터들, 속성들, 태양들 등이 다른 실시 형태에서 사용될 수 있다는 것이 고려된다. 파라미터들, 속성들, 태양들 등은 단지 명확성을 위해 하나 이상의 실시 형태들에서만 설명되며, 본 명세서에 구체적으로 부인되지 않는 한, 파라미터들, 속성들, 태양들 등이 다른 실시 형태의 파라미터들, 속성들, 태양들 등과 조합되거나 그들로 대체될 수 있다는 것을 인식한다.
전술한 것이 명료함의 목적들을 위해 일부 세부사항으로 설명되었지만, 본 발명의 원리들을 벗어나지 않으면서 소정의 변화들 및 수정들이 행해질 수 있다는 것은 자명할 것이다. 본 명세서에 설명된 프로세스들 및 장치들 둘 모두를 구현하는 많은 대안적인 방식들이 존재한다는 것을 유의해야 한다. 따라서, 본 실시 형태들은 제한적인 것이 아니라 예시적인 것으로 간주되어야 하며, 설명은 본 명세서에 주어진 세부사항들로 제한되는 것이 아니라, 첨부된 청구범위의 범주 및 등가물들 내에서 수정될 수 있다.
Claims (29)
- 무선 시스템에서 다운링크(downlink, DL) 포지셔닝 기준 신호(positioning reference signal, PRS)들을 위한 리소스들을 할당하기 위한 장치로서,
기저대역 프로세서; 및
명령어들을 저장하는 메모리를 포함하고, 상기 명령어들은, 상기 기저대역 프로세서에 의해 실행될 때, 상기 장치를,
무선 통신 시스템에서 복수의 기지국들에 의한 DL PRS 송신에 전용되는 주기적으로 반복된 양의 리소스들을 포함하는 DL PRS 리소스 풀(pool)을 구성하도록;
상기 DL PRS 리소스 풀을 상기 복수의 기지국들 중 하나 이상의 기지국에 대응하는 복수의 DL PRS 리소스 세트들로 분할하도록; 그리고,
상기 DL PRS들의 송신을 위해 상기 복수의 DL PRS 리소스 세트들 내의 구성된 DL PRS 리소스들을 생성하도록 구성하는, 장치. - 제1항에 있어서, 상기 DL PRS 리소스 풀을 구성하는 것은, 고유 DL PRS 풀 식별자(ID); DL PRS 풀 대역폭; 2개의 연속적인 DL PRS 풀들 사이의 시간을 정의하는 DL PRS 풀 주기성; 및 DL PRS 풀 시간 오프셋을 포함하는 하나 이상의 파라미터들을 구성하는 것을 포함하는, 장치.
- 제2항에 있어서, 상기 DL PRS 풀 시간 오프셋은 미리결정된 시스템 프레임 번호(system frame number, SFN)에 대하여 슬롯들에서 정의되는, 장치.
- 제1항 내지 제3항 중 어느 한 항에 있어서, 상기 DL PRS 리소스 풀을 구성하는 것은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 어느 슬롯들이 구성되는지를 나타내도록 DL PRS 풀 슬롯 패턴을 구성하는 것을 포함하는, 장치.
- 제4항에 있어서, 상기 DL PRS 풀 슬롯 패턴을 구성하는 것은 상기 DL PRS 리소스 풀 내의 각각의 PRS 할당된 슬롯을 나타내도록 비트맵 패턴을 포맷하는 것을 포함하는, 장치.
- 제1항 내지 제3항 중 어느 한 항에 있어서, 상기 DL PRS 리소스 풀을 구성하는 것은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 슬롯 내의 어느 심볼들이 구성되는지를 나타내도록 DL PRS 풀 심볼 패턴을 구성하는 것을 포함하는, 장치.
- 제6항에 있어서, 상기 DL PRS 풀 심볼 패턴을 구성하는 것은 DL PRS 송신을 위해 이용가능한 각각의 슬롯 내의 각각의 할당된 심볼을 나타내도록 비트맵 패턴을 포맷하는 것을 포함하는, 장치.
- 제2항에 있어서, 상기 DL PRS 풀 대역폭을 구성하는 것은 기준 포인트에 대하여 상기 DL PRS 리소스 풀에 대한 시작 및 종료 물리적 리소스 블록(physical resource block, PRB)을 나타내는 것; 상기 기준 포인트에 대한 PRB 오프셋 및 상기 DL PRS 리소스 풀에 대한 할당된 PRB들의 수를 나타내는 것; 또는 상기 기준 포인트에 대하여 비트맵으로서 정의되는 PRB 할당 패턴을 나타내는 것 중 하나를 포함하는, 장치.
- 제1항에 있어서, 상기 DL PRS 리소스 풀을 구성하는 것은, 구성된 DL PRS 리소스 세트를 식별하기 위한 리소스 세트 식별자(ID); 상기 구성된 DL PRS 리소스 세트가 어느 셀에 속하는지를 나타내기 위한 셀 ID; 상기 구성된 DL PRS 리소스 세트 내의 DL PRS 리소스들을 나타내기 위한 DL PRS 리소스 ID들의 목록; 리소스 세트 유형; 동일한 공간 송신(TX) 필터가 상기 구성된 DL PRS 리소스 세트 내의 DL PRS 리소스들 전체에 걸쳐 적용되는지 여부를 나타내기 위한 동일한 TX 안테나 포트 필드; 및 DL PRS 송신 기회들의 활성화 및/또는 비활성화를 위한 뮤팅 비트맵(muting bitmap)을 포함하는 하나 이상의 파라미터들을 구성하는 것을 포함하는, 장치.
- 제1항에 있어서, 상기 구성된 DL PRS 리소스들은, 리소스 요소 맵 패턴; 정의된 DL PRS 리소스 요소 맵핑 패턴의 주파수 시프트; DL PRS 송신을 위해 사용된 송신 빔을 나타내기 위한 송신(TX) 빔 식별자(ID); 안테나 포트들의 수; 리소스 ID; 상기 구성된 DL PRS 리소스가 상기 DL PRS 리소스 풀 내에서 시작하는 제1 직교 주파수 분할 다중화(orthogonal frequency division multiplexing, OFDM) 심볼을 가리키는 시간에서의 오프셋; 리소스 지속기간; 하나 이상의 의사 랜덤 DL PRS 시퀀스들을 생성하기 위한 시퀀스 ID; 및 준-병치(quasi-collocation) 정보(TCI) 상태 ID를 포함하는 그룹으로부터 선택된 하나 이상의 파라미터들을 포함하는, 장치.
- 제10항에 있어서, 상기 리소스 요소 맵 패턴은 고유 주파수 시프트들에 대응하는 comb-N 주파수 할당 패턴들을 포함하는 N개의 연속적인 심볼들에 기초하고, 여기서 상기 N의 값 = {1,2,3,4}인, 장치.
- 무선 시스템에서 다운링크(DL) 포지셔닝 기준 신호(PRS)들을 송신하기 위한 방법으로서,
상기 무선 통신 시스템에서 복수의 g node B(gNB)들에 의한 DL PRS 송신에 전용되는 주기적으로 반복된 양의 리소스들을 포함하는 DL PRS 리소스 풀을 구성하는 단계;
상기 DL PRS 리소스 풀을 상기 복수의 gNB들 중 하나 이상의 gNB에 대응하는 복수의 DL PRS 리소스 세트들로 분할하는 단계; 및
상기 복수의 DL PRS 리소스 세트들 내의 구성된 DL PRS 리소스들 상의 송신을 위해 상기 DL PRS들을 인코딩하는 단계를 포함하는, 방법. - 제12항에 있어서, 상기 DL PRS 리소스 풀을 구성하는 단계는, 고유 DL PRS 풀 식별자(ID); DL PRS 풀 대역폭; 2개의 연속적인 DL PRS 풀들 사이의 시간을 정의하는 DL PRS 풀 주기성; 및 DL PRS 풀 시간 오프셋을 포함하는 하나 이상의 파라미터들을 구성하는 단계를 포함하는, 방법.
- 제13항에 있어서, 상기 DL PRS 풀 시간 오프셋은 미리결정된 시스템 프레임 번호(SFN)에 대하여 슬롯들에서 정의되는, 방법.
- 제12항 내지 제14항 중 어느 한 항에 있어서, 상기 DL PRS 리소스 풀을 구성하는 단계는 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 어느 슬롯들이 구성되는지를 나타내도록 DL PRS 풀 슬롯 패턴을 구성하는 단계를 포함하는, 방법.
- 제15항에 있어서, 상기 DL PRS 풀 슬롯 패턴을 구성하는 단계는 상기 DL PRS 리소스 풀 내의 각각의 PRS 할당된 슬롯을 나타내는 비트맵 패턴을 포맷하는 단계를 포함하는, 방법.
- 제12항 내지 제14항 중 어느 한 항에 있어서, 상기 DL PRS 리소스 풀을 구성하는 단계는 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 슬롯 내의 어느 심볼들이 구성되는지를 나타내도록 DL PRS 풀 심볼 패턴을 구성하는 단계를 포함하는, 방법.
- 제17항에 있어서, 상기 DL PRS 풀 심볼 패턴을 구성하는 단계는 DL PRS 송신을 위해 이용가능한 각각의 슬롯 내의 각각의 할당된 심볼을 나타내는 비트맵 패턴을 포맷하는 단계를 포함하는, 방법.
- 제13항에 있어서, 상기 DL PRS 풀 대역폭을 구성하는 단계는 기준 포인트에 대하여 상기 DL PRS 리소스 풀에 대한 시작 및 종료 물리적 리소스 블록(PRB)의 표시를 제공하는 단계; 상기 기준 포인트에 대한 PRB 오프셋 및 상기 DL PRS 리소스 풀에 대한 할당된 PRB들의 수의 표시를 제공하는 단계; 또는 상기 기준 포인트에 대하여 비트맵으로서 정의되는 PRB 할당 패턴의 표시를 제공하는 단계 중 하나를 포함하는, 방법.
- 제12항에 있어서, 상기 DL PRS 리소스 풀을 구성하는 단계는, 구성된 DL PRS 리소스 세트를 식별하기 위한 리소스 세트 식별자(ID); 상기 구성된 DL PRS 리소스 세트가 어느 셀에 속하는지를 나타내기 위한 셀 ID; 상기 구성된 DL PRS 리소스 세트 내의 DL PRS 리소스들을 나타내기 위한 DL PRS 리소스 ID들의 목록; 리소스 세트 유형; 동일한 공간 송신(TX) 필터가 상기 구성된 DL PRS 리소스 세트 내의 DL PRS 리소스들 전체에 걸쳐 적용되는지 여부를 나타내기 위한 동일한 TX 안테나 포트 필드; 및 DL PRS 송신 기회들의 활성화 및/또는 비활성화를 위한 뮤팅 비트맵을 포함하는 하나 이상의 파라미터들을 구성하는 단계를 포함하는, 방법.
- 제12항에 있어서, 상기 구성된 DL PRS 리소스들은, 리소스 요소 맵핑 패턴; 정의된 DL PRS 리소스 요소 맵핑 패턴의 주파수 시프트; DL PRS 송신을 위해 사용되는 송신 빔을 나타내기 위한 송신(TX) 빔 식별자(ID); 안테나 포트들의 수; 리소스 ID; 상기 구성된 DL PRS 리소스가 상기 DL PRS 리소스 풀 내에서 시작하는 제1 직교 주파수 분할 다중화(OFDM) 심볼을 가리키는 시간에서의 오프셋; 리소스 지속기간; 하나 이상의 의사 랜덤 DL PRS 시퀀스들을 생성하기 위한 시퀀스 ID; 및 준-병치 정보(TCI) 상태 ID를 포함하는 그룹으로부터 선택된 하나 이상의 파라미터들을 포함하는, 방법.
- 제21항에 있어서, 상기 리소스 요소 맵핑 패턴은 고유 주파수 시프트들에 대응하는 comb-N 주파수 할당 패턴들을 포함하는 N개의 연속적인 심볼들에 기초하고, 여기서 상기 N의 값 = {1,2,3,4}인, 방법.
- 컴퓨터 판독가능 저장 매체로서, 상기 컴퓨터 판독가능 저장 매체는 명령어들을 포함하고, 상기 명령어들은, 컴퓨터에 의해 실행될 때, 상기 컴퓨터로 하여금,
무선 통신 시스템에서 복수의 g node B(gNB)들에 의한 DL PRS 송신에 전용되는 주기적으로 반복된 양의 리소스들을 포함하는 DL PRS 리소스 풀을 구성하게 하고;
상기 DL PRS 리소스 풀을 상기 복수의 gNB들 중 하나 이상의 gNB에 대응하는 복수의 DL PRS 리소스 세트들로 분할하게 하고;
상기 복수의 DL PRS 리소스 세트들 내의 구성된 DL PRS 리소스들 상의 송신을 위해 상기 DL PRS들을 인코딩하게 하는, 컴퓨터 판독가능 저장 매체. - 제23항에 있어서, 상기 DL PRS 리소스 풀을 구성하게 하는 것은, 고유 DL PRS 풀 식별자(ID); DL PRS 풀 대역폭; 2개의 연속적인 DL PRS 풀들 사이의 시간을 정의하는 DL PRS 풀 주기성; 및 DL PRS 풀 시간 오프셋을 포함하는 하나 이상의 파라미터들을 구성하게 하는 것을 포함하는, 컴퓨터 판독가능 저장 매체.
- 제24항에 있어서, 상기 DL PRS 풀 시간 오프셋은 미리결정된 시스템 프레임 번호(SFN)에 대하여 슬롯들에서 정의되는, 컴퓨터 판독가능 저장 매체.
- 제23항에 있어서, 상기 DL PRS 리소스 풀을 구성하게 하는 것은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 어느 슬롯들이 구성되는지를 나타내도록 DL PRS 풀 슬롯 패턴을 구성하게 하는 것을 포함하는, 컴퓨터 판독가능 저장 매체.
- 제26항에 있어서, 상기 DL PRS 풀 슬롯 패턴을 구성하게 하는 것은 상기 DL PRS 리소스 풀 내의 각각의 PRS 할당된 슬롯을 나타내는 비트맵 패턴을 포맷하게 하는 것을 포함하는, 컴퓨터 판독가능 저장 매체.
- 제23항에 있어서, 상기 DL PRS 리소스 풀을 구성하게 하는 것은 주어진 DL PRS 리소스 상의 DL PRS 송신을 위해 슬롯 내의 어느 심볼들이 구성되는지를 나타내도록 DL PRS 풀 심볼 패턴을 구성하게 하는 것을 포함하는, 컴퓨터 판독가능 저장 매체.
- 제28항에 있어서, 상기 DL PRS 풀 심볼 패턴을 구성하게 하는 것은 DL PRS 송신을 위해 이용가능한 각각의 슬롯 내의 각각의 할당된 심볼을 나타내는 비트맵 패턴을 포맷하게 하는 것을 포함하는, 컴퓨터 판독가능 저장 매체.
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