KR20200088798A - 대역폭 부분 타이머 구성을 위해 작동 가능한 방법 및 사용자 장비 - Google Patents

대역폭 부분 타이머 구성을 위해 작동 가능한 방법 및 사용자 장비 Download PDF

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Abstract

대역폭 부분(BWP) 타이머 구성을 위해 작동 가능한 방법 및 사용자 장비가 제공된다. 이 방법은 네트워크 노드로부터 활성화된 BWP 상의 물리 다운링크 제어 채널(PDCCH)을 통해 다운링크 할당을 수신하는 단계, 및 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 단계를 포함한다.

Description

대역폭 부분 타이머 구성을 위해 작동 가능한 방법 및 사용자 장비
본 개시는 통신 시스템 분야에 관한 것으로, 보다 상세하게는 대역폭 부분(BWP) 타이머 구성을 위해 작동 가능한 방법 및 사용자 장비에 관한 것이다.
대역폭 부분(BWP: bandwidth part) 타이머가 데이터 송신 기간보다 작은 때, 사용자 장비와 같은 디바이스는 남아 있는 데이터를 송신 및/또는 수신하지 못한다. 즉, BWP 타이머의 만료로 인해 데이터 송신이 중단될 수도 있다.
대역폭 부분(BWP) 타이머의 구성을 위해 작동 가능한 방법 및 사용자 장비를 위한 새로운 기술 솔루션을 제공할 필요가 있다.
본 개시의 목적은 데이터 송신을 보장하기 위하여 대역폭 부분(BWP) 타이머 구성을 위해 작동 가능한 방법 및 사용자 장비를 제안하는 것이다.
본 개시의 제1 양태에서, 대역폭 부분(BWP) 타이머 구성을 위해 작동 가능한 사용자 장비는 메모리, 트랜시버, 및 메모리 및 트랜시버에 연결되는 프로세서를 포함한다. 프로세서는 네트워크 노드로부터 활성화된 BWP 상의 물리 다운링크 제어 채널(PDCCH: physical downlink control channel)을 통해 다운링크 할당을 수신하도록 트랜시버를 제어하고, 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하도록 구성된다.
본 개시의 제2 양태에서, 사용자 장비의 대역폭 부분(BWP) 타이머 구성을 위해 작동 가능한 방법은, 네트워크 노드로부터 활성화된 BWP 상의 물리 다운링크 제어 채널(PDCCH)을 통해 다운링크 할당을 수신하는 단계, 및 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 단계를 포함한다.
본 발명의 제3 양태에서, 비-일시적 기계-판독 가능 저장 매체는 컴퓨터에 의해 실행되는 때, 컴퓨터가 상기 방법을 수행하도록 하는 명령들을 저장한다.
본 개시의 제4 양태에서, 단말 디바이스는 프로세서, 및 컴퓨터 프로그램을 저장하도록 구성된 메모리를 포함한다. 프로세서는 상기의 방법을 수행하도록 메모리에 저장된 컴퓨터 프로그램을 실행하도록 구성된다.
본 개시 또는 관련 기술의 실시예들을 보다 명확하게 설명하기 위해, 실시예들에서 설명된 이하의 도면들이 간략하게 소개될 것이다. 아래에 설명하는 도면들은 본 개시의 일부 실시예에 불과하며, 본 기술분야의 기술자에게 있어서, 진보적인 노동의 대가를 지불하지 않는 전제하에 이러한 도면들에 의해 다른 도면들도 얻을 수 있는 것은 자명한 것이다.
도 1은 본 개시의 일 실시예에 따른 대역폭 부분(BWP) 타이머 구성을 위해 작동 가능한 사용자 장비의 블록도이다.
도 2는 본 개시의 일 실시예에 따른 사용자 장비의 BWP 타이머 구성을 위해 작동 가능한 방법을 도시한 흐름도이다.
도 3은 본 개시의 일 실시예에 따른 BWP 타이머의 제어 방법을 나타내는 개략도이다.
도 4는 본 개시의 다른 실시예에 따른 BWP 타이머의 제어 방법을 나타내는 개략도이다.
도 5는 본 개시의 다른 실시예에 따른 BWP 타이머의 제어 방법을 나타내는 개략도이다.
도 6은 본 개시의 다른 실시예에 따른 BWP 타이머의 제어 방법을 나타내는 개략도이다.
도 7은 본 개시의 일 실시예에 따른 무선 통신 시스템의 블록도이다.
이하, 첨부된 도면을 참조하여 기술적 사상, 구조적 특징, 달성된 목적, 및 효과로써 본 개시의 실시예들이 상세히 설명된다. 구체적으로, 본 개시의 실시예들에서의 용어는 단지 특정 실시예의 목적을 설명하기 위한 것이며, 본 개시를 제한하는 것은 아니다.
도 1은, 일부 실시예들에서, 대역폭 부분(BWP: bandwidth part) 타이머 구성을 위해 작동 가능한 사용자 장비(UE: user equipment)(10)가 프로세서(processor)(11), 메모리(memory)(12), 및 트랜시버(transceiver)(13)를 포함 할 수 있음을 도시한다. 프로세서(11)는 이 설명에서 설명된 제안된 기능, 절차 및/또는 방법을 구현하도록 구성될 수 있다. 무선 인터페이스 프로토콜의 계층들은 프로세서(11)에서 구현될 수 있다. 메모리(12)는 프로세서(11)와 동작 가능하게 연결되고 프로세서(11)를 동작시키기 위한 다양한 정보를 저장한다. 트랜시버(13)는 프로세서(11)와 동작 가능하게 연결되고, 무선 신호를 송신 및/또는 수신한다.
프로세서(11)는 ASIC(application-specific integrated circuit), 다른 칩셋, 논리 회로, 및/또는 데이터 처리 장치를 포함할 수 있다. 메모리(12)는 ROM(read-only memory), RAM(random access memory), 플래시 메모리, 메모리 카드, 저장 매체, 및/또는 다른 저장 장치를 포함할 수 있다. 트랜시버(13)는 무선 주파수 신호를 처리하기 위한 베이스밴드(baseband) 회로를 포함할 수 있다. 실시예들이 소프트웨어로 구현되는 때, 여기에 설명된 기술들은 여기에 설명된 기능들을 수행하는 모듈들(예를 들어, 절차들, 기능들 등)로 구현될 수 있다. 모듈들은 메모리(12)에 저장되고 프로세서(11)에 의해 실행될 수 있다. 메모리(12)는 프로세서(11) 내에서 또는 프로세서(11) 외부에서 구현될 수 있으며, 이 경우, 이들은 공지된 다양한 수단을 통해 프로세서(11)에 통신 가능하게 연결될 수 있다.
UE들 사이의 통신은 3GPP(3rd generation partnership project) NR(new radio) 릴리스 16 이상에서 개발된 사이드링크 기술에 따른 V2V(vehicle-to-vehicle), V2P(vehicle-to-pedestrian) 및 V2I/N(vehicle-to-infrastructure/network)를 포함하는 V2X(vehicle-to-everything) 통신에 관한 것이다. UE들은 PC5 인터페이스와 같은 사이드링크 인터페이스를 통해 서로 직접 통신된다.
일부 실시예들에서, 프로세서(11)는 네트워크 노드로부터 활성화된 BWP 상의 물리 다운링크 제어 채널(PDCCH: physical downlink control channel)을 통해 다운링크 할당(downlink assignment)을 수신하도록 트랜시버(13)를 제어하고, 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하도록 구성된다.
도 2는 본 개시의 일 실시예에 따른 사용자 장비(10)의 BWP 타이머 구성을 위해 작동 가능한 방법(200)을 도시한다. 방법(200)은, 블록(202)에서, 네트워크 노드로부터 활성화된 BWP 상의 물리 다운링크 제어 채널(PDCCH)을 통해 다운링크 할당을 수신하는 단계, 및 블록(204)에서, 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 단계를 포함한다.
일부 실시예들에서, BWP 타이머는 예를 들어 BWP-비활성 타이머이다. 사용자 장비가 네트워크를 통해 데이터를 송수신 할 때, 사용자 장비는 활성(active) 또는 활성화된(activated) 모드에 있다. 활성 또는 활성화된 모드에 있는 동안, 사용자 장비는 네트워크와의 연결을 설정함으로써 실질적으로 지연없이 네트워크를 통해 데이터를 수신 및 송신할 수 있다. 사용자 장비와 네트워크 사이에 데이터가 송신되지 않는 소정 시간 후에, 사용자 장비는 자동으로 비활성(inactive) 또는 비활성화된(inactivated) 모드로 전환될 것이다. 사용자 장비가 비활성 또는 비활성화된 모드로 전환하기 전의 비활성 시간은 BWP-비활성 타이머에 의해 제어될 수 있다.
도 1 및 도 3은, 일부 실시예들에서, 일부 실시예들에서, PDCCH가 다운링크 할당을 포함하는 다운링크 제어 정보(DCI: downlink control information)(300)를 가지는 것을 도시한다. 일부 실시예들에서, 활성화된 BWP가 만료되는 때 다운링크 할당이 중단되지 않으면, 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 것은, 프로세서가 데이터 송신 중에 BWP 타이머를 시작하거나 또는 재시작하는 것을 포함한다. 예를 들어, 다운링크 할당에 포함되는 전송 블록(transport block)의 제1 송신(transmission)(301) 및 제2 송신(302) 후에 활성화된 BWP가 만료되는 때 다운링크 할당이 중단되지 않으면, 즉 다운링크 할당에 포함되는 전송 블록의 제1 송신(301) 및 제2 송신(302)이 BWP 타이머에 대한 유효 기간(valid duration)이면, 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 것은, 프로세서(11)가 다운링크 할당에 포함되는 전송 블록의 제3 송신(303)의 시작 시에 BWP 타이머를 시작하거나 또는 재시작하여, 다운링크 할당에 포함되는 전송 블록의 제3 송신(303) 및 제4 송신(304)이 BWP 타이머에 대해 유효 기간이 되도록 한다.
도 1, 4 및 5는, 일부 실시예들에서, PDCCH가 다운링크 할당을 포함하는 다운링크 제어 정보(DCI)(300)를 가지는 것을 도시한다. 일부 실시예들에서, 프로세서(11)는 트랜시버(13)가 DCI(300)를 수신하는 때 데이터 송신의 시작 시에(도 5에 도시된 바와 같이) 또는 데이터 송신 중에(도 4에 도시된 바와 같이) BWP 타이머를 정지시킨다. 일부 실시예들에서, 프로세서(11)는 트랜시버(13)가 DCI(300)를 수신한 후 데이터 송신의 시작 시에(도 5에 도시된 바와 같이) 또는 데이터 송신 중에(도 4에 도시된 바와 같이) BWP 타이머를 정지시킨다. 프로세서(11)는 데이터 송신 후에(도 5에 도시된 바와 같이) 또는 데이터 송신 중에(도 4에 도시된 바와 같이) BWP 타이머를 재시작한다.
도 1 및 도 4는, 일부 실시예들에서, 프로세서(11)가 다운링크 할당에 포함되는 전송 블록의 제1 송신(401)의 마지막 심볼 이후에 BWP 타이머를 정지 시켜서, 다운링크 할당에 포함되는 전송 블록의 제1 송신(401)이 BWP 타이머에 대한 유효 기간인 것을 도시한다. 다운링크 할당에 포함되는 전송 블록의 제2 송신(402) 및 제3 송신(403) 또한 BWP 타이머에 대해 유효 기간이다. 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 것은, 프로세서(11)가 다운링크 할당에 포함되는 전송 블록의, 예를 들어 제4 송신(404)과 같은, 마지막 송신의 첫 번째 심볼에서 BWP 타이머를 재시작는 것을 포함하여, 다운링크 할당에 포함되는 전송 블록의 제4 송신(404)이 BWP 타이머에 대해 유효 기간이다.
도 1 및 도 5는, 일부 실시예들에서, 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 것이, 프로세서(11)가 다운링크 할당의 첫 번째 심볼에서 BWP 타이머를 정지시키거나 또는 시작하는 것을 포함하는 것을 도시한다. 일부 실시예들에서, 프로세서(11)는 다운링크 할당의 마지막 심볼 이후에 BWP 타이머를 재시작한다. 다운링크 할당에 포함되는 전송 블록의 제1 송신(501), 제2 송신(502), 제3 송신(503), 및 제4 송신(404)은 BWP 타이머에 대해 유효 기간이다.
도 1 및 도 6은, 일부 실시예들에서, PDCCH가 다운링크 할당을 포함하는 다운링크 제어 정보(DCI)(300)를 가지는 것을 도시한다. 일부 실시예들에서, 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 것은, 프로세서(11)가 재송신(retransmission)이 발생하는 때 BWP 타이머를 재시작하는 것을 포함한다. 재송신은 자동 재송신일 수 있다. 구체적으로, 다운링크 할당을 지시하는 PDCCH가 활성화된 BWP 상에서 수신되면, 프로세서(11)는 BWP 타이머를 시작하거나 또는 재시작하고, 재송신을 위한 다운링크 할당이 제1 송신(601)과 동일한 활성화된 BWP 상에서 수신되면, 프로세서(11)는 BWP 타이머를 시작하거나 또는 재시작한다. 최신 PDCCH에 의해 지시되는, 활성화된 BWP 상에서 재송신이 수신되면, 프로세서(11)는 BWP 타이머를 시작하거나 또는 재시작한다. 프로세서(11)는 다운링크 할당에 포함되는 전송 블록의 제1 송신(601), 제2 송신(602), 제3 송신(603), 및 제4 송신(604)의 첫 번째 심볼에서 BWP 타이머를 재시작하여, 다운링크 할당에 포함되는 제1 송신(601), 제2 송신(602), 제3 송신(603) 및 제4 송신(604)이 각각 BWP 타이머에 대해 유효 기간이다.
일부 실시예들에서, BWP 타이머는 구성된 값 및 데이터 송신 기간에 의해 결정된다. 구체적으로, 데이터 송신 기간은 다운링크 할당의 첫 번째 심볼과 다운링크 할당에 포함된 전송 블록의 마지막 송신의 마지막 심볼 사이의 범위에 있다. BWP 타이머는 구성된 값과 데이터 송신 기간의 최대 값이다. 일부 실시예들에서, DCI는 다운링크 할당에 포함되는 첫 번째 송신 전송 블록으로부터 분리된다. 예를 들어, DCI와 첫 번째 송신 사이에는 1 마이크로 초와 같은 기간이 존재한다.
도 7은 본 개시의 일 실시예에 따른 무선 통신을 위한 예시적인 시스템(700)의 블록도이다. 여기서 설명된 실시예는 적절히 구성된 하드웨어 및/또는 소프트웨어를 사용하여 시스템 내에 구현될 수 있다. 도 7은 적어도 도시된 바와 같이 서로 결합된 무선 주파수(RF) 회로(710), 베이스밴드 회로(720), 애플리케이션 회로(730), 메모리/스토리지(740), 디스플레이(750), 카메라(760), 센서(770), 및 입력/출력(I/O) 인터페이스(780)을 포함하는 시스템(700)을 도시한다.
애플리케이션 회로(730)는 하나 이상의 싱글-코어 또는 멀티-코어 프로세서와 같은 회로를 포함할 수 있지만, 이에 제한되지는 않는다. 프로세서는 범용 프로세서 및 그래픽 프로세서, 애플리케이션 프로세서와 같은 전용 프로세서의 임의의 조합을 포함할 수 있다. 프로세서는 메모리/스토리지와 결합되고, 메모리/스토리지에 저장된 명령을 실행하여 시스템 상에서 실행되는 다양한 애플리케이션 프로그램 및/또는 운영 체제를 이네이블링하도록 구성될 수 있다.
베이스밴드 회로(720)는 하나 이상의 싱글-코어 또는 멀티-코어 프로세서와 같은 회로를 포함할 수 있지만, 이에 제한되지는 않는다. 프로세서는 베이스밴드 프로세서를 포함할 수 있다. 베이스밴드 회로는 RF 회로를 통해 하나 이상의 무선 네트워크와의 통신을 가능하게 하는 다양한 무선 제어 기능을 처리할 수 있다. 무선 제어 기능은 신호 변조, 인코딩, 디코딩, 무선 주파수 시프팅 등을 포함할 수 있지만, 이에 제한되지는 않는다. 일부 실시예들에서, 베이스밴드 회로는 하나 이상의 무선 기술과 호환되는 통신을 제공할 수 있다. 예를 들어, 일부 실시예들에서, 베이스밴드 회로는 EUTRAN(evolved universal terrestrial radio access network) 및/또는 다른 WMAN(wireless metropolitan area networks), WLAN(wireless local area network), WPAN(wireless personal area network)와의 통신을 지원할 수 있다. 베이스밴드 회로가 하나 이상의 무선 프로토콜의 무선 통신을 지원하도록 구성된 실시예들은 다중-모드 베이스밴드 회로라고 지칭될 수 있다.
다양한 실시예들에서, 베이스밴드 회로(720)는 베이스밴드 주파수 내에 있는 것으로 엄격하게 고려되지 않은 신호들과 동작하는 회로를 포함할 수 있다. 예를 들어, 일부 실시예들에서, 베이스밴드 회로는 베이스밴드 주파수와 무선 주파수 사이에 있는 중간 주파수를 갖는 신호로 동작하는 회로를 포함할 수 있다.
RF 회로(710)는 비-고체 매체를 통해 변조된 전자기 방사를 사용하여 무선 네트워크와의 통신을 가능하게 할 수 있다. 다양한 실시예들에서, RF 회로는 무선 네트워크와의 통신을 용이하게 하기 위해 스위치, 필터, 증폭기 등을 포함할 수 있다.
다양한 실시예들에서, RF 회로(710)는 무선 주파수에 있는 것으로 엄격하게 고려되지 않은 신호들과 동작하는 회로를 포함할 수 있다. 예를 들어, 일부 실시예들에서, RF 회로는 베이스밴드 주파수와 무선 주파수 사이의 중간 주파수를 갖는 신호로 동작하는 회로를 포함할 수 있다.
다양한 실시예들에서, 사용자 장비, eNB, 또는 gNB와 관련하여 상기에서 논의된 송신기 회로, 제어 회로, 또는 수신기 회로는 RF 회로, 베이스밴드 회로, 및/또는 애플리케이션 회로 중 하나 이상에서 전체적으로 또는 부분적으로 구현될 수 있다. 본 명세서에서 사용되는 "회로"는 ASIC(Application Specific Integrated Circuit), 전자 회로, 프로세서(공유, 전용, 또는 그룹), 및/또는 하나 이상의 소프트웨어 또는 펌웨어 프로그램을 실행하는 메모리(공유, 전용, 또는 그룹), 조합 논리 회로, 및/또는 설명된 기능을 제공하는 다른 적절한 하드웨어 구성 요소를 지칭하거나, 그 일부이거나, 또는 이를 포함할 수 있다. 일부 실시예에서, 전자 디바이스 회로는 하나 이상의 소프트웨어 또는 펌웨어 모듈로 구현될 수 있거나, 회로와 관련된 기능이 하나 이상의 소프트웨어 또는 펌웨어 모듈에 의해 구현될 수 있다.
일부 실시예들에서, 베이스밴드 회로, 애플리케이션 회로, 및/또는 메모리/스토리지의 구성 요소들의 일부 또는 전부는 SOC(system on a chip) 상에서 함께 구현될 수 있다.
메모리/스토리지(740)는 예를 들어 시스템에 대한 데이터 및/또는 명령어를 로딩 및 저장하는 데 사용될 수 있다. 일 실시예에 대한 메모리/스토리지는 DRAM(dynamic random access memory)과 같은 적절한 휘발성 메모리 및/또는 플래시 메모리와 같은 비-휘발성 메모리의 임의의 조합을 포함할 수 있다.
다양한 실시예들에서, I/O 인터페이스(780)는 시스템과의 사용자 상호 작용을 가능하게 하도록 설계된 하나 이상의 사용자 인터페이스 및/또는 시스템과의 주변 장치 구성요소 상호 작용을 가능하게 하도록 설계된 주변 장치 구성요소 인터페이스를 포함할 수 있다. 사용자 인터페이스는 물리 키보드 또는 키패드, 터치 패드, 스피커, 마이크 등을 포함할 수 있지만 이에 제한되지는 않는다. 주변 장치 구성요소 인터페이스는 비-휘발성 메모리 포트, USB(범용 직렬 버스) 포트, 오디오 잭, 및 전원 공급 인터페이스를 포함할 수 있지만, 이에 제한되지는 않는다.
다양한 실시예에서, 센서(770)는 시스템과 관련된 환경 조건 및/또는 위치 정보를 결정하기 위한 하나 이상의 감지 장치를 포함할 수 있다. 일부 실시예에서, 센서는 자이로 센서, 가속도계, 근접 센서, 주변 광 센서, 및 포지셔닝 유닛을 포함할 수 있지만, 이에 제한되지는 않는다. 포지셔닝 유닛은 또한 베이스밴드 회로 및/또는 RF 회로의 일부이거나 그와 상호 작용하여, 포지셔닝 네트워크의 구성 요소, 예를 들어, GPS(Global Positioning System) 위성과 통신할 수 있다.
다양한 실시예들에서, 디스플레이(750)는 액정 디스플레이 및 터치 스크린 디스플레이와 같은 디스플레이를 포함할 수 있다. 다양한 실시예들에서, 시스템(700)은 랩톱 컴퓨팅 장치, 태블릿 컴퓨팅 장치, 넷북, 울트라북, 스마트폰 등과 같은 모바일 컴퓨팅 장치일 수 있지만, 이에 제한되지는 않는다. 다양한 실시예에서, 시스템은 더 많거나 더 적은 구성요소 및/또는 상이한 아키텍처를 가질 수 있다. 적절한 경우, 여기서 기술된 방법은 컴퓨터 프로그램으로서 구현될 수 있다. 컴퓨터 프로그램은 비-일시적 저장 매체와 같은 저장 매체에 저장될 수 있다.
본 개시의 실시예에서는, 데이터 송신을 보장하기 위하여 대역폭 부분(BWP) 타이머 구성을 위해 작동 가능한 방법 및 사용자 장비가 제공된다. 본 개시의 실시예는 최종 제품을 생성하기 위해 3GPP 사양에서 채택될 수 있는 기술/프로세스의 조합이다.
당업자는 본 개시의 실시예에서 설명되고 개시된 각각의 유닛, 알고리즘, 및 단계가 전자 하드웨어 또는 컴퓨터 및 전자 하드웨어용 소프트웨어의 조합을 사용하여 실현된다는 것을 이해한다. 기능이 하드웨어 또는 소프트웨어에서 실행되는지 여부는 응용 조건과 기술 계획의 설계 요청 사항에 따른다.
당업자는 각각의 특정 응용에 대한 기능을 실현하기 위해 상이한 방식을 사용할 수 있지만, 이러한 실현은 본 개시의 범위를 넘어서는 안된다. 당업자는 시스템, 장치, 및 유닛의 작업 프로세스는 기본적으로 동일하기 때문에 당업자가 상기의 실시예에서 시스템, 장치, 및 유닛의 작업 프로세스를 참조할 수 있음을 이해한다. 쉬운 설명과 단순화를 위해, 이러한 작업 프로세스는 자세하게 설명되지 않는다.
본 개시의 실시예들에서의 개시된 시스템, 장치, 및 방법은 다른 방식으로 실현될 수 있는 것으로 이해된다. 전술한 실시예는 단지 예시일 뿐이다. 유닛의 구분은 단지 논리적 기능에 기초하고, 실현에 있어서 다른 구분이 존재한다. 복수의 유닛 또는 구성요소가 다른 시스템에 결합되거나 또는 통합될 수 있다. 일부 특성이 누락되거나 또는 생략될 수도 있다. 반면에, 표시되거나 논의된 상호 결합, 직접 결합, 또는 통신 결합은 전기적, 기계적, 또는 다른 종류의 형태에 의해 간접적으로 또는 통신적으로 일부 포트, 장치, 또는 유닛을 통해 작동한다.
설명을 위한 분리된 구성요소인 유닛들은 물리적으로 분리되어 있거나 또는 분리되어 있지 않다. 디스플레이를 위한 유닛은 물리적 유닛이거나, 또는 물리적인 유닛이 아니며, 즉 한 장소에 위치하거나 또는 복수의 네트워크 유닛에 분배되어 있다. 유닛들의 일부 또는 전부는 실시예의 목적에 따라 사용된다. 더욱이, 각각의 실시예에서의 기능 유닛 각각은 하나의 프로세싱 유닛에 통합될 수 있거나, 물리적으로 독립적일 수 있거나, 또는 둘 이상의 유닛을 갖는 하나의 프로세싱 유닛에 통합될 수 있다.
소프트웨어 기능 유닛이 실현되어 제품으로서 사용 및 판매되면, 그것은 컴퓨터의 판독 가능한 저장 매체에 저장될 수 있다. 이러한 이해에 기초하여, 본 개시에 의해 제안된 기술 계획은 소프트웨어 제품의 형태로서 본질적으로 또는 부분적으로 실현될 수 있다. 또는, 종래 기술에 유리한 기술 계획의 일부가 소프트웨어 제품의 형태로서 실현될 수 있다. 컴퓨터의 소프트웨어 제품은 컴퓨터 장치(예를 들어, 개인용 컴퓨터, 서버, 또는 네트워크 장치)가 본 개시의 실시예들에 의해 개시된 모든 단계 또는 일부 단계를 실행하기 위한 복수의 명령을 포함하는 저장 매체에 저장된다. 저장 매체는 USB 디스크, 모바일 하드 디스크, ROM(read-only memory), RAM(random access memory), 플로피 디스크, 또는 프로그램 코드를 저장할 수 있는 다른 종류의 매체를 포함한다.
본 개시는 가장 실용적이고 바람직한 실시예들로 간주되는 것과 관련하여 설명되었지만, 본 개시는 개시된 실시예들로 제한되지 않으나 첨부된 청구 범위의 가장 넓은 해석의 범위를 벗어나지 않고 이루어진 다양한 구성들을 포함하도록 의도된다는 것이 이해된다.

Claims (26)

  1. 대역폭 부분(BWP: bandwidth part) 타이머 구성을 위해 작동 가능한 사용자 장비로서,
    메모리,
    트랜시버, 및
    상기 메모리 및 상기 트랜시버에 연결되는 프로세서
    를 포함하고,
    상기 프로세서는,
    네트워크 노드로부터 활성화된 BWP 상의 물리 다운링크 제어 채널(PDCCH: physical downlink control channel)을 통해 다운링크 할당을 수신하도록 트랜시버를 제어하고,
    상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 BWP 타이머를 제어하도록 구성된,
    사용자 장비.
  2. 제1항에 있어서,
    상기 PDCCH는 상기 다운링크 할당을 포함하는 다운링크 제어 정보(DCI: downlink control information)를 갖는,
    사용자 장비.
  3. 제1항 또는 제2항에 있어서,
    상기 활성화된 BWP가 만료되는 때 상기 다운링크 할당이 중단되지 않으면, 상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 상기 BWP 타이머를 제어하는 것은,
    상기 프로세서가 데이터 송신 중에 상기 BWP 타이머를 시작하거나 또는 재시작하는 것을 포함하는,
    사용자 장비.
  4. 제2항에 있어서,
    상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 상기 BWP 타이머를 제어하는 것은,
    상기 트랜시버가 상기 DCI를 수신하는 때 또는 상기 트랜시버가 상기 DCI를 수신한 후에 상기 프로세서가 데이터 송신의 시작 시에 또는 데이터 송신 중에 상기 BWP 타이머를 정지시키는 것을 포함하는,
    사용자 장비.
  5. 제1항에 있어서,
    상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 상기 BWP 타이머를 제어하는 것은,
    상기 프로세서가 상기 다운링크 할당의 첫 번째 심볼에서 또는 상기 다운링크 할당에 포함된 전송 블록의 첫 번째 송신의 마지막 심볼 이후에 상기 BWP 타이머를 정지시키는 것을 포함하는, 사용자 장비.
  6. 제5항에있어서,
    상기 프로세서는 상기 다운링크 할당의 마지막 심볼 이후에 또는 상기 다운링크 할당에 포함된 전송 블록의 마지막 송신의 첫 번째 심볼에서 상기 BWP 타이머를 재시작하도록 추가로 구성되는,
    사용자 장비.
  7. 제1항 내지 제6항 중 어느 한 항에 있어서,
    상기 프로세서는 재송신이 발생하는 때 상기 BWP 타이머를 재시작하도록 추가로 구성되는,
    사용자 장비.
  8. 제1항 내지 제6항 중 어느 한 항에 있어서,
    상기 다운링크 할당을 지시하는 상기 PDCCH가 상기 활성화된 BWP 상에서 수신되면, 상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 상기 BWP 타이머를 제어하는 것은,
    상기 프로세서가 상기 BWP 타이머를 시작하거나 또는 재시작하는 것을 포함하고,
    재송신을 위한 상기 다운링크 할당이 첫 번째 송신과 동일한 활성화된 BWP 상에서 수신되면, 상기 프로세서는 상기 BWP 타이머를 시작하거나 또는 재시작하도록 추가로 구성되는,
    사용자 장비.
  9. 제8항에 있어서,
    최신 PDCCH에 의해 지시되는, 상기 활성화된 BWP 상에서 재송신이 수신되면, 상기 프로세서는 상기 BWP 타이머를 시작하거나 또는 재시작하도록 구성되는,
    사용자 장비.
  10. 제1항 내지 제9항 중 어느 한 항에 있어서,
    상기 BWP 타이머는 구성된 값 및 데이터 송신 기간에 의해 결정되는,
    사용자 장비.
  11. 제10항에 있어서,
    상기 데이터 송신 기간은 상기 다운링크 할당의 첫 번째 심볼과 상기 다운링크 할당에 포함된 전송 블록의 마지막 송신의 마지막 심볼 사이의 범위인,
    사용자 장비.
  12. 제10항 또는 제11항에 있어서,
    상기 BWP 타이머는 상기 구성된 값 및 상기 데이터 송신 기간의 최대 값인,
    사용자 장비.
  13. 사용자 장비의 대역폭 부분(BWP) 타이머 구성을 위해 작동 가능한 방법으로서,
    네트워크 노드로부터 활성화된 BWP 상의 물리 다운링크 제어채널(PDCCH)을 통해 다운링크 할당을 수신하는 단계, 그리고
    상기 다운링크 할당에 따라 활성화된 BWP와 연관된 BWP 타이머를 제어하는 단계
    를 포함하는 방법.
  14. 제13항에 있어서,
    상기 PDCCH는 상기 다운링크 할당을 포함하는 다운링크 제어 정보(DCI)를 갖는,
    방법.
  15. 제13항 또는 제14항에 있어서,
    상기 활성화된 BWP가 만료되는 때 상기 다운링크 할당이 중단되지 않으면, 상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 상기 BWP 타이머를 제어하는 단계는,
    데이터 송신 중 상기 BWP 타이머를 시작하거나 또는 재시작하는 단계를 포함하는,
    방법.
  16. 제14항에 있어서,
    상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 상기 BWP 타이머를 제어하는 단계는,
    상기 DCI를 수신하는 때 또는 상기 DCI를 수신한 후 데이터 송신의 시작 시에 또는 데이터 송신 중에 상기 BWP 타이머를 정지시키는 단계를 포함하는,
    방법.
  17. 제14항에 있어서,
    상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 상기 BWP 타이머를 제어하는 단계는,
    상기 다운링크 할당의 첫 번째 심볼에서 또는 상기 다운링크 할당에 포함된 전송 블록의 첫 번째 송신의 마지막 심볼 이후에 상기 BWP 타이머를 정지시키는 단계를 포함하는,
    방법.
  18. 제17항에있어서,
    상기 다운링크 할당의 마지막 심볼 이후에 또는 상기 다운링크 할당에 포함되는 전송 블록의 마지막 송신의 첫 번째 심볼에서 상기 BWP 타이머를 재시작하는 단계를 더 포함하는 방법.
  19. 제15항 내지 제18항 중 어느 한 항에 있어서,
    재송신이 발생하는 때 상기 BWP 타이머를 재시작하는 단계를 더 포함하는 방법.
  20. 제15항 내지 제18항 중 어느 한 항에 있어서,
    상기 다운링크 할당을 지시하는 상기 PDCCH가 상기 활성화된 BWP 상에서 수신되면, 상기 다운링크 할당에 따라 상기 활성화된 BWP와 연관된 상기 BWP 타이머를 제어하는 단계는, 상기 BWP 타이머를 시작하거나 또는 재시작하는 단계를 포함하고,
    재송신을 위한 상기 다운링크 할당이 첫 번째 송신과 동일한 활성화된 BWP에서 수신되면,
    상기 방법은 상기 BWP 타이머를 시작하거나 또는 재시작하는 단계를 더 포함하는 방법.
  21. 제20항에 있어서,
    최신 PDCCH에 의해 지시되는, 상기 활성화된 BWP상에서 재송신이 수신되면,
    상기 방법은 상기 BWP 타이머를 시작하거나 또는 재시작하는 단계를 포함하는 방법.
  22. 제13항 내지 제21항 중 어느 한 항에 있어서, 상기 BWP 타이머는 구성된 값 및 데이터 송신 기간에 의해 결정되는, 방법.
  23. 제22항에 있어서,
    상기 데이터 송신 기간은 상기 다운링크 할당의 첫 번째 심볼과 상기 다운링크 할당에 포함된 전송 블록의 마지막 송신의 마지막 심볼 사이의 범위인, 방법.
  24. 제22항 또는 제23항에 있어서,
    상기 BWP 타이머는 상기 구성된 값 및 상기 데이터 송신 기간의 최대 값인, 방법.
  25. 컴퓨터에 의해 실행되는 때, 상기 컴퓨터가 제13항 내지 제24항 중 어느 한 항의 방법을 수행하도록 하는 명령들이 저장된 비-일시적 기계-판독가능 저장 매체.
  26. 단말 디바이스로서,
    프로세서 및 컴퓨터 프로그램을 저장하도록 구성된 메모리를 포함하고,
    상기 프로세서는 제13항 내지 제24항 중 어느 한 항의 방법을 수행하도록 상기 메모리에 저장된 상기 컴퓨터 프로그램을 실행하도록 구성된,
    단말 디바이스.
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