KR20200082920A - Display panel and display device including the display panel - Google Patents

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KR20200082920A
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황준식
김성희
지문배
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엘지디스플레이 주식회사
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Abstract

According to embodiments of the present invention, a display panel capable of securing an aperture ratio since a bank is not included by including a photochromic layer divided into a first area and a second area, and a display device including the same may be provided. The display panel comprises: a first substrate; a photochromic layer; a plurality of first electrodes; an organic layer; and a second electrode.

Description

표시패널 및 이를 포함하는 표시장치{DISPLAY PANEL AND DISPLAY DEVICE INCLUDING THE DISPLAY PANEL}Display panel and display device including the same {DISPLAY PANEL AND DISPLAY DEVICE INCLUDING THE DISPLAY PANEL}

본 발명의 실시예들은 표시패널 및 이를 포함하는 표시장치에 관한 것이다.Embodiments of the present invention relate to a display panel and a display device including the same.

정보화 사회가 발전함에 따라, 표시장치, 조명장치 등의 다양한 표시패널에 대한 요구가 다양한 형태로 증가하고 있다. 표시패널 분야에서는, 별도의 광원이 필요하지 않아 경량화 및 박형화에서 유리한 유기발광 표시패널에 대한 수요가 증가하고 있다.As the information society develops, demands for various display panels such as display devices and lighting devices are increasing in various forms. In the field of display panels, there is an increasing demand for organic light-emitting display panels, which are advantageous in weight reduction and thinning, because a separate light source is not required.

최근 표시패널 분야에서는, 가상현실(Virtual Reality, VR)을 구현하기 위하여, 표시패널의 해상도를 높이는 것에 대해서도 연구가 활발히 이루어지고 있다. 그러나, 해상도를 넓힐 경우 서브픽셀당 비발광영역의 면적 비율이 증가하여, 개구율이 떨어지는 문제가 있다.Recently, in the field of display panels, in order to realize virtual reality (VR), research has been actively conducted on increasing the resolution of the display panel. However, when the resolution is widened, the ratio of the area of the non-emission region per subpixel increases, and thus there is a problem in that the aperture ratio decreases.

본 발명의 실시예들의 목적은, 고해상도에서도 높은 개구율을 가질 수 있는 표시패널 및 표시장치를 제공하는 데 있다.An object of embodiments of the present invention is to provide a display panel and a display device that can have a high aperture ratio even at high resolution.

본 발명의 실시예들에 따른 표시패널은, 제1 기판, 광색층, 제1 전극, 유기층 및 제2 전극을 포함할 수 있다.The display panel according to embodiments of the present invention may include a first substrate, a light color layer, a first electrode, an organic layer, and a second electrode.

표시패널은 발광영역과 비발광영역으로 구분되는 복수의 서브픽셀을 포함하는 액티브 영역을 포함할 수 있다.The display panel may include an active region including a plurality of subpixels divided into a light emitting region and a non-light emitting region.

광색층은 상기 제1 기판 상에 배치될 수 있다.The light color layer may be disposed on the first substrate.

광색층은 광에 의해 가역적인 이성질체화를 진행하는 광색 물질을 포함할 수 있다.The photochromic layer may include a photochromic material that undergoes reversible isomerization by light.

광색층은 제1 영역과 제2 영역으로 구성될 수 있다.The light color layer may include a first region and a second region.

제1 전극은 상기 광색층의 제1 영역 상에 배치될 수 있다.The first electrode may be disposed on the first region of the light color layer.

제1 전극은 상기 광색층의 제2 영역에 의해 구분될 수 있다.The first electrode may be divided by the second region of the light color layer.

유기층은 상기 제1 전극 상에 위치할 수 있다.The organic layer may be located on the first electrode.

유기층은 상기 광색층의 제2 영역 상에 위치할 수 있다.The organic layer may be located on the second region of the photochromic layer.

제2 전극은 상기 유기층 상에 배치될 수 있다.The second electrode may be disposed on the organic layer.

표시패널은, 광색층의 제2 영역 상에 상기 서브픽셀들을 구분하는 뱅크를 포함하지 않을 수 있다.The display panel may not include a bank separating the subpixels on the second region of the light color layer.

광색층은 제1 영역과 제2 영역의 색이 서로 상이할 수 있다.In the light color layer, colors of the first region and the second region may be different from each other.

광색층의 제2 영역에 포함되는 광색 물질은 디아릴에텐 화합물을 포함할 수 있다.The photochromic material included in the second region of the photochromic layer may include a diarylethene compound.

광색층의 제1 영역에 포함된 광색 물질은 유리 상태(glassy state)일 수 있다.The photochromic material included in the first region of the photochromic layer may be in a glassy state.

광색층의 제2 영역에 포함된 광색 물질은 고무 상태(rubbery state)인 표시패널.The photochromic material included in the second region of the photochromic layer is a rubbery display panel.

제1 전극은 알루미늄을 포함하는 금속층으로 구성될 수 있다.The first electrode may be formed of a metal layer containing aluminum.

제1 전극은, 상기 제1 전극의 주변주에서 슬로프를 가질 수 있다.The first electrode may have a slope at the periphery of the first electrode.

표시패널은 제1 기판 상에 위치하는 트랜지스터를 추가로 포함할 수 있다.The display panel may further include a transistor positioned on the first substrate.

제1 전극은 상기 트랜지스터와 컨택홀을 통해 연결될 수 있다.The first electrode may be connected to the transistor through a contact hole.

상기 컨택홀은 서브픽셀의 발광영역에 포함될 수 있다.The contact hole may be included in the emission region of the subpixel.

표시패널은 제2 기판 및 블랙 매트릭스를 추가로 포함할 수 있다.The display panel may further include a second substrate and a black matrix.

제2 기판은 제1 기판과 대향하도록 배치될 수 있다.The second substrate may be disposed to face the first substrate.

블랙 매트릭스는 상기 제1 기판과 대향하는 상기 제2 기판의 일면 상에 위치하고, 상기 광색층의 제2 영역과 중첩될 수 있다.The black matrix may be located on one surface of the second substrate facing the first substrate, and may overlap the second region of the photochromic layer.

서브픽셀들은 상기 블랙 매트릭스에 의해 구분될 수 있다.Subpixels may be classified by the black matrix.

발광영역의 면적은, 발광영역의 면적과 비발광영역의 면적의 합에 대하여 40% 이상일 수 있다.The area of the emission area may be 40% or more with respect to the sum of the area of the emission area and the area of the non-emission area.

액티브 영역은 화소밀도가 1000ppi 이상일 수 있다.The active region may have a pixel density of 1000 ppi or more.

본 발명의 실시예들에 따른 표시장치는, 표시패널 및 표시패널을 구동하는 구동회로를 포함할 수 있다.The display device according to embodiments of the present invention may include a display panel and a driving circuit for driving the display panel.

본 발명의 실시예들에 따르면, 제1 영역과 제2 영역으로 구분되는 광색층을 포함하여 뱅크를 포함하지 않아 개구율을 확보할 수 있는 표시패널 및 이를 포함하는 표시장치를 제공할 수 있다.According to embodiments of the present invention, a display panel including a light color layer divided into a first region and a second region and not including a bank to secure an aperture ratio and a display device including the same can be provided.

도 1은 본 발명의 실시예들에 따른 전자장치의 개략적인 시스템 구성도이다.
도 2는 본 발명의 실시예들에 따른 전자장치의 시스템 구현 예시도이다.
도 3은 본 발명의 실시예들에 따른 패널이 OLED (Organic Light Emitting Diode) 패널인 경우, 서브픽셀의 구조를 나타낸 도면이다.
도 4는 본 발명의 실시예들에 따른 광색층에 제1 전극이 증착되는 것을 설명하기 위한 도면이다.
도 5 및 도 6은 본 발명의 실시예들에 따른 광색층에 포함하는 광색 물질의 특징을 설명하기 위한 도면이다.
도 7은 본 발명의 제1 전극에 대해 설명하기 위한 도면이다.
도 8은 본 발명의 실시예들에 따른 표시패널의 액티브 영역의 단면도이다.
도 9는 본 발명의 표시패널의 액티브 영역 일부의 평면도이다.
도 10은 본 발명의 서브픽셀의 단면도 및 그 일부의 확대도이다.
도 11은 본 발명의 서브픽셀의 평면도이다.
도 12는 비교예의 서브픽셀의 단면도이다.
도 13은 비교예의 서브픽셀의 평면도이다.
도 14는 본 발명의 실시예들에 따른 표시패널의 제조방법의 일부 단계이다.
1 is a schematic system configuration diagram of an electronic device according to embodiments of the present invention.
2 is an exemplary system implementation of an electronic device according to embodiments of the present invention.
3 is a diagram illustrating the structure of a subpixel when the panel according to the embodiments of the present invention is an OLED (Organic Light Emitting Diode) panel.
4 is a view for explaining that a first electrode is deposited on a light color layer according to embodiments of the present invention.
5 and 6 are diagrams for describing characteristics of a photochromic material included in a photochromic layer according to embodiments of the present invention.
7 is a view for explaining the first electrode of the present invention.
8 is a cross-sectional view of an active area of a display panel according to embodiments of the present invention.
9 is a plan view of a portion of the active area of the display panel of the present invention.
10 is an enlarged view of a cross-sectional view and a part of a subpixel of the present invention.
11 is a plan view of a subpixel of the present invention.
12 is a cross-sectional view of a subpixel of a comparative example.
13 is a plan view of a subpixel of a comparative example.
14 is a partial step of a method of manufacturing a display panel according to embodiments of the present invention.

본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. Advantages and features of the present invention, and methods for achieving them will be clarified with reference to embodiments described below in detail together with the accompanying drawings. However, the present invention is not limited to the embodiments disclosed below, but will be implemented in various different forms, and only the present embodiments allow the disclosure of the present invention to be complete, and common knowledge in the art to which the present invention pertains. It is provided to fully inform the holder of the scope of the invention, and the invention is only defined by the scope of the claims.

또한, 본 발명의 실시예들을 설명하기 위한 도면에 개시된 형상, 크기, 비율, 각도, 개수 등은 예시적인 것이므로 본 발명이 도시된 사항에 한정되는 것은 아니다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다. 또한, 본 발명을 설명함에 있어서, 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명은 생략한다. 본 명세서 상에서 언급된 '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 '~만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 구성 요소를 단수로 표현한 경우에 특별히 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함할 수 있다. In addition, the shapes, sizes, ratios, angles, numbers, etc. disclosed in the drawings for explaining embodiments of the present invention are exemplary, and the present invention is not limited to the illustrated matters. The same reference numerals refer to the same components throughout the specification. In addition, in the description of the present invention, when it is determined that detailed descriptions of related known technologies may unnecessarily obscure the subject matter of the present invention, detailed descriptions thereof will be omitted. When'include','have','consist of', etc. mentioned in this specification are used, other parts may be added unless'~man' is used. When a component is expressed in singular, it may include a case in which plural is included unless specifically stated.

또한, 본 발명의 실시예들에서의 구성 요소들을 해석함에 있어서, 별도의 명시적 기재가 없더라도 오차 범위를 포함하는 것으로 해석되어야 할 것이다.In addition, in interpreting the components in the embodiments of the present invention, it should be interpreted as including an error range even if there is no explicit description.

또한, 본 발명의 구성 요소를 설명하는 데 있어서, 제 1, 제 2, A, B, (a), (b) 등의 용어를 사용할 수 있다. 이러한 용어는 그 구성 요소를 다른 구성 요소와 구별하기 위한 것일 뿐, 그 용어에 의해 해당 구성 요소의 본질, 차례, 순서 또는 개수 등이 한정되지 않는다. 어떤 구성 요소가 다른 구성 요소에 "연결", "결합" 또는 "접속"된다고 기재된 경우, 그 구성 요소는 그 다른 구성 요소에 직접적으로 연결되거나 또는 접속될 수 있지만, 각 구성 요소 사이에 다른 구성 요소가 "개재"되거나, 각 구성 요소가 다른 구성 요소를 통해 "연결", "결합" 또는 "접속"될 수도 있다고 이해되어야 할 것이다. 위치 관계에 대한 설명일 경우, 예를 들어, '~상에', '~상부에', '~하부에', '~옆에' 등으로 두 부분의 위치 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다. In addition, in describing the components of the present invention, terms such as first, second, A, B, (a), and (b) may be used. These terms are only for distinguishing the component from other components, and the nature, order, order, or number of the component is not limited by the term. When a component is described as being "connected", "coupled" or "connected" to another component, the component may be directly connected to or connected to the other component, but different components between each component It should be understood that the "intervenes" may be, or each component may be "connected", "coupled" or "connected" through other components. In the case of the description of the positional relationship, for example, when the positional relationship of two parts is described as'~top','~upper','~bottom','~side', etc.,'right' Alternatively, one or more other parts may be located between the two parts unless'direct' is used.

또한, 본 발명의 실시예들에서의 구성 요소들은 이들 용어에 의해 제한되지 않는다. 이들 용어들은 단지 하나의 구성 요소를 다른 구성 요소와 구별하기 위하여 사용하는 것일 뿐이다. 따라서, 이하에서 언급되는 제1 구성 요소는 본 발명의 기술적 사상 내에서 제2 구성 요소일 수도 있다. In addition, components in the embodiments of the present invention are not limited by these terms. These terms are only used to distinguish one component from another component. Therefore, the first component mentioned below may be the second component within the technical spirit of the present invention.

또한, 본 발명의 실시예들에서의 특징들(구성들)이 부분적으로 또는 전체적으로 서로 결합 또는 조합 또는 분리 가능하고, 기술적으로 다양한 연동 및 구동이 가능하며, 각 실시예는 서로에 대하여 독립적으로 실시 가능할 수도 있고 연관 관계로 함께 실시 가능할 수도 있다. In addition, the features (configurations) in the embodiments of the present invention may be partially or wholly combined with each other or combined or separated, and technically various interlocking and driving are possible, and each embodiment is independently performed with respect to each other. It may be possible or it may be implemented together in an association relationship.

이하에서는, 본 발명의 실시예들을 첨부된 도면을 참조하여 상세히 설명한다.Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 실시예들에 따른 전자장치의 개략적인 시스템 구성도이다.1 is a schematic system configuration diagram of an electronic device according to embodiments of the present invention.

본 발명의 실시예들에 따른 전자장치는 표시장치, 조명장치, 발광장치 등을 포함할 수 있다. 아래에서는, 설명의 편의를 위하여, 표시장치를 중심으로 설명한다. 하지만, 아래의 설명은 조명장치, 발광장치 등의 다른 다양한 전자장치에도 동일하게 적용될 수 있을 것이다. An electronic device according to embodiments of the present invention may include a display device, a lighting device, and a light emitting device. Hereinafter, for convenience of description, the display device will be mainly described. However, the following description may be equally applied to various other electronic devices such as a lighting device and a light emitting device.

본 발명의 실시예들에 따른 전자장치는, 영상을 표시하거나 빛을 출력하는 패널(100)과, 이러한 패널(100)을 구동하기 위한 구동회로를 포함할 수 있다. The electronic device according to embodiments of the present invention may include a panel 100 for displaying an image or outputting light, and a driving circuit for driving the panel 100.

패널(100)은, 다수의 데이터 라인(121) 및 다수의 게이트 라인(122)이 배치되고 다수의 데이터 라인(121) 및 다수의 게이트 라인(122)에 의해 정의되는 다수의 서브픽셀(111)이 매트릭스 타입으로 배열될 수 있다. In the panel 100, a plurality of data lines 121 and a plurality of gate lines 122 are disposed and a plurality of subpixels 111 defined by the plurality of data lines 121 and the plurality of gate lines 122. It can be arranged in a matrix type.

패널(100)에서 다수의 데이터 라인(121) 및 다수의 게이트 라인(122)은 서로 교차하여 배치될 수 있다. 예를 들어, 다수의 게이트 라인(122)은 행(Row) 또는 열(Column)으로 배열될 수 있고, 다수의 데이터 라인(121)은 열(Column) 또는 행(Row)으로 배열될 수 있다. 아래에서는, 설명의 편의를 위하여, 다수의 게이트 라인(122)은 행(Row)으로 배치되고, 다수의 데이터 라인(121)은 열(Column)로 배치되는 것으로 가정한다. In the panel 100, the plurality of data lines 121 and the plurality of gate lines 122 may be disposed to cross each other. For example, the plurality of gate lines 122 may be arranged in a row or a column, and the plurality of data lines 121 may be arranged in a column or a row. Hereinafter, for convenience of description, it is assumed that the plurality of gate lines 122 are arranged in a row, and the plurality of data lines 121 are arranged in a column.

패널(100)에는, 서브픽셀 구조 등에 따라, 다수의 데이터 라인(121) 및 다수의 게이트 라인(122) 이외에, 다른 종류의 신호배선들이 배치될 수 있다. 구동전압 배선, 기준전압 배선, 또는 공통전압 배선 등이 더 배치될 수 있다. In the panel 100, other types of signal wirings may be disposed in addition to the plurality of data lines 121 and the plurality of gate lines 122 according to a subpixel structure or the like. A driving voltage wiring, a reference voltage wiring, or a common voltage wiring may be further disposed.

패널(100)은 LCD (Liquid Crystal Display) 패널, OLED (Organic Light Emitting Diode) 패널 등 다양한 타입의 패널일 수 있다. The panel 100 may be various types of panels, such as a liquid crystal display (LCD) panel and an organic light emitting diode (OLED) panel.

패널(100)에 배치되는 신호배선들의 종류는, 서브픽셀 구조, 패널 타입(예: LCD 패널, OLED 패널 등) 등에 따라 달라질 수 있다. 그리고, 본 명세서에서는 신호배선은 신호가 인가되는 전극을 포함하는 개념일 수도 있다. The types of signal wirings arranged in the panel 100 may vary depending on a subpixel structure, a panel type (eg, LCD panel, OLED panel, etc.). And, in this specification, the signal wiring may be a concept including an electrode to which a signal is applied.

패널(100)은 화상(영상)이 표시되는 액티브 영역(110)과, 그 외곽 영역이고 화상이 표시되지 않는 넌-액티브 영역(120)을 포함할 수 있다. 여기서, 넌-액티브 영역(120)은 베젤 영역이라고도 한다. The panel 100 may include an active area 110 in which an image (image) is displayed, and a non-active area 120 in which it is an outer area and in which an image is not displayed. Here, the non-active region 120 is also referred to as a bezel region.

액티브 영역(110)에는 화상 표시를 위한 다수의 서브픽셀(111)이 배치된다. A plurality of subpixels 111 for displaying an image is disposed in the active area 110.

넌-액티브 영역(120)에는 데이터 드라이버(DDR)가 전기적으로 연결되기 위한 패드부가 배치되고, 이러한 패드부와 다수의 데이터 라인(121) 간의 연결을 위한 다수의 데이터 링크 라인이 배치될 수도 있다. 여기서, 다수의 데이터 링크 라인은 다수의 데이터 라인(121)이 넌-액티브 영역(120)으로 연장된 부분들이거나, 다수의 데이터 라인(121)과 전기적으로 연결된 별도의 패턴들일 수 있다. In the non-active area 120, a pad portion for electrically connecting the data driver DDR may be disposed, and a plurality of data link lines for connection between the pad portion and the plurality of data lines 121 may be disposed. Here, the plurality of data link lines may be portions in which the plurality of data lines 121 extend to the non-active region 120 or may be separate patterns electrically connected to the plurality of data lines 121.

또한, 넌-액티브 영역(120)에는 데이터 드라이버(DDR)가 전기적으로 연결되는 패드 부를 통해 게이트 드라이버(123)로 게이트 구동에 필요한 전압(신호)을 전달해주기 위한 게이트 구동 관련 배선들이 배치될 수 있다. 예를 들어, 게이트 구동 관련 배선들은, 클럭 신호를 전달해주기 위한 클럭 배선들, 게이트 전압(VGH, VGL)을 전달해주는 게이트 전압 배선들, 스캔신호 생성에 필요한 각종 제어신호를 전달해주는 게이트 구동 제어 신호배선들 등을 포함할 수 있다. 이러한 게이트 구동 관련 배선들은, 액티브 영역(110)에 배치되는 게이트 라인들(122)과 다르게, 넌-액티브 영역(120)에 배치된다. Also, in the non-active area 120, gate driving related wires for transmitting a voltage (signal) required for driving the gate to the gate driver 123 through a pad part to which the data driver DDR is electrically connected may be disposed. . For example, the gate driving-related wirings include clock wirings for transferring clock signals, gate voltage wirings for transferring gate voltages (VGH, VGL), and gate driving control signals for transmitting various control signals necessary for generating scan signals. Wires, and the like. The gate driving related wirings are disposed in the non-active region 120, unlike the gate lines 122 disposed in the active region 110.

구동회로는, 다수의 데이터 라인(121)을 구동하는 데이터 드라이버(DDR)와, 다수의 게이트 라인(122)을 구동하는 게이트 드라이버(123)와, 데이터 드라이버(DDR) 및 게이트 드라이버(123)를 제어하는 컨트롤러(141) 등을 포함할 수 있다. The driving circuit includes a data driver (DDR) driving a plurality of data lines 121, a gate driver 123 driving a plurality of gate lines 122, a data driver (DDR) and a gate driver 123. It may include a controller 141 to control.

데이터 드라이버(124)는 다수의 데이터 라인(121)으로 데이터 전압을 출력함으로써 다수의 데이터 라인(121)을 구동할 수 있다. The data driver 124 may drive the plurality of data lines 121 by outputting a data voltage to the plurality of data lines 121.

게이트 드라이버(123)는 다수의 게이트 라인(122)으로 스캔신호를 출력함으로써 다수의 게이트 라인(122)을 구동할 수 있다. The gate driver 123 may drive the plurality of gate lines 122 by outputting a scan signal to the plurality of gate lines 122.

컨트롤러(141)는, 데이터 드라이버(124) 및 게이트 드라이버(123)의 구동 동작에 필요한 각종 제어신호(126, 125)를 공급하여 데이터 드라이버(124) 및 게이트 드라이버(123)의 구동 동작을 제어할 수 있다. 또한, 컨트롤러(141)는 데이터 드라이버(124)로 영상데이터(127)를 공급할 수 있다. The controller 141 supplies various control signals 126 and 125 required for driving operations of the data driver 124 and the gate driver 123 to control driving operations of the data driver 124 and the gate driver 123. Can. Also, the controller 141 may supply the image data 127 to the data driver 124.

컨트롤러(141)는, 각 프레임에서 구현하는 타이밍에 따라 스캔을 시작하고, 외부에서 입력되는 입력 영상데이터를 데이터 드라이버(124)에서 사용하는 데이터 신호 형식에 맞게 전환하여 전환된 영상데이터(127)를 출력하고, 스캔에 맞춰 적당한 시간에 데이터 구동을 통제한다. The controller 141 starts scanning according to the timing implemented in each frame, and converts the input image data input from the external to the data signal format used by the data driver 124 to convert the converted image data 127. Print and control the data drive at the right time according to the scan.

컨트롤러(141)는, 데이터 드라이버(124) 및 게이트 드라이버(123)를 제어하기 위하여, 수직 동기 신호(Vsync), 수평 동기 신호(Hsync), 입력 데이터 인에이블(DE: Data Enable) 신호, 클럭 신호(CLK) 등의 타이밍 신호를 외부 (예: 호스트 시스템)로부터 입력 받아, 각종 제어 신호들을 생성하여 데이터 드라이버(124) 및 게이트 드라이버(123)로 출력한다. In order to control the data driver 124 and the gate driver 123, the controller 141 includes a vertical sync signal (Vsync), a horizontal sync signal (Hsync), an input data enable (DE: Data Enable) signal, and a clock signal. A timing signal such as (CLK) is received from an external (eg, host system), and various control signals are generated and output to the data driver 124 and the gate driver 123.

예를 들어, 컨트롤러(141)는, 게이트 드라이버(123)를 제어하기 위하여, 게이트 스타트 펄스(GSP: Gate Start Pulse), 게이트 쉬프트 클럭(GSC: Gate Shift Clock), 게이트 출력 인에이블 신호(GOE: Gate Output Enable) 등을 포함하는 각종 게이트 제어 신호(GCS: Gate Control Signal)를 출력한다. For example, the controller 141, in order to control the gate driver 123, a gate start pulse (GSP), a gate shift clock (GSC), and a gate output enable signal (GOE). Gate Output Signals (GCS) are output.

또한, 컨트롤러(141)는, 데이터 드라이버(124)를 제어하기 위하여, 소스 스타트 펄스(SSP: Source Start Pulse), 소스 샘플링 클럭(SSC: Source Sampling Clock), 소스 출력 인에이블 신호(SOE: Source Output Enable) 등을 포함하는 각종 데이터 제어 신호(DCS: Data Control Signal)를 출력한다. In addition, the controller 141, in order to control the data driver 124, source start pulse (SSP: Source Start Pulse), source sampling clock (SSC: Source Sampling Clock), source output enable signal (SOE: Source Output) Enable) and output various data control signals (DCS: Data Control Signal).

컨트롤러(141)는, 통상의 디스플레이 기술에서 이용되는 타이밍 컨트롤러(Timing Controller)이거나, 타이밍 컨트롤러(Timing Controller)를 포함하여 다른 제어 기능도 더 수행할 수 있는 제어장치일 수 있다. The controller 141 may be a timing controller used in a conventional display technology or a control device capable of further performing other control functions including a timing controller.

컨트롤러(141)는, 데이터 드라이버(124)와 별도의 부품으로 구현될 수도 있고, 데이터 드라이버(124)와 함께 통합되어 집적회로로 구현될 수 있다. The controller 141 may be implemented as a separate component from the data driver 124 or integrated with the data driver 124 to be implemented as an integrated circuit.

데이터 드라이버(124)는, 컨트롤러(141)로부터 영상데이터(127)를 입력 받아 다수의 데이터 라인(121)로 데이터 전압을 공급함으로써, 다수의 데이터 라인(121)을 구동한다. 여기서, 데이터 드라이버(124)는 소스 드라이버라고도 한다. The data driver 124 drives the plurality of data lines 121 by receiving the image data 127 from the controller 141 and supplying data voltages to the plurality of data lines 121. Here, the data driver 124 is also referred to as a source driver.

데이터 드라이버(124)는 다양한 인터페이스를 통해 컨트롤러(141)와 각종 신호를 주고받을 수 있다. The data driver 124 can exchange various signals with the controller 141 through various interfaces.

게이트 드라이버(123)는, 다수의 게이트 라인(122)로 스캔신호를 순차적으로 공급함으로써, 다수의 게이트 라인(122)을 순차적으로 구동한다. 여기서, 게이트 드라이버(123)는 스캔 드라이버라고도 한다. The gate driver 123 sequentially drives the plurality of gate lines 122 by sequentially supplying scan signals to the plurality of gate lines 122. Here, the gate driver 123 is also referred to as a scan driver.

게이트 드라이버(123)는, 컨트롤러(141)의 제어에 따라, 온(On) 전압 또는 오프(Off) 전압의 스캔신호를 다수의 게이트 라인(122)로 순차적으로 공급한다. The gate driver 123 sequentially supplies a scan signal of an on voltage or an off voltage to the plurality of gate lines 122 under the control of the controller 141.

데이터 드라이버(124)는, 게이트 드라이버(123)에 의해 특정 게이트 라인이 열리면, 컨트롤러(141)로부터 수신한 영상데이터(127)를 아날로그 형태의 데이터 전압으로 변환하여 다수의 데이터 라인(121)로 공급한다. When the specific gate line is opened by the gate driver 123, the data driver 124 converts the image data 127 received from the controller 141 into an analog data voltage and supplies it to the plurality of data lines 121. do.

데이터 드라이버(124)는, 패널(100)의 일 측(예: 상측 또는 하측)에만 위치할 수도 있고, 경우에 따라서는, 구동 방식, 패널 설계 방식 등에 따라 패널(100)의 양측(예: 상 측과 하 측)에 모두 위치할 수도 있다. The data driver 124 may be located only on one side (eg, an upper side or a lower side) of the panel 100, and in some cases, both sides of the panel 100 (eg, an upper side) according to a driving method, a panel design method, or the like. Side and bottom side).

게이트 드라이버(123)는, 패널(100)의 일 측(예: 좌측 또는 우측)에만 위치할 수도 있고, 경우에 따라서는, 구동 방식, 패널 설계 방식 등에 따라 패널(100)의 양측(예: 좌 측과 우 측)에 모두 위치할 수도 있다. The gate driver 123 may be located only on one side (eg, left or right) of the panel 100, and in some cases, both sides of the panel 100 (eg, left) according to a driving method or a panel design method. Side and right side).

데이터 드라이버(124)는 하나 이상의 소스 드라이버 집적회로(SDIC: Source Driver Integrated Circuit)를 포함하여 구현될 수 있다. The data driver 124 may include one or more source driver integrated circuits (SDICs).

각 소스 드라이버 집적회로(SDIC)는 시프트 레지스터(Shift Register), 래치 회로(Latch Circuit), 디지털 아날로그 컨버터(DAC: Digital to Analog Converter), 출력 버퍼(Output Buffer) 등을 포함할 수 있다. 데이터 드라이버(124)는, 경우에 따라서, 하나 이상의 아날로그 디지털 컨버터(ADC: Analog to Digital Converter)를 더 포함할 수 있다. Each source driver integrated circuit (SDIC) may include a shift register, a latch circuit, a digital to analog converter (DAC), an output buffer, and the like. The data driver 124 may further include one or more analog-to-digital converters (ADCs).

각 소스 드라이버 집적회로(SDIC)는, TAB (Tape Automated Bonding) 타입 또는 COG (Chip On Glass) 타입으로 패널(100)의 본딩 패드(Bonding Pad)에 연결되거나 패널(100) 상에 직접 배치될 수도 있다. 경우에 따라서, 각 소스 드라이버 집적회로(SDIC)는 패널(100)에 집적화되어 배치될 수도 있다. 또한, 각 소스 드라이버 집적회로(SDIC)는 COF (Chip On Film) 타입으로 구현될 수 있다. 이 경우, 각 소스 드라이버 집적회로(SDIC)는 회로필름 상에 실장 되어, 회로필름을 통해 패널(100)에서의 데이터 라인들(121)과 전기적으로 연결될 수 있다. Each source driver integrated circuit (SDIC) may be connected to a bonding pad of the panel 100 in a Tape Automated Bonding (TAB) type or a Chip On Glass (COG) type, or may be directly disposed on the panel 100 have. In some cases, each source driver integrated circuit (SDIC) may be integrated and disposed in the panel 100. Further, each source driver integrated circuit (SDIC) may be implemented in a COF (Chip On Film) type. In this case, each source driver integrated circuit (SDIC) is mounted on the circuit film, it can be electrically connected to the data lines 121 in the panel 100 through the circuit film.

게이트 드라이버(123)는 다수의 게이트 구동회로(230)를 포함할 수 있다. 여기서, 다수의 게이트 구동회로(230)는 다수의 게이트 라인(122)과 각각 대응될 수 있다. The gate driver 123 may include a plurality of gate driving circuits 230. Here, the plurality of gate driving circuits 230 may correspond to the plurality of gate lines 122, respectively.

각 게이트 구동회로(230)는 시프트 레지스터(Shift Register), 레벨 시프터(Level Shifter) 등을 포함할 수 있다. Each gate driving circuit 230 may include a shift register, a level shifter, and the like.

각 게이트 구동회로(230)는 TAB (Tape Automated Bonding) 타입 또는 COG (Chip On Glass) 타입으로 패널(100)의 본딩 패드(Bonding Pad)에 연결될 수 있다. 또한, 각 게이트 구동회로(230)는 COF (Chip On Film) 방식으로 구현될 수 있다. 이 경우, 각 게이트 구동회로(230)는 회로필름 상에 실장 되어, 회로필름을 통해 패널(100)에서의 게이트 라인들(122)과 전기적으로 연결될 수 있다. 또한, 각 게이트 구동회로(230)는 GIP (Gate In Panel) 타입으로 구현되어 패널(100)에 내장될 수 있다. 즉, 각 게이트 구동회로(230)는 패널(100)에 직접 형성될 수 있다. Each gate driving circuit 230 may be connected to a bonding pad of the panel 100 in a tape automated bonding (TAB) type or a chip on glass (COG) type. In addition, each gate driving circuit 230 may be implemented in a COF (Chip On Film) method. In this case, each gate driving circuit 230 is mounted on the circuit film, and may be electrically connected to the gate lines 122 in the panel 100 through the circuit film. In addition, each gate driving circuit 230 may be implemented in a GIP (Gate In Panel) type to be embedded in the panel 100. That is, each gate driving circuit 230 may be directly formed on the panel 100.

도 2는 본 발명의 실시예들에 따른 패널(200)이 OLED (Organic Light Emitting Diode) 패널인 경우, 서브픽셀의 구조를 나타낸 도면이다.FIG. 2 is a diagram illustrating the structure of a subpixel when the panel 200 according to embodiments of the present invention is an OLED (Organic Light Emitting Diode) panel.

도 2를 참조하면, OLED 패널인 패널(110)에서의 각 서브픽셀(SP)은, 유기발광다이오드(OLED)와, 유기발광다이오드(OLED)를 구동하는 구동 트랜지스터(DRT)와, 구동 트랜지스터(DRT)의 제1 노드(N1)와 해당 데이터 라인(DL) 사이에 전기적으로 연결된 스위칭 트랜지스터(O-SWT)와, 구동 트랜지스터(DRT)의 제1 노드(N1)와 제2 노드(N2) 사이에 전기적으로 연결된 스토리지 캐패시터(Cst) 등을 포함하여 구현될 수 있다. Referring to FIG. 2, each subpixel SP in the panel 110 which is an OLED panel includes an organic light emitting diode (OLED), a driving transistor (DRT) driving the organic light emitting diode (OLED), and a driving transistor ( The switching transistor O-SWT electrically connected between the first node N1 of the DRT and the corresponding data line DL, and between the first node N1 and the second node N2 of the driving transistor DRT. It may be implemented, including a storage capacitor (Cst) electrically connected to.

유기발광다이오드(OLED)는 애노드 전극, 유기발광층 및 캐소드 전극 등으로 이루어질 수 있다. The organic light emitting diode (OLED) may be formed of an anode electrode, an organic light emitting layer and a cathode electrode.

도 2는 본 발명의 실시예들에 따른 전자장치의 시스템 구현 예시도이다. 2 is an exemplary system implementation of an electronic device according to embodiments of the present invention.

도 2를 참조하면, 본 발명의 실시예들에 따른 전자장치에서, 데이터 드라이버(DDR)는 다양한 타입들(TAB, COG, COF 등) 중 COF (Chip On Film) 타입으로 구현되고, 게이트 드라이버(GDR)는 다양한 타입들(TAB, COG, COF, GIP 등) 중 GIP (Gate In Panel) 타입으로 구현될 수 있다. Referring to FIG. 2, in an electronic device according to embodiments of the present invention, a data driver (DDR) is implemented as a chip on film (COF) type among various types (TAB, COG, COF, etc.), and a gate driver ( GDR) may be implemented as a GIP (Gate In Panel) type among various types (TAB, COG, COF, GIP, etc.).

데이터 드라이버(DDR)는 하나 이상의 소스 드라이버 집적회로(270)로 구현될 수 있다. 도 2는 데이터 드라이버(DDR)가 다수의 소스 드라이버 집적회로(270)로 구현된 경우를 예시한 것이다. The data driver DDR may be implemented with one or more source driver integrated circuits 270. FIG. 2 illustrates a case where the data driver DDR is implemented by a plurality of source driver integrated circuits 270.

데이터 드라이버(DDR)가 COF 타입으로 구현된 경우, 데이터 드라이버(DDR)를 구현한 각 소스 드라이버 집적회로(270)는, 소스 측 회로필름(280) 상에 실장 될 수 있다. When the data driver DDR is implemented as a COF type, each source driver integrated circuit 270 that implements the data driver DDR may be mounted on the source side circuit film 280.

소스 측 회로필름(280)의 일 측은 패널(200)의 넌-액티브 영역(220)에 존재하는 패드 부 (패드들의 집합체)와 전기적으로 연결될 수 있다. One side of the source side circuit film 280 may be electrically connected to a pad portion (a collection of pads) existing in the non-active region 220 of the panel 200.

소스 측 회로필름(280) 상에는, 소스 드라이버 집적회로(270)와 패널(200)을 전기적으로 연결해주기 위한 배선들이 배치될 수 있다. Wires for electrically connecting the source driver integrated circuit 270 and the panel 200 may be disposed on the source-side circuit film 280.

전자장치는, 다수의 소스 드라이버 집적회로(270)와 다른 장치들 간의 회로적인 연결을 위해, 하나 이상의 소스 인쇄회로기판(250)과, 제어 부품들과 각종 전기 장치들을 실장 하기 위한 컨트롤 인쇄회로기판(240)을 포함할 수 있다. The electronic device is a control printed circuit board for mounting one or more source printed circuit boards 250 and control components and various electrical devices for circuit connection between a plurality of source driver integrated circuits 270 and other devices. It may include (240).

하나 이상의 소스 인쇄회로기판(250)에는 소스 드라이버 집적회로(270)가 실장 된 소스 측 회로필름(280)의 타 측이 연결될 수 있다. The other side of the source-side circuit film 280 on which the source driver integrated circuit 270 is mounted may be connected to one or more source printed circuit boards 250.

즉, 소스 드라이버 집적회로(270)가 실장 된 소스 측 회로필름(280)은, 일 측이 패널(200)의 넌-액티브 영역(220)과 전기적으로 연결되고, 타 측이 소스 인쇄회로기판(250)과 전기적으로 연결될 수 있다. That is, the source-side circuit film 280 on which the source driver integrated circuit 270 is mounted, one side is electrically connected to the non-active region 220 of the panel 200, and the other side is the source printed circuit board ( 250).

컨트롤 인쇄회로기판(240)에는, 데이터 드라이버(DDR) 및 게이트 드라이버(GDR) 등의 동작을 제어하는 컨트롤러(241)가 배치될 수 있다. A controller 241 that controls operations such as a data driver (DDR) and a gate driver (GDR) may be disposed on the control printed circuit board 240.

또한, 컨트롤 인쇄회로기판(240)에는, 패널(200), 데이터 드라이버(DDR) 및 게이트 드라이버(GDR) 등으로 각종 전압 또는 전류를 공급해주거나 공급할 각종 전압 또는 전류를 제어하는 파워 관리 집적회로(PMIC: Power Management IC) 등이 더 배치될 수도 있다. In addition, the control printed circuit board 240, the panel 200, a data driver (DDR) and a gate driver (GDR), such as supplying various voltages or currents, or power management integrated circuits (PMICs) for controlling various voltages or currents : Power Management IC).

소스 인쇄회로기판(250)과 컨트롤 인쇄회로기판(240)은 적어도 하나의 연결 부재(260)를 통해 회로적으로 연결될 수 있다. 여기서, 연결 부재(260)는, 일 예로, 가요성 인쇄 회로(FPC: Flexible Printed Circuit), 가요성 플랫 케이블(FFC: Flexible Flat Cable) 등일 수 있다. The source printed circuit board 250 and the control printed circuit board 240 may be circuitly connected through at least one connecting member 260. Here, the connection member 260 may be, for example, a flexible printed circuit (FPC), a flexible flat cable (FFC), or the like.

하나 이상의 소스 인쇄회로기판(250)과 컨트롤 인쇄회로기판(240)은 하나의 인쇄회로기판으로 통합되어 구현될 수도 있다. The one or more source printed circuit boards 250 and the control printed circuit board 240 may be embodied as one printed circuit board.

게이트 드라이버(GDR)가 GIP (Gate In Panel) 타입으로 구현된 경우, 게이트 드라이버(GDR)에 포함된 다수의 게이트 구동회로(230)는 패널(200)의 넌-액티브 영역(220) 상에 직접 형성될 수 있다. When the gate driver GDR is implemented in a GIP (Gate In Panel) type, a plurality of gate driving circuits 230 included in the gate driver GDR are directly on the non-active region 220 of the panel 200. Can be formed.

다수의 게이트 구동회로(230) 각각은 패널(200)에서의 액티브 영역(210)에 배치된 해당 게이트 라인(GL)으로 해당 스캔신호(SCAN)를 출력할 수 있다. Each of the plurality of gate driving circuits 230 may output the corresponding scan signal SCAN to the corresponding gate line GL disposed in the active area 210 of the panel 200.

패널(200) 상에 배치된 다수의 게이트 구동회로(230)는, 넌-액티브 영역(220)에 배치된 게이트 구동 관련 배선들을 통해, 스캔신호 생성에 필요한 각종 신호(클럭신호, 하이 레벨 게이트 전압(VGH), 로우 레벨 게이트 전압(VGL), 스타트 신호(VST), 리셋 신호(RST) 등)를 공급받을 수 있다. The plurality of gate driving circuits 230 disposed on the panel 200, through the gate driving related wirings arranged in the non-active region 220, various signals required for generating a scan signal (clock signal, high level gate voltage) (VGH), low level gate voltage (VGL), start signal (VST), reset signal (RST, etc.) may be supplied.

넌-액티브 영역(220)에 배치된 게이트 구동 관련 배선들은, 다수의 게이트 구동회로(230)에 가장 인접하게 배치된 소스 측 회로필름(280)과 전기적으로 연결될 수 있다.The gate driving related wires disposed in the non-active region 220 may be electrically connected to the source side circuit film 280 disposed closest to the plurality of gate driving circuits 230.

도 3은 본 발명의 실시예들에 따른 패널(PNL)이 OLED (Organic Light Emitting Diode) 패널인 경우, 서브픽셀(SP)의 구조를 나타낸 도면이다.FIG. 3 is a diagram illustrating the structure of a subpixel SP when the panel PNL according to embodiments of the present invention is an OLED (Organic Light Emitting Diode) panel.

도 3을 참조하면, OLED 패널인 패널(110)에서의 각 서브픽셀(SP)은, 유기발광다이오드(OLED)와, 유기발광다이오드(OLED)를 구동하는 구동 트랜지스터(DRT)와, 구동 트랜지스터(DRT)의 제1 노드(N1)와 해당 데이터 라인(DL) 사이에 전기적으로 연결된 스위칭 트랜지스터(O-SWT)와, 구동 트랜지스터(DRT)의 제1 노드(N1)와 제2 노드(N2) 사이에 전기적으로 연결된 스토리지 캐패시터(Cst) 등을 포함하여 구현될 수 있다. Referring to FIG. 3, each subpixel SP in the panel 110 which is an OLED panel includes an organic light emitting diode (OLED), a driving transistor (DRT) driving the organic light emitting diode (OLED), and a driving transistor ( The switching transistor O-SWT electrically connected between the first node N1 of the DRT and the corresponding data line DL, and between the first node N1 and the second node N2 of the driving transistor DRT. It may be implemented, including a storage capacitor (Cst) electrically connected to.

유기발광다이오드(OLED)는 애노드 전극, 유기발광층 및 캐소드 전극 등으로 이루어질 수 있다. The organic light emitting diode (OLED) may be formed of an anode electrode, an organic light emitting layer and a cathode electrode.

도 3의 회로 예시에 따르면, 유기발광다이오드(OLED)의 애노드 전극(픽셀전극이라고도 함)은 구동 트랜지스터(DRT)의 제2 노드(N2)와 전기적으로 연결될 수 있다. 유기발광다이오드(OLED)의 캐소드 전극(공통전극이라고도 함)에는 기저전압(EVSS)이 인가될 수 있다. According to the circuit example of FIG. 3, the anode electrode (also referred to as a pixel electrode) of the organic light emitting diode OLED may be electrically connected to the second node N2 of the driving transistor DRT. A ground voltage (EVSS) may be applied to the cathode electrode (also referred to as a common electrode) of the organic light emitting diode (OLED).

여기서, 기저전압(EVSS)은, 일 예로, 그라운드 전압이거나 그라운드 전압보다 높거나 낮은 전압일 수 있다. 또한, 기저전압(EVSS)은 구동상태에 따라 가변될 수 있다. 예를 들어, 영상 구동 시 기저전압(EVSS)과 센싱 구동 시 기저전압(EVSS)은 서로 다르게 설정될 수 있다. Here, the ground voltage EVSS may be, for example, a ground voltage or a voltage higher or lower than the ground voltage. In addition, the ground voltage EVSS may vary depending on the driving state. For example, the base voltage (EVSS) when driving the image and the base voltage (EVSS) when sensing may be set differently.

구동 트랜지스터(DRT)는 유기발광다이오드(OLED)로 구동전류를 공급해줌으로써 유기발광다이오드(OLED)를 구동해준다. The driving transistor DRT drives the organic light emitting diode OLED by supplying a driving current to the organic light emitting diode OLED.

구동 트랜지스터(DRT)는 제1 노드(N1), 제2 노드(N2) 및 제3 노드(N3) 등을 포함할 수 있다. The driving transistor DRT may include a first node N1, a second node N2, a third node N3, and the like.

구동 트랜지스터(DRT)의 제1 노드(N1)는 게이트 노드일 수 있으며, 스위칭 트랜지스터(O-SWT)의 소스 노드 또는 드레인 노드와 전기적으로 연결될 수 있다. 구동 트랜지스터(DRT)의 제2 노드(N2)는 소스 노드 또는 드레인 노드일 수 있으며, 유기발광다이오드(OLED)의 애노드 전극(또는 캐소드 전극)과 전기적으로 연결될 수 있다. 구동 트랜지스터(DRT)의 제3 노드(N3)는 드레인 노드 또는 소스 노드일 수 있으며, 구동전압(EVDD)이 인가될 수 있고, 구동전압(EVDD)을 공급하는 구동전압 라인(DVL: Driving Voltage Line)과 전기적으로 연결될 수 있다. The first node N1 of the driving transistor DRT may be a gate node, and may be electrically connected to a source node or a drain node of the switching transistor O-SWT. The second node N2 of the driving transistor DRT may be a source node or a drain node, and may be electrically connected to an anode electrode (or cathode electrode) of the organic light emitting diode (OLED). The third node N3 of the driving transistor DRT may be a drain node or a source node, a driving voltage EVDD may be applied, and a driving voltage line (DVL) that supplies the driving voltage EVDD ).

스토리지 캐패시터(Cst)는 구동 트랜지스터(DRT)의 제1 노드(N1)와 제2 노드(N2) 사이에 전기적으로 연결되어, 영상 신호 전압에 해당하는 데이터 전압(Vdata) 또는 이에 대응되는 전압을 한 프레임 시간 (또는 정해진 시간) 동안 유지해줄 수 있다. The storage capacitor Cst is electrically connected between the first node N1 and the second node N2 of the driving transistor DRT to perform a data voltage Vdata corresponding to the image signal voltage or a voltage corresponding thereto. It can be maintained for a frame time (or a fixed time).

스위칭 트랜지스터(O-SWT)의 드레인 노드 또는 소스 노드는 해당 데이터 라인(DL)에 전기적으로 연결되고, 스위칭 트랜지스터(O-SWT)의 소스 노드 또는 드레인 노드는 구동 트랜지스터(DRT)의 제1 노드(N1)에 전기적으로 연결되고, 스위칭 트랜지스터(O-SWT)의 게이트 노드는 해당 게이트 라인과 전기적으로 연결되어 스캔신호(SCAN)를 인가 받을 수 있다. The drain node or source node of the switching transistor O-SWT is electrically connected to the corresponding data line DL, and the source node or drain node of the switching transistor O-SWT is the first node of the driving transistor DRT ( N1), and the gate node of the switching transistor O-SWT is electrically connected to the corresponding gate line to receive the scan signal SCAN.

스위칭 트랜지스터(O-SWT)는 해당 게이트 라인을 통해 스캔신호(SCAN)를 게이트 노드로 인가 받아 온-오프가 제어될 수 있다. The switching transistor O-SWT receives the scan signal SCAN to the gate node through the corresponding gate line, so that on-off may be controlled.

이러한 스위칭 트랜지스터(O-SWT)는 스캔신호(SCAN)에 의해 턴-온 되어 해당 데이터 라인(DL)으로부터 공급된 데이터 전압(Vdata)을 구동 트랜지스터(DRT)의 제1 노드(N1)로 전달해줄 수 있다. The switching transistor O-SWT is turned on by the scan signal SCAN to transfer the data voltage Vdata supplied from the corresponding data line DL to the first node N1 of the driving transistor DRT. Can.

한편, 스토리지 캐패시터(Cst)는, 구동 트랜지스터(DRT)의 제1 노드(N1)와 제2 노드(N2) 사이에 존재하는 내부 캐패시터(Internal Capacitor)인 기생 캐패시터(예: Cgs, Cgd)가 아니라, 구동 트랜지스터(DRT)의 외부에 의도적으로 설계한 외부 캐패시터(External Capacitor)일 수 있다. Meanwhile, the storage capacitor Cst is not a parasitic capacitor (eg, Cgs, Cgd) which is an internal capacitor existing between the first node N1 and the second node N2 of the driving transistor DRT. , May be an external capacitor designed intentionally outside the driving transistor DRT.

구동 트랜지스터(DRT) 및 스위칭 트랜지스터(O-SWT) 각각은 n 타입 트랜지스터이거나 p 타입 트랜지스터일 수 있다. Each of the driving transistor DRT and the switching transistor O-SWT may be an n-type transistor or a p-type transistor.

도 3에 예시된 각 서브픽셀 구조는 2T(Transistor) 1C (Capacitor) 구조로서, 설명을 위한 예시일 뿐, 1개 이상의 트랜지스터를 더 포함하거나, 경우에 따라서는, 1개 이상의 캐패시터를 더 포함할 수도 있다. 또는, 다수의 서브픽셀들 각각이 동일한 구조로 되어 있을 수도 있고, 다수의 서브픽셀들 중 일부는 다른 구조로 되어 있을 수도 있다.Each sub-pixel structure illustrated in FIG. 3 is a 2T (Transistor) 1C (Capacitor) structure, and is only an example for description, and further includes one or more transistors, or, in some cases, one or more capacitors. It might be. Alternatively, each of the plurality of sub-pixels may have the same structure, and some of the plurality of sub-pixels may have a different structure.

본 발명의 실시예들에 따른 표시패널은, 제1 기판, 광색층, 제1 전극, 유기층및 제2 전극을 포함할 수 있다.The display panel according to embodiments of the present invention may include a first substrate, a light color layer, a first electrode, an organic layer, and a second electrode.

광색층은 제1 기판상에 배치될 수 있다.The light color layer may be disposed on the first substrate.

광색층은, 광에 의해 가역적인 이성질체화를 진행하는 광색 물질을 포함할 수 있다. 예를 들면, 상기 광색 물질은 광의 조사에 의하여 이성질체 1에서 이성질체 2로 전환 수 있으며, 이성질체 2는 상기 광과 다른 파장을 가지는 광의 조사에 의하여 이성질체 1로 전환될 수 있다.The photochromic layer may include a photochromic material that undergoes reversible isomerization by light. For example, the photochromic material may be converted from isomer 1 to isomer 2 by irradiation of light, and isomer 2 may be converted to isomer 1 by irradiation of light having a different wavelength from the light.

도 4는 광색층에 포함되는 광색 물질의 이성질체화를 설명하기 위한 도면이다.4 is a view for explaining the isomerization of a photochromic material included in the photochromic layer.

도 4를 참조하면, 본 발명의 광색 물질은 광의 조사에 의하여 광색 물질이 닫힌 형태(Closed form)의 이성질체로 전환될 수도 있고, 열린 형태(Open form)의 이성질체로 전환될 수 있다. 예를 들면, 열린 형태의 이성질체는 굽은 형태의 분자 구조를 가질 수 있고, 닫힌 형태의 이성질체는 직선 형태의 분자 구조를 가질 수 있다.Referring to FIG. 4, the photochromic material of the present invention may be converted to an isomer in a closed form or an open form isomer by irradiation of light. For example, an isomer in an open form may have a molecular structure in a curved form, and an isomer in a closed form may have a molecular structure in a straight form.

광색 물질이 직선 형태의 분자 구조를 가질 경우, 분자의 팩킹(packing)이 잘 일어나기 때문에, 광색 물질의 자유부피가 낮아 분자의 운동성이 낮아져 유리 상태(glassy state)를 가지게 된다. 광색 물질이 굽은 형태의 분자 구조를 가질 경우에는, 분자의 팩킹(packing)이 잘 일어나지 않기 때문에, 광색 물질의 자유부피가 커 분자의 운동성이 높아져 고무 상태(rubbery state) 상태를 가지게 된다. 이러한 광색 물질의 상태에 따른 운동성의 차이로 인하여, 광색층(420) 상에 제1 전극(430)을 형성할 때 제1 전극(430)을 선택적으로 형성할 수 있다.When the photochromic material has a linear molecular structure, since the packing of the molecule occurs well, the free volume of the photochromic material is low and the mobility of the molecule is lowered to have a glassy state. When the photochromic material has a curved molecular structure, since the packing of the molecule does not occur easily, the free volume of the photochromic material is large, and the mobility of the molecule is increased to have a rubbery state. Due to the difference in mobility according to the state of the photochromic material, the first electrode 430 may be selectively formed when the first electrode 430 is formed on the photochromic layer 420.

따라서, 본 발명의 실시예들에 따른 광색 물질은, 광의 조사에 의하여 유리 상태(glassy state)와 고무 상태(rubbery state)의 전환이 가능한 물질일 수 있다. 예를 들면, 본 발명의 광색 물질은 디아릴에텐(diarylethene) 화합물을 포함할 수 있다. 또한, 본 발명의 실시예들에 따른 광색 물질은, 상기 디아릴에텐(diarylethene) 화합물이 광 조사에 의하여 이성질체화된 화합물을 포함할 수 있다.Accordingly, the photochromic material according to embodiments of the present invention may be a material capable of switching between a glassy state and a rubbery state by irradiation of light. For example, the photochromic material of the present invention may include a diarylethene compound. In addition, the photochromic material according to embodiments of the present invention may include a compound in which the diarylethene compound isomerized by light irradiation.

도 4를 참조하면, 디아릴에텐 화합물은 열린 형태(open form)이므로, 디아릴에텐 화합물을 더 많이 포함하는 제2 영역(422)은 고무 상태(rubbery)일 수 있다. 따라서, 광색층(420)의 제1 영역(421)은 유리 상태인 영역일 수 있고, 광색층(420)의 제2 영역(422)은 고무 상태인 영역일 수 있다. 광색층(420)은, 제1 영역(421)에서 상기 디아릴에텐 화합물의 이성질체를 상기 디아릴에텐 화합물보다 다량으로 포함할 수 있다. Referring to FIG. 4, since the diarylethene compound is in an open form, the second region 422 including more diarylethene compound may be in a rubbery state. Accordingly, the first region 421 of the photochromic layer 420 may be a glassy region, and the second region 422 of the photochromic layer 420 may be a rubbery region. The photochromic layer 420 may include an isomer of the diarylethene compound in the first region 421 in a larger amount than the diarylethene compound.

도 4를 참조하면, 디아릴에텐 화합물의 이성질체는 닫힌 형태(closed form)로, 유리 상태(glassy state)를 가지므로, 광색층(420)은 제1 영역(421)에서 유리 상태일 수 있다. Referring to FIG. 4, since the isomer of the diarylethene compound is in a closed form and has a glassy state, the photochromic layer 420 may be free in the first region 421. .

도 5는 광색층(420)에 제1 전극(430)이 선택적으로 형성되는 것을 설명하기 위한 도면이다. 보다 구체적으로, 도 5는 열 증착(Thermal Evaporation)을 통하여 제1 영역(421) 및 제2 영역(422)으로 구분되는 광색층(420) 상에 제1 전극(430)을 증착하는 것을 설명하는 것이다. 5 is a view for explaining that the first electrode 430 is selectively formed on the photochromic layer 420. More specifically, FIG. 5 illustrates the deposition of the first electrode 430 on the light color layer 420 divided into the first region 421 and the second region 422 through thermal evaporation. will be.

도 5에 도시하였듯이, 유리 상태인 제1 영역(421)에는 열 증착에 의해 제1 전극(430)이 형성될 수 있다. 유리 상태인 제1 영역(421)은 광색 물질의 자유부피가 낮아 분자의 운동성이 낮기 때문에 열 증착에 의해 제1 전극(430)을 구성하는 물질의 결정핵 생성 및 결정핵의 성장이 일어날 수 있기 때문이다.As illustrated in FIG. 5, the first electrode 430 may be formed in the first region 421 in a glass state by thermal evaporation. Since the free region of the photochromic material has a low free volume in the glassy state, the molecular mobility is low, thereby generating crystal nuclei and growing crystal nuclei of the material constituting the first electrode 430 by thermal evaporation. Because.

고무 상태인 제2 영역(422)에는 열 증착에 의해 제1 전극(430)이 형성되지 않는다. 고무 상태인 제2 영역(422)은 광색 물질의 자유부피가 커 분자의 운동성이 크기 때문에 제1 전극(430)을 구성하는 물질이 표면에 도달하더라도 상기 물질을 탈착시키거나, 표면에서 상기 물질이 운동하여 결정핵이 형성되는 것을 방해하기 때문이다.The first electrode 430 is not formed in the rubbery second region 422 by thermal evaporation. Since the free volume of the photochromic material is large in the rubber-like second region 422, the mobility of the molecule is large, so that even if the material constituting the first electrode 430 reaches the surface, the material is detached or the material is removed from the surface. This is because exercise prevents the formation of crystal nuclei.

광색층(420)은 제1 영역(421)과 제2 영역(422)의 색이 서로 상이할 수 있다.In the light color layer 420, colors of the first region 421 and the second region 422 may be different from each other.

도 6은 본 발명의 실시예들에 따른 광색층의 제1 영역 및 제2 영역의 파장에 따른 흡광도를 측정한 것이다.6 is a measurement of absorbance according to the wavelengths of the first and second regions of the photochromic layer according to embodiments of the present invention.

도 6을 참조하면, 제1 영역의 흡광도(A)가 제2 영역의 흡광도(B)보다 가시광선 영역에 걸쳐 높은 것을 알 수 있다. 유리 상태인 제1 영역의 경우, 가시광선 영역에서 소정의 흡광도를 가지므로, 육안으로 특정한 색이 관찰될 수 있다. 고무 상태인 제2 영역의 경우, 가시광선 영역에서 흡광도가 매우 낮으므로, 투명하거나 무색으로 관찰된다.Referring to FIG. 6, it can be seen that the absorbance (A) of the first region is higher than the absorbance (B) of the second region over the visible region. In the case of the first region in the glass state, since it has a predetermined absorbance in the visible region, a specific color can be observed with the naked eye. In the case of the second region in the rubber state, since the absorbance is very low in the visible region, it is observed as transparent or colorless.

제1 전극(430)을 구성하는 물질은 특별히 제한되는 것은 아니며, 예를 들면, Al, Mg, Mn, Zn, Ag 등과 같은 금속으로 이루어진 금속층을 포함할 수 있다. 바람직하게는, 제1 전극(430)은 도전성 층으로 상기 금속층만을 포함할 수 있다.The material constituting the first electrode 430 is not particularly limited, and may include, for example, a metal layer made of a metal such as Al, Mg, Mn, Zn, Ag, or the like. Preferably, the first electrode 430 may include only the metal layer as a conductive layer.

예를 들면, 제1 전극(430)은 Al을 포함하는 금속층으로 구성되는 단일층일 수 있다.For example, the first electrode 430 may be a single layer composed of a metal layer containing Al.

Al의 경우 비용이 저렴하다는 장점이 있으나, 식각 공정에 의해 패턴을 형성할 경우 산화에 의해 물성이 저하되는 문제가 있다. 따라서, 산화에 의한 문제를 해결하기 위하여 Ag와 같은 금속을 사용할 수 있으나, 비용이 높다는 문제가 있다.In the case of Al, there is an advantage that it is inexpensive, but when forming a pattern by an etching process, there is a problem that physical properties are lowered by oxidation. Therefore, a metal such as Ag can be used to solve the problem due to oxidation, but there is a problem that the cost is high.

본 발명의 실시예들에 따른 표시패널의 경우, 광색층(420) 상에 제1 전극(430)을 선택적으로 형성할 수 있으므로, 식각 공정을 생략할 수 있다. 따라서, 식각 공정에 의한 전극의 물성 저하를 예방할 수 있으므로, 비용이 저렴한 Al을 사용할 수 있다.In the case of the display panel according to embodiments of the present invention, since the first electrode 430 may be selectively formed on the light color layer 420, an etching process may be omitted. Therefore, since it is possible to prevent deterioration of the physical properties of the electrode by the etching process, it is possible to use Al, which is inexpensive.

또한, Al은 Ag보다 반사율이 높다는 장점이 있어, 탑 에미션 구조에서 반사전극으로 사용할 때 Ag 보다 우수한 반사율을 가지는 반사전극을 제공할 수 있다는 장점이 있다.In addition, Al has an advantage of higher reflectivity than Ag, and when used as a reflective electrode in a top emission structure, there is an advantage of providing a reflective electrode having a better reflectivity than Ag.

도 7은 Al과 Ag의 파장에 따른 반사율을 나타내는 자료이다.7 is a data showing reflectance according to the wavelength of Al and Ag.

도 7을 참조하면, Ag의 경우 낮은 파장대에서 반사율이 낮기 때문에, 반사광이 청색으로 전이되는 현상이 일어난다. 그러나, Al은 가시광선 영역대에서 반사율이 고르기 때문에, 색의 전이 현상이 일어나지 않는다. 따라서, Al을 반사전극으로 사용할 경우, 서브픽셀이 방출하는 빛의 파장대를 조절하는 것이 더욱 용이하다는 장점이 있다.Referring to FIG. 7, in the case of Ag, since the reflectance is low in a low wavelength band, a phenomenon in which reflected light is transferred to blue occurs. However, since Al has a uniform reflectance in the visible light region, color transition does not occur. Therefore, when Al is used as a reflective electrode, there is an advantage that it is easier to control the wavelength band of light emitted by the subpixel.

도 8은 본 발명의 실시예들에 따른 표시패널의 단면을 개략적으로 나타낸 도면이다.8 is a view schematically showing a cross-section of a display panel according to embodiments of the present invention.

제1 기판(410)은 제1 기판 상에 형성되는 전자회로 소자를 지지하는 기판으로서, 상기 제1 기판 상에는 트랜지스터, 캐패시터, 유기발광 다이오드 등의 전자회로 소자가 형성될 수 있다.The first substrate 410 is a substrate supporting an electronic circuit element formed on the first substrate, and an electronic circuit element such as a transistor, a capacitor, or an organic light emitting diode may be formed on the first substrate.

제1 기판(410)의 종류는 특별히 제한되는 것은 아니나, 예를 들면, 유리 또는 플라스틱을 사용할 수 있다. 특히, 가요성 플라스틱을 사용할 경우에는 본 발명의 실시예들이 가요성 표시패널 및 가요성 표시장치를 제공할 수 있다.광색층(420)은, 제1 영역(421)과 제2 영역(422)으로 구성될 수 있다. 광색층(420)의 제1 영역(421)은, 닫힌 형태의 이성질체를 포함하는 유리 상태(glassy state)이고, 제2 영역(422)은, 열린 형태의 이성질체를 포함하는 고무 상태(rubbery state)일 수 있다.The type of the first substrate 410 is not particularly limited, but may be, for example, glass or plastic. In particular, when using flexible plastic, embodiments of the present invention can provide a flexible display panel and a flexible display device. The light color layer 420 includes a first region 421 and a second region 422. It can be composed of. The first region 421 of the photochromic layer 420 is a glassy state containing isomers in a closed form, and the second region 422 is a rubbery state containing isomers in an open form. Can be

광색층(420)의 제1 영역(421)은, 제1 전극(430)이 형성된 영역일 수 있고, 제2 영역(422)은 제1 전극(430)이 형성되지 않은 영역일 수 있다.The first region 421 of the photochromic layer 420 may be a region in which the first electrode 430 is formed, and the second region 422 may be a region in which the first electrode 430 is not formed.

광색층(420)은, 제1 영역(421)이 유리 상태(glassy state)이고, 제2 영역(422)이 고무 상태(rubbery state)일 수 있다. 예를 들면, 광색층(420)은, 제2 영역(422)에서 디아릴에텐 화합물을 포함할 수 있다. 바람직하게는, 광색층(420)은, 제2 영역(422)에서 광색 물질인 디아릴에텐 화합물을 그 이성질체인 화합물보다 다량으로 포함할 수 있다. 디아릴에텐 화합물이 그 이성질체인 화합물보다 다량이라 것은, 제2 영역(422)에 포함되는 디아릴에텐 화합물의 몰수가 상기 디아릴에텐 화합물의 이성질체의 몰수보다 더 크다는 것을 의미할 수 있다. In the light color layer 420, the first region 421 may be in a glassy state, and the second region 422 may be in a rubbery state. For example, the photochromic layer 420 may include a diarylethene compound in the second region 422. Preferably, the photochromic layer 420 may include a diarylethene compound that is a photochromic material in the second region 422 in a larger amount than the isomer compound. When the diarylethene compound has a larger amount than the isomer compound, it may mean that the number of moles of the diarylethene compound included in the second region 422 is greater than that of the isomer of the diarylethene compound. .

따라서, 본 발명의 실시예들에 따른 표시패널은 제1 전극(430)이 광색층(420)의 제1 영역(421) 상에만 위치하고, 광색층(420)의 제2 영역(422) 상에는 위치하지 않을 수 있다.Accordingly, in the display panel according to embodiments of the present invention, the first electrode 430 is positioned only on the first region 421 of the photochromic layer 420 and positioned on the second region 422 of the photochromic layer 420. You may not.

본 발명의 실시예들에 따른 표시패널은, 광색층(420)의 제2 영역(422) 상에 서브픽셀들을 구분하는 뱅크(417)를 포함하지 않을 수 있다.The display panel according to embodiments of the present invention may not include a bank 417 that separates subpixels on the second area 422 of the light color layer 420.

광색층(420) 상에 제1 전극(430)을 형성하는 과정에서, 제1 전극(430)이 광색층(420)의 제1 영역(421)에만 선택적으로 형성되므로, 본 발명의 실시예들에 따른 표시패널은 제1 전극(430)의 주변부에 뱅크를 형성하지 않아도 단락이 발생하지 않는다.In the process of forming the first electrode 430 on the photochromic layer 420, since the first electrode 430 is selectively formed only in the first region 421 of the photochromic layer 420, embodiments of the present invention A short circuit does not occur even if a bank is not formed in the periphery of the first electrode 430 according to the display panel.

제1 전극(430)이 본 발명의 실시예들과 달리 선택적으로 형성되지 않을 경우, 예를 들면, 제1 전극(430)을 패터닝하기 위하여 에칭을 하는 과정에서, 제1 전극의 주변부에 역 테이퍼 형상이 형성될 수 있다. 상기 역 테이퍼 형상이 극단적으로 형성될 경우, 소위 테일(tail)이라고 지칭하는 부분이 제1 전극(430)의 주변부에서 관찰될 수 있으며, 제1 전극(430)이 상기 테일을 가질 경우 전류 쏠림 현상에 의해 쇼트가 발생할 수 있다. 따라서, 에칭을 통하여 제1 전극을 패터닝하는 경우, 제1 전극의 주변부에서 쇼트가 발생하는 것을 예방하기 위해 뱅크를 형성하여 쇼트를 예방하기도 한다.If the first electrode 430 is not selectively formed unlike the embodiments of the present invention, for example, in the process of etching to pattern the first electrode 430, a reverse taper is formed on the periphery of the first electrode. A shape can be formed. When the inverse taper shape is extremely formed, a portion called a tail can be observed at the periphery of the first electrode 430, and when the first electrode 430 has the tail, a current is lost. Shorting may occur. Therefore, when the first electrode is patterned through etching, a bank may be formed to prevent a short circuit to prevent a short circuit from occurring in the peripheral portion of the first electrode.

그러나, 본 발명은 제1 전극(430)을 구성하는 패턴층을 형성하는 과정에서, 제1 전극(430)을 선택적으로 형성할 수 있으므로 별도의 식각 공정이 불필요하다. 식각 공정을 진행하지 않으므로, 제1 전극(430)의 주변부에 테일이 형성되지 않는다. 따라서, 본 발명의 실시예들에 따른 표시패널은 뱅크를 형성하지 않을 수 있어 개구율의 확보가 가능하다.However, in the process of forming the pattern layer constituting the first electrode 430, the present invention can selectively form the first electrode 430, so a separate etching process is unnecessary. Since the etching process is not performed, a tail is not formed in the periphery of the first electrode 430. Accordingly, the display panel according to the exemplary embodiments of the present invention may not form a bank, thereby ensuring the aperture ratio.

본 발명의 실시예들에 따른 표시패널은, 제1 전극(430)이 유리 상태인 제1 영역(421)에 형성되고, 고무 상태인 제2 영역(422)에는 형성되지 않으므로, 가시광선 영역에서 흡광도가 상이한 제1 영역(421)과 제2 영역(422)은 서로 색이 상이하다.In the display panel according to the embodiments of the present invention, since the first electrode 430 is formed in the first region 421 in the glass state and not in the second region 422 in the rubber state, the display panel in the visible light region The first region 421 and the second region 422 having different absorbances have different colors from each other.

제1 전극(430)은 광색층(420)의 제1 영역(421) 상에 배치될 수 있다.The first electrode 430 may be disposed on the first region 421 of the light color layer 420.

제1 전극(430)은, 표시패널에 포함되는 유기발광다이오드를 구성하는 전극으로, 유기층(440)으로 전공을 주입하는 애노드(Anode) 전극일 수 있다.The first electrode 430 is an electrode constituting the organic light emitting diode included in the display panel, and may be an anode electrode that injects electrons into the organic layer 440.

상술한 것처럼, 광색층(420)은 제1 영역(421)이 분자 운동성이 낮은 유리 상태이므로, 제1 영역(430) 형성시 제1 영역(430)을 구성하는 물질이 광색층(420)의 제1 영역(421) 상에만 증착된다. 따라서, 제1 전극(430)은 광색층(420)의 제1 영역(421) 상에 배치될 수 있다.As described above, since the first region 421 has a low molecular mobility in the photochromic layer 420, the material constituting the first region 430 is formed of the photochromic layer 420 when the first region 430 is formed. It is deposited only on the first region 421. Accordingly, the first electrode 430 may be disposed on the first region 421 of the light color layer 420.

제1 전극(430)은 광색층(420)의 제2 영역(422)에 의해 구분될 수 있다.The first electrode 430 may be divided by the second region 422 of the light color layer 420.

제1 전극(430)은 표시패널의 서브픽셀(SP)마다 개별적으로 배치될 수 있다. 복수의 제1 전극(430)은 광색층의 제1 영역(421) 상에 위치하면서, 광색층(420)의 제2 영역(422) 상에는 위치하지 않아 광색층(420)의 제2 영역(422)에 의해 구분될 수 있다. The first electrode 430 may be individually disposed for each subpixel SP of the display panel. While the plurality of first electrodes 430 are positioned on the first region 421 of the photochromic layer, they are not located on the second region 422 of the photochromic layer 420, and thus the second region 422 of the photochromic layer 420 ).

유기층(440)은 제1 전극(430) 상에 위치할 수 있다.The organic layer 440 may be positioned on the first electrode 430.

유기층(440)은 유기화합물에 전류가 흘러 빛을 내는 전계 발광 형상을 이용하여 빛을 내는 발광층을 포함하는 층을 지칭할 수 있다.The organic layer 440 may refer to a layer including a light emitting layer that emits light by using an electroluminescent shape in which current flows through an organic compound to emit light.

도 8을 참조하면, 유기층(440)은 제1 전극(430) 상에도 위치하고, 제1 전극(430) 상에서 연장되어 형성되어 제1 전극(430)이 형성되지 않은 광색층(420) 상에도 위치할 수 있다. 즉, 유기층(440)은 광색층(420)의 제2 영역(422) 상에 위치할 수 있다.Referring to FIG. 8, the organic layer 440 is also positioned on the first electrode 430 and is formed on the first electrode 430 and extends on the first electrode 430 to be located on the photochromic layer 420 where the first electrode 430 is not formed. can do. That is, the organic layer 440 may be positioned on the second region 422 of the light color layer 420.

제1 전극(430)을 광색층(420) 상에 선택적으로 형성한 후에, 유기층(440)을 증착할 경우, 도 8에 도시한 것처럼 유기층(440)이 제1 전극(440) 상에 위치하고, 광색층(420)의 제2 영역(422) 상에 위치할 수 있다.After selectively forming the first electrode 430 on the light color layer 420, when the organic layer 440 is deposited, the organic layer 440 is positioned on the first electrode 440 as illustrated in FIG. 8, It may be located on the second region 422 of the light color layer 420.

유기층(440)의 형성 방법은 특별히 제한되는 것은 아니며, 예를 들면, 열증착(Thermal Evaporation)에 의해 형성될 수 있다.The method of forming the organic layer 440 is not particularly limited, and may be formed, for example, by thermal evaporation.

제2 전극(450)은 유기층(440) 상에 배치될 수 있다.The second electrode 450 may be disposed on the organic layer 440.

제2 전극(450)은, 표시패널에 포함되는 유기발광다이오드를 구성하는 전극으로, 유기층에 전자를 주입하는 캐소드(cathode) 전극일 수 있다.The second electrode 450 is an electrode constituting the organic light emitting diode included in the display panel, and may be a cathode electrode that injects electrons into the organic layer.

본 발명의 실시예들에 따른 표시패널은, 제2 기판(470) 및 블랙 매트릭스(480)를 추가로 포함할 수 있다.The display panel according to embodiments of the present invention may further include a second substrate 470 and a black matrix 480.

제2 기판(470)은, 표면에 봉지층이 형성된 봉지 기판 또는 컬러 필터 패턴이 형성된 컬러 필터 기판일 수 있다.The second substrate 470 may be an encapsulation substrate having an encapsulation layer formed on its surface or a color filter substrate having a color filter pattern.

제2 기판(470) 상에는, 컬러 필터가 형성될 수 있다. 컬러 필터로는, 예를 들면, 적색 필터(RF), 녹색 필터(GF) 및 청색 필터(BF)가 형성될 수 있다.A color filter may be formed on the second substrate 470. As the color filter, for example, a red filter (RF), a green filter (GF), and a blue filter (BF) may be formed.

제2 기판(470)은, 제1 기판(410)과 대향하도록 배치될 수 있다.The second substrate 470 may be disposed to face the first substrate 410.

제2 기판(470)이 제1 기판(410)과 대향하도록 배치된다는 것은, 제1 기판(410)의 일면과 제2 기판(470)의 일면이 서로 마주보도록 배치되는 것을 의미할 수 있다.When the second substrate 470 is disposed to face the first substrate 410, it may mean that one surface of the first substrate 410 and one surface of the second substrate 470 are disposed to face each other.

블랙 매트릭스(480)는 제1 기판(410)과 대향하는 제2 기판(470)의 일면 상에 위치할 수 있다. 도 8을 참조하면, 블랙 매트릭스(480)가 제2 기판(470)의 일면 상에 위치하고, 상기 제2 기판(470)의 일면은 제1 기판(410)을 마주하고 있는 일면일 수 있다.The black matrix 480 may be positioned on one surface of the second substrate 470 facing the first substrate 410. Referring to FIG. 8, the black matrix 480 is positioned on one surface of the second substrate 470, and one surface of the second substrate 470 may be one surface facing the first substrate 410.

블랙 매트릭스(480)는, 광색층(420)의 제2 영역(422)과 중첩될 수 있다.The black matrix 480 may overlap the second region 422 of the light color layer 420.

본 발명은 상술하였듯이 뱅크를 포함하지 않으므로, 블랙 매트릭스(480)가 서브픽셀의 발광 영역((491)과 비발광 영역((492)을 구분한다. 블랙 매트릭스(480)를 형성할 때, 개구율을 최대한으로 확보하기 위하여, 블랙 매트릭스(480)는 유기층(440)에서 발광이 일어나는 영역과 중첩되지 않도록 형성할 수 있다. 따라서, 블랙 매트릭스(480)는, 제1 전극(430)이 형성되지 않아 유기층(440)의 발광이 일어나지 않는 광색층(420)의 제2 영역(422)과 중첩되도록 위치할 수 있다.Since the present invention does not include a bank as described above, the black matrix 480 distinguishes the light emitting area 491 and the non-light emitting area 492 of the subpixel. When forming the black matrix 480, the aperture ratio is In order to ensure the maximum, the black matrix 480 may be formed so as not to overlap with the region where light emission occurs in the organic layer 440. Therefore, the black matrix 480 does not have the first electrode 430, so the organic layer is not formed. The light emitting layer 440 may be positioned to overlap the second region 422 of the light color layer 420.

본 발명의 실시예들에 따른 표시패널은, 버퍼층(412), 층간절연막(413), 보호층(414), 평탄화층(415)을 추가로 포함할 수 있다.The display panel according to embodiments of the present invention may further include a buffer layer 412, an interlayer insulating film 413, a protective layer 414, and a planarization layer 415.

버퍼층(412)은 제1 기판(410) 상에 위치할 수 있으며, 제1 기판(410) 상에 전자회로 소자가 형성되기 전에 형성되어 제1 기판(410)을 보호할 수 있다.The buffer layer 412 may be positioned on the first substrate 410 and may be formed before an electronic circuit element is formed on the first substrate 410 to protect the first substrate 410.

층간 절연막(413)은, 제1 기판(410) 상에 형성된 트랜지스터(411)의 게이트 전극(411b), 반도체층(411d) 등을 덮도록 형성될 수 있다.The interlayer insulating layer 413 may be formed to cover the gate electrode 411b, the semiconductor layer 411d, and the like of the transistor 411 formed on the first substrate 410.

보호층(414)은 트랜지스터(411)의 소스 전극(411a) 및 드레인 전극(411e) 상에 형성될 수 있다.The protective layer 414 may be formed on the source electrode 411a and drain electrode 411e of the transistor 411.

평탄화층(415)은 제1 전극(430) 등을 포함하는 유기발광 다이오드를 형성하기 전에 기판 표면을 평탄화하는 층으로, 보호층(414) 상에 위치할 수 있다.The planarization layer 415 is a layer that flattens the surface of the substrate before forming the organic light emitting diode including the first electrode 430 and the like, and may be positioned on the protective layer 414.

도 9는 본 발명의 실시예들에 따른 표시패널에 포함되는 서브픽셀을 나타내는 평면도이다.9 is a plan view illustrating a subpixel included in a display panel according to embodiments of the present invention.

도 9에는 예시적으로 본 발명의 표시패널에 포함되는 R, G, B 서브픽셀을 도시하였다. 각각의 서브픽셀은 발광영역(491R, 491G, 491B)과 비발광영역(492)을 포함한다.9 illustrates R, G, and B subpixels included in the display panel of the present invention. Each sub-pixel includes light-emitting areas 491R, 491G, and 491B and non-light-emitting areas 492.

비발광영역(492)은, 도 8에 도시한 것처럼 블랙 매트릭스(480)가 위치할 것이며, 이는 광색층(420)의 제2 영역(422)과도 중첩될 수 있다.In the non-emission region 492, the black matrix 480 will be positioned as illustrated in FIG. 8, which may also overlap the second region 422 of the light color layer 420.

따라서, 도 8와 도 9를 참조하면, 블랙 매트릭스(480)가 서브픽셀들을 구분하는 것을 알 수 있다.Therefore, referring to FIGS. 8 and 9, it can be seen that the black matrix 480 distinguishes subpixels.

본 발명에서 블랙 매트릭스(480)가 서브픽셀들을 구분한다는 것은, 서브픽셀의 발광영역 주위 영역이 블랙 매트릭스(480)와 중첩되거나, 블랙 매트릭스(480)가 서브픽셀의 발광 영역(491R, 491G, 491B)을 둘러싼다는 것을 의미할 수 있다.In the present invention, the black matrix 480 distinguishes the subpixels. The area around the light emitting area of the subpixel overlaps with the black matrix 480, or the black matrix 480 has light emitting areas 491R, 491G, and 491B of the subpixel. ).

도 8을 참조하면, 블랙 매트릭스(480)가 서브픽셀의 발광 영역(491R, 491G, 491B)과는 중첩되지 않고, 비발광 영역(492)과 중첩될 수 있다. 또한, 상기 비발광 영역(492)은, 광색층(420)의 제2 영역(422)과 중첩될 수 있다.Referring to FIG. 8, the black matrix 480 may not overlap with the emission regions 491R, 491G, and 491B of the subpixel, but may overlap the non-emission region 492. In addition, the non-emission region 492 may overlap the second region 422 of the photochromic layer 420.

본 발명의 실시예들에 따른 표시패널은, 제1 기판(410) 상에 위치하는 트랜지스터(411)을 추가로 포함할 수 있다.The display panel according to embodiments of the present invention may further include a transistor 411 positioned on the first substrate 410.

도 8을 참조하면, 트랜지스터(411)는, 박막형 트랜지스터(Thin film transistor, TFT)로서, 반도체층(411d), 게이트 절연막(411c), 게이트 전극(411b), 소스 전극(411a), 드레인 전극(411e)을 포함할 수 있다.Referring to FIG. 8, the transistor 411 is a thin film transistor (TFT), a semiconductor layer 411d, a gate insulating film 411c, a gate electrode 411b, a source electrode 411a, and a drain electrode ( 411e).

도 8은 예시적으로 탑 게이트 코플라나형 트랜지스터의 구조를 도시하였으나, 트랜지스터의 구조가 이에 제한되는 것은 아니다.8 exemplarily shows a structure of a top gate coplanar transistor, but the structure of the transistor is not limited thereto.

제1 전극(430)은 트랜지스터(411)와 컨택홀을 통해 연결될 수 있다.The first electrode 430 may be connected to the transistor 411 through a contact hole.

도 8에는, 제1 전극(430)이 컨택홀을 통해 트랜지스터(411)의 드레인 전극(411e)과 연결되는 것을 도시하였다.8, the first electrode 430 is connected to the drain electrode 411e of the transistor 411 through a contact hole.

컨택홀(416)은 서브픽셀의 발광영역(491)에 포함될 수 있다.The contact hole 416 may be included in the emission region 491 of the subpixel.

컨택홀(416)은, 상술하였듯이 제1 전극(430)이 트랜지스터(411)의 드레인 전극(411e)과 연결되는 컨택홀을 지칭한다.As described above, the contact hole 416 refers to a contact hole in which the first electrode 430 is connected to the drain electrode 411e of the transistor 411.

도 10은 본 발명의 실시예들에 따른 표시패널에 포함되는 서브픽셀의 단면도이다.10 is a cross-sectional view of a subpixel included in a display panel according to embodiments of the present invention.

도 9와 도 10을 참조하면, 컨택홀(416)이 서브픽셀의 발광영역(491)에 포함되는 것을 알 수 있다. 본 발명의 서브픽셀은 뱅크를 포함하지 않으므로, 발광영역(491)이 뱅크에 의해 제한되지 않고, 제1 전극(430), 유기층(440) 및 제2 전극(450)이 유기발광다이오드를 구성하는 부분에 의해 정의되므로, 컨택홀(416)이 발광영역(491)에 포함될 수 있다. 즉, 본 발명은 뱅크를 포함하지 않아 제1 전극(430)이 형성된 부분을 발광영역(491)으로 활용할 수 있어 개구율을 확보할 수 있는 장점이 있다.9 and 10, it can be seen that the contact hole 416 is included in the emission region 491 of the subpixel. Since the sub-pixel of the present invention does not include a bank, the emission region 491 is not limited by the bank, and the first electrode 430, the organic layer 440, and the second electrode 450 constitute an organic light emitting diode. Since it is defined by a part, the contact hole 416 may be included in the light emitting area 491. That is, according to the present invention, since the portion in which the first electrode 430 is formed is not included in the bank, it can be utilized as the light-emitting region 491, and thus has an advantage of securing an aperture ratio.

도 11은 본 발명의 표시패널에 포함되는 서브픽셀의 개구율을 설명하기 위한 도면이다.11 is a view for explaining the aperture ratio of a sub-pixel included in the display panel of the present invention.

도 11을 참조하면, 본 발명의 서브픽셀은 발광영역(491)과 비발광영역(492)으로 구분될 수 있다.Referring to FIG. 11, the subpixel of the present invention may be divided into a light emitting area 491 and a non-light emitting area 492.

도 11에 도시한 서브픽셀은, 예를 들어, a가 1.25μm이고, b가 5.95μm이며, c가 14.4μm일 수 있다. 따라서, 발광영역의 면적과 비발광영역의 면적의 합(EA, NEA)에 대한 발광영역의 면적(491)의 비율인 개구율은 약 60%일 수 있다.In the sub-pixel shown in FIG. 11, for example, a may be 1.25 μm, b may be 5.95 μm, and c may be 14.4 μm. Therefore, the aperture ratio, which is the ratio of the area 491 of the light emitting area to the sum of the area of the light emitting area and the area of the non-light emitting area (EA, NEA), may be about 60%.

도 11에 도시한 서브픽셀은, 대각선 길이가 약 18.9μm이므로, 약 1344ppi의 표시패널을 구현할 수 있다. 따라서, 본 발명의 실시예들에 따른 표시패널은, 1000ppi 이상의 화소밀도에서 개구율이 40% 이상, 50% 이상 또는 55% 이상일 수 있다.Since the subpixel shown in FIG. 11 has a diagonal length of about 18.9 μm, a display panel of about 1344 ppi can be implemented. Accordingly, the display panel according to embodiments of the present invention may have an aperture ratio of 40% or more, 50% or more, or 55% or more at a pixel density of 1000 ppi or more.

도 12 및 도 13은 뱅크를 포함하는 비교예의 서브픽셀의 평면도 및 단면도이다.12 and 13 are plan and cross-sectional views of subpixels of a comparative example including a bank.

도 12는, 제1 전극(430)이 선택적으로 형성되지 않아 식각 공정에 의해 제1 전극(430)을 형성하였을 때, 제1 전극의 주변부에서 쇼트가 발생하는 것을 예방하기 위하여 뱅크(417)를 형성한 비교예이다.12 shows the bank 417 to prevent shorts from occurring in the peripheral portion of the first electrode when the first electrode 430 is formed by an etching process because the first electrode 430 is not selectively formed. It is a comparative example formed.

도 12와 같이 뱅크(417)를 형성할 경우, 발광영역(491)과 비발광영역(492)은 도 13에 도시한 것처럼 형성되며, 컨택홀(416)이 발광영역(491)에 포함되지 않는다.When the bank 417 is formed as shown in FIG. 12, the light-emitting area 491 and the non-light-emitting area 492 are formed as shown in FIG. 13, and the contact hole 416 is not included in the light-emitting area 491. .

본 발명의 실시예들에 따른 표시패널은, 상술한 것처럼 광색층(420)상에 제1 전극(430)을 선택적으로 형성하는 단계를 포함하는 제조 방법에 의해 제조될 수 있다.The display panel according to embodiments of the present invention may be manufactured by a manufacturing method including selectively forming the first electrode 430 on the photochromic layer 420 as described above.

도 14는 본 발명의 실시예들에 따른 표시패널을 제조하는 단계의 일부분을 설명하기 위한 도면이다.14 is a view for explaining a part of steps of manufacturing a display panel according to embodiments of the present invention.

도 14를 참조하면, 광색층(420)을 오버코트층(415) 상에 형성하고, 마스크를 이용해 광색층(420)에 자외선(UV)을 선택적으로 조사한다. 자외선(UV)을 선택적으로 조사할 경우, 광색층(420)에 제1 영역(421)과 제2 영역(422)이 형성되며, 자외선이 조사된 곳은 유리 상태인 제1 영역(421)을 구성하고, 자외선이 조사되지 않은 곳은 고무 상태인 제2 영역(422)을 구성할 수 있다.Referring to FIG. 14, a light color layer 420 is formed on the overcoat layer 415, and ultraviolet light (UV) is selectively irradiated to the light color layer 420 using a mask. When UV (UV) is selectively irradiated, a first region 421 and a second region 422 are formed in the photochromic layer 420, and the first region 421 in a glass state is irradiated with ultraviolet rays. It is possible to configure the second region 422 in a rubber state where ultraviolet light is not irradiated.

이후 열증착에 의해 제1 전극(430)을 증착하면, 상술한 제1 영역(421)과 제2 영역(422)의 물성 차이로 인하여 제1 전극(430)이 제1 영역(421) 상에만 선택적으로 형성된다.Subsequently, when the first electrode 430 is deposited by thermal evaporation, the first electrode 430 is only on the first region 421 due to the difference in physical properties between the first region 421 and the second region 422 described above. It is formed selectively.

제1 영역(421) 상에 형성된 제1 전극(430)은, 제1 전극(430)의 주변부에서 슬로프를 포함할 수 있다.The first electrode 430 formed on the first region 421 may include a slope at a peripheral portion of the first electrode 430.

도 10을 참조하면, 제1 전극(430)이 주변부에서 슬로프(431)를 포함하는 것을 확대하여 도시하였다. 상기 슬로프(431)는, 제1 영역(421) 표면에 제1 전극(430)을 구성하는 물질이 증착된 후, 기형성된 제1 전극(430) 상에만 제1 전극이 계속하여 성장하기 때문에 나타나는 형상이다. 식각에 의하여 제1 전극(430)을 형성할 경우에는, 도 10의 확대도에 도시한 것과 같은 슬로프(431)과 관찰되지 않으며, 역으로 아래 부분이 더 많이 식각된 테이퍼 형상이 나타나며, 이러한 현상이 극단적으로 나타날 경우 상술한 테일 형상이 관찰될 수 있다.Referring to FIG. 10, an enlarged view of the first electrode 430 including the slope 431 at the peripheral portion is illustrated. The slope 431 appears after the material constituting the first electrode 430 is deposited on the surface of the first region 421, and the first electrode continues to grow only on the preformed first electrode 430. It is shaped. When the first electrode 430 is formed by etching, the slope 431 as shown in the enlarged view of FIG. 10 is not observed, and conversely, a tapered shape in which the lower portion is more etched appears. When this appears extremely, the above-described tail shape can be observed.

다른 측면에서, 본 발명의 실시예들에 따른 표시장치는, 표시패널 및 구동회로를 포함할 수 있다.In another aspect, a display device according to embodiments of the present invention may include a display panel and a driving circuit.

상기 표시패널 및 상기 구동회로는 앞서 설명한 것과 동일하므로, 이에 관한 설명은 생략하도록 한다.Since the display panel and the driving circuit are the same as described above, a description thereof will be omitted.

이상에서의 설명 및 첨부된 도면은 본 발명의 기술 사상을 예시적으로 나타낸 것에 불과한 것으로서, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자라면 본 발명의 본질적인 특성에서 벗어나지 않는 범위에서 구성의 결합, 분리, 치환 및 변경 등의 다양한 수정 및 변형이 가능할 것이다. 따라서, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 한정하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 한정되는 것은 아니다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다. The above description and the accompanying drawings are merely illustrative of the technical spirit of the present invention, and those of ordinary skill in the art to which the present invention pertains combine combinations of configurations without departing from the essential characteristics of the present invention. , Various modifications and variations such as separation, substitution and change will be possible. Therefore, the embodiments disclosed in the present invention are not intended to limit the technical spirit of the present invention, but to explain, and the scope of the technical spirit of the present invention is not limited by these embodiments. The scope of protection of the present invention should be interpreted by the claims below, and all technical spirits within the scope equivalent thereto should be interpreted as being included in the scope of the present invention.

100, 200: 패널 110, 210: 액티브 영역
120, 220: 넌-액티브 영역 410: 제1 기판
420: 광색층 421: 제1 영역
422: 제2 영역 430: 제1 전극
440: 유기층 450: 제2 전극
460: 서브픽셀 491: 발광영역
492: 비발광영역
100, 200: panel 110, 210: active area
120, 220: non-active area 410: first substrate
420: light color layer 421: first region
422: second region 430: first electrode
440: organic layer 450: second electrode
460: subpixel 491: light emitting area
492: non-emission area

Claims (11)

제1 기판;
상기 제1 기판 상에 배치되고, 광에 의해 가역적인 이성질체화를 진행하는 광색 물질을 포함하고, 제1 영역과 제2 영역으로 구성되는 광색층;
상기 광색층의 제1 영역 상에 배치되고, 상기 광색층의 제2 영역에 의해 구분되는 복수의 제1 전극;
상기 제1 전극 상에 위치하고, 상기 광색층의 제2 영역 상에 위치하는 유기층; 및
상기 유기층 상에 배치된 제2 전극을 포함하고,
발광영역과 비발광영역으로 구분되는 복수의 서브픽셀을 포함하는 액티브 영역을 포함하는 표시패널.
A first substrate;
A photochromic layer disposed on the first substrate, including a photochromic material that undergoes reversible isomerization by light, and composed of a first region and a second region;
A plurality of first electrodes disposed on the first region of the photochromic layer and separated by the second region of the photochromic layer;
An organic layer positioned on the first electrode and positioned on a second region of the photochromic layer; And
It includes a second electrode disposed on the organic layer,
A display panel including an active area including a plurality of subpixels divided into a light emitting area and a non-light emitting area.
제1항에 있어서,
상기 광색층의 제2 영역 상에 상기 서브픽셀들을 구분하는 뱅크를 포함하지 않는 표시패널.
According to claim 1,
A display panel not including a bank separating the sub-pixels on a second region of the light color layer.
제1항에 있어서,
상기 광색층은 제1 영역과 제2 영역의 색이 서로 상이한 표시패널.
According to claim 1,
The light color layer has a display panel having different colors in the first region and the second region.
제1항에 있어서,
상기 광색층의 상기 제2 영역에 포함되는 광색 물질은 디아릴에텐 화합물을 포함하는 표시패널.
According to claim 1,
The photochromic material included in the second region of the photochromic layer includes a diarylethene compound.
제1항에 있어서,
상기 광색층의 제1 영역에 포함된 광색 물질은 유리 상태이고,
상기 광색층의 제2 영역에 포함된 광색 물질은 고무 상태인 표시패널.
According to claim 1,
The photochromic material included in the first region of the photochromic layer is in a glass state,
The photochromic material included in the second region of the photochromic layer is a rubber display panel.
제1항에 있어서,
상기 제1 전극은 알루미늄을 포함하는 금속층으로 구성되는 표시패널.
According to claim 1,
The first electrode is a display panel made of a metal layer containing aluminum.
제1항에 있어서,
상기 제1 전극은, 상기 제1 전극의 주변주에서 슬로프를 가지는 표시패널.
According to claim 1,
The first electrode is a display panel having a slope around the periphery of the first electrode.
제1항에 있어서,
제1 기판 상에 위치하는 트랜지스터를 추가로 포함하고,
상기 제1 전극은 상기 트랜지스터와 컨택홀을 통해 연결되며,
상기 컨택홀은 상기 서브픽셀의 발광영역에 포함되는 표시패널.
According to claim 1,
Further comprising a transistor located on the first substrate,
The first electrode is connected to the transistor through a contact hole,
The contact hole is a display panel included in the emission region of the sub-pixel.
제1항에 있어서,
상기 제1 기판과 대향하도록 배치된 제2 기판;
상기 제1 기판과 대향하는 상기 제2 기판의 일면 상에 위치하고, 상기 광색층의 제2 영역과 중첩되는 블랙 매트릭스를 추가로 포함하고,
상기 서브픽셀들은 상기 블랙 매트릭스에 의해 구분되는 표시패널.
According to claim 1,
A second substrate disposed to face the first substrate;
A black matrix positioned on one surface of the second substrate facing the first substrate and overlapping the second region of the photochromic layer,
The subpixels are display panels separated by the black matrix.
제1항에 있어서,
상기 발광영역의 면적은 상기 발광영역의 면적과 상기 비발광영역의 면적의 합에 대하여 40% 이상이고,
상기 액티브 영역은 화소밀도가 1000ppi 이상인 표시패널.
According to claim 1,
The area of the emission area is 40% or more with respect to the sum of the area of the emission area and the area of the non-emission area,
The active region is a display panel having a pixel density of 1000 ppi or higher.
표시패널 및 상기 표시패널을 구동하는 구동회로를 포함하고,
상기 표시패널은,
제1 기판;
상기 제1 기판 상에 배치되고, 광에 의해 가역적인 이성질체화를 진행하는 광색 물질을 포함하고, 제1 영역과 제2 영역으로 구성되는 광색층;
상기 광색층의 제1 영역 상에 배치되고, 상기 광색층의 제2 영역에 의해 구분되는 복수의 제1 전극;
상기 제1 전극 상에 배치되고, 상기 광색층의 제2 영역 상에 배치되는 유기층; 및
상기 유기층 상에 배치된 제2 전극을 포함하고,
발광영역과 비발광영역으로 구분되는 복수의 서브픽셀을 포함하는 액티브 영역을 포함하는 표시장치.
It includes a display panel and a driving circuit for driving the display panel,
The display panel,
A first substrate;
A photochromic layer disposed on the first substrate, including a photochromic material that undergoes reversible isomerization by light, and composed of a first region and a second region;
A plurality of first electrodes disposed on the first region of the photochromic layer and separated by the second region of the photochromic layer;
An organic layer disposed on the first electrode and disposed on a second region of the photochromic layer; And
It includes a second electrode disposed on the organic layer,
A display device including an active area including a plurality of subpixels divided into a light emitting area and a non-light emitting area.
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