KR20170045067A - Compact light emitting diode chip, light emitting device and electronic device including the same - Google Patents

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light
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김예슬
김경완
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Abstract

Disclosed are a light emitting diode chip, a light emitting device and an electronic device including the same. The light emitting diode chip includes: a substrate including a plurality of protrusions and disposed on the upper surface thereof; a light emitting structure disposed on the substrate and including at least one hole penetrating a second conductive semiconductor layer and an active layer to expose a part of a first conductive semiconductor layer; a contact electrode including a light transmitting conductive oxide; a light reflective insulating layer including a distributed Bragg reflector; a first pad electrode electrically connected to the first conductive semiconductor layer; and a second pad electrode electrically connected to the contact electrode, wherein a part of the top of the substrate is exposed to the periphery of a light emitting structure, and the light reflective insulating layer is in contact with the top of the substrate exposed to the periphery of the light emitting structure. The upper edge of the substrate is spaced apart from the light reflective insulating layer. The present invention increases light emitting efficiency of the light emitting diode chip while minimizing the area and thickness of the light emitting diode chip.

Description

소형 발광 다이오드 칩, 이를 포함하는 발광 장치 및 전자 장치{COMPACT LIGHT EMITTING DIODE CHIP, LIGHT EMITTING DEVICE AND ELECTRONIC DEVICE INCLUDING THE SAME}BACKGROUND OF THE INVENTION 1. Field of the Invention [0001] The present invention relates to a compact light emitting diode chip, a light emitting device including the light emitting diode chip,

본 발명은 소형 발광 다이오드 칩, 이를 포함하는 발광 장치 및 전자 장치에 관한 것으로, 특히, 면적이 작고 두께가 얇은 소형 발광 다이오드 칩, 이를 포함하는 발광 장치 및 전자 장치에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a small-sized light emitting diode chip, a light emitting device including the light emitting device and an electronic device, and in particular, to a compact light emitting diode chip having a small area and a small thickness,

최근 휴대용스마트폰, 태블릿 PC, 노트북 등과 같은 휴대용 기기들의 사용이 증가하면서, 휴대성이 우수한 휴대용 기기에 대한 요구가 증가하고 있다. 이에 따라, 소형화되면서 슬림화된 휴대용 전자 기기들의 개발이 필요하다. 이러한 휴대용 전자 기기에는 다양한 종류의 디스플레이 및 발광 장치가 요구되는데, 상기 휴대용 전자 기기의 소형화 및 슬림화를 위해서는 부피가 작은 발광 장치가 필수적으로 필요하게 된다.Recently, with the increasing use of portable devices such as portable smart phones, tablet PCs, notebooks and the like, there is a growing demand for highly portable portable devices. Accordingly, it is necessary to develop portable electronic devices that are miniaturized and slimmer. Such portable electronic devices require various kinds of displays and light emitting devices. In order to miniaturize and slim down the portable electronic devices, a light emitting device having a small volume is indispensably required.

발광 다이오드는 상술한 휴대용 기기의 발광 장치로서 폭넓게 이용되는데, 슬림화 및/또는 소형화된 휴대용 전자 기기에 적합한 구조를 가지도록 부피가 작으며, 발광 효율이 높고, 또한 제조 수율이 높은 발광 다이오드 칩 및 발광 장치의 개발이 요구된다.The light emitting diode is widely used as a light emitting device of the above-described portable device. The light emitting diode has a small volume to have a structure suitable for a slim and / or miniaturized portable electronic device, a light emitting diode chip having high luminous efficiency, Development of a device is required.

본 발명이 해결하고자 하는 과제는, 면적 및 두께를 최소화하면서, 발광 효율이 높고 제조 수율이 높은 발광 다이오드 칩을 제공하는 것이다.A problem to be solved by the present invention is to provide a light emitting diode chip having high luminous efficiency and high manufacturing yield while minimizing the area and thickness.

본 발명이 해결하고자 하는 또 다른 과제는 소형화 및 슬림화된 발광 다이오드 칩을 최소한의 두께의 본딩부를 이용하여 기판 상에 실장함으로써, 슬림화된 발광 장치를 제공하는 것이다.Another problem to be solved by the present invention is to provide a light-emitting device that is slimmed by mounting a miniaturized and slim light-emitting diode chip on a substrate using a bonding portion of a minimum thickness.

본 발명이 해결하고자 하는 또 다른 과제는 소형화 및 슬림화된 발광 다이오드 칩 및/또는 발광 장치를 포함하는 전자 장치를 제공하는 것이다.Another object of the present invention is to provide an electronic device including a miniaturized and slim light emitting diode chip and / or a light emitting device.

본 발명의 일 측면에 따른 발광 다이오드 칩은, 상면에 형성된 복수의 돌출부들을 포함하는 기판; 상기 기판 상에 위치하며, 제1 도전형 반도체층, 상기 제1 도전형 반도체층 상에 위치하는 제2 도전형 반도체층, 및 상기 제1 및 제2 도전형 반도체층의 사이에 위치하는 활성층을 포함하고, 상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부를 노출시키는 적어도 하나의 홀을 포함하는 발광 구조체; 상기 제2 도전형 반도체층 상에 적어도 부분적으로 위치하며, 상기 제2 도전형 반도체층에 오믹 컨택하는 광 투과성 도전성 산화물을 포함하는 컨택 전극; 상기 발광 구조체의 측면 및 상면을 덮으며, 상기 홀을 통해 노출된 제1 도전형 반도체층을 노출시키는 제1 개구부 및 상기 컨택 전극을 부분적으로 노출시키는 제2 개구부를 포함하며, 분포 브래그 반사기를 포함하는 광 반사성 절연층; 상기 광 반사성 절연층 상에 위치하며, 상기 제1 개구부를 통해 상기 제1 도전형 반도체층과 전기적으로 연결된 제1 패드 전극; 및 상기 광 반사성 절연층 상에 위치하며, 상기 제2 개구부를 통해 상기 컨택 전극과 전기적으로 연결된 제2 패드 전극을 포함하고, 상기 기판 상면의 일부는 상기 발광 구조체의 주변에 노출되고, 상기 광 반사성 절연층은 상기 발광 구조체의 주변에 노출된 기판의 상면과 접하되, 상기 기판의 상부 모서리는 상기 광 반사성 절연층과 이격된다.A light emitting diode chip according to an aspect of the present invention includes: a substrate including a plurality of protrusions formed on an upper surface; And a second conductivity type semiconductor layer disposed on the substrate and having a first conductivity type semiconductor layer, a second conductivity type semiconductor layer disposed on the first conductivity type semiconductor layer, and an active layer disposed between the first and second conductivity type semiconductor layers, A light emitting structure including at least one hole penetrating the second conductivity type semiconductor layer and the active layer and exposing a part of the first conductivity type semiconductor layer; A contact electrode at least partially located on the second conductivity type semiconductor layer, the contact electrode comprising a light-transmitting conductive oxide that is in ohmic contact with the second conductivity type semiconductor layer; A first opening exposing the first conductive type semiconductor layer exposed through the hole, and a second opening partially exposing the contact electrode, the second opening including a distributed Bragg reflector A light-reflective insulating layer; A first pad electrode located on the light reflective insulating layer and electrically connected to the first conductivity type semiconductor layer through the first opening; And a second pad electrode located on the light reflective insulating layer and electrically connected to the contact electrode through the second opening, wherein a part of the upper surface of the substrate is exposed to the periphery of the light emitting structure, The insulating layer is in contact with the upper surface of the substrate exposed at the periphery of the light emitting structure, and the upper edge of the substrate is spaced apart from the light reflecting insulating layer.

본 발명의 또 다른 측면에 따른 발광 장치는, 제2 기판; 상기 제2 기판 상에 위치하는 발광 다이오드 칩; 및 상기 발광 다이오드 칩과 상기 제2 기판의 사이에 위치하는 제1 본딩부 및 제2 본딩부를 포함하고, 상기 발광 다이오드 칩은, 하면에 형성된 복수의 돌출부들을 포함하는 제1 기판; 상기 제1 기판의 아래에 위치하며, 제2 도전형 반도체층, 상기 제2 도전형 반도체층 상에 위치하는 제1 도전형 반도체층, 및 상기 제1 및 제2 도전형 반도체층의 사이에 위치하는 활성층을 포함하고, 상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부를 노출시키는 적어도 하나의 홀을 포함하는 발광 구조체; 상기 제2 도전형 반도체층의 아래에 적어도 부분적으로 위치하며, 상기 제2 도전형 반도체층에 오믹 컨택하는 컨택 전극; 상기 발광 구조체의 측면 및 하면을 덮으며, 상기 홀을 통해 노출된 제1 도전형 반도체층을 노출시키는 제1 개구부 및 상기 컨택 전극을 부분적으로 노출시키는 제2 개구부를 포함하며, 분포 브래그 반사기를 포함하는 광 반사성 절연층; 상기 광 반사성 절연층의 아래에 위치하며, 상기 제1 개구부를 통해 상기 제1 도전형 반도체층과 전기적으로 연결된 제1 패드 전극; 및 상기 광 반사성 절연층 아래에 위치하며, 상기 제2 개구부를 통해 상기 컨택 전극과 전기적으로 연결된 제2 패드 전극을 포함하고, 상기 제1 기판 하면의 일부는 상기 발광 구조체의 주변에 노출되며, 상기 광 반사성 절연층은 상기 발광 구조체의 주변에 노출된 제1 기판의 하면과 접하되, 상기 제1 기판의 하부 모서리는 상기 광 반사성 절연층과 이격되고, 상기 제1 본딩부 및 상기 제2 본딩부는 각각 상기 제1 및 제2 패드 전극에 전기적으로 연결된다.A light emitting device according to another aspect of the present invention includes: a second substrate; A light emitting diode chip located on the second substrate; And a first bonding portion and a second bonding portion positioned between the light emitting diode chip and the second substrate, wherein the light emitting diode chip comprises: a first substrate including a plurality of protrusions formed on a bottom surface; A second conductive type semiconductor layer disposed on the first substrate and positioned below the first conductive type semiconductor layer, a first conductive type semiconductor layer located on the second conductive type semiconductor layer, and a second conductive type semiconductor layer disposed between the first and second conductive type semiconductor layers And at least one hole penetrating through the second conductive type semiconductor layer and the active layer and exposing a part of the first conductive type semiconductor layer; A contact electrode located at least partially below the second conductivity type semiconductor layer and ohmically contacting the second conductivity type semiconductor layer; A first opening exposing the first conductive type semiconductor layer exposed through the hole and a second opening partially exposing the contact electrode, the first and second openings partially covering the side and the bottom of the light emitting structure, A light-reflective insulating layer; A first pad electrode located below the light reflective insulating layer and electrically connected to the first conductive type semiconductor layer through the first opening; And a second pad electrode located below the light reflective insulating layer and electrically connected to the contact electrode through the second opening, wherein a portion of the first substrate bottom surface is exposed to the periphery of the light emitting structure, The light-reflecting insulating layer is in contact with the lower surface of the first substrate exposed to the periphery of the light-emitting structure, the lower edge of the first substrate is spaced apart from the light-reflecting insulating layer, and the first bonding portion and the second bonding portion And are electrically connected to the first and second pad electrodes, respectively.

본 발명의 또 다른 측면에 따른 입력 장치를 포함하는 전자 장치에 있어서, 상기 전자 장치는 다양한 실시예들에 따른 발광 다이오드 칩들 및 발광 장치들 중 적어도 하나를 포함한다.In an electronic device including an input device according to another aspect of the present invention, the electronic device includes at least one of light emitting diode chips and light emitting devices according to various embodiments.

본 발명에 따르면, 발광 구조체 주변에 기판의 상면이 노출되고, 발광 구조체의 상면 및 측면을 덮는 광 반사성 절연층을 포함하며, 광 투과성 컨택 전극을 포함하는 발광 다이오드 칩이 제공됨으로써, 소형화 및 슬림화된 고효율 발광 다이오드 칩이 제공될 수 있다. 또한, 상기 발광 다이오드 칩의 측면까지 덮도록 형성된 본딩부를 포함하는 발광 장치를 제공함으로써, 소형화 및 슬림화된 고효율 발광 장치가 제공될 수 있다. 나아가, 소형화 및 슬림화된 고효율 발광 다이오드 칩 및/또는 발광 장치를 포함하는 전자 장치가 제공될 수 있다.According to the present invention, there is provided a light emitting diode chip including a light-reflective contact layer including a light-reflective insulating layer which is exposed on an upper surface of a substrate around a light-emitting structure and covers an upper surface and a side surface of the light- A high-efficiency light emitting diode chip can be provided. Also, by providing a light emitting device including a bonding portion formed so as to cover a side surface of the light emitting diode chip, a highly efficient light emitting device having a reduced size and slimness can be provided. Furthermore, an electronic device including a highly efficient light emitting diode chip and / or a light emitting device that is miniaturized and slimmed can be provided.

도 1 내지 도 3은 본 발명의 일 실시예에 따른 발광 다이오드 칩을 설명하기 위한 평면도들 및 단면도이다.
도 4는 본 발명의 또 다른 실시예에 따른 발광 장치를 설명하기 위한 단면도이다.
도 5a 내지 도 10b는 본 발명의 또 다른 실시예에 따른 발광 다이오드 칩의 제조 방법을 설명하기 위한 평면도들 및 단면도들이다.
도 11a 내지 도 13은 본 발명의 또 다른 실시예에 따른 전자 장치를 설명하기 위한 사시도, 평면도, 단면도 및 회로도이다.
FIGS. 1 to 3 are plan views and cross-sectional views for explaining a light emitting diode chip according to an embodiment of the present invention.
4 is a cross-sectional view illustrating a light emitting device according to another embodiment of the present invention.
5A and 10B are a plan view and a cross-sectional view illustrating a method for fabricating a light emitting diode chip according to another embodiment of the present invention.
11A to 13 are a perspective view, a plan view, a sectional view, and a circuit diagram for explaining an electronic device according to another embodiment of the present invention.

본 발명의 실시예들에 따른 발광 다이오드 칩, 발광 장치, 및 전자 장치는 다양한 양태로 구현될 수 있다.The light emitting diode chip, light emitting device, and electronic device according to embodiments of the present invention can be implemented in various aspects.

본 발명의 다양한 측면들에 따른 발광 다이오드 칩은, 상면에 형성된 복수의 돌출부들을 포함하는 기판; 상기 기판 상에 위치하며, 제1 도전형 반도체층, 상기 제1 도전형 반도체층 상에 위치하는 제2 도전형 반도체층, 및 상기 제1 및 제2 도전형 반도체층의 사이에 위치하는 활성층을 포함하고, 상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부를 노출시키는 적어도 하나의 홀을 포함하는 발광 구조체; 상기 제2 도전형 반도체층 상에 적어도 부분적으로 위치하며, 상기 제2 도전형 반도체층에 오믹 컨택하는 광 투과성 도전성 산화물을 포함하는 컨택 전극; 상기 발광 구조체의 측면 및 상면을 덮으며, 상기 홀을 통해 노출된 제1 도전형 반도체층을 노출시키는 제1 개구부 및 상기 컨택 전극을 부분적으로 노출시키는 제2 개구부를 포함하며, 분포 브래그 반사기를 포함하는 광 반사성 절연층; 상기 광 반사성 절연층 상에 위치하며, 상기 제1 개구부를 통해 상기 제1 도전형 반도체층과 전기적으로 연결된 제1 패드 전극; 및 상기 광 반사성 절연층 상에 위치하며, 상기 제2 개구부를 통해 상기 컨택 전극과 전기적으로 연결된 제2 패드 전극을 포함하고, 상기 기판 상면의 일부는 상기 발광 구조체의 주변에 노출되고, 상기 광 반사성 절연층은 상기 발광 구조체의 주변에 노출된 기판의 상면과 접하되, 상기 기판의 상부 모서리는 상기 광 반사성 절연층과 이격된다.A light emitting diode chip according to various aspects of the present invention includes: a substrate including a plurality of protrusions formed on an upper surface; And a second conductivity type semiconductor layer disposed on the substrate and having a first conductivity type semiconductor layer, a second conductivity type semiconductor layer disposed on the first conductivity type semiconductor layer, and an active layer disposed between the first and second conductivity type semiconductor layers, A light emitting structure including at least one hole penetrating the second conductivity type semiconductor layer and the active layer and exposing a part of the first conductivity type semiconductor layer; A contact electrode at least partially located on the second conductivity type semiconductor layer, the contact electrode comprising a light-transmitting conductive oxide that is in ohmic contact with the second conductivity type semiconductor layer; A first opening exposing the first conductive type semiconductor layer exposed through the hole, and a second opening partially exposing the contact electrode, the second opening including a distributed Bragg reflector A light-reflective insulating layer; A first pad electrode located on the light reflective insulating layer and electrically connected to the first conductivity type semiconductor layer through the first opening; And a second pad electrode located on the light reflective insulating layer and electrically connected to the contact electrode through the second opening, wherein a part of the upper surface of the substrate is exposed to the periphery of the light emitting structure, The insulating layer is in contact with the upper surface of the substrate exposed at the periphery of the light emitting structure, and the upper edge of the substrate is spaced apart from the light reflecting insulating layer.

상기 발광 다이오드 칩의 두께는 40㎛ 이상 90㎛ 이하일 수 있다.The thickness of the light emitting diode chip may be 40 탆 or more and 90 탆 or less.

상기 발광 다이오드 칩의 수평 단면적은 30000㎛2 이상 65000㎛2 이하일 수 있다.Horizontal cross-sectional area of the LED chip can be up to more than 30000㎛ 2 65000㎛ 2.

상기 발광 다이오드 칩의 구동 전류의 전류 밀도는 7mA/mm2 이상 250mA/mm2 이하일 수 있다.The current density of the driving current of the LED chip can be equal to or less than 7mA / mm 2 or more 250mA / mm 2.

상기 제1 패드 전극 및 상기 제2 패드 전극의 면적의 합은, 상기 발광 다이오드 칩의 수평 면적의 80% 이상 95% 이하일 수 있다.The sum of the areas of the first pad electrode and the second pad electrode may be 80% or more and 95% or less of the horizontal area of the LED chip.

상기 제1 패드 전극 및 제2 패드 전극의 최단 이격거리는 3㎛ 내지 20㎛일 수 있다.The shortest distance between the first pad electrode and the second pad electrode may be 3 탆 to 20 탆.

상기 기판의 상면에 노출된 돌출부들 중 일부는 상기 광 반사성 절연층에 덮일 수 있다.Some of the protrusions exposed on the upper surface of the substrate may be covered with the light reflective insulating layer.

상기 기판의 상면에 노출된 돌출부들 중 나머지 일부는 노출될 수 있다.And the remaining part of the protrusions exposed on the upper surface of the substrate may be exposed.

상기 컨택 전극은 상기 제2 도전형 반도체층의 상면을 덮되, 상기 발광 구조체의 홀을 노출시키는 제3 개구부, 및 상기 제2 도전형 반도체층을 부분적으로 노출시키는 적어도 하나의 제4 개구부를 포함할 수 있다.The contact electrode includes a third opening covering the upper surface of the second conductive semiconductor layer and exposing a hole of the light emitting structure and at least one fourth opening partially exposing the second conductive semiconductor layer .

상기 제4 개구부의 폭은 상기 제2 개구부의 폭보다 작으며, 상기 컨택 전극의 상면의 일부는 상기 제2 패드 전극과 접할 수 있다.The width of the fourth opening may be smaller than the width of the second opening, and a portion of the upper surface of the contact electrode may contact the second pad electrode.

상기 기판은 패턴된 사파이어 기판을 포함할 수 있다.The substrate may comprise a patterned sapphire substrate.

상기 제1 패드 전극은 그 상면에 형성되며, 상기 제1 개구부의 위치에 대응하여 위치하는 오목부를 포함할 수 있고, 상기 제2 패드 전극은 그 상면에 형성되며, 상기 제2 개구부의 위치에 대응하여 위치하는 오목부를 포함할 수 있다.The first pad electrode may be formed on the upper surface thereof and may include a concave portion corresponding to the position of the first opening, the second pad electrode may be formed on the upper surface thereof, and may correspond to the position of the second opening And a concave portion that is located in the vicinity of the center.

본 발명의 다양한 측면들에 따른 발광 장치는, 제2 기판; 상기 제2 기판 상에 위치하는 발광 다이오드 칩; 및 상기 발광 다이오드 칩과 상기 제2 기판의 사이에 위치하는 제1 본딩부 및 제2 본딩부를 포함하고, 상기 발광 다이오드 칩은, 하면에 형성된 복수의 돌출부들을 포함하는 제1 기판; 상기 제1 기판의 아래에 위치하며, 제2 도전형 반도체층, 상기 제2 도전형 반도체층 상에 위치하는 제1 도전형 반도체층, 및 상기 제1 및 제2 도전형 반도체층의 사이에 위치하는 활성층을 포함하고, 상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부를 노출시키는 적어도 하나의 홀을 포함하는 발광 구조체; 상기 제2 도전형 반도체층의 아래에 적어도 부분적으로 위치하며, 상기 제2 도전형 반도체층에 오믹 컨택하는 컨택 전극; 상기 발광 구조체의 측면 및 하면을 덮으며, 상기 홀을 통해 노출된 제1 도전형 반도체층을 노출시키는 제1 개구부 및 상기 컨택 전극을 부분적으로 노출시키는 제2 개구부를 포함하며, 분포 브래그 반사기를 포함하는 광 반사성 절연층; 상기 광 반사성 절연층의 아래에 위치하며, 상기 제1 개구부를 통해 상기 제1 도전형 반도체층과 전기적으로 연결된 제1 패드 전극; 및 상기 광 반사성 절연층 아래에 위치하며, 상기 제2 개구부를 통해 상기 컨택 전극과 전기적으로 연결된 제2 패드 전극을 포함하고, 상기 제1 기판 하면의 일부는 상기 발광 구조체의 주변에 노출되며, 상기 광 반사성 절연층은 상기 발광 구조체의 주변에 노출된 제1 기판의 하면과 접하되, 상기 제1 기판의 하부 모서리는 상기 광 반사성 절연층과 이격되고, 상기 제1 본딩부 및 상기 제2 본딩부는 각각 상기 제1 및 제2 패드 전극에 전기적으로 연결된다.A light emitting device according to various aspects of the present invention includes: a second substrate; A light emitting diode chip located on the second substrate; And a first bonding portion and a second bonding portion positioned between the light emitting diode chip and the second substrate, wherein the light emitting diode chip comprises: a first substrate including a plurality of protrusions formed on a bottom surface; A second conductive type semiconductor layer disposed on the first substrate and positioned below the first conductive type semiconductor layer, a first conductive type semiconductor layer located on the second conductive type semiconductor layer, and a second conductive type semiconductor layer disposed between the first and second conductive type semiconductor layers And at least one hole penetrating through the second conductive type semiconductor layer and the active layer and exposing a part of the first conductive type semiconductor layer; A contact electrode located at least partially below the second conductivity type semiconductor layer and ohmically contacting the second conductivity type semiconductor layer; A first opening exposing the first conductive type semiconductor layer exposed through the hole and a second opening partially exposing the contact electrode, the first and second openings partially covering the side and the bottom of the light emitting structure, A light-reflective insulating layer; A first pad electrode located below the light reflective insulating layer and electrically connected to the first conductive type semiconductor layer through the first opening; And a second pad electrode located below the light reflective insulating layer and electrically connected to the contact electrode through the second opening, wherein a portion of the first substrate bottom surface is exposed to the periphery of the light emitting structure, The light-reflecting insulating layer is in contact with the lower surface of the first substrate exposed to the periphery of the light-emitting structure, the lower edge of the first substrate is spaced apart from the light-reflecting insulating layer, and the first bonding portion and the second bonding portion And are electrically connected to the first and second pad electrodes, respectively.

상기 제1 및 제2 본딩부 간의 최단 이격거리는 상기 제1 및 제2 패드 전극 간의 최단 이격거리보다 클 수 있다.The shortest distance between the first and second bonding units may be greater than the shortest distance between the first and second pad electrodes.

상기 제1 본딩부 및 제2 본딩부 중 적어도 하나는 상기 발광 구조체의 측면을 덮는 광 반사성 절연층을 적어도 부분적으로 덮을 수 있다.At least one of the first bonding portion and the second bonding portion may at least partially cover a light reflective insulating layer covering a side surface of the light emitting structure.

상기 제1 및 제2 본딩부 중 적어도 하나는 상기 발광 구조체의 주변에 노출된 제1 기판의 하면을 적어도 부분적으로 덮을 수 있다.At least one of the first and second bonding portions may at least partially cover the lower surface of the first substrate exposed in the periphery of the light emitting structure.

상기 제1 및 제2 본딩부 중 적어도 하나는 상기 제1 기판의 측면을 적어도 부분적으로 덮을 수 있다.At least one of the first and second bonding portions may at least partially cover the side surface of the first substrate.

상기 제1 및 제2 본딩부는 솔더를 포함할 수 있다.The first and second bonding portions may include solder.

본 발명의 다양한 측면들에 따른 입력 장치를 포함하는 전자 장치에 있어서, 상기 전자 장치는 실시예들에 따른 발광 다이오드 칩 및 발광 장치 중 적어도 어느 하나를 포함한다.In an electronic device including an input device according to various aspects of the present invention, the electronic device includes at least one of a light emitting diode chip and a light emitting device according to embodiments.

상기 입력 장치는 복수의 키패드를 포함할 수 있고, 상기 복수의 키패드는 그 상면에 형성된 발광 영역을 포함할 수 있으며, 상기 발광 영역으로부터 방출되는 광은 상기 발광 다이오드 칩 또는 상기 발광 장치로부터 방출된 광일 수 있다.The input device may include a plurality of keypads, and the plurality of keypads may include a light emitting region formed on an upper surface thereof. The light emitted from the light emitting region may be emitted from the light emitting diode chip or the light emitting device .

상기 입력 장치는 복수의 키패드를 포함할 수 있고, 상기 복수의 키패드는 그 상면에 형성된 발광 영역을 포함하며, 상기 복수의 키패드 중 적어도 일부의 아래에는 상기 발광 다이오드 칩이 위치할 수 있고, 상기 발광 다이오드 칩 또는 상기 발광 장치로부터 방출된 광은 상기 발광 영역을 통해 방출될 수 있다.The input device may include a plurality of keypads, and the plurality of keypads may include a light emitting area formed on an upper surface thereof, the light emitting diode chip may be positioned under at least a part of the plurality of keypads, The light emitted from the diode chip or the light emitting device may be emitted through the light emitting region.

이하, 첨부한 도면들을 참조하여 본 발명의 실시예들을 상세히 설명한다. 다음에 소개되는 실시예들은 본 발명이 속하는 기술분야의 통상의 기술자에게 본 발명의 사상이 충분히 전달될 수 있도록 하기 위해 예로서 제공되는 것이다. 따라서, 본 발명은 이하 설명되는 실시예들에 한정되지 않고 다른 형태로 구체화될 수도 있다. 그리고, 도면들에 있어서, 구성요소의 폭, 길이, 두께 등은 편의를 위하여 과장되어 표현될 수도 있다. 또한, 하나의 구성요소가 다른 구성요소의 "상부에" 또는 "상에" 있다고 기재된 경우 각 부분이 다른 부분의 "바로 상부" 또는 "바로 상에" 있는 경우뿐만 아니라 각 구성요소와 다른 구성요소 사이에 또 다른 구성요소가 개재된 경우도 포함한다. 명세서 전체에 걸쳐서 동일한 참조번호들은 동일한 구성요소들을 나타낸다.Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings. The following embodiments are provided by way of example so that those skilled in the art can sufficiently convey the spirit of the present invention. Therefore, the present invention is not limited to the embodiments described below, but may be embodied in other forms. In the drawings, the width, length, thickness, etc. of components may be exaggerated for convenience. It is also to be understood that when an element is referred to as being "above" or "above" another element, But also includes the case where another component is interposed between the two. Like reference numerals designate like elements throughout the specification.

도 1 내지 도 3은 본 발명의 일 실시예에 따른 발광 다이오드 칩(100)을 설명하기 위한 평면도들 및 단면도이다. 구체적으로, 도 1은 상기 발광 다이오드 칩(100)의 평면을 도시하는 평면도이고, 도 2는 설명의 편의를 위하여 제1 및 제2 패드 전극(151, 153) 및 광 반사성 절연층(140)을 생략하고, 메사(120m) 및 컨택 전극(130)의 평면을 도시하는 평면도이다. 도 3은 도 1 및 도 2의 A-A'선에 대응하는 부분의 단면을 도시하는 단면도이다.1 to 3 are plan and sectional views for explaining a light emitting diode chip 100 according to an embodiment of the present invention. 1 is a plan view showing a plane view of the light emitting diode chip 100. FIG. 2 is a cross-sectional view illustrating the first and second pad electrodes 151 and 153 and the light reflective insulating layer 140 for convenience of explanation. And a plane view of the mesa 120m and the contact electrode 130. FIG. 3 is a cross-sectional view showing a cross-section of a portion corresponding to line A-A 'in Fig. 1 and Fig.

도 1 내지 도 3을 참조하면, 발광 다이오드 칩(100)은 기판(110), 발광 구조체(120), 컨택 전극(130), 광 반사성 절연층(140), 제1 패드 전극(151) 및 제2 패드 전극(153)을 포함한다.1 to 3, the light emitting diode chip 100 includes a substrate 110, a light emitting structure 120, a contact electrode 130, a light reflective insulating layer 140, a first pad electrode 151, Two pad electrodes 153 are formed.

발광 다이오드 칩(100)은 비교적 작은 수평 면적을 갖는 소형 발광 다이오드 칩일 수 있다. 발광 다이오드 칩(100)은 약 65000㎛2 이하의 수평 단면적을 가질 수 있고, 나아가, 약 30000㎛2 이상 약 65000㎛2 이하의 수평 단면적을 가질 수 있다. 예를 들어, 발광 다이오드 칩(100)은 230㎛×180㎛ 또는 250㎛×200㎛의 크기를 가질 수 있다. 다만, 실시예들에 따른 발광 다이오드 칩(100)의 가로 및 세로의 길이가 상술한 바에 한정되는 것은 아니다. 또한, 발광 다이오드 칩(100)은 비교적 얇은 두께를 갖는 소형 발광 다이오드 칩일 수 있다. 발광 다이오드 칩(100)은 약 90㎛ 이하의 두께(T1)를 가질 수 있고, 나아가, 약 40㎛ 이상 90㎛ 이하의 두께(T1)를 가질 수 있다. 발광 다이오드 칩(100)은 7mA/mm2 이상 250mA/mm2 이하의 전류 밀도로 구동될 수 있다. 본 실시예의 발광 다이오드 칩(100)이 상술한 수평 단면적 및 두께를 가짐으로써, 소형 및/또는 슬림 발광 장치가 필요한 다양한 전자 장치에 상기 발광 다이오드 칩(100)이 용이하게 적용될 수 있다.The light emitting diode chip 100 may be a small light emitting diode chip having a relatively small horizontal area. The light emitting diode chip 100 may have a horizontal cross-sectional area of about 65000 μm 2 or less, and further may have a horizontal cross-sectional area of about 30000 μm 2 or more and about 65000 μm 2 or less. For example, the light emitting diode chip 100 may have a size of 230 mu m x 180 mu m or 250 mu m x 200 mu m. However, the lengths and the lengths of the LED chips 100 according to the embodiments are not limited to those described above. Also, the light emitting diode chip 100 may be a small light emitting diode chip having a relatively thin thickness. The light emitting diode chip 100 may have a thickness T1 of about 90 占 퐉 or less and further may have a thickness T1 of about 40 占 퐉 to 90 占 퐉. The LED chip 100 can be driven at a current density of 7mA / mm 2 or more 250mA / mm 2 or less. The light emitting diode chip 100 of the present embodiment has the above-described horizontal cross-sectional area and thickness, so that the light emitting diode chip 100 can be easily applied to various electronic devices requiring a small and / or slim light emitting device.

기판(110)은 절연성 또는 도전성 기판일 수 있다. 기판(110)은 발광 구조체(120)를 성장시키기 위한 성장 기판일 수 있으며, 사파이어 기판, 실리콘 카바이드 기판, 실리콘 기판, 질화갈륨 기판, 질화알루미늄 기판 등을 포함할 수 있다. 또한, 기판(110)은 그 상면의 적어도 일부 영역에 형성된 복수의 돌출부(110p)들을 포함한다. 기판(110)의 복수의 돌출부(110p)들은 규칙적인 및/또는 불규칙적인 패턴으로 형성될 수 있다. 예를 들어, 기판(110)은 상면에 형성된 복수의 돌출부(110p)들을 포함하는 패턴된 사파이어 기판(Patterned sapphire substrate; PSS)을 포함할 수 있다.The substrate 110 may be an insulating or conductive substrate. The substrate 110 may be a growth substrate for growing the light emitting structure 120, and may include a sapphire substrate, a silicon carbide substrate, a silicon substrate, a gallium nitride substrate, an aluminum nitride substrate, or the like. In addition, the substrate 110 includes a plurality of protrusions 110p formed on at least a part of its upper surface. The plurality of protrusions 110p of the substrate 110 may be formed in a regular and / or irregular pattern. For example, the substrate 110 may include a patterned sapphire substrate (PSS) including a plurality of protrusions 110p formed on an upper surface thereof.

나아가, 기판(110)은, 기판(110)의 적어도 일 측면에서 수평 방향으로 연장된 띠 형상을 가지는 적어도 하나의 개질 영역(111)을 포함할 수 있다. 개질 영역(111)은 기판(110)을 분리하여 소자를 개별화하는 과정에서 형성될 수 있다. 예를 들어, 내부 가공 방법(예컨대, 스텔스 다이싱 장비)을 이용하여 기판(110)을 내부 가공함으로써 개질 영역(111)이 형성될 수 있다. 상기 내부 가공 레이저를 통해 기판(110)의 내부에 스크라이빙면을 형성할 수 있다. 이때, 개질 영역(111)으로부터 기판(110)의 하부면까지의 거리는, 개질 영역(111)으로부터 기판(110)의 상부면까지의 거리보다 작을 수 있다. 발광 다이오드 칩(100)의 측면으로 방사되는 광을 고려할 때, 기판(110)의 아래쪽으로 치우쳐서 레이저 가공을 하여 상기 개질 영역(111)이 상대적으로 하부로 치우쳐 형성되게 함으로써, 발광 구조체(120)에서 형성된 광의 외부로의 추출 효율을 향상시킬 수 있다. 또한, 개질 영역(111)이 발광 구조체(120)에 가깝게 형성되면, 레이저 가공 공정 중에 질화물계 반도체가 손상되어 전기적 특성에 문제가 발생할 수 있다. 따라서 개질 영역(111)을 기판(110)의 아래쪽에 치우쳐 위치하도록 형성함으로써, 발광 구조체(120)의 손상에 따른 발광 다이오드 칩(100)의 신뢰성 저하 및 발광 효율 저하을 방지할 수 있다.Further, the substrate 110 may include at least one modified region 111 having a strip shape extending horizontally on at least one side of the substrate 110. The modified region 111 may be formed in the process of separating the substrate 110 to individualize the device. For example, the modified region 111 can be formed by internal processing of the substrate 110 using an internal processing method (e.g., a stealth dicing apparatus). The scribing surface can be formed inside the substrate 110 through the internal processing laser. At this time, the distance from the modified region 111 to the lower surface of the substrate 110 may be smaller than the distance from the modified region 111 to the upper surface of the substrate 110. Considering the light emitted to the side surface of the LED chip 100, laser processing is performed on the lower side of the substrate 110 so that the modified region 111 is relatively downwardly formed, The extraction efficiency of the formed light to the outside can be improved. Further, if the modified region 111 is formed close to the light emitting structure 120, the nitride based semiconductor may be damaged during the laser processing step, thereby causing a problem in electrical characteristics. Therefore, by forming the modified region 111 to be positioned below the substrate 110, it is possible to prevent the reliability of the light emitting diode chip 100 and the degradation of the light emitting efficiency due to the damage of the light emitting structure 120.

발광 구조체(120)는 기판(110) 상에 위치한다. 또한, 발광 구조체(120)의 하면의 면적은 기판(110)의 상면의 면적보다 작을 수 있고, 이에 따라, 발광 구조체(120) 주변의 적어도 일부 영역에 기판(110)의 상면이 노출될 수 있다. 복수의 돌출부(110p)들의 일부는 발광 구조체(120)와 기판(110)의 사이에 위치할 수 있고, 복수의 돌출부(110p)들의 일부는 발광 구조체(120)의 주변에 노출될 수 있다. The light emitting structure 120 is located on the substrate 110. The area of the bottom surface of the light emitting structure 120 may be smaller than the area of the top surface of the substrate 110 so that the top surface of the substrate 110 may be exposed to at least a portion of the periphery of the light emitting structure 120 . A part of the plurality of protrusions 110p may be positioned between the light emitting structure 120 and the substrate 110 and a part of the plurality of protrusions 110p may be exposed to the periphery of the light emitting structure 120. [

발광 구조체(120)의 주변에 기판(110)의 상면이 노출됨으로써, 발광 다이오드 칩(100)의 제조 과정에서의 보우잉(bowing)이 감소되어 의한 발광 구조체(120)의 손상을 방지하여 제조 수율을 향상시킬 수 있다. 또한, 상기 보우잉이 감소되어 발광 구조체(120)에 인가되는 스트레스를 감소시킬 수 있어, 기판(110)의 두께를 더욱 얇게 가공할 수 있다. 이에 따라, 약 90㎛ 이하의 얇은 두께를 갖는 슬림화된 발광 다이오드 칩(100)이 제공될 수 있다. 이와 관련하여 후술하는 실시예에서 더욱 상세하게 설명한다.The top surface of the substrate 110 is exposed to the periphery of the light emitting structure 120 to prevent damage to the light emitting structure 120 due to a reduction in bowing in the manufacturing process of the light emitting diode chip 100, Can be improved. In addition, the bowing can be reduced to reduce the stress applied to the light emitting structure 120, and the thickness of the substrate 110 can be further reduced. Accordingly, a slim light emitting diode chip 100 having a thin thickness of about 90 mu m or less can be provided. This will be described in more detail in the following embodiments.

발광 구조체(120)는 제1 도전형 반도체층(121), 제1 도전형 반도체층(121) 상에 위치하는 제2 도전형 반도체층(125), 및 제1 도전형 반도체층(121)과 제2 도전형 반도체층(125)의 사이에 위치하는 활성층(123)을 포함한다. 제1 도전형 반도체층(121), 활성층(123) 및 제2 도전형 반도체층(125)은 Ⅲ-Ⅴ 계열 질화물계 반도체를 포함할 수 있고, 예를 들어, (Al, Ga, In)N과 같은 질화물계 반도체를 포함할 수 있다. 제1 도전형 반도체층(121)은 n형 불순물 (예를 들어, Si, Ge. Sn)을 포함할 수 있고, 제2 도전형 반도체층(125)은 p형 불순물 (예를 들어, Mg, Sr, Ba)을 포함할 수 있다. 또한, 그 반대일 수도 있다. 활성층(123)은 다중양자우물 구조(MQW)를 포함할 수 있고, 원하는 파장을 방출하도록 질화물계 반도체의 조성비가 조절될 수 있다. 특히, 본 실시예에 있어서, 제2 도전형 반도체층(125)은 p형 반도체층일 수 있다.The light emitting structure 120 includes a first conductive semiconductor layer 121, a second conductive semiconductor layer 125 disposed on the first conductive semiconductor layer 121, a first conductive semiconductor layer 121, And an active layer 123 located between the second conductivity type semiconductor layers 125. The first conductivity type semiconductor layer 121, the active layer 123 and the second conductivity type semiconductor layer 125 may include a III-V series nitride semiconductor, for example, (Al, Ga, In) N Based semiconductor, for example. The first conductivity type semiconductor layer 121 may include n-type impurities (e.g., Si, Ge, Sn) and the second conductivity type semiconductor layer 125 may include p-type impurities (e.g., Mg, Sr, Ba). It may also be the opposite. The active layer 123 may include a multiple quantum well structure (MQW), and the composition ratio of the nitride-based semiconductor may be adjusted so as to emit a desired wavelength. In particular, in this embodiment, the second conductivity type semiconductor layer 125 may be a p-type semiconductor layer.

발광 구조체(120)는 활성층(123) 및 제2 도전형 반도체층(125)을 적어도 부분적으로 관통하여 제1 도전형 반도체층(121)이 노출되는 적어도 하나의 홀(120h)을 포함할 수 있다. 홀(120h)은 제1 도전형 반도체층(121)을 부분적으로 노출시키되, 홀(120h)의 측면은 활성층(123) 및 제2 도전형 반도체층(125)에 둘러싸일 수 있다. 또한, 발광 구조체(120)는 활성층(123) 및 제2 도전형 반도체층(125)을 포함하는 메사(120m)를 포함할 수 있다. 메사(120m)는 제1 도전형 반도체층(121) 상에 위치한다. 홀(120h)은 메사(120m)를 관통하도록 형성될 수 있으며, 이에 따라, 홀(120h)은 메사(120m)에 둘러싸인 형태로 형성될 수 있다. 다만, 본 실시예에 따른 발광 다이오드 칩(100)은 홀(120h)에 의해 제1 도전형 반도체층(121)이 노출되는 구조를 갖는 경우이면 제한되지 않으며, 메사(120m)는 생략될 수도 있다.The light emitting structure 120 may include at least one hole 120h through which the first conductivity type semiconductor layer 121 is exposed at least partially through the active layer 123 and the second conductivity type semiconductor layer 125 . The hole 120h may partially expose the first conductivity type semiconductor layer 121 and the side surface of the hole 120h may be surrounded by the active layer 123 and the second conductivity type semiconductor layer 125. [ The light emitting structure 120 may include a mesa 120m including an active layer 123 and a second conductive semiconductor layer 125. [ The mesa 120m is located on the first conductivity type semiconductor layer 121. [ The hole 120h may be formed to penetrate the mesa 120m so that the hole 120h may be formed to be surrounded by the mesa 120m. However, the light emitting diode chip 100 according to the present embodiment is not limited as long as it has a structure in which the first conductivity type semiconductor layer 121 is exposed by the hole 120h, and the mesa 120m may be omitted .

컨택 전극(130)은 제2 도전형 반도체층(125) 상에 위치한다. 컨택 전극(130)은 제2 도전형 반도체층(125)에 오믹 컨택할 수 있다. 컨택 전극(130)은 투명 전극을 포함할 수 있다. 투명 전극은, 예를 들어, ITO(Indium Tin Oxide), ZnO(Zinc Oxide), ZITO (Zinc Indium Tin Oxide), ZIO (Zinc Indium Oxide), ZTO (Zinc Tin Oxide), GITO (Gallium Indium Tin Oxide), GIO (Gallium Indium Oxide), GZO (Gallium Zinc Oxide), AZO(Aluminum doped Zinc Oxide), FTO (Fluorine Tin Oxide)등과 같은 광 투과성 도전성 산화물 및 Ni/Au 등과 같은 광 투과성 금속층 중 적어도 하나를 포함할 수도 있다. 상기 도전성 산화물은 다양한 도펀트를 더 포함할 수도 있다.The contact electrode 130 is located on the second conductive type semiconductor layer 125. The contact electrode 130 may be in ohmic contact with the second conductivity type semiconductor layer 125. The contact electrode 130 may include a transparent electrode. For example, the transparent electrode may be formed of indium tin oxide (ITO), zinc oxide (ZnO), zinc tin oxide (ZITO), zinc tin oxide (ZTO), gallium indium tin oxide (GITO) , A light transmitting conductive oxide such as GIO (Gallium Indium Oxide), GZO (Gallium Zinc Oxide), AZO (Aluminum Doped Zinc Oxide), FTO (Fluorine Tin Oxide) and the like and a light transmitting metal layer such as Ni / Au It is possible. The conductive oxide may further include various dopants.

특히, 광 투과성 도전성 산화물 포함하는 컨택 전극(130)은 제2 도전형 반도체층(125)과의 오믹 컨택 효율이 높다. 즉, ITO 또는 ZnO 등과 같은 도전성 산화물과 제2 도전형 반도체층(125)의 접촉 저항은 금속성 전극과의 제2 도전형 반도체층(125)과의 접촉 저항에 비해 낮아, 도전성 산화물을 포함하는 컨택 전극(130)을 적용함으로써 발광 다이오드 칩(100)의 순방향 전압(Vf)을 감소시켜 발광 효율을 향상시킬 수 있다. 특히, 본 실시예의 발광 다이오드 칩(100)과 같이 비교적 낮은 전류 밀도로 구동되는 소형 발광 다이오드 칩의 경우, 컨택 전극(130)과 제2 도전형 반도체층(125)과의 접촉 저항을 낮춰 오믹 특성을 향상시킴으로써 더욱 효과적으로 발광 효율을 향상시킬 수 있다. 또한, 도전성 산화물은 금속성 전극에 비해 질화물계 반도체층으로부터 박리(peeling)될 확률이 적으므로, 도전성 산화물을 포함하는 컨택 전극(130)을 갖는 발광 다이오드 칩(100)은 높은 신뢰성을 갖는다. 한편, 도전성 산화물은 금속성 전극에 비해 수평 방향으로의 전류 분산 효율이 상대적으로 낮으나, 본 실시예의 발광 다이오드 칩(100)은 약 65000㎛2 이하의 수평 단면적을 가지므로, 전류 분산 효율 저하에 따른 발광 효율 저하가 매우 작거나 거의 없다. 따라서, 도전성 산화물을 포함하는 컨택 전극(130)을 발광 다이오드 칩(100)에 적용함으로써, 전기적 특성을 향상시키고 발광 효율을 향상시킬 수 있다.In particular, the contact electrode 130 including the light-transmitting conductive oxide has high ohmic contact efficiency with the second conductivity type semiconductor layer 125. That is, the contact resistance between the conductive oxide such as ITO or ZnO and the second conductive type semiconductor layer 125 is lower than the contact resistance with the second conductive type semiconductor layer 125 with the metallic electrode, By applying the electrode 130, the forward voltage V f of the light emitting diode chip 100 can be reduced to improve the luminous efficiency. Particularly, in the case of a light emitting diode chip that is driven at a relatively low current density, such as the light emitting diode chip 100 of the present embodiment, contact resistance between the contact electrode 130 and the second conductivity type semiconductor layer 125 is lowered, The luminous efficiency can be improved more effectively. Further, since the conductive oxide is less likely to be peeled from the nitride based semiconductor layer as compared with the metallic electrode, the light emitting diode chip 100 having the contact electrode 130 including the conductive oxide has high reliability. On the other hand, since the conductive oxide has a relatively low current dispersion efficiency in the horizontal direction as compared with the metallic electrode, the light emitting diode chip 100 of this embodiment has a horizontal cross-sectional area of about 65000 μm 2 or less, There is very little or no reduction in efficiency. Accordingly, by applying the contact electrode 130 including the conductive oxide to the light emitting diode chip 100, it is possible to improve the electrical characteristics and improve the light emitting efficiency.

컨택 전극(130)의 두께는 제한되지 않으나, 약 2000Å 내지 3000Å의 두께를 가질 수 있다. 예를 들어, ITO를 포함하는 컨택 전극(130)은 약 2400Å의 두께로 형성될 수 있다. 컨택 전극(130)이 상술한 범위의 두께를 가짐으로써, 전류를 원활하게 수평 방향으로 분산시켜 발광 다이오드 칩(100)의 전기적 특성을 향상시킬 수 있다.The thickness of the contact electrode 130 is not limited, but may have a thickness of about 2000 Å to 3000 Å. For example, the contact electrode 130 including ITO may be formed to a thickness of about 2400 ANGSTROM. By having the thickness of the contact electrode 130 in the above-described range, the current can be smoothly dispersed in the horizontal direction, thereby improving the electrical characteristics of the LED chip 100.

또한, 컨택 전극(130)은 적어도 하나의 홀(120h)을 노출시키는 제1 개구부(130a)를 포함한다. 제1 개구부(130a)의 측면은 적어도 하나의 홀(120h)로부터 이격되되, 적어도 하나의 홀(120h)을 둘러싸도록 형성될 수 있다. 이때, 제1 개구부(130a)의 크기는 홀(120h)의 상부의 크기보다 크다. 컨택 전극(130)은 제2 도전형 반도체층(125)의 상면을 대체로 전체적으로 덮도록 형성됨으로써, 발광 다이오드 칩(100) 구동 시 전류 분산 효율을 향상시킬 수 있다. 나아가, 컨택 전극(130)은 제2 도전형 반도체층(125)을 부분적으로 노출시키는 적어도 하나의 제2 개구부(130b)를 더 포함할 수 있다. 후술하는 제2 패드 전극(153)가 제2 개구부(130b)를 적어도 부분적으로 채우도록 형성됨으로써, 제2 패드 전극(153)의 접촉면적을 증가시킬 수 있다. 이에 따라, 제2 패드 전극(153)이 컨택 전극(130)이나 발광 구조체(120)로부터 박리되는 것을 효과적으로 방지할 수 있다. 이와 관련하여 후술하여 더욱 상세하게 설명한다.In addition, the contact electrode 130 includes a first opening 130a exposing at least one hole 120h. The side surface of the first opening 130a may be spaced apart from the at least one hole 120h and may be formed to surround at least one hole 120h. At this time, the size of the first opening 130a is larger than the size of the upper portion of the hole 120h. The contact electrode 130 covers the upper surface of the second conductivity type semiconductor layer 125 as a whole, thereby improving the current dispersion efficiency when the LED chip 100 is driven. In addition, the contact electrode 130 may further include at least one second opening 130b for partially exposing the second conductive type semiconductor layer 125. The contact area of the second pad electrode 153 can be increased by forming the second pad electrode 153 described later at least partially to fill the second opening 130b. Accordingly, it is possible to effectively prevent the second pad electrode 153 from being peeled off from the contact electrode 130 or the light emitting structure 120. This will be described in more detail below.

광 반사성 절연층(140)은 발광 구조체(120)의 상면 및 측면을 덮으며, 또한, 컨택 전극(130)을 덮는다. 또한, 광 반사성 절연층(140)은 발광 구조체(120)의 주변에 노출된 기판(110)의 상면까지 연장되도록 형성될 수 있다. 이에 따라, 광 반사성 절연층(140)은 기판(110)의 상면과 접할 수 있으며, 따라서 발광 구조체(120)의 측면을 덮는 광 반사성 절연층(140)이 더욱 안정적으로 배치될 수 있다. 다만, 광 반사성 절연층(140)은 기판(110)의 상부 모서리 부분까지 연장되어 형성되지 않으며, 기판(110)의 상부 모서리 주변의 상면은 노출된다. 또한, 광 반사성 절연층(140)은 적어도 하나의 홀(120h)에 노출된 제1 도전형 반도체층(121)을 부분적으로 노출시키는 제3 개구부(140a) 및 컨택 전극(130)을 부분적으로 노출시키는 제4 개구부(140b)를 포함할 수 있다.The light reflective insulating layer 140 covers the upper surface and the side surface of the light emitting structure 120 and also covers the contact electrode 130. In addition, the light reflective insulating layer 140 may extend to the upper surface of the substrate 110 exposed to the periphery of the light emitting structure 120. Accordingly, the light reflective insulating layer 140 can be in contact with the upper surface of the substrate 110, so that the light reflective insulating layer 140 covering the side surface of the light emitting structure 120 can be more stably disposed. However, the light reflecting insulating layer 140 is not formed to extend to the upper edge of the substrate 110, and the upper surface of the upper edge of the substrate 110 is exposed. The light reflective insulating layer 140 includes a third opening 140a partially exposing the first conductivity type semiconductor layer 121 exposed in at least one hole 120h and a third opening 140b partially exposing the contact electrode 130 The first opening 140a and the second opening 140b.

광 반사성 절연층(140)의 제3 개구부(140a)는 적어도 하나의 홀(120h)에 노출된 제1 도전형 반도체층(121)을 부분적으로 노출시킨다. 이때, 홀(120h)의 측면은 광 반사성 절연층(140)에 덮여, 전기적 쇼트가 방지된다. 제3 개구부(140a)는 제1 도전형 반도체층(121)과 제1 패드 전극(151)의 전기적 접속을 허용하는 통로로 이용될 수 있다. 광 반사성 절연층(140)의 제4 개구부(140b)는 컨택 전극(130)을 부분적으로 노출시킨다. 제4 개구부(140b)는 컨택 전극(130)과 제2 패드 전극(153)의 전기적 접속을 허용하는 통로로 이용될 수 있다. 한편, 몇몇 실시예들에 있어서, 제4 개구부(140b)는 컨택 전극(130)의 제2 개구부(130b)의 위치에 대응하여 위치한다. 이때, 제4 개구부(140b)의 크기는 제2 개구부(130b)의 크기보다 크며, 이에 따라, 제4 개구부(140b)에는 컨택 전극(130)의 상면이 부분적으로 노출된다. The third opening 140a of the light reflective insulating layer 140 partially exposes the first conductive type semiconductor layer 121 exposed in at least one hole 120h. At this time, the side surface of the hole 120h is covered with the light reflective insulating layer 140 to prevent electrical short-circuiting. The third opening 140a may be used as a path for allowing electrical connection between the first conductive type semiconductor layer 121 and the first pad electrode 151. [ The fourth opening 140b of the light reflective insulating layer 140 partially exposes the contact electrode 130. [ The fourth opening 140b may be used as a path for allowing electrical connection between the contact electrode 130 and the second pad electrode 153. Meanwhile, in some embodiments, the fourth opening 140b is located corresponding to the position of the second opening 130b of the contact electrode 130. [ At this time, the size of the fourth opening 140b is larger than that of the second opening 130b, so that the upper surface of the contact electrode 130 is partially exposed in the fourth opening 140b.

광 반사성 절연층(140)은 분포 브래그 반사기를 포함할 수 있다. 상기 분포 브래그 반사기는 굴절률이 서로 다른 유전체층들이 반복 적층되어 형성될 수 있으며, 예컨대, 상기 유전체층들은 TiO2 , SiO2, HfO2, ZrO2, Nb2O5, MgF2등을 포함할 수 있다. 몇몇 실시예들에서, 광 반사성 절연층(140)은 교대로 적층된 TiO2층/SiO2층의 구조를 가질 수 있다. 분포 브래그 반사기의 각 층은 특정 파장의 1/4의 광학 두께를 가질 수 있으며, 4 내지 20 페어(pairs)로 형성할 수 있다. 광 반사성 절연층(140)의 최상부층은 SiNx로 형성될 수 있다. SiNx로 형성된 층은 방습성이 우수하여, 발광 다이오드 칩을 습기로부터 보호할 수 있다.The light reflective insulating layer 140 may comprise a distributed Bragg reflector. The distributed Bragg reflector may be formed by repeatedly stacking dielectric layers having different refractive indices. For example, the dielectric layers may include TiO 2 , SiO 2 , HfO 2 , ZrO 2 , Nb 2 O 5 , MgF 2 , and the like. In some embodiments, the light reflective insulating layer 140 may have a structure of an alternately stacked TiO 2 layer / SiO 2 layer. Each layer of the distributed Bragg reflector may have an optical thickness of 1/4 of a specific wavelength and may be formed of 4 to 20 pairs. The uppermost layer of the light reflective insulating layer 140 may be formed of SiN x . The layer formed of SiN x is excellent in moisture-proof property and can protect the light emitting diode chip from moisture.

광 반사성 절연층(140)이 분포 브래그 반사기를 포함하는 경우, 광 반사성 절연층(140)의 최하부 층은 분포 브래그 반사기의 막질을 향상시킬 수 있는 기반층 내지 계면층의 역할을 할 수 있다. 도 3의 확대도에 도시된 바와 같이, 광 반사성 절연층(140)은 상대적으로 두꺼운 두께를 갖는 계면층(141) 및 계면층(141) 상에 위치하는 굴절률이 서로 다른 유전체층들의 적층 구조(143)를 포함할 수 있다. 예컨대, 광 반사성 절연층(140)은 약 0.2㎛ 내지 1.0㎛ 두께의 SiO2로 형성된 계면층(141) 및 계면층(141) 상에 TiO2층/SiO2층이 소정 주기로 반복 적층된 적층 구조(143)를 포함할 수 있다.When the light reflective insulating layer 140 includes a distributed Bragg reflector, the lowermost layer of the light reflective insulating layer 140 may serve as a base layer or an interface layer capable of improving the film quality of the distributed Bragg reflector. As shown in the enlarged view of FIG. 3, the light reflective insulating layer 140 includes an interface layer 141 having a relatively thick thickness and a laminate structure 143 of dielectric layers having different refractive indexes located on the interface layer 141 ). For example, the light reflective insulating layer 140 is formed by stacking an interfacial layer 141 formed of SiO 2 with a thickness of about 0.2 μm to 1.0 μm and a laminated structure having a TiO 2 layer / SiO 2 layer repeatedly laminated at predetermined intervals on the interface layer 141 (Not shown).

상기 분포 브래그 반사기는 비교적 높은 가시광에 대한 반사율을 가질 수 있다. 상기 분포 브래그 반사기는 입사각이 0~60°이고, 파장이 400~700nm인 광에 대해 90% 이상의 반사율을 갖도록 설계될 수 있다. 상술한 반사율을 갖는 분포 브래그 반사기는 분포 브래그 반사기를 형성하는 복수의 유전체층들의 종류, 두께, 적층 주기등을 제어함으로써 제공될 수 있다. 이에 따라, 상대적으로 장파장의 광(예컨대, 550nm 내지 700nm) 및 상대적으로 단파장의 광(예컨대, 400nm 내지 550nm)에 대해 높은 반사율을 갖는 분포 브래그 반사기를 형성할 수 있다. The distributed Bragg reflector may have a reflectivity for relatively high visible light. The distributed Bragg reflector may be designed to have a reflectance of 90% or more with respect to light having an incident angle of 0 to 60 ° and a wavelength of 400 to 700 nm. The above-described distributed Bragg reflector having reflectance can be provided by controlling the type, thickness, stacking period, etc. of a plurality of dielectric layers forming the distributed Bragg reflector. Thus, it is possible to form a distributed Bragg reflector having a high reflectance for light of a relatively long wavelength (for example, 550 nm to 700 nm) and light of a relatively short wavelength (for example, 400 nm to 550 nm).

이와 같이, 분포 브래그 반사기가 넓은 파장대의 광에 대해 높은 반사율을 갖도록, 상기 분포 브래그 반사기는 다중 적층 구조를 포함할 수 있다. 즉, 상기 분포 브래그 반사기는 제1 두께를 갖는 유전체층들이 적층된 제1 적층 구조, 제2 두께를 갖는 유전체층들이 적층된 제2 적층 구조를 포함할 수 있다. 예를 들어, 상기 분포 브래그 반사기는 가시광의 중심 파장(약 550nm)의 광에 대해 1/4의 광학 두께보다 작은 두께를 갖는 유전체층들이 적층된 제1 적층 구조, 및 가시광의 중심 파장(약 550nm)의 광에 대해 1/4의 광학 두께보다 두꺼운 두께를 갖는 유전체층들이 적층된 제2 적층 구조를 포함할 수 있다. 나아가, 상기 분포 브래그 반사기는, 가시광의 중심 파장(약 550nm)의 광에 대해 1/4의 광학 두께보다 두꺼운 두께를 갖는 유전체층과 상기 광에 대해 1/4의 광학 두께보다 얇은 두께를 갖는 유전체층이 반복 적층된 제3 적층 구조를 더 포함할 수 있다.As such, the distributed Bragg reflector may include multiple laminate structures such that the distributed Bragg reflector has a high reflectance for light of a broad wavelength band. That is, the distributed Bragg reflector may include a first lamination structure in which dielectric layers having a first thickness are laminated, and a second lamination structure in which dielectric layers having a second thickness are laminated. For example, the distributed Bragg reflector has a first laminated structure in which dielectric layers having a thickness smaller than 1/4 of the optical thickness with respect to light having a center wavelength of visible light (about 550 nm) are laminated, and a first laminated structure having a center wavelength (about 550 nm) Lt; RTI ID = 0.0 > 1/4 < / RTI > optical thickness with respect to the light of the second layer stack. Furthermore, the above-mentioned distributed Bragg reflector has a dielectric layer having a thickness greater than 1/4 of the optical thickness with respect to light having a center wavelength (about 550 nm) of visible light and a dielectric layer having a thickness smaller than 1/4 of the optical thickness And may further include a third stacked structure repeatedly stacked.

광 반사성 절연층(140)은 기판(110)의 상면이 노출된 부분을 부분적으로 덮을 수 있다. 이때, 광 반사성 절연층(140)은 기판(110)의 상면이 노출된 부분의 돌출부(110p)들을 부분적으로 덮을 수 있다. 도 3의 확대도에 도시된 바와 같이, 광 반사성 절연층(140)은 노출된 돌출부(110p)들의 일부를 덮을 수 있다. 기판(110)의 상면을 덮는 광 반사성 절연층(140)의 표면은 기판(110)의 표면과 대체로 유사한 표면 프로파일을 가질 수 있다. 광 반사성 절연층(140)이 기판(110)의 노출된 돌출부(110p)들을 덮도록 형성됨으로써, 노출된 돌출부(110p)에 의해 산란된 광을 반사시켜 발광 다이오드 칩(100)의 발광 효율을 향상시킬 수 있다.The light reflective insulating layer 140 may partially cover the exposed portion of the substrate 110. At this time, the light reflective insulating layer 140 may partially cover the protrusions 110p of the exposed portion of the upper surface of the substrate 110. As shown in the enlarged view of FIG. 3, the light reflective insulating layer 140 may cover a part of the exposed protrusions 110p. The surface of the light reflective insulating layer 140 covering the top surface of the substrate 110 may have a surface profile that is generally similar to the surface of the substrate 110. [ The light reflecting insulating layer 140 is formed so as to cover the exposed protrusions 110p of the substrate 110 so that the light scattered by the exposed protrusions 110p is reflected to improve the luminous efficiency of the light emitting diode chip 100 .

발광 구조체(120)의 상면 및 측면을 거의 전반적으로 덮는 광 반사성 절연층(140)의 분포 브래그 반사기에 광이 반사됨으로써, 상기 발광 다이오드 칩(100)의 발광 효율이 향상될 수 있다. 특히, 발광 다이오드 칩(100)의 전기적 특성을 향상시킬 수 있는 도전성 산화물을 포함하는 컨택 전극(130)을 투과한 광이 광 반사성 절연층(140)에 반사되어 기판(110)의 하부로 방출될 수 있다. 또한, 광 반사성 절연층(140)이 발광 구조체(120)의 측면까지 덮도록 형성되어, 발광 구조체(120)의 측면을 향하는 광 역시 광 반사성 절연층(140)에 반사되어 기판(110)의 하부로 방출시킬 수 있다. 또한, 발광 구조체(120) 주변의 기판(110)의 상면이 노출됨으로써, 광 반사성 절연층(140)이 기판(110)의 상면에 접하여 발광 구조체(120)의 측면을 더욱 안정적으로 덮어, 발광 구조체(120)의 측면을 통해 손실되는 광을 최소화할 수 있다.The light emitting efficiency of the light emitting diode chip 100 can be improved by reflecting light on the distributed Bragg reflector of the light reflective insulating layer 140 covering the upper surface and side surfaces of the light emitting structure 120 almost entirely. Particularly, light transmitted through the contact electrode 130 including a conductive oxide, which can improve the electrical characteristics of the LED chip 100, is reflected by the light reflective insulating layer 140 and is emitted to the lower portion of the substrate 110 . The light reflecting reflective insulating layer 140 is formed to cover the side surface of the light emitting structure 120 so that the light directed toward the side surface of the light emitting structure 120 is also reflected by the light reflecting insulating layer 140, . The upper surface of the substrate 110 around the light emitting structure 120 is exposed so that the light reflecting insulating layer 140 contacts the upper surface of the substrate 110 to more stably cover the side surface of the light emitting structure 120, It is possible to minimize light that is lost through the side surface of the substrate 120.

한편, 광 반사성 절연층(140)이 기판(110)의 상면에 접하는 경우에도, 기판(110)의 상부 모서리 주변의 상면은 노출된다. 즉, 기판(110)의 상부 모서리는 광 반사성 절연층(140)과 이격된다. 이에 따라, 웨이퍼를 분할하여 복수의 발광 다이오드 칩(100)을 형성하는 과정에서, 기판(110)의 분할 과정(예컨대, 내부가공 다이싱, 스크라이빙 및/또는 브레이킹을 통한 기판(110)의 분할)에서 레이저 등에 의한 광 반사성 절연층(140)의 손상(예컨대, 박리, 깨짐 등)이 방지된다. 특히, 광 반사성 절연층(140)이 분포 브래그 반사기를 포함하는 경우, 광 반사성 절연층(140)이 손상되면 광 반사율이 저하될 수 있다. 본 실시예에 따르면, 이러한 광 반사성 절연층(140)의 손상으로 인한 발광 효율 저하를 방지할 수 있다. 이와 관련하여 후술하는 실시예에서 더욱 상세하게 설명한다.On the other hand, even when the light reflective insulating layer 140 is in contact with the upper surface of the substrate 110, the upper surface around the upper edge of the substrate 110 is exposed. That is, the upper edge of the substrate 110 is spaced apart from the light reflective insulating layer 140. Accordingly, in the process of forming the plurality of LED chips 100 by dividing the wafer, the process of dividing the substrate 110 (e.g., the process of dividing the substrate 110 through the inner process dicing, scribing and / (For example, peeling, cracking, etc.) of the light-reflective insulating layer 140 by laser or the like is prevented. In particular, in the case where the light-reflective insulating layer 140 includes a distributed Bragg reflector, the light reflectance may be lowered if the light-reflective insulating layer 140 is damaged. According to this embodiment, deterioration in luminous efficiency due to damage to the light reflective insulating layer 140 can be prevented. This will be described in more detail in the following embodiments.

제1 패드 전극(151)과 제2 패드 전극(153)은 광 반사성 절연층(140) 상에 위치한다. 제1 패드 전극(151)은 제3 개구부(140a)를 통해 제1 도전형 반도체층(121)과 오믹 컨택할 수 있고, 제2 패드 전극(153)은 제4 개구부(140b)를 통해 컨택 전극(130)과 전기적으로 연결될 수 있다. 컨택 전극(130)이 제2 개구부(130b)를 포함하는 경우, 제2 패드 전극(153)은 제2 도전형 반도체층(125)과 접촉될 수 있다. 다만, 이 경우, 제2 패드 전극(153)과 제2 도전형 반도체층(125) 간의 접촉 저항은 제2 패드 전극(153)과 컨택 전극(130) 간의 접촉 저항에 비해 높아, 제2 패드 전극(153)을 통해 도통되는 전류는 컨택 전극(130)으로 흐를 확률이 높다. 예컨대, 제2 패드 전극(153)과 제2 도전형 반도체층(125)은 쇼트키 컨택을 형성할 수 있다. 따라서, 제2 패드 전극(153)이 제2 도전형 반도체층(125)에 접촉함으로써 발생할 수 있는 전류 밀집(current crowding)이 최소화 될 수 있다.The first pad electrode 151 and the second pad electrode 153 are located on the light reflective insulating layer 140. The first pad electrode 151 may make an ohmic contact with the first conductive semiconductor layer 121 through the third opening 140a and the second pad electrode 153 may make an ohmic contact with the contact electrode 140a through the fourth opening 140b. (Not shown). When the contact electrode 130 includes the second opening 130b, the second pad electrode 153 may be in contact with the second conductive type semiconductor layer 125. In this case, the contact resistance between the second pad electrode 153 and the second conductive type semiconductor layer 125 is higher than the contact resistance between the second pad electrode 153 and the contact electrode 130, The current flowing through the contact electrode 130 is high. For example, the second pad electrode 153 and the second conductive semiconductor layer 125 may form a Schottky contact. Accordingly, the current crowding that may occur when the second pad electrode 153 contacts the second conductive type semiconductor layer 125 can be minimized.

제1 패드 전극(151) 및 제2 패드 전극(153)은 각각 그것들이 형성되는 부분의 하부면의 표면 프로파일에 대응하는 상면 프로파일을 가질 수 있다. 이에 따라, 제1 패드 전극(151)은 제3 개구부(140a) 상에 위치하는 오목부(151a)를 포함할 수 있고, 제2 패드 전극(153)은 제4 개구부(140b) 상에 위치하는 오목부(153a)를 포함할 수 있다. 이와 같이, 제1 및 제2 패드 전극(151, 153)의 하부에 단차를 갖는 표면이 형성되어, 제1 및 제2 패드 전극(151, 153)의 접촉 면적이 증가하고 접촉하는 부분에 단차가 발생하여 제1 및 제2 패드 전극(151, 153)의 박리가 방지될 수 있다. 특히, 컨택 전극(130)이 제2 개구부(130b)를 포함하는 경우, 제2 패드 전극(153)은 단턱부를 갖는 오목부(153a)가 형성되며, 더욱 효과적으로 제2 패드 전극(153)의 박리가 방지될 수 있다.The first pad electrode 151 and the second pad electrode 153 may each have a top surface profile corresponding to the surface profile of the lower surface of the portion where they are formed. The first pad electrode 151 may include a concave portion 151a positioned on the third opening portion 140a and the second pad electrode 153 may be located on the fourth opening portion 140b And may include a concave portion 153a. As described above, the surface of the first and second pad electrodes 151 and 153 is formed with a step, and the contact area of the first and second pad electrodes 151 and 153 increases, The first and second pad electrodes 151 and 153 can be prevented from peeling off. Particularly, when the contact electrode 130 includes the second opening 130b, the second pad electrode 153 has a concave portion 153a having a stepped portion, and more effectively, the second pad electrode 153 is peeled off Can be prevented.

한편, 제1 패드 전극(151)과 제2 패드 전극(153)의 최단 이격거리(D1)는 상대적으로 매우 작게 형성될 수 있으며, 예를 들어, 약 3㎛ 내지 약 20㎛일 수 있다. 발광 구조체(120)의 측면을 덮는 광 반사성 절연층(140)을 안정적으로 형성할 수 있기 때문에, 이는, 후술하는 실시예에서 설명하는 바와 같이, 발광 다이오드 칩(100)을 제2 기판(300)에 본딩하는 본딩부(211, 213)가 발광 다이오드 칩(100)의 측면까지 덮도록 형성될 수 있다. 이에 따라, 제1 패드 전극(151)과 제2 패드 전극(153)의 최단 이격거리(D1)를 통한 공정 마진을 확보할 필요성이 없어서, 제1 패드 전극(151)과 제2 패드 전극(153)의 최단 이격거리(D1)를 최소한으로 감소시킬 수 있다. 또한, 본 실시예의 소형 발광 다이오드 칩(100)은 비교적 낮은 전류 밀도로 구동되므로, 제1 패드 전극(151)과 제2 패드 전극(153)의 최단 이격거리를 더욱 감소시킬 수 있다. 제1 패드 전극(151)과 제2 패드 전극(153)의 최단 이격거리(D1)를 상술한 범위로 형성함으로써, 발광 다이오드 칩(100)의 방열 효율을 향상시킬 수 있다. 이때, 제1 패드 전극(151)의 면적과 제2 패드 전극(153)의 면적의 합은 발광 다이오드 칩(100)의 수평 단면적의 약 80% 이상 95% 이상일 수 있다.The shortest distance D1 between the first pad electrode 151 and the second pad electrode 153 may be relatively small and may be, for example, about 3 탆 to about 20 탆. The light emitting diode chip 100 can be stably formed on the second substrate 300 as described in the following embodiments because the light reflecting and insulating layer 140 covering the side surface of the light emitting structure 120 can be stably formed. The bonding portions 211 and 213 may be formed to cover the side surfaces of the light emitting diode chip 100. Accordingly, there is no need to secure a process margin through the shortest distance D1 between the first pad electrode 151 and the second pad electrode 153, so that the distance between the first pad electrode 151 and the second pad electrode 153 Can be minimized to a minimum. In addition, since the small-sized LED chip 100 of this embodiment is driven at a relatively low current density, the shortest distance between the first pad electrode 151 and the second pad electrode 153 can be further reduced. The heat dissipation efficiency of the light emitting diode chip 100 can be improved by forming the shortest distance D1 between the first pad electrode 151 and the second pad electrode 153 within the above described range. At this time, the sum of the area of the first pad electrode 151 and the area of the second pad electrode 153 may be about 80% or more and 95% or more of the horizontal cross-sectional area of the LED chip 100.

도 4는 본 발명의 또 다른 실시예에 따른 발광 장치를 설명하기 위한 단면도이다.4 is a cross-sectional view illustrating a light emitting device according to another embodiment of the present invention.

도 4를 참조하면, 상기 발광 장치는, 제2 기판(300), 제2 기판(300) 상에 위치하는 발광 다이오드 칩(100), 제1 본딩부(211) 및 제2 본딩부(213)를 포함한다.4, the light emitting device includes a second substrate 300, a light emitting diode chip 100 disposed on the second substrate 300, a first bonding portion 211 and a second bonding portion 213, .

제2 기판(300)은 발광 다이오드 칩(100)이 실장되는 영역을 제공할 수 있으며, 예컨대, 발광 다이오드 패키지의 기판 또는 발광 모듈의 기판 등일 수 있다. 제2 기판(300)은 베이스(310) 및 베이스(310) 상에 위치하는 제1 및 제2 도전성 패턴(321, 323)을 포함할 수 있다. 제2 기판(300)은 도전성 기판, 절연성 기판 또는 인쇄회로기판(PCB)을 포함할 수 있다. 예컨대, 도시된 바와 같이, 제2 기판(300)은 절연성 베이스(310), 베이스(310) 상에 위치하며, 서로 전기적으로 이격된 제1 및 제2 도전성 패턴(321, 323)을 포함할 수 있다. 예컨대, 제1 및 제2 도전성 패턴(321, 323)은 D3의 이격거리로 서로 이격되어 전기적으로 절연될 수 있다. 이때, 제1 및 제2 도전성 패턴(321, 323)은 각각 발광 다이오드 칩(100)의 제1 패드 전극(151) 및 제2 패드 전극(153)에 전기적으로 연결될 수 있다. 다만, 본 발명이 이에 한정되는 것은 아니며, 제2 기판(300)은 발광 다이오드 칩(100)이 실장되는 영역을 제공하며, 발광 다이오드 칩(100)과 전기적 연결을 형성할 수 있는 구조를 갖는 경우이면 제한되지 않는다.The second substrate 300 may provide an area where the light emitting diode chip 100 is mounted, for example, a substrate of a light emitting diode package or a substrate of a light emitting module. The second substrate 300 may include first and second conductive patterns 321 and 323 located on the base 310 and the base 310. The second substrate 300 may include a conductive substrate, an insulating substrate, or a printed circuit board (PCB). For example, as shown, the second substrate 300 may include an insulating base 310, first and second conductive patterns 321 and 323 located on the base 310 and electrically spaced from each other. have. For example, the first and second conductive patterns 321 and 323 may be electrically isolated from each other by a distance of D3. The first and second conductive patterns 321 and 323 may be electrically connected to the first pad electrode 151 and the second pad electrode 153 of the LED chip 100, respectively. However, the present invention is not limited thereto, and the second substrate 300 may provide an area where the light emitting diode chip 100 is mounted, and may have a structure capable of forming an electrical connection with the light emitting diode chip 100 .

발광 다이오드 칩(100)은 제2 기판(300) 상에 위치하며, 제2 기판(300)과 전기적으로 연결된다. 발광 다이오드 칩(100)은 도 1 내지 도 3을 참조하여 설명한 다양한 실시예들에 따른 발광 다이오드 칩(100)일 수 있다.The light emitting diode chip 100 is disposed on the second substrate 300 and electrically connected to the second substrate 300. The light emitting diode chip 100 may be the light emitting diode chip 100 according to various embodiments described with reference to FIGS.

제1 본딩부(211) 및 제2 본딩부(213)는 발광 다이오드 칩(100)과 제2 기판(300)의 사이에 위치하여, 발광 다이오드 칩(100)을 제2 기판(300)에 본딩함과 아울러, 전기적으로 서로 연결한다. 제1 본딩부(211)는 발광 다이오드 칩(100)의 제1 패드 전극(151)과 접촉하고, 제2 기판(300)의 제1 도전성 패턴(321)과 접촉할 수 있다. 이와 유사하게, 제2 본딩부(213)는 발광 다이오드 칩(100)의 제2 패드 전극(153)과 접촉하고, 제2 기판(300)의 제2 도전성 패턴(321)과 접촉할 수 있다. 제1 및 제2 본딩부(211, 213)는 발광 다이오드 칩(100)과 제2 기판(300)을 전기적으로 연결하고, 서로 본딩하는 물질이면 제한되지 않으며, 예컨대, 솔더를 포함할 수 있다.The first bonding portion 211 and the second bonding portion 213 are positioned between the LED chip 100 and the second substrate 300 and are bonded to the second substrate 300 And electrically connected to each other. The first bonding portion 211 may be in contact with the first pad electrode 151 of the LED chip 100 and may be in contact with the first conductive pattern 321 of the second substrate 300. Similarly, the second bonding portion 213 may be in contact with the second pad electrode 153 of the LED chip 100 and may contact the second conductive pattern 321 of the second substrate 300. The first and second bonding units 211 and 213 are not limited as long as the LED chip 100 and the second substrate 300 are electrically connected to each other and bonded to each other. For example, the first and second bonding units 211 and 213 may include solder.

또한, 제1 본딩부(211) 및 제2 본딩부(213) 중 적어도 하나는 발광 다이오드 칩(100)의 측면의 적어도 일부에 접촉할 수 있다. 일 실시예에서, 제1 본딩부(211) 및 제2 본딩부(213) 중 적어도 하나는 발광 구조체(120)의 측면을 덮는 광 반사성 절연층(140)의 측면의 적어도 일부를 덮을 수 있고, 나아가, 발광 구조체(120)의 주변에 노출된 기판(110)의 하면의 적어도 일부를 덮을 수 있으며, 더 나아가, 기판(110)의 측면의 적어도 일부를 더 덮을 수 있다.At least one of the first bonding portion 211 and the second bonding portion 213 may contact at least a part of the side surface of the light emitting diode chip 100. In one embodiment, at least one of the first bonding portion 211 and the second bonding portion 213 may cover at least a part of the side surface of the light reflective insulating layer 140 covering the side surface of the light emitting structure 120, Further, at least a part of the lower surface of the substrate 110 exposed at the periphery of the light emitting structure 120 can be covered, and furthermore, at least a part of the side surface of the substrate 110 can be further covered.

이와 같이, 제1 본딩부(211) 및 제2 본딩부(213) 중 적어도 하나는 발광 다이오드 칩(100)의 측면의 적어도 일부에 접촉하도록 형성됨으로써, 제1 본딩부(211)와 제2 본딩부(213) 간의 최단 이격거리(D2)는 제1 패드 전극(151)과 제2 패드 전극(153) 간의 최단 이격거리(D1)에 비해 작을 수 있다. 따라서, D1이 비교적 작게 형성되더라도(예를 들어, 약 3㎛ 내지 20㎛), D2를 D1보다 크게 형성할 수 있으므로 발광 다이오드 칩(100)의 실장 시 전기적 쇼트가 발생하는 것을 방지할 수 있다. 특히, 발광 다이오드 칩(100)의 광 반사성 절연층(140)은 안정적으로 발광 구조체(120)의 측면을 덮으므로, 제1 본딩부(211) 및/또는 제2 본딩부(213)가 발광 다이오드 칩(100)의 측면에 접촉하더라도 전기적 문제가 발생하지 않는다. 특히, 광 반사성 절연층(140)은 기판(110)의 노출된 상면까지 연장되어 형성되므로, 발광 구조체(120)의 측면을 더욱 안정적으로 절연시킬 수 있어, 본딩부들(211, 213)과 발광 구조체(120)의 측면을 통한 전기적 쇼트가 방지된다. 또한, 본딩부들(211, 213)이 발광 다이오드 칩(100)에 접촉하는 면적이 증가하여 발광 다이오드 칩(100)이 더욱 안정적으로 실장될 수 있어, 발광 장치의 기계적 안정성이 향상될 수 있다. 나아가, 본딩부들(211, 213)이 발광 다이오드 칩(100)과 제2 기판(300) 사이에 개재되는 두께(즉, 발광 다이오드 칩(100)과 제2 기판(300) 사이의 이격거리)를 감소시킬 수 있으므로, 발광 장치를 더욱 소형화 및 슬림화할 수 있다.As such, at least one of the first bonding portion 211 and the second bonding portion 213 is formed to contact at least a part of the side surface of the LED chip 100, so that the first bonding portion 211, The shortest distance D2 between the first pad electrode 151 and the second pad electrode 153 may be smaller than the shortest distance D1 between the first pad electrode 151 and the second pad electrode 153. [ Therefore, even if D 1 is relatively small (for example, about 3 탆 to 20 탆), D 2 can be formed to be larger than D 1, thereby preventing electrical shorts from occurring during mounting of the light emitting diode chip 100. The first bonding portion 211 and / or the second bonding portion 213 are formed on the side of the light emitting structure 120 in a stable manner, Electrical contact does not occur even when the chip 100 contacts the side surface. In particular, since the light reflective insulating layer 140 is formed to extend to the exposed upper surface of the substrate 110, the side surface of the light emitting structure 120 can be more stably insulated, and the bonding portions 211 and 213, Electrical shorting is prevented through the side surface of the semiconductor substrate 120. In addition, the area of contact of the bonding parts 211 and 213 with the light emitting diode chip 100 increases, so that the light emitting diode chip 100 can be more stably mounted, and the mechanical stability of the light emitting device can be improved. The thickness of the bonding portions 211 and 213 interposed between the light emitting diode chip 100 and the second substrate 300 (that is, the distance between the light emitting diode chip 100 and the second substrate 300) It is possible to make the light emitting device more compact and slimmer.

도 5a 내지 도 10b는 본 발명의 또 다른 실시예에 따른 발광 다이오드 칩(100)의 제조 방법을 설명하기 위한 평면도들 및 단면도들이다. 5A and 10B are a plan view and a cross-sectional view illustrating a method of manufacturing the LED chip 100 according to another embodiment of the present invention.

상술한 실시예들에서 설명한 구성과 실질적으로 동일한 구성에 대한 상세한 설명은 생략한다. 또한, 후술하는 실시예의 도면들에서, 두 개의 발광 다이오드 칩(100)을 제조하는 방법에 대해 도시하나, 본 발명은 이에 한정되지 않는다. 단일의 발광 다이오드 칩(100)을 제조하는 경우 및 대면적 웨이퍼 상에 세 개 이상의 복수의 발광 다이오드 칩(100)들을 형성하는 경우에도 후술하는 실시예들에 따른 발광 다이오드 칩(100)의 제조 방법이 적용될 수 있다. 각 도면들에 있어서, L1선은 단위 소자 영역(UD1)들의 경계선으로 정의된다. 즉, L1선을 기준으로 양측의 발광 구조체(120)들은 분리되어 두 개의 발광 다이오드 칩(100)로 제조될 수 있다. 또한, 각각의 단면도들은, 대응하는 평면도에서의 B-B'선에 대응하는 부분의 단면을 도시한다. 예컨대, 도 5a의 B-B'선에 대응하는 부분의 단면은 도 5b에 도시된다.A detailed description of the substantially same components as those described in the above embodiments will be omitted. In addition, in the drawings of the embodiments described later, a method of manufacturing two LED chips 100 is shown, but the present invention is not limited thereto. Even when a single LED chip 100 is manufactured and three or more LED chips 100 are formed on a large area wafer, the manufacturing method of the LED chip 100 according to embodiments Can be applied. In each of the figures, the L1 line is defined as the boundary of the unit element regions UD1. That is, the light emitting structures 120 on both sides may be separated from each other with respect to the L1 line to be fabricated as two light emitting diode chips 100. Further, each of the cross-sectional views shows a cross-section of a portion corresponding to line B-B 'in the corresponding plan view. For example, the cross section of the portion corresponding to the line B-B 'in Fig. 5A is shown in Fig. 5B.

도 5a 및 도 5b를 참조하면, 기판(100) 상에 발광 구조체(120)를 형성한다. 발광 구조체(120)는 일반적으로 알려진 다양한 방법을 이용하여 성장될 수 있으며, 예를 들어, MOCVD(Metal Organic Chemical Vapor Deposition), MBE(Molecular Beam Epitaxy) 또는 HVPE(Hydride Vapor Phase Epitaxy) 등의 기술을 이용하여 성장될 수 있다.Referring to FIGS. 5A and 5B, a light emitting structure 120 is formed on a substrate 100. The light emitting structure 120 can be grown using various generally known methods. For example, the light emitting structure 120 may be formed using a technique such as MOCVD (Metal Organic Chemical Vapor Deposition), MBE (Molecular Beam Epitaxy), or HVPE (Hydride Vapor Phase Epitaxy) . ≪ / RTI >

다음, 도 6a 내지 도 7b를 참조하면, 발광 구조체(120)에 적어도 하나의 홀(120h) 및 컨택 전극(130)을 형성한다. 나아가, 발광 구조체(120)를 부분적으로 제거하여, 기판(110)의 상면을 노출시키는 아이솔레이션 홈(120i)을 형성한다.Next, referring to FIGS. 6A to 7B, at least one hole 120h and a contact electrode 130 are formed in the light emitting structure 120. FIG. Further, the light emitting structure 120 is partly removed to form an isolation groove 120i exposing the upper surface of the substrate 110. [

구체적으로 먼저, 도 6a 및 도 6b를 참조하면, 발광 구조체(120) 상에 컨택 전극(130)을 형성한다.Specifically, first, referring to FIGS. 6A and 6B, a contact electrode 130 is formed on the light emitting structure 120.

컨택 전극(130)은 발광 구조체(120)의 제2 도전형 반도체층(125) 상에 형성되어, 제2 도전형 반도체층(125)과 오믹 컨택을 형성할 수 있다. 컨택 전극(130)은 광 투과성 도전성 산화물 및/또는 광 투과성 금속을 포함할 수 있다. 예컨대, 컨택 전극(130)을 형성하는 것은, 스퍼터링 및/또는 전자성 증착과 같은 증착 방법을 잉용하여 제2 도전형 반도체층(125) 상에 ITO를 형성하는 것을 포함할 수 있다. 다만, 본 발명은 이에 한정되지 않으며, 컨택 전극(130)을 형성하는 것은 ZnO 등과 같은 다른 다양한 종류의 광 투과성 도전성 산화물을 형성하는 것을 포함할 수 있으며, 도전성 산화물의 종류에 따라 다양한 제조 공정이 적용될 수 있다.The contact electrode 130 may be formed on the second conductive semiconductor layer 125 of the light emitting structure 120 to form an ohmic contact with the second conductive semiconductor layer 125. The contact electrode 130 may comprise a light transmissive conductive oxide and / or a light transmissive metal. For example, forming the contact electrode 130 may include forming ITO on the second conductivity type semiconductor layer 125 by using a deposition method such as sputtering and / or electron deposition. However, the present invention is not limited thereto. The formation of the contact electrode 130 may include forming various kinds of light-transmissive conductive oxides such as ZnO, and various manufacturing processes are applied depending on the kind of the conductive oxide .

이어서, 도 7a 및 도 7b를 참조하면, 발광 구조체(120)를 패터닝하여, 제2 도전형 반도체층(125) 및 활성층(123)을 관통하는 적어도 하나의 홈(120h)을 형성한다. 나아가, 발광 구조체(120)를 패터닝하여, 제2 도전형 반도체층(125), 활성층(123) 및 제1 도전형 반도체층(121)을 관통하며 기판(110)의 상면을 노출시키는 아이솔레이션 홈(120i)을 형성한다. 발광 구조체(120)를 패터닝하는 것은, 예컨대, 건식 식각 및/또는 습식 식각 공정을 이용할 수 있다.7A and 7B, the light emitting structure 120 is patterned to form at least one groove 120h passing through the second conductive type semiconductor layer 125 and the active layer 123. Next, as shown in FIG. The light emitting structure 120 may be patterned to form an isolation groove (not shown) through the second conductive semiconductor layer 125, the active layer 123, and the first conductive semiconductor layer 121 to expose the upper surface of the substrate 110 120i. The patterning of the light emitting structure 120 can be performed, for example, using a dry etching and / or a wet etching process.

아이솔레이션 홈(120i)에 의해, 발광 구조체(120)는 각 단위 소자 영역(UD1) 상에 위치하는 복수의 발광 구조체(120)들로 분할된다. 따라서, 아이솔레이션 홈(120i)은 L1선을 따라 형성될 수 있다. 이와 같이, 아이솔레이션 홈(120i)을 형성하여 발광 구조체(120)를 복수의 단위 소자 영역(UD1) 상에 위치하는 복수의 발광 구조체(120)들로 분할함으로써, 기판(110)과 발광 구조체(120) 간의 열팽창계수 차이로 발생하는 스트레스가 완화될 수 있다. 이에 따라, 발광 다이오드 칩(100) 제조 시 발생하는 웨이퍼의 보우잉(bowing)을 감소시킬 수 있다.By the isolation groove 120i, the light emitting structure 120 is divided into a plurality of light emitting structures 120 located on each unit element region UD1. Therefore, the isolation groove 120i can be formed along the L1 line. In this manner, the isolation trench 120i is formed and the light emitting structure 120 is divided into a plurality of the light emitting structures 120 located on the plurality of unit element regions UD1, so that the substrate 110 and the light emitting structure 120 ) Can be relieved due to the difference in thermal expansion coefficient. Accordingly, it is possible to reduce the bowing of the wafer that occurs when the light emitting diode chip 100 is manufactured.

컨택 전극(130)은 패터닝될 수 있으며, 컨택 전극(130)을 패터닝하는 것은 적어도 하나의 홈(120h)을 노출시키는 제1 개구부(130a)를 형성하는 것을 포함할 수 있다. 나아가, 컨택 전극(130)을 패터닝하는 것은 제2 도전형 반도체층(125)을 부분적으로 노출시키는 제2 개구부(130b)를 형성하는 것을 더 포함할 수 있다. 컨택 전극(130)을 패터닝하는 것은, 예컨대, 건식 식각 및/또는 습식 식각 공정을 이용할 수 있다.The contact electrode 130 may be patterned and patterning the contact electrode 130 may include forming a first opening 130a exposing at least one groove 120h. In addition, patterning the contact electrode 130 may further include forming a second opening 130b that partially exposes the second conductive type semiconductor layer 125. Patterning of the contact electrode 130 can be performed, for example, using a dry etching and / or a wet etching process.

상술한 실시예에서, 컨택 전극(130)을 먼저 형성하고 발광 구조체(120)를 패터닝하는 것으로 설명하였으나, 본 발명이 이에 한정되는 것은 아니다. 다양한 실시예들에서, 발광 구조체(120)를 먼저 패터닝한 후, 제2 도전형 반도체층(125) 상에 컨택 전극(130)을 형성할 수도 있다.In the above-described embodiment, the contact electrode 130 is formed first and the light emitting structure 120 is patterned. However, the present invention is not limited thereto. In various embodiments, the contact electrode 130 may be formed on the second conductive semiconductor layer 125 after the light emitting structure 120 is patterned first.

이어서, 도 8a 및 도 8b를 참조하면, 발광 구조체(120)의 상면 및 측면을 덮되, 제3 개구부(140a) 및 제4 개구부(140b)를 포함하는 광 반사성 절연층(140)을 형성한다.Next, referring to FIGS. 8A and 8B, a light reflective insulating layer 140 covering the upper surface and the side surface of the light emitting structure 120, including the third opening 140a and the fourth opening 140b, is formed.

광 반사성 절연층(140)을 형성하는 것은, 굴절률이 서로 다른 물질이 교대로 적층된 분포 브래그 반사기를 형성하는 것을 포함할 수 있다. 예를 들어, 광 반사성 절연층(140)을 형성하는 것은, 스퍼터링과 같은 공지의 증착 방법을 이용하여 SiO2층과 TiO2층을 교대로 반복 적층하는 것을 포함할 수 있다. 또한, 광 반사성 절연층(140)을 형성하는 것은, 발광 구조체(120)의 상면과 측면, 및 아이솔레이션 홈(120i)을 덮는 분포 브래그 반사기를 형성하고, 상기 분포 브래그 반사기를 패터닝하여 제3 개구부(140a), 제4 개구부(140b)를 형성함과 아울러, 아이솔레이션(120i) 홈의 기판(110)의 상면을 노출시킬 수 있다. 따라서, 일 단위 소자 영역(UD1)의 발광 구조체(120)를 덮는 광 반사성 절연층(140)은 인접하는 다른 단위 소자 영역(UD1)의 발광 구조체(120)를 덮는 광 반사성 절연층(140)과 서로 이격된다.Forming the light reflective insulating layer 140 may include forming distributed Bragg reflectors in which materials having different refractive indices are alternately stacked. For example, the formation of the light reflective insulating layer 140 may include alternately repeating deposition of a SiO 2 layer and a TiO 2 layer using a known deposition method such as sputtering. The formation of the light reflective insulating layer 140 is achieved by forming a distributed Bragg reflector covering the top and sides of the light emitting structure 120 and the isolation groove 120i and patterning the distributed Bragg reflector to form a third opening 140a and a fourth opening 140b and expose an upper surface of the substrate 110 in the isolation 120i groove. The light reflecting and insulating layer 140 covering the light emitting structure 120 of the one unit element region UD1 includes a light reflecting insulating layer 140 covering the light emitting structure 120 of the adjacent unit element region UD1, They are separated from each other.

다음, 도 9a 및 도 9b를 참조하면, 광 반사성 절연층(140) 상에 제1 패드 전극(151) 및 제2 패드 전극(153)을 형성할 수 있다. 9A and 9B, a first pad electrode 151 and a second pad electrode 153 may be formed on the light reflective insulating layer 140. Referring to FIG.

제1 패드 전극(151)은 광 반사성 절연층(140)의 제3 개구부(140a)를 통해 제1 도전형 반도체층(121)과 접촉될 수 있으며, 오믹 컨택할 수 있다. 이와 유사하게, 제2 패드 전극(153)은 광 반사성 절연층(140)의 제4 개구부(140b)를 통해 컨택 전극(130)과 접촉 및 전기적으로 연결될 수 있다. 제1 및 제2 패드 전극(151, 153)은 동일 공정으로 함께 형성될 수 있으며, 예를 들어, 증착 및/또는 도금 공정을 통해 형성된 후, 사진/식각 기술 또는 리프트 오프 기술을 통해 패터닝될 수 있다.The first pad electrode 151 may be in contact with the first conductive semiconductor layer 121 through the third opening 140a of the light reflective insulating layer 140 and may be in ohmic contact. Similarly, the second pad electrode 153 may be in contact with and electrically connected to the contact electrode 130 through the fourth opening 140b of the light reflective insulating layer 140. The first and second pad electrodes 151 and 153 may be formed together in the same process and may be patterned through a photo / etch technique or a lift-off technique after being formed, for example, through a deposition and / have.

이어서, 도 10a 및 도 10b를 참조하면, 기판(110)의 일부분(110a)을 제거함으로써, 기판(110)의 두께를 감소시킬 수 있다. 이에 따라, 복수의 단위 소자 영역(UD1)의 두께가 T1만큼 얇아질 수 있다. 이 후, L1을 따라 기판(110)을 분할함으로써, 도 1 내지 도 3에 도시된 바와 같은 복수의 발광 다이오드 칩(100)이 제공될 수 있다.10A and 10B, it is possible to reduce the thickness of the substrate 110 by removing the portion 110a of the substrate 110. FIG. Thus, the thickness of the plurality of unit element regions UD1 can be made thinner by T1. Thereafter, by dividing the substrate 110 along the line L1, a plurality of light emitting diode chips 100 as shown in Figs. 1 to 3 can be provided.

기판(110)의 일부분(110a)을 제거하는 것은, 물리적 및/또는 화학적 방법을 통해 기판(110)을 부분적으로 제거하는 것을 포함할 수 있다. 예를 들어, 기판(110)은 래핑, 그라인딩 등의 방법을 이용하여 부분적으로 제거될 수 있다. 기판(110)의 두께를 감소시키면, 열 팽창 계수 차이로 인하여 웨이퍼가 보우잉된 상태에서 웨이퍼를 지지하는 기판(110)이 얇아짐으로써 스트레스가 증가한다. 이에 따라, 발광 구조체(120)에 인가되는 스트레스가 증가하여 발광 구조체(120)에 손상이 발생할 가능성이 높다. 그러나 본 실시예에 따르면, 기판(110)의 두께를 감소시키기 전에, 발광 구조체(120)를 복수의 발광 구조체(120)로 분할하는 아이솔레이션 홈(120i)을 형성함으로써, 보우잉을 완화시키고, 스트레스를 완화시켜 기판(110)의 두께 감소에 의해 발생할 수 있는 발광 구조체(120)의 손상을 방지할 수 있다. 특히, 상대적으로 크기가 작은 단위 소자 영역(UD1)들로 인하여, 스트레스가 더욱 감소될 수 있어, 각 단위 소자 영역(UD1)의 두께는 약 90㎛ 이하의 두께로 감소될 수 있다.Removing a portion 110a of the substrate 110 may include partially removing the substrate 110 through a physical and / or chemical method. For example, the substrate 110 may be partially removed using a method such as lapping, grinding, or the like. Reducing the thickness of the substrate 110 increases the stress by thinning the substrate 110 that supports the wafer while the wafer is bowed due to the difference in thermal expansion coefficient. Accordingly, the stress applied to the light emitting structure 120 increases, and the light emitting structure 120 is more likely to be damaged. However, according to the present embodiment, before the thickness of the substrate 110 is reduced, the isolation groove 120i for dividing the light emitting structure 120 into the plurality of light emitting structures 120 is formed to relax bouling, The damage of the light emitting structure 120, which may occur due to the reduction in the thickness of the substrate 110, can be prevented. In particular, due to the relatively small unit element regions UD1, the stress can be further reduced, and the thickness of each unit element region UD1 can be reduced to a thickness of about 90 mu m or less.

기판(110)을 L1선을 따라 분할하는 것은, 스크라이빙 및 브레이킹 공정을 통해 기판(110)을 분리하는 것을 포함할 수 있다. 이때, 스크라이빙 공정은, 내부 가공 레이저(예컨대, 스텔스 레이저)를 이용하여 기판(110)을 내부 가공하는 것을 포함할 수 있다. 이때, 내부 가공 레이저를 이용하는 경우, 기판(110)의 적어도 일 측면에는 수평 방향으로 연장된 띠 형상을 가지는 적어도 하나의 개질 영역(111)이 형성될 수 있다. Dividing the substrate 110 along the L1 line may include separating the substrate 110 through a scribing and braking process. At this time, the scribing process may include internal processing of the substrate 110 using an internal machining laser (e.g., a stealth laser). At this time, if an internal processing laser is used, at least one modified region 111 having a strip shape extending in the horizontal direction may be formed on at least one side of the substrate 110.

본 실시예에 따르면, 아이솔레이션 홈(120i)이 L1선을 따라 형성되고, 광 반사성 절연층(140)들이 아이솔레이션 홈(120i)이 노출되도록 서로 이격된다. 이에 따라, 기판(110)의 분할 과정에서 레이저 등에 의해 광 반사성 절연층(140)이 영향을 받거나 손상되지 않으므로, 광 반사성 절연층(140)에 의한 광 반사성 절연층(140)의 손상(예컨대, 박리, 깨짐 등)이 방지된다. 특히, 광 반사성 절연층(140)이 분포 브래그 반사기를 포함하는 경우, 광 반사성 절연층(140)이 손상되면 광 반사율이 저하될 수 있다. 본 실시예의 제조 방법에 따르면, 이러한 광 반사성 절연층(140)의 손상으로 인하여 제조된 발광 다이오드 칩(100)의 발광 효율 저하를 방지할 수 있다. According to the present embodiment, the isolation trenches 120i are formed along the L1 line, and the light reflective insulating layers 140 are spaced apart from each other to expose the isolation trenches 120i. Accordingly, since the light-reflective insulating layer 140 is not affected or damaged by laser or the like in the process of dividing the substrate 110, damage to the light-reflective insulating layer 140 by the light-reflective insulating layer 140 (for example, Peeling, breakage, etc.) is prevented. In particular, in the case where the light-reflective insulating layer 140 includes a distributed Bragg reflector, the light reflectance may be lowered if the light-reflective insulating layer 140 is damaged. According to the manufacturing method of the present embodiment, it is possible to prevent a decrease in luminous efficiency of the light emitting diode chip 100 manufactured due to the damage of the light reflective insulating layer 140.

상술한 실시예들에 따른 발광 다이오드 칩(100) 및 발광 장치는 기판(110)의 상면이 노출되는 부분을 포함하여, 발광 다이오드 칩(100)의 제조 과정에서의 웨이퍼 보우잉을 감소시킨다. 이에 따라, 웨이퍼 보우잉의 정도가 비교적 작으므로, 상술한 바와 같이 기판(110)의 두께를 감소시킬 수 있고, 발광 다이오드 칩(100)의 제조 수율을 향상시킬 수 있다. 따라서, 소형화 및 슬림화되고 신뢰성이 높은 발광 다이오드 칩(100) 및 발광 장치가 제공된다. 또한, 광 반사성 절연층(140)이 발광 구조체(120)의 측면을 덮으며 기판(110)의 노출된 상면, 특히, 기판(110)의 돌출부(110p)까지 더 덮도록 연장되어 형성됨으로써, 발광 다이오드 칩(100)의 발광 효율을 향상시킬 수 있다. 또한, 이러한 광 반사성 절연층(140)을 통해 본딩부(211, 213)가 발광 다이오드 칩(100)의 측면까지 덮을 수 있어, 발광 장치가 소형화될 수 있고, 발광 장치의 기계적 안정성이 향상될 수 있다.The light emitting diode chip 100 and the light emitting device according to the above embodiments include a portion where the upper surface of the substrate 110 is exposed to reduce wafer bending in the manufacturing process of the light emitting diode chip 100. Accordingly, since the degree of wafer bake is relatively small, the thickness of the substrate 110 can be reduced as described above, and the yield of manufacturing the light emitting diode chip 100 can be improved. Therefore, a light-emitting diode chip 100 and a light-emitting device which are downsized, slim and highly reliable are provided. The light reflective insulating layer 140 is formed to cover the side surface of the light emitting structure 120 and extend to cover the exposed upper surface of the substrate 110, particularly, the protrusion 110p of the substrate 110, Emitting efficiency of the diode chip 100 can be improved. Also, since the bonding portions 211 and 213 can cover the side surface of the light emitting diode chip 100 through the light reflective insulating layer 140, the light emitting device can be downsized and the mechanical stability of the light emitting device can be improved have.

이와 같이, 실시예들에 따른 발광 장치는 기계적 안정성 및 발광 효율이 우수하고, 소형화 및 슬림화되어 있으므로, 휴대용 전자 장치에 유리하게 적용될 수 있다. 일례로, 얇은 두께가 요구되는 페이퍼 라이팅 보드(paper writing board)에 상기 발광 장치 또는 발광 다이오드 칩(100)이 적용될 수 있다. 또 다른 예로서, 키보드와 같은 입력 장치에 상기 발광 장치가 적용되는 경우, 상기 발광 장치의 키패드의 아래에 위치하여 키패드를 발광시킬 수 있다. 이러한 입력 장치에서, 키패드는 반복적인 외부의 스트레스를 받는다(예를 들어, 입력을 위한 가압). 또한, 휴대용 입력 장치는 얇은 두께 및 작은 크기가 요구된다. 실시예들에 따른 발광 장치는 소형화 및 슬림화되어 있어 슬림한 휴대용 입력 장치에 적합하며, 기계적 안정성이 우수하여 키보드의 작동(예를 들어, 키패드에 가해지는 압력)에 의해 발광 장치의 불량이 발생할 확률이 매우 적다. As described above, the light emitting device according to the embodiments is excellent in mechanical stability and luminous efficiency, and can be advantageously applied to portable electronic devices since it is downsized and slim. For example, the light emitting device or the light emitting diode chip 100 may be applied to a paper writing board requiring a thin thickness. As another example, when the light emitting device is applied to an input device such as a keyboard, the keypad may be positioned below the keypad of the light emitting device. In such an input device, the keypad is subjected to repeated external stresses (e.g., pressure for input). Also, portable input devices are required to be thin and small in size. The light emitting device according to the embodiments is small and slim, and is suitable for a slim portable input device. The light emitting device according to the embodiments is excellent in mechanical stability, so that the probability of a failure of the light emitting device due to the operation of the keyboard (for example, Is very small.

도 11a 내지 도 13은 본 발명의 다른 실시예들에 따른 전자 장치를 설명하기 위한 사시도, 평면도, 단면도 및 회로도이다. 도 12는 키패드들(440) 중 각 단위 키패드(440u)를 설명하기 위한 단면도이고, 도 13은 키패드(440u)의 동작에 따른 발광부(460)의 동작의 예시를 설명하기 위한 회로도이다.11A to 13 are a perspective view, a plan view, a sectional view, and a circuit diagram for explaining an electronic device according to another embodiment of the present invention. 12 is a sectional view for explaining each unit keypad 440u of the keypads 440 and FIG. 13 is a circuit diagram for explaining an example of the operation of the light emitting unit 460 according to the operation of the keypad 440u.

도 11a를 참조하면, 전자 장치(10)는 입력 장치(400)를 포함한다. 예컨대, 전자 장치(10)는 도 11a에 도시된 바와 같은, 노트북 컴퓨터일 수 있고, 입력 장치(400)는 키보드일 수 있다. 상기 전자 장치(10)는 기본 프레임을 구성하는 하우징(12), 디스플레이(10) 및 입력 장치(400)를 포함할 수 있다. 이때, 입력 장치(400)는 전자 장치(10)와 일체로 형성될 수 있다. 한편, 다양한 실시예에서, 입력 장치(400)는 별로도 분리될 수도 있다. 도 11b에 도시된 바와 같이, 입력 장치(400)는 개별적으로 전자 장치를 구성할 수도 있다. 다만, 본 실시예의 전자 장치(10)는 일례에 해당하며, 입력 장치(400)를 포함하는 경우이면 본 발명의 발광 다이오드 칩 및/또는 발광 장치가 적용될 수 있다. 예컨대, 입력 장치(400)를 포함하는 데스크톱 컴퓨터, 검출 기기, 통신 기기 등 다양한 전자 장치들이 본 발명에 포함될 수 있다.Referring to FIG. 11A, the electronic device 10 includes an input device 400. For example, the electronic device 10 may be a notebook computer, as shown in FIG. 11A, and the input device 400 may be a keyboard. The electronic device 10 may include a housing 12, a display 10, and an input device 400 constituting a basic frame. At this time, the input device 400 may be formed integrally with the electronic device 10. Meanwhile, in various embodiments, the input device 400 may be separate as well. As shown in FIG. 11B, the input device 400 may separately constitute an electronic device. However, the electronic device 10 of the present embodiment corresponds to an example, and the light emitting diode chip and / or the light emitting device of the present invention can be applied as long as the electronic device includes the input device 400. For example, various electronic devices such as a desktop computer, a detection device, a communication device, and the like including the input device 400 may be included in the present invention.

도 11a 및 도 11b에 도시된 바와 같이, 입력 장치(400)는 키패드(440) 및 발광부(460)를 포함하고, 나아가, 하우징(12 또는 410), 입력 구조물(420), 백라이트(430)를 더 포함할 수 있다.11A and 11B, the input device 400 includes a keypad 440 and a light emitting portion 460 and further includes a housing 12 or 410, an input structure 420, a backlight 430, As shown in FIG.

하우징(12 또는 410)은 입력 장치(400)의 외부 프레임을 구성할 수 있으며, 입력 구조물(420), 백라이트(430) 및 키패드(440)를 지지하는 역할을 한다. 입력 구조물(420)은 사용자의 키패드(440) 컨트롤에 따른 다양한 입력 신호를 수신 및 송신하는 역할을 할 수 있다. 입력 구조물(420)은 키패드(440)들의 아래에 위치할 수 있으며, 다양한 공지의 구조를 가질 수 있다. 백라이트(430)는 키보드와 같은 입력 장치(400)의 시감도를 향상시키기 위해 및/또는 입력 장치(400)에 추가적인 기능성을 제공하기 위해 아래로부터 키패드(440)를 조명할 수 있다. 백라이트(430)는 상술한 실시예들에 따른 발광 다이오드 칩 및/또는 발광 장치를 포함할 수 있다. 백라이트(430)는 키패드(440)들을 둘러싸는 형태로 배치될 수도 있고, 이와 달리, 키패드(440)들의 아래에 배치될 수도 있다. 다만, 백라이트(430)는 생략될 수도 있다.The housing 12 or 410 may constitute an outer frame of the input device 400 and serves to support the input structure 420, the backlight 430 and the keypad 440. The input structure 420 may serve to receive and transmit various input signals according to the control of the user's keypad 440. The input structure 420 may be located below the keypads 440 and may have a variety of known structures. The backlight 430 may illuminate the keypad 440 from below to enhance the visibility of the input device 400, such as a keyboard, and / or to provide additional functionality to the input device 400. The backlight 430 may include a light emitting diode chip and / or a light emitting device according to the above-described embodiments. The backlight 430 may be disposed to surround the keypads 440, or alternatively may be disposed below the keypads 440. However, the backlight 430 may be omitted.

일 실시예에서, 발광부(460)는 복수의 키패드(440)들 중 적어도 하나의 키패드(440)의 아래에 위치할 수 있다. 이때, 키패드(440)는 표면에 형성된 발광 영역을 포함할 수 있으며, 발광부(460)에서 방출된 광은 키패드(440)의 발광 영역을 통해 방출될 수 있다. 도 12를 참조하면, 단위 키패드(440)는 회로 기판(411) 상에 위치하며, 지지부(450)에 의해 지지된다. 이때, 회로 기판(411)과 지지부(450)는 입력 구조물(420)에 포함될 수 있으며, 사용자가 키패드(440)에 신호(예컨대, 압력 또는 터치를 통한 입력)를 전달하면, 지지부(450)와 회로 기판(411)을 통해 상기 신호가 입력될 수 있다. 발광부(460)는 회로 기판(411) 상에 위치하며, 키패드(440)의 아래에 위치할 수 있다. 발광부(460)는 키패드(440)의 입력 신호에 따라 온/오프가 제어될 수 있다. 예를 들어, 도 13에 도시된 바와 같이, 키패드(440)의 입력 신호에 따라 스위치(SWkey)가 온/오프될 수 있고, 이에 따라 회로의 저항(Rkey)이 연결 또는 개방되어 발광부(460)에 인가되는 전류가 제어된다. 이와 같은 동작을 통해, 사용자가 키패드(440)에 압력을 가하여 신호가 입력되면, 발광부(460)가 온(on) 상태로 동작함으로써, 압력을 받아 입력되는 키패드(440)들의 발광 영역을 통해 광이 방출될 수 있다. 다만, 본 발명이 이에 한정되는 것은 아니며, 다양한 실시예들이 가능하다. 다른 실시예들로서, 발광부(460)는 상시 온(on) 상태로 유지하되, 사용자가 키패드(440)에 압력을 가하여 신호가 입력되면, 발광부(460)가 오프(off) 상태로 동작함으로써, 키패드(440)들의 발광 영역이 암전되는 형태로 구동될 수도 있다. 또한 다른 실시예들로서, 사용자가 키패드(440)에 압력을 가하여 신호가 입력되면, 발광부(460)의 광도가 가변적으로 변하도록 동작함으로써, 압력을 받아 입력되는 키패드(440)들의 발광 영역의 광도가 변화하는 형태로 구동될 수도 있다.In one embodiment, the light emitting portion 460 may be located below the keypad 440 of at least one of the plurality of keypads 440. At this time, the keypad 440 may include a light emitting region formed on the surface, and the light emitted from the light emitting portion 460 may be emitted through the light emitting region of the keypad 440. Referring to FIG. 12, the unit keypad 440 is positioned on the circuit board 411 and supported by the support unit 450. The circuit board 411 and the support 450 may be included in the input structure 420. When the user transmits a signal (e.g., pressure or touch input) to the keypad 440, The signal can be input through the circuit board 411. [ The light emitting portion 460 is located on the circuit board 411 and may be located under the keypad 440. [ The light emitting portion 460 can be turned on / off according to an input signal of the keypad 440. For example, as shown in FIG. 13, the switch SW key can be turned on / off according to an input signal of the keypad 440, whereby the resistance R key of the circuit is connected or opened, (460) is controlled. When the user presses the keypad 440 to input a signal, the light emitting unit 460 is operated in an ON state, so that the user can press the keypad 440 through the light emitting area of the keypad 440, Light can be emitted. However, the present invention is not limited thereto, and various embodiments are possible. In other embodiments, the light emitting unit 460 is kept in an on state, and when a user applies a pressure to the keypad 440 to input a signal, the light emitting unit 460 operates in an off state And the light emitting area of the keypad 440 may be turned on. In other embodiments, when the user applies a pressure to the keypad 440 to input a signal, the brightness of the light emitting portion 460 is varied to change the brightness of the light emitting region of the keypad 440, May be driven in such a manner as to vary.

이러한 키패드(440)의 아래에 위치하는 발광부(460)는 상술한 실시예들에서 설명한 발광 다이오드 칩 및/또는 발광 장치를 포함할 수 있다. 전자 기기의 슬림화 및 소형화에 따라, 입력 장치(400)의 매우 얇은 두께가 요구되므로, 소형 발광 다이오드 칩 및/또는 소형 발광 장치가 적용될 수 있다. 특히, 휴대용 키보드와 같은 입력 장치, 경량 노트북과 같은 전자 장치의 입력 장치에 본 발명의 소형 발광 다이오드 칩 및/또는 소형 발광 장치를 적용함으로써, 발광부(460)의 크기 증가에 따른 전자 장치의 부피를 증가를 방지할 수 있어, 상기 전자 장치들의 휴대성을 향상시킬 수 있다. 또한, 키패드(440)의 아래에 위치하는 발광부(460)는 키패드(440)의 입력에 따라 지속적인 스트레스를 받고, 이러한 스트레스는 발광부(460)의 발광 장치 또는 발광 다이오드 칩(100)에 전달되어 발광부(460)의 불량을 일으킬 수 있다. 그러나 상기 입력 장치(400)는 기계적 안정성이 우수한 본 실시예들의 발광 다이오드 칩(100) 또는 발광 장치를 포함하므로, 키패드(440)의 지속적인 동작에 따른 발광부(460)의 불량을 방지할 수 있다.The light emitting portion 460 positioned below the keypad 440 may include the light emitting diode chip and / or the light emitting device described in the above embodiments. Because of the slimness and miniaturization of the electronic device, a very thin thickness of the input device 400 is required, so that a small light emitting diode chip and / or a small light emitting device can be applied. Particularly, by applying the small light emitting diode chip and / or the small light emitting device of the present invention to an input device of an electronic device such as an input device such as a portable keyboard or a lightweight notebook, the volume of the electronic device It is possible to improve the portability of the electronic devices. The light emitting portion 460 located under the keypad 440 is subjected to continuous stress according to the input of the keypad 440 and the stress is transmitted to the light emitting device of the light emitting portion 460 or the light emitting diode chip 100 So that the light emitting portion 460 may be defective. However, since the input device 400 includes the light emitting diode chip 100 or the light emitting device according to the embodiments having excellent mechanical stability, it is possible to prevent the failure of the light emitting portion 460 due to the continuous operation of the keypad 440 .

상술한 실시예에서, 본 발명의 다양한 실시예들에 따른 발광 다이오드 칩 및/또는 발광 장치가 전자 장치의 입력 장치에 적용된 경우를 설명하였으나, 본 발명은 이에 한정되지 않는다. 상기 발광 다이오드 칩 및/또는 발광 장치는 소형 발광부가 요구되는 다른 다양한 전자 장치에도 적용될 수 있으며, 예를 들어, 조명 기기, 디스플레이 장치 등에도 적용될 수 있다.In the above-described embodiments, the light emitting diode chip and / or the light emitting device according to various embodiments of the present invention are applied to the input device of the electronic device, but the present invention is not limited thereto. The light emitting diode chip and / or light emitting device may be applied to various other electronic devices requiring a small light emitting portion, and may be applied to, for example, a lighting device, a display device, and the like.

Claims (21)

상면에 형성된 복수의 돌출부들을 포함하는 기판;
상기 기판 상에 위치하며, 제1 도전형 반도체층, 상기 제1 도전형 반도체층 상에 위치하는 제2 도전형 반도체층, 및 상기 제1 및 제2 도전형 반도체층의 사이에 위치하는 활성층을 포함하고, 상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부를 노출시키는 적어도 하나의 홀을 포함하는 발광 구조체;
상기 제2 도전형 반도체층 상에 적어도 부분적으로 위치하며, 상기 제2 도전형 반도체층에 오믹 컨택하는 광 투과성 도전성 산화물을 포함하는 컨택 전극;
상기 발광 구조체의 측면 및 상면을 덮으며, 상기 홀을 통해 노출된 제1 도전형 반도체층을 노출시키는 제1 개구부 및 상기 컨택 전극을 부분적으로 노출시키는 제2 개구부를 포함하며, 분포 브래그 반사기를 포함하는 광 반사성 절연층;
상기 광 반사성 절연층 상에 위치하며, 상기 제1 개구부를 통해 상기 제1 도전형 반도체층과 전기적으로 연결된 제1 패드 전극; 및
상기 광 반사성 절연층 상에 위치하며, 상기 제2 개구부를 통해 상기 컨택 전극과 전기적으로 연결된 제2 패드 전극을 포함하고,
상기 기판 상면의 일부는 상기 발광 구조체의 주변에 노출되고, 상기 광 반사성 절연층은 상기 발광 구조체의 주변에 노출된 기판의 상면과 접하되, 상기 기판의 상부 모서리는 상기 광 반사성 절연층과 이격된 발광 다이오드 칩.
A substrate including a plurality of protrusions formed on an upper surface thereof;
And a second conductivity type semiconductor layer disposed on the substrate and having a first conductivity type semiconductor layer, a second conductivity type semiconductor layer disposed on the first conductivity type semiconductor layer, and an active layer disposed between the first and second conductivity type semiconductor layers, A light emitting structure including at least one hole penetrating the second conductivity type semiconductor layer and the active layer and exposing a part of the first conductivity type semiconductor layer;
A contact electrode at least partially located on the second conductivity type semiconductor layer, the contact electrode comprising a light-transmitting conductive oxide that is in ohmic contact with the second conductivity type semiconductor layer;
A first opening exposing the first conductive type semiconductor layer exposed through the hole, and a second opening partially exposing the contact electrode, the second opening including a distributed Bragg reflector A light-reflective insulating layer;
A first pad electrode located on the light reflective insulating layer and electrically connected to the first conductivity type semiconductor layer through the first opening; And
And a second pad electrode located on the light reflective insulating layer and electrically connected to the contact electrode through the second opening,
Wherein a part of the upper surface of the substrate is exposed to the periphery of the light emitting structure and the light reflecting insulating layer contacts the upper surface of the substrate exposed in the periphery of the light emitting structure, Light emitting diode chip.
청구항 1에 있어서,
상기 발광 다이오드 칩의 두께는 40㎛ 이상 90㎛ 이하인 발광 다이오드 칩.
The method according to claim 1,
Wherein the thickness of the light emitting diode chip is 40 占 퐉 or more and 90 占 퐉 or less.
청구항 1에 있어서,
상기 발광 다이오드 칩의 수평 단면적은 30000㎛2 이상 65000㎛2 이하인 발광 다이오드 칩.
The method according to claim 1,
Horizontal cross-sectional area of the LED chip 2 is 30000㎛ 65000㎛ least 2 than the light emitting diode chip.
청구항 1에 있어서,
상기 발광 다이오드 칩의 구동 전류의 전류 밀도는 7mA/mm2 이상 250mA/mm2 이하인 발광 다이오드 칩.
The method according to claim 1,
The current density of the driving current of the LED chip is 7mA / mm 2 or more 250mA / mm 2 or less light emitting diode chip.
청구항 1에 있어서,
상기 제1 패드 전극 및 상기 제2 패드 전극의 면적의 합은, 상기 발광 다이오드 칩의 수평 면적의 80% 이상 95% 이하인 발광 다이오드 칩.
The method according to claim 1,
Wherein the sum of the areas of the first pad electrode and the second pad electrode is 80% or more and 95% or less of the horizontal area of the LED chip.
청구항 5에 있어서,
상기 제1 패드 전극 및 제2 패드 전극의 최단 이격거리는 3㎛ 내지 20㎛인 발광 다이오드 칩.
The method of claim 5,
And the shortest distance between the first pad electrode and the second pad electrode is 3 占 퐉 to 20 占 퐉.
청구항 1에 있어서,
상기 기판의 상면에 노출된 돌출부들 중 일부는 상기 광 반사성 절연층에 덮이는 발광 다이오드 칩.
The method according to claim 1,
Wherein a part of protrusions exposed on an upper surface of the substrate is covered with the light reflective insulating layer.
청구항 7에 있어서,
상기 기판의 상면에 노출된 돌출부들 중 나머지 일부는 노출되는 발광 다이오드 칩.
The method of claim 7,
And a remaining portion of the protrusions exposed on an upper surface of the substrate is exposed.
청구항 1에 있어서,
상기 컨택 전극은 상기 제2 도전형 반도체층의 상면을 덮되, 상기 발광 구조체의 홀을 노출시키는 제3 개구부, 및 상기 제2 도전형 반도체층을 부분적으로 노출시키는 적어도 하나의 제4 개구부를 포함하는 발광 다이오드 칩.
The method according to claim 1,
The contact electrode includes a third opening covering the upper surface of the second conductive semiconductor layer and exposing a hole of the light emitting structure and at least one fourth opening partially exposing the second conductive semiconductor layer Light emitting diode chip.
청구항 9에 있어서,
상기 제4 개구부의 폭은 상기 제2 개구부의 폭보다 작으며, 상기 컨택 전극의 상면의 일부는 상기 제2 패드 전극과 접하는 발광 다이오드 칩.
The method of claim 9,
Wherein a width of the fourth opening is smaller than a width of the second opening, and a portion of an upper surface of the contact electrode contacts the second pad electrode.
청구항 1에 있어서,
상기 기판은 패턴된 사파이어 기판을 포함하는 발광 다이오드 칩.
The method according to claim 1,
Wherein the substrate comprises a patterned sapphire substrate.
청구항 1에 있어서,
상기 제1 패드 전극은 그 상면에 형성되며, 상기 제1 개구부의 위치에 대응하여 위치하는 오목부를 포함하고,
상기 제2 패드 전극은 그 상면에 형성되며, 상기 제2 개구부의 위치에 대응하여 위치하는 오목부를 포함하는 발광 다이오드 칩.
The method according to claim 1,
Wherein the first pad electrode is formed on an upper surface thereof and includes a concave portion corresponding to a position of the first opening,
Wherein the second pad electrode is formed on an upper surface thereof and includes a concave portion corresponding to a position of the second opening.
제2 기판;
상기 제2 기판 상에 위치하는 발광 다이오드 칩; 및
상기 발광 다이오드 칩과 상기 제2 기판의 사이에 위치하는 제1 본딩부 및 제2 본딩부를 포함하고,
상기 발광 다이오드 칩은,
하면에 형성된 복수의 돌출부들을 포함하는 제1 기판;
상기 제1 기판의 아래에 위치하며, 제2 도전형 반도체층, 상기 제2 도전형 반도체층 상에 위치하는 제1 도전형 반도체층, 및 상기 제1 및 제2 도전형 반도체층의 사이에 위치하는 활성층을 포함하고, 상기 제2 도전형 반도체층 및 상기 활성층을 관통하여 상기 제1 도전형 반도체층의 일부를 노출시키는 적어도 하나의 홀을 포함하는 발광 구조체;
상기 제2 도전형 반도체층의 아래에 적어도 부분적으로 위치하며, 상기 제2 도전형 반도체층에 오믹 컨택하는 컨택 전극;
상기 발광 구조체의 측면 및 하면을 덮으며, 상기 홀을 통해 노출된 제1 도전형 반도체층을 노출시키는 제1 개구부 및 상기 컨택 전극을 부분적으로 노출시키는 제2 개구부를 포함하며, 분포 브래그 반사기를 포함하는 광 반사성 절연층;
상기 광 반사성 절연층의 아래에 위치하며, 상기 제1 개구부를 통해 상기 제1 도전형 반도체층과 전기적으로 연결된 제1 패드 전극; 및
상기 광 반사성 절연층 아래에 위치하며, 상기 제2 개구부를 통해 상기 컨택 전극과 전기적으로 연결된 제2 패드 전극을 포함하고,
상기 제1 기판 하면의 일부는 상기 발광 구조체의 주변에 노출되며, 상기 광 반사성 절연층은 상기 발광 구조체의 주변에 노출된 제1 기판의 하면과 접하되, 상기 제1 기판의 하부 모서리는 상기 광 반사성 절연층과 이격되고,
상기 제1 본딩부 및 상기 제2 본딩부는 각각 상기 제1 및 제2 패드 전극에 전기적으로 연결된 발광 장치.
A second substrate;
A light emitting diode chip located on the second substrate; And
A first bonding portion and a second bonding portion positioned between the light emitting diode chip and the second substrate,
The light emitting diode chip includes:
A first substrate including a plurality of protrusions formed on a bottom surface thereof;
A second conductive type semiconductor layer disposed on the first substrate and positioned below the first conductive type semiconductor layer, a first conductive type semiconductor layer located on the second conductive type semiconductor layer, and a second conductive type semiconductor layer disposed between the first and second conductive type semiconductor layers And at least one hole penetrating through the second conductive type semiconductor layer and the active layer and exposing a part of the first conductive type semiconductor layer;
A contact electrode located at least partially below the second conductivity type semiconductor layer and ohmically contacting the second conductivity type semiconductor layer;
A first opening exposing the first conductive type semiconductor layer exposed through the hole and a second opening partially exposing the contact electrode, the first and second openings partially covering the side and the bottom of the light emitting structure, A light-reflective insulating layer;
A first pad electrode located below the light reflective insulating layer and electrically connected to the first conductive type semiconductor layer through the first opening; And
And a second pad electrode located below the light reflective insulating layer and electrically connected to the contact electrode through the second opening,
Wherein a part of the lower surface of the first substrate is exposed to the periphery of the light emitting structure and the light reflecting insulating layer contacts the lower surface of the first substrate exposed in the periphery of the light emitting structure, A reflective insulating layer,
Wherein the first bonding portion and the second bonding portion are electrically connected to the first and second pad electrodes, respectively.
청구항 13에 있어서,
상기 제1 및 제2 본딩부 간의 최단 이격거리는 상기 제1 및 제2 패드 전극 간의 최단 이격거리보다 큰 발광 장치.
14. The method of claim 13,
Wherein a shortest distance between the first and second bonding portions is larger than a shortest distance between the first and second pad electrodes.
청구항 13에 있어서,
상기 제1 본딩부 및 제2 본딩부 중 적어도 하나는 상기 발광 구조체의 측면을 덮는 광 반사성 절연층을 적어도 부분적으로 덮는 발광 장치.
14. The method of claim 13,
Wherein at least one of the first bonding portion and the second bonding portion at least partially covers a light reflective insulating layer covering a side surface of the light emitting structure.
청구항 14에 있어서,
상기 제1 및 제2 본딩부 중 적어도 하나는 상기 발광 구조체의 주변에 노출된 제1 기판의 하면을 적어도 부분적으로 덮는 발광 장치.
15. The method of claim 14,
Wherein at least one of the first and second bonding portions at least partially covers the lower surface of the first substrate exposed in the periphery of the light emitting structure.
청구항 15에 있어서,
상기 제1 및 제2 본딩부 중 적어도 하나는 상기 제1 기판의 측면을 적어도 부분적으로 덮는 발광 장치.
16. The method of claim 15,
And at least one of the first and second bonding portions at least partially covers a side surface of the first substrate.
청구항 12에 있어서,
상기 제1 및 제2 본딩부는 솔더를 포함하는 발광 장치.
The method of claim 12,
Wherein the first and second bonding portions include solders.
입력 장치를 포함하는 전자 장치에 있어서,
청구항 1 내지 청구항 12에 따른 발광 다이오드 칩 및 청구항 13 내지 청구항 18에 따른 발광 장치 중 어느 하나를 포함하는 전자 장치.
An electronic device comprising an input device,
An electronic device comprising any one of a light emitting diode chip according to any one of claims 1 to 12 and a light emitting device according to any one of claims 13 to 18.
청구항 19에 있어서,
상기 입력 장치는 복수의 키패드를 포함하고,
상기 복수의 키패드는 그 상면에 형성된 발광 영역을 포함하며, 상기 발광 영역으로부터 방출되는 광은 상기 발광 다이오드 칩 또는 상기 발광 장치로부터 방출된 광인 전자 장치.
The method of claim 19,
Wherein the input device includes a plurality of keypads,
Wherein the plurality of keypads include a light emitting region formed on an upper surface thereof, and light emitted from the light emitting region is light emitted from the light emitting diode chip or the light emitting device.
청구항 19에 있어서,
상기 입력 장치는 복수의 키패드를 포함하고,
상기 복수의 키패드는 그 상면에 형성된 발광 영역을 포함하며, 상기 복수의 키패드 중 적어도 일부의 아래에는 상기 발광 다이오드 칩이 위치하고,
상기 발광 다이오드 칩 또는 상기 발광 장치로부터 방출된 광은 상기 발광 영역을 통해 방출되는 전자 장치.
The method of claim 19,
Wherein the input device includes a plurality of keypads,
Wherein the plurality of keypads includes a light emitting area formed on an upper surface thereof, the light emitting diode chip is positioned under at least a part of the plurality of keypads,
Wherein the light emitted from the light emitting diode chip or the light emitting device is emitted through the light emitting region.
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