KR20120063340A - 3차원 구조의 멀티코어 프로세서의 온도 조절 방법 및 그 방법을 이용한 3차원 구조의 멀티코어 프로세서 시스템 - Google Patents
3차원 구조의 멀티코어 프로세서의 온도 조절 방법 및 그 방법을 이용한 3차원 구조의 멀티코어 프로세서 시스템 Download PDFInfo
- Publication number
- KR20120063340A KR20120063340A KR1020100124463A KR20100124463A KR20120063340A KR 20120063340 A KR20120063340 A KR 20120063340A KR 1020100124463 A KR1020100124463 A KR 1020100124463A KR 20100124463 A KR20100124463 A KR 20100124463A KR 20120063340 A KR20120063340 A KR 20120063340A
- Authority
- KR
- South Korea
- Prior art keywords
- operating frequency
- processor
- temperature
- processor core
- level
- Prior art date
Links
- 238000000034 method Methods 0.000 title claims abstract description 43
- 230000007423 decrease Effects 0.000 claims description 6
- 238000012545 processing Methods 0.000 description 4
- 230000033228 biological regulation Effects 0.000 description 2
- 238000001816 cooling Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000008901 benefit Effects 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000009977 dual effect Effects 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 230000008569 process Effects 0.000 description 1
- 238000011160 research Methods 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/04—Generating or distributing clock signals or signals derived directly therefrom
- G06F1/08—Clock generators with changeable or programmable clock frequency
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/16—Constructional details or arrangements
- G06F1/20—Cooling means
- G06F1/206—Cooling means comprising thermal management
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Human Computer Interaction (AREA)
- Microcomputers (AREA)
Abstract
Description
도 2는 일반적인 2차원 구조의 멀티코어 프로세서의 온도 조절 방법의 일례를 설명하기 위한 도면,
도 3은 본 발명의 일 실시예에 따른 3차원 구조의 멀티코어 프로세서 시스템을 보여주는 도면,
도 4는 본 발명의 일 실시예에 따른 3차원 구조의 멀티코어 프로세서의 온도 조절방법을 설명하기 위한 도면이다.
평균온도 | 높음<------------------------------------------>낮음 | |||
동작 주파수 레벨 | 레벨 1 | 레벨 2 | 레벨 3 | 레벨 4 |
제1 프로세서 코어의 동작 주파수 | 0.5GHz | 1.5GHz | 2.5GHz | 3.5GHz |
제2 프로세서 코어의 동작 주파수 | 4.5GHz | 3.5GHz | 2.5GHz | 1.5GHz |
110:제1 프로세서 코어 110a:관통전극
120:제2 프로세서 코어 130:방열판
Claims (7)
- 적어도 두 개의 프로세서 코어가 방열판에 적층되는 3차원 구조의 멀티코어 프로세서의 온도 조절 방법에 있어서,
온도의 상승 또는 하강에 따라 상기 프로세서 코어들이 동작해야하는 동작 주파수를 설정하되, 상기 프로세서 코어들 중 방열판에 가까운 프로세서 코어인 제1 프로세서 코어의 동작 주파수는 온도가 상승할수록 상승하도록 설정하고, 상기 제1 프로세서 코어보다 상기 방열판에서 먼 프로세서인 제2 프로세서 코어의 동작 주파수는 온도가 상승할수록 하강하도록 설정하는 제1단계;
상기 멀티코어 프로세서의 온도를 측정하는 제2단계; 및
상기 멀티코어 프로세서의 현재 온도와 이전에 측정된 이전 온도를 서로 비교하여, 상기 현재 온도가 상기 이전 온도보다 높을 경우, 상기 제1 프로세서 코어의 동작 주파수는 상승시키고 상기 제2 프로세서 코어의 동작 주파수는 하강시키며, 상기 현재 온도가 상기 이전 온도보다 낮을 경우, 상기 제1 프로세서 코어의 동작 주파수는 하강시키고 상기 제2 프로세서 코어의 동작 주파수는 상승시키는 제3단계;를 포함하는 것을 특징으로 하는 3차원 구조의 멀티코어 프로세서의 온도 조절 방법.
- 제 1 항에 있어서,
상기 제1단계는,
상기 프로세서 코어들의 동작 주파수는 상기 동작 주파수들의 정보를 갖는 동작 주파수 레벨들로 설정되고,
상기 각 동작 주파수 레벨에서 상기 제1 프로세서 코어의 동작 주파수는 상기 동작 주파수 레벨이 커질수록 커지고, 상기 제2 프로세서 코어의 동작 주파수는 상기 동작 주파수 레벨이 커질수록 작아지게 설정되되,
상기 각 동작 주파수 레벨에서 상기 제1 프로세서 코어와 상기 제2 프로세서 코어의 동작 주파수의 합은 서로 일정한 것을 특징으로 하는 3차원 구조의 멀티코어 프로세서의 온도 조절 방법.
- 제 2 항에 있어서,
상기 제1 프로세서 코어의 동작 주파수와 상기 제2 프로세서 코어의 동작주파수의 합은 상기 각 동작 주파수 레벨에서 5[GHz]로 일정한 것을 특징으로 하는 3차원 구조의 멀티코어 프로세서의 온도 조절 방법.
- 제 3 항에 있어서,
상기 동작 주파수 레벨은 제1 동작 주파수 레벨, 제2 동작 주파수 레벨, 제3 동작 주파수 레벨 및 제4 동작 주파수 레벨의 네 단계의 주파수 레벨로 설정되고,
상기 제1 동작 주파수 레벨에서 상기 제1 프로세서 코어의 동작 주파수는 4.5[Ghz]이고 상기 제2 프로세서 코어의 동작 주파수는 0.5[GHz]이며,
상기 제2 동작 주파수 레벨에서 상기 제1 프로세서 코어의 동작 주파수는 3.5[Ghz]이고 상기 제2 프로세서 코어의 동작 주파수는 1.5[GHz]이며,
상기 제3 동작 주파수 레벨에서 상기 제1 프로세서 코어의 동작 주파수는 2.5[Ghz]이고 상기 제2 프로세서 코어의 동작 주파수는 2.5[GHz]이며,
상기 제1 동작 주파수 레벨에서 상기 제1 프로세서 코어의 동작 주파수는 1.5[Ghz]이고 상기 제2 프로세서 코어의 동작 주파수는 3.5[GHz]인 것을 특징으로 하는 3차원 구조의 멀티코어 프로세서의 온도 조절 방법.
- 제 2 항에 있어서,
상기 제3단계:는
상기 현재 온도가 상기 이전 온도보다 더 높을 경우, 현재 동작 주파수 레벨보다 한 레벨 더 낮은 동작 주파수 레벨이 존재하는지 판단하며, 상기 한 레벨 더 낮은 동작 주파수 레벨이 존재할 경우, 상기 제1 프로세서 코어 및 상기 제2 프로세서 코어의 동작 주파수를 상기 한 레벨 더 낮은 동작 주파수 레벨의 동작주파수로 동작시키고, 상기 한 레벨 더 낮은 동작 주파수 레벨이 존재하지 않을 경우 상기 현재 동작 주파수 레벨의 동작 주파수로 동작시키는 것을 특징으로 하는 3차원 구조의 멀티코어 프로세서의 온도 조절 방법.
- 제 2 항에 있어서,
상기 제3단계:는
상기 현재 온도가 상기 이전 온도보다 더 낮을 경우, 현재 동작 주파수 레벨보다 한 레벨 더 높은 동작 주파수 레벨이 존재하는지 판단하며, 상기 한 레벨 더 높은 동작 주파수 레벨이 존재할 경우, 상기 제1 프로세서 코어 및 상기 제2 프로세서 코어의 동작 주파수를 상기 한 레벨 더 높은 동작 주파수 레벨의 동작주파수로 동작시키고, 상기 한 레벨 더 높은 동작 주파수 레벨이 존재하지 않을 경우 상기 현재 동작 주파수 레벨의 동작 주파수로 동작시키는 것을 특징으로 하는 3차원 구조의 멀티코어 프로세서의 온도 조절 방법.
- 제 1 항 내지 제 6 항 중 어느 한 항의 3차원 구조의 멀티코어 프로세서의 온도 조절 방법에 의해 온도가 조절되는 3차원 구조의 멀티코어 프로세서 시스템.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020100124463A KR20120063340A (ko) | 2010-12-07 | 2010-12-07 | 3차원 구조의 멀티코어 프로세서의 온도 조절 방법 및 그 방법을 이용한 3차원 구조의 멀티코어 프로세서 시스템 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020100124463A KR20120063340A (ko) | 2010-12-07 | 2010-12-07 | 3차원 구조의 멀티코어 프로세서의 온도 조절 방법 및 그 방법을 이용한 3차원 구조의 멀티코어 프로세서 시스템 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR20120063340A true KR20120063340A (ko) | 2012-06-15 |
Family
ID=46683867
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020100124463A KR20120063340A (ko) | 2010-12-07 | 2010-12-07 | 3차원 구조의 멀티코어 프로세서의 온도 조절 방법 및 그 방법을 이용한 3차원 구조의 멀티코어 프로세서 시스템 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR20120063340A (ko) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9360907B2 (en) | 2012-06-29 | 2016-06-07 | Qualcomm Incorporated | System and method for adaptive thermal management in a portable computing device |
US10042731B2 (en) | 2013-11-11 | 2018-08-07 | Samsung Electronics Co., Ltd. | System-on-chip having a symmetric multi-processor and method of determining a maximum operating clock frequency for the same |
US11399720B2 (en) | 2016-04-05 | 2022-08-02 | Qulacomm Incorporated | Circuits and methods providing temperature mitigation for computing devices |
-
2010
- 2010-12-07 KR KR1020100124463A patent/KR20120063340A/ko not_active Application Discontinuation
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9360907B2 (en) | 2012-06-29 | 2016-06-07 | Qualcomm Incorporated | System and method for adaptive thermal management in a portable computing device |
US10042731B2 (en) | 2013-11-11 | 2018-08-07 | Samsung Electronics Co., Ltd. | System-on-chip having a symmetric multi-processor and method of determining a maximum operating clock frequency for the same |
US11399720B2 (en) | 2016-04-05 | 2022-08-02 | Qulacomm Incorporated | Circuits and methods providing temperature mitigation for computing devices |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US8516426B2 (en) | Vertical power budgeting and shifting for three-dimensional integration | |
US20240195605A1 (en) | Technologies for dynamic accelerator selection | |
US9665115B2 (en) | Reconfigurable power distribution system for three-dimensional integrated circuits | |
US10078359B2 (en) | Method, system, and apparatus for dynamic thermal management | |
US20190065172A1 (en) | Technologies for configuration-free platform firmware | |
CN110060963A (zh) | 用于将电力和热管理集成到集成电路中的系统和方法 | |
US8907462B2 (en) | Integrated circuit package | |
US10375820B2 (en) | Crosstalk reduction between signal layers in a multilayered package by variable-width mesh plane structures | |
US20070136617A1 (en) | Semiconductor integrated circuit | |
Zhao et al. | Optimizing GPU energy efficiency with 3D die-stacking graphics memory and reconfigurable memory interface | |
US8560141B2 (en) | Management of a 3D package and cooling system | |
TW201719643A (zh) | 用於熱電記憶體溫度控制之系統及方法 | |
US20170046079A1 (en) | Read distribution in a three-dimensional stacked memory based on thermal profiles | |
Agrawal et al. | Xylem: Enhancing vertical thermal conduction in 3D processor-memory stacks | |
US20110295443A1 (en) | Managing an infrastructure having a 3d package and cooling resource actuators | |
KR20120063340A (ko) | 3차원 구조의 멀티코어 프로세서의 온도 조절 방법 및 그 방법을 이용한 3차원 구조의 멀티코어 프로세서 시스템 | |
Eris et al. | Leveraging thermally-aware chiplet organization in 2.5 D systems to reclaim dark silicon | |
Al Faruque et al. | Runtime thermal management using software agents for multi-and many-core architectures | |
US9900424B2 (en) | Chip aware thermal policy | |
US8143932B2 (en) | Grid clock distribution network reducing clock skew and method for reducing the same | |
US9412718B2 (en) | 3-D stacked and aligned processors forming a logical processor with power modes controlled by respective set of configuration parameters | |
TW202312372A (zh) | 用於半導體晶片平面網格陣列封裝體及冷卻總成維持之圖形化承板及複合式背板 | |
US10461011B2 (en) | Microelectronics package with an integrated heat spreader having indentations | |
US11108574B2 (en) | Technologies for switch link and ply management for variable oversubscription ratios | |
US20230335462A1 (en) | Three-dimensional device cooling |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
PA0109 | Patent application |
Patent event code: PA01091R01D Comment text: Patent Application Patent event date: 20101207 |
|
PA0201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
PE0902 | Notice of grounds for rejection |
Comment text: Notification of reason for refusal Patent event date: 20120530 Patent event code: PE09021S01D |
|
PG1501 | Laying open of application | ||
E902 | Notification of reason for refusal | ||
PE0902 | Notice of grounds for rejection |
Comment text: Notification of reason for refusal Patent event date: 20121031 Patent event code: PE09021S01D |
|
E601 | Decision to refuse application | ||
PE0601 | Decision on rejection of patent |
Patent event date: 20130430 Comment text: Decision to Refuse Application Patent event code: PE06012S01D Patent event date: 20121031 Comment text: Notification of reason for refusal Patent event code: PE06011S01I Patent event date: 20120530 Comment text: Notification of reason for refusal Patent event code: PE06011S01I |