KR20100067961A - Multi-channel vertical-cavity surface-emitting laser(vcsel) and its manufacture method - Google Patents

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Abstract

PURPOSE: A multi-channel surface emitting laser and a manufacturing method thereof are provided to compose the surface emitting laser at a plurality of unit cells formed on one substrate by laminating a semi-insulating layer. CONSTITUTION: A buffer layer(110) and a semi-insulating layer(120) are successively laminated on an upper substrate. A plurality of unit cells is located on the semi-insulating layer. The each unit cell includes a first semiconductor layer(130), a first reflective layer(140), an active layer(150), a second reflective layer(160) and a second semiconductor layer(170). A protective layer(180) is covered on the upper part of a mesa-etched unit cell. A first electrode(192) is electrically connected to the first semiconductor layer revealed through an etching of a prescribed part of the protective layer covered on the upper side of the semiconductor layer. A second electrode(194) is electrically connected to the second semiconductor layer revealed through the etching of the prescribed part of the protective layer covered on the upper side of the second semiconductor layer.

Description

다채널 표면 방출 레이저 및 그의 제조 방법{MULTI-CHANNEL VERTICAL-CAVITY SURFACE-EMITTING LASER(VCSEL) AND ITS MANUFACTURE METHOD}MULTI-CHANNEL VERTICAL-CAVITY SURFACE-EMITTING LASER (VCSEL) AND ITS MANUFACTURE METHOD}

본 발명은 여러 채널을 하나의 소자에 구현하는 다채널 표면 방출 레이저 및 그의 제조 방법에 관한 것이다.The present invention relates to a multichannel surface emitting laser and a method of manufacturing the same, which implement several channels in one device.

표면 방출 레이저(VCSEL)는 하부의 기판, 분산된 브래그 반사경(DBR), 레이징(lasing)이 발생하는 활성층, 및 다른 하나의 DBR 또는 다른 형태의 거울이 될 수 있는 상부의 반사경을 포함하는 반도체 디바이스이며, 상부 및 하부 전극 층들이 제공된다. 전기 전압이 상부 및 하부 전극 층들을 통해 적용될 때 활성층에 의해 산출된 디바이스의 빛을 밖으로 시인하기(admit) 위하여 통로(opening)는 상부 또는 하부 전극에서 중앙에 제공된다.A surface emitting laser (VCSEL) is a semiconductor comprising an underlying substrate, a distributed Bragg reflector (DBR), an active layer on which lasing occurs, and an upper reflector that can be another DBR or other type of mirror. Device, and upper and lower electrode layers are provided. An opening is provided centrally at the upper or lower electrode to admit out the light of the device produced by the active layer when electrical voltage is applied through the upper and lower electrode layers.

표면 방출 레이저는 저-비용 광학 통신 네트워크에서 사용되기에 잘 맞도록 하는 많은 속성들을 가진다. 그리고, 표면 방출 레이저 구조에서 방출되는 대칭의 원형 광선(beam)은 광학 섬유에서 쉽게 결합될 수 있다.Surface emitting lasers have many properties that make them well suited for use in low-cost optical communication networks. And, a symmetrical circular beam emitted from the surface emitting laser structure can be easily combined in the optical fiber.

표면 방출 레이저는 작은 크기로 단일 반도체 웨이퍼 상에서 2차원을 따라 조밀하게 배열되며, 측면 발광 레이저(edge emittind lasers)와 같은 다른 유형의 레이저와 달리, 공진(rseonating) 거울이 DBR 형태로 레이저 내에서 완전하게 성장되는 것처럼 행동하는 구분된, 반사면(reflecting facet)을 기계적으로 또는 화학적으로 생성할 필요가 없는 장점이 있다.Surface-emitting lasers are small in size and are densely arranged along two dimensions on a single semiconductor wafer, and unlike other types of lasers, such as edge emittind lasers, the resonating mirror is completely within the laser in the form of a DBR. The advantage is that there is no need to mechanically or chemically create a separate, reflecting facet that behaves as if it is growing.

하지만, 하나의 채널이 아닌 다채널의 표면 방출 레이저를 구현하기 위해서는 채널간의 크로스-토크 문제가 발생하며, 크로스-토크 문제를 방지하고자 반 절연 기판을 사용할 경우에는 일반 기판 사용 시보다 공정 비용이 향상되는 문제가 발생한다.However, in order to implement a multi-channel surface emission laser instead of one channel, cross-talk problems occur between channels, and in order to prevent the cross-talk problem, the process cost is improved when using a semi-insulated substrate rather than a general substrate. Problem occurs.

따라서, 일반 기판을 사용하여 저렴한 공정비용으로 다채널 표면 방출 레이저를 제작할 수 있는 방법이 요구된다.Therefore, there is a need for a method that can produce a multi-channel surface emitting laser at low processing cost using a general substrate.

본 발명은 종래 기술의 문제점을 해결하기 위하여 고가의 반절연 기판 대신 기판의 상부에 반절연층을 형성하여 하나의 기판에 다채널의 표면 방출 레이저를 형성하며, 채널간의 간격을 줄이면서 크로스-토그를 방지할 수 있는 다채널 표면 방출 레이저 및 그의 제조 방법을 제공하는 데에 목적이 있다.The present invention forms a semi-insulating layer on top of a substrate instead of an expensive semi-insulating substrate in order to solve the problems of the prior art, thereby forming a multi-channel surface emitting laser on one substrate, while reducing the cross-to-channel spacing. It is an object of the present invention to provide a multichannel surface emitting laser and a method of manufacturing the same, which can prevent the same.

상기 목적을 달성하기 위하여 본 발명의 다채널 표면 방출 레이저 및 그의 제조 방법에 있어서, 일반적인 기판에 반절연층을 적층하여 하나의 기판을 사용하여 다채널 표면 방출 레이저를 제조할 수 있다.In order to achieve the above object, in the multichannel surface emitting laser of the present invention and a method of manufacturing the same, a multi-channel surface emitting laser can be manufactured using one substrate by stacking a semi-insulating layer on a general substrate.

본 발명은 다채널 표면 방출 레이저에 관한 것으로, 기판의 상부에 순차적으로 적층되는 버퍼층 및 반절연층을 포함하고, 상기 반절연층의 상부에 서로 이격하여 위치하는 다수의 단위 셀을 포함하되, 상기 각 단위 셀은 제 1반도체층, 제 1반사층, 활성층, 제 2반사층, 및 제 2반도체층이 순차적으로 적층되고, 상기 제 1반도체층이 노출되도록 메사 식각된 단위셀의 상부에 도포되는 보호층을 포함하며, 상기 제 1반도체층의 상부에 도포된 상기 보호층의 소정부분을 식각하여 드러난 제 1반도체층과 전기적으로 연결하는 제 1전극을 포함하고, 상기 제 2반도체층의 상부에 도포된 상기 보호층의 소정부분을 식각하여 드러난 제 2반도체층과 전기적으로 연결하는 제 2전극을 구비하는 표면 방출 레이저를 포함할 수 있다.The present invention relates to a multi-channel surface emitting laser, including a buffer layer and a semi-insulating layer sequentially stacked on the substrate, and includes a plurality of unit cells spaced apart from each other on the top of the semi-insulating layer, Each unit cell is a protective layer applied on top of a mesa-etched unit cell so that the first semiconductor layer, the first reflection layer, the active layer, the second reflection layer, and the second semiconductor layer are sequentially stacked, and the first semiconductor layer is exposed. And a first electrode electrically connecting the first semiconductor layer exposed by etching a predetermined portion of the protective layer applied on the first semiconductor layer, the second semiconductor layer being coated on the second semiconductor layer. It may include a surface emission laser having a second electrode electrically connected to the second semiconductor layer exposed by etching a predetermined portion of the protective layer.

본 발명에서 둘 이상의 상기 단위 셀 사이는 유전체 물질로 충진될 수 있다.In the present invention, two or more of the unit cells may be filled with a dielectric material.

본 발명에서 상기 유전체 물질은 폴리이미드 또는 BCB 으로 형성할 수 있다.In the present invention, the dielectric material may be formed of polyimide or BCB.

본 발명에서 상기 활성층은 SCH, 양자우물층, 및 SCH 산화층을 순차적으로 적층하여 형성할 수 있다.In the present invention, the active layer may be formed by sequentially stacking SCH, quantum well layer, and SCH oxide layer.

또한, 본 발명은 다채널 표면 방출 레이저 제조 방법에 관한 것으로, 기판, 버퍼층, 반절연층, 제 1반도체층, 제 1반사층, 활성층, 제 2반사층, 및 제 2반도체층을 순차적으로 적층하는 단계를 포함하고, 메사 식각을 통해 단위셀을 형성하는 단계를 포함하며, 형성된 상기 단위 셀에 메사 식각을 실행하여 홈을 형성하는 단계를 포함한다. 그리고, 상기 메사 식각이 이루어진 단위 셀의 상부에 보호막을 적층하는 단계를 포함하며, 상기 홈의 하부면의 소정 부분을 식각하여 제 1반도체층을 노출시키고, 상기 식각된 부분에 제 1전극 패드를 형성하는 단계를 포함하며, 상기 제 2반도체층의 상부에 적층된 보호막의 소정 부분을 식각하고, 상기 식각된 부분 제 2전극 패드를 형성하는 단계를 포함할 수 있다.In addition, the present invention relates to a method for manufacturing a multi-channel surface emission laser, comprising the steps of sequentially stacking a substrate, a buffer layer, a semi-insulating layer, a first semiconductor layer, a first reflection layer, an active layer, a second reflection layer, and a second semiconductor layer And forming a unit cell through mesa etching, and forming a groove by performing mesa etching on the formed unit cell. And depositing a protective layer on an upper portion of the unit cell in which the mesa etching is performed, etching a predetermined portion of the lower surface of the groove to expose the first semiconductor layer, and attaching the first electrode pad to the etched portion. And forming a portion of the protective layer stacked on the second semiconductor layer, and forming the etched portion of the second electrode pad.

본 발명에서 제 2전극 패드를 형성한 후, 상기 홈 및 단위 셀의 측면에 유전체 물질을 충진하는 단계를 더 포함할 수 있다.After forming the second electrode pad in the present invention, the method may further include filling a dielectric material in the grooves and side surfaces of the unit cells.

그리고, 본 발명은 다채널 표면 방출 레이저 제조 방법에 관한 것으로 기판, 버퍼층, 반절연층, 제 1반도체층, 제 1반사층, 활성층, 제 2반사층, 및 제 2반도체층을 순차적으로 적층하는 단계를 포함하고, 메사 식각을 통해 단위셀을 형성하고, 형성된 상기 단위 셀에 홈을 형성하는 단계를 포함하며, 상기 메사 식각이 이루어 진 단위 셀의 상부에 보호막을 적층하는 단계를 포함한다. 그리고, 상기 메사 식각이 이루어진 단위 셀의 측면 및 상기 홈에 유전체 물질을 충진하는 단계를 포함하며, 상기 유전체 물질이 충진된 홈의 하부면의 소정 부분을 식각하여 제 1반도체층을 노출시키고, 상기 식각된 부분에 제 1전극 패드를 형성하는 단계를 포함하고,상기 제 2반도체층의 상부에 적층된 보호막의 소정 부분을 식각하고, 상기 식각된 부분 제 2전극 패드를 형성하는 단계를 포함할 수 있다.In addition, the present invention relates to a method for manufacturing a multi-channel surface emission laser, comprising the steps of sequentially stacking a substrate, a buffer layer, a semi-insulating layer, a first semiconductor layer, a first reflection layer, an active layer, a second reflection layer, and a second semiconductor layer. And forming a unit cell through mesa etching, and forming a groove in the formed unit cell, and laminating a passivation layer on the mesa-etched unit cell. And filling a dielectric material in the side surface and the groove of the unit cell in which the mesa etching is performed, and etching a predetermined portion of the lower surface of the groove filled with the dielectric material to expose the first semiconductor layer. And forming a first electrode pad on the etched portion, and etching a predetermined portion of the protective layer stacked on the second semiconductor layer, and forming the etched portion second electrode pad. have.

본 발명은 에피 성장 시 반절연층을 적층하여 하나의 기판에 다수개의 단위 셀을 형성하고, 단위 셀마다 표면 방출 레이저를 구성함으로써 다채널 표면 방출 레이저를 제조할 수 있는 효과가 있다. The present invention has the effect of forming a multi-channel surface emission laser by forming a plurality of unit cells on one substrate by stacking a semi-insulating layer during epitaxial growth, and by configuring a surface emission laser for each unit cell.

또한, 고가의 반절연 기판을 사용하지 않고 반절연층을 적층하여 다채널 표면 방출 레이저를 제조함에 따라 채널간에 형성될 수 있는 크로스-토크 현상을 방지하고, 채널간의 간격을 줄임으로써 제조 공정 및 제조 비용을 절감하면서 성능이 향상된 고성능의 다채널 표면 방출 레이저를 제조할 수 있는 효과가 있다.In addition, as a multi-channel surface emitting laser is manufactured by stacking semi-insulating layers without using an expensive semi-insulating substrate, the cross-talk phenomenon that may be formed between channels is prevented, and the gap between the channels is reduced to reduce the manufacturing process and manufacturing process. This has the effect of producing high performance multichannel surface emitting lasers with improved performance while reducing costs.

발명의 바람직한 실시예를 첨부한 도면을 참조하여 설명하기로 한다. 하기의 각 도면의 구성 요소들에 참조 부호를 부가함에 있어서, 동일한 구성 요소들에 한해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가지도록 하며, 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 공지 기능 및 구성에 대한 상세한 설명은 생략한다.Preferred embodiments of the invention will be described with reference to the accompanying drawings. In adding reference numerals to components of the following drawings, it is determined that the same components have the same reference numerals as much as possible even if displayed on different drawings, and it is determined that they may unnecessarily obscure the subject matter of the present invention. Detailed descriptions of well-known functions and configurations will be omitted.

도 1a 내지 도 1f는 본 발명의 일 실시 예에 따른 다채널 표면 방출 레이저 제조 방법을 나타낸 도면이다.1A to 1F illustrate a method of manufacturing a multi-channel surface emitting laser according to an embodiment of the present invention.

도 1a를 참조하면, 기판(100), 버퍼층(110), 반절연층(120), 제 1반도체층(130), 제 1반사층(140), 활성층(150), 제 2반사층(160), 및 제 2반도체층(170)을 차례로 적층하여 형성한다.Referring to FIG. 1A, the substrate 100, the buffer layer 110, the semi-insulating layer 120, the first semiconductor layer 130, the first reflection layer 140, the active layer 150, the second reflection layer 160, And a second semiconductor layer 170 are sequentially stacked.

기판(100)은 고가의 반절연 기판이 아닌 화합물 반도체 기판을 사용할 수 있으며, 한정하는 것은 아니나 갈륨비소(GaAs) 기판 또는 인듐인(InP) 기판 등의 Ⅲ-Ⅴ족 반도체 기판을 사용하는 것이 바람직하다.The substrate 100 may be a compound semiconductor substrate instead of an expensive semi-insulating substrate, but is not limited thereto. It is preferable to use a III-V semiconductor substrate such as a gallium arsenide (GaAs) substrate or an indium phosphorus (InP) substrate. Do.

버퍼층(110)은 기판(100)의 상부에 적층하여 이는 갈륨 비소(GaAs) 또는 인듐인(InP)으로 형성할 수 있으며, 사용자의 선택에 따라 생략할 수 있다.The buffer layer 110 may be stacked on the substrate 100 to be formed of gallium arsenide (GaAs) or indium phosphorus (InP), and may be omitted according to a user's selection.

반절연층(120)은 여러 채널의 표면 방출 레이저를 하나의 기판에 형성하기 위하여 고가의 반 절연 기판 대신 일반 기판을 사용하여 에피 성장 과정에서 기판(100) 또는 버퍼층(110)의 상부에 반절연층(120)을 적층함으로써 채널간의 크로스-토크(cross-talk)를 감소시키는 효과를 가져온다.The semi-insulating layer 120 is semi-insulated on top of the substrate 100 or the buffer layer 110 during the epitaxial growth process by using a general substrate instead of an expensive semi-insulating substrate to form several channel surface emitting lasers on a single substrate. Stacking layers 120 has the effect of reducing cross-talk between channels.

이때, 반절연층(120)은 MOCVD(Metal Organic Chemical Vapor Deposition)법, MBE(molecular beam deposition)법, HVPE(hydride or halide vapor phase epitaxy)법, 또는 SVPE(sublimation vapor phase epitaxy)법 등을 사용하여 적층한다.In this case, the semi-insulating layer 120 uses a metal organic chemical vapor deposition (MOCVD) method, a molecular beam deposition (MBE) method, a hydride or halide vapor phase epitaxy (HVPE) method, or a sublimation vapor phase epitaxy (SVPE) method. By laminating.

제 1반도체층(130)은 반절연층(120)의 상부에 적층하며 n형 불순물이 첨가된 반도체 층으로 형성하며 제 2반도체층(170)은 제 1반도체층(130)과 다른 불순물인 p형 불순물이 첨가된 반도체층으로 형성한다.The first semiconductor layer 130 is stacked on top of the semi-insulating layer 120 and formed of a semiconductor layer to which n-type impurities are added. The second semiconductor layer 170 is a different impurity p from the first semiconductor layer 130. It is formed of a semiconductor layer to which type impurities are added.

제 1반사층(140)은 제 1반도체층(130)과 동일한 불순물이 첨가되는 분산형 브래그 반사기(Digtributed Bragg Reflector)로서 다층의 미러 쌍으로 형성할 수 있으며, 제 2반사층(160)은 제 2반도체층(170)과 동일한 불순물이 첨가된 분산형 브래그 반사기로 제 1반사층(140)과 동일한 형태로 형성한다.The first reflection layer 140 is a distributed Bragg reflector to which the same impurities as the first semiconductor layer 130 is added, and may be formed as a multilayer mirror pair, and the second reflection layer 160 may be formed of the second semiconductor. The distributed Bragg reflector to which the same impurities as the layer 170 are added is formed in the same form as the first reflective layer 140.

다수의 미러쌍으로 형성된 제 1반사층(140)과 제 2반사층(160)은 내부에 투입된 광이 미러들 상이에서 왕복 증폭되며, 제 1반사층(140)은 제 2반사층(160)과 고위 도핑 레벨만큼 상이하게 형성하여 굴절률 차를 생성함으로써 광의 방출 파장을 제어한다.In the first reflection layer 140 and the second reflection layer 160 formed of a plurality of mirror pairs, light injected therein is reciprocally amplified between the mirrors, and the first reflection layer 140 has a high doping level with the second reflection layer 160. The emission wavelength of the light is controlled by forming differently as much as possible to generate a difference in refractive index.

활성층(150)은 제 1반사층(140) 및 제 2반사층(160)을 통과하는 광을 발광하는 영역으로 단층 또는 다층으로 형성할 수 있으며, 본 발명에서는 SCH층(152), 양자우물층(154), 및 SCH+산화층(156)이 순차적으로 적층되어 형성한다.The active layer 150 is a region emitting light passing through the first and second reflection layers 140 and 160 and may be formed in a single layer or multiple layers. In the present invention, the SCH layer 152 and the quantum well layer 154 may be formed. ) And the SCH + oxide layer 156 are sequentially stacked.

도 1b를 참조하면, 하나의 기판에 여러 채널의 소자를 구현하기 위하여 하나 이상의 단위 셀을 형성한다. Referring to FIG. 1B, one or more unit cells are formed on one substrate to implement devices of multiple channels.

단위 셀은 도 1a에서 에피 성장된 소자를 식각하여 형성함으로써 하나의 기판에 다수개의 단위 셀을 형성한다. The unit cell is formed by etching the epitaxially grown device in FIG. 1A to form a plurality of unit cells on one substrate.

그리고, 하나의 기판(100)에 다수개의 단위 셀 즉, 다채널의 표면 방출 레이저를 형성함에 따라 발생할 수 있는 채널 간의 크로스-토크(cross-talk)를 방지하 기 위해 단위 셀 식각 시 반절연층(130)까지 식각하여 형성한다.In addition, a semi-insulating layer during unit cell etching to prevent cross-talk between channels, which may be generated by forming a plurality of unit cells, that is, multi-channel surface emission lasers, on one substrate 100. It is formed by etching up to 130.

이때, 반절연층(130)의 소정부분(상부 일부) 또한 식각될 수 있으며, 반절연층(130)을 식각하여 드러난 버퍼층(110) 역시 소정부분(상부 일부) 식각될 수 있다.In this case, a predetermined portion (upper part) of the semi-insulating layer 130 may also be etched, and the buffer layer 110 exposed by etching the semi-insulating layer 130 may also be etched in a predetermined portion (upper part).

도 1c를 참조하면, 각각의 단위 셀마다 표면 방출 레이저를 형성하기 위하여, 메사 식각을 실행하여 홈(A,B)을 형성(단면 상 3개의 메사 기둥을 형성)한다. 도 1c는 단면도로 홈의 2개가 형성되는 것으로 보이지만, 둥글게 식각하여 연결되는 하나의 홈을 나타낸다(도 3참조)Referring to FIG. 1C, in order to form a surface emitting laser in each unit cell, mesa etching is performed to form grooves A and B (three mesa pillars on a cross section). Figure 1c is a cross-sectional view showing that two of the grooves are formed, but shows one groove that is connected by etched round (see Figure 3)

그리고, 상기 홈(A,B)은 제 1반도체층(130)의 일부가 노출되도록 식각하여 추후 전극패드를 통해 제 1반도체층(130)와 전기적으로 연결될 수 있도록 한다.In addition, the grooves A and B are etched to expose a portion of the first semiconductor layer 130 so that the grooves A and B may be electrically connected to the first semiconductor layer 130 through an electrode pad.

본 발명에서는 단위 셀 형성을 위한 식각 후 단위 셀마다 홈을 형성하였으나, 두 공정의 순서는 바뀌어 실행할 수도 있다.In the present invention, grooves are formed in each unit cell after etching to form unit cells, but the order of the two processes may be changed.

도 1d를 참조하면, 도 1c에서 형성된 소자의 상부면에 전반적으로 보호막(180)을 적층하며, 도 1e를 참조하면, 전극패드 형성을 위하여 적층된 보호막(180)의 소정 부분을 식각한다. 이때, 보호막의 식각은 습식 식각법 또는 건식 식각법을 사용할 수 있다.Referring to FIG. 1D, a protective film 180 is generally stacked on an upper surface of the device formed in FIG. 1C. Referring to FIG. 1E, a predetermined portion of the stacked protective film 180 is etched to form an electrode pad. In this case, the etching of the protective film may use a wet etching method or a dry etching method.

보호막(180)은 소자 내부의 광이 외부로 반사되지 않도록 반사 방지막 역할을 하며, 추후 전극패드, 및 단위 셀 내의 메사식각(홈 형성을 위한 식각)에 의해 형성된 메사 측면 간의 절연을 유도한다. 또한, 한정되는 것은 아니나 보호막(180) 은 질화실리콘(SiN)층 또는 산화 실리콘(SiO2)층으로 형성할 수 있다.The passivation layer 180 serves as an anti-reflection film so that the light inside the device is not reflected to the outside, and induces insulation between the electrode pad and the mesa side formed by the mesa etching (etch for forming the groove) in the unit cell. In addition, the protective layer 180 may be formed of a silicon nitride (SiN) layer or a silicon oxide (SiO 2 ) layer.

좀 더 자세하게, 도 1e의 전극패드 형성을 위한 보호막(180)의 식각은 홈(A,B) 하부면을 소정 식각하여 제 1반도체층(130)의 일부가 노출되도록 하며, 홈의(B) 식각에 의해 형성된 메사 기둥의 상부면을 소정 식각하여 제 2반도체층(170)의 일부가 노출되도록 한다.In more detail, the etching of the passivation layer 180 for forming the electrode pad of FIG. 1E may expose a portion of the first semiconductor layer 130 by etching the lower surfaces of the grooves A and B, and thus, the grooves B may be exposed. The upper surface of the mesa pillar formed by etching is etched to expose a portion of the second semiconductor layer 170.

이때, 메사 기둥의 상부면 식각은 추후 제 2전극패드를 형성함에 따라 원형으로 한번에 식각(도 3참조)하며 도 1e에서와 같이 단면도로 나타낼 경우 트렌치 구조가 됨으로 보호막(180) 역시 단면도 상(도 1e) 트렌치 구조로 식각된 것으로 나타난다.At this time, the upper surface of the mesa pillar is etched at once in a circular shape (see FIG. 3) as the second electrode pad is formed later, and when the cross section is shown in FIG. 1E, the protective layer 180 is also in cross-sectional view (FIG. 1e) It appears to be etched into the trench structure.

도 1f를 참조하면, 도 1e에서 보호막(180)이 식각된 부분에 전극패드를 형성한다.Referring to FIG. 1F, an electrode pad is formed in a portion where the passivation layer 180 is etched in FIG. 1E.

좀더 자세하게, 홈(A,B)의 하부면에 소정부분 노출된 제 1반도체층(130)에 제 1전극(192)을 형성하여 제 1전극 패드(193)와 제 1반도체층(130)을 전기적으로 연결한다.In more detail, the first electrode 192 is formed on the first semiconductor layer 130 partially exposed on the lower surfaces of the grooves A and B to form the first electrode pad 193 and the first semiconductor layer 130. Connect electrically.

제 1전극(192)은 본 발명에서 금(Au)을 포함한 n형 전극을 나타내며, 일 예로 Ti/Pt/Au 또는 Pt/Ti/Pt/Au로 형성할 수 있다.The first electrode 192 represents an n-type electrode including gold (Au) in the present invention. For example, the first electrode 192 may be formed of Ti / Pt / Au or Pt / Ti / Pt / Au.

그리고, 도 1e에서 메사 기둥의 상부에 트렌치 구조로 식각된 보호막(180)에 의해 노출된 제 2반도체층(170)에 제 2전극(194)을 형성하여 제 2전극패드(195)와 제 2반도체층(170)을 전기적으로 연결한다.In addition, in FIG. 1E, the second electrode 194 is formed on the second semiconductor layer 170 exposed by the passivation layer 180 etched in the trench structure on the mesa pillar, thereby forming the second electrode pad 195 and the second electrode. The semiconductor layer 170 is electrically connected.

도 1g를 참조하면, 도 1f만으로도 다채널 표면 방출 레이저를 형성할 수 있으나, 각각의 채널 사이의 절연을 향상시키기 위하여 각각의 단위 셀을 구분하는 홈 및 단위 셀 내의 메사 식각이 이루어져 형성된 홈 내부에 유전체 물질(200)을 충진한다.Referring to FIG. 1G, a multi-channel surface emitting laser may be formed by only FIG. 1F, but a groove for dividing each unit cell and a mesa etching in the unit cell may be formed in order to improve insulation between respective channels. The dielectric material 200 is filled.

유전체 물질(200)은 한정되는 것은 아니나 폴리이미드(Polyimide) 또는 BCB(Benzocyclobutene)으로 형성할 수 있다.The dielectric material 200 may be formed of, but not limited to, polyimide or benzocyclobutene (BCB).

도 2a 내지 도 2c는 본 발명의 다른 실시 예에 따른 다채널 표면 방출 레이저 제조 방법을 나타낸 도면이다.2A to 2C are views illustrating a method for manufacturing a multi-channel surface emitting laser according to another embodiment of the present invention.

도 2a를 참조하면, 상기 도 1a 내지 도 1d의 공정을 진행 한 후 형성된 홈 및 단위 셀의 측면에 유전체 물질(200)을 충진한다. Referring to FIG. 2A, the dielectric material 200 is filled in the side surfaces of the grooves and unit cells formed after the processes of FIGS. 1A to 1D.

도 2b를 참조하면, 제 1반도체층(130)의 일부가 노출되도록 유전체 물질(200)이 충진된 홈의 소정부분을 식각하며, 제 2반도체층(170)의 일부가 노출되도록 메사 기둥의 상부면에 형성된 보호막(180)의 소정부분을 식각한다.Referring to FIG. 2B, a portion of the groove filled with the dielectric material 200 is etched to expose a portion of the first semiconductor layer 130, and an upper portion of the mesa pillar is exposed to expose a portion of the second semiconductor layer 170. A predetermined portion of the passivation layer 180 formed on the surface is etched.

도 2c를 참조하면, 도 2b에서 식각되어 노출된 제 1반도체층(130)의 상부에 제 1전극(192)을 형성하고, 제 2반도체층(170)의 상부에 제 2전극(194)을 형성한다.Referring to FIG. 2C, the first electrode 192 is formed on the first semiconductor layer 130 etched and exposed in FIG. 2B, and the second electrode 194 is formed on the second semiconductor layer 170. Form.

도 2a 내지 도 2c는 상기 도 1a 내지 도 1g와 동일한 다채널 표면 방출 레이저를 나타내나, 제조하는 방법에 있어 유전체 물질(200)의 충진 순서를 다르게 하여 나타낸다.2A to 2C show the same multi-channel surface emitting laser as in FIGS. 1A to 1G, but show different order of filling of the dielectric material 200 in the manufacturing method.

도 3a 및 도 3b는 본 발명의 일 실시 예에 따른 다채널 표면 방출 레이저를 나타낸 도면이다3A and 3B are views illustrating a multi-channel surface emitting laser according to an embodiment of the present invention.

도 3a를 참조하면, 상기 도 1a 내지 도 1f에 의해 형성된 다채널 표면 방출 레이저를 나타내며, 상기의 도면들(도 1a 내지 도 1f)을 도 3a에서 A-A`를 기준으로 잘라진 단면을 나타낸다.Referring to FIG. 3A, a multi-channel surface emitting laser formed by FIGS. 1A to 1F is illustrated, and the drawings (FIGS. 1A to 1F) are cross-sectional views taken along the line AA ′ of FIG. 3A.

도 3b를 참조하면, 상기 도 2a 내지 도 2c에 의해 형성된 다채널 표면 방출 레이저를 나타내며, 상기의 도면들(도 2a 내지 도 2c)은 도 3b에서 B-B`를 기준으로 잘라진 단면을 나타낸다.Referring to FIG. 3B, a multi-channel surface emitting laser formed by FIGS. 2A to 2C is illustrated, and the drawings (FIGS. 2A to 2C) show a cross section taken along line B-B 'in FIG. 3B.

본 출원에서 사용한 용어는 단지 특정한 실시예를 설명하기 위해 사용된 것으로, 본 발명을 한정하려는 의도가 아니다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다. 본 출원에서, "포함하다" 또는 "가지다"등의 용어는 명세서상에 기재된 특징, 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.The terminology used herein is for the purpose of describing particular example embodiments only and is not intended to be limiting of the present invention. Singular expressions include plural expressions unless the context clearly indicates otherwise. In this application, the terms "comprise" or "having" are intended to indicate that there is a feature, number, step, operation, component, part, or combination thereof described in the specification, and one or more other features. It is to be understood that the present invention does not exclude the possibility of the presence or the addition of numbers, steps, operations, components, components, or a combination thereof.

다르게 정의되지 않는 한, 기술적이거나 과학적인 용어를 포함해서 여기서 사용되는 모든 용어들은 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에 의해 일반적으로 이해되는 것과 동일한 의미를 가지고 있다. 일반적으로 사용되는 사전에 정의되어 있는 것과 같은 용어들은 관련 기술의 문맥상 가지는 의미와 일치하는 의미를 가지는 것으로 해석되어야 하며, 본 출원에서 명백하게 정의하지 않는 한, 이상적이거나 과도하게 형식적인 의미로 해석되지 않는다.Unless defined otherwise, all terms used herein, including technical or scientific terms, have the same meaning as commonly understood by one of ordinary skill in the art. Terms such as those defined in the commonly used dictionaries should be construed as having meanings consistent with the meanings in the context of the related art, and are not construed in ideal or excessively formal meanings unless expressly defined in this application. Do not.

당업자는 본 발명의 범위를 벗어나지 않고 설명된 실시형태를 변경 또는 변형할 수 있으며, 이러한 변경 또는 변형도 본 발명의 범위에 속한다. 또한, 본 명세서에서 설명한 각 구성요소의 물질은 당업자가 공지된 다양한 물질로부터 용이하게 선택하여 대처할 수 있다. 또한, 당업자는 본 명세서에서 설명된 구성요소 중 일부를 성능의 열화 없이 생략하거나 성능을 개선하기 위해 구성요소를 추가할 수 있다. 뿐만 아니라, 당업자는 공정 환경이나 장비에 따라 본 명세서에서 설명한 방법 단계의 순서를 변경할 수도 있다. 따라서 본 발명의 범위는 설명된 실시형태가 아니라 특허청구범위 및 그 균등물에 의해 결정되어야 한다.Those skilled in the art can change or modify the described embodiments without departing from the scope of the present invention, and such changes or modifications are within the scope of the present invention. In addition, the materials of each component described herein can be readily selected and coped by a variety of materials known to those skilled in the art. In addition, those skilled in the art may omit some of the components described herein without adding to the performance or add the components to improve performance. In addition, those skilled in the art may change the order of the method steps described herein depending on the process environment or equipment. Therefore, the scope of the present invention should be determined by the appended claims and equivalents thereof, not by the embodiments described.

도 1a 내지 도 1f는 본 발명의 일 실시 예에 따른 다채널 표면 방출 레이저 제조 방법을 나타낸 도면.1A to 1F illustrate a method of manufacturing a multi-channel surface emitting laser according to an embodiment of the present invention.

도 2a 내지 도 2c는 본 발명의 다른 실시 예에 따른 다채널 표면 방출 레이저 제조 방법을 나타낸 도면.2A to 2C illustrate a method of manufacturing a multi-channel surface emitting laser according to another embodiment of the present invention.

도 3a 및 도 3b는 본 발명의 일 실시 예에 따른 다채널 표면 방출 레이저를 나타낸 도면.3A and 3B illustrate a multi-channel surface emitting laser in accordance with one embodiment of the present invention.

<도면의 주요 부분에 대한 부호의 설명>            <Explanation of symbols for the main parts of the drawings>

100 : 기판 110 : 버퍼층100 substrate 110 buffer layer

120 : 반절연층 130 : 제 1반도체층120: semi-insulating layer 130: first semiconductor layer

140 : 제 1반사층 150 : 활성층140: first reflective layer 150: active layer

152 : SCH층 154 : 양자우물층(MQW)152: SCH layer 154: quantum well layer (MQW)

156 : SCH+산화층 160 : 제 2반사층156: SCH + oxide layer 160: second reflection layer

170 : 제 2반도체층 180 : 보호막170: second semiconductor layer 180: protective film

192 : 제 1전극 193 : 제 1전극 패드192: first electrode 193: first electrode pad

194 : 제 2전극 195 : 제 2전극 패드194: second electrode 195: second electrode pad

200 : 유전체 물질200: dielectric material

Claims (6)

기판의 상부에 순차적으로 적층되는 버퍼층 및 반절연층;A buffer layer and a semi-insulating layer sequentially stacked on the substrate; 상기 반절연층의 상부에 서로 이격하여 위치하는 다수의 단위 셀을 포함하되, It includes a plurality of unit cells spaced apart from each other on top of the semi-insulating layer, 상기 각 단위 셀은 제 1반도체층, 제 1반사층, 활성층, 제 2반사층, 및 제 2반도체층이 순차적으로 적층되고, 상기 제 1반도체층이 노출되도록 메사 식각된 단위셀의 상부에 도포되는 보호층;Each unit cell is a protective layer is applied on top of the mesa-etched unit cell so that the first semiconductor layer, the first reflection layer, the active layer, the second reflection layer, and the second semiconductor layer are sequentially stacked, and the first semiconductor layer is exposed. layer; 상기 제 1반도체층의 상부에 도포된 상기 보호층의 소정부분을 식각하여 드러난 제 1반도체층과 전기적으로 연결하는 제 1전극; 및A first electrode electrically connecting the first semiconductor layer exposed by etching a predetermined portion of the protective layer applied on the first semiconductor layer; And 상기 제 2반도체층의 상부에 도포된 상기 보호층의 소정부분을 식각하여 드러난 제 2반도체층과 전기적으로 연결하는 제 2전극;을 구비하는 표면 방출 레이저를 포함하는 다채널 표면 방출 레이저.And a second electrode electrically connecting the second semiconductor layer exposed by etching a predetermined portion of the protective layer applied on the second semiconductor layer. 제 1항에 있어서, 둘 이상의 상기 단위 셀 사이는 유전체 물질로 충진되는 것을 특징으로 하는 다채널 표면 방출 레이저.2. The multi-channel surface emitting laser of claim 1, wherein a gap between two or more of said unit cells is filled with a dielectric material. 제 2항에 있어서, 상기 유전체 물질은 폴리이미드 또는 BCB 인 것을 특징으 로 하는 다채널 표면 방출 레이저.3. The multichannel surface emission laser of claim 2, wherein the dielectric material is polyimide or BCB. 기판, 버퍼층, 반절연층, 제 1반도체층, 제 1반사층, 활성층, 제 2반사층, 및 제 2반도체층을 순차적으로 적층하는 단계;Sequentially stacking a substrate, a buffer layer, a semi-insulating layer, a first semiconductor layer, a first reflection layer, an active layer, a second reflection layer, and a second semiconductor layer; 상기 버퍼층 또는 반절연층이 노출되도록 메사 식각을 실행하여 적어도 하나 이상의 단위 셀을 형성하는 단계;Performing mesa etching to expose the buffer layer or semi-insulating layer to form at least one unit cell; 상기 단위 셀 각각에 메사 식각을 실행하여 홈을 형성하는 단계;Forming a groove by performing mesa etching on each of the unit cells; 상기 메사 식각이 이루어진 단위 셀의 상부에 보호막을 적층하는 단계;Stacking a protective layer on an upper portion of the unit cell in which the mesa etching is performed; 상기 홈의 하부면의 소정 부분을 식각하여 제 1반도체층을 노출시키고, 상기 식각된 부분에 제 1전극을 형성하는 단계; 및Etching a predetermined portion of the lower surface of the groove to expose a first semiconductor layer, and forming a first electrode on the etched portion; And 상기 제 2반도체층의 상부에 적층된 보호막의 소정 부분을 식각하고, 상기 식각된 부분 제 2전극을 형성하는 단계;Etching a predetermined portion of the passivation layer stacked on the second semiconductor layer, and forming the etched portion second electrode; 를 포함하는 것을 특징으로 하는 다채널 표면 방출 레이저 제조 방법.Multi-channel surface emission laser manufacturing method comprising a. 제 4항에 있어서, 제 2전극을 형성한 후, 상기 홈 및 단위 셀의 측면에 유전체 물질을 충진하는 단계를 더 포함하는 것을 특징으로 하는 다채널 표면 방출 레이저 제조 방법.5. The method of claim 4, further comprising filling a dielectric material on the sides of the grooves and unit cells after forming the second electrode. 기판, 버퍼층, 반절연층, 제 1반도체층, 제 1반사층, 활성층, 제 2반사층, 및 제 2반도체층을 순차적으로 적층하는 단계;Sequentially stacking a substrate, a buffer layer, a semi-insulating layer, a first semiconductor layer, a first reflection layer, an active layer, a second reflection layer, and a second semiconductor layer; 상기 버퍼층 또는 반절연층이 노출되도록 메사 식각을 실행하여 적어도 하나 이상의 단위 셀을 형성하고, 형성된 각각의 상기 단위 셀에 홈을 형성하는 단계;Performing mesa etching to expose the buffer layer or the semi-insulating layer to form at least one unit cell, and forming a groove in each of the formed unit cells; 상기 메사 식각이 이루어진 단위 셀의 상부에 보호막을 적층하는 단계;Stacking a protective layer on an upper portion of the unit cell in which the mesa etching is performed; 상기 메사 식각이 이루어진 단위 셀의 측면 및 상기 홈에 유전체 물질을 충진하는 단계;Filling a dielectric material into a side surface of the unit cell in which the mesa etching is performed and the groove; 상기 홈에 충진된 유전체 물질과 상기 홈에 충진된 유전체 물질의 하부면에 형성된 보호막의 소정 부분을 식각하여 제 1반도체층을 노출시키고, 상기 식각된 부분에 제 1전극을 형성하는 단계; 및Etching a predetermined portion of the dielectric material filled in the grooves and a protective film formed on the lower surface of the dielectric material filled in the grooves to expose a first semiconductor layer, and forming a first electrode on the etched portions; And 상기 제 2반도체층의 상부에 적층된 보호막의 소정 부분을 식각하고, 상기 식각된 부분 제 2전극을 형성하는 단계;Etching a predetermined portion of the passivation layer stacked on the second semiconductor layer, and forming the etched portion second electrode; 를 포함하는 것을 특징으로 하는 다채널 표면 방출 레이저 제조 방법.Multi-channel surface emission laser manufacturing method comprising a.
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* Cited by examiner, † Cited by third party
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JP2019140414A (en) * 2014-10-22 2019-08-22 富士ゼロックス株式会社 Surface emitting semiconductor laser element

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