KR20090131821A - Method of forming fine pattern in a semiconductor device fabricating - Google Patents

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Abstract

PURPOSE: A method for forming a fine pattern is provided to prevent deterioration of a semiconductor device by reducing the number of high temperature deposition processes. CONSTITUTION: A first mask film(102) is formed on a substrate(100). A coating film is spin-coated on the first mask film. A photoresist pattern is formed on the coating film. A coating film pattern(104a) is formed by etching the coating film through the photoresist film. A second mask pattern(110a) of a spacer shape is formed to a side wall of the coating film pattern. The coating film pattern is removed. The first mask pattern is formed by etching the first mask film through the second mask pattern.

Description

미세 패턴 형성 방법{Method of forming fine pattern in a semiconductor device fabricating}Method of forming fine pattern in a semiconductor device fabricating}

본 발명은 반도체 소자의 제조에서 미세 패턴의 형성 방법에 관한 것으로써, 보다 상세하게는, 사진 공정에 의해 형성되는 패턴보다 더 좁은 선폭을 갖는 마스크 패턴의 형성 방법에 관한 것이다.The present invention relates to a method of forming a fine pattern in the manufacture of a semiconductor device, and more particularly, to a method of forming a mask pattern having a narrower line width than the pattern formed by a photographic process.

최근, 반도체 소자가 고집적화됨에 따라 반도체 소자 내에 포함된 패턴의 선폭은 더욱 미세해지고 있다. 따라서, 반도체 소자의 제조 시에 보다 미세한 패턴의 형성을 위하여, 셀프 얼라인먼트 더블 패터닝(self alignment double patterning : 이하, 'SADP'라 한다) 공정 등이 개발되고 있다. 상기 SADP 공정은 더블 패터닝을 수행함으로써 사진 공정에 의해 형성되는 마스크 패턴보다 좁은 선폭을 갖는 마스크 패턴을 형성하고, 이를 이용하여 미세 패턴을 형성하는 공정이다.In recent years, as semiconductor devices have been highly integrated, line widths of patterns included in semiconductor devices have become smaller. Therefore, in order to form a finer pattern in the manufacture of a semiconductor device, a self alignment double patterning process (hereinafter referred to as 'SADP') and the like have been developed. The SADP process is a process of forming a mask pattern having a narrower line width than a mask pattern formed by a photo process by performing double patterning, and forming a fine pattern using the pattern.

상기 SADP 공정에 의하면, 마스크 패턴을 형성하기 위하여 2회의 패터닝 공정이 요구되므로 상기 마스크 패턴을 형성하기 위한 공정이 매우 복잡하다. 그러므로, 상기 마스크 패턴을 형성하는데 소요되는 시간 및 비용이 증가하게 된다. According to the SADP process, since two patterning processes are required to form a mask pattern, the process for forming the mask pattern is very complicated. Therefore, the time and cost for forming the mask pattern are increased.

또한, 상기 SADP 공정을 적용하여 높은 종횡비를 갖는 패턴 또는 콘택을 형 성하기 위해서는 상기 마스크 패턴의 종횡비도 매우 높아져야 한다. 그러나, 상기 SADP 공정을 통해 높은 종횡비를 갖는 마스크 패턴을 형성할 때 상기 마스크 패턴이 쓰러지는 등의 문제가 빈번히 발생하게 된다. In addition, in order to form a pattern or a contact having a high aspect ratio by applying the SADP process, the aspect ratio of the mask pattern should also be very high. However, when the mask pattern having a high aspect ratio is formed through the SADP process, a problem such as collapse of the mask pattern frequently occurs.

더구나, 상기 SADP 공정에 의하면, 상기 마스크 패턴을 형성하기 위하여 수 회의 증착, 식각 및 연마 공정이 수행되어야 하기 때문에 상기 마스크 패턴이 원하는 측벽 프로파일을 갖기가 어렵다. Moreover, according to the SADP process, it is difficult for the mask pattern to have a desired sidewall profile because several deposition, etching and polishing processes have to be performed to form the mask pattern.

본 발명의 목적은 공정이 간소화되고 불량 발생 요인이 감소되는 미세 패턴의 형성 방법을 제공하는데 있다.It is an object of the present invention to provide a method of forming a fine pattern in which the process is simplified and defect generation factors are reduced.

상기한 목적을 달성하기 위한 본 발명의 일 양태에 의한 미세 패턴 형성 방법으로, 기판 상에 제1 마스크막을 형성한다. 상기 제1 마스크막 상에 코팅막 패턴을 형성한다. 상기 코팅막 패턴의 측벽에 스페이서 형상의 제2 마스크 패턴을 형성한다. 상기 코팅막 패턴을 제거한다. 다음에, 상기 제2 마스크 패턴을 이용하여 상기 제1 마스크막을 식각함으로써 제1 마스크 패턴을 형성한다. In the method for forming a fine pattern according to an aspect of the present invention for achieving the above object, a first mask film is formed on a substrate. A coating film pattern is formed on the first mask film. A second mask pattern having a spacer shape is formed on sidewalls of the coating layer pattern. The coating layer pattern is removed. Next, a first mask pattern is formed by etching the first mask layer using the second mask pattern.

본 발명의 일 실시예에서, 상기 기판 상에 피 식각막을 형성하는 공정이 더 수행될 수 있다.  In an embodiment of the present disclosure, a process of forming an etched film on the substrate may be further performed.

본 발명의 일 실시예에서, 상기 코팅막 패턴을 형성하기 위하여, 상기 제1 마스크막 상에 코팅막을 스핀 코팅한다. 상기 코팅막 상에 포토레지스트 패턴을 형성한다. 상기 포토레지스트 패턴을 이용하여 상기 코팅막을 식각함으로써 코팅막 패턴을 형성한다. In one embodiment of the present invention, in order to form the coating layer pattern, spin coating a coating layer on the first mask layer. A photoresist pattern is formed on the coating film. The coating layer is etched using the photoresist pattern to form a coating layer pattern.

상기 코팅막 패턴은 탄소를 포함할 수 있다. The coating layer pattern may include carbon.

본 발명의 일 실시예에서, 상기 제2 마스크 패턴은 제1 마스크막과 식각 선택비를 갖는 물질을 이용하여 형성될 수 있다. In an embodiment, the second mask pattern may be formed using a material having an etching selectivity with respect to the first mask layer.

본 발명의 일 실시예에서, 상기 제2 마스크 패턴을 형성하기 위하여, 상기 코팅막 패턴 및 상기 제1 마스크막 표면을 따라 제2 마스크막을 형성한다. 다음에, 상기 제2 마스크막을 이방성으로 식각하여 스페이서 형상의 제2 하드 마스크 패턴을 형성한다. In one embodiment of the present invention, in order to form the second mask pattern, a second mask layer is formed along the surface of the coating layer pattern and the first mask layer. Next, the second mask layer is etched anisotropically to form a spacer-shaped second hard mask pattern.

본 발명의 일 실시예에서, 상기 제2 마스크막을 형성하기 위한 증착 공정은 상기 코팅막 패턴의 경화 온도보다 낮은 온도에서 수행될 수 있다. In one embodiment of the present invention, the deposition process for forming the second mask film may be performed at a temperature lower than the curing temperature of the coating film pattern.

본 발명의 일 실시예에서, 상기 제2 마스크막을 형성하기 위한 증착 공정은 200 내지 450℃의 온도에서 수행될 수 있다. In one embodiment of the present invention, the deposition process for forming the second mask film may be performed at a temperature of 200 to 450 ℃.

본 발명의 일 실시예에서, 상기 제2 마스크막은 인시튜로 보론이 도핑된 폴리실리콘 물질로 형성될 수 있다. 상기 보론 도핑된 폴리실리콘 물질을 형성하기 위한 증착 공정에서 사용할 수 있는 실리콘 소오스의 예로는 SiH4, Si2H6, Si3H8등을 들 수 있다. 이들은 단독 또는 혼합하여 사용할 수 있다. 또한, 상기 증착 공정에서 사용할 수 있는 보론 소오스의 예로는 BCl3 , B2H6 등을 들 수 있다. 이들은 단독 또는 혼합하여 사용할 수 있다. In one embodiment of the present invention, the second mask layer may be formed of a polysilicon material doped with boron in situ. Examples of the silicon source that can be used in the deposition process for forming the boron doped polysilicon material include SiH 4 , Si 2 H 6 , Si 3 H 8 , and the like. These can be used individually or in mixture. In addition, examples of the boron source that may be used in the deposition process may include BCl 3 , B 2 H 6 , and the like. These can be used individually or in mixture.

본 발명의 일 실시예에서, 상기 제2 마스크막은 인시튜로 보론이 도핑된 실리콘 게르마늄 물질로 형성될 수 있다. 상기 보론 도핑된 실리콘 게르마늄 물질을 증착하기 위한 증착 공정에서, 상기 보론 도핑된 폴리실리콘 물질을 형성하기 위한 증착 공정에서 사용할 수 있는 실리콘 소오스의 예로는 SiH4, Si2H6, Si3H8등을 들 수 있다. 상기 증착 공정에서 사용할 수 있는 보론 소오스의 예로는 BCl3, B2H6 등을 들 수 있다. 이들은 단독 또는 혼합하여 사용할 수 있다. 또한, 상기 증착 공정 에서 사용할 수 있는 게르마늄 소오스의 예로는 GeH4 등을 들 수 있다. In one embodiment of the present invention, the second mask layer may be formed of a silicon germanium material doped with boron in situ. In the deposition process for depositing the boron doped silicon germanium material, examples of the silicon source that can be used in the deposition process for forming the boron doped polysilicon material include SiH 4 , Si 2 H 6 , Si 3 H 8, and the like. Can be mentioned. Examples of the boron source that can be used in the deposition process include BCl 3 , B 2 H 6 and the like. These can be used individually or in mixture. In addition, examples of the germanium source that can be used in the deposition process may include GeH 4 .

설명한 것과 같이 본 발명의 방법에 의하면 간단한 공정에 의해 미세 패턴을 형성할 수 있다. 따라서, 상기 미세 패턴을 형성하기 위한 공정 비용 및 공정 시간이 감소된다. 이로인해, 저비용으로 고집적화된 반도체 소자를 제조할 수 있다. As described, according to the method of the present invention, a fine pattern can be formed by a simple process. Therefore, the process cost and the process time for forming the fine pattern are reduced. This makes it possible to manufacture highly integrated semiconductor devices at low cost.

이하, 첨부한 도면을 참조하여 본 발명의 바람직한 실시예를 상세히 설명하고자 한다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.

본 발명에서, 각 도면을 설명하면서 유사한 참조부호를 유사한 구성요소에 대해 사용하였다. 첨부된 도면에 있어서, 구조물들의 치수는 본 발명의 명확성을 기하기 위하여 실제보다 확대하여 도시한 것이다. In the present invention, like reference numerals are used for like elements in describing the drawings. In the accompanying drawings, the dimensions of the structures are shown in an enlarged scale than actual for clarity of the invention.

본 발명에서, 제1, 제2 등의 용어는 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안 된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용된다. In the present invention, terms such as first and second may be used to describe various components, but the components should not be limited by the terms. The terms are used only for the purpose of distinguishing one component from another.

본 발명에서 사용한 용어는 단지 특정한 실시예를 설명하기 위해 사용된 것으로, 본 발명을 한정하려는 의도가 아니다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다. 본 출원에서, "포함하다" 또는 "가지다" 등의 용어는 명세서 상에 기재된 특징, 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특 징들이나 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.The terminology used herein is for the purpose of describing particular example embodiments only and is not intended to be limiting of the present invention. Singular expressions include plural expressions unless the context clearly indicates otherwise. In the present application, the terms "comprise" or "have" are intended to indicate that there is a feature, number, step, operation, component, part, or combination thereof described on the specification, but one or more other features. It should be understood that it does not preclude the presence or possibility of additions or numbers, steps, actions, components, parts or combinations thereof.

본 발명에 있어서, 각 층(막), 영역, 전극, 패턴 또는 구조물들이 대상체, 기판, 각 층(막), 영역, 전극 또는 패턴들의 "상에", "상부에" 또는 "하부"에 형성되는 것으로 언급되는 경우에는 각 층(막), 영역, 전극, 패턴 또는 구조물들이 직접 기판, 각 층(막), 영역, 또는 패턴들 위에 형성되거나 아래에 위치하는 것을 의미하거나, 다른 층(막), 다른 영역, 다른 전극, 다른 패턴 또는 다른 구조물들이 대상체나 기판 상에 추가적으로 형성될 수 있다. In the present invention, each layer (film), region, electrode, pattern or structures is formed on, "on" or "bottom" of the object, substrate, each layer (film), region, electrode or pattern. When referred to as being meant that each layer (film), region, electrode, pattern or structure is formed directly over or below the substrate, each layer (film), region or patterns, or other layer (film) Other regions, different electrodes, different patterns, or different structures may be additionally formed on the object or the substrate.

본문에 개시되어 있는 본 발명의 실시예들에 대해서, 특정한 구조적 내지 기능적 설명들은 단지 본 발명의 실시예를 설명하기 위한 목적으로 예시된 것으로, 본 발명의 실시예들은 다양한 형태로 실시될 수 있으며 본문에 설명된 실시예들에 한정되는 것으로 해석되어서는 안된다.With respect to the embodiments of the present invention disclosed in the text, specific structural to functional descriptions are merely illustrated for the purpose of describing embodiments of the present invention, embodiments of the present invention may be implemented in various forms and It should not be construed as limited to the embodiments described in.

본 발명은 다양한 변경을 가할 수 있고 여러 가지 형태를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 본문에 상세하게 설명하고자 한다. 그러나, 이는 본 발명을 특정한 개시 형태에 대해 한정하려는 것이 아니며, 본 발명의 사상 및 기술 범위에 포함되는 모든 변경, 균등물 내지 대체물을 포함하는 것으로 이해되어야 한다. As the inventive concept allows for various changes and numerous embodiments, particular embodiments will be illustrated in the drawings and described in detail in the text. However, this is not intended to limit the present invention to the specific disclosed form, it should be understood to include all modifications, equivalents, and substitutes included in the spirit and scope of the present invention.

도 1 내지 도 7은 본 발명의 바람직한 실시예에 따른 미세 패턴의 형성 방법을 나타내는 개략적인 단면도들이다.1 to 7 are schematic cross-sectional views showing a method of forming a fine pattern according to a preferred embodiment of the present invention.

도 1을 참조하면, 반도체 기판(100) 상에 피 식각막(도시안됨)을 형성한다. 상기 반도체 기판(100)은 단결정 실리콘 기판일 수 있다. 한편, 식각 대상물이 반도체 기판(100)인 경우에는 상기 피 식각막이 형성되지 않는다. Referring to FIG. 1, an etched film (not shown) is formed on the semiconductor substrate 100. The semiconductor substrate 100 may be a single crystal silicon substrate. When the object to be etched is the semiconductor substrate 100, the etched film is not formed.

상기 피 식각막 상에 제1 마스크막(102)을 형성한다. 상기 제1 마스크막은 상기 피 식각막과의 식각 선택비를 갖는 물질로 형성되는 것이 바람직하다. 즉, 상기 제1 마스크막(102)은 피 식각막을 식각할 때 거의 식각되지 않는 물질로 형성되어야 한다. 예를들어, 상기 제1 마스크막(102)으로 사용될 수 있는 물질의 예로는 실리콘 산화물, 실리콘 질화물 등을 들 수 있다. 상기 제1 마스크막(102)은 이들 물질의 단독막으로 형성되는 것이 바람직하다. 본 실시예에서, 상기 제1 마스크막(102)은 실리콘 산화물을 PE-CVD 공정을 통해 증착함으로써 형성될 수 있다. A first mask layer 102 is formed on the etching target layer. The first mask layer may be formed of a material having an etching selectivity with respect to the etching target film. That is, the first mask layer 102 should be formed of a material that is hardly etched when the etching layer is etched. For example, examples of the material that can be used as the first mask layer 102 include silicon oxide, silicon nitride, and the like. The first mask film 102 is preferably formed of a single film of these materials. In the present embodiment, the first mask layer 102 may be formed by depositing silicon oxide through a PE-CVD process.

상기 제1 마스크막(102) 상에 코팅막(104)을 형성한다. 상기 코팅막(104)은 약 99%의 탄소로 이루어진 탄소 스핀 온 하드마스크(C-Spin on hardmask, C-SOH) 물질로 이루어질 수 있다. 구체적으로, 상기 탄소 스핀 온 하드마스크 물질을 상기 제1 마스크막(102) 상에 스핀 코팅한 후, 350 내지 450℃ 정도의 온도에서 베이크하여 경화시킴으로써 상기 코팅막을 형성할 수 있다. 상기 코팅막(104)은 후속 공정을 통해 패터닝됨으로써 제1 마스크막(102)을 패터닝하기 위한 제2 마스크 패턴의 위치 및 높이를 정의한다. 그러므로, 상기 코팅막(104)은 형성하고자하는 제2 마스크 패턴의 높이보다 높거나 또는 형성하고자하는 제2 마스크 패턴의 높이와 동일한 높이를 갖도록 형성된다. A coating film 104 is formed on the first mask film 102. The coating film 104 may be formed of a carbon spin on hardmask (C-SOH) material made of about 99% carbon. Specifically, the coating layer may be formed by spin-coating the carbon spin-on hard mask material on the first mask layer 102 and baking the same at a temperature of about 350 to 450 ° C. The coating film 104 is patterned through a subsequent process to define the position and height of the second mask pattern for patterning the first mask film 102. Therefore, the coating film 104 is formed to have a height higher than the height of the second mask pattern to be formed or the same as the height of the second mask pattern to be formed.

상기 코팅막(104) 상에 반사 방지막(106)을 형성한다. 상기 반사 방지막은 후속에 형성되는 포토레지스트막과 기판 간의 반사를 최소화하기 위하여 제공된다. 상기 반사 방지막은 실리콘 산 질화물을 화학기상증착법에 의해 증착시켜 형성할 수 있다. 그러나, 상기 반사 방지막(106)은 공정을 단순화하기 위하여 생략할 수도 있다. An anti-reflection film 106 is formed on the coating film 104. The anti-reflection film is provided to minimize reflection between the subsequently formed photoresist film and the substrate. The anti-reflection film may be formed by depositing silicon oxynitride by chemical vapor deposition. However, the anti-reflection film 106 may be omitted to simplify the process.

도 2를 참조하면, 상기 반사 방지막(106) 상에 포토레지스트를 코팅하고, 사진 공정에 의해 상기 포토레지스트를 패터닝함으로써 포토레지스트 패턴(108)을 형성한다. Referring to FIG. 2, a photoresist pattern 108 is formed by coating a photoresist on the antireflection film 106 and patterning the photoresist by a photolithography process.

상기 포토레지스트 패턴(108)은 형성하고자 하는 하드 마스크 패턴들 사이의 간격과 동일한 선폭을 갖는다. 또한, 상기 포토레지스트 패턴(108)은 형성하고자 하는 하드 마스크 패턴의 선폭의 약 3배 정도의 간격으로 서로 이격되게 형성한다. The photoresist pattern 108 has the same line width as the spacing between the hard mask patterns to be formed. In addition, the photoresist pattern 108 is formed to be spaced apart from each other at intervals of about three times the line width of the hard mask pattern to be formed.

상기 포토레지스트 패턴(108)은 형성하고자 하는 하드 마스크 패턴들 사이 부위에 위치하여야 한다. 따라서, 상기 포토레지스트 패턴(108)이 형성된 부위의 아래는 하드 마스크 패턴의 사이 부위가 된다. The photoresist pattern 108 should be located between the hard mask patterns to be formed. Therefore, a portion under the portion where the photoresist pattern 108 is formed is a portion between the hard mask patterns.

도 3을 참조하면, 상기 포토레지스트 패턴(108)을 식각 마스크로 사용하여, 상기 반사 방지막(106) 및 코팅막(104)을 순차적으로 이방성 식각한다. 상기 이방성 식각 공정을 통해 상기 제1 마스크막(102) 상에는 코팅막 패턴(104a)이 형성된다. Referring to FIG. 3, the antireflection film 106 and the coating film 104 are sequentially anisotropically etched using the photoresist pattern 108 as an etching mask. The coating layer pattern 104a is formed on the first mask layer 102 through the anisotropic etching process.

상기 이방성 식각 공정을 수행할 때, 상기 코팅막(104) 뿐 아니라 상기 포토레지스트 패턴(108) 및 상기 포토레지스트 패턴(108) 아래에 위치한 반사 방지막(106)도 함께 제거된다. 그러므로, 상기 이방성 식각을 통해 코팅막 패턴(104a) 을 형성하면, 상기 포토레지스트 패턴(108) 및 반사 방지막(106)은 거의 제거된다. When the anisotropic etching process is performed, not only the coating layer 104 but also the photoresist pattern 108 and the anti-reflection film 106 disposed under the photoresist pattern 108 are also removed. Therefore, when the coating film pattern 104a is formed through the anisotropic etching, the photoresist pattern 108 and the anti-reflection film 106 are almost removed.

이 후, 일부 남아있는 상기 포토레지스트 패턴(108) 및 반사 방지막(106)을 제거한다. 상기 제거 공정 시에 상기 코팅막 패턴(104a)은 제거되지 않도록 하는 것이 바람직하다. 이와는 달리, 상기 포토레지스트 패턴(108) 및 반사 방지막(106)이 상기 이방성 식각 공정에 의해 완전하게 제거되는 경우에는 상기 포토레지스트 패턴(108) 및 반사 방지막(106)을 제거하기 위한 별도의 공정을 수행하지 않아도 된다. Thereafter, some of the remaining photoresist pattern 108 and the anti-reflection film 106 are removed. The coating layer pattern 104a may not be removed during the removal process. In contrast, when the photoresist pattern 108 and the anti-reflection film 106 are completely removed by the anisotropic etching process, a separate process for removing the photoresist pattern 108 and the anti-reflection film 106 may be performed. You do not have to do it.

도 4를 참조하면, 상기 코팅막 패턴(104a)의 측벽, 상부면 및 상기 코팅막 패턴(104a)의 사이의 제1 마스크막(102) 상부면을 따라 스페이서막(106)을 형성한다. 상기 스페이서막(110)은 후속 공정을 통해 하드 마스크 패턴을 형성하기 위한 식각 마스크로써 사용된다. 때문에, 상기 제1 마스크막(102)과 식각 선택비를 갖는 물질로 형성되는 것이 바람직하다. 또한, 상기 스페이서막(110)은 형성하고자 하는 하드 마스크 패턴의 폭과 동일한 두께로 형성하여야 한다. Referring to FIG. 4, a spacer layer 106 is formed along a sidewall, an upper surface of the coating layer pattern 104a, and an upper surface of the first mask layer 102 between the coating layer pattern 104a. The spacer layer 110 is used as an etching mask to form a hard mask pattern through a subsequent process. Therefore, the first mask layer 102 is preferably formed of a material having an etching selectivity. In addition, the spacer layer 110 should be formed to have the same thickness as the width of the hard mask pattern to be formed.

상기 코팅막 패턴은 열적으로 불안정하므로 상기 스페이서막(110)을 형성할 때 상기 코팅막 패턴(104a)에 열적 버짓이 발생될 수 있다. 때문에, 상기 스페이서막(110)을 형성하기 위한 증착 공정은 상기 코팅막 패턴(104a)을 베이크하는 온도보다 낮은 온도에서 형성되는 것이 바람직하다. Since the coating pattern is thermally unstable, a thermal budget may be generated in the coating pattern 104a when the spacer layer 110 is formed. Therefore, the deposition process for forming the spacer film 110 is preferably formed at a temperature lower than the temperature for baking the coating film pattern 104a.

상기 스페이서막(110)이 450℃ 이상의 온도에서 형성하는 경우, 상기 스페이서막(110)을 형성할 때 열적으로 불안정한 상기 코팅막 패턴(104a)이 무너질 수 있다. 그러므로, 상기 스페이서막(110)은 450℃ 이하의 낮은 온도에서 증착되는 것이 바람직하다. When the spacer layer 110 is formed at a temperature of 450 ° C. or higher, the thermally unstable coating layer pattern 104a may be collapsed when the spacer layer 110 is formed. Therefore, the spacer film 110 is preferably deposited at a low temperature of 450 ℃ or less.

상기와 같이 450℃ 이하의 온도에서 증착할 수 있고, 상기 제1 마스크막(102)과의 식각 선택비를 갖는 물질의 예로는 인시튜 보론 도핑된 폴리실리콘, 인시튜 보론 도핑된 실리콘 게르마늄 등을 들 수 있다. 상기 제1 마스크막(102)은 이들 물질의 단독막으로 형성되는 것이 바람직하다. As described above, examples of the material having a deposition selectivity with respect to the first mask layer 102 and having an etching selectivity with respect to the first mask layer 102 include in situ boron-doped polysilicon, in-situ boron-doped silicon germanium, and the like. Can be mentioned. The first mask film 102 is preferably formed of a single film of these materials.

구체적으로, 상기 인시튜 보론 도핑된 폴리실리콘으로 이루어지는 스페이서막(110)은 보론 소오스 가스 및 실리콘 소오스 가스를 반응 가스로 사용하는 증착 공정을 통해 형성할 수 있다. 상기 증착은 CVD 공정 또는 ALD 공정을 통해 수행될 수 있다. 상기 증착 공정에서 사용될 수 있는 상기 보론 소오스 가스의 예로는 BCl3, B2H6 등을 들 수 있다. 이들은 단독으로 사용되거나 2 이상을 혼합하여 사용할 수 있다. 또한, 상기 실리콘 소오스 로 사용될 수 있는 가스의 예로는 SiH4, Si2H6, Si3H8 등을 들 수 있다. 이들은 단독으로 사용되거나 2 이상을 혼합하여 사용할 수 있다. Specifically, the spacer film 110 formed of the in-situ boron-doped polysilicon may be formed through a deposition process using a boron source gas and a silicon source gas as a reaction gas. The deposition may be performed through a CVD process or an ALD process. Examples of the boron source gas that may be used in the deposition process include BCl 3 , B 2 H 6 , and the like. These may be used alone or in combination of two or more. In addition, examples of the gas that may be used as the silicon source include SiH 4 , Si 2 H 6 , Si 3 H 8 , and the like. These may be used alone or in combination of two or more.

상기 보론 소오스 가스는 200℃ 이하의 저온에서 분해하여 반응을 촉진시킨다. 때문에, 상기 인시튜 보론 도핑된 폴리실리콘막의 경우 300 내지 450℃의 온도에서 증착될 수 있다. The boron source gas is decomposed at a low temperature of 200 ° C. or lower to promote the reaction. Therefore, in situ boron doped polysilicon film may be deposited at a temperature of 300 to 450 ℃.

상기 인시튜 보론 도핑된 실리콘 게르마늄으로 이루어지는 스페이서막은 보론 소오스 가스, 실리콘 소오스 가스 및 게르마늄 소오스 가스를 반응 가스로 사용하는 증착 공정을 통해 형성할 수 있다. 상기 증착은 CVD 공정 또는 ALD 공정을 통 해 수행될 수 있다. 상기 증착 시에 사용될 수 있는 보론 소오스 가스의 예로는 BCl3, B2H6 등을 들 수 있다. 이들은 단독으로 사용되거나 2 이상을 혼합하여 사용할 수 있다. 상기 증착 시에 사용될 수 있는 실리콘 소오스 가스의 예로는 SiH4, Si2H6, Si3H8 등을 들 수 있다. 이들은 단독으로 사용되거나 2 이상을 혼합하여 사용할 수 있다. 또한, 상기 증착 시에 사용될 수 있는 상기 게르마늄 소오스 가스의 예로는 GeH4를 들 수 있다. 상기 게르마늄 소오스 가스의 경우에도 저온에서 반응하기 때문에, 상기 인시튜 보론 도핑된 실리콘 게르마늄막은 300 내지 450℃ 온도에서 증착될 수 있다. The spacer film made of in situ boron-doped silicon germanium may be formed through a deposition process using boron source gas, silicon source gas, and germanium source gas as a reaction gas. The deposition may be performed through a CVD process or an ALD process. Examples of the boron source gas that may be used during the deposition include BCl 3 , B 2 H 6 , and the like. These may be used alone or in combination of two or more. Examples of the silicon source gas that may be used in the deposition include SiH 4 , Si 2 H 6 , Si 3 H 8 , and the like. These may be used alone or in combination of two or more. In addition, an example of the germanium source gas that may be used in the deposition may include GeH 4 . Since the germanium source gas also reacts at a low temperature, the in-situ boron-doped silicon germanium film may be deposited at a temperature of 300 to 450 ° C.

이에 반하여, 언도프드 폴리실리콘 및 인이 도핑된 폴리실리콘(P-doped polysilicon)은 약 530℃의 온도에서 증착될 수 있다. 때문에, 상기 언도프드 폴리실리콘 및 인이 도핑된 폴리실리콘은 상기 스페이서막으로 적합하지 않다. In contrast, undoped polysilicon and phosphorus doped polysilicon may be deposited at a temperature of about 530 ° C. Therefore, the undoped polysilicon and the polysilicon doped with phosphorus are not suitable as the spacer film.

도 5를 참조하면, 상기 스페이서막(110)을 이방성으로 식각함으로써 스페이서 형상을 갖는 제2 마스크 패턴(110a)을 형성한다. 상기 코팅막 패턴(104a) 사이에는 2개의 제2 마스크 패턴(110a)이 형성된다. Referring to FIG. 5, the spacer layer 110 is anisotropically etched to form a second mask pattern 110a having a spacer shape. Two second mask patterns 110a are formed between the coating layer patterns 104a.

상기 제2 마스크 패턴(110a)은 상기 스페이서막(110)의 두께와 동일한 선폭을 갖게된다. 또한, 사진 공정에 의해 형성된 코팅막 패턴(104a)들 사이에 2개의 제2 마스크 패턴(110a)이 형성되므로, 상기 제2 마스크 패턴(110a)은 사진 공정에 의해 형성할 수 있는 최소 선폭의 약 1/2배의 선폭을 가질 수 있다. 그러므로, 상기 제2 마스크 패턴(110a)은 약 20 내지 40㎚의 미세한 선폭을 가질 수 있다. The second mask pattern 110a has the same line width as the thickness of the spacer layer 110. In addition, since two second mask patterns 110a are formed between the coating film patterns 104a formed by the photographing process, the second mask pattern 110a is about 1 of the minimum line width that can be formed by the photographing process. It can have a line width of twice. Therefore, the second mask pattern 110a may have a fine line width of about 20 to 40 nm.

도 6을 참조하면, 상기 제2 마스크 패턴(110a) 사이에 구비되는 상기 코팅막 패턴(104a)을 제거한다. 상기 코팅막 패턴(104a)은 에싱 및 스트립 공정을 통해 제거될 수 있다. 상기 코팅막 패턴(104a)이 제거됨으로써 상기 제2 마스크 패턴(110a) 사이에 제1 마스크막(102)이 노출된다.Referring to FIG. 6, the coating film pattern 104a provided between the second mask patterns 110a is removed. The coating pattern 104a may be removed through an ashing and stripping process. The first mask layer 102 is exposed between the second mask patterns 110a by removing the coating layer pattern 104a.

설명한 것과 같이, 상기 제2 마스크 패턴(110a)을 형성하기 위하여 스페이서막(110)의 증착, 상기 스페이서막(110)의 식각 및 코팅막 패턴(104a)의 제거 공정만을 수행한다. 즉, 종래의 더블 패터닝 공정에서는 2회의 마스크막 형성 공정, 1회의 패터닝 공정, 반사 방지막 제거 공정, 희생막 형성 공정, 평탄화 공정 및 희생막 이방성 식각 공정과 같은 복잡한 단계들이 수행되어야 하지만, 본 발명의 일 실시예에 의하면 1회의 증착, 식각 공정 및 코팅막 패턴 제거 공정만이 수행되므로 공정이 매우 간단해진다. As described above, only the deposition of the spacer layer 110, the etching of the spacer layer 110, and the removal of the coating layer pattern 104a are performed to form the second mask pattern 110a. That is, in the conventional double patterning process, complex steps such as two mask film forming processes, one patterning process, an anti-reflection film removing process, a sacrificial film forming process, a planarization process, and a sacrificial film anisotropic etching process should be performed. According to one embodiment, only one deposition, etching, and coating layer pattern removing process is performed, thereby simplifying the process.

더구나, 종래의 더블 패터닝 공정에서는 수 회의 증착 공정이 수행되기 때문에, 고온 공정 시간이 증가하게 되어 열에 의한 불량이 발생되기 쉽다. 또한, 공정 시간이 길어지게 되어 공정에 소요되는 비용이 증가하게 된다. 반면에, 본 발명의 일 실시예에 의하면, 고온 공정이 감소되어 소자의 열화가 거의 발생되지 않으며, 공정을 수행하는데 소요되는 비용도 감소하게 된다.In addition, in the conventional double patterning process, since the deposition process is performed several times, the high temperature process time is increased, and heat defects are likely to occur. In addition, the process time becomes longer and the cost required for the process increases. On the other hand, according to one embodiment of the present invention, the high temperature process is reduced, so that deterioration of the device is hardly generated, and the cost required to perform the process is also reduced.

또한, 상기 제2 마스크 패턴(110a)을 형성할 시에 희생막을 제거하는 공정이 수행되지 않기 때문에, 종래에 상기 희생막을 제거하면서 측벽 프로파일이 불량해지는 현상이 발생되지 않는다. 따라서, 상기 제2 마스크 패턴(110a)은 종래의 더블 패터닝에 의해 형성되는 마스크 패턴보다 측벽 프로파일이 우수하다. In addition, since the process of removing the sacrificial film is not performed when the second mask pattern 110a is formed, a phenomenon in which the sidewall profile is deteriorated while the sacrificial film is removed conventionally does not occur. Accordingly, the second mask pattern 110a has a better sidewall profile than the mask pattern formed by conventional double patterning.

도 7을 참조하면, 상기 제2 마스크 패턴(110a) 사이에 노출되어 있는 제1 마스크막(102)을 이방성 식각함으로써 제1 마스크 패턴(102a)을 형성한다. 상기 제1 마스크 패턴(102a)은 통상의 사진 공정에 의해 형성되는 마스크 패턴에 비해 미세한 선폭을 갖는다. Referring to FIG. 7, the first mask pattern 102a is formed by anisotropically etching the first mask layer 102 exposed between the second mask patterns 110a. The first mask pattern 102a has a finer line width than the mask pattern formed by a normal photo process.

상기 제1 마스크 패턴(102a)을 형성한 다음, 상기 제2 하드 마스크 패턴을 제거한다. After forming the first mask pattern 102a, the second hard mask pattern is removed.

이 후, 도시하지는 않았지만, 상기 제1 마스크 패턴을 이용하여 피 식각막을 식각함으로써 패턴을 형성한다. 상기 피 식각막이 기판인 경우에는 상기 기판을 식각한다. Thereafter, although not shown, a pattern is formed by etching the etched film using the first mask pattern. If the etched film is a substrate, the substrate is etched.

본 실시예에 의하면, 미세한 선폭을 갖는 식각 마스크 패턴을 형성할 수 있다. 또한, 상기 식각 마스크 패턴을 이용함으로써 원하는 패턴을 형성할 수 있다. According to the present embodiment, an etching mask pattern having a fine line width can be formed. In addition, a desired pattern may be formed by using the etching mask pattern.

실험용 비교 샘플 제조Experimental Comparative Sample Preparation

보론 소오스 가스를 유입하지 않고 언도프드 폴리실리콘막을 증착하여 비교 샘플1을 제조하였다. 또한, 상기 언도프드 폴리실리콘막의 성장률(Growth rate)을 측정하였다. 비교 샘플 1을 수득하기 위한 언도프드 폴리실리콘막의 증착 조건은 아래의 표 1과 같다. Comparative Sample 1 was prepared by depositing an undoped polysilicon film without introducing a boron source gas. In addition, the growth rate (Growth rate) of the undoped polysilicon film was measured. The deposition conditions of the undoped polysilicon film for obtaining Comparative Sample 1 are shown in Table 1 below.

실험용 샘플 제조Experimental Sample Preparation

상기 비교 샘플1의 언도프드 폴리실리콘막의 증착 속도와 비교하기 위하여, 본 발명의 방법에 따라 인시튜 보론 도핑된 폴리실리콘막을 증착하여 샘플 1 내지 6을 수득하였다. 또한, 각 샘플에서의 폴리실리콘막 성장율을 측정하였다. 상기 샘플 1 내지 6은 인시튜 보론 도핑된 폴리실리콘막을 증착하기 위한 증착 조건에서 다소 차이가 있으며, 각 샘플별 증착 조건은 아래의 표 1과 같다. In order to compare the deposition rate of the undoped polysilicon film of Comparative Sample 1, samples 1 to 6 were obtained by depositing an in-situ boron doped polysilicon film according to the method of the present invention. In addition, the polysilicon film growth rate in each sample was measured. Samples 1 to 6 are slightly different from the deposition conditions for depositing the in-situ boron-doped polysilicon film, and the deposition conditions for each sample are shown in Table 1 below.

<표 1>TABLE 1

Figure 112008043882142-PAT00001
Figure 112008043882142-PAT00001

본 발명의 경우, 스페이서막으로 사용되는 보론 도핑된 폴리실리콘막은 코팅막의 베이크 온도인 약 450℃ 이하의 저온에서 증착되어야 한다. 즉, 약 450℃ 의 저온에서 충분히 빠른 속도로 폴리실리콘막이 증착되어야 한다. In the case of the present invention, the boron doped polysilicon film used as the spacer film should be deposited at a low temperature of about 450 ° C. or less, which is the baking temperature of the coating film. That is, the polysilicon film should be deposited at a sufficiently fast rate at a low temperature of about 450 ° C.

도 8은 비교 샘플 및 샘플 1 내지 6에서 각 샘플 증착 시의 폴리실리콘막의 성장률을 나타내는 그래프이다. 8 is a graph showing the growth rate of the polysilicon film during deposition of each sample in Comparative Samples and Samples 1 to 6. FIG.

도 8을 참조하면, 비교 샘플과 같이 보론 소오스 가스를 유입하지 않고 450℃의 저온에서 언도프드 폴리실리콘을 형성하는 경우에는 박막이 전혀 성장하지 않았다. Referring to FIG. 8, when the undoped polysilicon was formed at a low temperature of 450 ° C. without introducing the boron source gas as in the comparative sample, the thin film did not grow at all.

그러나, 샘플 1 내지 6에서와 같이 보론 소오스 가스를 유입하는 경우, 상기 보론 소오스 가스의 유입량과 비례하여 성장률이 높아짐을 알 수 있었다. 구체적으 로, 상기 보론 소오스 가스를 유입함으로써 450℃의 저온에서 20 내지 60Å/min의 성장률로 박막이 증착됨을 알 수 있었다. However, when the boron source gas is introduced as in Samples 1 to 6, it can be seen that the growth rate is increased in proportion to the inflow amount of the boron source gas. Specifically, it can be seen that the thin film is deposited at a growth rate of 20 to 60 μs / min at a low temperature of 450 ° C. by introducing the boron source gas.

상기 결과를 통해, 스페이서막으로써 인시튜 보론 도프드 폴리실리콘막을 사용할 수 있음을 알 수 있었다. 이로인해, 미세한 선폭을 갖는 마스크 패턴을 형성할 수 있음을 알 수 있었다. 반면에, 보론이 도핑되지 않은 폴리실리콘막의 경우 450℃의 온도에서 증착되지 않아서 스페이서막으로써 사용할 수 없음을 알 수 있었다.From the above results, it can be seen that the in-situ boron doped polysilicon film can be used as the spacer film. As a result, it was found that a mask pattern having a fine line width could be formed. On the other hand, in the case of the boron doped polysilicon film was not deposited at a temperature of 450 ℃ it can be seen that it can not be used as a spacer film.

본 발명에 따른 마스크 패턴은 미세한 선폭을 갖는 배선, 좁은 개구폭을 갖는 콘택홀 등을 형성하기 위한 식각 마스크로써 사용될 수 있다. 특히, 반도체 소자의 제조에서 라인 및 스페이스의 폭이 동일한 배선 또는 일정 간격을 가지면서 반복 배치되고 높은 종횡비를 갖는 콘택홀을 형성하기 위한 마스크 패턴을 사용될 수 있다. The mask pattern according to the present invention can be used as an etching mask for forming a wiring having a fine line width, a contact hole having a narrow opening width, and the like. In particular, in the manufacture of semiconductor devices, a mask pattern for forming contact holes having a high aspect ratio and repeatedly arranged with the same wiring or a predetermined interval of the width of the line and the space may be used.

상기에서는 본 발명의 바람직한 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다. Although described above with reference to a preferred embodiment of the present invention, those skilled in the art will be variously modified and changed within the scope of the invention without departing from the spirit and scope of the invention described in the claims below I can understand that you can.

도 1 내지 도 7은 본 발명의 바람직한 실시예에 따른 미세 패턴의 형성 방법을 나타내는 개략적인 단면도들이다.1 to 7 are schematic cross-sectional views showing a method of forming a fine pattern according to a preferred embodiment of the present invention.

도 8은 비교 샘플 및 샘플 1 내지 6에서 각 샘플 증착 시의 폴리실리콘막의 성장률을 나타내는 그래프이다. 8 is a graph showing the growth rate of the polysilicon film during deposition of each sample in Comparative Samples and Samples 1 to 6. FIG.

Claims (12)

기판 상에 제1 마스크막을 형성하는 단계; Forming a first mask film on the substrate; 상기 제1 마스크막 상에 코팅막 패턴을 형성하는 단계; Forming a coating pattern on the first mask layer; 상기 코팅막 패턴의 측벽에 스페이서 형상의 제2 마스크 패턴을 형성하는 단계; Forming a spacer-shaped second mask pattern on sidewalls of the coating layer pattern; 상기 코팅막 패턴을 제거하는 단계; 및 Removing the coating pattern; And 상기 제2 마스크 패턴을 이용하여 상기 제1 마스크막을 식각함으로써 제1 마스크 패턴을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 소자의 미세 패턴 형성 방법. Forming a first mask pattern by etching the first mask layer using the second mask pattern. 제1항에 있어서, 상기 기판 상에 피 식각막을 형성하는 단계를 더 포함하는 것을 특징으로 하는 미세 패턴 형성 방법.The method of claim 1, further comprising forming an etched film on the substrate. 제1항에 있어서, 상기 코팅막 패턴을 형성하는 단계는, The method of claim 1, wherein the forming of the coating layer pattern comprises: 상기 제1 마스크막 상에 코팅막을 스핑 코팅하는 단계; Sputter coating a coating film on the first mask film; 상기 코팅막 상에 포토레지스트 패턴을 형성하는 단계; 및Forming a photoresist pattern on the coating film; And 상기 포토레지스트 패턴을 이용하여 상기 코팅막을 식각함으로써 코팅막 패턴을 형성하는 단계를 포함하는 것을 특징으로 하는 미세 패턴 형성 방법.And forming a coating layer pattern by etching the coating layer using the photoresist pattern. 제1항에 있어서, 상기 코팅막 패턴은 탄소를 포함하는 것을 특징으로 하는 미세 패턴 형성 방법.The method of claim 1, wherein the coating pattern comprises carbon. 제1항에 있어서, 상기 제2 마스크 패턴은 제1 마스크막과 식각 선택비를 갖는 물질을 이용하여 형성하는 것을 특징으로 하는 미세 패턴 형성 방법. The method of claim 1, wherein the second mask pattern is formed using a material having an etch selectivity with respect to the first mask layer. 제1항에 있어서, 상기 제2 마스크 패턴을 형성하는 단계는, The method of claim 1, wherein the forming of the second mask pattern comprises: 상기 코팅막 패턴 및 상기 제1 마스크막 표면을 따라 제2 마스크막을 형성하는 단계; 및 Forming a second mask film along the coating pattern and the surface of the first mask film; And 상기 제2 마스크막을 이방성으로 식각하여 스페이서 형상의 제2 하드 마스크 패턴을 형성하는 단계를 포함하는 것을 특징으로 하는 미세 패턴 형성 방법. And etching the second mask layer anisotropically to form a second hard mask pattern having a spacer shape. 제6항에 있어서, 상기 제2 마스크막을 형성하기 위한 증착 공정은 상기 코팅막 패턴의 경화 온도보다 낮은 온도에서 수행되는 것을 특징으로 하는 미세 패턴 형성 방법. The method of claim 6, wherein the deposition process for forming the second mask layer is performed at a temperature lower than a curing temperature of the coating layer pattern. 제6항에 있어서, 상기 제2 마스크막을 형성하기 위한 증착 공정은 200 내지 450℃의 온도에서 수행되는 것을 특징으로 하는 미세 패턴 형성 방법. The method of claim 6, wherein the deposition process for forming the second mask layer is performed at a temperature of 200 to 450 ° C. 8. 제6항에 있어서, 상기 제2 마스크막은 인시튜로 보론이 도핑된 폴리실리콘 물질로 형성되는 것을 특징으로 하는 미세 패턴 형성 방법. The method of claim 6, wherein the second mask layer is formed of a polysilicon material doped with boron in situ. 제9항에 있어서, 상기 제2 마스크막을 증착하기 위한 증착 공정에서, 실리콘 소오스는 SiH4, Si2H6 및 Si3H8로 이루어진 군에서 선택된 적어도 하나를 사용하고, 상기 보론 소오스는 BCl3 및 B2H6로 이루어진 군에서 선택된 적어도 하나를 사용하는 것을 특징으로 하는 미세 패턴 형성 방법. The method of claim 9, wherein in the deposition process for depositing the second mask layer, the silicon source uses at least one selected from the group consisting of SiH 4 , Si 2 H 6, and Si 3 H 8 , and the boron source is BCl 3. And at least one selected from the group consisting of B 2 H 6 . 제6항에 있어서, 상기 제2 마스크막은 인시튜로 보론이 도핑된 실리콘 게르마늄 물질로 형성되는 것을 특징으로 하는 미세 패턴 형성 방법. The method of claim 6, wherein the second mask layer is formed of a silicon germanium material doped with boron in situ. 제11항에 있어서, 상기 제2 마스크막을 증착하기 위한 증착 공정에서, 실리콘 소오스는 SiH4, Si2H6 및 Si3H8로 이루어진 군에서 선택된 적어도 하나를 사용하고, 상기 보론 소오스는 BCl3 및 B2H6로 이루어진 군에서 선택된 적어도 하나를 사용하고, 상기 게르마늄 소오스는 GeH4 가스를 사용하는 것을 특징으로 하는 미세 패턴 형성 방법. The method of claim 11, wherein in the deposition process for depositing the second mask layer, the silicon source uses at least one selected from the group consisting of SiH 4 , Si 2 H 6, and Si 3 H 8 , and the boron source is BCl 3. And at least one selected from the group consisting of B 2 H 6 , and the germanium source uses GeH 4 gas.
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