KR20090076375A - Plasma display panel and method for manufacturing of the same - Google Patents
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Abstract
Description
본 발명은 플라즈마 디스플레이 패널과 그의 제조방법에 대한 것이다.The present invention relates to a plasma display panel and a method of manufacturing the same.
플라즈마 디스플레이 패널은 격벽으로 구획된 방전 셀(Cell) 내에 형성되는 형광체 층을 포함하고, 아울러 복수의 전극(Electrode)을 포함한다.The plasma display panel includes a phosphor layer formed in a discharge cell divided by a partition, and includes a plurality of electrodes.
플라즈마 디스플레이 패널의 전극에 구동 신호를 공급하면, 방전 셀 내에서는 공급되는 구동 신호에 의해 방전이 발생한다. 여기서, 방전 셀 내에서 구동 신호에 의해 방전이 될 때, 방전 셀 내에 충진 되어 있는 방전 가스가 진공자외선(Vacuum Ultraviolet rays)을 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체를 발광시켜 가시 광을 발생시킨다. 이러한 가시 광에 의해 플라즈마 디스플레이 패널의 화면상에 영상이 표시된다.When the drive signal is supplied to the electrode of the plasma display panel, the discharge is generated by the drive signal supplied in the discharge cell. Here, when discharged by a drive signal in the discharge cell, the discharge gas filled in the discharge cell generates vacuum ultraviolet rays, and the vacuum ultraviolet light emits the phosphor formed in the discharge cell to emit visible light. Generate. The visible light displays an image on the screen of the plasma display panel.
본 발명의 일면은 전면 기판에 배치되는 전극의 구조를 개선하여 패널 반사율을 감소시키고, 전극의 단락(Short) 현상의 발생을 방지하는 플라즈마 디스플레이 패널과 그의 제조방법에 관한 것이다.One aspect of the present invention relates to a plasma display panel and a method for manufacturing the same, which improve a structure of an electrode disposed on a front substrate to reduce panel reflectance and prevent occurrence of a short circuit phenomenon of the electrode.
본 발명에 따른 플라즈마 디스플레이 패널은 서로 나란한 스캔 전극과 서스테인 전극이 배치되는 전면 기판과, 스캔 전극 및 서스테인 전극과 교차하는 어드레스 전극이 배치되는 후면 기판 및 전면 기판과 후면 기판 사이에서 방전셀을 구획하는 격벽을 포함하고, 스캔 전극 및 서스테인 전극은 단일층(One Layer)이고, 격벽은 스캔 전극 및 서스테인 전극과 나란한 제 1 격벽과, 스캔 전극 및 서스테인 전극과 교차하는 제 2 격벽을 포함하고, 전면 기판에는 제 1 격벽에 대응되는 위치에 단일층 구조의 더미 전극이 더 배치되고, 스캔 전극 또는 서스테인 전극 중 적어도 하나와 더미 전극 간의 최단 간격은 방전셀의 장변의 길이의 0.039배 이상 0.2배 이하일 수 있다.The plasma display panel according to the present invention divides a discharge cell between a front substrate on which scan electrodes and a sustain electrode are parallel to each other, a rear substrate on which an address electrode intersecting the scan electrode and the sustain electrode is disposed, and a front substrate and a rear substrate. A barrier rib, wherein the scan electrode and the sustain electrode are one layer, the barrier rib including a first barrier wall parallel to the scan electrode and the sustain electrode, and a second barrier wall intersecting the scan electrode and the sustain electrode; The dummy electrode of a single layer structure is further disposed at a position corresponding to the first partition wall, and the shortest distance between at least one of the scan electrode or the sustain electrode and the dummy electrode may be 0.039 times or more and 0.2 times or less of the length of the long side of the discharge cell. .
또한, 스캔 전극 또는 서스테인 전극 중 적어도 하나와 더미 전극 간의 최단 간격은 방전셀의 장변의 길이의 0.039배 이상 0.12배 이하일 수 있다.In addition, the shortest interval between at least one of the scan electrode or the sustain electrode and the dummy electrode may be 0.039 times or more and 0.12 times or less of the length of the long side of the discharge cell.
또한, 더미 전극은 플로팅(Floating)되거나 접지(GND)될 수 있다.In addition, the dummy electrode may be floating or grounded.
또한, 스캔 전극 및 서스테인 전극과 전면 기판 사이에는 각각 블랙층(Black Layer)이 배치될 수 있다.In addition, a black layer may be disposed between the scan electrode, the sustain electrode, and the front substrate.
또한, 스캔 전극, 서스테인 전극 및 블랙층은 함께 노광될 수 있다.In addition, the scan electrode, the sustain electrode and the black layer can be exposed together.
또한, 스캔 전극 및 서스테인 전극 중 적어도 하나는 라인부와, 라인부로부터 방전셀 중심방향으로 돌출되는 돌출부를 포함할 수 있다.In addition, at least one of the scan electrode and the sustain electrode may include a line part and a protrusion part protruding from the line part toward the center of the discharge cell.
또한, 스캔 전극 및 서스테인 전극 중 적어도 하나는 라인부로부터 방전셀 외곽방향으로 돌출되는 꼬리부를 더 포함할 수 있다.In addition, at least one of the scan electrode and the sustain electrode may further include a tail protruding from the line part in the discharge cell outer direction.
또한, 본 발명에 따른 또다른 플라즈마 디스플레이 패널은 서로 나란한 스캔 전극과 서스테인 전극이 배치되는 전면 기판과, 스캔 전극 및 서스테인 전극과 교차하는 어드레스 전극이 배치되는 후면 기판 및 전면 기판과 후면 기판 사이에서 방전셀을 구획하는 격벽을 포함하고, 스캔 전극 및 서스테인 전극은 단일층(One Layer)이고, 격벽은 스캔 전극 및 서스테인 전극과 나란한 제 1 격벽과, 스캔 전극 및 서스테인 전극과 교차하는 제 2 격벽을 포함하고, 전면 기판에는 제 1 격벽에 대응되는 위치에 단일층 구조의 더미 전극이 더 배치되고, 스캔 전극 및 서스테인 전극은 라인부와, 라인부로부터 방전셀 외곽방향으로 돌출되는 꼬리부를 포함하고, 꼬리부와 더미 전극 간의 최단 간격은 방전셀의 장변의 길이의 0.039배 이상 0.2배 이하일 수 있다.In addition, another plasma display panel according to the present invention is discharged between a front substrate on which scan electrodes and a sustain electrode are arranged in parallel with each other, a rear substrate on which an address electrode intersecting the scan electrode and the sustain electrode is disposed, and a front substrate and a rear substrate. A partition wall partitioning the cell, wherein the scan electrode and the sustain electrode are one layer, the partition wall including a first partition wall parallel to the scan electrode and the sustain electrode, and a second partition wall intersecting the scan electrode and the sustain electrode. The front substrate further includes a dummy electrode having a single layer structure at a position corresponding to the first partition wall, wherein the scan electrode and the sustain electrode include a line portion and a tail portion protruding from the line portion in a discharge cell outward direction. The shortest gap between the negative electrode and the dummy electrode may be 0.039 times or more and 0.2 times or less of the length of the long side of the discharge cell.
또한, 스캔 전극 및 서스테인 전극과 전면 기판 사이에는 각각 블랙층(Black Layer)이 배치되고, 스캔 전극, 서스테인 전극 및 블랙층은 함께 노광될 수 있다.In addition, a black layer may be disposed between the scan electrode, the sustain electrode, and the front substrate, respectively, and the scan electrode, the sustain electrode, and the black layer may be exposed together.
또한, 본 발명에 따른 플라즈마 디스플레이 패널의 제조방법은 전면 기판에 블랙 재료를 도포하는 과정과, 블랙 재료 상부에 전극 재료를 도포하는 과정과, 블랙 재료와 전극 재료를 함께 노광하여 서로 나란한 스캔 전극과 서스테인 전극 및 더미 전극을 형성하는 과정 및 전면 기판에 대항되는 후면 기판에 방전셀을 구획하는 격벽을 형성하는 과정을 포함하고, 격벽은 스캔 전극 및 서스테인 전극과 나란한 제 1 격벽과, 스캔 전극 및 서스테인 전극과 교차하는 제 2 격벽을 포함하고, 스캔 전극, 서스테인 전극 및 더미 전극은 단일층(One Layer)이고, 더미 전극은 제 1 격벽과 대응되는 위치에 배치되고, 스캔 전극 또는 서스테인 전극 중 적어도 하나와 더미 전극 간의 최단 간격은 방전셀의 장변의 길이의 0.039배 이상 0.2배 이하일 수 있다.In addition, the manufacturing method of the plasma display panel according to the present invention comprises the steps of applying a black material to the front substrate, a process of applying the electrode material on the black material, the black electrode and the electrode material together to expose the scan electrode and parallel to each other; Forming a sustain electrode and a dummy electrode, and forming a partition wall partitioning a discharge cell on a rear substrate facing the front substrate, wherein the partition wall includes a first partition wall parallel to the scan electrode and the sustain electrode, and the scan electrode and the sustain electrode; And a second partition wall intersecting the electrode, wherein the scan electrode, the sustain electrode, and the dummy electrode are one layer, the dummy electrode is disposed at a position corresponding to the first partition wall, and at least one of the scan electrode and the sustain electrode. The shortest interval between the dummy electrode and the dummy electrode may be 0.039 times or more and 0.2 times or less of the length of the long side of the discharge cell.
본 발명에 따른 플라즈마 디스플레이 패널과 그의 제조방법은 패널 반사율을 감소시킴으로써 구현되는 영상의 콘트라스트(Contrast) 특성을 향상시키고, 전극의 단락(Short) 현상의 발생을 방지함으로써 패널 신뢰성을 높이는 효과가 있다.The plasma display panel and the method of manufacturing the same according to the present invention have the effect of improving the contrast characteristics of an image implemented by reducing the panel reflectance and improving the panel reliability by preventing the occurrence of a short circuit phenomenon of the electrode.
이하, 첨부된 도면을 참조하여 본 발명에 따른 플라즈마 디스플레이 패널과 그의 제조방법을 상세히 설명하기로 한다.Hereinafter, a plasma display panel and a method of manufacturing the same according to the present invention will be described in detail with reference to the accompanying drawings.
도 1은 플라즈마 디스플레이 패널의 구조에 대해 설명하기 위한 도면이다.1 is a diagram for explaining the structure of a plasma display panel.
도 1을 살펴보면 플라즈마 디스플레이 패널(100)은 서로 나란한 스캔 전극(102, Y)과 서스테인 전극(103, Z)이 형성되는 전면 기판(101)과, 스캔 전극(102, Y) 및 서스테인 전극(103, Z)과 교차하는 어드레스 전극(113, X)이 형성되는 후면 기판(111)을 포함할 수 있다.Referring to FIG. 1, the
스캔 전극(102, Y)과 서스테인 전극(103, Z)의 상부에는 스캔 전극(102, Y) 및 서스테인 전극(103, Z)의 방전 전류를 제한하며 스캔 전극(102, Y)과 서스테인 전극(103, Z) 간을 절연시키는 상부 유전체 층(104)이 배치될 수 있다.The discharge currents of the
상부 유전체 층(104)의 상부에는 방전 조건을 용이하게 하기 위한 보호 층(105)이 형성될 수 있다. 이러한 보호 층(105)은 2차 전자 방출 계수가 높은 재질, 예컨대 산화마그네슘(MgO) 재질을 포함할 수 있다.A
후면 기판(111) 상에는 어드레스 전극(113, X)이 형성되고, 이러한 어드레스 전극(113, X)의 상부에는 어드레스 전극(113, X)을 절연시키는 하부 유전체 층(115)이 형성될 수 있다.
하부 유전체 층(115)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(Stripe Type), 웰 타입(Well Type), 델타 타입(Delta Type), 벌집 타입 등의 격벽(112)이 형성될 수 있다. 이에 따라, 전면 기판(101)과 후면 기판(111)의 사이에서 적색(Red : R)광을 방출하는 제 1 방전 셀, 청색(Blue : B)광을 방출하는 제 2 방전 셀 및 녹색(Green : G)광을 방출하는 제 3 방전 셀 등이 형성될 수 있다.On top of the lower
또한, 제 1, 2, 3 방전 셀 이외에 백색(White : W) 또는 황색(Yellow : Y)광을 방출하는 제 4 방전 셀이 더 형성되는 것도 가능하다.In addition, it is also possible to further form a fourth discharge cell emitting white (W) or yellow (Y) light in addition to the first, second and third discharge cells.
한편, 제 1, 2, 3 방전 셀의 폭은 실질적으로 동일할 수도 있지만, 제 1 방전 셀, 제 2 방전 셀 및 제 3 방전 셀 중 적어도 하나의 폭이 다른 방전 셀의 폭과 다르게 할 수도 있다.Meanwhile, the widths of the first, second, and third discharge cells may be substantially the same, but the width of at least one of the first, second, and third discharge cells may be different from that of the other discharge cells. .
예컨대, 적색(R)광을 방출하는 제 1 방전 셀의 폭이 가장 작고, 녹색(G)광을 방출하는 제 3 방전 셀 및 청색(B)광을 방출하는 제 2 방전 셀의 폭을 제 1 방전 셀의 폭보다 크게 할 수 있다. 그러면, 구현되는 영상의 색온도 특성이 향상될 수 있다. 제 2 방전 셀의 폭은 제 3 방전 셀의 폭과 실질적으로 동일하거나 상이할 수 있다.For example, the width of the first discharge cell that emits red (R) light is the smallest, and the width of the third discharge cell that emits green (G) light and the width of the second discharge cell that emits blue (B) light is first. It can be made larger than the width of the discharge cell. Then, color temperature characteristics of the image to be implemented may be improved. The width of the second discharge cell may be substantially the same or different from the width of the third discharge cell.
또한, 격벽(112)은 서로 교차하는 제 1 격벽(112a)과 제 2 격벽(112b)을 포함하고, 여기서, 제 1 격벽(112a)의 높이와 제 2 격벽(112b)의 높이가 서로 다를 수 있다. 여기서, 제 1 격벽(112a)은 후면 기판(111)의 장변과 나란하고, 제 2 격벽(112b)은 후면 기판(111)의 단변과 나란할 수 있다.In addition, the
또한, 도 1에 도시된 격벽(112)의 구조뿐만 아니라, 다양한 형상의 격벽의 구조도 가능할 것이다. 제 1 격벽(112a) 또는 제 2 격벽(112b) 중 하나 이상에 배기 통로로 사용 가능한 채널(Channel)이 형성된 채널형 격벽 구조, 제 1 격벽(112a) 또는 제 2 격벽(112b) 중 하나 이상에 홈(Hollow)이 형성된 홈형 격벽 구조 등이 가능할 것이다.In addition, not only the structure of the
또한, 제 1, 2, 3 방전 셀 각각이 동일한 선상에 배열되는 것으로 도시 및 설명되고 있지만, 다른 형상으로 배열되는 것도 가능할 것이다. 예컨대, 제 1, 2, 3 방전 셀이 삼각형 형상으로 배열되는 델타(Delta) 타입의 배열도 가능할 것이다. 또한, 방전 셀의 형상도 사각형상뿐만 아니라 오각형, 육각형 등의 다양한 다각 형상도 가능할 것이다.In addition, although each of the first, second, and third discharge cells is shown and described as being arranged on the same line, it may be arranged in other shapes. For example, a delta type arrangement in which the first, second and third discharge cells are arranged in a triangular shape may be possible. In addition, the shape of the discharge cell may also be a variety of polygonal shapes, such as pentagonal, hexagonal, as well as rectangular.
또한, 여기 도 1에서는 후면 기판(111)에 격벽(112)이 형성된 경우만을 도시하고 있지만, 격벽(112)은 전면 기판(101) 또는 후면 기판(111) 중 적어도 어느 하 나에 형성될 수 있다.In addition, in FIG. 1, only the case where the
격벽(112)에 의해 구획된 방전 셀 내에는 방전 가스가 채워질 수 있다.The discharge gas may be filled in the discharge cells partitioned by the
아울러, 격벽(112)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(114)이 형성될 수 있다. 예를 들면, 적색 광을 발생시키는 제 1 형광체 층, 청색 광을 발생시키는 제 2 형광체 층 및 녹색 광을 발생시키는 제 3 형광체 층이 형성될 수 있다.In addition, a
또한, 제 1, 2, 3 형광체 이외에 백색(White : W) 및/또는 황색(Yellow : Y) 광을 발생시키는 제 4 형광체 층이 더 형성되는 것도 가능하다.In addition to the first, second, and third phosphors, it is also possible to further form a fourth phosphor layer for generating white (W) and / or yellow (Y) light.
또한, 제 1, 2, 3 형광체 층의 두께가 다른 형광체 층과 상이할 수 있다. 예를 들면, 제 2 형광체 층 또는 제 3 형광체 층의 두께가 제 1 형광체 층의 두께보다 더 두꺼울 수 있다. 여기서, 제 2 형광체 층의 두께는 제 3 형광체 층의 두께와 실질적으로 동일하거나 상이할 수 있다.In addition, the thicknesses of the first, second, and third phosphor layers may be different from other phosphor layers. For example, the thickness of the second phosphor layer or the third phosphor layer may be thicker than the thickness of the first phosphor layer. Here, the thickness of the second phosphor layer may be substantially the same or different from the thickness of the third phosphor layer.
또한, 이상의 설명에서는 상부 유전체 층(104) 및 하부 유전체 층(115)이 각각 하나의 층(Layer)인 경우만을 도시하고 있지만, 이러한 상부 유전체 층(104) 및 하부 유전체 층(115) 중 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.In addition, the above description shows only the case where the upper
아울러, 격벽(112)으로 인한 외부 광의 반사를 방지하기 위해 격벽(112)의 상부에 외부 광을 흡수할 수 있는 블랙 층(미도시)을 더 배치하는 것도 가능하다.In addition, in order to prevent reflection of external light due to the
또한, 격벽(112)과 대응되는 전면 기판(101) 상의 특정 위치에 또 다른 블랙 층(미도시)이 더 형성되는 것도 가능하다.In addition, another black layer (not shown) may be further formed at a specific position on the
또한, 후면 기판(111) 상에 형성되는 어드레스 전극(113)은 폭이나 두께가 실질적으로 일정할 수도 있지만, 방전 셀 내부에서의 폭이나 두께가 방전 셀 외부에서의 폭이나 두께와 다를 수도 있을 것이다. 예컨대, 방전 셀 내부에서의 폭이나 두께가 방전 셀 외부에서의 그것보다 더 넓거나 두꺼울 수 있을 것이다.In addition, although the width and thickness of the
도 2는 플라즈마 디스플레이 패널의 구동방법을 설명하기 위한 도면이다.2 is a view for explaining a method of driving a plasma display panel.
도 2를 살펴보면, 프레임(Frame)의 복수의 서브필드(Sub-Field) 중 적어도 하나의 서브필드의 초기화를 위한 리셋 기간(RP)에서는 스캔 전극(Y)으로 상승 신호(RS)와 하강 신호(FS)가 공급될 수 있다.Referring to FIG. 2, in the reset period RP for initializing at least one subfield among a plurality of subfields of a frame, the rising signal RS and the falling signal RS may be applied to the scan electrode Y. FS) can be supplied.
예를 들면, 리셋 기간의 셋업 기간(SU)에서는 스캔 전극에 상승신호가 공급되고, 셋업 기간 이후의 셋다운 기간(SD)에서는 스캔 전극에 하강신호가 공급될 수 있다.For example, the rising signal may be supplied to the scan electrode in the setup period SU of the reset period, and the falling signal may be supplied to the scan electrode in the set-down period SD after the setup period.
스캔 전극에 상승 신호가 공급되면, 상승 신호에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 벽 전하(Wall Charge)의 분포가 균일해질 수 있다.When the rising signal is supplied to the scan electrode, a weak dark discharge, that is, a setup discharge occurs in the discharge cell by the rising signal. By this setup discharge, the distribution of wall charges can be uniform in the discharge cells.
상승 신호가 공급된 이후, 스캔 전극에 하강 신호가 공급되면, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류될 수 있다.After the rising signal is supplied, when the falling signal is supplied to the scan electrode, a weak erase discharge, that is, a set-down discharge occurs in the discharge cell. By this set-down discharge, wall charges such that address discharge can be stably generated can be uniformly retained in the discharge cells.
리셋 기간 이후의 어드레스 기간(AP)에서는 하강 신호의 최저 전압보다는 높은 전압을 갖는 스캔 바이어스 신호(Vsc)가 스캔 전극에 공급될 수 있다.In the address period AP after the reset period, the scan bias signal Vsc having a voltage higher than the lowest voltage of the falling signal may be supplied to the scan electrode.
또한, 어드레스 기간에서는 스캔 바이어스 신호로부터 하강하는 스캔 신 호(Scan)가 스캔 전극에 공급될 수 있다.In addition, in the address period, a scan signal (Scan) falling from the scan bias signal may be supplied to the scan electrode.
한편, 적어도 하나의 서브필드의 어드레스 기간에서 스캔 전극으로 공급되는 스캔 신호의 펄스폭은 다른 서브필드의 스캔 신호의 펄스폭과 다를 수 있다. 예컨대, 시간상 뒤에 위치하는 서브필드에서의 스캔 신호의 폭이 앞에 위치하는 서브필드에서의 스캔 신호의 폭보다 작을 수 있다. 또한, 서브필드의 배열 순서에 따른 스캔 신호 폭의 감소는 2.6㎲(마이크로초), 2.3㎲, 2.1㎲, 1.9㎲ 등과 같이 점진적으로 이루어질 수 있거나 2.6㎲, 2.3㎲, 2.3㎲, 2.1㎲......1.9㎲, 1.9㎲ 등과 같이 이루어질 수도 있다.Meanwhile, the pulse width of the scan signal supplied to the scan electrode in the address period of at least one subfield may be different from the pulse width of the scan signal of another subfield. For example, the width of the scan signal in the subfield located later in time may be smaller than the width of the scan signal in the preceding subfield. In addition, the reduction of the scan signal width according to the arrangement order of the subfields can be made gradually, such as 2.6 Hz (microseconds), 2.3 Hz, 2.1 Hz, 1.9 Hz, or 2.6 Hz, 2.3 Hz, 2.3 Hz, 2.1 Hz. .... 1.9 ㎲, 1.9 ㎲ and so on.
이와 같이, 스캔 신호가 스캔 전극으로 공급될 때, 스캔 신호에 대응되게 어드레스 전극(X)에 데이터 신호(Data)가 공급될 수 있다.As such, when the scan signal is supplied to the scan electrode, the data signal Data may be supplied to the address electrode X corresponding to the scan signal.
이러한 스캔 신호와 데이터 신호가 공급되면, 스캔 신호와 데이터 신호 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 신호가 공급되는 방전 셀 내에는 어드레스 방전이 발생될 수 있다.When the scan signal and the data signal are supplied, an address discharge may be generated in the discharge cell to which the data signal is supplied while the voltage difference between the scan signal and the data signal and the wall voltage generated by the wall charges generated in the reset period are added. .
어드레스 기간 이후의 서스테인 기간(SP)에서는 스캔 전극 또는 서스테인 전극 중 적어도 하나에 서스테인 신호(SUS)가 공급될 수 있다. 예를 들면, 스캔 전극과 서스테인 전극에 교번적으로 서스테인 신호가 공급될 수 있다.In the sustain period SP after the address period, the sustain signal SUS may be supplied to at least one of the scan electrode and the sustain electrode. For example, a sustain signal may be alternately supplied to the scan electrode and the sustain electrode.
이러한 서스테인 신호가 공급되면, 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 신호의 서스테인 전압(Vs)이 더해지면서 서스테인 신호가 공급될 때 스캔 전극과 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 발생될 수 있다.When such a sustain signal is supplied, the discharge cell selected by the address discharge is added with the wall voltage in the discharge cell and the sustain voltage Vs of the sustain signal, and a sustain discharge, i.e., display between the scan electrode and the sustain electrode when the sustain signal is supplied. Discharge may occur.
도 3은 스캔 전극, 서스테인 전극 및 블랙층에 대해 설명하기 위한 도면이다.3 is a diagram for explaining a scan electrode, a sustain electrode, and a black layer.
도 3을 살펴보면, 스캔 전극(102)과 서스테인 전극(103)은 단일 층(One Layer)구조일 수 있다. 즉, 스캔 전극(102)과 서스테인 전극(103)은 투명 전극이 생략된 버스(Bus) 전극인 것이다.Referring to FIG. 3, the
또한, 스캔 전극(102) 및 서스테인 전극(103)과 전면 기판(101) 사이에는 각각 블랙층(120, 130)이 배치될 수 있다.In addition,
스캔 전극(102)과 서스테인 전극(103)은 전기 전도성이 우수하고, 성형하기 쉬운 금속성 재질, 예컨대 음(Ag), 금(Au), 구리(Cu), 알루미늄(Al) 등의 재질로 이루어질 수 있다.The
블랙층(120. 130)은 흑색도(Degree of Darkness)가 상대적으로 높은 재질, 예컨대 코발트(Co) 재질과 루테늄(Ru)을 포함할 수 있다.The
이와 같이, 스캔 전극(102) 및 서스테인 전극(103)과 전면 기판(101) 사이에 블랙층(120, 130)이 배치되면, 패널 반사율을 저감시켜 구현되는 영상의 콘트라스트(Contrast) 특성이 향상될 수 있다.As such, when the
도 4 내지 도 5는 스캔 전극과 서스테인 전극의 구조를 보다 상세히 설명하기 위한 도면이다.4 to 5 are views for explaining the structure of the scan electrode and the sustain electrode in more detail.
먼저, 도 4를 살펴보면 스캔 전극(102)과 서스테인 전극(103)은 어드레스 전극(113)과 교차하는 복수의 라인부(521a, 521b, 531a, 531b)와, 복수의 라인부(521a, 521b, 531a, 531b) 중 적어도 하나의 라인부로부터 방전셀의 중심방향으 로 돌출되는 적어도 하나의 돌출부(522a, 522b, 532a, 532b)를 포함할 수 있다.First, referring to FIG. 4, the
또한, 스캔 전극(102)과 서스테인 전극(103)은 복수의 라인부(521a, 521b, 531a, 531b) 중 적어도 두 개의 라인부를 연결하는 연결부(523, 533)를 포함할 수 있다. 예컨대 스캔 전극(102)의 제 1 라인부(521a)와 제 2 라인부(521b)를 연결하는 제 1 연결부(523)와, 서스테인 전극(103)의 제 1 라인부(531a)와 제 2 라인부(531b)를 연결하는 제 2 연결부(533)를 더 포함할 수 있다.In addition, the
스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나에 구동신호가 공급되면, 스캔 전극(102)의 돌출부(522a, 522b)와 서스테인 전극(103)의 돌출부(532a, 532b)의 사이에서 방전이 개시될 수 있다.When a driving signal is supplied to at least one of the
개시된 방전은 스캔 전극(102)의 제 1 라인부(521a)와 서스테인 전극(103)의 제 1 라인부(531a)로 확산되고, 이후 연결부(523, 533)를 타고 스캔 전극(102)의 제 2 라인부(521b)와 서스테인 전극(103)의 제 2 라인부(531b)로 확산될 수 있다.The discharge discharged is diffused into the
도 4에서는 스캔 전극(102)이 두 개의 돌출부(522a, 522b)를 포함하고, 서스테인 전극(103)도 두 개의 돌출부(532a, 532b)를 포함하는 경우만을 도시하고 있지만, 돌출부의 개수는 이에 한정되지 않는다. 예를 들면 스캔 전극(102)과 서스테인 전극(103)이 각각 3개씩의 돌출부를 포함하는 것도 가능하고, 또는 스캔 전극(102)이 4개의 돌출부를 포함하고, 서스테인 전극(103)은 3개의 돌출부를 포함하는 것도 가능한 것이다.In FIG. 4, the
복수의 라인부들(521a, 521b, 531a, 531b)은 소정의 폭을 갖는다, 예를 들어, 스캔 전극(102)의 제 1 라인부(521a)는 W1의 폭을 갖고, 제 2 라인부(521b)는 W2의 폭을 가지고, 아울러 서스테인 전극(103)의 제 1 라인부(531a)는 W3의 폭을 갖고, 제 2 라인부(531b)는 W4의 폭을 갖는다. 여기서, W1, W2, W3, W4는 실질적으로 동일한 값을 갖는 것도 가능하고, 하나 이상이 상이한 값을 갖는 것도 가능하다. 예를 들면, 스캔 전극(102)의 제 1 라인부(521a)와 서스테인 전극(103)의 제 1 라인부(531a)의 폭(W1, W3)이 대략 35㎛이고, 제 2 라인부(521b, 531b)의 폭(W2, W4)은 45㎛로서 스캔 전극(102)의 제 1 라인부(521a)와 서스테인 전극(103)의 제 1 라인부(531a)의 폭(W1, W3)이 제 2 라인부(521b, 531b)의 폭(W2, W4)보다 더 작을 수 있다.The plurality of
한편, 스캔 전극(102)의 제 1 라인부(521a)와 제 2 라인부(521b) 사이 간격(g3)과 서스테인 전극(103)의 제 1 라인부(531a)와 제 2 라인부(531b) 사이 간격(g4)이 과도하게 큰 경우에는 스캔 전극(102)과 서스테인 전극(103) 사이에서 개시된 방전이 스캔 전극(102)의 제 2 라인부(521b)와 서스테인 전극(103)의 제 2 라인부(531b)로 원활히 확산되기 어렵고, 반면에 과도하게 작은 경우에는 격벽(112)을 구획된 방전 셀의 후방으로 방전을 확산시키기가 어렵다. 따라서 스캔 전극(102)의 제 1 라인부(521a)와 제 2 라인부(521b) 사이 간격(g3)과 서스테인 전극(103)의 제 1 라인부(531a)와 제 2 라인부(531b) 사이 간격(g4)은 대략 170㎛이상 210㎛이하인 것이 바람직할 수 있다.Meanwhile, the gap g3 between the
돌출부(522a. 522b, 532a, 532b)들은 서로 소정 거리 이격되어 배치될 수 있다. 예를 들면, 스캔 전극(102)의 제 1 돌출부(522a)와 제 2 돌출부(522b)는 g1 간격을 두고 이격되고, 서스테인 전극(103)의 제 3 돌출부(532a)와 제 4 돌출 부(532b)는 g2 간격을 두고 이격될 수 있다. 여기서, g1 및 g2 중 적어도 하나는 방전 효율을 충분히 확보하기 위해 75㎛이상 110㎛이하인 것이 바람직할 수 있다.The
한편, 도 5를 살펴보면 스캔 전극(102)과 서스테인 전극(103)은 적어도 하나의 라인부로부터 방전셀의 후방으로 돌출되는 꼬리부(522c, 532c)를 포함할 수 있다.Meanwhile, referring to FIG. 5, the
이와 같이, 스캔 전극(102)과 서스테인 전극(103)이 꼬리부를 포함하면 개시된 방전이 꼬리부(522c, 532c)를 타고 방전 셀의 후방으로 더욱 넓게 확산될 수 있다.As such, when the
또한, 돌출부(522a. 522b, 532a, 532b)의 길이는 꼬리부(552c, 532c)의 길이와 다를 수 있다. 예를 들면, 돌출부(522a. 522b, 532a, 532b)의 길이는 꼬리부(552c, 532c)의 길이보다 길 수 있다. 그러면, 스캔 전극(102)과 서스테인 전극(103) 간의 방전 개시 전압을 낮출 수 있다. 이와는 반대로 꼬리부(552c, 532c)의 길이가 돌출부(522a. 522b, 532a, 532b)의 길이보다 긴 경우에는 스캔 전극(102)의 돌출부(522a. 522b)와 서스테인 전극(103)의 돌출부(532a, 532b) 사이에서 개시된 방전을 방전셀 후방으로 더욱 효과적으로 확산시킬 수 있다.In addition, the lengths of the
도 6 내지 도 7은 더미 전극에 대해 설명하기 위한 도면이다.6 to 7 are diagrams for explaining the dummy electrode.
먼저, 도 6을 살펴보면 전면 기판(미도시)에는 스캔 전극(102) 및 서스테인 전극(103)과 나라한 제 1 격벽(112a)에 대응되는 위치에 단일층 구조의 더미 전극(600)이 배치될 수 있다.First, referring to FIG. 6, a
또한, 더미 전극(600)은 스캔 전극(102) 및 서스테인 전극(103)과 동일한 층(Layer)에 배치되는 것이 바람직할 수 있다.In addition, the
또한, 더미 전극(600)은 플로팅(Floating)되거나 접지(GND)될 수 있다. 더미 전극(600)이 접지되는 경우에는 인접하는 방전셀간에 전하들의 이동을 억제함으로써 크로스토크(Cross-talk)의 발생을 억제할 수 있다.In addition, the
더미 전극(600)과 전면 기판의 사이에는 또 다른 블랙층이 배치될 수 있다. 이와 같이, 더미 전극(600)과 전면 기판의 사이에 또 다른 블랙층을 배치하게 되면, 패널 반사율을 저감시킴으로써 구현되는 영상의 콘트라스트 특성을 향상시킬 수 있다.Another black layer may be disposed between the
다음, 도 7과 같이 서스테인 전극(103)이 꼬리부(532c)를 포함하는 경우에는 더미 전극(600)과 서스테인 전극(103)의 최단 간격(d)은 더미 전극(600)과 서스테인 전극(103)의 꼬리부(532c)간의 간격이다. 여기 도 7에서는 서스테인 전극(103)과 더미 전극(600)간의 관계만을 도시하였지만, 스캔 전극(102)과 더미 전극(600)도 이와 동일할 수 있다.Next, as shown in FIG. 7, when the sustain
도 8 내지 도 10은 스캔 전극 및 서스테인 전극과 더미 전극의 최단 간격에 대해 설명하기 위한 도면이다.8 to 10 are diagrams for explaining the shortest gap between the scan electrode, the sustain electrode, and the dummy electrode.
도 8에는 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 간의 최단 간격(d)과 방전셀의 장변의 길이(L) 간의 비율(d/L)이 0.01에서 0.30사이의 값을 가질 때, 구현되는 영상의 휘도를 측정하고, 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600)이 단락(Short) 되는지의 여부를 관찰한 데이터가 도시되어 있다.8 shows a ratio d / L between the shortest distance d between at least one of the
단락 발생을 관찰할 때는 실험에 사용된 복수의 패널 중에서 적어도 하나의 패널에서 단락이 발생하는 경우에 단락이 발생한 것으로 판단하였다. 또한, 영상의 휘도를 측정할 때는 실험에 사용된 복수의 패널 중에서 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600)의 단락이 발생하지 않는 패널을 사용하였다.When observing the occurrence of a short circuit, it was determined that a short circuit occurred when a short circuit occurred in at least one panel among a plurality of panels used in the experiment. In addition, when measuring the luminance of the image, a panel in which at least one of the
영상의 휘도 측면에서 ◎ 표시는 영상의 휘도가 충분히 높아서 매우 양호함을 나타내고, □ 표시는 상대적으로 양호함을 나타내고, △ 표시는 영상의 휘도가 과도하게 낮아서 불량함을 나타내고, 단락 발생의 측면에서는 ○ 표시는 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600)이 단락되는 것을 나타내고, X 표시는 단락이 발생하지 않음을 나타낸다.In terms of the brightness of the image, the mark ◎ indicates that the image is high enough to be very good, the mark □ indicates that it is relatively good, and the △ mark indicates that the image is excessively low and poor, and in terms of occurrence of short circuits. A mark indicates that at least one of the
도 8을 살펴보면, 영상의 휘도 측면에서 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 간의 최단 간격(d)이 방전셀의 장변의 길이(L)의 0.25배 이상 0.30배 이하인 경우에는 매우 불량함을 알 수 있다.Referring to FIG. 8, the shortest distance d between at least one of the
이러한 경우에는, 도 9의 경우와 같이 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 간의 최단 간격(d)이 방전셀의 장변의 길이(L)에 비해 과도하게 클 수 있고, 이에 따라 스캔 전극(102)과 서스테인 전극(103)이 방전셀의 중앙부분에 치우치게 배치될 수 있다. 그러면, 가시광선의 발생량이 상대적으로 많은 방전셀의 중앙부분이 스캔 전극(102)과 서스테인 전극(103)에 의해 과도하게 가려지게 됨으로써 구현되는 영상의 휘도가 과도하게 낮아질 수 있는 것이다.In this case, as shown in FIG. 9, the shortest distance d between at least one of the
반면에, 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 간의 최단 간격(d)이 방전셀의 장변의 길이(L)의 0.17배 이상 0.20배 이하인 경우에는 영상의 휘도 측면에서 상대적으로 양호함을 알 수 있다.On the other hand, when the shortest distance d between at least one of the
또한, 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 간의 최단 간격(d)이 방전셀의 장변의 길이(L)의 0.01배 이상 0.12배 이하인 경우에는 영상의 휘도 측면에서 매우 양호함을 알 수 있다. 이러한 경우에는 스캔 전극(102)과 서스테인 전극(103)이 방전셀의 중앙부분이 가려지지 않도록 방전셀의 후방향에 배치될 수 있고, 이에 따라 영상의 휘도가 충분히 높을 수 있다.In addition, when the shortest distance d between at least one of the
단락 발생의 측면에서 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 간의 최단 간격(d)이 방전셀의 장변의 길이(L)의 0.01배 이상 0.02배 이하인 경우에는 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 사이에서 전기적 단락이 발생할 수 있다.When the shortest distance d between at least one of the
이러한 경우에는 도 10의 경우와 같이, 서스테인 전극(103)의 꼬리부(532c)와 더미 전극(600) 간의 간격(d2)이 과도하게 작아짐으로써 서스테인 전극(103)의 꼬리부(532c)와 더미 전극(600)이 접촉하지 않은 경우에도 서스테인 전극(103)과 더미 전극(600)이 전기적으로 단락될 수 있다. 또는 서스테인 전극(103)의 꼬리부(532c)와 더미 전극(600)이 소정 이격되도록 설계를 하였지만, 공정 상 오차로 인해 서스테인 전극(103)의 꼬리부(532c)와 더미 전극(600)이 접촉함으로써 전기적 단락이 발생하는 경우도 발생할 수 있다.In this case, as shown in FIG. 10, the distance d2 between the
반면에, 스캔 전극(102) 및 서스테인 전극(103) 중 적어도 하나와 더미 전 극(600) 간의 최단 간격(d)이 방전셀의 장변의 길이(L)의 0.039배 이상 0.30배 이하인 경우에는 스캔 전극(102) 및 서스테인 전극(103)과 더미 전극(600)의 최단 간격(d)이 충분히 클 수 있고, 이에 따라 전기적 단락이 발생하지 않음을 알 수 있다.On the other hand, when the shortest distance d between at least one of the
이상의 도 8의 데이터를 고려할 때, 스캔 전극(102) 또는 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 간의 최단 간격(d)은 방전셀의 장변의 길이(L)의 0.039배 이상 0.2배 이하인 것이 바람직할 수 있고, 0.039배 이상 0.12배 이하인 것이 더욱 바람직할 수 있다.In consideration of the data of FIG. 8, the shortest distance d between at least one of the
스캔 전극(102)과 서스테인 전극(103)이 방전셀 외곽방향으로 돌출된 꼬리부(522c, 532c)를 포함하는 경우에는 꼬리부(522c, 532c)와 더미 전극(600) 간의 최단 간격(d)은 방전셀의 장변의 길이(L)의 0.039배 이상 0.2배 이하인 것이 바람직할 수 있고, 0.039배 이상 0.12배 이하인 것이 더욱 바람직할 수 있다.In the case where the
도 11은 스캔 전극과 서스테인 전극의 또 다른 구조의 일례에 대해 설명하기 위한 도면이다.It is a figure for demonstrating another example of the structure of a scan electrode and a sustain electrode.
도 11을 살펴보면, 스캔 전극(102)과 서스테인 전극(103)의 복수의 돌출부(522a, 522b, 532a, 532b) 중 적어도 하나는 적어도 일부분이 곡률(Curvature)을 가질 수 있다. 바람직하게는, 복수의 돌출부(522a, 522b, 532a, 532b) 중 적어도 하나의 끝단부가 곡률을 가질 수 있다.Referring to FIG. 11, at least one of the plurality of protrusions 522a, 522b, 532a, and 532b of the
또는, 돌출부(522a, 522b, 532a, 532b)와 라인부(521a, 521b, 531a, 531b)가 연결되는 부분이 곡률을 갖는 것도 가능하다.Alternatively, the portion where the
또는, 라인부(521a, 521b, 531a, 531b)와 연결부(523, 533)가 연결되는 부분이 곡률을 갖는 것도 가능하다.Alternatively, the portion where the
또는, 꼬리부(522c, 532c)는 적어도 일부분이 곡률을 갖는 부분을 포함할 수 있다.Alternatively, the
이와 같이, 스캔 전극(102)과 서스테인 전극(103)의 일부분이 곡률을 갖도록 형성하면 스캔 전극(102)과 서스테인 전극(103)의 제조 공정이 보다 용이해질 수 있다. 아울러, 구동 시 벽 전하가 특정 위치에 과도하게 집중되는 것을 방지할 수 있어서 구동을 안정시킬 수 있다.As such, when a portion of the
도 12 내지 도 13은 플라즈마 디스플레이 패널의 제조방법에 대해 설명하기 위한 도면이다.12 to 13 illustrate a method of manufacturing a plasma display panel.
먼저, 도 12를 살펴보면 (a)와 같이 전면 기판(101)에 블랙 재료(1200)를 도포할 수 있다. 블랙 재료(1200)는 흑색도가 높은 재질, 예컨대 코발트(Co) 재질과 루테늄(Ru) 재질을 포함할 수 있다.First, referring to FIG. 12, a
이후, (b)와 같이 블랙 재료(1200) 상부에 전극 재료(1210)를 도포할 수 있다. 전극 재료(1210) 은(Ag) 재질을 포함할 수 있다.Thereafter, as illustrated in (b), the
이후, (c)와 같이 블랙 재료(1200)와 전극 재료(1210)의 상부에 패턴(Pattern)이 형성된 포토마스크(Photo-Mask, 1220)를 배치하고, 포토마스크(1220)를 이용하여 블랙 재료(1200)와 전극 재료(1210)를 함께 노광할 수 있다.Subsequently, as shown in (c), a photo-mask (1220) having a pattern formed thereon is disposed on the
그러면, (d)와 같이 전극(1240)과 블랙층(1230)이 형성될 수 있다. 즉, 전극(1240)과 블랙층(1230)을 함께 노광되어 형성되는 것이다. 여기서, 전극(1240)은 스캔 전극, 서스테인 전극 및 더미 전극 중 적어도 하나일 수 있다.Then, the
아울러, 도시하지는 않았지만 전면 기판에 대항되는 후면 기판에 방전셀을 구획하는 격벽을 형성하고, 전면 기판과 후면 기판을 합착하여 플라즈마 디스플레이 패널을 형성할 수 있다.In addition, although not shown, a partition wall may be formed on the rear substrate facing the front substrate to partition the discharge cells, and the front substrate and the rear substrate may be joined to form a plasma display panel.
도 12와 같이 전극(1240)과 블랙층(1230)을 함께 노광하게 되면, 도 13에서와 같이 제 1 격벽(112a)에 대응되는 지점에 더미 전극(1330)이 스캔 전극(1310) 및 서스테인 전극(1320)과 함께 형성된다. 즉, 제 1 격벽(112a)에 대응되는 지점에 배치되는 더미 전극(1330), 서로 나란한 스캔 전극(1310)과 서스테인 전극(1320), 블랙층(1311, 1321, 1331)이 함께 노광됨으로써 형성되는 것이다.When the
따라서, 전극(1240)과 블랙층(1230)을 함께 노광하는 공정에서 앞서 상세히 설명한 바와 같이 스캔 전극(102) 또는 서스테인 전극(103) 중 적어도 하나와 더미 전극(600) 간의 최단 간격(d)은 방전셀의 장변의 길이(L)의 0.039배 이상 0.2배 이하로 하거나, 0.039배 이상 0.12배 이하인 것이 더욱 바람직할 수 있는 것이다.Therefore, in the process of exposing the
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.As such, the technical configuration of the present invention described above can be understood by those skilled in the art that the present invention can be implemented in other specific forms without changing the technical spirit or essential features of the present invention.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범 위에 포함되는 것으로 해석되어야 한다.Therefore, the exemplary embodiments described above are to be understood as illustrative and not restrictive in all respects, and the scope of the present invention is indicated by the appended claims rather than the foregoing detailed description, and the meaning and scope of the claims are as follows. And all changes or modifications derived from the equivalent concept should be interpreted as being included in the scope of the present invention.
도 1은 플라즈마 디스플레이 패널의 구조에 대해 설명하기 위한 도면.1 is a diagram for explaining the structure of a plasma display panel;
도 2는 플라즈마 디스플레이 패널의 구동방법을 설명하기 위한 도면.2 is a view for explaining a method of driving a plasma display panel.
도 3은 스캔 전극, 서스테인 전극 및 블랙층에 대해 설명하기 위한 도면.3 is a diagram for explaining a scan electrode, a sustain electrode, and a black layer.
도 4 내지 도 5는 스캔 전극과 서스테인 전극의 구조를 보다 상세히 설명하기 위한 도면.4 to 5 are views for explaining the structure of the scan electrode and the sustain electrode in more detail.
도 6 내지 도 7은 더미 전극에 대해 설명하기 위한 도면.6 to 7 are diagrams for explaining the dummy electrode.
도 8 내지 도 10은 스캔 전극 및 서스테인 전극과 더미 전극의 최단 간격에 대해 설명하기 위한 도면.8 to 10 are diagrams for explaining the shortest gap between the scan electrode, the sustain electrode and the dummy electrode.
도 11은 스캔 전극과 서스테인 전극의 또 다른 구조의 일례에 대해 설명하기 위한 도면.11 is a view for explaining an example of still another structure of a scan electrode and a sustain electrode;
도 12 내지 도 13은 플라즈마 디스플레이 패널의 제조방법에 대해 설명하기 위한 도면.12 to 13 are views for explaining a method for manufacturing a plasma display panel.
<도면의 주요 부분에 대한 번호의 설명><Description of the numbers for the main parts of the drawings>
101 : 전면 기판 102 : 스캔 전극101: front substrate 102: scan electrode
103 : 서스테인 전극 104 : 상부 유전체층103: sustain electrode 104: upper dielectric layer
105 : 보호층 111 : 후면 기판105: protective layer 111: back substrate
112 : 격벽 113 : 어드레스 전극112: partition 113: address electrode
114 : 형광체층 115 : 하부 유전체층114
Claims (10)
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KR1020080002289A KR20090076375A (en) | 2008-01-08 | 2008-01-08 | Plasma display panel and method for manufacturing of the same |
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