KR20070113875A - Spacer and electron emission display device with the spacer - Google Patents

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KR20070113875A
KR20070113875A KR1020060047725A KR20060047725A KR20070113875A KR 20070113875 A KR20070113875 A KR 20070113875A KR 1020060047725 A KR1020060047725 A KR 1020060047725A KR 20060047725 A KR20060047725 A KR 20060047725A KR 20070113875 A KR20070113875 A KR 20070113875A
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안상혁
이상조
제병길
전상호
조진희
홍수봉
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삼성에스디아이 주식회사
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Abstract

A spacer and an electron emission display device having the same are provided to prevent distortion of equipotential lines even when temperature is linearly changed from an electron emission portion to an anode. A spacer is interposed between a first substrate(10) and a second substrate(12) which form a vacuum envelope. A preform(22) is made of dielectric and has a certain height along a thickness direction of the first and second substrates. A first coating layer(24) is formed on a surface of the preform which is adjacent to the first substrate. A second coating layer(26) is formed on a surface of the preform which is adjacent to the second substrate, and is made of material having conductivity lower than that of the first coating layer.

Description

스페이서 및 이 스페이서를 구비한 전자 방출 표시 디바이스 {Spacer and Electron Emission Display Device with The Spacer}Spacer and Electron Emission Display Device with The Spacer

도 1은 본 발명의 일 실시예에 따른 전자 방출 표시 디바이스를 개략적으로 나타낸 부분 단면도이다.1 is a partial cross-sectional view schematically illustrating an electron emission display device according to an exemplary embodiment of the present invention.

도 2는 스페이서에 제1코팅층만 형성한 전자 방출 표시 디바이스를 개략적으로 나타낸 부분 단면도이다.2 is a partial cross-sectional view schematically illustrating an electron emission display device in which only a first coating layer is formed on a spacer.

도 3은 본 발명의 일 실시예에 따른 전계 방출 어레이(FEA)형 전자 방출 표시 디바이스의 부분 분해 사시도이다.3 is a partially exploded perspective view of a field emission array (FEA) type electron emission display device according to an embodiment of the present invention.

도 4는 본 발명의 일 실시예에 따른 전계 방출 어레이(FEA)형 전자 방출 표시 디바이스의 부분 단면도이다.4 is a partial cross-sectional view of a field emission array (FEA) type electron emission display device in accordance with one embodiment of the present invention.

도 5는 본 발명의 일 실시예에 따른 표면 전도 에미션(SCE)형 전자 방출 표시 디바이스의 부분 단면도이다.5 is a partial cross-sectional view of a surface conduction emission (SCE) type electron emission display device according to an embodiment of the present invention.

본 발명은 전자 방출 표시 디바이스에 관한 것으로서, 보다 상세하게는 진공 용기 내부에 설치되어 진공 용기에 가해지는 압축력을 지지하는 스페이서들 및 이 스페이서들을 구비한 전자 방출 표시 디바이스에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an electron emission display device, and more particularly, to spacers installed in a vacuum container to support a compressive force applied to the vacuum container, and an electron emission display device having the spacers.

일반적으로 전자 방출 소자(electron emission element)는 전자원의 종류에 따라 열음극(hot cathode)을 이용하는 방식과 냉음극(cold cathode)을 이용하는 방식으로 분류할 수 있다.In general, electron emission elements may be classified into a method using a hot cathode and a cold cathode according to the type of electron source.

여기서, 냉음극을 이용하는 방식의 전자 방출 소자로는 전계 방출 어레이(Field Emitter Array; FEA)형, 표면 전도 에미션(Surface-Conduction Emission; SCE)형, 금속-절연층-금속(Metal-Insulator-Metal; MIM)형 및 금속-절연층-반도체(Metal-Insulator-Semiconductor; MIS)형 등이 알려져 있다.Here, the electron-emitting device using the cold cathode is a field emitter array (FEA) type, a surface conduction emission type (SCE) type, a metal-insulation layer-metal Metal (MIM) type and Metal-Insulator-Semiconductor (MIS) type are known.

전계 방출 어레이(FEA)형 전자 방출 소자는 일함수(work function)가 낮거나 종횡비가 큰 물질을 전자원으로 사용하는 경우 진공 중에서 전계에 의해 쉽게 전자가 방출되는 원리를 이용한 것으로서, 몰리브덴(Mo) 또는 실리콘(Si) 등을 주 재질로 하는 선단이 뾰족한 팁 구조물로 전자 방출부를 형성하거나, 탄소 나노튜브 같은 탄소계 물질로 전자 방출부를 형성한 예가 개발되고 있다.The field emission array (FEA) type electron emission device uses a principle that electrons are easily emitted by an electric field in vacuum when a material having a low work function or a high aspect ratio is used as an electron source. Molybdenum (Mo) Alternatively, an example has been developed in which an electron emission unit is formed of a tip structure having a sharp tip, mainly made of silicon (Si), or an electron emission unit is formed of a carbon-based material such as carbon nanotubes.

표면 전도 에미션(SCE)형 전자 방출 소자는 일 기판 위에 서로 마주보며 배치된 제1전극과 제2전극 사이에 도전 박막을 제공하고 이 도전 박막에 미세 균열을 제공함으로써 전자 방출부를 형성하고 있으며, 양 전극에 전압을 인가하여 도전 박막의 표면으로 전류가 흐를 때 전자 방출부로부터 전자가 방출되는 원리를 이용한다.The surface conduction emission (SCE) type electron emission device forms an electron emission portion by providing a conductive thin film between a first electrode and a second electrode disposed to face each other on a substrate and providing a micro crack in the conductive thin film. By applying a voltage to both electrodes, a principle is used in which electrons are emitted from the electron emission unit when a current flows to the surface of the conductive thin film.

금속-절연층-금속(MIM)형과 금속-절연층-반도체(MIS)형 전자 방출 소자는 각각 금속/절연층/금속(MIM)과 금속/절연층/반도체(MIS) 구조로 이루어진 전자 방출 부를 구비하며, 절연층을 사이에 두고 위치하는 두 금속 또는 금속과 반도체 사이에 전압을 인가할 때, 금속이나 반도체로부터 공급되는 전자가 터널링(tunneling) 현상에 의해 절연층을 통과하여 상부 금속에 도달하고, 도달한 전자 중 상부 금속의 일 함수 이상의 에너지를 가지는 전자가 상부 금속으로부터 방출되는 원리를 이용한다.Metal-insulating layer-metal (MIM) type and metal-insulating layer-semiconductor (MIS) type electron emission devices have electron emission structures of metal / insulation layer / metal (MIM) and metal / insulation layer / semiconductor (MIS) structures, respectively. When a voltage is applied between two metals or metals and semiconductors having an insulating layer interposed therebetween, electrons supplied from the metal or semiconductor pass through the insulating layer and reach the upper metal by a tunneling phenomenon. In addition, a principle in which electrons having energy above a work function of the upper metal are emitted from the upper metal among the reached electrons is used.

전자 방출 소자는 제1기판에 어레이를 이루며 배치되어 전자 방출 디바이스(electron emission device)를 구성하고, 전자 방출 디바이스는 형광층과 애노드 전극 등으로 이루어진 발광 유닛이 구비된 제2기판과 결합하여 전자 방출 표시 디바이스(electron emission display device)를 구성한다.The electron emission devices are arranged in an array on the first substrate to form an electron emission device, and the electron emission device is combined with a second substrate having a light emitting unit composed of a fluorescent layer and an anode electrode to emit electrons. A display device (electron emission display device) is configured.

전자 방출 디바이스는 전자 방출부와 함께 주사 전극들과 데이터 전극들로 기능하는 복수의 구동 전극들을 구비하여 단위 화소별 전자 방출부들의 전자 방출량을 제어한다. 그리고 전자 방출 표시 디바이스는 애노드 전극에 고전압을 인가하여 제1기판 측에서 방출된 전자들을 제2기판을 향해 가속시키며, 이 전자들이 형광층을 여기시켜 가시광을 냄으로써 소정의 발광 또는 표시가 이루어진다.The electron emission device includes a plurality of driving electrodes that function as scan electrodes and data electrodes together with the electron emission portion to control the electron emission amount of the electron emission portions per unit pixel. The electron emission display device applies a high voltage to the anode electrode to accelerate electrons emitted from the first substrate side toward the second substrate, and these electrons excite the fluorescent layer to emit visible light, thereby making a predetermined light emission or display.

전자 방출 표시 디바이스에서 제1기판과 제2기판은 프릿 바(frit bar)와 같은 밀봉 부재에 의해 가장자리가 상호 접합된 다음 내부 공간이 대략 10-6 Torr의 진공도로 배기되어 밀봉 부재와 함께 진공 용기를 구성한다. 진공 용기는 내부와 외부의 압력 차이에 의해 강한 압축력을 인가받으며, 이 압축력은 화면 사이즈에 비례하여 커진다.In the electron emission display device, the first substrate and the second substrate are edge-bonded to each other by a sealing member such as a frit bar, and then the internal space is evacuated to a vacuum of approximately 10 -6 Torr so that the vacuum container together with the sealing member is removed. Configure The vacuum container receives a strong compressive force due to the pressure difference between the inside and the outside, and the compressive force increases in proportion to the screen size.

따라서 진공 용기는 그 내부에 다수의 스페이서를 설치하여 진공 용기에 가해지는 압축력을 지지하고, 제1기판과 제2기판의 간격을 일정하게 유지시키고 있다. 이때 스페이서는 제1기판 상의 구동 전극들과 제2기판 상의 애노드 전극이 스페이서를 통해 단락되지 않도록 주로 유리나 세라믹과 같은 유전체로 제작된다.Therefore, the vacuum container supports a compression force applied to the vacuum container by installing a plurality of spacers therein, and maintains a constant gap between the first substrate and the second substrate. In this case, the spacer is mainly made of a dielectric such as glass or ceramic so that the driving electrodes on the first substrate and the anode electrode on the second substrate are not shorted through the spacer.

그런데 통상의 전자 방출 표시 디바이스는 그 작용시 전자 방출부에서 방출된 전자들이 제2기판을 향해 직진하는 대신 소정의 발산각을 가지고 퍼지며 진행하는 경향이 있다. 이러한 전자빔 퍼짐으로 인해 스페이서 표면에 전자가 충돌하게 되고, 전자가 충돌한 스페이서는 재료 특성(유전 상수나 2차 전자 방출계수 등)에 따라 그 표면이 양 또는 음의 전위로 대전되고, 대전된 스페이서는 주위의 전기장을 변화시켜 전자빔 경로를 왜곡시킨다. 예컨대 양의 전위로 대전된 스페이서는 주위의 전자빔을 끌어당기고, 음의 전위로 대전된 스페이서는 주위의 전자빔을 밀어낸다. 이와 같은 전자빔의 경로 왜곡은 스페이서 주위로 정확한 색 표현을 방해하며, 화면에 스페이서 자리가 보이는 표시 품질 저하를 유발한다.However, in the conventional electron emission display device, electrons emitted from the electron emission portion tend to spread with a predetermined divergence angle instead of going straight toward the second substrate. Due to the electron beam spread, electrons collide with the surface of the spacer, and the spacer where the electron collides is charged with a positive or negative potential according to the material properties (dielectric constant or secondary electron emission coefficient), and the charged spacer Distorts the electron beam path by changing the surrounding electric field. For example, a spacer charged at a positive potential attracts an surrounding electron beam, and a spacer charged at a negative potential pushes the surrounding electron beam. Such path distortion of the electron beam interferes with accurate color representation around the spacer, and causes display quality deterioration in which the spacer spot is visible on the screen.

따라서 스페이서의 대전을 방지하기 위하여 표면에 반도체 등의 저항층을 코팅하게 된다.Therefore, in order to prevent the charging of the spacer, a resistive layer such as a semiconductor is coated on the surface.

그런데 저항층에서의 열 발산 및 전자 방출부에서의 전자 방출에 따른 전류의 흐름이 원인이 되어 열이 발생하게 되고, 이로 인하여 스페이서의 온도가 전자 방출부쪽에서 애노드 전극쪽으로 선형적으로 변하게 된다.However, heat is generated due to the heat dissipation in the resistive layer and the flow of current due to the electron emission in the electron emission part, and thus the temperature of the spacer is linearly changed from the electron emission part toward the anode electrode.

상기에서 스페이서의 대전을 방지하기 위하여 형성되는 저항층의 특성은 온 도가 증가함에 따라 전자의 전도도가 증가되고, 이로 인하여 전자 방출부쪽에서 애노드쪽 까지의 등전위선이 등간격을 이루지 않고, 애노드 방향으로 몰려 있게 된다. 이에 따라 전자의 궤적인 스페이서의 반대쪽으로 밀리는 현상이 발생한다.The characteristics of the resistance layer formed to prevent the charging of the spacer in the above is that the conductivity of the electrons increases as the temperature increases, so that the equipotential lines from the electron emission side to the anode side do not form an equal interval, and are in the anode direction. You will be gathered. As a result, a phenomenon in which the electron trajectory is pushed to the opposite side of the spacer occurs.

본 발명은 상기한 문제점을 해소하기 위한 것으로서, 본 발명의 목적은 스페이서의 애노드쪽 표면에 낮은 비저항값을 갖는 전도성이 높은 물질을 코팅하여 애노드 방향으로 등전위선이 몰리는 현상을 방지할 수 있으며 스페이서 주위의 전자빔 왜곡과 이에 따른 표시 품질 저하를 억제할 수 있는 스페이서 및 이 스페이서를 구비한 전자 방출 표시 디바이스를 제공하는 데 있다.The present invention is to solve the above problems, an object of the present invention is to coat a highly conductive material having a low specific resistance value on the anode side surface of the spacer to prevent the phenomenon of equipotential lines in the anode direction and around the spacer The present invention provides a spacer capable of suppressing electron beam distortion and a deterioration in display quality thereof, and an electron emission display device having the spacer.

상기의 목적을 달성하기 위하여 본 발명은, 진공 용기를 구성하는 제1기판과 제2기판 사이에 설치되어 진공 용기에 가해지는 압축력을 지지하는 전자 방출 표시 디바이스용 스페이서에 있어서, 제1기판과 제2기판의 두께 방향을 따라 임의의 높이를 가지며 유전체로 이루어지는 모체와, 상기 모체의 제1기판에 가까운 쪽 표면에 형성되는 제1코팅층과, 상기 모체의 제2기판에 가까운 쪽 표면에 형성되고 상기 제1코팅층에 비하여 비저항값이 낮은 전도성이 높은 물질로 형성되는 제2코팅층을 포함하는 전자 방출 표시 디바이스용 스페이서를 제공한다.In order to achieve the above object, the present invention relates to a spacer for an electron emission display device which is provided between a first substrate and a second substrate constituting a vacuum container to support a compressive force applied to the vacuum container. A substrate formed of a dielectric material having an arbitrary height along the thickness direction of the two substrates, a first coating layer formed on a surface close to the first substrate of the substrate, and a surface formed on the surface close to the second substrate of the substrate Provided is a spacer for an electron emission display device including a second coating layer formed of a highly conductive material having a lower specific resistance than that of the first coating layer.

상기 제2코팅층은 스페이서의 전체 높이 중에서 애노드쪽으로부터 대략 20∼50% 정도까지 형성하는 것이 충분하게 등전위선이 몰리는 현상을 방지할 수 있으므로 바람직하다.The second coating layer is preferably formed in the total height of the spacer up to about 20 to 50% from the anode side because it can sufficiently prevent the phenomenon of equipotential lines flocking.

또한, 상기의 목적을 달성하기 위하여 본 발명은, 서로 대향 배치되는 제1기 판 및 제2기판과, 제1기판에 제공되며 복수의 전자 방출 소자들로 이루어지는 전자 방출 디바이스와, 제2기판에 제공되며 형광층들과 이 형광층들의 어느 일면에 위치하는 애노드 전극을 포함하는 발광 유닛과, 제1기판과 제2기판 사이에 위치하는 복수의 스페이서들을 포함하고, 스페이서가 제1기판과 제2기판의 두께 방향을 따라 임의의 높이를 가지며 유전체로 이루어지는 모체와, 상기 모체의 제1기판에 가까운 쪽 표면에 형성되는 제1코팅층과, 상기 모체의 제2기판에 가까운 쪽 표면에 형성되고 상기 제1코팅층에 비하여 비저항값이 낮은 전도성이 높은 물질로 형성되는 제2코팅층을 포함하는 전자 방출 표시 디바이스를 제공한다.Further, in order to achieve the above object, the present invention provides a first substrate and a second substrate disposed opposite to each other, an electron emitting device provided on the first substrate and composed of a plurality of electron emitting elements, and a second substrate. And a plurality of spacers provided between the first substrate and the second substrate, the light emitting unit including a fluorescent layer and an anode electrode positioned on one surface of the fluorescent layers, wherein the spacer includes a first substrate and a second substrate. A matrix formed of a dielectric material having an arbitrary height along the thickness direction of the substrate, a first coating layer formed on a surface near the first substrate of the matrix, and a surface formed on the surface near the second substrate of the matrix, Provided is an electron emission display device including a second coating layer formed of a highly conductive material having a lower specific resistance than a first coating layer.

상기 전자 방출 소자는 전계 방출 어레이(FEA)형, 표면 전도 에미션(SCE)형, 금속-절연층-금속(MIM)형 및 금속-절연층-반도체(MIS)형 중 어느 하나로 이루어질 수 있다.The electron emission device may be any one of a field emission array (FEA) type, a surface conduction emission (SCE) type, a metal-insulating layer-metal (MIM) type, and a metal-insulating layer-semiconductor (MIS) type.

이하, 첨부한 도면을 참고하여 본 발명의 바람직한 실시예를 보다 상세하게 설명하면 다음과 같다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 일 실시예에 따른 전자 방출 표시 디바이스를 개략적으로 나타낸 부분 단면도이다.1 is a partial cross-sectional view schematically illustrating an electron emission display device according to an exemplary embodiment of the present invention.

도면을 참고하면, 전자 방출 표시 디바이스는 소정의 간격을 두고 평행하게 대향 배치되는 제1기판(10)과 제2기판(12)을 포함한다. 제1기판(10)과 제2기판(12)의 가장자리에는 밀봉 부재(도면에 나타내지 않음)가 배치되어 두 기판을 접합시키며, 내부 공간이 대략 10-6 Torr의 진공도로 배기되어 제1기판(10)과 제2기판(12) 및 밀봉 부재가 진공 용기를 구성한다.Referring to the drawings, the electron emission display device includes a first substrate 10 and a second substrate 12 which are arranged in parallel to each other at predetermined intervals. Sealing members (not shown) are disposed at the edges of the first substrate 10 and the second substrate 12 to bond the two substrates, and the internal space is evacuated with a vacuum of approximately 10 −6 Torr to form the first substrate ( 10) and the second substrate 12 and the sealing member constitute a vacuum container.

제1기판(10) 중 제2기판(12)과의 대향면에는 전자 방출 소자(100)들이 어레이를 이루며 배치되어 제1기판(10)과 함께 전자 방출 디바이스(101)를 구성하고, 전자 방출 디바이스(101)가 제2기판(12) 및 제2기판(12)에 제공된 발광 유닛(102)과 결합하여 전자 방출 표시 디바이스를 구성한다.On the opposite surface of the first substrate 10 to the second substrate 12, the electron emission elements 100 are arranged in an array to form the electron emission device 101 together with the first substrate 10, and emit electrons. The device 101 is combined with the light emitting unit 102 provided on the second substrate 12 and the second substrate 12 to form an electron emission display device.

전자 방출 소자(100)는 전자 방출부와 구동 전극들을 구비하여 전자 방출의 온/오프와 전자 방출량을 제어하는 기본 단위를 이루며, 제1기판(10) 상의 단위 화소마다 하나씩 배치된다.The electron emission device 100 includes an electron emission unit and driving electrodes to form a basic unit for controlling ON / OFF of electron emission and an electron emission amount, and are disposed for each unit pixel on the first substrate 10.

발광 유닛(102)은 형광층(14), 일례로 적색과 녹색 및 청색의 형광층(14R), (14G), (14B)들과, 형광층(14)들 사이에 위치하는 흑색층(16)과, 형광층(14)들과 흑색층(16)의 어느 일면에 위치하는 애노드 전극(18)을 포함한다. 형광층(14)은 전자 방출 소자(100)마다 하나의 형광층(14R), (14G), (14B)이 대응하도록 배치된다. 도면에서는 일례로 애노드 전극(18)이 제1기판(10)을 향한 형광층(14)들과 흑색층(16)의 일면에 위치하는 경우를 나타내였다.The light emitting unit 102 includes a fluorescent layer 14, for example, red, green, and blue fluorescent layers 14R, 14G, 14B, and a black layer 16 positioned between the fluorescent layers 14. ) And an anode electrode 18 positioned on either surface of the fluorescent layers 14 and the black layer 16. The fluorescent layer 14 is disposed so that one fluorescent layer 14R, 14G, 14B corresponds to each electron emission element 100. In the drawing, for example, the anode electrode 18 is positioned on one surface of the fluorescent layers 14 and the black layer 16 facing the first substrate 10.

제1기판(10)과 제2기판(12) 사이에는 진공 용기에 가해지는 압축력을 지지하고 제1기판(10)과 제2기판(12)의 간격을 일정하게 유지시키는 스페이서(20)들이 배치된다. 스페이서(20)들은 형광층(14)을 침범하지 않도록 흑색층(16)에 대응하여 위치하며, 두 기판(10), (12)의 두께 방향을 따라 소정의 높이를 가진다.Spacers 20 are disposed between the first substrate 10 and the second substrate 12 to support the compressive force applied to the vacuum container and to keep the gap between the first substrate 10 and the second substrate 12 constant. do. The spacers 20 are positioned to correspond to the black layer 16 so as not to invade the fluorescent layer 14 and have a predetermined height along the thickness direction of the two substrates 10 and 12.

상기한 구성에서 전자 방출 디바이스는 전자 방출 소자(100)별로 전자 방출부와 구동 전극들의 작용으로 전자들을 방출시키고, 애노드 전극(18)이 고전압(대 략, 수 내지 수십 kV의 전압)을 인가받아 이 전자들을 제2기판(12)을 향해 가속시키며, 가속된 전자들이 해당 단위 화소의 형광층(14)에 충돌하여 이를 발광시키는 과정을 통해 소정의 표시 작용이 이루어진다.In the above configuration, the electron emission device emits electrons by the action of the electron emission unit and the driving electrodes for each electron emission element 100, and the anode electrode 18 receives a high voltage (a voltage of about several to several tens of kV). The electrons are accelerated toward the second substrate 12, and the accelerated electrons collide with the fluorescent layer 14 of the corresponding unit pixel to emit light.

이 과정에서 발광 유닛(102)은 전자 방출 디바이스(101)에 대해 애노드 전압의 크기에 상응하는 수 내지 수십 kV의 전압 차이를 가진다. 이로써 제1기판(10)과 제2기판(12) 사이의 진공 영역에는 전자 방출 디바이스(101)로부터 발광 유닛(102)을 향해 전압이 점진적으로 상승하는 전압 구배가 발생한다.In this process, the light emitting unit 102 has a voltage difference of several to several tens of kV corresponding to the magnitude of the anode voltage with respect to the electron emitting device 101. This generates a voltage gradient in which the voltage gradually rises from the electron emitting device 101 toward the light emitting unit 102 in the vacuum region between the first substrate 10 and the second substrate 12.

또한, 상기한 구동 과정에서 각 전자 방출 소자(100)로부터 방출되는 전자들은 제2기판(12)을 향해 퍼지며 진행하고, 그 결과 전자들의 일부가 스페이서(20) 표면에 충돌하게 된다.In addition, in the driving process, the electrons emitted from each of the electron emission devices 100 propagate toward the second substrate 12, and as a result, some of the electrons collide with the surface of the spacer 20.

본 실시예의 스페이서(20)는 아래와 같은 구성을 통해 상기한 전자 방출 표시 디바이스의 구동 환경 아래에서 그 표면이 높이에 따라 전기적 특성(2차 전자 방출계수)이 다르도록 하여 스페이서(20)의 대전에 의한 전자빔 왜곡을 최소화한다.The spacer 20 according to the present embodiment has the following configuration so that its electrical characteristics (secondary electron emission coefficient) vary according to its height under the driving environment of the electron emission display device as described above. Minimize electron beam distortion.

본 실시예에서 스페이서(20)는 유전체로 이루어지는 모체(22)와, 상기 모체(22)의 제1기판(10)을 향한 하부 영역(상기 제1기판(10)에 가까운 쪽) 표면에 위치하는 제1코팅층(24)과, 상기 모체(22)의 제2기판(12)을 향한 상부 영역(상기 제2기판(12)에 가까운 쪽) 표면에 위치하는 제2코팅층(26)으로 이루어진다. 이때 제2코팅층(26)은 제1코팅층(24)보다 전도성이 높은 물질로 형성된다.In the present embodiment, the spacer 20 is located on the surface of the matrix 22 made of a dielectric material and the lower region (near the first substrate 10) facing the first substrate 10 of the matrix 22. The first coating layer 24 and the second coating layer 26 positioned on the surface of the upper region (near the second substrate 12) facing the second substrate 12 of the matrix 22. In this case, the second coating layer 26 is formed of a material having a higher conductivity than the first coating layer 24.

상기 모체(22)는 유리, 강화유리, 세라믹 또는 유리-세라믹 혼합물과 같은 유전체로 제작되며, 기둥형이나 막대형 등 다양한 형상으로 이루어질 수 있다.The matrix 22 is made of a dielectric such as glass, tempered glass, ceramic, or glass-ceramic mixture, and may be formed in various shapes such as columnar or rod-shaped.

상기 제1코팅층(24)은 비저항값이 높은 산화물, 반도체, 다이아몬드상 탄소(DLC) 등을 이용하여 형성하고, 제2코팅층(26)은 상대적으로 비저항값이 낮은 금속이나 아몰퍼스 실리콘(a-Si(도펀트 P)) 등을 이용하여 형성한다.The first coating layer 24 is formed using an oxide, a semiconductor, diamond-like carbon (DLC) having a high resistivity value, and the second coating layer 26 is a metal or amorphous silicon (a-Si) having a relatively low resistivity value. (Dopant P)) and the like.

상기에서 물질의 비저항값이 높은 물질보다 비저항값이 낮은 물질이 상대적으로 전도성이 높다.In the above, a material having a low resistivity is relatively higher than a material having a high resistivity.

상기 제1코팅층(24)을 형성하는 산화물로는 산화크롬(Cr2O3) 등이 사용 가능하고, 반도체로는 아몰퍼스 실리콘(a-Si) 등이 사용 가능하다.Chromium oxide (Cr 2 O 3 ) or the like may be used as an oxide forming the first coating layer 24, and amorphous silicon (a-Si) may be used as the semiconductor.

상기 제2코팅층(26)을 형성하는 금속으로는 알루미늄(Al), 크롬(Cr), 구리(Cu), 아연(Zn), 니켈(Ni), 백금(Pt), 금(Au), 은(Ag), 팔라듐(Pd) 또는 이들의 합금 등이 사용 가능하다.Examples of the metal forming the second coating layer 26 include aluminum (Al), chromium (Cr), copper (Cu), zinc (Zn), nickel (Ni), platinum (Pt), gold (Au), and silver ( Ag), palladium (Pd) or alloys thereof and the like can be used.

상기 제2코팅층(26)은 스페이서(20)의 전체 높이 중에서 애노드 전극(18)쪽으로부터 대략 20∼50% 정도까지 형성하는 것이 충분하게 등전위선이 몰리는 현상을 방지할 수 있으므로 바람직하다.The second coating layer 26 is preferably formed at about 20 to 50% of the total height of the spacer 20 from the anode electrode 18, since it is possible to prevent the phenomenon of equipotential lines from gathering.

상기에서 제2코팅층(26)을 애노드 전극(18)쪽으로부터 스페이서(20) 전체 높이의 20% 미만까지 형성하게 되면, 스페이서(20)의 반대쪽으로 밀리는 등전위선을 충분하게 보정하는 것이 어렵다.When the second coating layer 26 is formed to less than 20% of the total height of the spacer 20 from the anode electrode 18, it is difficult to sufficiently correct the equipotential line that is pushed to the opposite side of the spacer 20.

또 상기 제2코팅층(26)을 애노드 전극(18)쪽으로부터 스페이서(20) 전체 높이의 50% 초과하여 형성하게 되면, 등전위선이 지나치게 스페이서(20)쪽으로 근접 하게 되어 역으로 왜곡이 발생할 우려가 있다.In addition, when the second coating layer 26 is formed to exceed 50% of the total height of the spacer 20 from the anode electrode 18 side, the equipotential lines may be too close to the spacer 20, which may cause distortion in the reverse direction. have.

상기 제2코팅층(26)을 형성하는 높이는 제1기판(10)으로부터 증가되는 온도와 애노드 전압 등을 고려하여 설정한다.The height of forming the second coating layer 26 is set in consideration of the temperature and the anode voltage increased from the first substrate 10.

도 2에 나타낸 바와 같이, 스페이서(20)에 대전을 방지하기 위하여 제1코팅층(24)만을 형성하면, 저항층인 제1코팅층(24)에서의 열 발산 및 전자 방출 소자(100)에서의 전자 방출에 따른 전류의 흐름이 원인이 되어 열이 발생하게 되고, 이로 인하여 스페이서(20)의 온도가 전자 방출 소자(100)쪽에서 애노드 전극(18)쪽으로 선형적으로 변하게 된다.As shown in FIG. 2, when only the first coating layer 24 is formed in the spacer 20 to prevent electrification, heat dissipation in the first coating layer 24, which is a resistance layer, and electrons in the electron emission device 100 are formed. Heat is generated due to the flow of current due to the emission, which causes the temperature of the spacer 20 to change linearly from the electron emission element 100 toward the anode electrode 18.

상기 제1코팅층(24)의 특성은 온도가 증가함에 따라 전자의 전도도가 증가되고, 이로 인하여 전자 방출 소자(100)쪽에서 애노드 전극(18)쪽 까지의 등전위선이 등간격을 이루지 않고, 애노드 방향으로 몰려 있게 되고, 전자의 궤적이 스페이서(20)의 반대쪽으로 밀리는 현상이 발생한다(도 2의 왼쪽에 위치한 점선화살표로 나타내는 전자의 궤적 참조).The characteristics of the first coating layer 24 is that the conductivity of the electrons increases as the temperature increases, so that the equipotential lines from the electron emission element 100 to the anode electrode 18 do not form an equal interval, and the anode direction , A phenomenon in which the electron trajectory is pushed to the opposite side of the spacer 20 occurs (see the electron trajectory indicated by the dotted arrow located on the left side in FIG. 2).

도 1에 나타낸 바와 같이, 제1코팅층(24)과 제2코팅층(26)을 형성하게 되면, 상대적으로 전도성이 높은 제2코팅층(26)에서의 전류의 흐름이 제1코팅층(24)보다 원활하게 이루어지므로 등전위선이 몰리는 현상이 발생하지 않으며, 스페이서(20) 반대쪽으로 밀리는 전자의 궤적에 대한 보상(보정)이 이루어진다(도 1의 왼쪽에 위치한 점선화살표로 나타내는 전자의 궤적 참조).As shown in FIG. 1, when the first coating layer 24 and the second coating layer 26 are formed, a current flow in the second coating layer 26 having relatively high conductivity is smoother than that of the first coating layer 24. Since the equipotential lines do not occur, the compensation of the trajectory of the electrons pushed to the opposite side of the spacer 20 is performed (see the trajectory of the electrons indicated by dotted arrows on the left side of FIG. 1).

상기와 같이 본 발명에 따른 실시예의 스페이서(20)는 상기 제1코팅층(24)과 제2코팅층(26)에 의해 스페이서(20) 주위를 진행하는 전자빔 경로를 보정하므로, 본 실시예의 전자 방출 표시 디바이스는 스페이서(20) 주위로 정확한 색 표현이 가능해지고, 화면에 스페이서(20) 자리가 보이는 문제를 해결할 수 있다.As described above, the spacer 20 of the embodiment according to the present invention corrects the electron beam path traveling around the spacer 20 by the first coating layer 24 and the second coating layer 26, and thus the electron emission display of the present embodiment. The device can accurately express colors around the spacer 20 and solve the problem of showing the spacer 20 on the screen.

상기한 전자 방출 표시 디바이스는 전계 방출 어레이(FEA)형, 표면 전도 에미션(SCE)형, 금속-절연층-금속(MIM)형 및 금속-절연층-반도체(MIS)형 중 어느 하나의 표시 디바이스로 이루어질 수 있다.The above-mentioned electron emission display device can be any one of a field emission array (FEA) type, a surface conduction emission (SCE) type, a metal-insulating layer-metal (MIM) type, and a metal-insulating layer-semiconductor (MIS) type. It may be made of a device.

이 가운데 도 3과 도 4를 참고하여 전계 방출 어레이(FEA)형 전자 방출 표시 디바이스의 구성에 대해 설명하고, 도 5를 참고하여 표면 전도 에미션(SCE)형 전자 방출 표시 디바이스의 구성에 대해 설명한다.3 and 4, the structure of the field emission array (FEA) type electron emission display device will be described, and the structure of the surface conduction emission type (SCE) type electron emission display device will be described with reference to FIG. 5. do.

도 3과 도 4는 각각 본 발명의 일 실시예에 따른 전계 방출 어레이형 전자 방출 표시 디바이스의 부분 분해 사시도와 부분 단면도이다.3 and 4 are partial exploded perspective and partial cross-sectional views, respectively, of a field emission array type electron emission display device according to an embodiment of the present invention.

도면을 참고하면, 제1기판(10) 위에는 제1전극인 캐소드 전극(28)들이 제1기판(10)의 일 방향을 따라 스트라이프 패턴으로 형성되고, 캐소드 전극(28)들을 덮으면서 제1기판(10) 전체에 제1절연층(30)이 형성된다. 제1절연층(30) 위에는 제2전극인 게이트 전극(32)들이 캐소드 전극(28)과 직교하는 방향을 따라 스트라이프 패턴으로 형성된다.Referring to the drawings, the cathode electrodes 28, which are the first electrodes, are formed in a stripe pattern along one direction of the first substrate 10 on the first substrate 10, and cover the cathode electrodes 28. The first insulating layer 30 is formed on the entirety of (10). Gate electrodes 32, which are second electrodes, are formed on the first insulating layer 30 in a stripe pattern along a direction orthogonal to the cathode electrodes 28.

캐소드 전극(28)들과 게이트 전극(32)들의 교차 영역이 하나의 단위 화소(sub-pixel)를 구성하며, 캐소드 전극(28) 위로 각 단위 화소마다 전자 방출부(34)들이 형성된다. 그리고 제1절연층(30)과 게이트 전극(32)들에는 각 전자 방출부(34)에 대응하는 개구부(301), (321)가 형성되어 제1기판(10) 위에 전자 방출부(34)가 노출되도록 한다.An intersection area between the cathode electrodes 28 and the gate electrodes 32 constitutes one unit pixel, and electron emission parts 34 are formed in each unit pixel on the cathode electrode 28. In addition, openings 301 and 321 corresponding to the electron emission parts 34 are formed in the first insulating layer 30 and the gate electrodes 32 to form the electron emission parts 34 on the first substrate 10. To be exposed.

전자 방출부(34)는 진공 중에서 전계가 가해지면 전자를 방출하는 물질들, 예를 들어 탄소계 물질 또는 나노미터(nm) 사이즈 물질로 이루어질 수 있다. 전자 방출부(34)는 일례로 탄소 나노튜브(CNT), 흑연, 흑연 나노파이버, 다이아몬드, 다이아몬드상 탄소(DLC), 훌러렌(C60), 실리콘 나노와이어 및 이들의 조합 물질을 포함할 수 있으며, 그 제조법으로 직접 성장, 스크린 인쇄, 화학기상증착 또는 스퍼터링 등을 적용할 수 있다.The electron emission part 34 may be formed of materials emitting electrons, for example, a carbon-based material or a nanometer (nm) size material, when an electric field is applied in a vacuum. The electron emission part 34 may include, for example, carbon nanotubes (CNT), graphite, graphite nanofibers, diamonds, diamond-like carbons (DLC), fullerenes (C 60 ), silicon nanowires, and combinations thereof. Direct growth, screen printing, chemical vapor deposition, or sputtering may be applied to the preparation method.

다른 한편으로 전자 방출부는 몰리브덴(Mo) 또는 실리콘(Si) 등을 주 재질로 하는 선단이 뾰족한 팁 구조물로 이루어질 수 있다.On the other hand, the electron emission unit may be formed of a tip structure having a pointed tip mainly made of molybdenum (Mo) or silicon (Si).

도면에서는 원형의 전자 방출부(34)들이 캐소드 전극(28)의 길이 방향을 따라 일렬로 배열되는 구성을 나타내였으나, 전자 방출부(34)의 형상과 화소 영역당 개수 및 배열 형태 등은 나타낸 예에 한정되지 않고 다양하게 변형 가능하다.In the figure, the circular electron emitters 34 are arranged in a line along the longitudinal direction of the cathode electrode 28, but the shape, the number and arrangement per pixel area, etc. of the electron emitter 34 are shown. It is not limited to this and can be variously modified.

또한, 상기에서는 게이트 전극(32)들이 제1절연층(30)을 사이에 두고 캐소드 전극(28)들 상부에 위치하는 구조에 대해 설명하였으나, 게이트 전극들이 제1절연층을 사이에 두고 캐소드 전극들 하부에 위치하는 구조도 가능하다. 이 경우 전자 방출부는 제1절연층 위에서 캐소드 전극의 측면에 형성될 수 있다.In addition, the structure in which the gate electrodes 32 are positioned on the cathode electrodes 28 with the first insulating layer 30 therebetween has been described, but the gate electrodes 32 have the first insulating layer therebetween. A structure located below the field is also possible. In this case, the electron emission part may be formed on the side of the cathode electrode on the first insulating layer.

그리고 게이트 전극(32)들과 제1절연층(30) 위로 제3 전극인 집속 전극(36)이 형성된다. 집속 전극(36) 하부에는 제2절연층(38)이 위치하여 게이트 전극(32)들과 집속 전극(36)을 절연시키며, 집속 전극(36)과 제2절연층(38)에도 전자빔 통과를 위한 개구부(361), (381)가 마련된다.The focusing electrode 36, which is a third electrode, is formed on the gate electrodes 32 and the first insulating layer 30. A second insulating layer 38 is positioned below the focusing electrode 36 to insulate the gate electrodes 32 and the focusing electrode 36, and passes the electron beam through the focusing electrode 36 and the second insulating layer 38. Openings 361 and 381 are provided.

집속 전극(36)은 전자 방출부(34)마다 하나의 개구부를 형성하여 각 전자 방출부(34)에서 방출되는 전자들을 개별적으로 집속할 수 있고, 단위 화소마다 하나의 개구부(361)를 형성하여 하나의 단위 화소에서 방출되는 전자들을 포괄적으로 집속할 수 있다. 도면에서는 두 번째 경우를 나타낸다.The focusing electrode 36 may form one opening for each electron emission unit 34 to focus electrons emitted from each electron emission unit 34, and one opening 361 may be formed for each unit pixel. The electrons emitted from one unit pixel may be collectively focused. The figure shows the second case.

다음으로, 제1기판(10)에 대향하는 제2기판(12)의 일면에는 형광층(14), 일례로 적색과 녹색 및 청색의 형광층(14R), (14G), (14B)들이 서로간 임의의 간격을 두고 형성되고, 각 형광층(14) 사이로 화면의 콘트라스트 향상을 위한 흑색층(16)이 형성된다.Next, on one surface of the second substrate 12 opposite to the first substrate 10, the fluorescent layers 14, for example, the red, green, and blue fluorescent layers 14R, 14G, and 14B are each other. It is formed at arbitrary intervals, and a black layer 16 is formed between the fluorescent layers 14 to improve the contrast of the screen.

그리고 형광층(14)과 흑색층(16) 위로 알루미늄(Al)과 같은 금속막으로 이루어진 애노드 전극(18)이 형성된다. 애노드 전극(18)은 외부로부터 전자빔 가속에 필요한 고전압을 인가받아 형광층(14)을 고전위 상태로 유지시키며, 형광층(14)에서 방사된 가시광 중 제1기판(10)을 향해 방사된 가시광을 제2기판(12) 측으로 반사시켜 화면의 휘도를 높인다.An anode electrode 18 made of a metal film such as aluminum (Al) is formed on the fluorescent layer 14 and the black layer 16. The anode electrode 18 receives the high voltage necessary for accelerating the electron beam from the outside to maintain the fluorescent layer 14 in a high potential state, and visible light emitted toward the first substrate 10 of the visible light emitted from the fluorescent layer 14. Is reflected toward the second substrate 12 to increase the brightness of the screen.

한편 애노드 전극은 ITO(Indium Tin Oxide)와 같은 투명 도전막으로 이루어질 수 있으며, 이 경우 애노드 전극은 제2기판(12)을 향한 형광층(14)과 흑색층(16)의 일면에 위치한다. 또한 애노드 전극으로서 상기한 투명 도전막과 금속막을 동시에 형성하는 구조도 가능하다.The anode electrode may be formed of a transparent conductive film such as indium tin oxide (ITO), in which case the anode electrode is positioned on one surface of the fluorescent layer 14 and the black layer 16 facing the second substrate 12. Moreover, the structure which forms simultaneously the above-mentioned transparent conductive film and a metal film as an anode electrode is also possible.

그리고 제1기판(10)과 제2기판(12) 사이에 위치하는 스페이서(20)는 상기한 바와 같이, 유전체로 이루어지는 모체(22)와, 모체(22)의 하부 영역 표면에 형성되는 제1코팅층(24)과, 모체(22)의 상부 영역 표면에 형성되는 제2코팅층(26)으로 이 루어진다.As described above, the spacer 20 positioned between the first substrate 10 and the second substrate 12 may be formed of a matrix 22 made of a dielectric material and a first region formed on the surface of the lower region of the matrix 22. It consists of a coating layer 24 and a second coating layer 26 formed on the surface of the upper region of the matrix 22.

상기한 구성의 전자 방출 표시 디바이스는 외부로부터 캐소드 전극(28)들, 게이트 전극(32)들, 집속 전극(36) 및 애노드 전극(18)에 소정의 전압을 공급하여 구동한다.The electron emission display device having the above configuration is driven by supplying a predetermined voltage to the cathode electrodes 28, the gate electrodes 32, the focusing electrode 36 and the anode electrode 18 from the outside.

일례로 캐소드 전극(28)들과 게이트 전극(32)들 중 어느 한 전극들이 주사 구동 전압을 인가받아 주사 전극들로 기능하고, 다른 한 전극들이 데이터 구동 전압을 인가받아 데이터 전극들로 기능한다. 그리고 집속 전극(36)은 전자빔 집속에 필요한 전압, 일례로 0V 또는 수 내지 수십 V의 음의 직류 전압을 인가받으며, 애노드 전극(18)은 전자빔 가속에 필요한 전압, 일례로 수백 내지 수천 V의 양의 직류 전압을 인가받는다.For example, any one of the cathode electrodes 28 and the gate electrodes 32 may receive a scan driving voltage to serve as scan electrodes, and the other electrodes may receive a data driving voltage to serve as data electrodes. In addition, the focusing electrode 36 receives a voltage required for electron beam focusing, for example, 0 V or a negative DC voltage of several to several tens of volts, and the anode electrode 18 is a voltage necessary for accelerating the electron beam, for example, several hundred to several thousand V. DC voltage of is applied.

그러면 캐소드 전극(28)과 게이트 전극(32)의 전압 차가 임계치 이상인 단위 화소들에서 전자 방출부(34) 주위에 전계가 형성되어 이로부터 전자들이 방출된다. 방출된 전자들은 집속 전극(36)의 개구부(361)를 통과하면서 전자빔 다발의 중심부로 집속되고, 애노드 전극(18)에 인가된 고전압에 이끌려 대응하는 단위 화소의 형광층(14)에 충돌함으로써 이를 발광시킨다.As a result, an electric field is formed around the electron emission part 34 in the unit pixels in which the voltage difference between the cathode electrode 28 and the gate electrode 32 is greater than or equal to a threshold, and electrons are emitted therefrom. The emitted electrons are focused through the opening 361 of the focusing electrode 36 to the center of the electron beam bundle, and are attracted to the fluorescent layer 14 of the corresponding unit pixel by being attracted by the high voltage applied to the anode electrode 18. It emits light.

도 5는 본 발명의 일 실시예에 따른 표면 전도 에미션형 전자 방출 표시 디바이스의 부분 단면도이다. 제2기판에 제공되는 발광 유닛과 스페이서의 구성은 상기한 전계 방출 어레이형 전자 방출 표시 디바이스와 동일하게 이루어지므로, 여기서는 전자 방출 디바이스의 구성에 대해서만 간략하게 설명한다.5 is a partial cross-sectional view of a surface conduction emission type electron emission display device according to an embodiment of the present invention. Since the configuration of the light emitting unit and the spacer provided on the second substrate is the same as that of the field emission array type electron emission display device described above, only the configuration of the electron emission device will be described here briefly.

도면을 참고하면, 제1기판(10) 위로 각 단위 화소마다 제1전극(40)과 제2전 극(42)이 이격되어 위치하고, 제1전극(40)과 제2전극(42) 위로 각각 제1도전 박막(44)과 제2도전 박막(46)이 서로 근접하게 위치한다. 그리고 제1도전 박막(44)과 제2도전 박막(46) 사이에 전자 방출부(48)가 형성되며, 전자 방출부(48)는 이 도전 박막(44), (46)들을 통해 제1전극(40) 및 제2전극(42)과 전기적으로 연결된다.Referring to the drawings, the first electrode 40 and the second electrode 42 are spaced apart from each other on each of the unit pixels on the first substrate 10, and above the first electrode 40 and the second electrode 42, respectively. The first conductive thin film 44 and the second conductive thin film 46 are located close to each other. An electron emission portion 48 is formed between the first conductive thin film 44 and the second conductive thin film 46, and the electron emission portion 48 is formed through the first thin films 44 and 46. 40 is electrically connected to the second electrode 42.

제1전극(40)과 제2전극(42)은 도전성을 갖는 다양한 재료가 사용 가능하며, 제1도전 박막(44)과 제2도전 박막(46)은 니켈(Ni), 금(Au), 백금(Pt), 팔라듐(Pd) 등의 도전성 재료를 이용한 미립자 박막으로 이루어진다.The first electrode 40 and the second electrode 42 may be formed of various conductive materials. The first conductive thin film 44 and the second conductive thin film 46 may include nickel (Ni), gold (Au), It consists of a thin film of fine particles using a conductive material such as platinum (Pt) and palladium (Pd).

전자 방출부(48)는 제1도전 박막(44)과 제2도전 박막(46) 사이에 제공된 미세 크랙으로 이루어지거나, 탄소계 물질막으로 이루어질 수 있다. 두 번째 경우 전자 방출부(48)는 상기한 전계 방출 어레이(FEA)형에서와 마찬가지로 탄소 나노튜브, 흑연, 흑연 나노파이버, 다이아몬드, 다이아몬드상 탄소, 훌러렌(C60), 실리콘 나노와이어 및 이들의 조합 물질을 포함할 수 있다.The electron emission part 48 may be formed of fine cracks provided between the first conductive thin film 44 and the second conductive thin film 46, or may be formed of a carbon-based material film. In the second case, the electron emitter 48 is formed of carbon nanotubes, graphite, graphite nanofibers, diamonds, diamond-like carbon, fullerene (C 60 ), silicon nanowires, and the like as in the field emission array (FEA) type described above. It may include a combination material of.

상기한 구조에서, 제1전극(40)과 제2전극(42)에 각각 전압을 인가하면, 제1도전 박막(44)과 제2도전 박막(46)을 통해 전자 방출부(48)의 표면과 수평한 방향으로 전류가 흐르면서 표면 전도형 전자 방출이 이루어지고, 방출된 전자들은 애노드 전극(18)에 인가된 고전압에 이끌려 제2기판(12)으로 향하면서 대응하는 형광층(14)에 충돌하여 이를 발광시킨다.In the above structure, when a voltage is applied to each of the first electrode 40 and the second electrode 42, the surface of the electron emission part 48 is formed through the first conductive film 44 and the second conductive film 46. When the current flows in a horizontal direction, the surface conduction electrons are emitted, and the emitted electrons are attracted to the second substrate 12 by the high voltage applied to the anode electrode 18 and collide with the corresponding fluorescent layer 14. To emit light.

상기에서는 본 발명의 바람직한 실시예에 대하여 설명하였지만, 본 발명은 이에 한정되는 것이 아니고 특허청구범위와 발명의 상세한 설명 및 첨부한 도면의 범위 안에서 여러 가지로 변형하여 실시하는 것이 가능하고 이 또한 본 발명의 범위에 속하는 것은 당연하다.Although the preferred embodiments of the present invention have been described above, the present invention is not limited thereto, and various modifications and changes can be made within the scope of the claims and the detailed description of the invention and the accompanying drawings. Naturally, it belongs to the range of.

상기와 같이 본 발명에 의한 전자 방출 표시 디바이스는 상기한 모체와 제1코팅층 및 제2코팅층으로 이루어진 스페이서를 구비함에 따라, 전자 방출부로부터 애노드 방향으로 온도가 선형적으로 변하는 경우에도 등전위선이 왜곡되는 것을 방지할 수 있으므로, 스페이서 주위로 정확한 색 표현이 가능해지고, 화면에 스페이서 자리가 보이지 않도록 하여 우수한 표시 품질을 구현할 수 있다.As described above, since the electron emission display device according to the present invention includes a spacer including the matrix, the first coating layer, and the second coating layer, the equipotential lines are distorted even when the temperature is linearly changed from the electron emission portion to the anode direction. Because it can be prevented, it is possible to accurately represent the color around the spacer, it is possible to implement the excellent display quality by not showing the spacer position on the screen.

Claims (15)

진공 용기를 구성하는 제1기판과 제2기판 사이에 설치되어 진공 용기에 가해지는 압축력을 지지하는 전자 방출 표시 디바이스용 스페이서에 있어서,A spacer for an electron emission display device provided between a first substrate and a second substrate constituting a vacuum container to support a compressive force applied to the vacuum container. 제1기판과 제2기판의 두께 방향을 따라 임의의 높이를 가지며 유전체로 이루어지는 모체와,A matrix composed of a dielectric having an arbitrary height along the thickness direction of the first substrate and the second substrate, 상기 모체의 제1기판에 가까운 쪽 표면에 형성되는 제1코팅층과,A first coating layer formed on a surface close to the first substrate of the matrix, 상기 모체의 제2기판에 가까운 쪽 표면에 형성되고 상기 제1코팅층에 비하여 비저항값이 낮은 전도성이 높은 물질로 형성되는 제2코팅층을 포함하는 전자 방출 표시 디바이스용 스페이서.And a second coating layer formed on a surface close to the second substrate of the matrix and formed of a highly conductive material having a lower specific resistance than that of the first coating layer. 청구항 1에 있어서,The method according to claim 1, 상기 제1코팅층은 비저항값이 높은 산화물, 반도체, 다이아몬드상 탄소(DLC) 중에서 선택하여 형성하고,The first coating layer is formed by selecting from oxides, semiconductors, diamond-like carbon (DLC) having a high specific resistance, 상기 제2코팅층은 상대적으로 비저항값이 낮은 금속이나 아몰퍼스 실리콘(도펀트 P) 중에서 선택하여 형성하는 전자 방출 표시 디바이스용 스페이서.And the second coating layer is formed of a metal having relatively low resistivity or amorphous silicon (dopant P). 청구항 2에 있어서,The method according to claim 2, 상기 제1코팅층을 형성하는 산화물로는 산화크롬을 사용하고, 반도체로는 아몰퍼스 실리콘(a-Si)을 사용하는 전자 방출 표시 디바이스용 스페이서.A spacer for an electron emission display device using chromium oxide as an oxide for forming the first coating layer and amorphous silicon (a-Si) as a semiconductor. 청구항 2에 있어서,The method according to claim 2, 상기 제2코팅층을 형성하는 금속으로는 알루미늄(Al), 크롬(Cr), 구리(Cu), 아연(Zn), 니켈(Ni), 백금(Pt), 금(Au), 은(Ag), 팔라듐(Pd) 또는 이들의 합금 중에서 선택하여 사용하는 전자 방출 표시 디바이스용 스페이서.Examples of the metal forming the second coating layer include aluminum (Al), chromium (Cr), copper (Cu), zinc (Zn), nickel (Ni), platinum (Pt), gold (Au), silver (Ag), A spacer for an electron emission display device used by selecting from palladium (Pd) or alloys thereof. 청구항 1에 있어서,The method according to claim 1, 상기 제2코팅층은 스페이서의 전체 높이 중에서 제2기판쪽으로부터 20∼50%의 범위까지 형성하는 전자 방출 표시 디바이스용 스페이서.And the second coating layer is formed in a range of 20 to 50% of the total height of the spacer from the second substrate side. 서로 대향 배치되는 제1기판 및 제2기판과, 상기 제1기판에 제공되며 복수의 전자 방출 소자들로 이루어지는 전자 방출 디바이스와, 상기 제2기판에 제공되며 형광층들과 이 형광층들의 어느 일면에 위치하는 애노드 전극을 포함하는 발광 유닛과, 상기 제1기판과 제2기판 사이에 위치하는 복수의 스페이서들을 포함하고,A first substrate and a second substrate disposed opposite to each other, an electron emitting device provided on the first substrate, the electron emitting device comprising a plurality of electron emitting elements, and a fluorescent layer provided on the second substrate and any one surface of the fluorescent layers A light emitting unit including an anode electrode positioned at the first substrate, and a plurality of spacers positioned between the first substrate and the second substrate, 상기 스페이서가 제1기판과 제2기판의 두께 방향을 따라 임의의 높이를 가지며 유전체로 이루어지는 모체와, 상기 모체의 제1기판에 가까운 쪽 표면에 형성되는 제1코팅층과, 상기 모체의 제2기판에 가까운 쪽 표면에 형성되고 상기 제1코팅층에 비하여 비저항값이 낮은 전도성이 높은 물질로 형성되는 제2코팅층을 포함하는 전자 방출 표시 디바이스.The spacer has an arbitrary height along the thickness direction of the first substrate and the second substrate, a matrix made of a dielectric, a first coating layer formed on a surface close to the first substrate of the matrix, and a second substrate of the matrix. And a second coating layer formed on a surface close to the substrate and formed of a highly conductive material having a specific resistance lower than that of the first coating layer. 청구항 6에 있어서,The method according to claim 6, 상기 제1코팅층은 비저항값이 높은 산화물, 반도체, 다이아몬드상 탄소(DLC) 중에서 선택하여 형성하고,The first coating layer is formed by selecting from oxides, semiconductors, diamond-like carbon (DLC) having a high specific resistance, 상기 제2코팅층은 상대적으로 비저항값이 낮은 금속이나 아몰퍼스 실리콘(도펀트 P) 중에서 선택하여 형성하는 전자 방출 표시 디바이스.And the second coating layer is formed of a metal having relatively low resistivity or amorphous silicon (dopant P). 청구항 7에 있어서,The method according to claim 7, 상기 제1코팅층을 형성하는 산화물로는 산화크롬을 사용하고, 반도체로는 아몰퍼스 실리콘(a-Si)을 사용하고,Chromium oxide is used as an oxide forming the first coating layer, amorphous silicon (a-Si) is used as a semiconductor, 상기 제2코팅층을 형성하는 금속으로는 알루미늄(Al), 크롬(Cr), 구리(Cu), 아연(Zn), 니켈(Ni), 백금(Pt), 금(Au), 은(Ag), 팔라듐(Pd) 또는 이들의 합금 중에서 선택하여 사용하는 전자 방출 표시 디바이스.Examples of the metal forming the second coating layer include aluminum (Al), chromium (Cr), copper (Cu), zinc (Zn), nickel (Ni), platinum (Pt), gold (Au), silver (Ag), An electron emission display device used by selecting from palladium (Pd) or alloys thereof. 청구항 6에 있어서,The method according to claim 6, 상기 제2코팅층은 스페이서의 전체 높이 중에서 애노드 전극쪽으로부터 20∼50%의 범위까지 형성하는 전자 방출 표시 디바이스.And the second coating layer is formed in a range of 20 to 50% from an anode electrode side of the entire height of the spacer. 청구항 6에 있어서,The method according to claim 6, 상기 전자 방출 디바이스가 상기 제1 기판의 일 방향을 따라 형성되는 캐소드 전극들과; 절연층을 사이에 두고 상기 캐소드 전극들과 교차하는 방향을 따라 형성되는 게이트 전극들; 및 상기 캐소드 전극에 전기적으로 연결되는 전자 방출부들을 포함하는 전자 방출 표시 디바이스.Cathode electrodes in which the electron emitting device is formed along one direction of the first substrate; Gate electrodes formed along a direction crossing the cathode electrodes with an insulating layer interposed therebetween; And electron emission portions electrically connected to the cathode electrode. 청구항 10에 있어서,The method according to claim 10, 상기 전자 방출부가 카본 나노튜브, 흑연, 흑연 나노파이버, 다이아몬드, 다이아몬드상 카본, 훌러렌(C60) 및 실리콘 나노와이어로 이루어진 군으로부터 선택된 적어도 하나의 물질을 포함하는 전자 방출 표시 디바이스.And the electron emission unit comprises at least one material selected from the group consisting of carbon nanotubes, graphite, graphite nanofibers, diamonds, diamond-like carbons, fullerenes (C 60 ), and silicon nanowires. 청구항 10에 있어서,The method according to claim 10, 상기 전자 방출 디바이스가 상기 캐소드 전극들 및 게이트 전극들과 절연을 유지하며 캐소드 전극들과 게이트 전극들 상부에 위치하는 집속 전극을 더욱 포함하는 전자 방출 표시 디바이스.And a focusing electrode on which the electron emission device is insulated from the cathode and gate electrodes and positioned above the cathode and gate electrodes. 청구항 6에 있어서,The method according to claim 6, 상기 전자 방출 디바이스가 서로 이격되어 위치하는 제1 전극들 및 제2 전극들과; 상기 제1 전극들 위에 형성되는 제1 도전 박막들과; 상기 제2 전극들 위에 형성되며 상기 각각의 제1 도전 박막에 근접하게 위치하는 제2 도전 박막들; 및 상기 각각의 제1 도전 박막과 제2 도전 박막 사이에 제공되는 전자 방출부들을 포함하는 전자 방출 표시 디바이스.First and second electrodes with the electron emitting device spaced apart from each other; First conductive thin films formed on the first electrodes; Second conductive thin films formed on the second electrodes and positioned adjacent to each of the first conductive thin films; And electron emission portions provided between each of the first conductive thin film and the second conductive thin film. 청구항 13에 있어서,The method according to claim 13, 상기 전자 방출부가 미세 크랙으로 이루어지는 전자 방출 표시 디바이스.An electron emission display device in which the electron emission section is made of fine cracks. 청구항 13에 있어서,The method according to claim 13, 상기 전자 방출부가 카본 나노튜브, 흑연, 흑연 나노파이버, 다이아몬드, 다이아몬드상 카본, 훌러렌(C60) 및 실리콘 나노와이어로 이루어진 군으로부터 선택된 적어도 하나의 물질을 포함하는 전자 방출 표시 디바이스.And the electron emission unit comprises at least one material selected from the group consisting of carbon nanotubes, graphite, graphite nanofibers, diamonds, diamond-like carbons, fullerenes (C 60 ), and silicon nanowires.
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