KR20070057442A - 멀티미디어 프로세서의 ｉ2ｃ/ｉ2ｓ 통합 버스 시스템 - Google Patents

멀티미디어 프로세서의 ｉ2ｃ/ｉ2ｓ 통합 버스 시스템 Download PDF

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KR20070057442A
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Abstract

본 발명은 멀티미디어 프로세서에서의 I2C/I2S 통합 버스 시스템에 관한 것이다. 즉, 본 발명에서는 멀티미디어 프로세서 시스템 내에서 병렬 디바이스들을 연결하기 위한 I2C와 I2S 각각의 버스라인을 하나로 통합하여 I2C/I2S 통합 버스라인으로 구현함으로써, 멀티미디어 프로세서 시스템 내에서 I2C와 I2S 버스를 각각 구성함에 따른 보드상 설계의 복잡함과 하드웨어 자원 낭비를 방지시킬 수 있게 된다.
I2C, I2S, 통합, 버스, 프로세서

Description

멀티미디어 프로세서의 Ｉ2Ｃ/Ｉ2Ｓ 통합 버스 시스템{I2C/I2S UNIFICATION BUS SYSTEM ON MULTI-MEDIA PROCESSOR}
도 1은 종래 멀티미디어 프로세서의 I2C/I2S 각각의 버스 시스템 구성도,
도 2는 본 발명의 실시 예에 따른 멀티미디어 프로세서의 I2C/I2S 통합 버스 시스템 구성도,
도 3은 상기 도 2의 I2C/I2S 통합 버스 제어부 상세 블록 구성도,
도 4 및 도 5는 본 발명의 실시 예에 따른 I2C 통신 프로토콜의 데이터 전송 타이밍 예시도,
도 6은 본 발명의 실시 예에 따른 I2S 통신 디바이스의 I2C 통신 규격화 예시도.
<도면의 주요 부호에 대한 간략한 설명>
200 : I2C/I2S 통합 버스 제어부 202 : 병렬 디바이스 IC
300 : 제어부 302 : SFR부
304 : SCL 발생부 306 : SDA 발생부
본 발명은 멀티미디어 프로세서(Multi-media processor)에 관한 것으로, 특히 멀티미디어 프로세서 시스템 내에서 I2C와 I2S버스를 각각 구성할 때 시스템 내에서 두 가지의 버스(bus)를 사용함으로 인한 하드웨어(hardware) 자원낭비를 보완하기 위하여 버스를 하나로 통합하고 한 버스 내에 I2C, I2S 스펙(spec)을 통합하여 구성하는 멀티미디어 프로세서에서의 I2C/I2S 통합 버스 시스템(bus system)에 관한 것이다.
통상적으로 멀티미디어 프로세서 시스템 내에서 병렬 디바이스(peripheral device)를 연결하기 위해 I2C(Inter-Integrated Circuit)와 I2S(Inter-IC-Sound bus)를 사용하며, 상기 I2C는 일반적인 IC 통신 시에 그리고 I2S는 오디오 인터페이스를 위해 사용한다.
도 1에는 IC 통신과 오디오 인터페이스를 위해 I2C와 I2S를 모두 사용하는 종래 멀티미디어 프로세서(100)의 버스 시스템 구성을 도시하였다.
상기 도 1을 참조하면, I2C는 IC 칩간 통신의 방법으로서, 각 병렬 연결 디바이스 IC(102)간의 데이터 전송을 위해 사용하는 데이터 선로로, 데이터와 클럭을 각각 전송하는 2개의 라인으로 통신을 수행하며, 상기 2개의 라인은 시리얼 데이터(Serial Data: SDA)를 전송하는 데이터 라인과 시리얼 클럭(Serial Clock: SCL)을 전송하는 클럭 라인으로 이루어진다.
또한 I2S는 Audio IC(104)와의 칩간 통신의 방법으로서, 2채널 오디오 신호 에서 L 및 R 채널을 결정하기 위한 워드 선택신호(Word Select :WS) 라인과, 인터페이스 회로 동작의 기준이 되는 클럭 신호를 전송하기 위한 직렬 클럭 신호(SCLK) 라인과 오디오 데이터 전송을 위한 직렬 데이터(Serial Data : SD) 신호 라인으로 이루어진다.
그러나, 상기한 바와 같이 종래에는 I2C와 I2S를 각각의 자체 버스를 사용하여 칩설계시는 I2C와 I2S 블록을 각각 구성해야 하고 보드 설계 시는 시스템 버스와 이 두 가지 버스가 같이 존재하여 보드 설계가 복잡해지고 자원이 낭비되는 문제점이 있었다.
따라서, 본 발명의 목적은 멀티미디어 프로세서 시스템 내에서 I2C와 I2S버스를 각각 구성할 때 시스템 내에서 두 가지의 버스를 사용함으로 인한 하드웨어 자원낭비를 보완하기 위하여 버스를 하나로 통합하고 한 버스 내에 I2C, I2S 스펙을 통합하여 구성하는 멀티미디어 프로세서에서의 I2C/I2S 통합 버스 시스템을 제공함에 있다.
상술한 목적을 달성하기 위한 본 발명은 멀티미디어 프로세서의 I2C/I2S 통합 버스 시스템으로서, 데이터 버스를 요청하는 I2C/I2S 통신방식의 병렬 디바이스 IC칩들을 판별하여 I2C 또는 I2S 통신 방식을 결정하고, I2C 통신 칩과의 통신방식은 I2C 통신 방식을 기반으로 수행하며, I2S 통신 오디오 칩과의 통신 시에는 I2S 규격에서의 WS와 SD를 먹스 하도록 하는 I2C규격으로 변환하여 데이터 통신을 수행하는 멀티미디어 프로세서의 I2C/I2S 통합 버스부와, 상기 I2C/I2S 통합 버스부로 부터 I2C/I2S 통합 버스를 점유하여 I2C 통신방식에 따라 칩간 통신을 수행하는 다수의 I2C 통신 병렬 디바이스 IC칩과, 상기 I2C/I2S 통합 버스부로부터 I2C/I2S 통합 버스를 점유하여 I2C 데이터 통신 규격에 맞도록 WS, SD를 먹스하여 칩간 통신을 수행하는 다수의 I2S 통신 병렬 디바이스 IC칩을 포함하는 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명에 따른 바람직한 실시 예의 동작을 상세하게 설명한다.
도 2는 본 발명의 실시 예에 따른 멀티미디어 프로세서의 I2C/I2S 통합 버스 시스템의 상세 회로 구성을 도시한 것이다.
상기 도 2를 참조하면, 본 발명의 I2C/I2S 통합 버스부(200)는 I2C 통신 프로토콜(protocol)을 사용하는 병렬 디바이스(peripheral devices) IC들인 IC1, IC2, IC3(202, 204, 206)의 동작 주파수를 종래 I2C 통신 프로토콜에서와 같이 생성하고, 각 병렬 디바이스 IC에 데이터를 기록하거나, 데이터를 전송하고자 하는 IC로부터 데이터를 독출한다.
또한 I2S 통신 프로토콜을 사용하는 병렬 디바이스들인 Audio IC1(208), Audio IC2(210)의 경우에는 버스 분배를 I2C 방식을 따르도록 구현하며, 테이터 통신 규격은 워드 선택신호(WS)와 직렬 데이터 신호(SD)를 먹스(Mux)하여 사용하도록 하여 I2S 통신 프로토콜을 사용하는 병렬 디바이스들이 I2C/I2S 통합 버스를 통해 데이터 통신이 가능하도록 한다.
도 3은 상기 도 2의 I2C/I2S 통합 버스부(200)의 상세 블록 구성을 도시한 것이다. 상기 도 3을 참조하면, 상기 I2C/I2S 통합 버스부(200)는 다수의 병렬 디바이스(peripheral device) IC와의 동작 주파수를 생성하는 SCL 발생부(304)와, I2C/I2S 통합 버스를 점유한 병렬 디바이스 IC에 데이터를 쓰거나, 해당 병렬 디바이스 IC로부터 데이터를 읽어오는 SDA 발생부(306)와, 상기 I2C 및 I2S를 지원하는 병렬 디바이스 IC들의 제어를 위한 콘트롤러 기능이 내장되며, I2S 방식을 지원하는 병렬 디바이스 IC의 버스 점유 시 I2C 데이터 통신 규격에 맞도록 WS, SD를 먹스하여 데이터 통신을 수행하는 제어부(300)와, I2C/I2S 통합 버스 프로토콜 제어를 위해 상기 제어부(300)와 SCL/SDA 발생부(304, 306)와의 인터페이싱을 수행하는 SFR부(302)를 포함한다.
이하 상기 도 2 및 도 3를 참조하여 본 발명의 I2C/I2S 통합 버스 시스템에서 I2C/I2S 통합 버스 라인을 통해 I2C 통신 프로토콜의 병렬 디바이스 IC들과 I2S 통신 프로토콜의 병렬 디바이스 IC들간 데이터 통신을 모두 수행하는 동작을 상세히 설명하기로 한다.
먼저 I2C/I2S 통합 버스부(200)는 본 발명에서 따른 I2C/I2S 통합버스에서 I2C를 사용하는 경우에는 도 4 및 도 5에 도시된 바와 같은 종래 I2C 통신방식을 이용하여 다수의 병렬 디바이스(peripheral devices) IC(202, 204, 206)간 통신을 수행한다.
상기 도 4는 I2C 버스의 기본적인 프로토콜을 설명하는 타이밍도를 도시한 것으로, I2C 통신 프로토콜을 사용하는 병렬 디바이스 IC들(202, 204, 206) 간에 있어서, 마스터(master)는 전송을 개시하는 장치로 클럭 펄스(clock pulse)를 만들 고, 또한 전송을 종료하는 역할을 하는 장치이며, 슬레이브(slave)는 마스터가 어드레싱한 장치이다. 마스터가 시작 상태(start condition)(400)를 만들면, 버스(bus)에 연결된 슬레이브 장치들이 이후의 데이터를 기다린다. 마스터에 의한 시작 상태는 SCL과 SDA가 모두 하이(high)인 상태에서, SDA가 로우(low)로 떨어지는 상태를 말한다.
마스터가 슬레이브 어드레스(slave address)를 보내면, 각각의 병렬 디바이스 IC칩은 자신의 고유 어드레스와 비교하며, 어드레스가 일치하는 칩(chip)은 이어지는 ACK 신호 구간에서 데이터를 로우(low)로 유지하여 응답(response)을 보낸다. 그러면 마스터는 슬레이브에 대하여 데이터를 읽거나 쓰기를 할 수 있다. 모든 작업이 끝나면, 마스터(master)는 정지상태(stop condition)(402)을 만들고, 버스를 해제(release)한다.
상기 도 5는 두 개의 마스터에 의한 데이터 분배를 도시한 것으로, 마스터1, 마스터2에 의한 데이터1, 데이터2가 I2C 버스의 데이터 라인을 순차적으로 점유하여 데이터를 전송하는 것을 나타낸다.
다음으로 I2C/I2S 통합 버스부(200)는 상기 I2C/I2S 통합버스를 I2S로 사용하는 병렬 디바이스 IC들인 Audio IC1(208), Audio IC2(210)의 경우에는 버스 분배를 I2C 방식을 따르도록 구현하며, 테이터 통신 규격은 워드 선택신호(WS)와 직렬 데이터 신호(SD)를 먹스하여 사용하도록 한다.
즉, 종래 I2S 방식에서는 상기 도 1에서 도시된 바와 같이 2채널 오디오 신호에서 L 및 R채널을 결정하기 위한 신호로서, I2S 포맷의 경우에는 로우 레벨일 때 L 채널을, 하이 레벨일 때 R 채널을 선택하는 워드 선택신호(Word Select : WS) 라인과, 인터페이스 회로 동작의 기준이 되는 클럭 신호를 발생시키는 직렬 클럭 신호(SCK) 라인과, 직렬형 데이터를 전송하는 직렬 데이터(Serial Data : SD) 라인으로 버스 라인이 구성되었음을 전술한 바와 같다.
따라서 본 발명에서는 I2C/I2S 통합 버스 구현에 따른 I2C 데이터 통신 규격으로 변환을 위해 도 6에서 보여지는 바와 같이 클럭 신호(SCK)에 따라 WS와 SD를 먹스하여 사용하도록 함으로써 I2C/I2S 통합 버스에서도 I2S방식을 통한 오디오 데이터의 전송이 가능하도록 한다.
상기한 바와 같이 본 발명에서는 멀티미디어 프로세서 시스템 내에서 병렬 디바이스들을 연결하기 위한 I2C와 I2S 각각의 버스라인을 하나로 통합하여 I2C/I2S 통합 버스라인으로 구현함으로써, 멀티미디어 프로세서 시스템 내에서 I2C와 I2S 버스를 각각 구성함에 따른 보드상 설계의 복잡함과 하드웨어 자원 낭비를 방지시킬 수 있게 된다.
한편 상술한 본 발명의 설명에서는 구체적인 실시 예에 관해 설명하였으나, 여러 가지 변형이 본 발명의 범위에서 벗어나지 않고 실시될 수 있다. 따라서 발명의 범위는 설명된 실시 예에 의하여 정할 것이 아니고 특허청구범위에 의해 정하여져야 한다.
이상에서 설명한 바와 같이, 본 발명에서는 멀티미디어 프로세서 시스템 내에서 병렬 디바이스들을 연결하기 위한 I2C와 I2S 각각의 버스라인을 하나로 통합 하여 I2C/I2S 통합 버스라인으로 구현함으로써, 멀티미디어 프로세서 시스템 내에서 I2C와 I2S 버스를 각각 구성함에 따른 보드상 설계의 복잡함과 하드웨어 자원 낭비를 방지시킬 수 있게 되는 이점이 있다.

Claims (2)

  1. 멀티미디어 프로세서의 I2C/I2S 통합 버스 시스템으로서,
    데이터 버스를 요청하는 I2C/I2S 통신방식의 병렬 디바이스 IC칩들을 판별하여 I2C 또는 I2S 통신 방식을 결정하고, I2C 통신 칩과의 통신방식은 I2C 통신 방식을 기반으로 수행하며, I2S 통신 오디오 칩과의 통신 시에는 I2S 규격에서의 WS와 SD를 먹스하도록 하는 I2C규격으로 변환하여 데이터 통신을 수행하는 멀티미디어 프로세서의 I2C/I2S 통합 버스부와,
    상기 I2C/I2S 통합 버스부로부터 I2C/I2S 통합 버스를 점유하여 I2C 통신방식에 따라 칩간 통신을 수행하는 다수의 I2C 통신 병렬 디바이스 IC칩과,
    상기 I2C/I2S 통합 버스부로부터 I2C/I2S 통합 버스를 점유하여 I2C 데이터 통신 규격에 맞도록 WS, SD를 먹스하여 칩간 통신을 수행하는 다수의 I2S 통신 병렬 디바이스 IC칩
    을 포함하는 I2C/I2S 통합 버스 시스템.
  2. 제1항에 있어서,
    상기 I2C/I2S 통합 버스부는,
    다수의 병렬 디바이스 IC의 동작 주파수를 생성하는 SCL 발생부와,
    I2C/I2S 통합 버스를 점유한 병렬 디바이스 IC에 데이터를 쓰거나, 해당 병 렬 디바이스 IC로부터 데이터를 읽어오는 SDA 발생부와,
    상기 I2C 및 I2S를 지원하는 병렬 디바이스 IC들의 제어를 위한 콘트롤러 기능이 내장되며, I2S 방식을 지원하는 통신칩의 버스 점유 시 I2C 데이터 통신 규격에 맞도록 WS, SD를 먹스하여 데이터 통신을 수행하는 제어부와,
    I2C/I2S 통합 버스 프로토콜 제어를 위해 상기 제어부와 SCL/SDA 발생부와의 인터페이싱을 수행하는 SFR부
    를 포함하는 I2C/I2S 통합 버스 시스템.
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Publication number Priority date Publication date Assignee Title
WO2011136796A1 (en) * 2010-04-30 2011-11-03 Hewlett-Packard Development Company, L.P. Management data transfer between processors
CN102929828A (zh) * 2012-10-18 2013-02-13 广东欧珀移动通信有限公司 同时支持标准和非标准i2c接口的数据传输方法及装置

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2011136796A1 (en) * 2010-04-30 2011-11-03 Hewlett-Packard Development Company, L.P. Management data transfer between processors
US9229886B2 (en) 2010-04-30 2016-01-05 Hewlett Packard Enterprise Development Lp Management data transfer between processors
CN102929828A (zh) * 2012-10-18 2013-02-13 广东欧珀移动通信有限公司 同时支持标准和非标准i2c接口的数据传输方法及装置
CN102929828B (zh) * 2012-10-18 2016-01-06 广东欧珀移动通信有限公司 同时支持标准和非标准i2c接口的数据传输方法及装置

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