KR20070031924A - Active matrix display devices - Google Patents

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데이비드 에이. 피쉬
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코닌클리케 필립스 일렉트로닉스 엔.브이.
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Abstract

능동 매트릭스 디스플레이 디바이스는 디스플레이 픽셀의 어레이를 포함하고, 각 픽셀은 전류-구동되는 발광 디스플레이 소자(2), 디스플레이 소자를 통과하는 전류를 구동하기 위한 구동 트랜지스터(22), 요구되는 디스플레이 픽셀 출력 레벨과 광 피드백 소자의 광 피드백 신호에 종속되는 기간 동안 상기 디스플레이 소자를 통과하는 실질적으로 일정한 전류를 구동하기 위한 상기 구동 트랜지스터를 제어하기 위해, 광 피드백 소자(38)를 포함한다. 상기 픽셀 전원 전압에 대한 값, 필드 기간 및 픽셀 구동 레벨의 허용된 범위를 포함하는 출력 구성이 상기 디스플레이에 적용된다. 출력 구성은 디스플레이 소자의 노화에 대한 응답으로 변경된다. 이 디바이스에서, 출력 구성은 디바이스가 노화됨에 따라 변경되어, 광 피드백 시스템은 디스플레이 사용의 보다 긴 기간 동안 디스플레이 소자의 차동적인 노화에 대한 보상을 계속해서 제공할 수 있다.The active matrix display device comprises an array of display pixels, each pixel comprising a current-driven light emitting display element 2, a drive transistor 22 for driving a current through the display element, a required display pixel output level and An optical feedback element 38 is included to control the drive transistor for driving a substantially constant current through the display element for a period dependent on the optical feedback signal of the optical feedback element. An output configuration including the allowed range of values for the pixel power supply voltage, field periods and pixel drive level is applied to the display. The output configuration changes in response to aging of the display element. In this device, the output configuration changes as the device ages so that the optical feedback system can continue to provide compensation for differential aging of the display element for a longer period of display use.

Description

능동 매트릭스 디스플레이 디바이스{ACTIVE MATRIX DISPLAY DEVICES}Active Matrix Display Devices {ACTIVE MATRIX DISPLAY DEVICES}

본 발명은 능동 매트릭스 디바이스에 관한 것이며, 특히, 하지만 배타적이지 않게, 각 픽셀에 연관된 박막 스위칭 트랜지스터를 구비한 능동 매트릭스 전계발광 디스플레이 디바이스에 관한 것이다. The present invention relates to an active matrix device, and in particular, but not exclusively, to an active matrix electroluminescent display device having a thin film switching transistor associated with each pixel.

전계발광 디스플레이 소자를 이용하는 매트릭스 디스플레이 디바이스는 잘 알려져 있다. 디스플레이 소자는 예를 들면, 폴리머 재료를 사용하는 박막 필름 전계발광 소자 또는 종래의 III-V 반도체 합성물을 사용하는 발광 다이오드(LED)를 포함할 수 있다. 유기 전계발광 재료, 특히 폴리머 재료에서의 최근의 발전은 비디오 디스플레이 디바이스에 실제적으로 사용되기 위한 그 능력을 보여 주었다. 이 재료는 일반적으로 한 쌍의 전극 사이에 삽입된 반도체 복합 폴리머의 하나 이상의 층을 포함하고, 이 전극의 하나는 투명하고, 다른 하나는 홀(hole) 또는 전자를 폴리머 층에 주입시키기 위해 적절한 재료로 제조된다.Matrix display devices using electroluminescent display elements are well known. The display device may include, for example, a thin film electroluminescent device using a polymer material or a light emitting diode (LED) using a conventional III-V semiconductor composite. Recent developments in organic electroluminescent materials, especially polymeric materials, have shown their ability to be used in practical use in video display devices. This material generally comprises one or more layers of semiconductor composite polymer sandwiched between a pair of electrodes, one of which is transparent and the other suitable material for injecting holes or electrons into the polymer layer. Is manufactured.

도 1은 알려진 능동 매트릭스 어드레스 지정된 전계발광 디스플레이 디바이스를 도시한다. 디스플레이 디바이스는 블록(1)으로 표시된 규칙적으로 이격된 픽셀의 행과 열 매트릭스 어레이를 갖는 패널을 포함하고, 상기 패널은 행(선택)과 열(데이터) 어드레스 컨덕터(4와 6)의 교차하는 세트 사이의 교차점에 위치된, 연관된 스위칭 수단과 함께 전계발광 디스플레이 소자(2)를 포함한다. 단지 소수의 픽셀만이 간략성을 위해 이 도면에서 도시된다. 실제에서는, 수백 개의 픽셀 행과 열이 존재할 수 있다. 픽셀(1)은 행 스캐닝 구동기 회로(8)와, 컨덕터의 제각기의 세트의 단부에 연결된 열 데이터 구동기 회로(9)를 포함하는 주변 구동 회로에 의해 행과 열 어드레스 컨덕터의 세트를 통해 어드레스 지정된다.1 shows a known active matrix addressed electroluminescent display device. The display device comprises a panel having a row and column matrix array of regularly spaced pixels represented by block 1, which panel comprises an intersecting set of row (selection) and column (data) address conductors 4 and 6. It comprises an electroluminescent display element 2 with an associated switching means, located at the intersection between. Only a few pixels are shown in this figure for simplicity. In practice, there may be hundreds of pixel rows and columns. The pixel 1 is addressed via a set of row and column address conductors by a peripheral drive circuit comprising a row scanning driver circuit 8 and a column data driver circuit 9 connected to an end of each set of conductors. .

이런 유형의 디스플레이 디바이스는 전류-어드레스 지정되는 디스플레이 소자를 가지고 있다. 디스플레이 소자를 통해 제어가능한 전류를 제공하기 위한 다수의 픽셀 회로가 존재하고, 이러한 픽셀 회로는 일반적으로 전류 소스 트랜지스터를 포함하며, 전류 소스 트랜지스터에 제공된 게이트 전압은 디스플레이 소자를 통과하는 전류를 결정한다. 저장 커패시터는 어드레스 지정 단계 후의 게이트 전압을 유지한다.Display devices of this type have display elements that are current-addressed. There are a number of pixel circuits for providing controllable current through the display element, which pixel circuit generally comprises a current source transistor, the gate voltage provided to the current source transistor determining the current passing through the display element. The storage capacitor holds the gate voltage after the addressing step.

폴리실리콘을 주원료로 하는 회로에 대해, 트랜지스터의 채널에서의 폴리실리콘 그레인(grain)의 통계적 분포 때문에, 트랜지스터의 임계 전압에서의 변동이 존재한다. 하지만, 폴리실리콘 트랜지스터는 전류와 전압 스트레스 하에서 상당히 안정적이어서, 임계 전압이 실질적으로 일정하게 유지된다.For circuits based on polysilicon, there is a variation in the threshold voltage of the transistor because of the statistical distribution of polysilicon grains in the channel of the transistor. However, polysilicon transistors are quite stable under current and voltage stresses so that the threshold voltage remains substantially constant.

임계 전압에서의 변동은 적어도 기판 상의 짧은 범위 상에서 비결정 실리콘 트랜지스터에서 작지만, 임계 전압은 전압 스트레스에 매우 민감하다. 구동 트랜지스터에 대해 필요한 임계 이상의 고전압의 인가는 임계 전압에서의 큰 변동을 야기시키는데, 이 변동은 디스플레이되는 이미지의 정보 내용에 따라 변한다. 그러므로, 비결정 실리콘 트랜지스터가 아닌 실리콘 트랜지스터와 비교해서 항상 온(on)인 비결정 실리콘 트랜지스터의 임계 전압에서의 큰 차이가 존재할 것이다. 이러한 차동적인 노화는 비결정 실리콘 트랜지스터를 이용해 구동되는 LED 디스플레이에서 심각한 문제이다.Variation in threshold voltage is small in amorphous silicon transistors, at least over a short range on the substrate, but the threshold voltage is very sensitive to voltage stress. Application of a high voltage above the threshold necessary for the drive transistor causes a large variation in the threshold voltage, which varies with the information content of the image being displayed. Therefore, there will be a large difference in the threshold voltage of an amorphous silicon transistor that is always on compared to a silicon transistor that is not an amorphous silicon transistor. This differential aging is a serious problem for LED displays driven with amorphous silicon transistors.

트랜지스터 특성에 있어서 변동에 추가하여, LED 자체에서의 차동적인 에이지이 또한 존재한다. 이것은 전류 스트레싱 이후에 발광 재료의 효율성에서의 감소 때문이다. 대부분의 경우에서, 전류와 전하가 LED를 더 많이 통과할수록, 그 효율성은 더 낮다. In addition to variations in transistor characteristics, there is also a differential age in the LED itself. This is due to a decrease in the efficiency of the luminescent material after current stressing. In most cases, the more current and charge passes through the LED, the lower the efficiency.

LED 재료의 노화를 보상하는 전압-어드레스 지정된 픽셀 회로를 위한 제안이 있어 왔다. 예를 들면, 픽셀이 광 감지 소자를 포함하는, 다양한 픽셀 회로가 제안되어 왔다. 이 소자는 디스플레이 소자의 광 출력에 응답하고, 광 출력에 응답하여 저장 커패시터상에 저장된 전하를 누출하도록 동작하여, 어드레스 지정 기간 동안 디스플레이의 통합된 광 출력을 제어한다. 도 2는 이 목적을 위한 픽셀 배치의 한 예를 도시한다. 이러한 유형의 픽셀 구성의 예는 WO 01/20591과 EP 1 096 466에 상세히 설명된다.There has been a proposal for voltage-addressed pixel circuits to compensate for aging of LED materials. For example, various pixel circuits have been proposed in which the pixels comprise photosensitive elements. The device responds to the light output of the display device and operates to leak charge stored on the storage capacitor in response to the light output, thereby controlling the integrated light output of the display during the addressing period. 2 shows an example of pixel arrangement for this purpose. Examples of pixel configurations of this type are described in detail in WO 01/20591 and EP 1 096 466.

구동 트랜지스터(22)는 어드레스 지정 단계 동안 커패시터(24) 상에 저장된, 게이트 상의 전압에 의해 제어된다. 어드레스 지정 단계 동안, 요구되는 전압이 어드레스 지정 단계 동안에만 턴 온되는 어드레스 지정 트랜지스터(16)에 의해 열(6)로부터 커패시터(24)에 전달된다. Drive transistor 22 is controlled by a voltage on the gate, stored on capacitor 24 during the addressing step. During the addressing phase, the required voltage is transferred from the column 6 to the capacitor 24 by the addressing transistor 16 which is turned on only during the addressing phase.

도 2의 픽셀 회로에서, 광다이오드(27)는 커패시터(24)상에 저장된 게이트 전압을 방전한다. 구동 트랜지스터(22) 상의 게이트 전압이 임계 전압에 도달할 때, EL 디스플레이 소자(2)는 더 이상 방출하지 않을 것이며, 저장 커패시터(24)는 방전을 멈출 것이다. 전하가 광다이오드(27)로부터 누출되는 비율은 디스플레이 소자 출력의 함수여서, 광다이오드(27)는 광-민감 피드백 디바이스로서 기능한다. 광다이오드(27)의 효과를 고려하면, 통합된 광 출력은:In the pixel circuit of FIG. 2, photodiode 27 discharges the gate voltage stored on capacitor 24. When the gate voltage on the driving transistor 22 reaches the threshold voltage, the EL display element 2 will no longer emit, and the storage capacitor 24 will stop discharging. The rate at which charge leaks from the photodiode 27 is a function of the display element output, so that the photodiode 27 functions as a light-sensitive feedback device. Considering the effect of the photodiode 27, the integrated light output is:

에 의해 주어진다는 것이 보여질 수 있다.It can be seen that given by.

이 수학식에서, ηPD는 디스플레이 전체에 걸쳐서 매우 균일한 광다이오드의 효율이고, Cs는 저장 커패시턴스이고, TF는 프레임 시간이고, V(0)는 구동 트랜지스터의 초기 게이트-소스 전압이고, VT는 구동 트랜지스터의 임계 전압이다. 그러므로, 광 출력은 EL 디스플레이 소자 효율에 독립적이고, 따라서, 노화 보상을 제공한다. 하지만, VT는 디스플레이 전체에 걸쳐 변하여, 비균일성을 나타내게 될 것이다.In this equation, η PD is the efficiency of the photodiode, which is very uniform across the display, C s is the storage capacitance, T F is the frame time, V (0) is the initial gate-source voltage of the drive transistor, and V T is the threshold voltage of the drive transistor. Therefore, the light output is independent of the EL display element efficiency, thus providing aging compensation. However, V T will change throughout the display, resulting in non-uniformity.

이러한 기본 회로의 개정(refinement)이 존재하지만, 실제적 전압-어드레스 지정된 회로가 임계 전압 변동에 여전히 민감하다는 문제로 남는다. 따라서, 도 2의 회로는 비결정 실리콘 구동 트랜지스터의 스트레스 유도된 임계 전압 변동을 보상하지 않을 것이다. 나아가, 게이트-소스 전압을 보유하는 커패시터가 방전되므로, 디스플레이 소자에 대한 구동 전류가 점차적으로 강하할 것이다. 따라서, 밝기는 점점 희미해지게 된다. 이것은 보다 낮은 평균 광 강도를 야기시킨다. While there is a refinement of this basic circuit, it remains a problem that the actual voltage-addressed circuitry is still sensitive to threshold voltage variations. Thus, the circuit of FIG. 2 will not compensate for the stress induced threshold voltage variation of the amorphous silicon drive transistor. Furthermore, since the capacitor holding the gate-source voltage is discharged, the driving current for the display element will gradually drop. Thus, the brightness becomes dim. This results in lower average light intensity.

출원인은 대안적인 광 피드백 픽셀 회로를 제안하였고, 이 회로에서 구동 트랜지스터는 디스플레이 소자로부터 일정한 광 출력을 제공하기 위해 제어된다. 노화 보상을 위해 광 피드백은 방전 트랜지스터의 동작(특히 턴온)의 타이밍을 변경하기 위해 사용되고, 방전 트랜지스터는 구동 트랜지스터를 빠르게 스위칭 오프하기 위해 동작한다. 방전 트랜지스터의 동작의 타이밍은 픽셀에 인가될 데이터 전압에 또한 따른다. 이런 방식으로, 평균 광 출력이 광 출력에 응답하여 보다 느리게 구동 트랜지스터를 스위칭 오프하는 방식보다 높을 수 있다. 따라서, 디스플레이 소자는 보다 효율적으로 동작할 수 있다. 구동 트랜지스터의 임계 전압에서의 임의의 드리프트(drift)는 디스플레이 소자의 (일정한) 밝기에서의 변화로서 나타날 것이다. 결과적으로, 출원인에 의해 제안된 수정된 광 출력 피드백 회로는 LED 노화와 구동 트랜지스터 임계 전압 변동 모두로부터 야기되는 출력 밝기에서의 변동을 보상한다.Applicants have proposed alternative optical feedback pixel circuits in which the drive transistors are controlled to provide a constant light output from the display element. For aging compensation, optical feedback is used to change the timing of the operation (especially turn on) of the discharge transistor, which operates to quickly switch off the driving transistor. The timing of the operation of the discharge transistor also depends on the data voltage to be applied to the pixel. In this way, the average light output can be higher than the method of switching off the drive transistor more slowly in response to the light output. Thus, the display element can operate more efficiently. Any drift in the threshold voltage of the drive transistor will appear as a change in the (constant) brightness of the display element. As a result, the modified light output feedback circuit proposed by the applicant compensates for variations in output brightness resulting from both LED aging and drive transistor threshold voltage variations.

알려진 픽셀 회로, 특히, 상기에서 요약된(그리고 아래에서 더 설명될) 제안된 픽셀 회로는 다른 픽셀의 LED 디스플레이 소자의 차동적 노화에 대한 정정을 제공할 수 있지만, 디스플레이의 수명을 연장시키지 않는다.Known pixel circuits, in particular the proposed pixel circuits summarized above (and described further below), can provide correction for the differential aging of LED display elements of other pixels, but do not extend the life of the display.

도 1은 알려진 EL 디스플레이 디바이스를 도시하는 도면.1 shows a known EL display device;

도 2는 차동적 노화를 보상하는 알려진 픽셀 설계를 도시하는 도면.2 illustrates a known pixel design that compensates for differential aging.

도 3은 출원자에 의해 제안된 픽셀 회로를 도시한 도면.3 shows a pixel circuit proposed by the applicant.

도 4는 도 3의 회로의 동작을 설명하기 위한 타이밍도.4 is a timing diagram for explaining the operation of the circuit of FIG.

도 5는 도 3의 회로를 수정한 도면.5 is a modified view of the circuit of FIG.

도 6은 도 5의 회로의 동작을 설명하기 위한 타이밍도.6 is a timing diagram for explaining the operation of the circuit of FIG.

도 7은 도 6의 회로의 동작을 보다 상세히 설명하는 목적을 위한 도 6의 회로에 대한 디바이스 특성을 도시한 도면.7 illustrates device characteristics for the circuit of FIG. 6 for the purpose of describing the operation of the circuit of FIG. 6 in more detail.

도 8은 하나의 필드에 대한 픽셀 출력을 도시한 도면.8 shows pixel output for one field;

도 9는 픽셀 출력이 보다 심한 노화 효과 이후에 어떻게 정정될 수 없는지를 도시하는 도면.9 illustrates how pixel output cannot be corrected after a more severe aging effect.

도 10은 픽셀 출력 성능이 시간에 따라 어떻게 변하는지를 도시한 도면.10 illustrates how pixel output performance changes over time.

도 11은 본 발명의 수정된 픽셀 회로를 도시한 도면.Figure 11 shows a modified pixel circuit of the present invention.

도 12는 본 발명을 구현하기 위한 수정된 열 회로의 제1 예를 도시한 도면.12 shows a first example of a modified thermal circuit for implementing the invention.

도 13은 도 12의 회로의 동작을 설명하기 위한 타이밍도.13 is a timing diagram for explaining the operation of the circuit of FIG.

도 14는 본 발명을 구현하기 위한 수정된 열 회로의 제2 예를 도시한 도면.14 shows a second example of a modified thermal circuit for implementing the invention.

도 15는 도 14의 회로의 동작을 설명하기 위한 타이밍도.15 is a timing diagram for explaining the operation of the circuit of FIG.

도 16은 본 발명을 구현하기 위한 수정된 열 회로의 제3 예를 도시한 도면.16 shows a third example of a modified thermal circuit for implementing the invention.

도 17은 본 발명의 대안적인 회로 동작을 설명하기 위해 사용되는 도면.17 is a diagram used to describe an alternative circuit operation of the present invention.

도 18은 본 발명에 의해 수정될 수 있는 픽셀 회로의 추가적인 예를 도시한 도면.18 illustrates a further example of a pixel circuit that may be modified by the present invention.

도 19은 도 3에서 도시된 것과 유사한 비결정 실리콘 회로가 본 발명에 따라 어떻게 수정될 수 있는지를 도시한 도면.19 shows how an amorphous silicon circuit similar to that shown in FIG. 3 can be modified in accordance with the present invention.

본 발명에 따라, 디스플레이 픽셀의 어레이를 포함하는 능동 매트릭스 디스플레이 디바이스가 제공되고, 각 픽셀은:According to the invention, there is provided an active matrix display device comprising an array of display pixels, each pixel:

전류-구동되는 발광 디스플레이 소자;Current-driven light emitting display elements;

디스플레이 소자를 통과하는 전류를 구동하기 위한 구동 트랜지스터;A driving transistor for driving a current through the display element;

요구되는 디스플레이 픽셀 출력 레벨과 광 피드백 소자의 광 피드백 신호에 종속되는 기간 동안 상기 디스플레이 소자를 통과하는 실질적으로 일정한 전류를 구동하기 위한 상기 구동 트랜지스터를 제어하기 위해, 광 피드백 소자를 포함하는 픽셀 회로; 및A pixel circuit comprising an optical feedback element for controlling said drive transistor for driving a substantially constant current through said display element for a period of time dependent upon the required display pixel output level and an optical feedback signal of the optical feedback element; And

상기 디스플레이에 대한 출력 구성을 적용하기 위한 제어 수단으로서, 상기 출력 구성은 적어도 상기 픽셀 전원 전압에 대한 값, 필드 기간 및 픽셀 구동 레벨의 허용된 범위를 포함하고, 상기 제어 수단은 상기 디스플레이 소자의 노화(aging)에 대한 응답으로 상기 값의 하나 이상을 변경시켜 상기 출력 구성을 변경하기 위해 적응되는, 제어 수단을 포함한다.Control means for applying an output configuration for the display, the output configuration including at least a permitted range of values, field periods, and pixel drive levels for the pixel power supply voltage, the control means aging the display element; control means adapted to change the output configuration by changing one or more of the values in response to aging.

이 디바이스에서, 출력 구성은 디바이스가 노화됨에 따라 변하여, 광 피드백 시스템은 디스플레이의 사용의 보다 긴 기간 동안 디스플레이 소자의 차동적 노화에 대한 보상을 계속해서 제공할 수 있다.In this device, the output configuration changes as the device ages, such that the optical feedback system can continue to provide compensation for differential aging of the display element for a longer period of use of the display.

픽셀 회로는 구동 트랜지스터에 대한 어드레스를 지정하기 위해 사용될 전압을 저장하기 위한 저장 커패시터와 구동 트랜지스터를 스위칭 오프하기 위해 저장 커패시터를 방전하기 위한 방전 트랜지스터를 포함할 수 있다. 그러면, 광-의존적 디바이스는 디스플레이 소자의 광 출력에 따라 방전 트랜지스터에 인가된 게이트 전압을 변경하여 방전 트랜지스터의 동작의 타이밍을 제어한다. 이러한 듀티(duty) 주기 제어 방식은 디스플레이 소자가 실질적으로 최대 밝기에서 동작하는 것을 가능케하며, 이는 다시 필드 기간이 보다 큰 디스플레이를 위해 바람직한 최소값으로 감소되는 것을 가능케 한다.The pixel circuit may include a storage capacitor for storing a voltage to be used for addressing the driving transistor and a discharge transistor for discharging the storage capacitor to switch off the driving transistor. The light-dependent device then controls the timing of the operation of the discharge transistor by changing the gate voltage applied to the discharge transistor in accordance with the light output of the display element. This duty cycle control scheme enables the display element to operate at substantially full brightness, which in turn allows the field period to be reduced to the minimum value desired for larger displays.

방전 커패시터는 방전 트랜지스터의 게이트와 일정한 전압 라인 사이에서 제공될 수 있고, 그러면 광 의존적 디바이스는 방전 커패시터를 충전 또는 방전하기 위한 것이다.A discharge capacitor can be provided between the gate of the discharge transistor and a constant voltage line, and then the light dependent device is for charging or discharging the discharge capacitor.

각 픽셀은 충전 라인과 구동 트랜지스터의 게이트 사이에 연결된 충전 트랜지스터를 더 포함할 수 있고, 각 픽셀은 상기 구동 트랜지스터와 직렬로 연결된 차단(isolating) 트랜지스터를 더 포함할 수 있다.Each pixel may further include a charging transistor connected between the charging line and the gate of the driving transistor, and each pixel may further include an isolating transistor connected in series with the driving transistor.

하나의 배치에서, 전원 라인은 픽셀의 각 열에 대해 제공된다. 예를 들면, 다른 전력 라인은 다른 컬러 픽셀의 열에 대해 제공될 수 있다. 이러한 수직적 전력 라인은 디스플레이 소자의 노화를 모니터링하기 위한 모니터링 목적을 위해 또한 사용될 수 있다. 예를 들면, 각 픽셀은 열 컨덕터로부터 상기 구동 트랜지스터의 상태의 검출을 가능케 하기 위한 판독 트랜지스터를 더 포함할 수 있다. 필드 기간의 끝에 구동 트랜지스터의 상태를 검출하여, 광 피드백 시스템이 구동 트랜지스터를 턴 오프했는지가 결정될 수 있다. 만약 그렇치 않다면, 이것은 디스플레이의 전류 동작적 특성이 정확한 보상이 발생하는 것을 허용하지 않는 정도로 디스플레이 소자의 노화를 나타낸다. In one arrangement, power lines are provided for each column of pixels. For example, different power lines can be provided for columns of different color pixels. Such vertical power lines can also be used for monitoring purposes to monitor the aging of display elements. For example, each pixel may further comprise a read transistor for enabling detection of the state of the drive transistor from a column conductor. By detecting the state of the drive transistor at the end of the field period, it may be determined whether the optical feedback system has turned off the drive transistor. If not, this indicates aging of the display element to such an extent that the current operational characteristics of the display do not allow accurate compensation to occur.

하나의 배치에서, 각 픽셀은 열 컨덕터로부터 구동 트랜지스터의 상태의 검출을 가능케 하기 위한 판독 트랜지스터를 더 포함한다.In one arrangement, each pixel further includes a read transistor for enabling detection of the state of the drive transistor from the column conductor.

대안적으로, 픽셀의 각 열은 열에서 구동 트랜지스터의 상태의 검출을 가능케하기 위한 판독 트랜지스터를 더 포함한다.Alternatively, each column of pixels further includes a read transistor for enabling detection of the state of the drive transistor in the column.

본 발명은 또한 디스플레이 픽셀의 어레이를 포함하는 능동 매트릭스 디바이스를 구동하는 방법을 제공하는데, 상기 능동 매트릭스 디스플레이 디바이스의 각각은 구동 트랜지스터, 전류-구동되는 발광 디스플레이 소자, 및 광 피드백 소자를 포함하는 픽셀 회로를 포함하고,The invention also provides a method of driving an active matrix device comprising an array of display pixels, each of the active matrix display devices comprising a pixel circuit comprising a drive transistor, a current-driven light emitting display element, and an optical feedback element. Including,

상기 방법은:The method is:

(i) 상기 디스플레이에 대한 출력 구성을 적용하는 단계로서, 상기 출력 구성은 적어도 상기 픽셀 전원 전압에 대한 값, 필드 기간 및 픽셀 구동 레벨의 허용된 범위를 포함하는, 적용 단계;(i) applying an output configuration for the display, the output configuration comprising an allowed range of values, field periods, and pixel drive levels for at least the pixel power supply voltage;

(ii) 요구되는 디스플레이 픽셀 출력 레벨과 광 피드백 소자의 광 피드백 신호에 종속되는 기간 동안 상기 디스플레이 소자를 통과하는 실질적으로 일정한 전류를 구동하기 위한 상기 구동 트랜지스터를 제어해서 각 픽셀을 어드레스 지정하는 단계; 및(ii) addressing each pixel by controlling the drive transistor to drive a substantially constant current through the display element for a period dependent on the required display pixel output level and the optical feedback signal of the optical feedback element; And

(iii) 상기 어레이의 디스플레이 소자의 노화를 모니터링하고, 상기 디스플레이 소자의 노화에 응답하여 상기 값의 하나 이상을 변경하여 상기 출력 구성을 변경하고, 상기 변경된 출력 구성에 대한 단계 (i)와 (ii)를 반복하는 단계를 포함한다.(iii) monitoring the aging of display elements of the array, changing the output configuration by changing one or more of the values in response to aging of the display elements, and (i) and (ii) for the modified output configuration. Repeating).

본 발명은 첨부된 도면을 참조해서 예를 통해 이제 설명될 것이다.The invention will now be described by way of example with reference to the accompanying drawings.

이 도면들은 개략적이고, 그 크기대로 그려지지 않았다는 것을 주목해야 한다. 이 도면들의 상대적인 크기와 비율은 도면에서의 명확성과 편리성을 위해, 크기에서 과장되거나 감소되었다. It should be noted that these figures are schematic and not drawn to scale. The relative sizes and ratios of these figures have been exaggerated or reduced in size for clarity and convenience in the figures.

출원인에 의해 이미 제안된 픽셀 회로(하지만, 이 발명을 출원시에는 아직 발표되지 않음)가 먼저 설명될 것이다. 이 픽셀 회로에서, 구동 트랜지스터는 주어진 프레임 동안 일정한 게이트 전압을 가지고 구동되고, 디스플레이 소자가 조명되는 기간은 요구되는 밝기의 출력뿐만 아니라 LED 재료와 구동 트랜지스터 모두의 노화 효과를 고려한다.The pixel circuits already proposed by the applicant (but not yet published at the time of filing this invention) will be described first. In this pixel circuit, the driving transistor is driven with a constant gate voltage for a given frame, and the period during which the display element is illuminated takes into account the aging effect of both the LED material and the driving transistor as well as the output of the required brightness.

도 3은 제안된 픽셀 배치의 예를 도시한다. 픽셀 회로는 도 1에서 도시된 것과 같은 디스플레이에서 사용하기 위한 것이다. 도 3의 회로는 비결정 실리콘 n-타입 트랜지스터를 사용하는 구현을 위해 적절하다.3 shows an example of the proposed pixel arrangement. The pixel circuit is for use in a display as shown in FIG. The circuit of Figure 3 is suitable for implementation using amorphous silicon n-type transistors.

구동 트랜지스터(22)의 게이트-소스 전압은 저장 커패시터(30)상에서 다시 유지된다. 하지만, 이 커패시터는 충전 트랜지스터(34)에 의해 충전 라인(32)로부터 고정된 전압으로 충전된다. 따라서, 디스플레이 소자가 조명되어야 할 때, 구동 트랜지스터(22)는 픽셀로의 데이터 입력에 독립적인 일정한 레벨로 구동된다. 밝기는 듀티 주기를 변경함으로써, 특히 구동 트랜지스터가 턴 오프될 때의 시간을 변경함으로서 제어된다.The gate-source voltage of the drive transistor 22 is again maintained on the storage capacitor 30. However, this capacitor is charged to a fixed voltage from the charging line 32 by the charging transistor 34. Thus, when the display element is to be illuminated, the drive transistor 22 is driven to a constant level independent of data input to the pixel. The brightness is controlled by changing the duty period, in particular by changing the time when the drive transistor is turned off.

구동 트랜지스터(22)는 저장 커패시터(30)를 방전하는 방전 트랜지스터(36)에 의해 턴 오프된다. 방전 트랜지스터(36)가 턴 온 될 때, 커패시터(30)는 빠르게 방전되고, 구동 트랜지스터는 턴 오프된다.The driving transistor 22 is turned off by the discharge transistor 36 which discharges the storage capacitor 30. When the discharge transistor 36 is turned on, the capacitor 30 is quickly discharged and the driving transistor is turned off.

게이트 전압이 충분한 전압에 도달할 때, 방전 트랜지스터가 턴 온된다. 광다이오드(38)는 디스플레이 소자(2)에 의해 조명되고, 디스플레이 소자(2)의 광 출력에 따라 광전류를 생성한다. 이러한 광 전류는 방전 커패시터(40)를 충전하고, 특정 시점에서, 커패시터(40) 양단에 걸리는 전압은 방전 트랜지스터(40)의 임계 전압에 도달할 것이고, 이에 따라 방전 트랜지스터를 스위치 온 할 것이다. 이 시간은 커패시터(40)와 광전류상에 원래 저장된 전하에 따를 것이며, 광전류는 따라서 디스플레이 소자의 광출력에 따를 것이다.When the gate voltage reaches a sufficient voltage, the discharge transistor is turned on. The photodiode 38 is illuminated by the display element 2 and generates a photocurrent in accordance with the light output of the display element 2. This photocurrent charges the discharge capacitor 40, and at some point in time, the voltage across the capacitor 40 will reach the threshold voltage of the discharge transistor 40, thereby switching on the discharge transistor. This time will depend on the charge originally stored on the capacitor 40 and on the photocurrent, which will therefore depend on the light output of the display element.

따라서, 데이터 라인(6) 상의 픽셀에 제공되는 데이터 신호는 어드레스 트랜지스터(16)에 의해 제공되고, 방전 커패시터(40)상에 저장된다. 저 밝기는 고 데이터 신호에 의해 표현되고{그 결과 단지 적은 양의 추가 전하가 트랜지스터(36)가 스위치 오프하기 위해 필요하다}, 고 밝기는 저 데이터 신호에 의해 표현된다{그 결과 많은 양의 추가적인 전하가 트랜지스터(36)가 스위치 오프하기 위해 필요하다}.Thus, the data signal provided to the pixel on the data line 6 is provided by the address transistor 16 and stored on the discharge capacitor 40. Low brightness is represented by a high data signal (as a result only a small amount of additional charge is needed for the transistor 36 to switch off), and high brightness is represented by a low data signal {as a result a large amount of additional Charge is needed for the transistor 36 to switch off.

따라서, 이 회로는 디스플레이 소자의 노화를 보상하기 위한 광 피드백을 가지고, 또한 구동 트랜지스터(22)의 임계 보상을 가지는데, 그 이유는 구동 트랜지스터 특성에서의 변동이 디바이스 소자 출력에서의 차이를 또한 초래할 것이고, 이 디스플레이 소자 출력은 광 피드백에 의해 다시 보상된다. 트랜지스터(36)에 대해, 임계치 이상의 게이트 전압은 매우 작게 유지되고, 그 결과 임계 전압 변동은 훨씬 덜 중요하다.Thus, this circuit has optical feedback to compensate for aging of the display element, and also has threshold compensation of the drive transistor 22, because variations in drive transistor characteristics will also result in differences in device element output. This display element output is again compensated by light feedback. For transistor 36, the gate voltage above the threshold is kept very small, so that the threshold voltage variation is much less important.

도 3에서 도시된 것처럼, 각 픽셀은 또한 구동 트랜지스터(22)의 소스와 바이패스 라인(44) 사이에 연결된 바이패스 트랜지스터(42)(T3)를 또한 가지고 있다. 이 바이패스 라인(44)은 모든 픽셀에 대해 공통일 수 있다. 저장 커패시터(30)가 충전되고 있을 때, 이것은 구동 트랜지스터의 소스에서 일정한 전압을 보장하기 위해 사용된다. 따라서, 이것은 전류의 흐름의 함수인, 디스플레이 소자의 양단에 걸리는 전압 강하에 대한 소스 전압의 의존성을 제거시킨다. 따라서, 고정된 게이트-소스 전압은 커패시터(30)상에 저장되고, 데이터 전압이 픽셀에 저장되고 있을 때, 디스플레이 소자가 턴 오프된다.As shown in FIG. 3, each pixel also has a bypass transistor 42 (T3) connected between the source of the drive transistor 22 and the bypass line 44. This bypass line 44 may be common for all pixels. When the storage capacitor 30 is being charged, it is used to ensure a constant voltage at the source of the drive transistor. This eliminates the dependence of the source voltage on the voltage drop across the display element, which is a function of the flow of current. Thus, the fixed gate-source voltage is stored on the capacitor 30 and when the data voltage is being stored in the pixel, the display element is turned off.

도 4는 도 3의 회로의 동작을 위한 타이밍도를 도시하고, 추가적으로 상세하게 회로 동작을 설명하기 위해 사용된다.4 shows a timing diagram for the operation of the circuit of FIG. 3 and is used to further explain the circuit operation.

전원 라인은 자신에 인가된 스위칭된 전압을 갖는다. 플롯(plot)(50)은 전압을 도시한다. 데이터를 픽셀에 기록하는 동안, 전원 라인(26)이 낮게 스위칭되고, 그 결과 구동 트랜지스터(22)가 턴 오프된다. 이것은 바이패스 트랜지스터(42)가 양호한 접지 기준을 제공하는 것을 가능케 한다. The power line has a switched voltage applied to it. Plot 50 shows the voltage. While writing data to the pixel, power supply line 26 is switched low, resulting in drive transistor 22 being turned off. This enables the bypass transistor 42 to provide a good ground reference.

3개의 트랜지스터(16, 34, 42)에 대한 제어 라인이 함께 연결되고, 전원 라인이 낮을 때, 이 3개의 트랜지스터는 모두 턴 온된다. 이 공유된 제어 라인 신호는 플롯(52)으로서 도시된다.The control lines for the three transistors 16, 34, 42 are connected together, and when the power supply line is low, all three transistors are turned on. This shared control line signal is shown as plot 52.

트랜지스터(16)를 턴 온 하는 것은 방전 커패시터(40)를 데이터 전압으로 충전하는 효과를 갖는다. 트랜지스터(34)를 턴 온하는 것은 저장 커패시터(30)를 충전 라인(32)으로부터 일정한 충전 전압으로 충전하는 효과를 가지며, 트랜지스터(42)를 턴온하는 것은 디스플레이 소자(2)를 바이패스하고, 구동 트랜지스터(22)의 소스 전압을 고정하는 효과를 갖는다. 플롯(54)에 도시된 것처럼, 데이터{해치된(hatched) 영역}는 이 시간 동안 픽셀에 적용된다. Turning on the transistor 16 has the effect of charging the discharge capacitor 40 to the data voltage. Turning on transistor 34 has the effect of charging storage capacitor 30 from charge line 32 to a constant charging voltage, turning on transistor 42 bypasses display element 2 and drives it. It has the effect of fixing the source voltage of the transistor 22. As shown in plot 54, data (hatched areas) is applied to the pixels during this time.

상기 회로는 n-타입만의 배치이고, 그러므로 비결정 실리콘 구현을 위해 적절하다. The circuit is an n-type only arrangement and is therefore suitable for amorphous silicon implementation.

도 5는 저온 폴리실리콘 프로세스를 사용하는 구현을 위해 적절하고, n-타입과 p-타입 디바이스를 이용하는 n-타입과 p-타입 회로를 도시한다.FIG. 5 shows n-type and p-type circuits suitable for implementation using low temperature polysilicon processes and using n-type and p-type devices.

구동 트랜지스터(22)는 p-타입 디바이스로서 구현된다. 소스가 이제 전원 라인에 연결되므로, 저장 커패시터(30)는 전원 라인(26)과 구동 트랜지스터(22)의 게이트 사이에서 연결된다. 유사하게, 방전 트랜지스터(36)는 p-타입 디바이스이고, 따라서 방전 커패시터(40)는 전원 라인(26)과 트랜지스터(36)의 게이트 사이에 연결된다. 이 회로에서, 전하는 광다이오드(38)에 의해 커패시터(40)로부터 제거되어, 방전 트랜지스터(36)가 턴 온 될 때까지 방전 트랜지스터(36)의 게이트 전압에서의 강하를 초래한다.The drive transistor 22 is implemented as a p-type device. Since the source is now connected to the power supply line, the storage capacitor 30 is connected between the power supply line 26 and the gate of the driving transistor 22. Similarly, the discharge transistor 36 is a p-type device, so that the discharge capacitor 40 is connected between the power supply line 26 and the gate of the transistor 36. In this circuit, charge is removed from the capacitor 40 by the photodiode 38, causing a drop in the gate voltage of the discharge transistor 36 until the discharge transistor 36 is turned on.

충전 트랜지스터(34)는 또한 p-타입 디바이스이고, 구동 트랜지스터(22)의 게이트와 접지 사이에 연결된다. 따라서, 트랜지스터(34)에 의해 실행되는 충전 동작은, 최대 전원 전압이 그 양단에 걸릴 때까지 커패시터를 충전하는 것이다. 이것은 구동 트랜지스터(22)의 게이트를 접지에 유지시키며, (구동 트랜지스터는 p-타입 디바이스이므로) 구동 트랜지스터를 최대로 턴 온한다. The charging transistor 34 is also a p-type device and is connected between the gate and the ground of the driving transistor 22. Thus, the charging operation performed by the transistor 34 is to charge the capacitor until the maximum power supply voltage is across it. This keeps the gate of the drive transistor 22 at ground and turns the drive transistor to the maximum (since it is a p-type device).

따라서, 기본적으로, 이 회로는 p-타입 트랜지스터의 사용을 허용하기 위한 적응과 함께 상기 회로와 동일한 방식으로 동작한다.Thus, basically, this circuit operates in the same way as the circuit with an adaptation to allow the use of p-type transistors.

차단 트랜지스터(62)는 디스플레이 소자(2)가 어드레스 지정 단계 동안 턴 오프되는 것을 가능케 하여, 블랙(black) 성능이 보존된다. 도 5에서, 이것은 물론 n-타입 디바이스일 수 있지만, 이것은 p-타입 디바이스이다.The blocking transistor 62 allows the display element 2 to be turned off during the addressing step, so that black performance is preserved. In FIG. 5 this may of course be an n-type device, but this is a p-type device.

도 6에서 도시된 것처럼, p-타입 트랜지스터(62)가 낮을 때, 게이트 제어 신호(56)는 p-타입 트랜지스터(62)를 턴 온하며, 이 트랜지스터가 어드레스 지정 기간을 지날 때, 트랜지스터(62)가 턴 오프되며, 한편 트랜지스터(16, 34)가 (56의 역전 신호에 의해) 턴 온된다.As shown in FIG. 6, when the p-type transistor 62 is low, the gate control signal 56 turns on the p-type transistor 62, and when the transistor passes an addressing period, the transistor 62 ) Is turned off, while transistors 16 and 34 are turned on (by a reverse signal of 56).

OLED 디스플레이의 전체 수명은 이 유형의 디스플레이에 대해, 특히 청색 LED 픽셀에 대해 가장 중요한 요소로 남아 있다. 그러므로, 연장된 수명을 가능케하는 임의의 처리가 중요하다.The overall lifetime of an OLED display remains the most important factor for this type of display, especially for blue LED pixels. Therefore, any treatment that enables extended life is important.

본 발명은 보상된 차동적 노화의 혜택을 유지시키면서, 연장된 수명을 얻기 위해 그 수명 동안 상기 설명된 유형의 픽셀 회로의 제어에 관한 것이다. 디스플레이 수명에 영향을 끼치는 주요 인자는 전원 전압, 프레임 시간과 데이터 전압 범위이다. 본 발명은 최소한의 차동적 노화를 갖는 최상의 가능한 디스플레이 수명을 얻기 위한 이러한 파라미터의 제어에 관한 것이다.The present invention relates to the control of pixel circuits of the type described above during their lifetime in order to obtain an extended lifetime while maintaining the benefits of compensated differential aging. The main factors affecting display life are supply voltage, frame time and data voltage range. The present invention relates to the control of these parameters to obtain the best possible display life with minimal differential aging.

본 발명은 광 피드백 보상 시스템을 사용하는 디스플레이의 수명을 연장시키지만, 광 피드백 시스템이 언제 그 정정 능력의 한도에 도달했는지를 결정하고, 그후 디스플레이에 대한 출력 구성을 변화시킨다. 이 출력 구성은 픽셀 전원 전압, 픽셀 구동 레벨의 필드 기간과 허용된 범위에 대한 값들을 포함한다. 하나 이상의 이러한 파라미터를 변경시킴으로써, 정정 능력이 확장된다.The present invention extends the life of a display using an optical feedback compensation system, but determines when the optical feedback system has reached its limit of its correction capability, and then changes the output configuration for the display. This output configuration includes values for the pixel power supply voltage, the field duration of the pixel drive level, and the allowed range. By changing one or more of these parameters, the correction capability is extended.

본 발명의 방법과 회로 수정을 설명하기 위해, 상기 설명된 회로의 동작을 보다 상세히 분석하는 것이 유용하다. 이 목적을 위해, 도 7은 분석 목적을 위해 지시된 소자 값을 갖는 도 6의 회로를 도시한다. 아래 첨자 1은 구동 트랜지스터(22)와 관련이 있고(그리고 TD로서 표시됨), 아래 첨자 2는 방전 트랜지스터(36)와 관련이 있다(그리고 TS로서 표시됨).To illustrate the method and circuit modification of the present invention, it is useful to analyze the operation of the circuit described above in more detail. For this purpose, FIG. 7 shows the circuit of FIG. 6 with device values indicated for analysis purposes. Subscript 1 is associated with drive transistor 22 (and denoted as T D ) and subscript 2 is associated with discharge transistor 36 (and denoted as T S ).

TD에 의해 OLED에 제공된 전류는 I1=f(V1,VDS)로서 쓸 수 있고, OLED의 휘도는 L=ηLEDI1/ALED이고, ηLED는 Cd/A 단위의 OLED의 효율이고, ALED는 픽셀 구경(aperture)의 영역이다. TS가 완벽한 스위치여서, I1=H(V2-VT2)이고, 여기서 H는 V2가 VT2와 같을 때까지 0인 계단 함수라고 가정할 수 있다. 회로 동작을 설명하는 차동적 등식은 수학식 2에서 주어진다.The current provided to the OLED by T D can be written as I 1 = f (V 1 , V DS ), the luminance of the OLED is L = η LED I 1 / A LED , and η LED is the Efficiency, A LED is a region of pixel aperture. Since T S is a perfect switch, I 1 = H (V 2 -V T2 ), where H can be assumed to be a step function that is zero until V 2 is equal to V T2 . The differential equation describing the circuit operation is given by equation (2).

등식 쌍의 처음 부분은 커패시턴스(C1)의 방전으로부터 온 것이고, 두 번째 부분은 효율이 A/Cd의 단위를 갖는 ηLED이고, 영역(APD)를 갖는 광다이오드에 의해 C2의 충전으로부터 온 것이다. H가 계단 함수이므로, 이러한 연결된 등식을 쉽게 해결할 수 있다. V1에 대한 해결책은 단순히:The first part of the equation pair comes from the discharge of capacitance C 1 , the second part is an η LED whose efficiency is in units of A / Cd, and by a photodiode having an area APD From the charging of C 2 . Since H is a step function, this connected equation can be easily solved. The solution for V 1 is simply:

이고, tON은 회로가 도 8에서 도시된 것처럼 광을 방출하는 시간이다.And t ON is the time for the circuit to emit light as shown in FIG. 8.

tON이 도달될 때까지 V1(t)가 고정되므로, VDS(t)가 또한 발견될 수 있다.Since V 1 (t) is fixed until t ON is reached, V DS (t) can also be found.

VP는 전원 전압이고, VLED는 OLED 애노드 전압이고, VTLED는 OLED의 임계 전압이다. 이것은 V2에 대해 쉽게 해결될 수 있다.V P is the supply voltage, V LED is the OLED anode voltage, and V TLED is the threshold voltage of the OLED. This can be easily solved for V 2 .

그러면, 이것이 TS가 스위치 온되는 시간, 즉, V2(t) = VT2이 될 것이기 때문에, tON이 발견될 수 있다. 회로의 평균 휘도는:Then, since this will be the time T S is switched on, that is, V 2 (t) = V T2 , t ON can be found. The average luminance of the circuit is:

에 의해 주어지고, TF는 프레임 시간이다. 그러므로, tON < TF 일 때,T F is given by frame time. Therefore, when t ON <T F ,

TS가 완벽한 스위치라는 것이 가정될 때, 이것은 회로가 OLED의 효율과 구동 TFT(TD)의 파라미터와 상관이 없다는 것을 보여준다. 밝기를 제어하기 위해 사용될 수 있는 파라미터는 전압{V2(0)}과 프레임 시간(TF)이다.When it is assumed that T S is a perfect switch, this shows that the circuit has nothing to do with the efficiency of the OLED and the parameters of the driving TFT (T D ). Parameters that can be used to control the brightness are voltage {V 2 (0)} and frame time (T F ).

만약, 하지만, tON > TF라면, 에러가 회로의 차동적 노화 정정 능력에서 발생한다. 이 경우에 휘도 에러는:If t ON > T F , however, an error occurs in the circuit's differential aging correction capability. In this case the luminance error is:

인데, 상기 값은 양수이고, 즉, 도 9에서 도시된 것 같이 프레임 시간의 끝이 도달되었기 때문에, 이 회로는 너무 많은 조명을 제공하였다.This value is positive, ie, because the end of the frame time has been reached, as shown in Figure 9, this circuit provided too much illumination.

이 에러는 0보다 작거나 같을 필요가 있는데, 즉, ΔL ≤ 0이고,This error needs to be less than or equal to zero, that is, ΔL ≤ 0,

구동 TFT(TD)에 대한 가정이 행해질 수 있다. TD가 그 선형 영역에서 구동될 때, 회로의 최저 전력 소모가 달성될 수 있으므로:Assumptions can be made for the driving TFT T D. When T D is driven in its linear region, the lowest power consumption of the circuit can be achieved:

이 가정될 수 있고, β는 TD의 트랜스-컨덕턴스 파라미터이다. OLED에 대한 간단한 모델, 즉,Can be assumed, β is the trans-conductance parameter of T D. Simple model for OLED, i.e.

을 가정하면, Assuming

를 수학식 4 내로 대체시키면:Replace with in Equation 4:

또는 or

τ는 τ is

에 의해 주어진 시간 상수이다.Is the time constant given by.

OLED가 노화됨에 따라, ηLED와 α가 감소할 것이고, 이는 프레임 시간 내에서 충분한 휘도를 제공하고, 회로가 프레임 내에서 턴 오프하는 것을 보장하기 위해 필요한, τ와, 이에 따라 초기적 OLED 전압을 증가시킬 것이다. TD가 그 선형 영역 내에 존재하므로, 전원은 OLED 전압보다 약간 위에 있을 것이다. 그러므로, 전원 또는 프레임 시간이 증가될 필요가 있거나, 데이터 전압 범위는 OLED가 감퇴함에 따라 감소될 필요가 있다.As the OLED ages, η LEDs and α will decrease, which reduces the τ and thus the initial OLED voltage, which is necessary to provide sufficient brightness within the frame time and to ensure that the circuit turns off within the frame. Will increase. Since T D is in its linear region, the power supply will be slightly above the OLED voltage. Therefore, the power supply or frame time needs to be increased, or the data voltage range needs to be reduced as the OLED decays.

AMPLED 디스플레이에 대한 픽셀 사용이 도 10에서 도시된다. 이것은 시간(T)에 대한 수명 P(TP)=TP/Tmax 상의 픽셀 사용의 확률을 도시한다. TP는 전체 픽셀 온-타임(on-time)이고, Tmax는 픽셀이 온되기 위한 최대 가능 시간이다. 세 개의 플롯이 주어진 온-타임을 갖는 임의의 픽셀의 확률을 도시하고, 각 플롯은 다른 에이지의 디스플레이에 대한 픽셀을 나타난다.Pixel usage for the AMPLED display is shown in FIG. 10. This shows the probability of using pixels on the lifetime P (T P ) = T P / T max over time T. T P is the overall pixel on-time and T max is the maximum possible time for the pixel to be on. Three plots show the probability of any pixel having a given on-time, and each plot represents a pixel for a display of a different age.

디스플레이 수명(T1)의 시작에서 픽셀 사용(즉, 픽셀 온-타임)에서의 확장은 아주 작고, 그러므로, 번-인(burn-in)의 가시적 효과는 무시할 수 있을 것이다. 디스플레이의 수명 상에(T2 그후 T3), 분포는 보다 넓게 될 것이고, 번-인 효과는 보다 심각하게 될 것이다. The expansion in pixel usage (i.e. pixel on-time) at the beginning of the display life T1 is very small and therefore the visible effects of burn-in will be negligible. On the lifetime of the display (T2 then T3), the distribution will be wider and the burn-in effect will be more severe.

이것은 번-인의 효과(즉, LED 디스플레이 소자의 차동적 노화)가 디스플레이 수명의 시작에서 중대하지 않을 것이라는 것을 보여주어, 광 피드백 보상 방식은 차동적 노화 보상을 수행하기 위해 최대 프레임 기간을 요구하지 않을 것이다.This shows that the effects of burn-in (ie, differential aging of LED display elements) will not be significant at the beginning of the display life, so that the optical feedback compensation scheme will not require the maximum frame period to perform differential aging compensation. will be.

결과적으로, 디스플레이 수명의 시작에서, 디스플레이는 저 전원(VP)에서 동작될 수 있고, 번-인은 발생하지 않을 것이다. 이것은 발열(heating)을 감소할 것이고, 그러므로, OLED의 감퇴를 감소시킬 것이다. 디스플레이가 노화됨에 따라, 픽셀 사용에서의 확장은 보다 심각하게 될 것이고, 광 피드백의 정정 처리가 필요하게 될 것이다. 이것은:As a result, at the beginning of the display life, the display can be operated at low power supply V P , and burn-in will not occur. This will reduce heating and therefore reduce OLED decay. As the display ages, the expansion in pixel usage will become more serious and a correction process of the light feedback will be needed. this is:

(A) 전원을 증가시키는 것(그 결과 충분한 광 출력이 필드 기간 내에 제공될 수 있는); 및/또는(A) increasing the power source (as a result sufficient light output can be provided within the field period); And / or

(B) 프레임 시간을 증가시키는 것(그 결과 보다 많은 시간이 모든 픽셀에 대해 보상된 통합된 광 출력을 제공하기 위해 이용 가능하다), 및/또는(B) increasing the frame time (as a result more time is available to provide a compensated integrated light output for all pixels), and / or

(C) 데이터 전압 범위를 감소시키는 것(그 결과 아무런 픽셀도 최대 밝기 출력으로 구동된다)을 요구할 것이다.(C) would require reducing the data voltage range (as a result no pixels are driven to full brightness output).

처리(A)는 보다 큰 발열과 따라서 보다 짧은 수명을 초래하면서, 그 수명 동안 일정한 휘도를 가능하게 할 것이다. 처리(B)와 (C)는 번-인 없이 수명 동안 휘도를 감소시킬 것이다. 예를 들면, 프레임 시간을 증가시켜서, 프레임 비율이 감소될 것이고, 물론 평균 광 출력을 감소시킬 것이고, 이것은 또한 깜박거림(flicker)을 초래할 수 있다.The treatment A will enable constant luminance during that lifetime, resulting in greater heat generation and thus shorter lifetime. Processing (B) and (C) will reduce the brightness over the lifetime without burn-in. For example, by increasing the frame time, the frame rate will be reduced and, of course, the average light output will be reduced, which can also result in flicker.

본 발명은, 차동적 노화 보상이 디스플레이의 연장된 수명 동안 달성될 수 있도록 하기 위해 디스플레이의 수명 동안 전원 전압, 및/또는 프레임 시간 및/또는 데이터 전압 범위를 조정하는 것을 수반한다.The present invention involves adjusting the supply voltage, and / or frame time and / or data voltage range during the lifetime of the display so that differential aging compensation can be achieved for the extended lifetime of the display.

바람직한 실시예에서, 전원 라인은 적색, 녹색 및 청색 디스플레이 소자에 대해 분리적인 전원을 가지고, 수직으로 이어지도록 배열된다. 각 전원은 각 컬러의 전압 동작에 맞게 조정될 수 있어서, 그러므로 전체적 전원 소모를 감소시키고, 수명을 향상시킨다.In a preferred embodiment, the power lines are arranged to run vertically with separate power supplies for the red, green and blue display elements. Each power source can be adjusted for the voltage operation of each color, thus reducing overall power consumption and improving lifetime.

디스플레이 동작 특성의 제어를 구현하기 위해, 디스플레이에서의 픽셀의 분포가 결정될 필요가 있다. 수직 전원 라인을 가진 디스플레이에 대해, 이것은 도 7에서 구동 트랜지스터 게이트 전압(C1)에 대한 저장 커패시터상의 전압의 상태를 감지하여 달성될 수 있다.In order to implement control of display operating characteristics, the distribution of pixels in the display needs to be determined. For a display with a vertical power supply line, this can be accomplished by sensing the state of the voltage on the storage capacitor with respect to the drive transistor gate voltage C 1 in FIG. 7.

만약 C1이 필드 기간의 끝에서 완전히 충전되면, 픽셀을 턴 오프 하기 위해 조명이 충분하지 않았다. 이 경우에, 본 발명은 전원 전압을 증가시키거나, 프레임 시간을 증가시키거나, 이 픽셀에 대한 데이터 전압 범위를 감소시킬 필요가 있다는 것을 인식한다.If C 1 is fully charged at the end of the field period, there is not enough light to turn off the pixel. In this case, the present invention recognizes that it is necessary to increase the power supply voltage, increase the frame time, or reduce the data voltage range for this pixel.

본 발명은 모든 픽셀의 상태를 감지하여, 그후 상기 3개의 처리들 중의 임의의 하나의 처리가 구현될 필요가 있는지를 판단하는 것을 수반한다.The present invention involves sensing the state of every pixel and then determining whether any one of the three processes needs to be implemented.

도 11은 구동 트랜지스터의 전도 상태가 감지되는 것을 허용하고, 그후 C1상의 전압의 지시를 제공하는 도 7의 픽셀 회로에 대한 수정을 도시한다. 픽셀 회로는 추가적인 트랜지스터(70)를 포함하고, 이것은 차단 트랜지스터(62)와 동일한 제어 라인에 의해 게이팅되지만, 보완적인 방식에서 동작한다. 이 회로는 C1상의 전압의 상태가 열로부터 감지되는 것을 가능케하고, 하나의 추가적인 TFT를 요구하지만, 아무런 추가적인 열 또는 어드레스 라인을 필요로 하지 않는다.FIG. 11 illustrates a modification to the pixel circuit of FIG. 7 that allows the conduction state of the drive transistor to be sensed and then provides an indication of the voltage on C1. The pixel circuit includes an additional transistor 70, which is gated by the same control line as the blocking transistor 62, but operates in a complementary manner. This circuit allows the state of the voltage on C1 to be sensed from the column and requires one additional TFT, but no additional column or address line.

트랜지스터(70)는 구동 트랜지스터와 직렬로 연결되고, 만약 구동 트랜지스터가 턴 온되면, 검출될 수 있는, 구동 트랜지스터를 통과하는 전원 라인으로의 연결이 존재한다.Transistor 70 is connected in series with the drive transistor, and there is a connection to the power supply line through the drive transistor, which can be detected if the drive transistor is turned on.

트랜지스터(70)는 픽셀의 특정 행이 어드레스 지정되고 있을 때에만 턴 온된다. 따라서, 임의의 열 이내에서, 단지 하나의 픽셀만이 항상 턴 온되는 트랜지스터(70)를 가지고 있고, C1의 상태는 개별 픽셀에 대해 결정될 수 있다.Transistor 70 is turned on only when a particular row of pixels is being addressed. Thus, within any column, only one pixel has a transistor 70 that is always turned on, and the state of C 1 can be determined for individual pixels.

도 12는 열 구동기 내에 감지 회로를 도시하며, 도 13은 픽셀 어드레스 라인과, 고(high) 상태가 닫히는, 도 12의 열 구동기 스위치(M1, M2와 M3)의 타이밍을 도시한다. FIG. 12 shows the sensing circuit in the column driver, and FIG. 13 shows the timing of the pixel driver line and column driver switches M1, M2 and M3 of FIG. 12 with the high state closed.

픽셀이 어드레스 지정되기 바로 전에(즉, 이전 필드 기간의 끝에서), 열이 스위치(M3)을 닫음으로써 저 전압으로 사전-충전된다. Just before the pixel is addressed (ie at the end of the previous field period), the column is pre-charged to a low voltage by closing the switch M3.

그후 M3가 열리고, M2는 열 전압의 상태를 측정하기 위해 닫힌다. 만약 C1이 방전되지 않으면, 구동 TFT가 온이므로, 열이 고 전압으로 충전될 것이고, 반면, C1는 방전되면, 그러면 구동 TFT가 OFF이므로, 열이 저 전압으로 유지될 것이다. 따라서, 열 전압의 충전은 온된 구동 트랜지스터를 나타내고, 이것은 광 피드백 시스템은 완전한 정정을 제공할 수 없었다는 것을 나타낸다.M3 is then opened and M2 is closed to measure the state of the thermal voltage. If C 1 is not discharged, the heat will be charged to high voltage because the driving TFT is on, whereas C 1 will be discharged, and then heat will be kept at low voltage since the driving TFT is OFF. Thus, charging the thermal voltage represents an on drive transistor, which indicates that the optical feedback system could not provide full correction.

그후, 열의 상태는 메모리에 저장된다. 그후 M2가 열리고, M1은 닫혀서, 열이 다음 데이터 전압으로 충전된다. 정상 어드레스 지정 단계가 후속되고, 본 발명은 M2에 대한 제어 펄스의 기간에 대응하는 기간을 갖는 어드레스 지정 주기에서 추가적인 단계로서 구현된다. 이 기간은 온 구동 트랜지스터를 통과하는 전원 라인에 의한 열 커패시턴스의 충전을 위해 간단히 충분해야 하고, 수 마이크로초 정도일 수 있다.The state of the column is then stored in memory. M2 is then opened and M1 is closed so that the column is charged to the next data voltage. The normal addressing step follows, and the present invention is implemented as an additional step in an addressing period having a period corresponding to the period of the control pulse for M2. This period should simply be sufficient for charging the thermal capacitance by the power line passing through the on drive transistor and may be on the order of several microseconds.

필드 시간의 끝에서, 모든 픽셀이 감지될 것이고, 다수의 방식이 수집된 날짜에 응답하여 디스플레이 파라미터를 제어하기 위해 사용될 수 있다.At the end of the field time all pixels will be sensed and a number of schemes can be used to control the display parameters in response to the date collected.

한 방식에서, 만약 임의의 픽셀이, 필드 시간의 끝에서 방전되지 않은, 저장 커패시터(C1)를 가지고 있다면, 정정 처리가 수행된다. 상기에서 요약된 것처럼, 이러한 정정 처리는:In one way, if any pixel has a storage capacitor C 1 , which is not discharged at the end of the field time, a correction process is performed. As summarized above, this correction process is:

(i) 아무런 열도 높게 감지되지 않을 때까지 각 필드 후에 ΔV만큼 전원 라인 전압을 증가시키는 것, 및/또는(i) increasing the power line voltage by ΔV after each field until no heat is detected high, and / or

(ii) 아무런 열도 높게 감지되지 않을 때까지 각 필드 후에 ΔV만큼 프레임 시간을 증가시키는 것, 및/또는(ii) increasing the frame time by ΔV after each field until no heat is detected high, and / or

(iii) 아무런 열도 높게 감지되지 않을 때까지 각 필드 후에 ΔV만큼 데이터 전압 범위를 감소시키는 것일 수 있다.(iii) reducing the data voltage range by ΔV after each field until no heat is detected high.

대안적인 제어 방식에서, 사전 결정된 수(N)를 초과하는 픽셀은 필드 시간의 끝에서 방전되지 않은 커패시터(C1)를 갖을 때에만, 정정 처리가 이용될 수 있다.In an alternative control scheme, correction processing can be used only when the pixels exceeding the predetermined number N have an undischarged capacitor C 1 at the end of the field time.

개별 픽셀을 기초로 하는 정정 방식은 아무런 번-인도 허용하지 않지만, 픽셀 오류가 존재할 수 있으므로, 이것은 바람직하지 않을 수 있다. 따라서, 사전 결정된 수(N)에 의해 지정되는 번-인의 레벨을 허용하는 정정 방식이 바람직하다. A correction scheme based on individual pixels does not allow any burn-in, but this may be undesirable as there may be pixel errors. Thus, a correction scheme that allows for the level of burn-in specified by the predetermined number N is desirable.

도 14는 픽셀 상태 감지를 달성하기 위한 다른 방법을 도시하고, 열 당 추가적인 트랜지스터(80)를 요구한다. 픽셀에 대한 저 전위 라인이 열에 평행으로 이어지도록 배열되고, 추가적인 트랜지스터(80)는 저 전위 라인을 저 전위 전압원(접지)에 선택적으로 연결시킨다.14 illustrates another method for achieving pixel state sensing and requires an additional transistor 80 per column. The low potential line for the pixel is arranged to run parallel to the column, and an additional transistor 80 selectively connects the low potential line to the low potential voltage source (ground).

이 배치에서, 저 전위 라인은 낮게 미리-충전될 수 있다. 감지 동작 동안, 이 라인은 트랜지스터에 의해 저 전압원으로부터 차단되어, 라인 상의 전압이 모니터링된다. 이 배치에서, 만약 저장 커패시터(C1)가 방전되었다면, 방전 트랜지스터(TS)가 저 전위 열 라인을 높게 충전하기 위해 사용된다. 만약 커패시터(C1)가 방전되었다면, 이것은 광 피드백 시스템이 방전 트랜지스터를 턴 온 했기 때문이다. 결과적으로, 방전 트랜지스터와 (필드 기간 동안 온인) 충전 트랜지스터(34)를 통해 전원 라인으로부터 전도 경로가 존재한다.In this arrangement, the low potential line can be low pre-charged. During the sensing operation, this line is disconnected from the low voltage source by the transistors so that the voltage on the line is monitored. In this arrangement, if the storage capacitor C 1 is discharged, the discharge transistor T S is used to charge the low potential column line high. If capacitor C 1 is discharged, this is because the optical feedback system has turned on the discharge transistor. As a result, there is a conductive path from the power supply line through the discharge transistor and the charge transistor 34 (which is on for the field period).

이 경우에, 방전 트랜지스터(TS)는 임계 전압일 것이며, 그래서 충전 시간이 아주 길게 될 것이다. 그러므로, 이 방법은 충분한 시간이 이용 가능할 때, 예를 들면, 디스플레이가 턴 오프될 때마다 가장 잘 구현된다.In this case, the discharge transistor T S will be the threshold voltage, so that the charging time will be very long. Therefore, this method is best implemented when sufficient time is available, for example whenever the display is turned off.

감지를 위한 타이밍도가, C1이 방전될 때 발생하는 고전압으로 열이 충전되는 경우에 대해, 도 15에서 도시된다. 도 15는 픽셀이 감지 이후에 즉시로 어드레스 지정되는 경우를 도시한다. 이 배치는 다시 각 픽셀 방전 트랜지스터의 상태가 디스플레이의 최대 어드레스 지정 주기동안 결정되는 것을 가능하게 한다.A timing diagram for sensing is shown in FIG. 15 for the case where heat is charged with the high voltage generated when C 1 is discharged. 15 shows the case where a pixel is immediately addressed after sensing. This arrangement again allows the state of each pixel discharge transistor to be determined for the maximum addressing period of the display.

상기 회로에서 열 상태의 저장은 아날로그 또는 디지털 모드에서 수행될 수 있다.The storage of the thermal state in the circuit can be performed in analog or digital mode.

도 16은 아날로그 구현을 도시한다. 만약 (도 12를 참조하여) M2가 닫힐 때, 열이 높게 충전되면, 전류가 트랜지스터(TM)를 통과해 흐를 것이다. 높게 지나는 임의의 다른 열은 또한 그 열에 대해 TM을 거쳐 전류를 흐르게 해서, 그결과 측정 라인(모든 열 사이에 공유된 경우) 상의 전류가 높게 지나는 모든 열의 합일 것이고, 이것이 측정될 것이다. 이것은 행 내에서 픽셀의 조합을 위한 분석을 나타낸다. 이 전류에 대응하는 값이 저장될 수 있고, 디스플레이에서 모든 다른 행에 대해 생성된 전류를 가지고 축적된다. 그러면, 야기된 값은 전원과 프레임 시간 등을 조정하기 위해 사용될 수 있다.16 illustrates an analog implementation. If M2 is closed (see FIG. 12), if the heat is charged high, current will flow through transistor T M. Any other row that passes high will also cause a current to flow through T M for that column, so that the current on the measurement line (if shared between all columns) will be the sum of all the rows that go high. This represents the analysis for the combination of pixels within a row. A value corresponding to this current can be stored and accumulated with the current generated for every other row in the display. The resulting value can then be used to adjust power and frame time and the like.

디지털 방법은 열 상에서 감지된 값을 저장하고 클록을 발생시키기 위한 열 구동기 이동 레지스터의 출력에서의 래치(latch)를 사용할 수 있다. 그러면, 이 값이 축적되고, 적절한 파라미터를 조정할 결정 로직으로 입력된다.The digital method can use a latch at the output of the column driver shift register to store the sensed value on the column and generate a clock. This value is then accumulated and input into the decision logic to adjust the appropriate parameter.

상기 예에서, 감지 기능은 라인이 재-어드레스 지정되기 바로 전에 발생하는 것으로 설명된다. 이것은 프레임 기간에서 임의의 시간으로 연장될 수 있다. 예를 들면, LED 디스플레이 소자의 듀티 주기를 제한하여, 이것이 50%를 초과하지 않는 것이 바람직할 수 있다. 디스플레이 소자를 보다 높은 밝기와 하지만 보다 짧은 듀티 주기를 가지고 발광시킴으로써, 디스플레이의 수명이 또한 연장될 수 있다. 이 경우에, 감지 기능은 아무런 광 출력도 없을 때 필드 기간의 일부 동안에, 필드 기간의 중간에서 발생할 수 있다. In the above example, the sensing function is described as occurring just before the line is re-addressed. This can be extended to any time in the frame period. For example, it may be desirable to limit the duty cycle of the LED display device so that it does not exceed 50%. By emitting the display elements with higher brightness and with shorter duty cycles, the lifetime of the display can also be extended. In this case, the sensing function may occur in the middle of the field period, during part of the field period when there is no light output.

각 어드레스 지정 단계가 감지 기간을 포함하면, 다른 라인이 어드레스 지정을 위해 사용되는 동안에, 임의의 라인(예를 들면, 행 컨덕터)이 감지를 위해 사용될 수 있다. 어드레스 지정된 라인과 감지된 라인은 도 17에서 도시된 것처럼 두 개의 출력을 가진 행 구동기에 의해 제어될 수 있다.If each addressing step includes a sensing period, any line (eg, row conductor) can be used for sensing, while other lines are used for addressing. The addressed and sensed lines can be controlled by a row driver with two outputs as shown in FIG.

도 17은 두 개의 출력(A, B)을 가진 행 구동기(8)를 도시한다. 임의의 시간에, 하나의 출력(A)이 픽셀 행을 어드레스 지정하기 위해 사용되고, 다른 출력(B)은 감지 기능을 위해 사용된다. 두 개의 출력이 필드 기간의 단편(fraction)에 의해 서로 엇갈리게 되어(staggered), 감지 동작은 행에서 픽셀의 조명이 완전한 후에 발생한다.17 shows a row driver 8 with two outputs A and B. At any time, one output A is used to address the pixel row and the other output B is used for the sensing function. The two outputs are staggered from each other by a fraction of the field period so that the sensing operation occurs after the illumination of the pixels in the row is complete.

타이밍도에서 도시된 것처럼, 각 행에 대한 어드레스 지정 기간(82)은 두 부분을 포함한다. 한 부분(84)은 감지 기능을 위해 사용되고, 다른 부분(86)은 어드레스 지정 기능을 위해 사용된다.As shown in the timing diagram, the addressing period 82 for each row includes two parts. One portion 84 is used for the sensing function and the other portion 86 is used for the addressing function.

감지 동작 동안, 열 컨덕터는 초기에는 고 임피던스("고 Z")이지만, 픽셀이 오프되는 것을 보장하기 위해 낮게 구동된다. 픽셀 어드레스 지정 동작 동안, 행 펄스(86)는 열 컨덕터상의 데이터 신호의 늘상적인 타이밍에 대응한다. 각 필드 기간 동안, 따라서 각 열이 두 번 사용되는데, 한 번은 감지를 위해 사용되고, 다른 한 번은 어드레스 지정을 위해 사용된다.During the sensing operation, the thermal conductor is initially high impedance (“high Z”), but is driven low to ensure that the pixel is off. During the pixel addressing operation, the row pulse 86 corresponds to the usual timing of the data signal on the column conductor. During each field period, each column is therefore used twice, once for detection and once for addressing.

상기 설명된 바람직한 구현은 수직 전력 라인을 사용한다. 하지만 수평 전력 라인이 또한 사용될 수 있다. 이 경우에, 수평 전력 라인상에 흐르는 전류가 적절한 시간에 감지될 수 있고, 상기 설명된 것과 동일한 방법으로 조정이 행해진다.The preferred implementation described above uses vertical power lines. However, horizontal power lines can also be used. In this case, the current flowing on the horizontal power line can be sensed at an appropriate time, and the adjustment is made in the same manner as described above.

상기 설명은 하나의 특정한 광 피드백 픽셀 설계로의 본 발명의 구현과 관련이 있다. 발명이 적용될 수 있는 광 피드백 시스템의 다양한 가능한 대안적인 구현이 존재한다.The above description relates to the implementation of the present invention in one particular optical feedback pixel design. There are various possible alternative implementations of the optical feedback system to which the invention can be applied.

도 18은 도 17의 픽셀 회로로의 수정을 도시하는데, 이 수정에서 추가적인 트랜지스터(90)가 방전 트랜지스터(36)의 게이트와 접지 라인 사이에 제공되고, 광 피드백 시스템이 디스플레이 소자를 스위칭 오프하기 위해 동작할 때 방전을 증가시킨다.FIG. 18 shows a modification to the pixel circuit of FIG. 17, in which an additional transistor 90 is provided between the gate and the ground line of the discharge transistor 36, and an optical feedback system is used to switch off the display element. Increases discharge when in operation.

만약 회로가 스위칭 오프되었다면, TFT(90)는 열을 낮게 구동하는 것을 가능하게 하므로, 도 18에서 도시된 회로가 또한 감지를 위해 사용될 수 있다. If the circuit was switched off, the TFT 90 makes it possible to drive the heat low, so the circuit shown in Fig. 18 can also be used for sensing.

비록 비결정 실리콘 광 피드백 회로의 예가 도 3에서 도시되지만, 상기 본 발명의 예가 폴리실리콘 구동 TFT를 사용한다. 도 3의 한 변형은 광다이오드를 충전 라인(32)에 연결시켜서, 전원 라인(26)이 단지 구동 트랜지스터(22)에만 연결된다. 이것은 전원 라인(26)이 스위칭되는 것을 가능케 하며, 그 결과 디스플레이 소자가 어드레스 지정 단계 동안에 턴 오프될 수 있다. 이것은 픽셀 구동의 명암을 검게 향상시킨다. 또한, 이것은 바이패스 트랜지스터가 생략되는 것을 가능케 한다. 이런 유형의 회로에 대한 본 발명의 구현이 도 19에 도시된다.Although an example of the amorphous silicon optical feedback circuit is shown in Fig. 3, the example of the present invention uses a polysilicon driving TFT. One variant of FIG. 3 connects the photodiode to the charging line 32 such that the power supply line 26 is only connected to the drive transistor 22. This allows the power supply line 26 to be switched so that the display element can be turned off during the addressing step. This blackens the contrast of the pixel drive. This also allows the bypass transistor to be omitted. An implementation of the present invention for this type of circuit is shown in FIG. 19.

도 19는 상기 요약된 수정을 가지고, 도 3에 본질적으로 대응하고, 여기서 추가적 트랜지스터 스위치(100)가 감지 동작이 수행되는 것을 가능케 하기 위해 디스플레이 소자의 애노드와 열 라인 사이에 연결된다.FIG. 19, with the modification outlined above, corresponds essentially to FIG. 3, wherein an additional transistor switch 100 is connected between the anode and column lines of the display element to enable the sensing operation to be performed.

상기 예에서, 제어 파라미터는 전원 전압을 포함한다. 이것은 전원 라인(26)에 제공되는 전압일 수 있지만, 디스플레이의 제어는 충전 라인(32)상의 전압을 수정함으로써 또한 달성될 수 있다. 이 충전 라인 전압은 픽셀 전원 전압의 하나이다. 따라서, 픽셀 전원 전압은 충전 라인(32) 전압(여기서 이것은 주 전원 라인과 분리된다)과 전원 라인(26) 전압을 포함한다. In the above example, the control parameter includes a power supply voltage. This may be the voltage provided to the power supply line 26, but control of the display may also be achieved by modifying the voltage on the charging line 32. This charging line voltage is one of the pixel power supply voltages. Thus, the pixel power supply voltage includes the charge line 32 voltage (where it is separate from the main power supply line) and the power supply line 26 voltage.

상기 예는 공통-캐소드 구현이고, 여기서 LED 디스플레이 소자의 애노드 측은 패터닝(patterning)이 되고, 모든 LED 소자의 캐소드 측은 공통 패터닝되지 않는 전극을 공유한다. 이것은 LED 소자 어레이의 제조에서 사용된 재료와 공정의 결과로서 현재의 바람직한 구현이다. 하지만, 패터닝된 캐소드 설계가 구현되고 있으며, 이것은 픽셀 회로를 단순화할 수 있다.The above example is a common-cathode implementation, where the anode side of the LED display element is patterned, and the cathode side of all LED elements share an electrode that is not common patterned. This is a presently preferred implementation as a result of the materials and processes used in the manufacture of LED device arrays. However, patterned cathode designs are being implemented, which can simplify pixel circuitry.

상기 예에서, 광 피드백이 LED 재료와 구동 트랜지스터의 노화의 보상을 위해 사용된다. 임계 전압에서의 변동이 매우 큰 비결정 실리콘 구동 트랜지스터의 경우라면, 소정의 전기 임계 전압 보상이 요구될 수 있다. 이것은 직렬로 연결된 두 개의 커패시터, 저장 커패시터와 임계 커패시터 상의 구동 트랜지스터에 대한 게이트-소스 전압을 유지함으로써 달성될 수 있다. 방전 트랜지스터를 턴 오프하기 위한 방전 커패시터는 저장 커패시터를 단락시키기 위해 배열된다. 그러면 이 회로는 저장 커패시터(30)상의 구동 전압 레벨을 제공하고 임계 커패시터 상의 구동 트랜지스터 임계 전압을 저장시킬 수 있다. In the above example, optical feedback is used to compensate for the aging of the LED material and the drive transistor. In the case of amorphous silicon driving transistors where the variation in threshold voltage is very large, some electrical threshold voltage compensation may be required. This can be accomplished by maintaining the gate-source voltage for the drive transistors on the two capacitors in series, the storage capacitor and the threshold capacitor. A discharge capacitor for turning off the discharge transistor is arranged to short the storage capacitor. This circuit can then provide the drive voltage level on the storage capacitor 30 and store the drive transistor threshold voltage on the threshold capacitor.

상기 설명된 광 피드백 시스템으로의 많은 변형과 정제(refinements)가 존재한다.There are many variations and refinements to the optical feedback system described above.

상기 예에서, 광 의존 소자는 광 다이오드이지만, 픽셀 회로는 광트랜지스터 또는 광레지스터를 사용해서 고안될 수 있다. 다양한 트랜지스터 반도체 기술을 사용하는 회로가 도시되었다. 예를 들면, 결정질 실리콘, 수소화 비결정질 실리콘, 폴리실리콘과 심지어 반도체 폴리머와 같은 다수의 변형이 가능하다. 이것은 청구한 것과 같은 본 발명의 범위 내에 모두 있는 것이 의도된다. 디스플레이 디바이스는 LED 디바이스, 유기 LED 디바이스, 재료를 포함하는 형광체 및 다른 발광 구조일 수 있다.In this example, the light dependent element is a photodiode, but the pixel circuit can be designed using phototransistors or photoresistors. Circuits using various transistor semiconductor technologies are shown. For example, many variations are possible, such as crystalline silicon, hydrogenated amorphous silicon, polysilicon and even semiconductor polymers. This is intended to be all within the scope of the invention as claimed. The display device can be an LED device, an organic LED device, phosphors including materials, and other light emitting structures.

디스플레이 구성으로의 조정은 모든 픽셀에 대해 구성을 변경하는 것 일 수 있다. 예를 들면, 프레임 시간이 변경될 때, 이것은 적절할 것이다. 하지만, 디스플레이 구성으로의 조정은 픽셀의 개별 그룹, 특히 픽셀의 열에 대한 것일 수 있다. 따라서, 다른 전원 전압은 다른 열에 적용될 수 있다. 전압에서의 이러한 변동은 이미지 데이터가 처리되는 것을 요구할 수 있다. 특히, LED 디스플레이 소자의 노화는 모든 출력 레벨에 걸쳐 선형적인 효과를 가지지 않을 수 있고, 하나의 함수가 조정된 열에 대해 픽셀 데이터에 인가될 필요가 있을 수 있다. 그대신 전압 변화는 완전한 디스플레이를 위해 수행될 수 있으며, 이 경우에, 픽셀 데이터 처리가 요구되지 않을 수 있다.Adjustment to the display configuration may be to change the configuration for every pixel. For example, when the frame time changes, this will be appropriate. However, adjustments to the display configuration may be for individual groups of pixels, especially for columns of pixels. Thus, different power supply voltages can be applied to different columns. This variation in voltage may require that the image data be processed. In particular, the aging of LED display elements may not have a linear effect over all output levels, and one function may need to be applied to the pixel data for the adjusted columns. Instead, the voltage change can be performed for complete display, in which case pixel data processing may not be required.

출력 구성을 변경시키기 위해 상기 설명된 하나 이상의 처리가 임의의 조합으로 적용될 수 있다. One or more of the processes described above can be applied in any combination to change the output configuration.

디스플레이 동작 특성을 변경하기 위한 제어 수단은 종래의 설계일 수 있으며, 행 및 열 어드레스 지정 회로의 전압 및/또는 타이밍 동작을 제어할 것이고, 이러한 제어 수단은 참조 번호 10으로 도 1에 개략적으로 도시된다. 전압 레벨이 변경되는 구현에 대해, 종래의 회로는 전원 레벨, 예를 들면, 열 구동기 전원, 디스플레이 전원 또는 픽셀 충전 라인 전원 레벨을 조정하기 위해 사용될 수 있다.The control means for changing the display operating characteristics can be of conventional design and will control the voltage and / or timing operation of the row and column addressing circuitry, which control means are schematically shown in FIG. 1 with reference numeral 10. . For implementations where the voltage level is changed, conventional circuitry can be used to adjust the power supply level, eg, column driver power supply, display power supply, or pixel charging line power supply level.

디스플레이 구성의 감지 동작과 제어의 구현은 당업자에게는 자명할 것이다.The sensing operation of the display configuration and the implementation of the control will be apparent to those skilled in the art.

다양한 다른 변형이 당업자에게 명백할 것이다.Various other variations will be apparent to those skilled in the art.

본 발명은 능동 매트릭스 디바이스에 이용 가능하며, 특히, 하지만 배타적이지 않게, 각 픽셀에 연관된 박막 스위칭 트랜지스터를 구비한 능동 매트릭스 전계발광 디스플레이 디바이스에 이용 가능하다.The present invention is applicable to active matrix devices, and in particular, but not exclusively, to active matrix electroluminescent display devices having thin film switching transistors associated with each pixel.

Claims (18)

디스플레이 픽셀의 어레이를 포함하는 능동 매트릭스 디스플레이 디바이스로서, 각 픽셀은An active matrix display device comprising an array of display pixels, wherein each pixel is 전류-구동되는 발광 디스플레이 소자(2);A current-driven light emitting display element 2; 디스플레이 소자를 통과하는 전류를 구동하기 위한 구동 트랜지스터(22);A drive transistor 22 for driving a current through the display element; 요구되는 디스플레이 픽셀 출력 레벨과 광 피드백 소자의 광 피드백 신호에 종속되는 기간 동안 상기 디스플레이 소자를 통과하는 실질적으로 일정한 전류를 구동하기 위한 상기 구동 트랜지스터를 제어하기 위해, 광 피드백 소자(38)를 포함하는 픽셀 회로; 및An optical feedback element 38 for controlling the driving transistor for driving a substantially constant current through the display element for a period dependent on the required display pixel output level and the optical feedback signal of the optical feedback element. Pixel circuits; And 상기 디스플레이에 대한 출력 구성을 적용하기 위한 제어 수단(10)으로서, 상기 출력 구성은 적어도 상기 픽셀 전원 전압, 필드 기간 및 픽셀 구동 레벨의 허용된 범위에 대한 값을 포함하고, 상기 제어 수단은 상기 디스플레이 소자의 노화(aging)에 대한 응답으로 상기 값의 하나 이상을 변경시켜 상기 출력 구성을 변경하기 위해 적응된, 제어 수단(10)을 포함하는, 능동 매트릭스 디스플레이 디바이스.Control means for applying an output configuration for the display, the output configuration comprising at least a value for the allowed range of the pixel power supply voltage, the field period and the pixel drive level, wherein the control means Control means (10) adapted to change the output configuration by changing one or more of the values in response to aging of the device. 제1항에 있어서, 상기 픽셀 회로는 상기 구동 트랜지스터(22)를 위한 어드레스 지정하기 위해 사용될 전압을 저장하기 위한 저장 커패시터(30; C1)를 포함하는, 능동 매트릭스 디스플레이 디바이스.2. The active matrix display device of claim 1, wherein the pixel circuit comprises a storage capacitor (30; C 1 ) for storing a voltage to be used for addressing for the drive transistor (22). 제2항에 있어서, 상기 픽셀 회로는 상기 구동 트랜지스터(22)를 스위칭 오프하기 위해 상기 저장 커패시터를 방전하기 위한 방전 트랜지스터(36; T2)를 포함하고, 상기 광 피드백 소자(38)는 상기 디스플레이 소자(2)의 광 출력에 따라 상기 방전 트랜지스터에 인가된 게이트 전압을 변경하여 상기 방전 트랜지스터(36; T2)의 동작의 타이밍을 제어하기 위함인, 능동 매트릭스 디스플레이 디바이스.3. The pixel circuit according to claim 2, wherein the pixel circuit includes a discharge transistor 36 (T2) for discharging the storage capacitor to switch off the driving transistor 22, and the optical feedback element 38 comprises the display element. An active matrix display device for controlling the timing of the operation of the discharge transistor (36; T2) by changing the gate voltage applied to the discharge transistor in accordance with the light output of (2). 제3항에 있어서, 상기 광 피드백 소자(38)는 오프 상태에서 온 상태로 상기 방전 트랜지스터(36; T2)의 스위칭의 타이밍을 제어하는, 능동 매트릭스 디스플레이 디바이스.4. An active matrix display device according to claim 3, wherein the optical feedback element (38) controls the timing of switching of the discharge transistor (36; T2) from an off state to an on state. 제3항 또는 제4항에 있어서, 상기 광 피드백 소자(38)는 방전 광다이오드를 포함하는, 능동 매트릭스 디스플레이 디바이스.5. Active matrix display device according to claim 3 or 4, wherein the optical feedback element (38) comprises a discharge photodiode. 제3항 내지 제5항 중의 어느 한 항에 있어서, 방전 커패시터(40; C2)는 상기 방전 트랜지스터(36; T2)의 게이트와 일정한 전압 라인 사이에 제공되고, 상기 광 피드백 소자는 상기 방전 커패시터를 충전 또는 방전하기 위함인, 능동 매트릭스 디스플레이 디바이스.A discharge capacitor (40; C 2 ) is provided between the gate of said discharge transistor (36; T2) and a constant voltage line, and said optical feedback element is provided with said discharge capacitor. To charge or discharge the active matrix display device. 제1항 내지 제6항 중의 어느 한 항에 있어서, 상기 구동 트랜지스터(22)는 전원 라인(26)과 상기 디스플레이 소자(2) 사이에 연결되는, 능동 매트릭스 디스플레이 디바이스.7. Active matrix display device according to any of the preceding claims, wherein the drive transistor (22) is connected between a power supply line (26) and the display element (2). 제7항에 있어서, 상기 저장 커패시터(30; C1)는 상기 구동 트랜지스터(22)의 게이트와 소스 사이에 연결되는, 능동 매트릭스 디스플레이 디바이스.8. Active matrix display device according to claim 7, wherein the storage capacitor (30; C 1 ) is connected between the gate and the source of the drive transistor (22). 제1항 내지 제8항 중의 어느 한 항에 있어서, 각 픽셀은 상기 구동 트랜지스터의 게이트와 충전 라인 사이에 연결되는 충전 트랜지스터(34)를 더 포함하는, 능동 매트릭스 디스플레이 디바이스.9. An active matrix display device according to any of the preceding claims, wherein each pixel further comprises a charging transistor (34) connected between the gate and the charging line of the driving transistor. 제1항 내지 제9항 중의 어느 한 항에 있어서, 각 픽셀은 상기 구동 트랜지스터(22)와 직렬로 연결된 차단(isolating) 트랜지스터(62)를 더 포함하는, 능동 매트릭스 디스플레이 디바이스.10. The active matrix display device according to any one of the preceding claims, wherein each pixel further comprises an isolating transistor (62) connected in series with the drive transistor (22). 제1항 내지 제10항 중의 어느 한 항에 있어서, 전원 라인은 픽셀의 각 열에 대해 제공되는, 능동 매트릭스 디스플레이 디바이스.The active matrix display device of claim 1, wherein a power line is provided for each column of pixels. 제11항에 있어서, 다른 전력 라인은 다른 컬러 픽셀의 열에 대해 제공되는, 능동 매트릭스 디스플레이 디바이스.The active matrix display device of claim 11, wherein different power lines are provided for columns of different color pixels. 제1항 내지 제12항 중의 어느 한 항에 있어서, 각 픽셀은 열 컨덕터로부터 상기 구동 트랜지스터(22)의 상태의 검출을 가능케 하기 위한 판독(readout) 트랜지스터(70; 100)를 더 포함하는, 능동 매트릭스 디스플레이 디바이스.13. Active according to any of the preceding claims, wherein each pixel further comprises a readout transistor (70; 100) for enabling detection of the state of the drive transistor (22) from a thermal conductor. Matrix display device. 제1항 내지 제12항 중의 어느 한 항에 있어서, 픽셀의 각 열은 상기 열에서 상기 구동 트랜지스터의 상태의 검출을 가능케 하기 위한 판독 트랜지스터(80)를 더 포함하는, 능동 매트릭스 디스플레이 디바이스.13. An active matrix display device according to any of the preceding claims, wherein each column of pixels further comprises a read transistor (80) for enabling detection of the state of the drive transistor in the column. 제1항 내지 제14항 중의 어느 한 항에 있어서, 상기 전류-구동되는 발광 디스플레이 소자(2)는 전계발광 디스플레이 소자를 포함하는, 능동 매트릭스 디스플레이 디바이스.15. Active matrix display device according to any of the preceding claims, wherein the current-driven light emitting display element (2) comprises an electroluminescent display element. 디스플레이 픽셀의 어레이를 포함하는 능동 매트릭스 디바이스를 구동하는 방법으로서, A method of driving an active matrix device comprising an array of display pixels, the method comprising: 디스플레이 픽셀 각각은 구동 트랜지스터(22), 전류-구동되는 발광 디스플레이 소자(2), 및 광 피드백 소자(38)를 포함하는 픽셀 회로를 포함하는, 능동 매트릭스 디스플레이 구동 방법에 있어서In the method of driving an active matrix display, each display pixel comprises a pixel circuit comprising a driving transistor 22, a current-driven light emitting display element 2, and an optical feedback element 38. (i) 상기 디스플레이에 대한 출력 구성을 적용하는 단계로서, 상기 출력 구성은 적어도 상기 픽셀 전원 전압에 대한 값, 필드 기간 및 픽셀 구동 레벨의 허용된 범위를 포함하는, 단계;(i) applying an output configuration for the display, the output configuration comprising at least a permitted range of values, field periods, and pixel drive levels for the pixel power supply voltage; (ii) 요구되는 디스플레이 픽셀 출력 레벨과 광 피드백 소자(38)의 광 피드백 신호에 종속되는 기간 동안 상기 디스플레이 소자(2)를 통과하는 실질적으로 일정한 전류를 구동하기 위한 상기 구동 트랜지스터(22)를 제어해서 각 픽셀을 어드레스 지정하는 단계; 및(ii) controlling the drive transistor 22 to drive a substantially constant current through the display element 2 for a period dependent on the required display pixel output level and the light feedback signal of the optical feedback element 38. Addressing each pixel; And (iii) 상기 어레이의 디스플레이의 노화를 모니터링하고, 상기 디스플레이 소자의 노화에 응답하여 상기 값의 하나 이상을 변경하여 상기 출력 구성을 변경하고, 상기 변경된 출력 구성에 대한 단계 (i)와 (ii)를 반복하는 단계를 포함하는, 능동 매트릭스 디바이스를 구동하는 방법.(iii) monitoring the aging of the display of the array, changing the output configuration by changing one or more of the values in response to aging of the display element, and (i) and (ii) for the modified output configuration. Repeating the method of driving an active matrix device. 제16항에 있어서, 상기 어레이의 디스플레이 소자의 노화를 모니터링하는 단계는 필드 기간의 시작 또는 끝에서 상기 구동 트랜지스터(22)의 온 또는 오프 상태를 모니터링하는 단계를 포함하는, 능동 매트릭스 디바이스를 구동하는 방법.17. The method of claim 16, wherein monitoring the aging of display elements of the array comprises monitoring an on or off state of the drive transistor 22 at the beginning or end of a field period. Way. 제17항에 있어서, 만약 사전 결정된 수보다 많은 구동 트랜지스터(22)가 필드 기간의 끝에 턴 온되면, 상기 출력 구성이 변경되는, 능동 매트릭스 디바이스를 구동하는 방법.18. The method of claim 17, wherein if more than a predetermined number of drive transistors (22) are turned on at the end of the field period, the output configuration is changed.
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