KR20060015207A - Substrate for a display panel, liquid crystal display panel and method for repairing the same - Google Patents
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Abstract
액정 표시 패널은 제1 기판, 제2 기판 및 액정층을 포함한다. 상기 제1 기판은 상부 플레이트 및 공통 전극을 포함한다. 상기 제2 기판은 하부 플레이트와, 상기 하부 플레이트 상에 배치되고 스위칭 소자의 게이트 전극과 전기적으로 연결되는 게이트 라인과, 상기 하부 플레이트 상에 배치된 스토리지 캐패시터 라인과, 상기 게이트 라인 및 상기 캐패시터 라인 상에 배치되는 절연막과, 상기 절연막 상에 배치되어 상기 게이트 라인의 일부 및 상기 스토리지 캐패시터 라인의 일부와 중첩되는 리페어 패턴을 포함한다. 상기 액정층은 상기 공통 전극과 상기 제2 기판의 화소 전극의 사이에 배치된다. 따라서, 다수의 박막 트랜지스터들의 오동작을 방지하여 표시 패널의 화질이 향상된다.The liquid crystal display panel includes a first substrate, a second substrate, and a liquid crystal layer. The first substrate includes an upper plate and a common electrode. The second substrate includes a lower plate, a gate line disposed on the lower plate and electrically connected to a gate electrode of a switching element, a storage capacitor line disposed on the lower plate, and on the gate line and the capacitor line. And a repair pattern disposed on the insulation layer and overlapping a portion of the gate line and a portion of the storage capacitor line. The liquid crystal layer is disposed between the common electrode and the pixel electrode of the second substrate. Therefore, the malfunction of the plurality of thin film transistors is prevented, thereby improving the image quality of the display panel.
Description
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치를 나타내는 평면도이다.1 is a plan view illustrating a liquid crystal display according to an exemplary embodiment of the present invention.
도 2는 본 발명의 제1 실시예에 따른 액정 표시 패널을 나타내는 평면도이다.2 is a plan view illustrating a liquid crystal display panel according to a first exemplary embodiment of the present invention.
도 3은 상기 도 2의 I-I'라인의 단면도이다.3 is a cross-sectional view taken along the line II ′ of FIG. 2.
도 4는 상기 도 2의 II-II'라인의 단면도이다.4 is a cross-sectional view taken along the line II-II 'of FIG. 2.
도 5는 상기 도 2의 III-III'라인의 단면도이다.5 is a cross-sectional view taken along the line III-III ′ of FIG. 2.
도 6은 상기 도 2에 도시된 액정 표시 패널에 발생한 불량을 나타내는 평면도이다.6 is a plan view illustrating a failure occurring in the liquid crystal display panel illustrated in FIG. 2.
도 7은 상기 도 6의 VI-VI'라인의 단면도이다.FIG. 7 is a cross-sectional view taken along the line VI-VI 'of FIG. 6.
도 8은 본 발명의 제2 실시예에 따른 액정 표시 패널을 나타내는 평면도이다.8 is a plan view illustrating a liquid crystal display panel according to a second exemplary embodiment of the present invention.
도 9는 상기 도 8의 V-V'라인의 단면도이다.9 is a cross-sectional view taken along the line VV ′ of FIG. 8.
도 10 내지 도 14는 본 발명의 제2 실시예에 따른 액정 표시 패널의 제조방법을 나타내는 단면도들이다. 10 to 14 are cross-sectional views illustrating a method of manufacturing a liquid crystal display panel according to a second embodiment of the present invention.
도 15는 상기 도 8에 도시된 액정 표시 패널에 발생한 불량을 나타내는 평면도이다.FIG. 15 is a plan view illustrating a failure occurring in the liquid crystal display panel illustrated in FIG. 8.
도 16은 상기 도 15의 VI-VI'라인의 단면도이다.FIG. 16 is a cross-sectional view taken along the line VI-VI 'of FIG. 15.
도 17 내지 도 19는 본 발명의 제2 실시예에 따른 액정 표시 패널의 불량 제거 방법을 나타내는 평면도들이다.17 to 19 are plan views illustrating a method for removing defects of a liquid crystal display panel according to a second exemplary embodiment of the present invention.
도 20은 본 발명의 제3 실시예에 따른 액정 표시 패널을 나타내는 평면도이다.20 is a plan view illustrating a liquid crystal display panel according to a third exemplary embodiment of the present invention.
도 21은 상기 도 20의 VII-VII'라인의 단면도이다.FIG. 21 is a cross-sectional view taken along the line VII-VII ′ of FIG. 20.
* 도면의 주요부분에 대한 부호의 설명 *Explanation of symbols on the main parts of the drawings
10 : 액정 표시 패널 11 : 제2 기판10 liquid
12 : 게이트 구동부 13 : 데이터 구동부12 gate driver 13 data driver
20 : 인쇄 회로 기판 25 : 연성 회로 기판20: printed circuit board 25: flexible circuit board
100 : 상부 플레이트 102 : 블랙 매트릭스100: upper plate 102: black matrix
104a, 104b : 컬러 필터 105 : 오버 코팅층104a, 104b: color filter 105: overcoating layer
106 : 공통 전극 108 : 액정층106: common electrode 108: liquid crystal layer
112 : 화소 전극 114 : 유기막112
116 : 패시베이션막 118a : 소오스 전극116:
118a' : 데이터 라인 118b : 게이트 전극118a ':
118b' : 게이트 라인 118c : 드레인 전극118b ':
119 : 박막 트랜지스터 120 : 하부 플레이트
119
122 : 스토리지 캐패시터 라인 123 : 스토리지 캐패시터122: storage capacitor line 123: storage capacitor
126 : 게이트 절연막 130 : 리페어 패턴126: gate insulating film 130: repair pattern
140 : 파티클140: Particles
141a, 141b, 142a, 142b, 146a, 146b : 오픈된 부분141a, 141b, 142a, 142b, 146a, 146b: open part
144a, 144b, 144c, 144d : 리페어 패턴용 콘택홀144a, 144b, 144c, 144d: Contact hole for repair pattern
170 : 제1 기판170: first substrate
180 : 제2 기판180: second substrate
본 발명은 표시 패널용 기판, 액정 표시 패널 및 그 불량 제거 방법에 관한 것으로 보다 상세하게는 화질이 향상된 표시 패널용 기판, 화질이 향상된 액정 표시 패널 및 그 불량 제거 방법에 관한 것이다.The present invention relates to a substrate for a display panel, a liquid crystal display panel and a defect removing method thereof, and more particularly, to a display panel substrate having an improved image quality, a liquid crystal display panel having an improved image quality, and a defect removing method.
액정 표시 장치(Liquid Crystal Display, LCD)는 박막 트랜지스터가 형성된 어레이 기판(Array Substrate) 및 대향 기판(Counter Substrate) 사이에 주입되어 있는 이방성 유전율을 갖는 액정 물질에 전계(Electric Field)를 인가하고, 이 전계의 세기를 조절하여 기판에 투과되는 광의 양을 조절함으로써 원하는 화상 신호를 얻는 표시 장치이다.A liquid crystal display (LCD) applies an electric field to a liquid crystal material having an anisotropic dielectric constant injected between an array substrate and a counter substrate on which a thin film transistor is formed. A display device that obtains a desired image signal by controlling an intensity of an electric field to adjust an amount of light transmitted through a substrate.
상기 어레이 기판은 박막 트랜지스터, 게이트 라인 및 데이터 라인을 포함한다. 상기 박막 트랜지스터는 상기 게이트 라인과 전기적으로 연결된 게이트 전극, 상기 데이터 라인과 전기적으로 연결된 소오스 전극, 드레인 전극 및 반도체층 패턴을 포함한다. 상기 박막 트랜지스터, 상기 게이트 라인 및 상기 데이터 라인은 복수회의 박막 증착 공정을 통하여 형성된다. 이때, 상기 박막 증착 공정 중에 식각 불량이 발생하는 경우, 상기 게이트 전극이 상기 게이트 라인과 전기적으로 절연될 수 있다. 또한, 상기 박막 증착 공정 중에 불순물이 존재하는 경우, 상기 게이트 전극이 상기 소오스 전극 또는 상기 드레인 전극과 단락될 수 있다.The array substrate includes a thin film transistor, a gate line and a data line. The thin film transistor includes a gate electrode electrically connected to the gate line, a source electrode electrically connected to the data line, a drain electrode, and a semiconductor layer pattern. The thin film transistor, the gate line, and the data line are formed through a plurality of thin film deposition processes. In this case, when an etching failure occurs during the thin film deposition process, the gate electrode may be electrically insulated from the gate line. In addition, when impurities are present during the thin film deposition process, the gate electrode may be shorted to the source electrode or the drain electrode.
상기 게이트 전극이 상기 게이트 라인과 전기적으로 절연되는 경우, 상기 어레이 기판의 화소 전극과 상기 대향 기판의 공통 전극의 사이에 전압이 인가되지 않는다.When the gate electrode is electrically insulated from the gate line, no voltage is applied between the pixel electrode of the array substrate and the common electrode of the opposite substrate.
상기 게이트 전극이 상기 소오스 전극 또는 상기 드레인 전극과 단락되는 경우, 상기 박막 트랜지스터가 오작동하여 콘트라스트비가 감소한다.When the gate electrode is shorted to the source electrode or the drain electrode, the thin film transistor malfunctions and the contrast ratio is reduced.
특히, 상기 콘트라스트비가 감소하는 경우, 상기 액정 표시 장치의 화질이 급격히 감소한다.In particular, when the contrast ratio is reduced, the image quality of the liquid crystal display is drastically reduced.
상기와 같은 문제점을 해결하기 위한 본 발명의 제1 목적은, 화질이 향상된 표시 패널용 기판을 제공하는데 있다.The first object of the present invention for solving the above problems is to provide a display panel substrate with improved image quality.
본 발명의 제2 목적은 화질이 향상된 액정 표시 패널을 제공하는데 있다.It is a second object of the present invention to provide a liquid crystal display panel with improved image quality.
본 발명의 제3 목적은 상기 표시 패널의 불량을 제거하는 방법을 제공하는데 있다.It is a third object of the present invention to provide a method of removing a defect of the display panel.
상기 제1 목적을 달성하기 위한 본 발명의 일 실시예에 따른 표시 패널용 기판은 플레이트, 게이트 라인, 스토리지 캐패시터 라인, 절연막, 화소 전극 및 리페어 패턴을 포함한다. 상기 게이트 라인은 상기 플레이트 상에 배치되고 스위칭 소자의 게이트 전극과 전기적으로 연결된다. 상기 스토리지 캐패시터 라인은 상기 플레이트 상에 배치된다. 상기 절연막은 상기 게이트 라인 및 상기 캐패시터 라인 상에 배치된다. 상기 화소 전극은 상기 절연막 상에 배치되고, 상기 스위칭 소자의 드레인 전극과 전기적으로 연결되며, 상기 스토리지 캐패시터 라인의 일부와 중첩된다. 상기 리페어 패턴은 상기 절연막 상에 배치되어 상기 게이트 라인의 일부 및 상기 스토리지 캐패시터 라인의 일부와 중첩된다.A display panel substrate according to an exemplary embodiment of the present invention for achieving the first object includes a plate, a gate line, a storage capacitor line, an insulating film, a pixel electrode, and a repair pattern. The gate line is disposed on the plate and electrically connected to the gate electrode of the switching element. The storage capacitor line is disposed on the plate. The insulating layer is disposed on the gate line and the capacitor line. The pixel electrode is disposed on the insulating layer, is electrically connected to the drain electrode of the switching element, and overlaps a portion of the storage capacitor line. The repair pattern is disposed on the insulating layer and overlaps a portion of the gate line and a portion of the storage capacitor line.
상기 제2 목적을 달성하기 위한 본 발명의 일 실시예에 따른 액정 표시 패널은 제1 기판, 제2 기판 및 액정층을 포함한다. 상기 제1 기판은 상부 플레이트 및 상기 상부 플레이트 상에 배치된 공통 전극을 포함한다. 상기 제2 기판은 하부 플레이트와, 상기 하부 플레이트 상에 배치되고 스위칭 소자의 게이트 전극과 전기적으로 연결되는 게이트 라인과, 상기 하부 플레이트 상에 배치된 스토리지 캐패시터 라인과, 상기 게이트 라인 및 상기 캐패시터 라인 상에 배치되는 절연막과, 상기 절연막 상에 배치되고, 상기 스위칭 소자의 드레인 전극과 전기적으로 연결되며, 상기 스토리지 캐패시터 라인의 일부와 중첩되는 화소 전극과, 상기 절연막 상에 배치되어 상기 게이트 라인의 일부 및 상기 스토리지 캐패시터 라인의 일부와 중첩되는 리페어 패턴을 포함한다. 상기 액정층은 상기 공통 전극과 상기 화소 전극의 사이에 배치된다. A liquid crystal display panel according to an exemplary embodiment of the present invention for achieving the second object includes a first substrate, a second substrate, and a liquid crystal layer. The first substrate includes an upper plate and a common electrode disposed on the upper plate. The second substrate includes a lower plate, a gate line disposed on the lower plate and electrically connected to a gate electrode of a switching element, a storage capacitor line disposed on the lower plate, and on the gate line and the capacitor line. An insulating film disposed on the insulating film, a pixel electrode disposed on the insulating film, and electrically connected to a drain electrode of the switching element, and overlapping a portion of the storage capacitor line, a portion of the gate line disposed on the insulating film; It includes a repair pattern overlapping a portion of the storage capacitor line. The liquid crystal layer is disposed between the common electrode and the pixel electrode.
상기 제3 목적을 달성하기 위하여 본 발명의 일 실시예에 따른 표시 패널의 불량 제거 방법에서, 먼저 오동작하는 박막 트랜지스터에 인접하는 게이트 라인의 양측을 오픈시켜 상기 박막 트랜지스터를 상기 게이트 라인과 전기적으로 절연시킨다. 이어서, 상기 박막 트랜지스터에 인접하여 배치된 리페어 패턴들을 상기 게이트 라인 및 상기 게이트 라인에 이격되어 배치된 스토리지 캐패시터 라인과 전기적으로 연결시킨다. 마지막으로, 상기 리페어 패턴들을 기준으로 상기 박막 트랜지스터의 반대쪽에 배치된 스토리지 캐패시터 라인의 양측을 오픈시킨다.In the method of removing a defect of a display panel according to an exemplary embodiment of the present invention, first, both sides of a gate line adjacent to a malfunctioning thin film transistor are opened to electrically insulate the thin film transistor from the gate line. Let's do it. Subsequently, repair patterns arranged adjacent to the thin film transistor are electrically connected to the gate line and the storage capacitor line spaced apart from the gate line. Finally, both sides of the storage capacitor line disposed on the opposite side of the thin film transistor are opened based on the repair patterns.
상기 표시 패널은 상기 액정 표시 패널(LCD), 유기 전계 발광 표시 패널(OLED), 플라즈마 표시 패널(PDP) 등을 포함한다.The display panel includes the liquid crystal display panel (LCD), an organic electroluminescent display panel (OLED), a plasma display panel (PDP), and the like.
따라서, 다수의 박막 트랜지스터들이 오동작하는 경우에도 상기 다수의 박막 트랜지스터들의 오동작을 방지하여 표시 패널의 화질이 향상된다. 또한, 상기 표시 패널의 수리가 용이하여 제조비용 및 수리비용이 감소하고 수율이 향상된다.Therefore, even when a plurality of thin film transistors malfunction, the malfunction of the plurality of thin film transistors is prevented, thereby improving the image quality of the display panel. In addition, the display panel can be easily repaired, thereby reducing manufacturing and repair costs and improving yield.
이하, 본 발명에 따른 바람직한 실시예들을 첨부된 도면을 참조하여 상세하게 설명한다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치를 나타내는 평면도이다.1 is a plan view illustrating a liquid crystal display according to an exemplary embodiment of the present invention.
도 1을 참조하면, 상기 액정 표시 장치는 영상을 표시하는 액정 표시 패널(10), 상기 액정 표시 패널(10)을 구동하는 게이트 구동부(12) 및 상기 액정 표시 패널에 데이터 신호를 인가하는 데이터 구동부(13)를 포함한다.Referring to FIG. 1, the liquid crystal display includes a liquid
상기 액정 표시 패널(10)은 제1 기판(도시되지 않음), 제2 기판(11) 및 상기 제1 기판(도시되지 않음)과 상기 제2 기판(11)의 사이에 베치된 액정층(도시되지 않음)을 포함한다. 상기 액정 표시 패널(10)은 영상을 표시하는 표시부(DP) 및 상기 표시부에 인접하는 주변부(PP)로 구분된다.The liquid
상기 제2 기판(11)은 복수의 박막 트랜지스터들(TFT), 복수의 게이트 라인들(GL), 복수의 데이터 라인들(DL), 복수의 스토리지 캐패시터 라인들(SL), 제1 리페어 라인(RL1) 및 제2 리페어 라인(RL2)을 포함한다. 상기 게이트 라인들(GL), 상기 데이터 라인들(DL) 및 상기 스토리지 캐패시터 라인들(SL)은 상기 표시부(DP) 내에 배치된다. 상기 데이터 라인들(DL) 및 상기 게이트 라인들(GL)은 서로 교차되어 복수의 화소 영역들을 정의한다. 상기 각 데이터 라인들(DL)은 상기 각 박막 트랜지스터의 소오스 전극에 전기적으로 연결된다. 상기 각 게이트 라인들(GL)은 상기 각 박막 트랜지스터들(TFT)의 게이트 전극에 전기적으로 연결된다. 상기 각 박막 트랜지스터들(TFT)의 드레인 전극은 화소 전극에 연결된다. 상기 화소 전극과, 상기 제1 기판(도시되지 않음)의 공통 전극과, 상기 화소 전극 및 상기 공통 전극의 사이에 배치된 상기 액정층(도시되지 않음)은 액정 캐패시터(Clc)를 형성한다. 상기 스토리지 캐패시터 라인(SL)은 상기 화소 전극의 일부와 중첩되어 스토리지 캐패시터(Cst)를 형성한다.The
상기 게이트 라인들(GL)은 알루미늄, 알루미늄 합금 등의 금속을 포함한다. 상기 데이터 라인들(DL)은 크롬, 몰리브덴, 크롬 합금, 몰리브덴 합금 등의 금속을 포함한다. 이때, 상기 알루미늄의 비저항(ρ)은 대략 4.5이고, 크롬의 비저항(ρ)은 대략 21이다.The gate lines GL may include a metal such as aluminum or an aluminum alloy. The data lines DL include a metal such as chromium, molybdenum, chromium alloy, and molybdenum alloy. In this case, the specific resistance p of the aluminum is about 4.5, and the specific resistance p of chromium is about 21.
상기 게이트 구동부(12)는 상기 게이트 라인들(GL)에 게이트 신호들을 인가 한다. 상기 데이터 구동부(13)는 상기 데이터 라인들(DL)에 데이터 신호들을 인가한다.The
인쇄 회로 기판(20)은 외부 장치(미도시)로부터 제공된 각종 신호에 응답하여 상기 게이트 구동부(12) 및 상기 데이터 구동부(13)를 구동하기 위한 구동 신호들을 연성 회로 기판(25)을 통하여 상기 제2 기판(11)의 상기 게이트 구동부(12) 및 상기 데이터 구동부(13)에 인가한다.The printed
i번째 게이트 라인(GLi) 및 j번째 데이터 라인(DLi)에 전기적으로 연결된 박막 트랜지스터의 게이트 전극과 드레인 전극이 단락되는 경우, 상기 박막 트랜지스터가 오동작하여 액정 표시 장치의 화질이 저하된다. 따라서, 상기 오동작하는 박막 트랜지스터에 인가되는 신호를 차단하기 위하여, 상기 오동작하는 박막 트랜지스터에 인접하는 j번째 데이터 라인의 일부를 오픈시킨다. 이때, 상기 박막 트랜지스터에 인접하는 j번째 데이터 라인의 일부에 레이저를 조사하여 상기 박막 트랜지스터에 인접하는 j번째 데이터 라인의 일부를 오픈시킬 수 있다.When the gate electrode and the drain electrode of the thin film transistor electrically connected to the i-th gate line GLi and the j-th data line DLi are short-circuited, the thin film transistor malfunctions and the image quality of the liquid crystal display is degraded. Therefore, in order to block the signal applied to the malfunctioning thin film transistor, a part of the j-th data line adjacent to the malfunctioning thin film transistor is opened. In this case, a portion of the j-th data line adjacent to the thin film transistor may be opened by irradiating a laser to a portion of the j-th data line adjacent to the thin film transistor.
이때, 상기 데이터 신호는 상기 데이터 구동부(13)에 연결된 단부로부터 상기 j번째 데이터 라인의 상부로 인가되기 때문에, 상기 액정 표시 패널(10)의 하부에 배치된 j번째 데이터 라인에 상기 데이터 신호를 인가하기 위하여 제1 리페어 라인(FRL)과 상기 j번째 데이터 라인의 상부 및 하부를 전기적으로 연결시킨다. 이때, 상기 j번째 데이터 라인의 상부 및 하부에 레이저를 조사하여 제1 리페어 라인(FRL)과 상기 j번째 데이터 라인의 상부 및 하부를 전기적으로 연결시킬 수 있다. 상기 j번째 데이터 라인의 상부는 제1 포인트(LP1)를 통하여 상기 제1 리페어 라인 (FRL)과 전기적으로 연결된다. 상기 j번째 데이터 라인의 하부는 제2 포인트(LP2)를 통하여 상기 제1 리페어 라인(FRL)과 전기적으로 연결된다. 따라서, 상기 데이터 신호는 제1 포인트(LP1), 상기 제1 리페어 라인(FRL) 및 제2 포인트(LP2)를 통하여 상기 액정 표시 패널(10)의 하부에 배치된 j번째 데이터 라인에 인가된다.In this case, since the data signal is applied from the end connected to the
다른 박막 트랜지스터가 오동작하는 경우, 상기 제2 리페어 라인(SRL)을 이용하여 상기 오동작을 방지할 수 있다.If another thin film transistor malfunctions, the second repair line SRL may be used to prevent the malfunction.
실시예Example 1 One
도 2는 본 발명의 제1 실시예에 따른 액정 표시 패널을 나타내는 평면도이고, 도 3은 상기 도 2의 I-I'라인의 단면도이며, 도 4는 상기 도 2의 II-II'라인의 단면도이고, 도 5는 상기 도 2의 III-III'라인의 단면도이다.2 is a plan view illustrating a liquid crystal display panel according to a first exemplary embodiment of the present invention, FIG. 3 is a cross-sectional view taken along the line II ′ of FIG. 2, and FIG. 4 is a cross-sectional view taken along the line II-II ′ of FIG. 2. 5 is a cross-sectional view taken along the line III-III ′ of FIG. 2.
도 2 내지 도 5를 참조하면, 상기 액정 표시 패널은 제1 기판(170), 제2 기판(180) 및 액정층(108)을 포함한다.2 to 5, the liquid crystal display panel includes a
상기 제1 기판(170)은 상부 플레이트(100), 블랙 매트릭스(102), 오버코팅층(105) 및 공통 전극(106)을 포함한다.The
상기 제2 기판(180)은 하부 플레이트(120), 복수의 박막 트랜지스터(119), 복수의 스토리지 캐패시터(123), 복수의 데이터 라인(118a'), 복수의 게이트 라인(118b'), 복수의 스토리지 캐패시터 라인(122), 게이트 절연막(126), 패시베이션막(116), 복수의 컬러 필터(104a), 유기막(114), 복수의 화소 전극(112), 제1 리페어 라인(도시되지 않음) 및 제2 리페어 라인(도시되지 않음)을 포함한다.The
상기 액정 표시 패널은 복수의 화소들을 포함하고, 상기 화소들은 서로 인접 하는 데이터 라인들(118a')과 게이트 라인들(118b')에 의해 정의된다.The liquid crystal display panel includes a plurality of pixels, which are defined by the
상기 액정층(108)은 상기 제1 기판(170) 및 상기 제2 기판(180)의 사이에 배치된다.The
상기 상부 플레이트(100) 및 상기 하부 플레이트(120)는 광을 통과시킬 수 있는 투명한 재질의 유리를 사용한다. 상기 유리는 무알칼리 특성이다. 상기 유리가 알칼리 특성인 경우, 상기 유리에서 알칼리 이온이 액정 셀 중에 용출되면 액정 비저항이 저하되어 표시 특성이 변하게 되고, 상기 씰과 유리와의 부착력을 저하시키고, 스위칭 소자의 동작에 악영향을 준다.The
이때, 상기 상부 플레이트(100) 및 상기 하부 플레이트(120)는 트리아세틸셀룰로오스 (Triacetylcellulose; TAC), 폴리카보네이트 (Polycarbonate; PC), 폴리에테르설폰 (Polyethersulfone; PES), 폴리에틸렌테라프탈레이트 (Polyethyleneterephthalate; PET), 폴리에틸렌나프탈레이트 (Polyethylenenaphthalate; PEN), 폴리비닐알콜 (Polyvinylalcohol; PVA), 폴리메틸메타아크릴레이트 (Polymethylmethacrylate; PMMA), 싸이클로올핀 폴리머 (Cyclo-Olefin Polymer; COP) 등을 포함할 수도 있다.In this case, the
바람직하게는, 상기 상부 플레이트(100) 및 상기 하부 플레이트(120)는 광학적으로 등방성이다.Preferably, the
상기 박막 트랜지스터(119)는 상기 화소에 대응하는 상기 하부 플레이트(120) 상에 배치되며, 소오스 전극(118a), 게이트 전극(118b), 드레인 전극(118c) 및 반도체층 패턴을 포함한다. 데이터 구동부(도시되지 않음)는 데이터 전압을 출 력하여 상기 데이터 라인(118a')을 통하여 상기 소오스 전극(118a)에 인가하고, 게이트 구동부(도시되지 않음)는 선택 신호를 출력하여 상기 게이트 라인(118b')을 통하여 상기 게이트 전극(118b)에 인가한다.The
상기 게이트 절연막(126)은 상기 게이트 전극(118b)이 형성된 상기 하부 플레이트(120) 상에 배치되어 상기 게이트 전극(118b)을 상기 소오스 전극(118a) 및 상기 드레인 전극(118c)과 전기적으로 절연한다. 상기 게이트 절연막(126)은 실리콘 질화물(SiNx), 실리콘 산화물(SiOx) 등을 포함한다.The
상기 패시베이션막(116)은 상기 박막 트랜지스터(119)가 형성된 상기 하부 플레이트(120) 상에 배치되고, 상기 드레인 전극(118c)의 일부를 노출하는 콘택홀을 포함한다. 상기 패시베이션막(116)은 실리콘 질화물(SiNx), 실리콘 산화물(SiOx) 등을 포함한다.The
상기 스토리지 캐패시터 라인(122)은 상기 하부 플레이트(120)와 상기 게이트 절연막(126)의 사이에 배치되어, 상기 화소 전극(112)의 일부와 함께 상기 스토리지 캐패시터(123)를 형성한다.The
상기 스토리지 캐패시터(123)는 상기 공통 전극(106)과 상기 화소 전극(112)의 사이의 전위차를 유지시켜준다.The
상기 컬러 필터(104a)는 상기 박막 트랜지스터(119) 및 상기 패시베이션막(116)이 형성된 상기 하부 플레이트(120) 상에 배치되어 소정의 파장을 갖는 광만을 투과시킨다. 상기 컬러 필터(104a)는 적색 컬러 필터부, 녹색 컬러 필터부 및 청색 컬러 필터부를 포함한다. 상기 컬러 필터(104a)는 광중합 개시제, 모노머, 바 인더, 안료, 분산제, 용제, 포토레지스트 등을 포함한다.The
상기 유기막(114)은 상기 박막 트랜지스터(119), 상기 패시베이션막(116) 및 상기 컬러 필터(104a)가 형성된 상기 하부 플레이트(120) 상에 배치되어 상기 액정층(108)의 두께를 조절하고, 상기 하부 기판(180)의 표면을 평탄화한다.The
상기 컬러 필터(104a) 및 상기 유기막(114)은 상기 드레인 전극(108c)의 일부를 노출하는 콘택홀을 포함한다.The
상기 화소 전극(112)은 상기 화소에 대응하는 상기 유기막(114)의 표면 및 상기 콘택홀의 내면 상에 형성되어 상기 드레인 전극(118c)과 전기적으로 연결된다. 상기 화소 전극(112)은 상기 공통 전극(106)과의 사이에 인가된 전압에 의해 상기 액정층(108) 내의 액정을 제어하여 광의 투과를 조절한다. 상기 화소 전극(112)은 투명한 도전성 물질인 산화 주석 인듐(Indium Tin Oxide, ITO), 산화 아연 인듐(Indium Zinc Oxide, IZO), 산화 아연(Zinc Oxide, ZO) 등을 포함한다. 이때, 상기 화소 전극이 반사율이 높은 물질을 갖는 반사 전극을 포함할 수도 있다. 또한, 상기 화소 전극이 상기 투명한 도전성 물질을 갖는 투명 전극 및 상기 투명 전극 상에 배치되고 반사율이 높은 물질을 갖는 반사 전극을 포함할 수도 있다.The
상기 블랙 매트릭스(102)는 상기 데이터 라인(118a') 및 상기 게이트 라인(118b')에 대응하는 상기 상부 플레이트(100)의 일부에 형성되어 광을 차단한다. 상기 블랙 매트릭스(102)는 액정을 제어할 수 없는 영역을 통과하는 광을 차단하여 화질을 향상시킨다.The
상기 블랙 매트릭스(102)는 금속 또는 금속화합물을 증착하고 식각하여 형성 된다. 상기 금속은 크롬(Cr) 등을 포함하고, 상기 금속화합물은 산화 크롬(CrOx), 질화 크롬(CrNx) 등을 포함한다. 또한, 상기 블랙 매트릭스(102)는 포토 레지스트 성분을 포함하는 불투명한 유기물을 도포한 후에, 사진 공정을 통해 상기 도포된 유기물을 부분적으로 제거하여 형성될 수 있다. 상기 불투명한 유기물은 카본 블랙(Carbon Black), 안료 혼합물, 염료 혼합물 등을 포함한다. 상기 안료 혼합물은 적색, 녹색 및 청색 안료를 포함하고, 상기 염료 혼합물은 적색, 녹색 및 청색 염료를 포함한다. 이때, 복수의 컬러 필터들(104a)을 중첩하여 상기 제2 기판(180)의 상기 패시베이션막(116) 상에 블랙 매트릭스를 형성할 수도 있다.The
상기 오버코팅층(105)은 상기 블랙 매트릭스(102)가 형성된 상기 상부 플레이트(100) 상에 배치되어 상기 블랙 매트릭스(102)를 보호하고 상기 제1 기판(170)의 표면을 평탄화한다.The
상기 공통 전극(106)은 상기 오버코팅층(105) 상에 배치된다. 상기 공통 전극(106)은 ITO(Indium Tin Oxide), IZO(Indium Zinc Oxide) 또는 ZO(Zinc Oxide)와 같은 투명한 도전성 물질을 포함한다.The
도 6은 상기 도 2에 도시된 액정 표시 장치에 발생한 불량을 나타내는 평면도이고, 도 7은 상기 도 6의 VI-VI'라인의 단면도이다.FIG. 6 is a plan view illustrating a failure occurring in the liquid crystal display illustrated in FIG. 2, and FIG. 7 is a cross-sectional view taken along the line VI-VI ′ of FIG. 6.
도 6 및 도 7을 참조하면, 상기 게이트 전극(118b)과 상기 드레인 전극(118c)의 사이에 파티클(140)이 배치되어 상기 게이트 전극(118b)과 상기 드레인 전극(118c)이 단락된다. 상기 게이트 전극(118b)과 상기 드레인 전극(118c)이 단락되는 경우, 상기 박막 트랜지스터(119)가 오동작하여 상기 액정 표시 패널의 화질 이 저하된다. 따라서, 상기 오동작하는 박막 트랜지스터(119)에 인가되는 상기 데이터 신호를 차단하기 위하여, 상기 오동작하는 박막 트랜지스터(119)에 인접하는 상기 데이터 라인(118a')의 일부에 레이저를 조사하여 상기 박막 트랜지스터(119)에 인접하는 상기 데이터 라인(118a')의 일부를 오픈시킨다.6 and 7, a
또한, 상기 오픈된 데이터 라인(118a')의 하부에 상기 데이터 신호를 인가하기 위하여, 상기 제1 리페어 라인(도시되지 않음)과 상기 오픈된 데이터 라인(118a')의 상부 및 하부에 레이저를 조사하여 상기 제1 리페어 라인(도시되지 않음)과 상기 오픈된 데이터 라인(118a')의 상부 및 하부를 전기적으로 연결시킨다. 따라서, 상기 오픈된 데이터 라인(118a')의 상부에는 상기 데이터 구동부(도시되지 않음)로부터 상기 데이터 신호가 직접 인가되지만, 상기 오픈된 데이터 라인(118a')의 하부에는 상기 데이터 구동부(도시되지 않음)로부터 상기 데이터 신호가 상기 제1 리페어 라인(도시되지 않음)을 통하여 우회하여 인가된다.Further, in order to apply the data signal to the lower portion of the
따라서, 2개 이하의 박막 트랜지스터가 오동작하는 경우, 상기 제1 및 제2 리페어 라인들(도시되지 않음)을 이용하여 상기 오동작을 방지할 수 있다.Therefore, when two or less thin film transistors malfunction, the malfunctions may be prevented by using the first and second repair lines (not shown).
실시예Example 2 2
도 8은 본 발명의 제2 실시예에 따른 액정 표시 패널을 나타내는 평면도이고, 도 9는 상기 도 8의 V-V'라인의 단면도이다. 본 실시예에서 리페어 패턴을 제외한 나머지 구성 요소들은 실시예 1과 동일하므로 중복된 부분에 대해서는 상세한 설명을 생략한다.8 is a plan view illustrating a liquid crystal display panel according to a second exemplary embodiment of the present invention, and FIG. 9 is a cross-sectional view taken along the line VV ′ of FIG. 8. In the present embodiment, the rest of the components except for the repair pattern are the same as those of the first embodiment, and thus detailed descriptions of overlapping portions will be omitted.
도 8 및 도 9를 참조하면, 상기 액정 표시 패널은 제1 기판(170), 제2 기판 (180) 및 액정층(108)을 포함한다.8 and 9, the liquid crystal display panel includes a
상기 제1 기판(170)은 상부 플레이트(100), 블랙 매트릭스(102), 오버코팅층(105) 및 공통 전극(106)을 포함한다.The
상기 제2 기판(180)은 하부 플레이트(120), 복수의 박막 트랜지스터(119), 복수의 스토리지 캐패시터(123), 복수의 데이터 라인(118a'), 복수의 게이트 라인(118b'), 복수의 스토리지 캐패시터 라인(122), 게이트 절연막(126), 패시베이션막(116), 복수의 컬러 필터(104a), 유기막(114), 복수의 화소 전극(112) 및 복수의 리페어 패턴(130)을 포함한다.The
상기 액정 표시 패널은 복수의 화소들을 포함하고, 상기 화소들은 서로 인접하는 데이터 라인들(118a')과 게이트 라인들(118b')에 의해 정의된다.The liquid crystal display panel includes a plurality of pixels, which are defined by
상기 리페어 패턴(130)은 상기 화소에 대응하는 상기 게이트 절연막(126)과 상기 패시베이션막(116)의 사이에 배치되며, 상단부 및 하단부가 각각 상기 스토리지 캐패시터 라인(122) 및 상기 게이트 라인(118b')과 오버랩된다.The
상기 리페어 패턴(130)이 상기 스토리지 캐패시터 라인(122) 또는 상기 게이트 라인(118b')에 오버랩되는 부분에 레이저가 조사되는 경우, 상기 리페어 패턴(130)은 상기 스토리지 캐패시터 라인(122) 또는 상기 게이트 라인(118b')과 전기적으로 연결된다.When the laser is irradiated to a portion where the
도 10 내지 도 14는 본 발명의 제2 실시예에 따른 액정 표시 패널의 제조방법을 나타내는 단면도들이다.10 to 14 are cross-sectional views illustrating a method of manufacturing a liquid crystal display panel according to a second embodiment of the present invention.
도 8 및 도 10을 참조하면, 먼저 상기 하부 플레이트(120) 상에 도전성 물질 을 증착한다. 계속해서, 상기 도전성 물질의 일부를 식각하여 상기 게이트 전극(118b), 상기 게이트 라인(118b'), 상기 스토리지 캐패시터 라인(122), 상기 제1 리페어 라인(도시되지 않음) 및 상기 제2 리페어 라인(도시되지 않음)을 형성한다. 이후에, 상기 게이트 전극(118b), 상기 게이트 라인(118b'), 상기 스토리지 캐패시터 라인(122), 상기 제1 리페어 라인(도시되지 않음) 및 상기 제2 리페어 라인(도시되지 않음)이 형성된 하부 플레이트(120) 상에 게이트 절연막(126)을 증착한다. 상기 게이트 절연막(126)은 산화 실리콘, 질화 실리콘 등을 포함한다.8 and 10, first, a conductive material is deposited on the
도 8 및 도 11을 참조하면, 계속해서 아몰퍼스 실리콘 패턴 및 N+ 아몰퍼스 실리콘 패턴을 상기 게이트 전극(118b)에 대응하는 상기 게이트 절연막(126) 상에 형성하여 상기 반도체층을 형성한다. 이어서, 상기 반도체층이 형성된 상기 게이트 절연막(126) 상에 도전성 물질을 증착한다. 이후에, 상기 도전성 물질의 일부를 식각하여 상기 소오스 전극(118a), 상기 데이터 라인(118a'), 상기 드레인 전극(118c) 및 상기 리페어 패턴(130)을 형성한다. 따라서, 상기 소오스 전극(118a), 상기 게이트 전극(118b), 상기 드레인 전극(118c) 및 상기 반도체층을 포함하는 상기 박막 트랜지스터(119) 및 상기 리페어 패턴(130)이 형성된다.8 and 11, an amorphous silicon pattern and an N + amorphous silicon pattern are subsequently formed on the
도 8 및 도 12를 참조하면, 계속해서 상기 박막 트랜지스터(119) 및 상기 리페어 패턴(130)이 형성된 상기 하부 플레이트(120) 상에 투명한 절연물질을 증착한다.8 and 12, a transparent insulating material is deposited on the
이어서, 상기 증착된 투명한 절연물질 상에 컬러 필터용 물질을 도포한다. 상기 컬러 필터용 물질은 포토 레지스트를 포함한다. 이후에, 상기 도포된 컬러 필 터용 물질 상에 유기물을 도포한다. 상기 유기물을 포토 레지스트를 포함한다. 계속해서, 사진 공정을 이용하여 상기 도포된 유기물 및 컬러 필터용 물질의 일부를 제거하여 상기 드레인 전극(118c)의 일부에 대응하는 상기 증착된 투명한 절연물질이 노출되는 상기 유기막(114) 및 상기 컬러 필터(104a)를 형성한다. 이후에, 상기 유기막(114) 및 상기 컬러 필터(104a)를 식각 마스크로 이용하여 상기 드레인 전극(118c)의 일부에 대응하는 상기 증착된 투명한 절연물질을 식각하여 상기 패시베이션막(116) 및 상기 콘택홀을 형성한다.Subsequently, a color filter material is coated on the deposited transparent insulating material. The color filter material includes a photoresist. Thereafter, the organic material is applied onto the applied color filter material. The organic material includes a photoresist. Subsequently, a portion of the applied organic material and color filter material is removed using a photographic process to expose the
이어서, 상기 유기막(114) 및 상기 콘택홀의 내면 상에 투명한 도전성 물질을 증착한다. 상기 투명한 도전성 물질은 ITO(Indium Tin Oxide), TO(Tin Oxide), IZO(Indium Zinc Oxide), ZO(Zinc Oxide) 등을 포함한다. 계속해서, 상기 증착된 투명한 도전성 물질의 일부를 식각하여 상기 화소 전극(112)을 형성한다. 상기 스토리지 캐패서터 라인(122)과, 상기 화소 전극(122)과, 상기 스토리지 캐패시터 라인(122) 및 상기 화소 전극(122)의 사이에 배치된 절연막은 상기 스토리지 캐패시터(123)를 형성한다.Subsequently, a transparent conductive material is deposited on the inner surface of the
따라서, 상기 하부 플레이트(120), 상기 박막 트랜지스터(119), 상기 스토리지 캐패시터(123), 상기 데이터 라인(118a'), 상기 게이트 라인(118b'), 상기 스토리지 캐패시터 라인(122), 상기 게이트 절연막(126), 상기 패시베이션막(116), 상기 컬러 필터(104a), 상기 유기막(114), 상기 화소 전극(112), 상기 제1 리페어 라인(도시되지 않음) 및 상기 제2 리페어 라인(도시되지 않음)을 포함하는 상기 제2 기판(180)이 형성된다.
Accordingly, the
도 8 및 도 13을 참조하면, 이어서 상기 상부 플레이트(100) 상에 불투명한 물질을 증착한다. 계속해서, 상기 불투명한 물질의 일부를 제거하여 상기 블랙 매트릭스(102)를 형성한다. 이때, 불투명한 물질 및 포토레지스트를 상기 상부 기판(100) 상에 도포한 후에 사진 공정(Photo Process)을 이용하여 상기 블랙 매트릭스(102)를 형성할 수도 있다. 상기 사진 공정(Photo Process)은 노광 공정(Exposure Process) 및 현상 공정(Development Process)을 포함한다.8 and 13, an opaque material is subsequently deposited on the
이후에, 상기 블랙 매트릭스(102)가 형성된 상기 상부 플레이트(100) 상에 유기물을 도포하여 상기 패시베이션막(105)을 형성한다. 계속해서, 상기 패시베이션막(105) 상에 투명한 도전성 물질을 도포하여 상기 공통 전극(106)을 형성한다.Thereafter, the
따라서, 상기 하부 플레이트(100), 상기 블랙 매트릭스(102), 상기 오버코팅층(105) 및 상기 공통 전극(106)을 포함하는 상기 제1 기판(170)이 형성된다.Accordingly, the
도 8 및 도 14를 참조하면, 이어서 상기 제1 기판(170) 및 상기 제2 기판(180)을 대향하여 결합한다.8 and 14, the
계속해서, 상기 제1 기판(170) 및 상기 제2 기판(180) 사이에 액정을 주입한 후에 씰런트(Sealant, 도시되지 않음)에 의해 밀봉하여 상기 액정층(108)을 형성한다. 이때, 상기 씰런트(도시되지 않음)가 형성된 상기 제1 기판(170) 또는 상기 제2 기판(180) 상에 액정을 적하(Drop)한 후에 상기 제1 기판(170) 및 상기 제2 기판(180)을 대향하여 결합하여 상기 액정층(108)을 형성할 수도 있다.Subsequently, the liquid crystal is injected between the
도 15는 상기 도 8에 도시된 액정 표시 패널에 발생한 불량을 나타내는 평면도이고, 도 16은 상기 도 15의 VI-VI'라인의 단면도이다. FIG. 15 is a plan view illustrating a failure occurring in the liquid crystal display panel illustrated in FIG. 8, and FIG. 16 is a cross-sectional view taken along the line VI-VI ′ of FIG. 15.
도 15 및 도 16을 참조하면, 상기 게이트 전극(118b)과 상기 드레인 전극(118c)의 사이에 파티클(140)이 배치되어 상기 게이트 전극(118b)과 상기 드레인 전극(118c)이 단락된다. 상기 게이트 전극(118b)과 상기 드레인 전극(118c)이 단락되는 경우, 상기 박막 트랜지스터(119)가 오동작하여 상기 액정 표시 패널의 화질이 저하된다.15 and 16, a
도 17 내지 도 19는 본 발명의 제2 실시예에 따른 액정 표시 패널의 불량 제거 방법을 나타내는 평면도들이다.17 to 19 are plan views illustrating a method for removing defects of a liquid crystal display panel according to a second exemplary embodiment of the present invention.
도 17을 참조하면, 상기 오동작하는 박막 트랜지스터(119)에 인가되는 상기 데이터 신호를 차단하기 위하여, 상기 오동작하는 박막 트랜지스터(119)에 인접하는 상기 게이트 라인(118b')의 양측에 레이저를 조사하여 상기 오동작하는 박막 트랜지스터(119)에 인접하는 상기 게이트 라인(118b')의 양측을 오픈시킨다. 상기 게이트 라인(118b')의 오픈된 부분들(142a, 142b)은 상기 오동작하는 박막 트랜지스터(119)의 좌우측에 각각 배치된다. 따라서, 상기 오동작하는 박막 트랜지스터(119)는 상기 게이트 라인(118b')과 전기적으로 절연된다.Referring to FIG. 17, in order to block the data signal applied to the malfunctioning
도 18을 참조하면, 상기 오동작하는 박막 트랜지스터(119)에 인접하는 상기 리페어 패턴들(130)과 상기 오픈된 게이트 라인(118b')이 오버랩되는 부분, 및 상기 리페어 패턴들(130)과 상기 스토리지 캐패시터 라인(122)이 오버랩되는 부분에 레이저를 조사하여, 상기 오픈된 게이트 라인(118b')이 상기 리페어 패턴들(130)을 통하여 상기 스토리지 캐패시터 라인(122)에 전기적으로 연결시키는 리패어 패턴용 콘택홀들(144a, 144b, 144c, 144d)을 형성한다.
Referring to FIG. 18, a portion of the
도 19를 참조하면, 상기 공통 전압이 상기 오픈된 게이트 라인(118b')에 인가되는 것을 방지하기 위하여, 상기 리페어 패턴들(130)을 기준으로 상기 오동작하는 박막 트랜지스터(119)의 반대쪽에 배치되며, 상기 리페어 패턴들(130)에 전기적으로 연결된 상기 스토리지 캐패시터 라인(122)의 양측에 레이저를 조사하여 상기 스토리지 캐패시터 라인(122)의 양측을 오픈시킨다. 상기 스토리지 캐패시터 라인(122)의 오픈된 부분들(146a, 146b)은 상기 스토리지 캐패시터 라인(122)과 상기 리페어 패턴들(130)을 연결하는 콘택홀들(144b, 144c)의 좌우측에 배치된다.Referring to FIG. 19, to prevent the common voltage from being applied to the
따라서, 상기 게이트 신호가 상기 리페어 패턴들(130) 및 상기 스토리지 캐패시터 라인(122)을 통하여 상기 오동작하는 박막 트랜지스터를 우회하여 상기 오픈된 게이트 라인(118b')에 인가된다. 본 실시예에서, 상기 게이트 신호는 상기 게이트 라인(118b')의 일측에서만 인가되나, 상기 공통 전압은 상기 스토리지 캐패시터 라인(122)의 양측에서 인가된다.Accordingly, the gate signal is applied to the
따라서, 상기 제2 기판(180)이 상기 리페어 라인들(130)을 포함하여 상기 오동작하는 박막 트랜지스터(119)의 수가 3개 이상인 경우에도 상기 오동작을 방지할 수 있다.Therefore, even when the
실시예Example 3 3
도 20은 본 발명의 제3 실시예에 따른 액정 표시 패널을 나타내는 평면도이고, 도 21은 상기 도 20의 VII-VII'라인의 단면도이다. 본 실시예에서 컬러 필터를 제외한 나머지 구성 요소들은 실시예 2와 동일하므로 중복된 부분에 대해서는 상세한 설명을 생략한다. 20 is a plan view illustrating a liquid crystal display panel according to a third exemplary embodiment of the present invention, and FIG. 21 is a cross-sectional view taken along the line VII-VII ′ of FIG. 20. In the present embodiment, the rest of the components except for the color filter are the same as those of the second embodiment, and thus detailed descriptions thereof will be omitted.
도 20 및 도 21을 참조하면, 상기 액정 표시 패널은 제1 기판(170), 제2 기판(180) 및 액정층(108)을 포함한다.20 and 21, the liquid crystal display panel includes a
상기 제1 기판(170)은 상부 플레이트(100), 블랙 매트릭스(102), 컬러 필터(104b) 및 공통 전극(106)을 포함한다.The
상기 제2 기판(180)은 하부 플레이트(120), 복수의 박막 트랜지스터(119), 복수의 스토리지 캐패시터(123), 복수의 데이터 라인(118a'), 복수의 게이트 라인(118b'), 복수의 스토리지 캐패시터 라인(122), 게이트 절연막(126), 패시베이션막(116), 유기막(114), 복수의 화소 전극(112) 및 복수의 리페어 패턴(130)을 포함한다.The
따라서, 상기 제1 기판(170)이 상기 컬러 필터(104b)를 포함하는 경우에도, 상기 리페어 패턴을 이용하여 상기 박막 트랜지스터(119)의 오동작을 방지할 수 있다.Therefore, even when the
상기와 같은 본 발명에 따르면, 표시 패널이 우회회로용 패턴을 포함하여 박막 트랜지스터의 오동작을 방지한다. 또한, 상기 표시 패널이 리페어 패턴을 포함하여 다수의 박막 트랜지스터들이 오동작하는 경우에도 상기 다수의 박막 트랜지스터들의 오동작을 방지할 수 있다. 또한, 상기 박막 트랜지스터들의 오동작을 방지하여 상기 표시 패널의 화질이 향상된다.According to the present invention as described above, the display panel includes a bypass circuit pattern to prevent malfunction of the thin film transistor. In addition, even when the display panel includes a repair pattern and a plurality of thin film transistors malfunction, the malfunction of the plurality of thin film transistors can be prevented. In addition, the image quality of the display panel is improved by preventing malfunction of the thin film transistors.
더욱이, 상기 표시 패널의 수리가 용이하여 제조비용 및 수리비용이 감소하고 수율이 향상된다. In addition, the display panel can be easily repaired, thereby reducing manufacturing and repair costs and improving yield.
상기에서는 본 발명의 바람직한 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.Although described above with reference to a preferred embodiment of the present invention, those skilled in the art will be variously modified and changed within the scope of the invention without departing from the spirit and scope of the invention described in the claims below I can understand that you can.
Claims (17)
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- 2004-08-13 KR KR1020040064059A patent/KR20060015207A/en not_active Application Discontinuation
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