KR20050107044A - 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법 - Google Patents

시분할 이중화 방식의 중계기에서 동기를 획득하는 방법 Download PDF

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KR20050107044A
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Abstract

개시된 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법은 상향 링크 회로, 하향 링크 회로, 동기 획득부 및 제어부를 포함하여 구성되는 시분할 이중화(Time Division Duplex) 방식의 중계기에서, 프리앰블(preamble)을 포함하여 구성되는 하향 링크 신호로부터 동기를 획득하는 방법에 있어서, 시분할 이중화 방식의 프레임을 구성하는 하향 링크 시간, 가드 시간 및 상향 링크 시간의 주기를 상기 동기 획득부에 미리 저장하는 단계 프리앰블을 검출하여 하향 링크의 시작점으로 인식하는 단계 및 하향 링크의 시작점을 기준으로 동기 획득부에 저장된 주기를 이용하여 하향 링크시간, 상향 링크시간 및 가드시간의 동기(同期)를 획득하는 단계를 포함하여 구성된다.
이와 같은 구성의 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법은 하향 링크 신호에 포함된 프리앰블과 하향/상향 링크 시간 비율정보를 이용하여 동기를 획득할 수 있기 때문에 기지국과 단말기에게 영향을 미치지 않으면서 기지국의 서비스 영역을 확장할 수 있는 효과를 제공할 수 있다.

Description

시분할 이중화 방식의 중계기에서 동기를 획득하는 방법{method for synchronization acquisition in TDD repeater}
본 발명은 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법에 관한 것으로서, 더 상세하게는 하향 링크 신호에 포함된 프리앰블과 하향 및 상향 링크의 비율정보를 이용하여 동기를 획득하는 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법에 관한 것이다.
일반적으로 시분할 이중화(TDD: Time Division Duplexing) 방식이란 동일한 주파수 대역의 신호 프레임을 상향 링크(up link)와 하향 링크(down link)로 시간 분할하여 양방향 전송을 지원하는 기술을 말한다.
시분할 이중화 방식은 상향 링크(up link)와 하향 링크(down link) 신호에 다른 주파수 대역을 사용하는 주파수 분할 이중화 방식에 비하여 적은 타임슬롯(timeslot)을 사용하여 동일한 전송속도 지원이 가능하고, 타임슬롯의 동적 할당으로 비대칭(asymmetric)이나 버스티(busty)한 애플리케이션의 전송에 적합하며, 주파수 분할 이중화 방식에 비해 1/2 주파수로 서비스를 제공할 수 있는 이점이 있다.
시분할 이중화 방식은 저렴한 비용으로 무선 인터넷 서비스를 제공하고자 하는 통신 사업자에게 매력적인 기술로 인식되고 있으며, 휴대 인터넷 서비스를 제공하기 위한 중요 기술로서 많은 주목을 받고 있다. 그러나, 시분할 이중화 방식은 타임슬롯의 동적할당에 따른 애플리케이션의 타이밍과 동기화 작업이 매우 어려워, 전송거리에 따른 신호 지연문제를 해결하지 못하는 문제점이 있다.
이러한 시분할 이중화 방식이 중계기에 적용되는 경우, 하향 링크 신호와 상향 링크 신호를 고속으로 스위칭 하여야 하는 중계기가 바람직하게 동작하기 위하여 하향 링크 신호 시간, 상향 링크 신호 시간 및 가드시간의 정확한 동기의 획득이 필수적이다.
따라서, 시분할 이중화 방식의 중계기에서 중계기의 바람직한 동작을 위하여 정확한 동기를 획득하는 방법이 요구되고 있다.
본 발명은 상기의 필요성을 감안하여 창출된 것으로서, 하향 링크 신호에 포함된 프리앰블과 동기획득부에 저장된 하향 링크 시간, 상향 링크 시간 및 가드 시간의 주기를 이용하여 동기를 획득하는 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법을 제공하는 것을 그 목적으로 한다.
또한, 본 발명의 다른 목적은 하향 링크 신호에 포함된 프림엠블과 상향 링크 시간과 하향 링크 시간 비율정보를 포함하는 에스아이씨에이치(SICH:System Information Channel) 또는 에프씨에이치(FCH:Frame Control Channel)를 이용하여 동기를 획득하는 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법을 제공하는 데 있다.
상기의 목적을 달성하기 위한 본 발명은, 상향 링크 회로, 하향 링크 회로, 동기 획득부 및 제어부를 포함하여 구성되는 시분할 이중화(Time Division Duplex) 방식의 중계기에서, 프리앰블(preamble)을 포함하여 구성되는 하향 링크 신호로부터 동기를 획득하는 방법에 있어서, a) 상기 시분할 이중화 방식의 프레임을 구성하는 하향 링크 시간, 가드 시간 및 상향 링크 시간의 주기를 상기 동기 획득부에 미리 저장하는 단계;,b) 상기 프리앰블을 검출하여 하향 링크의 시작점으로 인식하는 단계; 및 c) 상기 하향 링크의 시작점을 기준으로 동기 획득부에 저장된 주기를 이용하여 하향 링크시간, 상향 링크시간 및 가드시간의 동기를 획득하는 단계;를 포함하여 이루어지는 것을 특징으로 한다.
또한, 상기의 목적을 달성하기 위한 본 발명은, 상향 링크 회로, 하향 링크 회로, 동기 획득부 및 제어부를 포함하여 구성되는 시분할 이중화(Time Division Duplex) 방식의 중계기에서, 프리앰블(preamble)과 하향/상향 링크 시간 비율정보를 포함하는 에스아이씨에이치(SICH:System Information Channel) 또는 에프씨에이치(FCH:Frame Control Channel)를 포함하여 구성되는 하향 링크 신호로부터 동기를 획득하는 방법에 있어서, a) 상기 프리앰블을 검출하여 하향 링크의 시작점의 시작점으로 인식하는 단계; b) 상기 에스아이에이치 또는 에프씨에이치를 분석하여 상기 하향/상향 링크 시간 비율정보를 검출하는 단계; 및 c) 상기 하향 링크의 시작점을 기준으로 상기 하향/상향 링크 시간 비율정보를 이용하여 하향 링크 시간, 상향 링크 시간 및 가드시간의 동기를 획득하는 단계;를 포함하여 이루어질 수 있다.
또한, 상기의 목적을 달성하기 위한 본 발명은 상기 동기(同期)에 따라서 상기 상향 링크 회로와 하향 링크 회로를 스위칭하여 활성화하는 단계를 더 포함하는 것이 바람직하다.
이하 첨부된 도면을 참조하면서 본 발명에 따른 바람직한 실시 예를 상세히 설명하기로 한다.
도 1은 시분할 이중화(TDD) 방식의 일반적인 프레임 구조를 도시한 도면이다. 도면을 참조하면, 시분할 이중 방식의 일반적인 프레임은 하향 링크 시간, 상향 링크 시간, 가드 시간을 포함하여 구성된다.
다수의 직교하는 반송파 신호를 다중화하는 OFDM(Orthogonal Frequency Division Multiplexing) 변조방식에 있어서, 1 프레임은 115.2㎲ 길이의 42개의 심볼 구간으로 구성될 수 있으며, 전체적으로 5ms길이를 가질 수 있다.
상기 하향 링크에서는 프리앰블(Preamble)에 2 심볼 구간, SICH(System Information CHannel)에 1 심볼 구간이 할당될 수 있으며, 상향 링크에서는 각종 제어정보를 위해 3 심볼 구간이 할당될 수 있다. 하향 링크와 상향 링크에서 데이터에 할당될 수 있는 심볼 구간 수는 36 심볼 구간이 된다. 또한 SICH는 FCH(Frame Control Channel)로 변경 가능하며, FCH는 데이터 구간 내에 존재하게 된다.
데이터 전송에 할당되는 심볼 구간 수는 하향/상향 링크 비율에 따라 하향/상향 링크에 각각 할당될 수 있다. 예를 들면, 하향 링크 대 상향 링크 비율이 1 대 1인 경우 하향 링크에 18 심볼 구간, 상향 링크에 18 심볼 구간이 할당되며, 하향 링크 대 상향 링크 비율이 2 대 1인 경우 하향 링크에 24 심볼 구간, 상향 링크에 12 심볼 구간이 할당되고, 하향 링크 대 상향 링크 비율이 5 대 1인 경우 하향 링크에 30 심볼 구간, 상향 링크에 6 심볼 구간이 할당된다.
상기 하향/상향 링크 비율과 하향 링크의 끝나는 시점과의 관계를 하향/상향링크 비율이 2대1인 경우를 예시하여 설명한다. 하향/ 상향 링크 비율이 2 대1인 경우 하향 링크에 할당된 심볼 구간 수는 프리앰블(2) + SICH(1) + 데이터(24) = 27 심볼 구간 수가 된다. 따라서, 하향 링크의 끝나는 시점은 27 심볼 구간수 x 115.2㎲ = 3110.4㎲가 지난 시간이 된다.
가드 시간은 하향 링크와 상향 링크 시간을 구분하는 것으로 중계기에서 하향 링크와 하향 링크의 활성화를 스위칭하는데 걸리는 시간이 된다. 하향 링크 시간과 상향 링크 시간 사이의 가드 시간(TTG: Transmit / receive Transition Gap)은 121.2㎲일 수 있으며, 상향 링크 시간과 하향 링크 시간 사이의 가드 시간(RTG: Receive / transmit Transition Gap)은 40.4㎲일 수 있다.
도 2는 시분할 이중화(TDD) 방식의 하향 링크 프레임 구조를 도시한 도면이고, 도 3은 시분할 이중화(TDD) 방식의 다른 형태의 하향 링크 프레임 구조를 도시한 도면이다. 도면을 참조하면, 상기 하향 링크 신호는 프리앰블(preamble), SICH(System Information CHannel) 또는 FCH(Frame Control Channel), 데이터를 포함하여 구성될 수 있다.
프리앰블은 48비트로 구성되는 Walsh Hadamard 매트릭스의 한행의 값을 가질 수 있다.
SICH는 6비트로 구성될 수 있으며, 하향/상향 링크 비율, 하향/상향 링크 내의 다이버시티(diversity) 및 AMC(Adaptive Modulation and Coding) 적용 심볼 등에 대한 프레임 구조정보를 포함할 수 있다.
도 4는 본 발명의 일실시예에 따라 동기를 획득하기 위한 시분할 이중 방식의 중계기의 구성 블록도이다. 도면을 참조하면, 동기를 획득하기 위한 방법에 사용되는 시분할 이중 방식(Time Division Duplex)의 중계기는 하향 링크 회로(A), 상향 링크 회로(B), 동기 획득부(150) 및 제어부(130)를 포함하여 구성된다.
상기 하향 링크 회로(A)는 기지국에서 단말기 방향으로 송신되는 하향 링크 신호가 거쳐 가는 경로이고, 상기 상향 링크 회로(B)는 단말기에서 기지국 방향으로 송신 되는 상향 링크 신호가 거쳐 가는 경로이다.
하향 링크 회로(A)와 상향 링크 회로(B)는 각각 스위치(110,120), 저잡음 증폭기(LNA:Low Noise Amplifier)(112,122) 및 전력 증폭기(PA: Power Amplifier)(114,124)를 포함하여 구성될 수 있다.
상기 동기 획득부(150)는 기지국에서 송신되는 하향 링크 신호로부터 동기를 획득하는 구성요소로서 중간 주파수(Intermediate Frequency) 변환부(도5a의 151), 베이스 밴드(Base Band) 신호 변환부(도5a의 152), 프리앰블 검출부(도5a의 154), 동기 결정부(도5a의158)를 포함하여 구성될 수 있다.
상기 제어부(130)는 동기 획득부(150)에서 얻어진 동기에 따라서 상기 하향 링크 회로(A)와 상향 링크 회로(B)의 스위치(110,120), 저잡음 증폭기(112,122), 및 전력 증폭기(114,124)를 제어하는 구성요소이다.
시분할 이중화 방식의 중계기에서 동기를 획득하는 방법 및 중계기의 동작을 개략적으로 설명한다.
기지국의 하향 링크 신호가 안테나(141), BPF(Band Pass Filter)(142)로 유입되어 서큘레이터(144)를 거쳐 하향 링크용 스위치(110)에 도달된다. 하향 링크 신호로부터 동기를 획득하기 위하여 하향 링크용 스위치(110)는 온(on)상태가 되며, 하향 링크 스위치(110)를 거친 하향 링크 신호는 하향 링크용 저잡음 증폭기(112)와 2웨이 분배기(145)를 통하여 동기 획득부(150)로 전달된다. 이때, 하향 링크용 전력 증폭기(114)와 상향 링크용 저잡음 증폭기(122)와 전력 증폭기(124)는 오프(off) 상태인 것이 바람직하다.
동기 획득부(150)는 하향 링크 신호 중 프리앰블을 분석하여 프레임의 시작점을 알아내고 이를 기준으로 하여 중계기가 바람직하게 동작할 수 있는 동기를 획득하여 제어부(130)로 전송한다.
제어부(130)는 동기 획득부(150)로부터 전송받은 동기에 따라서 하향 링크 회로(A)와 상향 링크 회로(B)를 활성화 시키며 스위칭을 제어한다.
다시 설명하면, 제어부(150)는 하향 링크 시간일 때에는 하향 링크 스위치(110)를 연결하며, 저잡음 증폭기(112) 및 전력 증폭기(114)를 온(on) 시켜 동작시킨다. 하향 링크 시간이 끝나는 시점이 되면 하향 링크 스위치(110)를 개방하고, 저잡음 증폭기(112) 및 전력 증폭기(114)를 오프(off)한다.
그리고, 제어부(150)는 상향 링크 시간일 때에는 상향 링크용 스위치(120)를 연결하며 상향 링크의 저잡음 증폭기(122)와 전력 증폭기(124)를 온(on) 시킨다. 하향 링크 회로(110,112,114)의 동작을 멈추게 하고 상향 링크 회로(120,122,124)를 동작시키는 시간은 하향/상향 링크 시간 사이의 가드 시간 내에 이루어지는 것이 바람직하다.
다시 하향 링크의 시간이 돌아오면 하향 링크 스위치(110)를 연결하며, 저잡음 증폭기(112) 및 전력 증폭기(114)를 온(on) 시켜 동작시킨다. 하향 링크 시간이 끝나는 시점이 되면 하향 링크 스위치(110)를 개방하고, 저잡음 증폭기(112) 및 전력 증폭기(114)를 오프(off)한다. 제어부(130)는 상기의 과정을 반복적으로 수행하면서 중계기를 동작시킬 수 있다.
<제1실시예>
본 발명의 제1실시예에 따라 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법은 프리앰블(preamble)과 동기 획득부(도5a의 150)에 저장된 하향 링크 시간, 상향 링크 시간 및 가드 시간의 주기를 이용하여 동기를 획득하는 방법이다.
도 5a는 도 4의 시분할 이중화 방식의 중계기의 제1실시 예에 따른 동기 획득부(150)의 구성 블록도이다. 도면을 참조하여 본 발명의 제1실시 예에 따라 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법을 설명한다.
먼저, 시분할 이중 방식의 프레임을 구성하는 하향 링크 시간, 가드 시간 및 상향 링크 시간의 주기를 상기 동기 획득부(150)에 미리 저장한다. 하향/상향 비율이 1대1일인 경우 하향 링크가 끝나는 시점은 2419.2㎲이고, 2 대 1일 경우 3110.4㎲이고, 5대 1일 경우 3801.6㎲일 수 있다. 상향 링크 시간은 프레임 길이에서 가드 시간과 하향 링크 시간을 감한 시간이 된다.
그리고, 동기 획득부(150)는 하향 링크 신호에 포함된 프리앰블을 검출하여 하향 링크의 시작점을 획득한다. 프리앰블의 검출은 2웨이 분배기(145)를 거친 기지국의 하향 신호가 중간 주파수 변환부(151), 기저 대역 신호 변환부(152) 및 프리앰블 검출부(154)를 거쳐 중간 주파수 신호로 변환되고 기저 대역 신호로 변환된 후에 수행될 수 있으며, OFDM 변조과정에서 IFFT(Inverse Fast Fourier Transform)되어 수신되는 신호에 FFT(Fast Fourier Transform)를 수행함으로서 이루어 질 수 있다.
마지막으로 동기 결정부(158)에서는 프리앰블 검출부(154)에 검출된 프리앰블을 하향 링크의 시작 기준점으로 하고 저장된 하향 링크 시간, 가드시간, 상향 링크 시간 주기를 이용하여 최종적으로 시분할 이중화 방식의 중계기(100)가 동작할 수 있는 동기를 획득한다. 획득된 동기는 중계기(100)의 하향/상향 링크 회로(A,B)의 스위칭을 제어하는 제어부(130)로 전송되는 것이 바람직하다.
<제2실시예>
본 발명의 제2실시예에 따라 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법은 프리앰블(preamble)과 하향/상향 링크 시간 비율 정보를 포함하는 SICH를 이용하여 동기를 획득하는 방법이다.
도 5b는 도 4의 시분할 이중 방식의 중계기의 제2실시 예에 따른 동기 획득부의 구성 블록도이다. 도면을 참조하며 본 발명의 제2실시 예에 따라 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법을 설명한다.
OFDM 변조 방식에서 프리앰블은 BPSK(Binary Phase Shift Keying) 방식, SICH는 QPSK(Quadrature Phase Shift Keying) 방식으로 서로 다른 변조방식을 사용하므로, 동기 획득부(150')는 상기 제1실시예의 동기 획득부에 별도의 SICH 획득부(155)와 파일롯 획득부(156)를 더 구비하는 형태일 수 있다.
먼저, 프리앰블을 검출하여 하향 링크의 시작점을 획득한다. 프리앰블의 검출은 제1실시예에서와 같이 2웨이 분배기(145)를 거친 기지국의 하향 신호가 중간 주파수 변환부(151), 기저 대역 신호 변환부(152) 및 프리앰블 검출부(154)를 거쳐 중간 주파수(IF) 신호로 변환되고 기저 대역 신호로 변환된 후에 FFT(Fast Fourier Transform)를 수행함으로서 이루어 질 수 있다.
그리고, SICH 획득부(155)는 SICH를 분석하여 하향 링크 시간과 상향 링크 시간 비율 정보를 획득한다. 파이럿 획득부(156)는 SICH 획득부(155)가 정확한 동기에 의하여 정보를 분석할 수 있도록 파일럿(Pilot)을 추적하여 SICH 획득부(155)에 공급할 수 있다.
마지막으로 동기 결정부(158)에서는 프리앰블 검출부(154)에서 검출된 프리앰블을 하향 링크의 시작 기준점으로 하고 SICH 획득부(155)에서 얻어진 하향/상향링크 비율 정보를 이용하여 최종적으로 시분할 이중화 방식의 중계기(100)가 동작할 수 있는 동기를 획득한다. 획득된 동기는 중계기의 하향/상향 링크 회로(A,B)의 스위칭을 제어하는 제어부(130)로 전송되는 것이 바람직하다.
도 6은 본 발명의 일실시예에 따라 동기를 획득하기 위한 시분할 이중화 방식의 광중계기의 구성 블록도이다. 도면을 참조하면, 시분할 이중화 방식의 광중계기는 전기-광변환(E/O) 모듈(221,312)과 광-전기변환(O/E) 모듈(211,316)을 포함하는 광중계기 도우너(300)와 광중계기 리모트(200)로 구성될 수 있다.
광중계기 리모트(200)는 전기-광변환 모듈(221)과 광-전기변환 모듈(211)을 더 포함하는 것을 제외하면 스위치(210,220), 저잡음 증폭기(212,222), 전력 증폭기(214,224)를 포함하는 하향/상향 링크 회로, 동기 획득부(250) 및 제어부(230) 등은 상기 도 4와 도 5에서 설명한 중계기와 동일하다.
기지국(310)에 설치되는 광중계기 도너(300)에서는 전기-광 변환 모듈(312)을 통하여 기지국 하향 신호를 광신호로 전기-광 변조하여 변조된 광 신호를 광케이블을 매개로 광중계기 리모트(200)에 전달한다.
리모트(200)에서는 광-전기 변환 모듈(211)을 통하여 기지국 하향 링크 신호를 이전의 RF 신호로 변환하고, 하향 링크 회로의 스위치(210)와 저잡음 증폭기(212) 및 2웨이 분배기(245)를 통해 동기 획득부(250)에 전달한다.
동기 획득부(250)에서 동기를 획득하는 방법은 상기 도 3내지 4에서 설명한바와 같다. 제어부(230)는 동기 획득부(250)에서 획득한 동기에 따라 리모트(200)의 하향 링크 회로를 구성하는 스위치(210), 저잡음 증폭기(212) 및 전력 증폭기(214), 상향 링크 회로를 구성하는 스위치(220), 저잡음 증폭기(222) 및 전력 증폭기(224)를 제어하여 중계기를 동작시킬 수 있게 된다.
상술한 바와 같이 상향 링크 회로, 하향 링크 회로, 동기 획득부 및 제어부를 포함하여 구성되는 시분할 이중화(Time Division Duplex) 방식의 중계기에서, 프리앰블(preamble)을 포함하여 구성되는 하향 링크 신호로부터 동기를 획득하는 방법에 있어서, a) 상기 시분할 이중화 방식의 프레임을 구성하는 하향 링크 시간, 가드 시간 및 상향 링크 시간의 주기를 상기 동기 획득부에 미리 저장하는 단계; b) 상기 프리앰블을 검출하여 하향 링크의 시작점으로 인식하는 단계; 및 c) 상기 하향 링크의 시작점을 기준으로 동기 획득부에 저장된 주기를 이용하여 하향 링크시간, 상향 링크시간 및 가드시간의 동기(同期)를 획득하는 단계; 를 포함하여 이루어지는 본 발명의 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법은 다음과 같은 효과를 제공한다.
첫째, 하향 링크 신호에 포함된 프리앰블과 하향/상향 링크 시간 비율정보를 이용하여 동기를 획득함으로써, 기지국과 단말기에게 영향을 미치지 않으면서 기지국의 서비스 영역을 확장할 수 있는 효과를 제공한다.
둘째. 무선 중계기뿐 만 아니라 광중계기에 있어서도, 기지국 동기와 정확하게 일치된 상태로 동작할 수 있게 되어 안정적인 망운용의 기반을 제공하는 효과가 있다.
본 발명은 상기에 설명되고 도면에 예시된 것에 의해 한정되는 것은 아니며 다음에 기재되는 청구의 범위 내에서 더 많은 변형 및 변용예가 가능한 것임은 물론이다.
도 1은 시분할 이중화(TDD) 방식의 일반적인 프레임 구조를 도시한 도면.
도 2는 시분할 이중화(TDD) 방식의 하향 링크 프레임 구조를 도시한 도면.
도 3은 시분할 이중화(TDD) 방식의 다른 형태의 하향 링크 프레임 구조를 도시한 도면.
도 4는 본 발명의 일실시예에 따라 동기를 획득하기 위한 시분할 이중화 방식의 중계기의 구성 블록도.
도 5a는 도 4의 시분할 이중화 방식의 중계기의 제1실시 예에 따른 동기 획득부의 구성 블록도.
도 5b는 도 4의 시분할 이중화 방식의 중계기의 제2실시 예에 따른 동기 획득부의 구성 블록도.
도 6은 본 발명의 일실시예에 따라 동기를 획득하기 위한 시분할 이중화 방식의 광중계기의 구성 블록도.
< 도면의 주요부분에 대한 부호의 설명 >
100... 시분할 이중화 방식의 중계기 110,120... 스위치
112,122... 저잡음 증폭기 114,124... 전력 증폭기
130... 제어부 142,146... 밴드패스필터
141,149... 안테나 144,146... 서큘레이터
145... 2웨이 분배기 150... 동기 획득부

Claims (4)

  1. 상향 링크 회로, 하향 링크 회로, 동기 획득부 및 제어부를 포함하여 구성되는 시분할 이중화(Time Division Duplex) 방식의 중계기에서, 프리앰블(preamble)을 포함하여 구성되는 하향 링크 신호로부터 동기를 획득하는 방법에 있어서,
    a) 상기 시분할 이중화 방식의 프레임을 구성하는 하향 링크 시간, 가드 시간 및 상향 링크 시간의 주기를 상기 동기 획득부에 미리 저장하는 단계;,
    b) 상기 프리앰블을 검출하여 하향 링크의 시작점으로 인식하는 단계; 및
    c) 상기 하향 링크의 시작점을 기준으로 동기 획득부에 저장된 주기를 이용하여 하향 링크시간, 상향 링크시간 및 가드시간의 동기(同期)를 획득하는 단계;
    를 포함하여 이루어지는 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법.
  2. 상향 링크 회로, 하향 링크 회로, 동기 획득부 및 제어부를 포함하여 구성되는 시분할 이중화(Time Division Duplex) 방식의 중계기에서, 프리앰블(preamble)과 하향/상향 링크 시간 비율정보를 포함하는 에스아이씨에이치(SICH)를 포함하여 구성되는 하향 링크 신호로부터 동기를 획득하는 방법에 있어서,
    a) 상기 프리앰블을 검출하여 하향 링크의 시작점의 시작점으로 인식하는 단계;
    b) 상기 에스아이에이치를 분석하여 상기 하향/상향 링크 시간 비율정보를 검출하는 단계; 및
    c) 상기 하향 링크의 시작점을 기준으로 상기 하향/상향 링크 시간 비율정보를 이용하여 하향 링크 시간, 상향 링크 시간 및 가드시간의 동기(同期)를 획득하는 단계;
    를 포함하여 이루어지는 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법.
  3. 제 1 또는 2항에 있어서,
    d) 상기 동기(同期)에 따라서 상기 상향 링크 회로와 하향 링크회로를 스위칭하여 활성화하는 단계를 더 포함하는 것을 특징으로 하는 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법.
  4. 제 1 또는 2항에 있어서,
    상기 시분할 이중화 방식의 중계기는 전기-광변환 모듈과 광-전기변환 모듈을 포함하는 광중계기 도우너와 광중계기 리모트로 구성되는 광중계기인 것을 특징으로 하는 시분할 이중화 방식의 중계기에서 동기를 획득하는 방법.
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