KR20050038907A - Plasma display panel - Google Patents
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Abstract
본 발명은 어드레스 신호가 나중에 인가되는 방전 셀들, 특히 녹색 방전 셀들에 있어서 저방전 현상을 방지하기 위한 내부 구조를 갖는 플라즈마 디스플레이 패널에 관한 것으로서,The present invention relates to a plasma display panel having an internal structure for preventing a low discharge phenomenon in discharge cells, especially green discharge cells, to which an address signal is applied later.
제1 및 제2 기판과; 제1 기판에 형성되는 어드레스 전극들과; 제1 기판과 제2 기판의 사이 공간에 배치되어 방전 셀들을 구획하는 격벽과; 각각의 방전 셀 내에 위치하는 적색, 녹색 또는 청색의 형광층과; 제2 기판에 형성되는 유지 전극들을 포함하며, 녹색 형광층이 어드레스 전극 방향을 따라 변화하는 두께로 형성되는 플라즈마 디스플레이 패널을 제공한다.First and second substrates; Address electrodes formed on the first substrate; A partition wall disposed in a space between the first substrate and the second substrate to partition the discharge cells; A red, green or blue fluorescent layer located in each discharge cell; The present invention provides a plasma display panel including sustain electrodes formed on a second substrate, wherein a green fluorescent layer is formed to have a thickness varying along an address electrode direction.
Description
본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 보다 상세하게는 어드레스 신호가 나중에 인가되는 방전 셀들, 특히 녹색 방전 셀들에 있어서 저방전 현상을 방지하기 위한 내부 구조를 갖는 플라즈마 디스플레이 패널에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a plasma display panel, and more particularly, to a plasma display panel having an internal structure for preventing a low discharge phenomenon in discharge cells, especially green discharge cells, to which an address signal is applied later.
일반적으로 플라즈마 디스플레이 패널(PDP; plasma display panel, 이하 'PDP'라 한다)은 방전 셀 내에서 일어나는 기체 방전에 의한 진공 자외선으로 형광체를 여기시켜 화상을 구현하는 표시장치로서, 고해상도의 대화면 구성이 가능하여 차세대 박형 표시장치로 각광을 받고 있다.In general, a plasma display panel (PDP) is a display device for realizing an image by exciting phosphors by vacuum ultraviolet rays caused by gas discharge occurring in a discharge cell. It is attracting attention as the next generation thin display device.
도 7은 종래 기술에 의한 PDP의 부분 분해 사시도이다.7 is a partially exploded perspective view of a PDP according to the prior art.
도면을 참고하면, 후면 기판(1)에는 어드레스 전극(3)과 격벽(5) 및 형광층(7R, 7G, 7B)이 형성되고, 전면 기판(9)에는 스캔 전극(11)과 공통 전극(13)으로 이루어지는 유지 전극(15)이 형성된다. 어드레스 전극(3)과 유지 전극(15)은 각각 제1 유전층(17)과 제2 유전층(19)으로 덮여지며, 유지 전극(15) 방향을 따라 적색, 녹색 및 청색 형광층(7R, 7G, 7B)이 순서대로 마련된다.Referring to the drawings, an address electrode 3, a partition wall 5, and fluorescent layers 7R, 7G, and 7B are formed on a rear substrate 1, and a scan electrode 11 and a common electrode are formed on the front substrate 9. A sustain electrode 15 made of 13 is formed. The address electrode 3 and the sustain electrode 15 are covered with the first dielectric layer 17 and the second dielectric layer 19, respectively, and the red, green, and blue fluorescent layers 7R, 7G, 7B) are arranged in this order.
상기 어드레스 전극(3)과 유지 전극(15)이 교차하는 방전 공간이 하나의 방전 셀로 기능하며, 방전 셀 내부는 방전 가스(주로 Ne-Xe 혼합 가스)로 채워진다. 참고로, 도면에서 부호 21은 제2 유전층(19)을 덮는 MgO 보호막을 나타낸다.The discharge space where the address electrode 3 and the sustain electrode 15 cross each other functions as one discharge cell, and the discharge cell is filled with discharge gas (mainly Ne-Xe mixed gas). For reference, reference numeral 21 in the drawing represents an MgO protective film covering the second dielectric layer 19.
전술한 구성에 의해, 어드레스 전극(3)과 스캔 전극(11) 사이에 어드레스 전압(Va)을 인가하여 발광이 일어날 방전 셀을 선택하고, 선택된 방전 셀의 스캔 전극(11)과 공통 전극(13) 사이에 유지 전압(Vs)을 인가하면, 방전 셀 내에 플라즈마 방전이 일어나면서 플라즈마 방전시 만들어지는 Xe의 여기 원자로부터 진공 자외선이 방출되고, 진공 자외선이 형광층을 여기시켜 가시광을 내게 함으로써 소정의 표시가 이루어진다.By the above-described configuration, an address voltage Va is applied between the address electrode 3 and the scan electrode 11 to select a discharge cell to emit light, and the scan electrode 11 and the common electrode 13 of the selected discharge cell are selected. When the sustain voltage (Vs) is applied, the plasma discharge occurs in the discharge cell, and the vacuum ultraviolet rays are emitted from the excitation atoms of Xe generated during the plasma discharge, and the vacuum ultraviolet rays excite the fluorescent layer to emit visible light. Indication is made.
이 때, 통상의 PDP에서는 방전 셀 내에 어드레스 방전이 원활하게 이루어지도록 리셋 구간을 두며, 리셋 구간을 거치면 어드레스 전극(3) 측에는 (+)전하가 쌓이고, 스캔 전극(11) 측에는 (-)전하가 쌓이게 된다. 그런데 리셋 구간에 의해 생성된 벽전하는 방전 셀 내부 벽면에 지속적으로 남아있지 않고, 시간이 지나면서 손실된다.In this case, in the conventional PDP, a reset period is provided to smoothly discharge the discharge in the discharge cell, and after the reset period, positive charges are accumulated on the address electrode 3 side, and negative charges are stored on the scan electrode 11 side. Will accumulate. However, the wall charges generated by the reset period do not remain on the inner wall of the discharge cell but are lost over time.
따라서 싱글 스캔(single scan)으로 구동하는 PDP의 경우, 어드레스 전극(3) 상에 설정되는 방전 셀들 가운데 어드레스 신호가 먼저 인가되는 일측 단부 근처의 방전 셀들은 어드레스 방전에 유리하지만, 어드레스 신호가 나중에 인가되는 타측 단부 근처의 방전 셀들은 손실된 벽전하에 의해 방전 지연이 일어나고, 저방전이 생기는 등, 방전 불량이 발생하게 된다.Therefore, in the case of the PDP driven by a single scan, the discharge cells near one end where the address signal is applied first among the discharge cells set on the address electrode 3 are advantageous for the address discharge, but the address signal is applied later. The discharge cells near the other end portion are discharge delayed due to the lost wall charges and low discharge occurs.
더욱이 녹색 형광층(7G)은 적색 및 청색 형광층(7R, 8B)과 달리 형광층 자체의 물질 특성에 의해 표면이 (-)전하로 대전되므로, 녹색 방전 셀들은 어드레스 방전에 더욱 불리한 조건을 가지고 있다.Furthermore, since the surface of the green fluorescent layer 7G is negatively charged due to the material properties of the fluorescent layer itself, unlike the red and blue fluorescent layers 7R and 8B, the green discharge cells have more disadvantageous conditions for address discharge. have.
도 8은 종래 기술에 의한 PDP 가운데 어드레스 신호가 가장 늦게 인가되는 방전 셀들에 있어서, 적색, 녹색 및 청색 방전 셀별로 어드레스 지연 시간을 수백번 측정하여 그 결과를 나타낸 그래프이다. 그래프의 가로축은 지연 시간을 나타내고, 세로축은 해당 시간에서 어드레스 방전이 일어나지 않을 확률을 나타낸다.FIG. 8 is a graph showing the result of measuring an address delay time of hundreds of times for each of red, green, and blue discharge cells in the discharge cells to which the address signal is applied to the latest among the PDPs according to the prior art. The horizontal axis of the graph represents the delay time, and the vertical axis represents the probability that no address discharge occurs at that time.
도면을 참고하면, 적색 및 청색 방전 셀과 비교하여 녹색 방전 셀에서 어드레스 방전이 지연되고 있음을 확인할 수 있다. 따라서 녹색 방전 셀에서 어드레스 방전이 불안정하게 되어 유지 전압을 인가받은 경우 정상적인 방전이 이루어지지 않고, 깜빡거리는 상태가 되거나 발광 현상이 일어나지 않는 등의 불량으로 나타나게 된다.Referring to the drawings, it can be seen that the address discharge is delayed in the green discharge cells compared to the red and blue discharge cells. Therefore, when the address discharge becomes unstable in the green discharge cell and the sustain voltage is applied, the discharge is not normally discharged, and it appears to be in a flickering state or a light emission phenomenon does not occur.
따라서 본 발명은 상기한 문제점을 해소하기 위한 것으로서, 본 발명의 목적은 어드레스 신호가 나중에 인가되는 어드레스 전극의 타측 단부 근처에 위치하는 방전 셀들, 특히 녹색 방전 셀들에 있어서 방전 지연과 저방전 현상을 방지할 수 있는 플라즈마 디스플레이 패널을 제공하는데 있다.Accordingly, the present invention has been made to solve the above problems, and an object of the present invention is to prevent discharge delay and low discharge in discharge cells, particularly green discharge cells, located near the other end of the address electrode to which the address signal is applied later. A plasma display panel can be provided.
상기의 목적을 달성하기 위하여 본 발명은,In order to achieve the above object, the present invention,
제1 및 제2 기판과, 제1 기판 중 제2 기판과의 대향면 상에 형성되는 어드레스 전극들과, 제1 기판과 제2 기판의 사이 공간에 배치되어 방전 셀들을 구획하는 격벽과, 각각의 방전 셀 내에 위치하는 적색, 녹색 또는 청색의 형광층과, 제2 기판 중 제1 기판과의 대향면 상에 어드레스 전극과 교차하는 방향을 따라 형성되는 유지 전극들을 포함하며, 녹색 형광층이 어드레스 전극 방향을 따라 변화하는 두께로 형성되는 플라즈마 디스플레이 패널을 제공한다.Address electrodes formed on opposite surfaces of the first and second substrates, the second substrate of the first substrates, a partition wall disposed in a space between the first substrate and the second substrate to partition discharge cells, respectively; A red, green, or blue fluorescent layer located in a discharge cell of the first substrate; and sustain electrodes formed along a direction intersecting the address electrode on a surface opposite to the first substrate of the second substrate, wherein the green fluorescent layer is an address. Provided is a plasma display panel having a thickness varying along an electrode direction.
상기 어드레스 전극은 어드레스 신호를 인가받는 단자부를 구비하며, 녹색 형광층은 단자부로부터 멀어질수록 얇은 두께로 형성된다. 한편, 적색 형광층과 청색 형광층은 균일한 두께로 형성되고, 단자부와 가장 가까운 녹색 형광층의 두께는 적색 및 청색 형광층의 두께와 동일하게 이루어진다.The address electrode has a terminal portion to which an address signal is applied, and the green fluorescent layer is formed to a thinner thickness as it moves away from the terminal portion. Meanwhile, the red phosphor layer and the blue phosphor layer are formed to have a uniform thickness, and the thickness of the green phosphor layer closest to the terminal portion is the same as that of the red and blue phosphor layers.
이하, 첨부한 도면을 참고하여 본 발명의 바람직한 실시예를 보다 상세하게 설명하면 다음과 같다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.
도 1은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 부분 분해 사시도이고, 도 2는 도 1에 도시한 제1 기판과 어드레스 전극의 개략도이다.1 is a partially exploded perspective view of a plasma display panel according to an exemplary embodiment of the present invention, and FIG. 2 is a schematic view of a first substrate and an address electrode shown in FIG. 1.
도면을 참고하면, 본 실시예에 의한 플라즈마 디스플레이 패널(이하 'PDP'라 한다)은 제1 기판(2)과 제2 기판(4)이 임의의 간격을 두고 서로 대향 배치되고, 양 기판의 사이 공간에는 격벽(6)에 의해 구획되는 방전 셀들(8R, 8G, 8B)이 마련된다.Referring to the drawings, in the plasma display panel according to the present embodiment (hereinafter referred to as 'PDP'), the first substrate 2 and the second substrate 4 are disposed to face each other at arbitrary intervals, and between the two substrates. In the space, discharge cells 8R, 8G, and 8B partitioned by the partition 6 are provided.
먼저, 제1 기판(2)의 내면에는 일방향(도면의 Y 방향)을 따라 어드레스 전극(10)들이 형성되고, 어드레스 전극(10)들을 덮으면서 제1 기판(2)의 내면 전체에 제1 유전층(12)이 위치한다. 어드레스 전극(10)은 일례로 스트라이프 패턴으로 이루어져 이웃한 어드레스 전극(10)과 소정의 간격을 두고 나란하게 위치한다.First, address electrodes 10 are formed on an inner surface of the first substrate 2 along one direction (Y direction in the drawing), and cover the address electrodes 10 to cover the entire first inner layer of the first substrate 2. 12 is located. For example, the address electrode 10 is formed in a stripe pattern and is positioned side by side with a neighboring address electrode 10 at a predetermined interval.
상기 어드레스 전극(10)은 도 2에 도시한 바와 같이 제1 기판(2)의 상측 혹은 하측 가장자리에 단자부(10a)를 형성하고, 단자부(10a)에 도시하지 않은 칩 온 필름(COF; chip on film) 또는 테이프 캐리어 패키지(TCP; tape carrier package)와 같은 접속 부재가 실장되어 접속 부재를 통해 어드레스 전압(Va)을 인가받는다.As shown in FIG. 2, the address electrode 10 forms a terminal portion 10a at an upper side or a lower edge of the first substrate 2, and a chip on film (COF) not shown in the terminal portion 10a. A connection member such as a film or a tape carrier package (TCP) is mounted to receive an address voltage Va through the connection member.
제1 유전층(12) 위에는 격벽(6), 일례로 어드레스 전극(10)과 평행한 스트라이프 패턴의 격벽(6)이 형성되고, 격벽(6)의 측면과 제1 유전층(12) 상면에 걸쳐 적색, 녹색 및 청색의 형광층(14R, 14G, 14B)이 순서대로 마련된다. 이 때, 격벽(6)의 형상은 스트라이프 패턴에 한정되지 않으며, 격자형과 같은 폐쇄형 구조 또는 그 이외의 패턴으로 이루어질 수 있다.On the first dielectric layer 12, a partition 6, for example, a stripe pattern 6 in parallel with the address electrode 10, is formed, and red over the side surface of the partition 6 and the upper surface of the first dielectric layer 12. , Green and blue fluorescent layers 14R, 14G, 14B are provided in this order. At this time, the shape of the partition wall 6 is not limited to the stripe pattern, it may be made of a closed structure such as a lattice or other patterns.
그리고 제1 기판(2)에 대향하는 제2 기판(4)의 내면에는 어드레스 전극(10)과 직교하는 방향(도면의 X 방향)을 따라 스캔 전극(16)과 공통 전극(18)으로 이루어지는 유지 전극(20)이 형성되고, 유지 전극(20)들을 덮으면서 제2 기판(4)의 내면 전체에 투명한 제2 유전층(22)과 MgO 보호막(24)이 위치한다.In addition, the inner surface of the second substrate 4 facing the first substrate 2 is formed of the scan electrode 16 and the common electrode 18 along a direction orthogonal to the address electrode 10 (the X direction in the drawing). The electrode 20 is formed, and the second dielectric layer 22 and the MgO passivation layer 24 that are transparent are disposed on the entire inner surface of the second substrate 4 while covering the sustain electrodes 20.
본 실시예에서 스캔 전극(16)과 공통 전극(18)은 각각 스트라이프 패턴의 투명 전극(16a, 18a)과, 투명 전극(16a, 18a)의 일측 가장자리에 형성되어 투명 전극(16a, 18a)의 전압 강하를 방지하는 금속의 버스 전극(16b, 18b)으로 이루어진다. 투명 전극(16a, 18a)으로는 인듐 틴 옥사이드(ITO; indium tin oxide)가 바람직하고, 버스 전극(16b, 18b)으로는 은(Ag), 알루미늄(Al) 또는 구리(Cu)와 같은 금속 전극이 바람직하다.In this embodiment, the scan electrode 16 and the common electrode 18 are formed at the edges of one side of the transparent electrodes 16a and 18a of the stripe pattern and the transparent electrodes 16a and 18a, respectively, to form the transparent electrodes 16a and 18a. It consists of metal bus electrodes 16b and 18b which prevent the voltage drop. Indium tin oxide (ITO) is preferable as the transparent electrodes 16a and 18a, and metal electrodes such as silver (Ag), aluminum (Al), or copper (Cu) are used as the bus electrodes 16b and 18b. This is preferred.
상기 제1 기판(2)과 제2 기판(4)의 조합에 의해 어드레스 전극(10)과 유지 전극(20)이 교차하는 방전 공간이 하나의 방전 셀(8R, 8G, 8B)을 구성하며, 방전 셀(8R, 8G, 8B) 내부는 방전 가스(주로 Ne-Xe 혼합 가스)로 채워진다.The discharge space where the address electrode 10 and the sustain electrode 20 intersect by the combination of the first substrate 2 and the second substrate 4 constitutes one discharge cell 8R, 8G, 8B, The discharge cells 8R, 8G and 8B are filled with discharge gas (mainly Ne-Xe mixed gas).
여기서, 본 실시예에 의한 PDP는 (-)전하로 대전되는 녹색 형광층(14G)을 구비하여 어드레스 방전에 불리한 조건을 갖는 녹색 방전 셀(8G)에 있어서, 어드레스 방전 특성을 높이는 구성을 제공하며, 이는 어드레스 전극(10) 방향을 따라 녹색 형광층(14G)의 두께를 변화시켜 리셋 구간에 의해 생성되는 (+)전하의 양을 조절하는 것으로 이루어진다.Here, the PDP according to the present embodiment includes a green fluorescent layer 14G that is charged with a negative charge, and provides a configuration in which the address discharge characteristic is enhanced in the green discharge cell 8G having a condition unfavorable to address discharge. This is done by changing the thickness of the green fluorescent layer 14G along the direction of the address electrode 10 to adjust the amount of positive charges generated by the reset period.
도 3은 녹색 형광층의 두께 특성을 설명하기 위한 제1 기판의 부분 단면도로서, (a)는 도 2의 A-A선 단면에서의 녹색 방전 셀을, (b)는 도 2의 B-B선 단면에서의 녹색 방전 셀을, (c)는 도 2의 C-C선 단면에서의 녹색 방전 셀을 나타내고 있다.3 is a partial cross-sectional view of the first substrate for explaining the thickness characteristics of the green fluorescent layer, (a) is a green discharge cell in the cross-section line AA of Figure 2, (b) is a cross-sectional view of the line BB in Figure 2 Green discharge cell (c) has shown the green discharge cell in the CC line cross section of FIG.
도면을 참고하면, 녹색 형광층(14G)은 어드레스 전극(10)의 단자부(10a)로부터 멀어질수록 얇은 두께로 형성된다. 즉, 어드레스 전극(10)의 단자부(10a) 근처에 위치하는 녹색 방전 셀(8G-1)에서 녹색 형광층(14G)은 t1의 두께로 형성되고, 녹색 방전 셀(8G-2, 8G-3)이 어드레스 전극(10)의 단자부(10a)로부터 멀어질수록 녹색 형광층(14G)은 t1보다 작은 t2 및 t3의 두께로 형성된다. (t1 > t2 > t3)Referring to the drawing, the green fluorescent layer 14G is formed in a thinner thickness as it moves away from the terminal portion 10a of the address electrode 10. That is, in the green discharge cell 8G-1 positioned near the terminal portion 10a of the address electrode 10, the green fluorescent layer 14G is formed to a thickness of t1 and the green discharge cells 8G-2 and 8G-3. The green fluorescent layer 14G is formed to a thickness of t2 and t3 smaller than t1 as the distance from the terminal portion 10a of the address electrode 10 increases. (t1> t2> t3)
이와 같이 녹색 형광층(14G)이 어드레스 전극(10)의 단자부(10a)로부터 멀어질수록 얇은 두께로 형성됨에 따라, 리셋 구간을 통해 어드레스 전극(10) 측에 (+)전하가 축적될 때에, 어드레스 전극(10)의 단자부(10a) 근처에 위치하는 녹색 방전 셀(8G-1)에서는 (+)전하가 축적되는 양이 적어지고, 어드레스 전극(10)의 단자부(10a)와 멀리 떨어져 위치하는 녹색 방전 셀(8G-3)에서는 (+)전하가 축적되는 양이 많아진다.As the green fluorescent layer 14G is formed to be thinner as it moves away from the terminal portion 10a of the address electrode 10, when positive charges are accumulated on the address electrode 10 side through the reset period, In the green discharge cell 8G-1 positioned near the terminal portion 10a of the address electrode 10, the amount of positive charges is reduced, and is located far from the terminal portion 10a of the address electrode 10. In the green discharge cells 8G-3, the amount of positive charges is increased.
따라서 리셋 구간을 통해 어드레스 전극(10) 측에 (+)전하를 축적한 다음, 어드레스 전극(10)의 단자부(10a)를 통해 어드레스 전압(Va)을 인가하면, 단자부(10a)로부터 멀리 떨어져 어드레스 전압(Va)이 가장 늦게 인가되는 녹색 방전 셀(8G-3)에서 시간 경과에 따라 (+)전하가 손실되어도 단자부(10a) 근처의 녹색 방전 셀들(8G-1)과 단자부(10a)로부터 멀리 떨어진 녹색 방전 셀들(8G-3)에서 (+)전하의 축적 양이 실질적으로 동일하게 된다. 그 결과, 본 실시예에 의한 PDP는 후자의 녹색 방전 셀(8G-3)에서 방전 지연 및 저방전 등과 같은 방전 불량을 방지할 수 있다.Accordingly, if positive charge is accumulated on the address electrode 10 through the reset period, and then the address voltage Va is applied through the terminal portion 10a of the address electrode 10, the address is far from the terminal portion 10a. In the green discharge cells 8G-3 where the voltage Va is applied at the latest, even if positive charges are lost over time, they are far from the green discharge cells 8G-1 and the terminal parts 10a near the terminal part 10a. In the green discharge cells 8G-3, the accumulated amount of positive charges becomes substantially the same. As a result, the PDP according to the present embodiment can prevent discharge failure such as discharge delay and low discharge in the latter green discharge cell 8G-3.
바람직하게, 도 4에 도시한 바와 같이 녹색 형광층(14G)은 제1 유전층(12) 상부에 위치하는 바닥부(14a)와, 격벽(6)의 측면에 위치하는 측면부(14b)로 구성되며, 어드레스 전극(10)의 단자부(10a)로부터 멀어질수록 바닥부(14a)와 측면부(14b)의 두께가 점진적으로 얇아진다.Preferably, as shown in FIG. 4, the green fluorescent layer 14G includes a bottom portion 14a positioned above the first dielectric layer 12 and a side portion 14b positioned on the side surface of the partition wall 6. As the distance from the terminal portion 10a of the address electrode 10 increases, the thicknesses of the bottom portion 14a and the side portion 14b gradually become thinner.
한편, 도 5에 도시한 바와 같이 적색 형광층(14R)과 청색 형광층(14B)은 PDP에 설정된 모든 적색 방전 셀들(8R)과 청색 방전 셀들(8B)에서 균일한 두께로 형성되며, 어드레스 전극(10)의 단자부(10a)와 가장 가까운 녹색 방전 셀(8G-1)에 위치하는 녹색 형광층(14G)의 두께(t1)가 적색 형광층(14R) 및 청색 형광층(14B)의 두께와 동일하게 이루어질 수 있다.Meanwhile, as shown in FIG. 5, the red fluorescent layer 14R and the blue fluorescent layer 14B are formed to have a uniform thickness in all the red discharge cells 8R and the blue discharge cells 8B set in the PDP. The thickness t1 of the green fluorescent layer 14G positioned in the green discharge cell 8G-1 closest to the terminal portion 10a of (10) is equal to the thickness of the red fluorescent layer 14R and the blue fluorescent layer 14B. The same can be done.
도 6은 어드레스 전극의 단자부로부터 가장 멀리 떨어진 방전 셀들에 있어서, 적색, 녹색 및 청색 방전 셀별로 어드레스 지연 시간을 수백번 측정하여 그 결과를 나타낸 그래프이다. 그래프의 가로축은 지연 시간을 나타내고, 세로축은 해당 시간에서 어드레스 방전이 일어나지 않을 확률을 나타낸다.FIG. 6 is a graph illustrating the result of measuring an address delay time of several hundred times for each of the red, green, and blue discharge cells in the discharge cells farthest from the terminal portion of the address electrode. The horizontal axis of the graph represents the delay time, and the vertical axis represents the probability that no address discharge occurs at that time.
도면을 참고하면, 적색과 녹색 및 청색 방전 셀 모두에서 어드레스 방전 시간이 동일하게 나타나고 있음을 확인할 수 있으며, 이는 녹색 형광층(14G)의 두께 변화에 따라 녹색 방전 셀(8G)에서 방전 지연을 개선한 결과이다.Referring to the drawings, it can be seen that the address discharge time is the same in both the red, green, and blue discharge cells, which improves the discharge delay in the green discharge cell 8G according to the thickness change of the green fluorescent layer 14G. One result.
상기에서는 본 발명의 바람직한 실시예에 대하여 설명하였지만, 본 발명은 이에 한정되는 것이 아니고 특허청구범위와 발명의 상세한 설명 및 첨부한 도면의 범위 안에서 여러 가지로 변형하여 실시하는 것이 가능하고 이 또한 본 발명의 범위에 속하는 것은 당연하다.Although the preferred embodiments of the present invention have been described above, the present invention is not limited thereto, and various modifications and changes can be made within the scope of the claims and the detailed description of the invention and the accompanying drawings. Naturally, it belongs to the range of.
이와 같이 본 발명의 실시예에서는 어드레스 전극의 단자부로부터 멀어질수록 녹색 형광층이 얇은 두께로 형성됨에 따라, 단자부 근처의 녹색 방전 셀들과 단자부로부터 멀리 떨어진 녹색 방전 셀들에서 리셋 구간의 결과물인 (+)전하의 축적 양을 실질적으로 동일하게 할 수 있다. 따라서 후자의 방전 셀에서 방전 지연 및 저방전과 같은 방전 불량을 방지하여 화면 품질을 높일 수 있다.As described above, according to the exemplary embodiment of the present invention, as the green fluorescent layer is formed to be thinner as it moves away from the terminal portion of the address electrode, (+) which is a result of the reset period in the green discharge cells near the terminal portion and green discharge cells away from the terminal portion. The amount of charge accumulated can be made substantially the same. Therefore, in the latter discharge cell, it is possible to prevent discharge failure such as discharge delay and low discharge, thereby improving the screen quality.
도 1은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 부분 분해 사시도이다.1 is a partially exploded perspective view of a plasma display panel according to an embodiment of the present invention.
도 2는 도 1에 도시한 제1 기판과 어드레스 전극의 개략도이다.FIG. 2 is a schematic diagram of the first substrate and the address electrode shown in FIG. 1.
도 3과 도 4는 녹색 형광층의 두께 특성을 설명하기 위한 제1 기판의 부분 확대 단면도이다.3 and 4 are partially enlarged cross-sectional views of the first substrate for explaining the thickness characteristics of the green fluorescent layer.
도 5는 적색 방전 셀과 청색 방전 셀을 도시한 제1 기판의 부분 확대 단면도이다.5 is a partially enlarged cross-sectional view of a first substrate showing a red discharge cell and a blue discharge cell.
도 6은 어드레스 전극의 단자부로부터 가장 멀리 떨어진 방전 셀들에 있어서, 적색, 녹색 및 청색 방전 셀의 방전 지연 특성을 나타낸 그래프이다.6 is a graph showing discharge delay characteristics of red, green, and blue discharge cells in discharge cells furthest from the terminal portion of the address electrode.
도 7은 종래 기술에 의한 플라즈마 디스플레이 패널의 부분 분해 사시도이다.7 is a partially exploded perspective view of a plasma display panel according to the prior art.
도 8은 종래 기술에 의한 플라즈마 디스플레이 패널 중 적색, 녹색 및 청색 방전 셀의 방전 지연 특성을 나타낸 그래프이다.8 is a graph illustrating discharge delay characteristics of red, green, and blue discharge cells in a plasma display panel according to the related art.
Claims (4)
Priority Applications (1)
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|---|---|---|---|
| KR1020030074221A KR100599679B1 (en) | 2003-10-23 | 2003-10-23 | Plasma display panel |
Applications Claiming Priority (1)
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|---|---|---|---|
| KR1020030074221A KR100599679B1 (en) | 2003-10-23 | 2003-10-23 | Plasma display panel |
Publications (2)
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Family Applications (1)
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|---|---|---|---|
| KR1020030074221A KR100599679B1 (en) | 2003-10-23 | 2003-10-23 | Plasma display panel |
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-
2003
- 2003-10-23 KR KR1020030074221A patent/KR100599679B1/en not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
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| KR100599679B1 (en) | 2006-07-13 |
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