KR20040046330A - Storage capacitor of liquid crystal display - Google Patents

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KR20040046330A
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김종순
박현진
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엘지.필립스 엘시디 주식회사
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Abstract

PURPOSE: A storage capacitor of an LCD(Liquid Crystal Display) is provided to prevent a short of an electrode relating to a pixel electrode and a source/drain electrode within an adjacent pixel region by constructing an electrode shape forming the storage capacitor as a step shape. CONSTITUTION: A subsidiary electrode is formed as a step shape, that is, a curve. Accordingly, distances among the subsidiary electrode, source/drain electrodes(19,20), a pixel electrode(17), and a data line(15) are maintained constantly to some extent. The distance is larger than the size of a foreign substance as about 10um, so that short due to the foreign substance can be overcome. To reduce the distance between the subsidiary electrode and the data line and to increase the distance between the source/drain electrodes and the pixel electrode, the curve of step shape is formed.

Description

액정표시장치의 스토리지 캐패시터{storage capacitor of liquid crystal display}Storage capacitor of liquid crystal display

본 발명은 액정표시장치에 관한 것으로, 특히 온 게이트(on gate) 방식의 스토리지 캐패시터를 구비하는 액정표시장치의 스토리지 캐패시터의 구조에 관한 것이다.The present invention relates to a liquid crystal display device, and more particularly, to a structure of a storage capacitor of a liquid crystal display device having an on-gate storage capacitor.

일반적으로, 화상 정보를 화면에 나타내는 화면 표시 장치들 중에서 브라운관 표시 장치(CRT: Cathode Ray Tube)가 지금까지 가장 많이 사용되어 왔는데, 이것은 표시 면적에 비해 부피가 크고 무겁기 때문에 사용하는데 많은 불편함이 있다.In general, CRT (Cathode Ray Tube) has been the most used among the screen display devices that display image information on the screen, which is inconvenient to use because it is bulky and heavy compared to the display area. .

이에 따라, 표시 면적이 크더라도 그 두께가 얇아서 어느 장소에서든지 쉽게 사용할 수 있는 박막형 평판 표시 장치가 개발되었고, 점점 브라운관 표시 장치를 대체하고 있다. 특히, 액정 표시 장치(LCD : Liquid Crystal Display)는 표시 해상도가 다른 평판 표시 장치보다 뛰어나고, 동화상을 구현할 때 그 품질이 브라운관에 비할 만큼 반응 속도가 빠른 특성을 나타내고 있다.Accordingly, a thin film type flat panel display device having a small display area that can be easily used in any place even though the display area is large has been developed, and is gradually replacing the CRT display device. In particular, liquid crystal displays (LCDs) exhibit superior display resolution than other flat panel displays, and exhibit fast response speeds as compared to CRTs when a moving image is realized.

이러한 액정표시장치는 기본적으로 적어도 한쪽이 투명한 유리 등으로 이루어지는 두 장의(한 쌍의) 기판 사이에 액정층을 협지한 소위 액정패널을 구성하며,이는 일반적으로 그 구조 및 구동방법에 따라 크게 수동 매트릭스(passive matrix)형 및 액티브 매트릭스(active matrix)형 액정표시장치로 나뉘어 진다.Such a liquid crystal display device basically constitutes a so-called liquid crystal panel in which a liquid crystal layer is sandwiched between two (pair) substrates, at least one of which is made of transparent glass or the like, which is largely passive matrix depending on its structure and driving method. It is divided into a passive matrix type and an active matrix type liquid crystal display device.

수동 매트릭스형 액정표시장치는 액티브 매트릭스형에 비해 제작이 용이하고 구동방법이 간단하다는 장점을 갖고 있으나, 전력소모가 크고 주사선(scan line)의 수가 늘어날수록 구동이 어려워진다는 단점이 있고, 이에 반해 능동 매트릭스형 액정표시장치는 수동 매트릭스형의 구성과는 달리 다수의 화소영역 마다 박막트랜지스터(thin film transistor : TFT)가 포함되어, 상기 다수의 화소영역 내부의 각 화소부를 독립적으로 구동할 수 있도록 하므로 정교한 소자를 만드는 경우 효율적이라는 장점이 있다. 이러한 액티브 매트릭스형 액정표시장치는 스위칭 소자로서 박막트랜지스터를 이용하여 자연스러운 동화상을 표현하고 있다. 도 1은 종래의 액티브 매트릭스형 액정표시장치를 개략적으로 도시한 평면도이다.Passive matrix type liquid crystal display device has advantages of being easy to manufacture and simple driving method compared to active matrix type, but the disadvantage is that driving becomes more difficult as power consumption is larger and the number of scan lines is increased. Unlike the passive matrix structure, the matrix type liquid crystal display device includes a thin film transistor (TFT) in each pixel area so that each pixel part in the plurality of pixel areas can be driven independently. The advantage of making devices is that they are efficient. Such an active matrix liquid crystal display uses a thin film transistor as a switching element to express a natural moving image. 1 is a plan view schematically showing a conventional active matrix liquid crystal display device.

도 1을 참조하면, 종래의 액티브 매트릭스형 액정표시장치(11)는 블랙매트릭스(6)와 서브 칼러필터(8)를 포함하는 칼라필터(7) 상에 투명한 공통전극(18)이 형성된 상부기판(5)과, 화소영역(P) 및 화소영역 상에 형성된 화소전극(17)과 스위칭 소자(T)로서의 박막트랜지스터 및 데이터 라인(15), 게이트 라인(13)이 형성된 하부기판으로 구성되며, 상기 상부기판(5)과 하부기판(22) 사이에는 액정(14)이 충진되어 있다.Referring to FIG. 1, a conventional active matrix liquid crystal display 11 includes an upper substrate on which a transparent common electrode 18 is formed on a color filter 7 including a black matrix 6 and a sub color filter 8. (5), the pixel region P and the pixel electrode 17 formed on the pixel region, the thin film transistor as the switching element T and the lower substrate on which the data line 15 and the gate line 13 are formed. The liquid crystal 14 is filled between the upper substrate 5 and the lower substrate 22.

상기 하부기판(22)을 어레이 기판이라고도 하며, 상기 스위칭 소자인 박막트랜지스터(T)가 매트릭스형태로 위치하고, 이러한 다수의 박막트랜지스터를 교차하여 지나가는 게이트 라인(13)과 데이터 라인(15)이 형성되며, 또한 상기 게이트 라인(13)과 데이터 라인(15)이 교차하여 정의되는 영역이 상기 화소영역(P)이 되는 것이다.The lower substrate 22 is also referred to as an array substrate, and the thin film transistor T, which is the switching element, is positioned in a matrix form, and a gate line 13 and a data line 15 passing through the plurality of thin film transistors are formed. In addition, an area defined by the intersection of the gate line 13 and the data line 15 becomes the pixel area P. FIG.

여기서 상기 게이트 라인(13)은 상기 박막트랜지스터(T)의 게이트 전극(16)을 구동하는 펄스전압을 전달하며, 상기 데이터 라인(15)은 상기 박막트랜지스터(T)의 소스전극(19)을 구동하는 신호전압을 전달하는 수단이다. 이 때, 상기 게이트 전극(16)의 신호에 의해 임의의 소스 전극(19)에 액정을 구동할 수 있는 전압이 인가되고, 나머지에는 액정 구동전압보다 작은 전압이 인가된다면, 액정 구동전압이 인가된 화소만 동작을 할 것이다.The gate line 13 transfers a pulse voltage driving the gate electrode 16 of the thin film transistor T, and the data line 15 drives the source electrode 19 of the thin film transistor T. Means for transmitting a signal voltage. At this time, if a voltage capable of driving the liquid crystal is applied to an arbitrary source electrode 19 by the signal of the gate electrode 16, and a voltage smaller than the liquid crystal driving voltage is applied to the rest, the liquid crystal driving voltage is applied. Only the pixel will work.

즉, 상기 액티브 매트릭스형 액정 표시 장치는 스위칭 소자로서의 박막트랜지스터(T)와 상, 하판 전극 즉, 공통전극(18) 및 화소전극(17) 사이의 액정(14)의 존재로 인해 형성되는 캐패시터, 보조 캐패시터, 게이트 라인(13) 및 데이터 라인(15)을 구비한다.That is, the active matrix liquid crystal display device is a capacitor formed by the presence of the liquid crystal 14 between the thin film transistor T as the switching element and the upper and lower electrodes, that is, the common electrode 18 and the pixel electrode 17, Auxiliary capacitor, gate line 13 and data line 15 are provided.

또한, 상기 액정 표시 장치의 구동에 있어서는, 먼저 게이트 전극(16)에 일정한 전압이 인가되면 박막트랜지스터(T)가 턴 온(turn on)되고, 이 시간 동안에 화상에 관한 정보를 가진 데이터 신호가 상기 박막트랜지스터(T)를 통해 액정(14)에 인가되며, 이 때, 캐패시터인 액정부분은 충전되는데, 이상적인 경우 액정(14)에 충전된 총전하량은 게이트가 턴 오프(turn off)되어 다음 신호가 들어올 때까지 유지가 된다.In addition, in driving the liquid crystal display, first, when a constant voltage is applied to the gate electrode 16, the thin film transistor T is turned on, and during this time, a data signal having information about an image is displayed. It is applied to the liquid crystal 14 through the thin film transistor T. At this time, the liquid crystal portion, which is a capacitor, is charged. In the ideal case, the total charge charged in the liquid crystal 14 is turned off and the next signal is It stays in until it comes in.

액정전압 즉, 공통전극(18)과 화소전극(17) 사이의 전압은 현실적으로 액정표시장치에서 발생되는 다수의 캐패시턴스의 존재로 인하여만큼의 변동이 있으며,는 근사적으로 다음의 식에 의하여 표현된다.The liquid crystal voltage, that is, the voltage between the common electrode 18 and the pixel electrode 17 is actually due to the presence of a plurality of capacitances generated in the liquid crystal display device. As much as Is approximately expressed by the equation

여기서,는 액정전압의 변동량, Cgd는 게이트전극(16)과 드레인전극(20)의 중첩으로 존재하는 기생축적용량, CLC는 화소용량, 그리고 Cst는 스토리지 캐패시터의 축적용량 및Vg는 게이트전압의 차이을 나타내며, 이와 같은즉, 액정전압의 변동량은 액정전압의 왜곡을 발생시키기 때문에 플리커(flicker)의 주요원인이 된다.here, Is the amount of change in the liquid crystal voltage, C gd is the parasitic storage capacity that exists due to the overlap of the gate electrode 16 and the drain electrode 20, C LC is the pixel capacity, and C st is the storage capacity of the storage capacitor and V g represents the difference in gate voltage. In other words, the amount of variation in the liquid crystal voltage causes distortion of the liquid crystal voltage, which is a major cause of flicker.

이에 따라, 상기를 작게 하기 위해서는 스토리지 캐패시터의 축적용량 Cst를 증가시키는 것이 유리하며, 따라서 스토리지 캐패시터는 액정이 데이터 신호를 안정적으로 유지시키도록 하기 위해 필요한 것이다.Accordingly, the It is advantageous to increase the storage capacitor C st of the storage capacitor to make it small, so that the storage capacitor is necessary for the liquid crystal to keep the data signal stable.

또한, 상기 스토리지 캐패시터에 축적용량은 알려진 바와 같이에 의하여 축적용량의 크기가 결정되는 것이며, C는 축적용량,는 유전상수, A는 전극의 면적을 나타내고, d는 전극 간의 거리를 나타낸다.In addition, the storage capacity of the storage capacitor is The size of the storage capacity is determined by, and C is the storage capacity, Denotes the dielectric constant, A denotes the area of the electrode, and d denotes the distance between the electrodes.

여기서, 액정 표시 장치에 형성되는 상기 스토리지 캐패시터는 충전을 위한 전극을 사용하는 방식에 따라 온 컴먼(on common) 방식과 온 게이트(on gate) 방식으로 구분될 수 있다.The storage capacitor formed in the liquid crystal display may be divided into an on common method and an on gate method according to a method of using an electrode for charging.

이들 방식을 비교하면, 온 게이트 방식은 n-1번째의 게이트 라인 일부를 (n)번째 화소의 충전 전극으로 사용하는 방식으로 개구율의 감소 정도가 적고, NW 방식(Normally White Mode)에서 점결함 발생시 눈에 쉽게 띄지 않아 수율이 좋은 반면에 주사신호 시간이 길어지는 단점이 있으며, 온 컴먼 방식은 충전 전극을 별도로 배선하여 사용하는 방식으로, 주사신호 시간이 짧은 반면에 개구율의 감소 정도가 큰 장점이 있으나, NW 방식에서 점결함 발생시 눈에 쉽게 띄며, 수율이 떨어진다는 단점이 있다.Comparing these methods, the on-gate method uses a part of the n-1th gate line as the charging electrode of the (n) pixel, so that the reduction of the aperture ratio is small, and when the defect occurs in the NW method (Normally White Mode) Although the yield is good, the scan signal time is long, and there is a disadvantage in that the on-communication method uses a charging electrode separately wired, and the scan signal time is short while the decrease of the aperture ratio is large. In the NW method, when a defect occurs, it is easy to see and has a disadvantage of low yield.

현재는 온 컴먼 방식 및 온 게이트 방식에서 상기 스토리지 커패시터의 축적용량을 증가시키기 위하여 전극의 간격(d)을 좁히거나 또는 전극의 면적(A)을 확대하는 등의 시도를 하고 있다.At present, in order to increase the storage capacitance of the storage capacitor in an on-common method and an on-gate method, an attempt has been made to narrow the electrode spacing d or enlarge the area A of the electrode.

본 발명은 온 게이트(on gate) 방식의 스토리지 캐패시터를 구비하는 액정표시장치에서 상기 스토리지 커패시터를 형성하는 전극의 형태를 계단형으로 구성함으로써 상기 전극이 이웃하는 화소영역 내의 화소전극 및 소스/ 드레인 전극과 단락되는 것을 방지하는 액정표시장치의 스토리지 캐패시터를 제공함에 그 목적이 있다.According to the present invention, a pixel electrode and a source / drain electrode in neighboring pixel regions are formed by forming a stepped shape of an electrode forming the storage capacitor in a liquid crystal display having an on gate type storage capacitor. It is an object of the present invention to provide a storage capacitor of the liquid crystal display device to prevent the short circuit.

도 1은 종래의 액티브 매트릭스형 액정표시장치를 개략적으로 도시한 평면도.1 is a plan view schematically showing a conventional active matrix liquid crystal display device.

도 2는 종래의 온 게이트 방식의 스토리지 캐패시터를 구비하는 액정표시장치의 평면도.2 is a plan view of a liquid crystal display device including a conventional on-gate storage capacitor.

도 3은 도2의 특정부분(A-A')에 대한 단면도.3 is a sectional view of a specific portion A-A 'of FIG.

도 4는 상기와 같이 보조전극과 소스/ 드레인 전극간의 간격이 좁아 단락이 발생한 것을 나타내는 도면.4 is a view showing that a short circuit occurs due to a narrow gap between the auxiliary electrode and the source / drain electrode as described above.

도 5는 본 발명에 의한 온 게이트 방식의 스토리지 캐패시터를 구비하는 액정표시장치의 평면도.5 is a plan view of a liquid crystal display device having an on-gate storage capacitor according to the present invention.

<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>

13 : 게이트 라인 15 : 데이터 라인13: gate line 15: data line

17, 17' : 화소전극19 : 소스 전극17, 17 ': pixel electrode 19: source electrode

20 : 드레인 전극24, 34 : 보조전극20: drain electrode 24, 34: auxiliary electrode

①, ①' : 보조전극과 데이터라인과의 간격①, ① ': Spacing between auxiliary electrode and data line

②, ②' : 보조전극과 소스 전극과의 간격②, ② ': spacing between auxiliary electrode and source electrode

③, ③' : 보조전극과 드레인 전극과의 간격③, ③ ': distance between the auxiliary electrode and the drain electrode

④, ④' : 보조전극과 화소전극과의 간격④, ④ ': distance between auxiliary electrode and pixel electrode

⑤, ⑤ : 보조전극과 화소전극과의 간격⑤, ⑤: spacing between auxiliary electrode and pixel electrode

상기 목적을 달성하기 위하여 본 발명에 의한 액정표시장치의 스토리지 캐패시터는, 기판과, 상기 기판 상에 형성된 게이트 라인과, 상기 게이트 라인을 덮는 게이트 절연막과, 상기 게이트 라인에 중첩되도록 상기 게이트 절연막 위에 형성되는 계단 형태의 스토리지 캐패시터용 보조전극이 포함되는 것을 특징으로 한다.In order to achieve the above object, a storage capacitor of a liquid crystal display according to the present invention includes a substrate, a gate line formed on the substrate, a gate insulating film covering the gate line, and a gate capacitor formed on the gate insulating film so as to overlap the gate line. It characterized in that the auxiliary electrode for the storage capacitor of the stepped form is included.

또한, 상기 계단 형태의 보조전극은 일정부분 굴곡이 형성된 보조전극으로서 상기 굴곡에 의해 상기 보조전극과 데이터 라인 및 소스전극, 드레인 전극, 화소전극 간의 간격이 각각 일정하게 유지되는 것을 특징으로 하며, 또한 상기 보조전극과 데이터 라인 및 소스전극, 드레인 전극, 화소전극 간에 각각 유지되는 일정한 간격이 10um임을 특징으로 한다.In addition, the staircase auxiliary electrode is an auxiliary electrode having a predetermined portion of curvature, and the spacing between the auxiliary electrode, the data line, the source electrode, the drain electrode, and the pixel electrode is constantly maintained by the bending. The auxiliary electrode and the data line and the source electrode, the drain electrode, the pixel electrode is maintained at a constant interval, respectively characterized in that 10um.

또한, 좀 더 바람직하게는 상기 보조전극과 상기 데이터 라인과의 간격이 10um이고, 상기 보조전극과 상기 소스 전극과의 간격이 10um이고, 상기 보조전극과 상기 드레인 전극과의 간격이 11um이며, 상기 보조전극과 상기 화소전극과의 간격이 7 ~ 8.9um임을 특징으로 한다.More preferably, the spacing between the auxiliary electrode and the data line is 10um, the spacing between the auxiliary electrode and the source electrode is 10um, and the spacing between the auxiliary electrode and the drain electrode is 11um. The distance between the auxiliary electrode and the pixel electrode is 7 ~ 8.9um.

또한, 상기 보조전극을 포함하는 기판의 노출된 전면을 덮는 보호막과, 상기 보호막에 상기 보조전극을 노출시키도록 형성된 콘택홀과, 상기 노출된 보조전극에 연결되는 화소전극이 더 포함하는 되는 것을 특징으로 한다.The display device may further include a passivation layer covering an exposed front surface of the substrate including the auxiliary electrode, a contact hole formed to expose the auxiliary electrode on the passivation layer, and a pixel electrode connected to the exposed auxiliary electrode. It is done.

이와 같은 본 발명에 의하면 스토리지 캐패시터의 축적용량은 유지하면서 상기 스토리지 커패시터를 형성하는 전극의 형태를 계단형으로 구성함으로써 상기 전극이 이웃하는 화소영역 내의 화소전극 및 소스/ 드레인 전극과 단락되는 것을 방지하여 액정표시장치의 수율을 향상시키는 장점이 있다.According to the present invention as described above by forming a stepped shape of the electrode forming the storage capacitor while maintaining the storage capacitance of the storage capacitor to prevent the short circuit with the pixel electrode and the source / drain electrode in the adjacent pixel region There is an advantage of improving the yield of the liquid crystal display device.

이하 첨부된 도면을 참조하여 본 발명에 의한 실시예를 상세히 설명하도록 한다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 2는 온 게이트 방식의 스토리지 캐패시터를 구비하는 액정표시장치의 평면구조를 나타낸 것이다.2 illustrates a planar structure of a liquid crystal display device having an on-gate storage capacitor.

단, 도 2는 도 1에서의 하판 즉, 어레이 기판의 소정 부분으로 스위칭 소자인 박막트랜지스터(T)와, 이러한 박막트랜지스터를 교차하여 지나가는 게이트 라인(13)과 데이터 라인(15) 및 상기 게이트 라인(13)과 데이터 라인(15)이 교차하여 정의되는 영역이 상기 화소영역(P)의 일부에 대한 도면이다.2 shows a thin film transistor T, which is a switching element, a gate line 13, a data line 15, and the gate line passing through the thin film transistor. An area defined by the intersection of 13 and the data line 15 is a view of part of the pixel area P. As shown in FIG.

도 2를 참조하면, 온 게이트 방식의 스토리지 캐패시터에 있어 축적용량을 증가시키기 위해 n-1번째 게이트 라인(13)의 일부와 이에 중첩되는 n번째 화소전극(17')의 일부를 n번째 화소의 스토리지 캐패시터용 전극으로 사용하지 않고, 상기 n-1번째 게이트 라인 상부에 형성된 게이트 절연막 위에 n번째 화소전극(17')과 연결되는 보조전극(24)을 형성한다.Referring to FIG. 2, in order to increase the storage capacity of an on-gate storage capacitor, a portion of the n−1 th gate line 13 and a portion of the n th pixel electrode 17 ′ overlapped with the n th pixel may be formed. The auxiliary electrode 24 connected to the n th pixel electrode 17 ′ is formed on the gate insulating layer formed on the n−1 th gate line instead of the storage capacitor electrode.

이는 종래의 스토리지 커패시터의 경우 n-1번째 게이트 라인(13)과 n번째 화소전극(17')을 스토리지 커패시터의 전극들로 이용하기 때문에 게이트 절연막과 보호막이 유전막이 되나, 상기 게이트 절연막 상에 상기 n번째 화소전극(17')과 연결되는 보조전극(24)을 형성할 경우에는 상기 보조전극(24)이 형성된 부분에는 보조전극(24)과 상기 n-1번째 게이트 라인(13)이 스토리지 캐패시터의 전극들이 되기 때문에 게이트 절연막 만을 유전막으로 사용하여 유전막의 두께를 감소시킴으로써 상기 전극들의 간격이 줄어들어 스토리지 캐패시터의 축적용량을 증가시킬 수 있기 때문이다.This is because in the conventional storage capacitor, since the n−1 th gate line 13 and the n th pixel electrode 17 ′ are used as electrodes of the storage capacitor, the gate insulating layer and the protective layer become dielectric layers. In the case of forming the auxiliary electrode 24 connected to the n-th pixel electrode 17 ', the auxiliary electrode 24 and the n-th gate line 13 are formed at the portion where the auxiliary electrode 24 is formed. This is because the thickness of the dielectric film is reduced by using only the gate insulating film as the dielectric film because the electrodes are formed in the electrodes, thereby increasing the storage capacitor storage capacity.

도 3은 도2의 특정부분(A-A')에 대한 단면으로, 즉 상기 보조전극 및 게이트 라인에 대한 단면도이다.3 is a cross-sectional view of a specific portion A-A 'of FIG. 2, that is, a cross-sectional view of the auxiliary electrode and the gate line.

도 3을 참조하면, 기판(30) 상에 게이트 전극을 포함하는 게이트 라인(13)이형성되어 있고, 게이트 라인(13)을 포함하는 기판(30)의 노출된 면에 게이트 절연막(25)이 형성되어 있다. 그리고, 상기 게이트 절연막(25) 상에는 소스/ 드레인 형성용 금속층으로 형성된 보조전극(24)이 형성되어 있다. 또한, 상기 보조전극(24)을 보호막(26)이 덮고 있으며, 보호막(26)에는 보조전극의 일부를 노출시키는 콘택홀(미도시)이 형성되어 있고, 상기 콘택홀을 통하여 화소전극(17 )이 보조전극(24)과 연결되면서 보호막(26) 상에 형성되어 있다.Referring to FIG. 3, a gate line 13 including a gate electrode is formed on a substrate 30, and a gate insulating layer 25 is formed on an exposed surface of the substrate 30 including the gate line 13. It is. An auxiliary electrode 24 formed of a metal layer for source / drain formation is formed on the gate insulating layer 25. In addition, the passivation layer 26 covers the auxiliary electrode 24, and a contact hole (not shown) for exposing a part of the auxiliary electrode is formed in the passivation layer 26, and the pixel electrode 17 is formed through the contact hole. It is formed on the passivation layer 26 while being connected to the auxiliary electrode 24.

상기 구조에서 보조전극(24)과 이에 중첩되는 게이트 라인(13) 부분 및 보조전극(24)과 중첩되지 않는 화소전극(17') 부분과 이에 중첩되는 게이트라인(13) 부분이 스토리지 캐패시터의 축적용량을 만든다.In the above structure, the storage electrode accumulates in the auxiliary electrode 24, the gate line 13 overlapping with the auxiliary electrode 24, the pixel electrode 17 ′ not overlapping with the auxiliary electrode 24, and the gate line 13 overlapping with the auxiliary electrode 24. Make capacity.

상기에서 살펴본 바와 같이 현재는 별도의 보조전극을 형성하여 각 전극의 간격을 줄임으로써 축적용량을 증가시키고 있으며, 또한 상기 보조전극의 면적(A)도 최대한 넓힘으로 축적용량을 증가시키고 있다.As described above, at present, a separate auxiliary electrode is formed to reduce the spacing of each electrode, thereby increasing the storage capacity, and also increasing the storage capacity by increasing the area A of the auxiliary electrode as much as possible.

그러나, 이와 같이 별도의 보조전극을 형성하고 상기 보조전극의 면적을 넓히는 경우 도 2에 나타난 바와 상기 보조전극(24)과 n번째 화소영역에 형성된 소스/ 드레인 전극(19, 20), 화소전극(17) 등과의 거리가 짧아지게 되어 주위 환경 또는 공정시 발생되는 이물에 의해 상기 보조전극(24)과 소스/ 드레인 전극(19, 20), 화소전극(17) 등이 단락되는 현상이 발생되기 한다.However, in the case of forming a separate auxiliary electrode and increasing the area of the auxiliary electrode as shown in FIG. 2, the source / drain electrodes 19 and 20 and the pixel electrode formed in the auxiliary electrode 24 and the n-th pixel region are shown in FIG. 2. 17) the short distance between the auxiliary electrode 24, the source / drain electrodes 19 and 20, the pixel electrode 17, etc. may occur due to the foreign environment generated during the environment or the process. .

도 4는 상기와 같이 보조전극과 소스/ 드레인 전극간의 간격이 좁아 단락이 발생한 것을 나타내는 도면이다.FIG. 4 is a diagram illustrating that a short circuit occurs because the gap between the auxiliary electrode and the source / drain electrode is narrow as described above.

도 2 및 도 4를 참조하면, 상기 보조전극(24)과 데이터 라인(15)과의 거리(①)는 상대적으로 멀지만, 그 밖에 소스 전극(19)과의 거리(②), 드레인 전극(20)과의 거리(③), 화소전극(17)과의 거리(④, ⑤)가 가깝게 형성되어 있으므로, 상기와 같이 이물에 의해 단락되는 현상이 발생하게 되고, 이 경우 상기 단락이 발생된 화소영역에 있어서는 화상을 표시하지 못하게 된다.Referring to FIGS. 2 and 4, although the distance ① between the auxiliary electrode 24 and the data line 15 is relatively far, other distances (②) from the source electrode 19 and the drain electrode ( Since the distance ③ to 20 and the distances ④ and ⑤ to the pixel electrodes 17 are close to each other, a short circuit occurs due to a foreign substance as described above. In the area, the image cannot be displayed.

여기서, 도 4는 이물에 의해 상기 보조전극과 상기 드레인 전극 및/ 또는 화소전극이 단락된 여러가지 상태를 나타내고 있다.4 shows various states in which the auxiliary electrode, the drain electrode, and / or the pixel electrode are shorted by foreign matter.

도 5는 본 발명에 의한 온 게이트 방식의 스토리지 캐패시터를 구비하는 액정표시장치의 평면구조를 나타낸 것이다.5 illustrates a planar structure of a liquid crystal display device having an on-gate storage capacitor according to the present invention.

단, 도 5는 도 2와 동일한 영역에 대한 도면으로서 어레이 기판의 소정 부분으로 스위칭 소자인 박막트랜지스터(T)와, 이러한 박막트랜지스터를 교차하여 지나가는 게이트 라인(13)과 데이터 라인(15) 및 상기 게이트 라인(13)과 데이터 라인(15)이 교차하여 정의되는 영역이 상기 화소영역(P)의 일부에 대한 도면이며, 따라서, 도 2와 동일한 구성요소에 대해서는 동일한 도면부호를 사용한다.FIG. 5 is a view of the same region as in FIG. 2, but a thin film transistor T, which is a switching element, is formed on a predetermined portion of the array substrate, a gate line 13 and a data line 15 passing through the thin film transistor, and the A region defined by the intersection of the gate line 13 and the data line 15 is a view of a part of the pixel region P. Therefore, the same reference numerals are used for the same components as in FIG.

도 5를 참조하여 본 발명에 의한 온 게이트 방식의 스토리지 캐패시터를 구비하는 액정표시장치를 설명하면 다음과 같다.Referring to FIG. 5, a liquid crystal display including an on-gate storage capacitor according to the present invention will be described.

본 발명에 의한 온 게이트 방식의 스토리지 캐패시터는, 도 2에 도시된 바와 동일하게 축적용량을 증가시키기 위해 n-1번째 게이트 라인(13)의 일부와 이에 중첩되는 n번째 화소전극(17')의 일부를 n번째 화소의 스토리지 캐패시터용 전극으로 사용하지 않고, 상기 n-1번째 게이트 라인(13) 상부에 형성된 게이트 절연막 위에 n번째 화소전극(17')과 연결되는 보조전극(34)을 형성한다.In the on-gate storage capacitor according to the present invention, as shown in FIG. 2, a portion of the n−1 th gate line 13 and the n th pixel electrode 17 ′ overlapping the same may be used to increase the storage capacitance. Instead of using a portion of the n-th pixel as a storage capacitor electrode, an auxiliary electrode 34 connected to the n-th pixel electrode 17 'is formed on the gate insulating layer formed on the n-th gate line 13. .

이는 상기 설명한 바와 같이 상기 보조전극(34)이 형성된 부분에는 보조전극(34)과 상기 n-1번째 게이트 라인(13)이 스토리지 캐패시터의 전극들이 되기 때문에 게이트 절연막만을 유전막으로 사용하여 유전막의 두께를 감소시킴으로써 상기 전극들의 간격이 줄어들어 스토리지 캐패시터의 축적용량을 증가시킬 수 있기 때문이다.As described above, since the auxiliary electrode 34 and the n−1 th gate line 13 serve as electrodes of the storage capacitor in the portion where the auxiliary electrode 34 is formed, only the gate insulating film is used as the dielectric film, thereby reducing the thickness of the dielectric film. This is because by reducing the spacing of the electrodes can increase the storage capacity of the storage capacitor.

단, 본 발명에 의할 경우 상기 보조전극(34)의 형태가 도 5에 도시된 바와 같이 계단 형태를 이루고 있으며, 이는 도 2에 도시된 액정표시장치의 보조전극(34)의 형태와 구별되는 것이다.However, according to the present invention, the auxiliary electrode 34 has a stepped shape as shown in FIG. 5, which is distinguished from the shape of the auxiliary electrode 34 of the LCD shown in FIG. 2. will be.

좀 더 상세히 설명하면, 본 발명에 의한 상기 보조전극(34)이 계단 형태 즉, 일정부분 굴곡이 있는 형태로 형성되어 있고, 이를 통하여 도 2에 도시된 보조전극(24)과는 달리 상기 보조전극(34)과 소스/ 드레인 전극(19, 20) 및 화소전극(17) 등과의 거리를 일정하게 유지할 수 있게 된다.In more detail, the auxiliary electrode 34 according to the present invention is formed in a step shape, that is, in a shape having a predetermined portion, and through this, unlike the auxiliary electrode 24 shown in FIG. The distance between the 34 and the source / drain electrodes 19 and 20 and the pixel electrode 17 can be kept constant.

결국 본 발명에 의한 보조전극(34)을 이용할 경우 도 4에서 나타난 문제점 즉, 보조전극과 소스 전극과의 거리, 드레인 전극과의 거리, 화소전극과의 거리가 가깝게 형성되어 주위 환경 또는 공정시 발생되는 이물에 의해 상기 전극간 단락 되는 현상이 발생하게 되어 상기 단락이 발생된 화소영역에 있어서는 화상을 표시하지 못하게 되는 현상을 극복할 수 있게 된다.As a result, when the auxiliary electrode 34 according to the present invention is used, the problem shown in FIG. 4, that is, the distance between the auxiliary electrode and the source electrode, the distance between the drain electrode, and the distance between the pixel electrode are formed to be close to each other. The phenomenon that the short circuit between the electrodes is caused by the foreign matter that can be caused to overcome the phenomenon that the image is not displayed in the pixel region where the short circuit occurs.

본 발명에 의한 상기 보조전극(34)은 일정하게 계단 형태의 굴곡을 형성하게 되는데, 상기 굴곡은 상기 보조전극(34)과 소스/ 드레인 전극(19, 20), 화소전극(17) 및 데이터 라인(15)간의 간격을 일정하게 유지하게끔 형성된다.The auxiliary electrode 34 according to the present invention is to form a step-shaped bend constantly, the bend is the auxiliary electrode 34 and the source / drain electrodes 19 and 20, the pixel electrode 17 and the data line It is formed to keep the interval between the 15 constant.

도 2를 참조하면, 종래의 보조전극(24)의 경우 보조전극(24)과 데이터 라인(15)과의 간격(①)은 상대적으로 멀지만, 그 밖에 소스 전극(19)과의 간격(②), 드레인 전극(20)과의 간격(③), 화소전극(17)과의 간격(④, ⑤)이 가깝게 형성되어 있는데, 일반적으로 상기 데이터 라인과의 간격(①)은 약 26.6um정도이고, 상기 소스 전극과의 간격(②)은 약 9.1um, 상기 드레인 전극과의 간격(③)은 약 7.4um, 상기 화소전극과의 간격(④,⑤)은 5.3um 정도이다.Referring to FIG. 2, in the case of the conventional auxiliary electrode 24, the distance ① between the auxiliary electrode 24 and the data line 15 is relatively far, but the distance between the source electrode 19 and ② ), The gap (③) from the drain electrode 20 and the distance (④, ⑤) from the pixel electrode 17 are formed close to each other. In general, the distance (①) from the data line is about 26.6 μm. The distance (②) from the source electrode is about 9.1 um, the distance ③ from the drain electrode is about 7.4 um, and the distance (④, ⑤) from the pixel electrode is about 5.3 um.

이에 상기 주위 환경에 의해 또는 공정시 발생되는 이물의 사이즈는 보통 10um 미만으로 형성되므로 상대적으로 보조전극과 소스/ 드레인 전극 및 화소전극 간의 간격보다 큰 이물이 발생될 경우에는 쉽게 단락이 발생되는 것이다.Accordingly, since the size of foreign matters generated by the surrounding environment or during the process is usually less than 10 μm, a short circuit occurs easily when foreign matters larger than a distance between the auxiliary electrode, the source / drain electrode, and the pixel electrode are generated.

이를 극복하기 위해 본 발명에 의한 보조전극은 상기 보조전극과 데이터 라인간의 간격을 줄이면서, 상기 소스/ 드레인 전극 및 화소전극 간의 간격을 크게 하기 위해 계단 형태의 굴곡을 가진 형태로 형성된다.In order to overcome this problem, the auxiliary electrode according to the present invention is formed in a stepped shape to reduce the distance between the auxiliary electrode and the data line and to increase the distance between the source / drain electrode and the pixel electrode.

즉, 상기 계단 형태의 굴곡은 상기 보조전극(34)과 데이터 라인(15) 및 소스/ 드레인 전극(19, 20), 화소전극(17) 간의 간격을 상기 이물의 사이즈보다는 큰 상태로 일정하게 하기 위함이다.That is, the step-shaped bending is to make the distance between the auxiliary electrode 34, the data line 15, the source / drain electrodes 19 and 20, and the pixel electrode 17 to be larger than the size of the foreign material. For sake.

도 5를 참조하면, 본 발명에 의한 보조전극(34)의 경우 보조전극(34)과 데이터 라인(15)과의 간격(①') 및 그 밖에 소스 전극(19)과의 간격(②'), 드레인 전극(20)과의 간격(③'), 화소전극(17)과의 간격(④', ⑤')을 어느 정도 일정하게 형성되어 있는데, 상기 간격은 일반적인 이물의 사이즈보다는 크도록 형성되는 것으로 10um정도를 유지하게끔 함으로써 상기 이물에 의한 단락 현상을 극복할 수 있다.Referring to FIG. 5, in the case of the auxiliary electrode 34 according to the present invention, an interval ① ′ between the auxiliary electrode 34 and the data line 15 and other intervals ② ′ between the source electrode 19 and others. The gap (3 ′ ') with the drain electrode 20 and the distance (4 ′, ⑤ ′) with the pixel electrode 17 are formed to a certain degree, and the gap is formed to be larger than the size of a general foreign material. It is possible to overcome the short-circuit phenomenon caused by the foreign matter by maintaining about 10um.

상기 간격에 대한 일 실시예로서, 상기 보조전극과 상기 데이터 라인과의 간격(①')은 약 10um정도이고, 상기 소스 전극과의 간격(②')은 약 10um, 상기 드레인 전극과의 간격(③')은 약 11um, 상기 화소전극과의 간격(④', ⑤')은 7 ~ 8.9um 정도로 형성시킬 수 있다. 단, 상기 수치는 이에 한정되는 것은 아니다.As an example of the spacing, the spacing (① ') of the auxiliary electrode and the data line is about 10 um, the spacing (②') of the source electrode is about 10 um, and the spacing of the drain electrode ( ③ ') may be formed to about 11um, and the distances ④' and ⑤ 'with the pixel electrode may be about 7 to 8.9um. However, the numerical value is not limited thereto.

이상의 설명에서와 같이 본 발명에 따른 액정표시장치의 스토리지 캐패시터 구조에 의하면 스토리지 캐패시터의 축적용량은 유지하면서 상기 스토리지 커패시터를 형성하는 전극의 형태를 계단형으로 구성함으로써 상기 전극이 이웃하는 화소영역 내의 화소전극 및 소스/ 드레인 전극과 단락되는 것을 방지하여 액정표시장치의 수율을 향상시키는 장점이 있다.As described above, according to the storage capacitor structure of the liquid crystal display according to the present invention, the electrodes in the pixel region adjacent to each other are formed by forming a stepped shape of the electrode forming the storage capacitor while maintaining the storage capacitor. There is an advantage of improving the yield of the liquid crystal display by preventing the short circuit with the electrode and the source / drain electrode.

Claims (8)

액정표시장치의 스토리지 캐패시터에 있어서,In the storage capacitor of the liquid crystal display device, 기판과,Substrate, 상기 기판 상에 형성된 게이트 라인과,A gate line formed on the substrate, 상기 게이트 라인을 덮는 게이트 절연막과,A gate insulating film covering the gate line; 상기 게이트 라인에 중첩되도록 상기 게이트 절연막 위에 형성되는 계단 형태의 스토리지 캐패시터용 보조전극이 포함되는 것을 특징으로 하는 액정표시장치의 스토리지 캐패시터.And a second electrode for a storage capacitor having a step shape formed on the gate insulating layer so as to overlap the gate line. 제 1항에 있어서,The method of claim 1, 상기 계단 형태의 보조전극은 일정부분 굴곡이 형성된 보조전극으로서 상기 굴곡에 의해 상기 보조전극과 데이터 라인 및 소스전극, 드레인 전극, 화소전극 간의 간격이 각각 일정하게 유지되는 것을 특징으로 하는 액정표시장치의 스토리지 캐패시터.The staircase auxiliary electrode is an auxiliary electrode having a predetermined portion of curvature, and the gap between the auxiliary electrode, the data line, the source electrode, the drain electrode, and the pixel electrode is constantly maintained by the bending. Storage capacitors. 제 2항에 있어서,The method of claim 2, 상기 보조전극과 데이터 라인 및 소스전극, 드레인 전극, 화소전극 간에 각각 유지되는 일정한 간격이 10um임을 특징으로 하는 액정표시장치의 스토리지 캐패시터.The storage capacitor of the liquid crystal display device, characterized in that the constant interval is maintained between the auxiliary electrode, the data line, the source electrode, the drain electrode, the pixel electrode, respectively 10um. 제 2항에 있어서,The method of claim 2, 상기 보조전극과 상기 데이터 라인과의 간격이 10um임을 특징으로 하는 액정표시장치의 스토리지 캐패시터.The storage capacitor of the liquid crystal display device, characterized in that the distance between the auxiliary electrode and the data line is 10um. 제 2항에 있어서,The method of claim 2, 상기 보조전극과 상기 소스 전극과의 간격이 10um임을 특징으로 하는 액정표시장치의 스토리지 캐패시터.The storage capacitor of the liquid crystal display device, characterized in that the interval between the auxiliary electrode and the source electrode is 10um. 제 2항에 있어서,The method of claim 2, 상기 보조전극과 상기 드레인 전극과의 간격이 11um임을 특징으로 하는 액정표시장치의 스토리지 캐패시터.The storage capacitor of the liquid crystal display device, characterized in that the interval between the auxiliary electrode and the drain electrode is 11um. 제 2항에 있어서,The method of claim 2, 상기 보조전극과 상기 화소전극과의 간격이 7 ~ 8.9um임을 특징으로 하는 액정표시장치의 스토리지 캐패시터.The storage capacitor of the liquid crystal display device, characterized in that the interval between the auxiliary electrode and the pixel electrode is 7 ~ 8.9um. 제 1항에 있어서,The method of claim 1, 상기 보조전극을 포함하는 기판의 노출된 전면을 덮는 보호막과, 상기 보호막에 상기 보조전극을 노출시키도록 형성된 콘택홀과, 상기 노출된 보조전극에 연결되는 화소전극이 더 포함하는 되는 것을 특징으로 하는 액정표시장치의 스토리지 캐패시터.And a protective film covering an exposed entire surface of the substrate including the auxiliary electrode, a contact hole formed to expose the auxiliary electrode in the protective film, and a pixel electrode connected to the exposed auxiliary electrode. Storage capacitors in liquid crystal displays.
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