KR20040022505A - Apparatus for cooperating with private branch exchange in integrated access device - Google Patents

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KR20040022505A
KR20040022505A KR1020020054097A KR20020054097A KR20040022505A KR 20040022505 A KR20040022505 A KR 20040022505A KR 1020020054097 A KR1020020054097 A KR 1020020054097A KR 20020054097 A KR20020054097 A KR 20020054097A KR 20040022505 A KR20040022505 A KR 20040022505A
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고영훈
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Abstract

PURPOSE: An interworking device with a PBX in an IAD(Integrated Access Device) is provided to directly connect PCM data to a highway of a PBX, and to replace an SPI(Serial Port Interface) for exchanging information between a DSP and a CODEC and a logic for exchanging information between the CODEC and an SLIC(Subscriber Line Interface Circuit), thereby interworking with the PBX. CONSTITUTION: A DSP(10) connects PCM-related data to a highway of a PBX, and controls SLIC information through an SPI. A CPLD(Complex Programmable Logic Device)(22) directly supplies the SLIC information given through the SPI from the DSP(10) to a private exchange. The CPLD(22) transmits the SLIC information through the SPI, reads a state of an SLIC, reflects a detected hook-off state on a state of the SLIC, and generates a ring signal. A TMC(Trunk Module Controller)(24) interfaces between the CPLD(22) and the private exchange.

Description

통합 액세스 장치에서 사설교환시스템과의 연동 장치{APPARATUS FOR COOPERATING WITH PRIVATE BRANCH EXCHANGE IN INTEGRATED ACCESS DEVICE}APAPATUS FOR COOPERATING WITH PRIVATE BRANCH EXCHANGE IN INTEGRATED ACCESS DEVICE}

본 발명은 유선통신시스템에서 통합 액세스 장치(IAD: Integrated Access Device)에 관한 것으로, 특히 키폰 시스템과 같은 사설교환시스템과 연동하기 위한 IAD의 연동 장치에 관한 것이다.The present invention relates to an integrated access device (IAD) in a wired communication system, and more particularly, to an interworking device of an IAD for interworking with a private exchange system such as a key phone system.

일반적으로 통합 액세스 장치는 몇 개의 DSL(Digital Subscriber Line) 포트를 가진 채널 서비스 유닛으로부터 음성 ATM(Asynchronous Transfer Mode), 프레임 릴레이 등 서로 다른 데이터 액세스를 위한 다중 모듈을 관리하는 고성능 액세스 기능을 갖춘 장비를 말하는 것으로서, 통신 업체가 한꺼번에 제공하는 토털 장비의 사용시보다는 이러한 IAD를 설치함으로써 통신 서비스의 통합과 대역폭의 확장, 네트웍의 통제 등에 있어 유리한 점이 많다.Typically, integrated access devices are equipped with high-performance access equipment that manages multiple modules for different data accesses, such as voice Asynchronous Transfer Mode (ATM) and frame relay, from a channel service unit with several Digital Subscriber Line (DSL) ports. In other words, there are many advantages in consolidating communication services, expanding bandwidth, and controlling the network by installing these IADs rather than using the total equipment provided by the telecommunications companies.

특히 VoDSL(Voice over DSL) 장비의 일종인 IAD의 경우, ADSL(Asymmetric DSL) 등을 이용하여 음성 및 데이터 통신을 동시에 지원하며, 이때 음성 통신을 지원하는 포트에 연결되는 전화기 등과 같은 음성 통화 장치는 IAD 내부의 음성 처리용 디지털 신호 프로세서(DSP: Digital Signal Processor)와 코덱(CODEC: Coder Decoder) 등을 이용한 아날로그 음성 신호의 디지털 처리 과정을 거쳐 송수신이 이루어지게 된다.In particular, IAD, a type of Voice over DSL (VoDSL) equipment, supports voice and data communication simultaneously using Asymmetric DSL (ADSL), and at this time, voice call devices such as a telephone connected to a port that supports voice communication Transmitting and receiving is performed through digital processing of an analog voice signal using a digital signal processor (DSP) and a coder decoder (CODEC) for processing a voice inside the IAD.

이러한 IAD는 DSL 서비스 가입자 댁내에서 하나의 전화선을 통해 DSL 데이터 서비스와 하나 이상의 전화 또는 팩스 서비스를 기존에 받던 전화 서비스와 동일하게 가입자 댁내에 위치한 IAD를 통한 패킷 기반 음성 트래픽을 기존 음성 신호로 변형하여 스위치를 통해 PSTN(Public Switched Telephone Network)으로 전달하는기능 및 그 반대의 기능을 수행하는 ATM 망과 PSTN과의 정합 기능을 가진다.This IAD transforms packet-based voice traffic through the IAD located in the subscriber's premises into the existing voice signal, which is the same as the existing telephone service receiving DSL data service and one or more telephone or fax services over the DSL service subscriber's premises. It has a matching function between the ATM network and the PSTN which performs the function of transferring to a public switched telephone network (PSTN) through a switch and vice versa.

이러한 IAD에서 "삼성 IAD"를 예로 들어 설명하면 삼성 IAD는 ADSL을 인터페이스로 한 데이터 및 음성 통신이 가능한 제품으로, 이는 바이라타(Virata) CPU(Helium)를 이용하여 VoDSL 2/4포트를 지원하며, 10/100 기반-T 이더넷 데이터 포트 지원이 가능하다. 도 1을 참조하면, 상기 삼성 IAD는 VoDSL의 구현을 위해서 DSP(Magnesium)(10)와 코덱(T8536)(12)사이에 PCM 데이터(PCMTX, PCMRX, FSX, PCMCLK)를 전송하고, 코덱(12)에서 SLIC(Subscriber Line Interface Circuit)(L9215)(14)과의 정보를 교환하기 위하여 DSP(10)에서 코덱(12)을 제어하게 된다. 도 1에는 이외에도 DSP(10)의 주변에 클럭 분주 및 HPI(Host Port Interface) 관련 동작 등을 하기 위한 CPLD(16)가 구비된다.Samsung IAD is a product that enables data and voice communication using ADSL interface, which supports VoDSL 2/4 port using Viirata CPU (Helium). It also supports 10 / 100-based Ethernet data ports. Referring to FIG. 1, the Samsung IAD transmits PCM data (PCMTX, PCMRX, FSX, PCMCLK) between a DSP (Magnesium) 10 and a codec T8536 12 to implement VoDSL. The codec 12 is controlled by the DSP 10 in order to exchange information with the subscriber line interface circuit (SLIC) L9215 and 14. In addition to FIG. 1, a CPLD 16 is provided around the DSP 10 to perform clock division and host port interface (HPI) related operations.

DSP(10)에서 코덱(12)을 제어하기 위해 양자간에 SPI(Serial Port Interface)통신을 한다. SPI는 전송 클럭(DCLK), 칩 선택(CS: chip select), 입력 데이터(DI: data in), 출력 데이터(DO: data out)로 구성되며, DSP(10)가 정상동작을 하게 되면 5ms마다 상기 CS와 DCLK가 발생하게 된다. 이때 DSP(10)와 CODEC(12)은 서로의 정보를 교환하게 된다. 여기서 교환되는 데이터를 통해 DSP(10)는 각각의 SLIC(14)의 상태를 알게되며, 코덱(12)을 통해 각 SLIC(14)의 상태 변화에 대한 커맨드(command)를 내려보낸다. SPI의 DO(Data out)은 채널당 32 비트 직렬 데이터로 구성되며, 전송은 8비트씩 구성되는 '커맨드', '어드레스', '길이', '데이터' 순으로 전송된다.In order to control the codec 12 in the DSP 10, SPI (Serial Port Interface) communication is performed between the two. SPI consists of transmission clock (DCLK), chip select (CS: chip select), input data (DI: data in), and output data (DO: data out), and every 5ms when DSP 10 operates normally The CS and DCLK are generated. At this time, the DSP 10 and the CODEC 12 exchange information with each other. Here, the DSP 10 knows the state of each SLIC 14 through the data exchanged, and issues a command for changing the state of each SLIC 14 through the codec 12. Data out (DO) of SPI consists of 32 bits of serial data per channel, and transmission is transmitted in the order of 'command', 'address', 'length', and 'data' which consists of 8 bits.

이와 같이 구성되는 IAD에서는 일반적으로 일반 전화기인 디지털 가입자 라인과 연동하기 위한 코덱(12) 및 SLIC(14) 등의 구조를 가지나, 사설교환시스템(예를 들어 '삼성 키폰 시스템[DCS-828]')과의 연동을 위한 구조는 고려되지 않았다.The IAD configured as described above generally has a structure such as a codec 12 and a SLIC 14 for interworking with a digital subscriber line, which is a general telephone, but a private exchange system (for example, 'Samsung Key Phone System [DCS-828]'). ), The structure for interworking with) is not considered.

따라서 본 발명의 목적은 통합 액세스 장치에서 삼성 키폰 시스템(DCS-828)과 같은 사설교환시스템과의 연동을 할 수 있는 장치를 제공함에 있다.Accordingly, an object of the present invention is to provide an apparatus for interworking with a private exchange system such as a Samsung keyphone system (DCS-828) in an integrated access device.

본 발명에 따른 통합 액세스 장치는 사설교환시스템과의 연동을 위하여 DSP에서 전송되는 PCM 데이터를 직접 사설교환시스템의 하이웨이(Highway)에 연결시켜야 하며, SLIC에 대한 정보도 직접 사설교환시스템에 전송하여야 한다. 이를 구현하기 위해서는 종래의 코덱 및 SLIC 제거하고 DSP와 코덱간에 정보를 교환하는 SPI와 코덱과 SLIC간에 정보를 교환하는 로직을 사설교환시스템에 연동할 수 있도록 로직을 재구성하게 된다.The integrated access device according to the present invention should directly connect the PCM data transmitted from the DSP to the highway of the private exchange system for interworking with the private exchange system, and also transmit the information about the SLIC to the private exchange system directly. . In order to implement this, the SPI removes the conventional codec and SLIC and reconfigures the logic so that the SPI for exchanging information between the DSP and the codec and the logic for exchanging information between the codec and the SLIC can be linked to the private exchange system.

도 1은 종래의 통합 액세스 장치에서 가입자 일반 전화기와의 연동을 위한 주요부의 블록 구성도1 is a block diagram of an essential part for interworking with a subscriber general telephone in a conventional integrated access device;

도 2는 본 발명의 일 실시예에 따른 통합 액세스 장치에서 사설교환시스템과의 연동을 위한 주요부 블록 구성도2 is a block diagram illustrating main parts for interworking with a private exchange system in an integrated access device according to an embodiment of the present invention;

도 3은 통합 액세스 장치의 일반 전화기/사설교환시스템과의 연동을 위한 DSP에서의 직렬 포트 인터페이스 관련 신호 파형의 예시도3 is an exemplary diagram of a signal waveform related to a serial port interface in a DSP for interworking with a general telephone / private switching system of an integrated access device.

도 4는 통합 액세스 장치의 일반 전화기/사설교환시스템과의 연동을 위한 DSP에서의 직렬 포트 인터페이스 출력 데이터 구조도4 is a diagram of a serial port interface output data structure in a DSP for interworking with a general telephone / private switching system of an integrated access device.

도 5는 통합 액세스 장치의 일반 전화기/사설교환시스템과의 연동을 위한 DSP에서의 직렬 포트 인터페이스의 패스트 스캔 동작을 위한 관련 신호 파형의 예시도5 is an illustration of an associated signal waveform for a fast scan operation of a serial port interface in a DSP for interworking with a general telephone / private switching system of an integrated access device.

이하 본 발명에 따른 바람직한 실시예를 첨부한 도면을 참조하여 상세히 설명한다. 하기 설명에서는 구체적인 구성 소자 등과 같은 특정 사항들이 나타나고 있는데 이는 본 발명의 보다 전반적인 이해를 돕기 위해서 제공된 것일 뿐 이러한 특정 사항들이 본 발명의 범위 내에서 소정의 변형이나 혹은 변경이 이루어질 수 있음은 이 기술분야에서 통상의 지식을 가진 자에게는 자명하다 할 것이다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings. In the following description, specific details such as specific components are shown, which are provided to help a more general understanding of the present invention, and it is understood that these specific details may be changed or changed within the scope of the present invention. It is self-evident to those of ordinary knowledge in Esau.

도 2는 본 발명의 일 실시예에 따른 통합 액세스 장치에서 사설교환시스템과의 연동을 위한 주요부 블록 구성도이다. 도 2에서는 IAD, 예를 들어 '삼성IAD'에서 사설교환기, 예를 들어 '삼성 키폰 시스템(DCS-828)'과의 연동을 위한 장치가 개시되며, 특히 SPI(Serial Port Interface) 통신을 제어하기 위한 CPLD 로직 구성을 제안한다. 도 2에 도시된 구성은 도1에 도시된 바와 같은 종래의 구성과 비교하여 코덱(12) 및 SLIC(14)을 대신에 새로운 CPLD(Complex Programmable Logic Device)(22)를 이용한 로직구성을 한다. 이때 CPLD(22)로 종래의 DSP(10)와 코덱(12)간의 하드웨어적인 회로를 VHDL(Very High Speed Integrated Circuit Hardware Description Language) 프로그램을 이용하여 구현한다.2 is a block diagram illustrating main parts for interworking with a private exchange system in an integrated access device according to an embodiment of the present invention. In FIG. 2, an apparatus for interworking with a private exchange, for example, a Samsung keyphone system (DCS-828), is disclosed in an IAD, for example, 'Samsung IAD', and in particular, to control serial port interface (SPI) communication. We propose a CPLD logic configuration. The configuration shown in FIG. 2 has a logic configuration using a new Complex Programmable Logic Device (CPLD) 22 instead of the codec 12 and the SLIC 14 as compared to the conventional configuration as shown in FIG. In this case, the CPLD 22 implements a hardware circuit between the conventional DSP 10 and the codec 12 using a VHDL (Very High Speed Integrated Circuit Hardware Description Language) program.

도 2에 도시된 삼성 IAD는 사설교환시스템(DCS-828)과의 연동을 위하여 DSP에서 전송되는 PCM 관련 데이터, 즉 PCM 클럭(PCMCLK), 프레임 동기(FSX), 송신 PDM(PCMTX), 수신 PCM(PCMRX)를 직접 사설교환시스템의 하이웨이(Highway)에 연결시킨다. DSP(10)에서 SPI(Serial Port Interface)를 통해 제공되는 SLIC에 대한 정보도 직접 사설교환시스템에 전송하기 위하여 CPLD(22)를 구현한다. SPI는 전송 클럭(DCLK), 칩 선택(CS: chip select), 입력 데이터(DI: data in), 출력 데이터(DO: data out)로 구성되며, DSP(10)가 정상동작을 하게 되면 5ms마다 상기 CS와 DCLK가 발생하게 된다. SPI의 DO(Data out)은 도 3 및 도 4에 도시된 바와 같이, 채널당 32 비트 직렬 데이터로 구성되며, 전송은 8비트씩 구성되는 '커맨드', '어드레스', '길이', '데이터' 순으로 전송된다.The Samsung IAD shown in FIG. 2 shows PCM-related data transmitted from the DSP for interworking with the private switching system (DCS-828), that is, PCM clock (PCMCLK), frame synchronization (FSX), transmission PDM (PCMTX), and reception PCM. (PCMRX) directly connects to the highway of the private exchange system. The CPLD implements the CPLD 22 to directly transmit information on the SLIC provided through the SPI (Serial Port Interface) to the private exchange system. SPI consists of transmission clock (DCLK), chip select (CS: chip select), input data (DI: data in), and output data (DO: data out), and every 5ms when DSP 10 operates normally The CS and DCLK are generated. Data out (DO) of the SPI is composed of 32-bit serial data per channel, as shown in Figures 3 and 4, the transmission is 'command', 'address', 'length', 'data' Are transmitted in order.

상기 CPLD(22)에서 구현하는 것은 크게 3가지로 구분할 수 있다. 첫째, SPI를 통해 32비트 데이터를 전송하고, SLIC의 상태를 리드(read)하는 부분, 둘째 후크 오프 검출(Hook-off Detect: DP)을 SLIC의 상태에 반영하는 부분, 셋째 링 신호 발생(Ring Signal generate: HOS) 부분이다.The CPLD 22 may be classified into three types. First, 32-bit data is transmitted through SPI, the part that reads the state of the SLIC, the second part that reflects the Hook-off Detect (DP) to the state of the SLIC, and the third ring signal generation (Ring) Signal generate: HOS) part.

SPI동작을 위해서는 아이들 상태(idle, 300)에서 시작하여-> 커맨드 수신(rcv_cmd, 301) -> CS 대기 1(wait_cs_d1, 302) -> 상기 수신한 커맨드가 패스트 스캔이 아닐 경우에 어드레스 수신(rcv_addr, 303)으로 이동 -> CS 대기 2(wait_cs_d2, 304) -> 데이터 필드 길이 수신(rcv_leigh, 306) -> CS 대기 3(wait_cs_d3, 307) -> 데이터 필드 수신(data_st, 308) -> 아이들 상태(309)로 상태전이가 일어나게 된다. 이때 상기 CS 대기 1(302) 상태 이후 상기 수신한 커맨드가 패스트 스캔일 경우에는 상기 데이터 필드 수신(308) 상태로 바로 전이하게 된다(도 5참조).For the SPI operation, start in the idle state (idle, 300)-> receive a command (rcv_cmd, 301)-> CS wait 1 (wait_cs_d1, 302)-> receive an address when the received command is not a fast scan (rcv_addr , Go to 303)-> CS wait 2 (wait_cs_d2, 304)-> Receive data field length (rcv_leigh, 306)-> CS wait 3 (wait_cs_d3, 307)-> Receive data field (data_st, 308)-> Idle state At 309, a state transition occurs. At this time, if the received command is the fast scan after the CS wait 1 302 state, the data field is immediately transitioned to the reception 308 state (see FIG. 5).

이때 상기 각 상태는 데이터 입력을 체크하기 위해서 카운트를 하게되는데, 어드레스와 길이는 8비트로 항상 고정되어 전송되므로 해당 데이터를 래치(latch)하지 않는다. 커맨드 수신(301) 상태에서는 도 4에 도시된 바와 같은 수신 커맨드 중 0, 1번 비트인 "COMMAND"부분(모드 설정)과 4, 5번 비트인 CKT 선택(SLIC Select)부분만을 검출하여 사용한다. 도 4를 참조하면 커맨드의 종류로는 'FAST SCAN MODE : 10', 'WRITE MEMORY 01', 'WRITE ALL MEMORY 11', 'READ MEMORY 00'으로 구분된다. 데이터 필드 수신(data_st, 308) 상태에서는 데이터를 입력받고, 각 커맨드별로 해당 작업을 수행한다. 또한, 데이터 필드 수신 상태(308)상태에서 후크 오프 검출 상태 여부 로직도 구성해준다. 마지막으로 HOS(RING)신호는 입력받은 데이터가 링 인에이블(ring enable)일 경우 링 신호를 보내고, 후크 오프 검출시신호를 끊어준다.At this time, each state is counted to check the data input. Since the address and the length are always fixed to 8 bits and transmitted, the corresponding data is not latched. In the command receiving state 301, only the "COMMAND" part (mode setting) of bits 0 and 1 (mode setting) and the CKT select part (SLIC Select) part of bits 4 and 5 are detected and used among the received commands as shown in FIG. . Referring to FIG. 4, types of commands are classified into 'FAST SCAN MODE: 10', 'WRITE MEMORY 01', 'WRITE ALL MEMORY 11', and 'READ MEMORY 00'. In the data field reception (data_st, 308) state, data is input and a corresponding operation is performed for each command. In addition, the logic of the hook off detection state is configured in the data field reception state 308. Finally, the HOS (RING) signal sends a ring signal when the received data is ring enable, and disconnects the signal when the hook-off is detected.

이와 같은 CPLD(22)의 구현 예는 하기 <CPLD 프로그램 소스>에 개시한 바와 같은 VHDL(Very High Speed Integrated Circuit Hardware Description Language) 프로그램과 같은 수 있다. 하기 <CPLD 프로그램 소스>를 참조하면, 리셋(Reset)시 SPI는 아이들 상태에서 DCLK 하강(falling)시 CS가 인에이블(low active)되면, 다음상태인 커맨드 수신(rcv_cmd) 상태로 전이된다(하기 소스 프로그램 중 *command* 부분). 커맨드 수신(rcv_cmd) 상태에서 카운트를 이용해서 DCLK 상승(rising) 일 때 8비트의 데이터를 입력받도록 대기(wait)한다. 카운트가 완료후 커맨드 수신(rcv_cmd) 상태에서는 패스트 스캔(fast scan)여부에 대한 확인을 하여 커맨드가 패스트 스캔(command="10")일 경우, 다음 상태를 데이터 필드 수신(data_st)상태로 전이하게 된다(하기 프로그램 소스 중 *Data Field* 부분). 이는 바로 다음상태에서 채널 상태를 곧바로 리드하기 위해서이다. 이때에는 즉, 데이터 필드 수신 상태에서 command="10"인 경우임으로 모든 채널에 대한 상태를 2비트씩 리드한다. 즉, 한번 리드하게 되면 8비트를 리드하게됨으로 4채널에 대한 후크 오프 여부를 확인 할 수 있다.An implementation example of such CPLD 22 may be a VHDL (Very High Speed Integrated Circuit Hardware Description Language) program as disclosed in <CPLD Program Source>. Referring to <CPLD Program Source>, when the reset is performed, the SPI transitions from the idle state to the command receive (rcv_cmd) state when the CS is enabled (low active) when the DCLK falls. * Command * part of the source program). In the command receiving (rcv_cmd) state, a count is used to wait for 8-bit data to be input when the DCLK rises. After the count is completed, the command reception (rcv_cmd) state checks whether or not a fast scan is performed. If the command is a fast scan (command = "10"), the next state is transferred to the data field reception (data_st) state. (The * Data Field * part of the program source below). This is to immediately lead the channel state in the next state. In this case, in the case of command = "10" in the data field reception state, the state of all channels is read by 2 bits. That is, once read, 8 bits are read, so it is possible to check whether the 4 channels are hooked off.

만약, 상기 커맨드가 패스트 스캔 모드가 아닐 경우 다음 상태인 어드레스 수신(rcv_addr)상태로 전이된다(하기 프로그램 소스 중 *start Address* 부분). 이 상태는 카운트를 이용해서 대기만 해준다. 대기 후 다음 상태인 데이터 길이 수신 상태(rcv_length) 상태로 전이된다(하기 프로그램 소스 중 *Data Field length* 부분) 상태로 전이된다. 이 상태 역시 대기만 해준 후 다음 상태인 데이터 필드수신(data_st) 상태로 전이하게 된다(*Data Field*). 이때에는 항상 고정된 값이 전송되므로 별도로 데이터를 래치하지 않는다. 다음 데이터 필드 수신 상태에서는 입력되는 직렬 데이터를 DCLK 상승 일 때, 데이터 시프트(shift)시킨 후 저장한다(하기 프로그램 소스 중 "wr_data(6 down 1)"로 개시됨)에 저장한다. 저장 후 커맨드가 라이트 메모리, 즉, command="01"일 경우, DCLK 하강시 클럭 선택(ckt_sel) 값에 따라 각 채널에 채널 상태를 라이트(write)해주고, command="11"일 경우 모든 채널에 상태를 라이트(write)해준다.If the command is not in the fast scan mode, the command transitions to the next address reception (rcv_addr) state (* start Address * portion of the following program source). This state only waits using the count. After waiting, the transition to the next state, the data length reception state (rcv_length) state (the * Data Field length * portion of the program source) transitions to the state. This state also waits and transitions to the next state (data_st), which is the next state (* Data Field *). In this case, since a fixed value is always transmitted, data is not latched separately. In the next data field reception state, the input serial data is stored after shifting the data when DCLK rises (initiated as "wr_data (6 down 1)" in the following program source). After saving, if the command is write memory, that is, command = "01", the channel status is written to each channel according to the clock selection (ckt_sel) value when DCLK descends. If command = "11", all channels are written. Write the state.

한편, 하기 프로그램 소스를 참조하면, HOS(RING) 신호는 ba(5 downto 2)="0110"일 경우 발생하며, DP(HOOK-OFF DETECT)신호가 1일때 까지 발생한다.Meanwhile, referring to the following program source, the HOS (RING) signal is generated when ba (5 downto 2) = " 0110 " and is generated until the DP (HOOK-OFF DETECT) signal is 1.

이와 같이 본 발명에 따라 구성되는 상기 CPLD(22)의 HOS 신호는 트렁크 모듈 컨트롤러(TMC: Trunk Module Controller 7053)(24)에 제공되며, TMC(24)에서는 상기 DP 신호를 CPLD(22)에 제공한다. TMC(24)는 본 발명에서 DSP(10)가 종래의 일반 전화 단말기와 연결되는 것이 아니라 키폰 시스템과 연동되므로 이에 대한 인터페이스를 제공하기 위하여 설치되는 것으로서, 다이얼 펄스 제너레이터 타임 슬럿 제너레이터의 역할을 하며 입력 검출 및 출력 제어 기능을 한다. TMC(24)는 사설교환시스템(DCS-828)과 어드레스(BA) 및 데이터(BSD)를 주고받아 상기 HOS 신호를 사설교환시스템으로 보내게 된다.As such, the HOS signal of the CPLD 22 configured according to the present invention is provided to a trunk module controller (TMC: Trunk Module Controller 7053) 24, and the TMC 24 provides the DP signal to the CPLD 22. do. In the present invention, the TMC 24 is installed to provide an interface for the DSP 10 because the DSP 10 is not connected with a conventional general telephone terminal, but serves as a dial pulse generator time slot generator. Detect and output control functions. The TMC 24 exchanges the address BA and the data BSD with the private switching system DCS-828 and sends the HOS signal to the private switching system.

<CPLD 프로그램 소스><CPLD Program Source>

상기와 같이 본 발명의 일 실시예에 따른 구성 및 동작이 이루어질 수 있으며, 한편 상기한 본 발명의 설명에서는 구체적인 실시예에 관해 설명하였으나 여러 가지 변형이 본 발명의 범위를 벗어나지 않고 실시될 수 있다. 따라서 본 발명의범위는 설명된 실시예에 의하여 정할 것이 아니고 청구범위와 청구범위의 균등한 것에 의하여 정하여져야 할 것이다.As described above, the configuration and operation according to an embodiment of the present invention can be made. Meanwhile, in the above description of the present invention, specific embodiments have been described, but various modifications can be made without departing from the scope of the present invention. Therefore, the scope of the present invention should not be defined by the embodiments described, but by the claims and equivalents thereof.

상기한 바와 같이 본 발명에 따른 통합 액세스 장치는 사설교환시스템과의 연동을 위하여 DSP에서 전송되는 PCM 데이터를 직접 사설교환시스템의 하이웨이(Highway)에 연결시키고, 종래의 코덱 및 SLIC 제거하고 DSP와 코덱간에 정보를 교환하는 SPI와 코덱과 SLIC간에 정보를 교환하는 로직을 사설교환시스템에 연동할 수 있는 로직으로 대체하여 재구함으로, 삼성 키폰 시스템(DCS-828)과 같은 사설교환시스템과의 연동을 할 수 있다.As described above, the integrated access device according to the present invention directly connects the PCM data transmitted from the DSP to the highway of the private exchange system, removes the conventional codec and the SLIC, and removes the DSP and the codec for interworking with the private exchange system. It is possible to work with private exchange system such as Samsung Key Phone System (DCS-828) by replacing SPI that exchanges information between SPI and logic that exchanges information between codec and SLIC with logic that can interoperate with private exchange system. Can be.

Claims (3)

통합 액세스 장치에서 사설교환시스템과의 연동 장치에 있어서,In the interlocking device with the private exchange system in the integrated access device, PCM 관련 데이터를 바로 상기 사설교환시스템의 하이웨이(Highway)에 연결시키며, SPI(Serial Port Interface)를 통해 SLIC(Subscriber Line Interface Circuit) 정보를 제어하는 디지털 신호 프로세서와,A digital signal processor that directly connects PCM-related data to the highway of the private exchange system and controls SLIC (Subscriber Line Interface Circuit) information through the Serial Port Interface (SPI); 상기 디지털 신호 프로세서에서 상기 SPI를 통해 제공되는 SLIC 정보를 직접 상기 사설교환기에 제공하기 위한 CPLD(Complex Programmable Logic Device)를 포함하여 구성함을 특징으로 하는 연동 장치.And a complex programmable logic device (CPLD) for directly providing the SLIC information provided through the SPI to the private exchange in the digital signal processor. 제1항에 있어서, 상기 CPLD는 상기 SPI를 통해 상기 SLIC 정보를 전송하고, 상기 SLIC의 상태를 리드(read)하며, 후크 오프 검출을 상기 SLIC의 상태에 반영하며, 링 신호 발생함을 특징으로 하는 연동 장치.The CPLD of claim 1, wherein the CPLD transmits the SLIC information through the SPI, reads the state of the SLIC, reflects a hook-off detection to the state of the SLIC, and generates a ring signal. Interlocking device. 제1항에 있어서,The method of claim 1, 상기 CPLD와 상기 사설교환기간을 인터페이스하는 트렁크 모듈 컨트롤러를 더 구비함을 특징으로 하는 연동 장치.And a trunk module controller for interfacing the CPLD and the private exchange period.
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