KR20030087827A - 홈 네트워크 시스템에서 프레임 처리 장치 - Google Patents

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홈 네트워크 시스템에서 프레임 처리 장치가 개시된다. 본 발명에 따른 프레임 처리 장치는 프레임 전송에 필요한 타임슬롯정보를 제공하는 홈 PNA 맥(MAC), 프레임 전송에 필요한 파라메터를 제공하는 홈 PNA 관리부, 소정의 심볼값을 갖는 홈 PNA 프레임이 수신되면, 심볼값을 이용하여 프레임을 변조시켜 전화선을 통해 외부로 송신하고, 외부로부터 홈 PNA 프레임이 수신되면 심볼값을 추출하는 홈 PNA 모뎀 및 미디어 독립 인터페이스(MII)를 통해 이더넷 프레임을 입력받으면 홈 PNA 관리부에서 제공되는 파라메터에 따라 심볼로 구성되는 홈 PNA 프레임을 생성하여 타임슬롯에 따라 홈 PNA 모뎀으로 전달하고, 홈 PNA 모뎀으로부터 추출된 심볼이 수신되면 파라메터를 추출하여 홈 PNA 관리부로 전달하고, 추출된 심볼을 이더넷 프레임으로 변환하여 MII로 전달하는 프레임 처리부를 포함하는 것을 특징으로 하고, 4~32Mbps의 데이터 전송률을 보장할 수 있다. 또한, HCS 생성부, CRC16 생성부, 스크램블러 등 프레임 처리과정에 필요한 기능 블록들을 옥텟 단위의 병렬처리 구조로 설계함으로써 홈 PNA 프레임을 병렬처리 할 수 있다.

Description

홈 네트워크 시스템에서 프레임 처리 장치{Frame processing apparatus in home network system}
본 발명은 랜(Local Area Network:LAN) 시스템에 관한 것으로, 특히, 기존 전화선(UTP wiring)을 이용하여 가정 내에 LAN을 구축하는 모뎀 시스템에서 프레임 처리 장치 및 그 방법에 관한 것이다.
최근, 인터넷 서비스 수요가 폭발적으로 증가하고, 더불어 가정에서 보유하고 있는 PC를 포함한 각종 정보기기가 증가함으로 인하여 산재해 있는 장치들을 하나의 통합된 망에 연결하고, 가입자 망을 경유하여 전달된 정보를 구내 망에서 효율적으로 활용해야 한다는 요구가 높아진다. 이러한 요구에 따라 많은 단체에서 다양한 방법의 홈 네트워킹 방법을 개발하고 있으며, 그 중에서 홈 PNA는 가정 내에 이미 설치된 전화선로를 이용하여 추가의 비용 부담 없이 가정 내의 정보통신 기기들을 하나의 망에 연결하며, 허브, 라우터 등의 별도의 장비 없이 가정 내에 LAN을 설치할 수 있다.
홈 네트워크 구축을 위해 홈 PNA 기관에서 1Mbps의 전송률을 지원하는 1세대 시스템 규격이 제안되었다. 그러나, ADSL(Asymmetric Digital Subscriber Line)과 DOCSIS(Data Over Cable Service Interface Standard) 같은 커먼 광대역 접근(common broad band access) 기술이 접근 대역폭을 공유하기 위해 6Mbps이상의 데이터 전송률이 요구되고, DVD 스트림(stream)이나 고화질 디지털 비디오(high definition digital video) 등과 같은 어플리케이션을 위해 10Mbps이상의 전송률이 요구된다. 이러한 요구 조건을 충족시키기 위해 홈 PNA 기구에서 4~32Mbps의 데이터 전송률을 지원하는 2세대 시스템 규격이 제안되었으며, 이러한 2세대 시스템 규격을 충족시킬 수 있는 프레임 처리 장치가 요구된다.
본 발명이 이루고자 하는 기술적 과제는 2세대 홈 PNA 시스템의 규격을 만족시킬 수 있는 고속의 프레임 처리 장치를 제공하는 데 있다.
도 1은 2세대 홈 PNA 기능을 갖는 단말기를 개략적으로 나타내는 블록도이다.
도 2는 도 1에서 이더넷 프레임과 홈 PNA 프레임을 상호 변환시키는 프레임 처리 장치의 본 발명의 일실시예에 따른 블록도이다.
도 3은 도 2에 도시된 송신 프레임 제어기(200)의 일실시예에 따른 블록도이다.
도 4는 도 2에 도시된 수신 프레임 제어기(230)의 일실시예를 나타내는 블록도이다.
상기 과제를 이루기 위해, 프레임 전송에 필요한 타임슬롯정보를 제공하는 홈 PNA 맥(MAC), 프레임 전송에 필요한 파라메터를 제공하는 홈 PNA 관리부, 소정의 심볼값을 갖는 홈 PNA 프레임이 수신되면, 심볼값을 이용하여 프레임을 변조시켜 전화선을 통해 외부로 송신하고, 외부로부터 홈 PNA 프레임이 수신되면 심볼값을 추출하는 홈 PNA 모뎀 및 미디어 독립 인터페이스(MII)를 통해 이더넷 프레임을 입력받으면 홈 PNA 관리부에서 제공되는 파라메터에 따라 심볼로 구성되는 홈 PNA 프레임을 생성하여 타임슬롯에 따라 홈 PNA 모뎀으로 전달하고, 홈 PNA 모뎀으로부터 추출된 심볼이 수신되면 파라메터를 추출하여 홈 PNA 관리부로 전달하고, 추출된 심볼을 이더넷 프레임으로 변환하여 MII로 전달하는 프레임 처리부를 포함하는 것이 바람직하다.
이하, 본 발명에 따른 2세대 홈 PNA 시스템을 위한 프레임 처리 장치 및 그 방법을 첨부한 도면들을 참조하여 다음과 같이 설명한다.
도 1은 2세대 홈 PNA 기능을 갖는 단말기를 개략적으로 나타내는 블록도로서, 2세대 홈 PNA(이하, H2로 약함) MAC(Media Access Control)(20), 프레임 처리 장치(Frame Processor)(10) 및 H2 관리부(Management)(30)를 포함하여 구성된다. 설명의 편의를 위해, 도 1에는 H2 PNA 모뎀(40)과 IEEE 802.3 MAC)50)를 함께 도시하였다.
도 1을 참조하여, 프레임 처리기(10)는 MII(Media Independent Interface)(100)를 통해 IEEE 802.3 MAC(50)에 연결되어 이더넷 프레임(Ethernet frame)을 송수신하고, H2 MAC(20)으로부터 프레임을 송신하는데 필요한 타임 슬롯정보를 수신한다. 그리고, H2 관리부(30)로부터 PE(Payload Encoding Rate), PRI(Priority), SI(Scrambler Initialization seed) 등, frame 전송에 필요한 파라메터들을 전달받는다.
프레임 처리기(10)는 IEEE 802.3 MAC(50)으로부터 이더넷 프레임을 입력받으면 프레임이 입력되었다는 정보를 H2 MAC(20)에 전달하여 H2 MAC으로부터 프레임 전송 가능 시점(time slot) 정보를 제공받는다. 또한 프레임 처리기(10)는 H2 관리부(30)로부터 프레임 전송전에 각종 파라메터를 입력받고, 입력된 파라메터에 따라 프레임 전송을 제어한다. 즉, 프레임 처리기(10)는 H2 MAC(20)으로부터 전송 가능 시점을 부여받으면 IEEE 802.3 MAC(50)로부터 수신한 이더넷 프레임을 PE값에 따라 심볼로 구성된 홈 PNA 프레임으로 변환하여 H2 모뎀(40)에 전달한다. H2 모뎀(40)은 심볼값을 이용하여 프레임을 변조시켜 전화선을 통해 송신한다.
반면, H2 모뎀(40)이 홈 PNA 프레임을 수신하게 되면 심볼값을 프레임 처리 기(10)에 전달한다. 그러면, 프레임 처리기(10)는 H2 모뎀(40)으로부터 수신된 심볼로부터 파라메터를 추출하여 H2 관리부(30)에 전달하고, 홈 PNA 프레임을 이더넷 프레임으로 변환하여 IEEE 802.3 MAC(50)에 전달한다.
도 2는 도 1에서 이더넷 프레임과 홈 PNA 프레임을 상호 변환시키는 프레임 처리 장치의 본 발명의 일실시예에 따른 블록도로서, 송신 프레임 제어기(200), 수신 프레임 제어기(230), 충돌 감지부(240) 및 루프 백 브리지(Loop Back Bridge)(250)를 포함하여 구성된다. 설명의 편의를 위해, H2 MAC(20), H2 관리부(30), IEEE 802.3 MAC(50) 및 H2 모뎀(40)을 함께 도시하였다.
도 2를 참조하여, 송신 프레임 제어기(200)는 MII(100)를 통해 IEEE 802.3 MAC(50)로부터 수신된 이더넷 프레임을 홈 PNA 프레임으로 변환하고 PE 값에 따라 심볼을 생성하여 이를 H2 모뎀(40)의 컨스텔레이션 엔코더(Constellation Encoder:CE)(260)에 전달한다. 또한, 송신 프레임 제어기(200)는 자가 충돌 검출부(240)에서 발생되는 충돌신호(Col)에 응답하여 백-오프 프레임(Back-Off frame)을 발생한다.
수신 프레임 제어기(230)는 컨스텔레이션 디코더(Constellation Decoder:CDE)(270)로부터 심볼로 구성된 홈 PNA 프레임을 수신하여 이더넷 프레임으로 재구성하여 IEEE 802.3 MAC(50)로 전송한다.
자가 충돌 검출부(Self Collision Detector, 240)는 프레임 처리 장치(10)가 프레임 송신 중에 다른 홈 PNA 단말기로부터의 송신 프레임과 충돌이 발생하는 경우를 검출한다. 자가 충돌 검출부(240)는 송신 프레임 제어기(200)에서 발생되는 송신 프레임에서 프레임 제어 필드(Frame Control Field:FC)부터 이더넷 타입(Ethernet Type:ET)을 버퍼에 저장하고, H2 모뎀(40)으로부터 수신되는 수신 프레임의 해당 부분(FC~FT)과 비교하여 값이 다르면 충돌로 판단하고 값이 같으면 충돌이 아닌 것을 판단한다. 만약, 충돌이 발생된 것으로 판단되면, 자가 충돌 검출부(240)는 충돌신호(Col)를 발생하여 송신 프레임 제어기(200)에 충돌이 발생되었음을 알린다. 송신 프레임 제어기(240)는 충돌신호(Col)에 응답하여 백-오프 프레임(Back-Off frame)을 발생한다.
루프백 브리지(Loop-Back Bridge, 250)는 프레임 처리 장치(10)의 자체 동작검증을 위해 사용되는 루프백 모드를 지원하기 위한 것이다. 루프백 브리지(250)는 루프백 모드가 비활성 상태에서는 송신 프레임 제어기(200)에서 발생되는 송신 홈 PNA 프레임(H2 Tx Frame)을 CE(260)에 전달하고, CDE(270)으로부터 입력되는 수신 홈 PNA 프레임(H2 Rx Frame)을 수신 프레임 제어기(230)에 전달한다. 그러나, 루프백 모드가 활성화될 때에는 송신 홈 PNA 프레임(H2 Tx Frame)을 CE(260)에 전달하지 않고 수신 프레임 제어기(230)로 전송한다. 그러면, 수신 프레임 제어기(230)는 수신한 홈 PNA 프레임(H2 Rx Frame)을 이더넷 프레임으로 변환한다. MII(100)는 송신 이더넷 프레임(1040)과 수신 이더넷 프레임(1050)의 동일함을 비교함으로써 프레임 송수신이 정상적으로 이루어지고 있는지를 확인할 수 있다.
도 3은 도 2에 도시된 송신 프레임 제어기(200)의 일실시예에 따른 블록도로서, 버퍼(300), CRC 생성부(310), HCS 생성부(320), 제어부(350), 패드(Pad) 생성부(330), 스크램블러(340) 및 심볼 생성부(360)를 포함하여 구성된다. 도 3에는 설명의 편의를 위해 MII(100) 및 CE(260)를 함께 도시하였다.
도 3을 참조하여, 수신 제어부(300)는 MII(100)의 25MHz 클럭을 이용하여 100Mbps의 데이터 전송률을 갖는 이더넷 프레임을 수신한다. 그러나, 홈 PNA 프레임 전송 속도는 4Mbps ~ 32Mbps이므로 더 빠른 데이터 전송률을 갖는 이더넷 프레임이 유실되지 않도록 이더넷 프레임을 메모리에 저장해야 한다. 이러한 이유로 수신 제어부(300)는 내부에 메모리를 구비하고 있으며, 이 메모리는 이더넷 프레임을 최대 1518Bytes까지 수용할 수 있도록 그 크기를 정한다. 수신 제어부(300)는 프레임 제어부(350)로부터 홈 PNA 프레임 생성을 위한 데이터 요청 신호가 수신되면 메모리로부터 1byte단위로 이더넷 프레임을 출력하여 프레임 제어부(350)에 제공한다.
프레임 제어부(350)은 IEEE 802.3 이더넷 프레임을 홈 PNA 프레임으로 변환한다. 즉, 심볼 생성부(360)로부터 심볼 생성을 위해 데이터 요청 신호(R2)를 활성 시키면 수신 제어부(300)내의 메모리로부터 1byte씩 데이터를 읽기 위한 신호(R1)를 수신 제어부(300)에 전달한다. 그리고, 프레임 변환에 소요되는 HCS와 CRC16 시퀀스(sequence)를 요청하는 활성 신호(EnCRC, EnHCS) 및 입출력 데이터를 제어한다. 또한 4Mbaud 율로 동작할 때 규격에서 정의한 최소 송신 홈 PNA 프레임 크기를 보장하기 위해 패딩(padding)이 요구되는 경우 패드 요청신호(R3)를 패드 생성부(330)로 발생하여 패드를 수신하고, 수신된 패드를 추가한다. 그런 다음, 홈 PNA 프레임의 프레임 제어 필드의 하위 2bytes부터 EOF(End Of Frame)전까지의 모든 홈 PNA 프레임 데이터를 스크램블러(340)로 제공한다.
HCS 생성부(320)는 홈 PNA 프레임의 FT(Frame Type)부터 SA(Source Address) 필드를 전송 순서대로 128bits 시퀀스로 구성되어 입력되는 데이터를 수학식 1을 이용하여 옥텟(octet)단위로 처리할 수 있도록 설계된 LFSR(Linear Feedback Shift Register)을 이용하여 HCS를 구한다.
CRC 생성부(310)는 스크램블링을 하지 않은 IEEE802.3 이더넷 프레임이 전송 순서대로 구성되어 입력되는 데이터를 이용하여 다음 수학식 2로부터 설계된 옥텟단위의 병렬처리 구조를 갖는 LFSR을 통해 CRC16 시퀀스를 구한다.
스크램블러(340)은 규격에서 제안한 스크램블러 구조를 8bits 병렬처리가 가능하도록 설계한 후 홈 PNA 프레임의 FC 필드의 하위 2bytes부터 EOF전의 모든 프레임 데이터를 입력으로 하여 스크램블링된 프레임 데이터를 구한다. 스크램블러(340)의 구조는 수학식 3을 이용하여 병렬 처리가 가능하도록 설계된 LFSR을 이용한다.
여기서, 스크램블러(340)의 LFSR에서 x15~x18의 4비트는 H2 관리부(30)로부터 수신한 스크램블러 씨드(scrambler seed)를 이용하여 초기화하고, 나머지 비트는 로직 "1"로 초기화한다.
심볼 생성부(360)는 홈 PNA 프레임의 헤더(프리앰블~ET(Ether Type))를 2Mbaud, QPSK 심볼 전송하고, 패이로드(Payload)에 해당하는 ET이후의 IEEE802.3 이더넷 프레임은 PE 값에 따라 전송하고, 트레일러(EOF)는 2Mbaud, QPSK로 전송한다. 심볼 생성부(360)는 이러한 심볼 발생 및 전송을 제어하기 위한 FSM과, 제어 카운터와, 프레임 데이터를 저장하기 위해 8-bytes로 구성된 레지스터 초기화 블록과, 심볼 생성에 필요한 프레임 데이터를 요청하는 블록과, PE 값에 따라 2~8bits/심볼을 발생하는 블록으로 구성된다.
도 4는 도 2에 도시된 수신 프레임 제어기(230)의 일실시예를 나타내는 블록도로서, 송신 제어기(400), 프레임 오류 검출부(410), 헤더 오류 검출부(420), 프레임 제어부(440) 및 디스크램블러(430)를 포함하여 구성된다. 설명의 편의를 위해, 도 4에는 MII(100) 및 CDE(270)를 함께 도시하였다.
도 4를 참조하여, 홈 PNA 프레임은 도 2를 참조하여 설명된 바와 같이 CDE(270)로부터 심볼로 구성된 프레임 (1070)으로 수신 프레임 제어기(230)로 전송된다. 프레임 제어부(440)는 CDE(270)로부터 수신되는 수신 홈 PNA 프레임으로부터 스크램블 씨드를 추출하여 디스크램블(430)을 초기화한 후 수신 홈 PNA 프레임의 FC 필드 하위 2bytes부터 EOF 전까지를 입력으로 디스크램블링을 수행한다. 디스크램블링 과정 후의 프레임 데이터를 프레임 오류 검출부(410)와 헤더 오류 검출부(420)에 입력하여 프레임 헤더 오류 발생 및 프레임 오류 발생 여부를 결정한다. 한편, 프레임 제어부(440)는 수신된 홈 PNA 프레임에서 이더넷 프레임 구간에 대한 정보를 알고 있으며, 이더넷 프레임의 끝을 나타내는 프레임 구분신호를 송신 제어기(400)로 전송한다.
헤더 오류 검출부(420)에서 HCS 검사 결과가 수학식 4와 같으면 프레임 헤더 오류 없이 홈 PNA 프레임을 수신했다고 판정한다.
프레임 오류 검출부(410)는 CRC16 검사 결과 나머지가 0이면 정상적으로 프레임을 수신한 것으로 판정한다.
이러한 프레임 오류 정보는 H2 관리부(30)로 전달되어 상위 계층에서 ARQ(Automatic Rate request) 및 Rate Negotiation Algorithm을 운용하는데 사용된다.
디스크램블러(430)은 송신 프레임 제어기(200)의 스크램블러(340)와 동일한 구조를 취한다. 디스크램블링 후의 프레임은 송신 제어기(400)의 내부 메모리에 저장된다.
송신 제어기(400)는 프레임 제어기(440)로부터 발생되는 프레임 구분신호(CNT)에 따라 디스크램블러(430)로부터 이더넷 프레임에 대응하는 프레임 데이터만 수신하고, 수신된 이더넷 프레임을 저장하고 있다가 이더넷 프레임의 전송속도로 저장된 이더넷 프레임을 상기 MII를 통해 전송한다. 즉, MII(100)를 통해 수신 이더넷 프레임을 IEEE 802.3 MAC(50, 도 2참조)에 전송하는데 25MHz 클럭을 사용하고, 이더넷 프레임 데이터는 4bits 니블(nibble)단위로 전송함으로 IEEE802.3 이더넷 프레임의 전송 속도(100Mbps)와 H2 프레임의 전송 속도(4~32Mbps)의 차이를 고려하여 메모리 엠프티(empty) 상태를 발생시키지 않고 이더넷 프레임을 정상적으로 전송할 수 있도록 프레임이 메모리에 저장한다. CRS(Carrier Sense)와 RxDv를 활성 시키고 이더넷 프레임을 전송한다.
이상에서 설명된 바와 같이, 본 발명에 따른 고속의 홈 네트워크를 구축하기 위한 10Mbps급 홈 PNA 기술의 프레임 처리 장치를 제공한다. 본 발명을 통해 4~32Mbps의 데이터 전송률을 보장할 수 있을 뿐만 아니라, HCS 생성부, CRC16 생성부, 스크램블러 등 프레임 처리과정에 필요한 기능 블록들을 옥텟 단위의 병렬처리 구조로 설계함으로써 홈 PNA 프레임을 옥텟 단위로 병렬처리 할 수 있다.
본 발명은 병렬처리 구조를 취함으로써 동작 주파수를 낮출 수 있고, 고속의 차세대 시스템(100Mbps급)에 쉽게 응용될 수 있어 홈 네트워크의 고속화에 기여할 수 있다.
이상 도면과 명세서에서 최적 실시예들이 개시되었다. 여기서 특정한 용어들이 사용되었으나, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미 한정이나 특허청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 그러므로 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의해 정해져야 할 것이다.
상술한 바와 같이, 본 발명에 따른 홈 네트워크 시스템에서 프레임 처리에 따르면, 4~32Mbps의 데이터 전송률을 보장할 수 있다. 또한, HCS 생성부, CRC16 생성부, 스크램블러 등 프레임 처리과정에 필요한 기능 블록들을 옥텟 단위의 병렬처리 구조로 설계함으로써 홈 PNA 프레임을 병렬처리 할 수 있다.

Claims (8)

  1. 프레임 전송에 필요한 타임슬롯정보를 제공하는 홈 PNA 맥(MAC);
    프레임 전송에 필요한 파라메터를 제공하는 홈 PNA 관리부;
    소정의 심볼값을 갖는 홈 PNA 프레임이 수신되면, 상기 심볼값을 이용하여 프레임을 변조시켜 전화선을 통해 외부로 송신하고, 외부로부터 홈 PNA 프레임이 수신되면 심볼값을 추출하는 홈 PNA 모뎀; 및
    미디어 독립 인터페이스(MII)를 통해 이더넷 프레임을 입력받으면 상기 홈 PNA 관리부에서 제공되는 파라메터에 따라 심볼로 구성되는 홈 PNA 프레임을 생성하여 상기 타임슬롯에 따라 상기 홈 PNA 모뎀으로 전달하고, 상기 홈 PNA 모뎀으로부터 상기 추출된 심볼이 수신되면 파라메터를 추출하여 상기 홈 PNA 관리부로 전달하고, 상기 추출된 심볼을 이더넷 프레임으로 변환하여 상기 MII로 전달하는 프레임 처리부를 포함하는 것을 특징으로 하는 프레임 처리장치.
  2. 제1항에 있어서, 상기 프레임 처리부는
    상기 수신된 이더넷 프레임이 수신되면 상기 파라메터에 따라 심볼을 생성하여 생성된 심볼을 홈 PNA 프레임으로 변환하고, 충돌 신호에 응답하여 상기 홈 PNA 프레임을 출력하거나 또는 백오프 프레임을 출력하는 송신 프레임 제어기;
    상기 송신 프레임 제어기에서 발생되는 홈 PNA 프레임과 상기 홈 PNA 모뎀으로부터 수신되는 수신 홈 PNA 프레임을 비교하여 충돌 여부를 판단하고, 판단된 결과에 따라 상기 충돌 신호를 발생하는 자가 충돌 검출부; 및
    상기 홈 PNA 모뎀으로부터 심볼로 구성된 홈 PNA 프레임을 수신되면 파라메터를 추출하여 상기 홈 PNA 관리부로 전달하고, 수신된 홈 PNA 프레임을 이더넷 프레임으로 변환하여 상기 MII로 전달하는 수신 프레임 제어기를 를 포함하는 것을 특징으로 하는 프레임 처리장치.
  3. 제2항에 있어서, 상기 자가 충돌 검출부는 상기 송신 프레임 제어기에서 발생되는 홈 PNA 프레임의 프레임 제어 필드(FC)부터 이더넷 타입 필드(ET)와 상기 홈 PNA 모뎀으로부터 수신되는 수신 홈 PNA 프레임의 해당 부분(FC~FT)의 값을 비교하여 값이 다르면 충돌로 판단하고 값이 같으면 충돌이 아닌 것으로 판단하는 것을 특징으로 하는 프레임 처리 장치.
  4. 제2항에 있어서,
    자체 동작 검증을 위한 루프백 모드가 활성화되면 상기 송신 프레임 제어기에서 발생되는 송신 홈 PNA 프레임을 상기 홈 PNA 모뎀으로 전송하지 않고 상기 수신 프레임 제어기로 전송하는 루프백 브리지를 더 구비하고,
    상기 수신 프레임 제어기는 상기 루프백 브리지로부터 수신된 송신 홈 PNA 프레임을 이더넷 프레임으로 변환하여 상기 MII로 전송하며,
    상기 MII는 송신 프레임 제어기로 전달한 수신 이더넷 프레임과 수신 프레임 제어기에서 변환된 이더넷 프레임의 동일함을 비교함으로써 프레임 송수신이 정상적으로 이루어지고 있는지를 확인하는 것을 특징으로 하는 프레임 처리 장치.
  5. 제2항에 있어서, 상기 송신 프레임 제어기는
    홈 PNA 프레임의 전송속도보다 빠른 이더넷 프레임이 유실되지 않도록 수신 이더넷 프레임을 저장하고, 제1데이터 요청 신호가 수신되면 저장된 이더넷 프레임을 소정단위로 출력하는 송신 제어부;
    수신 단말기에서 수신한 홈 PNA 프레임의 프레임 헤더 오류 검출을 위한 헤더 첵크 시퀀스(HCS)를 병렬로 생성하는 HCS 생성부;
    수신 단말기에서 수신한 홈 PNA 프레임의 프레임 오류 검출을 위한 CRC를 병렬로 생성하는 CRC 생성부;
    홈 PNA 프레임의 최소길이를 보장하기 위한 패드를 생성하는 패드 생성부;
    제2데이터 요청 신호가 수신되면 상기 제1데이터 요청 신호를 발생하여 상기 송신 제어부로부터 이더넷 프레임을 제공받아 초기 홈 PNA 프레임을 생성하고, 상기 HCS 생성부, CRC 생성부 및 패드 생성부로 HCS, CRC 및 패드를 각각 제공받아 상기 초기 홈 PNA 프레임에 추가하여 홈 PNA 프레임을 생성하는 프레임 제어부;
    상기 프레임 제어부에서 생성된 홈 PNA 프레임의 프레임 데이터를 병렬로 스크램블하여 스크램블링된 프레임 데이터를 생성하는 스크램블러; 및
    상기 파라메터에 따라 심볼을 생성하여 생성된 심볼을 생성하여 심볼로 구성된 홈 PNA 프레임을 홈 PNA 모뎀으로 전송하는 심볼 생성부를 포함하는 것을 특징으로 하는 프레임 처리 장치.
  6. 제5항에 있어서, 상기 스크램블러는
    상기 홈 PNA 프레임의 프레임 제어 필드의 하위 2바이트부터 EOF(End OfFrame)전까지의 모든 홈 PNA 프레임 데이터를 소정의 비트 단위로 병렬 스크램블링하는 것을 특징으로 하는 프레임 처리 장치.
  7. 제2항에 있어서, 상기 수신 프레임 제어기는
    프레임 헤더 오류를 검출하는 헤더 오류 검출부;
    프레임 데이터의 오류를 검출하는 프레임 오류 검출부;
    홈 PNA 프레임을 디스크램블링하는 디스크램블러;
    상기 홈 PNA 모뎀으로부터 심볼로 구성된 수신 홈 PNA 프레임이 수신되면 상기 수신된 홈 PNA 프레임에서 디스크램블링 대상 필드의 데이터를 상기 디스크램블러로 제공하고, HCS 데이터와 디스크램블된 데이터로부터 CRC 데이터를 각각 추출하여 상기 헤더 오류 검출부 및 상기 프레임 오류 검출부로 각각 제공하여 헤더 및 프레임 데이터의 오류 체크를 하고, 상기 디스크램블된 데이터에서 이더넷 프레임임을 구분하는 프레임 구분 신호를 발생하는 프레임 제어부; 및
    상기 프레임 구분신호에 따라 상기 디스크램블러로부터 이더넷 프레임에 대응하는 프레임 데이터만 수신하고, 수신된 이더넷 프레임을 저장하고 있다가 이더넷 프레임의 전송속도로 저장된 이더넷 프레임을 상기 MII를 통해 전송하는 수신 제어부를 포함하는 것을 특징으로 하는 프레임 처리 장치.
  8. 제7항에 있어서,
    상기 프레임 오류 검출부에서 검출된 프레임 오류 정보는 상기 홈 PNA 관리부로 전달되고,
    상기 홈 PNA 관리부는 상기 프레임 오류 정보를 이용하여 상위 계층에서 ARQ(Automatic Rate request) 및 RNA(Rate Negotiation Algorithm)을 운용하는데 이용하는 것을 특징으로 하는 프레임 처리 장치.
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