KR19990046854A - Carrier Phase Error Compensator - Google Patents

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Abstract

본 발명은 반송파 위상 에러 보상장치에 관한 것으로, 종래에는 반송파가 정확히 90 ° 위상차이가 나지않고 위상에러가 존재할 경우 입력신호를 변복조하면 불필요한 오프셋전압으로 인해 신호의 왜곡을 초래할 수 있는 문제점이 있었다. 따라서, 본 발명은 반송파의 위상에러를 내부적으로 보상하여 반송파의 위상차이가 정확히 90 ° 를 유지하도록 구성하여 데이터신호의 반송파에 의해 발생하는 노이즈를 제거할 수 있는 효과가 있다.The present invention relates to a carrier phase error compensator, in which a carrier of exactly 90 ° If there is a phase error and there is a phase error, modulation and demodulation of the input signal may cause distortion of the signal due to unnecessary offset voltage. Therefore, the present invention compensates the phase error of the carrier internally so that the phase difference of the carrier is exactly 90 ° It is effective to remove the noise generated by the carrier of the data signal by configuring so as to hold.

Description

반송파 위상 에러 보상장치Carrier Phase Error Compensator

본 발명은 반송파 위상 에러 보상장치에 관한 것으로, 특히 두 개의 위상을 가진 반송파를 이용하는 변복조시스템에서 발생하는 위상에러를 감지하여 이를 내부적으로 보상할 수 있도록 한 반송파 위상 에러 보상장치에 관한 것이다.The present invention relates to a carrier phase error compensation device, and more particularly, to a carrier phase error compensation device capable of detecting a phase error occurring in a modulation / demodulation system using a carrier having two phases and compensating it internally.

도1은 종래 반송파 위상 에러 보상장치의 구성을 보인 블록도로서, 이에 도시된 바와같이 반송파( COSωCt )를 발진하는 로컬 오실레이터(10)와; 상기 로컬 오실레이터(10)의 반송파( COSωCt )를 입력받아 이를 90 ° 만큼 시프트하는 위상시프터(12)와; 상기 위상시프터(12)로부터 신호( SINWCt )를 입력받아 이를 제1 입력신호(I1(t))와 믹싱하는 제1 믹서(11)와; 상기 로컬 오실레이터(10)로부터 신호( COSωCt )를 입력받아 이를 제2 입력신호(I2(t))와 믹싱하는 제2 믹서(13)로 구성되며, 이와같은 종래 장치의 동작을 설명한다.1 is a block diagram showing the configuration of a conventional carrier phase error compensator, as shown in FIG. COSω C t A local oscillator 10 oscillating; Carrier of the local oscillator 10 COSω C t ) And enter ° A phase shifter 12 shifted by an amount; Signal from the phase shifter 12 SINW C t A first mixer (11) which receives a) and mixes it with the first input signal (I1 (t)); Signal from the local oscillator 10 COSω C t ) And a second mixer 13 for mixing the second input signal I2 (t) with the second input signal I2 (t).

먼저, 위상시프터(12)는 로컬 오실레이터(10)에서 발생한 반송파( COSωCt )를 입력받아 이를 90 ° 만큼 시프트한 신호( SINWCt )를 출력하고, 이때 제1 믹서(11)는 상기 위상시프터(12)로부터 시프트된 신호( SINWCt )를 입력받아 이를 제1 입력신호(I1(t))와 믹싱하여 출력하며, 또한 제2 믹서(13)는 상기 로컬 오실레이터(10)로부터 발생한 반송파( COSωCt )를 입력받아 이를 믹싱하여 출력한다.First, the phase shifter 12 is a carrier wave generated in the local oscillator 10 ( COSω C t ) And enter ° Shifted by SINW C t , And the first mixer 11 outputs a signal (shifted from the phase shifter 12). SINW C t ) Is mixed with the first input signal I1 (t) and output, and the second mixer 13 is a carrier wave generated from the local oscillator 10. COSω C t ) Is input and mixed and output.

즉, 제1,제2 입력신호(I1(t),I2(t))는 반송파( COSωCt ) 주파수만큼 업/다운 변환되는데 사인(SIN)과 코사인(COS)의 직교성질을 이용하여 원래의 데이터를 복구한다.That is, the first and second input signals I1 (t) and I2 (t) are carrier waves ( COSω C t ) Up / down conversion by frequency is used to restore the original data using the orthogonality of sine and cosine.

그러나, 상기와 같이 동작하는 종래 장치는 반송파가 정확히 90 ° 위상차이가 나지않고 위상에러가 존재할 경우 입력신호를 변복조하면 불필요한 오프셋전압으로 인해 신호의 왜곡을 초래할 수 있는 문제점이 있었다.However, in the conventional apparatus operating as described above, the carrier has exactly 90 carriers. ° If there is a phase error and there is a phase error, modulation and demodulation of the input signal may cause distortion of the signal due to unnecessary offset voltage.

따라서, 상기와 같은 문제점을 감안하여 창안한 본 발명은 두 개의 위상을 가진 반송파를 이용하는 변복조시스템에서 발생하는 위상에러를 감지하여 이를 내부적으로 보상할 수 있도록 한 반송파 위상 에러 보상장치를 제공함에 그 목적이 있다.Accordingly, an object of the present invention is to provide a carrier phase error compensation device capable of detecting a phase error occurring in a modulation / demodulation system using a carrier having two phases and compensating it internally. There is this.

도1은 종래 반송파 위상 에러 보상장치의 구성을 보인 블록도.1 is a block diagram showing the configuration of a conventional carrier phase error compensation device.

도2는 본 발명 반송파 위상 에러 보상장치의 구성을 보인 블록도.Figure 2 is a block diagram showing the configuration of the carrier phase error compensation device of the present invention.

도3은 도2에 있어서, 검출부의 구성을 보인 블록도.3 is a block diagram showing the configuration of a detector in FIG.

도4는 도2에 있어서, 지연부의 구성을 보인 블록도.4 is a block diagram showing the configuration of a delay unit in FIG.

*****도면의 주요부분에 대한 부호의 설명********** Description of the symbols for the main parts of the drawings *****

10:로컬 오실레이터 11,13,20:믹서10: Local Oscillator 11, 13, 20: Mixer

12:위상시프터 21:로우패스필터12: phase shifter 21: low pass filter

22:레벨시프터 23:적분기22: level shifter 23: integrator

24:합성기 25:아나로그/디지털변환기24: Synthesizer 25: Analog / Digital Converter

26:검출부 27:지연부26: Detection part 27: Delay part

상기와 같은 목적은 반송파를 발생하는 로컬 오실레이터와; 상기 로컬 오실레이터로부터 반송파를 입력받아 이를 90도 만큼 위상을 시프터하는 위상시프터와; 상기 로컬 오실레이터로부터 반송파를 입력받아 이를 제2 입력신호와 승산하는 제2 믹서와; 상기 위상시프터로부터 시프트된 신호를 입력받아 이를 로컬 오실레이터로부터 발생된 신호와 승산하는 믹서와; 상기 믹서로부터 승산신호를 입력받아 이를 로우 패스 필터링하는 로우패스필터와; 상기 로우패스필터로부터 필터링된 신호를 입력받아 그 신호의 레벨을 시프트하는 레벨시프터와; 상기 레벨시프터로부터 출력된 신호를 입력받아 이를 적분하는 적분기와; 상기 로컬 오실레이터로부터 반송파를 입력받아 그 반송파의 위상에러인 직류값을 검출하는 검출부와; 상기 검출부의 직류값과 상기 적분기의 적분신호를 입력받아 이를 가산하는 합성부와; 상기 합성부의 가산신호를 입력받아 이를 디지털신호로 변환하는 아나로그/디지털변환부와; 상기 위상시프터의 시프팅신호를 입력받아 이를 상기 아나로그/디지털변환부의 디지털신호에 의해 소정시간 지연하는 지연부와; 상기 지연부의 지연신호를 입력받아 이를 입력신호와 믹싱하는 믹서로 구성함으로써 달성되는 것으로, 이와같은 본 발명을 첨부한 도면을 참조하여 설명하면 다음과 같다.The above object is a local oscillator for generating a carrier; A phase shifter which receives a carrier from the local oscillator and shifts the phase by 90 degrees; A second mixer configured to receive a carrier from the local oscillator and multiply it by a second input signal; A mixer which receives the shifted signal from the phase shifter and multiplies it by a signal generated from a local oscillator; A low pass filter configured to receive a multiplication signal from the mixer and low pass filter the multiplication signal; A level shifter which receives the filtered signal from the low pass filter and shifts the level of the signal; An integrator that receives the signal output from the level shifter and integrates it; A detector which receives a carrier from the local oscillator and detects a direct current value that is a phase error of the carrier; A synthesizer which receives the DC value of the detector and the integrated signal of the integrator and adds the integrated signal; An analog / digital converting unit which receives the addition signal of the combining unit and converts it into a digital signal; A delay unit which receives a shifting signal of the phase shifter and delays the shift signal by a predetermined time by a digital signal of the analog / digital converter; This is achieved by receiving a delay signal of the delay unit and mixing the input signal with the input signal. The present invention will be described below with reference to the accompanying drawings.

도2는 본 발명 반송파 위상 에러장치의 일실시예의 구성을 보인 블록도로서, 이에 도시한 바와같이 반송파( COSωCt )를 발생하는 로컬 오실레이터(10)와; 상기 로컬 오실레이터(10)로부터 반송파( COSωCt )를 입력받아 이를 90도 만큼 위상을 시프터하는 위상시프터(12)와; 상기 로컬 오실레이터(10)로부터 반송파( COSωCt )를 입력받아 이를 제2 입력신호(I2(t))와 승산하는 믹서(13)와; 상기 위상시프터(12)로부터 시프트된 신호( SINWCt )를 입력받아 이를 로컬 오실레이터(10)로부터 발생된 신호( COSωCt )와 승산하는 믹서(20)와; 상기 믹서(20)로부터 승산신호를 입력받아 이를 로우 패스 필터링하는 로우패스필터(21)와; 상기 로우패스필터(21)로부터 필터링된 신호를 입력받아 그 신호의 레벨을 시프트하는 레벨시프터(22)와; 상기 레벨시프터(22)로부터 출력된 신호를 입력받아 이를 적분하는 적분기(23)와; 상기 로컬 오실레이터(10)로부터 반송파( COSωCt )를 입력받아 그 반송파( COSωCt )의 위상에러인 직류값을 검출하는 검출부(26)와; 상기 검출부(26)의 직류값과 상기 적분기(23)의 적분신호를 입력받아 이를 가산하는 합성부(24)와; 상기 합성부(24)의 가산신호를 입력받아 이를 디지털신호로 변환하는 아나로그/디지털변환부(25)와; 상기 위상시프터(12)의 시프팅신호( SINWCt )를 입력받아 이를 상기 아나로그/디지털변환부(25)의 디지털신호에 의해 소정시간 지연하는 지연부(27)와; 상기 지연부(27)의 지연신호를 입력받아 이를 입력신호(I1(t))와 믹싱하는 믹서(11)로 구성한다.FIG. 2 is a block diagram showing the configuration of an embodiment of the carrier phase error device of the present invention. As shown in FIG. COSω C t A local oscillator 10 generating a); The carrier wave from the local oscillator 10 COSω C t A phase shifter 12 for receiving the shift signal and shifting the phase by 90 degrees; The carrier wave from the local oscillator 10 COSω C t And a mixer 13 for receiving the multiplier and multiplying it by the second input signal I2 (t); The signal shifted from the phase shifter 12 ( SINW C t ) And the signal generated from the local oscillator 10 ( COSω C t A mixer 20 that multiplies the multiplier; A low pass filter 21 for receiving a multiplication signal from the mixer 20 and performing low pass filtering on the multiplication signal; A level shifter 22 which receives the filtered signal from the low pass filter 21 and shifts the level of the signal; An integrator (23) which receives the signal output from the level shifter (22) and integrates it; The carrier wave from the local oscillator 10 COSω C t ) And the carrier ( COSω C t A detection unit 26 for detecting a direct current value that is a phase error of? A combiner 24 which receives the DC value of the detector 26 and the integrated signal of the integrator 23 and adds the integrated signal; An analog / digital converter (25) which receives the addition signal of the synthesizer (24) and converts it into a digital signal; The shifting signal of the phase shifter 12 SINW C t A delay unit 27 for receiving a predetermined time and delaying the predetermined time by a digital signal of the analog / digital conversion unit 25; The mixer 11 is configured to receive a delay signal of the delay unit 27 and mix the delay signal with the input signal I1 (t).

도3은 상기 검출부(26)의 구성을 보인 블록도로서, 이에 도시한 바와같이 로컬 오실레이터(10)로부터 반송파( COSωCt )를 입력받아 이를 다시 반송파( COSωCt )와 믹싱하는 믹서(30)와; 상기 믹서(30)로부터 믹싱신호를 입력받아 이를 로우 패스 필터링하는 로우패스필터(31)와; 상기 로우패스필터(31)로부터 필터링된 신호를 입력받아 이 신호의 레벨을 시프팅하는 레벨시프터(32)와; 상기 레벨시프터(32)의 신호를 입력받아 이를 적분하는 적분기(33)로 구성한다.3 is a block diagram showing the configuration of the detection unit 26. As shown in FIG. 3, a carrier wave from the local oscillator 10 is shown. COSω C t ) And take it back to the carrier ( COSω C t Mixer 30 for mixing with; A low pass filter 31 which receives the mixing signal from the mixer 30 and performs low pass filtering on the mixing signal; A level shifter (32) for receiving the filtered signal from the low pass filter (31) and shifting the level of the signal; Integrator 33 receives the signal of the level shifter 32 and integrates it.

도4는 상기 지연부(27)의 구성을 보인 블록도로서, 이에 도시한 바와같이 아나로그/디지털변환부(25)로부터 출력되는 디지털신호의 최상위비트의 값에 따라 위상시프터(12)의 시프팅신호( SINWCt )를 디먹싱하는 디먹스(40)와; 상기 아나로그/디지털변환부(25)로부터 출력되는 디지털신호의 최상위비트가 '1'일때 상기 디먹스(40)로부터 신호를 입력받아 이를 상기 디지털신호에 의해 소정시간만큼 지연시간을 감소하는 지연감소부(42)와; 상기 아나로그/디지털변환부(25)로부터 출력되는 디지털신호의 최상위비트가 '0' 일때 상기 디먹스(40)로부터 신호를 입력받아 이를 상기 디지털신호에 의해 소정시간만큼 지연시간을 증가하는 지연증가부(41)로 구성하며, 이와같이 구성한 본 발명의 일실시예의 동작을 설명한다.FIG. 4 is a block diagram showing the configuration of the delay unit 27. As shown in FIG. Ting signal ( SINW C t Demux 40 and demuxing; When the most significant bit of the digital signal output from the analog / digital converter 25 is '1', the delay is reduced by receiving a signal from the demux 40 and reducing the delay time by a predetermined time by the digital signal. Section 42; When the most significant bit of the digital signal output from the analog / digital converter 25 is '0', the delay is increased by receiving the signal from the demux 40 and increasing the delay time by the predetermined time by the digital signal. The operation of one embodiment of the present invention constituted by the section 41 and thus constructed will be described.

먼저, 믹서(20)는 로컬 오실레이터(10)로부터 발생되는 반송파( COSωCt )를 입력받아 이를 위상시프터(12)의 시프팅신호( SINWCt )와 승산하여 신호를 출력한다.First, the mixer 20 is a carrier wave generated from the local oscillator 10 ( COSω C t ) And the shifting signal of the phase shifter 12 SINW C t ) To output a signal.

이때, 상기 반송파( COSωCt )가 위상에러 θ 만큼 존재할 경우 상기 믹서(20)에서 승산된 결과를 수식으로 표현하면 다음과 같다.In this case, the carrier ( COSω C t ) Phase error θ If there is as much, the result multiplied by the mixer 20 is expressed as a formula as follows.

---------식(1) --------- Equation (1)

상기 식(1)에서 하모닉(Harmonic)성분인 는 로우패스필터(21)에서 필터링되어 제거된다.The harmonic component in the formula (1) Is filtered by the low pass filter 21 and removed.

이후, 레벨시프터(22)는 상기 로우패스필터(21)의 필터링된 신호를 입력받아 그 신호의 레벨을 시프팅하고, 적분기(23)는 상기 레벨시프터(22)의 시프팅된 신호를 입력받아 이를 적분한다.Then, the level shifter 22 receives the filtered signal of the low pass filter 21 and shifts the level of the signal, and the integrator 23 receives the shifted signal of the level shifter 22. Integrate this.

한편, 검출부(26)는 상기 로컬 오실레이터(10)로부터 발생된 반송파( COSωCt )를 입력받아 이 신호의 에러성분( )인 직류값을 검출한다.On the other hand, the detection unit 26 is a carrier wave generated from the local oscillator 10 ( COSω C t ), The error component of this signal ( DC value is detected.

이를 상세히 설명하면, 상기 검출부(26)의 믹서(30)는 상기 로컬 오실레이터(10)로부터 발생된 반송파( COSωCt )를 입력받아 그 신호만큼의 반송파( COSωCt )를 승산하고, 검출부(26)의 로우패스필터(21)는 상기 믹서(30)로부터 상기 식(1)과 같은 승산신호를 입력받아 이를 로우패스 필터링하며, 검출부(26)의 레벨시프터(22)는 상기 로우패스필터(21)의 필터링된 신호를 입력받아 그 신호의 레벨을 시프팅하여 그 시프팅된 신호를 적분기(33)에서 적분한다.In detail, the mixer 30 of the detector 26 may generate a carrier wave generated from the local oscillator 10. COSω C t ) Receives a carrier as many as that signal ( COSω C t ), The low pass filter 21 of the detector 26 receives the multiplier signal as shown in Equation (1) from the mixer 30 and performs low pass filtering on the multiplier signal, and the level shifter 22 of the detector 26. ) Receives the filtered signal of the low pass filter 21 and shifts the level of the signal to integrate the shifted signal in the integrator 33.

이때, 합성부(24)는 상기 적분기(23)의 적분신호를 입력받아 이를 상기 검출부(26)의 신호와 합성하고, 아나로그/디지털변환부(25)는 상기 합성부(24)의 신호를 입력받아 이를 디지털신호로 변환하여 출력한다.In this case, the combiner 24 receives the integrated signal of the integrator 23 and synthesizes it with the signal of the detector 26, and the analog / digital converter 25 converts the signal of the combiner 24. It receives the input and converts it into a digital signal and outputs it.

이후, 지연부(27)는 상기 디지털신호를 입력받아 그에 따라 위상시프터(12)의 시프팅된 신호( SINWCt )를 소정시간 지연하고, 믹서(11)는 상기 지연부(27)로부터 소정시간 지연된 신호를 입력받아 이를 입력신호(I1(t))와 승산하여 출력한다.Then, the delay unit 27 receives the digital signal and accordingly the shifted signal of the phase shifter 12 ( SINW C t ) Is delayed by a predetermined time, and the mixer 11 receives a signal delayed by a predetermined time from the delay unit 27 and multiplies it by the input signal I1 (t) and outputs the signal.

즉, 상기 에러성분( )인 직류값과 상기 식(1)의 의 직류값이 합성부(14)에서 가감되어 결국 아나로그/디지털변환기(25)는 위상에러에 의한 직류성분인 SINθ 값만 나타난다.That is, the error component ( ) And the DC value of The DC value of is added to or subtracted from the synthesis section 14, and thus the analog / digital converter 25 is a direct current component due to a phase error. SINθ Only the values appear.

이때, 위상에러 θ 가 90 ° 에 더해지는 형태라면 상기 아나로그/디지털변환기(25)의 출력신호는 최상위비트가 '1'인 신호가 발생하고, 만약 상기 위상에러 θ 가 90 ° 에 빼는 형태라면 상기 아나로그/디지털변환기(25)의 출력신호는 최상위비트가 '0'인 신호가 발생한다.At this time, phase error θ 90 ° If the signal is added to the output signal of the analog-to-digital converter 25, a signal having the most significant bit '1' is generated, and if the phase error θ 90 ° If subtracted from the output signal of the analog-to-digital converter 25, a signal having the most significant bit of '0' is generated.

여기서, 디먹스(40)는 상기 아나로그/디지털변환기(25)의 최상위비트가 '1'인 디지털신호에 의해 상기 위상시프터(12)의 시프팅된 신호( SINWCt )를 디먹싱하여 지연감소부(42)로 출력하고, 이에따라 지연감소부(42)는 상기 아나로그/디지털변환기(25)의 디지털신호에 해당되는 먹스가 선택되어 그에 따른 지연시간만큼 상기 디먹스(40)로부터 출력된 디먹싱신호의 지연시간을 감소하여 출력한다.Here, the demux 40 is a shifted signal of the phase shifter 12 by a digital signal having the most significant bit of the analog / digital converter 25 as '1'. SINW C t ) Demuxed and outputted to the delay reducing unit 42. The delay reducing unit 42 selects a mux corresponding to the digital signal of the analog / digital converter 25, and demuxes according to the delay time. The delay time of the demux signal outputted from 40 is reduced and output.

반대로, 상기 디먹스(40)는 상기 아나로그/디지털변환기(25)의 최상위비트가 '0'인 디지털신호에 의해 상기 위상시프터(12)의 시프팅된 신호( SINWCt )를 디먹싱하여 지연증가부(41)로 출력하고, 이에따라 지연증가부(41)는 상기 아나로그/디지털변환기(25)의 디지털신호에 해당되는 먹스가 선택되어 그에 따른 지연시간만큼 상기 디먹스(40)로부터 출력된 디먹싱신호의 지연시간을 증가하여 출력한다.On the contrary, the demux 40 is a shifted signal of the phase shifter 12 by a digital signal of which the most significant bit of the analog / digital converter 25 is '0'. SINW C t ) Demuxed and outputted to the delay increasing unit 41, and accordingly, the delay increasing unit 41 selects a mux corresponding to the digital signal of the analog / digital converter 25, and demuxes according to the delay time. The delay time of the demux signal outputted from 40 is increased and output.

이상에서 상세히 설명한 바와같이 반송파의 위상에러를 내부적으로 보상하여 반송파의 위상차이가 정확히 90 ° 를 유지하도록 하여 데이터신호의 반송파에 의해 발생하는 노이즈를 제거할 수 있는 효과가 있다.As described in detail above, the phase error of the carrier is compensated internally by correcting the phase error of the carrier. ° It is possible to remove the noise generated by the carrier of the data signal by maintaining the.

Claims (3)

반송파를 발생하는 로컬 오실레이터와; 상기 로컬 오실레이터로부터 반송파를 입력받아 이를 90도 만큼 위상을 시프터하는 위상시프터와; 상기 로컬 오실레이터로부터 반송파를 입력받아 이를 제1 입력신호와 승산하는 제1 믹서와; 상기 위상시프터로부터 시프트된 신호를 입력받아 이를 로컬 오실레이터로부터 발생된 신호와 승산하는 제2 믹서와; 상기 제2 믹서로부터 승산신호를 입력받아 이를 로우 패스 필터링하는 로우패스필터와; 상기 로우패스필터로부터 필터링된 신호를 입력받아 그 신호의 레벨을 시프트하는 레벨시프터와; 상기 레벨시프터로부터 출력된 신호를 입력받아 이를 적분하는 적분기와; 상기 로컬 오실레이터로부터 반송파를 입력받아 그 반송파의 위상에러인 직류값을 검출하는 검출부와; 상기 검출부의 직류값과 상기 적분기의 적분신호를 입력받아 이를 가산하는 합성부와; 상기 합성부의 가산신호를 입력받아 이를 디지털신호로 변환하는 아나로그/디지털변환부와; 상기 위상시프터의 시프팅신호를 입력받아 이를 상기 아나로그/디지털변환부의 디지털신호에 의해 소정시간 지연하는 지연부와; 상기 지연부의 지연신호를 입력받아 이를 입력신호와 믹싱하는 제3 믹서로 구성한 것을 특징으로 하는 반송파 위상 에러 보상장치.A local oscillator for generating a carrier; A phase shifter which receives a carrier from the local oscillator and shifts the phase by 90 degrees; A first mixer receiving a carrier from the local oscillator and multiplying the carrier by a first input signal; A second mixer which receives the shifted signal from the phase shifter and multiplies it by a signal generated from a local oscillator; A low pass filter configured to receive a multiplication signal from the second mixer and low pass filter the multiplication signal; A level shifter which receives the filtered signal from the low pass filter and shifts the level of the signal; An integrator that receives the signal output from the level shifter and integrates it; A detector which receives a carrier from the local oscillator and detects a direct current value that is a phase error of the carrier; A synthesizer which receives the DC value of the detector and the integrated signal of the integrator and adds the integrated signal; An analog / digital converting unit which receives the addition signal of the combining unit and converts it into a digital signal; A delay unit which receives a shifting signal of the phase shifter and delays the shift signal by a predetermined time by a digital signal of the analog / digital converter; And a third mixer which receives the delay signal of the delay unit and mixes the delay signal with the input signal. 제1 항에 있어서, 검출부는 로컬 오실레이터로부터 반송파를 입력받아 이를 위상시프터의 시프팅신호와 믹싱하는 믹서와; 상기 믹서로부터 믹싱신호를 입력받아 이를 로우 패스 필터링하는 로우패스필터와; 상기 로우패스필터로부터 필터링된 신호를 입력받아 이 신호의 레벨을 시프팅하는 레벨시프터와; 상기 레벨시프터의 신호를 입력받아 이를 적분하는 적분기로 구성한 것을 특징으로 하는 반송파 위상 에러 보상장치.2. The apparatus of claim 1, further comprising: a mixer which receives a carrier from a local oscillator and mixes it with a shifting signal of a phase shifter; A low pass filter configured to receive a mixing signal from the mixer and low pass filter the mixed signal; A level shifter which receives the filtered signal from the low pass filter and shifts the level of the signal; The carrier phase error compensation device, characterized in that configured to receive the signal of the level shifter and integrate it. 제1 항에 있어서, 지연부는 아나로그/디지털변환부로부터 출력되는 디지털신호의 최상위비트의 값에 따라 위상시프트의 시프팅신호를 디먹싱하는 디먹스와; 상기 아나로그/디지털변환부로부터 출력되는 디지털신호의 최상위비트가 '1'일때 상기 디먹스로부터 신호를 입력받아 이를 상기 디지털신호에 의해 소정시간만큼 지연시간을 감소하는 지연감소부와; 상기 아나로그/디지털변환부로부터 출력되는 디지털신호의 최상위비트가 '0'일때 상기 디먹스로부터 신호를 입력받아 이를 상기 디지털신호에 의해 소정시간만큼 지연시간을 증가하는 지연증가부로 구성한 것을 특징으로 하는 반송파 위상 에러 보상장치.2. The apparatus of claim 1, wherein the delay unit comprises: a demux for demuxing the shift signal of the phase shift according to the value of the most significant bit of the digital signal output from the analog / digital converter; A delay reduction unit receiving a signal from the demux when the most significant bit of the digital signal output from the analog / digital converter is '1' and reducing the delay time by the predetermined time by the digital signal; When the most significant bit of the digital signal output from the analog / digital converter is a '0' input signal received from the demux and comprises a delay increasing unit for increasing the delay time by a predetermined time by the digital signal Carrier phase error compensation device.
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