KR19990005583U - Tuner's Input Tuning Circuit - Google Patents
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Abstract
본 고안은 인덕턴스 결합 회로를 이용하여 되는 입력 동조 회로에 합성 임피던스를 변환하기 위하여 저항을 병렬 연결함으로써 저주파수 대역의 선택도를 향상시키기 위한 튜너의 입력 동조 회로에 관한 것으로, 적어도 입력 신호를 수신하는 제 1 인덕터와 상기 제 1 인덕터에 연결되어 그 일단이 접지되는 제 2 인덕터와 상기 제 2 인덕터와 병렬연결 되는 제 3 인덕터로 되는 인덕턴스 결합회로 및 상기 인덕턴스 결합회로의 제 3 인덕터에 병렬 연결되어 수신되는 신호 주파수를 동조하기 위한 가변 용량 콘덴서를 포함하여 이루어지는 튜너의 입력 동조 회로에 있어서, 상기 인덕턴스 결합회로는 합성 임피던스 값을 변화시켜 저주파 대역에서의 선택도를 향상시키기 위하여 소정의 저항값을 가지는 저항을 상기 제 2 인덕터에 병렬 연결시켜 이루어지기 때문에, 주파수 가변에 따른 합성 임피던스 변화폭을 축소하게 되어 주파수 대역폭을 일정하게 하고 선택도를 양호하게 하는 효과가 있다.The present invention relates to an input tuning circuit of a tuner for improving selectivity of a low frequency band by connecting resistors in parallel to convert a composite impedance to an input tuning circuit using an inductance coupling circuit. A first inductor coupled to the first inductor, the one end of which is grounded, and an inductance coupling circuit comprising a third inductor connected in parallel with the second inductor; In an input tuning circuit of a tuner comprising a variable capacitor for tuning signal frequencies, the inductance coupling circuit employs a resistor having a predetermined resistance value in order to change the synthesized impedance value to improve selectivity in the low frequency band. In parallel with the second inductor Therefore, the variation range is to reduce the composite impedance of the variable frequency has the effect of, and preferably the selectivity of a constant frequency bandwidth.
Description
본 고안은 낮은 주파수 대역에서 원활한 주파수 동조를 이루도록 하는 튜너의 입력 동조 회로에 관한 것으로, 특히 인덕턴스 결합 회로를 이용한 입력 동조 회로에 합성 임피던스를 변환하기 위하여 저항을 병렬 연결하여 이루어지기 때문에 저주파수 대역에서 원활한 동조를 이루어 선택도를 향상시키는 튜너의 입력 동조 회로에 관한 것이다.The present invention relates to an input tuning circuit of a tuner that achieves a smooth frequency tuning in a low frequency band, and is particularly smooth in a low frequency band because a resistor is connected in parallel to convert a composite impedance into an input tuning circuit using an inductance coupling circuit. An input tuning circuit of a tuner that tunes to improve selectivity.
종래 튜너의 입력 동조 회로의 구성을 예시된 도면을 참조로 하여 설명하기로 한다.The configuration of the input tuning circuit of the conventional tuner will be described with reference to the illustrated drawings.
도 1a는 종래 기술에 의한 튜너의 입력 동조 회로를 나타내는 회로도이고, 도 1b는 종래 기술에 의한 튜너의 입력 동조 회로의 등가 회로도이다.Fig. 1A is a circuit diagram showing an input tuning circuit of a tuner according to the prior art, and Fig. 1B is an equivalent circuit diagram of an input tuning circuit of a tuner according to the prior art.
도 1a에 도시된 바와 같이 인덕턴스 결합회로(10)의 제 1 인덕터(L1)를 통하여 신호 주파수를 제공받는다.As shown in FIG. 1A, a signal frequency is provided through the first inductor L 1 of the inductance coupling circuit 10.
상기 인덕턴스 결합회로(10)의 제 1 인덕터(L1)와, 상기 제 1 인덕터(L1)에 제 2 인덕터(L2)와 제 3 인덕터(L3)가 병렬 연결되어 이루어진다.A first inductor L 1 of the inductance coupling circuit 10 and a second inductor L 2 and a third inductor L 3 are connected in parallel to the first inductor L 1 .
상기 제 2 인덕터(L2)는 접지되며, 상기 제 3 인덕터(L3)는 동조 주파수에 대한 변화치를 보상하는 보조 용량이 되는 콘덴서(C)와 병렬 연결되어 상기 가변 용량 콘덴서(CT)에 연결되어 동조 신호를 출력하게 된다.The second inductor L 2 is grounded, and the third inductor L 3 is connected in parallel with the capacitor C, which is a storage capacitor for compensating a change in tuning frequency, to the variable capacitor C T. Connected to output a tuning signal.
상기 제 1, 제 2, 제 3 인덕터(L1∼L3)의 직·병렬 조합으로 구성되는 인덕턴스 결합 회로(10)와 가변 용량 콘덴서(CT)에 의해 동조 회로를 구성한다.The tuning circuit is constituted by the inductance coupling circuit 10 and the variable capacitor CT composed of a series-parallel combination of the first, second, and third inductors L 1 to L 3 .
이때, 주파수 변화에 따라 상기 가변 용량 콘덴서(CT)의 용량값이 변화되어 특정 채널에 동조되게 된다.At this time, the capacitance value of the variable capacitor C T is changed in accordance with the frequency change to be tuned to a specific channel.
상기와 같은 구성으로 되는 종래의 튜너의 입력 동조 회로의 작동을 예시된 도면을 참조하면서 상세히 설명하기로 한다.The operation of the input tuning circuit of the conventional tuner having the above configuration will be described in detail with reference to the illustrated drawings.
도 1b에 도시된 바와 같이, 상기 제 1, 제 2, 제 3 인덕터(L1∼L3)의 합성으로 되는 합성 인덕턴스(LT)와 가변 용량 콘덴서(CT)의 병렬연결로 되는 등가 회로를 구성하게 된다.As shown in FIG. 1B, an equivalent circuit having parallel connection of the composite inductance L T and the variable capacitor C T , which is the synthesis of the first, second, and third inductors L 1 to L 3 . Will be configured.
이때, 입력측을 통하여 제공되는 주파수 변화에 따라 상기 가변 용량 콘덴서(CT)의 용량이 변화하게 되어 특정 주파수 대역에 동조된다.At this time, the capacitance of the variable capacitor C T is changed according to the frequency change provided through the input side, and is tuned to a specific frequency band.
또한, 상기 콘덴서(C)는 동조 주파수에 대한 변화치를 보상하는 보조 용량으로, 특정 채널을 수신하는데 필요한 국부 발진 회로와 입력 동조 회로의 발진 주파수의 차이에 대해 보상함으로써 그 변화치를 조절하게 된다.In addition, the capacitor C is an auxiliary capacitance that compensates for the change in the tuning frequency, and adjusts the change by compensating for the difference between the oscillation frequencies of the local oscillation circuit and the input tuning circuit necessary to receive a specific channel.
그런데, 종래 기술에 의한 튜너의 입력 동조 회로는 인덕턴스 결합 회로를 이용하기 때문에 수신 주파수에 대한 임피던스 변화가 크게 발생되므로 주파수 대역폭이 일정하지 않고 선택도가 양호하지 않게 되는 문제점이 있었다.However, the input tuning circuit of the tuner according to the related art uses an inductance coupling circuit, so that a large change in impedance with respect to a reception frequency occurs, resulting in a problem in that the frequency bandwidth is not constant and the selectivity is not good.
이에, 본 고안에 의한 튜너의 입력 동조 회로는 상기와 같은 문제점을 해결하기 위하여 안출된 것으로, 그 목적으로 하는 바는 주파수 가변에 따른 임피던스 변화폭을 줄여 주파수 대역폭 변화를 축소하고 특정 주파수 대역이 선택되는 동조 회로의 선택도를 향상시킬 수 있는 튜너의 입력 동조 회로를 제공함에 있다.Accordingly, an input tuning circuit of the tuner according to the present invention has been devised to solve the above problems, and its purpose is to reduce the change in the impedance bandwidth according to the frequency change, thereby reducing the change in the frequency bandwidth and selecting a specific frequency band. An input tuning circuit of a tuner capable of improving the selectivity of the tuning circuit is provided.
도 1a는 종래 기술에 의한 튜너의 입력 동조 회로를 나타내는 회로도1A is a circuit diagram showing an input tuning circuit of a tuner according to the prior art.
도 1b는 종래 기술에 의한 튜너의 입력 동조 회로의 등가 회로도1B is an equivalent circuit diagram of an input tuning circuit of a tuner according to the prior art.
도 2a는 본 고안에 의한 튜너의 입력 동조 회로를 나타내는 회로도2A is a circuit diagram showing an input tuning circuit of a tuner according to the present invention.
도 2b는 본 고안에 의한 튜너의 입력 동조 회로의 등가 회로도2B is an equivalent circuit diagram of an input tuning circuit of a tuner according to the present invention.
[도면의 주요부분에 대한 부호의 설명][Explanation of symbols on the main parts of the drawings]
10, 12 : 인덕턴스 결합회로 L1,L2,L3: 인덕터10, 12: inductance coupling circuit L 1 , L 2 , L 3 : inductor
C : 콘덴서 CT: 가변 용량 콘덴서C: Capacitor C T : Variable Capacitor
LT: 합성 인덕턴스 R : 저항L T : Synthetic Inductance R: Resistance
상기 목적을 달성하기 위하여 본 고안에 의한 튜너의 입력 동조 회로는, 적어도 입력 신호를 수신하는 제 1 인덕터와 상기 제 1 인덕터에 연결되어 그 일단이 접지되는 제 2 인덕터와 상기 제 2 인덕터와 병렬연결 되는 제 3 인덕터로 되는 인덕턴스 결합회로와, 상기 인덕턴스 결합회로의 제 3 인덕터에 병렬 연결되어 수신되는 신호 주파수를 동조하기 위한 가변 용량 콘덴서를 포함하여 이루어지는 튜너의 입력 동조 회로에 있어서, 상기 인덕턴스 결합회로는, 합성 임피던스 값을 변화시켜 저주파 대역에서의 선택도를 향상시키기 위하여 소정의 저항값을 가지는 저항을 상기 제 2 인덕터에 병렬 연결시켜 이루어진다.In order to achieve the above object, an input tuning circuit of a tuner according to the present invention includes at least a first inductor for receiving an input signal and a second inductor connected to the first inductor and grounded at one end thereof in parallel with the second inductor. An inductance coupling circuit of a tuner, comprising: an inductance coupling circuit serving as a third inductor; and a variable capacitor for tuning a signal frequency received in parallel with a third inductor of the inductance coupling circuit. In this case, a resistor having a predetermined resistance value is connected in parallel to the second inductor in order to change the synthesized impedance value to improve selectivity in the low frequency band.
상기와 같은 구성으로 이루어지는 본 고안에 의한 튜너의 입력 동조 회로의 구성을 예시된 도면을 참조하면서 설명하기로 한다.A configuration of an input tuning circuit of a tuner according to the present invention having the above configuration will be described with reference to the illustrated drawings.
도 2a는 본 고안에 의한 튜너의 입력 동조 회로를 나타내는 회로도이고, 도 2b는 본 고안에 의한 튜너의 입력 동조 회로의 등가 회로도이다.2A is a circuit diagram showing an input tuning circuit of a tuner according to the present invention, and FIG. 2B is an equivalent circuit diagram of an input tuning circuit of a tuner according to the present invention.
도 2에 도시된 바와 같이 인덕턴스 결합회로(10)의 제 1 인덕터(L1)를 통하여 신호 주파수를 제공받는다.As shown in FIG. 2, a signal frequency is provided through the first inductor L 1 of the inductance coupling circuit 10.
상기 인덕턴스 결합회로(10)의 제 1 인덕터(L1)와, 상기 제 1 인덕터(L1)에 제 2 인덕터(L2)와 제 3 인덕터(L3)가 병렬 연결되어 이루어진다.A first inductor L 1 of the inductance coupling circuit 10 and a second inductor L 2 and a third inductor L 3 are connected in parallel to the first inductor L 1 .
상기 제 2 인덕터(L2)는 접지되며, 상기 제 3 인덕터(L3)는 동조 주파수에 대한 변화치를 보상하는 보조 용량이 되는 콘덴서(C)와 병렬 연결되어 상기 가변 용량 콘덴서(CT)에 연결되어 동조 신호를 출력하게 된다.The second inductor L 2 is grounded, and the third inductor L 3 is connected in parallel with the capacitor C, which is a storage capacitor for compensating a change in tuning frequency, to the variable capacitor C T. Connected to output a tuning signal.
상기 제 1, 제 2, 제 3 인덕터(L1∼L3)의 직·병렬 조합으로 구성되는 인덕턴스 결합 회로(10)와 가변 용량 콘덴서(CT)에 의해 동조 회로를 구성한다.The tuning circuit is constituted by the inductance coupling circuit 10 and the variable capacitor CT composed of a series-parallel combination of the first, second, and third inductors L 1 to L 3 .
이때, 주파수 변화에 따라 상기 가변 용량 콘덴서(CT)의 용량값이 변화되어 특정 채널에 동조되게 된다.At this time, the capacitance value of the variable capacitor C T is changed in accordance with the frequency change to be tuned to a specific channel.
상기와 같은 구성으로 이루어지는 본 고안에 의한 튜너의 입력 동조 회로의 작용을 예시된 도면을 참조하면서 보다 상세히 설명하기로 한다.The operation of the input tuning circuit of the tuner according to the present invention having the configuration as described above will be described in more detail with reference to the illustrated drawings.
도 2a 또는 도 2b에 도시된 바와 같이, 제 1, 제 2, 제 3 인덕터(L1∼L3)를 갖는 인덕턴스 결합 회로(12)가 상기 가변 용량 콘덴서(CT)와 함께 동조 회로를 구성하게 되며, 상기 가변 용량 콘덴서(CT)의 용량 변화에 따라 동조 주파수가 변화하게 되어 원하는 채널의 주파수대에서 동조하게 된다.As shown in Fig. 2A or 2B, an inductance coupling circuit 12 having first, second and third inductors L 1 to L 3 constitutes a tuning circuit together with the variable capacitor C T. In accordance with the change in the capacitance of the variable capacitor C T , the tuning frequency is changed to tune in the frequency band of the desired channel.
이때, 상기 인덕턴스 결합 회로(12)에 접속되는 저항(R)은 저주파수 대역에서 합성 임피던스 값을 변화시켜 원활한 동조가 이루어지도록 하며, 특히 대역폭을 일정하게 하고 선택도를 향상시키기 때문에 안정된 출력을 얻을 수 있다.In this case, the resistor R connected to the inductance coupling circuit 12 changes the synthesized impedance value in the low frequency band so that smooth tuning is achieved. In particular, a stable output can be obtained because the bandwidth is constant and the selectivity is improved. have.
즉, 본 고안에 의한 튜너의 입력 동조 회로는 제 1, 제 2, 제 3 인덕터로 되는 합성 인덕턴스(LT)와, 상기 합성 인덕턴스(LT)에 병렬연결 되는 저항(R)과 가변 용량 콘덴서(CT)의 합성 임피던스를 갖게 되므로 저주파 대역에서의 원활한 주파수 동조를 이룰 수 있게 된다.That is, the tuner's input tuning circuit according to the present invention has a combined inductance L T as the first, second, and third inductors, a resistor R connected in parallel with the combined inductance L T , and a variable capacitor. The composite impedance of (C T ) allows smooth frequency tuning in the low frequency band.
따라서, 본 고안에 의한 튜너의 입력 동조 회로에 의하면, 주파수 가변에 따른 합성 임피던스 변화폭을 축소하게 되어 주파수 대역폭을 일정하게 하고 특정 주파수 대역이 선택되는 동조 회로에서 양호한 선택도를 얻게 되는 효과가 있다.Therefore, according to the input tuning circuit of the tuner according to the present invention, it is possible to reduce the synthesized impedance variation range according to the frequency variation, thereby making the frequency bandwidth constant and obtaining good selectivity in the tuning circuit in which a specific frequency band is selected.
Claims (1)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019970018931U KR19990005583U (en) | 1997-07-18 | 1997-07-18 | Tuner's Input Tuning Circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019970018931U KR19990005583U (en) | 1997-07-18 | 1997-07-18 | Tuner's Input Tuning Circuit |
Publications (1)
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|---|---|
| KR19990005583U true KR19990005583U (en) | 1999-02-18 |
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ID=69680550
Family Applications (1)
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| KR2019970018931U KR19990005583U (en) | 1997-07-18 | 1997-07-18 | Tuner's Input Tuning Circuit |
Country Status (1)
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|---|---|
| KR (1) | KR19990005583U (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100407492B1 (en) * | 2000-11-29 | 2003-11-28 | 알프스 덴키 가부시키가이샤 | Television tuner |
-
1997
- 1997-07-18 KR KR2019970018931U patent/KR19990005583U/en not_active Application Discontinuation
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100407492B1 (en) * | 2000-11-29 | 2003-11-28 | 알프스 덴키 가부시키가이샤 | Television tuner |
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