KR19980037809A - Manufacturing method of silicon tip field emitter coated with diamond carbon thin film - Google Patents

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최영환
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정효수
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이우복
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Abstract

본 발명은 전계방출 표시소자에 사용되는 3극형 실리콘 팁 필드 에미터에 관한 것으로, 특히 3극형 실리콘 팁 필드 에미터의 실리콘 팁 표면에 RPCVD 법으로 다이아몬드성 탄소 박막을 팁의 파괴 없이 균일하게 코팅함으로써, 실리콘 팁 필드 에미터의 전류-전압 특성과 에미션 전류 밀도 및 수명을 향상시킨 실리콘 팁 필드 에미터의 제조방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to tripolar silicon tip field emitters used in field emission display devices, and more particularly by uniformly coating a diamond-like carbon thin film on the silicon tip surface of a tripolar silicon tip field emitter without breaking the tip. The present invention relates to a method for fabricating a silicon tip field emitter with improved current-voltage characteristics, emission current density and lifetime.

Description

다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터의 제조방법Fabrication method of silicon tip field emitter coated with diamond carbon thin film

본 발명은 전계방출 표시소자에서 전계에 의해 전자를 방출하는 실리콘 팁 필드 에미터의 제조방법에 관한 것으로, 특히 3극형의 실리콘 팁 필드 에미터의 실리콘 팁 상부에 RPCVD(Remote Plasma Chemical Vapor Deposition)법으로 다이아몬드성 탄소를 코팅하여 팁의 파손을 방지하고 전자방출 특성을 향상시킨 다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터의 제조방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a method of manufacturing a silicon tip field emitter that emits electrons by an electric field in a field emission display device, and in particular, a RPCVD method on a silicon tip of a tripolar silicon tip field emitter. The present invention relates to a method of manufacturing a silicon tip field emitter coated with a diamond carbon thin film coated with diamond carbon to prevent breakage of the tip and to improve electron emission characteristics.

종래의 3극형 실리콘 팁 필드 에미터는 도1A 내지 도1G에 도시된 바와 같은 공정으로 제조되었다. 먼저 도1A는 P형 실리콘 웨이퍼(10)에 캐소드 전극과 실리콘 팁을 형성할 수 있을 정도의 높이를 갖도록 인(Phosphorous) 이온을 주입하여 인 이온 확산층(11)을 형성하고, 상기 인 이온 확산층(11) 상부에 실리콘 산화막을 형성한 후, 팁 이 형성될 부분 이외의 실리콘 산화막을 식각하여 산화막 마스크(12)를 형성한 것을 나타낸 것이다. 다음에 도1B는 도1A의 산화막 마스크 이외의 노출된 인 이온 확산층(11)을 반응성 이온 식각(Reactive Ion Etching) 방법으로 식각하여 실리콘 팁 에미터(14)와 캐소드 전극(13)을 형성하고, 상기 캐소드 전극(13)과 실리콘 팁 에미터(14) 상부에 샤프닝 산화공정을 실시하여 팁 선단을 날카롭게 한 것을 나타낸 것이다. 다음에 도1C는 도1B의 샤프닝 산화막(도시되지 않음)과 산화막 마스크(12)를 습식식각법으로 제거한 다음, 후술할 절연체(16)와 선택 식각이 가능하도록 캐소드 전극(13)과 실리콘 팁(14) 표면에 실리콘 질화막(15)을 형성하고, 상기 실리콘 질화막(15) 상부에 절연체(16)를 팁(14)의 형상을 따라 등각으로 형성한 것이다. 이때 절연체(16) 두께는 후술할 게이트 전극(17)과 팁 에미터(14) 사이의 거리를 결정하게 된다. 또한, 절연체(16)의 재료는 후 공정인 리플로우 공정을 통하여 평탄화가 용이하게 이루어지도록 SOG(Spin-On-Glass), BPSG (Borophosphosilicate Glass), 및 폴리이미드 등이 사용되나 BPSG가 많이 사용된다. 다음에 도1D는 도1C의 절연체(16)를 리플로우 공정을 통하여 실리콘 질화막(15)의 선단이 노출되도록 평탄화한 것을 나타낸 것이다. 이때 절연체(15)가 BPSG인 경우의 리플로우 공정은 700∼1,000℃ 범위에서 이루어진다. 다음에 도1E는 도1D의 평탄화된 절연체(16)와 노출된 실리콘 질화막(15)의 표면을 따라 등각으로 게이트 금속층(17 또는 게이트 전극)을 형성한 것을 나타낸 것이다. 다음에 도1F는 도1E의 등각으로 형성된 게이트 금속층(17)을 CMP(Chemical Mechanical Polishing) 공정으로 식각하여 실리콘 팁 에미터(14) 상부의 실리콘 질화막(15)이 노출되도록 한 것을 나타낸 것이고, 도1G는 도1F의 게이트 금속층(17)이 평탄화되어 노출된 실리콘 질화막(15)을 습식식각으로 식각하고, 연속해서 절연체(16)를 실리콘 팁(14)이 완전히 노출되도록 습식식각하여 제조된 3극형 실리콘 팁 필드 에미터를 나타낸 것이다.Conventional tripolar silicon tip field emitters were fabricated in a process as shown in FIGS. 1A-1G. First, FIG. 1A illustrates a phosphorus ion diffusion layer 11 by implanting phosphorous ions into a P-type silicon wafer 10 to have a height sufficient to form a cathode electrode and a silicon tip. 11) After the silicon oxide film is formed on the upper portion, the silicon oxide film other than the portion where the tip is to be formed is etched to form the oxide mask 12. Next, FIG. 1B etches the exposed phosphorus ion diffusion layer 11 other than the oxide mask of FIG. 1A by reactive ion etching to form a silicon tip emitter 14 and a cathode electrode 13. The tip of the cathode electrode 13 and the silicon tip emitter 14 is sharpened by a sharp oxidation process. Next, FIG. 1C illustrates the removal of the sharpening oxide film (not shown) and the oxide mask 12 of FIG. 1B by wet etching, and then the cathode 16 and the silicon tip 13 to be selectively etched with the insulator 16 to be described later. 14) A silicon nitride film 15 is formed on the surface, and an insulator 16 is formed conformally on the silicon nitride film 15 along the shape of the tip 14. At this time, the thickness of the insulator 16 determines the distance between the gate electrode 17 and the tip emitter 14 which will be described later. In addition, the material of the insulator 16 is SOG (Spin-On-Glass), BPSG (Borophosphosilicate Glass), polyimide, etc. to facilitate the planarization through a reflow process, which is a post-process. . Next, FIG. 1D shows that the insulator 16 of FIG. 1C is planarized to expose the tip of the silicon nitride film 15 through a reflow process. At this time, when the insulator 15 is BPSG, the reflow step is performed in the range of 700 to 1,000 ° C. 1E shows the formation of a gate metal layer 17 or gate electrode at an equiangular surface along the surfaces of the planarized insulator 16 and exposed silicon nitride film 15 of FIG. 1D. Next, FIG. 1F illustrates that the conformal gate metal layer 17 of FIG. 1E is etched by a chemical mechanical polishing (CMP) process to expose the silicon nitride film 15 on the silicon tip emitter 14. 1G is a three-pole type fabricated by wet etching the exposed silicon nitride film 15 by planarizing the gate metal layer 17 of FIG. 1F, and subsequently wet etching the insulator 16 so that the silicon tip 14 is completely exposed. Silicon tip field emitters are shown.

상술한 공정에 의해 제조된 실리콘 팁 필드 에미터를 스페이서를 매개로 하여 도2에 도시된 바와 같이 애노드 전극(31)과 형광체(32)가 형성되어 있는 상부 기판(30)과 정렬접합시켜 전계방출 표시소자를 완성하게 된다. 상기와 같이 제조된 실리콘 팁 필드 에미터를 갖는 전계방출 표시소자의 게이트 전극(17)과 캐소드 전극(13)에 약 100V의 게이트 전압(35)을 인가하면 게이트 전극(17)과 팁 에미터(14) 사이에 전계가 형성되고, 상기 전계에 의해 실리콘 팁 에미터(14)의 선단으로부터 전자(33)가 방출된다. 이때 애노드 전극(31)과 캐소드 전극(13)에 애노드 전압(34)을 인가하면 애노드 전극(31)에 의해 방출된 전자(33)가 가속되어 형광체(32)를 자극함으로써 전계방출 표시소자의 기능을 수행하게 된다.The silicon tip field emitter manufactured by the above process is aligned with the upper substrate 30 on which the anode electrode 31 and the phosphor 32 are formed as shown in FIG. The display element is completed. When the gate voltage 35 of about 100 V is applied to the gate electrode 17 and the cathode electrode 13 of the field emission display device having the silicon tip field emitter manufactured as described above, the gate electrode 17 and the tip emitter ( An electric field is formed between the layers 14 and electrons 33 are emitted from the tip of the silicon tip emitter 14 by the electric field. At this time, when the anode voltage 34 is applied to the anode electrode 31 and the cathode electrode 13, the electrons 33 emitted by the anode electrode 31 are accelerated to stimulate the phosphor 32 to function as a field emission display device. Will be performed.

상술한 종래의 실리콘 팁 필드 에미터는 실리콘이 금속에 비하여 에미션 전류밀도가 작기 때문에 전계방출형 표시소자에 사용하게 될 경우 휘도가 떨어진다는 문제점이 있으며, 또 실리콘 팁 에미터는 팁의 반경이 200∼400Å 정도로 매우 날카롭기 때문에 동작중에 방출되는 전자에 의하여 이온화된 기체가 충돌하게 될 경우 쉽게 파손된다는 문제점이 있다.The conventional silicon tip field emitter described above has a problem in that the luminance is lowered when the silicon tip field emitter is used in the field emission display device because the emission current density is smaller than that of the metal. Since it is very sharp as about 400 kPa, there is a problem in that when the ionized gas collides with the electrons emitted during operation, it is easily broken.

상술한 문제점들을 해결하기 위하여 개선된 종래의 기술로 실리콘 팁 에미터의 표면에 필드 에미션의 특성이 우수하고 경도가 높은 다이아몬드 박막을 코팅하려는 노력이 있어 왔다. 그러나 일반적으로 열 필라멘트 CVD나 마이크로 웨이브 CVD에 의해 제조되는 다결정 다이아몬드 박막은 섬(island) 성장을 하므로 100Å 이하의 두께에서는 균일한 증착이 불가능하여 필드 에미터에 적용할 경우 에미션의 특성이 불균일해지는 결과를 초래하므로 전계방출 표시소자에 응용하기가 어렵다는 문제점이 있다.In order to solve the above problems, there has been an effort to coat diamond films having high hardness and high hardness on the surface of silicon tip emitters with improved conventional techniques. However, in general, polycrystalline diamond thin films manufactured by thermal filament CVD or microwave CVD have island growth, so that uniform deposition is not possible at a thickness of less than 100 μs, resulting in uneven emission characteristics when applied to field emitters. As a result, it is difficult to apply to the field emission display device.

따라서 본 발명은 실리콘 팁 필드 에미터의 팁과 캐소드 전극 표면에 RPCVD법으로 다이아몬드성 탄소를 실리콘 팁 에미터의 파괴 없이 균일하게 증착함으로써 필드 에미터의 전류-전압 특성과 에미션 전류 밀도, 그리고 필드 에미터의 수명을 향상시키는데 그목적이 있다.Accordingly, the present invention provides uniform deposition of diamond-like carbon on the tip and cathode electrode surfaces of silicon tip field emitters without rupturing the silicon tip emitters. The purpose is to improve the life of the emitter.

도1A 내지 도1G는 종래의 3극형 실리콘 팁 필드 에미터의 제조공정을 순차적으로 나타낸 단면도.1A to 1G are cross-sectional views sequentially illustrating a manufacturing process of a conventional tripolar silicon tip field emitter.

도2는 도1A 내지 도1G의 공정에 의해 제조된 3극형 실리콘 팁 필드 에미터를 이용한 전계방출 표시소자를 나타낸 단면도.FIG. 2 is a cross-sectional view showing a field emission display device using a tripolar silicon tip field emitter manufactured by the process of FIGS. 1A to 1G;

도3A 내지 도3F는 본 발명에 따른 다이아몬드성 탄소 박막이 코팅된 3극형 실리콘 팁 필드 에미터의 제조공정을 순차적으로 나타낸 단면도.3A to 3F are cross-sectional views sequentially illustrating a manufacturing process of a tripolar silicon tip field emitter coated with a diamond-like carbon thin film according to the present invention.

도4는 도3A 내지 도3F의 공정에 의해 제조된 다이아몬드성 탄소 박막이 코팅된 3극형 실리콘 팁 필드 에미터를 이용한 전계방출 표시소자를 나타낸 단면도.4 is a cross-sectional view of a field emission display device using a tripolar silicon tip field emitter coated with a diamond-like carbon thin film manufactured by the process of FIGS. 3A to 3F.

도면의주요부분에대한부호의설명Explanation of symbols on the main parts of the drawing

10,20 : 실리콘 웨이퍼 11,21 : 인 이온 확산층10,20: silicon wafer 11,21: phosphorus ion diffusion layer

12,22 : 마스크 13,23 : 캐소드 전극12,22 mask 13,23 cathode electrode

14,24 : 실리콘 팁 15 : 실리콘 질화막14,24 silicon tip 15 silicon nitride film

16,26 : 절연체 17,27 : 게이트 전극16,26: insulator 17,27: gate electrode

25 : 다이아몬드성 탄소 28 : 평탄화층25 diamondy carbon 28 planarization layer

30 : 상부기판 31 : 애노드 전극30: upper substrate 31: anode electrode

32 : 형광체 33 : 전자32: phosphor 33: electron

34 : 애노드 전압 35 : 게이트 전압34: anode voltage 35: gate voltage

본 발명은 RPCVD법으로 다이아몬드성 탄소 박막을 실리콘 팁 필드 에미터의 캐소드 전극과 팁의 표면에 코팅하는 제조방법에 관한 것으로 도3A 내지 도3F에 도시된 바와 같이 순차적인 공정에 의해 제조된다.The present invention relates to a method of coating a diamond-like carbon thin film on the surface of a cathode and a tip of a silicon tip field emitter by RPCVD, and is manufactured by a sequential process as shown in FIGS. 3A to 3F.

먼저 도3A 및 도3B는 상술한 도2A 및 도2B와 제조방법이 동일하므로 더 이상의 설명은 생략하기로 한다. 다음에 도3C는 도3B의 캐소드 전극(23)과 실리콘 팁(24) 상부에 RPCVD법으로 다이아몬드성 탄소 박막(25)을 약 300∼600Å의 두께로 코팅한 것을 나타낸다. 다음에 3D는 도3C의 다이아몬드성 탄소 박막(25) 상부에 절연체(26)와 게이트 전극(27)을 순차적으로 팁 에미터(24)의 형상을 따라 등각이 되도록 형성하고, 상기 등각으로 형성된 게이트 전극(27) 상부에 포토레지스트를 스핀코팅 방법으로 증착하여 평탄화층(28)을 형성한 것을 나타낸다. 다음에 도3E는 도3D의 평탄화층(28)을 아르곤 스퍼터링 식각법으로 식각하여 팁 에미터(24) 상부에 등각으로 형성되어 있는 게이트 전극(27)의 선단이 노출되도록 한 것을 나타낸다. 다음에 도3F는 도3E의 노출된 게이트 전극(27)을 반응성 이온식각법으로 식각한 다음, 계속해서 습식식각으로 절연체를 다이아몬드성 탄소 박막(25)이 코팅된 실리콘 팁(24)의 선단이 노출되도록 식각한 다음, 게이트 전극(27) 상부에 남아 있는 평탄화층(28)을 제거하여 완성된 다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터를 나타낸다.First, since FIGS. 3A and 3B are the same as those of FIGS. 2A and 2B, the detailed description thereof will be omitted. Next, FIG. 3C shows a diamond-like carbon thin film 25 coated on the cathode electrode 23 and the silicon tip 24 of FIG. 3B with a thickness of about 300 to 600 kPa by RPCVD. Next, 3D forms an insulator 26 and a gate electrode 27 on the diamond-like carbon thin film 25 of FIG. 3C in order to conformally conform to the shape of the tip emitter 24, and the gate formed at the conformal angle. The planarization layer 28 is formed by depositing a photoresist on the electrode 27 by spin coating. 3E shows that the planarization layer 28 of FIG. 3D is etched by argon sputtering etching so as to expose the tip of the gate electrode 27 formed conformally on the tip emitter 24. Next, FIG. 3F etches the exposed gate electrode 27 of FIG. 3E by reactive ion etching, and then wets the insulator with the tip of the silicon tip 24 coated with the diamond-like carbon thin film 25. After etching to expose, the planarization layer 28 remaining above the gate electrode 27 is removed to show a silicon tip field emitter coated with the finished diamondoid carbon thin film.

상술한 공정에 의해 제조된 다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터를 이용하여 도4에 도시된 바와 같이 스페이서(도시되지 않음)를 매개로 하여 애노드 전극(31)과 형광체(32)가 형성되어 있는 상부기판(30)을 정렬접합 시켜 전계방출 표시소자를 제조한다.Using the silicon tip field emitter coated with the diamond-like carbon thin film manufactured by the above-described process, the anode electrode 31 and the phosphor 32 were formed through a spacer (not shown) as shown in FIG. The formed top substrate 30 is aligned and manufactured to manufacture a field emission display device.

도시된 다이아몬드성 탄소 박막(25)이 코팅된 실리콘 팁 필드 에미터를 갖는 전계방출 표시소자의 게이트 전극(27)과 캐소드 전극(23)에 약 100V의 게이트 전압(35)을 인가하게 되면 팁 에미터(24)와 게이트 전극(27) 사이에 약 1 V/Å 이상의 전기장이 발생되어 팁(24) 선단으로부터 전자(33)를 방출시키고, 이때 애노드 전극(31)과 캐소드 전극(23)에 인가되는 애노드 전압(31)에 의해 방출된 전자(33)는 애노드 전극(31)으로 가속되고, 가속된 전자(33)는 형광체(32)를 자극하여 전계방출 표시소자의 기능을 수행하게 된다.When a gate voltage 35 of about 100 V is applied to the gate electrode 27 and the cathode electrode 23 of the field emission display device having the silicon tip field emitter coated with the diamond-like carbon thin film 25 shown in FIG. An electric field of about 1 V / Å or more is generated between the rotor 24 and the gate electrode 27 to emit electrons 33 from the tip 24, which is applied to the anode electrode 31 and the cathode electrode 23. The electrons 33 emitted by the anode voltage 31 are accelerated to the anode electrode 31, and the accelerated electrons 33 stimulate the phosphor 32 to perform the function of the field emission display device.

본 발명은 상술한 바와 같이 실리콘 팁 에미터와 캐소드 전극의 표면에 다이아몬드성 탄소박막을 코팅함으로써 전자방출에 필요한 문턱전압을 감소시켜 게이트 전압을 낮출 수 있으며, 전자방출 전류밀도가 균일하고, 에미션의 균일도가 향상된다. 또한 실리콘 팁 에미터의 동작중 발생되는 이온들의 충돌에 의한 에미터 선단의 파손을 방지할 수 있어 에미터의 신뢰도와 수명을 향상시키고, 코팅된 다이아몬드성 탄소박막의 표면은 다른 재료에 비하여 화학작용이 적게 발생하므로 기체의 흡착 및 탈착 현상되어 방출 전류의 안정성을 향상시켜 노이즈를 줄일 수 있다.The present invention can reduce the threshold voltage required for electron emission by coating a diamond-like carbon thin film on the surface of the silicon tip emitter and the cathode as described above to lower the gate voltage, uniform electron emission current density, emission The uniformity of is improved. In addition, the tip of the emitter can be prevented from being damaged by the collision of ions generated during the operation of the silicon tip emitter, which improves the reliability and life of the emitter. Since the gas is generated less, the adsorption and desorption of the gas may be improved to reduce the noise by improving the stability of the discharge current.

또한 실리콘 팁 표면에 다이아몬드성 탄소 박막을 RPCVD법으로 코팅하므로 증착되는 물질의 에너지를 최소화함으로써 다이아몬드성 탄소 박막의 코팅시 충격으로 실리콘 팁의 선단이 파손되는 것을 방지한다.In addition, since the diamond-like carbon thin film is coated on the silicon tip surface by RPCVD method, the energy of the deposited material is minimized to prevent the tip of the silicon tip from being damaged by the impact during coating of the diamond-like carbon thin film.

또한 평탄화층으로 포토레지스트를 코팅하고 이를 아르곤 스퍼터링 방법으로 식각하므로써 제조단가를 낮출 수 있다.In addition, the manufacturing cost can be lowered by coating the photoresist with the planarization layer and etching it by the argon sputtering method.

Claims (5)

실리콘 웨이퍼에 인 이온을 주입하여 확산층을 형성하고, 상기 확산층 상부의 팁이 형성될 부분에 실리콘 산화막 마스트를 형성하는 단계와,Implanting phosphorus ions into the silicon wafer to form a diffusion layer, and forming a silicon oxide film mast on a portion where the tip of the diffusion layer is to be formed; 상기 산화막 마스크 이외의 노출된 확산층을 식각하여 산화막 마스크 하부에 실리콘 팁과 캐소드 전극을 형성한 후, 팁 선단을 날카롭게 하기 위하여 샤프인 산화막을 형성하는 단계와,Etching the exposed diffusion layers other than the oxide mask to form a silicon tip and a cathode electrode under the oxide mask, and then forming a sharp oxide film to sharpen the tip tip; 상기 산화막 마스크와 샤프인 산화막을 제거한 후, 노출된 팁과 캐소드 전극 표면에 다이아몬드성 탄소박막을 코팅하는 단계와,After removing the oxide mask and the oxide oxide which is sharp, coating a diamond-like carbon thin film on the exposed tip and the cathode electrode surface; 팁 상부에 등각으로 형성된 절연층과 게이트 금속층 상부에 게이트 금속층을 완전히 덮도록 평탄화층을 형성하는 단계와;Forming a planarization layer so as to completely cover the gate metal layer over the gate metal layer and the insulating layer formed on top of the tip; 상기 다이마몬드성 탄소박막 상부에 절연체와 게이트 금속층을 팁의 형상을 따라 등각으로 형성하는 단계와,Forming an insulator and a gate metal layer in conformal shape on a tip of the diamond-like carbon thin film along the shape of the tip; 상기 게이트 금속층 상부에 게이트 금속층을 완전히 덮도록 평탄화층을 형성하는 단계와,Forming a planarization layer on the gate metal layer to completely cover the gate metal layer; 상기 게이트 금속층 상부의 평탄화층을 팁 상부의 게이트 금속층 선단이 노출되도록 식각하는 단계와;Etching the planarization layer over the gate metal layer to expose the tip of the gate metal layer over the tip; 상기 평탄화층의 식각에 의해 노출된 게이트 금속층을 식각한 후, 연속해서 다이아몬드성 탄소 박막이 코팅된 팁이 선단이 노출되도록 절연체를 식각하는 단계와,Etching the gate metal layer exposed by the etching of the planarization layer, and subsequently etching the insulator such that the tip coated with the diamond-like carbon thin film is exposed at its tip; 상기 절연체를 식각한 후 잔존하는 평탄화층을 제거하는 단계를 포함하는 것을 특징으로하는 다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터의 제조방법.And removing the planarization layer remaining after etching the insulator. 제 1 항에 있어서,The method of claim 1, 상기 캐소드 전극과 팁 상부에 다이아몬드성 탄소 박막을 RPVCD(Remote Plasma Chemical Vapor Deposition)법으로 코팅하는 것을 특징으로 하는 다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터의 제조방법.A method of manufacturing a silicon tip field emitter coated with a diamond carbon film, characterized in that the diamond electrode is coated with a diamond carbon thin film on the tip and the tip by a Remote Plasma Chemical Vapor Deposition (RPVCD) method. 제 1 항 또는 제 2 항에 있어서,The method according to claim 1 or 2, 상기 다이아몬드성 탄소 박막은 약 300∼600Å의 두께로 코팅하는 것을 특징으로 하는 다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터의 제조방법.The diamond-like carbon thin film is coated with a diamond-like carbon thin film, characterized in that the coating of a thickness of about 300 ~ 600Å. 제 1 항에 있어서,The method of claim 1, 상기 게이트 금속층 상부에 형성되는 평탄화층은 포토레지스트인 것을 특징으로 하는 다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터의 제조방법.And a planarization layer formed on the gate metal layer is a photoresist. 제 1 항에 있어서,The method of claim 1, 상기 게이트 금속층 상부의 평탄화층을 아르곤 이온식각법을 사용하여 식각하는 것을 특징으로 하는 다이아몬드성 탄소 박막이 코팅된 실리콘 팁 필드 에미터의 제조방법.And a planarization layer on the gate metal layer is etched using an argon ion etching method.
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