KR102596361B1 - Thin film transistor and display apparatus comprising the same - Google Patents

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Abstract

본 발명은 박막 트랜지스터 및 이를 포함하는 표시 장치에 관한 것으로, 본 발명의 일 실시예에 따른 박막 트랜지스터는 기판 상에 배치되고 산화물 반도체 물질로 이루어진 액티브층, 액티브층 상의 게이트 절연층, 게이트 절연층을 사이에 두고 액티브층과 중첩하는 게이트 전극, 게이트 전극 상의 층간 절연층, 층간 절연층에 형성된 컨택홀을 통해 액티브층과 전기적으로 연결되고, 층간 절연층 상에서 서로 이격되어 배치된 소스 전극 및 드레인 전극, 및 소스 전극 및 드레인 전극 중 어느 하나와 전기적으로 연결되고, 게이트 전극과 중첩하도록 층간 절연층 상에 배치된 산화물 배리어층을 포함한다. 따라서, 산화물 반도체 물질로 이루어진 액티브층으로 수소가 유입되는 것을 차단하여 박막 트랜지스터의 성능이 감소하는 것을 방지할 수 있다.The present invention relates to a thin film transistor and a display device including the same. The thin film transistor according to an embodiment of the present invention is disposed on a substrate and includes an active layer made of an oxide semiconductor material, a gate insulating layer on the active layer, and a gate insulating layer. A gate electrode overlapping the active layer with an interlayer in between, an interlayer insulating layer on the gate electrode, a source electrode and a drain electrode electrically connected to the active layer through a contact hole formed in the interlayer insulating layer, and spaced apart from each other on the interlayer insulating layer; and an oxide barrier layer electrically connected to one of the source electrode and the drain electrode and disposed on the interlayer insulating layer to overlap the gate electrode. Accordingly, the performance of the thin film transistor can be prevented from being reduced by blocking hydrogen from flowing into the active layer made of an oxide semiconductor material.

Description

박막 트랜지스터 및 이를 포함하는 표시 장치{THIN FILM TRANSISTOR AND DISPLAY APPARATUS COMPRISING THE SAME}Thin film transistor and display device including same {THIN FILM TRANSISTOR AND DISPLAY APPARATUS COMPRISING THE SAME}

본 명세서는 박막 트랜지스터 및 이를 포함하는 표시 장치에 관한 것으로서, 보다 상세하게는 수소에 의한 성능 저하를 방지할 수 있는 박막 트랜지스터 및 표시 장치에 관한 것이다.This specification relates to a thin film transistor and a display device including the same, and more specifically, to a thin film transistor and a display device that can prevent performance degradation due to hydrogen.

최근, 본격적인 정보화 시대로 접어듦에 따라 전기적 정보 신호를 시각적으로 표현하는 디스플레이 분야가 급속도로 발전해 왔고, 이에 부응하여 박형화, 경량화, 저 소비전력화의 우수한 성능을 지닌 여러 가지 다양한 표시 장치(Display Apparatus)가 개발되고 있다. 이와 같은 표시 장치의 구체적인 예로는 액정 표시 장치(LCD), 유기 발광 표시 장치(OLED) 및 퀀텀닷 발광 표시 장치 (QLED)와 같은 전계 발광 표시 장치(Electroluminescence Display)등을 들 수 있다. Recently, as we entered the full-fledged information age, the field of displays that visually express electrical information signals has developed rapidly, and in response to this, various display devices (Display Apparatus) with excellent performance such as thinness, weight, and low power consumption have been developed. is being developed. Specific examples of such display devices include electroluminescence displays such as liquid crystal displays (LCDs), organic light emitting displays (OLEDs), and quantum dot light emitting displays (QLEDs).

전계 발광 표시 장치는 영상을 표시하기 위한 표시 영역 및 표시 영역에 인접하여 배치되는 비표시 영역을 포함한다. 그리고, 화소 영역은 화소 회로 및 발광 소자를 포함한다. 화소 회로에는 복수의 박막 트랜지스터가 위치하여 복수의 화소에 배치된 발광 소자를 구동시킨다. An electroluminescent display device includes a display area for displaying an image and a non-display area disposed adjacent to the display area. And, the pixel area includes a pixel circuit and a light emitting element. A plurality of thin film transistors are located in the pixel circuit to drive light emitting elements arranged in a plurality of pixels.

박막 트랜지스터는 액티브층을 구성하는 물질에 따라 분류될 수 있다. 그 중 저온 폴리 실리콘(Low Temperature Poly-Silicon: LTPS) 박막 트랜지스터 및 산화물(oxide) 박막 트랜지스터가 가장 널리 사용되고 있다. 한편, 동일한 기판 위에 LTPS 박막 트랜지스터와 산화물 박막 트랜지스터가 형성된 전계 발광 표시 장치의 기술 개발이 활발하게 이루어지고 있다.Thin film transistors can be classified according to the material that makes up the active layer. Among them, low temperature poly-silicon (LTPS) thin film transistors and oxide thin film transistors are the most widely used. Meanwhile, the technology development of electroluminescent display devices in which LTPS thin film transistors and oxide thin film transistors are formed on the same substrate is being actively developed.

한편, 본 명세서의 발명자는 표시 장치에 있어서, 복수의 박막 트랜지스터를 서로 상이한 반도체로 형성하는 멀티 타입의 박막 트랜지스터를 사용함으로써 화소의 동작 특성을 개선할 수 있다는 점을 인지하였다. Meanwhile, the inventor of the present specification recognized that the operating characteristics of a pixel can be improved by using a multi-type thin film transistor in which a plurality of thin film transistors are formed of different semiconductors in a display device.

LTPS 박막 트랜지스터는 이동도가 높은(100㎠/Vs 이상) 폴리 실리콘 물질을 사용하므로, 에너지 소비 전력이 낮고 신뢰성이 우수하다. 반면에, 산화물 박막 트랜지스터는 LTPS 박막 트랜지스터과 비교하여, 밴드갭이 더 큰 물질을 액티브층으로 사용한다. 이로 인해, 산화물 박막 트랜지스터는 오프-전류(Off-Current)가 낮으며, 온(On) 시간이 짧고 오프(Off) 시간을 길게 유지할 수 있다. 이에 제한되는 것은 아니나, LTPS 박막 트랜지스터는 구동 박막 트랜지스터에 사용될 수 있고, 산화물 박막 트랜지스터는 스위칭 박막 트랜지스터에 사용될 수 있다.LTPS thin film transistors use polysilicon materials with high mobility (more than 100 cm2/Vs), so they have low energy consumption and excellent reliability. On the other hand, oxide thin film transistors use a material with a larger band gap as the active layer compared to LTPS thin film transistors. Because of this, the oxide thin film transistor has a low off-current, has a short on time, and can maintain a long off time. Although not limited thereto, LTPS thin film transistors can be used in driving thin film transistors, and oxide thin film transistors can be used in switching thin film transistors.

한편, 유기 발광 표시 장치 및 퀀텀닷 발광 표시 장치와 같은 전계 발광 표시 장치는 박막 트랜지스터 상에 형성된 다양한 유기물층을 포함한다. 예를 들어, 박막 트랜지스터를 보호하기 위한 보호층, 박막 트랜지스터 상부를 평탄화하기 위한 평탄화층 또는 박막 트랜지스터 및 표시 소자를 보호하기 위한 봉지층 등이 배치될 수 있다. 이러한, 유기물층은 제조 공정에서 고온에 의하여 수소를 발생시킬 수 있다. 뿐만 아니라, 표시 장치가 구동됨에 따라, 각종 유기물층에서 수소 및 수소 이온이 발생될 수 있다. Meanwhile, electroluminescent display devices such as organic light emitting display devices and quantum dot light emitting display devices include various organic material layers formed on thin film transistors. For example, a protective layer to protect the thin film transistor, a planarization layer to planarize the upper part of the thin film transistor, or an encapsulation layer to protect the thin film transistor and the display device, etc. may be disposed. This organic material layer can generate hydrogen at high temperatures during the manufacturing process. In addition, as the display device is driven, hydrogen and hydrogen ions may be generated in various organic material layers.

표시 장치 내부에서 발생한 수소 및 수소 이온은 확산되어 박막 트랜지스터를 구성하는 전극 및 액티브층에 영향을 주어, 휘도를 저하시키거나 화소 불량을 야기시킬 수 있다. 특히, 산화물 박막 트랜지스터의 경우, 액티브층을 구성하는 산화물 반도체 물질에 수소가 확산되면, 캐리어가 생성되고 임계 전압(threshold voltage; Vth)이 변경될 수 있는 문제점이 있다.Hydrogen and hydrogen ions generated inside the display device may diffuse and affect the electrodes and active layers constituting the thin film transistor, reducing brightness or causing pixel defects. In particular, in the case of oxide thin film transistors, there is a problem that when hydrogen diffuses into the oxide semiconductor material constituting the active layer, carriers are generated and the threshold voltage (Vth) may change.

이에 본 명세서의 발명자들은 위에서 언급한 문제점들을 인식하고, 수소에 의한 박막 트랜지스터의 불량을 방지하기 위한 기술을 개발하였다.Accordingly, the inventors of the present specification recognized the above-mentioned problems and developed technology to prevent defects in thin film transistors caused by hydrogen.

본 발명이 해결하고자 하는 과제는 박막 트랜지스터에 영향을 줄 수 있는 수소가 게이트 전극 또는 액티브층으로 확산되는 것을 차단할 수 있는 박막 트랜지스터 및 표시 장치를 제공하는 것이다.The problem to be solved by the present invention is to provide a thin film transistor and a display device that can block hydrogen, which can affect the thin film transistor, from diffusing into the gate electrode or active layer.

본 발명의 과제들은 이상에서 언급한 과제들로 제한되지 않으며, 언급되지 않은 또 다른 과제들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.The problems of the present invention are not limited to the problems mentioned above, and other problems not mentioned will be clearly understood by those skilled in the art from the description below.

전술한 바와 같은 과제를 해결하기 위하여 본 발명의 일 실시예에 따른 박막 트랜지스터는 기판 상에 배치되고 산화물 반도체 물질로 이루어진 액티브층, 액티브층 상의 게이트 절연층, 게이트 절연층을 사이에 두고 액티브층과 중첩하는 게이트 전극, 게이트 전극 상의 층간 절연층, 층간 절연층에 형성된 컨택홀을 통해 액티브층과 전기적으로 연결되고, 층간 절연층 상에서 서로 이격되어 배치된 소스 전극 및 드레인 전극, 및 소스 전극 및 드레인 전극 중 어느 하나와 전기적으로 연결되고, 게이트 전극과 중첩하도록 층간 절연층 상에 배치된 산화물 배리어층을 포함한다. 따라서, 산화물 반도체 물질로 이루어진 액티브층으로 수소가 유입되는 것을 차단하여 박막 트랜지스터의 성능이 감소하는 것을 방지할 수 있다.In order to solve the above-described problem, a thin film transistor according to an embodiment of the present invention is disposed on a substrate and includes an active layer made of an oxide semiconductor material, a gate insulating layer on the active layer, and an active layer with the gate insulating layer in between. Overlapping gate electrodes, an interlayer insulating layer on the gate electrode, a source electrode and a drain electrode electrically connected to the active layer through a contact hole formed in the interlayer insulating layer, and spaced apart from each other on the interlayer insulating layer, and a source electrode and a drain electrode. It is electrically connected to any one of the electrodes and includes an oxide barrier layer disposed on the interlayer insulating layer to overlap the gate electrode. Accordingly, the performance of the thin film transistor can be prevented from being reduced by blocking hydrogen from flowing into the active layer made of an oxide semiconductor material.

전술한 바와 같은 과제를 해결하기 위하여 본 발명의 일 실시예에 따른 표시 장치는, 저온 폴리 실리콘 물질을 포함하는 제1 박막 트랜지스터, 산화물 반도체 물질을 포함하는 제2 박막 트랜지스터, 제1 박막 트랜지스터 및 제2 박막 트랜지스터 상에 배치되고, 애노드, 유기발광층, 및 캐소드를 포함하는 유기 발광 소자, 및 유기 발광 소자 상에 배치되는 봉지부를 포함하고, 제2 박막 트랜지스터는 봉지부에서 발생하는 수소가 제2 박막 트랜지스터로 유입되는 것을 차단하기 위하여, 제2 박막 트랜지스터의 게이트 전극 및 액티브층과 봉지부 사이에 산화물로 이루어진 산화물 배리어층을 포함한다.In order to solve the problems described above, a display device according to an embodiment of the present invention includes a first thin film transistor including a low-temperature polysilicon material, a second thin film transistor including an oxide semiconductor material, a first thin film transistor, and a second thin film transistor. 2 disposed on a thin film transistor, and includes an organic light-emitting device including an anode, an organic light-emitting layer, and a cathode, and an encapsulation portion disposed on the organic light-emitting device, wherein hydrogen generated in the encapsulation portion is transferred to the second thin film. In order to block inflow into the transistor, an oxide barrier layer made of oxide is included between the gate electrode and the active layer of the second thin film transistor and the encapsulation part.

기타 실시예의 구체적인 사항들은 상세한 설명 및 도면들에 포함되어 있다.Specific details of other embodiments are included in the detailed description and drawings.

본 발명은 박막 트랜지스터와 유기 발광 소자 사이에 산화물 배리어층을 배치함으로써, 박막 트랜지스터 상부의 유기물층으로부터 수소가 유입되는 것을 차단하여 박막 트랜지스터의 성능이 감소하는 것을 방지할 수 있다.The present invention can prevent a decrease in performance of the thin film transistor by disposing an oxide barrier layer between the thin film transistor and the organic light emitting device, thereby blocking hydrogen from flowing in from the organic layer on the top of the thin film transistor.

또한, 본 발명은 소스 전극 또는 드레인 전극과 연결된 산화물 배리어층에 양전위를 인가함으로써, 수소 이온과의 척력을 이용하여 수소 이온의 유입을 억제할 수 있다.In addition, the present invention can suppress the inflow of hydrogen ions by applying a positive potential to the oxide barrier layer connected to the source electrode or drain electrode, using a repulsive force with hydrogen ions.

또한, 본 발명은 상이한 반도체 물질을 포함하는 멀티 타입의 박막 트랜지스터를 포함하는 표시 장치에 있어서, 산화물 반도체 물질을 포함하는 스위칭 트랜지스터의 성능 저하 및 임계 전압이 변경되는 문제를 해소할 수 있다.In addition, the present invention can solve problems of performance degradation and threshold voltage changes of switching transistors containing oxide semiconductor materials in display devices containing multi-type thin film transistors containing different semiconductor materials.

본 발명에 따른 효과는 이상에서 예시된 내용에 의해 제한되지 않으며, 더욱 다양한 효과들이 본 발명 내에 포함되어 있다.The effects according to the present invention are not limited to the details exemplified above, and further various effects are included within the present invention.

도 1a 내지 1c는 본 명세서의 일 실시예에 따른 표시 장치를 도시한 단면도이다.
도 2는 본 명세서의 다른 실시예에 따른 표시 장치를 도시한 단면도이다.
도 3은 본 명세서의 또 다른 실시예에 따른 표시 장치를 도시한 단면도이다.
도 4는 본 명세서의 또 다른 실시예에 따른 표시 장치를 도시한 단면도이다.
1A to 1C are cross-sectional views showing a display device according to an embodiment of the present specification.
Figure 2 is a cross-sectional view showing a display device according to another embodiment of the present specification.
Figure 3 is a cross-sectional view showing a display device according to another embodiment of the present specification.
Figure 4 is a cross-sectional view showing a display device according to another embodiment of the present specification.

본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나, 본 발명은 이하에서 개시되는 실시예들에 제한되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다.The advantages and features of the present invention and methods for achieving them will become clear by referring to the embodiments described in detail below along with the accompanying drawings. However, the present invention is not limited to the embodiments disclosed below and will be implemented in various different forms, but the present embodiments only serve to complete the disclosure of the present invention, and are not limited to the embodiments disclosed below, and are known to those skilled in the art in the technical field to which the present invention pertains. It is provided to fully inform those who have the scope of the invention, and the present invention is only defined by the scope of the claims.

본 발명의 실시예를 설명하기 위한 도면에 개시된 형상, 크기, 비율, 각도, 개수 등은 예시적인 것이므로 본 발명이 도시된 사항에 제한되는 것은 아니다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다. 또한, 본 발명을 설명함에 있어서, 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명은 생략한다. 본 발명 상에서 언급된 '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 '~만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 구성 요소를 단수로 표현한 경우에 특별히 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함한다.The shape, size, ratio, angle, number, etc. disclosed in the drawings for explaining embodiments of the present invention are illustrative and the present invention is not limited to the matters shown. Like reference numerals refer to like elements throughout the specification. Additionally, in describing the present invention, if it is determined that a detailed description of related known technologies may unnecessarily obscure the gist of the present invention, the detailed description will be omitted. When 'comprises', 'has', 'consists of', etc. mentioned in the present invention are used, other parts may be added unless 'only' is used. When a component is expressed in the singular, the plural is included unless specifically stated otherwise.

구성 요소를 해석함에 있어서, 별도의 명시적 기재가 없더라도 오차 범위를 포함하는 것으로 해석한다. When interpreting a component, it is interpreted to include the margin of error even if there is no separate explicit description.

위치 관계에 대한 설명일 경우, 예를 들어, '~상에', '~상부에', '~하부에', '~옆에' 등으로 두 부분의 위치 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다.In the case of a description of a positional relationship, for example, if the positional relationship of two parts is described as 'on top', 'on the top', 'on the bottom', 'next to', etc., 'immediately' Alternatively, there may be one or more other parts placed between the two parts, unless 'directly' is used.

소자 또는 층이 다른 소자 또는 층 "위 (on)"로 지칭되는 것은 다른 소자 바로 위에 또는 중간에 다른 층 또는 다른 소자를 개재한 경우를 모두 포함한다.When an element or layer is referred to as “on” another element or layer, it includes instances where the other layer or other element is directly on top of or interposed between the other elements.

또한 제 1, 제 2 등이 다양한 구성 요소들을 서술하기 위해서 사용되나, 이들 구성 요소들은 이들 용어에 의해 제한되지 않는다. 이들 용어들은 단지 하나의 구성 요소를 다른 구성 요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제 1 구성 요소는 본 발명의 기술적 사상 내에서 제 2 구성 요소일 수도 있다.Additionally, first, second, etc. are used to describe various components, but these components are not limited by these terms. These terms are merely used to distinguish one component from another. Accordingly, the first component mentioned below may also be the second component within the technical spirit of the present invention.

명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.Like reference numerals refer to like elements throughout the specification.

도면에서 나타난 각 구성의 크기 및 두께는 설명의 편의를 위해 도시된 것이며, 본 발명이 도시된 구성의 크기 및 두께에 반드시 한정되는 것은 아니다.The size and thickness of each component shown in the drawings are shown for convenience of explanation, and the present invention is not necessarily limited to the size and thickness of the components shown.

본 발명의 여러 실시예들의 각각 특징들이 부분적으로 또는 전체적으로 서로 결합 또는 조합 가능하고, 기술적으로 다양한 연동 및 구동이 가능하며, 각 실시예들이 서로에 대하여 독립적으로 실시 가능할 수도 있고 연관 관계로 함께 실시할 수도 있다.Each feature of the various embodiments of the present invention can be combined or combined with each other, partially or entirely, and various technological interconnections and operations are possible, and each embodiment can be implemented independently of each other or together in a related relationship. It may be possible.

이하에서는 도면을 참조하여 본 발명에 대해 설명하기로 한다. Hereinafter, the present invention will be described with reference to the drawings.

도 1a 내지 1c는 본 명세서의 일 실시예에 따른 표시 장치를 도시한 단면도이다. 1A to 1C are cross-sectional views showing a display device according to an embodiment of the present specification.

도 1a를 참조하면, 본 명세서의 실시예에 따른 표시 장치(100)는 기판(110), 버퍼층(111), 산화물 박막 트랜지스터(120), 게이트 절연층(112), 층간 절연층(113), 산화물 배리어층(130), 보호층(114), 평탄화층(115), 뱅크(140), 유기 발광 소자(150) 및 봉지부(160)를 포함한다.Referring to FIG. 1A, the display device 100 according to an embodiment of the present specification includes a substrate 110, a buffer layer 111, an oxide thin film transistor 120, a gate insulating layer 112, an interlayer insulating layer 113, It includes an oxide barrier layer 130, a protective layer 114, a planarization layer 115, a bank 140, an organic light emitting device 150, and an encapsulation portion 160.

기판(110)은 표시 장치(100)의 다양한 구성요소들을 지지한다. 기판(110)은 유리 또는 플렉서빌리티(flexibility)를 갖는 플라스틱 물질로 이루어질 수 있다. 예를 들어, 기판(110)은 폴리이미드(PI)로 이루어질 수도 있다. 기판(110)이 폴리이미드(PI)로 이루어지는 경우, 기판(110) 하부에 유리로 이루어지는 지지 기판이 배치된 상황에서 표시 장치 제조 공정이 진행되고, 표시 장치 제조 공정이 완료된 후 지지 기판이 릴리즈(release)될 수 있다. 또한, 지지 기판이 릴리즈된 후, 기판(110)을 지지하기 위한 백 플레이트(back plate)가 기판(110) 하부에 배치될 수도 있다.The substrate 110 supports various components of the display device 100. The substrate 110 may be made of glass or a plastic material with flexibility. For example, the substrate 110 may be made of polyimide (PI). When the substrate 110 is made of polyimide (PI), the display device manufacturing process proceeds with a support substrate made of glass placed below the substrate 110, and after the display device manufacturing process is completed, the support substrate is released ( can be released. Additionally, after the support substrate is released, a back plate for supporting the substrate 110 may be placed under the substrate 110.

버퍼층(111)은 기판(110)의 전체 표면 상에 형성된다. 버퍼층(111)은 버퍼층(111) 상에 형성되는 층들과 기판(110) 간의 접착력을 향상시키고, 기판(110)으로부터 유출되는 알칼리 성분 등을 차단하는 역할 등을 수행할 수 있다. 버퍼층(111)은 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)의 단일층 또는 이들의 다중층으로 이루어질 수 있다. 버퍼층(111)은 필수적인 구성요소는 아니며, 기판(110)의 종류 및 물질, 박막 트랜지스터의 구조 및 타입 등에 따라 생략될 수도 있다.The buffer layer 111 is formed on the entire surface of the substrate 110. The buffer layer 111 may improve the adhesion between the layers formed on the buffer layer 111 and the substrate 110 and block alkaline components leaking from the substrate 110. The buffer layer 111 may be made of a single layer or multiple layers of silicon nitride (SiNx) or silicon oxide (SiOx). The buffer layer 111 is not an essential component and may be omitted depending on the type and material of the substrate 110, the structure and type of the thin film transistor, etc.

산화물 박막 트랜지스터(120)는 버퍼층(111) 상에 배치된다. 산화물 박막 트랜지스터(120)는 액티브층(121), 게이트 전극(124), 소스 전극(122) 및 드레인 전극(123)을 포함할 수 있다. 버퍼층(111) 상에는 산화물 박막 트랜지스터(120)의 액티브층(121)이 배치될 수 있다.The oxide thin film transistor 120 is disposed on the buffer layer 111. The oxide thin film transistor 120 may include an active layer 121, a gate electrode 124, a source electrode 122, and a drain electrode 123. The active layer 121 of the oxide thin film transistor 120 may be disposed on the buffer layer 111.

액티브층(121)은 산화물 반도체 물질로 이루어진다. 산화물 반도체 물질은 실리콘 물질과 비교하여 밴드갭이 더 큰 물질이므로 오프(Off) 상태에서 전자가 밴드 갭을 넘어가지 못한다. 즉, 산화물 반도체 물질은 오프 상태에서 트랜지스터의 소스와 드레인 사이의 누설 전류인 오프-전류(Off-Current)가 낮다. 따라서, 산화물 반도체 물질로 이루어진 액티브층을 포함하는 박막 트랜지스터는 온(On) 시간이 짧고 오프(Off) 시간을 길게 유지하는 스위칭 박막 트랜지스터에 적합할 수 있으나, 이에 제한되지는 않는다. 표시장치의 특성에 따라서, 구동 박막 트랜지스터로 적용될 수도 있다. 또한, 산화물 반도체 물질은 오프-전류가 작으므로 보조 용량의 크기가 감소될 수 있으므로, 고해상도 표시 소자에 적합하다. 액티브층(121)은 금속 산화물로 이루어질 수 있고, 예를 들어, IGZO(indium-gallium-zinc-oxide) 등과 같은 다양한 금속 산화물로 이루어질 수 있다. 산화물 박막 트랜지스터(120)의 액티브층(121)은 다양한 금속 산화물 중 IGZO로 이루어지는 것을 가정하여 IGZO층을 기초로 형성되는 것으로 설명하였으나, 이에 제한되지 않고 IGZO가 아닌 ZnO(Zinc Oxide), IZO(indium-zinc-oxide), IGTO(indium-gallium-tin-oxide), 또는 IGO(indium-gallium-oxide) 등과 같은 다른 금속 산화물로 형성될 수도 있다.The active layer 121 is made of an oxide semiconductor material. Oxide semiconductor materials have a larger band gap than silicon materials, so electrons cannot cross the band gap in the off state. That is, the oxide semiconductor material has a low off-current, which is the leakage current between the source and drain of the transistor in the off state. Accordingly, a thin film transistor including an active layer made of an oxide semiconductor material may be suitable as a switching thin film transistor that maintains a short on time and a long off time, but is not limited thereto. Depending on the characteristics of the display device, it may be applied as a driving thin film transistor. Additionally, the oxide semiconductor material has a small off-current, so the size of the auxiliary capacitance can be reduced, making it suitable for high-resolution display devices. The active layer 121 may be made of a metal oxide, for example, various metal oxides such as indium-gallium-zinc-oxide (IGZO). The active layer 121 of the oxide thin film transistor 120 has been described as being formed based on the IGZO layer, assuming that it is made of IGZO among various metal oxides, but is not limited to this and is not limited to IGZO, but ZnO (Zinc Oxide), IZO (indium -zinc-oxide), indium-gallium-tin-oxide (IGTO), or indium-gallium-oxide (IGO).

액티브층(121)은 금속 산화물을 버퍼층(111) 상에 증착하고 안정화를 위한 열처리 공정을 수행한 후, 금속 산화물을 패터닝하여 형성될 수 있다. The active layer 121 may be formed by depositing a metal oxide on the buffer layer 111, performing a heat treatment process for stabilization, and then patterning the metal oxide.

액티브층(121)을 포함한 기판(110) 전체 면에 절연물질층 및 금속물질층을 차례로 형성하고, 금속물질층 상에 포토레지스트 패턴을 형성할 수 있다. 절연물질층은 PECVD법을 이용하여 형성하고, 금속물질층은 스퍼터링법(Sputtering)을 이용하여 형성할 수 있다. An insulating material layer and a metal material layer may be sequentially formed on the entire surface of the substrate 110 including the active layer 121, and a photoresist pattern may be formed on the metal material layer. The insulating material layer can be formed using the PECVD method, and the metal material layer can be formed using sputtering.

포토레지스트 패턴을 마스크로 하여 금속물질층을 습식 식각하여 게이트 전극(124)을 형성할 수 있다. 금속물질층을 식각하기 위한 습식 식각 액은 금속물질층을 구성하는 몰리브덴(Mo), 구리(Cu), 티타늄(Ti), 알루미늄(Al) 크롬(Cr), 금(Au), 니켈(Ni), 네오디뮴(Nd) 또는 그들의 합금을 선택적으로 식각하고, 절연물질층을 식각하지 않는 물질이 이용될 수 있다.The gate electrode 124 can be formed by wet etching the metal material layer using the photoresist pattern as a mask. The wet etching solution for etching the metal material layer consists of molybdenum (Mo), copper (Cu), titanium (Ti), aluminum (Al), chromium (Cr), gold (Au), and nickel (Ni). , materials that selectively etch neodymium (Nd) or their alloys and do not etch the insulating material layer can be used.

포토레지스트 패턴 및 게이트 전극(124)을 마스크로 하여 절연물질층을 건식 식각하여 게이트 절연층(112)을 형성할 수 있다. 건식 식각 공정을 통하여, 절연물질층이 식각되어 액티브층(121) 상에 게이트 절연층(112) 패턴이 형성될 수 있다. 이후, 패터닝된 게이트 절연층(112)에 의해 노출된 액티브층(121)은 건식 식각 공정에 의해 도체화가 될 수 있다. The gate insulating layer 112 can be formed by dry etching the insulating material layer using the photoresist pattern and the gate electrode 124 as a mask. Through a dry etching process, the insulating material layer may be etched to form a gate insulating layer 112 pattern on the active layer 121. Thereafter, the active layer 121 exposed by the patterned gate insulating layer 112 may be made into a conductor through a dry etching process.

게이트 전극(124)이 형성된 영역에 대응하여 도체화가 되지 않은 채널 영역(121a)과 액티브층(121)의 양단에서 각각 도체화 처리된 소스 영역(121b) 및 드레인 영역(121c)을 포함하는 액티브층(121)이 형성될 수 있다. An active layer including a non-conductive channel region 121a corresponding to the area where the gate electrode 124 is formed, and a source region 121b and a drain region 121c that are conductive at both ends of the active layer 121, respectively. (121) can be formed.

도체화된 액티브층(121)의 소스 영역(121b) 및 드레인 영역(121c)은 저항이 낮아짐으로써, 산화물 박막 트랜지스터(120)의 소자 성능이 향상될 수 있으며, 이에 따라 본 명세서의 실시예에 따른 표시 장치(100)의 신뢰성이 향상될 수 있는 효과를 얻을 수 있다.The resistance of the source region 121b and the drain region 121c of the conductive active layer 121 is lowered, so that the device performance of the oxide thin film transistor 120 can be improved, and accordingly, according to the embodiments of the present specification The effect of improving the reliability of the display device 100 can be obtained.

액티브층(121)의 채널 영역(121a)은 게이트 전극(124)과 중첩하여 배치될 수 있다. 액티브층(121)의 소스 영역(121b) 및 드레인 영역(121c)은 채널 영역(121a)의 양측에 배치될 수 있다. 게이트 절연층(112)은 게이트 전극(124)과 액티브층(121) 사이에 배치될 수 있다. 게이트 절연층(112)은 게이트 전극(124) 및 액티브층(121)의 채널 영역(121a)과 중첩하도록 배치될 수 있다. The channel region 121a of the active layer 121 may be disposed to overlap the gate electrode 124. The source region 121b and drain region 121c of the active layer 121 may be disposed on both sides of the channel region 121a. The gate insulating layer 112 may be disposed between the gate electrode 124 and the active layer 121. The gate insulating layer 112 may be disposed to overlap the gate electrode 124 and the channel region 121a of the active layer 121.

포토레지스트 패턴(PR)을 마스크로 절연 물질층 및 금속 물질층을 식각함에 따라 게이트 절연층(112)과 게이트 전극(124)은 동일한 패턴으로 형성될 수 있다. 게이트 절연층(112)은 액티브층(121) 상에 배치될 수 있다. 게이트 절연층(112)은 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)의 단일층 또는 이들의 다중층으로 구성될 수 있다. 게이트 절연층(112)은 액티브층(121)과 중첩되도록 패터닝될 수 있다. By etching the insulating material layer and the metal material layer using the photoresist pattern PR as a mask, the gate insulating layer 112 and the gate electrode 124 may be formed in the same pattern. The gate insulating layer 112 may be disposed on the active layer 121. The gate insulating layer 112 may be composed of a single layer or multiple layers of silicon nitride (SiNx) or silicon oxide (SiOx). The gate insulating layer 112 may be patterned to overlap the active layer 121.

게이트 전극(124)은 게이트 절연층(112) 상에 배치된다. 게이트 전극(124)은 몰리브덴(Mo), 구리(Cu), 티타늄(Ti), 알루미늄(Al) 크롬(Cr), 금(Au), 니켈(Ni), 네오디뮴(Nd) 중 어느 하나 또는 이들의 합금으로 이루어진 단일층 또는 다중층으로 형성될 수 있다. 게이트 전극(124)은 액티브층(121) 및 게이트 절연층(112)과 중첩되도록 패터닝될 수 있다. 게이트 전극(124)은 액티브층(121)의 채널 영역(121a)과 중첩되도록 패터닝될 수 있다. 또한, 게이트 절연층(112)은 액티브층(121)의 채널 영역(121a)과 중첩되도록 패터닝될 수 있다. 따라서, 게이트 전극(124) 및 게이트 절연층(112)은 액티브층(121)의 채널 영역(121a)과 중첩할 수 있다. The gate electrode 124 is disposed on the gate insulating layer 112. The gate electrode 124 is made of any one of molybdenum (Mo), copper (Cu), titanium (Ti), aluminum (Al), chromium (Cr), gold (Au), nickel (Ni), and neodymium (Nd). It can be formed as a single layer or multiple layers made of alloy. The gate electrode 124 may be patterned to overlap the active layer 121 and the gate insulating layer 112. The gate electrode 124 may be patterned to overlap the channel region 121a of the active layer 121. Additionally, the gate insulating layer 112 may be patterned to overlap the channel region 121a of the active layer 121. Accordingly, the gate electrode 124 and the gate insulating layer 112 may overlap the channel region 121a of the active layer 121.

층간 절연층(113)은 버퍼층(111), 액티브층(121), 게이트 전극(124) 상에 배치된다. 층간 절연층(113)은 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)의 단일층 또는 이들의 다중층으로 구성될 수 있다. 층간 절연층(113)에는 산화물 박막 트랜지스터(120)의 액티브층(121)의 소스 영역(121b) 및 드레인 영역(121c)을 노출시키기 위한 컨택홀이 형성될 수 있다.The interlayer insulating layer 113 is disposed on the buffer layer 111, the active layer 121, and the gate electrode 124. The interlayer insulating layer 113 may be composed of a single layer or multiple layers of silicon nitride (SiNx) or silicon oxide (SiOx). A contact hole may be formed in the interlayer insulating layer 113 to expose the source region 121b and drain region 121c of the active layer 121 of the oxide thin film transistor 120.

층간 절연층(113) 상에 소스 전극(122) 및 드레인 전극(123)이 형성된다. 소스 전극(122) 및 드레인 전극(123)은 층간 절연층(113)에 형성된 컨택홀을 통하여 액티브층(121)과 연결될 수 있다. 예를 들면, 소스 전극(122) 및 드레인 전극(123)은 층간 절연층(113)에 형성된 컨택홀을 통하여, 액티브층(121)의 소스 영역(121b) 및 드레인 영역(121c)과 각각 전기적으로 연결될 수 있다. 소스 전극(122) 및 드레인 전극(123)은 도전성 금속 물질로 이루어진다. 예를 들어, 소스 전극(122) 및 드레인 전극(123)은 몰리브덴(Mo), 구리(Cu), 티타늄(Ti), 알루미늄(Al) 크롬(Cr), 금(Au), 니켈(Ni), 네오디뮴(Nd) 중 어느 하나 또는 이들의 합금으로 이루어진 단일층 또는 다중층으로 형성될 수 있다. 예를 들어, 소스 전극(122) 및 드레인 전극(123)은 티타늄(Ti)/알루미늄(Al)/티타늄(Ti)의 3층 구조로 이루어질 수 있으며, 이에 제한되지는 않는다.A source electrode 122 and a drain electrode 123 are formed on the interlayer insulating layer 113. The source electrode 122 and the drain electrode 123 may be connected to the active layer 121 through a contact hole formed in the interlayer insulating layer 113. For example, the source electrode 122 and the drain electrode 123 are electrically connected to the source region 121b and drain region 121c of the active layer 121, respectively, through a contact hole formed in the interlayer insulating layer 113. can be connected The source electrode 122 and the drain electrode 123 are made of a conductive metal material. For example, the source electrode 122 and the drain electrode 123 are made of molybdenum (Mo), copper (Cu), titanium (Ti), aluminum (Al), chromium (Cr), gold (Au), nickel (Ni), It may be formed as a single layer or multiple layers made of neodymium (Nd) or an alloy thereof. For example, the source electrode 122 and the drain electrode 123 may have a three-layer structure of titanium (Ti)/aluminum (Al)/titanium (Ti), but are not limited thereto.

산화물 배리어층(130)은 층간 절연층(113) 상에 배치된다. 산화물 배리어층(130)은 층간 절연층(113) 상에서 게이트 전극(124)와 중첩되도록 배치됨으로써, 산화물 박막 트랜지스터(120) 상부에서 발생된 수소가 게이트 전극(124) 또는 액티브층(121)으로 확산되는 것을 차단한다. 산화물 배리어층(130)은 게이트 전극(124)의 일부와 중첩될 수 있으나, 수소를 차단하기 위하여, 게이트 전극(124)의 상부를 완전히 커버하도록 중첩할 수 있다.The oxide barrier layer 130 is disposed on the interlayer insulating layer 113. The oxide barrier layer 130 is arranged to overlap the gate electrode 124 on the interlayer insulating layer 113, so that hydrogen generated at the top of the oxide thin film transistor 120 diffuses to the gate electrode 124 or the active layer 121. block it from happening. The oxide barrier layer 130 may overlap a portion of the gate electrode 124, but may overlap to completely cover the top of the gate electrode 124 to block hydrogen.

도 1b를 참조하면, 산화물 박막 트랜지스터(120) 상에는 산화물 박막 트랜지스터(120)의 상부를 평탄화하기 위한 평탄화층(115)이 배치된다. 또한, 평탄화층(115) 상에 배치된 유기 발광 소자(150) 상에는 수분이나 산소로부터 유기 발광 소자(150)를 보호하기 위한 봉지부(160)가 배치된다. 이때, 평탄화층(115) 및 봉지부(160)는 유기물층으로 이루어질 수 있으며, 제조 공정에서 고온에 의하여 수소(H)가 발생될 수 있다. 또한, 유기물층의 경우, 표시 장치가 구동됨에 따라 수소 또는 수소 이온이 발생될 수 있다. 유기물층에서 발생된 수소 또는 수소 이온은 하부로 확산되어 산화물 박막 트랜지스터(120)를 구성하는 게이트 전극(124) 및 액티브층(121)에 악영향을 준다. 특히, 수소(H)가 액티브층(121)에 유입됨에 따라, 액티브층(121)에 캐리어가 생성되고 임계 전압(threshold voltage; Vth)이 변경될 수 있다.Referring to FIG. 1B, a planarization layer 115 is disposed on the oxide thin film transistor 120 to planarize the upper part of the oxide thin film transistor 120. Additionally, an encapsulation unit 160 is disposed on the organic light emitting device 150 disposed on the planarization layer 115 to protect the organic light emitting device 150 from moisture or oxygen. At this time, the planarization layer 115 and the encapsulation portion 160 may be made of an organic material layer, and hydrogen (H) may be generated due to high temperature during the manufacturing process. Additionally, in the case of the organic material layer, hydrogen or hydrogen ions may be generated as the display device is driven. Hydrogen or hydrogen ions generated in the organic material layer diffuse downward and adversely affect the gate electrode 124 and the active layer 121 constituting the oxide thin film transistor 120. In particular, as hydrogen (H) flows into the active layer 121, carriers are generated in the active layer 121 and the threshold voltage (Vth) may change.

도 1b를 참조하면, 산화물 박막 트랜지스터(120)의 상부에서 형성된 수소(H)는 산화물 배리어층(130)에 의해 물리적으로 차단되어 게이트 전극(124) 및 액티브층(121)에 유입되지 않는다. 따라서, 산화물 박막 트랜지스터(120)는 수소(H)로부터 보호되어 트랜지스터의 성능을 유지할 수 있다. Referring to FIG. 1B, hydrogen (H) formed on the top of the oxide thin film transistor 120 is physically blocked by the oxide barrier layer 130 and does not flow into the gate electrode 124 and the active layer 121. Accordingly, the oxide thin film transistor 120 is protected from hydrogen (H) and can maintain transistor performance.

한편, 산화물 배리어층(130)은 층간 절연층(113) 상에서 소스 전극(122) 및 드레인 전극(123) 중 어느 하나와 전기적으로 연결되도록 배치된다. 도 1a를 참조하면, 산화물 배리어층(130)은 드레인 전극(123)과 직접 접촉(contact)하도록 배치되나, 소스 전극(122)과는 접촉하지 않고 이격되도록 배치된다. 이때, 산화물 배리어층(130)은 드레인 전극(123)과 전기적으로 연결되도록 접촉하는 구조이면 된다. 예를 들어, 도 1a에서는 산화물 배리어층(130)의 좌측 끝단이 드레인 전극(123)의 우측 끝단의 아래에 배치되어 산화물 배리어층(130)과 드레인 전극(123)의 일부분이 상하로 중첩되어 접촉하는 것으로 도시되어 있으나, 이에 제한되지는 않고, 산화물 배리어층(130)의 일 측면이 드레인 전극(123)의 일 측면과 맞닿도록 접촉될 수도 있다.Meanwhile, the oxide barrier layer 130 is disposed to be electrically connected to either the source electrode 122 or the drain electrode 123 on the interlayer insulating layer 113. Referring to FIG. 1A, the oxide barrier layer 130 is arranged to be in direct contact with the drain electrode 123, but is arranged to be spaced apart from the source electrode 122 without contacting the source electrode 122. At this time, the oxide barrier layer 130 may have a structure that is in contact with the drain electrode 123 so as to be electrically connected. For example, in Figure 1a, the left end of the oxide barrier layer 130 is disposed below the right end of the drain electrode 123, so that portions of the oxide barrier layer 130 and the drain electrode 123 overlap and contact each other vertically. Although shown as being done, it is not limited thereto, and one side of the oxide barrier layer 130 may be in contact with one side of the drain electrode 123.

산화물 배리어층(130)은 소스 전극(122) 및 드레인 전극(123) 중 어느 하나와 전기적으로 연결됨으로써, 소스 전극(122) 또는 드레인 전극(123)과 동일한 전위를 인가 받을 수 있다. The oxide barrier layer 130 is electrically connected to either the source electrode 122 or the drain electrode 123, so that it can receive the same potential as the source electrode 122 or the drain electrode 123.

도 1c를 참조하면, 유기물을 포함하는 평탄화층(115) 및 봉지부(160)는 표시 장치가 지속적으로 구동됨에 따라 열화가 가속되어 수소 이온(H+)이 발생될 수 있다. 수소 이온(H+)은 양전하를 가지고 있으므로, 게이트 전극(124)에 음전위가 인가되는 경우, 수소 이온(H+)과 게이트 전극(124) 사이의 인력에 의해 수소 이온(H+)이 게이트 전극(124)의 표면에서 포집될 수 있다. 게이트 전극(124)에 수소 이온(H+)이 포집되면, 게이트 전극(124) 주변에 공극 및 기공층이 형성될 수 있다. 또한, 게이트 전극(124) 주변에 포집된 수소 이온(H+)은 수소 분자를 형성하여 하부의 액티브층(121)까지 확산될 수 있다. 즉, 산화물 박막 트랜지스터(120)의 게이트 전극(124)에 음전위가 인가되는 경우, 게이트 전극(124)은 표시 장치(100) 내부에 형성된 수소 이온(H+)을 오히려 끌어오는 역할을 하게 된다.Referring to FIG. 1C, as the display device is continuously driven, the planarization layer 115 and the encapsulation portion 160 containing organic materials may deteriorate and generate hydrogen ions (H + ). Since the hydrogen ion (H + ) has a positive charge, when a negative potential is applied to the gate electrode 124, the hydrogen ion (H + ) is transferred to the gate electrode due to the attractive force between the hydrogen ion (H + ) and the gate electrode 124 . It can be captured on the surface of (124). When hydrogen ions (H + ) are collected in the gate electrode 124, voids and a porous layer may be formed around the gate electrode 124. Additionally, hydrogen ions (H + ) trapped around the gate electrode 124 may form hydrogen molecules and diffuse to the lower active layer 121. That is, when a negative potential is applied to the gate electrode 124 of the oxide thin film transistor 120, the gate electrode 124 serves to attract hydrogen ions (H + ) formed inside the display device 100.

이때, 산화물 배리어층(130)은 드레인 전극(123)과 직접 접촉하므로 연결된 드레인 전극(123)과 동일한 전위를 인가받는다. 일반적으로 드레인 전극(123) 및 소스 전극(122)에는 양전위가 인가되므로, 산화물 배리어층(130)은 드레인 전극(123)과 같이 양전위를 띄게 된다. 산화물 배리어층(130)이 양전위를 띄게 되면, 산화물 박막 트랜지스터(120)의 상부에서 형성된 수소 이온(H+)과 산화물 배리어층(130) 사이에 척력이 발생한다. 따라서, 수소 이온(H+)은 산화물 박막 트랜지스터(120)의 게이트 전극(124) 및 액티브층(121) 방향으로 확산되지 않고, 산화물 배리어층(130)과의 척력에 의해 상부로 확산된다. 따라서, 산화물 박막 트랜지스터(120)는 수소 이온(H+)로부터 보호될 수 있다. At this time, the oxide barrier layer 130 is in direct contact with the drain electrode 123 and therefore receives the same potential as the connected drain electrode 123. Generally, a positive potential is applied to the drain electrode 123 and the source electrode 122, so the oxide barrier layer 130 has a positive potential like the drain electrode 123. When the oxide barrier layer 130 has a positive potential, a repulsive force occurs between the hydrogen ions (H + ) formed on the top of the oxide thin film transistor 120 and the oxide barrier layer 130. Accordingly, hydrogen ions (H + ) do not diffuse toward the gate electrode 124 and the active layer 121 of the oxide thin film transistor 120, but diffuse upward due to a repulsive force with the oxide barrier layer 130. Accordingly, the oxide thin film transistor 120 can be protected from hydrogen ions (H + ).

산화물 배리어층(130)은 금속 산화물로 이루어질 수 있다. 예를 들어, 산화물 배리어층(130)은 금속 산화물로 이루어질 수 있다. 예를 들어, 산화물 배리어층(130)은 IGZO(indium-gallium-zinc-oxide), ZnO(Zinc Oxide), IZO(indium-zinc-oxide), IGTO(indium-gallium-tin-oxide), IGO(indium-gallium-oxide) 또는 이들의 조합으로 이루어질 수 있다. 금속 산화물로 이루어진 산화물 배리어층(130)은 산화물 박막 트랜지스터(120)의 상부에서 발생된 수소가 게이트 전극(124) 또는 액티브층(121)으로 유입되는 것을 차단할 수 있다. The oxide barrier layer 130 may be made of metal oxide. For example, the oxide barrier layer 130 may be made of metal oxide. For example, the oxide barrier layer 130 may include indium-gallium-zinc-oxide (IGZO), zinc oxide (ZnO), indium-zinc-oxide (IZO), indium-gallium-tin-oxide (IGTO), and IGO ( indium-gallium-oxide) or a combination thereof. The oxide barrier layer 130 made of metal oxide can block hydrogen generated at the top of the oxide thin film transistor 120 from flowing into the gate electrode 124 or the active layer 121.

또한, 산화물 배리어층(130)은 산화물 박막 트랜지스터(120)의 액티브층(121)과 동일한 물질을 포함할 수 있다. 예를 들어, 액티브층(121)이 IGZO로 이루어진 경우, 산화물 배리어층(130) 또한, IGZO로 이루어질 수 있다. 산화물 배리어층(130)과 액티브층(121)이 동일한 물질로 이루어지는 경우, 액티브층(121)을 형성하는 공정과 산화물 배리어층(130)을 형성하는 공정을 공유할 수 있는 장점이 있다. 즉, 액티브층(121)을 형성하는 공정에서 이용된 물질 및 장치를 산화물 배리어층(130)을 형성하는 공정에서 동일하게 사용할 수 있으므로, 제조시 공정 시간 및 비용을 절약할 수 있다. 또한, 산화물 배리어층(130)과 액티브층(121)이 동일한 물질로 구성함으로써, 산화물 배리어층(130)과 액티브층(121)에 전위를 동일하게 인가할 수 있고, 이로 인해, 산화물 배리어층(130)이 액티브층(121)과 동일한 바이어스(Bias) 환경을 구현할 수 있다.Additionally, the oxide barrier layer 130 may include the same material as the active layer 121 of the oxide thin film transistor 120. For example, when the active layer 121 is made of IGZO, the oxide barrier layer 130 may also be made of IGZO. When the oxide barrier layer 130 and the active layer 121 are made of the same material, there is an advantage that the process for forming the active layer 121 and the process for forming the oxide barrier layer 130 can be shared. That is, the same materials and devices used in the process of forming the active layer 121 can be used in the process of forming the oxide barrier layer 130, thereby saving process time and cost during manufacturing. In addition, since the oxide barrier layer 130 and the active layer 121 are made of the same material, the same potential can be applied to the oxide barrier layer 130 and the active layer 121, which results in the oxide barrier layer ( 130) can implement the same bias environment as the active layer 121.

산화물 배리어층(130)은 200Å 내지 600Å의 두께를 가질 수 있으나, 이에 제한되지는 않는다. 산화물 배리어층(130)의 두께를 200Å 내지 600Å으로 형성함으로써, 수소를 효과적으로 차단할 수 있고, 산화물 배리어층(130)의 제조를 용이하게 할 수 있다.The oxide barrier layer 130 may have a thickness of 200Å to 600Å, but is not limited thereto. By forming the thickness of the oxide barrier layer 130 to be 200Å to 600Å, hydrogen can be effectively blocked and manufacturing of the oxide barrier layer 130 can be facilitated.

보호층(114)은 소스 전극(122), 드레인 전극(123), 산화물 배리어층(130) 및 층간 절연층(113) 상에 배치된다. 도 1a에 도시된 바와 같이, 보호층(114)에는 드레인 전극(123)을 노출시키기 위한 컨택홀이 형성될 수 있으나, 이에 제한되지는 않는다. 보호층(114)은 산화물 박막 트랜지스터(120)의 상부를 보호하기 위한 무기물층일 수 있다. 예를 들면, 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)의 단일층 또는 이들의 다중층으로 구성될 수 있다. 보호층(114)은 산화물 박막 트랜지스터(120) 상부로부터 확산되는 수소를 억제시킬 수 있다. 보호층(114)은 본 명세서의 실시예에 따른 표시장치(100)의 특성 또는 박막 트랜지스터의 구조 및 특성에 따라서 생략될 수 있다. The protective layer 114 is disposed on the source electrode 122, the drain electrode 123, the oxide barrier layer 130, and the interlayer insulating layer 113. As shown in FIG. 1A, a contact hole may be formed in the protective layer 114 to expose the drain electrode 123, but is not limited thereto. The protective layer 114 may be an inorganic layer to protect the upper part of the oxide thin film transistor 120. For example, it may be composed of a single layer of silicon nitride (SiNx) or silicon oxide (SiOx) or multiple layers thereof. The protective layer 114 can suppress hydrogen diffusing from the top of the oxide thin film transistor 120. The protective layer 114 may be omitted depending on the characteristics of the display device 100 or the structure and characteristics of the thin film transistor according to the embodiment of the present specification.

평탄화층(115)은 보호층(114)상에 배치된다. 평탄화층(115)에는 산화물 박막 트랜지스터(120)의 드레인 전극(123)을 노출시키기 위한 컨택홀이 형성될 수 있으나, 이에 제한되지는 않는다. 평탄화층(115)은 산화물 박막 트랜지스터(120)의 상부를 평탄화하기 위한 유기물층일 수 있다. 예를 들면, 평탄화층(115)은 아크릴 수지(acryl resin), 에폭시 수지(epoxy resin), 페놀 수지(phenolic resin), 폴리아미드 수지(polyamide resin), 및 폴리이미드 수지(polyimide resin) 등의 유기물질로 형성될 수 있다. The planarization layer 115 is disposed on the protective layer 114. A contact hole may be formed in the planarization layer 115 to expose the drain electrode 123 of the oxide thin film transistor 120, but is not limited thereto. The planarization layer 115 may be an organic material layer for planarizing the top of the oxide thin film transistor 120. For example, the planarization layer 115 is made of organic resins such as acryl resin, epoxy resin, phenolic resin, polyamide resin, and polyimide resin. It can be formed from materials.

유기 발광 소자(150)가 평탄화층(115) 상에 배치된다. 유기 발광 소자(150)는 산화물 박막 트랜지스터(120)과 연결된 제1 전극(151), 제1 전극(151) 상에 배치된 유기 발광층(152) 및 유기 발광층(152) 상에 배치된 제2 전극(153)를 포함한다.The organic light emitting device 150 is disposed on the planarization layer 115. The organic light emitting device 150 includes a first electrode 151 connected to the oxide thin film transistor 120, an organic light emitting layer 152 disposed on the first electrode 151, and a second electrode disposed on the organic light emitting layer 152. Includes (153).

제1 전극(151)은 평탄화층(115) 상에 배치되어 평탄화층(115)과 보호층(117)에 형성된 컨택홀을 통하여 산화물 박막 트랜지스터(120)의 드레인 전극(123)과 전기적으로 연결될 수 있다. The first electrode 151 may be disposed on the planarization layer 115 and electrically connected to the drain electrode 123 of the oxide thin film transistor 120 through a contact hole formed in the planarization layer 115 and the protective layer 117. there is.

본 명세서의 실시예에 따른 표시장치(100)가 상부 발광(Top Emission) 표시 장치인 경우에는 제1 전극(151)은 애노드 전극일 수 있다. 표시 장치(100)가 하부 발광(Bottom Emission) 표시 장치인 경우에는 평탄화층(115) 상에 배치된 제1 전극(151)은 캐소드 전극일 수 있다. When the display device 100 according to an embodiment of the present specification is a top emission display device, the first electrode 151 may be an anode electrode. When the display device 100 is a bottom emission display device, the first electrode 151 disposed on the planarization layer 115 may be a cathode electrode.

제1 전극(151)이 애노드인 경우, 제1 전극(151)은 유기 발광층(152)에 정공을 공급하기 위하여 일함수가 높은 도전성 물질로 이루어질 수 있다. 제1 전극(151)은 예를 들어, 인듐 주석 산화물(ITO; Indium Tin Oxide), 인듐 아연 산화물(IZO; Indium Zinc Oxide), 인듐 주석 아연 산화물(ITZO; Indium Tin Zinc Oxide) 등과 같은 투명 전도성 물질로 이루어질 수 있다. 표시 장치(100)가 상부 발광 표시 장치인 경우, 제1 전극(151)은 유기 발광층(152)에서 발광된 광을 제2 전극(153) 측으로 반사시키기 위한 반사층 및 유기 발광층(152)에 정공을 공급하기 위한 투명 도전층을 포함할 수 있다. 다만, 제1 전극(151)은 투명 도전층만을 포함하고 반사층은 제1 전극(151)와 별개의 구성요소인 것으로 정의될 수 있다.When the first electrode 151 is an anode, the first electrode 151 may be made of a conductive material with a high work function in order to supply holes to the organic light emitting layer 152. The first electrode 151 is, for example, a transparent conductive material such as indium tin oxide (ITO), indium zinc oxide (IZO), indium tin zinc oxide (ITZO), etc. It can be done with When the display device 100 is a top emitting display device, the first electrode 151 has a reflective layer for reflecting light emitted from the organic light emitting layer 152 toward the second electrode 153 and a hole in the organic light emitting layer 152. It may include a transparent conductive layer for supply. However, the first electrode 151 may be defined as including only a transparent conductive layer and the reflective layer may be a separate component from the first electrode 151.

도 1에서는 제1 전극(151)이 컨택홀을 통해 산화물 반도체 산화물 박막 트랜지스터(120)의 드레인 전극(123)과 전기적으로 연결되는 것으로 도시되었으나, 박막 트랜지스터의 종류, 구동 회로의 설계 방식 등을 통해 제1 전극(151)이 컨택홀을 통해 산화물 반도체 산화물 박막 트랜지스터(120)의 소스 전극(124)과 전기적으로 연결되도록 구성될 수 있다.In Figure 1, the first electrode 151 is shown as being electrically connected to the drain electrode 123 of the oxide semiconductor oxide thin film transistor 120 through a contact hole, but the first electrode 151 is shown as being electrically connected to the drain electrode 123 of the oxide semiconductor oxide thin film transistor 120. The first electrode 151 may be configured to be electrically connected to the source electrode 124 of the oxide semiconductor oxide thin film transistor 120 through a contact hole.

유기 발광층(152)은 특정 색의 광을 발광하기 위한 층으로서, 적색 발광층, 녹색 발광층, 청색 발광층 및 백색 발광층 중 하나를 포함할 수 있다. 또한, 유기 발광층(152)은 정공 수송층, 정공 주입층, 전자 주입층, 전자 수송층 등과 같은 다양한 층을 더 포함할 수도 있다. 도 1a에서는 유기 발광층(152)이 표시 영역전체에 걸쳐 하나의 층으로 형성된 것으로 도시되었으나, 패터닝될 수도 있다.The organic light-emitting layer 152 is a layer for emitting light of a specific color and may include one of a red light-emitting layer, a green light-emitting layer, a blue light-emitting layer, and a white light-emitting layer. Additionally, the organic light-emitting layer 152 may further include various layers such as a hole transport layer, a hole injection layer, an electron injection layer, and an electron transport layer. In FIG. 1A, the organic emission layer 152 is shown as being formed as one layer over the entire display area, but it may also be patterned.

제2 전극(153)은 유기 발광층(152) 상에 배치된다. 표시 장치(100)가 상부 발광 표시 장치인 경우, 제2 전극(153)은 캐소드 전극일 수 있다. 제2 전극(153)이 캐소드인 경우, 제2 전극(153)은 인듐 주석 산화물(Indium Tin Oxide, ITO), 인듐 아연 산화물(Indium Zin Oxide, IZO), 인듐 주석 아연 산화물(Indium Tin Zinc Oxide, ITZO), 아연 산화물(Zinc Oxide, ZnO) 및 주석 산화물(Tin Oxide, TO) 계열의 투명 도전성 산화물 또는 이테르븀(Yb) 합금으로 이루어질 수도 있다. 또는, 제2 전극(153)은 금속 물질로 이루어질 수도 있다.The second electrode 153 is disposed on the organic light emitting layer 152. When the display device 100 is a top emitting display device, the second electrode 153 may be a cathode electrode. When the second electrode 153 is a cathode, the second electrode 153 is made of indium tin oxide (ITO), indium zinc oxide (IZO), or indium tin zinc oxide (Indium Tin Zinc Oxide). It may be made of a transparent conductive oxide of the ITZO (ITZO), zinc oxide (ZnO), and tin oxide (Tin oxide (TO) series) or a ytterbium (Yb) alloy. Alternatively, the second electrode 153 may be made of a metal material.

도 1a를 참조하면, 제1 전극(151) 및 오버 코팅층(115) 상에 뱅크(140)가 배치된다. 뱅크(140)는 유기 발광 소자(150)의 제1 전극(151)의 일부를 커버하여 발광 영역을 정의할 수 있다. 뱅크(140)는 유기물로 이루어질 수 있다. 예를 들어, 뱅크(140)는 폴리이미드(polyimide), 아크릴(acryl) 또는 벤조사이클로부텐(benzocyclobutene; BCB)계 수지로 이루어질 수 있으나, 이에 제한되는 것은 아니다.Referring to FIG. 1A, a bank 140 is disposed on the first electrode 151 and the overcoating layer 115. The bank 140 may define a light-emitting area by covering a portion of the first electrode 151 of the organic light-emitting device 150. Bank 140 may be made of organic material. For example, the bank 140 may be made of polyimide, acryl, or benzocyclobutene (BCB)-based resin, but is not limited thereto.

봉지부(160)는 유기 발광 소자(150) 상에 배치되어 수분이나 산소로부터 유기 발광 소자(150)를 보호한다. 봉지부(160)는 제1 봉지층(161), 제2 봉지층(162), 및 제3 봉지층(163)을 포함한다. 제1 봉지층(161) 및 제3 봉지층(163)은 무기절연층으로 실리콘 질화물(SiNx), 실리콘 산화물(SiOx), 또는 실리콘 산화 질화물(SiON) 중 어느 하나 또는 하나 이상으로 이루어질 수 있으나, 이에 제한되지는 않는다. 제2 봉지층(161)은 유기절연층으로 고분자(polymer)로 형성될 수 있다. 제2 봉지층(161)은 이물커버층(particle covering layer, PCL)이라고도 불리며, 이물을 커버하는 역할을 한다. 예를 들어, 제1 봉지층(161) 표면에 이물이 부착된 상태에서 제2 봉지층(161) 없이 제1 봉지층(161) 상에 무기절연물질로 이루어진 제3 봉지층(163)이 배치될 경우, 제3 봉지층(163)은 제1 봉지층(161) 표면에 부착된 이물과의 밀착력이 높지 않기 때문에 이물 주변으로 틈이 생길 수 있으며 틈 형성으로 인해 제3 봉지층(163)이 박리될 수 있다. 따라서, 유기물질로 형성된 제2 봉지층(162)을 제1 봉지층(161)과 제3 봉지층(163) 사이에 배치함으로써, 이물 및 이물 주변을 커버하여 제3 봉지층(163)이 박리되는 것을 방지할 수 있다.The encapsulation portion 160 is disposed on the organic light emitting device 150 to protect the organic light emitting device 150 from moisture or oxygen. The encapsulation portion 160 includes a first encapsulation layer 161, a second encapsulation layer 162, and a third encapsulation layer 163. The first encapsulation layer 161 and the third encapsulation layer 163 are inorganic insulating layers and may be made of one or more of silicon nitride (SiNx), silicon oxide (SiOx), or silicon oxynitride (SiON). It is not limited to this. The second encapsulation layer 161 is an organic insulating layer and may be formed of polymer. The second encapsulation layer 161 is also called a particle covering layer (PCL) and serves to cover foreign substances. For example, with foreign matter attached to the surface of the first encapsulation layer 161, the third encapsulation layer 163 made of an inorganic insulating material is disposed on the first encapsulation layer 161 without the second encapsulation layer 161. In this case, since the third encapsulation layer 163 does not have a high adhesion to the foreign matter attached to the surface of the first encapsulation layer 161, a gap may form around the foreign matter, and the third encapsulation layer 163 may form a gap due to the formation of the gap. It may peel off. Therefore, by disposing the second encapsulation layer 162 made of an organic material between the first encapsulation layer 161 and the third encapsulation layer 163, the third encapsulation layer 163 is peeled off to cover the foreign matter and the surrounding area. You can prevent it from happening.

또한, 봉지부(160)와 제2 전극(153) 사이에는 캡핑층(capping layer)이 배치될 수 있다. 캡핑층은 유기발광소자(150)를 커버함으로써 외부로부터 유입된 산소 및 수분의 유입을 막아주고, 제2 전극(153)을 통과하는 광의 효율을 향상시키는 역할을 할 수 있고, 봉지부(160)와 캐소드(153)의 접착력을 향상시킬 수 있다.Additionally, a capping layer may be disposed between the sealing portion 160 and the second electrode 153. The capping layer covers the organic light emitting device 150 to prevent the inflow of oxygen and moisture from the outside, and can serve to improve the efficiency of light passing through the second electrode 153, and the encapsulation portion 160. The adhesion of the cathode 153 can be improved.

본 명세서의 일 실시예에 따른 표시 장치는 소스 전극 또는 드레인 전극과 전기적으로 연결되고, 게이트 전극과 중첩하도록 층간 절연층 상에 금속 산화물로 이루어진 산화물 배리어층을 배치하여, 표시 장치 내부에서 발생하는 수소 또는 수소 이온이 산화물 박막 트랜지스터로 확산되는 것을 차단할 수 있다.The display device according to an embodiment of the present specification is electrically connected to the source electrode or the drain electrode and disposes an oxide barrier layer made of metal oxide on the interlayer insulating layer to overlap the gate electrode, thereby reducing the hydrogen generated inside the display device. Alternatively, hydrogen ions can be blocked from diffusing into the oxide thin film transistor.

구체적으로, 산화물 반도체 물질로 이루어진 액티브층을 포함하는 산화물 박막 트랜지스터는 수소에 의한 성능 저하가 문제된다. 박막 트랜지스터 상에 배치되는 평탄화층 및 봉지층을 구성하는 유기물질로부터 형성된 수소는 액티브층으로 유입되어 박막 트랜지스터의 임계 전압(또는 문턱 전압)의 편차를 증가시킬 수 있다. 이에, 금속 산화물로 이루어진 산화물 배리어층을 게이트 전극 및 액티브층 상부에 배치시킴으로써 물리적으로 수소의 침투를 차단할 수 있다. 또한, 산화물 배리어층을 소스 전극 또는 드레인 전극과 연결하여 양전위를 인가함으로써, 수소 이온이 산화물 배리어층과의 척력에 의하여 산화물 배리어층의 하부로 확산되는 것을 억제할 수 있다. 이에, 본 명세서의 일 실시예에 따른 표시 장치는 산화물 박막 트랜지스터에 영향을 줄 수 있는 수소가 게이트 전극 또는 액티브층으로 확산되는 것을 막고, 구동에 의한 장치의 성능 저하를 최소화할 수 있다. Specifically, oxide thin film transistors including an active layer made of an oxide semiconductor material suffer from performance degradation due to hydrogen. Hydrogen formed from organic materials constituting the planarization layer and the encapsulation layer disposed on the thin film transistor may flow into the active layer and increase the deviation of the threshold voltage (or threshold voltage) of the thin film transistor. Accordingly, by disposing an oxide barrier layer made of metal oxide on the gate electrode and the active layer, it is possible to physically block hydrogen penetration. Additionally, by connecting the oxide barrier layer to the source electrode or the drain electrode and applying a positive potential, diffusion of hydrogen ions to the lower part of the oxide barrier layer due to repulsive force with the oxide barrier layer can be prevented. Accordingly, the display device according to an embodiment of the present specification can prevent hydrogen, which may affect the oxide thin film transistor, from diffusing into the gate electrode or active layer, and minimize performance degradation of the device due to driving.

도 2는 본 명세서의 다른 실시예에 따른 표시 장치를 도시한 단면도이다. 도 2의 표시 장치(200)는 도 1의 표시 장치(100)와 비교하여, 산화물 배리어층(230)만이 상이하고 다른 구성은 실질적으로 동일하므로, 중복 설명을 생략하기로 한다.Figure 2 is a cross-sectional view showing a display device according to another embodiment of the present specification. Since the display device 200 of FIG. 2 is different from the display device 100 of FIG. 1 only in the oxide barrier layer 230 and other configurations are substantially the same, duplicate description will be omitted.

도 2를 참조하면, 본 발명의 다른 실시예에 따른 표시 장치(200)의 산화물 배리어층(230)은 층간 절연층(113) 상에서 게이트 전극(124)의 상부뿐만 아니라 측부까지 커버하도록 배치된다.Referring to FIG. 2 , the oxide barrier layer 230 of the display device 200 according to another embodiment of the present invention is arranged to cover not only the top but also the side of the gate electrode 124 on the interlayer insulating layer 113.

층간 절연층(113)은 버퍼층(111), 액티브층(121), 게이트 전극(124) 상에 배치될 수 있다. 이때, 층간 절연층(113)은 버퍼층(111), 액티브층(121), 게이트 절연층(112), 게이트 전극(124)을 따라 컨포멀(conformal)하게 배치될 수 있다. 층간 절연층(113)은 버퍼층(111)의 상면, 액티브층(121)의 측면 및 상면, 게이트 절연층(112)의 측면 및 게이트 전극(124)의 측면 및 상면과 접촉할 수 있다.The interlayer insulating layer 113 may be disposed on the buffer layer 111, the active layer 121, and the gate electrode 124. At this time, the interlayer insulating layer 113 may be disposed conformally along the buffer layer 111, the active layer 121, the gate insulating layer 112, and the gate electrode 124. The interlayer insulating layer 113 may contact the top surface of the buffer layer 111, the side and top surface of the active layer 121, the side surface of the gate insulating layer 112, and the side and top surface of the gate electrode 124.

층간 절연층(113)은 게이트 절연층(112) 및 게이트 전극(124)을 둘러싸도록 배치되며, 게이트 절연층(112) 및 게이트 전극(124)이 배치된 영역에서 단차를 형성한다. 층간 절연층(113)은 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)로 이루어진 무기물질로 형성되며, 층간 절연층(113) 형성 과정에서 게이트 절연층(112) 및 게이트 전극(124) 주변의 단차 영역에서 크랙 또는 공극(G)이 발생할 수 있다. 뿐만 아니라, 표시 장치(200)를 구동함에 따른 소자들의 열화 및 박막 트랜지스터 주변에서 형성된 기공에 의하여, 단차 영역에 배치되는 층간 절연층(113)에 크랙 또는 공극(G)이 발생할 수 있다. 크랙 또는 공극(G)은 표시 장치(200) 내부에서 발생하는 수소 또는 수소 이온이 이동하는 경로를 제공할 수 있다. 따라서, 산화물 박막 트랜지스터(220)의 상부에서 발생한 수소가 층간 절연층(113)에 형성된 크랙 또는 공극(G)을 따라 빠르게 게이트 전극(124) 및 액티브층(121)으로 이동될 수 있다. 이로 인해, 산화물 박막 트랜지스터(220)의 성능이 빠르게 저하되는 문제점이 발생할 수 있다.The interlayer insulating layer 113 is disposed to surround the gate insulating layer 112 and the gate electrode 124, and forms a step in the area where the gate insulating layer 112 and the gate electrode 124 are disposed. The interlayer insulating layer 113 is formed of an inorganic material made of silicon nitride (SiNx) or silicon oxide (SiOx). During the formation of the interlayer insulating layer 113, there is a step around the gate insulating layer 112 and the gate electrode 124. Cracks or voids (G) may occur in the area. In addition, cracks or voids (G) may occur in the interlayer insulating layer 113 disposed in the step area due to deterioration of elements resulting from driving the display device 200 and pores formed around the thin film transistor. Cracks or voids (G) may provide a path through which hydrogen or hydrogen ions generated inside the display device 200 move. Accordingly, hydrogen generated at the top of the oxide thin film transistor 220 can quickly move to the gate electrode 124 and the active layer 121 along the crack or gap (G) formed in the interlayer insulating layer 113. Because of this, a problem may occur in which the performance of the oxide thin film transistor 220 rapidly deteriorates.

도 2를 참조하면, 산화물 배리어층(230)은 층간 절연층(113)의 단차 영역을 커버하도록 배치된다. 즉, 도 1의 산화물 배리어층(130)이 게이트 전극(124)의 상부만을 커버하도록 배치된 구조와 달리, 도 2의 산화물 배리어층(230)은 게이트 전극(124)의 측면을 커버하도록 배치된다. 이로 인해, 산화물 배리어층(230)은 크랙 또는 공극(G)이 형성된 층간 절연층(113)의 표면에 접촉하도록 배치되고, 크랙 또는 공극(G)이 외부에 노출되는 것을 막을 수 있다. Referring to FIG. 2, the oxide barrier layer 230 is arranged to cover the step area of the interlayer insulating layer 113. That is, unlike the structure in which the oxide barrier layer 130 in FIG. 1 is arranged to cover only the top of the gate electrode 124, the oxide barrier layer 230 in FIG. 2 is arranged to cover the side surfaces of the gate electrode 124. . Because of this, the oxide barrier layer 230 is disposed to contact the surface of the interlayer insulating layer 113 where the crack or gap (G) is formed, and can prevent the crack or gap (G) from being exposed to the outside.

따라서, 산화물 배리어층(230)은 층간 절연층(113)의 단차 영역에 형성된 크랙 또는 공극(G)의 측면을 통해 수소가 이동하는 것을 차단할 수 있다. Accordingly, the oxide barrier layer 230 can block hydrogen from moving through the side of the crack or gap (G) formed in the step area of the interlayer insulating layer 113.

도 3은 본 명세서의 또 다른 실시예에 따른 표시 장치를 도시한 단면도이다. 도 3의 표시 장치(300)는 도 2의 표시 장치(200)와 비교하여, 산화물 박막 트랜지스터(320) 및 산화물 배리어층(330)만이 상이하고 다른 구성은 실질적으로 동일하므로, 중복 설명을 생략하기로 한다.Figure 3 is a cross-sectional view showing a display device according to another embodiment of the present specification. The display device 300 of FIG. 3 is different from the display device 200 of FIG. 2 only in the oxide thin film transistor 320 and the oxide barrier layer 330, and other configurations are substantially the same, so redundant description is omitted. Do this.

도 3을 참조하면, 본 발명의 다른 실시예에 따른 표시 장치(300)의 산화물 배리어층(330)은 드레인 전극(323)이 아닌 소스 전극(322)과 전기적으로 연결되도록 배치된다. 구체적으로, 산화물 배리어층(330)은 소스 전극(322)과 직접 접촉하도록 배치되고, 드레인 전극(323)과는 접촉하지 않고 이격되도록 배치된다. 예를 들어, 도 3에서는 산화물 배리어층(330)의 좌측 끝단이 소스 전극(322)의 우측 끝단의 아래에 배치되어 산화물 배리어층(330)과 소스 전극(322)이 상하로 부분적으로 중첩되어 접촉하는 것으로 도시되어 있으나, 이에 제한되지는 않는다.Referring to FIG. 3 , the oxide barrier layer 330 of the display device 300 according to another embodiment of the present invention is disposed to be electrically connected to the source electrode 322 rather than the drain electrode 323. Specifically, the oxide barrier layer 330 is arranged to directly contact the source electrode 322, and is arranged to be spaced apart from the drain electrode 323 without contacting the drain electrode 323. For example, in Figure 3, the left end of the oxide barrier layer 330 is disposed below the right end of the source electrode 322, so that the oxide barrier layer 330 and the source electrode 322 partially overlap and contact each other vertically. It is shown as doing so, but is not limited thereto.

산화물 배리어층(330)은 소스 전극(322)와 전기적으로 소스 전극(322)과 동일한 전위를 인가 받을 수 있다. 일반적으로 소스 전극(322)에는 양전위가 인가되므로, 산화물 배리어층(330)은 소스 전극(322)과 같이 양전위를 띄게 된다. 산화물 배리어층(30)이 양전위를 띄게 되면, 산화물 박막 트랜지스터(320)의 상부에서 형성된 수소 이온과 산화물 배리어층(330) 사이에 척력이 발생하며, 수소 이온은 산화물 박막 트랜지스터(320)의 게이트 전극(124) 및 액티브층(121) 방향으로 확산되지 않고 척력에 의하여 반대 방향으로 확산된다. 이로 인해, 본 발명의 다른 실시예에 따른 표시 장치(300)는 산화물 배리어층(330)을 이용하여 수소 이온로부터 산화물 박막 트랜지스터(320)를 보호할 수 있다. The oxide barrier layer 330 may be electrically applied to the same potential as the source electrode 322 . Generally, a positive potential is applied to the source electrode 322, so the oxide barrier layer 330 has a positive potential like the source electrode 322. When the oxide barrier layer 30 has a positive potential, a repulsive force occurs between the hydrogen ions formed at the top of the oxide thin film transistor 320 and the oxide barrier layer 330, and the hydrogen ions are generated at the gate of the oxide thin film transistor 320. It does not diffuse in the direction of the electrode 124 and the active layer 121, but diffuses in the opposite direction due to the repulsive force. For this reason, the display device 300 according to another embodiment of the present invention can protect the oxide thin film transistor 320 from hydrogen ions using the oxide barrier layer 330.

도 4는 본 명세서의 또 다른 실시예에 따른 표시 장치를 도시한 단면도이다. 도 4는 서로 상이한 반도체 물질을 포함하는 복수의 박막 트랜지스터로 이루어진 멀티 타입의 박막 트랜지스터를 포함하는 표시 장치이다. 예를 들어, 도 4의 표시 장치는 LTPS 박막 트랜지스터 및 산화물 박막 트랜지스터를 포함하는 유기 발광 표시 장치이다.Figure 4 is a cross-sectional view showing a display device according to another embodiment of the present specification. 4 shows a display device including a multi-type thin film transistor consisting of a plurality of thin film transistors containing different semiconductor materials. For example, the display device of FIG. 4 is an organic light emitting display device including an LTPS thin film transistor and an oxide thin film transistor.

도 4를 참조하면, 본 명세서의 일 실시예에 따른 표시 장치(400)는 기판(110), 버퍼층(111), 제1 박막 트랜지스터(470), 제2 박막 트랜지스터(420), 제1 게이트 절연층(412), 제1 층간 절연층(413), 분리 절연층(414), 제2 게이트 절연층(415), 제2 층간 절연층(416), 산화물 배리어층(430), 보호층(417), 평탄화층(418), 연결전극(480), 뱅크(140), 유기 발광 소자(150) 및 봉지부(160)을 포함한다.Referring to FIG. 4, the display device 400 according to an embodiment of the present specification includes a substrate 110, a buffer layer 111, a first thin film transistor 470, a second thin film transistor 420, and a first gate insulator. Layer 412, first interlayer insulating layer 413, separation insulating layer 414, second gate insulating layer 415, second interlayer insulating layer 416, oxide barrier layer 430, protective layer 417 ), a planarization layer 418, a connection electrode 480, a bank 140, an organic light emitting device 150, and an encapsulation portion 160.

도 4의 표시 장치(400)는 도 1의 표시 장치(100)와 비교하여, 복수의 박막 트랜지스터를 포함한다는 점에서 차이점이 있으나, 기판(110), 버퍼층(111), 뱅크(140), 유기 발광 소자(150) 및 봉지부(160)은 실질적으로 동일하다. 이에, 추가 및 변경된 구성을 제외하고 실질적으로 동일한 구성에 대해서는 중복 설명을 생략하기로 한다.The display device 400 of FIG. 4 differs from the display device 100 of FIG. 1 in that it includes a plurality of thin film transistors, but includes a substrate 110, a buffer layer 111, a bank 140, and an organic thin film transistor. The light emitting device 150 and the encapsulation unit 160 are substantially the same. Accordingly, redundant description will be omitted for substantially the same configurations, excluding added and changed configurations.

도 4를 참조하면, 제1 박막 트랜지스터(470)는 버퍼층(111) 상에 배치될 수 있다. 제1 박막 트랜지스터(470)는 제1 액티브층(471), 제1 게이트 전극(474), 제1 소스 전극(472) 및 제1 드레인 전극(473)을 포함할 수 있다. 버퍼층(111) 상에는 제1 박막 트랜지스터(470)의 제1 액티브층(471)이 배치될 수 있다. 제1 박막 트랜지스터(470)는 저온 폴리 실리콘(LTPS)로 이루어진 액티브층을 포함하는 LTPS 박막 트랜지스터이다.Referring to FIG. 4 , the first thin film transistor 470 may be disposed on the buffer layer 111 . The first thin film transistor 470 may include a first active layer 471, a first gate electrode 474, a first source electrode 472, and a first drain electrode 473. The first active layer 471 of the first thin film transistor 470 may be disposed on the buffer layer 111. The first thin film transistor 470 is an LTPS thin film transistor including an active layer made of low temperature polysilicon (LTPS).

제1 액티브층(471)은 저온 폴리 실리콘(LTPS)을 포함한다. 저온 폴리 실리콘 물질은 이동도가 높아 (100㎠/Vs 이상), 에너지 소비 전력이 낮고 신뢰성이 우수하므로, 표시 소자용 박막 트랜지스터들을 구동하는 구동 소자용 게이트 드라이버 및/또는 멀티플렉서(MUX)에 적용될 수 있으나, 이에 제한되지는 않는다. 버퍼층(111) 상에 아몰퍼스 실리콘(a-Si) 물질을 증착하고, 탈수소화 공정 및 결정화 공정을 수행하는 방식으로 폴리 실리콘이 형성되고, 폴리 실리콘을 패터닝하여 제1 액티브층(471)이 형성될 수 있다. 제1 액티브층(471)은 제1 박막 트랜지스터(470)의 구동 시 채널이 형성되는 제1 채널 영역(471a), 제1 채널 영역(471a) 양 측의 제1 소스 영역(471b) 및 제1 드레인 영역(471c)을 포함할 수 있다. 제1 소스 영역(471b)은 제1 소스 전극(472)과 연결된 제1 액티브층(471)의 부분을 의미하며, 제1 드레인 영역(471c)은 제1 드레인 전극(473)과 연결된 제1 액티브층(471)의 부분을 의미한다. 제1 채널 영역(471a), 제1 소스 영역(471b) 및 제1 드레인 영역(471c)은 제1 액티브층(471)의 이온 도핑(불순물 도핑)에 의해 구성될 수 있다. 제1 소스 영역(471b) 및 제1 드레인 영역(471c)은 폴리 실리콘 물질을 이온 도핑하여 생성될 수 있으며, 제1 채널 영역(471a)은 이온 도핑되지 않고 폴리 실리콘 물질로 남겨진 부분을 의미할 수 있다.The first active layer 471 includes low temperature polysilicon (LTPS). Low-temperature polysilicon materials have high mobility (over 100㎠/Vs), low energy consumption and excellent reliability, so they can be applied to gate drivers and/or multiplexers (MUX) for driving devices that drive thin film transistors for display devices. However, it is not limited to this. Polysilicon is formed by depositing an amorphous silicon (a-Si) material on the buffer layer 111, performing a dehydrogenation process and a crystallization process, and the first active layer 471 is formed by patterning the polysilicon. You can. The first active layer 471 includes the first channel region 471a, where a channel is formed when the first thin film transistor 470 is driven, the first source region 471b on both sides of the first channel region 471a, and the first It may include a drain area 471c. The first source region 471b refers to a portion of the first active layer 471 connected to the first source electrode 472, and the first drain region 471c refers to a portion of the first active layer 471 connected to the first drain electrode 473. It refers to a portion of the layer 471. The first channel region 471a, the first source region 471b, and the first drain region 471c may be formed by ion doping (impurity doping) of the first active layer 471. The first source region 471b and the first drain region 471c may be created by ion-doping a polysilicon material, and the first channel region 471a may refer to a portion left as a polysilicon material without ion doping. there is.

제1 박막 트랜지스터(470)의 제1 액티브층(471) 상에 제1 게이트 절연층(412)이 배치될 수 있다. 제1 게이트 절연층(412)은 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)의 단일층 또는 이들의 다중층으로 구성될 수 있다. 제1 게이트 절연층(412)에는 제1 박막 트랜지스터(470)의 제1 소스 전극(472) 및 제1 드레인 전극(473) 각각이 제1 박막 트랜지스터(470)의 제1 액티브층(471)의 제1 소스 영역(471b) 및 제1 드레인 영역(471c) 각각에 연결되기 위한 컨택홀이 형성될 수 있다.A first gate insulating layer 412 may be disposed on the first active layer 471 of the first thin film transistor 470. The first gate insulating layer 412 may be composed of a single layer or multiple layers of silicon nitride (SiNx) or silicon oxide (SiOx). The first gate insulating layer 412 includes the first source electrode 472 and the first drain electrode 473 of the first thin film transistor 470, respectively, of the first active layer 471 of the first thin film transistor 470. Contact holes may be formed to connect to each of the first source region 471b and the first drain region 471c.

제1 게이트 절연층(412) 상에 제1 박막 트랜지스터(470)의 제1 게이트 전극(474)이 배치될 수 있다. 제1 게이트 전극(474)은 도 1의 게이트 전극(124)과 실질적으로 동일하므로 중복 설명을 생략하기로 한다.The first gate electrode 474 of the first thin film transistor 470 may be disposed on the first gate insulating layer 412. Since the first gate electrode 474 is substantially the same as the gate electrode 124 of FIG. 1, duplicate description will be omitted.

제1 게이트 절연층(412) 및 제1 게이트 전극(474) 상에 제1 층간 절연층(413)이 배치될 수 있다. 제1 층간 절연층(413)은 도 1의 층간 절연층(113)과 실질적으로 동일하므로 중복 설명을 생략하기로 한다.A first interlayer insulating layer 413 may be disposed on the first gate insulating layer 412 and the first gate electrode 474. Since the first interlayer insulating layer 413 is substantially the same as the interlayer insulating layer 113 of FIG. 1, duplicate description will be omitted.

제1 층간 절연층(413) 상에 제1 소스 전극(472), 제1 드레인 전극(473)이 형성될 수 있다. 제1 소스 전극(472) 및 제1 드레인 전극(473)은 제1 층간 절연층(413) 및 제1 게이트 절연층(412)에 형성된 컨택홀을 통하여 제1 액티브층(471)과 연결될 수 있다. 예를 들면, 제1 소스 전극(472) 및 제1 드레인 전극(473)은 제1 층간 절연층(413) 및 제1 게이트 절연층(412)에 형성된 컨택홀을 통하여, 제1 액티브층(471)의 제1 소스 영역(471b) 및 제1 드레인 영역(471c)과 각각 전기적으로 연결될 수 있다. 제1 소스 전극(472), 제1 드레인 전극(473)의 구성 물질은 도 1의 소스 전극(122) 및 제 드레인 전극(123)과 실질적으로 동일하므로 중복 설명을 생략하기로 한다.A first source electrode 472 and a first drain electrode 473 may be formed on the first interlayer insulating layer 413. The first source electrode 472 and the first drain electrode 473 may be connected to the first active layer 471 through a contact hole formed in the first interlayer insulating layer 413 and the first gate insulating layer 412. . For example, the first source electrode 472 and the first drain electrode 473 are connected to the first active layer 471 through contact holes formed in the first interlayer insulating layer 413 and the first gate insulating layer 412. ) may be electrically connected to the first source region 471b and the first drain region 471c, respectively. Since the constituent materials of the first source electrode 472 and the first drain electrode 473 are substantially the same as those of the source electrode 122 and the drain electrode 123 of FIG. 1, duplicate description will be omitted.

제1 층간 절연층(413), 제1 소스 전극(472) 및 제1 드레인 전극(473) 상에 분리 절연층(414)이 배치된다. 분리 절연층(414)은 분리 절연층(414) 상에 배치된 제2 박막 트랜지스터(420)와 분리 절연층(414) 하부에 배치된 제1 박막 트랜지스터(470)를 분리시키는 역할을 수행한다. 예를 들면, 제1 박막 트랜지스터(470)의 제1 소스 전극(472) 및 제1 드레인 전극(473) 상에 분리 절연층(414)이 배치되고, 그 상에 제2 박막 트랜지스터(420)가 배치될 수 있다. 분리 절연층(414)에는 제1 소스 전극(472) 및 제1 드레인 전극(473)의 적어도 일부를 노출시키기 위한 컨택홀이 형성될 수 있다. 분리 절연층(414)은 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)의 단일층 또는 이들의 다중층으로 구성될 수 있다.A separation insulating layer 414 is disposed on the first interlayer insulating layer 413, the first source electrode 472, and the first drain electrode 473. The isolation insulating layer 414 serves to separate the second thin film transistor 420 disposed on the isolation insulating layer 414 and the first thin film transistor 470 disposed below the isolation insulating layer 414. For example, the isolation insulating layer 414 is disposed on the first source electrode 472 and the first drain electrode 473 of the first thin film transistor 470, and the second thin film transistor 420 is disposed on the first source electrode 472 and the first drain electrode 473. can be placed. A contact hole may be formed in the separation insulating layer 414 to expose at least a portion of the first source electrode 472 and the first drain electrode 473. The isolation insulating layer 414 may be composed of a single layer of silicon nitride (SiNx) or silicon oxide (SiOx) or multiple layers thereof.

분리 절연층(114) 상에는 제2 박막 트랜지스터(420)의 제2 액티브층(421)이 배치될 수 있다. 제2 박막 트랜지스터(420)는 제2 액티브층(421), 제2 게이트 전극(424), 제2 소스 전극(422) 및 제2 드레인 전극(423)을 포함할 수 있다. 제2 박막 트랜지스터(420)는 산화물 반도체로 이루어진 액티브층을 포함하는 산화물 박막 트랜지스터이다. 즉, 도 4의 제2 박막 트랜지스터(420)은 도 1에서 설명한 산화물 박막 트랜지스터(120)와 실질적으로 동일하므로 중복 설명을 생략하기로 한다.The second active layer 421 of the second thin film transistor 420 may be disposed on the isolation insulating layer 114. The second thin film transistor 420 may include a second active layer 421, a second gate electrode 424, a second source electrode 422, and a second drain electrode 423. The second thin film transistor 420 is an oxide thin film transistor including an active layer made of an oxide semiconductor. That is, since the second thin film transistor 420 of FIG. 4 is substantially the same as the oxide thin film transistor 120 described in FIG. 1, duplicate description will be omitted.

제2 액티브층(421) 상에 제2 게이트 절연층(415)가 배치될 수 있다. 제2 게이트 절연층(415)은 도 1의 게이트 절연층(412)과 실질적으로 동일하므로 중복 설명을 생략하기로 한다.A second gate insulating layer 415 may be disposed on the second active layer 421. Since the second gate insulating layer 415 is substantially the same as the gate insulating layer 412 of FIG. 1, duplicate description will be omitted.

제2 게이트 절연층(415) 상에 제2 박막 트랜지스터(420)의 제2 게이트 전극(424)이 배치될 수 있다. 제2 게이트 전극(424)은 도 1의 게이트 전극(124)과 실질적으로 동일하므로 중복 설명을 생략하기로 한다.The second gate electrode 424 of the second thin film transistor 420 may be disposed on the second gate insulating layer 415. Since the second gate electrode 424 is substantially the same as the gate electrode 124 of FIG. 1, duplicate description will be omitted.

제2 게이트 절연층(415) 및 제2 게이트 전극(424) 상에 제2 층간 절연층(416)이 배치될 수 있다. 제2 층간 절연층(416)은 도 1의 층간 절연층(113)과 실질적으로 동일하므로 중복 설명을 생략하기로 한다.A second interlayer insulating layer 416 may be disposed on the second gate insulating layer 415 and the second gate electrode 424. Since the second interlayer insulating layer 416 is substantially the same as the interlayer insulating layer 113 of FIG. 1, duplicate description will be omitted.

제2 층간 절연층(416) 상에는 제2 소스 전극(422), 제2 드레인 전극(423), 산화물 배리어층(430) 및 연결 전극(480)이 배치될 수 있다. 제2 소스 전극(422) 및 제2 드레인 전극(423)은 도 1의 소스 전극(122) 및 드레인 전극(123)과 실질적으로 동일하므로 중복 설명을 생략하기로 한다.A second source electrode 422, a second drain electrode 423, an oxide barrier layer 430, and a connection electrode 480 may be disposed on the second interlayer insulating layer 416. Since the second source electrode 422 and the second drain electrode 423 are substantially the same as the source electrode 122 and the drain electrode 123 of FIG. 1, duplicate description will be omitted.

산화물 배리어층(430)은 제2 층간 절연층(416) 상에 배치된다. 산화물 배리어층(430)은 제2 층간 절연층(416) 상에서 제2 게이트 전극(424)와 중첩되도록 배치됨으로써, 제2 박막 트랜지스터(420) 상부에서 발생된 수소가 제2 게이트 전극(424) 또는 제2 액티브층(421)으로 확산되는 것을 차단한다. 산화물 배리어층(430)은 제2 게이트 전극(424)의 일부와 중첩될 수 있으나, 수소를 차단하기 위하여, 제2 게이트 전극(424)의 상부를 완전히 커버하도록 중첩할 수 있다. 산화물 배리어층(430)은 도 1의 산화물 배리어층(130)과 실질적으로 동일하므로 중복 설명을 생략하기로 한다.The oxide barrier layer 430 is disposed on the second interlayer insulating layer 416. The oxide barrier layer 430 is arranged to overlap the second gate electrode 424 on the second interlayer insulating layer 416, so that hydrogen generated on the top of the second thin film transistor 420 flows to the second gate electrode 424 or It blocks diffusion into the second active layer 421. The oxide barrier layer 430 may overlap a portion of the second gate electrode 424, but may overlap to completely cover the top of the second gate electrode 424 to block hydrogen. Since the oxide barrier layer 430 is substantially the same as the oxide barrier layer 130 of FIG. 1, duplicate description will be omitted.

연결 전극(480)은 분리 절연층(414) 및 제2 층간 절연층(416)에 형성된 컨택홀을 통하여 제1 드레인 전극(473)과 전기적으로 연결될 수 있으나, 이에 제한되지는 않는다. 예를 들면, 연결 전극(480)은 분리 절연층(414) 및 제2 층간 절연층(416)에 형성된 컨택홀을 통하여 제1 드레인 전극(473)과 전기적으로 연결될 수 있다. 또한, 분리 절연층(414) 및 제2 층간 절연층(416)에 형성된 컨택홀을 통하여 제1 드레인 전극(473)과 전기적으로 연결되는 연결 전극(480)을 형성하는 경우, 분리 절연층(414) 및 제2 층간 절연층(416)에 형성된 컨택홀을 통하여 제1 소스 전극(472)과 전기적으로 연결되는 제1 보조 소스 전극을 더 형성할 수 있다. The connection electrode 480 may be electrically connected to the first drain electrode 473 through a contact hole formed in the separation insulating layer 414 and the second interlayer insulating layer 416, but is not limited thereto. For example, the connection electrode 480 may be electrically connected to the first drain electrode 473 through a contact hole formed in the separation insulating layer 414 and the second interlayer insulating layer 416. In addition, when forming the connection electrode 480 electrically connected to the first drain electrode 473 through the contact hole formed in the separation insulating layer 414 and the second interlayer insulating layer 416, the separation insulating layer 414 ) and a first auxiliary source electrode electrically connected to the first source electrode 472 through a contact hole formed in the second interlayer insulating layer 416 may be further formed.

연결 전극(480), 제2 소스 전극(422) 및 제2 드레인 전극(423)은 동일한 공정에 의해 형성될 수 있다. 그리고, 연결 전극(480), 제2 소스 전극(422), 및 제2 드레인 전극(423)은 동일한 물질로 형성될 수 있다. The connection electrode 480, the second source electrode 422, and the second drain electrode 423 may be formed through the same process. Also, the connection electrode 480, the second source electrode 422, and the second drain electrode 423 may be formed of the same material.

본 발명의 다른 실시예에 따른 표시 장치(400)는 저온 폴리 실리콘 물질을 포함하는 제1 박막 트랜지스터(470) 및 산화물 반도체 물질을 포함하는 제2 박막 트랜지스터(420)를 포함한다. 산화물 반도체 물질을 포함하는 제2 박막 트랜지스터(420)는 제2 소스 전극(422) 또는 제2 드레인 전극(423)과 전기적으로 연결되고, 제2 게이트 전극(424)과 중첩하도록 제2 층간 절연층(416) 상에 배치되고 금속 산화물로 이루어진 산화물 배리어층(430)을 포함한다. 산화물 배리어층(430)은 제2 박막 트랜지스터(420) 상부에 배치된 평탄화층(418) 및 봉지부(160)에서 발생한 수소 또는 수소 이온이 제2 박막 트랜지스터(420)의 제2 게이트 전극(424) 및 제2 액티브층(421)으로 확산되는 것을 차단한다.The display device 400 according to another embodiment of the present invention includes a first thin film transistor 470 including a low-temperature polysilicon material and a second thin film transistor 420 including an oxide semiconductor material. The second thin film transistor 420 including an oxide semiconductor material is electrically connected to the second source electrode 422 or the second drain electrode 423, and has a second interlayer insulating layer to overlap the second gate electrode 424. It is disposed on (416) and includes an oxide barrier layer (430) made of metal oxide. The oxide barrier layer 430 allows hydrogen or hydrogen ions generated in the planarization layer 418 and the encapsulation portion 160 disposed on the second thin film transistor 420 to pass through the second gate electrode 424 of the second thin film transistor 420. ) and diffusion to the second active layer 421.

특히, 산화물 반도체 물질을 포함하는 제2 박막 트랜지스터(420)는 스위칭 박막 트랜지스터로 사용될 수 있다. 스위칭 박막 트랜지스터는 온(On) 시간이 짧고 오프(Off) 시간을 길게 유지하는데, 오프(Off) 시간 동안 스위칭 박막 트랜지스터의 게이트 전극은 음전위를 띄게 된다. 게이트 전극이 음전위를 띄면, 양전하를 가지는 수소 이온(H+)이 게이트 전극과의 전기적 인력에 의해 빠르게 게이트 전극으로 이동한다. 결국 많은 수소 이온 및 수소 원자가 액티브층에 확산되어 액티브층의 전기적 성질을 변화시키고 성능을 크게 저하시킬 수 있다.In particular, the second thin film transistor 420 containing an oxide semiconductor material can be used as a switching thin film transistor. A switching thin film transistor has a short on time and a long off time, and during the off time, the gate electrode of the switching thin film transistor has a negative potential. When the gate electrode has a negative potential, positively charged hydrogen ions (H + ) quickly move to the gate electrode due to electrical attraction with the gate electrode. Ultimately, many hydrogen ions and hydrogen atoms may diffuse into the active layer, changing the electrical properties of the active layer and significantly reducing performance.

그러나, 본 발명의 다른 실시예에 따른 표시 장치는 스위칭 박막 트랜지스터로 사용되는 제2 박막 트랜지스터의 소스 전극 또는 드레인 전극과 연결된 산화물 배리어층을 게이트 전극 및 액티브층 상에 배치시킴으로써, 수소 또는 수소 이온의 침투를 억제할 수 있다.However, a display device according to another embodiment of the present invention arranges an oxide barrier layer connected to the source electrode or drain electrode of the second thin film transistor used as a switching thin film transistor on the gate electrode and the active layer, so that hydrogen or hydrogen ions Infiltration can be suppressed.

본 발명의 다양한 실시예들에 따른 표시 장치는 다음과 같이 설명될 수 있다.A display device according to various embodiments of the present invention may be described as follows.

본 발명의 일 실시예에 따른 박막 트랜지스터는 기판 상에 배치되고 산화물 반도체 물질로 이루어진 액티브층, 액티브층 상의 게이트 절연층, 게이트 절연층을 사이에 두고 액티브층과 중첩하는 게이트 전극, 게이트 전극 상의 층간 절연층, 층간 절연층에 형성된 컨택홀을 통해 액티브층과 전기적으로 연결되고, 층간 절연층 상에서 서로 이격되어 배치된 소스 전극 및 드레인 전극, 및 소스 전극 및 드레인 전극 중 어느 하나와 전기적으로 연결되고, 게이트 전극과 중첩하도록 층간 절연층 상에 배치된 산화물 배리어층을 포함한다. A thin film transistor according to an embodiment of the present invention is disposed on a substrate and includes an active layer made of an oxide semiconductor material, a gate insulating layer on the active layer, a gate electrode overlapping the active layer with the gate insulating layer in between, and an interlayer on the gate electrode. It is electrically connected to the active layer through a contact hole formed in the insulating layer and the interlayer insulating layer, and is electrically connected to one of the source electrode and the drain electrode arranged to be spaced apart from each other on the interlayer insulating layer, and the source electrode and the drain electrode, and an oxide barrier layer disposed on the interlayer insulating layer to overlap the gate electrode.

본 발명의 다른 특징에 따르면, 산화물 배리어층은 액티브층과 동일한 물질을 포함할 수 있다.According to another feature of the present invention, the oxide barrier layer may include the same material as the active layer.

본 발명의 또 다른 특징에 따르면, 액티브층 및 산화물 배리어층은 IGZO(indium-gallium-zinc-oxide), ZnO(Zinc Oxide), IZO(indium-zinc-oxide), IGTO(indium-gallium-tin-oxide), IGO(indium-gallium-oxide) 또는 이들의 조합으로 이루어질 수 있다.According to another feature of the present invention, the active layer and the oxide barrier layer include indium-gallium-zinc-oxide (IGZO), zinc oxide (ZnO), indium-zinc-oxide (IZO), and indium-gallium-tin- (IGTO). oxide), IGO (indium-gallium-oxide), or a combination thereof.

본 발명의 또 다른 특징에 따르면, 게이트 전극과 산화물 배리어층은 서로 반대되는 전위가 인가될 수 있다.According to another feature of the present invention, potentials opposite to each other may be applied to the gate electrode and the oxide barrier layer.

본 발명의 또 다른 특징에 따르면, 게이트 전극에는 음전위가 인가되고, 산화물 배리어층은 양전위가 인가될 수 있다.According to another feature of the present invention, a negative potential may be applied to the gate electrode, and a positive potential may be applied to the oxide barrier layer.

본 발명의 또 다른 특징에 따르면, 산화물 배리어층은 소스 전극 또는 드레인 전극과 직접 접촉할 수 있다.According to another feature of the present invention, the oxide barrier layer may be in direct contact with the source electrode or the drain electrode.

본 발명의 또 다른 특징에 따르면, 산화물 배리어층의 두께는 200Å 내지 600Å일 수 있다.According to another feature of the present invention, the thickness of the oxide barrier layer may be 200Å to 600Å.

본 발명의 또 다른 특징에 따르면, 산화물 배리어층은 게이트 전극의 상부를 완전히 커버할 수 있다.According to another feature of the present invention, the oxide barrier layer can completely cover the top of the gate electrode.

본 발명의 또 다른 특징에 따르면, 층간 절연층은 액티브층, 게이트 절연층 및 게이트 전극을 커버하도록 배치되고, 층간 절연층은 게이트 전극이 배치된 영역에서 단차를 형성하고, 산화물 배리어층은 층간 절연층의 단차를 커버하도록 배치될 수 있다.According to another feature of the present invention, the interlayer insulating layer is disposed to cover the active layer, the gate insulating layer, and the gate electrode, the interlayer insulating layer forms a step in the area where the gate electrode is disposed, and the oxide barrier layer is an interlayer insulating layer. It can be arranged to cover the level difference in the floor.

본 발명의 또 다른 특징에 따르면, 층간 절연층은 게이트 전극과 인접하는 부분에 형성된 공극을 포함하고, 산화물 배리어층은 공극을 커버하도록 층간 절연층 표면에 접촉하도록 배치될 수 있다.According to another feature of the present invention, the interlayer insulating layer includes a gap formed in a portion adjacent to the gate electrode, and the oxide barrier layer may be disposed to contact the surface of the interlayer insulating layer to cover the gap.

본 발명의 일 실시예에 따른 표시 장치는, 저온 폴리 실리콘 물질을 포함하는 제1 박막 트랜지스터, 산화물 반도체 물질을 포함하는 제2 박막 트랜지스터, 제1 박막 트랜지스터 및 제2 박막 트랜지스터 상에 배치되고, 애노드, 유기발광층, 및 캐소드를 포함하는 유기 발광 소자, 및 유기 발광 소자 상에 배치되는 봉지부를 포함하고, 제2 박막 트랜지스터는 봉지부에서 발생하는 수소가 제2 박막 트랜지스터로 유입되는 것을 차단하기 위하여, 제2 박막 트랜지스터의 게이트 전극 및 액티브층과 봉지부 사이에 산화물로 이루어진 산화물 배리어층을 포함한다.A display device according to an embodiment of the present invention is disposed on a first thin film transistor including a low-temperature polysilicon material, a second thin film transistor including an oxide semiconductor material, the first thin film transistor and the second thin film transistor, and an anode. , an organic light-emitting device including an organic light-emitting layer and a cathode, and an encapsulation portion disposed on the organic light-emitting device, wherein the second thin film transistor blocks hydrogen generated in the encapsulation portion from flowing into the second thin film transistor, It includes an oxide barrier layer made of oxide between the gate electrode and the active layer of the second thin film transistor and the encapsulation part.

본 발명의 다른 특징에 따르면, 제1 박막 트랜지스터는 저온 폴리 실리콘 물질로 이루어진 제1 액티브층, 제1 액티브층 상의 제1 게이트 절연층, 제1 게이트 절연층 상에 배치되고 제1 액티브층과 중첩하는 제1 게이트 전극, 게이트 전극 상의 제1 층간 절연층, 및 제1 층간 절연층 상에 배치되고 제1 액티브층과 연결된 제1 소스 전극 및 제1 드레인 전극을 포함하고, 제2 박막 트랜지스터는 산화물 반도체 물질로 이루어진 제2 액티브층, 제2 액티브층 상의 제2 게이트 절연층, 제2 게이트 절연층 상에 배치되고 제2 액티브층과 중첩하는 제2 게이트 전극, 게이트 전극 상의 제2 층간 절연층, 및 제2 층간 절연층 상에 배치되고 제2 액티브층과 연결된 제2 소스 전극 및 제2 드레인 전극을 포함할 수 있다.According to another feature of the present invention, the first thin film transistor includes a first active layer made of a low-temperature polysilicon material, a first gate insulating layer on the first active layer, and disposed on the first gate insulating layer and overlapping with the first active layer. It includes a first gate electrode, a first interlayer insulating layer on the gate electrode, and a first source electrode and a first drain electrode disposed on the first interlayer insulating layer and connected to the first active layer, and the second thin film transistor is made of oxide. a second active layer made of a semiconductor material, a second gate insulating layer on the second active layer, a second gate electrode disposed on the second gate insulating layer and overlapping the second active layer, a second interlayer insulating layer on the gate electrode, and a second source electrode and a second drain electrode disposed on the second interlayer insulating layer and connected to the second active layer.

본 발명의 또 다른 특징에 따르면, 산화물 배리어층은 제2 게이트 전극과 중첩하도록 제2 층간 절연층 상에 배치되고, 제2 소스 전극 및 제2 드레인 전극과 직접 접촉할 수 있다.According to another feature of the present invention, the oxide barrier layer is disposed on the second interlayer insulating layer to overlap the second gate electrode and may be in direct contact with the second source electrode and the second drain electrode.

본 발명의 또 다른 특징에 따르면, 제2 액티브층 및 산화물 배리어층은 IGZO(indium-gallium-zinc-oxide), ZnO(Zinc Oxide), IZO(indium-zinc-oxide), IGTO(indium-gallium-tin-oxide), IGO(indium-gallium-oxide) 또는 이들의 조합으로 이루질 수 있다.According to another feature of the present invention, the second active layer and the oxide barrier layer include indium-gallium-zinc-oxide (IGZO), indium-gallium-zinc-oxide (ZnO), indium-zinc-oxide (IZO), and indium-gallium-oxide (IGTO). It may be made of tin-oxide), IGO (indium-gallium-oxide), or a combination thereof.

본 발명의 또 다른 특징에 따르면, 산화물 배리어층은 제2 게이트 전극의 상부 및 측부를 커버하도록 배치될 수 있다.According to another feature of the present invention, the oxide barrier layer may be disposed to cover the top and sides of the second gate electrode.

본 발명의 또 다른 특징에 따르면, 제1 박막 트랜지스터는 구동 박막 트랜지스터이고, 제2 박막 트랜지스터는 스위칭 박막 트랜지스터일 수 있다.According to another feature of the present invention, the first thin film transistor may be a driving thin film transistor, and the second thin film transistor may be a switching thin film transistor.

이상 첨부된 도면을 참조하여 본 발명의 실시예들을 더욱 상세하게 설명하였으나, 본 발명은 반드시 이러한 실시예로 국한되는 것은 아니고, 본 발명의 기술사상을 벗어나지 않는 범위 내에서 다양하게 변형실시될 수 있다. 따라서, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 제한하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 제한되는 것은 아니다. 그러므로, 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 제한적이 아닌 것으로 이해해야만 한다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.Although embodiments of the present invention have been described in more detail with reference to the accompanying drawings, the present invention is not necessarily limited to these embodiments, and various modifications may be made without departing from the technical spirit of the present invention. . Accordingly, the embodiments disclosed in the present invention are not intended to limit the technical idea of the present invention but are for illustrative purposes, and the scope of the technical idea of the present invention is not limited by these embodiments. Therefore, the embodiments described above should be understood in all respects as illustrative and not restrictive. The scope of protection of the present invention should be interpreted in accordance with the claims below, and all technical ideas within the equivalent scope should be construed as being included in the scope of rights of the present invention.

100, 200, 300, 400: 표시 장치
110: 기판
111: 버퍼층
112: 게이트 절연층
113: 층간 절연층
114: 보호층
115: 평탄화층
120, 220, 320: 산화물 박막 트랜지스터,
121: 액티브층
122, 322: 소스 전극
123, 323: 드레인 전극
124: 게이트 전극
130, 230, 330: 산화물 배리어층
140: 뱅크
150: 유기 발광 소자
151: 애노드
152: 유기 발광층
153: 캐소드
160: 봉지부
161: 제1 봉지층
162: 제2 봉지층
163: 제3 봉지층
100, 200, 300, 400: display device
110: substrate
111: buffer layer
112: Gate insulating layer
113: Interlayer insulation layer
114: protective layer
115: Flattening layer
120, 220, 320: oxide thin film transistor,
121: active layer
122, 322: source electrode
123, 323: drain electrode
124: Gate electrode
130, 230, 330: Oxide barrier layer
140: bank
150: Organic light emitting device
151: anode
152: Organic light emitting layer
153: cathode
160: Encapsulation part
161: first encapsulation layer
162: Second encapsulation layer
163: Third encapsulation layer

Claims (16)

기판 상에 배치되고 산화물 반도체 물질로 이루어진 액티브층;
상기 액티브층 상의 게이트 절연층;
상기 게이트 절연층을 사이에 두고 상기 액티브층과 중첩하는 게이트 전극;
상기 게이트 전극 상의 층간 절연층;
상기 층간 절연층에 형성된 컨택홀을 통해 상기 액티브층과 전기적으로 연결되고, 상기 층간 절연층 상에서 서로 이격되어 배치된 소스 전극 및 드레인 전극; 및
상기 소스 전극 및 상기 드레인 전극 중 어느 하나와 전기적으로 연결되고, 상기 게이트 전극과 중첩하도록 상기 층간 절연층 상에 배치된 산화물 배리어층을 포함하고,
상기 게이트 전극과 상기 산화물 배리어층은 서로 반대되는 전위가 인가되는, 박막 트랜지스터.
An active layer disposed on a substrate and made of an oxide semiconductor material;
a gate insulating layer on the active layer;
a gate electrode overlapping the active layer with the gate insulating layer interposed therebetween;
an interlayer insulating layer on the gate electrode;
a source electrode and a drain electrode electrically connected to the active layer through a contact hole formed in the interlayer insulating layer and spaced apart from each other on the interlayer insulating layer; and
An oxide barrier layer electrically connected to one of the source electrode and the drain electrode and disposed on the interlayer insulating layer to overlap the gate electrode,
A thin film transistor in which opposite potentials are applied to the gate electrode and the oxide barrier layer.
제1 항에 있어서,
상기 산화물 배리어층은 상기 액티브층과 동일한 물질을 포함하는, 박막 트랜지스터.
According to claim 1,
A thin film transistor, wherein the oxide barrier layer includes the same material as the active layer.
제2 항에 있어서,
상기 액티브층 및 상기 산화물 배리어층은 IGZO(indium-gallium-zinc-oxide), ZnO(Zinc Oxide), IZO(indium-zinc-oxide), IGTO(indium-gallium-tin-oxide), IGO(indium-gallium-oxide) 또는 이들의 조합으로 이루어진, 박막 트랜지스터.
According to clause 2,
The active layer and the oxide barrier layer include indium-gallium-zinc-oxide (IGZO), zinc oxide (ZnO), indium-zinc-oxide (IZO), indium-gallium-tin-oxide (IGTO), and indium-gallium-tin-oxide (IGO). A thin film transistor made of gallium-oxide) or a combination thereof.
삭제delete 제1 항에 있어서,
상기 게이트 전극에는 음전위가 인가되고, 상기 산화물 배리어층은 양전위가 인가된, 박막 트랜지스터.
According to claim 1,
A thin film transistor in which a negative potential is applied to the gate electrode and a positive potential is applied to the oxide barrier layer.
제1 항에 있어서,
상기 산화물 배리어층은 상기 소스 전극 또는 상기 드레인 전극과 직접 접촉하는, 박막 트랜지스터.
According to claim 1,
A thin film transistor, wherein the oxide barrier layer is in direct contact with the source electrode or the drain electrode.
제1 항에 있어서,
상기 산화물 배리어층의 두께는 200Å 내지 600Å인, 박막 트랜지스터.
According to claim 1,
A thin film transistor wherein the oxide barrier layer has a thickness of 200Å to 600Å.
제1 항에 있어서,
상기 산화물 배리어층은 상기 게이트 전극의 상부를 완전히 커버하는, 박막 트랜지스터.
According to claim 1,
A thin film transistor, wherein the oxide barrier layer completely covers the top of the gate electrode.
제8 항에 있어서,
상기 층간 절연층은 상기 액티브층, 상기 게이트 절연층 및 상기 게이트 전극을 커버하도록 배치되고, 상기 층간 절연층은 상기 게이트 전극이 배치된 영역에서 단차를 형성하고,
상기 산화물 배리어층은 상기 층간 절연층의 상기 단차를 커버하도록 배치된, 박막 트랜지스터.
According to clause 8,
The interlayer insulating layer is disposed to cover the active layer, the gate insulating layer, and the gate electrode, and the interlayer insulating layer forms a step in the area where the gate electrode is disposed,
The thin film transistor, wherein the oxide barrier layer is arranged to cover the step of the interlayer insulating layer.
제9 항에 있어서,
상기 층간 절연층은 상기 게이트 전극과 인접하는 부분에 형성된 공극을 포함하고,
상기 산화물 배리어층은 상기 공극을 커버하도록 상기 층간 절연층 표면에 접촉하도록 배치된, 박막 트랜지스터.
According to clause 9,
The interlayer insulating layer includes a gap formed in a portion adjacent to the gate electrode,
The thin film transistor, wherein the oxide barrier layer is disposed to contact the surface of the interlayer insulating layer to cover the air gap.
저온 폴리 실리콘 물질을 포함하는 제1 박막 트랜지스터;
산화물 반도체 물질을 포함하는 제2 박막 트랜지스터;
상기 제1 박막 트랜지스터 및 상기 제2 박막 트랜지스터 상에 배치되고, 애노드, 유기발광층, 및 캐소드를 포함하는 유기 발광 소자; 및
상기 유기 발광 소자 상에 배치되는 봉지부를 포함하고,
상기 제2 박막 트랜지스터는 상기 봉지부에서 발생하는 수소가 상기 제2 박막 트랜지스터로 유입되는 것을 차단하기 위하여, 제2 박막 트랜지스터의 게이트 전극 및 액티브층과 상기 봉지부 사이에 산화물로 이루어진 산화물 배리어층을 포함하고,
상기 게이트 전극과 상기 산화물 배리어층은 서로 반대되는 전위가 인가되는, 표시 장치.
A first thin film transistor comprising a low-temperature polysilicon material;
a second thin film transistor comprising an oxide semiconductor material;
an organic light emitting device disposed on the first thin film transistor and the second thin film transistor and including an anode, an organic light emitting layer, and a cathode; and
It includes an encapsulation portion disposed on the organic light emitting device,
The second thin film transistor has an oxide barrier layer made of oxide between the gate electrode and active layer of the second thin film transistor and the sealing part to block hydrogen generated in the encapsulation from flowing into the second thin film transistor. Contains,
A display device wherein opposing potentials are applied to the gate electrode and the oxide barrier layer.
제11 항에 있어서,
상기 제1 박막 트랜지스터는 저온 폴리 실리콘 물질로 이루어진 제1 액티브층, 상기 제1 액티브층 상의 제1 게이트 절연층, 상기 제1 게이트 절연층 상에 배치되고 제1 액티브층과 중첩하는 제1 게이트 전극, 상기 게이트 전극 상의 제1 층간 절연층, 및 상기 제1 층간 절연층 상에 배치되고 상기 제1 액티브층과 연결된 제1 소스 전극 및 제1 드레인 전극을 포함하고,
상기 제2 박막 트랜지스터는 산화물 반도체 물질로 이루어진 제2 액티브층, 상기 제2 액티브층 상의 제2 게이트 절연층, 상기 제2 게이트 절연층 상에 배치되고 제2 액티브층과 중첩하는 제2 게이트 전극, 상기 게이트 전극 상의 제2 층간 절연층, 및 상기 제2 층간 절연층 상에 배치되고 상기 제2 액티브층과 연결된 제2 소스 전극 및 제2 드레인 전극을 포함하는, 표시 장치.
According to claim 11,
The first thin film transistor includes a first active layer made of a low-temperature polysilicon material, a first gate insulating layer on the first active layer, and a first gate electrode disposed on the first gate insulating layer and overlapping the first active layer. , a first interlayer insulating layer on the gate electrode, and a first source electrode and a first drain electrode disposed on the first interlayer insulating layer and connected to the first active layer,
The second thin film transistor includes a second active layer made of an oxide semiconductor material, a second gate insulating layer on the second active layer, a second gate electrode disposed on the second gate insulating layer and overlapping the second active layer, A display device comprising a second interlayer insulating layer on the gate electrode, and a second source electrode and a second drain electrode disposed on the second interlayer insulating layer and connected to the second active layer.
제12 항에 있어서,
상기 산화물 배리어층은 상기 제2 게이트 전극과 중첩하도록 상기 제2 층간 절연층 상에 배치되고, 상기 제2 소스 전극 및 상기 제2 드레인 전극과 직접 접촉하는, 표시 장치.
According to claim 12,
The display device wherein the oxide barrier layer is disposed on the second interlayer insulating layer to overlap the second gate electrode and is in direct contact with the second source electrode and the second drain electrode.
제12 항에 있어서,
상기 제2 액티브층 및 상기 산화물 배리어층은 IGZO(indium-gallium-zinc-oxide), ZnO(Zinc Oxide), IZO(indium-zinc-oxide), IGTO(indium-gallium-tin-oxide), IGO(indium-gallium-oxide) 또는 이들의 조합으로 이루어진, 표시 장치.
According to claim 12,
The second active layer and the oxide barrier layer include indium-gallium-zinc-oxide (IGZO), zinc oxide (ZnO), indium-zinc-oxide (IZO), indium-gallium-tin-oxide (IGTO), and IGO ( indium-gallium-oxide) or a combination thereof.
제12 항에 있어서,
상기 산화물 배리어층은 상기 제2 게이트 전극의 상부 및 측부를 커버하도록 배치된, 표시 장치.
According to claim 12,
The display device wherein the oxide barrier layer is disposed to cover a top and a side of the second gate electrode.
제12 항에 있어서,
상기 제1 박막 트랜지스터는 구동 박막 트랜지스터이고,
상기 제2 박막 트랜지스터는 스위칭 박막 트랜지스터인, 표시 장치.
According to claim 12,
The first thin film transistor is a driving thin film transistor,
The display device wherein the second thin film transistor is a switching thin film transistor.
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* Cited by examiner, † Cited by third party
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CN114883414B (en) * 2022-04-29 2023-12-29 武汉华星光电半导体显示技术有限公司 Display backboard, display module and display device

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000269505A (en) * 1999-03-16 2000-09-29 Matsushita Electric Ind Co Ltd Semiconductor device and its manufacture

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20130056784A1 (en) * 2011-09-02 2013-03-07 Lg Display Co., Ltd. Organic Light-Emitting Display Device and Method of Fabricating the Same
JP5636392B2 (en) * 2012-05-24 2014-12-03 株式会社東芝 Display device
KR102397873B1 (en) * 2014-02-24 2022-05-16 엘지디스플레이 주식회사 Display device
KR102326408B1 (en) * 2014-02-24 2021-11-16 엘지디스플레이 주식회사 Thin Film Transistor Substrate And Display Using The Same
KR101672091B1 (en) * 2014-02-25 2016-11-02 엘지디스플레이 주식회사 Organic emitting display device having multi-type thin film transistor
KR102593335B1 (en) * 2016-06-10 2023-10-23 엘지디스플레이 주식회사 Organic light emitting display device and method of manufacturing the same
KR20180013369A (en) * 2016-07-29 2018-02-07 엘지디스플레이 주식회사 Organic light emitting display device comprising multi-type thin film transistor

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000269505A (en) * 1999-03-16 2000-09-29 Matsushita Electric Ind Co Ltd Semiconductor device and its manufacture

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