KR102477326B1 - Display panel having stable maintenance ratio with viewing angle changed in different gray levels - Google Patents

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Abstract

디스플레이 패널은 제1 기판과 제2 기판 사이에 위치된 액정 층을 포함한다. 제1 기판은 픽셀 영역을 정의하도록 교차된 스캔 라인 및 데이터 라인을 포함한다. 각각의 픽셀 영역은, 데이터 라인의 연장 방향에 평행한 2개의 연장 부분 및 2개의 연장 부분 사이에 위치되며 2개의 연장 부분을 연결하는 하나의 휨 부분을 갖는 전극을 포함한다. 광이 픽셀 영역을 통과할 때 제1 다크 패턴 및 복수의 제2 다크 패턴을 포함하는 다크 패턴이 발생된다. 제1 다크 패턴은 휨 부분에 대응하고 스캔 라인에 평행하다. 제2 다크 패턴은 연장 부분에 대응한다. 제1 다크 패턴은 각각 제1 그레이 레벨(전체 그레이 레벨의 1/2) 및 제2 그레이 레벨(최대 그레이 레벨)에서의 제1 및 제2 폭을 갖는다. 제2 폭에 대한 제1 폭의 비는 2.1 내지 3.0이다. The display panel includes a liquid crystal layer positioned between a first substrate and a second substrate. The first substrate includes scan lines and data lines crossed to define a pixel area. Each pixel area includes two extending portions parallel to the extending direction of the data line and an electrode having one bent portion positioned between the two extending portions and connecting the two extending portions. When light passes through the pixel area, a dark pattern including a first dark pattern and a plurality of second dark patterns is generated. The first dark pattern corresponds to the bending portion and is parallel to the scan line. The second dark pattern corresponds to the extended portion. The first dark pattern has first and second widths at a first gray level (half of the total gray level) and a second gray level (maximum gray level), respectively. A ratio of the first width to the second width is 2.1 to 3.0.

Description

상이한 그레이 레벨에서 시야각이 달라지는 안정적인 유지보수율을 갖는 디스플레이 패널{DISPLAY PANEL HAVING STABLE MAINTENANCE RATIO WITH VIEWING ANGLE CHANGED IN DIFFERENT GRAY LEVELS}Display panel having a stable maintenance rate with varying viewing angles at different gray levels

본 개시는 일반적으로 디스플레이 패널에 관한 것으로, 보다 상세하게는 보다 나은 디스플레이 품질을 갖는 디스플레이 패널에 관한 것이다. The present disclosure relates generally to display panels, and more particularly to display panels with better display quality.

오늘날 스마트폰, 태블릿 개인용 컴퓨터(즉, 태블릿 PC, 플랫 PC, 예: iPad), 랩톱, 모니터, 및 텔레비전과 같은 디스플레이 패널을 구비한 전자 제품들은 일상 생활에 있어서 작업 및 여가를 위해 필요한 도구이다. 액정 디스플레이(LCD; liquid crystal display) 패널은 사용되고 있는 가장 인기있는 디스플레이 패널이다. BACKGROUND OF THE INVENTION Electronic products with display panels such as smart phones, tablet personal computers (i.e., tablet PCs, flat PCs, eg iPad), laptops, monitors, and televisions today are necessary tools for work and leisure in daily life. Liquid crystal display (LCD) panels are the most popular display panels in use.

평판 디스플레이, 전자 시각적 디스플레이 및 이미지 디스플레이에 적용가능한 LCD 패널에 대하여, 2개의 투명 전극들 사이에 정렬된 액정 분자들은 전기장이 인가될 때 전기장의 극성과 크기에 따라 연속적으로 회전하며, 인가 전압을 변화시킴으로써 상이한 그레이 스케일 표현이 조정 및 실현될 수 있다. LCD 패널은 컴팩트한 크기, 가벼운 중량, 휴대 용이성, 합리적 가격, 높은 디스플레이 품질 및 동작 신뢰성과 같은 우수한 특성을 소유한다. 또한, 시청자의 눈은 LCD 패널을 보는 데에 훨씬 더 편안함을 느낀다. 예전의 음극선관(CRT; cathode ray tube) 모니터는 LCD 패널로 교체되었다. 현재, LCD 패널은 소비자들에 대하여 크기, 형상 및 해상도에 있어서 범용적인 선택을 제공한다. 그러나, 디스플레이 패널의 품질은 프로세스의 변동(variation)에 의해 영향을 받을 것이다. 제조 절차에서의 세부사항 뿐만 아니라 제품의 요건을 충족시키는 전기적 성능 및 사양도 고려하는 것이 중요하다. 예를 들어, 적임의 디스플레이 패널은 높은 동작 신뢰성 및 안정적인 디스플레이 품질과 같은 보다 나은 전기적 특성을 가져야 하며, 제공되는 제조 방법은 높은 생산 수율을 얻고 유지하여야 한다. 일반적으로, 디스플레이 패널의 불량 설계는 생산의 수율 및 신뢰성 감소를 초래할 것이다. 또한, 디스플레이 품질 뿐만 아니라 전기적 성능에 미치는 프로세스 변동 영향도 고려되어야 한다. For LCD panels applicable to flat panel displays, electronic visual displays and image displays, liquid crystal molecules aligned between two transparent electrodes continuously rotate according to the polarity and magnitude of an electric field when an electric field is applied, and changes the applied voltage. By doing so, different gray scale representations can be adjusted and realized. LCD panels possess excellent characteristics such as compact size, light weight, portability, reasonable price, high display quality and operation reliability. Also, the viewer's eyes feel much more comfortable viewing the LCD panel. Old cathode ray tube (CRT) monitors have been replaced with LCD panels. Currently, LCD panels offer consumers a universal choice in size, shape and resolution. However, the quality of the display panel will be affected by process variations. It is important to consider the details in the manufacturing process as well as the electrical performance and specifications to meet the product's requirements. For example, a suitable display panel should have better electrical properties, such as high operational reliability and stable display quality, and provided manufacturing methods should obtain and maintain high production yields. Generally, poor design of display panels will result in reduced yield and reliability of production. In addition, the impact of process variations on electrical performance as well as display quality must be considered.

본 개시는 보다 나은 디스플레이 품질을 갖는 디스플레이 패널에 관한 것이다. The present disclosure relates to a display panel having better display quality.

본 개시의 하나의 양상에 따르면, 디스플레이 패널로서, 제1 기판, 제1 기판에 대향하는 제2 기판, 및 제1 기판과 제2 기판 사이에 배치된 액정 층을 포함하는 디스플레이 패널이 제공된다. 제1 기판은, 제1 기판 위에 배치된 스캔 라인 및 제1 기판 위에 배치되며 픽셀 영역을 정의하도록 스캔 라인과 교차하는 데이터 라인을 포함한다. 픽셀 영역 중의 적어도 하나는, 2개의 연장(extending) 부분 및 하나의 휨(bending) 부분을 갖는 전극을 포함하며, 연장 부분은 데이터 라인의 연장 방향에 실질적으로 평행하고, 휨 부분은 2개의 연장 부분 사이에 위치되며 2개의 연장 부분을 연결한다. 광이 픽셀 영역 중의 상기 하나를 통과할 때, 제1 다크 패턴 및 복수의 제2 다크 패턴을 포함하는 다크 패턴이 픽셀 영역 중의 상기 하나에 발생되며, 제1 다크 패턴은 전극의 휨 부분에 대응하고, 제1 다크 패턴의 연장 방향은 스캔 라인의 연장 방향에 실질적으로 평행하고, 제2 다크 패턴은 전극의 연장 부분에 대응한다. 제1 다크 패턴은 제1 그레이 레벨에서의 제1 폭 및 제2 그레이 레벨에서의 제2 폭을 갖고, 제2 폭에 대한 제1 폭의 비(ratio)는 2.1 내지 3.0의 범위이며, 제2 그레이 레벨은 디스플레이 패널의 최대 그레이 레벨이고, 제1 그레이 레벨은 전체 그레이 레벨의 1/2이다.According to one aspect of the present disclosure, a display panel including a first substrate, a second substrate opposite the first substrate, and a liquid crystal layer disposed between the first substrate and the second substrate is provided. The first substrate includes a scan line disposed on the first substrate and a data line disposed on the first substrate and crossing the scan line to define a pixel area. At least one of the pixel regions includes an electrode having two extending portions and one bending portion, the extending portion being substantially parallel to the extending direction of the data line, and the bending portion comprising two extending portions It is located between and connects the two extensions. When light passes through said one of the pixel areas, a dark pattern comprising a first dark pattern and a plurality of second dark patterns is generated in said one of the pixel areas, the first dark pattern corresponding to a bent portion of the electrode; , the extending direction of the first dark pattern is substantially parallel to the extending direction of the scan line, and the second dark pattern corresponds to the extending portion of the electrode. The first dark pattern has a first width at a first gray level and a second width at a second gray level, a ratio of the first width to the second width ranges from 2.1 to 3.0, and a second width The gray level is the maximum gray level of the display panel, and the first gray level is 1/2 of the entire gray level.

본 개시의 상기 및 기타 양상은, 바람직하지만 비한정적인 실시예의 다음 상세한 설명에 관련하여 보다 잘 이해될 것이다. 다음의 설명은 첨부 도면을 참조하여 이루어진다.These and other aspects of the present disclosure will be better understood in connection with the following detailed description of preferred but non-limiting embodiments. The following description is made with reference to the accompanying drawings.

도 1a는 본 개시의 실시예에 따른 FFS(fringe field switching) 모드 LCD 패널의 평면도이다.
도 1b는 도 1a의 단면 선을 따라 취한 LCD 패널의 단면도이다.
도 2는 본 개시의 다른 실시예에 따른 FFS 모드 LCD 패널의 단면도이다.
도 3a는 본 개시의 실시예에 따른 단일 픽셀 영역을 도시한다.
도 3b는 광이 도 3a의 픽셀 영역을 통과하는 경우 발생된 다크 패턴을 예시한다.
도 4는 실시예의 디스플레이 패널에서 그레이 레벨에 따라 달라지는 제1 다크 패턴의 폭을 도시한다.
도 5는 본 개시의 실시예에 따라, 폭의 비에 따라 각각 달라지는 중간 그레이 레벨에서의 시야각 균일도 파라미터, 최대 그레이 레벨에서의 시야각 균일도 파라미터 및 시야각 유지보수율(maintenance ratio)을 도시한다.
도 6은 본 개시의 실시예에 따른 디스플레이 패널의 상이한 컬러의 R, G 및 B 서브픽셀에서 그레이 레벨에 따라 달라지는 폭을 도시한다.
도 7은 상이한 정렬 방향으로부터의 결과인 픽셀 영역에서의 LC 모듈 정렬의 여러 패턴들을 예시하며, 그리하여 픽셀 영역의 폭의 더 높은 비, 중간 비, 및 더 낮은 비를 얻는다.
도 8은 대응하는 픽셀 영역에서 제1 다크 패턴의 폭의 상이한 비를 갖는 여러 다크 패턴들을 예시한다.
도 9는 픽셀 전극의 형상에 응답하여 픽셀 영역에서의 LC 모듈 정렬의 여러 패턴들을 예시한다.
도 10은 픽셀 전극의 상이한 형상에 따라 대응하는 픽셀 영역에서의 제1 다크 패턴의 폭의 상이한 비를 갖는 2개의 다크 패턴을 예시한다.
도 11a, 도 11b 및 도 11c는 각각 액정 분자들의 스플레이, 트위스트 및 벤드 타입의 변형을 예시한다.
도 12는 액정 분자들의 상이한 변형에 따라 대응하는 픽셀 영역에서의 제1 다크 패턴의 폭의 상이한 비를 갖는 2개의 다크 패턴을 예시한다.
도 13은 도 12-(1)에서 간격 d에 대응하는 그레이 스케일 곡선을 도시한다.
1A is a plan view of a fringe field switching (FFS) mode LCD panel according to an embodiment of the present disclosure.
FIG. 1B is a cross-sectional view of the LCD panel taken along the section line of FIG. 1A.
2 is a cross-sectional view of an FFS mode LCD panel according to another embodiment of the present disclosure.
3A shows a single pixel area according to an embodiment of the present disclosure.
3B illustrates a dark pattern generated when light passes through the pixel area of FIG. 3A.
4 illustrates a width of a first dark pattern that varies according to a gray level in a display panel according to an exemplary embodiment.
FIG. 5 illustrates a viewing angle uniformity parameter at an intermediate gray level, a viewing angle uniformity parameter at a maximum gray level, and a viewing angle maintenance ratio, each varying according to a width ratio, according to an embodiment of the present disclosure.
6 illustrates widths varying according to gray levels in R, G, and B subpixels of different colors of a display panel according to an embodiment of the present disclosure.
Figure 7 illustrates several patterns of LC module alignment in the pixel area resulting from different alignment directions, thus obtaining higher, median, and lower ratios of the width of the pixel area.
8 illustrates several dark patterns with different ratios of widths of the first dark patterns in corresponding pixel areas.
9 illustrates several patterns of LC module alignment in a pixel area in response to the shape of a pixel electrode.
10 illustrates two dark patterns having different ratios of widths of the first dark patterns in corresponding pixel areas according to different shapes of pixel electrodes.
11A, 11B and 11C respectively illustrate the splay, twist and bend type of deformation of liquid crystal molecules.
12 illustrates two dark patterns having different ratios of widths of the first dark patterns in corresponding pixel areas according to different deformations of liquid crystal molecules.
Fig. 13 shows a gray scale curve corresponding to interval d in Fig. 12-(1).

본 개시의 실시예에서는, 상이한 그레이 레벨에서 폭의 비의 특정 설계를 제공하는 것에 의해 상이한 그레이 레벨에서 달라지는 시야각으로 광 변동의 보다 나은 안정적인 유지보수율(maintenance ratio)을 달성함으로써, 보다 나은 디스플레이 품질을 갖는 디스플레이 패널이 개시된다. 또한, 안정적인 유지보수율의 결과에 의해 영향받는 제조 프로세스의 변동을 감소시킨다. 또한, 다음의 실시예의 디스플레이 패널은 제품의 설계 요건을 충족시키도록 보다 높은 개구율(aperture ratio)을 제공한다. 따라서, 실시예의 설계에 의해 제조되는 디스플레이 패널의 생산 수율이 증가되고, 그 결과 구현된 디스플레이 패널의 보다 신뢰성있고 안정적인 디스플레이 품질이 얻어진다. In an embodiment of the present disclosure, by providing a specific design of the width ratio at different gray levels to achieve a better and more stable maintenance ratio of light fluctuations with different viewing angles at different gray levels, thereby providing better display quality. A display panel having is disclosed. It also reduces fluctuations in the manufacturing process that are affected by results in stable maintenance rates. In addition, the display panel of the following embodiment provides a higher aperture ratio to meet the design requirements of the product. Therefore, the production yield of the display panel manufactured by the design of the embodiment is increased, and as a result, more reliable and stable display quality of the implemented display panel is obtained.

실시예가 첨부 도면에 관련하여 상세하게 기재된다. 실시예의 구조의 세부사항이 예시를 위해 제공되며 실시예의 기재된 세부사항은 본 개시를 한정하고자 하는 것이 아님을 유의한다. 본 발명의 모든 실시예가 도시된 것은 아님을 유의하여야 한다. 실제 응용의 요건을 충족시키도록 본 개시의 진정한 의미로부터 벗어나지 않고서 수정 및 변형이 이루어질 수 있다. 따라서, 구체적으로 예시되지 않은 본 개시의 다른 실시예가 존재할 수 있다. 또한, 첨부 도면은 본 개시의 명확한 예시를 위해 단순화된 것이며, 도면에서의 크기 및 비율이 실제 제품에 직접 비례하는 것은 아니고 본 개시에의 한정으로서 해석되어서는 안 된다. 따라서, 명세서 및 도면은 한정하는 것이 아니라 예시적인 것으로서 간주되어야 할 것이다. 또한, 실시예의 동일 및/또는 유사 요소는 동일 및/또는 유사 참조 번호로 지정된다. Embodiments are described in detail with reference to the accompanying drawings. It is noted that structural details of the embodiments are provided for purposes of illustration and that the described details of the embodiments are not intended to limit the present disclosure. It should be noted that not all embodiments of the present invention are shown. Modifications and variations may be made to meet the requirements of actual applications without departing from the true meaning of the present disclosure. Accordingly, there may be other embodiments of the present disclosure that are not specifically illustrated. In addition, the accompanying drawings are simplified for clear illustration of the present disclosure, and the sizes and proportions in the drawings are not directly proportional to actual products and should not be construed as limitations on the present disclosure. Accordingly, the specification and drawings are to be regarded as illustrative rather than limiting. Also, identical and/or similar elements in the embodiments are designated with identical and/or similar reference numerals.

또한, 구성요소를 수정하도록 명세서 및 청구항에서 "제1", "제2", "제3" 등과 같은 서수 용어를 사용하는 것은, 그 자체가 방법의 동작들이 수행되는, 또다른 또는 시간적 순서보다 우선하는 하나의 청구항 구성요소의 임의의 우선순위, 우선권, 또는 순서를 내포하는 것은 아니며, 단지 청구항 구성요소들을 구별하도록 특정 이름을 갖는 하나의 청구항 구성요소를 동일한 이름을 갖는 또다른 구성요소(하지만 서수적 용어의 사용)와 구별하기 위한 라벨로서 사용되는 것이다. Further, the use of ordinal terms such as “first,” “second,” “third,” etc. in the specification and claims to modify an element is, in itself, rather than another or chronological order in which the operations of a method are performed. It does not imply any priority, precedence, or order of the overriding one claim element, merely to distinguish one claim element having a particular name from another claim element having the same name (but It is used as a label to distinguish it from the use of ordinal terms).

본 개시의 실시예는 FFS(fringe field switching) 모드 LCD 패널에 적용되는 것과 같은 상이한 응용 분야에 널리 사용될 수 있다. 도 1a는 본 개시의 실시예에 따른 FFS 모드 LCD 패널의 평면도이다. 도 1b는 도 1a의 단면 선 1B-1B를 따라 취한 LCD 패널의 단면도이다. 디스플레이 패널은 제1 기판(S1), 제1 기판(S1)에 대향하여 배치된 제2 기판(S2), 및 제1 기판(S1)과 제2 기판(S2) 사이에 배치된 액정 층(LC)을 포함한다. 이 실시예에서, 설명을 위해 상부 픽셀 전극 구성을 갖는 LCD 패널이 예시되어 있지만, 본 개시는 이 구성 및 예시된 세부사항에 한정되지 않는다. Embodiments of the present disclosure can be widely used in different application fields, such as applied to fringe field switching (FFS) mode LCD panels. 1A is a plan view of an FFS mode LCD panel according to an embodiment of the present disclosure. FIG. 1B is a cross-sectional view of the LCD panel taken along section line 1B-1B in FIG. 1A. The display panel includes a first substrate S1, a second substrate S2 disposed to face the first substrate S1, and a liquid crystal layer LC disposed between the first substrate S1 and the second substrate S2. ). In this embodiment, an LCD panel with an upper pixel electrode configuration is illustrated for illustrative purposes, but the present disclosure is not limited to this configuration and illustrated details.

하나의 실시예 에서, 도 1a에 도시된 바와 같이, 제1 기판(S1)은 제1 베이스(110), 및 제1 기판(110) 위에 배치되며 서로 교차하는 복수의 스캔 라인(SL) 및 데이터 라인(DL)을 포함한다. 또한, 2개의 인접한 데이터 라인(DL) 및 2개의 인접한 스캔 라인(SL)이 픽셀 영역(PX)을 정의하도록 교차한다. 또한, 제2 기판(S2)의 구성요소는 생략되어 도 1a에 도시되지 않았다. In one embodiment, as shown in FIG. 1A, the first substrate S1 includes a first base 110, and a plurality of scan lines SL and data disposed on the first substrate 110 and crossing each other. It includes line DL. Also, two adjacent data lines DL and two adjacent scan lines SL intersect to define a pixel area PX. Also, components of the second substrate S2 are omitted and are not shown in FIG. 1A.

도 1a 및 도 1b에 도시된 바와 같이, 픽셀 영역(PX)은, 제1 베이스(110) 위에 배치되며 LTPS(low temperature polysilicon)으로 제조된 활성 층(113), 활성 층(113) 위에 배치된 제1 절연 층(121), 게이트(120G), 및 게이트(120G) 위에 배치된 제2 절연 층(122)을 포함하는 박막 트랜지스터(TFT)를 포함한다. 실시예에서, TFT는 더블 게이트를 갖는다. 픽셀 영역(PX)을 제어하기 위한 스위치로서 기능하는 박막 트랜지스터(TFT)는 스캔 라인(SL)과 데이터 라인(DL) 사이의 교차점에 인접하게 배치되고, 데이터 라인(DL)에 전기적으로 접속된다. 또한, 제2 절연 층(122)은 비아(124) 및 비아(125)를 가지며, 각각 TFT의 데이터 라인(DL) 및 드레인 전극(DE)을 형성하도록 전도성 재료가 비아(124) 및 비아(125)에 배치된다. 전도성 재료의 예는 금속 재료 또는 ITO, IZO, ITZO, IGZO, 또는 이들의 조합과 같은 다른 적합한 전도성 재료를 포함한다. 따라서, 데이터 라인(DL)은 비아(124)를 통해 활성 층(113)에 전기적으로 접속되고, 드레인 전극(DE)은 비아(125)를 통해 활성 층(113)에 전기적으로 접속된다. 추가적으로, 제3 절연 층(127)이 제2 절연 층(122), 데이터 라인(DL) 및 드레인 전극(DE) 위에 배치된다. 제1 전도성 층(131)(도 1a에 도시되지 않음)이 제3 절연 층(127) 위에 배치되고, 제2 전도성 층(132)이 제1 전도성 층(131) 위에 배치되고, 제4 절연 층(128)이 제1 전도성 층(131)과 제2 전도성 층(132) 사이에 배치되고, 절연 막(133)이 제2 전도성 층(132) 위에 배치된다. 도 1b에 도시된 바와 같이, 이 실시예의 디스플레이 패널에 따르면, 구성은 상부에 있는 제2 전도성 층(132)이 데이터 라인(DL)에 전기적으로 접속되는 것을 도시하며, 제2 전도성 층(132)은 픽셀 전극으로 지칭되고, 제1 전도성 층(131)은 공통 전극으로 지칭된다. 도 1b에 도시된 구조는 또한, 상부 픽셀 전극 구성을 갖는 LCD 패널로서 알려져 있다. 따라서, 도 1b에 도시된 바와 같이, 비아(129)는 드레인 전극(DE)을 노출시키도록 제4 절연 층(128)(제1 전도성 층(131)과 제2 전도성 층(132) 사이에 배치됨)과 제3 절연 층(127)(TFT와 제1 전도성 층(131) 사이에 배치됨)을 관통한다. 제2 전도성 층(132)은 드레인 전극(DE)에 전기적으로 접속하기 위해 비아(129)에 배치되며, 그리하여 제2 전도성 층(132)이 활성 층(113)에 의해 데이터 라인(DL)에 전기적으로 접속될 수 있다. As shown in FIGS. 1A and 1B , the pixel area PX is disposed on the first base 110 and disposed on the active layer 113 made of low temperature polysilicon (LTPS) and the active layer 113 A thin film transistor (TFT) including a first insulating layer 121 , a gate 120G, and a second insulating layer 122 disposed on the gate 120G. In an embodiment, the TFT has a double gate. The thin film transistor TFT serving as a switch for controlling the pixel area PX is disposed adjacent to the intersection between the scan line SL and the data line DL, and is electrically connected to the data line DL. In addition, the second insulating layer 122 has a via 124 and a via 125, and a conductive material is formed in the via 124 and the via 125 to form the data line DL and the drain electrode DE of the TFT, respectively. ) is placed in Examples of conductive materials include metallic materials or other suitable conductive materials such as ITO, IZO, ITZO, IGZO, or combinations thereof. Accordingly, the data line DL is electrically connected to the active layer 113 through the via 124 , and the drain electrode DE is electrically connected to the active layer 113 through the via 125 . Additionally, a third insulating layer 127 is disposed on the second insulating layer 122 , the data line DL, and the drain electrode DE. A first conductive layer 131 (not shown in FIG. 1A ) is disposed over the third insulating layer 127, a second conductive layer 132 is disposed over the first conductive layer 131, and a fourth insulating layer 128 is disposed between the first conductive layer 131 and the second conductive layer 132 , and an insulating film 133 is disposed over the second conductive layer 132 . As shown in FIG. 1B, according to the display panel of this embodiment, the configuration shows that the second conductive layer 132 on the top is electrically connected to the data line DL, and the second conductive layer 132 is referred to as a pixel electrode, and the first conductive layer 131 is referred to as a common electrode. The structure shown in FIG. 1B is also known as an LCD panel with an upper pixel electrode configuration. Therefore, as shown in FIG. 1B, the via 129 is disposed between the fourth insulating layer 128 (the first conductive layer 131 and the second conductive layer 132) to expose the drain electrode DE. ) and the third insulating layer 127 (disposed between the TFT and the first conductive layer 131). The second conductive layer 132 is disposed on the via 129 to electrically connect to the drain electrode DE, so that the second conductive layer 132 is electrically connected to the data line DL by the active layer 113. can be connected to.

하나의 실시예에서, 제1 절연 층(121), 제2 절연 층(122) 및 제4 절연 층(128)은, SiOx 또는 SiNx 또는 기타 적용가능한 재료로부터 독립적으로 선택되는 것과 같은, 동일하거나 상이한 무기 재료로 제조될 수 있는 무기 절연 층일 수 있다. 제2 절연 층(122) 및 제4 절연 층(128)은 단층 또는 다층일 수 있다. 제3 절연 층(127)은 제1 전도성 층(131)으로부터 TFT를 격리하도록 평탄화 층인 것에 대하여 PFA(polyfluoroalkoxy)와 같은 유기 절연 층일 수 있다. 다른 실시예에서, 제3 절연 층(127)은, 동일 기판 상에 컬러 필터 층 및 박막 트랜지스터(TFT)를 갖는 COA(Color filter on array) 실시예인 컬러 필터 층의 재료로 제조될 수 있다. 그러나, 본 개시는 이에 한정되지 않고, 제3 절연 층(127)은 다른 유기 재료, 무기 재료, 또는 유기 재료와 무기 재료의 조합을 선택하여 제조될 수 있다. 하나의 실시예에서, 제1 전도성 층(131)과 제2 전도성 층(132)은 약 50 nm 내지 약 700 nm 범위 간격으로 이격되어 있다. 하나의 실시예에서, 박막 트랜지스터와 제1 전도성 층(131) 사이의 제3 절연 층(127)이 유기 절연 층인 경우, 제1 전도성 층(131)과 제2 전도성 층(132)은 약 300 nm 내지 약 700 nm 범위, 예를 들어 약 500 nm 간격으로 이격되어 있다. 다른 실시예에서, 박막 트랜지스터와 제1 전도성 층(131) 사이의 제3 절연 층(127)이 무기 절연 층인 경우, 제1 전도성 층(131)과 제2 전도성 층(132)은 약 50 nm 내지 약 300 nm 범위, 예를 들어 약 150 nm 내지 약 200 nm 간격으로 이격되어 있다. 제공되는 이들 수치 값은 한정하는 것이 아니라 단지 설명을 위해 개시된 것임을 유의하여야 한다.In one embodiment, the first insulating layer 121, the second insulating layer 122 and the fourth insulating layer 128 are the same or different, such as independently selected from SiOx or SiNx or other applicable materials. It may be an inorganic insulating layer which may be made of an inorganic material. The second insulating layer 122 and the fourth insulating layer 128 may have a single layer or multiple layers. The third insulating layer 127 may be an organic insulating layer such as polyfluoroalkoxy (PFA) for being a planarization layer to isolate the TFT from the first conductive layer 131 . In another embodiment, the third insulating layer 127 may be made of a color filter layer material that is a color filter on array (COA) embodiment having a color filter layer and a thin film transistor (TFT) on the same substrate. However, the present disclosure is not limited thereto, and the third insulating layer 127 may be manufactured by selecting other organic materials, inorganic materials, or a combination of organic and inorganic materials. In one embodiment, the first conductive layer 131 and the second conductive layer 132 are spaced apart by a spacing ranging from about 50 nm to about 700 nm. In one embodiment, when the third insulating layer 127 between the thin film transistor and the first conductive layer 131 is an organic insulating layer, the first conductive layer 131 and the second conductive layer 132 are about 300 nm to about 700 nm, for example about 500 nm apart. In another embodiment, when the third insulating layer 127 between the thin film transistor and the first conductive layer 131 is an inorganic insulating layer, the first conductive layer 131 and the second conductive layer 132 may have a thickness of about 50 nm to about 50 nm. They are spaced apart in a range of about 300 nm, for example about 150 nm to about 200 nm apart. It should be noted that these numerical values provided are not limiting and are disclosed for illustrative purposes only.

또한, 실시예의 전극은 복수의 전극 브랜치(branches) 및 복수의 슬릿(slits)을 포함하고, 각각의 슬릿은 인접한 전극 브랜치들 사이에 위치된다. 도 1a 및 도 1b에 도시된 바와 같이, 제2 전도성 층(132)(즉, 전극)은 여러 슬릿들(134)을 갖고, 슬릿들(134)의 연장 방향은 데이터 라인(DL)의 방향에 실질적으로 평행하다. 하나의 실시예에서, 각각의 슬릿(134)은 1.5 ㎛ 내지 4 ㎛ 범위의 폭을 가질 수 있다(하지만 이에 한정되는 것은 아님). 하나의 실시예에서, 전극 브랜치의 각각은 1.5 ㎛ 내지 4 ㎛ 범위의 폭을 가질 수 있다(하지만 이에 한정되는 것은 아님). 또한, 제1 전도성 층(131)은 슬릿이 없거나(도 1b에 도시된 바와 같이) 슬릿을 가질 수 있고, 본 개시는 이에 어떠한 특정 한정도 갖지 않는다. In addition, the electrode of an embodiment includes a plurality of electrode branches and a plurality of slits, each slit being positioned between adjacent electrode branches. As shown in FIGS. 1A and 1B , the second conductive layer 132 (ie, the electrode) has several slits 134, and the extending direction of the slits 134 is in the direction of the data line DL. Practically parallel. In one embodiment, each slit 134 may have a width in the range of 1.5 μm to 4 μm (but is not limited to). In one embodiment, each of the electrode branches may have a width ranging from (but not limited to) 1.5 μm to 4 μm. In addition, the first conductive layer 131 may be without slits (as shown in FIG. 1B) or may have slits, and the present disclosure does not have any specific limitations thereto.

일부 실시예에서, 도 1b에 도시된 바와 같이, 디스플레이 패널의 TFT는 상부-게이트(top-gate) 구조로서 구성될 수 있다. 다른 실시예에서, 디스플레이 패널의 TFT는 하부-게이트(bottom-gate) 구조로서 구성될 수 있다. 본 개시는 상부-게이트 디스플레이 패널 뿐만 아니라 하부-게이트 디스플레이 패널에도 적용 가능하다. 그리고 게이트의 수는 이에 한정되지 않는다. In some embodiments, as shown in FIG. 1B , the TFTs of the display panel may be configured as a top-gate structure. In another embodiment, the TFTs of the display panel may be configured as a bottom-gate structure. The present disclosure is applicable not only to top-gate display panels but also to bottom-gate display panels. And the number of gates is not limited thereto.

도 2는 본 개시의 다른 실시예에 따른 FFS 모드 LCD 패널의 단면도이다. 도 2의 LCD 패널은 상부 공통 전극 구성을 갖는 LCD 패널로도 알려져 있다. 또한, 도 2 및 도 1a에서의 동일한 구성요소는 동일한 참조 번호로 지정되고, 동일한 구성요소의 구조적 세부사항은 상기에 기재되었으며 여기에서 중복으로 반복되지 않았다. 도 1b와 도 2 간의 구조적 차이는 데이터 라인(DL)에 접속된 구성요소이다. 도 2에서는, 제1 전도성 층(131)(제2 전도성 층(132) 아래)이 데이터 라인(DL)에 전기적으로 접속된다. 제2 전도성 층(132)은 공통 전극일 수 있으며, 제1 전도성 층(131)은 픽셀 전극일 수 있고, 도 2에 도시된 구조는 상부 공통 전극 구성을 갖는 LCD 패널로 지칭된다. 또한, 제2 전도성 층(132)은 여러 슬릿들을 갖는 반면에, 제1 전도성 층(131)은 슬릿을 갖지 않거나 슬릿이 없을 수 있다. 따라서, 도 2에 도시된 바와 같이, 비아(129)는 드레인 전극(DE)을 노출시키도록 제3 절연 층(127)(TFT의 드레인 전극(DE)과 제1 전도성 층(131) 사이에 배치됨)을 관통한다. 제2 전도성 층(132)은, 드레인 전극(DE)에 전기적으로 접속하고 활성 층(113)을 통해 데이터 라인(DL)에 더 전기적으로 접속하기 위해 비아(129)에 배치된다. 2 is a cross-sectional view of an FFS mode LCD panel according to another embodiment of the present disclosure. The LCD panel of FIG. 2 is also known as an LCD panel having an upper common electrode configuration. Also, like elements in FIGS. 2 and 1A are designated by like reference numerals, and structural details of like elements have been described above and are not repeated here. A structural difference between FIG. 1B and FIG. 2 is a component connected to the data line DL. In FIG. 2 , the first conductive layer 131 (under the second conductive layer 132 ) is electrically connected to the data line DL. The second conductive layer 132 may be a common electrode, the first conductive layer 131 may be a pixel electrode, and the structure shown in FIG. 2 is referred to as an LCD panel having an upper common electrode configuration. Also, while the second conductive layer 132 has several slits, the first conductive layer 131 may or may not have slits. Therefore, as shown in FIG. 2, the via 129 is disposed between the third insulating layer 127 (the drain electrode DE of the TFT and the first conductive layer 131 to expose the drain electrode DE) ) penetrates The second conductive layer 132 is disposed on the via 129 to electrically connect to the drain electrode DE and further electrically connect to the data line DL through the active layer 113 .

일반적으로, FFS 모드 LCD 패널의 각각의 픽셀 영역(PX)은 상부 도메인 및 하부 도메인과 같은 적어도 2개의 도메인을 포함하고, 전극의 패턴은 도 1a에 도시된 바와 같은 V형 형상의 전극과 같이, 응용에서의 멀티도메인의 실제 타입에 따라 대응하여 설계된다. 다음의 기재에서, 설명을 위해 상부 도메인 및 하부 도메인을 갖는 픽셀 영역(PX)이 예시되어 있으며(하지만 본 개시의 응용은 이에 한정되지 않음), 픽셀 영역(PX)에 대응하는 전극은 2개의 연장 부분(132E) 및 하나의 휨 부분(132B)을 갖고, 휨 부분(132B)은 2개의 연장 부분(132E) 사이에 위치되며 2개의 연장 부분(132E)을 연결한다. 상부 픽셀 전극 구성을 갖는 LCD 패널의 픽셀 영역(PX)을 예시한 하나의 실시예에서, 도 1b에 도시된 바와 같이, 제2 전도성 층(132)이 TFT에 전기적으로 접속된다. 상부 공통 전극 구성을 갖는 LCD 패널의 픽셀 영역(PX)을 예시한 하나의 실시예에서, 도 2에 도시된 바와 같이, 제1 전도성 층(131)이 TFT에 전기적으로 접속되며, 픽셀 영역(PX) 내의 공통 전극의 패턴은 연장 부분 및 휨 부분을 정의한다. 슬릿 또는 픽셀 영역에 대응하는 연장 부분은 데이터 라인(DL)의 연장 방향에 실질적으로 평행하고, 휨 부분은 2개의 연장 부분 사이에 위치되며 2개의 연장 부분을 연결한다. In general, each pixel area PX of the FFS mode LCD panel includes at least two domains such as an upper domain and a lower domain, and the pattern of the electrode is like the V-shaped electrode shown in FIG. 1A, It is designed correspondingly according to the actual type of multi-domain in the application. In the following description, a pixel area PX having an upper domain and a lower domain is exemplified for description (but the application of the present disclosure is not limited thereto), and an electrode corresponding to the pixel area PX has two extensions. It has a portion 132E and one bending portion 132B, and the bending portion 132B is positioned between the two extending portions 132E and connects the two extending portions 132E. In one embodiment illustrating the pixel area PX of an LCD panel having a top pixel electrode configuration, the second conductive layer 132 is electrically connected to the TFT, as shown in FIG. 1B. In one embodiment illustrating the pixel area PX of the LCD panel having the upper common electrode configuration, as shown in FIG. 2 , the first conductive layer 131 is electrically connected to the TFT, and the pixel area PX The pattern of the common electrode in ) defines an extended portion and a bent portion. The extension portion corresponding to the slit or pixel area is substantially parallel to the extension direction of the data line DL, and the bending portion is positioned between the two extension portions and connects the two extension portions.

도 3a 및 도 3b를 참조하자. 도 3a는 본 개시의 실시예에 따른 단일 픽셀 영역을 도시한다. 픽셀 영역(PX)의 전극은 2개의 연장 부분(330E) 및 하나의 휨 부분(330B)을 가지며, 2개의 슬릿(331)이 픽셀 영역(PX)의 전극에 형성된다. 슬릿(331)의 연장 부분(330E)은 데이터 라인(DL)의 연장 방향에 실질적으로 평행하고, 휨 부분(330B)은 2개의 연장 부분(330E) 사이에 위치되며 2개의 연장 부분(330E)을 연결한다. 실시예에서, 스캔 라인(SL)은 직선으로서 패터닝되고 X 방향에 평행한 연장 방향을 갖는다. 데이터 라인(DL)은 스킨 라인(SL)에 수직이 아니지만, 실질적으로 연장 방향(Y 방향)을 갖는다. 도 3a에서, 데이터 라인(DL)과 스캔 라인(X 방향) 사이의 각도 θDL가 XY-평면(Cartesian 평면) 상에 표시되어 있다. 다른 실시예에서, 스캔 라인(SL)이 비-직선으로서 패터닝될 수 있지만, 여전히 실질적으로 연장 방향(X 방향)을 갖는다. 하나의 실시예에서, 전극의 2개의 연장 부분(330E)과 스캔 라인(SL) 사이의 각도가 존재하고, 이 각도는 각도 θDL과 실질적으로 동일하며, 80도 내지 87도 범위, 예를 들어 84도일 수 있다. 그러나, 본 개시는 도 3a에 도시된 구조 타입, 및 내각 또는 각도 범위로서 제공된 수치 값에 한정되지 않는다. 또한, 스캔 라인(SL)과 2개의 연장 부분(330E) 사이의 각도 θDL가 동일하거나 상이할 수 있다.See Figures 3a and 3b. 3A shows a single pixel area according to an embodiment of the present disclosure. The electrode of the pixel area PX has two extending parts 330E and one bending part 330B, and two slits 331 are formed in the electrode of the pixel area PX. The extension portion 330E of the slit 331 is substantially parallel to the extension direction of the data line DL, and the bending portion 330B is positioned between the two extension portions 330E and extends the two extension portions 330E. connect In an embodiment, the scan lines SL are patterned as straight lines and have an extension direction parallel to the X direction. The data line DL is not perpendicular to the skin line SL, but has a substantially extending direction (Y direction). In FIG. 3A , the angle θ DL between the data line DL and the scan line (X direction) is displayed on the XY-plane (Cartesian plane). In another embodiment, the scan lines SL may be patterned as non-straight lines, but still have a substantially extending direction (X direction). In one embodiment, there is an angle between the two extension portions 330E of the electrode and the scan line SL, which angle is substantially equal to the angle θ DL and is in the range of 80 degrees to 87 degrees, for example It may be 84 degrees. However, the present disclosure is not limited to the type of structure shown in FIG. 3A and the numerical values provided as interior angles or angular ranges. Also, the angle θ DL between the scan line SL and the two extension portions 330E may be the same or different.

도 3b는 광이 도 3a의 단일 픽셀 영역을 통과하는 경우 발생되는 다크 패턴을 예시한다. 광이 픽셀 영역을 통과할 때, 제1 다크 패턴(DF1) 및 복수의 제2 다크 패턴(DF2)을 포함하는 다크 패턴이 발생된다. 제1 다크 패턴(DF1)은 전극의 휨 부분(330B)에 대응하고, 제1 다크 패턴(DF1)의 연장 방향(예: X 방향에 실질적으로 평행한, 도 3b의 XY-평면 상에 표시된 방향 DDF1)은 스캔 라인에 실질적으로 평행하다. 제2 다크 패턴(DF2)은 전극의 연장 부분(330E)에 대응하고, 제2 다크 패턴(DF2)의 연장 방향(예: 도 3b의 XY-평면 상에 표시된 방향 DDF2, 각도 θDF가 방향 DDF2와 X 축 사이에 포함됨)은 전극의 연장 부분(330E)에 실질적으로 평행하다. FIG. 3B illustrates a dark pattern generated when light passes through the single pixel area of FIG. 3A. When light passes through the pixel area, a dark pattern including a first dark pattern DF1 and a plurality of second dark patterns DF2 is generated. The first dark pattern DF1 corresponds to the bent portion 330B of the electrode, and extends in a direction of the first dark pattern DF1 (eg, a direction substantially parallel to the X direction, indicated on the XY-plane of FIG. 3B ). D DF1 ) is substantially parallel to the scan line. The second dark pattern DF2 corresponds to the extension portion 330E of the electrode, and the extension direction of the second dark pattern DF2 (eg, the direction D DF2 shown on the XY-plane of FIG. 3B , the angle θ DF is the direction D included between DF2 and the X axis) is substantially parallel to the extension portion 330E of the electrode.

또한, 광이 픽셀 영역을 통과할 때 제1 다크 패턴(DF1)(즉, 스캔 라인에 평행한 방향(X 방향)을 따라 연장된 다크 프린지) 및 제2 다크 패턴(DF2)이 발생되는 것 외에, 제1 다크 패턴(DF1)의 폭은 상이한 그레이 레벨의 변화에 따라 달라진다. 그레이 레벨이 높을수록, 제1 다크 패턴(DF1)의 폭은 더 얇아진다. 도 4는 실시예의 디스플레이 패널에서 그레이 레벨에 따라 달라지는 제1 다크 패턴의 폭을 도시한다. 설명을 위해 0(블랙)에서 255(화이트)(전체 그레이 레벨은 256 그레이 레벨임)의 그레이 레벨을 나타낼 수 있는 디스플레이 패널이 예시된다. 디스플레이 패널의 최대 그레이 레벨(255) 및 중간 그레이 레벨(128)에서 각각 폭을 비교하면, 결과는, 중간 그레이 레벨(128)에서의 제1 다크 패턴(DF1)의 폭(예: 도 4에서의 4 단위)이 최대 그레이 레벨(255)에서의 제1 다크 패턴(DF1)의 폭(예: 도 4에서의 1.54 단위)의 2.6배임을 나타낸다. 본 개시에 따르면, 폭, 시야각 균일도 파라미터 및 시야각 유지보수율 간의 관계가 조사 및 연구된다. 상이한 그레이 레벨에서 제1 다크 패턴(DF1)의 폭의 비를 조정함으로써, 실시예의 디스플레이 패널은 상이한 그레이 레벨에서 달라지는 시야각으로 광 변동의 보다 나은 안정적인 유지보수율을 소유하며(즉, 여기에서 "안정적인 시야각 유지보수율"로 간략하게 불릴 수 있음), 또한 제조 프로세스의 변동의 영향을 감소시킨다. In addition, in addition to generating a first dark pattern DF1 (that is, a dark fringe extending along a direction (X direction) parallel to the scan line) and a second dark pattern DF2 when light passes through the pixel area, , the width of the first dark pattern DF1 varies according to the change of different gray levels. The higher the gray level, the thinner the first dark pattern DF1 is. 4 illustrates a width of a first dark pattern that varies according to a gray level in a display panel according to an exemplary embodiment. A display panel capable of representing gray levels from 0 (black) to 255 (white) (total gray levels are 256 gray levels) is exemplified for the sake of explanation. Comparing the widths at the maximum gray level 255 and the middle gray level 128 of the display panel, the result is the width of the first dark pattern DF1 at the middle gray level 128 (eg, in FIG. 4 ). 4 units) represents 2.6 times the width (eg, 1.54 units in FIG. 4 ) of the first dark pattern DF1 at the maximum gray level 255 . According to the present disclosure, the relationship between width, viewing angle uniformity parameter and viewing angle maintenance rate is investigated and studied. By adjusting the ratio of the widths of the first dark patterns DF1 at different gray levels, the display panel of the embodiment possesses a better stable maintenance rate of light fluctuations with varying viewing angles at different gray levels (i.e., herein referred to as "stable viewing angle"). may be simply referred to as "maintenance rate"), and also reduces the impact of variations in the manufacturing process.

본 개시에 따라, 디스플레이 패널의 시야각 균일도 파라미터는 다음에 의해 정의된다:According to the present disclosure, the viewing angle uniformity parameter of the display panel is defined by:

θ(광 방출(luminous emittance)과 Z축 사이의 각도, Z 축은 X 축 및 Y 축에 수직임)=60 및

Figure 112016072598697-pat00001
(광 방출과 수평 축, 즉 X 축 사이의 각도)=90에서의 광도를 θ=60 및
Figure 112016072598697-pat00002
=0에서의 광도로 나눔. 통상적으로, 광도는 단위 면적당 각도 θ 및
Figure 112016072598697-pat00003
에 대응하는 광출력을 의미한다. 따라서, 디스플레이 패널의 시야각 균일도 파라미터는 아래와 같이 수학식 (1)에 의해 표현될 수 있다:θ (angle between the luminous emittance and the Z axis, the Z axis is perpendicular to the X and Y axes) = 60 and
Figure 112016072598697-pat00001
(the angle between the light emission and the horizontal axis, i.e. the X axis) = 90 as θ = 60 and
Figure 112016072598697-pat00002
Divide by the luminance at =0. Typically, the luminous intensity is an angle θ per unit area and
Figure 112016072598697-pat00003
represents the light output corresponding to Therefore, the viewing angle uniformity parameter of the display panel can be expressed by Equation (1) as follows:

Figure 112016072598697-pat00004
...(1)
Figure 112016072598697-pat00004
...(One)

디스플레이 패널의 시야각 유지보수율은 다음과 같이 정의될 수 있다:The viewing angle maintenance rate of the display panel can be defined as:

중간 그레이 레벨에서의 시야각 균일도 파라미터/최대 그레이 레벨에서의 시야각 균일도 파라미터Viewing angle uniformity parameter at medium gray level/Viewing angle uniformity parameter at maximum gray level

중간 그레이 레벨 및 최대 그레이 레벨은 응용에서의 디스플레이 패널의 그레이 스케일에 따라 결정된다. 통상적으로, 중간 그레이 레벨은 전체 그레이 레벨의 1/2이다. 예를 들어, 0(블랙) 내지 63(화이트)의 그레이 레벨을 나타낼 수 있는 디스플레이 패널의 경우, 최대 그레이 레벨은 63이고, 전체 그레이 레벨은 64 그레이 레벨이고, 중간 그레이 레벨은 32이다. 0(블랙) 내지 255(화이트)의 그레이 레벨을 나타낼 수 있는 디스플레이 패널의 경우, 최대 그레이 레벨은 255이고, 전체 그레이 레벨은 256 그레이 레벨이고, 중간 그레이 레벨은 128이다. 0(블랙) 내지 1023(화이트)의 그레이 레벨을 나타낼 수 있는 디스플레이 패널의 경우, 최대 그레이 레벨은 1023이고, 전체 그레이 레벨은 1024 그레이 레벨이고, 중간 그레이 레벨은 512이다. The middle gray level and the maximum gray level are determined according to the gray scale of the display panel in the application. Typically, the middle gray level is half the full gray level. For example, in the case of a display panel capable of representing gray levels from 0 (black) to 63 (white), the maximum gray level is 63, the total gray level is 64 gray levels, and the intermediate gray level is 32. For a display panel capable of representing gray levels from 0 (black) to 255 (white), the maximum gray level is 255, the total gray level is 256 gray levels, and the intermediate gray level is 128. For a display panel capable of representing a gray level of 0 (black) to 1023 (white), the maximum gray level is 1023, the total gray level is 1024 gray levels, and the intermediate gray level is 512.

따라서, 0(블랙) 내지 255(화이트)의 그레이 레벨을 갖는 구현된 디스플레이 패널의 시야각 유지보수율은 아래와 같이 수학식 (2)로 표현될 수 있다:Therefore, the viewing angle maintenance rate of the implemented display panel having a gray level of 0 (black) to 255 (white) can be expressed by Equation (2) as follows:

128 그레이 레벨에서의 시야각 균일도 파라미터/255 그레이 레벨에서의 시야각 균일도 ...(2)Viewing Angle Uniformity Parameter at 128 Gray Levels/Viewing Angle Uniformity at 255 Gray Levels...(2)

도 5는 본 개시의 실시예에 따라 제1 다크 패턴(DF1)의 폭의 비에 따라 각각 달라지는, 중간 그레이 레벨의 시야각 균일도 파라미터, 최대 그레이 레벨의 시야각 균일도 파라미터, 및 시야각 유지보수율을 도시한다. 제1 다크 패턴(DF1)의 폭의 비는, 중간 그레이 레벨(예: 128)에서의 제1 다크 패턴(DF1)의 폭을 최대 그레이 레벨(예: 255)에서의 제1 다크 패턴(DF1)의 폭으로 나눔으로써 정의된다. 또한, 도 5의 좌측 Y 축은 중간 그레이 레벨에서의 시야각 균일도 파라미터 및 최대 그레이 레벨에서의 시야각 균일도 파라미터를 나타낸다. 도 5의 우측 Y 축은 시야각 유지보수율을 나타낸다(즉, 중간 그레이 레벨에서의 시야각 균일도 파라미터를 최대 그레이 레벨에서의 시야각 균일도 파라미터로 나눔). 도 5에 도시된 바와 같이, 결과는, 제1 다크 패턴(DF1)의 폭의 비가 2.1보다 작을 때에 시야각 유지보수율이 현저하게 변한다는 문제를 나타낸다. 약 2.1 내지 약 3.0의 범위와 같이 제1 다크 패턴(DF1)의 폭의 비가 2.1보다 클 때에, 시야각 유지보수율은 안정적인 결과를 나타내고, 제조 프로세스의 변동에 의해 쉽게 영향받지 않을 것이다. 제1 다크 패턴(DF1)의 폭의 비가 높을수록 픽셀의 개구율이 낮아진다는 것이 알려져 있다. 따라서, 상한은 실제 응용에 있어서 픽셀의 개구율에 따라 설정되어야 한다. 예를 들어, 제1 다크 패턴(DF1)의 폭의 비가 3.0보다 크고, 폭이 너무 넓어서 픽셀의 개구율이 수락 불가능하다는 것이 밝혀졌을 때, "3.0"의 값이 제1 다크 패턴(DF1)의 폭의 비의 상한으로서 선택될 수 있다. FIG. 5 shows a viewing angle uniformity parameter of a medium gray level, a viewing angle uniformity parameter of a maximum gray level, and a viewing angle maintenance rate, each varying according to a width ratio of the first dark pattern DF1 according to an embodiment of the present disclosure. The ratio of the widths of the first dark patterns DF1 is the width of the first dark patterns DF1 at the middle gray level (eg 128) to the first dark pattern DF1 at the maximum gray level (eg 255). is defined by dividing by the breadth of In addition, the left Y-axis of FIG. 5 represents the viewing angle uniformity parameter at the middle gray level and the viewing angle uniformity parameter at the maximum gray level. The right Y-axis in Fig. 5 represents the viewing angle maintenance rate (ie, viewing angle uniformity parameter at the middle gray level divided by the viewing angle uniformity parameter at the maximum gray level). As shown in FIG. 5 , the result shows a problem that the viewing angle maintenance rate changes remarkably when the ratio of the widths of the first dark patterns DF1 is smaller than 2.1. When the ratio of the width of the first dark pattern DF1 is greater than 2.1, such as in the range of about 2.1 to about 3.0, the viewing angle maintenance rate shows a stable result and will not be easily affected by variations in the manufacturing process. It is known that the aperture ratio of a pixel decreases as the width ratio of the first dark pattern DF1 increases. Therefore, the upper limit must be set according to the aperture ratio of pixels in actual applications. For example, when it is found that the width ratio of the first dark pattern DF1 is greater than 3.0 and the aperture ratio of the pixels is unacceptable because the width is too wide, a value of “3.0” indicates the width of the first dark pattern DF1. can be chosen as the upper limit of the ratio of

또한, 사람의 눈은 녹색 컬러에 제일 민감하다. 디스플레이 패널은 컬러 필터 층을 구비하고 RGB 서브픽셀이 사용되는 것으로 가정한다. 사람의 눈은 녹색 컬러에 제일 민감하고 녹색 서브픽셀은 픽셀 투과율에 가장 큰 영향을 미치므로, 실제 설계에 있어서 녹색 서브픽셀의 투과율이 증가될 수 있는 것이 바람직하다. 제1 다크 패턴(DF1)의 폭은 투과율에 영향을 미친다. 제1 다크 패턴(DF1)의 폭이 더 좁을수록, 정면도(front-view) 투과율이 더 높아진다. 도 6은 본 개시의 실시예에 따른 디스플레이 패널의 상이한 컬러의 R, G 및 B 서브픽셀에서 그레이 레벨에 따라 달라진 제1 다크 패턴(DF1)의 폭을 도시한다. 실시예의 설계 개념에 따르면, 녹색 서브픽셀의 최대 광도는, 최대 그레이 레벨에서 제1 다크 패턴(DF1)의 폭을 감소시키는 것에 의해 녹색 서브픽셀의 투과율을 증가시킴으로써 얻어질 수 있다. 하나의 실시예에서, 광이 픽셀 영역을 통과할 때, 도 3a 및 도 3b에 도시된 제1 다크 패턴(DF1)을 포함하는 다크 패턴이 발생된다. 픽셀 영역(PX)이 녹색 서브픽셀 영역일 때, 제1 다크 패턴(예: DF1)은 최대 그레이 레벨에서의 제1 녹색 폭을 갖는다. 픽셀 영역(PX)이 적색 서브픽셀 영역일 때, 제1 다크 패턴(예: DF1)은 최대 그레이 레벨에서의 제1 적색 폭을 갖는다. 픽셀 영역(PX)이 청색 서브 픽셀 영역일 때, 제1 다크 패턴(예: DF1)은 최대 그레이 레벨에서의 제1 청색 폭을 갖는다. 제1 녹색 폭은 제1 적색 폭보다 더 작고 제1 녹색 폭은 또한 제1 청색 폭보다도 더 작도록 설계된다. Also, human eyes are most sensitive to green color. It is assumed that the display panel has a color filter layer and RGB subpixels are used. Since the human eye is most sensitive to green color and the green sub-pixel has the greatest influence on the pixel transmittance, it is desirable that the transmittance of the green sub-pixel can be increased in actual design. The width of the first dark pattern DF1 affects transmittance. The narrower the width of the first dark pattern DF1 is, the higher the front-view transmittance is. 6 illustrates widths of the first dark patterns DF1 varied according to gray levels in R, G, and B subpixels of different colors of the display panel according to an embodiment of the present disclosure. According to the design concept of the embodiment, the maximum luminance of the green sub-pixel can be obtained by increasing the transmittance of the green sub-pixel by reducing the width of the first dark pattern DF1 at the maximum gray level. In one embodiment, when light passes through the pixel area, a dark pattern including the first dark pattern DF1 shown in FIGS. 3A and 3B is generated. When the pixel area PX is a green subpixel area, the first dark pattern (eg, DF1) has a first green width at the maximum gray level. When the pixel area PX is a red subpixel area, the first dark pattern (eg, DF1) has a first red width at the maximum gray level. When the pixel area PX is a blue sub-pixel area, the first dark pattern (eg, DF1) has a first blue width at the maximum gray level. The first green width is smaller than the first red width and the first green width is also designed to be smaller than the first blue width.

설명을 위해, (제2 그레이 레벨; 예: 최대 그레이 레벨에서의 제1 다크 패턴의) 제2 폭에 대한 (제1 그레이 레벨; 예: 중간 그레이 레벨에서의 제1 다크 패턴의) 제1 폭의 구현된 비(예컨대 2.1 내지 3.0)를 달성하기 위한 3가지 상이한 방식들이 아래에 기재된다. 그러나, 본 개시는 이들 세부사항에 한정되지 않고, 실시예의 제2 폭에 대한 제1 폭의 비를 달성할 수 있는 다른 기술적 방식도 또한 적용가능하다. For purposes of explanation, a first width (of a first gray level; eg of a first dark pattern at an intermediate gray level) relative to a second width (of a second gray level; eg of a first dark pattern at a maximum gray level) Three different ways to achieve the realized ratio of (eg, 2.1 to 3.0) are described below. However, the present disclosure is not limited to these details, and other technical schemes capable of achieving the ratio of the first width to the second width of an embodiment are also applicable.

<광 정렬 층에의 노출 방법을 조정함으로써 제어되는 제1 다크 패턴의 폭의 비><The ratio of the widths of the first dark patterns controlled by adjusting the exposure method to the light alignment layer>

본 개시의 실시예는 포토 정렬(PA; photo alignment) 층을 구비한 디스플레이 패널에 적용될 수 있다. 예를 들어, 폴리이미드(PI; polyimide) 정렬 층과 같은 포토 정렬 층이 각각 제1 전도성 층(131) 및 제2 전도성 층(132) 위에 배치되며, 그 다음에 액정(LC) 분자들에 대한 정렬 방향을 생성하도록 UV 광으로 조사한다. 실시예에서, 최대 그레이 레벨에서의 제1 다크 패턴의 폭에 대한, 중간 그레이 레벨에서의 제1 다크 패턴의 폭의 비를 제어하기 위한 적용가능한 기술적 방식 중의 하나는, 포토 정렬 층에의 노출 방법의 조정이며, 그에 의해 적절한 폭의 비(즉, 최대 그레이 레벨(예: 255)에서의 제1 다크 패턴의 폭에 대한, 중간 그레이 레벨(예: 128)에서의 제1 다크 패턴의 폭), 예를 들어 2.1 이상(예: 약 2.1 내지 약 3.0 범위)의 폭의 비를 달성한다. 따라서, 시야각 유지보수율은 비교적 안정적이며, 제조 프로세스의 변동의 영향을 감소시킨다. An embodiment of the present disclosure may be applied to a display panel having a photo alignment (PA) layer. For example, a photo alignment layer, such as a polyimide (PI) alignment layer, is disposed over the first conductive layer 131 and the second conductive layer 132, respectively, and then the liquid crystal (LC) molecules Irradiate with UV light to create alignment directions. In an embodiment, one of the applicable technical ways for controlling the ratio of the width of the first dark pattern at the middle gray level to the width of the first dark pattern at the maximum gray level is an exposure method to the photo alignment layer. is an adjustment of , whereby an appropriate width ratio (i.e., the width of the first dark pattern at the intermediate gray level (eg 128) to the width of the first dark pattern at the maximum gray level (eg 255)), For example, a width ratio of 2.1 or greater (eg, in the range of about 2.1 to about 3.0) is achieved. Therefore, the viewing angle maintenance rate is relatively stable, reducing the influence of fluctuations in the manufacturing process.

도 7은 상이한 정렬 방향들로부터의 결과인 픽셀 영역에서의 LC 분자들의 여러 패턴들을 예시하며, 그에 의해 픽셀 영역에서의 제1 다크 패턴의 폭의 더 높은 비, 중간 비 및 더 낮은 비를 얻는다. 도 7에서, 패턴 (A)는 전압없음(I), 낮은 전압(II) 및 높은 전압(III)이 각각 적용되는 픽셀 영역에서의 LC 분자들의 3가지 상이한 정렬들을 나타내며, 픽셀 영역에서의 제1 다크 패턴의 폭의 더 높은 비가 획득될 수 있다. 패턴(B)는 전압없음(I), 낮은 전압(II) 및 높은 전압(III)이 각각 적용되는 픽셀 영역에서의 LC 분자들의 3가지 상이한 정렬들을 나타내며, 픽셀 영역에서의 제1 다크 패턴의 폭의 중간 비가 획득될 수 있다. 패턴 (C)는 전압없음(I), 낮은 전압(II) 및 높은 전압(III)이 각각 적용되는 픽셀 영역에서의 LC 분자들의 3가지 상이한 정렬들을 나타내며, 픽셀 영역에서의 제1 다크 패턴의 폭의 더 낮은 비가 획득될 수 있다. 다르게 말하자면, 도 7의 제1 열(I)의 패턴들은 전압없음이 적용되는 픽셀 영역에서의 LC 분자들의 정렬을 나타내고, 도 7의 제2 열(II)의 패턴들은 낮은 전압이 적용되는 픽셀 영역에서의 LC 분자들의 정렬을 나타내며, 픽셀 영역은 중간 그레이 레벨(예: 128)을 나타낸다. 또한, 도 7의 제3 열(III)의 패턴들은 높은 전압이 인가되는 픽셀 영역에서의 LC 분자들의 정렬을 나타내고, 픽셀 영역은 최대 그레이 레벨(예: 255)을 나타낸다. 7 illustrates several patterns of LC molecules in the pixel area resulting from different alignment directions, thereby obtaining a higher ratio, a middle ratio and a lower ratio of the width of the first dark pattern in the pixel area. In FIG. 7 , pattern (A) represents three different alignments of LC molecules in the pixel area to which no voltage (I), low voltage (II) and high voltage (III) are applied, respectively, and the first A higher ratio of the width of the dark pattern can be obtained. Pattern (B) represents three different alignments of LC molecules in the pixel area where no voltage (I), low voltage (II) and high voltage (III) are applied, respectively, and the width of the first dark pattern in the pixel area The middle ratio of can be obtained. Pattern (C) represents three different alignments of LC molecules in the pixel area where no voltage (I), low voltage (II) and high voltage (III) are applied, respectively, the width of the first dark pattern in the pixel area A lower ratio of can be obtained. In other words, the patterns in the first column (I) of FIG. 7 represent the alignment of LC molecules in the pixel region where no voltage is applied, and the patterns in the second column (II) in FIG. 7 represent the pixel region where low voltage is applied. represents the alignment of the LC molecules in the pixel area represents an intermediate gray level (eg 128). In addition, the patterns of the third column (III) of FIG. 7 represent alignment of LC molecules in a pixel region to which a high voltage is applied, and the pixel region represents a maximum gray level (eg, 255).

도 7에서는, 단순히 단일 픽셀 영역에서의 전극 패턴을 도시하며, 다른 구성요소들을 생략한다. 단일 픽셀 영역에서, 전극은 2개의 연장 부분(330E) 및 하나의 휨 부분(330B)을 포함하며, 휨 부분(330B)은 2개의 연장 부분(330E) 사이에 위치되며 2개의 연장 부분(330E)을 연결한다. XY 평면 상의 방향 DDL로서 표시된, 연장 부분(330E)의 연장 방향은 데이터 라인(DL)의 연장 방향에 실질적으로 평행하다. 또한, 픽셀 영역에서의 화살표는 대응하는 영역에서의 LC 분자들의 정렬을 나타낸다. In FIG. 7, an electrode pattern in a single pixel area is simply shown, and other components are omitted. In a single pixel area, the electrode includes two extension portions 330E and one bend portion 330B, and the bend portion 330B is positioned between the two extension portions 330E and the two extension portions 330E. connect The extending direction of the extending portion 330E, indicated as the direction D DL on the XY plane, is substantially parallel to the extending direction of the data line DL. Also, arrows in the pixel area indicate the alignment of LC molecules in the corresponding area.

도 7에 예시된 바와 같은 정렬 방향의 조정에 따르면, 도 8에 도시된 바와 같이, LC 분자들의 정렬에 대응하는 상이한 다크 패턴들이 발생될 수 있다. 도 7 및 도 8을 참조하자. 도 8은 대응하는 픽셀 영역에서의 폭의 상이한 비를 갖는 여러 다크 패턴들을 예시하며, 제1 다크 패턴의 128과 같은 중간 그레이 레벨(즉, 제1 그레이 레벨)에서의 제1 폭(W1) 및 255와 같은 최대 그레이 레벨(즉, 제2 그레이 레벨)에서의 제2 폭(W2)이 또한 패턴 각각에 표시되어 있다. XY 평면 상에 방향 DDF1(X 방향에 평행)로서 표시된 제1 다크 패턴의 연장 방향은, 스캔 라인(DL)의 연장 방향에 실질적으로 평행하다. 도 8에서, 패턴 (1)은 3.4의 폭의 비(즉, 제2 폭으로 나눈 제1 폭, W1/W2)를 갖고, 패턴 (2)는 2.6의 폭의 비를 갖고, 패턴 (3)은 2.13의 폭의 비를 갖고, 패턴 (4)는 1.9의 폭의 비를 갖고, 패턴 (5)는 1.8의 폭의 비를 갖는다. According to the adjustment of the alignment direction as illustrated in Fig. 7, different dark patterns corresponding to the alignment of the LC molecules can be generated, as shown in Fig. 8. See Figures 7 and 8. 8 illustrates several dark patterns having different ratios of widths in corresponding pixel areas, a first width W1 at an intermediate gray level (ie, first gray level) such as 128 of the first dark pattern and A second width W2 at a maximum gray level equal to 255 (ie, a second gray level) is also marked for each pattern. An extension direction of the first dark pattern, indicated as direction D DF1 (parallel to the X direction) on the XY plane, is substantially parallel to the extension direction of the scan line DL. 8, pattern (1) has a ratio of widths of 3.4 (i.e., a first width divided by a second width, W1/W2), pattern (2) has a ratio of widths of 2.6, and pattern (3) has a width ratio of 2.13, pattern (4) has a width ratio of 1.9, and pattern (5) has a width ratio of 1.8.

도 7의 (I), (II) 및 (III)를 포함한 패턴 (A)(예: 디스플레이 패널에서 네가티브 타입 액정 채택) 및 도 8의 패턴 (1) 또는 패턴 (2)를 참조하자. 3.4나 2.6 또는 다른 높은 값과 같은, 폭의 더 높은 비(W1/W2)를 획득하는 것이 바람직한 경우, 도 7의 패턴 (A)-(I)에 도시된 바와 같은 각도

Figure 112016072598697-pat00005
(즉, 프리(pre)-
Figure 112016072598697-pat00006
의 방위각)가 LC 분자들과 스캔 라인(SL) 사이에 생성되도록, UV 노출 후에 광 정렬 층의 정렬 방향에 응답하여, 전극의 휨 부분(330B)에 대응하는 영역에서의 LC 분자들이 예비회전(pre-rotated)(예: XY 평면 상에서) 되도록 설계될 수 있다. 따라서, 전압없음이 픽셀 전극에 적용될 때, 도 7의 패턴 (A)-(I)에 도시된 바와 같이, 휨 부분(330B)에 대응하는 영역에서의 LC 분자들은 내전(adduction)의 정렬을 나타내고(예: 휨 부분(330B)의 중심을 향해 정렬됨), 연장 부분(330E)에 대응하는 영역에서의 LC 분자들은 스캔 라인(SL)에 평행하게 정렬된다. 중간 그레이 레벨(예: 128)에 관련된 값에 도달하기 위해 적용되는 낮은 전압과 같이, 픽셀 전극에 적용되는 전압이 증가될 때, 도 7의 패턴(A)-(II)(낮은 전압 적용)에 도시된 바와 같이, 전극의 휨 부분(330B)에 대응하는 영역에서의 LC 분자들은 바깥쪽으로 회전한다. 픽셀 전극에 적용된 전압이 최대 그레이 레벨(예: 255)에 관련된 값에 도달할 때(도 7의 패턴 (A)-(III)), 전극의 휨 부분(330B) 및 연장 부분(330E)에 대응하는 영역에서의 LC 분자들은 전기장의 등전위 라인을 따라 정렬될 수 있다. 따라서, 포토 정렬 층에의 노출 방법을 조정함으로써 중간 그레이 레벨 및 최대 그레이 레벨(W1 및 W2)에서의 폭이 획득될 수 있으며, 그리하여 그의 폭의 비(W1/W2)를 제어할 수 있다. See pattern (A) including (I), (II) and (III) of FIG. 7 (e.g., negative type liquid crystal is adopted in the display panel) and pattern (1) or pattern (2) of FIG. 8. If it is desirable to obtain a higher ratio of widths (W1/W2), such as 3.4 or 2.6 or other high values, the angle as shown in pattern (A)-(I) of FIG.
Figure 112016072598697-pat00005
(i.e. pre-
Figure 112016072598697-pat00006
In response to the alignment direction of the light alignment layer after UV exposure, the LC molecules in the region corresponding to the bent portion 330B of the electrode are pre-rotated ( It can be designed to be pre-rotated (eg on the XY plane). Therefore, when no voltage is applied to the pixel electrode, the LC molecules in the region corresponding to the bending portion 330B exhibit an alignment of adduction, as shown in patterns (A)-(I) in FIG. 7 . (eg, aligned toward the center of the bending portion 330B), LC molecules in a region corresponding to the extending portion 330E are aligned parallel to the scan line SL. When the voltage applied to the pixel electrode is increased, such as the lower voltage applied to reach a value related to the intermediate gray level (e.g. 128), patterns (A)-(II) of Fig. 7 (low voltage applied) As shown, the LC molecules in the region corresponding to the bent portion 330B of the electrode rotate outward. When the voltage applied to the pixel electrode reaches a value related to the maximum gray level (e.g., 255) (patterns (A)-(III) in FIG. 7), corresponding to the bent portion 330B and the extended portion 330E of the electrode LC molecules in the region can align along the equipotential lines of the electric field. Accordingly, the widths at the intermediate gray level and the maximum gray levels (W1 and W2) can be obtained by adjusting the exposure method to the photo alignment layer, and thus the ratio (W1/W2) of their widths can be controlled.

마찬가지로, 2.13이나 1.9, 또는 다른 중간 값과 같은, 폭의 중간 비(W1/W2)를 획득하는 것이 바람직한 경우, 도 7의 패턴 (B)-(I)에 도시된 바와 같은 정렬을 나타내도록, UV 노출 후에 포토 정렬 층의 정렬 방향에 응답하여 전극의 휨 부분(330B) 및 연장 부분(330E)에 대응하는 영역에서의 LC 분자들이 정렬될 수 있도록 설계된다. 낮은 전압 및 높은 전압이 픽셀 전극에 적용될 때, 각각 LC 분자들은 도 7의 패턴 (B)-(II) 및 (B)-(III)에 도시된 바와 같은 정렬을 나타낸다. UV 노출 후에 포토 정렬 층의 정렬 방향에 응답하여 정렬되는, 휨 부분(330B)에 대응하는 영역에서의 LC 분자들이 도 7의 패턴 (C)-(I)에 도시된 바와 같이 바깥쪽으로 정렬될 수 있는 경우, 1.8 또는 1.8보다 낮은 다른 값과 같은, 더 낮은 폭의 비(W1/W2)를 획득할 것이다. Similarly, if it is desired to obtain an intermediate ratio of widths (W1/W2), such as 2.13 or 1.9, or other intermediate values, to exhibit an alignment as shown in patterns (B)-(I) of FIG. 7, It is designed to align LC molecules in regions corresponding to the bent portion 330B and the extended portion 330E of the electrode in response to the alignment direction of the photo alignment layer after UV exposure. When low and high voltages are applied to the pixel electrodes, respectively, the LC molecules exhibit an alignment as shown in patterns (B)-(II) and (B)-(III) of FIG. 7 . After UV exposure, the LC molecules in the region corresponding to the bending portion 330B, which is aligned in response to the alignment direction of the photo alignment layer, may align outward as shown in patterns (C)-(I) of FIG. 7 . If there is, you will get a lower width ratio (W1/W2), such as 1.8 or any other value lower than 1.8.

하나의 실시예에서, UV 노출 후에 포토 정렬 층의 정렬 방향을 생성한 후에, 도 7에 도시된 바와 같이, 전극의 휨 부분(330B)에 대응하는 영역에서의 LC 분자들은 스캔 라인(SL)으로 각도

Figure 112016072598697-pat00007
(프리-
Figure 112016072598697-pat00008
)를 나타내도록 예비회전되고, 그 후에 폭의 비(W1/W2)가 획득될 수 있다. 예를 들어, 각도
Figure 112016072598697-pat00009
가 휨 부분(330B)의 중심을 향해 5도이고 다크 패턴이 도 8-(1)로서 나타나는 경우, 폭의 비(W1/W2)는 3.4이다. 각도
Figure 112016072598697-pat00010
가 휨 부분(330B)의 중심을 향해 0.5도이고 다크 패턴이 도 8-(2)로서 나타나는 경우, 폭의 비(W1/W2)는 2.6이다. 각도
Figure 112016072598697-pat00011
가 바깥쪽으로 20도이고 다크 패턴이 도 8-(3)으로서 나타나는 경우, 폭의 비(W1/W2)는 2/13이다. 각도
Figure 112016072598697-pat00012
가 바깥쪽으로 40도이고 다크 패턴이 도 8-(4)로서 나타나는 경우, 폭의 비(W1/W2)는 1.9이다. 각도
Figure 112016072598697-pat00013
가 바깥쪽으로 60도이고 다크 패턴이 도 8-(5)로서 나타나는 경우, 폭의 비(W1/W2)는 1.8이다. In one embodiment, after generating the alignment direction of the photo alignment layer after UV exposure, as shown in FIG. 7 , LC molecules in a region corresponding to the bent portion 330B of the electrode form a scan line SL. Angle
Figure 112016072598697-pat00007
(free-
Figure 112016072598697-pat00008
), and then the ratio of widths (W1/W2) can be obtained. For example, angle
Figure 112016072598697-pat00009
When is 5 degrees toward the center of the bending portion 330B and the dark pattern appears as Fig. 8-(1), the width ratio (W1/W2) is 3.4. Angle
Figure 112016072598697-pat00010
When is 0.5 degrees toward the center of the bending portion 330B and the dark pattern appears as Fig. 8-(2), the width ratio (W1/W2) is 2.6. Angle
Figure 112016072598697-pat00011
When is 20 degrees outward and the dark pattern appears as Fig. 8-(3), the ratio of widths (W1/W2) is 2/13. Angle
Figure 112016072598697-pat00012
When is 40 degrees outward and the dark pattern appears as Fig. 8-(4), the width ratio (W1/W2) is 1.9. Angle
Figure 112016072598697-pat00013
When is 60 degrees outward and the dark pattern appears as Fig. 8-(5), the width ratio (W1/W2) is 1.8.

또한, 다크 패턴 각각의 다크 패턴 점유 퍼센티지가 도 8에 표시되었으며, 다크 패턴 점유 퍼센티지는 픽셀 영역에서 점유된 128과 같은 중간 그레이 레벨(즉, 제1 그레이 레벨)에서의 다크 프린지를 체크함으로써 결정된다. 다크 패턴 점유 퍼센티지는: 제1 다크 패턴의 Y 방향을 따른 폭(W1)/픽셀 영역의 총 길이(L)(즉, W1/L)에 의해 정의된다. 도 8-(1)에서, 128과 같은 중간 그레이 레벨에서의 다크 패턴 점유 퍼센티지는 약 15.4%이다. 도 8-(2)에서, 128과 같은 중간 그레이 레벨에서의 다크 패턴 점유 퍼센티지는 약 11.7%이다. 도 8-(3)에서, 128과 같은 중간 그레이 레벨에서의 다크 패턴 점유 퍼센티지는 약 11.0%이다. 도 8-(4)에서, 128과 같은 중간 그레이 레벨에서의 다크 패턴 점유 퍼센티지는 약 9.5%이다. 도 8-(5)에서, 128과 같은 중간 그레이 레벨에서의 다크 패턴 점유 퍼센티지는 약 8.8%이다. 다크 패턴 점유 퍼센티지가 더 높을수록, 픽셀의 개구율이 더 낮아진다. 폭의 비(W1/W2)의 상한은 실제 응용에서 픽셀 개구율의 요건에 따라 결정되어야 한다. 예를 들어, 폭의 비(W1/W2)가 3.0보다 더 크고 중간 그레이 레벨에서의 다크 패턴 점유 퍼센티지가 너무 커서 수락할 수 없는 것으로 밝혀진 경우(예를 들어, 폭의 비(W1/W2)가 3.4일 때 다크 패턴 점유 퍼센티지가 15% 이상임), 픽셀의 개구율이 너무 낮을 것이므로 제1 다크 패턴의 폭은 너무 넓어서 수락할 수 없을 것이다. 따라서, 적합한 범위의 폭의 비(W1/W2)가 실제 응용의 요건을 충족시키도록 결정되어야 한다. 하나의 실시예에서, 보다 안정적인 시야각 유지보수를 얻기 위해(또는 제조 프로세스의 변동의 영향을 감소시킬 것임), 그리고 그 뿐만 아니라 실제 제품의 개구율 요건을 충족시키기 위해, 약 2.1 내지 약 3.0 범위와 같은 적합한 범위의 폭의 비(W1/W2)(즉, 최대 그레이 레벨(예: 255)에서의 폭으로 나눈 중간 그레이 레벨(예: 128)에서의 폭)가 선택될 수 있다. In addition, the dark pattern occupancy percentage of each dark pattern is shown in FIG. 8, and the dark pattern occupancy percentage is determined by checking the dark fringe at an intermediate gray level (i.e., the first gray level) such as 128 occupied in the pixel area . The dark pattern occupancy percentage is defined by: the width W1 of the first dark pattern along the Y direction/the total length L of the pixel area (ie, W1/L). In Fig. 8-(1), the dark pattern occupancy percentage at an intermediate gray level such as 128 is about 15.4%. In Fig. 8-(2), the dark pattern occupancy percentage at an intermediate gray level such as 128 is about 11.7%. In Fig. 8-(3), the dark pattern occupancy percentage at an intermediate gray level such as 128 is about 11.0%. In Fig. 8-(4), the dark pattern occupancy percentage at an intermediate gray level such as 128 is about 9.5%. In Fig. 8-(5), the dark pattern occupancy percentage at an intermediate gray level such as 128 is about 8.8%. The higher the dark pattern occupancy percentage, the lower the aperture ratio of the pixel. The upper limit of the width ratio (W1/W2) should be determined according to the requirements of the pixel aperture ratio in actual applications. For example, if the width ratio (W1/W2) is greater than 3.0 and the dark pattern occupancy percentage at intermediate gray levels is found to be too large to be acceptable (e.g., the width ratio (W1/W2) is 3.4, the dark pattern occupancy percentage is 15% or more), the width of the first dark pattern will be too wide to be acceptable because the aperture ratio of the pixels will be too low. Therefore, a suitable range of width ratios (W1/W2) must be determined to meet the requirements of actual applications. In one embodiment, to obtain more stable viewing angle maintenance (or to reduce the impact of variations in the manufacturing process), as well as to meet the aperture ratio requirements of actual products, such as in the range of about 2.1 to about 3.0. A suitable range of width ratios (W1/W2) (ie the width at the middle gray level (eg 128) divided by the width at the maximum gray level (eg 255)) can be selected.

<픽셀 전극의 형상을 수정함으로써 제어된 제1 다크 패턴의 폭의 비><The ratio of the widths of the first dark patterns controlled by modifying the shape of the pixel electrode>

실시예에 따르면, 적용가능한 기술적 방식들 중의 하나는, 중간 및 최대 그레이 레벨에서 각각 제1 다크 패턴의 폭을 제어하기 위해 픽셀 전극의 형상을 변경하는 것이며, 그에 의해 안정적인 시야각 유지보수를 달성하기 위해 2.1 이상(예: 약 2.1-약 3.0)과 같은 적합한 폭의 비(즉, 최대 그레이 레벨(예: 255)에서의 제1 다크 패턴의 폭으로 나눈, 중간 그레이 레벨(예: 128)에서의 제1 다크 패턴의 폭)를 획득하고, 제조 프로세스의 변동의 영향이 감소될 수 있다. 다른 실시예에서, 최대 그레이 레벨에서의 제1 다크 패턴의 폭에 대한, 중간 그레이 레벨에서의 제1 다크 패턴의 폭의 비를 제어하기 위해, 연장 부분 및 휨 부분을 갖는 픽셀 전극 패턴과 유사하게, 픽셀 영역 내의 공통 전극 상의 슬릿 패턴이 변경될 수 있다. According to the embodiment, one of the applicable technical ways is to change the shape of the pixel electrode to control the width of the first dark pattern at the middle and maximum gray levels respectively, thereby achieving stable viewing angle maintenance. A ratio of a suitable width such as 2.1 or greater (eg about 2.1 to about 3.0) (i.e. the first dark pattern at the intermediate gray level (eg 128) divided by the width of the first dark pattern at the maximum gray level (eg 255)) width of 1 dark pattern), and the influence of variations in the manufacturing process can be reduced. In another embodiment, to control the ratio of the width of the first dark pattern at the intermediate gray level to the width of the first dark pattern at the maximum gray level, similar to a pixel electrode pattern having an extension portion and a bent portion. , the slit pattern on the common electrode in the pixel area may be changed.

도 9는 픽셀 전극의 형상에 응답하여 픽셀 영역에서의 LC 분자들 정렬의 여러 패턴들을 예시하며, 그에 의해 픽셀 영역에서 제1 다크 패턴의 폭의 더 높은 비 및 더 낮은 비를 획득한다. 도 9에서, 패턴 (A)는 전압없음(I), 낮은 전압(II) 및 높은 전압(III)이 각각 적용되는 픽셀 영역에서의 LC 분자들의 3가지 상이한 정렬들을 나타내며, 픽셀 영역에서의 제1 다크 패턴의 폭의 더 높은 비(예컨대 2.86, 또는 다른 더 높은 값)가 획득될 수 있다. 패턴 (B)는 전압없음(I), 낮은 전압(II) 및 높은 전압(III)이 각각 적용되는 픽셀 영역에서의 LC 분자들의 3가지 상이한 정렬들을 나타내며, 픽셀 영역에서의 제1 다크 패턴의 폭의 더 낮은 비(예컨대 2.26, 또는 다른 더 낮은 값)가 획득될 수 있다. 마찬가지로, 픽셀 영역에서의 화살표는 대응하는 영역에서의 LC 분자들의 정렬을 나타낸다. 도 9의 패턴 (A)에서(즉, 제1 다크 패턴의 폭의 더 높은 비를 가짐), 전극은 2개의 연장 부분(330E) 및 하나의 휨 부분(330B)을 포함하며, 연장 부분(330E)은 데이터 라인(DL)의 연장 방향에 실질적으로 평행하지만, 휨 부분(330B)의 형상은 스캔 라인(SL)의 연장 방향에 수직인 둘 다의 측면을 갖도록 수정된다(즉, 휨 부분(330B)의 측면은 Y 방향에 평행함). 도 9의 (I), (II) 및 (III)를 포함한 패턴 (A) 및 도 10의 패턴 (1)을 참조하자. 제1 다크 패턴의 폭의 더 높은 비(W1/W2)(예컨대 2.86, 또는 다른 더 높은 값)를 획득하는 것이 바람직한 경우, 휨 부분(330B)의 형상은 도 9-(A)에 도시된 바와 같이 변경될 수 있다. 전압없음이 픽셀 전극에 적용될 때, LC 분자들은 정렬 힘에 응답하여 정렬되며, 도 9의 패턴 (A)-(I)에 도시된 바와 같이, LC 분자들은 휨 부분(330B) 및 연장 부분(330E)에 대응하는 영역에서 스캔 라인(SL)에 평행한 정렬을 나타낸다. 중간 그레이 레벨(예: 128)에 관련된 값에 도달하기 위해 적용되는 낮은 전압과 같이, 픽셀 전극에 인가된 전압이 증가될 때, 도 9의 패턴 (A)-(II)(낮은 전압 적용)에 도시된 바와 같이, 전극의 휨 부분(330B)에 대응하는 영역에서의 LC 분자들은 바깥쪽으로 회전한다. 픽셀 전극에 인가된 전압이 최대 그레이 레벨(예: 255)에 관련된 값에 도달할 때(도 9의 패턴 (A)-(III)), 전극의 휨 부분(330B) 및 연장 부분(330E)에 대응하는 영역에서의 LC 분자들은 전기장의 등전위 라인을 따라 정렬될 수 있다. 따라서, 중간 그레이 레벨 및 최대 그레이 레벨(W1 및 W2)에서의 제1 다크 패턴의 폭은 픽셀 전극의 특별한 형상을 채택함으로써 획득될 수 있으며, 그리하여 그의 폭의 비(W1/W2)를 제어할 수 있다.9 illustrates several patterns of alignment of LC molecules in the pixel area in response to the shape of the pixel electrode, thereby obtaining a higher ratio and a lower ratio of widths of the first dark pattern in the pixel area. In FIG. 9, pattern (A) represents three different alignments of LC molecules in the pixel area to which no voltage (I), low voltage (II) and high voltage (III) are applied, respectively, and the first A higher ratio of the width of the dark pattern may be obtained (eg 2.86, or other higher value). Pattern (B) represents three different alignments of LC molecules in the pixel area where no voltage (I), low voltage (II) and high voltage (III) are applied, respectively, the width of the first dark pattern in the pixel area A lower ratio of (eg 2.26, or other lower value) may be obtained. Likewise, arrows in pixel areas indicate the alignment of LC molecules in the corresponding areas. In pattern (A) of FIG. 9 (ie, having a higher ratio of the widths of the first dark pattern), the electrode includes two extending portions 330E and one bending portion 330B, and the extending portion 330E ) is substantially parallel to the extension direction of the data line DL, but the shape of the bend portion 330B is modified to have both sides perpendicular to the extension direction of the scan line SL (ie, bend portion 330B). ) side is parallel to the Y direction). See pattern (A) including (I), (II) and (III) of FIG. 9 and pattern (1) of FIG. 10 . If it is desirable to obtain a higher ratio (W1/W2) of the width of the first dark pattern (e.g., 2.86, or other higher value), the shape of the bending portion 330B is as shown in Fig. 9-(A). can be changed together. When no voltage is applied to the pixel electrode, the LC molecules align in response to the alignment force, and as shown in patterns (A)-(I) of FIG. ) represents alignment parallel to the scan line SL in the region corresponding to . When the voltage applied to the pixel electrode is increased, such as a low voltage applied to reach a value related to the intermediate gray level (e.g. 128), patterns (A)-(II) of Fig. 9 (low voltage applied) As shown, the LC molecules in the region corresponding to the bent portion 330B of the electrode rotate outward. When the voltage applied to the pixel electrode reaches a value related to the maximum gray level (e.g., 255) (patterns (A)-(III) in FIG. 9), the bending portion 330B and the extending portion 330E of the electrode LC molecules in the corresponding region can be aligned along the equipotential lines of the electric field. Therefore, the width of the first dark pattern at the intermediate gray level and the maximum gray level (W1 and W2) can be obtained by adopting a special shape of the pixel electrode, and thus the ratio (W1/W2) of its width can be controlled. there is.

또한, 폭의 더 낮은 비(W1/W2)를 달성하는 것이 바람직한 경우, 도 9의 패턴 (B)에 도시된 바와 같이, 픽셀 전극의 형상은 또한, 연장 부분(330E)의 하나의 측면으로부터 휨 부분(330B)의 측면을 돌출시키지만 연장 부분(330E)의 설계를 유지함으로써(즉, 연장 부분(330E)은 데이터 라인(DL)의 연장 방향에 실질적으로 평행함), 변경될 수 있다. 도 9의 패턴 (B)에서, 휨 부분(330B)의 각도 αB는 연장 부분(330E)의 각도 αE보다 더 작은 것으로 나타나 있다. 도 9의 (I), (II) 및 (III)를 포함한 패턴 (B) 및 도 10의 패턴 (2)를 참조하자. 2.26이나 다른 더 낮은 값과 같은, 폭의 더 낮은 비(W1/W2)를 획득하는 것이 바람직한 경우, 휨 부분(330B)의 형상은 도 9-(B)에 도시된 바와 같이 변경될 수 있다. 전압없음이 픽셀 전극에 적용될 때, LC 분자들은 정렬 힘에 응답하여 정렬되며, 도 9의 패턴 (B)-(I)에 도시된 바와 같이, LC 분자들은 휨 부분(330B) 및 연장 부분(330E)에 대응하는 영역에서 스캔 라인(SL)에 평행한 정렬을 나타낸다. 중간 그레이 레벨(예: 128)에 관련된 값에 도달하기 위해 적용되는 낮은 전압과 같이, 픽셀 전극에 인가된 전압이 증가될 때, 도 9의 패턴 (B)-(II)(낮은 전압 적용)에 도시된 바와 같이, 전극의 휨 부분(330B)에 대응하는 영역에서의 LC 분자들은 바깥쪽으로 회전한다. 픽셀 전극에 인가된 전압이 최대 그레이 레벨(예: 255)에 관련된 값에 도달할 때(도 9의 패턴 (B)-(III)), 전극의 연장 부분(330E)에 대응하는 영역에서의 LC 분자들은 전기장의 등전위 라인을 따라 정렬될 수 있다. 도 9의 패턴 (B)-(III)에서, 휨 부분(330B)에 대응하는 영역에서의 LC 분자들은 도 9의 패턴 (B)-(II)에서 나타난 것보다 더 바깥쪽으로 회전하지만, 이들은 연장 부분(330E)에 대응하는 영역에서의 LC 분자들이 하는 방식과 같이 정렬되지는 않는다(따라서, 도 10-(2)의 최대 그레이 레벨에서의 폭(W2)은 도 10-(1)의 경우보다 다소 더 클 것임). 따라서, 중간 그레이 레벨 및 최대 그레이 레벨에서의 폭(W1 및 W2)은 픽셀 전극의 특별한 형상을 채택함으로써 획득될 수 있으며, 그에 의해 폭의 비(W1/W2)를 제어할 수 있고 결과적으로 안정적인 시야각 유지보수를 달성할 수 있다(또는 제조 프로세스의 변동의 영향을 감소시킬 것임). In addition, when it is desirable to achieve a lower ratio of widths (W1/W2), as shown in pattern (B) in Fig. 9, the shape of the pixel electrode is also bent from one side of the extending portion 330E. It can be changed by protruding the side of portion 330B but maintaining the design of extension portion 330E (ie, extension portion 330E is substantially parallel to the extension direction of data line DL). In pattern (B) of FIG. 9 , angle αB of bend portion 330B is shown to be smaller than angle αE of extension portion 330E. See pattern (B) including (I), (II) and (III) of FIG. 9 and pattern (2) of FIG. 10 . If it is desired to obtain a lower ratio of widths (W1/W2), such as 2.26 or some other lower value, the shape of the bend portion 330B may be changed as shown in FIG. 9-(B). When no voltage is applied to the pixel electrode, the LC molecules align in response to the alignment force, and as shown in patterns (B)-(I) of FIG. ) represents alignment parallel to the scan line SL in the region corresponding to . When the voltage applied to the pixel electrode is increased, such as a low voltage applied to reach a value related to the intermediate gray level (e.g. 128), patterns (B)-(II) of Fig. 9 (low voltage applied) As shown, the LC molecules in the region corresponding to the bent portion 330B of the electrode rotate outward. When the voltage applied to the pixel electrode reaches a value related to the maximum gray level (eg, 255) (patterns (B)-(III) in FIG. 9), LC in the region corresponding to the extension portion 330E of the electrode Molecules can align along equipotential lines of the electric field. In the pattern (B)-(III) of FIG. 9, the LC molecules in the region corresponding to the bending portion 330B rotate outward more than shown in the pattern (B)-(II) of FIG. 9, but they extend It is not aligned the way the LC molecules in the region corresponding to portion 330E do (thus, the width W2 at the maximum gray level in FIG. 10-(2) is smaller than that in FIG. 10-(1)). somewhat larger). Therefore, the widths W1 and W2 at the intermediate gray level and the maximum gray level can be obtained by adopting a special shape of the pixel electrode, whereby the ratio of the widths (W1/W2) can be controlled, resulting in a stable viewing angle. Maintenance can be achieved (or will reduce the impact of variations in the manufacturing process).

도 9에 예시된 바와 같은 픽셀 전극의 수정에 따르면, 도 10에 도시된 바와 같이, LC 분자들의 정렬에 대응하는 상이한 다크 패턴들이 발생될 수 있다. 도 9 및 도 10을 참조하자. 도 10은 대응하는 픽셀 영역에서의 상이한 폭의 비를 갖는 2개의 다크 패턴을 예시하고, 제1 다크 패턴의 128과 같은 중간 그레이 레벨(즉, 제1 그레이 레벨)에서의 제1 폭(W1) 및 255와 같은 최대 그레이 레벨(즉, 제2 그레이 레벨)에서의 제2 폭(W2)이 또한 패턴 각각에 표시되어 있다. XY 평면 상에 방향 DDF1(X 방향에 평행함)로서 표시된, 제1 다크 패턴의 연장 방향은, 스캔 라인(SL)의 연장 방향에 실질적으로 평행하다. 도 10에서, 패턴 (1)은 2.86의 폭의 비(W1/W2)를 갖고, 패턴 (2)는 2.26의 폭의 비(W1/W2)를 갖는다.According to the modification of the pixel electrode as illustrated in Fig. 9, different dark patterns corresponding to the alignment of the LC molecules can be generated, as shown in Fig. 10. See Figures 9 and 10. 10 illustrates two dark patterns having different width ratios in corresponding pixel areas, the first width W1 at an intermediate gray level equal to 128 (i.e., the first gray level) of the first dark pattern. and a second width W2 at a maximum gray level equal to 255 (i.e., a second gray level) is also indicated in each pattern. An extension direction of the first dark pattern, indicated as direction D DF1 (parallel to the X direction) on the XY plane, is substantially parallel to the extension direction of the scan line SL. In Fig. 10, pattern (1) has a width ratio (W1/W2) of 2.86, and pattern (2) has a width ratio (W1/W2) of 2.26.

<액정의 탄성 계수에 의해 제어되는 제1 다크 패턴의 폭의 비><The ratio of the widths of the first dark patterns controlled by the modulus of elasticity of the liquid crystal>

액정 분자들은, 전기장, 자기장 등에서의 힘과 같은 작은 외부 힘에 의해서도 변형될 수 있는 탄성 매체로서 간주될 수 있다. 액정 분자들의 변형은 3가지 기본 타입의 변형, 즉 스플레이(splay), 트위스트(twist) 및 벤드(bend)에 대하여 기술될 수 있으며, 이들 변형에 대응하는 탄성 계수는 각각 K11, K22, 및 K33이다. 액정 분자들의 스플레이, 트위스트 및 벤드 타입의 변형을 각각 예시한 도 11a,도 11b 및 도 11c를 참조하자. 실시예에서, 적용가능한 기술적 방식들 중의 하나는, 중간 및 최대 그레이 레벨에서 각각 제1 다크 패턴의 폭을 제어하기 위해 상이한 탄성 계수를 갖는 액정 분자들의 채택이며, 그에 의해 상기 설명된 바와 같이 2.1 이상(예: 약 2.1-약 3.0)과 같은 제1 다크 패턴의 폭의 적합한 비를 획득한다. 따라서, 안정적인 시야각 유지보수가 달성될 수 있고, 제조 프로세스의 변동에 의해 쉽게 영향받지 않을 것이다. Liquid crystal molecules can be regarded as an elastic medium that can be deformed even by a small external force, such as a force in an electric field, a magnetic field, or the like. The deformation of liquid crystal molecules can be described for three basic types of deformation: splay, twist and bend, and the elastic moduli corresponding to these deformations are K11, K22, and K33, respectively. . Referring to FIGS. 11A, 11B and 11C respectively illustrating the deformation of the splay, twist and bend types of liquid crystal molecules. In an embodiment, one of the applicable technical ways is the adoption of liquid crystal molecules having different moduli of elasticity to control the width of the first dark pattern at the intermediate and maximum gray levels, respectively, whereby, as described above, 2.1 or more. A suitable ratio of widths of the first dark pattern such as (eg, about 2.1 to about 3.0) is obtained. Therefore, stable viewing angle maintenance can be achieved and will not be easily affected by fluctuations in the manufacturing process.

도 12는 대응하는 픽셀 영역에서 제1 다크 패턴의 상이한 폭의 비를 갖는 2개의 다크 패턴을 예시하며, 128과 같은 중간 그레이 레벨(즉, 제1 그레이 레벨)에서의 제1 다크 패턴의 제1 폭(W1) 및 255와 같은 최대 그레이 레벨(즉, 제2 그레이 레벨)에서의 제1 다크 패턴의 제2 폭(W2)도 또한 패턴 각각에 표시된다. XY 평면 상에 방향 DDF1(X 방향에 평행함)로서 표시된, 제1 다크 패턴의 연장 방향은, 스캔 라인(SL)의 연장 방향에 실질적으로 평행하다. 도 12에서, 패턴 (1)은 더 낮은 스플레이 탄성 계수(K11)를 갖는 액정 분자들을 채택함으로써 2.93의, 더 큰 폭의 비(즉, 제2 폭으로 나눈 제1 폭, W1/W2)를 갖는다. 도 12에서, 패턴 (2)는 더 높은 스플레이 탄성 계수(K11)를 갖는 액정 분자들을 채택함으로써 2.42의 더 낮은 폭의 비(W1/W2)를 갖는다. 12 illustrates two dark patterns having different width ratios of the first dark pattern in corresponding pixel areas, the first of the first dark pattern at an intermediate gray level such as 128 (ie, the first gray level). A width W1 and a second width W2 of the first dark pattern at the maximum gray level equal to 255 (ie, the second gray level) are also indicated in each pattern. An extension direction of the first dark pattern, indicated as direction D DF1 (parallel to the X direction) on the XY plane, is substantially parallel to the extension direction of the scan line SL. In FIG. 12, pattern (1) has a larger width ratio (ie, a first width divided by a second width, W1/W2) of 2.93 by adopting liquid crystal molecules having a lower splay elastic modulus (K11). . In Fig. 12, pattern (2) has a lower width ratio (W1/W2) of 2.42 by employing liquid crystal molecules having a higher splay elastic modulus (K11).

하나의 실시예에서, 액정 층의 액정 분자들(또는 액정 재료)은 10 내지 20 범위의 스플레이 탄성 계수(K11)를 갖는다. 하나의 실시예에서, 액정 층의 액정 분자들(또는 액정 재료)은 10 내지 25의 벤드 탄성 계수(K33)를 갖는다. 실시예에 따르면, 약 2.1 내지 약 3.0의 범위와 같은 적합한 폭의 비(W1/W2)가 획득될 수 있다. 따라서, 안정적인 시야각 유지보수가 달성될 수 있고, 제조 프로세스의 변동에 의해 쉽게 영향받지 않을 것이다. In one embodiment, the liquid crystal molecules (or liquid crystal material) of the liquid crystal layer have a splay elastic modulus (K11) in the range of 10 to 20. In one embodiment, the liquid crystal molecules (or liquid crystal material) of the liquid crystal layer have a bend modulus (K33) of 10 to 25. According to embodiments, suitable width ratios (W1/W2) such as in the range of about 2.1 to about 3.0 may be obtained. Therefore, stable viewing angle maintenance can be achieved and will not be easily affected by fluctuations in the manufacturing process.

전술한 기재에 따르면, 포토 정렬 층에의 노출 방법을 조정함으로써(즉, 휨 부분(330B)에 대응하는 LC 분자들과 스캔 라인(SL) 사이의 각도

Figure 112016072598697-pat00014
를 조정함으로써), 또는 전극의 형상을 변경함으로써, 또는 (스플레이 탄성 계수(K11) 또는 벤드 탄성 계수(K33)와 같은) 적합한 탄성 계수를 갖는 LC 분자들을 채택함으로써, 중간 그레이 레벨에서의 폭 및 최대 그레이 레벨에서의 폭이 획득될 수 있고, 그리하여 그의 폭의 비(W1/W2)를 범위(예컨대, 약 2.1 내지 약 3.0의 범위) 내에 있도록 제어할 수 있다. 이 범위의 비(즉, W1/W2)에서, 안정적인 시야각 유지보수가 달성될 수 있고, 제조 프로세스의 변동에 의해 쉽게 영향받지 않을 것이다. 중간 그레이 레벨에서의 제1 다크 패턴의 폭 및 최대 그레이 레벨에서의 제1 다크 패턴의 폭을 제어함으로써 그의 적합한 비(즉, W1/W2)를 달성할 수 있는 한, 다른 적용가능한 기술적 방식들이 실시예에 채용될 수 있다는 것을 유의하여야 한다. According to the above description, by adjusting the exposure method to the photo alignment layer (ie, the angle between the LC molecules corresponding to the bending portion 330B and the scan line SL)
Figure 112016072598697-pat00014
), or by changing the shape of the electrode, or by adopting LC molecules with a suitable elastic modulus (such as the splay modulus (K11) or the bend modulus (K33)), the width and maximum The width at the gray level can be obtained, and thus the ratio of its width (W1/W2) can be controlled to be within a range (eg, a range of about 2.1 to about 3.0). In this range of ratios (i.e., W1/W2), stable viewing angle maintenance can be achieved and will not be easily affected by variations in the manufacturing process. As long as a suitable ratio (i.e., W1/W2) can be achieved by controlling the width of the first dark pattern at the intermediate gray level and the width of the first dark pattern at the maximum gray level, other applicable technical schemes are implemented. It should be noted that examples can be employed.

또한, 실시예의 제1 다크 패턴의 폭은 다음 절차에 따라 결정될 수 있다. 도 12-(1)를 참조하자. 128과 같은 중간 그레이 레벨(제1 그레이 레벨)에서의 제1 다크 패턴의 측정이 수행된다. 포인트 "a"와 포인트 "b" 사이의 간격 d에 걸쳐 이어지는 제1 다크 패턴의 부분이 이미지 캡처 소프트웨어에 의해 캡처되고 그레이 스케일 이미지로서 저장된다. 도 12-(1)에서의 간격 d에 대응하는 그레이 스케일 곡선을 도시한 도 13을 참조하자. 간격 d에 대응하는 가장 큰 그레이 레벨은 100이고 간격 d에 대응하는 가장 작은 것은 50이라고 가정한다. 그러면, 제1 다크 패턴의 폭은 FWHM(full width at half maximum) 값, 즉 75에 대응하는 폭으로서 결정될 수 있다. 따라서, 도 12-(1)에 도시된 바와 같은 제1 다크 패턴의 제1 폭(W1)이 결정될 수 있다. 이 접근은 실시예의 폭 전부를 결정하는데 적합하다. 또한, 하나의 실시예에서, 제1 다크 패턴의 측정은 10X 올림푸스의 대안 렌즈 및 50X 올림푸스의 대물 렌즈를 사용하여 수행될 수 있다. 또한, 광원은 배면 광 모듈에 의해 제공되고, 전하 결합 소자(CCD, 모델: Motic Moticam 2300)가 채용될 수 있다. Also, the width of the first dark pattern of the embodiment may be determined according to the following procedure. See Fig. 12-(1). A measurement of the first dark pattern at an intermediate gray level (first gray level) equal to 128 is performed. The portion of the first dark pattern that spans the distance d between point "a" and point "b" is captured by the image capture software and stored as a gray scale image. 13 which shows a gray scale curve corresponding to the interval d in FIG. 12-(1). Assume that the largest gray level corresponding to interval d is 100 and the smallest corresponding to interval d is 50. Then, the width of the first dark pattern may be determined as a width corresponding to a full width at half maximum (FWHM) value, that is, 75. Accordingly, the first width W1 of the first dark pattern as shown in FIG. 12-(1) may be determined. This approach is suitable for determining the full breadth of an embodiment. Also, in one embodiment, the measurement of the first dark pattern may be performed using a 10X Olympus eyepiece and a 50X Olympus objective lens. Also, the light source is provided by a rear light module, and a charge-coupled device (CCD, model: Motic Moticam 2300) may be employed.

실시예의 디스플레이 패널에 따르면, 중간 그레이 레벨에서의 제1 다크 패턴의 폭 및 최대 그레이 레벨에서의 제1 다크 패턴의 폭은 약 2.1 내지 약 3.0 범위와 같은 적합한 범위에서 수정될 수 있다. 이 범위의 비(즉, W1/W2)에서, 보다 나은 안정적인 시야각 유지보수가 달성될 수 있고, 제조 프로세스의 변동의 영향이 감소될 수 있다. 또한, 실시예의 디스플레이 패널은 여전히 응용에서의 제품의 요건을 충족시키도록 높은 개구율을 소유한다. 따라서, 실시예의 설계에 의해 제조되는 디스플레이 패널의 생산 수율이 증가되고, 결과적으로 구현된 디스플레이 패널의 신뢰성있고 안정적인 디스플레이 품질이 얻어진다. According to the display panel of the embodiment, the width of the first dark pattern at an intermediate gray level and the width of the first dark pattern at a maximum gray level may be modified in a suitable range, such as a range of about 2.1 to about 3.0. In this range of ratios (i.e., W1/W2), better stable viewing angle maintenance can be achieved, and the influence of fluctuations in the manufacturing process can be reduced. Further, the display panels of the embodiments still possess high aperture ratios to meet the requirements of products in applications. Therefore, the production yield of the display panel manufactured by the design of the embodiment is increased, and as a result, reliable and stable display quality of the implemented display panel is obtained.

상기 기재된 바와 같은 구조는 설명을 위해 제공된 것임을 유의하여야 한다. 본 개시는 상기 개시된 구성 및 임의의 세부사항에 한정되지 않고, 예시된 구조 및 정렬은 실제 응용의 실제 수요에 기초하여 조정 및 변경될 수 있다. 예를 들어, 제1 및 제2 전도성 층의 패턴(슬릿 수, 슬릿 폭, 전극 브랜치 폭,...등을 포함함), 또는 데이터 라인과 스캔 라인 사이의 각도, 또는 곡선 단부 부분을 갖는 슬릿... 등이 본 개시의 실시예에 적용 가능하다. 또한, 상부 픽셀 전극 구성을 갖는 LCD 패널 또는 상부 공통 전극 구성을 갖는 LCD 패널이 본 개시에 의해 적용될 수 있다. 또한, 액정 정렬은 포토 정렬 또는 러빙(rubbing) 정렬에 의해 달성될 수 있고, 본 개시는 이에 어떠한 특정 한정도 하지 않는다. 하나의 실시예에서, 액정 층의 액정 분자들은 0도 내지 4도 범위로 프리틸트된(pre-tilted) 각도를 가질 수 있다(예를 들어, 포토 정렬을 사용한 응용에서 프리틸트된 각도가 0도일 수 있고, 러빙 정렬을 사용한 응용에서 프리틸트된 각도가 2도일 수 있음). 또한, 포지티비 타입 액정 또는 네가티브 타입 액정이 실시예의 디스플레이 패널에 채용될 수 있다. 실제 응용의 실제 수요에 기초하여 예시된 구조 및 세부사항들이 조정 및 변경될 수 있는 것으로 알려진다. It should be noted that the structure as described above is provided for illustrative purposes. The present disclosure is not limited to the configuration and any details disclosed above, and the illustrated structure and arrangement can be adjusted and changed based on the actual needs of actual applications. For example, the pattern of the first and second conductive layers (including the number of slits, the width of the slits, the width of the electrode branches, etc.), or the angle between the data line and the scan line, or the slits with curved end portions. ... and the like are applicable to the embodiments of the present disclosure. Also, an LCD panel having an upper pixel electrode configuration or an LCD panel having an upper common electrode configuration may be applied according to the present disclosure. In addition, liquid crystal alignment can be achieved by photo alignment or rubbing alignment, and the present disclosure does not make any specific limitations thereto. In one embodiment, the liquid crystal molecules of the liquid crystal layer may have a pre-tilted angle in the range of 0 to 4 degrees (eg, in applications using photo alignment, the pre-tilted angle may be 0 degrees). may be, and the pretilted angle may be 2 degrees in applications using rubbing alignment). Also, a positive-type liquid crystal or a negative-type liquid crystal may be employed in the display panel of the embodiment. It is understood that the exemplified structures and details can be adjusted and changed based on the actual needs of actual applications.

본 발명은 예로써 바람직한 실시예에 대하여 기재되었지만, 본 발명은 이에 한정되지 않는 것으로 이해되어야 한다. 이와 달리, 다양한 수정과 유사한 구성 및 절차를 커버하도록 의도되고, 따라서 첨부된 청구항의 범위는 이러한 모든 수정과 유사한 구성 및 절차를 망라하도록 가장 넓은 해석이 부여되어야 한다. Although the present invention has been described with respect to preferred embodiments by way of example, it should be understood that the present invention is not limited thereto. On the contrary, it is intended to cover various modifications and similar arrangements and procedures, and accordingly the scope of the appended claims is to be accorded the broadest interpretation so as to encompass all such modifications and similar arrangements and procedures.

Claims (16)

디스플레이 패널에 있어서,
제1 기판으로서,
상기 제1 기판 위에 배치된 스캔 라인들과;
상기 제1 기판 위에 배치되며, 픽셀 영역들을 정의하도록 상기 스캔 라인들과 교차하는 데이터 라인들
을 포함하며, 상기 픽셀 영역들 중의 적어도 하나의 픽셀 영역은, 2개의 연장(extending) 부분들과 하나의 휨(bending) 부분을 갖는 전극을 포함하고, 상기 연장 부분들은 상기 데이터 라인들의 연장 방향에 실질적으로 평행하고, 상기 휨 부분은 상기 2개의 연장 부분들 사이에 위치되어 상기 2개의 연장 부분들을 연결하는 것인, 상기 제1 기판;
상기 제1 기판에 대향하는 제2 기판; 및
상기 제1 기판과 상기 제2 기판 사이에 배치된 액정 층을 포함하고,
광이 픽셀 영역들 중의 상기 픽셀 영역을 통과할 때, 제1 다크 패턴과 복수의 제2 다크 패턴들을 포함하는 다크 패턴이 픽셀 영역들 중의 상기 픽셀 영역에 발생되며, 상기 제1 다크 패턴은 상기 전극의 휨 부분에 대응하고, 상기 제1 다크 패턴의 연장 방향은 상기 스캔 라인의 연장 방향에 실질적으로 평행하고, 상기 제2 다크 패턴들은 상기 전극의 연장 부분들에 대응하고,
상기 제1 다크 패턴은 제1 그레이 레벨(gray level)에서의 제1 폭 및 제2 그레이 레벨에서의 제2 폭을 갖고, 상기 제2 폭에 대한 상기 제1 폭의 비는 2.1 내지 3.0의 범위이며, 상기 제2 그레이 레벨은 상기 디스플레이 패널의 최대 그레이 레벨이고, 상기 제1 그레이 레벨은 전체 그레이 레벨의 1/2인 것인, 디스플레이 패널.
In the display panel,
As a first substrate,
scan lines disposed on the first substrate;
data lines disposed on the first substrate and crossing the scan lines to define pixel areas;
wherein at least one of the pixel areas includes an electrode having two extending parts and one bending part, and the extending parts extend in the extension direction of the data lines. the first substrate being substantially parallel, wherein the bend portion is positioned between the two extension portions and connects the two extension portions;
a second substrate facing the first substrate; and
A liquid crystal layer disposed between the first substrate and the second substrate;
When light passes through the pixel area among the pixel areas, a dark pattern including a first dark pattern and a plurality of second dark patterns is generated in the pixel area among the pixel areas, and the first dark pattern is applied to the electrode. corresponds to a bent portion of , an extension direction of the first dark pattern is substantially parallel to an extension direction of the scan line, and the second dark patterns correspond to extension portions of the electrode;
The first dark pattern has a first width at a first gray level and a second width at a second gray level, and a ratio of the first width to the second width ranges from 2.1 to 3.0. , wherein the second gray level is a maximum gray level of the display panel, and the first gray level is 1/2 of the entire gray level.
청구항 1에 있어서, 상기 제1 다크 패턴은, 픽셀 영역들 중의 상기 픽셀 영역이 녹색 서브픽셀 영역인 동안 상기 제2 그레이 레벨에서의 제1 녹색 폭을 갖고, 상기 제1 다크 패턴은, 픽셀 영역들 중의 상기 픽셀 영역이 적색 서브픽셀 영역인 동안 상기 제2 그레이 레벨에서의 제1 적색 폭을 가지며, 상기 제1 녹색 폭은 상기 제1 적색 폭보다 더 작은 것인, 디스플레이 패널. The method according to claim 1, wherein the first dark pattern has a first green width at the second gray level while the pixel area of the pixel areas is a green sub-pixel area, and the first dark pattern comprises pixel areas wherein the pixel area of H has a first red width at the second gray level while being a red sub-pixel area, and wherein the first green width is smaller than the first red width. 청구항 2에 있어서, 상기 제1 다크 패턴은, 픽셀 영역들 중의 상기 픽셀 영역이 청색 서브픽셀 영역인 동안 상기 제2 그레이 레벨에서의 제1 청색 폭을 갖고, 상기 제1 녹색 폭은 상기 제1 청색 폭보다 더 작은 것인, 디스플레이 패널. The method according to claim 2, wherein the first dark pattern has a first blue width in the second gray level while the pixel area among the pixel areas is a blue sub-pixel area, and the first green width is the first blue sub-pixel area. A display panel that is smaller than the width. 청구항 1에 있어서, 상기 제2 다크 패턴들은 상기 전극의 연장 부분들에 실질적으로 평행한 연장 방향들을 갖는 것인, 디스플레이 패널. The display panel according to claim 1, wherein the second dark patterns have extension directions substantially parallel to extension portions of the electrode. 청구항 1에 있어서, 상기 제2 그레이 레벨은 상기 디스플레이 패널의 상기 최대 그레이 레벨이고, 상기 제1 그레이 레벨은 상기 디스플레이 패널의 중간(medium) 그레이 레벨인 것인, 디스플레이 패널. The display panel according to claim 1, wherein the second gray level is the maximum gray level of the display panel, and the first gray level is a medium gray level of the display panel. 청구항 1에 있어서, 상기 액정 층의 액정 재료는 10 내지 20 범위의 스플레이(splay) 탄성 계수(K11)를 갖는 것인, 디스플레이 패널. The display panel according to claim 1, wherein the liquid crystal material of the liquid crystal layer has a splay elastic modulus (K11) in the range of 10 to 20. 청구항 1에 있어서, 상기 액정 층의 액정 재료는 10 내지 25 범위의 벤드(bend) 탄성 계수(K33)를 갖는 것인, 디스플레이 패널. The display panel according to claim 1, wherein the liquid crystal material of the liquid crystal layer has a bend modulus of elasticity (K33) in the range of 10 to 25. 청구항 1에 있어서, 상기 액정 층의 액정 분자들은 0도 내지 4도 범위의 프리틸트(pre-tilt)된 각도를 갖는 것인, 디스플레이 패널. The display panel according to claim 1, wherein the liquid crystal molecules of the liquid crystal layer have a pre-tilt angle ranging from 0 to 4 degrees. 청구항 1에 있어서, 상기 전극의 2개의 연장 부분들과 상기 스캔 라인 사이의 각도는 80도 내지 87도 범위인 것인, 디스플레이 패널. The display panel according to claim 1 , wherein an angle between the two extension parts of the electrode and the scan line ranges from 80 degrees to 87 degrees. 청구항 1에 있어서, 상기 전극은 복수의 전극 브랜치들과 복수의 슬릿들을 포함하고, 상기 복수의 슬릿들 각각은 상기 복수의 전극 브랜치들 사이에 위치되며, 상기 복수의 전극 브랜치들 각각은 휨 부분과 2개의 연장 부분들을 포함하고, 상기 휨 부분은 상기 2개의 연장 부분들 사이에 위치되며 상기 2개의 연장 부분들을 연결하는 것인, 디스플레이 패널. The method according to claim 1, wherein the electrode includes a plurality of electrode branches and a plurality of slits, each of the plurality of slits is located between the plurality of electrode branches, each of the plurality of electrode branches is bent portion and A display panel comprising two extension portions, wherein the bent portion is positioned between the two extension portions and connects the two extension portions. 청구항 10에 있어서, 상기 슬릿들 각각은 1.5 ㎛ 내지 4 ㎛ 범위의 폭을 갖는 것인, 디스플레이 패널. The display panel according to claim 10, wherein each of the slits has a width ranging from 1.5 μm to 4 μm. 청구항 10에 있어서, 상기 복수의 전극 브랜치들 각각은 1.5 ㎛ 내지 4 ㎛ 범위의 폭을 갖는 것인, 디스플레이 패널. The display panel according to claim 10, wherein each of the plurality of electrode branches has a width ranging from 1.5 μm to 4 μm. 청구항 1에 있어서, 픽셀 영역들 중의 상기 픽셀 영역은, 박막 트랜지스터(TFT; thin film transistor), 상기 박막 트랜지스터 위의 제1 전도성 층, 상기 박막 트랜지스터와 상기 제1 전도성 층 사이에 배치된 절연 층, 및 상기 제1 전도성 층 위의 제2 전도성 층을 더 포함하고, 상기 전극은 상기 제1 전도성 층과 상기 제2 전도성 층 중의 하나이며, 상기 박막 트랜지스터에 전기적으로 접속되는 것인, 디스플레이 패널. The method according to claim 1, wherein the pixel region of the pixel regions, a thin film transistor (TFT; thin film transistor), a first conductive layer on the thin film transistor, an insulating layer disposed between the thin film transistor and the first conductive layer, and a second conductive layer on the first conductive layer, wherein the electrode is one of the first conductive layer and the second conductive layer, and is electrically connected to the thin film transistor. 청구항 13에 있어서, 상기 제1 전도성 층과 상기 제2 전도성 층은 50 nm 내지 700 nm 범위의 간격으로 이격되는 것인, 디스플레이 패널. The display panel according to claim 13, wherein the first conductive layer and the second conductive layer are spaced apart at intervals ranging from 50 nm to 700 nm. 청구항 13에 있어서, 상기 박막 트랜지스터와 상기 제1 전도성 층 사이의 상기 절연 층은 유기 절연 층이고, 상기 제1 전도성 층과 상기 제2 전도성 층은 300 nm 내지 700 nm 범위의 간격으로 이격되는 것인, 디스플레이 패널. 14. The method according to claim 13, wherein the insulating layer between the thin film transistor and the first conductive layer is an organic insulating layer, and the first conductive layer and the second conductive layer are spaced at intervals ranging from 300 nm to 700 nm. , display panel. 청구항 13에 있어서, 상기 박막 트랜지스터와 상기 제1 전도성 층 사이의 상기 절연 층은 무기 절연 층이고, 상기 제1 전도성 층과 상기 제2 전도성 층은 50 nm 내지 300 nm 범위의 간격으로 이격되는 것인, 디스플레이 패널.The method according to claim 13, wherein the insulating layer between the thin film transistor and the first conductive layer is an inorganic insulating layer, and the first conductive layer and the second conductive layer are spaced apart at intervals ranging from 50 nm to 300 nm , display panel.
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