KR102425402B1 - 뉴 라디오에서 불연속 수신을 제어하기 위한 디바이스들 및 방법들 - Google Patents

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Abstract

불연속 수신(DRX)을 위한 방법이 개시된다. 방법은, 사용자 장비(UE)의 수신 회로에 의해, DRX 시작 오프셋(drx-StartOffset) 및 DRX 슬롯 오프셋(drx-SlotOffset)을 갖는 라디오 자원 제어(RRC) 메시지를 수신하는 단계; UE의 프로세싱 회로에 의해, drx-StartOffset에 기초하여 시작 서브프레임을 결정하는 단계; 및 프로세싱 회로에 의해, drx-SlotOffset에 기초하여 시작 서브프레임에서 DRX 온-듀레이션 타이머(drx-onDurationTimer)의 시작 시간을 결정하는 단계를 포함한다.

Description

뉴 라디오에서 불연속 수신을 제어하기 위한 디바이스들 및 방법들
<관련 출원(들)에 대한 상호-참조>
본 출원은 2017년 9월 28일자로 출원되고 발명의 명칭이 "DRX STATE TRANSITION UNDER MULTIPLE NUMEROLOGY IN NEW RADIO"인 미국 가특허 출원 제62/564,650호의 이익 및 우선권을 주장하며, 그 대리인 정리 번호는 US71996이다(이는 이하에서 "US71996 출원"이라고 지칭된다). US71996 출원의 개시내용은 본 명세서에서 본 출원에 전체적으로 참조로 포함된다.
<기술 분야>
본 개시내용은 일반적으로 무선 통신에 관한 것으로, 보다 구체적으로, 불연속 수신을 제어하기 위한 디바이스들 및 방법들에 관한 것이다.
롱 텀 에볼루션(long term evolution)(LTE) 또는 진화된 LTE(evolved LTE)(eLTE) 네트워크와 같은 무선 통신 네트워크에서, 불연속 수신(discontinuous reception)(DRX)은 일반적으로 기지국과 하나 이상의 사용자 장비(UE) 간에 UE들의 배터리 수명을 보존하는 데 사용된다. 예를 들어, DRX 동안, UE는 전력 소비를 감소시키기 위해 그것의 RF 모듈을 끄고/끄거나 데이터 송신들 사이에서 제어 채널 모니터링을 중단할 수 있다. UE는, 예를 들어, 기지국의 구성 및 실제 트래픽 패턴에 기초하여 미리 구성된 ON/OFF 사이클들로 제어 채널(예를 들어, 물리적 다운링크 제어 채널(physical downlink control channel)(PDCCH))을 주기적으로 모니터링할 수 있다. 활성 시간(예를 들어, ON 사이클들) 동안, UE는 가능한 데이터 송신/수신 지시에 대해 PDCCH를 모니터링한다. 활성 시간 동안 데이터 송신이 발생할 때, UE는 송신을 완료하기 위해 활성 상태를 유지할 수 있다.
차세대(예를 들어, 제5세대(5G) 뉴 라디오(NR)) 무선 통신 네트워크들에서의 데이터 스케줄링에 대한 유연성을 증가시키기 위해, 3세대 파트너십 프로젝트(Third Generation Partnership Project)(3GPP)는 프레임 구조들의 형성 및 제어 채널들의 할당에 대한 새로운 설계들을 도입하였으며, 여기서는 프레임 구조의 모든 엘리먼트들이 고정된 시간 단위를 갖지는 않을 것이다.
따라서, 본 기술 분야에서 차세대 무선 통신 네트워크들에 대한 DRX 동작을 제어하기 위한 디바이스들 및 방법들에 대한 필요성이 존재한다.
본 개시내용은 뉴 라디오에서 불연속 수신을 제어하기 위한 디바이스들 및 방법들에 관한 것이다.
본 개시내용의 제1 양태에서, 불연속 수신(discontinuous reception)(DRX)을 위한 방법이 개시되며, 방법은, 사용자 장비(User Equipment)(UE)의 수신 회로에 의해, DRX 시작 오프셋(drx-StartOffset) 및 DRX 슬롯 오프셋(drx-SlotOffset)을 갖는 라디오 자원 제어(Radio Resource Control)(RRC) 메시지를 수신하는 단계; UE의 프로세싱 회로에 의해, drx-StartOffset에 기초하여 시작 서브프레임을 결정하는 단계; 및 프로세싱 회로에 의해, drx-SlotOffset에 기초하여 시작 서브프레임에서 DRX 온-듀레이션(drx-onDuration) 타이머의 시작 시간을 결정하는 단계를 포함한다.
제1 양태의 일 구현에 따르면, 방법은, 수신 회로에 의해, 시스템 프레임 번호(system frame number)(SFN), 서브프레임 번호 및 숏 DRX 사이클(drx-ShortCycle)을 수신하는 단계; 프로세싱 회로에 의해, [(SFN×10)+서브프레임 번호] 모듈로 (drx-ShortCycle) = (drx-StartOffset) 모듈로 (drx-ShortCycle)일 때, 시작 서브프레임의 시작부로부터 drx-SlotOffset 후에 drx-온 듀레이션 타이머를 시작하는 단계를 추가로 포함한다.
제1 양태의 다른 구현에 따르면, 방법은, 수신 회로에 의해, 시스템 프레임 번호(SFN), 서브프레임 번호 및 롱 DRX 사이클(drx-LongCycle)을 수신하는 단계; 프로세싱 회로에 의해, [(SFN×10)+서브프레임 번호] 모듈로 (drx-LongCycle) = drx-StartOffset일 때, 시작 서브프레임의 시작부로부터 drx-SlotOffset 후에 drx-온 듀레이션 타이머를 시작하는 단계를 추가로 포함한다.
제1 양태의 다른 구현에 따르면, drx-SlotOffset은 하나 이상의 슬롯, 하나 이상의 슬롯의 일부분에 대응하는 실제 시간 값을 갖는다.
제1 양태의 다른 구현에 따르면, drx-SlotOffset은 밀리초 또는 밀리초의 일부분의 실제 시간 단위를 갖는다.
제1 양태의 다른 구현에 따르면, 방법은, 수신 회로에 의해, 물리적 다운링크 제어 채널(physical downlink control channel)(PDCCH)을 통한 새로운 송신의 지시를 수신하는 단계; 및 프로세싱 회로에 의해, PDCCH의 종료 후에, 제1 심볼에서 DRX 비활성 타이머(drx-InactivityTimer)를 시작하는 단계를 추가로 포함한다.
본 개시내용의 제2 양태에서, 사용자 장비(UE)가 개시되며, UE는 DRX 시작 오프셋(drx-StartOffset) 및 DRX 슬롯 오프셋(drx-SlotOffset)을 갖는 라디오 자원 제어(RRC) 메시지를 수신하도록 구성되는 수신 회로; 및 프로세싱 회로를 포함하고, 프로세싱 회로는, drx-StartOffset에 기초하여 시작 서브프레임을 결정하고, drx-SlotOffset에 기초하여 시작 서브프레임에서 DRX 온-듀레이션(drx-onDuration) 타이머의 시작 시간을 결정하도록 구성된다.
제2 양태의 일 구현에 따르면, 수신 회로는 시스템 프레임 번호(SFN) 및 숏 DRX 사이클(drx-ShortCycle)을 수신하도록 추가로 구성되고, 프로세싱 회로는, 서브프레임 번호를 결정하고, [(SFN×10)+서브프레임 번호] 모듈로 (drx-ShortCycle) = (drx-StartOffset) 모듈로 (drx-ShortCycle)일 때, 시작 서브프레임의 시작부로부터 drx-SlotOffset 후에 drx-온 듀레이션 타이머를 시작하도록 추가로 구성된다.
제2 양태의 다른 구현에 따르면, 수신 회로는 시스템 프레임 번호(SFN) 및 롱 DRX 사이클(drx-LongCycle)을 수신하도록 추가로 구성되고, 프로세싱 회로는, 서브프레임 번호를 결정하고, [(SFN×10)+서브프레임 번호] 모듈로 (drx-LongCycle) = drx-StartOffset일 때, 시작 서브프레임의 시작부로부터 drx-SlotOffset 후에 drx-온 듀레이션 타이머를 시작하도록 추가로 구성된다.
제2 양태의 다른 구현에 따르면, drx-SlotOffset은 하나 이상의 슬롯, 하나 이상의 슬롯의 일부분에 대응하는 실제 시간 값을 갖는다.
제2 양태의 다른 구현에 따르면, drx-SlotOffset은 밀리초 또는 밀리초의 일부분의 실제 시간 단위를 갖는다.
본 개시내용의 제3 양태에서, 불연속 수신(DRX)을 위한 방법이 개시되며, 방법은, 사용자 장비(UE)의 수신 회로에 의해, 물리적 다운링크 제어 채널(PDCCH)을 통한 새로운 송신의 지시를 수신하는 단계; 및 UE의 프로세싱 회로에 의해, PDCCH 수신의 종료 후에, 제1 심볼에서 DRX 비활성 타이머(drx-InactivityTimer)를 시작 또는 재시작하는 단계를 포함한다.
예시적인 개시내용의 양태들은 첨부 도면들과 함께 읽을 때 다음의 상세한 설명으로부터 가장 잘 이해된다. 다양한 특징들은 축척대로 도시되지 않았고, 다양한 특징들의 치수들은 명확하게 논의하기 위해 임의로 증가될 수도 있고 또는 감소될 수도 있다.
도 1은, 본 출원의 예시적인 구현들에 따라, 다양한 ON 듀레이션 타이머 시작 시간 포지션들을 나타내는 프레임 구조를 예시하는 개략도이다.
도 2는, 본 출원의 예시적인 구현들에 따라, 데이터 스케줄링을 갖고 다양한 DRX 비활성 타이머 시작 시간 포지션들을 나타내는 프레임 구조를 예시하는 개략도이다.
도 3a 및 도 3b는, 본 출원의 예시적인 구현들에 따라,
Figure 112020038188688-pct00001
로 구성된 다양한 DRX 비활성 타이머 만료 시간 포지션들을 나타내는 서브프레임 구조들을 예시하는 개략도들이다.
도 4a 및 도 4b는, 본 출원의 예시적인 구현들에 따라,
Figure 112020038188688-pct00002
로 구성된 다양한 DRX 비활성 타이머 만료 시간 포지션들을 나타내는 서브프레임 구조들을 예시하는 개략도들이다.
도 5는, 본 출원의 예시적인 구현들에 따라, DRX 비활성 타이머들의 만료에 대한 다양한 시간 인터벌들을 나타내는 서브프레임 구조를 예시하는 개략도이다.
도 6은, 본 출원의 예시적인 구현에 따라, DRX 동작을 위한 UE에 의한 방법을 예시하는 흐름도이다.
도 7은, 본 출원의 예시적인 구현에 따라, 무선 통신을 위한 노드를 예시하는 블록도이다.
다음의 설명은 본 개시내용의 예시적인 구현들에 관한 특정 정보를 포함한다. 본 개시내용의 도면들 및 이들의 첨부된 상세한 설명은 단지 예시적인 구현들에 관한 것이다. 그러나, 본 개시내용은 단지 이러한 예시적인 구현들에 제한되지 않는다. 본 개시내용의 다른 변형들 및 구현들이 본 기술분야의 통상의 기술자에게 일어날 것이다. 달리 언급되지 않는 한, 도면들 중 유사하거나 대응하는 엘리먼트들은 유사하거나 대응하는 참조 번호들로 지시될 수 있다. 더욱이, 본 개시내용의 도면들 및 예시들은 일반적으로 축척대로 이루어지지 않고, 실제 상대적인 치수들에 대응하도록 의도되지 않는다.
일관성 및 이해의 용이성을 위해, 예시적인 도면들에서 유사한 특징들은 숫자들로 식별된다(그러나, 일부 예들에서는, 도시 생략된다). 그러나, 상이한 구현들에서의 특징들은 다른 측면들에서 상이할 수 있기 때문에, 도면들에 도시된 것들에 국한되어 한정되지 않아야 한다.
본 설명은 "일 구현에서" 또는 "일부 구현들에서"라는 문구들을 사용하는데, 이들은 각각 동일하거나 상이한 구현들 중 하나 이상을 지칭할 수 있다. "커플링된"이라는 용어는 개재 컴포넌트들을 통해 직접적으로든 또는 간접적으로든 연결되는 것으로 정의되며, 물리적 연결들에 반드시 제한되는 것은 아니다. "포함하는"이라는 용어는, 활용될 때, "포함하지만, 이에 반드시 제한될 필요는 없는"을 의미하며, 구체적으로는, 상술된 조합, 그룹, 시리즈 및 등가물에서의 개방형 포함 또는 구성 요소를 지시한다.
또한, 설명 및 비-제한적인 목적을 위해, 기능 엔티티들, 기술들, 프로토콜들, 표준 등과 같은 특정 세부 사항들이 설명된 기술의 이해를 제공하기 위해 개시된다. 다른 예들에서, 널리 공지된 방법들, 기술들, 시스템, 아키텍처들 등의 상세한 설명은 불필요한 세부 사항들로 설명을 모호하게 하지 않기 위해 생략된다.
본 기술분야의 통상의 기술자는 본 개시내용에 설명된 임의의 네트워크 기능(들) 또는 알고리즘(들)이 하드웨어, 소프트웨어 또는 소프트웨어와 하드웨어의 조합에 의해 구현될 수 있다는 것을 즉시 인식할 것이다. 설명된 기능들은 소프트웨어, 하드웨어, 펌웨어 또는 이들의 임의의 조합일 수 있는 모듈들에 대응할 수 있다. 소프트웨어 구현은 메모리 또는 다른 타입의 저장 디바이스들과 같은 컴퓨터 판독 가능 매체에 저장된 컴퓨터 실행 가능 명령어들을 포함할 수 있다. 예를 들어, 통신 프로세싱 능력을 갖는 하나 이상의 마이크로프로세서 또는 범용 컴퓨터는 대응하는 실행 가능 명령어들로 프로그래밍될 수 있고, 설명된 네트워크 기능(들) 또는 알고리즘(들)을 수행할 수 있다. 마이크로프로세서들 또는 범용 컴퓨터들은 주문형 집적 회로(applications specific integrated circuitry)(ASIC), 프로그램 가능 로직 어레이들로, 및/또는 하나 이상의 디지털 신호 프로세서(digital signal processor)(DSP)를 사용하여 형성될 수 있다. 본 명세서에 설명된 예시적인 구현들 중 일부는 컴퓨터 하드웨어 상에서 설치되고 실행되는 소프트웨어에 관한 것이지만, 그럼에도 불구하고, 펌웨어로서 또는 하드웨어 또는 하드웨어와 소프트웨어의 조합으로서 구현되는 대안적인 예시적인 구현들 또한 본 개시내용의 범위 내에 있다.
컴퓨터 판독 가능 매체는 랜덤 액세스 메모리(random access memory)(RAM), 판독 전용 메모리(read only memory)(ROM), 소거 가능한 프로그램 가능 판독 전용 메모리(erasable programmable read-only memory)(EPROM), 전기적으로 소거 가능한 프로그램 가능 판독 전용 메모리(electrically erasable programmable read-only memory)(EEPROM), 플래시 메모리, 콤팩트 디스크 판독 전용 메모리(compact disc read-only memory)(CD ROM), 자기 카세트, 자기 테이프, 자기 디스크 스토리지, 또는 컴퓨터 판독 가능 명령어들을 저장할 수 있는 임의의 다른 등가의 매체를 포함하지만, 이에 제한되지 않는다.
라디오 통신 네트워크 아키텍처(예를 들어, 롱 텀 에볼루션(LTE) 시스템, LTE-어드밴스드(LTE-Advanced)(LTE-A) 시스템 또는 LTE-어드밴스드 프로 시스템)는 통상적으로 적어도 하나의 기지국, 적어도 하나의 사용자 장비(UE), 및 네트워크를 향한 연결을 제공하는 하나 이상의 임의적인 네트워크 엘리먼트를 포함한다. UE는 기지국에 의해 구축된 라디오 액세스 네트워크(radio access network)(RAN)를 통해 네트워크(예를 들어, 코어 네트워크(core network)(CN), 진화된 패킷 코어(evolved packet core)(EPC) 네트워크, 진화된 범용 지상 라디오 액세스 네트워크(Evolved Universal Terrestrial Radio Access network)(E-UTRAN), 차세대 코어(Next-Generation Core)(NGC), 5G 코어 네트워크(5G Core Network)(5GC) 또는 인터넷)와 통신한다.
본 출원에서, UE는 이동국, 모바일 단말기 또는 디바이스, 사용자 통신 라디오 단말기를 포함할 수 있지만, 이에 제한되지 않는다는 것에 유의해야 한다. 예를 들어, UE는 모바일폰, 태블릿, 웨어러블 디바이스, 센서, 또는 무선 통신 능력을 가진 개인 휴대 정보 단말(personal digital assistant)(PDA)을 포함하되, 이에 제한되지 않는 휴대용 라디오 장비일 수 있다. UE는 라디오 액세스 네트워크에서 하나 이상의 셀에 무선 인터페이스(air interface)를 통해 신호들을 수신 및 송신하도록 구성된다.
기지국은 UMTS에서와 같은 노드 B(NB), LTE-A에서와 같은 진화된 노드 B(eNB), UMTS에서와 같은 라디오 네트워크 제어기(RNC), GSM/GERAN에서와 같은 기지국 제어기(BSC), 5GC와 관련하여 E-UTRA 기지국에서와 같은 NG-eNB, 5G-RAN에서와 같은 차세대 노드 B(gNB), 및 라디오 통신을 제어하고 셀 내의 라디오 자원들을 관리할 수 있는 임의의 다른 장치를 포함할 수 있지만, 이에 제한되지 않는다. 기지국은 라디오 인터페이스를 통해 하나 이상의 UE를 서빙하도록 네트워크에 연결될 수 있다.
기지국은 다음의 라디오 액세스 기술(radio access technology)(RAT)들: WiMAX(Worldwide Interoperability for Microwave Access), 이동 통신 글로벌 시스템(Global System for Mobile communications)(GSM, 종종 2G로도 지칭됨), GSM EDGE 라디오 액세스 네트워크(GSM EDGE radio access Network)(GERAN), 일반 패킷 라디오 서비스(General Packet Radio Service)(GRPS), 기본 광대역-코드 분할 다중 액세스(wideband-code division multiple access)(W-CDMA)에 기초한 범용 이동 통신 시스템(Universal Mobile Telecommunication System)(UMTS, 종종 3G로도 지칭됨), 고속 패킷 액세스(high-speed packet access)(HSPA), LTE, LTE-A, eLTE (evolved LTE), 뉴 라디오(New Radio)(NR, 종종 5G로도 지칭됨), 및/또는 LTE-A 프로 중 적어도 하나에 따라 통신 서비스들을 제공하도록 구성될 수 있다. 그러나, 본 출원의 범위는 상기 언급된 프로토콜들에 제한되지 않아야 한다.
기지국은 라디오 액세스 네트워크를 형성하는 복수의 셀들을 사용하여 특정 지리적 영역에 라디오 커버리지를 제공하도록 동작 가능하다. 기지국은 셀들의 동작들을 지원한다. 각각의 셀은 셀의 라디오 커버리지 내에서 적어도 하나의 UE에 서비스들을 제공하도록 동작 가능하다. 보다 구체적으로, 각각의 셀(종종 서빙 셀로 지칭됨)은 셀의 라디오 커버리지 내에서 하나 이상의 UE를 서빙하는 서비스들을 제공한다(예를 들어, 각각의 셀은 다운링크 및 임의적으로는 업링크 패킷 송신들을 위해 셀의 라디오 커버리지 내에서 적어도 하나의 UE에 다운링크 및 임의적으로는 업링크 자원들을 스케줄링한다). 기지국은 복수의 셀들을 통해 라디오 통신 시스템에서 하나 이상의 UE와 통신할 수 있다. 셀은 근접 서비스(proximity service)(ProSe)를 지원하기 위해 사이드링크(sidelink)(SL) 자원들을 할당할 수 있다. 각각의 셀은 다른 셀들과 커버리지 영역들이 중첩될 수 있다.
위에서 논의된 바와 같이, 차세대(예를 들어, 5G NR) 무선 통신 네트워크들을 위한 프레임 구조는 eMBB, mMTC 및 URLLC와 같은 다양한 차세대 통신 요구 사항들을 수용하면서, 높은 신뢰성, 높은 데이터 레이트 및 낮은 레이턴시 요구 사항들을 충족시키기 위한 유연한 구성들을 지원한다. 3GPP에서 합의된 직교 주파수-분할 멀티플렉싱(orthogonal frequency-division multiplexing)(OFDM) 기술은 NR 파형의 기준선으로 작용할 수 있다. 적응적 서브캐리어 간격, 채널 대역폭 및 사이클릭 프리픽스(Cyclic Prefix)(CP)와 같은 스케일링 가능한 OFDM 뉴머롤로지(numerology)도 사용될 수 있다. 또한, NR에는 (1) 저밀도 패리티 검사(low-density parity-check)(LDPC) 코드, 및 (2) 폴라 코드(Polar Code)의 두 가지 코딩 방식이 고려된다. 코딩 방식 적응은 채널 조건들 및/또는 서비스 애플리케이션들에 기초하여 구성될 수 있다.
또한, 단일 NR 프레임의 송신 시간 인터벌 TX에서는, 다운링크(DL) 송신 데이터, 가드 주기 및 업링크(UL) 송신 데이터가 적어도 포함되어야 하는 것으로 고려되며, 여기서 DL 송신 데이터, 가드 주기, UL 송신 데이터의 개개의 부분들은 또한, 예를 들어, NR의 네트워크 역학에 기초하여 구성 가능해야 한다. 또한, ProSe 서비스들을 지원하기 위해 사이드링크 자원이 NR 프레임에서 제공될 수도 있다.
롱 텀 에볼루션(LTE) 무선 통신 시스템들에서는, DRX 동작 동안, UE의 매체 액세스 제어(Medium Access Control)(MAC) 엔티티가 MAC 엔티티의 공통-라디오 네트워크 임시 식별자(Common-Radio Network Temporary Identifier)(C-RNTI), 송신 전력 제어 물리적 업링크 제어 채널(PUCCH) 라디오 네트워크 임시 식별자(transmit power control Physical Uplink Control Channel (PUCCH)　Radio Network Temporary Identifier)(TPC-PUCCH-RNTI), 송신 전력 제어 물리적 업링크 공유 채널(PUSCH) 라디오 네트워크 임시 식별자(transmit power control Physical Uplink Shared Channel (PUSCH)　Radio Network Temporary Identifier)(TPC-PUSCH-RNTI), 반-영구적 스케줄링 C-RNTI(구성 가능한 경우), 업링크(UL) 반-영구적 스케줄링 가상-RNTI(Virtual-RNTI)(V-RNTI)(구성 가능한 경우), 트래픽 적응을 갖는 강화된 간섭 완화-RNTI(enhanced interference mitigation with traffic adaptation-RNTI)(eIMTA-RNTI)(구성 가능한 경우), 사이드링크-RNTI(S-RNTI)(구성 가능한 경우), SL-V-RNTI(구성 가능한 경우), 컴포넌트 캐리어-RNTI(Component Carrier-RNTI)(CC-RNTI)(구성 가능한 경우), 및 사운딩 기준 신호(Sounding Reference Signal)(SRS)-TPC-RNTI(SRS-TPC-RNTI)(구성 가능한 경우)에 대한 UE의 물리적 다운링크 제어 채널(Physical Downlink Control Channel)(PDCCH) 모니터링 활동들을 제어하는 DRX 기능을 갖는 라디오 자원 제어(RRC)에 의해 구성될 수 있다. RRC_CONNECTED 상태에 있을 때, DRX가 구성되는 경우, MAC 엔티티는 DRX 동작을 사용하여 PDCCH를 불연속적으로 모니터링하도록 허용된다. 표 I의 리스트와 같이, RRC는 다음의 타이머들 및 파라미터들: DRX 온 듀레이션 타이머(onDurationTimer), DRX 비활성 타이머(drx - InactivityTimer), DRX 재송신 타이머(drx -RetransmissionTimer), DRX UL 재송신 타이머(예를 들어, drx -ULRetransmissionTimer), DRX 롱 사이클(longDRX -Cycle), DRX 시작 오프셋(drxStartOffset), DRX 숏 사이클(shortDRX -Cycle), 및 DRX 숏 사이클 타이머(drxShortCycleTimer) 중 하나 이상을 구성함으로써, DRX 동작을 제어한다. 기지국(예를 들어, 진화된 NodeB(eNB))에 의해 제공되는 DRX 구성에 기초하여, UE는 정확한 활성 시간으로 구성된다. DRX 사이클이 구성될 때, 활성 시간은 ON 듀레이션 타이머, DRX 비활성 타이머, DRX 재송신 타이머, DRX UL 재송신 타이머, 및/또는 MAC-경쟁 해결 타이머에 의해 지시되는 시간을 포함한다.
본 출원의 구현들은 ON 듀레이션 타이머 및 DRX 비활성 타이머에 중점을 둔다. 본 출원에서 다뤄지는 목적들 및 용도들에 따라, 이들 파라미터들은 DRX 사이클, 데이터 송신, 데이터 재송신 및 하이브리드 자동 반복 요청(Hybrid Automatic Repeat reQuest)(HARQ)의 4가지 양태로 분류될 수 있다. 또한, 이러한 파라미터들은 상이한 시간 단위들을 가질 수 있다. 예를 들어, DRX 사이클 및 HARQ와 관련된 파라미터들은 서브프레임(sf)의 시간 단위들로 구성되고, 데이터 송신 및 데이터 재송신과 관련된 파라미터들은 PDCCH 서브프레임(psf)으로 구성된다.
Figure 112020038188688-pct00003
차세대(예를 들어, 5G NR) 무선 통신 네트워크들에는, 적어도 세 가지 상이한 타입의 시간 단위: 고정 시간 단위(Fix time unit)(FTU), 스케일링 가능한 시간 단위(Scalable time unit)(STU) 및 절대 시간(Absolute time)(AT)이 있다. 예를 들어, 서브프레임들, 프레임들 및 하이퍼-프레임들은 FTU이고, 슬롯들 및 심볼들은 STU이다. 서브프레임들, 프레임들 및 하이퍼-프레임들은 각각 고정된 시간 길이, 예를 들어, 1ms, 10ms 및 10240ms로 구성된다. LTE와 달리, 차세대(예를 들어, 5G NR) 무선 통신 네트워크들에서의 슬롯 길이는 심볼 길이들의 차이들로 인해 정적이지 않다. 심볼 길이는 서브캐리어 간격(subcarrier spacing)(SCS)에 반비례하므로, 서브프레임 내의 슬롯들의 수는, 예를 들어, SCS에 따라 변할 수 있다.
5G NR 무선 통신 네트워크에서는, 슬롯-기반 스케줄링 및 비-슬롯-기반 스케줄링의 두 가지 상이한 스케줄링 메커니즘이 지원된다. 슬롯-기반 스케줄링의 경우, 각각의 슬롯은 PDCCH 기회(occasion)를 포함하기 때문에, 기지국(예를 들어, gNB)은 슬롯 당 기초하여 데이터 스케줄링을 수행할 수 있다. 다시 말해서, 2개의 데이터 스케줄링 간의 최단 시간 인터벌은 5G NR 무선 통신 네트워크들에서의 슬롯일 수 있으며, 이는 LTE 무선 통신 네트워크들에서의 서브프레임보다 작은 시간 입도(granularity)를 갖는다. 비-슬롯-기반 스케줄링 메커니즘의 경우, 데이터 스케줄링은 슬롯들과 함께 번들로 제공되지 않는다. UE는 UE가 모니터링해야 하는 시간 및 주파수 자원 할당 정보를 포함할 수 있는 UE-특정 제어 자원 세트(control resource set)(CORESET) 구성으로 구성되어야 한다. CORESET 구성은 또한 CORESET 모니터 주기도 포함한다. CORESET 모니터 주기는 심볼(들)로 이루어질 수 있다. 따라서, 기지국(예를 들어, eNB 또는 gNB)은 하나의 슬롯 내에서 2개 이상의 데이터 스케줄링을 수행할 수 있고, 또한 슬롯-기반 스케줄링보다 작은 시간 입도를 가질 수 있다. 슬롯-기반 스케줄링에서, UE는 또한 UE가 각각의 슬롯의 PDCCH 내에서 모니터링해야 하는 시간 및 주파수 자원 할당 정보를 지시하는 CORESET 구성으로 구성될 수 있다.
또한, 5G NR 무선 통신 네트워크들에서, DRX 파라미터들은 상이한 시간 단위들(예를 들어, FTU, STU 또는 AT)로 구성될 수 있다. 예를 들어, DRX 숏 사이클 타이머(drx-ShortCycleTimer), DRX 롱 사이클(drx - LongCycle), DRX ON 듀레이션 타이머(drx-onDurationTimer) 및 DRX 비활성 타이머(drx - InactivityTimer)는 AT(예를 들어, ms)에 의해 구성될 수 있다. 따라서, 5G NR 무선 통신 네트워크들에서, DRX 동작은 LTE 무선 통신 네트워크들에서의 DRX 동작보다 유연하다. 예를 들어, LTE 네트워크들에서, DRX 비활성 타이머는 PDCCH가 초기 업링크, 다운링크 또는 사이드링크 사용자 데이터 송신을 지시하는 서브프레임 후에 트리거될 수 있다. 표 I에 지시된 바와 같이, DRX 비활성 타이머는 psf로 구성된다. 5G NR 네트워크들에서, DRX 비활성 타이머는 밀리초(ms)로 구성될 수 있다. 따라서, DRX 동작의 세부 거동들이 그에 따라 조정되어야 한다. 예를 들어, 숏 DRX 사이클, 롱 DRX 사이클, ON 듀레이션 타이머 및 DRX 비활성 타이머의 시작 시간 및/또는 만료 시간이 다루어져야 한다.
LTE 네트워크들에서, ON 듀레이션 타이머는 다음의 두 공식 중 하나가 충족될 때 트리거될 것이다.
(1) 숏 DRX 사이클이 사용되고, [(SFN*10)+서브프레임 번호] 모듈로 (shortDRX-Cycle) = (drxStartOffset) 모듈로 (shortDRX-Cycle)
(2) 롱 DRX 사이클이 사용되고, [(SFN*10)+서브프레임 번호] 모듈로 (longDRX-Cycle) = drxStartOffset
여기서, SFN은 시스템 프레임 번호이다.
ON 듀레이션 타이머는 psf에 의해 구성되기 때문에, ON 듀레이션 타이머가 트리거될 때, ON 듀레이션 타이머의 시작 시간은 서브프레임의 시작부에 있다(각각의 서브프레임이 PDCCH를 포함하기 때문). 그러나, 5G NR 네트워크들에서의 ON 듀레이션 타이머는 ms에 의해 구성되며, ON 듀레이션 타이머의 실제 시작 시간은 몇 가지 가능한 시작 포지션들을 가질 수 있다.
본 출원의 구현들은 5G NR 네트워크들에서의 숏 DRX 사이클, 롱 DRX 사이클, ON 듀레이션 타이머 및 DRX 비활성 타이머 각각의 시작 시간 및 종료 시간을 다룬다.
5G NR 네트워크들에서는, 시스템 프레임 당 10개의 서브프레임, 서브프레임 당
Figure 112020038188688-pct00004
개의 슬롯, 슬롯 당
Figure 112020038188688-pct00005
개의 심볼이 있다. 다시 말해서, 서브프레임 당
Figure 112020038188688-pct00006
개의 심볼, 시스템 프레임 당
Figure 112020038188688-pct00007
개의 심볼이 있다.
도 1을 참조하면, UE는 CORESET의 위치(들)를 지시하기 위한 몇 개의 파라미터들을 포함하는 CORESET 구성으로 구성될 수 있다. 예를 들어, CORESET 구성은 CORESET에 대한 시작 심볼(CORESET-start-symb) 및 CORESET의 연속적인 시간 듀레이션(CORESET-time-duration)을 포함한다. 표 II는 본 출원에서 사용되는 파라미터들의 약어들 및 설명들을 포함한다.
Figure 112020038188688-pct00008
5G NR 무선 통신 네트워크들에서는, DRX 동작 동안, 기지국(예를 들어, gNB)이 다음의 타이머들 및 파라미터들: DRX 온 듀레이션 타이머(drx -onDurationTimer), DRX 비활성 타이머(drx - InactivityTimer), DRX 재송신 타이머(drx-RetransmissionTimerDL), DRX UL 재송신 타이머(drx -RetransmissionTimerUL), DRX 롱 사이클(drx - LongCycle), DRX 시작 오프셋(drx -StartOffset), DRX 숏 사이클(drx - ShortCycle), DRX 숏 사이클 타이머(drx -ShortCycleTimer), DRX 슬롯 오프셋(drx - SlotOffset), DRX DL HARQ RTT 타이머(drx-HARQ-RTT-TimerDL) 및 DRX UL HARQ RTT 타이머(drx - HARQ - RTT - TimerUL) 중 하나 이상을 갖는 DRX 구성을 제공할 수 있다.
사례 1: ON 듀레이션 타이머 시작 시간
도 1은, 본 출원의 예시적인 구현들에 따라, 다양한 ON 듀레이션 타이머 시작 시간 포지션들을 나타내는 프레임 구조를 예시하는 개략도이다.
일 구현에서, ON 듀레이션 타이머는 서브프레임의 시작부에서 시작될 수 있다. 다이어그램(100)에서, ON 듀레이션 타이머는 서브프레임1의 시작부에 있는 포지션 198A에서 시작될 수 있다. 이 구현에서는, 추가적인 파라미터가 UE에 시그널링되도록 요구되지 않는다.
일 구현에서, ON 듀레이션 타이머는 슬롯-기반 스케줄링에 적용되는 CORESET의 시작부에서 시작될 수 있다. 다이어그램(100)에서, ON 듀레이션 타이머는 CORESET(110)의 시작부에 있는 포지션 198B에서 시작될 수 있다. 이 구현에서, ON 듀레이션 타이머는 다음의 두 공식 중 적어도 하나가 충족될 때 시작될 수 있다.
(1) 숏 DRX 사이클이 사용되고, [(SFN*10)+서브프레임 번호] 모듈로 (drx-ShortCycle) = (drx-StartOffset) 모듈로 (drx-ShortCycle)이고, 슬롯 번호 = drxStartOffset_slot이고, 심볼 번호 = CORESET-start-symb임;
(2) 롱 DRX 사이클이 사용되고, [(SFN*10)+서브프레임 번호] 모듈로 (drx-LongCycle) = drx-StartOffset이고, 슬롯 번호 = drxStartOffset_slot이고, 심볼 번호 = CORESET-start-symb임;
여기서, drx-StartOffset은 LTE의 drxStartOffset과 동일하고, drxStartOffset_slot은 RRC 메시지(들)를 통해 gNB에 의해 구성되는 슬롯의 오프셋이다. 이 구현 하에서, ON 듀레이션 타이머의 시작은 CORESET 구성에 의해 암시적으로 시그널링될 수 있고, ON 듀레이션 타이머의 시작 시간은 CORESET 재구성에 기초하여 변할 수 있다.
일 구현에서, ON 듀레이션 타이머는 슬롯의 시작부에서 시작될 수 있다. 다이어그램(100)에서, ON 듀레이션 타이머는 서브프레임1의 슬롯1의 시작부에 있는 포지션 198C에서 시작될 수 있다. 이 구현에서, ON 듀레이션 타이머는 다음의 두 공식 중 적어도 하나가 충족될 때 시작될 수 있다.
(1) 숏 DRX 사이클이 사용되고, [(SFN*10)+서브프레임 번호] 모듈로 (drx-ShortCycle) = (drx-StartOffset) 모듈로 (drx-ShortCycle)이고, 슬롯 번호 = drxStartOffset_slot임
(2) 롱 DRX 사이클이 사용되고, [(SFN*10)+서브프레임 번호] 모듈로 (drx-LongCycle) = drx-StartOffset이고, 슬롯 번호 = drxStartOffset_slot임
여기서, drx-StartOffset은 LTE의 drxStartOffset과 동일하고, drxStartOffset_slot은 RRC 메시지(들)를 통해 기지국(예를 들어, eNB 또는 gNB)에 의해 구성되는 슬롯의 오프셋이다.
일 구현에서, ON 듀레이션 타이머는 비-슬롯-기반 스케줄링에 적용되는 CORESET의 시작부에서 시작될 수 있다. 다이어그램(100)에서, 온 듀레이션 타이머는 슬롯N의 CORESET(110N)의 시작부에 있는 포지션 198D에서 시작될 수 있다. 이 구현에서, ON 듀레이션 타이머는 다음의 공식들 중 적어도 하나가 충족될 때 시작될 수 있다.
(1) 숏 DRX 사이클이 사용되고, [(SFN*10)+서브프레임 번호] 모듈로 (drx-ShortCycle) = (drx-StartOffset) 모듈로 (drx-ShortCycle)이고, 슬롯 번호 = drxStartOffset_slot이고, 심볼 번호 = (CORESET-start-symb+n * CORESET-Monitor-periodicity)임;
(2) 롱 DRX 사이클이 사용되고, [(SFN*10)+서브프레임 번호] 모듈로 (drx-LongCycle) = drx-StartOffset이고, 슬롯 번호 = drxStartOffset_slot이고, 심볼 번호 = (CORESET-start-symb+n * CORESET-Monitor-periodicity)임;
여기서, drx-StartOffset은 LTE의 drxStartOffset과 동일하다. drxStartOffset_slot은 슬롯의 오프셋이고, n은 슬롯 내의 CORESET 번호이다. drxStartOffset_slot 및 n은 모두 RRC 메시지(들)를 통해 기지국(예를 들어, eNB 또는 gNB)에 의해 구성된다.
일부 구현들에서는, 다수의 CORESET들이 구성될 때, UE가 자동으로 DRX 동작을 취소/중단할 수 있는데, 이는 이 상황에서 전력 절약이 주요 관심사가 아닐 수 있기 때문이다. 일부 구현들에서는, UE-당 ON 듀레이션 타이머가 구성될 수 있고, CORESET 구성 및 그 대응하는 PDSCH에 관계없이 계속 실행될 수 있으며, ON 듀레이션 타이머는 그것이 만료될 때 중지될 것이다. 일부 구현들에서는, CORESET-당 ON 듀레이션 타이머가 구성될 수 있으며, 여기서, 캐시 CORESET은 ON 듀레이션 타이머와 연관될 수 있고, 모든 ON 듀레이션 타이머들이 중지될 때, UE는 슬립 상태에 있도록 허용된다.
사례 2: DRX 비활성 타이머 시작 시간
DRX 비활성 타이머는 PDCCH가 UE에 대한 초기 업링크, 다운링크 또는 사이드링크 사용자 데이터 송신을 지시한 후에 시작될 수 있다. 유연한 CORESET 구성들에 비추어, 5G NR 무선 통신 네트워크들은 슬롯-기반 및 비-슬롯-기반 스케줄링을 모두 지원할 수 있다. 따라서, DRX 비활성 타이머의 실제 시작 시간은 데이터 송신/수신을 지시하는 CORESET 내의 DCI/UCI(Uplink control information)와 관련될 수 있다.
도 2는, 본 출원의 예시적인 구현들에 따라, 데이터 스케줄링을 갖고 다양한 DRX 비활성 타이머 시작 시간 포지션들을 나타내는 프레임 구조를 예시하는 개략도이다.
일 구현에서, DRX 비활성 타이머는 DCI 송신을 지시하는 CORESET의 종료 후에 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 CORESET 종료 후 제1 심볼의 시작부에서 시작될 수 있다. 다이어그램(200)에서, DRX 비활성 타이머는 DCI 송신을 지시하는 CORESET(210)의 종료 직후인 포지션(298A)에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 CORESET(210)의 종료 직후에 제1 심볼의 시작부에서 시작된다.
일 구현에서, DRX 비활성 타이머는 DCI 송신을 갖는 PDCCH의 종료부에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 PDCCH의 종료 후 제1 심볼의 시작부에서 시작될 수 있다. 다이어그램(200)에서, DRX 비활성 타이머는 DCI 송신을 갖는 PDCCH(212)의 종료 직후인 포지션(298B)에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 PDCCH(212)의 종료 직후에 제1 심볼의 시작부에서 시작된다.
일 구현에서, DRX 비활성 타이머는 데이터 수신/송신의 슬롯의 종료 후에 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 동일한 슬롯 내에서 데이터 수신/송신의 슬롯의 종료 직후에 시작될 수 있다. 다이어그램(200)에서, DRX 비활성 타이머는 데이터 수신/송신(214)의 종료 직후인 포지션 298C에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 동일한 슬롯0 내의 데이터 수신/송신(214)의 종료 직후에 제1 심볼의 시작부에서 시작된다. DCI(220)는 DCI(220)와 동일한 슬롯0 내의 데이터 수신/송신(214)을 지시한다는 것에 유의해야 한다.
일 구현에서, DRX 비활성 타이머는 DCI 송신을 갖는 슬롯의 종료부에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 DCI 송신을 포함하는 슬롯의 종료 후 제1 심볼의 시작부에서 시작될 수 있다. 다이어그램(200)에서, DRX 비활성 타이머는 DCI(220)를 포함하는 슬롯0의 종료부에 있는 포지션 298D에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 DCI(220)를 포함하는 슬롯0의 종료 직후에 제1 심볼의 시작부에서 시작된다.
일 구현에서, DRX 비활성 타이머는 데이터 수신/송신의 종료부를 포함하는 서브프레임의 종료부에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 완료된 데이터 수신/송신을 포함하는 서브프레임의 종료 후 제1 심볼의 시작부에서 시작될 수 있다. 다이어그램(200)에서, DRX 비활성 타이머는 데이터 수신/송신(218)이 완료된 슬롯N을 포함하는 서브프레임1의 종료부에 있는 포지션 298E에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 데이터 수신/송신(218)이 완료된 슬롯N을 포함하는 서브프레임1의 종료 직후에 제1 심볼의 시작부에서 시작된다.
일 구현에서, DRX 비활성 타이머는 연속-슬롯의 데이터 수신/송신의 종료 후에 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 스케줄링된 연속-슬롯의 데이터 수신/송신 내에서 (예를 들어, PDSCH의 종료부에서) 데이터 수신/송신의 종료 후 제1 심볼의 시작부에서 시작될 수 있다. 다이어그램(200)에서, DRX 비활성 타이머는 데이터 수신/송신(216)의 종료 직후인 포지션 298F에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 슬롯1 내의 데이터 수신/송신(216)의 종료 직후에 제1 심볼의 시작부에서 시작된다. 이 구현에서, DCI(220)는 연속-슬롯의 데이터 수신/송신을 지시하며, 여기서 데이터 수신/송신을 위한 시간 인터벌은 시간 도메인에서 연속적인 다수의 슬롯들을 점유한다. 예를 들어, 다이어그램(200)에서, 기지국은 2개의 연속적인 슬롯0 및 슬롯1을 통해 PDSCH를 통한 데이터 수신을 지시하는 DCI(220)를 송신한다. 그 다음, DRX 비활성 타이머는 포지션 298F에서 연속-슬롯의 데이터 수신/송신의 종료부에서 PDSCH의 종료 직후에 시작된다. 예를 들어, DRX 비활성 타이머는 슬롯1 내에서 데이터 수신/송신(216)의 종료 직후에 제1 심볼의 시작부에서 시작된다.
일 구현에서, DRX 비활성 타이머는 크로스-슬롯의 데이터 수신/송신의 종료 후에 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 스케줄링된 크로스-슬롯의 데이터 수신/송신 내에서 데이터 수신/송신의 종료 후 제1 심볼의 시작부에서 시작될 수 있다.
다이어그램(200)에서, DRX 비활성 타이머는 DCI(222)에 의해 스케줄링된 데이터 수신/송신(218)의 종료 직후인 포지션 298G에서 시작될 수 있다. 예를 들어, DRX 비활성 타이머는 슬롯N 내의 데이터 수신/송신(218)의 종료 직후에 제1 심볼의 시작부에서 시작된다. 이 구현에서, DCI(222)는 크로스-슬롯의 데이터 수신/송신을 지시하며, 여기서 데이터 수신/송신은 시간 도메인에서 슬롯1에 바로 인접하지 않은 슬롯을 점유한다. 예를 들어, 다이어그램(200)에서, 기지국들은 슬롯N에서 PDSCH를 통해 데이터 수신을 지시하는 DCI(222)를 송신한다. 그 다음, DRX 비활성 타이머는 포지션 298G에서 크로스-슬롯의 데이터 수신/송신의 종료부에서 PDSCH의 종료 직후에 시작된다. 예를 들어, DRX 비활성 타이머는 슬롯N 내에서 데이터 수신/송신(218)의 종료 직후에 제1 심볼의 시작부에서 시작된다.
DRX 비활성 타이머가 실행되는 시간 인터벌 동안, UE는 기지국(예를 들어, eNB 또는 gNB)에 의해 구성된 PDCCH 및/또는 CORESET을 모니터링할 수 있다. UE가 데이터 송신/수신을 위해 스케줄링되는 경우, DRX 비활성 타이머는 재시작될 수 있다. 구현에서, 기지국은 DCI를 통해 각각의 스케줄링(DCI 송신)에 대해 DRX 비활성 타이머를 (재)시작할지 여부를 명시적으로 또는 암시적으로 지시할 수 있다. 다른 구현에서, 기지국이 DRX 비활성 타이머 스킵 지시와 함께 UE에 새로운 송신/수신을 스케줄링할 때, DRX 비활성 타이머는 (재)시작되지 않는다. 다른 구현에서, 기지국이 DRX 비활성 타이머 트리거 지시와 함께 UE에 새로운 송신/수신을 스케줄링할 때, DRX 비활성 타이머는 (재)시작된다. 또 다른 구현들에서, 기지국은 CORESET 구성 특정 DRX 비활성 타이머 길이를 구성할 수 있다. DRX 비활성 타이머의 최소값은 0일 수 있으며, 이는 UE가 기지국에 의해 구성된 특정 CORESET 구성들에 대해 DRX 비활성 타이머의 트리거를 스킵할 수 있음을 의미한다.
사례 3: DRX 비활성 타이머 만료 시간
LTE 네트워크들에서, UE는 DRX 비활성 타이머가 만료된 후 숏 DRX 사이클로 전환될 것이다. DRX 비활성 타이머는 UE가 DCI 지시를 수신하는 서브프레임의 종료부에서 트리거되고, 타이머는 psf에 의해 카운트되므로, 시작 시간 및 만료 시간이 서브프레임의 에지와 정렬된다. LTE 네트워크들과 달리, 5G NR 네트워크들은 상이한 슬롯 길이들을 지원할 수 있고, 데이터 스케줄링 및 타이머 구성들에서 더 유연하다. 따라서, DRX 비활성 타이머는 서브프레임의 에지들과 정렬되지 않은 타이밍 포지션들에서 만료될 수 있다.
DRX 비활성 타이머는 밀리초의 시간 단위를 가질 수 있지만, DRX 비활성 타이머의 실제 듀레이션은 정수 또는 부동 값들일 수 있다. 상기 사례 2에서 논의된 프레임 구조 및 다양한 DRX 비활성 타이머 시작 포지션들에 기초하여, 사례 3은 다양한 DRX 비활성 타이머 만료 포지션들을 포함한다. 또한, DRX 비활성 타이머가 정수(
Figure 112020038188688-pct00009
) 값 또는 부동(
Figure 112020038188688-pct00010
) 값으로 구성될 수 있으므로, 다양한 DRX 비활성 타이머 만료 포지션들이 아래의 도 3a 및 도 3b 및 도 4a 및 도 4b를 각각 참조하여 논의될 것이다.
도 3a 및 도 3b는, 본 출원의 예시적인 구현들에 따라,
Figure 112020038188688-pct00011
로 구성된 다양한 DRX 비활성 타이머 만료 시간 포지션들을 나타내는 서브프레임 구조들을 예시하는 개략도들이다. 도 3a 및 도 3b에 예시된 예들과 같이, 서브프레임은 4개의 슬롯을 포함하고, UE는 슬롯-기반 스케줄링에 의해 구성되어, UE는 각각의 슬롯의 PDCCH 내에서 CORESET을 모니터링하도록 구성된다. PDCCH는 각각의 슬롯의 시작부에 있을 수도 있고, 또는 각각의 슬롯에 대해 기지국에 의해 슬롯 내의 어느 곳에든 반-정적으로 할당될 수도 있다. 본 구현에서, 도 3a 및 도 3b를 참조하면, PDCCH는 각각의 슬롯의 시작부에 할당되고, DRX 비활성 타이머는
Figure 112020038188688-pct00012
=1ms로 구성된다. 상이한 DRX 비활성 타이머 구성 값들에 따라 결과들이 상이할 수 있다는 것에 유의해야 한다. 도 3a에 도시된 바와 같이, UE에 대한 DCI(320)는 서브프레임N의 슬롯0에서 수신된다. 상기 사례 2에서 논의된 바와 같이 트리거된 DRX 비활성 타이머의 다양한 시작 시간 포지션들에 기초하여, DCI(320)에 의해 트리거되는 DRX 비활성 타이머의 대응하는 만료 시간 포지션들이 몇 개 존재한다.
일 구현에서, DRX 비활성 타이머는 서브프레임N +1의 슬롯0(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00013
후임)의 CORESET의 종료 직후에, 예를 들어, 도 3a에 도시된 바와 같은 포지션 398A에서 만료될 수 있다.
일 구현에서, DRX 비활성 타이머는 서브프레임N +1의 슬롯0(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00014
후인 슬롯)의 PDCCH의 종료부에서, 예를 들어, 도 3a에 도시된 바와 같은 포지션 398B에서 만료될 수 있다.
일 구현에서, DCI가 DCI 송신과 동일한 슬롯 내에서 해당 데이터 수신/송신을 지시하는 경우, DRX 비활성 타이머는 슬롯(서브프레임N +1의 슬롯0(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00015
후임)) 내에서, 예를 들어, 도 3a에 도시된 바와 같은 포지션 398C에서 만료될 수 있다.
일 구현에서, DCI가 DCI 송신과 동일한 슬롯 내에서 해당 데이터 수신/송신을 지시하는 경우, DRX 비활성 타이머는 슬롯(서브프레임N +1의 슬롯0(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00016
후임))의 종료부에서, 예를 들어, 도 3b에 도시된 바와 같은 포지션 398C'에서 만료될 수 있다.
일 구현에서, DRX 비활성 타이머는 슬롯(예를 들어, 서브프레임N +1의 슬롯0(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00017
후임))의 종료부에서, 예를 들어, 도 3a에 도시된 바와 같은 포지션 398D에서 만료될 수 있다.
일 구현에서, DRX 비활성 타이머는 서브프레임(예를 들어, 서브프레임N +1(DCI 송신을 지시하는 서브프레임의
Figure 112020038188688-pct00018
후임))의 종료부에서, 예를 들어, 도 3a에 도시된 바와 같은 포지션 398E에서 만료될 수 있다.
일 구현에서, DCI가 연속-슬롯의 데이터 수신/송신(예를 들어, 서브프레임N의 슬롯0 및 슬롯1)을 지시하는 경우, DRX 비활성 타이머는 CORESET(예를 들어, 서브프레임N +1의 슬롯1) 내에서, 예를 들어, 도 3b에 도시된 바와 같은 포지션 398F에서 만료될 수 있다.
일 구현에서, DCI가 크로스-슬롯의 데이터 수신/송신을 지시하는 경우(예를 들어, 서브프레임N의 슬롯0 및 슬롯2), DRX 비활성 타이머는 슬롯 내에서(예를 들어, 서브프레임N+1의 슬롯1에서), 예를 들어, 도 3b에 도시된 바와 같은 포지션 398G에서 만료될 수 있다.
포지션들 398C, 398C', 398F 및 398G의 경우, DRX 비활성 타이머의 만료 시간은 데이터 수신/송신의 길이에 의존한다. 다시 말해서, DRX 비활성 타이머가 데이터 수신/송신의 종료 직후에 시작될 때, DRX 비활성 타이머의 만료 시간은 도 3a 및 도 3b에 예시된 바와 같이 데이터 수신/송신의 길이에 의존한다.
도 4a 및 도 4b는, 본 출원의 예시적인 구현들에 따라,
Figure 112020038188688-pct00019
로 구성된 다양한 DRX 비활성 타이머 만료 시간들을 나타내는 서브프레임 구조들을 예시하는 개략도들이다.
본 구현에서, 도 4a 및 도 4b를 참조하면, DRX 비활성 타이머는
Figure 112020038188688-pct00020
=0.5ms로 구성된다. 상이한 DRX 비활성 타이머 구성 값들에 따라 결과들이 상이할 수 있다는 것에 유의해야 한다. 도 4a에 도시된 바와 같이, UE에 대한 DCI(420)가 서브프레임N의 슬롯0에서 수신된다. 상기 사례 2에서 논의된 바와 같이 트리거된 DRX 비활성 타이머의 다양한 시작 시간 포지션들에 기초하여, DCI(420)에 의해 트리거되는 DRX 비활성 타이머의 대응하는 만료 시간 포지션들이 몇 개 존재한다.
일 구현에서, DRX 비활성 타이머는 서브프레임N의 슬롯2(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00021
후의 슬롯)의 CORESET의 종료 직후에, 예를 들어, 도 4a에 도시된 바와 같은 포지션 498A에서 만료될 수 있다.
일 구현에서, DRX 비활성 타이머는 서브프레임N의 슬롯2(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00022
후의 슬롯)의 PDCCH의 종료부에서, 예를 들어, 도 4a에 도시된 바와 같은 포지션 498B에서 만료될 수 있다.
일 구현에서, DCI가 DCI 송신과 동일한 슬롯 내에서 해당 데이터 수신/송신을 지시하는 경우, DRX 비활성 타이머는 슬롯(서브프레임N의 슬롯2(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00023
후임) 내에서, 예를 들어, 도 4a에 도시된 바와 같은 포지션 498C에서 만료될 수 있다.
일 구현에서, DCI가 DCI 송신과 동일한 슬롯 내에서 해당 데이터 수신/송신을 지시하는 경우, DRX 비활성 타이머는 슬롯(서브프레임N의 슬롯2(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00024
후임))의 종료부에서, 예를 들어, 도 4b에 도시된 바와 같은 포지션 498C'에서 만료될 수 있다.
일 구현에서, DRX 비활성 타이머는 슬롯(예를 들어, 서브프레임N의 슬롯2(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00025
후임))의 종료부에서, 예를 들어, 도 4a에 도시된 바와 같은 포지션 498D에서 만료될 수 있다.
일 구현에서, DRX 비활성 타이머는 슬롯(예를 들어, 서브프레임N +1의 슬롯1(DCI 송신을 지시하는 슬롯의
Figure 112020038188688-pct00026
후임)의 종료부에서, 예를 들어, 도 4a에 도시된 바와 같은 포지션 498E에서 만료될 수 있다.
일 구현에서, DCI가 연속-슬롯의 데이터 수신/송신을 지시하는 경우(예를 들어, 서브프레임N의 슬롯0 및 슬롯1), DRX 비활성 타이머는 CORESET(예를 들어, 서브프레임N의 슬롯3) 내에서, 예를 들어, 도 4b에 도시된 바와 같은 포지션 498F에서 만료될 수 있다.
일 구현에서, DCI가 크로스-슬롯의 데이터 수신/송신을 지시하는 경우(예를 들어, 서브프레임N의 슬롯0 및 슬롯2), DRX 비활성 타이머는 슬롯 내에서(예를 들어, 서브프레임N+1의 슬롯0에서), 예를 들어, 도 4b에 도시된 바와 같은 포지션 498G에서 만료될 수 있다.
포지션들 498C, 498C', 498F 및 498G의 경우, DRX 비활성 타이머의 만료 시간은 데이터 수신/송신의 길이에 의존한다. 다시 말해서, 데이터 수신/송신의 종료 직후에 DRX 비활성 타이머가 시작될 때, DRX 비활성 타이머의 만료 시간은 도 4a 및 도 4b에 예시된 바와 같이 데이터 수신/송신의 길이에 의존한다.
사례 4: DRX 비활성 타이머의 만료 시의 UE 거동
도 5는, 본 출원의 예시적인 구현들에 따라, DRX 비활성 타이머들의 만료에 대한 다양한 시간 인터벌들을 나타내는 서브프레임 구조를 예시하는 개략도이다.
다이어그램(500)에서, 구역 A는 CORESET(510)가 나타나기 전의 슬롯0의 시간 인터벌이다. 구역 A는 슬롯0의 시작부에서 시작하여, CORESET(510)의 시작부에서 종료된다. 이 시간 인터벌의 길이는 (CORESET-start-symb)*심볼 길이이다.
다이어그램(500)에서, 구역 B는 CORESET(510)의 시간 인터벌이다. 이 시간 인터벌의 길이는 (CORESET-time-duration)*심볼 길이이다.
다이어그램(500)에서, 구역 C는 CORESET(510)가 나타난 후의 PDCCH의 시간 인터벌이다. 이는 구역 C가 CORESET의 종료부에서 시작하여, PDCCH(512)의 종료부에서 종료된다는 것을 의미한다. 이 시간 인터벌의 길이는 PDCCH의 길이에서 구역 A 및 B의 시간 길이들을 뺀 것이다.
다이어그램(500)에서, 구역 D는 PDCCH 후의 슬롯의 시간 인터벌로서, 이는 PDCCH(512)의 종료부에서 시작하여, 슬롯0의 종료부에서 종료되며, 여기서 슬롯0은 UE에 의해 수신된 DCI를 포함하여 동일하다.
다이어그램(500)에서, 구역 E는 슬롯들의 시간 인터벌로서, 이는 PDCCH를 갖는 슬롯0을 제외하며, 슬롯0의 종료부에서 시작하여, 슬롯N의 종료부에서 종료된다.
구역 A의 경우, UE는 다음의 가능한 타이밍들에서 PDCCH/CORESET 모니터링을 중지하도록 구성될 수 있다.
1. DRX 비활성 타이머가 만료된 직후의 종료부.
2. 이전 슬롯의 종료부;
3. 이 슬롯의 CORESET의 종료부.
4. 이 PDCCH의 종료부;
5. 이 슬롯의 종료부;
6. UE가 비-슬롯-기반 스케줄링을 위한 CORESET 구성으로 구성되고, 이 슬롯이 비-슬롯-기반 스케줄링을 위한 CORESET을 포함하는 경우, 이 슬롯의 종료부;
7. 이 슬롯이 다른 CORESET(들)를 포함하는 경우, 이 슬롯의 종료부;
8. 이 서브프레임의 종료부;
9. UE가 비-슬롯-기반 스케줄링을 위한 CORESET 구성으로 구성되고, 이 서브프레임이 비-슬롯-기반 스케줄링을 위한 CORESET을 포함하는 경우, 이 서브프레임의 종료부;
10. 이 서브프레임이 다른 CORESET(들)를 포함하는 경우, 이 서브프레임의 종료부.
구역 B의 경우, UE는 다음의 가능한 타이밍들에서 PDCCH/CORESET 모니터링을 중지하도록 구성될 수 있다.
1. 이 슬롯의 CORESET의 종료부;
2. 이 PDCCH의 종료부;
3. 이 슬롯의 종료부;
4. UE가 비-슬롯-기반 스케줄링을 위한 CORESET 구성으로 구성되고, 이 슬롯이 비-슬롯-기반 스케줄링을 위한 CORESET을 포함하는 경우, 이 슬롯의 종료부;
5. 이 슬롯이 다른 CORESET(들)를 포함하는 경우, 이 슬롯의 종료부;
6. 이 서브프레임의 종료부;
7. UE가 비-슬롯-기반 스케줄링을 위한 CORESET 구성으로 구성되고, 이 서브프레임이 비-슬롯-기반 스케줄링을 위한 CORESET을 포함하는 경우, 이 서브프레임의 종료부;
8. 이 서브프레임이 다른 CORESET(들)를 포함하는 경우, 이 서브프레임의 종료부.
구역 C의 경우, UE는 다음의 가능한 타이밍들에서 PDCCH/CORESET 모니터링을 중지하도록 구성될 수 있다.
1. 이 PDCCH의 종료부;
2. 이 슬롯의 종료부;
3. UE가 비-슬롯-기반 스케줄링을 위한 CORESET 구성으로 구성되고, 이 슬롯이 비-슬롯-기반 스케줄링을 위한 CORESET을 포함하는 경우, 이 슬롯의 종료부;
4. 이 슬롯이 다른 CORESET(들)를 포함하는 경우, 이 슬롯의 종료부;
5. 이 서브프레임의 종료부;
6. UE가 비-슬롯-기반 스케줄링을 위한 CORESET 구성으로 구성되고, 이 서브프레임이 비-슬롯-기반 스케줄링을 위한 CORESET을 포함하는 경우, 이 서브프레임의 종료부;
7. 이 서브프레임이 다른 CORESET(들)를 포함하는 경우, 이 서브프레임의 종료부.
구역 D 및 E의 경우, UE는 다음의 가능한 타이밍들에서 PDCCH/CORESET 모니터링을 중지하도록 구성될 수 있다.
1. 이 슬롯의 종료부;
2. UE가 비-슬롯-기반 스케줄링을 위한 CORESET 구성으로 구성되고, 이 슬롯이 비-슬롯-기반 스케줄링을 위한 CORESET을 포함하는 경우, 이 슬롯의 종료부;
3. 이 슬롯이 다른 CORESET(들)를 포함하는 경우, 이 슬롯의 종료부;
4. 이 서브프레임의 종료부;
5. UE가 비-슬롯-기반 스케줄링을 위한 CORESET 구성으로 구성되고, 이 서브프레임이 비-슬롯-기반 스케줄링을 위한 CORESET을 포함하는 경우, 이 서브프레임의 종료부;
6. 이 서브프레임이 다른 CORESET(들)를 포함하는 경우, 이 서브프레임의 종료부.
비록 도 1, 도 2 및 도 5는 CORESET들(110, 210, 510)이 PDCCH들(112, 212, 512)에 각각 포함되어 있는 것으로 예시하지만, 다른 구현들에서, CORESET들(110, 210, 510)은 UE가 PDCCH들(112, 212 및 512)의 위치를 각각 찾을 수 있게 하는 자원(예를 들어, 시간 및 주파수) 할당 정보를 포함할 수 있다는 것에 유의하도록 한다. 이러한 경우에, CORESET들(110, 210, 510)은 PDCCH들(112, 212, 512)에 각각 포함되지 않을 수 있다.
도 6은 본 출원의 예시적인 구현에 따른 UE에 의한 흐름도이다. 도 6에서, 흐름도(600)는 동작들(682, 684, 686, 688, 690, 692 및 694)을 포함한다.
동작(682)에서, UE는, 수신 회로에 의해, DRX 시작 오프셋(drx-StartOffset) 및 DRX 슬롯 오프셋(drx-SlotOffset)을 갖는 라디오 자원 제어(RRC) 메시지를 수신한다.
동작(684)에서, UE는, 프로세싱 회로에 의해, drx-StartOffset에 기초하여 시작 서브프레임을 결정한다.
동작(686)에서, UE는, 프로세싱 회로에 의해, drx-SlotOffset에 기초하여 시작 서브프레임에서 DRX 온-듀레이션(drx-onDuration) 타이머의 시작 시간을 결정한다.
동작(688)에서, 숏 DRX 사이클이 사용되면, [(SFN×10)+서브프레임 번호] 모듈로 (drx-ShortCycle) = (drx-StartOffset) 모듈로 (drx-ShortCycle)일 때, 시스템 프레임 번호(SFN), 서브프레임 번호 및 숏 DRX 사이클(drx-ShortCycle)이 수신될 때, UE는, 프로세싱 회로에 의해, 시작 서브프레임의 시작부로부터 drx-SlotOffset 후에 drx-온 듀레이션 타이머를 시작한다.
동작(690)에서, 롱 DRX 사이클이 사용되면, [(SFN×10)+서브프레임 번호] 모듈로 (drx-LongCycle) = drx-StartOffset일 때, 시스템 프레임 번호(SFN), 서브프레임 번호 및 롱 DRX 사이클(drx-LongCycle)이 수신될 때, UE는, 프로세싱 회로에 의해, 시작 서브프레임의 시작부로부터 drx-SlotOffset 후에 drx-온 듀레이션 타이머를 시작한다.
동작(692)에서, UE는, 수신 회로에 의해, 물리적 다운링크 제어 채널(PDCCH)을 통한 새로운 송신의 지시를 수신한다.
동작(692)에서, UE는, 프로세싱 회로에 의해, PDCCH의 종료 후에, 제1 심볼에서 DRX 비활성 타이머(drx-InactivityTimer)를 시작한다.
도 7은 본 출원의 다양한 양태들에 따른 무선 통신을 위한 노드의 블록도를 예시한다. 도 7에 도시된 바와 같이, 노드(700)는 송수신기(720), 프로세서(726), 메모리(728), 하나 이상의 프리젠테이션 컴포넌트(734) 및 적어도 하나의 안테나(736)를 포함할 수 있다. 노드(700)는 또한 RF 스펙트럼 대역 모듈, 기지국 통신 모듈, 네트워크 통신 모듈 및 시스템 통신 관리 모듈, 입/출력(I/O) 포트들, I/O 컴포넌트들 및 전력 공급기(도 7에 명시적으로 도시되지는 않음)를 포함할 수 있다. 이들 컴포넌트들 각각은 하나 이상의 버스(740)를 통해 직접적으로 또는 간접적으로 서로 통신할 수 있다. 일 구현에서, 노드(700)는, 예를 들어, 도 1 내지 도 6을 참조하여 본 명세서에 설명된 다양한 기능들을 수행하는 UE 또는 기지국일 수 있다.
송신기(722)(송신 회로를 가짐) 및 수신기(724)(수신 회로를 가짐)를 갖는 송수신기(720)는 시간 및/또는 주파수 자원 파티셔닝 정보를 송신 및/또는 수신하도록 구성될 수 있다. 일부 구현들에서, 송수신기(720)는 사용 가능하고, 사용 가능하지 않고, 유연하게 사용 가능한 서브프레임들 및 슬롯 포맷들을 포함하되, 이에 제한되지 않는 상이한 타입들의 서브프레임들 및 슬롯들로 송신하도록 구성될 수 있다. 송수신기(720)는 데이터 및 제어 채널들을 수신하도록 구성될 수 있다.
노드(700)는 다양한 컴퓨터 판독 가능 매체를 포함할 수 있다. 컴퓨터 판독 가능 매체는 노드(700)에 의해 액세스될 수 있는 임의의 사용 가능한 매체일 수 있으며, 휘발성 및 비-휘발성 매체, 이동식 및 비-이동식 매체 모두를 포함할 수 있다. 비제한적인 예로서, 컴퓨터 판독 가능 매체는 컴퓨터 저장 매체 및 통신 매체를 포함할 수 있다. 컴퓨터 저장 매체는 컴퓨터 판독 가능 명령어들, 데이터 구조들, 프로그램 모듈들 또는 다른 데이터와 같은 정보를 저장하기 위한 임의의 방법 또는 기술로 구현된 휘발성 및 비-휘발성, 이동식 및 비-이동식 매체 모두를 포함한다.
컴퓨터 저장 매체는 RAM, ROM, EEPROM, 플래시 메모리 또는 다른 메모리 기술, CD-ROM, 디지털 다목적 디스크(digital versatile disks)(DVD) 또는 다른 광 디스크 스토리지, 자기 카세트들, 자기 테이프, 자기 디스크 스토리지 또는 다른 자기 저장 디바이스들을 포함한다. 컴퓨터 저장 매체는 전파형 데이터 신호를 포함하지 않는다. 통신 매체는 통상적으로 반송파 또는 다른 전송 메커니즘과 같은 변조된 데이터 신호로 컴퓨터 판독 가능 명령어들, 데이터 구조들, 프로그램 모듈들 또는 다른 데이터를 구체화하고, 임의의 정보 전달 매체를 포함한다. "변조된 데이터 신호"라는 용어는 신호에 정보를 인코딩하는 방식으로 설정되거나 변경된 그 특성들 중 하나 이상을 갖는 신호를 의미한다. 비제한적인 예로서, 통신 매체는 유선 네트워크 또는 직접-유선 연결과 같은 유선 매체, 및 음향, RF, 적외선 및 기타 무선 매체와 같은 무선 매체를 포함한다. 상기 중 임의의 것의 조합들 또한 컴퓨터 판독 가능 매체의 범위 내에 포함되어야 한다.
메모리(728)는 휘발성 및/또는 비-휘발성 메모리 형태의 컴퓨터 저장 매체를 포함할 수 있다. 메모리(728)는 이동식, 비-이동식 또는 그 조합일 수 있다. 예시적인 메모리는 고상 메모리, 하드 드라이브들, 광 디스크 드라이브들 등을 포함한다. 도 7에 예시된 바와 같이, 메모리(728)는, 실행될 때, 프로세서(726)(예를 들어, 프로세싱 회로)로 하여금, 예를 들어, 도 1 내지 도 6을 참조하여 본 명세서에 설명된 다양한 기능들을 수행하게 하도록 구성되는 컴퓨터 판독 가능한 컴퓨터 실행 가능 명령어들(732)(예를 들어, 소프트웨어 코드들)을 저장할 수 있다. 대안적으로, 명령어들(732)은 프로세서(726)에 의해 직접 실행 가능하지 않고, (예를 들어, 컴파일되고 실행될 때) 노드(700)로 하여금, 본 명세서에 설명된 다양한 기능들을 수행하게 하도록 구성될 수 있다.
프로세서(726)는 지능형 하드웨어 디바이스, 예를 들어, 중앙 처리 장치(CPU), 마이크로제어기, ASIC 등을 포함할 수 있다. 프로세서(726)는 메모리를 포함할 수 있다. 프로세서(726)는 송수신기(720), 기저 대역 통신 모듈 및/또는 네트워크 통신 모듈을 통해 메모리(728)로부터 수신된 데이터(730) 및 명령어들(732), 및 정보를 프로세싱할 수 있다. 프로세서(726)는 또한 안테나(736)를 통해 송신하기 위해 송수신기(720)에, 코어 네트워크에 송신하기 위해 네트워크 통신 모듈에 전송될 정보를 프로세싱할 수도 있다.
하나 이상의 프리젠테이션 컴포넌트(734)는 사람 또는 다른 디바이스에 데이터 지시들을 제시한다. 예시적인 프리젠테이션 컴포넌트들(734)은 디스플레이 디바이스, 스피커, 인쇄 컴포넌트, 진동 컴포넌트 등을 포함한다.
상기 설명으로부터, 본 출원에 설명된 개념들을 구현하기 위해 이러한 개념들의 범위를 벗어나지 않고 다양한 기술들이 사용될 수 있음이 명백하다. 더욱이, 개념들이 특정 구현들을 구체적으로 참조하여 설명되었지만, 본 기술분야의 통상의 기술자는 이러한 개념들의 범위를 벗어나지 않고 형태 및 세부 사항들에 변경들이 이루어질 수 있다는 것을 인식할 것이다. 이와 같이, 설명된 구현들은 모든 측면들에서 예시적이고 비제한적인 것으로 간주되어야 한다. 또한, 본 출원은 전술한 특정 구현들에 제한되지 않으며, 본 개시내용의 범위를 벗어나지 않고 많은 재구성들, 수정들 및 대체들이 가능하다는 것 또한 이해되어야 한다.

Claims (13)

  1. 불연속 수신(discontinuous reception)(DRX)을 위한 방법으로서,
    사용자 장비(User Equipment)(UE)의 수신 회로에 의해, DRX 시작 오프셋(drx-StartOffset) 및 DRX 슬롯 오프셋(drxStartOffset_slot)을 갖는 라디오 자원 제어(Radio Resource Control)(RRC) 메시지를 수신하는 단계;
    상기 UE의 프로세싱 회로에 의해, 상기 drx-StartOffset에 기초하여 시작 서브프레임을 결정하는 단계; 및
    상기 프로세싱 회로에 의해, 상기 drxStartOffset_slot에 기초하여 상기 시작 서브프레임에서 DRX 온-듀레이션 타이머(drx-onDurationTimer)의 시작 시간을 결정하는 단계 - 상기 drxStartOffset_slot은 실제 시간 단위를 가짐 -
    를 포함하는 방법.
  2. 제1항에 있어서,
    상기 수신 회로에 의해, 시스템 프레임 번호(system frame number)(SFN) 및 숏 DRX 사이클(drx-ShortCycle)을 수신하는 단계;
    상기 프로세싱 회로에 의해, 서브프레임 번호를 결정하는 단계; 및
    상기 프로세싱 회로에 의해, [(SFN×10)+서브프레임 번호] 모듈로 (drx-ShortCycle) = (drx-StartOffset) 모듈로 (drx-ShortCycle)일 때, 상기 시작 서브프레임의 시작부로부터 상기 drxStartOffset_slot 후에 상기 drx-onDurationTimer를 시작하는 단계
    를 추가로 포함하는 방법.
  3. 제1항에 있어서,
    상기 수신 회로에 의해, 시스템 프레임 번호(SFN) 및 롱 DRX 사이클(drx-LongCycle)을 수신하는 단계;
    상기 프로세싱 회로에 의해, 서브프레임 번호를 결정하는 단계; 및
    상기 프로세싱 회로에 의해, [(SFN×10)+서브프레임 번호] 모듈로 (drx-LongCycle) = drx-StartOffset일 때, 상기 시작 서브프레임의 시작부로부터 상기 drxStartOffset_slot 후에 상기 drx-onDurationTimer를 시작하는 단계
    를 추가로 포함하는 방법.
  4. 제1항에 있어서, 상기 실제 시간 단위는 하나 이상의 슬롯, 상기 하나 이상의 슬롯의 일부분에 대응하는 실제 시간 값인 방법.
  5. 제1항에 있어서, 상기 실제 시간 단위는 밀리초 또는 밀리초의 일부분인 방법.
  6. 제1항에 있어서,
    상기 수신 회로에 의해, 물리적 다운링크 제어 채널(physical downlink control channel)(PDCCH)을 통한 새로운 송신의 지시를 수신하는 단계; 및
    상기 프로세싱 회로에 의해, 상기 PDCCH 수신의 종료 후에, 제1 심볼에서 DRX 비활성 타이머(drx-InactivityTimer)를 시작 또는 재시작하는 단계
    를 추가로 포함하는 방법.
  7. 사용자 장비(UE)로서,
    DRX 시작 오프셋(drx-StartOffset) 및 DRX 슬롯 오프셋(drxStartOffset_slot)을 갖는 라디오 자원 제어(RRC) 메시지를 수신하도록 구성되는 수신 회로; 및
    프로세싱 회로
    를 포함하고, 상기 프로세싱 회로는,
    상기 drx-StartOffset에 기초하여 시작 서브프레임을 결정하고,
    상기 drxStartOffset_slot에 기초하여 상기 시작 서브프레임에서 DRX 온-듀레이션 타이머(drx-onDurationTimer)의 시작 시간을 결정하도록 - 상기 drxStartOffset_slot은 실제 시간 단위를 가짐 -
    구성되는 UE.
  8. 제7항에 있어서,
    상기 수신 회로는 시스템 프레임 번호(SFN) 및 숏 DRX 사이클(drx-ShortCycle)을 수신하도록 추가로 구성되고,
    상기 프로세싱 회로는,
    서브프레임 번호를 결정하고,
    [(SFN×10)+서브프레임 번호] 모듈로 (drx-ShortCycle) = (drx-StartOffset) 모듈로 (drx-ShortCycle)일 때, 상기 시작 서브프레임의 시작부로부터 상기 drxStartOffset_slot 후에 상기 drx-onDurationTimer를 시작하도록
    추가로 구성되는 UE.
  9. 제7항에 있어서,
    상기 수신 회로는 시스템 프레임 번호(SFN) 및 롱 DRX 사이클(drx-LongCycle)을 수신하도록 추가로 구성되고,
    상기 프로세싱 회로는,
    서브프레임 번호를 결정하고,
    [(SFN×10)+서브프레임 번호] 모듈로 (drx-LongCycle) = drx-StartOffset일 때, 상기 시작 서브프레임의 시작부로부터 상기 drxStartOffset_slot 후에 상기 drx-onDurationTimer를 시작하도록
    추가로 구성되는 UE.
  10. 제7항에 있어서, 상기 drxStartOffset_slot은 하나 이상의 슬롯, 상기 하나 이상의 슬롯의 일부분에 대응하는 실제 시간 값을 갖는 UE.
  11. 제7항에 있어서, 상기 drxStartOffset_slot은 밀리초 또는 밀리초의 일부분의 실제 시간 단위를 갖는 UE.
  12. 제7항에 있어서,
    상기 수신 회로는 물리적 다운링크 제어 채널(PDCCH)을 통한 새로운 송신의 지시를 수신하도록 추가로 구성되고,
    상기 프로세싱 회로는, 상기 PDCCH의 종료 후에, 제1 심볼에서 DRX 비활성 타이머(drx-InactivityTimer)를 시작하도록 추가로 구성되는 UE.
  13. 삭제
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