KR102423674B1 - 소스 드라이버, 및 이를 포함하는 디스플레이 장치 - Google Patents

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Abstract

실시 예는 기설정된 개수 단위로 데이터를 수신하고 기설정된 개수의 채널들에 대응하는 데이터를 저장하는 데이터 교환부, 및 데이터 교환부로부터 출력되는 데이터를 저장하는 래치부를 포함하고, 데이터 교환부는 복수의 그룹들 각각에 포함되는 2개의 채널들에 대응하는 데이터를 서로 교환하고, 복수의 그룹들에 대한 데이터 교환은 서로 독립적으로 이루어지고, 복수의 그룹들 각각은 기설정된 개수의 채널들 중에서 인접하는 2개의 채널들을 포함한다.

Description

소스 드라이버, 및 이를 포함하는 디스플레이 장치{A SOURCE DRIVER AND A DISPLAY DEVICE INCLUDING THE SAME}
실시 예는 소스 드라이버 및 이를 포함하는 디스플레이 장치에 관한 것이다.
일반적으로 디스플레이 장치, 예컨대, LCD(Liquid Crystal Display)는 전기장에 의해 분자 배열이 변하는 액정의 광학적 성질을 이용하여 액정 셀들의 광투과율을 조절함으로써, 영상을 표시하는 장치로서, 디스플레이 패널 및 디스플레이 패널에 데이터를 제공하는 소스 드라이버를 포함할 수 있다.
디스플레이하고자 하는 데이터를 패널의 데이터 라인으로 공급함에 있어서, 디스플레이 패널의 열화를 방지하기 위하여 극성 제어 신호에 따라 인접 채널 간 데이터를 교환하는 인버전 방식이 이용된다. 그리고 이를 위해서는 소스 드라이버는 데이터를 교환하기 위한 멀티플렉서가 각 채널마다 필요하므로, 각 채널이 형성되는 영역의 사이즈가 증가될 수 있고, 이에 따라 소스 드라이버 칩의 크기도 증가할 수 있다.
또한 채널의 열화를 방지하기 위한 인버전 방식은 단순히 2개의 인접 채널들 간의 데이터를 교환하는 것은 물론이고, 다양한 형태로 구현될 수 있다. 소스 드라이버는 고객사가 요구하는 다양한 형태의 인버전 방식을 수행할 수 있어야 한다.
실시 예는 칩 사이즈를 줄일 수 있고, 다양한 형태의 인버전 패턴을 구현할 수 있는 소스 드라이버, 및 이를 포함하는 디스플레이 장치를 제공한다.
실시 예에 따른 소스 드라이버는 기설정된 개수 단위로 데이터를 수신하고 기설정된 개수의 채널들에 대응하는 데이터를 저장하는 데이터 교환부; 및 상기 데이터 교환부로부터 출력되는 데이터를 저장하는 래치부를 포함하고, 상기 데이터 교환부는 복수의 그룹들 각각에 포함되는 2개의 채널들에 대응하는 데이터를 서로 교환하고, 상기 복수의 그룹들에 대한 상기 데이터 교환은 서로 독립적으로 이루어지고, 상기 복수의 그룹들 각각은 상기 기설정된 개수의 채널들 중에서 인접하는 2개의 채널들을 포함할 수 있다.
상기 데이터 교환부는 상기 기설정된 개수 단위로 데이터를 수신하여 상기 기설정된 개수의 채널들에 대응하는 데이터를 저장하는 복수의 저장부들; 및 상기 복수의 그룹들에 대응하는 스위치부들을 포함할 수 있고, 상기 스위치부들 각각은 상기 복수의 저장부들 중에서 상기 복수의 그룹들 중 대응하는 어느 하나에 포함된 2개의 채널들에 대응하는 2개의 저장부들에 저장된 데이터를 서로 교환하여 출력할 수 있다.
상기 복수의 저장부들은 제1 클럭 신호에 기초하여, 상기 기설정된 개수 단위의 데이터를 수신하는 제1 저장부들; 및 상기 제1 클럭 신호에 기초하여, 상기 제1 저장부들에 저장된 데이터를 수신하여 저장하는 제2 저장부들을 포함할 수 있다.
상기 스위치부들은 스위치 제어 신호들에 의하여 독립적으로 제어되는 복수의 인버전 스위치들을 포함할 수 있고, 상기 복수의 인버전 스위치들 각각은 상기 제1 저장부들 중 대응하는 어느 하나에 저장된 제1 데이터와 상기 제2 저장부들 중 대응하는 어느 하나에 저장된 제2 데이터를 수신하고, 상기 수신된 제1 및 제2 데이터를 출력하는 제1 출력 단자와 제2 출력 단자를 포함할 수 있다.
상기 복수의 인버전 스위치들 각각은 상기 스위치 제어 신호들 중 대응하는 어느 하나에 기초하여, 상기 수신된 제1 및 제2 데이터 중 어느 하나를 상기 제1 출력 단자로 출력하고, 상기 수신된 제1 및 제2 데이터 중 나머지 다른 하나를 상기 제2 출력 단자로 출력할 수 있다.
상기 스위치부들 각각은 제2 클럭 신호에 기초하여, 상기 복수의 인버전 스위치들 각각의 제1 출력 단자로부터 출력되는 데이터를 저장하는 제3 저장부; 및
상기 제2 클럭 신호에 기초하여, 상기 복수의 인버전 스위치들 각각의 제2 출력 단자로부터 출력되는 데이터를 저장하는 제4 저장부를 더 포함할 수 있다.
상기 스위치부들 각각은 상기 복수의 인버전 스위치들에 대응하는 멀티플렉서들을 더 포함하고, 상기 멀티플렉서들 각각은 선택 신호에 기초하여 상기 제3 저장부에 저장된 데이터와 상기 제4 저장부에 저장된 데이터 중 어느 하나를 선택적으로 출력할 수 있다.
상기 제1 클럭 신호에 기초하여 상기 멀티플렉서들로부터 출력되는 데이터를 저장하고, 상기 래치부로 출력하는 저장부들을 더 포함할 수 있다.
상기 소스 드라이버는 상기 래치부로부터 출력되는 데이터의 전압 레벨을 변환하는 레벨 쉬프터부; 상기 레벨 쉬프터부의 출력을 아날로그 신호로 변환하는 디지털-아날로그 변환부; 및 상기 디지털-아날로그 변환부로부터 출력되는 아날로그 신호를 증폭하고, 증폭된 아날로그 신호를 출력하는 출력부를 더 포함할 수 있다.
다른 실시 예에 따른 소스 드라이버는 3개 단위로 데이터를 수신하고, 수신된 데이터를 순차로 저장하는 제1 내지 제6 저장부들; 상기 제1 저장부에 저장된 제1 데이터와 상기 제2 저장부에 저장된 제2 데이터를 수신하는 제1 인버전 스위치; 상기 제3 저장부에 저장된 제3 데이터와 상기 제4 저장부에 저장된 제4 데이터를 수신하는 제2 인버전 스위치; 상기 제5 저장부에 저장된 제5 데이터와 상기 제6 저장부에 저장된 제6 데이터를 수신하는 제3 인버전 스위치; 상기 제1 인버전 스위치에 접속되는 제7 저장부와 제8 저장부; 상기 제2 인버전 스위치에 접속되는 제9 저장부와 제10 저장부; 및 상기 제3 인버전 스위치에 접속되는 제11 저장부와 제12 저장부를 포함하고, 상기 제1 인버전 스위치는 제1 스위치 제어 신호에 기초하여 상기 제1 데이터를 상기 제7 및 제8 저장부들 중 어느 하나에 출력하고, 상기 제2 데이터를 상기 제7 및 제9 저장부들 중 나머지 다른 하나에 출력하고, 상기 제2 인버전 스위치는 제2 스위치 제어 신호에 기초하여 상기 제3 데이터를 상기 제9 및 제10 저장부들 중 어느 하나에 출력하고, 상기 제4 데이터를 상기 제9 및 제10 저장부들 중 나머지 다른 하나에 출력하고, 상기 제3 인버전 스위치는 제3 스위치 제어 신호에 기초하여 상기 제5 데이터를 상기 제11 및 제12 저장부들 중 어느 하나에 출력하고, 상기 제6 데이터를 상기 제11 및 제12 저장부들 중 나머지 다른 하나에 출력할 수 있다.
상기 제1 내지 제3 스위치 제어 신호들은 서로 독립적으로 제어될 수 있다.
상기 제1 저장부는 제1 클럭 신호에 기초하여 상기 제4 저장부에 저장된 데이터를 수신하여 저장하고, 상기 제2 저장부는 상기 제1 클럭 신호에 기초하여 상기 제5 저장부에 저장된 데이터를 수신하여 저장하고, 상기 제3 저장부는 상기 제1 클럭 신호에 기초하여 상기 제6 저장부에 저장된 데이터를 수신하여 저장할 수 있다.
상기 제7 내지 제12 저장부들 각각은 제2 클럭 신호에 기초하여 상기 제1 내지 제4 인버전 스위치들의 출력들 중 대응하는 어느 하나를 저장할 수 있다.
다른 실시 예에 따른 소스 드라이버는 선택 신호에 기초하여 상기 제7 및 제8 저장부들 중 어느 하나에 저장된 데이터를 출력하는 제1 멀티플렉서; 상기 선택 신호에 기초하여 상기 제9 및 제10 저장부들 중 어느 하나에 저장된 데이터를 출력하는 제2 멀티 플렉서; 및 상기 선택 신호에 기초하여, 상기 제11 및 제12 저장부들 중 어느 하나에 저장된 데이터를 출력하는 제3 멀티 플렉서를 더 포함할 수 있다.
다른 실시 예에 따른 소스 드라이버는 상기 제1 멀티플렉서의 출력을 수신하고 저장하는 제13 저장부; 상기 제2 멀티플렉서의 출력을 수신하고 저장하는 제14 저장부; 및 상기 제3 멀티플렉서의 출력을 수신하고 저장하는 제15 저장부를 더 포함할 수 있다.
다른 실시 예에 따른 소스 드라이버는 상기 제13 내지 제15 저장부들에 저장된 데이터를 순차적으로 저장하는 래치부; 상기 래치부로부터 출력되는 데이터의 전압 레벨을 변환하는 레벨 쉬프터부; 상기 레벨 쉬프터부의 출력을 아날로그 신호로 변환하는 디지털-아날로그 변환부; 및 상기 디지털-아날로그 변환부로부터 출력되는 아날로그 신호를 증폭하고, 증폭된 아날로그 신호를 출력하는 출력부를 더 포함할 수 있다.
다른 실시 예에 따른 소스 드라이버는 3개 단위로 데이터를 상기 제4 내지 제6 저장부들에 제공하는 데이터 수신부를 더 포함할 수 있다.
상기 래치부는 복수의 제1 래치들을 포함하는 제1 래치부; 복수의 제2 래치들을 포함하는 제2 래치부를 포함하고, 상기 제1 래치들은 제1 래치 인에이블 신호에 기초하여 상기 제13 내지 제15 저장부들에 저장된 데이터들을 순차적으로 샘플링할 수 있고, 샘플링된 데이터들을 저장하고, 상기 제2 래치들 각각은 제2 래치 인에이블 신호에 기초하여 상기 제1 래치들 중 대응하는 어느 하나에 저장된 데이터를 저장하고, 저장된 데이터를 상기 레벨 쉬프터부로 출력할 수 있다.
상기 제1 내지 제3 스위치 제어 신호들, 및 상기 제1 및 제2 클럭 신호들은 상기 데이터 수신부로부터 제공될 수 있다.
실시 예에 따른 디스플레이 장치는 게이트 라인들, 데이터 라인들, 상기 게이트 라인들과 상기 데이터 라인들에 연결되고 행과 열을 이루는 매트릭스 형태로 배열되는 화소들을 포함하는 디스플레이 패널; 상기 데이터 라인들을 구동하기 위한 소스 드라이버; 및 상기 게이트 라인들을 구동하기 위한 게이트 드라이버를 포함하고, 상기 소스 드라이버는 상술한 실시 예들 중 어느 하나일 수 있다.
실시 예는 칩 사이즈를 줄일 수 있고, 다양한 형태의 인버전 패턴을 구현할 수 있다.
도 1은 실시 예에 따른 소스 드라이버의 구성도를 나타낸다.
도 2는 도 1에 도시된 데이터 교환부의 일 실시 예를 나타낸다.
도 3은 디스플레이 패널의 기설정된 인버전 패턴을 나타낸다.
도 4는 도 1에 도시된 데이터 교환부의 동작에 관한 타이밍도를 나타낸다.
도 5는 실시 예에 따른 디스플레이 장치를 나타낸다.
이하 상기의 목적을 구체적으로 실현할 수 있는 본 발명의 실시 예를 첨부한 도면을 참조하여 설명한다.
실시 예의 설명에 있어서, 각 element의 " 상(위) 또는 하(아래)(on or under)"에 형성되는 것으로 기재되는 경우에 있어, 상(위) 또는 하(아래)(on or under)는 두 개의 element가 서로 직접(directly)접촉되거나 하나 이상의 다른 element가 상기 두 개의 element 사이에 배치되어(indirectly) 형성되는 것을 모두 포함한다. 또한 "상(위) 또는 하(아래)(on or under)"으로 표현되는 경우 하나의 element를 기준으로 위쪽 방향뿐만 아니라 아래쪽 방향의 의미도 포함할 수 있다.
또한, 이하에서 이용되는 “제1” 및 “제2”, “상/상부/위” 및 “하/하부/아래” 등과 같은 관계적 용어들은 그런 실체 또는 요소들 간의 어떠한 물리적 또는 논리적 관계 또는 순서를 반드시 요구하거나 내포하지는 않으면서, 어느 한 실체 또는 요소를 다른 실체 또는 요소와 구별하기 위해서만 이용될 수도 있다. 또한 동일한 참조 번호는 도면의 설명을 통하여 동일한 요소를 나타낸다.
또한, 이상에서 기재된 "포함하다", "구성하다", 또는 "가지다" 등의 용어는, 특별히 반대되는 기재가 없는 한, 해당 구성 요소가 내재될 수 있음을 의미하는 것이므로, 다른 구성 요소를 제외하는 것이 아니라 다른 구성 요소를 더 포함할 수 있는 것으로 해석되어야 한다. 또한 이상에서 기재된 "대응하는" 등의 용어는 "대향하는" 또는 "중첩되는" 의미들 중 적어도 하나를 포함할 수 있다.
도 1은 실시 예에 따른 소스 드라이버(100)의 구성도를 나타낸다.
도 1을 참조하면, 소스 드라이버(100)는 데이터 수신부(110), 데이터 교환부(120), 래치부(130), 레벨 쉬프터부(140), 디지털-아날로그 변환부(150), 및 출력부(160)를 포함할 수 있다.
데이터 수신부(110)는 타이밍 컨트롤러(미도시)로부터 수신되는 데이터, 예컨대, R, G, B 영상 데이터를 수신하고, 수신된 데이터를 저장한다.
또한 데이터 수신부(110)는 타이밍 컨트롤러(미도시)로부터 수신되는 제어 신호, 예컨대, 스위치 제어 신호들(SW1 내지 SW3), 클럭 신호들(CLK1, CLK2), 래치인에이블 신호들(En1, En2)등을 수신할 수 있으나, 이에 한정되는 것은 아니다.
데이터 교환부(120)는 데이터 수신부(110)로부터 기설정된 채널 개수에 대응되는 기설정된 채널 개수의 데이터를 수신하고, 수신된 기설정된 채널 개수의 데이터를 저장한다.
여기서 채널(channel)은 디스플레이 패널의 채널, 또는 소스 드라이버의 데이터 출력 라인을 의미할 수 있다.
예컨대, 데이터 교환부(120)는 데이터 수신부(110)로부터 기설정된 개수 단위로 기설정된 개수의 채널들에 대응하는 데이터를 수신하고, 수신된 데이터를 저장할 수 있다.
예컨대, 데이터 교환부(120)는 데이터 수신부(110)로부터 3개 단위(예컨대, R, G, B 데이터)로 6개 채널들에 대응하는 6개의 데이터를 수신할 수 있고, 수신된 6개의 데이터를 저장할 수 있다.
데이터 교환부(120)는 수신된 기설정된 개수의 채널들 중에서 적어도 인접하는 2개의 채널들에 대응하는 데이터를 서로 교환하고, 교환된 결과에 따른 데이터를 출력한다.
데이터 교환부(120)는 복수의 그룹들 각각에 대하여 독립적으로 데이터를 서로 교환하는 인버전 동작을 수행할 수 있다. 예컨대, 복수의 그룹들 각각은 기설정된 개수의 채널들 중에서 인접하는 2개의 채널들을 포함할 수 있다.
예컨대, 데이터 교환부(120)는 데이터 수신부(110)로부터 수신하여 저장된 데이터 중에서 복수의 그룹들 각각에 포함되는 2개의 채널들에 대응하는 데이터를 서로 교환할 수 있다. 이때 복수의 그룹들에 대한 데이터 교환부(120)의 데이터 교환은 서로 독립적으로 이루어질 수 있다.
예컨대, 데이터 교환부(120)는 복수의 저장부들(예컨대, 121-1 내지 121-6), 및 복수의 스위치부들(예컨대, 122-1 내지 122-3)을 포함하는 인버전부(122), 및 데이터 수신부로부터 제어 신호들을 수신하고 수신된 제어 신호들(예컨대, SW1 내지 SW3, CLK1, CLK2)을 인버전부(122)에 제공하는 제어부(124)를 포함할 수 있다.
다른 실시 예에서는 제어부(124)가 데이터 교환부(120)에 포함되지 않고, 별도로 구성될 수도 있다. 또 다른 실시 예에서는 제어부(124)가 생략되고, 제어 신호들은 데이터 수신부로부터 데이터 교환부(120)의 복수의 저장부들(예컨대, 121-1 내지 121-6)과 복수의 스위치부들(예컨대, 122-1 내지 122-3)에 직접 제공될 수도 있다.
예컨대, 데이터 교환부(120)는 제1 내지 제6 저장부들(121-1 내지 121-6) 및 제1 내지 제3 스위치부들(122-1 내지 122-3)을 포함할 수 있으나, 그 개수가 이에 한정되는 것은 아니다.
복수의 저장부들(예컨대, 121-1 내지 121-6)은 기설정된 개수 단위로 데이터를 수신하여 기설정된 개수의 채널들에 대응하는 데이터를 저장할 수 있다.
예컨대, 복수의 저장부들(예컨대, 121-1 내지 121-6)은 데이터 수신부(110)로부터 3개 단위로 수신되는 데이터(D1 내지 D3)를 저장할 수 있다.
예컨대, 복수의 저장부들은 제1 클럭 신호(CLK1)에 기초하여, 기설정된 개수 단위의 데이터를 수신하는 저장부들(121-4 내지 121-6), 및 제1 클럭 신호에 기초하여 저장부들(121-4 내지 121-6)에 저장된 데이터를 수신하여 저장하는 저장부들(121-1 내지 121-3)을 포함할 수 있다.
복수의 스위치부들(예컨대, 122-1 내지 122-3)은 복수의 그룹들에 대응될 수 있다.
복수의 스위치부들 각각은 복수의 저장부들 중에서 복수의 그룹들 중 대응하는 어느 하나에 포함된 2개의 채널들에 대응하는 2개의 저장부들에 저장된 데이터를 서로 교환하여 출력할 수 있다.
복수의 스위치부들(예컨대, 122-1 내지 122-3) 각각은 복수의 저장부들 중에서 인접하는 2개의 저장부들(예컨대, 121-1과 121-2, 121-3와 121-4, 121-5과 121-6)의 데이터를 독립적으로 교환하거나 교환하지 않을 수 있다.
예컨대, 복수의 스위치부들(예컨대, 122-1 내지 122-3) 각각은 복수의 저장부들(예컨대, 121-1과 121-2, 121-3와 121-4, 121-5과 121-6) 중에서 적어도 한 쌍의 저장부들의 데이터를 선택적으로 교환할 수 있다.
도 2는 도 1에 도시된 데이터 교환부(120)의 일 실시 예를 나타낸다.
도 2를 참조하면, 데이터 교환부(120)는 제1 내지 제6 저장부들(121-1 내지 121-6), 제1 내지 제3 인버전 스위치들(210 내지 230), 제7 내지 제12 저장부들(311 내지 316), 제1 내지 제3 멀티플렉서들(321 내지 323), 제13 내지 제15 저장부들(331 내지 333)을 포함할 수 있다.
제1 클럭 신호(CLK1)에 응답하여 제4 내지 제6 저장부들(121-4 내지 121-6)은 데이터 수신부(110)로부터 3개 단위로 데이터(D1 내지 D3)를 수신하고, 수신된 데이터(R1, G1, B1)를 저장할 수 있다.
제1 클럭 신호(CLK)에 응답하여 제1 내지 제3 저장부들(121-1 내지 121-3) 각각은 제4 내지 제6 저장부들(121-4 내지 121-6) 중 대응하는 어느 하나에 저장된 데이터를 수신하여 저장할 수 있다.
예컨대, 데이터 수신부(110)로부터 수신되는 데이터(D1)는 제1 클럭 신호(CLK1)에 응답하여 제4 저장부(121-4) 및 제1 저장부(121-1)에 순차적으로 저장될 수 있다.
예컨대, 제1 클럭 신호에 기초하여 제1 저장부(121-1)는 제4 저장부(121-1)에 저장된 데이터를 수신하여 저장할 수 있다.
또한 예컨대, 데이터 수신부(110)로부터 수신되는 데이터(D2)는 제1 클럭 신호(CLK1)에 응답하여 제5 저장부(121-5) 및 제2 저장부(121-2)에 순차적으로 저장될 수 있다.
예컨대, 제1 클럭 신호에 기초하여 제2 저장부(121-2)는 제5 저장부(121-5)에 저장된 데이터를 수신하여 저장할 수 있다.
또한 예컨대, 데이터 수신부(110)로부터 수신되는 데이터(D3)는 제1 클럭 신호(CLK1)에 응답하여 제6 저장부(121-6) 및 제3 저장부(121-3)에 순차적으로 저장될 수 있다.
예컨대, 제1 클럭 신호에 기초하여 제3 저장부(121-3)는 제6 저장부(121-6)에 저장된 데이터를 수신하여 저장할 수 있다.
복수의 스위치부들(예컨대, 122-1 내지 122-3) 각각은 인버전 스위치(210, 220, 또는 230), 2개의 제3 저장부들(311과 312, 313과 314, 또는 315와 316), 멀티플렉서(321, 322, 또는 323), 및 제4 저장부(331, 332, 또는 333)를 포함할 수 있다.
복수의 인버전 스위치들(210 내지 230)은 스위치 제어 신호들(SW1 내지 SW3)에 의하여 독립적으로 제어될 수 있다.
복수의 인버전 스위치들(210 내지 230) 각각은 저장부들(121-1 내지 121-3) 중 대응하는 어느 하나에 저장된 데이터(R2, G2, 또는 B2)와 저장부들(121-4 내지 121-6) 중 대응하는 어느 하나에 저장된 데이터(R1, G1, 또는 B1)를 수신하고, 수신된 데이터를 출력하는 제1 출력 단자(211, 221, 231)와 제2 출력 단자(212, 222, 232)를 포함할 수 있다.
복수의 인버전 스위치들(210 내지 230) 각각은 스위치 제어 신호들(SW1 내지 SW3) 중 대응하는 어느 하나에 기초하여, 수신된 데이터(R2, G2, B2)와 데이터(R1, G1, 또는 B1) 중 어느 하나를 제1 출력 단자(211, 221, 231)로 출력할 수 있고, 수신된 데이터(R2, G2, B2)와 데이터(R1, G1, 또는 B1) 중 나머지 다른 하나를 제2 출력 단자(212, 222, 232)로 출력할 수 있다.
저장부(311, 313, 또는 315)는 제2 클럭 신호(CLK2)에 기초하여 인버전 스위치들(210 내지 230) 각각의 제1 출력 단자(211, 221, 231)로부터 출력되는 데이터를 저장할 수 있고, 저장부(312, 314, 316)는 제2 클럭 신호(CLK2)에 기초하여 인버전 스위치들(210 내지 230) 각각의 제2 출력 단자(212, 222, 232)로부터 출력되는 데이터를 저장할 수 있다.
멀티플렉서들(321, 322,323) 각각은 선택 신호(SEL)에 기초하여 저장부(311, 313, 또는 315)에 저장된 데이터와 저장부(312, 314, 316)에 저장된 데이터 중 어느 하나를 선택적으로 출력할 수 있다.
저장부들(331 내지 333)은 제1 클럭 신호(CLK1)에 기초하여 멀티플렉서들(321,322,323)로부터 출력되는 데이터를 저장하고, 래치부(130)로 출력할 수 있다.
제1 인버전 스위치(210)는 제1 저장부(121-1)에 저장된 제1 데이터(R2), 및 제2 저장부(121-2)에 저장된 제2 데이터(G2)를 수신하고, 제1 스위치 제어 신호(SW1)에 기초하여 제1 데이터(R2)를 제1 및 제2 출력단들(211, 212) 중 어느 하나로 출력하고, 제2 데이터(G2)를 제1 및 제2 출력단들(211, 212) 중 나머지 다른 하나로 출력할 수 있다.
제2 인버전 스위치(220)는 제3 저장부(121-3)에 저장된 제3 데이터(B2), 및 제4 저장부(121-4)에 저장된 제4 데이터(R1)를 수신하고, 제2 스위치 제어 신호(SW2)에 기초하여 제3 데이터(B2)를 제3 및 제4 출력단들(221, 222) 중 어느 하나로 출력하고, 제4 데이터(R1)를 제3 및 제4 출력단들(221, 222) 중 나머지 다른 하나로 출력할 수 있다.
제3 인버전 스위치(230)는 제5 저장부(121-5)에 저장된 제5 데이터(G1), 및 제6 저장부(121-6)에 저장된 제6 데이터(B1)를 수신하고, 제3 스위치 제어 신호(SW3)에 기초하여 제5 데이터(G1)를 제5 및 제6 출력단들(231, 232) 중 어느 하나로 출력하고, 제6 데이터(B1)를 제5 및 제6 출력단들(231, 232) 중 나머지 다른 하나로 출력할 수 있다.
제7 내지 제12 저장부들(311 내지 316)은 제2 클럭 신호(CLK2)에 기초하여, 제1 내지 제6 출력단들(211,212,221,222,231,232) 중 대응하는 어느 하나로부터 출력되는 데이터를 저장할 수 있다. 예컨대, 제2 클럭 신호(CLK2)의 주기는 제1 클럭 신호(CLK1)의 주기보다 클 수 있다. 또는 제1 클럭 신호(CLK1)의 주파수는 제2 클럭 신호(CLK2)의 주파수보다 클 수 있다.
예컨대, 제7 저장부(311)는 제2 클럭 신호(CLK)에 기초하여 제1 인버전 스위치(210)의 제1 출력단(211)으로부터 출력되는 데이터를 저장할 수 있다.
예컨대, 제8 저장부(312)는 제2 클럭 신호(CLK)에 기초하여 제1 인버전 스위치(210)의 제2 출력단(212)으로부터 출력되는 데이터를 저장할 수 있다.
예컨대, 제9 저장부(313)는 제2 클럭 신호(CLK)에 기초하여 제2 인버전 스위치(220)의 제3 출력단(221)으로부터 출력되는 데이터를 저장할 수 있다.
예컨대, 제10 저장부(314)는 제2 클럭 신호(CLK)에 기초하여 제2 인버전 스위치(220)의 제4 출력단(222)으로부터 출력되는 데이터를 저장할 수 있다.
예컨대, 제11 저장부(315)는 제2 클럭 신호(CLK)에 기초하여 제3 인버전 스위치(230)의 제5 출력단(231)으로부터 출력되는 데이터를 저장할 수 있다.
예컨대, 제12 저장부(316)는 제2 클럭 신호(CLK)에 기초하여 제3 인버전 스위치(230)의 제6 출력단(232)으로부터 출력되는 데이터를 저장할 수 있다.
제1 내지 제3 멀티플렉서들(321 내지 323) 각각은 선택 제어 신호(SEL)에 기초하여, 홀수 데이터들(S1, S3, S5) 중 대응하는 어느 하나와 짝수 데이터들(S2, S4, S6) 중 대응하는 어느 하나 중에서 선택된 어느 하나를 출력할 수 있다.
여기서 홀수 데이터들은 제7 내지 제12 저장부들(311 내지 316)의 홀수 번째 저장부들(311, 313, 315)에 저장된 데이터일 수 있다. 짝수 데이터들은 제7 내지 제12 저장부들(311 내지 316)의 홀수 번째 저장부들(312, 314, 316)에 저장된 데이터일 수 있다.
예컨대, 제1 멀티플렉서(321)는 선택 신호(SEL)에 기초하여, 제7 저장부(311)에 저장된 데이터(S1)와 제10 저장부(314)에 저장된 데이터(S4) 중 어느 하나를 출력할 수 있다.
예컨대, 제2 멀티플렉서(322)는 선택 신호(SEL)에 기초하여, 제8 저장부(312)에 저장된 데이터(S2)와 제11 저장부(311)에 저장된 데이터(S5) 중 어느 하나를 출력할 수 있다.
예컨대, 제3 멀티플렉서(323)는 선택 신호(SEL)에 기초하여, 제9 저장부(313)에 저장된 데이터(S3)와 제12 저장부(316)에 저장된 데이터(S6) 중 어느 하나를 출력할 수 있다.
제13 내지 제15 저장부들(331 내지 333)은 제1 클럭 신호(CLK1)에 기초하여, 제1 내지 제3 멀티플렉서들(331 내지 333) 중 대응하는 어느 하나로부터 출력되는 데이터를 저장할 수 있다.
상술한 제1 내지 제15 저장부들(121-1 내지 121-6, 311 내지 316, 331 내지 333) 각각은 플립플롭으로 구현될 수 있으나, 이에 한정되는 것은 아니며, 데이터 저장부의 기능을 하는 것이면 충분하다.
래치부(130)는 데이터 교환부(120)로부터 출력되는 데이터를 저장할 수 있다.
래치부(130)는 제1 래치부(131) 및 제2 래치부(132)를 포함할 수 있다.
제1 래치부(131)는 제1 래치 인에이블 신호(En1)에 기초하여, 제13 내지 제15 저장부들(331 내지 333)에 저장된 데이터들(DAT1 내지 DAT3)을 순차적으로 저장할 수 있다.
예컨대, 제1 래치부(131)는 복수의 제1 래치들(131-1 내지 131-n, n>1인 자연수)을 포함할 수 있으며, 복수의 제1 래치들(131-1 내지 131-n)은 제1 래치 인에이블 신호(En1)에 기초하여 제13 내지 제15 저장부들(331 내지 333)에 저장된 데이터들(DAT1 내지 DAT3)을 순차적으로 샘플링할 수 있고, 샘플링된 데이터들을 저장할 수 있다.
제2 래치부(132)는 제2 래치 인에이블 신호(En2)에 기초하여 복수의 제1 래치들(131-1 내지 131-n)에 저장된 데이터들을 수신하여 저장할 수 있다.
제2 래치부(132)는 복수의 제1 래치들(131-1 내지 131-n, n>1인 자연수)에 대응하는 복수의 제2 래치들(131-2 내지 132-n, n>1인 자연수)을 포함할 수 있다.
복수의 제2 래치들(131-2 내지 132-n, n>1인 자연수) 각각은 제2 래치 인에이블 신호(En2)에 기초하여 복수의 제1 래치들(131-1 내지 131-n) 중 대응하는 어느 하나에 저장된 데이터를 래치(latch) 또는 저장할 수 있고, 저장된 데이터를 레벨 쉬프터부(140)로 출력할 수 있다.
제1 및 제2 래치 인에이블 신호들(En1, En2)은 제어부(124)로부터 제공되거나 또는 타이밍 컨트롤러(205)로부터 제공될 수 있다.
레벨 쉬프터부(140)는 제2 래치부(132)로부터 제공되는 데이터의 전압 레벨을 변환한다. 예컨대, 레벨 쉬프터부(140)는 제2 래치부(132)로부터 제공되고 제1 레벨의 전압을 갖는 제1 데이터를 제2 레벨의 전압을 갖는 제2 데이터로 변환시킬 수 있다.
예컨대, 레벨 쉬프터부(140)는 제2 래치들(132-1 내지 132-n)과 대응하는 복수의 레벨 쉬프터들을 포함할 수 있으며, 레벨 쉬프터들의 수는 제1 래치들의 수, 또는/및 제2 래치들의 수와 동일할 수 있으나, 이에 한정되는 것은 아니다.
디지털-아날로그 변환부(150)는 레벨 쉬프터부(140)의 출력, 즉 디지털 데이터를 아날로그 신호로 변환한다.
예컨대, 디지털-아날로그 변환부(150)는 전원 공급부(미도시)에 의하여 발생하는 계조 전압들을 공급받아 레벨 쉬프터부(140)의 출력을 아날로그 신호로 변환할 수 있다.
예컨대, 전원 공급부(미도시)는 공급 전압원(VDD2)과 기저 전압원(GND) 사이에 직렬로 접속되는 다수의 저항들로 구현될 수 있고, 다수 단계, 예컨대, 256 단계로 나누어지는 계조 전압들을 발생할 수 있다.
출력부(160)는 디지털-아날로그 변환부(150)로부터 출력되는 아날로그 신호를 증폭(또는 버퍼링)하고, 증폭된(또는 버퍼링된) 아날로그 신호를 출력한다.
출력부(160)는 복수의 증폭기들 또는 복수의 버퍼들을 포함할 수 있다.
출력부(160)의 복수의 증폭기들 또는 버퍼들은 디스플레이 패널의 채널들 또는 데이터 라인들에 대응할 수 있으며, 대응하는 채널 또는 데이터 라인으로 아날로그 신호인 구동 신호를 제공할 수 있다.
도 3은 디스플레이 패널의 기설정된 인버전 패턴을 나타내고, 도 4는 도 1에 도시된 데이터 교환부의 동작에 관한 타이밍도를 나타낸다.
도 3 및 도 4를 참조하면, 디스플레이 패널의 열화를 방지하기 위한 디스플레이 패널의 “수평 방향의 도트 인버전 방식”에 따르면, 디스플레이 패널의 인접 채널들에 대하여 수평 방향으로 정극성(+) 및 부극성(-) 구동이 교번하여 반복될 수 있다.
도 3에서는 인접하는 8개의 채널들(n+1ch ~ n+8ch)에 대하여 “기설정된 인버전 패턴”은 정극성(+), 부극성(-), 부극성(-), 정극성(+), 정극성(+), 부극성(-), 부극성(-), 및 정극성(+)의 순서일 수 있다.
기설정된 인버전 패턴은 수평 방향의 도트 인버전 방식”에서 3번째 채널((n+3)ch)과 4번째 채널((n+3)ch)의 구동이 서로 바뀌고, 7번째 채널((n+7)ch)과 8번째 채널((n+8)ch)의 구동이 서로 바뀌도록 설계된다.
이러한 기설정된 인버전 패턴을 수행하기 위하여, 데이터 교환부(120)는 8개의 인접 채널들 중에서 3번째 채널((n+3)ch)과 4번째 채널((n+3)ch)을 구동하는 데이터를 서로 교환하고, 7번째 채널((n+7)ch)과 8번째 채널((n+8)ch)을 구동하는 데이터를 서로 교환하고, 그 밖의 나머지 채널들에 대해서는 데이터 교환이 이루어지지 않도록 할 수 있다.
도 4를 참조하면, 스위치 제어 신호들(SW1, SW2, SW3)이 제1 레벨(예컨대, 하이 레벨)일 때, 제1 내지 제3 인버전 스위치들(122-1 내지 122-3)은 인버전 동작에 따른 데이터 교환을 수행하고, 수행된 결과에 따라 제7 내지 제12 저장부들(311 내지 316) 중에서 대응하는 2개의 저장부들에 데이터를 출력할 수 있다.
반면에, 스위치 제어 신호들(SW1, SW2, SW3)이 제2 레벨(예컨대, 로우 레벨)일 때, 제1 내지 제3 인버전 스위치들(122-1 내지 122-3)은 인버전 동작에 따른 데이터 교환을 수행하지 않고, 그 결과에 따라 제7 내지 제12 저장부들(311 내지 316) 중에서 대응하는 2개의 저장부들에 데이터를 출력할 수 있다.
예컨대, 제3 채널을 위한 제3 데이터(B2)와 제4 채널을 위한 제4 데이터(R1)가 서로 교환될 수 있고, 제7 채널을 위한 제7 데이터(R2) 및 제8 채널을 위한 제8 데이터(G2)가 서로 교환될 수 있다.
제1 멀티플렉서(321)는 선택 신호(SEL)에 기초하여 제1 데이터(S1)와 제4 데이터(S4) 중 어느 하나를 선택하여 출력할 수 있다.
제2 멀티플렉서(322)는 선택 신호(SEL)에 기초하여 제2 데이터(S2)와 제5 데이터(S5) 중 어느 하나를 선택하여 출력할 수 있다.
제3 멀티플렉서(323)는 선택 신호(SEL)에 기초하여 제3 데이터(S3)와 제6 데이터(S6) 중 어느 하나를 선택하여 출력할 수 있다.
제13 내지 제15 저장부들(331 내지 333)은 제1 클럭 신호(CLK1)에 기초하여, 제1 내지 제3 멀티플렉서들(321 내지 323) 중 대응하는 어느 하나로부터 출력되는 데이터를 저장하고, 저장된 데이터(DAT1, DAT2, DAT3)를 출력할 수 있다.
실시 예에 따른 소스 드라이버(100)는 디스플레이 패널에 대한 기설정된 인버전 패턴에 맞도록 디스플레이 패널에 제공되는 데이터 인버전의 제어가 가능할 수 있다.
일반적으로 데이터 인버전을 위하여 각 채널에 대응하여 멀티플렉서가 요구되지만, 실시 예는 데이터 교환부(120)에 기설정된 개수(예컨대, 3개)의 멀티플렉서만을 구비함에 의하여 데이터 인버전을 수행할 수 있으므로, 칩 사이즈를 줄일 수 있다.
또한 디스플레이 패널의 종류, 또는 고객사의 요구에 따라 인버전 패턴이 다양하게 변경될 수 있는데, 실시 예는 스위치 제어 신호들(SW1 내지 SW3)에 기초하여 제1 내지 제3 인버전 스위치들(210 내지 230))이 개별적으로 제어됨으로써, 다양한 형태의 인버전 패턴을 구현할 수 있다.
도 5는 실시 예에 따른 디스플레이 장치(200)를 나타낸다.
도 5를 참조하면, 디스플레이 장치(200)는 디스플레이 패널(201), 타이밍 컨트롤러(205), 소스 드라이버부(1210), 및 게이트 드라이버부(1220)를 포함한다.
디스플레이 패널(201)은 행(row)을 이루는 게이트 라인들(221), 열(cloumn)을 이루는 데이터 라인들(1231)이 서로 교차하여 매트릭스 형태를 이루며, 교차되는 게이트 라인과 데이터 라인 각각에 연결되는 화소들(pixels)을 포함할 수 있다.
화소들은 게이트 라인들(1221)과 데이터 라인들(1231)에 연결되며, 행과 열을 갖는 매트릭스 형태로 배열될 수 있다.
화소들 각각은 게이트 라인과 데이터 라인에 연결되는 트랜지스터(Ta), 및 트랜지스터(Ta)에 연결되는 커패시터(Ca)를 포함할 수 있다.
예컨대, 화소들은 R(Red) 서브 픽셀(sub-pixel), G(Green) 서브 픽셀, 및 B(Blue) 서브 픽셀을 포함할 수 있으며, R, G, B 서브 픽셀들 각각은 게이트 라인과 데이터 라인에 연결되는 트랜지스터(Ta), 및 트랜지스터(Ta)에 연결되는 커패시터(Ca)를 포함할 수 있다.
타이밍 컨트롤러(205)는 클럭 신호(CLK), 데이터(DATA), 소스 드라이버부(210)를 제어하기 위한 제1 제어 신호(CONT), 및 게이트 드라이버(220)를 제어하기 위한 제2 제어 신호(G_CONT)를 출력한다.
도 5에서는 클럭 신호(CLK), 데이터(DATA), 및 제1 제어 신호(CONT)가 3개의 전송 라인들로 데이터 드라이버들(210-1 내지 210-P) 각각에 전송되는 것으로 표현되지만, 이에 한정되는 것은 아니며, 다른 실시 예에서는 클럭 신호(CLK), 데이터(DATA), 및 제1 제어 신호(CONT)가 1개의 전송 라인을 통하여 데이터 드라이버들(210-1 내지 210-P) 각각에 시분할적으로 전송될 수도 있다.
예컨대, 제1 제어 신호(CONT)는 소스 드라이버의 쉬프트 레지스터(110, 도 1 참조)에 입력되는 수평 시작 신호, 인에이블 신호(En), 및 클럭 신호(CLK)를 포함할 수 있다. 제2 제어 신호(G_CONT)는 게이트 라인들(1221)을 구동하기 위한 게이트 구동 신호를 포함할 수 있다.
게이트 드라이버부(1220)는 게이트 라인들(221)을 구동하며, 복수의 게이트 드라이버들을 포함할 수 있으며, 화소의 트랜지스터(Ta)를 제어하기 위한 게이트 구동 신호들을 게이트 라인들(1221)로 출력할 수 있다.
소스 드라이버부(1210)는 데이터 라인들 또는 디스플레이 패널의 채널들(1231)을 구동하며, 복수의 소스 드라이버들(210-1 내지 210-P, P>1인 자연수)을 포함할 수 있다.
소스 드라이버들(210-1 내지 210-P, P>1인 자연수) 각각은 도 1에 도시된 실시 예(100)일 수 있다.
이상에서 실시 예들에 설명된 특징, 구조, 효과 등은 본 발명의 적어도 하나의 실시 예에 포함되며, 반드시 하나의 실시 예에만 한정되는 것은 아니다. 나아가, 각 실시 예에서 예시된 특징, 구조, 효과 등은 실시 예들이 속하는 분야의 통상의 지식을 가지는 자에 의해 다른 실시 예들에 대해서도 조합 또는 변형되어 실시 가능하다. 따라서 이러한 조합과 변형에 관계된 내용들은 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.

Claims (20)

  1. 기설정된 개수 단위로 데이터를 수신하고, 기설정된 개수의 채널들에 대응하는 데이터를 저장하는 데이터 교환부; 및
    상기 데이터 교환부로부터 출력되는 데이터를 저장하는 래치부를 포함하고,
    상기 데이터 교환부는,
    상기 기설정된 개수 단위로 데이터를 수신하여 상기 기설정된 개수의 채널들에 대응하는 데이터를 저장하는 복수의 저장부들; 및
    복수의 그룹들에 대응하는 스위치부들을 포함하고,
    상기 스위치부들 각각은,
    상기 복수의 저장부들 중에서 상기 복수의 그룹들 중 대응하는 어느 하나에 포함된 2개의 채널들에 대응하는 2개의 저장부들에 저장된 데이터를 서로 교환하여 출력하고,
    상기 복수의 그룹들에 대한 상기 데이터 교환은 서로 독립적으로 이루어지고, 상기 복수의 그룹들 각각은 상기 기설정된 개수의 채널들 중에서 인접하는 2개의 채널들을 포함하는 소스 드라이버.
  2. 삭제
  3. 제1항에 있어서, 상기 복수의 저장부들은,
    제1 클럭 신호에 기초하여, 상기 기설정된 개수 단위의 데이터를 수신하는 제1 저장부들; 및
    상기 제1 클럭 신호에 기초하여, 상기 제1 저장부들에 저장된 데이터를 수신하여 저장하는 제2 저장부들을 포함하는 소스 드라이버.
  4. 제3항에 있어서,
    상기 스위치부들은 스위치 제어 신호들에 의하여 독립적으로 제어되는 복수의 인버전 스위치들을 포함하고,
    상기 복수의 인버전 스위치들 각각은 상기 제1 저장부들 중 대응하는 어느 하나에 저장된 제1 데이터와 상기 제2 저장부들 중 대응하는 어느 하나에 저장된 제2 데이터를 수신하고, 상기 수신된 제1 및 제2 데이터를 출력하는 제1 출력 단자와 제2 출력 단자를 포함하는 소스 드라이버.
  5. 제4항에 있어서,
    상기 복수의 인버전 스위치들 각각은,
    상기 스위치 제어 신호들 중 대응하는 어느 하나에 기초하여, 상기 수신된 제1 및 제2 데이터 중 어느 하나를 상기 제1 출력 단자로 출력하고, 상기 수신된 제1 및 제2 데이터 중 나머지 다른 하나를 상기 제2 출력 단자로 출력하는 소스 드라이버.
  6. 제4항에 있어서, 상기 스위치부들 각각은,
    제2 클럭 신호에 기초하여, 상기 복수의 인버전 스위치들 각각의 제1 출력 단자로부터 출력되는 데이터를 저장하는 제3 저장부; 및
    상기 제2 클럭 신호에 기초하여, 상기 복수의 인버전 스위치들 각각의 제2 출력 단자로부터 출력되는 데이터를 저장하는 제4 저장부를 더 포함하는 소스 드라이버.
  7. 제6항에 있어서, 상기 스위치부들 각각은,
    상기 복수의 인버전 스위치들에 대응하는 멀티플렉서들을 더 포함하고,
    상기 멀티플렉서들 각각은,
    선택 신호에 기초하여 상기 제3 저장부에 저장된 데이터와 상기 제4 저장부에 저장된 데이터 중 어느 하나를 선택적으로 출력하는 소스 드라이버.
  8. 제7항에 있어서,
    상기 제1 클럭 신호에 기초하여 상기 멀티플렉서들로부터 출력되는 데이터를 저장하고, 상기 래치부로 출력하는 저장부들을 더 포함하는 소스 드라이버.
  9. 제1항에 있어서,
    상기 래치부로부터 출력되는 데이터의 전압 레벨을 변환하는 레벨 쉬프터부;
    상기 레벨 쉬프터부의 출력을 아날로그 신호로 변환하는 디지털-아날로그 변환부; 및
    상기 디지털-아날로그 변환부로부터 출력되는 아날로그 신호를 증폭하고, 증폭된 아날로그 신호를 출력하는 출력부를 더 포함하는 소스 드라이버.
  10. 3개 단위로 데이터를 수신하고, 수신된 데이터를 순차로 저장하는 제1 내지 제6 저장부들;
    상기 제1 저장부에 저장된 제1 데이터와 상기 제2 저장부에 저장된 제2 데이터를 수신하는 제1 인버전 스위치;
    상기 제3 저장부에 저장된 제3 데이터와 상기 제4 저장부에 저장된 제4 데이터를 수신하는 제2 인버전 스위치;
    상기 제5 저장부에 저장된 제5 데이터와 상기 제6 저장부에 저장된 제6 데이터를 수신하는 제3 인버전 스위치;
    상기 제1 인버전 스위치에 접속되는 제7 저장부와 제8 저장부;
    상기 제2 인버전 스위치에 접속되는 제9 저장부와 제10 저장부; 및
    상기 제3 인버전 스위치에 접속되는 제11 저장부와 제12 저장부를 포함하고,
    상기 제1 인버전 스위치는 제1 스위치 제어 신호에 기초하여 상기 제1 데이터를 상기 제7 및 제8 저장부들 중 어느 하나에 출력하고, 상기 제2 데이터를 상기 제7 및 제9 저장부들 중 나머지 다른 하나에 출력하고,
    상기 제2 인버전 스위치는 제2 스위치 제어 신호에 기초하여 상기 제3 데이터를 상기 제9 및 제10 저장부들 중 어느 하나에 출력하고, 상기 제4 데이터를 상기 제9 및 제10 저장부들 중 나머지 다른 하나에 출력하고,
    상기 제3 인버전 스위치는 제3 스위치 제어 신호에 기초하여 상기 제5 데이터를 상기 제11 및 제12 저장부들 중 어느 하나에 출력하고, 상기 제6 데이터를 상기 제11 및 제12 저장부들 중 나머지 다른 하나에 출력하는 소스 드라이버.
  11. 제10항에 있어서,
    상기 제1 내지 제3 스위치 제어 신호들은 서로 독립적으로 제어되는 소스 드라이버.
  12. 제10항에 있어서,
    상기 제1 저장부는 제1 클럭 신호에 기초하여 상기 제4 저장부에 저장된 데이터를 수신하여 저장하고,
    상기 제2 저장부는 상기 제1 클럭 신호에 기초하여 상기 제5 저장부에 저장된 데이터를 수신하여 저장하고,
    상기 제3 저장부는 상기 제1 클럭 신호에 기초하여 상기 제6 저장부에 저장된 데이터를 수신하여 저장하는 소스 드라이버.
  13. 제10항에 있어서,
    상기 제7 내지 제12 저장부들 각각은 제2 클럭 신호에 기초하여 상기 제1 내지 제4 인버전 스위치들의 출력들 중 대응하는 어느 하나를 저장하는 소스 드라이버.
  14. 제10항에 있어서,
    선택 신호에 기초하여 상기 제7 및 제8 저장부들 중 어느 하나에 저장된 데이터를 출력하는 제1 멀티플렉서;
    상기 선택 신호에 기초하여 상기 제9 및 제10 저장부들 중 어느 하나에 저장된 데이터를 출력하는 제2 멀티 플렉서; 및
    상기 선택 신호에 기초하여, 상기 제11 및 제12 저장부들 중 어느 하나에 저장된 데이터를 출력하는 제3 멀티 플렉서를 더 포함하는 소스 드라이버.
  15. 제14항에 있어서,
    상기 제1 멀티플렉서의 출력을 수신하고 저장하는 제13 저장부;
    상기 제2 멀티플렉서의 출력을 수신하고 저장하는 제14 저장부; 및
    상기 제3 멀티플렉서의 출력을 수신하고 저장하는 제15 저장부를 더 포함하는 소스 드라이버.
  16. 제15항에 있어서,
    상기 제13 내지 제15 저장부들에 저장된 데이터를 순차적으로 저장하는 래치부;
    상기 래치부로부터 출력되는 데이터의 전압 레벨을 변환하는 레벨 쉬프터부;
    상기 레벨 쉬프터부의 출력을 아날로그 신호로 변환하는 디지털-아날로그 변환부; 및
    상기 디지털-아날로그 변환부로부터 출력되는 아날로그 신호를 증폭하고, 증폭된 아날로그 신호를 출력하는 출력부를 더 포함하는 소스 드라이버.
  17. 제12항에 있어서,
    3개 단위로 데이터를 상기 제4 내지 제6 저장부들에 제공하는 데이터 수신부를 더 포함하는 소스 드라이버.
  18. 제16항에 있어서, 상기 래치부는,
    복수의 제1 래치들을 포함하는 제1 래치부;
    복수의 제2 래치들을 포함하는 제2 래치부를 포함하고,
    상기 제1 래치들은 제1 래치 인에이블 신호에 기초하여 상기 제13 내지 제15 저장부들에 저장된 데이터들을 순차적으로 샘플링할 수 있고, 샘플링된 데이터들을 저장하고,
    상기 제2 래치들 각각은 제2 래치 인에이블 신호에 기초하여 상기 제1 래치들 중 대응하는 어느 하나에 저장된 데이터를 저장하고, 저장된 데이터를 상기 레벨 쉬프터부로 출력하는 소스 드라이버.
  19. 제17항에 있어서,
    상기 제1 내지 제3 스위치 제어 신호들, 및 상기 제1 및 제2 클럭 신호들은 상기 데이터 수신부로부터 제공되는 소스 드라이버.
  20. 게이트 라인들, 데이터 라인들, 상기 게이트 라인들과 상기 데이터 라인들에 연결되고 행과 열을 이루는 매트릭스 형태로 배열되는 화소들을 포함하는 디스플레이 패널;
    상기 데이터 라인들을 구동하기 위한 소스 드라이버; 및
    상기 게이트 라인들을 구동하기 위한 게이트 드라이버를 포함하고,
    상기 소스 드라이버는 제1항, 및 제3 내지 제19항 중 어느 한 항에 기재된 소스 드라이버인 디스플레이 장치.
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