KR102272555B1 - Small-signal cancellation circuit - Google Patents

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Abstract

마이크나 픽업에서 들어오는 소리의 신호전압에서 설정된 전압보다 큰 신호만 통과하도록 하는 정전압단을 플러스 측과 마이너스 측에 설치하는 것으로, 작은 신호를 제거하여 간결하고 깨끗한 출력신호를 얻으며, 작은 신호에 포함된 잡음을 제거하고, 증폭단을 설치하여 깨끗한 출력신호로 증폭하는 것을 특징으로 한다.By installing a constant voltage stage on the positive side and the negative side that allows only signals larger than the set voltage to pass from the signal voltage of the sound coming from the microphone or pickup, it removes the small signal to get a simple and clean output signal. It is characterized in that noise is removed and an amplification stage is installed to amplify a clean output signal.

Description

소신호제거회로{Small-signal cancellation circuit}Small-signal cancellation circuit

전자악기, 전기기타 앰프Electronic Musical Instruments, Electric Guitar Amplifier

마이크나 픽업에서 들어오는 소리에는 신호레벨이 큰 신호와 함께 신호레벨이 작은 신호가 포함되어 있으며, 이 작은 신호에는 잔향과 공간에서 반사되는 소리가 포함되어 있으며, 불필요한 잡음도 포함되어 있을 수 있다. The sound coming from a microphone or pickup includes a signal with a high signal level and a signal with a low signal level, and this small signal includes reverberation and sound reflected from space, and may also contain unnecessary noise.

깨끗하고 레벨이 작은 잔향이나 현의 여진동 등의 작은 신호는 소리를 풍부하고 감성 있는 소리로 들려주며 소리의 깊은맛을 느끼게 해준다. 반면에 잡음이 섞인 작은 신호는 소리가 지저분하고 오래 듣지 못할 수 있으며 집중할 수 없게 된다.
Small signals such as clean, low-level reverberation or string aftershocks make the sound rich and emotional, and let you feel the deep taste of the sound. A small, noisy signal, on the other hand, sounds messy, can't be heard for long, and makes it hard to concentrate.

특히 전기기타의 디스토션 앰프에서는 높은 이득으로 증폭하기 때문에 작은 신호가 포함되어 있으면 증폭되어 항상 들리기 때문에 지저분한 소리로 들리거나 음악에 방해를 주어 연주가 불가능할 수도 있게 된다.
In particular, the distortion amplifier of electric guitar amplifies with a high gain, so if a small signal is included, it is amplified and always heard, so it may sound messy or it may interfere with the music, making it impossible to play.

작은 신호가 필요할 때도 있지만, 높은 이득으로 증폭해야 할 경우에는 작은 신호를 어느 정도 제거해 줌으로써 깨끗한 소리를 얻을 수 있다.There are times when a small signal is needed, but if you need to amplify it with a high gain, you can get a clear sound by removing the small signal to some extent.

작은 신호를 제거해 줌으로써 작은 신호에 포함된 잡음도 제거되는 효과가 있으며, 본래의 연주 음이 부각되는 효과가 있으며 간결하고 깨끗한 연주를 할 수 있다.
By removing the small signal, the noise included in the small signal is also removed, and the original playing sound is emphasized, and a simple and clean performance can be performed.

전기기타의 디스토션 앰프와 같이 높은 이득으로 증폭할 경우 도 1과 같이 마이크나 픽업에서 들어오는 입력신호에서 레벨이 작은 소리를 제거하여 도 2와 같이 큰 신호만 출력되도록 하여 깨끗하고 간결한 신호를 얻는 것이 필요하고, 항상 들리는 잡음도 제거할 필요가 있다.
When amplifying with a high gain like the distortion amplifier of an electric guitar, it is necessary to obtain a clean and concise signal by removing the low-level sound from the input signal from the microphone or pickup as shown in Fig. 1 and outputting only the large signal as shown in Fig. 2 Also, it is necessary to remove the noise that is always audible.

마이크나 픽업에서 들어오는 소리의 신호에서 작은 신호를 제거하는 회로를 구성하며, 제거하는 신호레벨을 조절할 수 있도록 한다.
It composes a circuit that removes a small signal from the sound signal coming from a microphone or pickup, and allows the level of the signal to be removed to be adjusted.

제 1 수단으로써as a first means

도 3에서in Figure 3

제3입력단자(IN3)와 제31트랜지스터(Q31)의 에미터와 제31저항(R31)의 일단이 접속되고,The third input terminal (IN3), the emitter of the 31st transistor (Q31), and one end of the 31st resistor (R31) are connected,

제31트랜지스터(Q31)의 베이스와 제31저항(R31)의 타단과 제31가변저항기(VR31)의 일단이 접속되고,The base of the 31st transistor (Q31), the other end of the 31st resistor (R31), and one end of the 31st variable resistor (VR31) are connected,

제31트랜지스터(Q31)의 컬렉터와 제31가변저항기(VR31)의 타단과 제3출력단자(OUT3)가 접속된 정극성정전압단(310);a positive polarity positive voltage terminal 310 to which the collector of the 31st transistor Q31, the other terminal of the 31st variable resistor VR31, and the third output terminal OUT3 are connected;

제3입력단자(IN3)와 제32트랜지스터(Q32)의 컬렉터와 제32가변저항기(VR32)의 일단이 접속되고,The third input terminal IN3 and the collector of the 32nd transistor Q32 and one end of the 32nd variable resistor VR32 are connected,

제32트랜지스터(Q32)의 베이스와 제32가변저항기(VR32)의 타단과 제32저항(R32)의 일단이 접속되고,The base of the 32nd transistor Q32, the other end of the 32nd variable resistor VR32, and one end of the 32nd resistor R32 are connected,

제32트랜지스터(Q32)의 에미터와 제32저항(R32)의 타단과 제3출력단자(OUT3)가 접속된 부극성정전압단(320);a negative positive voltage terminal 320 to which the emitter of the 32nd transistor Q32, the other end of the 32nd resistor R32, and the third output terminal OUT3 are connected;

으로 구성된 소신호제거회로.
A small signal cancellation circuit consisting of

제 2 수단으로써as a second means

도 5에서in Figure 5

제5입력단자(IN5)와 제51트랜지스터(Q51)의 에미터와 제51저항(R51)의 일단이 접속되고,The fifth input terminal (IN5), the emitter of the 51st transistor (Q51), and one end of the 51st resistor (R51) are connected,

제51트랜지스터(Q51)의 베이스와 제51저항(R51)의 타단과 제51가변저항기(VR51)의 일단이 접속되고,The base of the 51st transistor (Q51), the other end of the 51st resistor (R51), and one end of the 51st variable resistor (VR51) are connected,

제51트랜지스터(Q51)의 컬렉터와 제51가변저항기(VR51)의 타단과 출력노드가 접속된 정극성정전압단(510);a positive polarity constant voltage terminal 510 to which the collector of the 51st transistor Q51, the other end of the 51st variable resistor VR51, and the output node are connected;

제5입력단자(IN5)와 제52트랜지스터(Q52)의 컬렉터와 제52가변저항기(VR52)의 일단이 접속되고,The fifth input terminal IN5 and the collector of the 52nd transistor Q52 and one end of the 52nd variable resistor VR52 are connected,

제52트랜지스터(Q52)의 베이스와 제52가변저항기(VR52)의 타단과 제52저항(R52)의 일단이 접속되고,The base of the 52nd transistor Q52, the other end of the 52nd variable resistor VR52, and one end of the 52nd resistor R52 are connected,

제52트랜지스터(Q52)의 에미터와 제52저항(R52)의 타단과 출력노드가 접속된 부극성정전압단(520);a negative polarity constant voltage terminal 520 to which the emitter of the 52nd transistor Q52, the other terminal of the 52nd resistor R52, and an output node are connected;

정극성정전압단(510)의 출력노드와 부극성정전압단(520)의 출력노드와 제53저항(R53)의 일단이 접속되고,The output node of the positive positive voltage terminal 510, the output node of the negative positive positive voltage terminal 520, and one end of the 53rd resistor R53 are connected,

제53저항(R53)의 타단과 제51증폭기(I51)의 부입력과 제54저항(R54)의 일단이 접속되고,The other end of the 53rd resistor (R53), the negative input of the 51st amplifier (I51), and one end of the 54th resistor (R54) are connected,

제51증폭기(I51)의 정입력과 접지가 접속되고,The positive input of the 51st amplifier (I51) and the ground are connected,

제51증폭기(I51)의 출력과 제54저항(R54)의 타단과 제5출력단자(OUT5)가 접속된 증폭단(530);an amplifier terminal 530 to which the output of the 51st amplifier I51, the other end of the 54th resistor R54, and the fifth output terminal OUT5 are connected;

으로 구성된 소신호제거회로.
A small signal cancellation circuit consisting of

제1가변저항(VR31, VR32, VR51, VR52, VR71, VR72)으로 입력신호의 제거레벨을 자유롭게 조절할 수 있는 특징이 있으며,The first variable resistor (VR31, VR32, VR51, VR52, VR71, VR72) has the feature that the removal level of the input signal can be freely adjusted.

입력단자(IN3, IN5, IN7)로 들어오는 신호에서 제1가변저항(VR31, VR32, VR51, VR52, VR71, VR72)으로 설정된 제거레벨 이하의 신호는 제3출력단자(OUT3, 출력노드)로 통과할 수 없어서 제거되는 장점이 있으며, 제5출력단자(도 5의 출력노드)에 이득이 고정되어 설정된 증폭기에 의해서 잡음없이 깨끗하고 간결한 증폭된 출력신호가 출력되는 장점이 있으며, 제7출력단자(도 7의 출력노드)에 이득을 가변할 수 있도록 제73가변저항(VR73)을 설치한 증폭기에 의해서 잡음없이 깨끗하고 간결한 증폭된 출력신호가 출력되는 장점이 있다.
Signals below the rejection level set by the first variable resistor (VR31, VR32, VR51, VR52, VR71, VR72) from the signal coming to the input terminal (IN3, IN5, IN7) pass to the third output terminal (OUT3, output node) There is an advantage of being removed because it cannot be done, and there is an advantage that a clean and concise amplified output signal is output without noise by an amplifier with a fixed gain to the fifth output terminal (the output node of FIG. 5), and the seventh output terminal ( There is an advantage in that a clean and concise amplified output signal is output without noise by an amplifier having a 73rd variable resistor VR73 installed so that the gain can be varied in the output node of FIG. 7 .

도 1: 입력되는 신호와 제거전압 레벨을 표시한 그래프.
도 2: 입력되는 신호가 소신호제거회로를 통과한 신호를 표시한 그래프.
도 3: 소신호제거회로 기본도.
도 4: 도 3 소신호제거회로에 입력신호와 정전압단의 전압 레벨 표시도와 출력신호 표시도.
도 5: 소신호제거회로와 고정이득 증폭단를 결합한 일실시 예.
도 6: 도 5 소신호제거회로에 입력신호와 정전압단의 전압 레벨 표시도와 증폭된 출력신호의 표시도.
도 7: 소신호제거회로와 가변이득 증폭단를 결합한 일실시 예.Figure 1: A graph showing the input signal and the removal voltage level.
Fig. 2: A graph showing a signal in which an input signal has passed through a small signal removal circuit.
Fig. 3: A basic diagram of a small signal cancellation circuit.
Fig. 4 is a diagram showing the voltage level of the input signal and the constant voltage stage and the output signal of the small signal removing circuit of Fig. 3;
Figure 5: An embodiment in which a small signal cancellation circuit and a fixed gain amplifier are combined.
Fig. 6: A display diagram of an input signal and a voltage level of a constant voltage stage and a display diagram of an amplified output signal in the small signal removal circuit of Fig. 5;
Figure 7: An embodiment in which a small signal cancellation circuit and a variable gain amplifier stage are combined.

도 3에서 정극성정전압단(310)은 제31트랜지스터(Q31)의 베이스에 접속된 제31저항(R31)과 제31가변저항(VR31)의 저항의 비율로 입력신호의 플러스 측 신호전압을 제거할 수 있는 전압이 결정되며, 제31가변저항(VR31)을 조정하여 제거전압 레벨을 변경한다.In FIG. 3 , the positive positive voltage terminal 310 removes the positive side signal voltage of the input signal by the ratio of the resistance of the 31st resistor R31 and the 31st variable resistor VR31 connected to the base of the 31st transistor Q31 . A possible voltage is determined, and the removal voltage level is changed by adjusting the 31st variable resistor VR31.

부극성정전압단(320)은 제32트랜지스터(Q32)의 베이스에 접속된 제32저항(R32)과 제32가변저항(VR32)의 저항의 비율로 입력신호의 마이너스 측 신호전압을 제거할 수 있는 전압이 결정되며, 제32가변저항(VR32)을 조정하여 제거전압 레벨을 변경한다.The negative polarity constant voltage terminal 320 is a ratio of the resistance of the 32nd resistor R32 and the 32nd variable resistor VR32 connected to the base of the 32nd transistor Q32 to remove the negative side signal voltage of the input signal. The voltage is determined, and the removal voltage level is changed by adjusting the 32nd variable resistor VR32.

정극성정전압단(310)의 정전압을 V_310 이라 하고, 제31트랜지스터의 Vbe 는 0.6V 이므로
Since the constant voltage of the positive polarity constant voltage terminal 310 is V_310, and the Vbe of the 31st transistor is 0.6V,

V_310 = 0.6 * VR31 / R31 (수학식 31)
V_310 = 0.6 * VR31 / R31 (Equation 31)

부극성정전압단(320)의 정전압을 V_320 이라 하고, 제32트랜지스터의 Vbe 는 0.6V 이므로
Since the constant voltage of the negative constant voltage terminal 320 is V_320 and the Vbe of the 32nd transistor is 0.6V,

V_320 = 0.6 * VR32 / R32 (수학식 32)

정극성정전압단(310)의 동작을 설명하면,
도 3에서
입력단자(IN3)로 입력되는 입력신호 전압이 V_310 보다 작은 신호일 경우;
제31트랜지스터(Q31)의 베이스에 바이어스 전압이 부족하여 바이어스 전류가 흐르지 않고 에미터와 컬렉터 사이는 오프(OFF)되어 입력신호는 통과하지 못하여 제거된다.
입력단자(IN3)로 입력되는 입력신호 전압이 V_310 보다 큰 신호일 경우;
제31트랜지스터(Q31)의 베이스에 바이어스 전압이 충분하여 바이어스 전류가 흐르고 에미터와 컬렉터 사이는 온(ON)되어 입력신호는 통과하여 출력노드(OUT3)에 출력된다.
부극성정전압단(320)의 동작을 설명하면,
도 3에서
입력단자(IN3)로 입력되는 입력신호 전압이 V_320 보다 작은 신호일 경우;
제32트랜지스터(Q32)의 베이스에 바이어스 전압이 부족하여 바이어스 전류가 흐르지 않고 에미터와 컬렉터 사이는 오프(OFF)되어 입력신호는 통과하지 못하여 제거된다.
입력단자(IN3)로 입력되는 입력신호 전압이 V_320 보다 큰 신호일 경우;
제32트랜지스터(Q32)의 베이스에 바이어스 전압이 충분하여 바이어스 전류가 흐르고 에미터와 컬렉터 사이는 온(ON)되어 입력신호는 통과하여 출력노드(OUT3)에 출력된다.
V_320 = 0.6 * VR32 / R32 (Equation 32)

When explaining the operation of the positive polarity constant voltage stage 310,
in Figure 3
When the input signal voltage input to the input terminal IN3 is less than V_310;
The bias voltage is insufficient at the base of the 31st transistor Q31, so that the bias current does not flow, and the emitter and the collector are turned OFF, so that the input signal does not pass and is removed.
When the input signal voltage input to the input terminal IN3 is a signal greater than V_310;
A bias voltage is sufficient at the base of the 31st transistor Q31, so that a bias current flows, and between the emitter and the collector is turned on, and the input signal passes through and is output to the output node OUT3.
When explaining the operation of the negative positive voltage stage 320,
in Figure 3
When the input signal voltage input to the input terminal IN3 is less than V_320;
The bias current does not flow due to insufficient bias voltage at the base of the 32-th transistor Q32, and the emitter and the collector are turned OFF, so that the input signal does not pass through and is removed.
When the input signal voltage input to the input terminal IN3 is a signal greater than V_320;
The bias voltage is sufficient in the base of the 32nd transistor Q32, so that the bias current flows, and the emitter and the collector are turned on, so that the input signal passes through and is output to the output node OUT3.

도 4에서 IN3 그래프는 입력신호와 정전압단의 정전압(V_310, V_320)을 표시한 것이며, 정전압단의 정전압(V_310, V_320)보다 큰 신호가 입력되는 경우에만 제3출력단자(OUT3)로 신호전압이 출력된다. 즉 정전압단의 정전압보다 낮은 입력신호는 제거되는 효과가 있다.
In FIG. 4 , the IN3 graph shows the input signal and the constant voltages V_310 and V_320 of the constant voltage terminal, and only when a signal greater than the constant voltages V_310 and V_320 of the constant voltage terminal is input, the signal voltage to the third output terminal OUT3 This is output. That is, an input signal lower than the constant voltage of the constant voltage stage has an effect of being removed.

도 4에 IN3 그래프는 입력신호와 정전압단의 전압 레벨을 표시한 것으로서 정전압단의 정전압(V_310, V_320)보다 큰 신호는 정극성정전압단(310)의 제31트랜지스터(Q31)의 에미터에서 컬렉터로 전류가 흘러서 제3출력단자(OUT3)에 플러스 측 신호로 출력되며, 부극성정전압단(320)의 제32트랜지스터(Q32)의 에미터에서 컬렉터로 전류가 흘러서 제3출력단자(OUT3)에 마이너스 측 신호로 출력되어 도 4의 OUT3 그래프와 같이 두 정전압단 전압의 합(V310 + |-V320|) 보다 작은 진폭의 신호는 제거되며, 큰 신호만 양측 파형이 결합되어 출력된다.The IN3 graph in FIG. 4 shows the input signal and the voltage level of the constant voltage stage, and the signal greater than the constant voltages (V_310, V_320) of the constant voltage stage is from the emitter to the collector of the 31st transistor Q31 of the positive positive voltage stage 310. current flows to the third output terminal (OUT3) and is output as a positive signal, and current flows from the emitter to the collector of the 32nd transistor (Q32) of the negative positive voltage terminal 320 to the third output terminal (OUT3) A signal with an amplitude smaller than the sum (V310 + |-V320|) of the two constant voltage terminal voltages (V310 + |-V320|) as output as a negative signal is removed as shown in the OUT3 graph of FIG. 4 , and only a large signal is output by combining both waveforms.

여기서 저항(R31, R32)의 저항값을 동일하게 하고 가변저항(VR31, VR32)의 저항값을 동일하게 하면 입력신호의 플러스 측과 마이너스 측 신호가 동일한 레벨로 제거되어 출력에 나타나며, 가변저항(VR31, VR32)을 각각 저항값을 다르게 설정할 경우에는 입력신호의 플러스 측과 마이너스 측 신호가 동시에 설정된 레벨로 제거된 신호가 출력에 나타나며, 제거되는 전압 레벨을 조절할 수 있다.
Here, if the resistance values of the resistors R31 and R32 are equal and the resistance values of the variable resistors VR31 and VR32 are made the same, the positive and negative signals of the input signal are removed to the same level and appear in the output, and the variable resistance ( When the resistance values of VR31 and VR32) are set differently, the signal from which the positive and negative side signals of the input signal are simultaneously set to the set level appears in the output, and the removed voltage level can be adjusted.

도 5는 도 3에서 작은 신호가 제거되어 작아진 전압레벨을 보상해주는 증폭단(530)을 추가한 일실시 예이다.FIG. 5 is an embodiment in which an amplifying stage 530 for compensating for a reduced voltage level by removing a small signal in FIG. 3 is added.

증폭단(530)의 이득을 제53저항(R53)과 제54저항(R54)의 저항 비율을 조절하여 출력신호의 전압을 조절할 수 있다.
The voltage of the output signal may be adjusted by adjusting the gain of the amplifying stage 530 and the resistance ratio of the 53rd resistor R53 and the 54th resistor R54.

도 6에 IN5 그래프는 입력신호와 정전압단의 정전압 레벨을 표시한 것으로서 정전압단의 정전압(V_510, V_520)보다 큰 신호는 정극성정전압단(510)의 제51트랜지스터(Q51)의 에미터에서 컬렉터로 전류가 흘러서 출력노드에 플러스 측 신호로 출력되며, 부극성정전압단(520)의 제52트랜지스터(Q52)의 에미터에서 컬렉터로 전류가 흘러서 출력노드에 마이너스 측 신호로 출력되어 도 6의 OUT5 그래프와 같이 두 정전압단 정전압의 합(V510 + |-V520|) 보다 작은 진폭의 신호는 제거되며, 큰 신호만 양측 파형이 결합되어 출력되고, 제53저항(R53)과 제54저항(R54)의 저항 비율로 증폭된 신호가 제5출력단자(OUT5)로 출력되며, 입력에서 제거된 작은 신호는 증폭하지 않기 때문에 깨끗하고 간결한 증폭된 출력신호가 출력된다.The IN5 graph in FIG. 6 shows the constant voltage level of the input signal and the constant voltage stage, and the signal greater than the constant voltages (V_510, V_520) of the constant voltage stage is from the emitter to the collector of the 51st transistor Q51 of the positive positive voltage stage 510. current flows to the output node and is output as a positive signal to the output node, and current flows from the emitter to the collector of the 52nd transistor Q52 of the negative positive voltage stage 520 and is output as a negative signal to the output node as a negative signal in OUT5 of FIG. As shown in the graph, a signal with an amplitude smaller than the sum of the two constant voltage stages (V510 + |-V520|) is removed, and only a large signal is output by combining both waveforms, and the 53rd resistor (R53) and the 54th resistor (R54) A signal amplified with a resistance ratio of is output to the fifth output terminal OUT5, and since the small signal removed from the input is not amplified, a clean and concise amplified output signal is output.

도 7은 도 3에서 작은 신호가 제거되어 작아진 전압레벨을 보상해주는 증폭단(730)을 추가한 일실시 예이며, 출력신호의 전압을 임의로 조절할 수 있도록 제73가변저항(VR73)이 설치되어 있다.
7 is an embodiment in which an amplification stage 730 for compensating for a reduced voltage level by removing a small signal in FIG. 3 is added, and a 73rd variable resistor VR73 is installed to arbitrarily adjust the voltage of the output signal. .

증폭단(730)의 이득을 제74가변저항(VR74)으로 조절하여 출력신호의 전압을 조절할 수 있다.
The voltage of the output signal may be adjusted by adjusting the gain of the amplifying stage 730 with the 74th variable resistor VR74.

Claims (6)

제1트랜지스터의 에미터와 제1저항의 일단이 접속된 제1입력노드,
제1트랜지스터의 베이스와 제1저항의 타단과 제1가변저항기의 일단이 접속되고,
제1트랜지스터의 컬렉터와 제1가변저항기의 타단과 제1출력노드가 접속된 정극성정전압단;
제2트랜지스터의 컬렉터와 제2가변저항기의 일단이 접속된 제2입력노드,
제2트랜지스터의 베이스와 제2가변저항기의 타단과 제2저항의 일단이 접속되고,
제2트랜지스터의 에미터와 제2저항의 타단과 제2출력노드가 접속된 부극성정전압단;
으로 구성되며,
정극성정전압단의 제1입력노드와 부극성정전압단의 제2입력노드가 접속된 입력단자와;
정극성정전압단의 제1출력노드와 부극성정전압단의 제2출력노드가 접속된 출력단자;
를 특징으로 하는 소신호제거회로.
a first input node to which the emitter of the first transistor and one end of the first resistor are connected;
The base of the first transistor, the other end of the first resistor, and one end of the first variable resistor are connected,
a positive polarity constant voltage terminal to which the collector of the first transistor, the other end of the first variable resistor, and the first output node are connected;
a second input node to which the collector of the second transistor and one end of the second variable resistor are connected;
The base of the second transistor, the other end of the second variable resistor, and one end of the second resistor are connected,
a negative polarity constant voltage terminal to which the emitter of the second transistor, the other end of the second resistor, and the second output node are connected;
is composed of
an input terminal to which the first input node of the positive positive voltage stage and the second input node of the negative positive voltage stage are connected;
an output terminal to which the first output node of the positive positive voltage stage and the second output node of the negative positive voltage stage are connected;
A small signal cancellation circuit characterized in that.
 청구항 1에서
소신호제거회로의 출력단자와 로드(LOAD)의 일단이 접속된 노드에서 출력 신호를 인출하는 것을 특징으로 하는 소신호제거회로.
in claim 1
A small signal removal circuit, characterized in that the output signal is drawn from a node in which an output terminal of the small signal removal circuit and one end of the load are connected.
 청구항 1 에서
소신호제거회로의 출력단자와 증폭단(530)의 입력이 접속되어 구성되는 것을 특징으로 하는 소신호제거회로.
in claim 1
A small signal removal circuit, characterized in that the output terminal of the small signal removal circuit and the input of the amplifier stage (530) are connected to each other.
 청구항 1 에서
제1가변저항기와 제2가변저항기가 연동으로 동작하는 것을 특징으로하는 소신호제거회로.
in claim 1
A small signal removal circuit, characterized in that the first variable resistor and the second variable resistor operate in conjunction.
 청구항 1 에서
제1가변저항기와 제2가변저항기가 독립적으로 동작하는 것을 특징으로하는 소신호제거회로.
in claim 1
A small signal cancellation circuit, characterized in that the first variable resistor and the second variable resistor operate independently.
 청구항 3에서
증폭단(730)이 이득을 조절할 수 있는 것을 특징으로 하는 소신호제거회로.
in claim 3
The small signal cancellation circuit, characterized in that the amplification stage 730 can adjust the gain.
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