KR101438042B1 - 계통 연계형 인버터 및 그의 제어 방법 - Google Patents

계통 연계형 인버터 및 그의 제어 방법 Download PDF

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KR101438042B1
KR101438042B1 KR1020130031666A KR20130031666A KR101438042B1 KR 101438042 B1 KR101438042 B1 KR 101438042B1 KR 1020130031666 A KR1020130031666 A KR 1020130031666A KR 20130031666 A KR20130031666 A KR 20130031666A KR 101438042 B1 KR101438042 B1 KR 101438042B1
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박주현
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엘에스산전 주식회사
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Abstract

본 명세서는 동기 좌표계를 이용하여 3상 계통의 상순을 확인하는 계통 연계형 인버터 및 그의 제어 방법에 관한 것이다. 이를 위하여 본 명세서에 따른 계통 연계형 인버터는, 계통과 연동하는 계통 연계형 인버터에 있어서, 계통 3상 계통 전압을 감지하는 아날로그 입력부; 상기 감지된 상기 3상 계통 전압을 3상 좌표계에서 d-q 정지 좌표계로 변환하고, 상기 d-q 정지 좌표계로 변환된 전압을 d-q 동기 좌표계로 변환하고, 상기 d-q 동기 좌표계로 변환된 전압을 근거로 상기 계통 연계형 인버터와 상기 계통 간의 연결이 정상적인지 여부를 판단하고, 상기 판단 결과, 상기 계통 연계형 인버터와 상기 계통 간의 연결이 비정상적인 연결일 때, 알람 정보를 생성하는 디지털 처리부; 및 상기 생성된 알람 정보를 표시하는 디스플레이부;를 포함한다.

Description

계통 연계형 인버터 및 그의 제어 방법{GRID CONNECTED INVERTER AND CONTROLLING METHOD THEREOF}
본 명세서는 계통 연계형 인버터 및 그의 제어 방법에 관한 것으로, 특히 동기 좌표계를 이용하여 3상 계통의 상순을 확인하는 계통 연계형 인버터 및 그의 제어 방법에 관한 것이다.
일반적으로, 계통 연계형 인버터 시스템은, 전력 변환 장치로써 입력 전력 계통과 상용 전력 계통인 전원 전력 계통으로 연계하여 상기 입력 전력 계통의 전력을 상기 전원 전력 계통으로 전송해주기 위한 시스템이다.
이러한 상기 계통 연계형 인버터는, 인버터의 출력 전압이 계통 전압의 크기 및 주파수로 출력되어야 한다. 3상 계통의 경우, 계통의 U-V-W 상순과 인버터의 R-S-T 상순이 맞이 않을 경우, 계통에 연계된 부하가 이상 동작을 하거나 화재의 위험이 있고, 인버터도 정상 동작을 하지 않는다.
한국 특허 출원 번호 제10-2008-0021807호
본 명세서의 목적은, 동기 좌표계를 이용하여 3상 계통의 상순을 확인하는 계통 연계형 인버터 및 그의 제어 방법을 제공하는 데 있다.
본 명세서의 다른 목적은, 3상의 계통 전압을 계통의 주파수로 좌표 변환하여 3상의 교류값을 2상의 직류값으로 실시간 확인하는 계통 연계형 인버터 및 그의 제어 방법을 제공하는 데 있다.
본 명세서의 또 다른 목적은, 고가의 추가 계측 장비 없이도, 3상 인버터(또는, 상기 계통 연계형 인버터)의 계통 연결을 가능하게 하는 계통 연계형 인버터 및 그의 제어 방법을 제공하는 데 있다.
본 명세서의 실시예에 따른 계통 연계형 인버터는, 계통과 연동하는 계통 연계형 인버터에 있어서, 계통 3상 계통 전압을 감지하는 아날로그 입력부; 상기 감지된 상기 3상 계통 전압을 3상 좌표계에서 d-q 정지 좌표계로 변환하고, 상기 d-q 정지 좌표계로 변환된 전압을 d-q 동기 좌표계로 변환하고, 상기 d-q 동기 좌표계로 변환된 전압을 근거로 상기 계통 연계형 인버터와 상기 계통 간의 연결이 정상적인지 여부를 판단하고, 상기 판단 결과, 상기 계통 연계형 인버터와 상기 계통 간의 연결이 비정상적인 연결일 때, 알람 정보를 생성하는 디지털 처리부; 및 상기 생성된 알람 정보를 표시하는 디스플레이부;를 포함한다.
본 명세서와 관련된 일 예로서, 상기 디지털 처리부는, 상기 감지된 상기 3상 계통 전압을 아래 수학식을 근거로 3상 좌표계에서 d-q 정지 좌표계로 변환하며,
Figure 112013025715615-pat00001
,
Figure 112013025715615-pat00002
여기서, 상기 fa, fb 및, fc는, 각각 3상 전압을 나타내고, 상기 fd s 및 fq s는, 2상 정지 좌표계 전압을 나타낼 수 있다.
본 명세서와 관련된 일 예로서, 상기 디지털 처리부는, 상기 d-q 정지 좌표계로 변환된 전압을 아래 수학식을 근거로 d-q 동기 좌표계로 변환하며,
Figure 112013025715615-pat00003
,
Figure 112013025715615-pat00004
여기서, 상기
Figure 112013025715615-pat00005
이고, 상기 f는 계통 주파수 60Hz일 수 있다.
본 명세서와 관련된 일 예로서, 상기 디지털 처리부는, 상순이 R-S-T 순서로 정상적으로 입력되는지 여부를 확인하기 위해서, 상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 일정한 상수 값을 각각 가지는지 여부를 판단할 수 있다.
본 명세서와 관련된 일 예로서, 상기 디지털 처리부는, 상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 일정한 상수 값을 각각 가질 때, 상기 계통 연계형 인버터와 계통이 정상적으로 연결되었음을 나타내는 정보를 생성하고, 상기 생성된 정보를 상기 디스플레이부에 표시할 수 있다.
본 명세서와 관련된 일 예로서, 상기 디지털 처리부는, 상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 일정한 상수 값을 각각 가지지 않을 때, 상기 계통 연계형 인버터와 상기 계통 간의 연결이 비정상적인 연결인 것으로 판단하고, 상기 알람 정보를 생성할 수 있다.
본 명세서의 실시예에 따른 계통 연계형 인버터의 제어 방법은, 계통과 연동하는 계통 연계형 인버터의 제어 방법에 있어서, 계통 3상 계통 전압을 감지하는 단계; 상기 감지된 상기 3상 계통 전압을 3상 좌표계에서 d-q 정지 좌표계로 변환하는 단계; 상기 d-q 정지 좌표계로 변환된 전압을 d-q 동기 좌표계로 변환하는 단계; 상기 d-q 동기 좌표계로 변환된 전압을 근거로 상기 계통 연계형 인버터와 상기 계통 간의 연결이 정상적인지 여부를 판단하는 단계; 및 상기 판단 결과, 상기 계통 연계형 인버터와 상기 계통 간의 연결이 비정상적인 연결일 때, 알람 정보를 생성하여 표시하는 단계;를 포함한다.
본 명세서와 관련된 일 예로서, 상기 판단 결과, 상기 계통 연계형 인버터와 상기 계통 간의 연결이 정상적인 연결일 때, 상기 계통 연계형 인버터와 계통이 정상적으로 연결되었음을 나타내는 정보를 생성하여 표시하는 단계;를 더 포함할 수 있다.
본 명세서의 실시예에 따른 계통 연계형 인버터 및 그의 제어 방법은, 동기 좌표계를 이용하여 3상 계통의 상순을 확인함으로써, 사용상의 편의성을 향상시킬 수 있다.
또한, 본 명세서의 실시예에 따른 계통 연계형 인버터 및 그의 제어 방법은, 3상의 계통 전압을 계통의 주파수로 좌표 변환하여 3상의 교류값을 2상의 직류값으로 실시간 확인함으로써, 추가 장비 없이도 편리하게 계통의 상순을 확인할 수 있다.
또한, 본 명세서의 실시예에 따른 계통 연계형 인버터 및 그의 제어 방법은, 고가의 추가 계측 장비 없이도, 3상 인버터(또는, 상기 계통 연계형 인버터)의 계통 연결을 가능하게 함으로써, 생산 비용을 절감할 수 있다.
도 1은 본 명세서의 실시예에 따른 계통 연계형 인버터의 구성을 나타낸 블록도이다.
도 2는 본 명세서의 일 실시예에 따른 계통 연계형 인버터의 제어 방법을 나타낸 흐름도이다.
도 3 내지 도 6은 본 명세서의 일 실시예에 따른 아날로그 입력부의 구성을 나타낸 회로도이다.
도 7은 본 명세서의 일 실시예에 따른 정상 연결 상태일 때의 화면을 나타낸 도이다.
도 8은 본 명세서의 일 실시예에 따른 정상 연결 상태일 때의 화면을 나타낸 도이다.
이하, 첨부된 도면을 참조하여 본 명세서에 따른 실시예를 상세히 설명하되, 도면 부호에 관계없이 동일하거나 대응하는 구성 요소는 동일한 참조 번호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.
도 1은 본 명세서의 실시예에 따른 계통 연계형 인버터(10)의 구성을 나타낸 블록도이다.
도 1에 도시한 바와 같이, 계통 연계형 인버터(10)는, 아날로그 입력부(110), 디지털 처리부(120) 및, 디스플레이부(130)로 구성된다. 도 1에 도시된 계통 연계형 인버터(10)의 구성 요소 모두가 필수 구성 요소인 것은 아니며, 도 1에 도시된 구성 요소보다 많은 구성 요소에 의해 계통 연계형 인버터(10)가 구현될 수도 있고, 그보다 적은 구성 요소에 의해서도 계통 연계형 인버터(10)가 구현될 수도 있다.
상기 아날로그 입력부(110)는, 상기 계통 연계형 인버터(10)에 연결된 계통(미도시)의 3상 계통 전압을 감지한다.
상기 디지털 처리부(120)는, 상기 계통 연계형 인버터(10)의 전반적인 제어 기능을 수행한다.
또한, 상기 디지털 처리부(120)는, 상기 아날로그 입력부(110)를 통해 감지된 상기 3상 계통 전압을 아래의 [수학식 1]을 근거로 3상 좌표계에서 d-q 정지 좌표계로 변환한다.
Figure 112013025715615-pat00006
Figure 112013025715615-pat00007
여기서, 상기 fa, fb 및, fc는, 각각 R, S 및, T에 대응하는 3상 전압을 나타내고, 상기 fd s 및 fq s는, 2상 정지 좌표계 전압을 나타낸다.
또한, 상기 디지털 처리부(120)는, 아래의 [수학식 2]를 근거로 상기 d-q 정지 좌표계로 변환된 전압을 d-q 동기 좌표계로 변환한다.
Figure 112013025715615-pat00008
Figure 112013025715615-pat00009
여기서, 상기
Figure 112013025715615-pat00010
(f는 계통 주파수 60Hz)이다.
또한, 상기 디지털 처리부(120)는, 상기 d-q 동기 좌표계로 변환된 전압을 근거로 상기 계통 연계형 인버터(10)와 계통 간의 연결이 정상적인지 여부를 판단한다.
즉, 상기 디지털 처리부(120)는, 상순이 R-S-T 순서로 정상적으로 입력되는지 여부를 확인하기 위해서, 상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 일정한 값(또는, 일정한 상수 값)을 각각 가지는지 여부를 판단한다.
또한, 상기 디지털 처리부(120)는, 상기 판단 결과, 상기 계통 연계형 인버터(10)와 계통 간의 연결이 정상적으로 연결될 때, 상기 계통 연계형 인버터(10)와 계통이 정상적으로 연결되었음을 나타내는 정보를 생성하여, 상기 디스플레이부(130)에 표시한다.
또한, 상기 디지털 처리부(120)는, 상기 판단 결과, 상기 계통 연계형 인버터(10)와 계통 간의 연결이 비정상적으로 연결될 때, 상기 계통 연계형 인버터(10)와 계통이 비정상적으로 연결되었음을 나타내는 정보(또는, 폴트(fault) 정보 또는, 알람 정보/신호)를 생성하여, 상기 생성된 정보(또는, 폴트 정보 또는, 알람 정보/신호)를 상기 디스플레이부(130)에 표시한다.
상기 디스플레이부(130)는, 상기 디지털 처리부(120)의 제어에 의해, 상기 계통 연계형 인버터(10)와 계통 간의 연결 상태 정보(예를 들어, 정상 연결 상태 정보, 비정상 연결 상태 정보 등 포함)를 표시한다. 또한, 상기 디스플레이부(130)는, 터치 스크린 일 수 있다.
또한, 상기 디스플레이부(130)는, 액정 디스플레이(Liquid Crystal Display : LCD), 박막 트랜지스터 액정 디스플레이(Thin Film Transistor-Liquid Crystal Display : TFT LCD), 유기 발광 다이오드(Organic Light-Emitting Diode : OLED), 플렉시블 디스플레이(Flexible Display), 3차원 디스플레이(3D Display), 전자잉크 디스플레이(e-ink display) 중에서 적어도 하나를 포함할 수 있다.
상기 계통 연계형 인버터(10)는, 상기 디지털 처리부(120)의 제어에 의해, 상기 계통 연계형 인버터(10)와 계통 간의 연결 상태 정보(예를 들어, 정상 연결 상태 정보, 비정상 연결 상태 정보 등 포함)에 대응하는 음성 정보를 출력하는 음성 출력부(미도시)를 더 포함할 수 있다. 여기서, 상기 음성 출력부는, 스피커가 될 수도 있다.
또한, 상기 계통 연계형 인버터(10)는, 상기 디지털 처리부(120)의 제어에 의해, 상기 아날로그 입력부(110)를 통해 감지된 계통(미도시)의 3상 계통 전압, 상기 d-q 정지 좌표계로 변환된 전압 및, 상기 d-q 동기 좌표계로 변환된 전압 등을 저장하는 저장부(미도시)를 더 포함한 수 있다.
상기 저장부는, 플래시 메모리 타입(Flash Memory Type), 하드 디스크 타입(Hard Disk Type), 멀티미디어 카드 마이크로 타입(Multimedia Card Micro Type), 카드 타입의 메모리(예를 들면, SD 또는 XD 메모리 등), 자기 메모리, 자기 디스크, 광디스크, 램(Random Access Memory : RAM), SRAM(Static Random Access Memory), 롬(Read-Only Memory : ROM), EEPROM(Electrically Erasable Programmable Read-Only Memory), PROM(Programmable Read-Only Memory) 중 적어도 하나의 저장매체를 포함할 수 있다.
이와 같이, 동기 좌표계를 이용하여 3상 계통의 상순을 확인할 수 있다.
또한, 이와 같이, 3상의 계통 전압을 계통의 주파수로 좌표 변환하여 3상의 교류값을 2상의 직류값으로 실시간 확인할 수 있다.
또한, 이와 같이, 고가의 추가 계측 장비 없이도, 3상 인버터(또는, 상기 계통 연계형 인버터)의 계통 연결을 가능하게 할 수 있다.
이하에서는, 본 명세서에 따른 계통 연계형 인버터의 제어 방법을 도 1 내지 도 8을 참조하여 상세히 설명한다.
도 2는 본 명세서의 일 실시예에 따른 계통 연계형 인버터의 제어 방법을 나타낸 흐름도이다.
먼저, 아날로그 입력부(110)는, 계통(미도시)의 3상 계통 전압을 감지한다.
일 예로, 상기 아날로그 입력부(110)는, 도 3 내지 도 6에 도시한 바와 같이, 상기 계통의 3상 계통 전압을 각각 감지하고, 상기 감지된 3상 계통 전압(예를 들어, Grid_Vr, Grid_Vs 및, Grid_Vt 포함)을 디지털 처리부(120)에 전달한다.
여기서, 상기 아날로그 입력부(110)는, 상기 도 3의 좌측 회로도에 도시한 바와 같이, R 위상, S 위상 및, T 위상에 대한 선간 전압을 감지한다. 또한, 상기 아날로그 입력부(110)는, 상기 도 3의 우측 회로도에 도시한 바와 같이, PT를 통해 전압을 감지한다. 또한, 상기 아날로그 입력부(110)는, 상기 도 4 내지 상기 도 6에 도시한 바와 같이, 다운사이징 및 필터를 통해 상기 디지털 처리부(120)로 입력되는 전압을 미리 설정된 전압(예를 들어, 3.3V)으로 맞춘다. 상기 도 3의 출력 전압(Vrs_r1, Vrs_s1, Vst_s1, Vst_t1, Vtr_t1 및, Vtr_r1)은, 상기 도 4 내지 도 6의 입력 전압(GRID_Vr_A, GRID_Vr_B, GRID_Vs_A, GRID_Vs_B, GRID_Vt_A 및, GRID_Vt_B)에 각각 대응한다. 또한, 상기 도 4 내지 도 6의 출력 전압(GRID_Vr, GRID_Vs 및, GRID_Vt)는, 상기 기재된 [수학식 1]의 fa, fb 및, fc에 각각 대응한다.
또한, 상기 도 3 내지 도 6에 도시된 회로도는, 선간 전압 센싱 PCB에서 델타 결선으로 선간 전압이 입력되며, 선간 전압 센싱 PCB는 220kohm * 2를 장착하며, 그리드 볼트 맥스 값(Grid Volt Max.)은 440V이며, TZ111V1 -> 1:1 CT 이고, 1차측이 440V*1/440k=1mA 이고, 2차측이 1mA*1k/1V(1.414Vpeak)이고, DSP(또는, 상기 디지털 처리부(120)) 보드의 볼트 OP-앰프 이득은 1로 각각 설정할 수 있다(S210).
이후, 상기 디지털 처리부(120)는, 상기 아날로그 입력부(110)를 통해 감지된 상기 3상 계통 전압을 상기 기재된 [수학식 1]을 근거로 3상 좌표계에서 d-q 정지 좌표계로 변환한다(S220).
이후, 상기 디지털 처리부(120)는, 상기 기재된 [수학식 2]를 근거로 상기 d-q 정지 좌표계로 변환된 전압을 d-q 동기 좌표계로 변환한다(S230).
이후, 상기 디지털 처리부(120)는, 상기 d-q 동기 좌표계로 변환된 전압을 근거로 상기 계통 연계형 인버터(10)와 계통 간의 연결이 정상적인지 여부를 판단한다.
즉, 상기 디지털 처리부(120)는, 상순이 R-S-T 순서로 정상적으로 입력되는지 여부를 확인하기 위해서, 상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 일정한 값(또는, 일정한 상수 값)을 각각 가지는지 여부를 판단한다(S240).
이후, 상기 디지털 처리부(120)는, 상기 판단 결과, 상기 계통 연계형 인버터(10)와 계통 간의 연결이 정상적으로 연결될 때, 상기 계통 연계형 인버터(10)와 계통이 정상적으로 연결되었음을 나타내는 정보를 생성하여, 디스플레이부(130)에 표시한다.
일 예로, 상기 디지털 처리부(120)는, 상기 판단 결과, 도 7에 도시한 바와 같이, 상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 각각 일정한 값을 가질 때, 상기 계통 연계형 인버터(10)와 계통 간의 연결이 정상적으로 연결된 것으로 판단하고, 상기 계통 연계형 인버터(10)와 계통이 정상적으로 연결되었음을 나타내는 정보를 생성하여, 디스플레이부(130)에 표시한다(S250).
또한, 상기 디지털 처리부(120)는, 상기 판단 결과, 상기 계통 연계형 인버터(10)와 계통 간의 연결이 비정상적으로 연결될 때, 상기 계통 연계형 인버터(10)와 계통이 비정상적으로 연결되었음을 나타내는 정보(또는, 폴트 정보 또는, 알람 정보/신호)를 생성하여, 상기 생성된 정보(또는, 폴트 정보 또는, 알람 정보/신호)를 상기 디스플레이부(130)에 표시한다.
일 예로, 상기 디지털 처리부(120)는, 상기 판단 결과, 도 8에 도시한 바와 같이, 상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 일정한 값을 가지지 못하고 120Hz의 주파수 형태를 나타낼 때, 상기 계통 연계형 인버터(10)와 계통 간의 연결이 비정상적으로 연결된 것으로 판단하고, 상기 계통 연계형 인버터(10)와 계통이 비정상적으로 연결되었음을 나타내는 알람 정보를 생성하여, 상기 생성된 알람 정보를 상기 디스플레이부(130)에 표시한다(S260).
본 명세서의 실시예는 앞서 설명한 바와 같이, 동기 좌표계를 이용하여 3상 계통의 상순을 확인하여, 사용상의 편의성을 향상시킬 수 있다.
또한, 본 명세서의 실시예는 앞서 설명한 바와 같이, 3상의 계통 전압을 계통의 주파수로 좌표 변환하여 3상의 교류값을 2상의 직류값으로 실시간 확인하여, 추가 장비 없이도 편리하게 계통의 상순을 확인할 수 있다.
또한, 본 명세서의 실시예는 앞서 설명한 바와 같이, 고가의 추가 계측 장비 없이도, 3상 인버터(또는, 상기 계통 연계형 인버터)의 계통 연결을 가능하게 하여, 생산 비용을 절감할 수 있다.
전술한 내용은 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자라면 본 발명의 본질적인 특성에서 벗어나지 않는 범위에서 다양한 수정 및 변형이 가능할 것이다. 따라서, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 한정하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 한정되는 것은 아니다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
10: 계통 연계형 인버터 110: 아날로그 입력부
120: 디지털 처리부 130: 디스플레이부

Claims (5)

  1. 계통과 연동하는 계통 연계형 인버터에 있어서,
    계통 3상 계통 전압을 감지하는 아날로그 입력부;
    상기 감지된 상기 3상 계통 전압을 3상 좌표계에서 d-q 정지 좌표계로 변환하고, 상기 d-q 정지 좌표계로 변환된 전압을 d-q 동기 좌표계로 변환하고, 상기 d-q 동기 좌표계로 변환된 전압을 근거로 상기 계통 연계형 인버터와 상기 계통 간의 연결이 정상적인지 여부를 판단하고, 상기 판단 결과, 상기 계통 연계형 인버터와 상기 계통 간의 연결이 비정상적인 연결일 때, 알람 정보를 생성하는 디지털 처리부; 및
    상기 생성된 알람 정보를 표시하는 디스플레이부;를 포함하는 것을 특징으로 하는 계통 연계형 인버터.
  2. 제1항에 있어서, 상기 디지털 처리부는,
    상기 감지된 상기 3상 계통 전압을 아래 수학식을 근거로 3상 좌표계에서 d-q 정지 좌표계로 변환하며,
    Figure 112013025715615-pat00011

    Figure 112013025715615-pat00012

    여기서, 상기 fa, fb 및, fc는, 각각 3상 전압을 나타내고, 상기 fd s 및 fq s는, 2상 정지 좌표계 전압을 나타내는 것을 특징으로 하는 계통 연계형 인버터.
  3. 제1항에 있어서, 상기 디지털 처리부는,
    상기 d-q 정지 좌표계로 변환된 전압을 아래 수학식을 근거로 d-q 동기 좌표계로 변환하며,
    Figure 112013025715615-pat00013

    Figure 112013025715615-pat00014

    여기서, 상기
    Figure 112013025715615-pat00015
    이고, 상기 f는 계통 주파수 60Hz인 것을 특징으로 하는 계통 연계형 인버터.
  4. 제1항에 있어서, 상기 디지털 처리부는,
    상순이 R-S-T 순서로 정상적으로 입력되는지 여부를 확인하기 위해서, 상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 일정한 상수 값을 각각 가지는지 여부를 판단하는 것을 특징으로 하는 계통 연계형 인버터.
  5. 제4항에 있어서, 상기 디지털 처리부는,
    상기 d-q 동기 좌표계로 변환된 d축 값 및 q축 값이 일정한 상수 값을 각각 가지지 않을 때, 상기 계통 연계형 인버터와 상기 계통 간의 연결이 비정상적인 연결인 것으로 판단하고, 상기 알람 정보를 생성하는 것을 특징으로 하는 계통 연계형 인버터.
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