KR101085393B1 - Method and apparatus for executing command to multitasking a plurality of process - Google Patents

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Abstract

호스트 프로세서에서 실행되는 복수의 프로세스를 멀티태스킹하기 위해, 각각의 프로세스마다 대응되는 상태를 설정하여 복수의 프로세스에 대응되는 명령들을 실행하는 전용 프로세스의 명령 처리 방법 및 장치가 개시된다. In order to multitask a plurality of processes executed in a host processor, a method and apparatus for processing instructions for a dedicated process for executing instructions corresponding to a plurality of processes by setting a state corresponding to each process is disclosed.

프로세스, 멀티태스킹, 단일 코어, DSP Process, Multitasking, Single Core, DSP

Description

복수의 프로세스를 멀티태스킹하기 위한 명령 실행 방법 및 장치{Method and apparatus for executing command to multitasking a plurality of process}Method and apparatus for executing command to multitasking a multiple of process}

본 발명은 호스트 프로세서가 실행하고 있는 복수의 프로세스를 멀티태스킹하기 위한 전용 프로세서의 명령 실행 방법 및 장치에 관한 것이고, 보다 상세히는 단일 코어의 프로세서가 외부의 호스트 프로세서로부터 복수의 프로세스에 대응되는 명령들을 수신하여 실행하는 방법 및 장치에 관한 것이다.The present invention relates to a method and an apparatus for executing instructions of a dedicated processor for multitasking a plurality of processes executed by a host processor. More particularly, a single core processor may execute instructions corresponding to a plurality of processes from an external host processor. A method and apparatus for receiving and executing.

최근 대부분의 멀티미디어 기기들은 멀티미디어와 관련된 프로세스의 처리를 위한 전용 프로세서인 DSP(Digital Signal Processor)를 구비한다. 음성, 영상 등과 같은 멀티미디어와 관련된 프로세스의 전용 처리를 위해 호스트 프로세서 이외에 별도의 전용 프로세서를 구비한다. Recently, most multimedia devices have a DSP (Digital Signal Processor), which is a dedicated processor for processing a multimedia related process. A separate dedicated processor is provided in addition to the host processor for dedicated processing of multimedia related processes such as audio and video.

DSP의 경우 비용상의 문제로 인해 단일 코어로 구성하는 경우가 있으며, 이 경우 호스트 프로세서가 복수의 프로세스를 멀티태스킹할 때, 단일 코어 DSP는 멀티태스킹을 할 수 없어 전체 시스템의 성능이 저하되는 경우가 있다. 도 1을 참조하여 상세히 설명한다. In the case of DSP, there is a case in which a single core is configured due to a cost problem. In this case, when a host processor multitasks a plurality of processes, the single core DSP cannot multitask and thus degrades the performance of the entire system. have. This will be described in detail with reference to FIG. 1.

도 1은 종래 기술에 따른 호스트 프로세서 및 단일 코어 DSP를 이용한 복수 의 프로세스를 실행하는 시스템을 도시한다.1 illustrates a system for executing a plurality of processes using a host processor and a single core DSP according to the prior art.

도 1을 참조하면, 호스트 프로세서(120)에서 실행 중인 복수의 프로세스(130 내지 134)에 대응되는 명령들은 단일 코어 DSP(110)에서 실행된다. 이 경우 호스트 프로세서(120)가 복수의 프로세스(130 내지 134)를 멀티태스킹할 때, 단일 코어 DSP(110)는 명령들을 멀티태스킹할 수 없다. DSP(110)에 타이머(timer)가 존재하여 멀티태스킹 동작이 가능하도록 지원하거나, RTOS(real time Operating System) 등의 멀티태스킹을 지원하는 OS가 있는 경우에는 단일 코어 DSP(110)도 복수의 프로세스에 대응되는 명령들을 동시에 처리할 수 있으나, 비용 상의 이유로 타이머가 존재하지 않고 RTOS를 운영 시스템으로 사용하지도 못하는 경우에 단일 코어 DSP(110)는 하나의 프로세스에 대응되는 명령들을 모두 처리하고, 다 처리된 후에 다음 프로세스에 대응되는 명령들을 처리하는 방식으로 순차적으로 프로세스를 실행할 수 있을 뿐이며, 동시에 복수의 프로세스에 대응되는 명령들을 멀티태스킹할 수 없다.Referring to FIG. 1, instructions corresponding to a plurality of processes 130 to 134 running in the host processor 120 are executed in the single core DSP 110. In this case, when the host processor 120 multitasks the plurality of processes 130 to 134, the single core DSP 110 may not multitask the instructions. If a timer exists in the DSP 110 to support a multitasking operation or there is an OS that supports multitasking such as a real time operating system (RTOS), the single core DSP 110 may also have a plurality of processes. In this case, the single core DSP 110 processes all the instructions corresponding to one process and processes all of them when the timer does not exist and the RTOS cannot be used as an operating system for cost reasons. After the process is executed, the processes may be sequentially executed in a manner of processing instructions corresponding to the next process, and the tasks corresponding to the plurality of processes cannot be multitasked at the same time.

따라서, 호스트프로세서(120)의 DSP제어부(122)는 제1 프로세스(130)을 처리하는 동안에는 제2 프로세스(132) 및 제 n 프로세스(134)은 대기하도록 하여 순차적으로 프로세스를 실행한다. Accordingly, the DSP controller 122 of the host processor 120 executes the processes sequentially by allowing the second process 132 and the n-th process 134 to wait while the first process 130 is processed.

이 경우 DSP(110) 하나 때문에 시스템 전체의 성능이 저하되며, 멀티태스킹이 적절히 수행되지 못함에 따라 시스템 사용자가 느끼는 서비스의 질(QoS : Quality of Service)도 현저히 저하될 수 있다.In this case, the performance of the entire system is degraded due to one DSP 110, and as the multitasking is not properly performed, the quality of service (QoS) that the system user feels may be significantly reduced.

본 발명이 해결하고자 하는 과제는 제2 프로세서, 즉 호스트 프로세서에서 실행되는 복수의 프로세스에 대응되는 명령들을 멀티태스킹할 수 있는 제1 프로세서의 명령 실행 방법 및 장치를 제공하는데 있고, 상기 방법을 실행시키기 위한 프로그램을 기록한 컴퓨터로 읽을 수 있는 기록 매체를 제공하는데 있다.An object of the present invention is to provide a method and apparatus for executing instructions of a first processor capable of multitasking instructions corresponding to a plurality of processes executed in a second processor, that is, a host processor. A computer readable recording medium having recorded thereon a program is provided.

상기 기술적 과제를 해결하기 위한 본 발명의 일 실시예에 따른 제1 프로세서가 명령을 실행하는 방법은 제2 프로세서부터 명령을 수신하는 단계; 상기 수신된 명령에 부가된 프로세스를 구별하기 위한 식별자에 기초해 상기 수신된 명령을 실행하기 위한 상기 제1 프로세서의 상태를 설정하는 단계; 상기 수신된 명령을 실행하는 단계; 및 상기 명령을 실행함에 따라 변경된 상기 제1 프로세서의 상태를 저장하는 단계를 포함한다.According to an aspect of the present invention, there is provided a method of executing a command by a first processor, the method comprising: receiving a command from a second processor; Setting a state of the first processor to execute the received command based on an identifier for identifying a process added to the received command; Executing the received command; And storing a state of the first processor changed as the command is executed.

본 발명의 보다 바람직한 실시예에 따르면, 상기 제1 프로세서는 단일 코어 DSP(Digital Signal Processor)인 것을 특징으로 한다.According to a more preferred embodiment of the present invention, the first processor is characterized in that the single core DSP (Digital Signal Processor).

본 발명의 보다 바람직한 실시예에 따르면, 상기 제1 프로세서의 상태는 상기 제1 프로세서의 내부 메모리의 상태 및 상기 명령과 관련된 프로세스를 처리하기 위한 상기 제1 프로세서의 설정값 중 적어도 하나를 포함한다.According to a more preferred embodiment of the present invention, the state of the first processor includes at least one of a state of an internal memory of the first processor and a setting value of the first processor for processing a process related to the instruction.

본 발명의 보다 바람직한 실시예에 따르면, 상기 제1 프로세서의 상태를 복원하는 단계는 상기 수신된 명령에 부가된 프로세스를 구별하기 위한 식별자에 기 초해 상기 수신된 명령과 관련된 제2 프로세서의 프로세스가 이전에 실행된 명령과 관련된 프로세스와 동일한지 판단하는 단계; 및 상기 판단 결과에 기초해 선택적으로 상기 수신된 명령을 실행하기 위한 제1 프로세서의 상태를 복원하는 단계를 포함한다.According to a more preferred embodiment of the present invention, restoring the state of the first processor is based on an identifier for distinguishing a process added to the received instruction, whereby a process of a second processor associated with the received instruction is transferred. Determining whether it is the same as a process associated with an instruction executed in a; And restoring a state of a first processor to selectively execute the received instruction based on the determination result.

상기 기술적 과제를 해결하기 위한 본 발명의 일 실시예에 따른 제2 프로세서가 복수의 프로세스를 실행하는 방법은 상기 복수의 프로세스에 대응되는 명령들 각각에 상기 복수의 프로세스 각각을 식별하기 위한 식별자들을 부가하는 단계; 및 상기 식별자들이 부가된 명령들을 소정의 순서에 따라 제1 프로세서에 전송하는 단계를 포함하고, 상기 제1 프로세서는 상기 식별자들에 기초해 각각의 프로세스마다 대응되는 제1 프로세서의 상태를 설정하고, 설정된 상태에 기초해 상기 수신된 명령들을 실행하는 것을 특징으로 한다.According to an embodiment of the present disclosure, a method for executing a plurality of processes by a second processor includes adding identifiers for identifying each of the plurality of processes to each of the instructions corresponding to the plurality of processes. Making; And transmitting the instructions to which the identifiers are added to a first processor in a predetermined order, wherein the first processor sets a state of a first processor corresponding to each process based on the identifiers, And execute the received commands based on the set state.

상기 기술적 과제를 해결하기 위한 본 발명의 일 실시예에 따른 제1 프로세서는 제2 프로세서부터 명령을 수신하고, 수신된 명령을 큐잉하는 명령큐; 상기 수신된 명령에 부가된 프로세스를 구별하기 위한 식별자에 기초해 상기 수신된 명령을 실행하기 위한 상기 제1 프로세서의 상태를 설정하는 상태제어부; 및 상기 수신된 명령을 실행하는 명령실행부를 포함하고, 상기 상태제어부는 상기 명령을 실행함에 따라 변경된 상기 제1 프로세서의 상태를 저장하는 것을 특징으로 한다.According to an aspect of the present invention, there is provided a first processor including an instruction queue configured to receive a command from a second processor and to queue the received instruction; A state controller configured to set a state of the first processor to execute the received command based on an identifier for identifying a process added to the received command; And a command execution unit that executes the received command, wherein the state control unit stores the state of the first processor changed as the command is executed.

상기 기술적 과제를 해결하기 위한 본 발명의 일 실시예에 따른 제2 프로세서는 복수의 프로세스를 실행하는 프로세스실행부; 및 상기 제2 프로세서에서 실행되는 복수의 프로세스에 대응되는 명령들 각각에 상기 복수의 프로세스 각각을 식 별하기 위한 식별자들을 부가하고, 상기 식별자들이 부가된 명령들을 소정의 순서에 따라 제1 프로세서에 전송하는 제1프로세서제어부를 포함하고, 상기 제1 프로세서는 상기 식별자들에 기초해 각각의 프로세스마다 대응되는 제1 프로세서의 상태를 설정하고, 설정된 상태에 기초해 상기 수신된 명령들을 실행하는 것을 특징으로 한다.According to an aspect of the present invention, there is provided a second processor including a process execution unit configured to execute a plurality of processes; And an identifier for identifying each of the plurality of processes to each of instructions corresponding to the plurality of processes executed in the second processor, and transmitting the instructions with the identifiers to the first processor in a predetermined order. And a first processor controller configured to set a state of a first processor corresponding to each process based on the identifiers, and execute the received instructions based on the set state. do.

상기 기술적 과제를 해결하기 위해 본 발명은 상기된 명령 실행 방법 및 프로세스 실행 방법을 실행하기 위한 프로그램을 기록한 컴퓨터로 읽을 수 있는 기록 매체를 제공한다. In order to solve the above technical problem, the present invention provides a computer-readable recording medium having recorded thereon a program for executing the above-described command execution method and process execution method.

본 발명에 따르면, RTOS를 OS로 이용하지 않고, 타이머도 구비하지 않는 전용 프로세서가 호스트 프로세서로부터 수신되는 복수의 프로세스에 대응되는 명령들을 멀티태스킹할 수 있어 보다 저렴한 비용으로 효율적으로 멀티태스킹이 가능한 시스템을 구성할 수 있다.According to the present invention, a dedicated processor that does not use an RTOS as an OS and does not have a timer can multitask instructions corresponding to a plurality of processes received from a host processor, thereby enabling efficient multitasking at a lower cost. Can be configured.

이하에서는 도면을 참조하여 본 발명의 바람직한 실시예들을 상세히 설명한다. Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 2는 본 발명의 일 실시예에 따른 제1 프로세서를 도시한다.2 illustrates a first processor according to an embodiment of the present invention.

도 2를 참조하면, 본 발명에 따른 제1 프로세서(200)는 명령큐(210), 상태제어부(220) 및 명령실행부(230)를 포함한다. 제1 프로세서(200)는 호스트 프로세서인 제2 프로세서로부터 명령(command)들을 수신하여 처리하는 프로세서이며, 멀티 미디어와 관련된 프로세스같이 특정 종류의 프로세스와 관련된 명령들을 처리하는 전용 프로세서일 수 있다. 본 발명의 일 실시예에 따르면, 제1 프로세서(200)는 단일 코어 DSP(Digital Signal Processor)로서 타이머(Timer) 또는 RTOS(Real Time Operating System)와 같이 멀티태스킹을 위한 별도의 기능들을 구비하지 아니한 프로세서일 수 있다. 2, the first processor 200 according to the present invention includes a command queue 210, a state control unit 220, and a command execution unit 230. The first processor 200 is a processor that receives and processes commands from a second processor, which is a host processor, and may be a dedicated processor that processes commands related to a specific type of process, such as a process related to multimedia. According to an embodiment of the present invention, the first processor 200 is a single-core digital signal processor (DSP) that does not have separate functions for multitasking, such as a timer or a real time operating system (RTOS). It may be a processor.

명령큐(210)는 제2 프로세서로부터 복수의 프로세스에 대응되는 명령들을 수신하여, 큐잉(queing)한다. 명령들을 수신하는 순서는 프로세스의 순서에 따르지 않는다. 예를 들어, 제1 프로세스에 대응되는 명령들을 모두 수신하고, 제2 프로세스에 대응되는 명령들을 수신하는 것이 아니라, 제1 프로세스에 대응되는 명령들을 전부 수신하기 이전에 제2 프로세스 또는 제3 프로세스에 대응되는 명령들을 수신할 수 있다. 도 3을 참조하여 상세히 설명한다.The command queue 210 receives the instructions corresponding to the plurality of processes from the second processor and queues them. The order of receiving instructions does not depend on the order of processes. For example, instead of receiving all instructions corresponding to the first process and receiving instructions corresponding to the second process, the second process or the third process may not be received before receiving all the instructions corresponding to the first process. Corresponding commands may be received. This will be described in detail with reference to FIG. 3.

도 3은 본 발명의 일 실시예에 따른 제2 프로세서 및 제2 프로세서의 명령 전송 방법을 도시한다. 3 illustrates a second processor and a method of transmitting a command of a second processor according to an embodiment of the present invention.

도 3을 참조하면, 본 발명의 일 실시예에 따른 제2 프로세서(300)는 프로세스실행부(310) 및 프로세서제어부(320)를 포함한다. 제2 프로세서(300)는 호스트 프로세서로서 예를 들어, ARM(Advanced RISC Machine) 프로세서일 수 있다. 프로세스실행부(310)는 복수의 프로세스를 실행한다. 복수의 프로세스를 멀티태스킹하여 동시에 실행한다. Referring to FIG. 3, the second processor 300 according to an embodiment of the present invention includes a process execution unit 310 and a processor control unit 320. The second processor 300 may be, for example, an ARM (Advanced RISC Machine) processor as a host processor. The process execution unit 310 executes a plurality of processes. Multitask and run multiple processes simultaneously.

프로세서제어부(320)는 복수의 프로세스(330 내지 334)에 대응되는 명령어들을 제1 프로세서(200)에 전송한다. 프로세스실행부(310)에서 멀티태스킹 중인 복 수의 프로세스에 대응되는 명령들을 제1 프로세서에 전송한다. 명령들을 전송하는 순서는 실행 중인 복수의 프로세스의 실행 순서에 따르지 아니한다. The processor controller 320 transmits instructions corresponding to the plurality of processes 330 to 334 to the first processor 200. The process execution unit 310 transmits instructions corresponding to a plurality of processes being multitasked to the first processor. The order of sending the instructions does not depend on the order of execution of the plurality of running processes.

도 3에 도시된 바와 같이, 제1 프로세스(330)에 대응되는 명령어 중 명령1 및 명령2를 먼저 전송하고, 그 다음 제2 프로세스(332)에 대응되는 명령어 중 명령 1 및 명령2를 전송한다. 제1 프로세스(330)에 대응되는 명령어들을 모두 전송한 후에 다음 프로세스인 제2 프로세스(332)에 대응되는 명령어들을 전송하는 것이 아니기 때문에 제1 프로세스(330)를 실행하는 동안 제2 프로세스(332)가 대기할 필요가 없다. As shown in FIG. 3, command 1 and command 2 of the command corresponding to the first process 330 are transmitted first, and then command 1 and command 2 of the command corresponding to the second process 332 are transmitted. . The second process 332 is executed while the first process 330 is not executed because the commands corresponding to the second process 332 which is the next process are not transmitted after all the instructions corresponding to the first process 330 are transmitted. There is no need to wait.

프로세서제어부(320)는 명령들을 제1 프로세서(200)에 전송함에 있어, 각각의 명령에 부가한다. 제1 프로세서(200)가 프로세스(330 내지 334)에 따라 구별하여 명령을 실행하게 하기 위해 식별자가 부가한다. 각각의 명령이 어떤 프로세스에 대응되는 명령인지를 나타내는 프로세스 식별자를 부가한다. 도 4a 및 4b를 참조하여 상세히 설명한다. The processor controller 320 adds the instructions to each instruction in transmitting the instructions to the first processor 200. An identifier is added to allow the first processor 200 to execute instructions in accordance with the processes 330 through 334. Add a process identifier indicating which process each command corresponds to. This will be described in detail with reference to FIGS. 4A and 4B.

도 4a는 본 발명의 일 실시예에 따른 멀티태스킹 중인 프로세스들을 식별하기 위한 식별자를 도시한다.4A illustrates an identifier for identifying processes that are multitasking in accordance with one embodiment of the present invention.

도 4a를 참조하면, 프로세서제어부(320)는 제1 프로세서(200)에 명령을 전송할 때 각각의 명령(410)이 어떠한 프로세스에 대응되는 명령인지를 나타내는 식별자(420)를 부가하여 전송한다. 제2 프로세서(300)에서 실행 중인 복수의 프로세스들 각각에 식별자들을 할당하고, 할당된 식별자들을 각각의 프로세스에 대응되는 명령들에 부가한다.Referring to FIG. 4A, when transmitting a command to the first processor 200, the processor controller 320 adds and transmits an identifier 420 indicating which process each command 410 corresponds to. The identifiers are assigned to each of the plurality of processes running in the second processor 300, and the assigned identifiers are added to the instructions corresponding to the respective processes.

도 4b는 본 발명의 또 다른 실시예에 따른 멀티태스킹 중인 프로세스들을 식별하기 위한 식별자를 도시한다.4B illustrates an identifier for identifying processes that are multitasking in accordance with another embodiment of the present invention.

도 4b를 참조하면, 프로세서제어부(320)가 각각의 명령(410)에 식별자(420)를 부가함에 있어, 보다 세분화된 복수의 식별자(422 및 424)를 부가할 수 있다. 복수의 식별자(422 및 424)를 이용해 명령과 관련된 프로세스를 보다 용이하게 식별할 수 있다. Referring to FIG. 4B, when the processor controller 320 adds the identifier 420 to each command 410, a plurality of more detailed identifiers 422 and 424 may be added. Multiple identifiers 422 and 424 may be used to more readily identify the process associated with the command.

제1 프로세서(200)가 DSP인 경우에 호스트 프로세서에서 실행 중인 프로세스들(330 내지 334)이 상이한 프로세스라 하더라도 DSP의 동일한 하드웨어 자원을 이용할 수 있다. 예를 들어, DSP의 동일한 하드웨어 자원 즉, 동일한 코덱을 이용하는 복수의 멀티미디어 프로세스가 있는 경우에 복수의 프로세스를 프로세스의 실행을 위해 이용되는 코덱을 기준으로 우선 식별하고, 다음으로 제1 프로세서(200)가 프로세스를 처리하기 위해 할당한 타임 슬롯(time slot)을 기준으로 프로세스를 식별할 수 있다. 이 경우 제1 식별자(422)는 타임 슬롯에 대한 식별자일 수 있고, 제2 식별자(424)는 코덱에 대한 식별자일 수 있다. 이와 같이 복수의 식별자를 사용하면, 동일한 코덱을 이용하는 복수의 프로세스일 경우에도 타임 슬롯이 상이하면 상이한 프로세스로 식별할 수 있고, 이러한 식별을 기초해 대응되는 제1 프로세서(200)의 상태를 설정하여 각각의 프로세스를 실행할 수 있게 된다. When the first processor 200 is a DSP, the same hardware resources of the DSP may be used even if the processes 330 to 334 running in the host processor are different processes. For example, when there are a plurality of multimedia processes using the same hardware resources of the DSP, that is, the same codec, the plurality of processes are first identified based on the codec used to execute the process, and then the first processor 200 A process may be identified based on a time slot allocated to process the process. In this case, the first identifier 422 may be an identifier for a time slot, and the second identifier 424 may be an identifier for a codec. By using a plurality of identifiers as described above, even in the case of a plurality of processes using the same codec, if the time slots are different, they can be identified as different processes, and based on the identification, the state of the corresponding first processor 200 Each process will be able to run.

다시 도 2를 참조하면, 제2 프로세서(300)의 프로세서제어부(320)로부터 프로세스를 식별하기 위한 식별자가 부가된 명령들을 수신한 제1 프로세서(200)는 수신된 명령들을 명령큐(210)에 큐잉한다. 명령들이 수신된 순서에 따라 차례로 명 령을 실행하기 위해 스택 등과 같은 내부 메모리에 명령들을 큐잉한다. Referring to FIG. 2 again, the first processor 200 that receives the instructions with the identifier for identifying the process from the processor control unit 320 of the second processor 300 sends the received instructions to the command queue 210. Queuing Queries instructions in internal memory, such as a stack, to execute instructions in the order in which they were received.

상태제어부(220)는 명령큐(210)에 큐잉된 명령들을 하나씩 수신하고, 수신된 명령에 부가된 식별자에 기초해 수신된 명령을 실행하기 위한 상태를 설정한다. 수신된 명령에 부가된 식별자에 기초해 현재 제1 프로세서(200)의 상태와 다른 제1 프로세서(200)의 상태를 설정할지 판단하고, 판단 결과에 기초해 선택적으로 제1 프로세서(200)의 상태를 재설정한다. 본 발명의 일 실시예에 따르면, 필요한 경우 외부메모리(400)에 저장된 제1 프로세서(200)의 상태에 대한 정보를 참조하여 수신된 명령을 실행하기 위한 제1 프로세서(200)의 상태를 설정할 수 있다. The state controller 220 receives commands queued to the command queue 210 one by one, and sets a state for executing the received command based on an identifier added to the received command. It is determined whether to set the state of the first processor 200 that is different from the state of the current first processor 200 based on the identifier added to the received instruction, and optionally the state of the first processor 200 based on the determination result. Reset it. According to an embodiment of the present invention, if necessary, the state of the first processor 200 for executing the received command may be set with reference to the information on the state of the first processor 200 stored in the external memory 400. have.

수신된 명령이 이전 실행된 명령과 동일한 프로세스를 구별하기 위한 식별자가 동일한 경우 즉, 동일한 프로세스와 관련된 명령인 경우 제1 프로세서(200)의 현재 상태를 그대로 이용하여 명령을 실행하면 된다. 그러나, 수신된 명령이 이전 실행된 명령과 다른 프로세스와 관련된 명령인 경우 다른 상태를 설정할 필요가 있다. When the received command is the same identifier for distinguishing the same process as the previously executed command, that is, the command related to the same process, the command may be executed using the current state of the first processor 200 as it is. However, if the received command is a command related to a process other than the previously executed command, a different state needs to be set.

제1 프로세서(200)의 상태는 명령을 처리하기 위해 참조하는 제1 프로세서(200)의 내부 메모리의 상태 및 프로세스를 처리하기 위한 제1 프로세서(200)의 설정값들을 포함할 수 있다. 제1 프로세서(200)가 수신된 명령을 처리하기 위해서 내부 메모리에 저장된 데이터를 참조하는 경우, 이러한 내부 메모리의 데이터가 제1 프로세서(200)가 설정해야 하는 내부 메모리의 상태일 수 있다. 또한, 제1 프로세서(200)의 실행 환경은 프로세스에 따라 상이할 수 있으므로, 현재 수신된 명령을 처리하기 위해 프로세스의 실행 환경을 설정하기 위한 설정값이 제1 프로세 서(200)의 상태일 수 있다. The state of the first processor 200 may include a state of an internal memory of the first processor 200 referred to for processing an instruction and setting values of the first processor 200 for processing a process. When the first processor 200 refers to data stored in the internal memory in order to process the received command, the data of the internal memory may be a state of the internal memory that the first processor 200 needs to set. In addition, since the execution environment of the first processor 200 may be different according to the process, the setting value for setting the execution environment of the process to process the currently received instruction is the state of the first processor 200. Can be.

예를 들어, H.264 코덱을 이용한 동영상의 인코딩 또는 디코딩과 관련하여 제1 프로세서의 내부 메모리에는 참조 픽처 또는 참조 블록에 대한 데이터가 존재해야 하므로, 이러한 참조 픽처 또는 참조 블록에 대한 데이터를 내부 메모리에 복원한다. 또한, H.264 코덱을 이용한 인코딩 또는 디코딩의 실행 환경을 설정하는데 필요한 영상의 해상도(resolution), 프레임율(frame rate)과 같은 설정값들도 복원한다. For example, in relation to encoding or decoding a video using the H.264 codec, data for a reference picture or a reference block must exist in the internal memory of the first processor. Therefore, the data for the reference picture or the reference block is stored in the internal memory. To restore. In addition, settings such as resolution and frame rate of an image required to set an execution environment of encoding or decoding using the H.264 codec are also restored.

이러한 제1 프로세서(200)의 상태는 프로세스마다 상이하다. 상이한 프로세스에 대응되는 명령들은 대응되는 제1 프로세서(200)의 상태를 기초로 제1 프로세서(200)에서 실행된다. 따라서, 도 1에 도시된 바와 같은 종래 기술에 따르면, 이미 실행 중인 프로세스(130)가 모두 실행될 때까지 나머지 프로세스들(132 내지 134)이 대기해야 한다. 다른 프로세스의 우선 순위가 이미 실행 중인 프로세스(130)보다 높은 경우에는 실행 중인 프로세스(130)의 실행을 위한 단일 코어 DSP(110)의 상태를 모두 초기화하고 새로운 프로세스를 실행시켜야 했다. 따라서, 우선 순위가 높은 프로세스를 모두 실행할 이후 실행 중이었던 프로세스(130)를 다시 실행하는 경우에 프로세스를 처음부터 다시 시작해야 했다.The state of the first processor 200 is different for each process. Instructions corresponding to different processes are executed in the first processor 200 based on the state of the corresponding first processor 200. Thus, according to the prior art as shown in FIG. 1, the remaining processes 132 to 134 have to wait until all of the processes 130 already running are executed. If the priority of another process was higher than the process 130 already running, it was necessary to initialize all the states of the single core DSP 110 for execution of the running process 130 and execute a new process. Therefore, when executing the process 130 that was running after executing all the high priority processes, the process had to be restarted from the beginning.

그러나, 본 발명의 일 실시예에 따르면, 명령 단위로 대응되는 제1 프로세서(200)의 상태를 외부메모리(400)로부터 가져와 설정할 수 있기 때문에 실행 중이었던 프로세스를 중지하더라도, 처음부터 실행하지 아니하고, 중지된 이후의 명령부터 이어서 프로세스를 실행할 수 있다. 외부메모리(400)는 제1 프로세서(200)의 상태를 저장하는 저장소의 예시일 뿐이며, 제1 프로세서(200)의 상태를 저장하는 저장소는 이에 한정되지 아니한다. 예를 들어, 제1 프로세서(200)의 내부 메모리 일부를 제1 프로세서(200)의 상태를 저장하는데 이용할 수도 있다.However, according to an embodiment of the present invention, since the state of the first processor 200 corresponding to the instruction unit can be obtained and set from the external memory 400, even if the running process is stopped, the first processor 200 is not executed from the beginning. You can continue the process from the command after it is stopped. The external memory 400 is only an example of a storage storing the state of the first processor 200, and the storage storing the state of the first processor 200 is not limited thereto. For example, a portion of the internal memory of the first processor 200 may be used to store the state of the first processor 200.

또한, 상태제어부(220)는 명령실행부(230)의 명령 실행 결과 제1 프로세서(200)의 상태를 저장할 필요가 있는 경우에 제1 프로세서(200)의 상태를 저장한다. 내부 메모리에 별도의 저장 공간을 할당하고 할당된 공간에 저장할 수도 있고, 도 2에 도시된 바와 같이 외부메모리(400)에 저장할 수도 있다. 저장되는 상태가 어떠한 프로세스에 대한 상태인지를 식별할 수 있도록 도 4a 또는 4b에 도시된 바와 같은 식별자와 함께 상태를 저장할 수 있다. 각각의 명령을 실행하여 상태의 변경이 생길 때마다 제1 프로세서(200)의 상태를 저장할 수도 있고, 수신된 명령을 실행하기 전에 이전 명령과 관련된 프로세스와 수신된 명령과 관련된 프로세스가 동일한지 판단하여 제1 프로세서(200)의 상태를 저장할 수도 있다.In addition, the state controller 220 stores the state of the first processor 200 when it is necessary to store the state of the first processor 200 as a result of the instruction execution of the instruction execution unit 230. A separate storage space may be allocated to the internal memory and stored in the allocated space, or may be stored in the external memory 400 as shown in FIG. 2. The state may be stored with an identifier as shown in FIG. 4A or 4B to identify which process the state being stored is for. Whenever a change of state occurs by executing each command, the state of the first processor 200 may be stored, and before executing the received command, it is determined whether the process related to the previous command and the process related to the received command are the same. The state of the first processor 200 may be stored.

명령실행부(230)는 상태제어부(220)에서 설정된 제1 프로세서(200)의 상태에 기초해 명령을 실행한다. The command execution unit 230 executes a command based on the state of the first processor 200 set by the state control unit 220.

도 5a는 본 발명의 일 실시예에 따른 제1 프로세서(200)의 명령 실행 방법을 설명하기 위한 흐름도이다.5A is a flowchart for describing a method of executing an instruction of the first processor 200 according to an exemplary embodiment.

도 5a를 참조하면, 단계 510에서 제1 프로세서(200)는 제2 프로세서(300)로부터 명령을 수신한다. 제2 프로세서(300)에서 실행 중인 복수의 프로세스에 대응되는 명령들을 하나씩 수신한다. 명령들을 수신하는 순서는 도 3과 관련하여 전술하였다. 제2 프로세서(300)에서 실행되는 복수의 프로세스를 식별하기 위해 각각 의 프로세스에 부가된 식별자도 명령과 함께 수신한다. 제1 프로세서(200)는 단일 코어 DSP와 같은 전용 프로세서일 수 있으며, 제2 프로세서는 ARM 프로세서와 같은 호스트 프로세서일 수 있음은 전술하였다. Referring to FIG. 5A, in operation 510, the first processor 200 receives a command from the second processor 300. Commands corresponding to a plurality of processes running in the second processor 300 are received one by one. The order of receiving commands has been described above with reference to FIG. 3. An identifier added to each process is also received with the command to identify the plurality of processes executed in the second processor 300. The first processor 200 may be a dedicated processor such as a single core DSP, and the second processor may be a host processor such as an ARM processor.

단계 512에서 제1 프로세서(200)는 단계 510에서 수신된 식별자에 기초해 수신된 명령을 실행하기 위한 제1 프로세서의 상태를 설정한다. 식별자는 단계 510에서 수신된 각각의 명령을 프로세스에 따라 구분하기 위한 식별자이다. 따라서, 식별자에 기초해 프로세스마다 대응되는 제1 프로세서(200)의 상태를 설정하며, 필요한 경우 외부 메모리(400)에 저장된 상태 정보를 참조할 수 있다. In operation 512, the first processor 200 sets a state of the first processor for executing the received command based on the identifier received in operation 510. The identifier is an identifier for distinguishing each command received in step 510 according to the process. Therefore, the state of the first processor 200 corresponding to each process is set based on the identifier, and if necessary, the state information stored in the external memory 400 may be referred to.

단계 514에서 제1 프로세서(200)는 수신된 명령을 단계 512에서 복원된 제1 프로세서(200)의 상태에 기초해 실행한다. In operation 514, the first processor 200 executes the received command based on the state of the first processor 200 restored in operation 512.

단계 516에서 제1 프로세서(200)는 수신된 명령의 실행에 따라 변경된 제1 프로세서(200)의 상태를 저장한다, 소정의 외부 메모리에 현재 제1 프로세서(200)의 상태를 저장한다.In operation 516, the first processor 200 stores the changed state of the first processor 200 according to the execution of the received command. The first processor 200 stores the current state of the first processor 200 in a predetermined external memory.

도 5b는 본 발명의 또 다른 일 실시예에 따른 제1 프로세서(200)의 명령 실행 방법을 설명하기 위한 흐름도이다.5B is a flowchart illustrating a method of executing an instruction of the first processor 200 according to another exemplary embodiment of the present invention.

도 5b를 참조하면, 단계 520에서 제1 프로세서(200)는 제2 프로세서(300)로부터 명령을 수신한다. 도 5a에 도시된 단계 510에 대응되는 단계이다. Referring to FIG. 5B, in operation 520, the first processor 200 receives a command from the second processor 300. This step corresponds to step 510 of FIG. 5A.

단계 522에서 제1 프로세서(200)는 단계 520에서 수신된 명령이 새로운 프로세스의 최초 명령인지 판단한다. 이전에 실행한 프로세스가 아닌 새로운 프로세스의 최초 명령인지 판단한다. In operation 522, the first processor 200 determines whether the command received in operation 520 is an initial command of a new process. Determine if the command is the first command of a new process, not a previously executed process.

단계 522의 판단결과 수신된 명령이 새로운 프로세스의 최초 명령으로 판단되면, 단계 524에서 제1 프로세서(200)는 현재 제1 프로세서의 상태를 저장한다. 최초 명령이므로 제1 프로세서(200)의 상태의 복원이 아닌 초기화가 수행된다. 이를 위해 우선 이전 처리된 명령과 관련된 프로세스를 나중에 다시 실행하기 위해 현재 제1 프로세서(200)의 상태를 외부 메모리(400)에 저장한다. 그런 다음, 단계 526에서 제1 프로세서(200)는 새로운 프로세스의 식별자를 등록하고, 제1 프로세서(200)의 상태를 초기화한다. 새로운 프로세스를 실행하기 위한 상태로 초기화한다. If it is determined in step 522 that the received command is the first command of the new process, the first processor 200 stores the current state of the first processor in step 524. Since this is the first command, the initialization is performed, not the restoration of the state of the first processor 200. To this end, first, the state of the first processor 200 is stored in the external memory 400 in order to execute a process related to a previously processed instruction again later. In operation 526, the first processor 200 registers an identifier of the new process and initializes the state of the first processor 200. Initialize the state to run a new process.

단계 522의 판단결과 수신된 명령이 새로운 프로세스의 최초 명령이 아닌 것으로 판단되면, 단계 528 내지 532를 통해 제1 프로세스의 상태를 복원한다. If it is determined in step 522 that the received command is not the first command of the new process, the state of the first process is restored through steps 528 to 532.

단계 528에서 제1 프로세서(200)는 수신된 명령과 관련된 프로세스가 이전 명령과 관련된 프로세스와 동일한지 판단한다. 수신된 명령에 부가된 프로세스 식별자와 이전 명령의 프로세스 식별자를 비교하여 동일한지 판단한다. In operation 528, the first processor 200 determines whether a process related to the received command is the same as a process related to the previous command. The process identifier added to the received command and the process identifier of the previous command are compared to determine whether they are the same.

수신된 명령과 관련된 프로세스가 이전 명령과 관련된 프로세스와 동일하다면, 현재 제1 프로세서(200)의 상태를 그대로 이용해 명령을 실행하면 되므로, 제1 프로세서(200)의 상태를 복원할 필요는 없으며, 단계 534에서 수신된 명령을 실행한다. If the process related to the received command is the same as the process related to the previous command, the command may be executed using the current state of the first processor 200 as it is, and there is no need to restore the state of the first processor 200. Run the command received at 534.

그러나, 수신된 명령과 관련된 프로세스가 이전 명령과 관련된 프로세스와 동일하지 않다면, 단계 530에서 현재 제1 프로세서(200)의 상태를 외부 메모리(400)에 저장한다. 그런 다음 단계 532에서 수신된 명령을 실행하기 위한 상태 를 복원한다. 수신된 명령에 부가되어 있는 프로세스 식별자에 기초해 외부 메모리(400)에 저장되어 있는 제1 프로세서(200)의 상태를 복원한다. 상태가 복원되면 단계 534에서 복원된 상태에 기초해 수신된 명령을 실행한다. However, if the process associated with the received instruction is not the same as the process associated with the previous instruction, in step 530 the current state of the first processor 200 is stored in the external memory 400. Then, the state for executing the command received in step 532 is restored. The state of the first processor 200 stored in the external memory 400 is restored based on the process identifier added to the received command. If the state is restored, the received command is executed based on the restored state in step 534.

수신된 명령의 실행이 모두 완료되면, 제1 프로세서(200)는 단계 536에서 실행된 명령이 프로세스의 최후 명령인지 판단한다. 최후 명령이 아닌 것으로 판단되면, 단계 520에서 다시 제2 프로세서로부터 명령을 수신한다. When the execution of the received command is completed, the first processor 200 determines whether the command executed in step 536 is the last command of the process. If it is determined that it is not the last command, the command is received again from the second processor in step 520.

단계 536에서 수신된 명령이 프로세스의 최후 명령인 것으로 판단되면, 단계 538에서 제1 프로세서(200)는 종료되지 않은 다른 프로세스가 있는지 판단한다. 다른 프로세스가 있다면, 종료되지 않은 다른 프로세스에 대응되는 명령을 제2 프로세서로부터 수신하여 실행을 계속한다.If it is determined that the command received in step 536 is the last command of the process, in step 538, the first processor 200 determines whether there is another process that is not terminated. If there is another process, the instruction corresponding to another process not terminated is received from the second processor to continue execution.

도 6은 본 발명의 일 실시예에 따른 제2 프로세서(300)가 제1 프로세서에 명령을 전송하는 방법을 설명하기 위한 흐름도이다.6 is a flowchart illustrating a method of transmitting a command to the first processor by the second processor 300 according to an embodiment of the present invention.

도 6을 참조하면, 단계 610에서 제2 프로세서(300)는 실행 중인 프로세스에 대응되는 명령들 각각에 프로세스 식별자들을 부가한다. 제1 프로세스에 대응되는 명령에는 제1 프로세스의 프로세스 식별자를 부가하고, 제2 프로세스에 대응되는 명령에는 제2 프로세스의 프로세스 식별자를 부가한다. 프로세스 식별자와 관련하여서는 도 4a 및 4b와 관련하여 전술하였다.Referring to FIG. 6, in operation 610, the second processor 300 adds process identifiers to each of instructions corresponding to a running process. A command corresponding to the first process is added to the instruction corresponding to the first process, and a process identifier of the second process is added to the instruction corresponding to the second process. Regarding the process identifier, the foregoing has been described with reference to Figs. 4A and 4B.

단계 620에서 제2 프로세서(300)는 프로세스 식별자들이 부가된 명령들을 제1 프로세서에 전송한다. 명령들을 소정의 순서에 따라 제1 프로세서(200)에 전송하는데 이 순서는 프로세스의 우선 순위와 일치하지 않음은 전술하였다. 예를 들 어, 제1 프로세스에 대응되는 명령들을 모두 전송하기 이전에 제2 프로세스에 대응되는 명령들을 전송할 수 있다. 이와 관련된 상세한 설명은 도 3과 관련하여 전술하였다. In operation 620, the second processor 300 transmits instructions to which the process identifiers are added, to the first processor. The instructions are transmitted to the first processor 200 in a predetermined order, which is not described above with respect to the priority of the processes. For example, before all the commands corresponding to the first process are transmitted, the commands corresponding to the second process may be transmitted. Detailed description related to this has been described above with reference to FIG. 3.

이상과 같이 본 발명은 비록 한정된 실시예와 도면에 의해 설명되었으나, 본 발명이 상기의 실시예에 한정되는 것은 아니며, 이는 본 발명이 속하는 분야에서 통상의 지식을 가진 자라면 이러한 기재로부터 다양한 수정 및 변형이 가능하다. 따라서, 본 발명의 사상은 아래에 기재된 특허청구범위에 의해서만 파악되어야 하고, 이와 균등하거나 또는 등가적인 변형 모두는 본 발명 사상의 범주에 속한다 할 것이다. 또한, 본 발명에 따른 시스템은 컴퓨터로 읽을 수 있는 기록매체에 컴퓨터가 읽을 수 있는 코드로서 구현하는 것이 가능하다. 컴퓨터가 읽을 수 있는 기록매체는 컴퓨터 시스템에 의하여 읽혀질 수 있는 데이터가 저장되는 모든 종류의 기록장치를 포함한다. 기록매체의 예로는 ROM, RAM, CD-ROM, 자기 테이프, 플로피 디스크, 광데이터 저장장치 등이 있으며, 또한 캐리어 웨이브(예를 들어 인터넷을 통한 전송)의 형태로 구현되는 것도 포함한다. 또한 컴퓨터가 읽을 수 있는 기록매체는 네트워크로 연결된 컴퓨터 시스템에 분산되어 분산방식으로 컴퓨터가 읽을 수 있는 코드가 저장되고 실행될 수 있다.As described above, although the present invention has been described by way of limited embodiments and drawings, the present invention is not limited to the above-described embodiments, which can be variously modified and modified by those skilled in the art to which the present invention pertains. Modifications are possible. Accordingly, the spirit of the invention should be understood only by the claims set forth below, and all equivalent or equivalent modifications will fall within the scope of the invention. In addition, the system according to the present invention can be embodied as computer readable codes on a computer readable recording medium. The computer-readable recording medium includes all kinds of recording devices in which data that can be read by a computer system is stored. Examples of the recording medium include a ROM, a RAM, a CD-ROM, a magnetic tape, a floppy disk, an optical data storage device, and the like, and also include a carrier wave (for example, transmission through the Internet). The computer readable recording medium can also be distributed over network coupled computer systems so that the computer readable code is stored and executed in a distributed fashion.

도 1은 종래 기술에 따른 호스트 프로세서 및 단일 코어 DSP를 이용한 복수의 프로세스를 실행하는 시스템을 도시한다.1 illustrates a system for executing a plurality of processes using a host processor and a single core DSP according to the prior art.

도 2는 본 발명의 일 실시예에 따른 제1 프로세서를 도시한다.2 illustrates a first processor according to an embodiment of the present invention.

도 3은 본 발명의 일 실시예에 따른 제2 프로세서 및 제2 프로세서의 명령 전송 방법을 도시한다. 3 illustrates a second processor and a method of transmitting a command of a second processor according to an embodiment of the present invention.

도 4a는 본 발명의 일 실시예에 따른 멀티태스킹 중인 프로세스들을 식별하기 위한 식별자를 도시한다.4A illustrates an identifier for identifying processes that are multitasking in accordance with one embodiment of the present invention.

도 4b는 본 발명의 또 다른 실시예에 따른 멀티태스킹 중인 프로세스들을 식별하기 위한 식별자를 도시한다.4B illustrates an identifier for identifying processes that are multitasking in accordance with another embodiment of the present invention.

도 5a는 본 발명의 일 실시예에 따른 제1 프로세서의 명령 실행 방법을 설명하기 위한 흐름도이다.5A is a flowchart illustrating a method of executing an instruction of a first processor according to an embodiment of the present invention.

도 5b는 본 발명의 또 다른 일 실시예에 따른 제1 프로세서의 명령 실행 방법을 설명하기 위한 흐름도이다.5B is a flowchart illustrating a method of executing an instruction of a first processor, according to another exemplary embodiment.

도 6은 본 발명의 일 실시예에 따른 제2 프로세서가 제1 프로세서에 명령을 전송하는 방법을 설명하기 위한 흐름도이다.6 is a flowchart illustrating a method for transmitting a command to a first processor by a second processor according to an embodiment of the present invention.

Claims (16)

제1 프로세서가, 복수의 프로세스를 실행하는 제2 프로세서로부터 상기 복수의 프로세스에 대응하는 명령들을 수신하는 단계;Receiving, by a first processor, instructions corresponding to the plurality of processes from a second processor executing a plurality of processes; 상기 수신된 명령들에 관련된 프로세스를 구별하기 위한 식별자에 기초하여, 상기 수신된 명령들 중 어느 하나의 명령을 실행하기 위한 상기 제1 프로세서의 상태를 설정하는 단계;Related to the received commands Setting a state of the first processor to execute any one of the received instructions based on an identifier for identifying a process; 상기 제1 프로세서가 설정된 상태에 따라 상기 하나의 명령을 실행하는 단계; 및Executing the one instruction according to the state in which the first processor is set; And 상기 하나의 명령을 실행함에 따라 변경된 상기 제1 프로세서의 상태를 저장하는 단계를 포함하며,Storing a state of the first processor changed as the one instruction is executed, 상기 제1 프로세서의 상태를 설정하는 단계는Setting the state of the first processor 상기 하나의 명령이 새로운 프로세스에 대한 최초 명령인지 판단하는 단계; 및Determining whether the one instruction is the first instruction for a new process; And 상기 판단 결과에 따라 선택적으로 상기 제1 프로세서의 상태를 복원하는 단계를 포함하는 것을 특징으로 하는 것을 특징으로 하는 명령 실행 방법.Selectively restoring the state of the first processor according to the determination result. 제 1 항에 있어서, 상기 제1 프로세서는The method of claim 1, wherein the first processor 단일 코어 DSP(Digital Signal Processor)인 것을 특징으로 하는 명령 실행 방법.Command execution method, characterized in that the single core DSP (Digital Signal Processor). 제 2 항에 있어서, 상기 제1 프로세서의 상태는The method of claim 2, wherein the state of the first processor is 상기 제1 프로세서의 내부 메모리의 상태 및 상기 하나의 명령과 관련된 프로세스를 처리하기 위한 상기 제1 프로세서의 설정값 중 적어도 하나를 포함하는 것을 특징으로 하는 명령 실행 방법.And at least one of a state of an internal memory of the first processor and a setting value of the first processor for processing a process related to the one instruction. 제 2 항에 있어서, 상기 식별자는The method of claim 2, wherein the identifier is 상기 제2 프로세서에서 실행 중인 복수의 프로세스를 각각 식별하기 위한 식별자인 것을 특징으로 하는 명령 실행 방법.And an identifier for identifying each of a plurality of processes running in the second processor. 삭제delete 제 1 항에 있어서, 상기 제1 프로세서의 상태를 설정하는 단계는,The method of claim 1, wherein setting the state of the first processor comprises: 상기 최초 명령인지 판단하는 단계 이후에,After the step of determining whether the first command, 상기 식별자에 기초하여, 상기 하나의 명령에 관련된 제2 프로세서의 프로세스가 이전에 실행된 명령에 관련된 프로세스와 동일한지 판단하는 단계; 및Based on the identifier, determining whether a process of a second processor related to the one instruction is the same as a process related to a previously executed instruction; And 상기 판단 결과에 기초하여 선택적으로 상기 하나의 명령을 실행하기 위한 제1 프로세서의 상태를 복원하는 단계를 포함하는 것을 특징으로 하는 명령 실행 방법.Restoring a state of a first processor to selectively execute the one instruction based on the determination result. 제1 항에 있어서,The method according to claim 1, 상기 수신하는 단계 전에,Before the receiving step, 상기 제2 프로세서에서, 상기 복수의 프로세스에 대응되는 명령들 각각에 상기 복수의 프로세스 각각을 식별하기 위한 식별자들을 부가하는 단계; 및Adding, at the second processor, identifiers for identifying each of the plurality of processes to each of the instructions corresponding to the plurality of processes; And 상기 제2 프로세서에서, 상기 식별자들이 부가된 명령들을 소정의 순서에 따라 제1 프로세서에 송신하는 단계를 포함하는 것을 특징으로 하는 명령 실행 방법.Sending, at the second processor, instructions to which the identifiers are added to the first processor in a predetermined order. 삭제delete 삭제delete 복수의 프로세스를 실행하는 제2 프로세서; 및A second processor executing a plurality of processes; And 상기 제2 프로세서로부터 상기 복수의 프로세스에 대응하는 명령들을 수신하여 실행하는 제1 프로세서를 포함하고,A first processor configured to receive and execute instructions corresponding to the plurality of processes from the second processor, 상기 제1 프로세서는,The first processor, 상기 복수의 프로세스에 대응하는 명령들을 수신하고, 수신된 명령들을 큐잉하는 명령큐;An instruction queue that receives instructions corresponding to the plurality of processes and queues the received instructions; 상기 수신된 명령들에 관련된 프로세스를 구별하기 위한 식별자에 기초하여 상기 수신된 명령들 중 어느 하나의 명령을 실행하기 위한 상기 제1프로세서의 상태를 설정하는 상태제어부; 및A state controller configured to set a state of the first processor to execute any one of the received instructions based on an identifier for distinguishing a process related to the received instructions; And 상기 하나의 명령을 실행하는 명령실행부;를 포함하며,Includes; command execution unit for executing the one command, 상기 상태제어부는 상기 하나의 명령이 새로운 프로세스에 대한 최초 명령인지 판단하여, 상기 판단 결과에 따라 선택적으로 상기 제1 프로세서의 상태를 복원하는 것을 특징으로 하는 프로세서 장치.And the state controller determines whether the one command is the first command for a new process, and selectively restores the state of the first processor according to the determination result. 제 10 항에 있어서, 상기 제1 프로세서는The method of claim 10, wherein the first processor 단일 코어 DSP(Digital Signal Processor)인 것을 특징으로 하는 프로세서 장치.A processor device, characterized in that a single core DSP (Digital Signal Processor). 제 11 항에 있어서, 상기 제1 프로세서의 상태는12. The method of claim 11, wherein the state of the first processor is 상기 제1 프로세서의 내부 메모리의 상태 및 상기 하나의 명령과 관련된 프로세스를 처리하기 위한 상기 제1 프로세서의 설정값 중 적어도 하나를 포함하는 것을 특징으로 하는 프로세서 장치.And at least one of a state of an internal memory of the first processor and a setting value of the first processor for processing a process related to the one instruction. 제10 항에 있어서,The method of claim 10, 상기 제2 프로세서는,The second processor, 상기 복수의 프로세스를 실행하는 프로세스실행부; 및A process execution unit executing the plurality of processes; And 상기 복수의 프로세스에 대응되는 명령들 각각에 상기 복수의 프로세스 각각을 식별하기 위한 식별자들을 부가하고, 상기 식별자들이 부가된 명령들을 소정의 순서에 따라 상기 제1 프로세서에 전송하는 프로세서제어부를 포함하는 것을 특징으로 하는 프로세서 장치.And a processor control unit configured to add identifiers for identifying each of the plurality of processes to each of the instructions corresponding to the plurality of processes, and to transmit the instructions to which the identifiers are added to the first processor in a predetermined order. And a processor device. 제 10 항에 있어서, 11. The method of claim 10, 상기 상태제어부는 상기 하나의 명령을 실행함에 따라 변경된 상기 제1 프로세서의 상태를 저장하는 것을 특징으로 하는 프로세서 장치.And the state controller stores the state of the first processor changed as the one command is executed. 삭제delete 삭제delete
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