KR101075437B1 - 저속 초광대역 시스템 및 그것의 데이터 검출 방법 - Google Patents

저속 초광대역 시스템 및 그것의 데이터 검출 방법 Download PDF

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Abstract

본 발명의 기술적 사상의 실시 예에 따른 저속 초광대역(LR-UWB) 시스템의 데이터 검출 방법은 프리엠블 신호를 제공받아, 상기 프리엠블 신호의 프리엠블 심볼 구간마다 시간 지연된 적어도 하나의 지연 프리엠블 신호들을 출력하는 단계, 상기 프리엠블 신호 및 상기 지연 프리엠블 신호들을 기준 프리엠블 신호와 상호상관하여 적어도 하나의 채널 이득들과 상기 채널 이득들에 대응하는 적어도 하나의 지연 시간들을 추정하는 단계; 및 상기 채널 이득들과 상기 지연 시간들을 이용하여, 데이터를 검출하는 단계를 포함한다.

Description

저속 초광대역 시스템 및 그것의 데이터 검출 방법{LR-UWB SYSTEM AND DATA DETECTION METHOD THEREOF}
본 발명은 통신 시스템에 관한 것으로, 좀더 상세하게는 저속 초광대역 시스템 및 그것의 데이터 검출 방법에 관한 것이다.
IEEE 802.15.4a 저속 초광대역(LR-UWB, Low Rate Ultra Wide Band) 시스템은 저 전력과 낮은 데이터 전송 속도를 지원한다. 저속 초광대역 시스템은 짧은 펄스를 전송하기 때문에 송수신기를 간단히 구현할 수 있고, 저 전력으로 구현이 가능하다. 저속 초광대역 시스템은 다중 경로 지연과 같은 외부 환경에 강한 특성을 가진다.
또한, 저속 초광대역 시스템은 짧은 펄스를 사용하기 때문에 뛰어난 신호 분해 능력을 제공한다. 따라서 저속 초광대역 시스템은 초정밀 위치 인식을 가능하게 한다. 더불어, 저속 초광대역 시스템은 짧은 펄스를 사용하므로 데이터 수신시 채널의 특징을 파악하기 위해 정확한 채널 추정 방법 및 데이터 검출 방법이 요구된다.
본 발명의 목적은 정확한 채널 추정 및 데이터 검출을 위한 저속 초광대역 시스템을 제공하는 데 있다.
본 발명의 기술적 사상의 실시 예에 따른 저속 초광대역(LR-UWB) 시스템의 데이터 검출 방법은 프리엠블 신호를 제공받아, 상기 프리엠블 신호의 프리엠블 심볼 구간마다 시간 지연된 적어도 하나의 지연 프리엠블 신호들을 출력하는 단계, 상기 프리엠블 신호 및 상기 지연 프리엠블 신호들을 기준 프리엠블 신호와 상호상관하여 적어도 하나의 채널 이득들과 상기 채널 이득들에 대응하는 적어도 하나의 지연 시간들을 추정하는 단계 및 상기 채널 이득들과 상기 지연 시간들을 이용하여, 데이터를 검출하는 단계를 포함한다.
실시 예로서, 상기 지연 프리엠블 신호들을 출력하는 단계는 상기 프리엠블 신호를 상기 프리엠블 신호의 한 프리엠블 심볼 구간만큼 시간 지연시킨 제 1 지연 프리엠블 신호를 출력하는 단계, 상기 프리엠블 신호를 상기 프리엠블 신호의 두 프리엠블 심볼 구간만큼 시간 지연시킨 제 2 지연 프리엠블 신호를 출력하는 단계 및 상기 프리엠블 신호를 상기 프리엠블 신호의 세 프리엠블 심볼 구간만큼 시간 지연시킨 제 3 지연 프리엠블 신호를 출력하는 단계를 포함한다.
실시 예로서, 데이터 신호를 제공받아, 상기 지연 시간들마다 시간 지연된 적어도 하나의 지연 데이터 신호들을 출력하는 단계 및 상기 지연 데이터 신호들을 상기 채널 이득들 중 각각 대응하는 채널 이득으로 조정한 조정 데이터 신호들을 출력하는 단계를 더 포함한다.
실시 예로서, 상기 조정 데이터 신호들를 합산한 후, 기준 데이터 신호와 상호상관하여 합산 데이터 신호를 출력하는 단계 및 상기 합산 데이터 신호를 1/4 데이터 심볼 구간마다 분할하여, 데이터를 검출하는 단계를 더 포함한다.
본 발명의 기술적 사상의 실시 예에 다른 저속 초광대역 시스템은 프리엠블 신호를 상기 프리엠블 신호의 프리엠블 심볼 구간마다 시간 지연시켜 적어도 하나의 지연 프리엠블 신호들을 출력하는 시간 지연부, 상기 프리엠블 신호 및 상기 지연 프리엠블 신호들을 기준 프리엠블 신호와 상호상관하여 적어도 하나의 채널 이득들과 상기 채널 이득들에 대응하는 적어도 하나의 지연 시간들을 추정하는 채널 추정부 및 상기 채널 이득들과 상기 지연 시간들을 이용하여, 데이터를 검출하는 데이터 검출부를 포함한다.
본 발명의 기술적 사상의 실시 예에 따른 저속 초광대역 시스템은 좀더 정확한 채널 추정 및 데이터 검출을 가능하게 한다.
이하, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명의 기술적 사상을 용이하게 실시할 수 있을 정도로 상세히 설명하기 위하여, 본 발명의 기술적 사상의 실시 예들을 첨부한 도면을 참조하여 설명한다.
도 1은 본 발명의 기술적 사상의 실시 예에 따른 저속 초광대역(LR-UWB) 시 스템의 수신기를 보여주는 블록도이다. 도 1을 참조하면, 수신기(10)는 분배부(100), 채널 추정부(200), 위치 합산부(300), 펄스 발생부(400) 및 데이터 검출부(500)를 포함한다.
분배부(100)는 수신 신호(r(t))를 제공받는다. 분배부(100)는 수신 신호(r(t))를 프리엠블 신호(rp(t)와 데이터 신호(rd(t))로 분리한다. 프리엠블 신호(rp(t))는 소정의 신호가 프리엠블 심볼의 주기만큼 반복해서 들어오는 신호이다.
채널 추정부(200)는 분배부(100)를 통하여 프리엠블 신호(rp(t))를 제공받는다. 채널 추정부(200)은 프리엠블 신호(rp(t))와 기준 프리엠블 신호(Vp(t))를 상호 상관을 한 후에 최대 채널 이득(βℓ) 및 최대 채널 이득에 해당하는 지연 시간(τℓ)을 구한다. 채널 추정부(200)는 이하의 도 2에서 좀더 상세하게 설명될 것이다.
위치 합산부(300)는 분배부(100)로부터 데이터 신호(rd(t))를 제공받는다. 위치 합산부(300)는 채널 추정부(200)로부터 최대 채널 이득(βℓ) 및 최대 채널 이득에 해당하는 지연 시간(τℓ)을 제공받는다. 위치 합산부(300)는 데이터 신호(rd(t))를 지연 시간(τℓ)만큼 지연한 후 최대 채널 이득(βℓ)으로 나누고, 각각의 경로를 합산한다. 위치 합산부(300)는 이하의 도 3에서 좀더 상세하게 설명될 것이다.
펄스 발생부(400)는 기준 프리엠블 신호(Vp(t))와 기준 데이터 신호(Vd(t))를 발생한다. 펄스 발생부(400)에 의하여 발생된 기준 프리엠블 신호(Vp(t))는 채 널 추정부(200)에 제공되어, 최대 채널 이득(βℓ) 및 최대 채널 이득에 해당하는 지연 시간(τℓ)을 구하는데 사용된다. 펄스 발생부(400)에 의하여 발생된 기준 데이터 신호(Vd(t))는 데이터 검출부(500)에 제공되어, 수신 신호(r(t))의 데이터를 검출하는데 사용된다.
데이터 검출부(500)는 위치 합산부(300)로부터 위치 합산 신호(Rpa(t))를 제공받는다. 데이터 검출부(500)는 펄스 발생부(400)로부터 기준 데이터 신호(Vd(t))를 제공받는다. 데이터 검출부(500)는 위치 합산 신호(Rpa(t))와 기준 데이터 신호(Vd(t))를 상호상관한 후에 한 심볼 구간을 세분화하여 데이터를 검출한다. 데이터 검출부(500)는 이하의 도 4에서 좀더 상세하게 설명될 것이다.
한편, 본 발명의 기술적 사상의 실시 예에 있어서, 저속 초광대역(LR-UWB) 시스템에(10)에서 수신 신호(r(t))는 수학식 1과 같이 정의될 수 있다.
Figure 112009077398760-pat00001
여기서, rp(t)는 프리엠블 신호를 의미하고, rd(t)는 데이터 신호를 의미하며, n(t)는 AWGN(Additive White Gaussian Noise)를 의미한다. 수학식 1은 수학식 2와 같이 표현될 수 있다.
Figure 112009077398760-pat00002
여기서, Sp(t)는 송신 프리엠블 신호를 의미하고, Sd(t)는 송신 데이터 신호를 의미하며, h(t)는 채널 임펄스 응답을 의미한다. 송신 프리엠블 신호(Sp(t))와 송신 데이터 신호(Sd(t))는 각각 수학식 3과 수학식 4와 같이 표현될 수 있다.
Figure 112009077398760-pat00003
여기서, Es는 프리엠블에서 한 한 프리엠블 심볼의 총 에너지를 의미하고, Ns는 한 심볼의 총 노이즈를 의미하며, N(n)은 한 패킷 구간에서의 프리엠블 수를 의미한다. Si(j)는 한 개의 프리엠블 심볼에 대한 길이를 말하는데 값은 {-1, 0, +1} 3개의 터너리 코드로 구성한다. Si(j)는 LR-UWB 시스템에서 31개와 127개 두가지로 구성한다. Vp(t)는 기준 프리엠블 신호를 의미한다. Tpsym은 프리엠블 한 구간이고, Tpri는 펄스 반복 구간이며, Tc는 한 펄스 구간이다.
Figure 112009077398760-pat00004
여기서, p(t)는 펄스 신호를 의미하고, Cburst(t)와 dmod(t)는 변조와 코딩 정보 신호이다. Cburst(t)와 dmod(t)는 각각 수학식 5와 수학식 6과 같이 표현될 수 있다.
Figure 112009077398760-pat00005
Figure 112009077398760-pat00006
여기서, Ncpb는 랜덤한 칩 수를 의미하고,
Figure 112009077398760-pat00007
는 타임 호핑 시 시간,
Figure 112009077398760-pat00008
은 위치 변조 시 시간을 의미한다.
Figure 112009077398760-pat00009
와
Figure 112009077398760-pat00010
는 극성정보와 위치랜덤 코드를 의미한다.
Figure 112009077398760-pat00011
는 버스트 당 펄스 수를 의미한다.
Figure 112009077398760-pat00012
와
Figure 112009077398760-pat00013
은 전송된 2비트 데이터 심볼이며 각각 위치 정보 비트와 극성 정보 비트를 나타낸다.
도 2는 도 1의 채널 추정부(200)를 보여주는 블록도이다. 도 2를 참조하면, 채널 추정부(200)는 제 1 지연부(210), 제 2 지연부(220), 제 3 지연부(230), 상호상관부(240), 합산부(250) 및 검출부(260)를 포함한다.
제 1 지연부(210)는 프리엠블 신호(rp(t))를 한 프리엠블 심볼 구간(Tpsym) 만큼 시간 지연한다. 제 2 지연부(220)는 프리엠블 신호(rp(t))를 두 프리엠블 심볼 구간(2Tpsym)만큼 시간 지연한다. 제 3 지연부(230)는 프리엠블 신호(rp(t))를 세 프리엠블 심볼 구간(3Tpsym)만큼 시간 지연한다.
상호상관부(240)는 프리엠블 신호(rp(t))와 기준 프리엠블 신호(Vp(t))를 상호상관하여 제 1 상호상관 결과(F1(t))를 출력한다. 또한, 상호상관부(240)는 한 프리엠블 심복 구간(Tpsym)만큼 시간 지연된 프리엠블 신호(r(t-Tpsym))와 기준 프리엠블 신호(Vp(t))를 상호상관하여 제 2 상호상관 결과(F2(t))를 출력한다. 상호상관부(240)는 두 프리엠블 심복 구간(2Tpsym)만큼 시간 지연된 프리엠블 신호(r(t-2Tpsym))와 기준 프리엠블 신호(Vp(t))를 상호상관하여 제 3 상호상관 결과(F3(t))를 출력한다. 상호상관부(240)는 세 프리엠블 심복 구간(3Tpsym)만큼 시간 지연된 프리엠블 신호(r(t-3Tpsym))와 기준 프리엠블 신호(Vp(t))를 상호상관하여 제 4 상호상관 결과(F4(t))를 출력한다. 이는 수학식 7 내지 수학식 10과 같이 표현될 수 있다.
Figure 112009077398760-pat00014
Figure 112009077398760-pat00015
Figure 112009077398760-pat00016
Figure 112009077398760-pat00017
여기서, MEb는 총 비트 에너지를 의미한다.
한편, 수학식 7 내지 10은 수학식 11과 같이 일반화된 식으로 표현될 수 있다.
Figure 112009077398760-pat00018
합산부(250)는 상호상관부(240)로부터 제 1 내지 제 4 상호상관 결과 (F1(t)~F4(t))를 제공받는다. 합산부(250)는 제공받은 제 1 내지 제 4 상호상관 결과(F1(t)~F4(t))를 합산하여 합산 상호상관 결과(A(t))를 출력한다.
검출부(260)는 합산부(250)로부터 합산 상호상관 결과(A(t))를 제공받는다. 검출부(260)는 제공받은 합산 상호상과 결과(A(t))를 이용하여 최대 채널 이득(βℓ)과 최대 채널 이득에 해당하는 지연 시간(τℓ)을 검출한다. 최대 채널 이득(βℓ) 및 최대 채널 이득에 해당하는 지연 시간(τℓ)은 각각 수학식 12와 수학식 13과 같이 표현될 수 있다.
Figure 112009077398760-pat00019
Figure 112009077398760-pat00020
수학식 12 및 수학식 13에 의하여 얻어진 최대 채널 이득(βℓ) 및 최대 채널 이득에 해당하는 지연 시간(τℓ)은 {τ1, β1}, {τ2, β2}, {τ3, β3}...{τℓ, βℓ} 등과 같이 표현될 수 있다.
도 3은 도 1의 위치 합산부(300)를 보여주는 블록도이다. 도 3을 참조하면, 위치 합산부(300)는 최대시간 지연부(310), 최대이득 조정부(320) 및 합산부(330)를 포함한다.
최대시간 지연부(310)는 분배부(100)로부터 데이터 신호(rd(t))를 전달받는다. 최대시간 지연부(310) 채널추정부(200)로부터 최대 채널 이득에 해당하는 지연 시간(τℓ)을 전달받는다. 최대시간 지연부(310)는 데이터 신호(rd(t))를 최대 채널 이득에 해당하는 지연시간(τℓ)만큼 지연시킨다.
구체적으로, 제 1 최대시간 지연부(311)는 데이터 신호(rd(t))를 제 1 지연시간(τ1)만큼 지연시켜, 제 1 지연 데이터 신호(rd(t-τ1))를 출력한다. 제 2 최대시간 지연부(312)는 데이터 신호(rd(t))를 제 2 지연시간(τ2)만큼 지연시켜, 제 2 지연 데이터 신호(rd(t-τ1))를 출력한다. 제 L 최대시간 지연부(313)는 데이터 신호(rd(t))를 제 L 지연시간(τℓ)만큼 지연시켜, 제 L 지연 데이터 신호(rd(t-τℓ))를 출력한다.
최대이득 조정부(320)는 최대시간 지연부(310)로부터 지연된 데이터 신호들을 전달받는다. 최대이득 조정부(320)는 채널추정부(200)로부터 최대 채널 이득(βℓ)을 전달받는다. 최대이득 조정부(320)는 지연된 데이터 신호를 최대 채널 이득(βℓ)으로 나누어 출력한다.
구체적으로, 제 1 최대이득 조정부(321)는 제 1 지연 데이터 신호(rd(t-τ1))를 제 1 최대 채널 이득(β1)으로 나누어 출력한다. 제 2 최대이득 조정부(322)는 제 2 지연 데이터 신호(rd(t-τ2))를 제 2 최대 채널 이득(β2)으로 나누어 출력한다. 제 L 최대이득 조정부(323)는 제 L 지연 데이터 신호(rd(t-τℓ))를 제 L 최대 채널 이득(β1)으로 나누어 출력한다.
한편, 합산부(330)는 제 1 최대이득 조정부(321) 내지 제 L 최대이득 조정부(323)의 출력들을 합산하여 위치 합산 출력 신호(Rpa(t))를 출력한다. .
도 4는 도 1의 데이터 검출부(500)를 보여주는 블록도이다. 도 4를 참조하면, 데이터 검출부(500)는 상호상관부(510), 심볼 분할부(520) 및 데이터 판정부(530)를 포함한다.
상호상관부(510)는 위치합산부(300)의 합산부(330)로부터 위치 합산 출력 신호(Rpa(t))를 제공받는다. 상호상관부(510)는 펄스 발생부(400)로부터 기준 데이터 신호(Vd(t))를 제공받는다. 상호상관부(510)는 위치 합산 출력 신호(Rpa(t))와 기준 데이터 신호(Vd(t))를 상호상관하여 출력한다. 여기서, 상호상관부(510)의 출력은 R1+R2+...+Rℓ로 표현될 수 있다. 여기서, R1은 제 1 최대이득 조정부(321)의 출력과 기준데이터 신호(Vd(t))의 상호상관 값을 의미한다. 마찬가지로, R2 내지 Rℓ은 각각 제 2 최대이득 조정부(322) 내지 제 L 최대이득 조정부(323)와 기준데이터 신호(Vd(t))의 상호상관 값을 의미한다.
이 경우, 예를 들어, R1 및 R2는 각각 수학식 14와 수학식 15로 표현될 수 있다.
Figure 112009077398760-pat00021
Figure 112009077398760-pat00022
수학식 14와 수학식 15는 수학식 16과 같이 일반화되어 표현될 수 있다.
Figure 112009077398760-pat00023
여기서, Tdsym은 한 데이터 심볼 구간을 의미한다. 또한, Vd(t)는 수학식 17과 같이 표현될 수 있다.
Figure 112009077398760-pat00024
심볼 분할부(520)는 상호상관부(510)로부터 전달받은 신호를 1/4 데이터 심볼 간격(1/4Tdsym)으로 나누어 출력한다. 구체적으로, 제 1 심볼 분할부(521)는 상호상관부(510)로부터 전달받은 신호를 [0,1/4Tdsym] 구간으로 나누어, 제 1 분할 신호(D1)를 출력한다. 마찬가지로, 제 2 내지 제 4 심볼 분할부(522~524)는 상호상관부(510)로부터 전달받은 신호를 각각 [1/4Tdsym,1/2Tdsym], [1/2Tdsym,3/4Tdsym] 및 [3/4Tdsym,Tdsym] 구간으로 나누어, 제 2 내지 제 4 분할 신호(D2~D4)를 출력한다. 이는 이하의 수학식 18 내지 수학식 21로 각각 표현될 수 있다.
Figure 112009077398760-pat00025
Figure 112009077398760-pat00026
Figure 112009077398760-pat00027
Figure 112009077398760-pat00028
데이터 판정부(530)는 심볼 분할부(520)로부터 제 1 내지 제 4 분할 신호(D1~D4)를 제공받는다. 데이터 판정부(530)는 제공받은 제 1 내지 제 4 분할 신호(D1~D4)를 이용하여, 데이터를 판별할 수 있다.
자세히 설명하면, 데이터 판정부(530)는 제 1 분할 신호(D1) 및 제 3 분할 신호(D3)의 크기를 비교하여 'BIT0'의 데이터 값을 판별할 수 있다. 예를 들어, 제 1 분할 신호(D1)가 제 3 분할 신호(D3)보다 큰 경우(D1>D3), 'BIT0'의 데이터 값은 '0'으로 판별된다. 제 1 분할 신호(D1)가 제 3 분할 신호(D3)보다 작은 경우(D1<D3), 'BIT0'의 데이터 값은 '1'로 판별된다.
또한, 데이터 판정부(530)는 제 1 분할 신호(D1)와 제 3 분할 신호(D3)의 합이 '0'보다 큰지를 비교하여 'BIT1'의 데이터 값을 판별할 수 있다. 예를 들어, 제 1 분할 신호와 제 3 분할 신호의 합(D1+D3)이 0보다 큰 경우(D1+D3>0), 'BIT1'의 데이터 값은 '0'으로 판별된다. 제 1 분할 신호와 제 3 분할 신호의 합(D1+D3)이 '0'보다 작은 경우(D1+D3<0), 'BIT1'의 데이터 값은 '1'로 판별된다.
도 5 내지 도 7은 도 2의 채널추정부(200)의 상호상관부(240)의 상호상관을 예시적으로 보여주는 도면이다. 구체적으로, 도 5는 본 발명의 기술적 사상의 실시 예에 따른 한 심볼 구간에서 수신된 프리엠블 신호(rpt(t))를 나타낸다. 도 6은 본 발명의 기술적 사상의 실시 예에 따른 기준 프리엠블 신호(Vp(t))를 나타낸다. 도 7은 프리엠블 신호(rp(t))와 기준 프리엠블 신호(Vp(t))의 상호상관 결과를 보여준다.
도 7을 참조하면, 몇 번째 큰 신호가 오는 지와 그에 해당하는 값을 추정할 수 있다. 이렇게 얻은 신호들은 큰 신호부터 {τ1,β1}, {τ2,β2}, {τ3,β3} 등으로 표현될 수 있다. 채널 추정으로부터 얻어진 신호들은 수신된 데이터 신호의 첫번째 큰 신호의 위치를 알려주는 신호가 된다.
도 8 내지 도 10은 도 4의 데이터 검출부(500)의 동작을 예시적으로 보여주는 도면이다. 구체적으로, 도 8은 본 발명의 기술적 사상의 실시 예에 따른 데이터 검출부(500)의 상호상관부(510)에 제공되는 위치합산 출력(Rpa(t))을 예시적으로 보여준다. 도 9는 본 발명의 기술적 사상의 실시 예에 따른 데이터를 검출하기 위한 기준 데이터 신호(Vd(t))를 예시적으로 보여준다.
도 9를 참조하면, 512ns를 기준으로 동일한 펄스를 앞에 뒤에 한번 발생시켜 수신도니 데이터 신호와 상호상관을 한다. 이렇게 하면 데이터가 있는 곳에서 위치와 데이터의 양인지 음인지 판단할 수 있다.
도 10은 본 발명의 기술적 사상의 실시 예에 따른 데이터 검출부(500)의 성능을 보여준다. 구체적으로, 도 10은 레이크 경로를 한 번 선택한 후 제안된 기술과 기존 기술의 비교 성능을 보여준다. 제안된 방법이 기준 기술에 비하여 우수한 특성을 가짐을 알 수 있다.
본 발명의 범위 또는 기술적 사상을 벗어나지 않고 본 발명의 구조가 다양하 게 수정되거나 변경될 수 있음은 이 분야에 숙련된 자들에게 자명하다. 상술한 내용을 고려하여 볼 때, 만약 본 발명의 수정 및 변경이 아래의 청구항들 및 동등물의 범주 내에 속한다면, 본 발명이 이 발명의 변경 및 수정을 포함하는 것으로 여겨진다.
도 1은 본 발명의 기술적 사상의 실시 예에 따른 저속 초광대역(LR-UWB) 시스템의 수신기를 보여주는 블록도이다.
도 2는 도 1의 채널 추정부(200)를 보여주는 블록도이다.
도 3은 도 1의 위치 합산부(300)를 보여주는 블록도이다.
도 4는 도 1의 데이터 검출부(500)를 보여주는 블록도이다.
도 5는 본 발명의 기술적 사상의 실시 예에 따른 한 심볼 구간에서 수신된 프리엠블 신호(rpt(t))를 나타낸다.
도 6은 본 발명의 기술적 사상의 실시 예에 따른 기준 프리엠블 신호(Vp(t))를 나타낸다.
도 7은 프리엠블 신호(rp(t))와 기준 프리엠블 신호(Vp(t))의 상호상관 결과를 보여준다.
도 8은 본 발명의 기술적 사상의 실시 예에 따른 데이터 검출부(500)의 상호상관부(510)에 제공되는 위치합산 출력(Rpa(t))을 예시적으로 보여준다.
도 9는 본 발명의 기술적 사상의 실시 예에 따른 데이터를 검출하기 위한 기준 데이터 신호(Vd(t))를 예시적으로 보여준다.
도 10은 본 발명의 기술적 사상의 실시 예에 따른 데이터 검출부(500)의 성능을 보여준다.

Claims (6)

  1. 삭제
  2. 저속 초광대역(LR-UWB) 시스템의 데이터 검출 방법에 있어서,
    프리엠블 신호를 제공받아, 상기 프리엠블 신호의 프리엠블 심볼 구간마다 시간 지연된 적어도 하나의 지연 프리엠블 신호를 출력하는 단계;
    상기 프리엠블 신호 및 상기 지연 프리엠블 신호를 기준 프리엠블 신호와 상호상관하여 적어도 하나의 채널 이득과 상기 채널 이득에 대응하는 적어도 하나의 지연 시간을 추정하는 단계; 및
    상기 채널 이득과 상기 지연 시간을 이용하여, 데이터를 검출하는 단계를 포함하며,
    상기 지연 프리엠블 신호를 출력하는 단계는
    상기 프리엠블 신호를 상기 프리엠블 신호의 한 프리엠블 심볼 구간만큼 시간 지연시킨 제 1 지연 프리엠블 신호를 출력하는 단계;
    상기 프리엠블 신호를 상기 프리엠블 신호의 두 프리엠블 심볼 구간만큼 시간 지연시킨 제 2 지연 프리엠블 신호를 출력하는 단계; 및
    상기 프리엠블 신호를 상기 프리엠블 신호의 세 프리엠블 심볼 구간만큼 시간 지연시킨 제 3 지연 프리엠블 신호를 출력하는 단계를 포함하는 저속 초광대역 시스템의 데이터 검출 방법.
  3. 저속 초광대역(LR-UWB) 시스템의 데이터 검출 방법에 있어서,
    프리엠블 신호를 제공받아, 상기 프리엠블 신호의 프리엠블 심볼 구간마다 시간 지연된 적어도 하나의 지연 프리엠블 신호를 출력하는 단계;
    상기 프리엠블 신호 및 상기 지연 프리엠블 신호를 기준 프리엠블 신호와 상호상관하여 적어도 하나의 채널 이득과 상기 채널 이득에 대응하는 적어도 하나의 지연 시간을 추정하는 단계;
    데이터 신호를 제공받아, 상기 지연 시간마다 시간 지연된 적어도 하나의 지연 데이터 신호를 출력하는 단계; 및
    상기 지연 데이터 신호를 상기 채널 이득 중 각각 대응하는 채널 이득으로 조정한 조정 데이터 신호를 출력하는 단계를 포함하는 저속 초광대역 시스템의 데이터 검출 방법.
  4. 제 3 항에 있어서,
    상기 조정 데이터 신호들를 합산한 후, 기준 데이터 신호와 상호상관하여 합산 데이터 신호를 출력하는 단계; 및
    상기 합산 데이터 신호를 1/4 데이터 심볼 구간마다 분할하여, 데이터를 검출하는 단계를 더 포함하는 저속 초광대역 시스템의 데이터 검출 방법.
  5. 프리엠블 신호를 상기 프리엠블 신호의 프리엠블 심볼 구간마다 시간 지연시켜 적어도 하나의 지연 프리엠블 신호를 출력하며, 상기 프리엠블 신호 및 상기 지연 프리엠블 신호를 기준 프리엠블 신호와 상호상관하여 적어도 하나의 채널 이득과 상기 채널 이득에 대응하는 적어도 하나의 지연 시간을 추정하는 채널 추정부;
    데이터 신호를 제공받아, 상기 지연 시간마다 시간 지연된 적어도 하나의 지연 데이터 신호를 출력하고, 상기 지연 데이터 신호를 상기 채널 이득 중 각각 대응하는 채널 이득으로 조정한 조정 데이터 신호를 출력하는 위치 합산부; 및
    상기 채널 이득과 상기 지연 시간을 이용하여 데이터를 검출하는 데이터 검출부를 포함하는 저속 초광대역 시스템.
  6. 제 5 항에 있어서,
    상기 데이터 검출부는 상기 조정 데이터 신호를 합산한 후, 기준 데이터 신호와 상호상관하여 합산 데이터 신호를 출력하고, 상기 합산 데이터 신호를 1/4 데이터 심볼 구간마다 분할하여 데이터를 검출하는 것을 특징으로 하는 저속 초광대역 시스템.
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