KR100970071B1 - 히스토리에 기초하여 측정된 전력 제어 응답 - Google Patents

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Abstract

채널의 제 1 링크를 통해 수신된 프레임들은 하나의 배치 또는 배치 모드로 후속 처리하기위해 그룹화 또는 큐잉된다. 상기 프레임들에 포함된 전력 제어 지시들은 검사되고 미리 결정된 길이의 히스토리가 유지된다. 채널의 제 2 링크를 통해 전송될 프레임들은 배치내의 후속 - 처리를 위해 배칭된다. 전력 제어 비트들은 유지된 히스토리에 적어도 부분적으로 기초하여 인입하는 전력 제어 지시들에 대한 응답을 저하시키는 방식으로 프레임들에 대한 전력 제어 명령을 생성한다.

Description

히스토리에 기초하여 측정된 전력 제어 응답{HISTORY BASED MEASURED POWER CONTROL RESPONSE}
- 관련 출원의 상호 참조 -
본 출원은 2002년 7월 23일에 제출된 임시 출원 60/398,264의 우선권을 청구한다.
본 발명은 무선 통신 분야에 관한 것이다. 특히, 본 발명은 수신된 전송 프레임들을 큐잉(queuing) 및 배치 처리(batch processing)하는 환경에서 채널의 역방향 링크를 통해 수신된 전력 제어 지시들에 응답하기 위한 방법 및 장치에 관한 것이다.
위성 통신 및 이와 관련된 기술에서의 진보들은 최근 몇년간 이동 위성 서비스(MSS)가 신속히 발달하도록 하였다. 경제적인 요소들이 상기 시스템들의 성장을 저하시키는 반면, 수만의 사용자 터미널들이 현재 사용중이며, 그렇지 않으면 통신 서비스들을 받지 못했을 영역들에 가치있는 서비스들을 제공하고 있다.
사용자 터미널들에 부가하여 이동 위성 서비스들의 제공은, 일반적으로 우주선들, 즉, 위성들 및 다수의 게이트웨이들을 제공하며, 이는 기지국들로도 지칭된다. 위성들은 게이트웨이들과 사용자 터미널들간에 "중계(relay)들"을 제공한다.
전력 제어는 종종 하나 또는 그이상의 위성들을 통해 사용자 터미널과 게이트웨이 사이의 신호들의 교환을 관리하기 위해 사용된다. 특히, 예를 들어 전력 제어 비트들과 같은 전력 제어 지시들은 채널의 역방향 링크(또한 채널의 복귀 링크로 지칭됨)를 통해 수신된 전송 프레임들에 포함되거나 전송 프레임들과 함께 제공된다.
MSS와 관련하여, 채널은 할당된 주파수에 해당한다. 시간 분할 다중 액세스(TDMA)의 경우에서와 같은 다중 액세스와 관련하여, 채널은 다수의 타임 슬롯들로 분할되며, 하나 또는 그이상의 타임 슬롯들이 각각의 사용자 터미널에 할당된다. 상기 타임 슬롯들 전체와 임의의 오버헤드 데이터 비트들의 합은 전송 프레임에 해당한다. 유사하게, 코드 분할 다중 액세스의 경우에, 채널은 직교하거나 거의 직교하는 확산 코드를 사용하여 각 사용자에 대한 전송들을 인코딩함으로써 동시에 존재하는 사용자들 사이에서 공유된다.
사용자들이 증가하고, 사용자들에 의한 사용이 증가하면, 데이터 트래픽이 증가하고, 사용자 터미널들로부터의 전송량 및 게이트웨이들에 의해 수행될 처리량들이 증가한다. 처리량이 증가하는 것을 용이하게 조절하기 위해, 몇몇의 게이트웨이들은 채널의 역방향 링크를 통해 수신된 전송 프레임들을 큐잉하여 이들을 배치들로(in batches) 처리하려고 할 것이다.
전력 제어는 CDMA 시스템들에서 최적의 성능을 위해 중요하며, 따라서, 사용자 트래픽(예를 들면, 음성 또는 데이터)을 위한 각각의 전송 프레임은 일반적으로 통신 링크의 다른 단부에서 송신기를 위한 전력 제어 지시(일반적으로, 하나의 증분량만큼 전력 업 또는 다운을 나타내는 단일 비트)를 전송한다. 만약 전력 제어 지시들이 큐잉되지 않은/배칭되지 않은(non-queued/un-batched) 처리 환경에서 실시간으로 응답되는 것과 같이 큐잉된/배칭된(queued/batched) 처리 환경에서 동일한 방식으로 응답되면, 큐잉에 의해 전력 제어 루프에 추가된 지연으로 인해 과도한 연속적인 동일한 전력 제어 명령들이 발생할 수 있다. 차례로, 동일한 전력 제어 명령들의 과도한 연속 발행(issuance)은 채널 또는 통신 링크의 손실을 초래할 수 있다.
따라서, 전송 프레임들이 큐잉되거나 배치들 내에서 처리될 때 전력 제어 지시들에 응답하는 개선안이 요구된다.
본 발명은 반대편의 또는 상응하는 송신기에 대한 통신 링크들을 통해 수신기에 의해 결정 또는 발생되고, 채널의 링크를 통해 수신된 각각의 프레임에 포함된 전력 제어 지시들에 대한 응답 또는 응답 레이트를 저하시키는 방법 및 장치를 제공한다. 만약 수신기가 반대편의 또는 상응하게 수신된 전송이 미약하다고 결정하면, 수신기는 수신된 프레임과 함께 전력-업 명령 권고(recommendation)를 포함할 것이며, 그 반대도 성립된다.
동작 조건들 하에서, 링크를 통해 수신된 제 1의 다수의 프레임들은 배치들내의 후속 처리를 위해 큐잉된다. 수신된 프레임들에 포함된 전력 제어 명령에 대한 응답을 저하(slow)시키기 위해, 지시들 또는 명령들이 검사되고, 미리 결정된 길이의 러닝 히스토리(running history)가 유지된다. 채널의 반대 방향 링크를 통해 전송될 제 2의 다수의 프레임들은 배치들내의 후속 처리를 위해 큐잉된다. 전력 제어 지시들은 유지되는 히스토리에 적어도 부분적으로 기초하여 인입되는 전력 제어 지시들에 대한 응답을 저하시키기 위해 전송될 큐잉된 프레임들에 포함되도록 생성된다.
본 발명의 일 양상에 따라, 전력 제어 지시들 및 응답들은 전력 제어 비트들의 형태이고, 미리 결정된 히스토리의 길이는 일반적인 통신 시스템 또는 링크에 대하여 약 2 비트이다. 전송될 프레임들에 포함되도록 발생된 "0"값의 전력 제어 비트들의 갯수 m 및 "1"값의 전력 제어 비트들의 갯수 n는 2비트 히스토리의 비트 패턴에 따라 결정되고 제 2의 다수의 프레임들이 짝수개 또는 홀수개의 프레임들을 포함하는지의 여부에 따라 결정되며, 두개의 값들은 동일하거나 1만큼 서로 상이할 수 있다.
동작들을 유지 및 생성하는 방법 또는 장치는 무선 통신 시스템의 게이트웨이 또는 무선 통신 테스트 시스템의 에뮬레이트된(emulated) 게이트웨이와 게이트웨이 시뮬레이터(simulator)에서 수행될 수 있다.
추가의 양상들에서, 무선 통신 시스템 게이트웨이는 채널의 링크를 통해 다수의 제 1 프레임들을 수신하고, 상기 제 1 프레임들을 배치 형태로 처리하기 위해 큐잉하고, 다수의 제 1 프레임들의 각각에 포함된 전력 제어 지시를 출력하기 위해 트랜시버를 사용하며, 상기 프레임들 각각은 전력 제어 지시를 포함한다. 트랜시버에 접속된 프로세싱 서브시스템은 큐잉된 제 1 프레임들내의 정보를 처리 또는 검사하여, 전력 제어 지시들을 수신하고, 채널을 통한 복귀 방향 링크에 대한 다수의 제 2 프레임들을 생성하며, 상기 제 2 프레임들은 트랜시버에 의해 조종되거나 트랜시버내에서 처리되기 이전에 큐잉된다. 프로세싱 서브시스템은 제 1 프레임들에 포함된 검사된 전력 제어 지시들의 연속적인 히스토리를 미리 결정된 시간 주기까지 유지하고, 상기 유지되는 연속적인 히스토리에 적어도 부분적으로 기초하여 전력 제어 지시들에 대한 응답 또는 응답 레이트를 저하시키는 방식으로 제 2 프레임들에 대한 전력 제어 명령들을 생성한다.
게이트웨이의 추가 양상들에서, 프로세싱 서브시스템은 다수의 제 2 프레임들로 형성된 각각의 배치에 대하여 m개의 "0"값의 전력 제어 비트들과 n개의 "1"값의 전력 제어 비트들을 생성하도록 설계되며, 상기 갯수는 프레임들이 짝수개인지 또는 홀수개인지의 여부 및 제어 명령들의 정보 비트값들에 따라 결정된다.
추가의 실시예들에서, 무선 통신 장치는 채널의 링크를 통해 한 방향으로의 다수의 제 1 프레임들 또는 제 1 세트의 프레임들의 수신을 에뮬레이팅하고, 상기 제 1 프레임들을 배치 형태로 처리하기 위해 그룹화 또는 큐잉하도록 구성된 게이트웨이 에뮬레이터(emulator)를 포함하며, 상기 제 1 프레임들은 전력 제어 지시들을 포함하거나, 이에 수반된다. 게이트웨이 에뮬레이터는 또한 제 1 세트의 프레임들의 각각에 전력 제어 지시들을 제공한다. 게이트웨이 에뮬레이터에 접속된 게이트웨이 시뮬레이터는 큐잉된 제 1 프레임들을 배치 형태로 처리하고, 게이트웨이 에뮬레이터에 의해 처리된 전력 제어 지시들의 값을 수신하거나 검출하고, 채널의 복귀 방향 링크에 대한 다수의 제 2 프레임들을 생성하며, 상기 다수의 제 2 프레임들은 게이트웨이 에뮬레이터에 의해 배치 형태로 처리되기 이전에 큐잉된다. 게이트웨이 시뮬레이터는 제 1 세트의 프레임들에 포함된 전력 제어 지시들의 연속적인 러닝(running) 히스토리를 미리 결정된 길이까지 유지하며, 유지된 연속적인 히스토리에 적어도 부분적으로 기초하여 전력 제어 지시들에 대한 응답들을 저하시키는 방식으로 제 2 세트의 프레임들에 대한 상응하는 전력 제어 명령들을 생성한다. 게이트웨이 시뮬레이터는 요구되는 바와 같이, 제 2 프레임들의 서브세트로 형성된 각각의 배치에 대하여 m개의 "0"값의 전력 제어 비트들과 n개의 "1"값의 전력 제어 비트들을 생성하도록 설계된다.
추가의 실시예들에서, 본 발명의 장점들 및 특징들을 구현하기 위한 장치는통신 채널의 링크를 통해 한 방향으로 수신되는 다수의 제 1 프레임들에 포함된 전력 제어 지시들의 러닝 히스토리를 미리 결정된 길이까지 유지하기 위한 수단 및 상기 유지되는 러닝 히스토리에 적어도 부분적으로 기초하여 인입하는 전력 제어 지시들에 대한 응답을 저하시키는 방식으로 채널의 링크를 통해 반대 방향으로 전송될 다수의 제 2 프레임들에 대한 전력 제어 명령들을 생성하기 위한 수단을 포함하며, 상기 제 1 프레임들은 처리 이전에 그룹화되고, 상기 제 2 프레임들은 전송을 위해 배치 형태로 후속처리하기 위해 그룹화된다.
본 발명의 동작들은 기계 판독가능한 매체를 사용하여 구현될 수 있으며, 상기 기계 판독가능한 매체는 실행될 때 통신 채널의 링크를 통해 수신된 다수의 제 1 프레임들에 포함된 전력 제어 지시들의 러닝 히스토리를 미리 결정된 시간 또는 길이까지 유지하고, 상기 검출되어 유지된 러닝 히스토리에 적어도 부분적으로 기초하여 수신된 전력 제어 지시들에 대한 응답 또는 응답 레이트을 저하시키는 방식으로 채널의 링크를 통해 역방향으로 전송될 제 2의 다수의 프레임들에 대한 전력 제어 명령들을 생성하는 것을 포함하는 방법을 수행하는 기계 수행가능한 지시들을 저장하며, 상기 제 1 프레임들은 처리 이전에 그룹화되고, 상기 제 2 프레임들은 전송을 위해 배치 형태로 후속처리하기 위해 그룹화된다.
본 발명은 하기의 도면을 참조로하여 상세히 설명된다.
도 1은 일 실시예에 따른 본 발명의 방법을 도시한다.
도 2는 1 실시예에 따른 도 1의 히스토리에 기초한 전력 제어 생성을 더 상세히 도시한다.
도 3은 일 실시예에서 본 발명이 수행될 수 있는 예시적인 게이트웨이를 도시한다.
도 4는 일 실시예에서 도 3의 예시적인 게이트웨이가 사용될 수 있는 위성에 기초한 무선 통신 시스템을 도시한다.
도 5는 일 실시예에서 본 발명이 수행될 수 있는 예시적인 게이트웨이 에뮬레이터 및 예시적인 게이트웨이 시뮬레이터를 도시한다.
도 6은 일 실시예에서 도 5의 예시적인 게이트웨이 에뮬레이터와 시뮬레이터가 사용될 수 있는 무선 통신 테스트 시스템을 도시한다.
도 7은 다양한 실시예들을 구현하기 위한 하드웨어 시스템의 일 실시예를 도시한다.
도 8은 다양한 실시예들을 구현하기 위해 수행가능한 지시들을 저장하는 기 계-판독가능한 매체의 일 실시예를 도시한다.
무선 통신 시스템 또는 디바이스를 위한 무선 통신에서 채널 또는 통신 링크의 손실을 초래하는 과도한 수의 연속적인 전력 제어 지시들의 발행 가능성을 감소시키기 위해 전력 제어 지시들에 대한 응답을 저하(slow)시키는 방법들 및 장치의 다양한 실시예들이 설명될 것이다.
하기의 설명에서, 상기 실시예들의 다양한 양상들이 설명될 것이다. 그러나, 당업자는 본 발명이 상기 설명될 실시예들의 단지 몇가지 또는 모든 양상들로 수행될 수 있음을 인식할 것이다. 설명을 위해, 본 발명의 완전한 이해를 위한 특정 갯수들, 물질들, 및 구성들이 설명된다. 그러나, 당업자는 본 발명이 특정 세부항목들 없이 수행될 수 있음을 인식할 것이다. 다른 예들에서, 공지된 특징들은 본 발명을 명확히 하기 위해 생략되거나 간략화될 수 있다.
여기에 참조된 "일 실시예" 또는 이와 유사한 표현들은 실시예와 관련하여 설명되는 특정 특징, 구성, 동작 또는 특성을 의미하며, 본 발명의 적어도 하나의 실시예에 포함된다. 따라서, 상기 구문들 또는 표현들은 동일한 실시예를 참조로하여 제공될 필요는 없다. 또한, 다양한 특정 특징들, 구성들, 동작들, 또는 특성들은 하나 또는 그이상의 실시예들에서 임의의 적절한 방식으로 결합될 수 있다.
일반적인 실시예
도 1을 참조로 하여, 본 발명의 일반적인 실시예를 설명하는 블럭 다이어그램이 도시된다. 상기 일반적인 실시예는 특히, 본 발명의 사상들내에 통합된 배칭 로직(batching logic:104) 및 전력 제어 명령 생성기/스터퍼(118)를 포함한다. 상기 실시예는 또한 저장 위치, 엘리먼트, 또는 디바이스(110)를 포함한다. 또한, 상기 실시예는 배치 처리 로직(batch processing logic:108) 및 프레임 생성기(114)를 포함한다. 엘리먼트들은 사용상 도시된 것과 같이 접속된다.
배칭 로직(104)은 채널의 링크, 예를 들면, 역방향 또는 복귀 링크(RL)를 통해 수신된 전송 프레임들(102)을 큐잉하거나, 그룹화하거나, 배칭하기 위해 사용되며, 상기 역방향 또는 복귀 링크(RL)에서 신호들은 사용자 터미널내의 송신기로부터 게이트웨이내의 수신기로, 예를 들면, 배치 처리 로직(108)에 의한 배치내의 후속 처리를 위해 프레임 배치들(106)로 변환된다. 또한, 배칭 로직(104)은 수신된 전송 프레임들(102)에 포함된 전력 제어 지시들 R을 출력하여 전력 제어 지시들의 러닝 히스토리가 미리 결정된 길이 또는 시간 주기까지 유지되거나 지속될 수 있도록 하기 위해 사용된다.
일 실시예에서, 저장장치(110)는 러닝 히스토리를 미리 결정된 길이까지 저장, 포함, 또는 유지하기 위해 사용된다. 하기에서 더 상세히 설명되는 것과 같이, 러닝 히스토리는 전력 제어 지시들에 대한 응답 행동들 또는 응답을 저하시키기 위해 사용되는 전력 제어 응답들 또는 명령들의 생성시 사용되며, 이에 따라 연속적인 전력 제어 명령들을 초과 발행(issue)하여 채널의 손실을 초래할 수 있는 가능성을 감소시킨다.
배치 처리 로직(108)은 그 명칭에서 알수 있듯이 프레임 배치들(106)을 처리하기 위해 사용된다. 수행되는 처리의 정확한 특징은 본 발명의 실시와 관련되는 것은 아니며, 관심 대상인 시스템에 대해 당업자에 의해 이해될 수 있다.
프레임 생성기(114)는 채널의 링크, 예를 들면, 신호가 게이트웨이내의 송신기로부터 사용자 터미널내의 수신기로 프레임들(116)로 변환되는 순방향 링크(FL)를 통해 전송될 전송 트래픽/신호들을 그룹화하기 위해 사용된다. 전송 트래픽/신호들이 프레임화되는 방식은 본 발명의 실행과 관련되는 것은 아니며, 채택되는 특정 통신 시스템에 대해 당업자가 알 것이다.
전력 제어 명령 생성기/스터퍼(stuffer)(118)는 채널의 순방향 링크를 통해 전송될 전력 제어 명령들 P를 생성하여 프레임들(116)에 삽입하기 위해 사용된다. 상기 실시예에서, 상기 전력 제어 명령 생성기/스터퍼(118)는 일반적인 트랜시버 서브시스템(비도시)에 의해 배치들 또는 그룹들로의 후속 처리를 위해 프레임들(116)을 프레임 배치들(120)로 큐잉한다.
따라서, 동작상, 전송 프레임들(102)이 채널의 역방향 또는 복귀 링크를 통해 수신되는 것과 같이, 전송 프레임들(102)은 예를 들면, 배치 처리 로직(108)에 의한 배치로의(in batch) 후속 처리를 위해 배칭 로직(104)에 의해 RL 프레임 배치들(106)로 큐잉되거나 배칭된다. 동시에, 전력 제어 지시들의 러닝 히스토리는 이후에 전력 제어 지시들에 대한 응답을 저하시키기 위해 사용하기 위해 미리 결정된 길이 또는 시간 주기까지 저장장치(110)내에 저장된다.
전송 트래픽 및 신호들(112)이 채널의 순방향 링크를 통한 전송을 위해 프레임 생성기(114)에 의해 전송 프레임들(116)로 그룹화되는 것과 같이, 생성된 프레임들(116)은 전력 제어 응답들이 생성되어 전송을 위해 전송 프레임들(116)에 삽입 되도록 하기 위해 전력 제어 응답 생성기/스터퍼(118)에 제공된다.
실시예들에 따라서, 생성기/스터퍼(118)는 저장장치(110)에 보유되는 러닝 히스토리에 적어도 부분적으로 기초하여 전력 제어 응답들을 생성한다. 특히, 전술된 바와 같이, 생성기/스터퍼(118)는 유지되는 러닝 히스토리에 적어도 부분적으로 기초하여 전력 제어 지시들에 대한 응답을 저하시키는 방식으로 전력 제어 명령들을 생성하며, 따라서, 채널의 손실을 초래할 수 있는 연속적인 전력 제어 명령들의 과도한 발행 가능성을 감소시킨다. 예를 들어, 전력 감소 명령들을 초과 발행하는 것은 링크 또는 접속들을 유지하거나 수신시 에러들을 증가시키기 위해 사용가능한 전력 레벨로 채널을 강하시킨다. 마찬가지로, 전력 증가 명령들의 초과 발행은 사용자 터미널이 너무 많은 전력을 사용하도록 하고 다른 사용자 단말들 또는 신호들과의 간섭을 유발할 뿐만 아니라 유용한 전원 공급원들을 불필요하게 소비할 수 있다.
상기 실시예에 대해, 전송 프레임들(102) 중 최소한의 선택된 전송 프레임은 전력 제어 비트 형태의 전력 제어 지시(instruction)들을 포함한다. 상기 전력 제어 비트들은 배칭 로직(104)에 의해 수신된 프레임(102)을 프레임 배치들(106)로 큐잉 또는 배칭함으로써 출력된다. 전력 제어 비트들은 검사되고 그들의 값들 또는 제어 정보가 제공되어 저장장치(110)에 큐의 형태로 연속 저장된다. 예시적인 큐는 약 2비트들의 큐 길이를 갖는다. 그러나, 다른 큐 길이들은 바람직하게 다른 요소들 중 저장될 명령 정보의 양에 따라 사용될 수 있다.
생성기/스터퍼(118)는 큐 내에 저장된 러닝 히스토리(여기에서 2비트)에 적어도 부분적으로 기초하여 전력 제어 명령을 생성한다. 특히, 일 실시예에 따라, 상기 생성기/스터퍼(118)는 유지되는 연속적인 2비트 히스토리에 적어도 부분적으로 기초하여 도 2를 참조로하여 상세히 설명될 배치 처리 레이트에서 전력 제어 지시들에 대한 응답을 저하시키는 방식으로 전력 제어 명령들을 생성한다.
히스토리를 유지하기 위해 전력 제어 지시들의 복사본 또는 버전을 축적(accrue)하는 것 이외에, 배칭 로직(104), 배치 처리(108) 및 프레임 생성기(114) 모두는 공지된 상기 엘리먼트들을 광범위하게 나타낸다. 따라서, 이들은 추가로 설명되지는 않을 것이다. 수신된 프레임들을 배칭하는 동안 전력 제어 지시들의 출력을 수행하는 것은 당업자의 능력내에 있으며, 따라서, 여기에서 더 상세히 설명될 필요는 없다.
전력 제어 명령 생성
도 2는 일 실시예에 따른 도 1의 전력 제어 명령 생성기/스터퍼(118)의 관련된 양상들의 동작 흐름도를 도시한다. 상기 실시예는 전력 제어 비트 지시들 R 및 명령들 P이 전력 제어 비트들의 형태라고 가정하고, 수신된 프레임들에 포함된 전력 제어 비트들의 러닝 2-비트 히스토리는 유지된다고 가정한다.
관련된 부분에서 설명된 것과 같이, 생성기/스터퍼(118)는 2-비트 히스토리가 단계 또는 처리 단계(202)에서 "01" 또는 "10"의 비트 패턴 중 어느 것을 가지는 지를 결정한다. 만약 2-비트 히스토리가 상기 두개의 비트 패턴들 중 하나를 가진다고 결정되면, 단계(204)에서 생성기/스터퍼(118)는 거의 동일한 갯수의 "0"값 및 "1"값의 전력 제어 명령 비트들, 즉, m개의 "0"값의 전력 제어 응답 비트들 및 n개의 "1"값의 전력 제어 응답 비트들을 생성하며, 상기 m 및 n은 많아야 1만큼 상이하며, 둘다 정수들이다.
만약 짝수개의 프레임들이 존재하면, 생성된 "0"값 및 "1"값의 전력 제어 명령 비트들의 갯수, 즉 m과 n은 동일하다. 만약 홀수개의 프레임들이 존재하면, 상기 배치들은 생성된 "0"값의 전력 제어 명령 비트들의 갯수(m)가 생성된 "1"값의 전력 제어 응답 비트들(n) 보다 "1"만큼 크도록 교번(alternate)할 것이다.
일 실시예에서, 배치 생성과 관련하여 홀수 차례의 위치들을 점유하는 배치들은 n보다 1만큼 큰 m을 가지며, 배치 생성과 관련하여 짝수 차례의 위치들을 점유하는 배치들은 m보다 1만큼 큰 n을 가질 것이다.
또다른 실시예에서, 배치는 반대가 되며, 즉, 배치 생성과 관련하여 홀수 차례의 위치들을 점유하는 배치들은 m보다 1만큼 큰 n을 가지며, 배치 생성과 관련하여 짝수 차례의 위치들을 점유하는 배치들은 n보다 1만큼 큰 m을 가질 것이다.
하나의 단계 또는 단계(202)에서, 2비트 히스토리가 "01" 또는 "10"의 비트 패턴중 하나를 가지지 않는 것으로 결정되면, 생성기/스터퍼(118)는 2비트 히스토리가 "11"의 비트 패턴을 가지는지의 여부를 추가 결정한다. 만약 2비트 히스토리가 "11"의 비트 패턴을 가지면, 단계(208)에서 생성기/스터퍼(118)는, 하나 또는 두개의 여분의 "1"값의 전력 제어 명령 비트들로써, "1"값의 전력 제어 명령 비트들과 "0"값의 전력 제어 명령 비트들의 생성을 교번하며 이는 하나의 배치내에 홀수개의 프레임들 또는 짝수개의 프레임들이 존재하는지에 따라 결정된다.
하나의 배치내에 홀수개의 프레임들이 존재하면, 상기 배치는 당연히 여분의 "1"값의 전력 제어 명령 비트들을 사용하여 형성된다. 하나의 배치내에 짝수개의 프레임들이 존재하면, 생성기/스터퍼(118)는 최종 비트를 "1"값의 전력 제어 비트로서 생성하여 최종의 두 개의 전력 제어 명령 비트들을, "1"값 비트들로 만든다. 따라서, 생성되는 "1"값의 전력 제어 명령 비트들의 갯수는 "0"값의 전력 제어 비트들의 갯수보다 2만큼 클 것이다.
단계 또는 처리 단계(204)에서, 2비트 히스토리가 "11"비트 패턴을 가지지 않는 것으로 결정되고 전술된 다른 패턴들 또한 가지지 않는 것으로 결정되면, 디폴트로 2비트 히스토리는 "00"의 비트 패턴을 갖는다. 단계(210)에서, 생성기/스터퍼(118)는, 하나 또는 두개의 여분의 "0"값의 전력 제어 명령 비트들로써, "0"값의 전력 제어 명령 비트들 및 "1"값의 전력 제어 응답 비트들 간에 교번하며, 이는 하나의 배치내에 홀수개의 프레임들이 존재하는지 또는 짝수개의 프레임들이 존재하는지에 따라 결정된다.
하나의 배치내에 홀수개의 프레임들이 존재하면, 상기 배치는 당연히 여분의 "0"값의 전력 제어 명령 비트들을 가지고 형성된다. 하나의 배치내에 짝수개의 프레임들이 존재하면, 생성기/스터퍼(118)는 "0"값의 전력 제어 비트로서 최종 비트를 생성하여, 최종 두개의 전력 제어 명령 비트들을, "0"값의 비트들로 만든다. 따라서, 생성된 "0"값의 전력 제어 명령 비트들의 갯수는 생성된 "1"값의 전력 제어 비트들의 갯수를 2만큼 초과할 것이다.
게이트웨이 실시예
도 3을 참조로 하여, 본 발명의 게이트웨이 실시예를 설명하는 블럭 다이어그램이 도시된다. 용어들 게이트웨이, 허브, 및 기지국은 때때로 업계에서 상호교 환적으로 사용되며, 상기 게이트웨이들은 기지국들이 주변의 지리적인 영역내에서 통신들을 전송하기 위해 육상 안테나들을 사용하는 동안 위성들을 통한 통신들을 전송하는 특정 기지국들로서 인식된다. 표현 육상국은 때때로 게이트웨이를 사용하는 상기 분야에서 상호교환적으로 사용된다.
도 1에 의해 설명된 일반적인 실시예와 유사하게, 게이트웨이(300)는 전술된 배칭 로직(104)과 전력 제어 명령 생성기/스터퍼(118)를 포함하며, 두가지 모두는 본 발명의 제시사항에 속한다. 상기 실시예는 또한, 저장 엘리먼트, 위치 또는 디바이스(110)를 포함한다. 또한, 상기 실시예는 배치 처리 로직(108)과 프레임 생성기(114)를 포함한다.
게이트웨이 실시예를 위해, 배칭 로직(104)은 트랜시버 서브시스템(302)의 구성요소인 반면에, 배치 처리(108), 저장장치(110), 프레임 생성기(114) 및 전력 제어 명령 생성기/스터퍼(118)는 프레임 처리 서브시스템(304)의 구성요소들이다.
엘리먼트들은 사용상 도시된 것과 같이 서로 접속된다. 또한, 상기 엘리먼트들이 사용되어 전술된 것과 같이 서로 상호작용한다.
특히, 전력 제어 지시들이 전력 제어 비트들의 형태인 일 실시예에서, 저장장치(110)는 2비트의 러닝 히스토리를 전술된 바와 같은 큐 형태로 유지하며, 생성기/스터퍼(118)는 도 2를 참조로 하여 전술된 것과 같은 방식으로 전력 제어비트들에 대한 응답을 저하시킨다.
트랜시버 서브시스템(302) 및 프레임 처리 서브시스템(304)내에 통합된 본 발명의 기술들 이외에, 엘리먼트들은 다른 방법으로 공지되며, 따라서 본 명세서에 서 추가로 설명되지 않을 것이다.
게이트웨이 실시예의 응용
도 4는 저하되거나 더 저하되는 본 발명의 전력 제어 응답을 갖는, 게이트웨이(300)가 사용될 수 있는 MSS를 도시한다. 도시된 것과 같이, MSS는 사용자 터미널들(430 및 440) 및 게이트웨이(300)를 포함하고 통신 위성(420)에 의해 연결된다. 제 1 사용자 터미널 또는 터미널 디바이스(430)는 제 1빔(435)의 제 1 채널의 순방향 링크를 통해 통신 위성(420)으로부터의 전송들을 수신하며, 제 1 채널의 역방향 링크를 통해 통신 위성(420)에 전송한다. 제 2 터미널 디바이스(440)는 제 2 빔(445)의 제 2 채널의 순방향 링크를 통해 통신 위성(420)으로부터 전송들을 수신하고 제 2 채널의 역방향 링크를 통해 통신 위성(420)에 전송한다.
위성(420)은 개별적이며 일반적으로 중첩하지 않는 지리적 영역들을 커버하기 위해 사용되는 적어도 하나의 '스폿(spot)'내에 다수의 빔들을 제공한다. 일반적으로, 다수의 빔들은 서로다른 주파수들에서 CDMA 채널들(CDMA를 사용할 때), '서브-빔들' 또는 FDM 신호들, 주파수 슬롯들 또는 채널들로서 지칭되며, 동일한 영역을 중첩하도록 지향될 수 있다. 그러나, 서로다른 위성들 또는 안테나 패턴들 또는 육상 셀사이트들에 대한 빔 커버리지 또는 서비스 영역들은 통신 시스템 설계 및 제공되는 서비스 형태에 따라 주어진 영역내에서 완전히 또는 부분적으로 중첩하는 것으로 용이하게 이해된다.
순방향 또는 역방향 링크들을 형성하기 위해, 채널들은 TDMA 형태의 통신 시스템들 또는 신호들을 위해 사용되는 것과 같은 타임 슬롯들, 또는 CDMA 형태의 통 신 시스템들 또는 신호들을 위해 사용되는 것과 같은 코드 채널들로 분할되어 각각의 터미널이 할당된 코드 채널을 통해 통신한다. 공지된 것과 같이, 여기에 개시된 채널들내에 링크들을 형성하기 위해 상기와 같은 또는 다른 조합들이 사용될 수 있다.
용어 역방향 링크 및 순방향 링크는 전술된 것과 같다. 용어 역방향 링크 및 복귀 링크는 때때로 본 분야에서 상호교환적으로 사용되며 터미널 디바이스로부터 위성으로 및 위성으로부터 육상국으로 신호들이 전파하는 통신 경로들을 말한다. 육상 통신 시스템에서, 신호들은 터미널로부터 기지국으로 직접 전파한다. 순방향 링크는 육상국으로부터 위성으로 및 위성으로부터 터미널 디바이스로 신호들이 전파하는 통신 경로들을 말한다. 육상 통신 시스템들에서, 신호들은 기지국으로부터 터미널로 직접 전파한다. 또한, 용어 "역방향"은 신호들이 수신되는 방향(FL 또는 RL)과는 상반된 방향(RL 또는 FL)으로 통신 링크들을 통해 신호들을 전달 또는 전송하기 위해 사용된다. 이는 당업자에 의해 잘 이해될 것이다.
사용자 터미널들 또는 터미널 디바이스들(430 및 440)은 각각 셀룰러 전화기, 데이터 트랜시버, 또는 전송 디바이스(예를 들면, 컴퓨터들, 개인 디지털 보조장치들, 팩시밀리와 같은)와 같은 무선 통신 디바이스를 갖거나 포함하지만, 이에 제한되는 것은 아니다. 일반적으로, 상기 유니트들은 바람직하게 휴대용이거나 또는 차량에 장착된다. 상기 사용자 터미널들이 이동가능한것으로 논의되지만, 본 발명의 기술들은 원격 무선 서비스가 바람직한 고정된 유니트들 또는 다른 형태의 터미널들에 응용가능하다. 상기 후자의 서비스 형태는 부분적으로 세계의 다수의 원거리 영역들에서 통신 링크들을 형성하기 위해 위성 중계기들을 사용하는데 적합하다. 사용자 터미널들, 터미널 디바이스들 또는 사용자 디바이스들은 때때로 무선 디바이스들, 액세스 터미널들, 가입자 유니트들, 이동 유니트들, 이동국들, 또는 임의의 통신 환경들에서 간단히 우선순위에 따라 "사용자", "모바일들", "가입자들"이라 참조된다. 상기 용어들은 본 업계에서 잘 이해될 것이다.
게이트웨이(300)는 통신 위성(420)을 통해 터미널 디바이스들(430, 440)에 순방향 채널 데이터를 전송하고 통신 위성(420)을 통해 터미널 디바이스들(430, 44)로부터 역방향 채널 데이터를 수신한다.
역방향 채널 데이터는 전력 제어 지시들, 특히, 전력 제어 비트들의 형태로 전력 제어 지시들을 포함할 수 있다. 본 발명의 기술에 따라 부과된 게이트웨이(300)는 수신된 역방향 채널 데이터를 배치 처리할 수 있고, 동시에 전력 제어 지시들에 대한 응답을 저하시킴으로써 연속적인 전력 제어 명령들을 초과 발생하는 가능성을 감소시키고 채널들을 손실하는 가능성을 감소시킨다.
게이트웨이(300)내에 포함된 본 발명의 기술들에 대하여 제외하고, 그밖의 엘리먼트들은 당업계에 공지된 것이며, 따라서 추가 설명되지 않을 것이다.
게이트웨이 에뮬레이터 및 시뮬레이터 실시예
당업자는 MSS의 개발이 광범위한 시험(testing)을 필요로 한다는 것을 인식할 것이다. 필드 시험 또는 실제 시험은 비용이 비싼 편이다. 따라서, 상당한 양의 시험은 에뮬레이팅 또는 시뮬레이팅 환경에서, 연구실에서 시행된다.
도 5는 본 발명의 게이트웨이 에뮬레이터 및 시뮬레이터 실시예를 설명한다. 도 1에 의해 설명된 일반적인 실시예와 유사하게, 에뮬레이터 및 시뮬레이터쌍(502 및 504)은 전술된 배칭 로직(104)과 전력 제어 응답 생성기/스터퍼(118)를 포함하며, 두가지 모두는 본 발명의 기술들내에서 통합된다. 상기 실시예는 또한 저장장치(110)를 포함한다. 또한, 상기 실시예는 배치 처리 로직(108) 및 프레임 생성기(114)를 포함한다.
실시예에 따라, 배칭 로직(104)은 에뮬레이터(502)의 구성요소인 반면, 배치 처리(108), 저장장치(110), 프레임 생성기(114) 및 전력 제어 응답 생성기/스터퍼(118)는 시뮬레이터(304)의 구성요소들이다.
상기 엘리먼트들은 사용상 도시된 것과 같이 서로 접속된다. 또한, 상기 엘리먼트들은 전술된 것과 같이 사용되고 서로 상호작용한다.
특히, 전력 제어 지시들이 전력 제어 비트들의 형태인 일 실시예에서, 저장장치(110)는 전술된 것과 같은 큐 형태로 2비트의 러닝 히스토리를 유지하며, 생성기/스터퍼(118)는 도 2를 참조로하여 전술된 것과 같이 전력 제어 비트들에 대한 응답을 저하시킨다.
게이트웨이 에뮬레이터(502) 및 시뮬레이터(504)에 통합된 본 발명의 기재사항들 이외에, 엘리먼트들은 서로 접속하고 사용자 터미널등과 같은 다른 엘리먼트들과 접속하기 위한 네트워킹 및 다른 인터페이스들과 같은 다른 구성요소들을 포함할 수 있다. 에뮬레이터(502)와 시뮬레이터(504)의 정확한 구성은 본 발명의 수행에 있어 필수적인 것은 아니며, 따라서, 추가 설명되지 않을 것이다.
게이트웨이 에뮬레이터 및 시뮬레이터 실시예의 애플리케이션
도 6은 본 발명의 전력 제어 응답이 저하된 에뮬레이터 및 시뮬레이터(502-504)가 사용될 수 있는 MSS 시험 환경을 도시한다. 실시예를 위해, 에뮬레이터 및 시뮬레이터(502-504)에 부가하여, MSS 시험 환경(600)은 사용자 터미널(606) 및 이동 통신 서브시스템(MCS:608)을 포함한다.
에뮬레이터(502)는 특히, 이더넷 인터페이스들, 무선 주파수(RF) 인터페이스 및 타이밍 및 주파수 유니트(TFU)(모두 도시되지 않음)와 같은 다수의 네트워킹 인터페이스들을 포함하며, 시뮬레이터(504)는 네트워킹 인터페이스 및 특수 모니터(도시되지 않음)를 포함한다.
에뮬레이터(502) 및 시뮬레이터(504)는 네트워킹 접속을 통해 서로 접속되며, 상기 네트워킹 접속을 통해 서로 데이터 및 명령들을 교환하여 시뮬레이터(504)가 MSS를 시험을 목적으로 에뮬레이터(502)를 구동하도록 한다.
사용자 터미널(606)은 하나 또는 그이상의 무선 주파수(RF)를 통해 MCS(608)와 통신하며, UT-DMI(특수 모니터 인터페이스)를 통해 게이트웨이 시뮬레이터(504)와 통신하여 게이트웨이 시뮬레이터(504)가 시험을 목적으로 에뮬레이터(502)를 구동하도록 한다.
MCD(608)는 차례로 제어 명령들을 위한 네트워킹 인터페이스를 통해, 사용자 데이터를 위한 RF를 통해, 및 타이밍 및 주파수 정보를 위한 TFU 접속을 통해 에뮬레이터(502)와 통신한다.
다시말해서, 게이트웨이 에뮬레이터 및 시뮬레이터(502-504)에 부과된 본 발명의 기술들을 제외하고, 남아있는 엘리먼트들의 정확한 구성 및 동작은 전력 제어 지시들, 특히 배치 처리 전송 프레임들과 관련하여 속도 또는 응답 레이트를 저하시키기 위한 본 발명의 실행에 필수적인 것은 아니다.
구현
본 발명의 다양한 양상들은 단일 집적 회로를 통한 가능한 구현을 포함하는 회로-기반의 해결책들로서 구현될 수 있다. 당업자에게 명백한 것과 같이, 회로 엘리먼트의 다양한 기능들은 소프트웨어 프로그램에서의 처리 동작들로서 구현될 수 있다. 상기 소프트웨어는 예를 들면 디지털 신호 처리기, 마이크로 제어기, 또는 범용 컴퓨터에서 사용될 수 있다.
본 발명의 다양한 실시예들은 전술된 기능들을 수행하기 위해 계산 자원들을 사용한다. 도 7은 개인 컴퓨터들, 워크스테이션들, 및/또는 장착된 시스템들과 같은 광범위한 카테고리의 컴퓨터 시스템들을 나타내도록 지정된 하드웨어 시스템의 일 실시예를 도시한다. 도시된 실시예에서, 하드웨어 시스템은 버스 브릿지(730)를 통해 입력/출력(I/O)버스(715)에 접속된 고속 버스(705)에 연결된 프로세서(710)를 포함한다. 임시 메모리(720)는 버스(705)에 접속된다. 영구 메모리(740)는 버스(715)에 접속된다. I/O 디바이스(들:750)은 버스(715)에 접속된다. I/O 디바이스(들)(750)은 디스플레이 디바이스, 키보드, 하나 또는 그이상의 외부 네트워크 인터페이스들 등등을 포함한다.
특정 실시예들은 추가의 구성요소들을 포함할 수 있거나, 전술된 구성요소들 모두를 요구하지 않을 수 있거나, 또는 하나 또는 그이상의 구성요소들을 조합할 수 있다. 예를 들어, 임시 메모리(720)는 프로세서(710)에 온칩(on-chip)일 수 있다. 선택적으로, 영구 메모리(740)는 제거될 수 있고, 임시 메모리(720)는 전기적으로 소거할 수 있는 프로그램가능한 판독 전용 메모리(EEPROM)와 교체될 수 있으며, 소프트웨어 루틴들은 상기 EEPROM으로부터 적절히 실행될 수 있다. 임의의 구현들은 단일 버스를 사용할 수 있고, 모든 구성요소들이 상기 단일 버스에 접속되거나 하나 또는 그이상의 추가 버스들 및 다양한 추가 구성요소들이 접속될 수 있는 버스 브릿지들에 접속될 수 있다. 당업자는 예를 들면, 메모리 제어기 허브 및 I/O 제어기 허브를 가지는 고속 시스템 버스에 기초한 내부 네트워크를 포함하는 다양한 선택적인 내부 네트워크들을 잘 알고있을 것이다. 추가의 구성요소들은 추가의 프로세서들, CD ROM 드라이브, 추가의 메모리들, 및 다른 공지된 주변 구성요소들을 포함할 수 있다.
일 실시예에서, 전술된 것과 같이, 도 7의 하드웨어 시스템과 같은 하나 또는 그이상의 하드웨어 시스템들을 사용하여 구현된다. 하나 이상의 컴퓨터가 사용되는 경우에, 시스템들은 근거리 네트워크(LAN), 인터넷 프로토콜(IP) 네트워크 등등과 같은 외부 네트워크를 통해 통신하도록 접속될 수 있다. 일 실시예에서, 본 발명은 컴퓨터(들)내의 하나 또는 그이상의 실행 유니트들에 의해 수행되는 소프트웨어 루틴들로서 구현된다. 주어진 컴퓨터에 대하여, 소프트웨어 루틴들은 영구 메모리(740)와 같은 저장 디바이스에 저장될 수 있다.
선택적으로, 도 8에 도시된 것과 같이, 소프트웨어 루틴들은 디스켓, CD-ROM, 자기 테이프, 디지털 비디오 또는 다용도 디스크(DVD), 레이저 디스크, ROM, 플래시 메모리 등등과 같은 임의의 기계 판독가능한 저장 매체(820)를 사용하여 저 장된 기계 수행가능한 지시들(810)이 될 수 있다. 일련의 지시들은 국부적으로 저장될 필요는 없으며, 예를 들면, 도 7의 I/O 디바이스(들:750)을 통해 네트워크상의 서버, CD-ROM 드라이브, 플로피 디스크 등등과 같은 원거리 저장 디바이스로 부터 수신된다.
어떠한 소스로부터, 지시들은 저장 디바이스로부터 임시 메모리(720)로 복사될 수 있으며, 프로세서(710)에 의해 액세스되어 실행된다. 일 실시예에서, 상기 소프트웨어 루틴들은 C 프로그래밍 언어로 기록된다. 그러나, 상기 루틴들은 임의의 광범위한 프로그래밍 언어들로 구현될 수 있다.
선택적인 실시예들에서, 본 발명은 이산 하드웨어 또는 펌웨어에서 구현된다. 예를 들면, 하나 또는 그이상의 애플리케이션 특정적 집적 회로들(ASICs)은 본 발명의 하나 또는 그이상의 전술된 기능들을 사용하여 프로그래밍될 수 있다. 또다른 예에서, 본 발명의 하나 또는 그이상의 기능들은 추가의 회로 보드들상의 하나 또는 그이상의 ASIC들에서 구현될 수 있고, 회로 보드들은 전술된 컴퓨터(들)로 내장될 수 있다. 또다른 예에서, 필드 프로그래머블 게이트 어레이들(FPGAs) 또는 정적 프로그래머블 게이트 어레이들(SPGA)은 본 발명의 하나 또는 그이상의 기능들을 수행하기 위해 사용될 수 있다. 또다른 실시예에서, 하드웨어 및 소프트웨어의 조합은 본 발명의 하나 또는 그이상의 기능들을 수행하기 위해 사용될 수 있다.
결론
따라서, MSS 애플리케이션들내에서 전력 제어 지시들에 대한 응답이 수행되 는 속도를 감소시키는 히스토리에 기초한 방법 및 장치가 설명되었다.
본 발명의 장점은 특히, 전송 프레임이 처리를 위해 그룹화되거나, 큐잉되거나, 배칭될 때, 채널 또는 통신 링크의 손실을 초래할 수 있는 연속적인 전력 제어 명령들의 발생 가능성을 감소시키는 것이다.
본 발명이 주로 무선의, 위성에 기초한 통신들과 관련하여 설명되었지만, 본 발명은 디지털이거나, 전기 또는 광학적이거나 무선의 와이어/화이버 등등을 포함하는 다른 형태의 통신 채널(들)에 적용가능할 수 있고, 이 경우에 통신 링크들의 엘리먼트는 신호 지연을 보상하기를 원한다.
본 발명은 전술된 실시예들에 제한되는 것이 아니라, 하기의 청구항들의 사상 내에 있는 임의의 및 모든 실시예들을 포함하는 것이 이해될 것이다.

Claims (38)

  1. 채널의 링크를 통해 한 방향에서 수신되는 제 1 복수의 프레임들에 포함된 전력 제어 지시(instruction)들의 러닝 히스토리(running history)를, 미리 결정된 길이까지 유지하는 단계 ― 상기 제 1 프레임들은 처리 이전에 큐잉됨(queued) ―; 및
    인입하는 전력 제어 지시들에 대한 응답의 저하(slow)를 실시하는 방식으로, 상기 유지되는 러닝 히스토리에 적어도 일부 기초하여, 상기 채널의 리턴 방향으로 전송될 제 2 복수의 프레임들에 대한 전력 제어 명령(command)들을 생성하는 단계― 상기 제 2 프레임들은 후속 처리를 위해 전송을 위한 배치 형태(batch form)로 배칭됨(batched) ―를 포함하고,
    상기 생성하는 단계는, 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 m개의 "0"값 전력 제어 비트들과 n개의 "1"값 전력 제어 비트들을 생성하는 단계를 포함하며, m과 n은, 만약 2-비트 러닝 히스토리가 "01" 및 "10" 중 선택된 하나와 동일하면, 많아야 1만큼 상이하고, m과 n은 정수들인, 방법.
  2. 제 1 항에 있어서,
    상기 전력 제어 지시들 및 명령들은 전력 제어 비트들의 형태이며, 상기 미리 결정된 길이는 2 비트들인, 방법.
  3. 삭제
  4. 제 1 항에 있어서,
    만약 상기 제 2 프레임들의 서브세트의 각각의 배치가 짝수개의 프레임들을 포함하면, m과 n은 동일한, 방법.
  5. 제 1 항에 있어서,
    만약 상기 제 2 프레임들의 서브세트의 각각의 배치가 홀수개의 프레임들을 포함하면, m과 n은 1만큼 상이한, 방법.
  6. 제 5 항에 있어서,
    m은 구성(formation) 순서가 홀수 차례의 위치들의 배치들에 대하여 n보다 1만큼 더 크고, n은 구성 순서가 짝수 차례의 위치들의 배치들에 대하여 m보다 1만큼 더 큰, 방법.
  7. 제 5 항에 있어서,
    m은 구성 순서가 짝수 차례의 위치들의 배치들에 대하여 n보다 1만큼 더 크고, n은 구성 순서가 홀수 차례의 위치들의 배치들에 대하여 m보다 1만큼 더 큰, 방법.
  8. 제 2 항에 있어서,
    상기 생성하는 단계는 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 "1"값 전력 제어 비트와 "0"값 전력 제어 비트의 생성 간에 교번(alternate)하는 단계를 포함하며, 최종 프레임과 최종 두개의 프레임들 중 선택된 하나는 만약 2비트 러닝 히스토리가 "11"과 동일하면 "1"값 전력 제어 비트를 수신하는, 방법.
  9. 제 8 항에 있어서,
    상기 최종 프레임은, 만약 각각의 배치내에 홀수개의 프레임들이 존재하면, "1"값 전력 제어 비트를 수신하고, 상기 최종 두개의 프레임들은, 만약 각각의 배치내에 짝수개의 프레임들이 존재하면, "1"값 전력 제어 비트를 수신하는, 방법.
  10. 제 2 항에 있어서,
    상기 생성하는 단계는 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 "0"값의 전력 제어 비트와 "1"값 전력 제어 비트의 생성 간에 교번하는 단계를 포함하며, 최종 프레임과 최종 두개의 프레임들 중 선택된 하나는, 만약 2비트 러닝 히스토리가 "00"과 동일하면, "0"값 전력 제어 비트를 수신하는, 방법.
  11. 제 10 항에 있어서,
    상기 최종 프레임은, 만약 각각의 배치내에 홀수개의 프레임들이 존재하면, "0"값 전력 제어 비트를 수신하고, 상기 최종 두개의 프레임들은, 만약 각각의 배치내에 짝수개의 프레임들이 존재하면, "0"값 전력 제어 비트를 수신하는, 방법.
  12. 제 1 항에 있어서,
    상기 유지 및 생성하는 단계 동작들은 무선 통신 시스템의 게이트웨이에서 수행되는, 방법.
  13. 제 1 항에 있어서,
    상기 유지 및 생성하는 단계 동작들은 무선 통신 테스트 시스템의 에뮬레이트된(emulated) 게이트웨이 및 게이트웨이 시뮬레이터에서 수행되는, 방법.
  14. 무선 통신 시스템의 게이트웨이로서:
    채널의 제 1 링크를 통해 제 1 복수의 프레임들을 수신하고, 배치로의(in batch) 처리를 위해 상기 제 1 프레임들을 배칭하는 트랜시버 서브시스템 ― 상기 제 1 프레임들 각각은 전력 제어 지시를 포함하고, 상기 트랜시버 서브시스템은 상기 제 1 프레임들 각각에 포함된 상기 전력 제어 지시를 출력함 ―; 및
    상기 트랜시버 서브시스템에 연결되며, 상기 배칭된 제 1 프레임들을 배치로 처리하고, 상기 트랜시버 서브시스템에 의해 출력된 상기 제 1 프레임들의 상기 전력 제어 지시들을 수신하고, 그리고 상기 채널의 제 2 링크에 대한 제 2 복수의 프레임들을 생성하기 위한 프로세싱 서브시스템을 포함하며 ― 상기 제 2 복수의 프레임들은 배치로 상기 트랜시버 서브시스템에 의해 처리되기 이전에 배칭됨 ―, 상기 프로세싱 서브시스템은:
    상기 제 1 프레임들에 포함된 상기 전력 제어 지시들의 러닝 히스토리를 미리 결정된 길이까지 유지하고, 그리고
    인입하는 전력 제어 지시들에 대한 응답의 저하를 실시하는 방식으로, 상기 유지된 러닝 히스토리에 적어도 일부 기초하여, 상기 제 2 프레임들에 대한 전력 제어 명령들을 생성하고,
    상기 프로세싱 서브시스템은 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 m개의 "0"값 전력 제어 비트들과 n개의 "1"값 전력 제어 비트들을 생성하도록 설계되며, m과 n은 만약 2비트들의 러닝 히스토리가 "01" 및 "10" 중 선택된 하나와 동일하면, 많아야 1만큼 상이하고, m과 n은 정수들인, 게이트웨이.
  15. 제 14 항에 있어서,
    상기 전력 제어 지시들은 전력 제어 비트들의 형태이며, 상기 미리 결정된 길이는 2 비트와 동일한, 게이트웨이.
  16. 삭제
  17. 제 14 항에 있어서,
    상기 프로세싱 서브시스템은, 만약 상기 제 2 프레임들의 서브세트의 각각의 배치가 짝수개의 프레임들을 포함하면, 동일한 갯수의 "0"값 및 "1"값 전력 제어 비트들을 생성하도록 설계되는, 게이트웨이.
  18. 제 14 항에 있어서,
    상기 프로세싱 서브시스템은, 만약 상기 제 2 프레임들의 서브세트의 각각의 배치가 홀수개의 프레임들을 포함하면, 추가로 하나의 "0"값 전력 제어 비트와 추가로 하나의 "1"값 전력 제어 비트 중 선택된 하나를 생성하도록 설계되는, 게이트웨이.
  19. 제 18 항에 있어서,
    상기 프로세싱 서브시스템은 구성 순서가 홀수 차례의 위치들의 배치들에 대하여 추가로 하나의 "0"값 전력 제어 비트를, 그리고 구성 순서가 짝수 차례의 위치들의 배치들에 대하여 추가로 하나의 "1"값 전력 제어 비트를 생성하도록 설계되는, 게이트웨이.
  20. 제 18 항에 있어서,
    상기 프로세싱 서브시스템은 구성 순서가 짝수 차례의 위치들의 배치들에 대하여 추가로 하나의 "0"값 전력 제어 비트를, 그리고 구성 순서가 홀수 차례의 위치들의 배치들에 대하여 추가로 하나의 "1"값 전력 제어 비트를 생성하도록 설계되는, 게이트웨이.
  21. 제 15 항에 있어서,
    상기 프로세싱 서브시스템은 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 "1"값 전력 제어 비트와 "0"값 전력 제어 비트의 생성 간에 교번하도록 설계되며, 최종 프레임과 최종 두개의 프레임들 중 선택된 하나는, 만약 2비트 러닝 히스토리가 "11"과 동일하면, "1"값 전력 제어 비트를 수신하는, 게이트웨이.
  22. 제 21 항에 있어서,
    상기 프로세싱 서브시스템은, 만약 각각의 배치내에 홀수 개의 프레임들이 존재하면, "1"값 전력 제어 비트를 가지는 최종 프레임을 생성하고, 만약 각각의 배치내에 짝수개의 프레임들이 존재하면, "1"값 전력 제어 비트를 가지는 최종 두개의 프레임들을 생성하도록 설계되는, 게이트웨이.
  23. 제 15 항에 있어서,
    상기 프로세싱 서브시스템은 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 "1"값 전력 제어 비트와 "0"값 전력 제어 비트의 생성 간에 교번하도록 설계되며, 최종 프레임과 최종 두개의 프레임들 중 선택된 하나는, 만약 2비트 러닝 히스토리가 "00"과 동일하면, "0"값 전력 제어 비트를 수신하는, 게이트웨이.
  24. 제 23 항에 있어서,
    상기 프로세싱 서브시스템은, 만약 각각의 배치내에 홀수개의 프레임들이 존재하면, "0"값 전력 제어 비트를 가지는 최종 프레임을 생성하고, 만약 각각의 배치내에 짝수개의 프레임들이 존재하면, "0"값 전력 제어 비트를 가지는 최종 2개의 프레임들을 생성하도록 설계되는, 게이트웨이.
  25. 무선 통신 시험 시스템으로서:
    채널의 링크를 통해 한 방향으로 제 1 복수의 프레임들을 수신, 그리고 배치로의(in batch) 처리를 위해 상기 제 1 프레임들을 큐잉하는 것을 포함하는 게이트웨이를 에뮬레이트하는 게이트웨이 에뮬레이터(emulator) ― 상기 제 1 프레임들 각각은 전력 제어 지시를 포함하고, 상기 게이트웨이 에뮬레이터는 상기 제 1 프레임들 각각에 포함된 상기 전력 제어 지시를 출력함 ―; 및
    상기 제 1 프레임들을 배치로 처리하고 상기 게이트웨이 에뮬레이터에 의해 출력되는 상기 제 1 프레임들의 전력 제어 지시들을 수신하고, 그리고 상기 채널의 링크를 통해 반대되는 방향으로의 전송을 위한 제 2 복수의 프레임들을 생성하기 위해 상기 게이트웨이 에뮬레이터에 연결되는 게이트웨이 시뮬레이터 ― 상기 제 2 복수의 프레임들은 상기 게이트웨이 에뮬레이터에 의해 배치로 처리되기 이전에 배칭됨 ― 를 포함하며, 상기 게이트웨이 시뮬레이터는:
    상기 제 1 프레임들에 포함된 상기 전력 제어 지시들의 러닝 히스토리를 미리 결정된 길이 이상으로(over) 유지하고, 그리고
    인입하는 전력 제어 지시들에 대한 응답의 저하를 실시하는 방식으로, 상기 유지되는 러닝 히스토리에 적어도 일부 기초하여, 상기 제 2 프레임들에 대한 전력 제어 명령들을 생성하고,
    상기 게이트웨이 시뮬레이터는, 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 m개의 "0"값 전력 제어 비트들과 n개의 "1"값 전력 제어 비트들을 생성하도록 설계되며, m과 n은, 만약 2비트 러닝 히스토리가 "01" 및 "10" 중 선택된 하나와 동일하면, 많아야 1만큼 상이하고, m과 n은 정수들인, 무선 통신 시험 시스템.
  26. 제 25 항에 있어서,
    상기 전력 제어 지시들 및 명령들은 전력 제어 비트들의 형태이며, 상기 미리 결정된 길이는 2 비트와 동일한, 무선 통신 시험 시스템.
  27. 삭제
  28. 제 25 항에 있어서,
    상기 게이트웨이 시뮬레이터는, 만약 상기 제 2 프레임들의 서브세트의 각각의 배치가 짝수개의 프레임들을 포함하면, 동일한 갯수의 "0"값 및 "1"값 전력 제어 비트들을 생성하도록 설계되는, 무선 통신 시험 시스템.
  29. 제 25 항에 있어서,
    상기 게이트웨이 시뮬레이터는, 만약 상기 제 2 프레임들의 서브세트의 각각의 배치가 홀수개의 프레임들을 포함하면, 추가로 하나의 "0"값 전력 제어 비트와 추가로 하나의 "1"값 전력 제어 비트 중 선택된 하나를 생성하도록 설계되는, 무선 통신 시험 시스템.
  30. 제 29 항에 있어서,
    상기 게이트웨이 시뮬레이터는 구성 순서가 홀수 차례의 위치들의 배치들에 대하여 추가로 하나의 "0"값 전력 제어 비트를 생성하고, 구성 순서가 짝수 차례의 위치들의 배치들에 대하여 추가로 하나의 "1"값 전력 제어 비트를 생성하도록 설계되는, 무선 통신 시험 시스템.
  31. 제 29 항에 있어서,
    상기 게이트웨이 시뮬레이터는 구성 순서가 짝수 차례의 위치들의 배치들에 대하여 추가로 하나의 "0"값 전력 제어 비트를 생성하고, 구성 순서가 홀수 차례의 위치들의 배치들에 대하여 추가로 하나의 "1"값 전력 제어 비트를 생성하도록 설계되는, 무선 통신 시험 시스템.
  32. 제 26 항에 있어서,
    상기 게이트웨이 시뮬레이터는 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 "1"값 전력 제어 비트와 "0"값 전력 제어 비트의 생성 간에 교번하도록 설계되며, 최종 프레임과 최종 두개의 프레임들 중 선택된 하나는, 만약 2비트 러닝 히스토리가 "11"과 동일하면, "1"값 전력 제어 비트를 수신하는, 무선 통신 시험 시스템.
  33. 제 32 항에 있어서,
    상기 게이트웨이 시뮬레이터는, 만약 각각의 배치내에 홀수개의 프레임들이 존재하면, "1"값 전력 제어 비트를 가지는 최종 프레임을 생성하고, 만약 각각의 배치내에 짝수개의 프레임들이 존재하면, "1"값 전력 제어 비트를 가지는 최종 두개의 프레임들을 생성하도록 설계되는, 무선 통신 시험 시스템.
  34. 제 26 항에 있어서,
    상기 게이트웨이 시뮬레이터는 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 "1"값 전력 제어 비트와 "0"값 전력 제어 비트의 생성 간에 교번하도록 설계되며, 최종 프레임과 최종 두개의 프레임들 중 선택된 하나는, 만약 2비트 러닝 히스토리가 "00"과 동일하면, "0"값 전력 제어 비트를 수신하는, 무선 통신 시험 시스템.
  35. 제 34 항에 있어서,
    상기 게이트웨이 시뮬레이터는, 만약 각각의 배치내에 홀수개의 프레임들이 존재하면 "0"값 전력 제어 비트를 가지는 최종 프레임을, 그리고 만약 각각의 배치내에 짝수개의 프레임들이 존재하면, "0"값 전력 제어 비트를 가지는 최종 2개의 프레임들을 생성하도록 설계되는, 무선 통신 시험 시스템.
  36. 채널의 제 1 링크를 통해 수신되는 제 1 복수의 프레임들에 포함된 전력 제어 지시들의 러닝 히스토리를, 미리 결정된 길이까지 유지하기 위한 수단 ― 상기 제 1 프레임들은 처리 이전에 그룹화됨 ―; 및
    인입하는 전력 제어 지시들에 대한 응답의 저하를 실시하는 방식으로, 상기 유지되는 러닝 히스토리에 적어도 일부 기초하여, 상기 채널의 제 2 링크를 통해 전송될 제 2 복수의 프레임들에 대한 전력 제어 명령들을 생성하기 위한 수단 ― 상기 제 2 프레임들은 후속 처리를 위해 전송을 위한 배치로 그룹화됨 ―을 포함하고,
    상기 생성하기 위한 수단은, 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 m개의 "0"값 전력 제어 비트들과 n개의 "1"값 전력 제어 비트들을 생성하기 위한 수단을 포함하며, m과 n은, 만약 2-비트 러닝 히스토리가 "01" 및 "10" 중 선택된 하나와 동일하면, 많아야 1만큼 상이하고, m과 n은 정수들인, 장치.
  37. 실행될 때 하기의 방법을 수행하는 저장된 기계 수행가능한 지시(machine executable instruction)들을 포함하는 기계 판독가능한 매체(machine readable medium)로서, 상기 방법은:
    채널의 제 1 링크를 통해 수신되는 제 1 복수의 프레임들에 포함된 전력 제어 지시들의 러닝 히스토리를, 미리 결정된 길이까지 유지하는 단계 ― 상기 제 1 프레임들은 처리 이전에 그룹화됨 ―; 및
    인입하는 전력 제어 지시들에 대한 응답의 저하를 실시하는 방식으로, 상기 유지되는 러닝 히스토리에 적어도 일부 기초하여, 상기 채널의 제 2 링크를 통해 전송될 제 2 복수의 프레임들에 대한 전력 제어 명령들을 생성하는 단계 ― 상기 제 2 프레임들은 후속 처리를 위해 전송을 위한 배치로 그룹화됨 ―를 포함하고,
    상기 전력 제어 명령들을 생성하는 단계는, 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 m개의 "0"값 전력 제어 비트들과 n개의 "1"값 전력 제어 비트들을 생성하는 단계를 포함하며, m과 n은, 만약 2-비트 러닝 히스토리가 "01" 및 "10" 중 선택된 하나와 동일하면, 많아야 1만큼 상이하고, m과 n은 정수들인, 기계 판독가능한 매체.
  38. 실행될 때 하기의 방법을 수행하는 저장된 기계 수행가능한 지시들을 포함하는 기계 판독가능한 매체로서, 상기 방법은:
    채널의 제 1 링크를 통해 제 1 복수의 프레임들 ― 상기 제 1 프레임들 각각은 전력 제어 지시를 포함함 ― 의 수신하고, 배치 형태로의 처리를 위해 상기 제 1 프레임들을 그룹화하며, 상기 제 1 프레임의 각각에 포함된 전력 제어 지시를 출력하는 것을 포함하는 게이트웨이를 에뮬레이팅하는 단계; 및
    상기 제 1 프레임들을 배치로 처리하고, 상기 제 1 프레임들의 전력 제어 지시들을 수신하고, 상기 채널의 제 2 링크에 대한 제 2 복수의 프레임들 ― 상기 제 2 복수의 프레임들은 배치로 처리되기 이전에 배칭됨 ― 을 생성하고,
    상기 제 1 프레임들에 포함된 전력 제어 지시들의 러닝 히스토리를, 미리 결정된 길이까지 유지하고, 그리고
    인입하는 전력 제어 지시들에 대한 응답의 저하를 실시하는 방식으로, 상기 유지되는 러닝 히스토리에 적어도 일부 기초하여, 상기 제 2 프레임들에 대한 전력 제어 명령들을 생성하기 위해 게이트웨이 시뮬레이터를 에뮬레이팅하는 단계를 포함하고,
    상기 전력 제어 명령들을 생성하는 것은, 상기 제 2 프레임들의 서브세트로써 형성되는 각각의 배치에 대하여 m개의 "0"값 전력 제어 비트들과 n개의 "1"값 전력 제어 비트들을 생성하는 것을 포함하며, m과 n은, 만약 2-비트 러닝 히스토리가 "01" 및 "10" 중 선택된 하나와 동일하면, 많아야 1만큼 상이하고, m과 n은 정수들인, 기계 판독가능한 매체.
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