KR100894393B1 - A Layout Method for Mask and A Semiconductor Device - Google Patents
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Abstract
실시예에 따른 반도체 소자는 제1 거리(spacing)를 두고 형성된 복수의 제1 더미 패턴들을 포함하는 제1 군의 더미 패턴; 상기 제1 거리를 두고 형성된 복수의 제2 더미 패턴들을 포함하면서, 상기 제1 군의 더미 패턴으로부터 제2 거리에 형성된 제2 군의 더미 패턴; 및 상기 제1 군의 더미 패턴으로부터 제3 거리에 형성된 메인 패턴;을 포함하는 것을 특징으로 한다.In example embodiments, a semiconductor device may include a first group of dummy patterns including a plurality of first dummy patterns formed at a first spacing; A dummy pattern of a second group formed at a second distance from the dummy pattern of the first group while including a plurality of second dummy patterns formed at the first distance; And a main pattern formed at a third distance from the dummy pattern of the first group.
더미 패턴, 마스크, 반도체소자 Dummy patterns, masks, semiconductor devices
Description
도 1은 실시예에 따른 반도체소자의 평면도.1 is a plan view of a semiconductor device according to an embodiment.
도 2a 내지 도 2g는 제1 실시예에 따른 마스크의 설계방법의 개념도.2A to 2G are conceptual views of a method of designing a mask according to the first embodiment.
도 3a 내지 도 3d는 제2 실시예에 따른 마스크의 설계방법의 개념도.3A to 3D are conceptual views of a method of designing a mask according to a second embodiment.
실시예는 마스크의 설계방법 및 반도체소자에 관한 것이다.The embodiment relates to a method of designing a mask and a semiconductor device.
반도체소자는 일반적으로 다층구조를 이루고 있으며, 이러한 다층구조의 각층은 스퍼터링, 화학기상증착 등의 방법에 의해 형성되고, 리소그라피 공정을 거쳐 패터닝된다.Semiconductor devices generally have a multilayer structure, and each layer of the multilayer structure is formed by a method such as sputtering, chemical vapor deposition, or the like and patterned through a lithography process.
그런데, 반도체 소자의 기판상에서의 패턴의 크기, 패턴 밀도 등의 차이에 의해 여러 문제가 발생하는 경우가 있어 더미 패턴(Dummy Pattern)을 메인 패턴(Main Pattern)과 함께 형성하는 기술이 발전하여 왔다.By the way, various problems may arise by the difference of the pattern size, pattern density, etc. on the board | substrate of a semiconductor element, and the technique which forms the dummy pattern with a main pattern has developed.
실시예는 패턴의 균일성을 확보할 수 있는 마스크의 설계방법 및 반도체소자 를 제공하고자 한다.The embodiment provides a method of designing a mask and a semiconductor device capable of securing pattern uniformity.
또한, 실시예는 패턴의 밀도를 높일 수 있는 마스크의 설계방법 및 반도체소자를 제공하고자 한다.In addition, the embodiment is to provide a mask design method and a semiconductor device that can increase the density of the pattern.
또한, 실시예는 새로운 형태의 모양을 지닌 더미 패턴(Dummy Pattern)의 마스크의 설계방법을 제공하고자 한다.In addition, the embodiment is to provide a method of designing a mask of a dummy pattern (Dummy Pattern) having a new shape.
또한, 실시예는 설계공정 및 제조공정을 단순화할 수 있는 마스크의 설계방법을 제공하고자 한다.In addition, the embodiment is to provide a mask design method that can simplify the design process and manufacturing process.
실시예에 따른 반도체 소자는 제1 거리(spacing)를 두고 형성된 복수의 제1 더미 패턴들을 포함하는 제1 군의 더미 패턴; 상기 제1 거리를 두고 형성된 복수의 제2 더미 패턴들을 포함하면서, 상기 제1 군의 더미 패턴으로부터 제2 거리에 형성된 제2 군의 더미 패턴; 및 상기 제1 군의 더미 패턴으로부터 제3 거리에 형성된 메인 패턴;을 포함하는 것을 특징으로 한다.In example embodiments, a semiconductor device may include a first group of dummy patterns including a plurality of first dummy patterns formed at a first spacing; A dummy pattern of a second group formed at a second distance from the dummy pattern of the first group while including a plurality of second dummy patterns formed at the first distance; And a main pattern formed at a third distance from the dummy pattern of the first group.
또한, 실시예에 따른 마스크 설계방법은 제3 거리의 폭과 높이를 가진 제1 모(母) 더미 패턴을 형성하는 단계; 상기 제1 모(母) 더미 패턴을 제1 거리의 폭과 높이의 제13 패턴으로 축소하는 단계; 상기 제13 패턴을 수평방향의 폭은 고정하고, 상기 제1 모 더미 패턴의 폭인 제3 거리의 높이로 수직확장하여 제14 패턴을 형성하는 단계; 제5 거리의 폭과 높이의 제15 패턴을 형성하는 단계; 상기 제15 패턴을 수평방향의 폭은 고정하고, 상기 제1 모 더미 패턴의 폭인 제3 거리의 높이로 수직확장하여 제16 패턴을 형성하는 단계; 상기 제14 패턴과 상기 제16 패턴을 합 성하여 제11 패턴을 형성하는 단계; 및 상기 제11 패턴과 상기 제1 모 더미 패턴과 겹치는 부분(interact)을 제거하여 제1 군의 더미 패턴을 형성하는 단계;를 포함하는 것을 특징으로 한다.In addition, the mask design method according to the embodiment comprises the steps of forming a first dummy pattern having a width and a height of the third distance; Reducing the first dummy pattern to a thirteenth pattern having a width and a height of a first distance; Fixing the thirteenth pattern to a horizontal width and vertically extending the thirteenth pattern to a height of a third distance, which is a width of the first dummy pattern, to form a fourteenth pattern; Forming a fifteenth pattern of width and height of the fifth distance; Fixing the fifteenth pattern in a horizontal direction and vertically extending the fifteenth pattern to a height of a third distance that is a width of the first dummy pattern to form a sixteenth pattern; Combining the fourteenth pattern and the sixteenth pattern to form an eleventh pattern; And forming a first group of dummy patterns by removing an interaction between the eleventh pattern and the first dummy pattern.
또한, 실시예에 따른 마스크 설계방법은 제1 더미 패턴을 제1 방향으로 P거리만큼 거리를 두고 제2 더미 패턴을 어레이 하는 단계; 상기 어레이 된 모든 제1 더미 패턴 및 상기 제2 더미 패턴을 선택하여 복사하고, 상기 제1 방향으로 Q거리 만큼 이동하여 어레이 함으로써 복사된 제1 더미 패턴 및 복사된 제2 더미 패턴을 형성하는 단계; 및 상기 제1 더미 패턴, 복사된 제1 더미 패턴, 제2 더미 패턴, 복사된 제2 더미패턴을 어레이 하여 더미 패턴을 삽입하는 단계;를 포함하는 것을 특징으로 한다.In addition, the mask design method according to the embodiment comprises the steps of arranging the second dummy pattern at a distance of the first dummy pattern in the first direction by a P distance; Selecting and copying all of the arrayed first dummy patterns and the second dummy patterns, and moving the arrays by Q distance in the first direction to form the copied first dummy patterns and the copied second dummy patterns; And inserting a dummy pattern by arranging the first dummy pattern, the copied first dummy pattern, the second dummy pattern, and the copied second dummy pattern.
상기와 같은 실시예에 의하면 패턴의 균일성을 확보할 수 있는 마스크의 설계방법 및 반도체소자를 제공할 수 있고, 새로운 형태의 모양을 지닌 더미 패턴(Dummy Pattern)의 마스크의 설계방법 및 반도체소자를 제공할 수 있고, 각 패턴의 CD(Critical Diameter)의 일정화를 얻을 수 있으며, 설계공정 및 제조공정을 단순화할 수 있는 마스크의 설계방법을 제공할 수 있는 장점이 있다.According to the embodiment as described above it is possible to provide a mask design method and a semiconductor device that can ensure the uniformity of the pattern, a method of designing a mask of a dummy pattern (Dummy Pattern) having a new shape and a semiconductor device It is possible to provide, to obtain the CD (Critical Diameter) of each pattern can be obtained, there is an advantage that can provide a mask design method that can simplify the design process and manufacturing process.
이하, 실시예를 첨부된 도면을 참조하여 상세히 설명한다.Hereinafter, embodiments will be described in detail with reference to the accompanying drawings.
아래 실시예를 설명함에 있어서 설계공정의 순서는 일 예에 불과하며 다양한 방법의 조합에 의해 진행되는 공정은 하기 된 청구항의 권리범위에 속한다.In describing the following embodiments, the order of the design process is only one example, and the process carried out by a combination of various methods is within the scope of the claims.
도 1은 실시예에 따른 반도체소자의 평면도이다.1 is a plan view of a semiconductor device according to an embodiment.
실시예에 따른 반도체소자는 제1 거리(spacing)(A)를 두고 형성된 복수의 제 1 더미 패턴(622)들을 포함하는 제1 군의 더미 패턴(620); 상기 제1 거리(A)를 두고 형성된 복수의 제2 더미 패턴(632)들을 포함하면서, 상기 제1 군의 더미 패턴(620)으로부터 제2 거리(B)에 형성된 제2 군의 더미 패턴(630); 및 상기 제1 군의 더미 패턴(620)으로부터 제3 거리(D)에 형성된 메인 패턴(650);을 포함하는 것을 특징으로 한다.In an embodiment, a semiconductor device may include a first group of
도 1에 도시된 실시예(600)는 제1 거리(spacing)(A)를 두고 형성된 복수의 제1 더미 패턴(622)과 상기 제1 더미 패턴(622)으로부터 제5 거리(E)에 형성된 제5 더미 패턴(625)을 포함하는 제1 군의 더미 패턴(620) 및 제1 거리(A)를 두고 형성된 복수의 제2 더미 패턴(632)들과 상기 제2 더미 패턴(622)으로부터 제5 거리(E)에 형성된 제6 더미 패턴(635)을 포함하면서, 상기 제1 군의 더미 패턴(620)으로부터 제2 거리(B)에 형성된 제2 군의 더미 패턴(630)을 포함하는 것을 특징으로 한다.1 illustrates a plurality of
도 1은 제1 군의 더미 패턴(620)과 상기 제2 군의 더미 패턴(630)이 각각 4개씩 형성된 예이며, 본 발명이 이에 한정되는 것은 아니다.1 illustrates an example in which the
실시예는 제1 군의 더미 패턴(620)을 구성하는 더미 패턴들이 서로 다른 거리에 위치한 점에 특징이 있다. 이는 제2 군의 더미 패턴(630)도 마찬가지이다.The embodiment is characterized in that the dummy patterns constituting the first group of
즉, 실시예에서 제1 군의 더미 패턴(620)은 제1 거리(spacing)(A)를 두고 형성된 복수의 제1 더미 패턴(622)과 상기 제1 더미 패턴(622)으로부터 제5 거리(E)에 형성된 제5 더미 패턴(625)을 포함할 수 있다.That is, in the exemplary embodiment, the
상기 제1 더미 패턴(622) 사이의 제1 거리(A)와 제1 더미 패턴(622)으로부터 제5 거리(E)는 반도체제조 공정상 패턴 간 최소 간격(Minimum Spacing) 이상의 거리일 수 있다.The first distance A between the
이때, 실시예에서 상기 제1 거리(A)가 상기 제5 거리(E)에 비해 길 수 있으나 이에 한정되는 것은 아니다. 즉, 상기 제1 거리(A)가 상기 제5 거리(E)에 비해 짧을 수도 있다.In this embodiment, the first distance A may be longer than the fifth distance E, but is not limited thereto. That is, the first distance A may be shorter than the fifth distance E. FIG.
또한, 실시예에서는 상기 제1 거리(A)가 상기 제5 거리(E)와 다른 경우를 예로 들고 있으나, 이에 한정되지 않으며 상기 제1 거리(A)가 상기 제5 거리(E)와 같을 수도 있다.Further, in the embodiment, the case where the first distance A is different from the fifth distance E is taken as an example, but the present invention is not limited thereto, and the first distance A may be equal to the fifth distance E. have.
실시예에서 상기 제1 군의 더미 패턴(620)과 상기 제2 군의 더미 패턴(630)은 액티브 레이어(Active layer) 패턴, 메탈 패턴(Metal pattern), 폴리 레이어(Poly Layer) 패턴 등과 같이 같은 기능을 하는 레이어(layer) 패턴일 수 있다.In an embodiment, the
실시예에서 상기 제1 더미 패턴(622)들은 2n개(단, n=정수)로 형성될 수 있다.In an embodiment, the
실시예에서, 상기 제1 더미 패턴(622), 제5 더미패턴(625), 제2 더미 패턴(632), 제6 더미패턴(635)들은 같은 모양, 예를 들어 직사각형으로 형성될 수 있으나 이에 한정되는 것은 아니다.In an embodiment, the
또한, 실시예에서 상기 제1 더미 패턴(622), 제5 더미패턴(625), 제2 더미 패턴(632), 제6 더미패턴(635)들은 같은 크기를 가질 수 있다. 상기 더미 패턴들이 같은 모양에 같은 크기를 가지는 경우 더미 패턴의 디자인과 반도체제조공정의 신속 정확성을 도모할 수 있고, 나아가 패턴의 균일성과 패턴밀도의 극대화를 도모할 수 있다.In an embodiment, the
상기 제1 더미 패턴(622)은 직사각형인 경우 상기 제1 더미 패턴(622)의 가로의 폭(X)와 세로의 폭(Y)은 서로 다르며, 가로의 폭(X)이 세로의 폭(Y)보다 길거나 짧을 수 있다.When the
상기 제1 더미 패턴(622)의 폭(With)은 반도체제조 공정상 패턴의 최소 선폭(Minimum Width) 또는 최소 크기(Minimum Width) 이상일 수 있다.The width With of the
(제1 실시예)(First embodiment)
이하, 도 2a 내지 도 2g를 참조하여 제1 실시예에 따른 마스크 설계방법을 설명한다.Hereinafter, the mask designing method according to the first embodiment will be described with reference to FIGS. 2A to 2G.
우선, 도 2a와 같이 제3 거리(C)의 폭과 높이를 가진 제1 모(母) 더미 패턴(621)을 형성한다.First, as shown in FIG. 2A, a
다음으로, 도 2b와 같이 제3 거리(C)의 폭과 높이를 가진 제1 모(母) 더미 패턴(621)을 제1 거리(A)와 같은 폭과 높이의 제13 패턴(624)으로 축소한다.Next, as shown in FIG. 2B, the
다음으로, 도 2c와 같이 상기 제13 패턴(624)을 수평방향의 폭(A)은 고정하고, 상기 제1 모 더미 패턴(621)의 폭(C)인 제3 거리(C)의 높이로 수직확장하여 제14 패턴(625)을 형성한다.Next, as shown in FIG. 2C, the horizontal width A of the
예를 들어, 상기 제13 패턴(624)에 대해 수평으로는 고정하되 수직으로 상기 제1 모 더미 패턴(621)의 폭(C)이 될 때까지 수직으로 확장하여 제14 패턴(625)을 형성할 수 있다.For example, the
다음으로, 도 2d와 같이 제3 거리(C)의 폭과 높이를 가진 제1 모(母) 더미 패턴(621)을 제5 거리(E)와 같은 폭과 높이의 제15 패턴(623)으로 축소한다.Next, as shown in FIG. 2D, the
또한, 다른 실시예로 상기 제15 패턴(623)을 형성하기 위해 상기 제13 패턴(624)을 제5 거리(E)의 폭과 높이의 제15 패턴(623)으로 확장 또는 축소하여 형성할 수도 있다.In another embodiment, the
다음으로, 도 2e와 같이 상기 제15 패턴(623)을 수평방향의 폭(E)은 고정하고, 상기 제1 모 더미 패턴(621)의 폭(C)인 제3 거리(C)의 높이로 수직확장하여 제16 패턴(626)을 형성한다.Next, as shown in FIG. 2E, the horizontal width E of the
예를 들어, 상기 제15 패턴(623)에 대해 수평으로는 고정하되 수직으로 상기 제1 모 더미 패턴(621)의 폭(C)이 될 때까지 수직으로 확장하여 제16 패턴(626)을 형성할 수 있다.For example, the
다음으로, 도 2f와 같이 상기 제14 패턴(625)과 상기 제16 패턴(626)을 합성하여 제11 패턴(629)을 형성한다.Next, as shown in FIG. 2F, the
이때, 상기 제11 패턴(629)을 형성하는 경우 상기 제14 패턴(625)과 상기 제16 패턴(626)을 논리합 하여 제11 패턴(629)을 형성할 수 있다. 즉, 상기 제14 패턴(625)과 상기 제16 패턴(626)이 어느 하나라도 존재하는 영역에는 패턴이 존재하도록 한다.In this case, when the
다음으로, 2g와 같이 상기 제11 패턴(629)과 상기 제1 모 더미 패턴(621)과 겹치는 부분(interact)을 제거하여 제1 군의 더미 패턴(620)을 형성할 수 있다.Next, as illustrated in FIG. 2G, the first
상기 제1 군의 더미 패턴(620)을 형성하는 방법은 하나의 예일 뿐이며, 상기 실시예의 다른 방법으로는 상기 제14 패턴(625)과 상기 제16 패턴(626)이 상기 제1 모 더미 패턴(621)과 겹치는 부분(interact)을 제거하고, 잔존하는 부분을 논리 곱하여 제1 군의 더미 패턴(620)을 형성할 수도 있다.The method of forming the
(제2 실시예)(2nd Example)
도 3a 내지 도 3d를 참조하여 제2 실시예에 따른 마스크의 설계방법을 설명한다.A method of designing a mask according to a second embodiment will be described with reference to FIGS. 3A to 3D.
제2 실시예에 따른 마스크의 설계방법은 상기 제1 실시예와 달리 더미 패턴을 형성함에 있어서 슬라이싱 개념보다는 배열(array) 개념을 도입한 것이다.The mask designing method according to the second embodiment introduces an array concept rather than a slicing concept in forming a dummy pattern unlike the first embodiment.
우선, 도 3a와 같이 제1 더미 패턴(622)을 제1 방향으로 P거리만큼 거리를 두고 제2 더미 패턴(632)을 어레이 한다.First, as shown in FIG. 3A, the
이때, 상기 제1 방향과 수직방향으로 역시 P거리만큼 거리를 두고 어레이될 수 있다.At this time, it may be arrayed at a distance P distance in the direction perpendicular to the first direction.
다음으로, 도 3b와 같이 상기 도 3a에서 어레이된 모든 제1 더미 패턴(622) 및 상기 제2 더미 패턴(632)을 선택하여 복사하고, 상기 제1 방향으로 Q거리 만큼 이동하여 어레이 함으로써 복사된 제1 더미 패턴(622a) 및 복사된 제2 더미 패턴(632a)을 형성할 수 있다.Next, as shown in FIG. 3B, all the
다음으로, 도 3c와 같이 상기 도 3a에서 어레이된 모든 제1 더미 패턴(622) 및 상기 제2 더미 패턴(632)을 선택하여 복사하고, 상기 제1 방향의 수직방향으로 R거리 만큼 이동하여 어레이 함으로써 제5 더미 패턴(625) 및 제6 더미 패턴(635)을 형성할 수 있다.Next, as shown in FIG. 3C, all the
다음으로, 도 3d와 같이 상기 도 3c에서 어레이된 제5 더미 패턴(625) 및 제 6 더미 패턴(635)을 선택하여 복사하고, 상기 제1 방향으로 Q거리 만큼 이동하여 어레이 함으로써 복사된 제5 더미 패턴(625a) 및 복사된 제6 더미 패턴(635a)을 형성함으로써 제2 실시예에 따른 마스크 설계를 진행할 수 있다.Next, as illustrated in FIG. 3D, the
한편, 또 다른 실시예로 상기 도 3b에서 어레이된 모든 제1 더미 패턴(622, 622a) 및 상기 제2 더미 패턴(632,632a)을 선택하여 복사하고, 상기 제1 방향의 수직방향으로 R거리 만큼 이동하여 어레이 함으로써 제5 더미 패턴(625,625a) 및 제6 더미 패턴(635, 635a)을 한번에 형성할 수도 있다.Meanwhile, in another embodiment, all the
제2 실시예에 따른 마스크의 설계방법에 의하면, 어레이에 의한 새로운 개념의 마스크 설계방법을 제공할 수 있다.According to the mask designing method according to the second embodiment, it is possible to provide a mask designing method of a new concept using an array.
또한, 제2 실시예에 의하면 어레이에 의한 마스크 설계방법을 채용함으로써 더미 패턴을 설계를 위한 데이터 부담을 최소한으로 할 수 있는 효과가 있다.In addition, according to the second embodiment, by employing a mask design method using an array, the data burden for designing a dummy pattern can be minimized.
본 발명은 전술한 실시예 및 도면에 의해 한정되는 것이 아니고, 하기 된 청구항의 권리범위에 속하는 범위 안에서 다양한 다른 실시예가 가능하다.The present invention is not limited by the above-described embodiments and drawings, and various other embodiments are possible within the scope of the claims.
이상에서 설명한 바와 같이 실시예에 따른 반도체소자 및 마스크의 설계방법에 의하면 같은 모양과 같은 크기를 가진 더미 패턴들을 형성함으로써 패턴의 균일성을 이룰 수 있다.As described above, according to the method of designing the semiconductor device and the mask according to the embodiment, the pattern uniformity may be achieved by forming dummy patterns having the same shape and the same size.
또한, 실시예에 의하면 모양과 크기가 같은 더미 패턴을 채용함으로써 더미 패턴을 설계를 위한 데이터 부담을 최소한으로 할 수 있는 효과가 있다.In addition, according to the embodiment, by employing a dummy pattern having the same shape and size, there is an effect of minimizing the data burden for designing the dummy pattern.
또한, 실시예에 의하면 패턴의 균일성 확보에 따라 각 패턴의 CD(Critical Diameter)의 일정화를 얻을 수 있다.In addition, according to the embodiment, it is possible to obtain a constant of the CD (Critical Diameter) of each pattern as the pattern is secured.
또한, 실시예에 의하면 같은 모양과 같은 크기를 지니는 새로운 형태의 모양을 지닌 더미 패턴이 형성된 반도체소자를 제공할 수 있다.In addition, according to the embodiment, it is possible to provide a semiconductor device in which a dummy pattern having a new shape having the same shape and the same size is formed.
또한, 실시예는 같은 모양과 같은 크기를 지니는 새로운 형태의 모양을 지닌 더미 패턴으로 인해 설계공정 및 제조공정을 단순화할 수 있는 더미 패턴을 포함하는 반도체소자를 제공할 수 있다.In addition, the embodiment can provide a semiconductor device including a dummy pattern that can simplify the design process and manufacturing process due to the dummy pattern having a new shape having the same shape and the same size.
Claims (15)
Priority Applications (5)
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