KR100778336B1 - 동일채널 중계기의 시간 지연을 줄이기 위한 전치등화 장치및 그 방법 - Google Patents

동일채널 중계기의 시간 지연을 줄이기 위한 전치등화 장치및 그 방법 Download PDF

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Abstract

1. 청구범위에 기재된 발명이 속한 기술분야
본 발명은 동일채널 중계기의 시간 지연을 줄이기 위한 전치등화 장치 및 그 방법에 관한 것임.
2. 발명이 해결하려고 하는 기술적 과제
본 발명은 업샘플링 과정 이후에 전치등화 필터 계수와 기 주어진 필터 계수로부터 수정된 필터 계수를 생성하여 상기 업샘플링된 신호를 필터링함으로써, 시간 지연을 줄이는 동일채널 중계기의 전치등화 장치 및 그 방법을 제공하는데 그 목적이 있음.
3. 발명의 해결방법의 요지
본 발명은, 신호를 동일 채널로 중계하는 동일 채널 중계기의 전치등화 장치로서, 입력된 필드(Field) 및 세그먼트(Segment) 동기 신호를 조합하여 기저대역 신호를 구성하는 기저대역 신호 구성수단; 상기 구성된 신호에 파일롯 신호를 삽입하는 파일롯 삽입수단; 상기 파일롯 신호가 삽입된 신호를 업샘플링하는 업샘플링수단; 전치등화 필터의 계수를 생성하는 전치등화 필터 계수 생성수단; 상기 전치등화 필터 계수와 기 주어진 필터의 계수를 이용하여 수정된 필터의 계수를 생성하는 수정 필터 계수 생성수단; 및 상기 업샘플링된 신호를 상기 수정된 필터 계수를 이용하여 필터링하는 필터링수단을 포함함.
4. 발명의 중요한 용도
본 발명은 디지털 TV 방송 시스템을 포함한 임의의 전송 시스템에서 동일채널 중계망을 구성하기 위해 이용됨.
동일 채널, 중계기, 변조, 전치 등화

Description

동일채널 중계기의 시간 지연을 줄이기 위한 전치등화 장치 및 그 방법{Apparatus and Method of pre-equalization to reduce time delay of on-channel repeater}
도 1은 기존의 중계기를 이용한 서비스를 나타낸 일실시예 설명도,
도 2는 동일채널 중계기를 이용한 서비스를 나타낸 일실시예 설명도,
도 3은 동일채널 중계기의 내부 구성도,
도 4는 동일채널 중계기에 포함된 변조 장치의 구성도,
도 5는 본 발명에 따른 동일채널 중계기의 전치등화 장치의 일실시예 구성도,
도 6은 수정 필터계수 생성부에서의 필터 계수 생성 과정을 설명하는 일실시예 도면,
도 7은 본 발명에 따른 동일채널 중계기의 전치등화 방법을 설명하는 일실시예 흐름도이다.
* 도면의 주요 부분에 대한 설명 *
501 : 기저대역 신호 구성부 502 : 파일롯 삽입부
503 : 업샘플링부 504 : 전치등화 필터계수 생성부
505 : 수정 필터계수 생성부 506 : 필터링부
507 : IF 상향 변환부 508 : 가산부
509 : 디지털-아날로그 변환부
본 발명은 동일채널 중계기에 관한 것으로, 보다 상세하게는 동일채널 중계기의 전치등화 과정에서 사용되는 필터에 의해 야기되는 시간 지연을 줄이기 위한 동일채널 중계기의 전치등화 장치 및 그 방법에 관한 것이다.
일반적으로, 방송 서비스를 위해서는 주변 지형/지물에 따라 그리고 방송사의 방송 구역에 따라 주송신기 및 중계기를 배치한다. 중계기는 주송신기의 방송 신호가 약하게 수신되는 지역에 설치되어 난시청 지역을 해소하고 주송신기 신호의 전송 영역을 넓히는 역할을 한다.
도 1은 기존의 중계기를 이용한 서비스를 나타낸 일실시예 설명도로서, 중계기가 서로 다른 주파수를 사용하여 중계하는 방식을 나타낸다.
도 1에 도시된 바와 같이, 기존의 중계기를 이용한 서비스는, 먼저 주송신기(101)에서는 송신주파수 A를 통해 신호를 송출하고, 각각의 중계기(102~105)에서는 송신주파수 A와 다른 주파수(B, C, D, E)로 신호를 중계한다. 그러나, 도 1과 같은 중계기는 각각의 중계기(102~105)마다 다른 주파수(B, C, D, E)를 부여하여 주송신기(101) 신호의 난시청 지역을 해소하거나 서비스 구역을 증가시키고 있으므로, 각각의 중계기(102~105)가 복수개의 주파수 대역을 사용하게 되고, 많은 주파수 자원이 필요하게 되므로 주파수 이용 관점에서는 상당히 비효율적이다.
도 2는 동일채널 중계기를 이용한 서비스를 나타낸 일실시예 설명도로서, 중계기가 같은 주파수로 신호를 중계하는 방식을 나타낸다. 즉, 주송신기(201)에서는 송신주파수 A로 신호를 송출하고, 각각의 중계기(202~205)에서는 송신주파수 A와 같은 주파수로 신호를 중계한다.
도 2와 같은 서비스를 위한 동일채널 중계기는 박성익 등에 의해 "지상파 디지털 텔레비젼 방송신호를 위한 동일채널 중계 장치 및 그 방법"이라는 명칭으로 2003년 5월 20일 출원번호 "2003-0032007"으로 출원되었다.
도 3은 동일채널 중계기의 내부 구성도로서, 도 3을 참조하여 동일채널 중계기의 동작을 설명하면 다음과 같다.
도 3에 도시된 동일채널 중계기는 수신안테나(301), RF 수신부(302), IF 하향 변환부(303), 복조부(304), 등화부(305), 변조부(306), RF 상향 변환부(307), 고전력 증폭부(308), 송신안테나(309)를 포함한다.
RF 수신부(302)는 주송신기 또는 다른 중계기로부터 송신된 RF 신호를 수신안테나(301)를 통해 수신하고, IF 하향 변환부(303)는 상기 수신된 RF 신호를 IF 신호로 주파수 하향 변환한다.
복조부(304)는 상기 주파수 하향 변환된 IF 신호를 기저대역 신호로 복조하 고, 등화부(305)는 상기 복조된 기저대역 신호를 등화하여 전송 채널상에서 발생한 신호 왜곡을 보상하고, 동일채널 중계기의 송수신안테나의 낮은 격리로 인해 야기된 피드백 신호를 제거한다.
변조부(306)는 상기 채널 왜곡이 보상된 기저대역 신호를 IF 신호로 변조하고, RF 상향 변환부(307)는 상기 변조된 IF 신호를 RF 신호로 주파수 상향 변환한다. 그리고, 고전력 증폭부(308)는 상기 주파수 상향 변환된 RF 신호를 증폭하고 송신안테나(309)를 통해 RF 신호를 송신한다.
도 3의 동일채널 중계기를 이용한 방송 서비스가 가능하기 위해서는 동일 주파수 대역을 사용하는 주송신기 및 동일채널 중계기로부터 전송되는 신호를 수신기가 식별해 낼 수 있어야 한다. 일반적으로 수신기에는 등화기라고 하는 다중경로 신호를 제거하는 장치가 있다. 이러한 등화기는 동일한 주파수 대역에서 원하는 신호 외에 시간적으로 지연되어 입력되는 신호를 제거할 수 있다.
그러나 주송신기와 동일채널 중계기로부터 전송되는 각각의 신호가 수신기 등화기의 다중경로 신호제거 능력을 벗어나는 시간적 지연을 갖게 되면 수신기 등화기는 지연된 신호를 제거하지 못한다.
따라서 동일채널 중계기를 통한 방송 서비스를 위해서는 수신기에서 수신되는 동일채널 중계기의 출력신호와 주송신기의 출력신호의 시간 차이가 작아야 한다는 전제 조건이 필요하다. 즉, 동일채널 중계기의 시간 지연을 최대한 줄여야 한다.
또한, 일반적으로 도 3에 도시된 바와 같은 동일채널 중계기에는 송신단에 마스크 필터를 포함하는데, 마스트 필터는 대역외 방사를 막기 위해 많은 선형 왜곡을 가지게 되며, 이러한 왜곡은 송신신호의 품질을 떨어뜨려 중계기의 방송구역을 줄이는 결과를 가져오게 된다.
따라서 전치 등화 방법을 이용하여 변조부 이후에 존재하는 RF 상향 변환부, 고전력 증폭부 및 마스크 필터에 의한 선형 왜곡을 보상하여 방송신호 품질을 높여 송출해야 한다. 이러한 전치 등화는 도 3에 도시된 동일채널 중계기의 변조부에 포함되는 형태로 구성되는 것이 일반적이다.
동일채널 중계기에서 사용되는 변조기는 박성익 등에 의해 "지상파 디지털 텔레비전 방송 시스템에서 동일채널 중계기의 시간지연을 줄이기 위한 변조 장치 및 그 방법"이라는 명칭으로 2003년 10월 29일 출원번호 "2003-0076097"으로 출원되었다.
도 4는 동일채널 중계기에 포함된 변조 장치의 구성도로서, 도 4에 도시된 바와 같이 동일채널 중계기의 변조 장치는, 필드(Field) 및 세그먼트 동기(Segment Sync) 신호를 조합하여 기저대역 신호를 구성하는 기저대역 신호 구성부(401), 상기 구성된 기저대역 신호에 파일롯 신호를 삽입하는 파일롯 삽입부(402), 상기 파일롯 신호가 삽입된 신호를 전치등화 필터계수 생성부(403)에 의해 생성된 전치등화 필터로 필터링하는 전치등화 필터링부(404), 상기 전치등화 필터링된 기저대역 신호를 업샘플링하는 업샘플링부(405), 상기 업샘플링된 기저대역 신호를 I(In-phase) 및 Q(Quadrature) 신호로 변환하고 펄스성형 필터를 통해 필터링하는 필터링부(406), 상기 필터링된 기저대역 I 및 Q 신호를 IF 대역의 I 및 Q 신호로 주파 수 상향 변환하는 IF 상향 변환부(407), 상기 주파수 상향 변환된 IF 대역의 I 및 Q 신호를 더하는 가산부(408) 및 디지털 IF 신호를 아날로그 IF 신호로 변환하는 디지털-아날로그 변환부(DAC, 409)를 포함한다.
그러나 도 3과 같은 동일채널 중계기에 도 4와 같은 기존의 전치 등화 방법이 적용된 변조기를 사용하면 전치등화 필터 자체에 의한 시간 지연이 크게 존재하므로, 동일채널 중계기의 시간지연을 더 크게 해서 상용 수신기의 등화 능력을 떨어뜨린다.
도 4에 도시된 전치등화 필터링부 및 필터링부에 의한 시간 지연을 계산하면 다음과 같다.
전치등화 필터계수 생성부(403)에 의해 생성된 전치등화 필터는 심볼율(symbol rate)에서 동작하는 필터로서, 전체 탭 수가 (C1 + D1 + 1)이며 메인 탭은 앞쪽에서 (C1 + 1)의 위치에 존재한다. 따라서 전치등화 필터링부(404)에 의한 시간 지연은 C1 심볼 시간이 된다.
그리고, 필터링부(406)에 있는 I 필터와 Q 필터 각각의 탭 수는 (C2 + D2 + 1)이며 메인 탭은 앞쪽에서 (C2 + 1)의 위치에 존재한다. 업샘플링부(405)의 업샘플링율이 K 라고 하면, 업샘플링율 K에서 동작하는 필터링부(406)에 의한 시간 지연은 C2/K 의 심볼 시간이 된다.
따라서 기존의 전치등화 방법을 적용한 변조부는 C1 + C2/K 의 심볼 시간 지연을 갖게 되어, 전치등화를 적용함에 따라 C1 심볼 시간만큼 동일채널 중계기의 시간 지연이 증가하게 된다.
따라서 수신기에서 수신되는 동일채널 중계기의 출력신호와 주송신기의 출력신호의 시간 차이가 적은, 즉 동일채널 중계기의 시간 지연을 줄이는 전치등화 방법 및 장치의 개발이 절실히 요구된다.
본 발명은 상기한 바와 같은 요구에 부응하기 위하여 제안된 것으로, 업샘플링 과정 이후에 전치등화 필터 계수와 기 주어진 필터 계수로부터 수정된 필터 계수를 생성하여 상기 업샘플링된 신호를 필터링함으로써, 시간 지연을 줄이는 동일채널 중계기의 전치등화 장치 및 그 방법을 제공하는데 그 목적이 있다.
본 발명의 다른 목적 및 장점들은 하기의 설명에 의해서 이해될 수 있으며, 본 발명의 실시예에 의해 보다 분명하게 알게 될 것이다. 또한, 본 발명의 목적 및 장점들은 특허 청구 범위에 나타낸 수단 및 그 조합에 의해 실현될 수 있음을 쉽게 알 수 있을 것이다.
상기와 같은 목적을 달성하기 위한 본 발명은, 신호를 동일 채널로 중계하는 동일채널 중계기의 전치등화 장치로서, 입력된 필드(Field) 및 세그먼트(Segment) 동기 신호를 조합하여 기저대역 신호를 구성하는 기저대역 신호 구성수단; 상기 구성된 신호에 파일롯 신호를 삽입하는 파일롯 삽입수단; 상기 파일롯 신호가 삽입된 신호를 업샘플링하는 업샘플링수단; 전치등화 필터의 계수를 생성하는 전치등화 필 터 계수 생성수단; 상기 전치등화 필터 계수와 기 주어진 필터의 계수를 이용하여 수정된 필터의 계수를 생성하는 수정 필터 계수 생성수단; 및 상기 업샘플링된 신호를 상기 수정된 필터 계수를 이용하여 필터링하는 필터링수단을 포함하는 것을 특징으로 한다.
또한, 본 발명은, 신호를 동일 채널로 중계하는 동일채널 중계기의 전치등화 방법으로서, 입력된 필드(Field) 및 세그먼트(Segment) 동기 신호를 조합하여 기저대역 신호를 구성하는 기저대역 신호 구성단계; 구성된 신호에 파일롯 신호를 삽입하는 파일롯 삽입단계; 파일롯 신호가 삽입된 신호를 업샘플링하는 업샘플링단계; 전치등화 필터의 계수를 생성하는 전치등화 필터 계수 생성단계; 생성된 전치등화 필터 계수와 기 주어진 필터의 계수를 이용하여 수정된 필터의 계수를 생성하는 수정 필터 계수 생성단계; 및 상기 업샘플링된 신호를 상기 수정된 필터 계수를 이용하여 필터링하는 필터링단계를 포함하는 것을 특징으로 한다.
상술한 목적, 특징 및 장점은 첨부된 도면과 관련한 다음의 상세한 설명을 통해 보다 분명해 질 것이며, 그에 따라 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명의 기술적 사상을 용이하게 실시할 수 있을 것이다. 또한, 본 발명을 설명함에 있어서 본 발명과 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우에 그 상세한 설명을 생략하기로 한다. 이하, 첨부된 도면을 참조하여 본 발명에 따른 바람직한 일실시예를 상세히 설명하기로 한다.
설명에 앞서, 본 발명에 따른 동일채널 중계기의 전치등화 장치 및 그 방법은 디지털 TV 방송(ATSC, DVB 등)에 적합하나, 이것에만 국한되는 것은 아니며, 일반적인 단일 주파수망 구성을 위해 중계기가 필요한 환경에서는 어디에나 적용이 가능함을 분명히 한다.
도 5는 본 발명에 따른 동일채널 중계기의 전치등화 장치의 일실시예 구성도이다.
도 5에 도시된 동일채널 중계기의 전치등화 장치는 기저대역 신호 구성부(501), 파일롯 삽입부(502), 업샘플링부(503), 전치등화 필터계수 생성부(504), 수정 필터계수 생성부(505), 필터링부(506), IF 상향 변환부(507), 가산부(508) 및 디지털-아날로그 변환부(DAC, 509)를 포함한다.
기저대역 신호 구성부(501)는 동일채널 중계기에서 사용되는 등화부의 출력 신호와 필드(Field) 및 세그먼트 동기(Segment Sync) 신호를 조합하여 기저대역 신호를 구성하고, 파일롯 삽입부(502)는 기저대역 신호 구성부(501)에서 구성된 기저대역 신호에 파일롯(pilot) 신호를 삽입한다.
한편, 업샘플링부(503)는 파일롯 신호가 삽입된 기저대역 신호를 업샘플링(up-sampling)하고, 필터링부(506)는 업샘플링된 기저대역 신호를 I(In-phase) 및 Q(Quadrature) 신호로 변환하고 필터링한다. 이 때, 필터링부(506)는 등리플(ER:Equi-Ripple) 필터와 윈도우 기법을 사용하여 필터링할 수도 있고, SRRC(Square Root Raised Cosine) 필터와 윈도우 기법을 사용하여 필터링할 수도 있다. 또한, 등리플 필터만을 사용하여 필터링할 수도 있다.
다만, 전치등화 필터계수 생성부(504)는 기준 신호(이는 시스템 운영자에 의해 가변될 수 있다)에 기초하여 전치등화 필터계수를 생성하고, 수정 필터계수 생성부(505)는 상기 전치등화 필터계수와 상기 필터링부(506)의 기존 필터계수를 컨벌류션하여 새로운 필터계수를 생성하여 필터링부(506)로 전달한다. 상기 필터링부(506)의 필터링은 상기 새로운 필터계수를 기초로 이루어진다.
다음으로, IF 상향 변환부(507)는 필터링된 기저대역 I 및 Q 신호를 IF 대역의 신호로 주파수 상향 변환하고, 가산부(508)는 주파수 상향 변환된 IF 대역의 I 및 Q 신호를 더한다. 그리고, 디지털-아날로그 변환부(509)는 가산된 기저대역 디지털 신호를 아날로그 신호로 변환한다.
보다 상세하게 전치등화 과정을 설명하면 다음과 같다.
상기 필터링부(506)의 필터 계수는 전치등화 필터계수 생성부(504)와 수정 필터계수 생성부(505)에 의해 제공되는데, 전치등화 필터계수 생성부(504)는 업샘플링율 L에서 동작하는 임의의 전치등화 알고리즘에 의해 전체 탭 수가 (N1 + M1 + 1)이며, 메인 탭은 (N1 + 1)의 위치에 있는 전치등화 필터의 계수를 생성하여 수정필터계수 생성부(505)로 전달한다.
수정 필터계수 생성부(505)는 전치등화 필터계수 생성부(504)로부터 전달된 전치등화 필터의 계수와 전체 탭 수가 (N2 + M2 + 1)이며 메인 탭은 (N2 + 1)의 위치에 있는 필터링부(506)의 기 주어진 필터 계수를 각각 컨볼루션한다. 컨볼루션된 필터의 계수는 전체 탭 수가 (N1 + N2 + M1 + M2 + 1)이며 메인 탭은 (N1 + N2 + 1)의 위치에 있다.
한편, 수정 필터계수 생성부(505)는 시간 지연을 줄이기 위해 상기 컨볼루션된 필터의 계수를 필요에 따라 제거한다. 즉, 수정 필터계수 생성부(505)는 필터링부(506)가 시간 지연이 적은 필터링을 수행할 수 있도록 상기 전체 탭 수 (N1 + N2 + M1 + M2 + 1) 중 전치 탭 수 N3 (N3≤N1 + N2)을 조정하고, 필요에 따라 후치 탭수 M3(M3≤M1 + M2)를 조정하여, 전체 탭 수가 (N3 + M3 +1)이며 메인 탭은 (N3 + 1)의 위치에 있도록 한다.
도 6은 수정 필터계수 생성부에서의 수정 필터 계수 생성 과정을 설명하는 일실시예 도면이다.
도 6의 (a)에 도시된 바와 같이 전치등화 필터계수 생성부(504)는 업샘플링율 L에서 동작하는 임의의 전치등화 알고리즘에 의해 전체 탭 수가 (N1 + M1 + 1)이며, 전치 탭 수는 N1 이고 후치 탭 수는 M1 인 전치등화 필터의 계수를 생성한다.
그리고, 도 6의 (b)에 도시된 바와 같이 필터링부(506)의 기 주어진 필터 계수는 전체 탭 수는 (N2 + M2 + 1)이며 전치 탭 수는 N2 이고 후치 탭 수는 M2 이다.
수정 필터계수 생성부(505)는 상기 전치등화 필터계수 생성부(504)에서 생성된 전치등화 필터 계수와 상기 필터링부(506)의 기 주어진 필터 계수를 컨볼류션(convolution)한다.
컨볼류션한 필터의 계수는 도 6의 (c)에 도시된 바와 같이 전체 탭 수가 (N1 + N2 + M1 + M2 + 1)이고, 전치 탭 수는 (N1 + N2)이며, 후치 탭 수는 (M1 + M2)이 된다.
수정 필터계수 생성부(505)는 시간 지연을 줄이기 위해 상기 컨볼루션된 필터의 계수를 필요에 따라 제거한다. 즉, 도 6의 (d)에 도시된 바와 같이 전치 탭 수를 N3(N3 ≤ N1 + N2)으로 조정하고, 필요에 따라 후치 탭 수를 M3(M3≤M1 + M2)으로 조정한다.
만약, 도 5에 주어진 필터링부(506)가 도 4에 도시된 기존 필터링부(406)와 동일한 필터를 사용하고, 즉 도 4의 기존 필터링부(406)의 전치 탭 수와 도 5의 필터링부(506)의 전치 탭 수(C2 = N2)가 같고 후치 탭 수도 같으며(D2 = M2), 업샘플링율도 동일하다고 하면(K = L), 도 5의 필터링부(506)의 전치 탭 수는 전치등화 필터계수 생성부(504) 및 수정 필터계수 생성부(505)에 의해 N3(N3≤N1+N2)이 되므로, 도 5의 필터링부(506)의 시간 지연은 다음 [수학식 1]과 같다.
N3/L ≤ (N1 + N2)/L = (N1 + C2)/K
더욱이, 도 4의 전치등화 필터링부(404)의 전치 탭 수(C1)와 도 5의 전치등화 필터계수 생성부(504)에 의해 생성된 전치 탭 수(N1)가 C1 = N1/L을 만족하고, 도 4의 전치등화 필터링부(404)의 후치 탭 수(D1)와 도 5의 전치등화 필터계수 생성부(504)에 의해 생성된 후치 탭 수(M1)가 D1 = M1/L을 만족한다면, 상기 [수학식 1]의 시간 지연은 다음 [수학식 2]와 같이 유도된다.
N3/L ≤ (K × C1 + C2)/K = C1 + C2/K
따라서, 종래 기술에서 기재하였듯이 도 4의 필터링부(406)는 C1 + C2/K 의 시간 지연을 갖는 반면, 상기 [수학식 2]와 같이 도 5의 필터링부(506)는 도 4의 필터링부(406)와 동일한 필터 계수를 갖더라도 시간 지연이 더욱 줄어든다.
도 7은 본 발명에 따른 본 발명에 따른 동일채널 중계기의 전치등화 방법을 설명하는 일실시예 흐름도이다.
도 7에 도시된 바와 같이, 본 발명에 따른 동일채널 중계기의 전치등화 방법은, 먼저, 동일채널 중계기에서 사용되는 등화부의 출력 신호와 필드(Field) 및 세그먼트 동기(Segment Sync) 신호를 조합하여 기저대역 신호를 구성한다(701).
다음으로, 구성된 기저대역 신호에 파일롯 신호를 삽입하고(702), 파일롯 신호가 삽입된 기저대역 신호를 업샘플링한다(703).
한편, 상기 업샘플링율에서 동작하는 임의의 전치등화 알고리즘에 의해 전치등화 필터의 계수를 생성하고(704), 생성된 전치등화 필터의 계수와 기 설정된 필터의 계수를 컨볼류션 한다(705).
예를 들어, 전체 탭 수가 (N1 + M1 + 1)이며, 메인 탭은 (N1 + 1)의 위치에 있는 전치등화 필터의 계수를 생성하고, 생성된 전치등화 필터의 계수와 전체 탭 수가 (N2 + M2 + 1)이며 메인 탭은 (N2 + 1)의 위치에 있는 기 주어진 필터 계수와 컨볼루션한다. 컨볼루션된 필터의 계수는 전체 탭 수가 (N1 + N2 + M1 + M2 + 1)이며 메인 탭은 (N1 + N2 + 1)의 위치에 있게 된다.
이어서, 시간 지연을 줄이기 위해 상기 컨볼루션된 필터의 계수를 제거한다(706). 즉, 시간 지연이 적은 필터링을 수행할 수 있도록 상기 전체 탭 수 (N1 + N2 + M1 + M2 + 1) 중 전치 탭 수 N3 (N3≤N1 + N2)을 조정하고, 필요에 따라 후치 탭수 M3(M3≤M1 + M2)를 조정한다.
이어서, 상기 업샘플링된 기저대역 신호를 I 및 Q 신호로 변환하고 상기 컨볼류션 되어 일부 탭 수가 제거된 필터를 이용하여 상기 변환된 I 및 Q 신호를 필터링한다(707).
이어서, 필터링된 I 및 Q 신호를 중간 주파수 신호(IF 신호)로 주파수 상향 변환하고(708), 주파수 상향 변환된 I 및 Q 신호를 가산한다(709). 그리고, 가산된 중간 주파수(IF) 신호를 아날로그 신호로 변환한다(710).
상술한 바와 같은 본 발명의 방법은 프로그램으로 구현되어 컴퓨터로 읽을 수 있는 형태로 기록매체(씨디롬, 램, 롬, 플로피 디스크, 하드 디스크, 광자기 디스크 등)에 저장될 수 있다. 이러한 과정은 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있으므로 더 이상 상세히 설명하지 않기로 한다.
이상에서 설명한 본 발명은, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 있어 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하므로 전술한 실시예 및 첨부된 도면에 의해 한정되는 것이 아니다.
본 발명은, 동일채널중계기의 시간 지연을 최소화할 수 있을 뿐만 아니라, 향상된 동일채널 중계기 성능으로 한정된 자원인 주파수 자원의 이용 효율을 증대시킬 수 있다.

Claims (8)

  1. 신호를 동일 채널로 중계하는 동일채널 중계기의 전치등화 장치로서,
    입력된 필드(Field) 및 세그먼트(Segment) 동기 신호를 조합하여 기저대역 신호를 구성하는 기저대역 신호 구성수단;
    상기 구성된 신호에 파일롯 신호를 삽입하는 파일롯 삽입수단;
    상기 파일롯 신호가 삽입된 신호를 업샘플링하는 업샘플링수단;
    전치등화 필터의 계수를 생성하는 전치등화 필터 계수 생성수단;
    상기 전치등화 필터 계수와 기 주어진 필터의 계수를 이용하여 수정된 필터의 계수를 생성하는 수정 필터 계수 생성수단; 및
    상기 업샘플링된 신호를 상기 수정된 필터 계수를 이용하여 필터링하는 필터링수단
    을 포함하는 동일채널 중계기의 전치등화 장치.
  2. 제 1 항에 있어서,
    상기 수정 필터 계수 생성수단은,
    상기 전치등화 필터 계수와 기 주어진 필터의 계수를 컨볼루션하는 것을 특징으로 하는 동일채널 중계기의 전치등화 장치.
  3. 제 2 항에 있어서,
    상기 수정 필터 계수 생성수단은,
    컨볼류션된 필터의 탭 수를 줄이는 것을 특징으로 하는 동일채널 중계기의 전치등화 장치.
  4. 제 3 항에 있어서,
    상기 수정 필터 계수 생성수단은,
    컨볼류션된 필터의 전체 탭 중 전치 탭 수를 줄이는 것을 특징으로 하는 동일채널 중계기의 전치등화 장치.
  5. 신호를 동일 채널로 중계하는 동일채널 중계기의 전치등화 방법으로서,
    입력된 필드(Field) 및 세그먼트(Segment) 동기 신호를 조합하여 기저대역 신호를 구성하는 기저대역 신호 구성단계;
    구성된 신호에 파일롯 신호를 삽입하는 파일롯 삽입단계;
    파일롯 신호가 삽입된 신호를 업샘플링하는 업샘플링단계;
    전치등화 필터의 계수를 생성하는 전치등화 필터 계수 생성단계;
    생성된 전치등화 필터 계수와 기 주어진 필터의 계수를 이용하여 수정된 필 터의 계수를 생성하는 수정 필터 계수 생성단계; 및
    상기 업샘플링된 신호를 상기 수정된 필터 계수를 이용하여 필터링하는 필터링단계
    를 포함하는 동일채널 중계기의 전치등화 방법.
  6. 제 5 항에 있어서,
    상기 수정 필터 계수 생성단계는,
    생성된 전치등화 필터 계수와 기 주어진 필터의 계수를 컨볼루션하는 것을 특징으로 하는 동일채널 중계기의 전치등화 방법.
  7. 제 6 항에 있어서,
    상기 수정 필터 계수 생성단계는,
    컨볼류션된 필터의 탭 수를 줄이는 것을 특징으로 하는 동일채널 중계기의 전치등화 방법.
  8. 제 7 항에 있어서,
    상기 수정 필터 계수 생성단계는,
    컨볼류션된 필터의 전체 탭 중 전치 탭 수를 줄이는 것을 특징으로 하는 동일채널 중계기의 전치등화 방법.
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