KR100696630B1 - Plasma display panel - Google Patents
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Abstract
본 발명의 플라즈마 디스플레이 패널은, 초기 어드레싱 전압을 낮추어 어드레스 방전을 원활히 유도하고, 보다 넓은 어드레싱 전압 마진을 확보하는 것으로서, 소정의 간격을 두고 대향 배치되며, 그 사이에 다수로 구획되는 방전공간들을 구비하는 제1 기판 및 제2 기판, 상기 방전공간들 내에 형성되는 형광체층, 상기 제1 기판과 제2 기판 사이에서, 어느 한 기판 측 방전공간들을 각각 둘러싸고, 제1 방향을 따라 연결되는 제1 전극, 상기 제1 기판 및 제2 기판의 수직 방향을 따라 상기 제1 전극과 이격되어, 다른 한 기판 측 방전공간들을 각각 둘러싸고, 상기 제1 방향을 따라 연결되는 제2 전극, 및 상기 제1 전극 및 상기 제2 전극 사이에서, 상기 방전공간들을 각각 둘러싸고 상기 제1 방향과 교차하는 제2 방향으로 연결되는 어드레스전극을 포함한다. 상기 제1 기판과 상기 제2 기판의 수직 방향으로의 거리에서, 상기 어드레스전극과 상기 제1 전극 사이의 제1 거리와, 상기 어드레스전극과 상기 제2 전극 사이의 제2 거리는, 서로 다른 크기로 형성될 수 있다.The plasma display panel of the present invention lowers the initial addressing voltage to smoothly induce an address discharge and secures a wider addressing voltage margin. The plasma display panel includes a plurality of discharge spaces disposed to face each other at predetermined intervals. First and second substrates, a phosphor layer formed in the discharge spaces, and a first electrode connected in a first direction, each of which surrounds one of the substrate-side discharge spaces between the first and second substrates. A second electrode spaced apart from the first electrode along a vertical direction of the first substrate and the second substrate to surround discharge spaces of the other substrate, and connected along the first direction; and the first electrode; An address electrode is formed between the second electrodes and surrounds the discharge spaces and is connected in a second direction crossing the first direction. At a distance between the first substrate and the second substrate in the vertical direction, a first distance between the address electrode and the first electrode and a second distance between the address electrode and the second electrode are different in size. Can be formed.
플라즈마, 디스플레이, 어드레스전극, 유전층, 유전율 Plasma, display, address electrode, dielectric layer, dielectric constant
Description
도1은 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널을 분해하여 도시한 사시도이다.1 is an exploded perspective view illustrating a plasma display panel according to an exemplary embodiment of the present invention.
도2는 도1의 Ⅱ-Ⅱ 선을 따라 절단하여 도시한 단면도이다.FIG. 2 is a cross-sectional view taken along the line II-II of FIG. 1.
도3은 도1의 Ⅲ-Ⅲ 선을 따라 절단하여 도시한 단면도이다.3 is a cross-sectional view taken along the line III-III of FIG.
도4는 전극의 배치 구조를 도시한 사시도이다.4 is a perspective view showing an arrangement structure of electrodes.
도5는 유지전극, 주사전극, 및 어드레스전극의 단면 규격을 비교하는 단면도이다.5 is a cross-sectional view comparing the cross-sectional specifications of the sustain electrode, scan electrode, and address electrode.
본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 보다 상세하게는 초기 어드레싱 전압을 낮추어 어드레스 방전을 원활히 유도하고, 보다 넓은 어드레싱 전압 마진을 확보하는 플라즈마 디스플레이 패널에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a plasma display panel, and more particularly, to a plasma display panel which lowers initial addressing voltage to smoothly induce address discharge and secures a wider addressing voltage margin.
일반적으로 플라즈마 디스플레이 패널(PDP: plasma display panel)에는 3전극 면방전형이 있다.In general, a plasma display panel (PDP) has a three-electrode surface discharge type.
이 3전극 면방전형 플라즈마 디스플레이 패널은 유지전극과 주사전극 및 어 드레스전극을 구비한다. 유지전극과 주사전극은 전면기판의 동일 면상에 나란히 구비되고, 어드레스전극은 유지전극 및 주사전극과 교차하는 방향으로 배면기판에 구비된다.The three-electrode surface discharge plasma display panel includes a sustain electrode, a scan electrode and an address electrode. The sustain electrode and the scan electrode are provided side by side on the same surface of the front substrate, and the address electrode is provided on the back substrate in the direction crossing the sustain electrode and the scan electrode.
이 전면기판과 배면기판 사이, 즉 유지전극 및 주사전극 측과 어드레스전극 측 사이에 격벽이 구비된다. 이 격벽은, 나란히 배치되는 유지전극 및 주사전극이 어드레스전극과 교차하는 부분에 방전공간을 형성한다. 이 방전공간에는 방전 가스가 충전되어 있다.A partition wall is provided between the front substrate and the rear substrate, that is, between the sustain electrode and the scan electrode side and the address electrode side. The barrier ribs form a discharge space at a portion where the sustain electrodes and the scan electrodes arranged side by side intersect with the address electrodes. This discharge space is filled with discharge gas.
이 플라즈마 디스플레이 패널은 주사전극에 인가되는 스캔 펄스와 어드레스전극에 인가되는 어드레스 펄스에 의한 어드레스 방전으로 켜질 방전공간을 선택하고, 이렇게 선택된 방전공간의 유지전극과 주사전극에 교호적으로 인가되는 유지 펄스에 의한 유지 방전으로 화상을 구현한다.The plasma display panel selects a discharge space to be turned on by an address discharge by a scan pulse applied to the scan electrode and an address pulse applied to the address electrode, and a sustain pulse alternately applied to the sustain electrode and the scan electrode in the selected discharge space. The image is realized by the sustain discharge by.
이 플라즈마 디스플레이 패널은 유지전극과 주사전극을 방전공간의 전방에 구비하므로 유지전극과 주사전극의 각 내면에서 플라즈마 방전을 발생시키고 이 플라즈마 방전을 배면기판 측으로 확산시킨다. 이 플라즈마 방전은 방전공간 내의 형광체를 여기시켜 가시광을 발생시킨다.Since the plasma display panel includes a sustain electrode and a scan electrode in front of the discharge space, a plasma discharge is generated at each inner surface of the sustain electrode and the scan electrode, and the plasma discharge is diffused to the rear substrate side. This plasma discharge excites the phosphor in the discharge space to generate visible light.
전면기판에 구비되는 유지전극 및 주사전극은 방전공간의 개구율을 저감시키고, 방전공간 내에서 발생되어 전면기판으로 향하는 가시광의 투과율을 저하시킨다.The sustain electrode and the scan electrode provided on the front substrate reduce the aperture ratio of the discharge space and reduce the transmittance of visible light generated in the discharge space and directed to the front substrate.
따라서, 3전극 면방전형 플라즈마 디스플레이 패널은 낮은 휘도 또는 낮은 발광효율을 가진다. 이를 장시간 사용할 경우, 전계에 의해, 방전가스의 하전 입자 가 형광체에 이온 스퍼터링(ion sputtering)을 일으킨다. 이로써 영구잔상이 발생될 수 있다.Therefore, the three-electrode surface discharge plasma display panel has low luminance or low luminous efficiency. When it is used for a long time, charged particles of the discharge gas cause ion sputtering on the phosphor by an electric field. This may cause permanent afterimages.
이를 해결하기 위하여, 각 전극들을 전면기판과 배면기판 사이에서, 방전공간의 측면에 형성할 필요가 있다. 그리고 어드레스전극과 주사전극에 의한 어드레스 방전 및 유지전극과 주사전극에 의한 유지 방전 시, 방전가스의 하전 입자를 방전공간의 중앙으로 향하게 할 필요가 있다.In order to solve this problem, each electrode needs to be formed on the side of the discharge space between the front substrate and the rear substrate. In addition, it is necessary to direct the charged particles of the discharge gas to the center of the discharge space during the address discharge by the address electrode and the scan electrode and the sustain discharge by the sustain electrode and the scan electrode.
본 발명의 목적은 방전공간의 개구율 또는 가시광의 투과율을 향상시키며, 휘도 및 발광효율을 향상시키는 플라즈마 디스플레이 패널을 제공하는 것이다.SUMMARY OF THE INVENTION An object of the present invention is to provide a plasma display panel which improves the aperture ratio of a discharge space or the transmittance of visible light and improves luminance and luminous efficiency.
본 발명의 다른 목적은 초기 어드레싱 전압을 낮추어 어드레스 방전을 원활히 유도하고, 보다 넓은 어드레싱 전압 마진을 확보하는 플라즈마 디스플레이 패널을 제공하는 것이다.Another object of the present invention is to provide a plasma display panel which lowers the initial addressing voltage to smoothly induce address discharge and secures a wider addressing voltage margin.
본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널은, 소정의 간격을 두고 대향 배치되며, 그 사이에 다수로 구획되는 방전공간들을 구비하는 제1 기판 및 제2 기판, 상기 방전공간들 내에 형성되는 형광체층, 상기 제1 기판과 제2 기판 사이에서, 어느 한 기판 측 방전공간들을 각각 둘러싸고, 제1 방향을 따라 연결되는 제1 전극, 상기 제1 기판 및 제2 기판의 수직 방향을 따라 상기 제1 전극과 이격되어, 다른 한 기판 측 방전공간들을 각각 둘러싸고, 상기 제1 방향을 따라 연결되는 제2 전극, 및 상기 제1 전극 및 상기 제2 전극 사이에서, 상기 방전공간들을 각각 둘러싸고 상기 제1 방향과 교차하는 제2 방향으로 연결되는 어드레스전극을 포함할 수 있다.Plasma display panel according to an embodiment of the present invention, the first substrate and the second substrate having a plurality of discharge spaces are disposed facing each other at a predetermined interval, between the phosphors formed in the discharge spaces A layer, between the first substrate and the second substrate, each of which surrounds one of the substrate-side discharge spaces and is connected in a first direction, the first electrode in a vertical direction of the first and second substrates; A second electrode spaced apart from an electrode and surrounding the other substrate-side discharge spaces, and connected along the first direction, and between the first electrode and the second electrode, respectively surrounding the discharge spaces and in the first direction. It may include an address electrode connected in a second direction crossing the.
상기 제1 기판과 상기 제2 기판의 수직 방향으로의 거리에서, 상기 어드레스전극과 상기 제1 전극 사이의 제1 거리와, 상기 어드레스전극과 상기 제2 전극 사이의 제2 거리는, 서로 다른 크기로 형성될 수 있다.At a distance between the first substrate and the second substrate in the vertical direction, a first distance between the address electrode and the first electrode and a second distance between the address electrode and the second electrode are different in size. Can be formed.
상기 제2 거리는 상기 제1 거리 보다 짧게 형성될 수 있다. 상기 제2 전극은 어드레싱 기간에 스캔 펄스를 인가하고, 유지 방전 기간에 유지 펄스를 인가한다.The second distance may be shorter than the first distance. The second electrode applies a scan pulse in the addressing period and a sustain pulse in the sustain discharge period.
상기 제1 전극은 제1 유전율을 가지는 제1 유전층으로 매립되고, 상기 제2 전극은 상기 제1 유전율과 다른 제2 유전율을 가지는 제2 유전층으로 매립된다.The first electrode is buried in a first dielectric layer having a first dielectric constant, and the second electrode is buried in a second dielectric layer having a second dielectric constant different from the first dielectric constant.
상기 제2 유전율은 상기 제1 유전율보다 클 수 있다.The second dielectric constant may be greater than the first dielectric constant.
상기 어드레스전극은 상기 제2 유전층에 매립될 수 있다.The address electrode may be embedded in the second dielectric layer.
상기 제1 전극 및 제2 전극 각각은, 상기 방전공간을 둘러싸는 원형부재와, 상기 원형부재들을 상기 제2 방향으로 연결하는 연결부재를 포함할 수 있다.Each of the first electrode and the second electrode may include a circular member surrounding the discharge space and a connection member connecting the circular members in the second direction.
상기 어드레스전극은, 상기 방전공간을 둘러싸는 원형부재와, 상기 원형부재들을 상기 제1 방향으로 연결하는 연결부재를 포함할 수 있다.The address electrode may include a circular member surrounding the discharge space and a connection member connecting the circular members in the first direction.
상기 제1 전극의 원형부재와, 상기 어드레스전극의 원형부재, 및 상기 제2 전극의 원형부재는, 상기 제1 기판 및 상기 제2 기판의 수직 방향을 따라 서로 이격되어 나란하게 배치될 수 있다.The circular member of the first electrode, the circular member of the address electrode, and the circular member of the second electrode may be spaced apart from each other along the vertical direction of the first substrate and the second substrate.
상기 제1 전극, 상기 제2 전극, 및 상기 어드레스전극은 금속 전극으로 형성될 수 있다.The first electrode, the second electrode, and the address electrode may be formed of a metal electrode.
상기 제1 유전층 및 상기 제2 유전층은, 상기 방전공간 내측면에 보호막으로 덮어질 수 있다.The first dielectric layer and the second dielectric layer may be covered with a protective film on an inner surface of the discharge space.
상기 방전공간은 상기 제2 기판을 식각하여 형성될 수 있다.The discharge space may be formed by etching the second substrate.
상기 형광체층은 상기 제2 기판 측에 형성되는 상기 방전공간의 내측에 형성되는 투과형 형광체로 이루어질 수 있다.The phosphor layer may be formed of a transmissive phosphor formed inside the discharge space formed on the second substrate side.
상기 방전공간은 상기 제1 전극, 상기 어드레스전극, 및 상기 제2 전극의 배치에 대응하는 원통 형상으로 형성될 수 있다.The discharge space may be formed in a cylindrical shape corresponding to the arrangement of the first electrode, the address electrode, and the second electrode.
이하, 첨부한 도면을 참조하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다. 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 동일 또는 유사한 구성요소에 대해서는 동일한 참조부호를 붙였다.Hereinafter, exemplary embodiments of the present invention will be described in detail with reference to the accompanying drawings so that those skilled in the art may easily implement the present invention. As those skilled in the art would realize, the described embodiments may be modified in various different ways, all without departing from the spirit or scope of the present invention. In the drawings, parts irrelevant to the description are omitted in order to clearly describe the present invention, and like reference numerals designate like elements throughout the specification.
도1은 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널을 분해하여 도시한 사시도이다.1 is an exploded perspective view illustrating a plasma display panel according to an exemplary embodiment of the present invention.
이 도면들을 참조하여 설명하면, 플라즈마 디스플레이 패널은 기본적으로 소정의 간격으로 대향 배치되는 제1 기판(이하 "배면기판"이라 한다)(10)과 제2 기판(이하 "전면기판"이라 한다)(20)을 포함하고, 이 배면기판(10)과 전면기판(20) 사이에 방전공간들(27)을 구비한다.Referring to these drawings, the plasma display panel is basically a first substrate (hereinafter referred to as a "back substrate") 10 and a second substrate (hereinafter referred to as "front substrate") that are arranged at predetermined intervals ( 20 and
이 방전공간들(27)은 전면기판(20)의 내측을 식각하여 다수로 형성된다(도2 참조). 또한, 이 방전공간들(27)은 배면기판(10)의 내측을 식각하여 형성될 수 있고, 서로 대향하는 양 기판(10, 20)의 내측을 식각하여 형성될 수 있다(미도시).The
이 식각 가공 방법은 양 기판(10, 20)에 격벽층을 별도로 구비하는 방법에 비하여 가공비를 낮출 수 있다.This etching method can lower the processing cost as compared to the method of separately providing a partition layer on both
더 나아가, 방전공간들(27)은 배면기판(10)과 전면기판(20) 사이에 격벽층(미도시)을 구비하고, 이 격벽층에 의하여 다수로 구획될 수 있다. 이 경우, 격벽층은 전면기판(20)에 형성될 수 있고, 배면기판(10)에 형성될 수 있으며, 또한 양 기판(10, 20)에 각각 분리 또는 일체로 형성될 수 있다.Furthermore, the
이 방전공간(27)은 사각형 또는 육각형과 같이 다양한 형상으로 형성 가능하다. 본 실시예는 원통 형상으로 형성되는 방전공간(27)을 예시하고 있다(도3 참조). 이 원통 형상의 방전공간(27)은 이의 내주면에서 중심에 이르는 거리를 일정하게 하여, 방전공간(27) 내에서 균일한 방전을 가능하게 한다.The
이 방전공간(27)은 진공자외선을 흡수하여 가시광을 방출하도록 그 내부에 형광체층(29)을 구비한다. 또한, 방전공간(27)은 플라즈마 방전으로 진공자외선을 발생시킬 수 있도록 방전가스(일례로 네온(Ne)과 제논(Xe) 등을 포함하는 혼합가스)를 충전하고 있다.The
도2는 도1의 Ⅱ-Ⅱ 선을 따라 절단하여 도시한 단면도이다. 이 도면을 참조하여 전면기판(20)의 내측을 식각하여 방전공간(27)을 구비한 실시예로 설명한다.FIG. 2 is a cross-sectional view taken along the line II-II of FIG. 1. Referring to this drawing, the inside of the
형광체층(29)은 전면기판(20)의 내측을 식각하여 형성되는 방전공간(27)의 내 측면과 내 표면에 형성된다. 형광체층(29)은 방전공간(27)의 내부에서 진공자외 선을 흡수하여 전면기판(20) 쪽으로 가시광을 투과시키는 투과형 형광체로 형성된다.The
형광체층을 배면기판(10)에 형성하는 경우, 이 형광체층은 방전공간(27) 내부에서 진공자외선을 흡수하여 가시광을 반사시키는 반사형 형광체로 형성된다(미도시).When the phosphor layer is formed on the
형광체층을 전면기판(20)과 배면기판(10)에 형성되는 경우, 전면기판(20)의 형광체층은 투과형 형광체로 형성되고, 배면기판(10)에 형성되는 형광체층은 반사형 형광체로 형성된다(미도시).When the phosphor layer is formed on the
본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널은 형광체층(29)에 충돌될 진공자외선을 플라즈마 방전으로 생성하여 화상을 구현하기 위하여, 각 방전공간(27)에 대응하는 제1 전극(이하 "유지전극"이라 한다)(31)과 제2 전극(이하 "주사전극"이라 한다)(32) 및 어드레스전극(33)을 배면기판(10)과 전면기판(20) 사이에 구비한다.The plasma display panel according to an embodiment of the present invention uses a first electrode corresponding to each discharge space 27 (hereinafter, " hold ") to generate an image by generating vacuum ultraviolet rays that will collide with the
이 플라즈마 디스플레이 패널은 주사전극(32)과 어드레스전극(33)에 의한 어드레스 방전으로 커질 방전공간(27)을 선택하고, 이 선택 이후, 유지전극(31)과 주사전극(32)에 의한 유지 방전으로 방전공간(27)에 화상을 구현한다.The plasma display panel selects the
이를 위하여, 주사전극(32)은 유지 방전시 유지 펄스를 인가하고, 어드레스 방전시 스캔 펄스를 인가한다. 유지전극(31)은 유지 방전시 유지 펄스를 인가한다. 어드레스전극(33)은 어드레스 방전시 어드레스 펄스를 인가한다.To this end, the
이 유지전극(31)과 주사전극(32) 및 어드레스전극(33)은 이들에 인가되는 신 호 전압에 따라 그 역할을 달리 수행할 수 있다. 따라서 상기한 전극들과 전압 신호들과의 관계는 상기한 설명에 한정되지 않는다.The sustain
유지전극(31)과 주사전극(32) 및 어드레스전극(33)은 별도의 전극층(30)을 형성하여 양 기판(10, 20) 사이에 구비된다. 따라서 방전공간(27)이 전면기판(10)에 형성되므로 전극층(30)은 전면기판(10) 측 방전공간(27)과 배면기판(10) 사이에 구비된다.The sustain
또한, 유지전극(31)과 주사전극(32) 및 어드레스전극(33)은 방전공간(27)의 전방 개구율을 저하시키지 않으므로 불투명 소재로 형성될 수 있으므로 통전성이 우수한 금속 전극으로 형성되는 것이 바람직하다.In addition, since the sustain
이 전극층(30) 내에서, 유지전극(31)은 전면기판(20)의 방전공간(27) 측에 구비되고, 주사전극(32)은 배면기판(10) 측에 구비되며, 어드레스전극(33)은 유지전극(31)과 주사전극(32) 사이에 구비된다.In the
이 전극층(30)은 전면기판(20)에 형성된 방전공간(27)에 일체로 연결되는 다른 방전공간(37)을 형성한다. 즉 전면기판(20)의 식각에 의한 방전공간(27)과 전극층(30)에 의한 방전공간(37)에 의하여 하나의 방전셀(17)이 형성된다.The
도3은 도1의 Ⅲ-Ⅲ 선을 따라 절단하여 도시한 단면도이고, 도4는 전극의 배치 구조를 도시한 사시도이다.FIG. 3 is a cross-sectional view taken along line III-III of FIG. 1, and FIG. 4 is a perspective view showing an arrangement of electrodes.
유지전극(31), 주사전극(32), 및 어드레스전극(33)은 방전공간(27)에 각각 대응하면서 이에 연결되는 방전공간(37)을 둘러싸는 구조로 형성된다.The sustain
유지전극(31)은 전면기판(20)(즉 방전공간(27)) 측에서 방전공간(37)을 둘러 싸고, 제1 방향(x 축 방향)을 따라 연결된다. 유지전극(31)은 x 축 방향을 따라 인접하는 방전공간(37)에 연속적으로 대응한다. 복수의 유지전극들(31)은 인접하는 방전공간(37)의 간격을 유지하면서 제2 방향(y 축 방향)을 따라 나란하게 배치된다.The sustain
주사전극(32)은 배면기판(10) 측에서 각 방전공간(37)을 둘러싸고, x 축 방향을 따라 연결된다. 방전공간(37)을 둘러싸고 연결되는 구조에 있어서, 주사전극(32)은 유지전극(31)과 대응하는 구조를 가진다. 주사전극(32)은 양 기판(10, 20)의 수직 방향(z 축 방향)을 따라 유지전극(31)과 이격된다. 주사전극(32)은 x 축 방향을 따라 인접하는 방전공간(37)에 연속적으로 대응한다. 복수의 주사전극들(32)은 인접하는 방전공간(37)의 간격을 유지하면서 y 축 방향으로 따라 나란히 배치된다.The
어드레스전극(33)은 양 기판(10, 20)의 수직 방향(z 축 방향)을 따라 유지전극(31)과 주사전극(32) 사이에 구비된다.The
이 어드레스전극(33)은 양 기판(10, 20)의 수직 방향(z 축 방향)으로 유지전극(31) 및 주사전극(32)과 각각 이격되어 배치된다. 이 상태에서, 어드레스전극(33)은 두 전극(31, 32) 중에서 어드레스 방전에 관여하는 전극에 더 인접하게 배치된다.The
주사전극(32)은 어드레싱 기간에 스캔 펄스를 인가하여 어드레스 방전에 관여한다. 그러므로 어드레스전극(33)은 유지전극(31) 보다 주사전극(32)에 더 인접하게 배치된다.The
양 기판(10, 20)의 수직 방향(z 축 방향)으로의 거리(LL)에서, 어드레스전극(33)은 유지전극(31)과의 사이에 제1 거리(LL1)를 형성하고, 주사전극(32)과의 사이에서 제2 거리(LL2)를 형성한다. 이때, 제1 거리(LL1)와 제2 거리(LL2)는 서로 다른 크기를 유지한다. 즉, 제2 거리(LL2)가 제1 거리(LL1)보다 더 짧게 형성된다(도2 또는 도5 참조).In the distance LL in the vertical direction (z-axis direction) of both
이 어드레스전극(33)은 y 축 방향을 따라 인접하는 방전공간(37)에 연속적으로 대응한다. 즉 어드레스전극(33)의 연결 방향(y 축 방향)은 주사전극(32)의 연결 방향(x 축 방향)과 교차한다. 복수의 어드레스전극들(33)은 인접하는 방전공간(37)의 간격을 유지하면서 x 축 방향을 따라 나란히 배치된다. 어드레스전극(33)과 주사전극(32)의 교차 배치로 인하여 방전공간(27, 37)은 선택될 수 있다.The
이 유지전극(31), 주사전극(32), 및 어드레스전극(33)은 플라즈마 방전을 방전공간(37)의 중심으로 향하게 하는 구조로 형성되는 것이 바람직하다.The sustain
이를 위하여, 유지전극(31)과 주사전극(32) 각각은 원형부재(31a, 32a)와 연결부재(31b, 32b)를 포함하여 형성된다. 원형부재(31a, 32a)는 방전공간(37)을 그 측방에서 둘러싼다. 유지전극(31)의 연결부재(31b)는 유지전극(31)의 원형부재들(31a)을 x 축 방향으로 서로 연결한다. 주사전극(32)의 연결부재(32a)는 주사전극(32)의 원형부재들(32a)을 x 축 방향으로 서로 연결한다.To this end, each of the sustain
또한, 어드레스전극(33)은 원형부재(33a)와 연결부재(33b)를 포함한다. 원형부재(33a)는 방전공간(37)을 그 측방에서 둘러싼다. 어드레스전극(33)의 연결부재(33b)는 어드레스전극(33)의 원형부재들(33a)을 y 축 방향으로 서로 연결한다.In addition, the
유지전극(31)의 원형부재(31a)와, 어드레스전극(33)의 원형부재(33a), 및 주사전극(32)의 원형부재(32a)는 전면기판(20)과 배면기판(10)의 수직 방향(z 축 방향)을 따라 서로 이격되어 나란하게 배치된다.The
한편, 유지전극(31), 주사전극(32), 및 어드레스전극(33)은 저전압에 의한 플라즈마 방전을 가능하게 하는 구조로 형성되는 것이 바람직하다.On the other hand, it is preferable that the sustain
도5는 유지전극, 주사전극, 및 어드레스전극의 단면 규격을 비교하는 단면도이다.5 is a cross-sectional view comparing the cross-sectional specifications of the sustain electrode, scan electrode, and address electrode.
양 기판(10, 20)을 수직 방향(z 축 방향)으로 절단한 단면에서, 유지전극(31), 주사전극(32), 어드레스전극(33) 각각은 직사각형의 수평 변(31c, 32c, 33c)과 수직 변(31d, 32d, 33d)을 가진다.In the cross section in which both
유지전극(31), 주사전극(32), 어드레스전극(33)에서 각각의 수평 변(31c, 32c, 33c)은 서로 대응하는 길이를 가진다.Each of the
유지 방전을 일으키는 유지전극(31)과 주사전극(32)에서 각각의 수직 변(31d, 32d)은 서로 대응하는 길이를 가진다.Each of the
어드레스전극(33)이 유지전극(31)과 주사전극(32) 사이에서 주사전극(32) 측으로 치우쳐 이격 구비됨에 따라, 초기 어드레싱 전압을 낮출 수 있고, 이로 인하여 낮은 전압으로 어드레스 방전을 일으키길 수 있다.As the
또한, 전극층(30)은 유지전극(31), 어드레스전극(33), 및 주사전극(32)을 매립하는 제1 유전층(34)과 제2 유전층(35)을 구비한다.In addition, the
제1 유전층(34)은 유지전극(31)을 매립하여 전면기판(20) 측에 구비된다. 제 2 유전층(35)은 주사전극(32)과 어드레스전극(33)을 매립하여 배면기판(10) 측에 구비된다.The
제1 유전층(34)과 제2 유전층(35)은 서로 다른 유전율인 제1 유전율(ε1)과 제2 유전율(ε2)을 가진다. 제2 유전율(ε2)은 제1 유전율(ε1)보다 큰 것이 바람직하다.The
제2 유전율(ε2)을 가지는 제2 유전층은 주사전극(32)과 어드레스전극(33)을 매립하므로 어드레스 방전시 높은 유전율을 가지는 부분에서 어드레스 방전을 가능하게 한다.The second dielectric layer having the second dielectric constant ε 2 fills the
주사전극(32)과 어드레스전극(33) 사이의 커패시턴스(C)는 수학식 1.에서와 같이 제2 유전층(35)의 제2 유전율(ε2)에 비례하고, 주사전극(32)과 어드레스전극(33) 사이의 거리(d)에 반비례하고 주사전극(32)과 어드레스전극(33)의 대향 단면적(S)에 비례한다.The capacitance C between the
이러한데, 주사전극(32)과 어드레스전극(33)의 대향 단면적(S)을 상수로 하고, 거리(d)가 짧아짐에 따라 유지전극(32)과 어드레스전극(33) 사이의 커패시턴스(C)가 커지게 된다.In this case, the opposing cross-sectional area S of the
이 어드레스전극(33)과 주사전극(32) 사이의 정전용량(Q)은 수학식 2.에서와 같이, 커패시턴스(C)에 비례한다.The capacitance Q between the
이러한데, 어드레스전극(33)과 주사전극(32) 사이에 인가되는 전압(V)을 상수로 하고, 커패시턴스(C)가 커짐에 따라 정전용량(Q)이 커진다.In this case, the voltage V applied between the
이 정전용량(Q)이 커짐에 따라 제2 유전층(35)에 보다 많은 벽전하가 축적된다.As the capacitance Q increases, more wall charges accumulate in the
이 벽전하에 의한 벽전압이 높아짐에 따라, 어드레스 방전을 위한 어드레스 펄스의 어드레스 전압을 보다 낮출 수 있다. 즉 저전압에 의한 어드레스 방전이 가능하게 된다.As the wall voltage caused by the wall charges increases, the address voltage of the address pulse for address discharge can be lowered. That is, address discharge by low voltage is possible.
이 제2 유전층(35)과 제1 유전층(34)은 전면기판(20) 측에 형성되는 방전공간(27)에 대응하는 원통 형상의 방전공간(37)을 형성한다.The
이 제1 유전층(34)과 제2 유전층(35)은 방전셀(17)의 일측 방전공간(37)을 형성하는 그 내측면에서 보호막(36)으로 덮어진다. 이 보호막(36)은 방전공간(37) 내에서 일어나는 플라즈마 방전에 노출되는 부분에 형성될 수 있다.The
이 보호막(36)은 제1 유전층(34)과 제2 유전층(35)을 보호하고, 높은 이차전자 방출계수를 요구하지만, 가시광의 투과성을 가질 필요는 없다. 즉 전극들(31, 32, 33)이 전면기판(20)이나 배면기판(10)에 형성되는 것이 아니고 양 기판(10, 20) 사이에 구비되므로 전극들(31, 32, 33)을 매립하고 있는 제1 유전층(34)과 제2 유전층(35)에 도포되는 보호막(36)은 가시광 비투과성의 특성을 갖는 물질로 이루 어질 수 있다.The
이 보호막(36)의 일례로써, 가시광 비투과성 MgO는 가시광 투과성 MgO에 비하여 훨씬 높은 이차전자 방출계수(secondary electron emission coefficient) 값을 가지며, 따라서 방전개시전압을 더욱 낮출 수 있다.As an example of the
이상을 통해 본 발명의 바람직한 실시예에 대하여 설명하였지만, 본 발명은 이에 한정되는 것이 아니고 특허청구범위와 발명의 상세한 설명 및 첨부한 도면의 범위 안에서 여러 가지로 변형 또는 변경하여 실시하는 것이 가능하고 이 또한 본 발명의 범위에 속하는 것은 당연하다.Although the preferred embodiments of the present invention have been described above, the present invention is not limited thereto, and various modifications or changes can be made within the scope of the claims and the detailed description of the invention and the accompanying drawings. It goes without saying that it belongs to the scope of the present invention.
이상 설명한 바와 같이 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널에 의하면, 배면기판과 전면기판 사이에서 유지전극과 어드레스전극 및 주사전극을 양 기판의 수직 방향으로 이격 배치하고 방전공간을 측방에서 둘러싸는 구조로 형성하므로 방전공간의 개구율 또는 가시광의 투과율을 향상시키며, 휘도 및 발광효율을 향상시키는 효과가 있다.As described above, according to the plasma display panel according to the exemplary embodiment of the present invention, the sustain electrode, the address electrode, and the scan electrode are spaced apart in the vertical direction between the rear substrate and the front substrate, and the discharge space is surrounded on the side. Since the structure is formed, the aperture ratio of the discharge space or the transmittance of visible light is improved, and the brightness and luminous efficiency are improved.
또한, 본 발명의 일 실시예에 의하면, 어드레스전극을 유지전극보다 주사전극에 더 인접하게 배치하여, 초기 어드레싱 전압을 낮추어 어드레스 방전을 원활히 유도하고, 보다 넓은 어드레싱 전압 마진을 확보하는 효과가 있다.In addition, according to an embodiment of the present invention, the address electrode is disposed closer to the scan electrode than the sustain electrode, thereby lowering the initial addressing voltage to smoothly induce the address discharge and securing a wider addressing voltage margin.
또한, 본 발명의 일 실시예에 의하면, 어드레스전극과 주사전극을 매립하는 제2 유전층을 유지전극을 매립하는 제1 유전층의 유전율보다 높은 유전율을 가지는 유전체로 형성함으로써, 초기 어드레싱 전압을 낮추어 어드레스 방전을 원활히 유 도하고, 보다 넓은 어드레싱 전압 마진을 확보하는 효과가 있다.In addition, according to an embodiment of the present invention, the second dielectric layer filling the address electrode and the scan electrode is formed of a dielectric having a higher dielectric constant than that of the first dielectric layer filling the sustain electrode, thereby lowering the addressing voltage at the initial address. It leads to smoothly, and has the effect of securing a wider addressing voltage margin.
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