KR100266611B1 - 데이터 스크램블링 회로 - Google Patents

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Abstract

본 발명은 데이터 스크램블링 회로에 관한 것으로, 종래 데이터 스크램블링회로는 암호화의 주체인 암호화 기능블록체인을 모두 통과한 후에 암호문을 얻음으로써, 랜덤비가 감소하는 문제점이 있었다. 이와 같은 문제점을 감안한 본 발명은 각 암호화 기능블록에 해당하는 특정 값을 저장하는 저장부와; 사용자의 선택에 따라 상기 저장부에 저장된 특정 값을 선택하여 특정 암호화 기능블록으로 출력하는 선택부와; 상기 선택부를 통해 선택되어 입력되는 특정 값에 따라 암호화정도를 향상시켜 각각 암호문을 출력하는 다수의 암호화 기능블록과; 상기 다수의 암호화 기능블록의 암호문중 특정 암호문을 선택하여 출력하는 출력선택부로 구성하여 암호화의 주체인 각 암호화 기능블록의 출력신호를 저장부에 저장된 특정 값을 사용하여 암호화 정도를 향상시키고, 그 암호화 정도가 향상된 출력신호 각각을 선택적으로 최종적인 암호문으로 사용함으로써, 랜덤비(RANDOM RATE)를 향상시키는 효과가 있다.

Description

데이터 스크램블링 회로
본 발명은 데이터 스크램블링 회로에 관한 것으로, 특히 사용자의 선택에 따라 특정 정도의 암호화된 데이터를 얻으며, 스크램블 기능을 세팅함으로써 출력을 다양화시키는데 적당하도록 한 데이터 스크램블링 회로에 관한 것이다.
일반적으로, 데이터 스크램블링 회로는 암호화 기능블록을 다수개 연결하고, 암호키에 따라 상기 암호화 기능블록을 통해 평문데이터를 순차적으로 암호화하게 되며, 마지막 암호화 기능블록에서 최종의 암호화된 데이터를 출력하게 된다. 이와 같은 기능의 기술은 미국특허 5488661, 5442705에 상세히 설명되어 있으며, 이와 같은 종래 데이터 스크램블링 회로를 첨부한 도면을 상세히 설명하면 다음과 같다.
도1은 종래 데이터 스크램블링 회로도로서, 이에 도시한 바와 같이 64비트의 초기키(IKEY)를 입력받아 처리하여 각각 48비트의 키(KEY1~KEY16)를 출력하는 키 스케줄링부(10)와; 64비트의 평문(PTEXT)을 입력받아 특정한 방식으로 배열하는 초기순열부(20)와; 상기 초기순열부(20)를 통해 배열된 평문(PTEXT)을 입력받아 상기 키 스케줄링부(10)의 키(KEY1~KEY16)에 따라 암호화 처리하여 출력하는 암호화부(30)와; 상기 암호화부(30)의 출력신호를 입력받아 반전 배열하여 암호문(CTEXT)을 출력하는 반전순열부(40)로 구성된다.
상기 암호화부(30)는 각각 상기 키 스케줄링부(10)의 출력인 키(KEY1~KEY16)에 따라 입력되는 특정 비트의 데이터를 확장하고, 소정의 조합을 통해 암호화하는 다수의 암호화 기능블록(B1~B16)으로 구성된다.
상기 암호화 기능블록(B1~B16)은 각각 키(KEY1~KEY16)를 저장하는 저장부(M1~M16)와; 상기 저장부(M1~M16)에 저장된 키(KEY1~KEY16)에 따라 전단에서 입력되는 데이터를 암호화 처리하는 암호처리부(CF1~CF16)와; 상기 암호처리부(CF1~CF16)를 통해 암호화된 데이터와 전단의 출력데이터를 배타적오아조합하여 출력하는 배타적오아게이트(XORA1~XORA16)와; 상기 암호처리부(CF1~CF16)를 통해 암호화된 데이터를 확장하는 확장부(E1~E16)와; 상기 확장부(E1~E16)를 통해 확장된 데이터와 상기 저장부(M1~M16)에 저장된 키(KEY1~KEY16)를 배타적오아조합하여 다시 저장부(M1~M16)에 저장하는 배타적오아게이트(XORB1~XORB16)로 구성된다.
이하, 상기와 같이 구성된 종래 데이터 스크램블링 회로의 동작을 설명한다.
먼저, 8비트의 패리티비트를 포함하는 64비트의 초기 키(IKEY)를 입력받은 키 스케줄링부(10)는 각 비트를 치환하고, 패리티비트를 제외한 56비트의 데이터를 순환이동(CIRCULARLY SHIFTING)하여 각각 48비트의 키(KEY1~KEY16)를 생성한다.
그 다음, 암호화되지 않은 64비트의 평문(PTEXT)을 인가 받은 초기순열부(20)는 상기 평문(PTEXT)을 32비트의 데이터로 변환하여 각각 다른 경로를 통해 출력한다.
그 다음, 상기 초기순열부(20)를 통해 각기 다른 경로를 통해 32비트의 데이터를 입력받은 암호화 기능블록(B1)은 상기 키(KEY1)에 따라 상기 입력받은 평문(PTEXT)을 암호화하여 출력한다. 이때의 암호화 과정은 상기 평문(PTEXT)을 분할한 32비트의 데이터를 암호처리부(CF1)에서 키(KEY1)를 저장하고 출력하는 저장부(M1)의 키(KEY1)에 따라 소정의 암호화처리를 하여 출력하며, 이는 배타적오아게이트(XORA1)에서 상기 사용되지 않은 32비트의 평문(PTEXT)과 배타적오아조합 즉 가산되어 출력됨과 동기에 확장부(E1)에서 64비트로 확장되며, 이 확장된 데이터는 배타적오아게이트(XORB1)에서 다시 상기 메모리(M1)에 저장된 키(KEY1)와 배타적오아조합, 즉 가산되어 다시 메모리(M1)에 저장된다. 암호화 기능블록(B1)에서는 이러한 과정을 반복적으로 수행하게 되며, 암호화 기능블록(B2)에서는 상기 배타적오아게이트(XORA1)의 출력을 암호처리부(CF2)에 입력받아 키(KEY2)에 따라 암호화하며, 상기 암호처리부(CF1)에 입력되었던 데이터와 배타적오아조합 되어 출력하는 것으로, 암호화의 정도를 높이게 된다.
즉, 암호화 기능블록(B1)을 통해 평문(PTEXT)은 암호화되나 암호화정도를 높이기 위해 암호화 기능블록(B1)과 동일한 구성의 기능블록을 체인화하여 사용한다.
이와 같은 과정을 마지막 단에 위치하는 암호화 기능블록(B16)이 완료하였을 때, 상기 반전순열부(40)에서는 상기 32비트씩 분할된 데이터를 다시 재배열하고, 반전하여 상기 평문(PTEXT)을 암호화한 암호문(CTEXT)을 출력하게 된다.
상기한 바와 같이 종래 데이터 스크램블링 회로는 다수의 암호화 기능블록을 모두 지난 후에만 암호문이 출력되어 랜덤비(RANDOM RATE)가 저하되는 문제점이 있었다.
이와 같은 문제점을 감안한 본 발명은 사용자의 선택에 따라 각 암호화 기능블록의 출력을 암호문으로써 출력할 수 있는 데이터 스크램블링 회로를 제공함에 그 목적이 있다.
도1은 종래 데이터 스크램블링 회로도.
도2는 본 발명 데이터 스크램블링 회로도.
***도면의 주요 부분에 대한 부호의 설명***
10:키 스케줄링부 20:초기순열부
30:암호화부 50:출력선택 결정부
60:저장부 70:테이블선택부
80:출력데이터 선택부
상기와 같은 목적은 각 암호화 기능블록에 해당하는 특정 값을 저장하는 저장부와; 사용자의 선택에 따라 상기 저장부에 저장된 특정 값을 선택하여 특정 암호화 기능블록으로 출력하는 선택부와; 상기 선택부를 통해 선택되어 입력되는 특정 값에 따라 암호화정도를 향상시켜 각각 암호문을 출력하는 다수의 암호화 기능블록과; 상기 다수의 암호화 기능블록의 암호문중 특정 암호문을 선택하여 출력하는 출력선택부로 구성함으로써 달성되는 것으로, 이와 같은 본 발명을 첨부한 도면을 참조하여 상세히 설명하면 다음과 같다.
도2는 본 발명 데이터 스크램블링 회로도로서, 이에 도시한 바와 같이 사용자의 출력선택을 입력받아 그에 따른 출력신호를 출력하는 출력선택 결정부(50)와; 상기 출력선택 결정부(50)의 출력신호에 따라 각 어드레스에 특정 값을 저장하는 저장부(60)의 테이블을 선택하여 출력하는 테이블선택부(70)와; 초기 키(IKEY)를 입력받아 처리하여 키(KEY1~KEY16)를 출력하는 키 스케줄링부(10)와; 평문(PTEXT)을 입력받아 특정 비트로 배열하여 출력하는 초기순열부(20)와; 다수의 암호화 기능블록(B1~B16)을 포함하여 상기 초기순열부(20)를 통해 평문(PTEXT)을 상기 키(KEY1~KEY16)와 상기 테이블선택부(70)에서 선택되어진 저장부(60)의 특정 값에 따라 각 암호화 기능블록(B1~B16)에서 출력데이터를 출력하는 암호화부(30)와; 상기 암호화부(30)에 구비된 다수의 암호화 기능블록(B1~B16)의 출력 각각을 재배열하여 암호문을 출력하는 다수의 반전순열부(IP1~IP16)와; 상기 출력선택 결정부(50)의 출력신호에 따라 상기 반전순열부(IP1~IP16)의 출력중 특정 반전순열부의 암호문(CTEXT)을 선택하여 출력하는 출력데이터선택부(80)로 구성된다.
상기 각 기능블록(B1~B16)은 상기 키(KEY1~KEY16)를 저장하는 저장부(M1~M16)와; 상기 저장부(M1~M16)에 저장된 값에 따라 전단에서 입력되는 32비트의 데이터를 암호화 처리하는 암호처리부(CF1~CF16)와; 상기 암호처리부(CF1~CF16)의 출력을 64비트로 확장하는 확장부(E1~E16)와; 상기 확장부(E1~E16)의 출력과 상기 저장부(M1~M16)에 저장된 값을 배타적오아조합하여 다시 저장부(M1~M16)에 저장하는 배타적오아게이트(XORB1~XORB16)와; 상기 암호처리부(CF1~CF16)의 출력과 입력을 배타적오아조합하여 출력하는 배타적오아게이트(XORA1~XORA16)와; 상기 테이블선택부(70)의 출력에 따라 인에이블되어, 상기 배타적오아게이트(XORA1~XORA16)의 데이터를 순환이동(CIRCULARLY SHIFTING)시켜 출력하는 순환이동부(F1~F16)와; 상기 순환히동부(F1~F16)의 출력신호와 전단에서 입력된 32비트의 데이터를 배타적오아조합하여 출력하는 배타적오아게이트(XORC1~XORC16)로 구성된다.
이하, 상기와 같이 구성된 본 발명 데이터 스크램블링 회로의 동작을 설명한다.
먼저, 사용자는 암호화 기능블록(B1~B16)중 어떤 블록의 출력을 사용할 것인지를 결정하여 그에 해당하는 입력신호를 출력선택 결정부(50)에 입력한다. 이와 같은 입력에 따라 상기 출력선택 결정부(50)는 해당하는 신호를 출력하게 된다.
그 다음, 상기 출력선택 결정부(50)의 출력신호를 입력받은 테이블선택부(70)는 각 어드레스에 저장되어있는 값을 선택하여 출력한다. 이때 저장된 값 각각은 특정 암호화 기능블록(B1~B16)에 입력될지 이미 결정된 상태이며, 상기 출력선택 결정부(50)에 의해 특정 암호화 기능블록(B1~B16)에 정해진 값이 출력된다. 즉, 암호화 기능블록(B1)을 선택하여 평문(PTEXT)을 암호화 기능블록(B1)에서 암호화한 결과를 암호문으로 사용하는 경우에는 상기 테이블선택부(70)는 정해진 값이 FF를 상기 암호화 기능블록(B1)의 순환이동부(F1)에 입력하게 된다.
그 다음, 키 스케줄링부(10)는 8비트의 패리티비트를 포함하는 64비트의 초기 키(IKEY)를 입력받아 처리하여 각각 48비트의 키(KEY1~KEY16)를 출력한다.
그 다음, 평문(PTEXT)이 입력되면 초기순열부(20)에서는 상기 64비트의 평문(PTEXT)을 32비트의 데이터로 변환하고, 각각 다른 경로를 통해 출력한다.
그 다음, 상기 초기순열부(20)의 일측경로를 통해 출력되는 32비트의 데이터는 암호화 기능블록(B1)의 암호처리부(CF1)에 입력되고, 저장부(M1)에 저장된 키(KE1)에 따라 암호화되어 출력된다.
그 다음, 상기 암호처리부(CF1)의 출력신호를 입력받은 확장부(E1)는 상기 32비트의 암호처리부(CF1) 출력을 64비트로 확장하여 출력하며, 이는 배타적오아게이트(XORB1)에서 상기 저장부(M1)에 저장된 키(KEY1)와 배타적오아조합 되어 다시 저장부(M1)에 저장된다.
이와 동시에 상기 암호처리부(CF1)의 출력신호는 일측경로를 통해 상기 암호처리부(CF1)에 입력되었던 초기순열부(20)의 32비트 데이터와 배타적오아게이트(XORA1)에서 배타적오아조합 되어 출력된다.
그 다음, 사용자가 암호화 기능블록(B1)의 출력을 암호문(CTEXT)으로 사용하고자 하는 경우에 저장부(60)의 어드레스(16)에 저장된 값인 BF가 순환이동부(F1)에 입력되며, 이는 상기 배타적오아게이트(XORA1)의 출력신호와 가산 및 순환이동되어 출력된다. 이때 순환이동부(F1)는 암호처리부(CF1)에서 처리된 암호문을 좀더 복잡한 암호문으로 만드는 역할을 한다.
그 다음, 배타적오아게이트(XORC1)에서는 상기 순환이동부(F1)의 출력신호와 상기 초기순열부(20)의 타측경로를 통해 출력된 32비트의 데이터를 배타적오아조합 즉 가산하여 출력한다.
이와 같은 과정을 통해 암호화된 데이터, 즉, 배타적오아게이트(XORA1),(XORC1)의 출력신호는 반전순열부(IP1)에서 64비트의 암호문으로 재배열되고, 이는 상기 출력선택 결정부(50)의 출력신호에 따라 동작하는 출력데이터 선택부(80)에서 선택되어 최종적인 암호문(CTEXT)으로 출력된다.
이때, 사용자가 암호화 기능블록(B2)의 출력을 암호문(CTEXT)으로 사용하는 것으로 결정한 경우, 상기 순환이동부(F1)는 저장부(60)의 값의 입력이 없으므로, 상기 배타적오아게이트(XORA1)의 출력신호를 순환이동하여 배타적오아게이트(XORC1)에서 배타적오아조합되도록 하며, 상기 배타적오아게이트(XORC1)의 출력신호는 키(KEY2)에 따라 암호처리부(CF2)에서 암호화 처리되고, 그 암호화된 출력은 다시 상기 배타적오아게이트(XORC1)의 출력과 배타적오아게이트(XORA2)에서 배타적오아조합되어 출력된다.
그 다음, 상기 출력선택 결정부(50)의 출력신호는 암호화 기능블록(B2)의 출력을 암호문(CTEXT)으로 하여 출력하는 것이므로, 테이블선택부(70)에 의해 특정한 값이 순환이동부(F2)에 입력되고, 그 입력된 값은 상기 순환이동부(F2)에서 상기 배타적오아게이트(XORA2)의 출력신호와 가산된 후, 순환이동되어 출력된다.
그 다음, 배타적오아게이트(XORC2)는 상기 암호화 기능블록(B1)의 배타적오아게이트(XORA1)의 출력신호와 상기 순환이동부(F2)의 출력신호를 배타적오아조합하여 출력한다.
그 다음, 상기 배타적오아게이트(XORA2),(XORC2)의 출력신호는 반전순열부(IP2)에서 64비트의 암호문(CTEXT)으로 재배열되며, 이는 출력데이터 선택부(80)에서 선택되어 최종적인 암호문(CTEXT)으로서 출력된다.
이와 같은 과정과 동일한 과정을 통해 사용자는 각 암호화 기능블록(B1~B16)의 출력신호를 최종적인 암호문(CTEXT)으로서 얻을 수 있게 되며, 종래에 비해 각 암호화 기능블록(B1~B16)의 출력은 순환이동부(F1~F16)에 의해 암호화정도가 더 복잡해진 상태로 출력되어, 사용효율을 향상시키게 된다.
상기한 바와 같이 본 발명 데이터 스크램블링 회로는 암호화의 주체인 각 암호화 기능블록의 출력신호를 저장부에 저장된 특정 값을 사용하여 암호화 정도를 향상시키고, 그 암호화 정도가 향상된 출력신호 각각을 선택적으로 최종적인 암호문으로 사용함으로써, 랜덤비(RANDOM RATE)를 향상시키는 효과가 있다.

Claims (6)

  1. 초기키를 입력받아 처리하여 다수의 키를 출력하는 키 스케줄링부와; 평문을 입력받아 분할하여 각기 다른 경로를 통해 출력하는 초기순열부와; 다수의 암호화 기능블록을 포함하여 상기 초기순열부의 출력을 상기 다수의 키에 따라 암호화하여 출력하는 암호화부와; 상기 암호화부의 출력을 상기 입력된 평문의 크기로 재배열하여 출력하는 반전순열부로 구성되는 데이터 스크램블링 회로에 있어서, 상기 암호화부는 사용자의 선택에 따라 각각의 출력신호의 암호화정도를 증가시켜 암호문으로 하여 출력하는 것을 특징으로 하는 데이터 스크램블링 회로.
  2. 제 1항에 있어서, 상기 암호화 기능블록 각각은 사용자의 선택에 따라 제어신호를 출력하는 출력선택 결정부의 출력신호에 따라 인가되는 기저장된 특정 값을 이용하여 암호화정도를 향상시켜 출력하는 것을 특징으로 하는 데이터 스크램블링 회로.
  3. 제 1항에 있어서, 상기 반전순열부는 상기 다수의 암호화 기능블록 각각의 출력신호를 입력받아 상기 입력된 평문과 동일한 크기의 암호문으로 변환하는 다수의 암호문 조합부와; 사용자의 선택에 따라 특정 암호화 기능블록의 출력신호를 변환한 암호문 조합부의 암호문을 선택하여 출력하는 출력데이터 선택부로 구성하여 된 것을 특징으로 하는 데이터 스크램블링 회로.
  4. 제 1항에 있어서, 상기 각 암호화 기능블록은 상기 키 스케줄링부의 키를 저장하는 저장부와; 상기 저장부에 저장된 키에 따라 초기순열부 또는 전단의 암호화 기능블록의 일측경로를 통해 출력되는 데이터를 암호화 처리하는 암호처리부와; 상기 암호처리부의 출력신호를 상기 평문의 크기로 확장하는 확장부와; 상기 확장부의 출력신호와 상기 저장부에 저장된 키를 가산하여 다시 저장부에 저장하는 제 1가산부와; 상기 암호처리부의 출력신호와 암호처리부의 입력신호를 가산하여 출력하는 제 2가산부와; 사용자의 선택에 따라 입력되는 특정 값이 있을 경우에 그 특정 값과 상기 제 2가산부의 출력신호를 가산하고, 순환이동하여 암호화정도를 향상시키는 순환이동부와; 상기 순환이동부의 출력신호와 상기 초기순열부 또는 전단의 암호화 기능블록의 타측단을 통해 출력되는 데이터를 가산하여 출력하는 제 3가산부로 구성하여 된 것을 특징으로 하는 데이터 스크램블링 회로.
  5. 제 2항에 있어서, 상기 암호화 기능블록에 입력되는 기저장된 특정 값은 상기 출력선택 결정부의 제어에 따라 각 어드레스에 상기 암호화 기능블록 각각에 해당하는 특정 값을 저장하는 저장부에서 특정 값을 선택하여 출력하는 테이블선택부에 의해 인가되는 것을 특징으로 하는 데이터 스크램블링 회로.
  6. 제 4항에 있어서, 상기 제 1 내지 제 3가산부는 배타적오아게이트인 것을 특징으로 하는 데이터 스크램블링 회로.
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