KR100260364B1 - Method for forming a gate electrode having polycide structure in a semiconductor device - Google Patents
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Abstract
Description
본 발명은 반도체 디바이스의 제조방법에 관한 것으로, 특히 폴리실리콘막과 텅스텐 실리사이드막이 적층된 폴리사이드 구조의 게이트 전극 형성방법에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a method for manufacturing a semiconductor device, and more particularly, to a method for forming a gate electrode having a polyside structure in which a polysilicon film and a tungsten silicide film are laminated.
대부분의 집적회로에서 낮은 저항과 고온에서의 안정도를 가지는 금속 실리사이드가 접촉재료로서 사용된다. 실리사이드는 고유의 조성과 각기의 화학적 성질을 갖는 금속-실리콘 화합물이다. 상기 금속은 내화성 금속족인 몰리브덴, 탄탈륨, 티타늄, 텅스텐 또는 귀금속 원자인 코발트, 니켈, 백금 등과 반응한 화합물로 구성된다. 한편, 금속 실리사이드 중 게이트 전극 물질로서 텅스텐 실리사이드가 사용되는데, 텅스텐 실리사이드는 폴리실리콘에 비하여 낮은 비저항과 고온에서의 안정도를 갖는 장점이 있는 반면, 게이트 산화막과의 접착력이 우수하지 못하다. 따라서, 텅스텐 실리사이드가 사용되는 게이트 전극은 폴리실리콘막 상에 텅스텐 실리사이드층을 적층한 폴리사이드 구조로서 형성된다.In most integrated circuits, metal silicides having low resistance and high temperature stability are used as contact materials. Silicides are metal-silicon compounds with inherent composition and respective chemical properties. The metal is composed of a compound reacted with molybdenum, tantalum, titanium, tungsten or precious metal atoms such as cobalt, nickel, platinum, etc., which are refractory metals. On the other hand, tungsten silicide is used as the gate electrode material among the metal silicides, while tungsten silicide has advantages of low specific resistance and stability at high temperatures compared to polysilicon, but is not excellent in adhesion to the gate oxide film. Therefore, the gate electrode in which tungsten silicide is used is formed as a polyside structure in which a tungsten silicide layer is laminated on a polysilicon film.
그러나, 텅스텐 실리사이드층 형성시 사용되는 소오스 개스인 WF6에 의한 다량의 불소(F)원자는 후속 열처리 공정에서 하부층인 폴리실리콘층으로 확산하여 게이트 산화막(SiO2)의 산소와 치환되어 실리콘-산소(Si-O)의 결합을 파괴한다. 이때, 결합에서 파괴된 산소는 계면으로 확산되어 실리콘 기판 및 폴리실리콘막을 산화시킨다. 이에 따라, 게이트 산화막의 두께 변화로 인하여 게이트 산화막의 특성이 저하되어, 결국 반도체 디바이스의 신뢰성을 저하시킨다.However, a large amount of fluorine (F) atoms by WF6, a source gas used in forming a tungsten silicide layer, diffuses into the polysilicon layer, which is a lower layer, in the subsequent heat treatment process, and is replaced with oxygen in the gate oxide film (SiO 2 ) to form silicon-oxygen ( Breaks the bond of Si-O). At this time, the oxygen destroyed in the bond diffuses to the interface to oxidize the silicon substrate and the polysilicon film. As a result, the characteristics of the gate oxide film are deteriorated due to the change in the thickness of the gate oxide film, which in turn lowers the reliability of the semiconductor device.
먼저, 불소원자의 확산을 억제하기 위하여 미국특허출원 제 5,364,803에서는 텅스텐 실리사이드층과 폴리실리콘막 사이에 TiN막을 개재하여 게이트 전극을 형성하는 방법을 제시하였다. 그러나, 원주(column)형 결정을 갖는 TiN막의 구조 상의 특성 때문에, TiN막의 결정립계(grain boundary)를 통한 불소 원자의 확산을 완전히 억제할 수는 없었다. 또한, 미국특허출원 제 5,393,676에서는 폴리실리콘막 내에 아르곤(Ar) 이온주입층의 형성을 제시하였으나, 아르곤 원자만으로 효과적으로 불소원자의 확산을 억제할 수는 없었다. 또한, 미국특허출원 제 5,441,904에서는 폴리실리콘막을 결정크기가 다른 두층의 폴리실리콘막을 적층하여 형성하되, 결정크기가 큰 폴리실리콘막을 상부층으로 형성하여, 결정립계를 불일치하도록 하는 방법을 제시하다. 그러나, 이러한 결정립계를 통한 불소의 확산을 효과적으로 억제할 수는 없었다.First, in order to suppress diffusion of fluorine atoms, U.S. Patent Application No. 5,364,803 has proposed a method of forming a gate electrode between a tungsten silicide layer and a polysilicon layer via a TiN film. However, due to the structural characteristics of the TiN film having columnar crystals, the diffusion of fluorine atoms through the grain boundaries of the TiN film could not be completely suppressed. In addition, U.S. Patent Application No. 5,393,676 suggested the formation of an argon (Ar) ion implantation layer in a polysilicon film, but the argon atom alone could not effectively suppress the diffusion of fluorine atoms. In addition, US Patent Application No. 5,441,904 discloses a method in which a polysilicon film is formed by stacking two layers of polysilicon films having different crystal sizes, but a polysilicon film having a large crystal size is formed as an upper layer to make the grain boundaries inconsistent. However, the diffusion of fluorine through such grain boundaries could not be effectively suppressed.
한편, 미국특허출원 제 5,434,096에서는 텅스텐 실리사이드막의 형성 후 열처리를 진행하여 다량의 불소 원자를 외부방출시키는 방법을 제시하였으나, 방출되지 않고 일부 남아있는 불소 원자에 의한 확산을 통제하지는 못하였다.On the other hand, U.S. Patent Application No. 5,434,096 proposed a method of externally releasing a large amount of fluorine atoms by heat treatment after formation of a tungsten silicide film, but did not control the diffusion by some remaining fluorine atoms.
따라서, 본 발명은 상기한 종래의 문제점을 해결하기 위한 것으로서, 폴리실리콘막과 텅스텐 실리사이드막의 적층 구조인 폴리사이드 구조의 게이트 전극의 형성시, 폴리실리콘막으로 불소 원자가 확산되는 것을 효과적으로 억제함으로써, 게이트 산화막의 특성을 향상시킬 수 있는 반도체 디바이스의 제조방법을 제공함에 그 목적이 있다.Accordingly, the present invention has been made to solve the above-mentioned problems, and when forming the gate electrode of the polyside structure, which is a laminated structure of the polysilicon film and the tungsten silicide film, by effectively suppressing the diffusion of fluorine atoms into the polysilicon film, It is an object of the present invention to provide a method for manufacturing a semiconductor device capable of improving the characteristics of an oxide film.
도 1a 내지 도 1d는 본 발명의 일 실시예에 따른 폴리사이드 구조를 갖는 반도체 디바이스의 게이트 형성방법을 설명하기 위한 단면도이다.1A to 1D are cross-sectional views illustrating a gate forming method of a semiconductor device having a polyside structure according to an exemplary embodiment of the present invention.
(도면의 주요 부분에 대한 부호의 설명)(Explanation of symbols for the main parts of the drawing)
50 : 반도체 기판 51 : 게이트 전극50
52 : 폴리실리콘막 53 : 비정질 실리콘막52
+ : 할로겐 이온주입층 54 : 텅스텐 실리사이드층+: Halogen ion implantation layer 54: tungsten silicide layer
55 : 산화질화막55 oxynitride film
상기 목적을 달성하기 위하여, 본 발명의 제 1 관점에 따른 반도체 디바이스의 게이트 형성방법은 게이트 산화막이 형성된 반도체 기판 상에 도핑된 폴리실리콘막을 형성하는 단계; 상기 폴리실리콘막 상에 제 1 확산방지막으로서 비정질 실리콘막을 형성하는 단계; 상기 비정질 실리콘막 및 상기 폴리실리콘막의 표면에 제 2 확산방지막으로서 할로겐 이온주입층을 형성하는 단계; 및, 상기 할로겐 이온주입층이 형성된 비정질 실리콘막 상에 텅스텐 실리사이드층을 형성하는 단계를 포함한다.In order to achieve the above object, a gate forming method of a semiconductor device according to a first aspect of the present invention comprises the steps of forming a doped polysilicon film on a semiconductor substrate formed with a gate oxide film; Forming an amorphous silicon film on the polysilicon film as a first diffusion barrier film; Forming a halogen ion implantation layer as a second diffusion barrier on surfaces of the amorphous silicon film and the polysilicon film; And forming a tungsten silicide layer on the amorphous silicon film on which the halogen ion implantation layer is formed.
또한, 상기 목적을 달성하기 위하여, 본 발명의 제 2 관점에 따른 반도체 디바스의 게이트 형성방법은 게이트 산화막이 형성된 반도체 기판 상에 도핑된 폴리실리콘막을 형성하는 단계; 상기 폴리실리콘막 상에 확산방지막으로서 할로겐 이온을 함유하는 비정질 실리콘막을 형성하는 단계; 및, 비정질 실리콘막 상에 텅스텐 실리사이드층을 형성하는 단계를 포함한다.In addition, in order to achieve the above object, a gate forming method of a semiconductor device according to a second aspect of the present invention comprises the steps of: forming a doped polysilicon film on a semiconductor substrate having a gate oxide film; Forming an amorphous silicon film containing halogen ions as a diffusion barrier on the polysilicon film; And forming a tungsten silicide layer on the amorphous silicon film.
상기한 본 발명에 의하면, 폴리실리콘막과 텅스텐 실리사이드막의 적층 구조인 폴리사이드 구조의 게이트 전극 형성에서, 폴리실리콘막과 텅스텐 실리사이드막 사이에 결정립계가 없는 비정질 실리콘막을 형성함과 더불어 폴리실리콘막과 비정질 실리콘막에 할로겐 이온층을 형성하거나, 비정질 실리콘막에 할로겐 원자를 첨가한다. 이러한 비정질 실리콘막 및 할로겐 원자에 의해, 텅스텐 실리사이드층의 형성시 불소 원자가 폴리실리콘막으로 확산되는 것을 효과적으로 방지할 수 있다. 이에 따라, 불소 원자의 확산으로 인한 게이트 산화막의 두께변화를 방지함으로써 게이트 산화막의 특성을 향상시킬 수 있으므로, 결국 소자의 신뢰성을 향상시킬 수 있다.According to the present invention described above, in forming a gate electrode having a polyside structure, which is a laminated structure of a polysilicon film and a tungsten silicide film, an amorphous silicon film having no grain boundary is formed between the polysilicon film and the tungsten silicide film, and the polysilicon film and the amorphous film A halogen ion layer is formed in a silicon film, or a halogen atom is added to an amorphous silicon film. By such an amorphous silicon film and a halogen atom, it is possible to effectively prevent fluorine atoms from diffusing into the polysilicon film during formation of the tungsten silicide layer. Accordingly, the characteristics of the gate oxide film can be improved by preventing the thickness change of the gate oxide film due to the diffusion of the fluorine atoms, thereby improving the reliability of the device.
이하, 첨부된 도면을 참조하여 본 발명의 실시예를 설명한다.Hereinafter, with reference to the accompanying drawings will be described an embodiment of the present invention.
도 1a 내지 도 1d는 본 발명의 일 실시예에 따른 폴리사이드 구조를 갖는 반도체 디바이스의 게이트 형성방법을 설명하기 위한 단면도이다.1A to 1D are cross-sectional views illustrating a gate forming method of a semiconductor device having a polyside structure according to an exemplary embodiment of the present invention.
도 1a를 참조하면, 반도체 기판(50) 상에 게이트 산화막(51) 및 폴리실리콘막(52)을 순차적으로 형성한다. 이때, 게이트 산화막(51)은 90 내지 110Å의 두께로 형성하고, 폴리실리콘막(52)은 1,300 내지 1,700Å의 두께로 형성한다. 그런 다음, 폴리실리콘막(52)에 대한 POCl3도핑을 실시하고, 50:1 비율의 초순수 : HF의 제 1 혼합액에서 190 내지 210초 동안 세정하여, 폴리실리콘막(52) 상에 형성되어 있는 소정의 자연산화막(미도시)을 제거하고, 초순수에서 세척한다. 이어서, 25 내지 35℃의 온도의 1:1:5 비율의 초순수 : H2O2: NH4OH 의 제 2 혼합액에서 10 내지 20분 동안 세정하고, 초순수에서 세척한 후 건조시켜, 폴리실리콘막(52) 상에 잔재하는 불순물등을 완전히 제거한다. 이때, 폴리실리콘막(52)은 100 내지 200Ω/?의 면저항을 갖게 된다.Referring to FIG. 1A, a
도 1b를 참조하면, 폴리실리콘막(52) 상에 이후 불소 원자의 확산을 방지하기 위한 제 1 확산방지막으로서, 비정질 실리콘막(53)을 50 내지 500Å의 두께로 형성한다. 이때, 비정질 실리콘막(53)은 SiCl2H2또는 SiH4개스를 이용하여 200 내지 400 mTorr의 압력과, 400 내지 550℃의 온도하에서 형성한다. 비정질 실리콘막(53)은 결정립계가 존재하기 않기 때문에, 이후 텅스텐 실리사이드층 형성에서 발생되는 불소 원자가 결정립계를 통해 확산되는 것을 방지할 수 있다.Referring to FIG. 1B, an
그런 다음, 불소원자보다 원자의 크기가 큰 염소(Cl), 브롬(Br), 요오드(I)를 포함하는 할로겐 원자의 그룹으로부터 선택되는 하나의 원자를 비정질 실리콘막(53) 및 폴리실리콘막(52)의 표면에 이온주입하여, 비정질 실리콘막(53) 및 폴리실리콘막(52)의 표면에 제 2 확산방지막으로서 할로겐 이온주입층(+)을 형성한다. 이때, 상기 이온주입은 10 내지 30KeV의 에너지와, 1×1013내지 1×1017원자/㎠의 농도로 실시한다. 할로겐 이온주입층(+)은 비정질 실리콘막(53) 및 폴리실리콘막(52) 내에서 실리콘-할로겐 원자의 결합을 형성하여, 이후 텅스텐 실리사이드층 형성에서 발생되는 불소 원자가 폴리실리콘막(52)으로 확산하는 것을 억제한다. 즉, 제 1 확산방지막인 비정질 실리콘(53)막과 제 2 확산방지막인 할로겐 이온주입층(+)의 이중 확산방지막에 의해, 이후 텅스텐 실리사이드층 형성시 발생되는 불소 원자가 폴리실리콘막(52)으로 확산하는 것을 효과적으로 방지할 수 있다.Then, one atom selected from the group of halogen atoms including chlorine (Cl), bromine (Br), and iodine (I) having an atom larger in size than the fluorine atom is selected from the
도 1c를 참조하면, 도 1B의 구조를 갖는 기판 전면을 HF 증기를 이용하여 세정하고 초순수 내에서 N2개스를 분사하면서 기판 전면을 세척하고 건조시킨다. 그런 다음, 비정질 폴리실리콘막(53) 상에, 390 내지 440℃의 온도와, 0.5 내지 1.0 Torr의 압력과, 350 내지 450 SCCM의 SiH4개스와, 4.0 내지 5.0 SCCM의 WF6개스를 이용하여, 텅스텐 실리사이드층(54)을 1,200 내지 2,000Å의 두께로 형성한다. 이때, 텅스텐 실리사이드층(54)은 50 내지 65Ω/?의 면저항을 갖는다. 그런 다음, 텅스텐 실리사이드층(54) 상에, 1 내지 2 Torr의 압력과, 350 내지 450℃의 온도와, 190 내지 210 SCCM의 SiH4개스와, 1,100 내지 1,300 SCCM의 N2O 개스와, 1,900 내지 2,100 SCCM의 NH3개스와, 2,900 내지 3,100 SCCM의 N2개스를 이용하여, 산화질화막(55)을 형성한다. 이때, 산화질화막(55)은 300 내지 600Å의 두께로 형성하고, 이 산화질화막(55)은 이후 패터닝 공정시 난반사 방지막으로서 작용한다.Referring to FIG. 1C, the front surface of the substrate having the structure of FIG. 1B is cleaned using HF vapor, and the front surface of the substrate is washed and dried while spraying N 2 gas in ultrapure water. Then, on the
도 1d를 참조하면, 포토리소그라피에 의해 산화질화막(55) 상에 마스크 패턴(미도시)이 형성한다. 상기 마스크 패턴을 이용하여 산화질화막(55), 텅스텐 실리사이드층(54), 비정질 실리콘막(53), 폴리실리콘막(52) 및 게이트 산화막(51)을 식각하여 게이트 전극을 형성한다. 그런 다음, 공지된 방법으로 상기 마스크 패턴을 제거한다.Referring to FIG. 1D, a mask pattern (not shown) is formed on the
상기 실시예에 의하면, 폴리실리콘막(52)에 제 1 확산방지막인 비정질 실리콘(53)막과 제 2 확산방지막인 할로겐 이온주입층(+)의 이중 확산방지막을 형성함으로써, 텅스텐 실리사이드층 형성시 발생되는 불소 원자가 폴리실리콘막(52)으로 확산하는 것을 효과적으로 방지할 수 있다.According to the above embodiment, when the tungsten silicide layer is formed by forming a double diffusion barrier film of the
한편, 상기 일 실시예에서는 제 2 확산방지막으로서 할로겐 이온주입층(+)을 폴리실리콘막(52) 및 비정질 실리콘막(53)에 별도로 형성하였으나, 이러한 할로겐 이온주입층(+)을 별도로 형성하지 않고, 비정질 실리콘막(53)의 형성시 비정질 실리콘막(53)이 할로겐 원자를 함유하도록 하여, 불소 원자의 확산을 효과적으로 방지할 수 있다.Meanwhile, in the above embodiment, the halogen ion implantation layer (+) is separately formed on the
즉, 도 1a에서의 공정 후, 폴리실리콘막(52) 상에 비정질 실리콘막(53)을 형성하는데, 이때 비정질 실리콘막(53)을 불소원자보다 원자의 크기가 큰 염소(Cl), 브롬(Br), 요오드(I)를 포함하는 할로겐 원자의 그룹으로부터 선택되는 하나의 원자를 분위기 개스로 하고, SiCl2H2또는 SiH4개스를 소오스 개스로 하여, 200 내지 400 mTorr 의 압력과, 400 내지 550℃의 온도하에서 형성한다. 이에 따라, 비정질 실리콘막(53)에 할로겐 원자가 첨가되어, 텅스텐 실리사이드층(54)의 형성시 발생되는 불소 원자가 폴리실리콘막(52)으로 확산되는 것을 효과적으로 방지할 수 있다.That is, after the process shown in FIG. 1A, an
상기한 본 발명에 의하면, 폴리실리콘막과 텅스텐 실리사이드막의 적층 구조인 폴리사이드 구조의 게이트 전극 형성에서, 폴리실리콘막과 텅스텐 실리사이드막 사이에 결정립계가 없는 비정질 실리콘막을 형성함과 더불어 폴리실리콘막과 비정질 실리콘막에 할로겐 이온층을 형성하거나, 비정질 실리콘막에 할로겐 원자를 첨가한다. 이러한 비정질 실리콘막 및 할로겐 원자에 의해, 텅스텐 실리사이드층의 형성시 불소 원자가 폴리실리콘막으로 확산되는 것을 효과적으로 방지할 수 있다. 이에 따라, 불소 원자의 확산으로 인한 게이트 산화막의 두께변화를 방지함으로써 게이트 산화막의 특성을 향상시킬 수 있으므로, 결국 소자의 신뢰성을 향상시킬 수 있다.According to the present invention described above, in forming a gate electrode having a polyside structure, which is a laminated structure of a polysilicon film and a tungsten silicide film, an amorphous silicon film having no grain boundary is formed between the polysilicon film and the tungsten silicide film, and the polysilicon film and the amorphous film A halogen ion layer is formed in a silicon film, or a halogen atom is added to an amorphous silicon film. By such an amorphous silicon film and a halogen atom, it is possible to effectively prevent fluorine atoms from diffusing into the polysilicon film during formation of the tungsten silicide layer. Accordingly, the characteristics of the gate oxide film can be improved by preventing the thickness change of the gate oxide film due to the diffusion of the fluorine atoms, thereby improving the reliability of the device.
또한, 본 발명은 상기 실시예에 한정되지 않고, 본 발명의 기술적 요지를 벗어나지 않는 범위내에서 다양하게 변형시켜 실시할 수 있다.In addition, this invention is not limited to the said Example, It can variously deform and implement within the range which does not deviate from the technical summary of this invention.
Claims (13)
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KR1019970057972A KR100260364B1 (en) | 1997-11-04 | 1997-11-04 | Method for forming a gate electrode having polycide structure in a semiconductor device |
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