KR0141417B1 - Method of dry dtching for semiconductor compound the periodic table iii-v - Google Patents

Method of dry dtching for semiconductor compound the periodic table iii-v

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Abstract

본 발명은 건식공정에 의한 주기율표 Ⅲ-Ⅴ족 화합물 반도체의 에칭방법으로서, 반도체의 열해리증발 온도 이상의 반도체 기판온도에서, 에칭제로서 트리알킬인듐 가스와 과산화수소 가스를 다같이 사용하는 반도체의 에칭방법에 관한 것이다.The present invention relates to a method of etching a III-V compound semiconductor of the periodic table by a dry process, the method of etching a semiconductor using both trialkylindium gas and hydrogen peroxide gas as an etchant at a semiconductor substrate temperature equal to or higher than the thermal dissociation evaporation temperature of the semiconductor. It is about.

본 발명에 따라 에칭제로서 트리알킬인듐 가스와 과산화수소 가스의 이용은 이들을 사용하는 금속 유기물 분자선에피탁시 장치나 화학빔에피탁시 장치와 함께 인라인 또는 인시투로 반도체의 선택적 에칭공정에서 유력한 에칭제로 활용될 수 있다.According to the present invention, the use of trialkylindium gas and hydrogen peroxide gas as an etchant may be used as a potent etchant in the selective etching process of semiconductors in-line or in situ together with a metal organic molecular beam epitaxy device or a chemical beam epitaxy device using them. Can be utilized.

Description

주기율표 Ⅲ-Ⅴ족 화합물 반도체의 건식 에칭방법Dry etching method of group III-V compound semiconductor of the periodic table

제1도는 갈륨비소 화합물 반도체 기판을 기판 온도 600℃에서 과산화수소와 트리메틸인듐 가스로 패턴 에칭한 후 그 결과를 도시한 도면 ((A)는 노말스키 광학현미경 사진, (B)는 깊이 프로파일러로 측정한 프로파일).FIG. 1 is a pattern etching process of a gallium arsenide compound semiconductor substrate with hydrogen peroxide and trimethylindium gas at a substrate temperature of 600 ° C., and shows the result ((A) is a photograph of a Normalsky optical microscope and (B) is measured by a depth profiler). One profile).

제2도는 갈륨비소 화합물 반도체 기판을 온도 650℃에서 과산화수소 가스만으로 또는 과산화수소와 트리메틸인듐 가스로 패턴 에칭한 후 그 결과를 각각 제 1도와 같이 노말스키 광학현미경 사진과 에칭 프로파일로 도시한 도면((A)는 과산화수소와 트리메틸인듐 가스로 에칭한 경우,FIG. 2 is a pattern etching of a gallium arsenide compound semiconductor substrate with only hydrogen peroxide gas or with hydrogen peroxide and trimethylindium gas at a temperature of 650 ° C., and the results are shown in a normal photomicrograph and an etching profile as shown in FIG. 1 ((A ) Is etched with hydrogen peroxide and trimethylindium gas,

(B)는 과산화수소 가스만으로 에칭한 경우).(B) is etched only with hydrogen peroxide gas).

본 발명은 주기율표 Ⅲ-Ⅴ족 화합물 반도체의 에칭방법에 관한 것이다. 특히 본 발명은 건식공정에 의한 주기율표 Ⅲ-Ⅴ족 화합물반도체의 에칭방법으로서, 반도체의 열해리증발온도 이상의 반도체 기판온도에서 에칭제(etchant)로서 트리알킬인듐 가스와 과산화수소 가스를 다같이 사용하는 것으로 이루어진 반도체의 에칭방법에 관한 것이다.The present invention relates to a method of etching a III-V compound semiconductor of the periodic table. In particular, the present invention relates to a method of etching a compound group III-V compound semiconductor of the periodic table by a dry process, wherein both trialkylindium gas and hydrogen peroxide gas are used as an etchant at a semiconductor substrate temperature above the thermal dissociation evaporation temperature of the semiconductor. A method for etching a semiconductor.

반도체 재료의 선택적 에칭 기술은 양자선(quantum wire) 또는 양자점(quantum point)과 같은 3차선 구조의 신기능 소자 개발을 위해 필수적인 기술중의 한가지이며, 또한 최근 다중 챔버 초고진공장치(multi-chamber UHV system)의 개발로 반도체 시편의 대기 노출없이고 인시투(in-situ)공정에 의한 수직 적층형 양자구조(quantum structure)형성에 대해 많은 노력이 경주되고 있어서, 이러한 에칭 기술의 필요성이 더욱 증대되고 있다.Selective etching of semiconductor materials is one of the essential technologies for the development of new functional devices of three-wire structure such as quantum wire or quantum point, and also recently, multi-chamber UHV system As a result of the development of HF), many efforts have been made to form a vertically stacked quantum structure by an in-situ process without exposing the semiconductor specimen to the atmosphere, thereby increasing the need for such an etching technique.

종래에는 인시루 공정에 의한 선택적 에칭 기술로서 갈륨산화막에 집속 전자빔이나 이온빔(FIB)을 조사한후 염소 가스(Cl2gas)에 노출시켜 패턴(pattern)에칭을 수행하는 기술이 알려져 있으나, 이 방법은 염소 가스 이용으로 인해 챔버내 부식성 문제와 인듐산화막과 같은 마스크 재료에 대해 취약성을 야기시키는 등의 문제가 발생된다.Conventionally, as a selective etching technique by an in-situ process, a technique of performing pattern etching by irradiating a focused electron beam or an ion beam (FIB) to a chlorine gas (Cl 2 gas) after irradiating a gallium oxide film is known. The use of chlorine gas creates problems such as corrosive problems in the chamber and vulnerability to mask materials such as indium oxide films.

본 발명에서는 이러한 인시투 에칭 공정을 위한 에칭제로서 과산화수소와 트리알킬인듐 가스를 다같이 사용하고 반도체의 기판온도를 변화시킴으로서 간단히 반도체를 에칭할 수 있는 기술을 발견하기에 이르렀다.In the present invention, a technique for easily etching a semiconductor has been found by using both hydrogen peroxide and trialkylindium gas as an etchant for the in-situ etching process and changing the substrate temperature of the semiconductor.

따라서 본 발명의 목적은 건식 공정에 의한 주기율표 Ⅲ-Ⅴ족 화합물 반도체의 에칭방법으로서, 반도체의 열해리증발온도 이상의 반도체 기판 온도에서 에칭제(etchant)로서 트리알킬인듐 가스와 과산화수소 가스를 다같이 사용하는 것으로 이루어진 반도체의 에칭방법을 제공하는 것이다.Accordingly, an object of the present invention is to provide a method of etching a group III-V compound semiconductor of the periodic table by a dry process, using both trialkylindium gas and hydrogen peroxide gas as an etchant at a temperature of a semiconductor substrate above the thermal dissociation evaporation temperature of the semiconductor. It is an object of the present invention to provide a method for etching a semiconductor.

본 발명의 일예에 따라, 반도체 재료는 주기율표 Ⅲ-Ⅴ족 원소로 구성된 화합물 반도체이며, 이들중 갈륨비소 또는 인듐인이 바람직하다.According to one embodiment of the invention, the semiconductor material is a compound semiconductor composed of group III-V elements of the periodic table, of which gallium arsenide or indium is preferable.

본 발명의 다른 일예에 따라, 에칭제로서 과산화수소 가스와 동시에 사용되는 트리알킬인듐 가스는 금속 유기물 분자선 에피탁시(metal organic molecular beam epitaxy)장치나 화학빔 에피탁시(chemical beam epitaxy)장치에서 반도체에피성장용 유기금속물증의 한가지로서 사용되고 있다. 이 트리알킬인듐 가스는 트리메틸인듐 또는 트리에틸인듐 가스가 바람직하다.According to another embodiment of the present invention, trialkylindium gas used simultaneously with hydrogen peroxide gas as an etchant is a semiconductor in a metal organic molecular beam epitaxy device or a chemical beam epitaxy device. It is used as one of epitaxial organometallics. The trialkyl indium gas is preferably trimethyl indium or triethyl indium gas.

본 발명의 또다른 일예에 따라, 반도체의 열해리증발온도 이상의 반도체 기판온도를 유지함이 바람직하다. 이와 같은 사실은 반도체인 갈륨비소의 경우 열해리증발온도 582℃이므로 반도체 기판온도는 582℃이상으로 하고, 인듐인의 경우는 열해리증발온도가 360℃이므로 그 이상의 온도로 유지함이 바람직하다.According to another embodiment of the present invention, it is preferable to maintain the semiconductor substrate temperature above the thermal dissociation evaporation temperature of the semiconductor. The fact is that in the case of gallium arsenide as a semiconductor, the thermal dissociation evaporation temperature is 582 ° C., so that the semiconductor substrate temperature is 582 ° C. or higher.

이와 같은 Ⅲ-Ⅴ족 화합물 반도체 재료의 에칭 공정은 다음 반응식의 과산화수소 가스에 의한 화학반응, 즉 Ⅲ족 금속의 산화치환 증발로 이루어진다 :The etching process of the group III-V compound semiconductor material consists of a chemical reaction by hydrogen peroxide gas of the following reaction formula, that is, the oxidation substitution evaporation of the group III metal:

2Ⅲ-Ⅴ+H2O2→ Ⅲ2O ↑ + V2↑ + H2O↑2III-V + H 2 O 2 → Ⅲ 2 O ↑ + V 2 ↑ + H 2 O ↑

(여기서, Ⅲ은 Ga, In 등이고, V는 As, P등을 나타냄).(III is Ga, In, etc., V represents As, P, etc.).

또한, 과산화수소 가스와 트리알킬인듐 가스를 동시에 사용함으로서 반도체 재료의 열해리증발온도 이상에서 형성되는 인듐산화막(In2O3)의 증착과 이 산화막에 의한 반도체 표면의 산화치환에 따른 원소 증발로 이루어지며, 이들 반응식은 다음과 같다 :In addition, by using hydrogen peroxide gas and trialkyl indium gas simultaneously, deposition of indium oxide film (In 2 O 3 ) formed above the thermal dissociation evaporation temperature of the semiconductor material and elemental evaporation due to oxidation substitution of the semiconductor surface by the oxide film. These schemes are as follows:

2In + 3H2O2→ In2O3+ 3H2O ↑ 및2In + 3H 2 O 2 → In 2 O 3 + 3H 2 O ↑ and

In2O3+ 4Ⅲ-Ⅴ → In2O ↑ + 2Ⅲ2O ↑ + 2Ⅴ2In 2 O 3 + 4Ⅲ-Ⅴ → In 2 O ↑ + 2Ⅲ 2 O ↑ + 2Ⅴ 2

(여기서, Ⅲ과 Ⅴ는 이전에 정의된 것과 같음)Where III and V are as previously defined

이와 같이 본 발명은 에칭제로서 과산화수소 가스와 트리알킬인듐 가스를 동시에 사용함으로서 과산화수소 가스에 의한 반도체 에칭 작용과 이들 가스로부터 형성된 인듐산화막에 의한 반도체 표면의 에칭 작용이 동시에 일어난다.As described above, according to the present invention, by using hydrogen peroxide gas and trialkyl indium gas simultaneously as an etchant, the semiconductor etching action by the hydrogen peroxide gas and the etching action of the semiconductor surface by the indium oxide film formed from these gases occur simultaneously.

본 발명을 실시예에 의해 보다 상세하게 설명하면 다음과 같다.The present invention will be described in more detail with reference to the following Examples.

본 실시예에서 반도체 웨이퍼의 에칭 마스크는 오염 레지스트(contamination resist)로 알려진 카본 필름을 사용한다. 이 카본 필름을 반도체 웨이퍼 표면위에 증착시켜(약 50이하) 상온에서 트리알킬인듐 가스 분위기에서 집속 전자빔을 조사함으로서 마스크 패턴을 쉽게 형성할 수 있다. 따라서 주기율표 Ⅲ-Ⅴ족 화합물 반도체 표면에 원하는 규격으로 마스크 패턴을 형성하여 본 실시예에 이용한다.The etching mask of the semiconductor wafer in this embodiment uses a carbon film known as a contamination resist. The mask pattern can be easily formed by depositing the carbon film on the surface of the semiconductor wafer (about 50 or less) and irradiating a focused electron beam in a trialkylindium gas atmosphere at room temperature. Therefore, a mask pattern is formed on the surface of the III-V compound semiconductor of the periodic table in a desired standard and used in this embodiment.

[실시예 1]Example 1

갈륨비소 반도체의 깨끗한 기판 표면에 카본 필름의 에칭마스크를 제작한 다음, 인시투 공정으로 과산화수소와 트리메틸인듐 가스를 유입시켜 반도체 재료를 에칭하였다. 이때 카본 마스크 패턴의 폭과 간격을 각각 10㎛로부터 1㎛까지 형성시켰으며, 반도체 기판의 온도는 600℃이었고, 과산화수소와 트리메틸인듐 가스의 유량은 각각 2.0×10-8mol/s와 1.2×10-9mol/s로 하였다. 에칭후 반도체 기판의 표면 상태를 노말스키 광학현미경 사진과 에칭 프로파일로 나타내어 확인하였다. 그 결과를 제1도에 제시한다.An etching mask of a carbon film was prepared on the clean substrate surface of the gallium arsenide semiconductor, and then the semiconductor material was etched by introducing hydrogen peroxide and trimethylindium gas in an in-situ process. At this time, the width and spacing of the carbon mask pattern were formed from 10 μm to 1 μm, respectively, and the temperature of the semiconductor substrate was 600 ° C., and the flow rates of hydrogen peroxide and trimethylindium gas were 2.0 × 10 −8 mol / s and 1.2 × 10, respectively. It was set to -9 mol / s. The surface state of the semiconductor substrate after the etching was confirmed by normalsky optical micrographs and etching profiles. The results are shown in FIG.

제1도는 카본 마스크 패턴(1)을 가진 갈륨비소 반도체 기판(2)의 에칭후 전형적인 모습을 도시한 것이며, 제1A도의 노말스키 광학현미경 사진으로부터 1㎛의 패턴폭(3)과 패턴간격(4)이 양호하게 분리형성되었음을 알 수 있었다. 또한, 제1B도의 에칭 프로파일로부터 에칭경사도(steepness)(5)가 잘 나타나 있음을 알 수 있었다. 이 때 에칭율은 약 1200Å/hr로서 양호하였다.FIG. 1 shows a typical state after etching of a gallium arsenide semiconductor substrate 2 having a carbon mask pattern 1, and a pattern width 3 and a pattern spacing (4) of 1 탆 from a Normalsky optical micrograph of FIG. 1A. ) Showed good separation. In addition, it can be seen from the etching profile of FIG. 1B that the etching slope 5 is shown well. At this time, the etching rate was good as about 1200 Pa / hr.

[실시예 2]Example 2

반도체 기판온도를 650℃로 한 것을 제외하고, 실시예 1과 동일한 방식으로 에칭하였고, 그 결과를 노말스키 광학현미경 사진과 에칭 프로파일로서 제 2A도에 제시한다.Etching was carried out in the same manner as in Example 1 except that the semiconductor substrate temperature was set at 650 ° C., and the results are shown in FIG.

[비교예 1]Comparative Example 1

과산화수소와 트리메틸인듐 가스 대신에 과산화수소 가스만을 사용한 것을 제외하고, 실시예 2와 동일한 방식으로 에칭하였고, 그 결과를 노말스키 광학현미경 사진과 에칭 프로파일로서 제2B도에 제시한다.Etching was performed in the same manner as in Example 2, except that only hydrogen peroxide gas was used instead of hydrogen peroxide and trimethylindium gas, and the results are shown in FIG. 2B as a Normalsky micrograph and etching profile.

제 2도는 패턴 간격(6) 10㎛에서 패턴폭(7) 10㎛ 및 5㎛의 노말스키 광학현미경 사진과 에칭 프로파일을 도시하여 실시예 2와 비교예 1의 결과를 비교한 도면으로서, 제2A도는 실시예 2의 결과를 나타내고 제 2B도는 비교예 1의 결과를 나타낸다. 제2도로부터 에칭율을 비교하면, 각각 약 2400Å/hr 및 약 650Å/hr로서, 본 발명에 따른 실시예 2의 방법이 비교예 1의 방법 보다 무려 4배 이상 높은 에칭율을 나타냈다. 한편, 제2도에서 에칭 패턴의 가장 자리 변화(8)는 전자빔 주사시의 흔들림에 따른 카본 패턴의 변화에 기인된 것이다. 또한, 이 온도에서 갈륨비소의 열해리 증발에 따른 효과는 에칭율로서 약 60Å/hr이나, 상기 에칭율에 비해 무시할 정도이다.FIG. 2 shows the results of Example 2 and Comparative Example 1, showing a Normalsky optical microscope photograph and an etching profile of pattern width (7) 10 μm and 5 μm at a pattern spacing (6) of 10 μm. Figure 2 shows the result of Example 2 and Figure 2B shows the result of Comparative Example 1. Comparing the etching rates from FIG. 2, the etching rate was about 2400 kPa / hr and about 650 kPa / hr, respectively, and the method of Example 2 according to the present invention showed an etching rate at least four times higher than that of Comparative Example 1. On the other hand, the edge change 8 of the etching pattern in FIG. 2 is due to the change of the carbon pattern due to the shaking during the electron beam scanning. The effect of thermal dissociation evaporation of gallium arsenide at this temperature is about 60 kW / hr as the etching rate, but negligible compared to the etching rate.

따라서, 본 발명에 따른 방법에 의해 에칭제로서 과산화수소와 트리알킬인듐 가스를 동시에 사용함으로서 에칭유이 더욱 증가되며, 이로서 이를 제어하기가 용이해진다.Thus, by simultaneously using hydrogen peroxide and trialkylindium gas as the etchant by the method according to the invention, the etching oil is further increased, thereby facilitating control thereof.

이와 같이 본 발명을 통해 주기율표 ⅢⅤ족 화합물 반도체에 대한 에칭제로서 트리알킬인듐 가스와 과산화수소 가스의 이용은 이들을 사용하는 금속 유기물 분자선에피탁시 장치나 화학빔에피탁시 장치와 함께 인라인 또는 인시투로 반도체의 선택적 에칭공정에서 유력한 에칭제로 활용될 수 있음을 보여주는 것이다.As described above, the use of trialkylindium gas and hydrogen peroxide gas as an etchant for the Group IIIV compound semiconductor of the periodic table can be performed in-line or in situ together with a metal organic molecular beam epitaxy device or a chemical beam epitaxy device using them. It can be used as a potent etchant in the selective etching process of semiconductors.

Claims (4)

건식공정에 의한 주기율표 Ⅲ-Ⅴ족 화합물 반도체의 에칭방법으로서, 반도체의 열해리증발 온도 이상의 반도체 기판온도에서, 에칭제로서 트리알킬인듐 가스와 과산화수소 가스를 다같이 사용하는 것이 특징인 반도체의 에칭방법.A method of etching a III-V compound periodic table of the periodic table by a dry process, wherein a trialkylindium gas and a hydrogen peroxide gas are both used as an etchant at a semiconductor substrate temperature equal to or higher than the thermal dissociation evaporation temperature of the semiconductor. 제1항에 있어서, 반도체가 갈륨비소 또는 인듐인인 것이 특징인 에칭방법.The etching method according to claim 1, wherein the semiconductor is gallium arsenide or indium. 제1항에 있어서, 트리알킬인듐이 트리메틸인듐 및 트리에틸인듐 중에서 선택되는 것이 특징인 에칭방법.The etching method according to claim 1, wherein the trialkyl indium is selected from trimethyl indium and triethyl indium. 제1항에 있어서, 반도체가 갈륨비소인 경우는 582℃이상, 인듐인인 경우는 360℃이상으로 기판온도를 유지하는 것이 특징인 에칭방법.The etching method according to claim 1, wherein the substrate is maintained at 582 占 폚 or higher when the semiconductor is gallium arsenide, or 360 占 폚 or higher when the semiconductor is indium.
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