JPWO2021042107A5 - - Google Patents

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物理層デバイスであって、
信号をスレッショルドと比較するように構成されたコンパレータであって、前記信号は、有線ローカルエリアネットワークの共有伝送媒体から受信される、コンパレータと、
信号品質インジケータ(SQI)回路であって、
複数の異なる期間中に、複数の異なるスレッショルドに対応する前記コンパレータの出力のビット誤り率を取得するために、前記スレッショルドを調整することであって、前記複数の異なるスレッショルドは前記複数の異なる期間に対応する、調整することと、 前記複数の異なるスレッショルドのための前記ビット誤り率に基づいて前記信号の信号対ノイズ比(SNR)を決定することと、を行うように構成されている、SQI回路と、を含む、物理層デバイス。
A physical layer device,
a comparator configured to compare a signal to a threshold, said signal being received from a shared transmission medium of a wired local area network;
A signal quality indicator (SQI) circuit, comprising:
adjusting the threshold to obtain bit error rates of the output of the comparator corresponding to a plurality of different thresholds during a plurality of different time periods , wherein the plurality of different thresholds are during the plurality of different time periods; an SQI circuit configured to correspondingly adjust and determine a signal-to-noise ratio (SNR) of the signal based on the bit error rate for the plurality of different thresholds . and, including, physical layer devices.
前記SQI回路は、
前記スレッショルドを第1の値に調整し、第1の期間中の前記コンパレータの前記出力の第1のビット誤り率を取得することと、
前記スレッショルドを第2の値に調整し、第2の期間中の前記コンパレータの前記出力の第2のビット誤り率を取得することと、
前記第1のビット誤り率及び前記第2のビット誤り率に基づいて前記信号の前記SNRを決定することと、を行うように構成されている、請求項1に記載の物理層デバイス。
The SQI circuit is
adjusting the threshold to a first value to obtain a first bit error rate of the output of the comparator during a first time period;
adjusting the threshold to a second value to obtain a second bit error rate of the output of the comparator during a second time period;
and determining the SNR of the signal based on the first bit error rate and the second bit error rate.
前記共有伝送媒体から受信された前記信号を処理するように構成された受信回路を更に含む、請求項1に記載の物理層デバイス。 2. The physical layer device of claim 1, further comprising receiving circuitry configured to process the signal received from the shared transmission medium. 前記受信回路は、前記信号を中間スレッショルドレベルと比較するように構成された受信コンパレータを含み、前記中間スレッショルドレベルは、前記信号の論理レベル高と論理レベル低との間の中間である、請求項に記載の物理層デバイス。 3. The receiving circuit of claim 1, wherein the receiving circuit includes a receiving comparator configured to compare the signal to an intermediate threshold level, the intermediate threshold level being midway between a logic level high and a logic level low of the signal. 4. The physical layer device of claim 3 . 前記SQI回路は、前記信号の前記SNRに基づいて前記信号のビット誤り率(BER)を決定するように更に構成されている、請求項1に記載の物理層デバイス。 2. The physical layer device of claim 1, wherein the SQI circuitry is further configured to determine a bit error rate (BER) of the signal based on the SNR of the signal. 変換データが記憶されているデータ記憶デバイスを更に含み、前記変換データは、複数のSNR値と、前記複数のSNR値に対応する複数のBER値と、を含み、前記SQI回路は、前記複数のSNR値から、前記信号の前記決定されたSNRに最も近い、前記SNR値のうちの1つを特定することによって前記信号の前記BERを決定し、前記複数のBER値からの対応するBERを前記信号の前記BERとして選択するように構成されている、請求項に記載の物理層デバイス。 further comprising a data storage device in which transform data is stored, the transform data including a plurality of SNR values and a plurality of BER values corresponding to the plurality of SNR values; From the SNR values, determine the BER of the signal by identifying one of the SNR values that is closest to the determined SNR of the signal, and determine the corresponding BER from the plurality of BER values. 6. The physical layer device of claim 5 , configured to select as the BER of a signal. 変換データが記憶されているデータ記憶デバイスを更に含み、前記変換データは、複数のSNR値と、前記複数のSNR値に対応する複数の対のビット誤り率(BER)値と、を含み、前記SQI回路は、第1のビット誤り率及び第2のビット誤り率に最も近いBER対に対応する、前記複数のSNR値のうちの1つを選択することによって前記信号の前記SNRを決定するように構成されている、請求項1に記載の物理層デバイス。 further comprising a data storage device in which transformed data is stored, said transformed data comprising a plurality of SNR values and a plurality of pairs of bit error rate (BER) values corresponding to said plurality of SNR values; The SQI circuit is adapted to determine the SNR of the signal by selecting one of the plurality of SNR values corresponding to a BER pair closest to a first bit error rate and a second bit error rate. 2. The physical layer device of claim 1, wherein the physical layer device is configured to: 前記物理層デバイスは、前記信号の前記SNRを含むSQI情報を、前記共有伝送媒体を介して前記有線ローカルエリアネットワークに報告するように構成されている、請求項1に記載の物理層デバイス。 2. The physical layer device of claim 1, wherein the physical layer device is configured to report SQI information including the SNR of the signal to the wired local area network via the shared transmission medium. 前記SQI回路は、搬送波感知多重アクセス/衝突検出(CSMA/CD)モード又は物理層衝突回避モードのうちの1つで前記信号の前記SNRを決定するように構成されている、請求項1に記載の物理層デバイス。 2. The SQI circuit of claim 1, wherein the SQI circuit is configured to determine the SNR of the signal in one of a carrier sense multiple access/collision detection (CSMA/CD) mode or a physical layer collision avoidance mode. physical layer device. 前記SQI回路は、複数の異なる送信者から受信された信号のSNRを決定するように構成されている、請求項1に記載の物理層デバイス。 2. The physical layer device of claim 1, wherein the SQI circuitry is configured to determine SNRs of signals received from multiple different senders. 前記SQI回路は、前記信号が所定の特定の送信者から受信されたと判定された場合に、前記信号の前記SNRを決定するように構成されている、請求項1に記載の物理層デバイス。 2. The physical layer device of claim 1, wherein the SQI circuitry is configured to determine the SNR of the signal when the signal is determined to have been received from a given particular sender. 物理層デバイスであって、前記物理層デバイスは、A physical layer device, the physical layer device comprising:
信号をスレッショルドと比較するように構成されたコンパレータであって、前記信号は、有線ローカルエリアネットワークの共有伝送媒体から受信される、コンパレータと、a comparator configured to compare a signal to a threshold, said signal being received from a shared transmission medium of a wired local area network;
前記信号を追加のスレッショルドと比較するように構成された追加のコンパレータと、含み、an additional comparator configured to compare the signal to an additional threshold;
SQI回路であって、前記SQI回路は、An SQI circuit, the SQI circuit comprising:
前記スレッショルドを調整し、複数の異なるスレッショルドに対応する前記コンパレータの出力のビット誤り率を取得することと、adjusting the threshold to obtain bit error rates of the output of the comparator corresponding to a plurality of different thresholds;
前記スレッショルドを第1の値に調整し、期間中の前記コンパレータの前記出力の第1のビット誤り率を取得することと、adjusting the threshold to a first value to obtain a first bit error rate of the output of the comparator during a period of time;
前記追加のスレッショルドを第2の値に調整し、前記期間中の前記追加のコンパレータの出力の第2のビット誤り率を取得することと、adjusting the additional threshold to a second value to obtain a second bit error rate of the output of the additional comparator during the time period;
前記第1のビット誤り率及び前記第2のビット誤り率に基づいて前記信号の信号ノイズ比(SNR)を決定することと、を行うように構成されている、SQI回路と、を含む物理層デバイス。a SQI circuit configured to: determine a signal-to-noise ratio (SNR) of the signal based on the first bit error rate and the second bit error rate. device.
信号の信号対ノイズ比(SNR)を推定する方法であって、
物理層デバイスのコンパレータのスレッショルドを第1の値に設定するステップと、
前記コンパレータに信号を印加するステップであって、前記信号は、有線ローカルエリアネットワークの通信バスから受信され、前記通信バスは共有伝送媒体を含む、ステップと、
前記スレッショルドが前記第1の値に設定されている前記コンパレータの出力の第1のビット誤り数を決定するステップと、
前記コンパレータの前記スレッショルドを前記第1の値とは異なる第2の値に設定するステップと、
前記コンパレータに前記信号を印加するステップと、
前記スレッショルドが前記第2の値に設定されている前記コンパレータの前記出力の第2のビット誤り数を決定するステップと、
前記第1のビット誤り数及び前記第2のビット誤り数に基づいて前記信号のSNRを決定するステップと、を含む、方法。
A method of estimating the signal-to-noise ratio (SNR) of a signal, comprising:
setting a threshold of a comparator of the physical layer device to a first value;
applying a signal to the comparator, the signal being received from a communication bus of a wired local area network, the communication bus comprising a shared transmission medium;
determining a first number of bit errors in the output of the comparator with the threshold set to the first value;
setting the threshold of the comparator to a second value different from the first value;
applying the signal to the comparator;
determining a second number of bit errors in the output of the comparator with the threshold set to the second value;
determining an SNR of the signal based on the first number of bit errors and the second number of bit errors.
前記決定されたSNRに基づいて前記信号のビット誤り率を決定するステップを更に含む、請求項13に記載の方法。 14. The method of claim 13, further comprising determining a bit error rate of said signal based on said determined SNR. 複数のSNRに対応する複数のビット誤り率を含む変換データを記憶するステップを更に含み、前記信号のビット誤り率を決定するステップは、前記記憶された変換データを参照することを含む、請求項14に記載の方法。 4. The claim further comprising storing transform data comprising a plurality of bit error rates corresponding to a plurality of SNRs, wherein determining a bit error rate of said signal comprises referencing said stored transform data. 14. The method according to 14. データ記憶デバイスに、第1のビット誤り数と第2のビット誤り数との組み合わせに対応する複数のSNRを含む変換データを記憶するステップを更に含み、前記SNRを決定するステップは、前記記憶された変換データを参照して、前記第1のビット誤り数及び前記第2のビット誤り数を、前記変換データに記憶された前記複数のSNRからのSNRに対応付けることを含む、請求項13に記載の方法。 further comprising storing, in a data storage device, transformed data comprising a plurality of SNRs corresponding to a combination of a first bit error count and a second bit error count, wherein determining the SNR comprises the stored 14. The method of claim 13, comprising referencing transformed data to correspond the first number of bit errors and the second number of bit errors to SNRs from the plurality of SNRs stored in the transformed data. the method of. 前記スレッショルドが前記第1の値に設定されている前記コンパレータの前記出力の前記第1のビット誤り数を決定するステップは、
前記決定された第1のビット誤り数が第1の所定のスレッショルド値より小さい場合、前記スレッショルドの前記第1の値をより高くなるように調整するステップと、
前記決定された第1のビット誤り数が第2の所定のスレッショルド値より大きい場合、前記スレッショルドの前記第1の値をより低くなるように調整するステップと、
前記スレッショルドが前記調整された第1の値に設定されている前記コンパレータに前記信号を印加している間に測定された置換値で、前記第1のビット誤り数を置換するステップと、を含む、請求項13に記載の方法。
determining the first number of bit errors in the output of the comparator with the threshold set to the first value;
adjusting the first value of the threshold higher if the determined first number of bit errors is less than a first predetermined threshold value;
adjusting the first value of the threshold lower if the determined first number of bit errors is greater than a second predetermined threshold value;
replacing the first number of bit errors with a replacement value measured while applying the signal to the comparator with the threshold set to the adjusted first value. 14. The method of claim 13.
前記コンパレータは、第1のコンパレータ及び第2のコンパレータを含み、
前記スレッショルドが前記第1の値に設定されている前記コンパレータの前記出力の前記第1のビット誤り数を決定するステップは、前記第1のコンパレータの第1のスレッショルドが前記第1の値に設定されている前記第1のコンパレータの第1の出力の前記第1のビット誤り数を決定するステップを含み、
前記スレッショルドが前記第2の値に設定されている前記コンパレータの前記出力の前記第2のビット誤り数を決定するステップは、前記第2のコンパレータの第2のスレッショルドが前記第2の値に設定されている前記第2のコンパレータの第2の出力の前記第2のビット誤り数を決定するステップを含む、請求項13に記載の方法。
the comparator includes a first comparator and a second comparator;
Determining the first number of bit errors in the output of the comparator with the threshold set to the first value comprises setting the first threshold of the first comparator to the first value. determining the first number of bit errors in a first output of the first comparator being executed;
Determining the second number of bit errors in the output of the comparator with the threshold set to the second value comprises: setting the second threshold of the second comparator to the second value; 14. The method of claim 13, comprising determining the second number of bit errors in the second output of the second comparator that has been set.
前記第1のコンパレータの前記第1の出力の前記第1のビット誤り数を決定するステップは、前記第2のスレッショルドが前記第2の値に設定されている前記第2のコンパレータの前記第2の出力の前記第2のビット誤り数を決定するステップと少なくとも部分的に同時に実行される、請求項18に記載の方法。 Determining the first number of bit errors in the first output of the first comparator includes performing the second threshold of the second comparator with the second threshold set to the second value. 19. The method of claim 18, performed at least partially concurrently with the step of determining the second number of bit errors in the output of . 前記スレッショルドが前記第1の値に設定されている前記コンパレータの前記出力の前記第1のビット誤り数を決定するステップ及び前記スレッショルドが前記第2の値に設定されている前記コンパレータの前記出力の前記第2のビット誤り数を決定するステップは、少なくとも部分的に同時に実行される、請求項13に記載の方法。 determining said first number of bit errors in said output of said comparator with said threshold set to said first value; and determining said output of said comparator with said threshold set to said second value. 14. The method of claim 13, wherein determining the second number of bit errors is performed at least partially concurrently. 前記スレッショルドが前記第1の値に設定されている前記コンパレータの前記出力の前記第1のビット誤り数を決定するステップ及び前記スレッショルドが前記第2の値に設定されている前記コンパレータの前記出力の前記第2のビット誤り数を決定するステップは、別個の期間にわたって実行される、請求項13に記載の方法。 determining said first number of bit errors in said output of said comparator with said threshold set to said first value; and determining said output of said comparator with said threshold set to said second value. 14. The method of claim 13, wherein determining the second number of bit errors is performed over discrete time periods. 物理層デバイスであって、
1つ以上のプロセッサと、
コンピュータ可読命令が記憶されている1つ以上のデータ記憶デバイスであって、前記コンピュータ可読命令は、前記1つ以上のプロセッサに、
物理層デバイスのコンパレータに信号が印加されている間に、前記物理層デバイスの前記コンパレータのスレッショルドを第1の値に設定することであって、前記信号は、有線ローカルエリアネットワークの通信バスから受信され、前記第1の値は、前記信号の論理電圧レベル間の中間である中間スレッショルド値とは異なり、前記通信バスは、共有伝送媒体を含む、ことと、
前記スレッショルドが前記第1の値に設定されている前記コンパレータの出力の第1のビット誤り数を決定することと、
前記信号が前記コンパレータに印加されている間に、前記コンパレータの前記スレッショルドを第2の値に設定することであって、前記第2の値は、前記第1の値及び前記中間スレッショルド値とは異なる、ことと、
前記スレッショルドが前記第2の値に設定されている前記コンパレータの前記出力の第2のビット誤り数を決定することと、
前記第1のビット誤り数及び前記第2のビット誤り数に基づいて前記信号の信号対ノイズ比(SNR)を決定することと、を命令するように構成されている、1つ以上のデータ記憶デバイスと、を含む、物理層デバイス。
A physical layer device,
one or more processors;
One or more data storage devices having computer readable instructions stored thereon, the computer readable instructions instructing the one or more processors to:
setting a threshold of the comparator of the physical layer device to a first value while a signal is applied to the comparator of the physical layer device, the signal being received from a communication bus of a wired local area network; and the first value is different from an intermediate threshold value that is intermediate between logic voltage levels of the signal, and the communication bus comprises a shared transmission medium;
determining a first number of bit errors in the output of the comparator with the threshold set to the first value;
setting the threshold of the comparator to a second value while the signal is applied to the comparator, the second value being different from the first value and the intermediate threshold value; different things and
determining a second number of bit errors in the output of the comparator with the threshold set to the second value;
determining a signal-to-noise ratio (SNR) of the signal based on the first number of bit errors and the second number of bit errors. A physical layer device, including a device.
前記1つ以上のプロセッサ及び前記1つ以上のデータ記憶デバイスを収容する半導体チップパッケージを更に含む、請求項22に記載の物理層デバイス。 23. The physical layer device of claim 22, further comprising a semiconductor chip package housing said one or more processors and said one or more data storage devices. 前記コンピュータ可読命令は、前記1つ以上のプロセッサに、前記信号の前記SNRに基づいて前記信号のビット誤り率(BER)を決定することを命令するように更に構成されている、請求項22に記載の物理層デバイス。 23. The computer readable instructions of claim 22, further configured to instruct the one or more processors to determine a bit error rate (BER) of the signal based on the SNR of the signal. A physical layer device as described.
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