JPS647700B2 - - Google Patents

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Publication number
JPS647700B2
JPS647700B2 JP19493081A JP19493081A JPS647700B2 JP S647700 B2 JPS647700 B2 JP S647700B2 JP 19493081 A JP19493081 A JP 19493081A JP 19493081 A JP19493081 A JP 19493081A JP S647700 B2 JPS647700 B2 JP S647700B2
Authority
JP
Japan
Prior art keywords
timer
transistor
voltage
resistor
rectifier circuit
Prior art date
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Expired
Application number
JP19493081A
Other languages
Japanese (ja)
Other versions
JPS5895425A (en
Inventor
Terukyo Koto
Tetsuya Waniishi
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Omron Corp
Original Assignee
Omron Tateisi Electronics Co
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Omron Tateisi Electronics Co filed Critical Omron Tateisi Electronics Co
Priority to JP19493081A priority Critical patent/JPS5895425A/en
Publication of JPS5895425A publication Critical patent/JPS5895425A/en
Publication of JPS647700B2 publication Critical patent/JPS647700B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K17/00Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/28Modifications for introducing a time delay before switching

Description

【発明の詳細な説明】 この発明のタイマに関し、特に所定の時間にな
つたときタイムアツプ出力を制御装置などに与え
るタイマに関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a timer, and particularly relates to a timer that provides a time-up output to a control device or the like when a predetermined time has elapsed.

周知のように、タイマは、所定の時間になつた
ときタイムアツプ出力を制御装置などに与え、制
御装置の自動化およびーケンス制御を行なわせる
ために利用されている。
As is well known, a timer is used to provide a time-up output to a control device or the like when a predetermined time has elapsed, thereby automating the control device and controlling the sequence.

第1図は従来のタイマ10の回路図であり、第
2図は従来のタイマ20の回路図である。構成に
おいて、タイマ10は半波倍電圧整流回路11を
含む。半波倍電圧整流回路11は周知のように交
流電源111の電圧をコンデンサ112,115
およびダイオード113,114を使用してほぼ
2倍の直流出力電圧を発生させる回路である。交
流電源111にはコンデンサ112とダイオード
113とが直列接続される。ダイオード113に
は整流用のダイオード114と平滑用のコンデン
サ115との直列回路が並列接続される。コンデ
ンサ115には抵抗12とツエナダイオード13
との直列回路が並列接続される。ツエナダイオー
ド13にはタイマ用集積回路(以下タイマ用IC
と名称する)14が並列接続される。タイマ用
IC14は、半波倍電圧整流回路11から直流電
圧が供給され、所定時間後にタイムアツプ出力を
第1のスイツチング手段の一例のトランジスタ1
5のベースに与える。トランジスタ15のコレク
タはリレー16のコイルを介してコンデンサ11
5の一方電極に接続される。トランジスタ15の
エミツタはコンデンサ115の他方電極に接続さ
れる。
FIG. 1 is a circuit diagram of a conventional timer 10, and FIG. 2 is a circuit diagram of a conventional timer 20. In its configuration, timer 10 includes a half-wave voltage doubler rectifier circuit 11 . As is well known, the half-wave voltage doubler rectifier circuit 11 converts the voltage of the AC power supply 111 into capacitors 112 and 115.
This circuit uses diodes 113 and 114 to generate approximately twice the DC output voltage. A capacitor 112 and a diode 113 are connected in series to the AC power supply 111 . A series circuit including a rectifying diode 114 and a smoothing capacitor 115 is connected in parallel to the diode 113. A resistor 12 and a Zener diode 13 are connected to the capacitor 115.
The series circuit with is connected in parallel. The Zener diode 13 is a timer integrated circuit (hereinafter referred to as a timer IC).
) 14 are connected in parallel. for timer
The IC 14 is supplied with DC voltage from the half-wave voltage doubler rectifier circuit 11, and after a predetermined time, outputs a time-up output to the transistor 1, which is an example of a first switching means.
Give it to the base of 5. The collector of the transistor 15 is connected to the capacitor 11 via the coil of the relay 16.
It is connected to one electrode of No.5. The emitter of transistor 15 is connected to the other electrode of capacitor 115.

動作において、半波倍電圧整流回路11で半波
整流された直流電圧は、リレー16のコイルを介
してトランジスタ15のコレクタに与えられると
ともに、抵抗12で降圧されてタイマ用IC14
に与えられる。応じて、タイマ用IC14は、所
定時間が経過した後、タイムアツプ出力をトラン
ジスタ15のベース端に与える。このため、トラ
ンジスタ15は導通状態となる。その結果、リレ
ー16の接点は閉成される。
In operation, the DC voltage half-wave rectified by the half-wave voltage doubler rectifier circuit 11 is applied to the collector of the transistor 15 via the coil of the relay 16, and is stepped down by the resistor 12 to the timer IC 14.
given to. In response, the timer IC 14 provides a time-up output to the base end of the transistor 15 after a predetermined period of time has elapsed. Therefore, the transistor 15 becomes conductive. As a result, the contacts of relay 16 are closed.

しかし、従来のタイマ10では、コンデンサ1
15の一方電極とタイマ用IC14との間に抵抗
12を接続しているため、所定時間が経過するま
での交流電源111から見たインピーダンスが高
い。このため、半波倍電圧整流回路11をフオト
トランジスタなどの無接点スイツチで駆動させた
場合は、暗電流がタイマ用IC14に流れて、タ
イマ用IC14を誤動作させるという欠点があつ
た。
However, in the conventional timer 10, the capacitor 1
Since the resistor 12 is connected between one electrode of the AC power source 115 and the timer IC 14, the impedance seen from the AC power source 111 is high until the predetermined time elapses. For this reason, when the half-wave voltage doubler rectifier circuit 11 is driven by a non-contact switch such as a phototransistor, a dark current flows into the timer IC 14, causing the timer IC 14 to malfunction.

このため上述のような欠点を解消するために第
2図に示すようなタイマ20が考えられる。この
第2図が第1図と異なる点は、コンデンサ115
に抵抗21を並列接続したことである。その結
果、タイマ20では、コンデンサ115に対して
抵抗21を並列接続しているため交流電源111
から見たインピーダンスを低くすることができ
る。
Therefore, in order to eliminate the above-mentioned drawbacks, a timer 20 as shown in FIG. 2 can be considered. The difference between FIG. 2 and FIG. 1 is that the capacitor 115
This is because a resistor 21 is connected in parallel to the . As a result, in the timer 20, since the resistor 21 is connected in parallel to the capacitor 115, the AC power supply 111
The impedance seen from the front can be lowered.

しかし、第2図に示すようなタイマ20では、
抵抗21に常時電流が流れるため無駄な電力を消
費し、温度上昇の点でも好ましくないという欠点
がある。また、タイマ20は、定電圧機能を有し
ていないため、抵抗によつて入力電圧の2乗に比
例して発熱を生じ、高い入力電圧を供給して駆動
させることがむずかしいという欠点もある。
However, in the timer 20 as shown in FIG.
Since current always flows through the resistor 21, there is a drawback that power is wasted and the temperature rise is also undesirable. Furthermore, since the timer 20 does not have a constant voltage function, it has the disadvantage that heat is generated by the resistance in proportion to the square of the input voltage, making it difficult to drive it by supplying a high input voltage.

そこで、この発明の目的は、無接点スイツチで
入力電圧を供給した場合に誤動作を生じにくくさ
せるとともに、入力電圧範囲を広くとることがで
きる電源回路を含むタイマを提供することであ
る。
SUMMARY OF THE INVENTION An object of the present invention is to provide a timer that includes a power supply circuit that is less prone to malfunction when input voltage is supplied by a non-contact switch and that can widen the input voltage range.

この発明は要約すれば、倍電圧整流回路の一方
の出力端が第1の抵抗を介して第2のスイツチン
グ手段の第1の電極に接続されるとともにツエナ
ダイオードを介して第2のスイツチング手段の第
3の電極およびリレーを閉成させるための第1の
スイツチング手段の出力端に接続され、倍電圧整
流回路の他方の出力端が第2のスイツチング手段
の第2の電極に接続されるように電源回路を構成
したタイマである。
In summary, the present invention is such that one output terminal of the voltage doubler rectifier circuit is connected to the first electrode of the second switching means via the first resistor, and the output terminal of the second switching means is connected via the Zener diode. The third electrode is connected to the output end of the first switching means for closing the relay, and the other output end of the voltage doubler rectifier circuit is connected to the second electrode of the second switching means. This is a timer made up of a power supply circuit.

以下に、図面を参照してこの発明の一実施例に
ついて説明する。
An embodiment of the present invention will be described below with reference to the drawings.

第3図はこの発明の一実施例のタイマ30の回
路図である。この実施例が第1図および第2図と
異なる点は、回路Aを設けたことである。より具
体的には、第2のスイツチング手段の一例のトラ
ンジスタ31のコレクタは抵抗32を介して半波
倍電圧整流回路11の一方の出力端に接続され
る。トランジスタ31のベースは、抵抗33およ
びツエナダイオード34を介して半波倍電圧整流
回路11の一方の出力端に接続されるとともに、
抵抗35を介してトランジスタ15のコレクタに
接続される。トランジスタ31のエミツタは半波
倍電圧整流回路11の他方の出力端に接続され
る。
FIG. 3 is a circuit diagram of a timer 30 according to an embodiment of the present invention. This embodiment differs from FIGS. 1 and 2 in that a circuit A is provided. More specifically, the collector of a transistor 31, which is an example of the second switching means, is connected to one output terminal of the half-wave voltage doubler rectifier circuit 11 via a resistor 32. The base of the transistor 31 is connected to one output terminal of the half-wave voltage doubler rectifier circuit 11 via a resistor 33 and a Zener diode 34, and
It is connected to the collector of the transistor 15 via a resistor 35. The emitter of the transistor 31 is connected to the other output terminal of the half-wave voltage doubler rectifier circuit 11.

なお、抵抗32の抵抗値は、タイマ用ICの所
定時間が経過するまでに入力電圧が高くなつたと
き、電圧上昇を吸収するためにリレー16のコイ
ルの抵抗値より少し小さく選ばれる。
Note that the resistance value of the resistor 32 is selected to be slightly smaller than the resistance value of the coil of the relay 16 in order to absorb the voltage increase when the input voltage increases before the predetermined time of the timer IC elapses.

次に、第3図を参照してこの実施例の動作を説
明する。まず、半波倍電圧整流回路11の出力電
圧がツエナダイオード34を導通させるために必
要な所定電圧より低い場合について述べる。この
場合は、半波倍電圧整流回路11で半波整流され
た直流電圧が抵抗32を介してトランジスタ31
のコレクタに与えられるとともに、リレー16の
コイルおよび抵抗35を介してトランジスタ31
のベース端に与えられる。また、直流電圧はリレ
ー16のコイルを介してトランジスタ15のコレ
クタに与えられる。さらに、直流電圧は抵抗12
で降圧されてタイマ用IC14に与えられる。タ
イマ用IC14は、直流電圧が与えられると所定
時間が経過した後、タイムアツプ出力をトランジ
スタ15のベースに与えるように構成されてい
る。このため、所定時間が経過するまでは、トラ
ンジスタ15が非導通状態となり、トランジスタ
31が導通状態となる。一方、所定時間が経過し
た後においては、タイマ用IC14がトランジス
タ15のベースにタイムアツプ出力を与えるた
め、トランジスタ15が導通状態となり、リレー
16の接点が閉成される。このため、トランジス
タ31は非導通状態となる。なお、抵抗32によ
る負荷変動はほとんどない。
Next, the operation of this embodiment will be explained with reference to FIG. First, a case will be described in which the output voltage of the half-wave voltage doubler rectifier circuit 11 is lower than the predetermined voltage required to make the Zener diode 34 conductive. In this case, the DC voltage half-wave rectified by the half-wave voltage doubler rectifier circuit 11 is passed through the resistor 32 to the transistor 31.
is applied to the collector of the transistor 31 through the coil of the relay 16 and the resistor 35.
given at the base end of. Further, the DC voltage is applied to the collector of the transistor 15 via the coil of the relay 16. Furthermore, the DC voltage is resistor 12
The voltage is stepped down and applied to the timer IC 14. The timer IC 14 is configured to provide a time-up output to the base of the transistor 15 after a predetermined time has elapsed when a DC voltage is applied. Therefore, the transistor 15 is in a non-conducting state and the transistor 31 is in a conducting state until a predetermined period of time has elapsed. On the other hand, after the predetermined time has elapsed, the timer IC 14 provides a time-up output to the base of the transistor 15, so the transistor 15 becomes conductive and the contact of the relay 16 is closed. Therefore, the transistor 31 becomes non-conductive. Note that there is almost no load variation due to the resistor 32.

次に、直流電圧がツエナダイオード34を導通
させるために必要な所定電圧より高い場合につい
て説明する。この場合は、直流電圧がツエナダイ
オード34を導通状態にさせ、抵抗33を介して
トランジスタ31のベースに与えられる。このた
め、所定時間が経過するまではトランジスタ31
が導通状態となる。また、所定時間が経過した後
は、トランジスタ15,31が導通状態となり、
リレー16の接点が閉成される。
Next, a case where the DC voltage is higher than the predetermined voltage required to make the Zener diode 34 conductive will be described. In this case, a DC voltage makes the Zener diode 34 conductive and is applied to the base of the transistor 31 via the resistor 33. Therefore, until the predetermined time elapses, the transistor 31
becomes conductive. Furthermore, after a predetermined period of time has elapsed, the transistors 15 and 31 become conductive.
The contacts of relay 16 are closed.

このように、この実施例においては、半波倍電
圧整流回路11を無接点スイツチで駆動させたと
き、コンデンサ115に対して抵抗32を並列接
続するようにしたので交流電源111から見たイ
ンピーダンスを小さくすることができる。誤動作
を生じにくくさせる。また、この実施例では、入
力電圧が高くなつても負荷電圧がほぼ一定となる
ので抵抗による発熱をほぼ入力電圧の1乗に比例
して低減させるため、高い入力電圧を供給して駆
動させることができる。
As described above, in this embodiment, when the half-wave voltage doubler rectifier circuit 11 is driven by a non-contact switch, the resistor 32 is connected in parallel to the capacitor 115, so that the impedance seen from the AC power supply 111 is Can be made smaller. Make malfunctions less likely to occur. In addition, in this embodiment, even if the input voltage becomes high, the load voltage remains almost constant, so the heat generated by the resistance is reduced approximately in proportion to the first power of the input voltage, so it is possible to drive by supplying a high input voltage. I can do it.

以上のように、この発明によれば、無接点スイ
ツチで入力電力を供給した場合に誤動作を生じに
くくさせるとともに、入力電圧範囲を広くとれる
という特有の効果が奏される。
As described above, according to the present invention, the unique effects of making malfunction less likely to occur when input power is supplied by a non-contact switch and widening the input voltage range are achieved.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来のタイマ10の回路図である。第
2図は従来の他のタイマ20の回路図である。第
3図はこの発明の一実施例のタイマ30の回路図
である。 図において、11は半波倍電圧整流回路、1
2,32,33,35は抵抗、13,34はツエ
ナダイオード、14はタイマ用IC、15,31
はトランジスタを示す。
FIG. 1 is a circuit diagram of a conventional timer 10. FIG. 2 is a circuit diagram of another conventional timer 20. FIG. 3 is a circuit diagram of a timer 30 according to an embodiment of the present invention. In the figure, 11 is a half-wave voltage doubler rectifier circuit;
2, 32, 33, 35 are resistors, 13, 34 are Zener diodes, 14 is a timer IC, 15, 31
indicates a transistor.

Claims (1)

【特許請求の範囲】 1 所定の時間になつたとき、第1のスイツチン
グ手段を駆動してリレーの接点を閉じるためのタ
イマであつて、 倍電圧整流回路、 前記倍電圧整流回路の一方の出力端にその一方
端が接続される第1の抵抗、 その第1の電極は前記第1の抵抗の他方端に接
続され、その第2の電極が前記倍電圧整流回路の
他方の出力端に接続され、その第3の電極が前記
第1のスイツチング手段の出力端に接続される第
2のスイツチング手段、および 前記倍電圧整流回路と前記第2のスイツチング
手段の第3の電極との間に接続されるツエナダイ
オードを備えた、タイマ。
[Scope of Claims] 1. A timer for driving a first switching means to close a contact of a relay when a predetermined time has elapsed, the voltage doubler rectifier circuit having one output of the voltage doubler rectifier circuit; a first resistor, one end of which is connected to the other end, a first electrode of which is connected to the other end of the first resistor, and a second electrode of which is connected to the other output end of the voltage doubler rectifier circuit; a second switching means whose third electrode is connected to the output end of the first switching means; and a second switching means connected between the voltage doubler rectifier circuit and a third electrode of the second switching means. A timer with a zener diode.
JP19493081A 1981-12-02 1981-12-02 Timer Granted JPS5895425A (en)

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JPS5895425A JPS5895425A (en) 1983-06-07
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