JPS6452002U - - Google Patents
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- Publication number
- JPS6452002U JPS6452002U JP14628087U JP14628087U JPS6452002U JP S6452002 U JPS6452002 U JP S6452002U JP 14628087 U JP14628087 U JP 14628087U JP 14628087 U JP14628087 U JP 14628087U JP S6452002 U JPS6452002 U JP S6452002U
- Authority
- JP
- Japan
- Prior art keywords
- cpu
- section
- input section
- motherboard
- control device
- Prior art date
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- Pending
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- 238000003780 insertion Methods 0.000 claims description 2
- 230000037431 insertion Effects 0.000 claims description 2
- 239000013256 coordination polymer Substances 0.000 description 1
Landscapes
- Safety Devices In Control Systems (AREA)
Description
第１図は本考案の１実施例によるＣＰＵボード
の平面図、第２図は本考案による誤挿入チエツク
処理例のフローチヤートである。 １はデイツプスイツチ、２はアドレス入力部、
３はＣＰＵ、４はＬＥＤなど表示部、１０はＣＰ
Ｕボードである。
の平面図、第２図は本考案による誤挿入チエツク
処理例のフローチヤートである。 １はデイツプスイツチ、２はアドレス入力部、
３はＣＰＵ、４はＬＥＤなど表示部、１０はＣＰ
Ｕボードである。
Claims (1)
- ＣＰＵボードをマザーボードに挿入固定して構
成されるデイジタル制御装置において、ＣＰＵボ
ードが、装置番号を設定するためのデイツプスイ
ツチと、マザーボードへの挿入位置を示す外部か
らのデイジタル信号の入力部と、ＣＰＵにつなが
つた表示部と、デイツプスイツチによる設定信号
と入力部の信号とが合致しないときに表示部が点
灯するようにしたＣＰＵの演算制御部とを具有し
ていることを特徴とする、デイジタル制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14628087U JPS6452002U (ja) | 1987-09-24 | 1987-09-24 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14628087U JPS6452002U (ja) | 1987-09-24 | 1987-09-24 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6452002U true JPS6452002U (ja) | 1989-03-30 |
Family
ID=31415620
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14628087U Pending JPS6452002U (ja) | 1987-09-24 | 1987-09-24 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6452002U (ja) |
-
1987
- 1987-09-24 JP JP14628087U patent/JPS6452002U/ja active Pending
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