JPS6447591U - - Google Patents

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JPS6447591U
JPS6447591U JP1987142378U JP14237887U JPS6447591U JP S6447591 U JPS6447591 U JP S6447591U JP 1987142378 U JP1987142378 U JP 1987142378U JP 14237887 U JP14237887 U JP 14237887U JP S6447591 U JPS6447591 U JP S6447591U
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JP
Japan
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input
circuit
voltage level
current
suppressing
Prior art date
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Application number
JP1987142378U
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【図面の簡単な説明】
第１図は本考案の第１の実施例に係わる電源回
路の構成を示す回路図、第２図は本考案の第２の
実施例に係わる電源回路の構成を示す回路図であ
る。 １０……入力回路、１１……整流回路、１２…
…スイツチ回路、１５……第１の電流抑制用抵抗
、２２……第２の電流抑制用抵抗、２３……ジヤ
ンパー線。

Claims (1)

  1. 【実用新案登録請求の範囲】 電圧レベルの異なる複数種の入力交流をその電
    圧レベルに応じた整流方式により直流に変換する
    ための整流回路を備えた電源回路において、 前記入力交流を入力し低電圧レベルの入力交流
    のラツシユ電流を抑制するための第１の電流抑制
    用抵抗を有する入力回路と、この入力回路に入力
    された入力交流を前記整流回路へ出力する際に前
    記入力交流の電圧レベルが低電圧レベル又は高電
    圧レベルに応じて整流方式を切換えるためのスイ
    ツチ回路と、このスイツチ回路により高電圧レベ
    ルの入力交流を所定の整流方式による整流回路へ
    出力する際に前記第１の電流抑制用抵抗と直列に
    接続された状態で前記高電圧レベルの入力交流の
    ラツシユ電流を抑制し前記整流回路の入力側に設
    けられた第２の電流抑制用抵抗とを具備したこと
    を特徴とする電源回路。
JP1987142378U 1987-09-18 1987-09-18 Pending JPS6447591U (ja)

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JP1987142378U JPS6447591U (ja) 1987-09-18 1987-09-18

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JPS6447591U true JPS6447591U (ja) 1989-03-23

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ID=31408275

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JP1987142378U Pending JPS6447591U (ja) 1987-09-18 1987-09-18

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