JPS6418350U - - Google Patents

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JPS6418350U
JPS6418350U JP11200587U JP11200587U JPS6418350U JP S6418350 U JPS6418350 U JP S6418350U JP 11200587 U JP11200587 U JP 11200587U JP 11200587 U JP11200587 U JP 11200587U JP S6418350 U JPS6418350 U JP S6418350U
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Description

【図面の簡単な説明】
第1図は本考案の一実施例のブロツク図である
。第2図は従来のバツフアメモリ装置を有するメ
モリ装置の概略ブロツク図である。 3……アドレス変換装置、3−1〜3−N……
第1〜第Nのアドレス変換テーブル、4……主記
憶装置、11……CPU、12…切換機構、13
……主記憶インターフエース、14……切換レジ
スタ、15……バツフアメモリ装置、15−1〜
15−N……第1〜第Nのバツフアメモリブロツ
ク、25……アドレス線、26……データ線、2
7……制御信号線。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 主記憶装置と、CPUより出力されたアド
    レスを、前記主記憶装置内のアドレスに対応する
    ように変換するための、複数のアドレス変換テー
    ブルを有するアドレス変換装置と、CPUより出
    力されたアドレスにより直接アクセスされるバツ
    フアメモリ装置とを有するメモリ装置であつて、 前記バツフアメモリ装置は、複数のバツフアメ
    モリブロツクより成り、 前記CPUの指令に応じて、前記アドレス変換
    テーブルを切り換えると共に、前記バツフアメモ
    リブロツクを切り換える切換手段を備えたことを
    特徴とするメモリ装置。 (2) 前記バツフアメモリブロツクは、前記各ア
    ドレス変換テーブルと対応するように、該アドレ
    ス変換テーブルと同数設けられたことを特徴とす
    る前記実用新案登録請求の範囲第1項記載のメモ
    リ装置。 (3) 前記バツフアメモリブロツクは、それぞれ
    同一の容量であることを特徴とする前記実用新案
    登録請求の範囲第1項あるいは第2項記載のメモ
    リ装置。 (4) 前記切換手段は、CPUと、互いに対応す
    るアドレス変換テーブルおよびバツフアメモリブ
    ロツクとの間のアドレス線を切換える切換機構、
    前記アドレス変換テーブルと前記主記憶装置との
    間のアドレス線を切換える主記憶インターフエー
    ス、および前記切換機構と主記憶インターフエー
    スとを制御する切換えレジスタより成ることを特
    徴とする前記実用新案登録請求の範囲第1項ない
    し第3項のいずれかに記載のメモリ装置。
JP1987112005U 1987-07-23 1987-07-23 メモリ装置 Expired - Lifetime JPH0731310Y2 (ja)

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JPS6418350U true JPS6418350U (ja) 1989-01-30
JPH0731310Y2 JPH0731310Y2 (ja) 1995-07-19

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113039529A (zh) * 2018-11-15 2021-06-25 美光科技公司 存储器的地址混淆

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JPS5856279A (ja) * 1981-09-30 1983-04-02 Fujitsu Ltd アドレス変換方式

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US11853230B2 (en) 2018-11-15 2023-12-26 Micron Technology, Inc. Address obfuscation for memory

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JPH0731310Y2 (ja) 1995-07-19

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