JPS6334425Y2 - - Google Patents
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- JPS6334425Y2 JPS6334425Y2 JP15122782U JP15122782U JPS6334425Y2 JP S6334425 Y2 JPS6334425 Y2 JP S6334425Y2 JP 15122782 U JP15122782 U JP 15122782U JP 15122782 U JP15122782 U JP 15122782U JP S6334425 Y2 JPS6334425 Y2 JP S6334425Y2
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- Electrostatic Spraying Apparatus (AREA)
- Protection Of Static Devices (AREA)
- Power Conversion In General (AREA)
- Thyristor Switches And Gates (AREA)
Description
【考案の詳細な説明】
本考案は接地した被塗装物品が高圧荷電電極に
極めて接近、或は接触する場合などにも火花放電
の発生を確実に防止し得る機能を備えた静電塗装
装置に関する。[Detailed Description of the Invention] The present invention relates to an electrostatic coating device that is capable of reliably preventing spark discharge even when a grounded article to be coated comes very close to or comes into contact with a high-voltage charged electrode. .
火花回避機能を備えた斯かる種の従来の静電塗
装装置としては特公昭55−35989号公報及び特開
昭53−21240号公報などに記載されたものがある
が、これら公報に記載された静電塗装装置におい
てはいずれも高電圧出力の短絡用スイツチとして
機械的スイツチを用いているために、その動作応
答の遅れ時間が種々な問題点を生じている。例え
ば機械的スイツチが数十ミリ秒の動作遅れ時間を
有する場合には、負荷電流の増加量がかなり小さ
い領域においてその増加量が火花放電の発生を招
来するものであるか否かを判定せねばならず、従
つて複雑な検出を行つているにも拘らず誤検出が
多くならざるを得ない。この誤検出を減少させる
ためには非常に多くの設定レベルを用意してお
き、被塗装物品の形状などに応じて適正な設定レ
ベルを選択せねばならないが、この作業は充分に
静電塗装についての経験を有する作業者でなけれ
ば適正な設定レベルを選定できないという大きな
欠点がある。また被塗装物品が、短絡用スイツチ
の動作応答時間に対応する速度以上の速度で高電
圧電極に接近する場合には、如何なる検出を行つ
ても火花放電の発生を回避し得ない。従つて、斯
かる従来の欠点を除去するためには、極めて動作
速度の速いシリコン制御整流素子のような半導体
スイツチ素子を多数個直列接続してなる半導体ス
イツチ装置を用いることが好ましい。 Conventional electrostatic coating devices of this type equipped with a spark avoidance function are described in Japanese Patent Publication No. 55-35989 and Japanese Patent Application Laid-Open No. 53-21240, etc. Since all electrostatic coating apparatuses use mechanical switches as short-circuit switches for high voltage output, various problems arise due to the delay time of the operation response. For example, if a mechanical switch has an operation delay time of several tens of milliseconds, it is necessary to determine whether or not the amount of increase in load current will cause spark discharge in a region where the amount of increase in load current is quite small. Therefore, even though complex detection is performed, false detections inevitably increase. In order to reduce this false detection, it is necessary to prepare a large number of setting levels and select the appropriate setting level according to the shape of the object to be coated, but this work requires sufficient consideration of electrostatic painting. A major drawback is that only an operator with experience can select an appropriate setting level. Further, if the article to be coated approaches the high voltage electrode at a speed greater than the speed corresponding to the operating response time of the shorting switch, no amount of detection can avoid the occurrence of spark discharge. Therefore, in order to eliminate these conventional drawbacks, it is preferable to use a semiconductor switch device formed by connecting a large number of semiconductor switch devices in series, such as silicon-controlled rectifier devices, which operate at extremely high speeds.
先ず第1図において、斯かる半導体スイツチ装
置を用いた従来の静電塗装装置を示す。同図にお
いて、1は高周波インバータのような交流電源、
2は昇圧用トランス、3はコツククロフトウオル
トン回路のような直流高電圧発生回路、4は該回
路の負の出力端子、5及び6は限流抵抗、7は放
電用ダイオード、8は塗装用ガンとして示されて
いる高電圧電極、9は接地された被塗装物、10
は電流検出回路、11は検出された電流検出信号
の変化の状態によつて火花放電発生の予知を行う
火花放電発生予知回路、12は該回路からの出力
信号を受けるとパルスを発生するパルス発生回
路、13はパルストランス、14は半導体スイツ
チ素子であるサイリスタS1,S2,……,Soを多数
個直列接続してある半導体スイツチ装置、Rは限
流抵抗である。 First, in FIG. 1, a conventional electrostatic coating apparatus using such a semiconductor switch device is shown. In the figure, 1 is an AC power source such as a high frequency inverter;
2 is a step-up transformer, 3 is a DC high voltage generating circuit such as a Kotsukucroft Walton circuit, 4 is the negative output terminal of the circuit, 5 and 6 are current limiting resistors, 7 is a discharge diode, and 8 is for painting. High voltage electrode shown as gun, 9 grounded workpiece, 10
11 is a current detection circuit, 11 is a spark discharge occurrence prediction circuit that predicts the occurrence of spark discharge based on the state of change in the detected current detection signal, and 12 is a pulse generator that generates a pulse when receiving an output signal from the circuit. The circuit includes a pulse transformer 13, a semiconductor switch device 14 in which a large number of thyristors S 1 , S 2 , . . . , So , which are semiconductor switch elements, are connected in series, and R a current limiting resistor.
斯かる構成の静電塗装装置において、通常の動
作状態においては出力端子4にマイナス数+KV
乃至−100KV程度の直流高電圧が現出しており、
負荷電流は電流検出回路10、接地、被塗装物
9、高電圧電極8、限流抵抗6,5を介して出力
端子4に流れている。 In the electrostatic coating device with such a configuration, under normal operating conditions, a negative number +KV is applied to output terminal 4.
DC high voltages of around -100KV have appeared,
The load current flows to the output terminal 4 via the current detection circuit 10, ground, the object to be painted 9, the high voltage electrode 8, and the current limiting resistors 6 and 5.
このような状態で被塗装物9が高電圧電極8に
異常に接近、又は人体が高電圧電極8に異常に接
近したとすると、電流検出回路10を流れている
電流の状態が変化する。火花放電発生予知回路1
1は電流検出回路10からの電流検出信号の変化
状態が火花放電発生の前駆現象であると判断され
るとき火花放電発生予知信号を出力する。この信
号によりパルス発生器12はパルス信号を発生
し、パルストランス13を介してサイリスタS1,
S2,……,Soを同時にターンオンさせる。これに
伴い接地点から限流抵抗R、各サイリスタS1,
S2,……,Soの直列接続体からなる半導体スイツ
チ装置14、点X、放電用ダイオード7、高電圧
電極8及び被塗装物9を介して接地点に放電電流
が流れ、数十μ秒乃至100μ秒程度の短時間で点
Xを高電位から低電位に降下させる。従つて火花
放電の発生をほぼ確実に防止できる。しかしなが
ら、この回路では限流抵抗Rと接地間には大きな
分布容量CRがあり、又パルストランス13の各
2次巻線N1,N2,……,Noと接地間にも夫々分
布容量C1,C2,……,Coがあるために、半導体
スイツチ装置14の動作時にこれらの分布容量を
介して大電流が流れてしまい、半導体スイツチ装
置を破損してしまうという欠点があつた。 If the object to be painted 9 abnormally approaches the high voltage electrode 8 or the human body abnormally approaches the high voltage electrode 8 in such a state, the state of the current flowing through the current detection circuit 10 changes. Spark discharge occurrence prediction circuit 1
1 outputs a spark discharge occurrence prediction signal when it is determined that the change state of the current detection signal from the current detection circuit 10 is a precursor phenomenon of spark discharge occurrence. In response to this signal, the pulse generator 12 generates a pulse signal, which is transmitted through the pulse transformer 13 to the thyristor S 1 ,
Turn on S 2 , ..., S o at the same time. Along with this, from the grounding point to the current limiting resistor R, each thyristor S 1 ,
A discharge current flows to the ground point through the semiconductor switch device 14 consisting of a series connection of S 2 , ..., S o , the point X, the discharge diode 7, the high voltage electrode 8 and the object to be coated 9, The point Therefore, the occurrence of spark discharge can be almost certainly prevented. However, in this circuit, there is a large distributed capacitance C R between the current limiting resistor R and the ground, and there is also a large distributed capacitance C R between each of the secondary windings N 1 , N 2 , ..., No of the pulse transformer 13 and the ground. Due to the capacitances C 1 , C 2 , . Ta.
又、半導体スイツチ装置のターンオン時には点
Xの高電圧が集中的に単一の電流制限用抵抗に印
加されるのでその抵抗の電圧が一瞬にして高電圧
になので大きなノイズ源になり、制御回路や周囲
の他の電子回路などに悪影響を与えるなどの欠点
があつた。 Furthermore, when the semiconductor switch device is turned on, the high voltage at point It had drawbacks such as having an adverse effect on other electronic circuits in the surrounding area.
本考案は以上の欠点を全て除去する新規な静電
塗装装置を提供するものである。 The present invention provides a novel electrostatic coating device that eliminates all of the above drawbacks.
第2図は本考案の一実施例を示す図である。 FIG. 2 is a diagram showing an embodiment of the present invention.
同図において、R1,R2,……,Roは夫々第1
図における限流抵抗Rの略1/nの抵抗値rを有
する限流抵抗であり、該限流抵抗は、各サイリス
タS1,S2,……、Soと交互に直列接続されてい
る。ここで図示していない高抵抗によつて、各サ
イリスタS1,S2,……,Soの電圧が均等に分担さ
れているものとすると、通常の動作状態において
分布容量C1,C2,……,Coに充電されている電
圧は夫々C1=V/n、C2=2n/V,……,Co-1
=(n−1)V/n、Co=vとなる。 In the same figure, R 1 , R 2 , ..., Ro are the first
A current limiting resistor having a resistance value r approximately 1/n of the current limiting resistor R in the figure, and the current limiting resistor is alternately connected in series with each thyristor S 1 , S 2 , ..., S o . Assuming that the voltage of each thyristor S 1 , S 2 , . ,..., the voltage charged in C o is C 1 = V/n, C 2 = 2n/V,..., C o-1, respectively.
=(n-1)V/n, C o =v.
このような状態で被塗装物9が高電圧電極8に
異常に接近、又は人体が高電圧電極8に異常に接
近して火花放電発生予知回路11により電流検出
回路10からの電流検出信号の変化状態が火花放
電発生の前駆現象であると判断されるとき第1図
の説明で述べたのと同様に動作してサイリスタ
S1,S2,……,Soが同時にターンオンする。 In such a state, if the object to be painted 9 approaches the high voltage electrode 8 abnormally or the human body approaches the high voltage electrode 8 abnormally, the spark discharge occurrence prediction circuit 11 detects a change in the current detection signal from the current detection circuit 10. When the condition is determined to be a precursor to spark discharge, the thyristor operates in the same manner as described in the explanation of Figure 1.
S 1 , S 2 , ..., S o are turned on at the same time.
ところで、サイリスタS1,S2,……,Soのター
ンオン時、限流抵抗R1,R2,R3,……,Roが点
Xの電圧を均等に分担しているので、分布容量
C1,C2,C3,……Co-1,Coに充電されている電
圧は殆ど変化しない。従つて、サイリスタS1,
S2,……,Soの動作時にこれらの分布容量を介し
て大電流が流れることがなくなり、サイリスタ
S1,S2,……,Soを夫々流れる電流i1,i2,……、
ioはi1=i2=……=io=v/nrとなつて、高電位側
と低電位側との構造により形成される分布容量を
介して半導体スイツチ装置に流れる電流を制限す
ることができる。このことにより半導体スイツチ
素子S1,S2,……,Soの電流定格を合理的に選定
できるようになり、又限流抵抗R1,R2,……,
Roの耐圧を半導体スイツチ素子S1,S2,……,
Soの耐圧程度とすることができるので、非常に経
済的である。 By the way, when the thyristors S 1 , S 2 , ..., S o are turned on, the current limiting resistors R 1 , R 2 , R 3 , ..., Ro equally share the voltage at point X, so the distribution is capacity
The voltages charged in C 1 , C 2 , C 3 , ...C o -1 , and Co hardly change. Therefore, thyristor S 1 ,
During the operation of S 2 , ..., S o , large currents no longer flow through these distributed capacitances, and the thyristor
Currents i 1 , i 2 , ..., flowing through S 1 , S 2 , ..., S o , respectively
i o is i 1 = i 2 = ... = i o = v/nr, which limits the current flowing to the semiconductor switch device via the distributed capacitance formed by the structure of the high potential side and the low potential side. be able to. This makes it possible to rationally select the current ratings of the semiconductor switch elements S 1 , S 2 , ..., S o , and the current limiting resistors R 1 , R 2 , ...,
The breakdown voltage of R o is determined by the semiconductor switch elements S 1 , S 2 , ...,
It is very economical because it can withstand a pressure of about the same level as So.
次に第3図は本考案の他の一実施例を示す図で
ある。同図において、R′1,R′2……,R′o及び
C′1,C′2,……,C′oは夫々限流抵抗R1とサイリ
スタSoのカソード間に交互に直列接続された抵
抗、コンデンサであり、サイリスタS1,S2,…
…,So-1の夫々のゲートは所定の抵抗とコンデン
サとの接続点に接続されている。この実施例では
パルストランス13の2次巻線Nは1つだけであ
り、この2次巻線Nは高電位にあるサイリスタSo
のゲートに結合されている。 Next, FIG. 3 is a diagram showing another embodiment of the present invention. In the same figure, R′ 1 , R′ 2 ..., R′ o and
C′ 1 , C′ 2 , ..., C′ o are resistors and capacitors that are alternately connected in series between the current limiting resistor R 1 and the cathode of the thyristor S o , respectively, and the thyristors S 1 , S 2 , ...
..., each gate of S o-1 is connected to a connection point between a predetermined resistor and a capacitor. In this embodiment, the pulse transformer 13 has only one secondary winding N, which is connected to the thyristor S o at a high potential.
connected to the gate.
点Xが負の高電位にある場合、コンデンサC′1,
C′2,……,C′oは図示極性に充電されている。 When point X is at a negative high potential, capacitor C′ 1 ,
C′ 2 , ..., C′ o are charged to the polarity shown.
上記実施例と同様にしてパルス発生器12がパ
ルス信号を発生すると、該信号がパルストランス
13を介してサイリスタSoをターンオンさせる。 When the pulse generator 12 generates a pulse signal in the same manner as in the above embodiment, the signal turns on the thyristor S o via the pulse transformer 13.
サイリスタSoがターンオンすると、コンデンサ
C′oの電荷は抵抗R′o、サイリスタSo-1のゲート・
カソード、抵抗Ro及びサイリスタSoのアノー
ド・カソードを介して放電される。従つてサイリ
スタSo-1がトリガされてターンオンし、サイリス
タSo-1のターンオンにより前述と同様にコンデン
サC′o-1の電荷がサイリスタSo-2のゲートに放電
されてこれをターンオンさせる。以下同様にして
サイリスタが次々にターンオンする。 When the thyristor S o turns on, the capacitor
The charge on C′ o is transferred to the resistor R′ o and the gate of thyristor S o-1 .
It is discharged through the cathode, the anode/cathode of the resistor R o and the thyristor S o . Therefore, thyristor S o-1 is triggered to turn on, and the turn-on of thyristor S o-1 discharges the charge of capacitor C' o-1 to the gate of thyristor S o-2, turning it on, as before. . Thereafter, the thyristors are turned on one after another in the same manner.
このようにして半導体スイツチ装置がターンオ
ンして数十μ秒乃至100μ秒程度の極く短い時間
内に高電位点Xを低電位に降下させるが、本実施
例においても、サイリスタS1,S2,……,Soのタ
ーンオン時、ターンオンする前と同様に限流抵抗
R1,R2,……,Roが点Xの電圧を均等に分担し
ているので高電位側と低電位側との構造により形
成される分布容量を介して半導体スイツチ装置に
流れる電流を大幅に制限することができる。 In this way, the semiconductor switch device is turned on and the high potential point X is lowered to a low potential within an extremely short time of several tens of microseconds to 100 microseconds . ,...,When turning on S o , the current limiting resistor is applied as before turning on.
Since R 1 , R 2 , ..., Ro equally share the voltage at point can be significantly restricted.
第4図は本考案の他の一実施例を示す図であ
る。同図において、15は光パルス発生器、
LG1,LG2,……,LGoはライトガイド、S1,S2,
……,Soは光制御サイリスタである。本実施例に
おいても、上記実施例と同様にして光パルス発生
器15が光パルス信号を発生すると、該信号がラ
イトガイドLG1,LG2,……,LGoを介して光制
御サイリスタS1,S2,……,Soを同時にターンオ
ンさせる。以下は前述した実施例と同様であり、
同様の効果が得られる。尚、以上の実施例におい
ては電流制限用部材として抵抗R1,R2,……,
Roを用いたが、インダクタンス素子、又はイン
ダクタンス素子と抵抗との直列接続体などを用い
てもよい。又、上記実施例では半導体スイツチ素
子としてサイリスタ、光制御サイリスタを用いた
が、勿論他の制御信号電極付の半導体装置でも良
い。 FIG. 4 is a diagram showing another embodiment of the present invention. In the figure, 15 is an optical pulse generator;
LG 1 , LG 2 , ..., LG o is a light guide, S 1 , S 2 ,
..., S o is a light controlled thyristor. In this embodiment as well, when the optical pulse generator 15 generates an optical pulse signal in the same manner as in the above embodiment, the signal is transmitted to the optically controlled thyristor S 1 via the light guides LG 1 , LG 2 , ..., LG o . , S 2 , ..., S o are turned on at the same time. The following is the same as the example described above,
A similar effect can be obtained. In the above embodiment, resistors R 1 , R 2 , ..., are used as current limiting members.
Although R o is used, an inductance element or a series connection body of an inductance element and a resistor may be used. Further, in the above embodiment, a thyristor or an optically controlled thyristor was used as the semiconductor switch element, but of course other semiconductor devices with control signal electrodes may be used.
以上述べたように本考案は、高電圧電源と、該
高電圧電源により荷電される高電圧電極と、これ
ら高電圧電源と高電圧電極間の高電圧線路と低電
圧端子間に直列接続された複数の半導体スイツチ
素子から成る半導体スイツチ装置とを少なくとも
備えた静電塗装装置において、上記半導体スイツ
チ装置の各半導体スイツチ素子間に電流制限用イ
ンピーダンスが挿入されたことを特徴とする静電
塗装装置である。本考案はこのような特徴を有す
るので、半導体スイツチ装置のターンオン時、電
流制限用インピーダンスが高電圧を均等に分担す
るので、高電位側と低電位側との構造により形成
される分布容量を介して半導体スイツチ装置に流
れる電流を大幅に制限することができる。従つ
て、半導体スイツチ素子の電流定格を合理的に選
定でき、又電流制限用インピーダンスの耐圧を半
導体スイツチ素子の耐圧程度とすることができる
ので非常に経済的である。 As described above, the present invention provides a high-voltage power supply, a high-voltage electrode charged by the high-voltage power supply, a high-voltage line between the high-voltage power supply and the high-voltage electrode, and a low-voltage terminal connected in series. An electrostatic coating device comprising at least a semiconductor switch device comprising a plurality of semiconductor switch devices, characterized in that a current limiting impedance is inserted between each semiconductor switch device of the semiconductor switch device. be. Since the present invention has such characteristics, when the semiconductor switch device is turned on, the current limiting impedance equally shares the high voltage, so that the current limiting impedance is distributed through the distributed capacitance formed by the structure of the high potential side and the low potential side. The current flowing through the semiconductor switch device can be significantly limited. Therefore, the current rating of the semiconductor switch element can be selected rationally, and the withstand voltage of the current limiting impedance can be set to the same level as the withstand voltage of the semiconductor switch element, which is very economical.
第1図は従来の静電塗装装置を示す図、第2図
乃至第4図は夫々本考案に係る静電塗装装置の異
なる実施例を示す図である。
1……交流電源、2……昇圧用トランス、3…
…直流高電圧発生回路、5,6……限流抵抗、7
……放電用ダイオード、8……高電圧電極、9…
…被塗装物、10……電流検出回路、11……火
花放電発生予知回路、12……パルス発生回路、
13……パルストランス、14……半導体スイツ
チ装置、15……光パルス発生器、S1〜So……半
導体スイツチ素子、R,R1〜Ro……限流抵抗、
C1〜Co……分布容量、C′1〜C′o……コンデンサ、
R′1〜R′o……抵抗、LG1〜LGo……ライトガイド。
FIG. 1 is a diagram showing a conventional electrostatic coating device, and FIGS. 2 to 4 are diagrams showing different embodiments of the electrostatic coating device according to the present invention. 1... AC power supply, 2... Step-up transformer, 3...
...DC high voltage generation circuit, 5, 6...Current limiting resistor, 7
...Discharge diode, 8...High voltage electrode, 9...
... object to be painted, 10 ... current detection circuit, 11 ... spark discharge occurrence prediction circuit, 12 ... pulse generation circuit,
13...Pulse transformer, 14...Semiconductor switch device, 15...Optical pulse generator, S1 ~ So ...Semiconductor switch element, R, R1 ~ Ro ...Current limiting resistor,
C 1 ~C o ……distributed capacitance, C′ 1 ~C′ o ……capacitor,
R′ 1 ~ R′ o ……Resistor, LG 1 ~ LG o ……Light guide.
Claims (1)
高電圧電極と、これら高電圧電源と高電圧電極間
の高電圧線路と低電圧端子間に直列接続された複
数の半導体スイツチ素子から成る半導体スイツチ
装置とを少なくとも備えた静電塗装装置におい
て、上記半導体スイツチ装置の各半導体スイツチ
素子間に電流制限用インピーダンスが挿入された
ことを特徴とする静電塗装装置。 A semiconductor switch consisting of a high voltage power supply, a high voltage electrode charged by the high voltage power supply, and a plurality of semiconductor switch elements connected in series between the high voltage line between the high voltage power supply and the high voltage electrode and the low voltage terminal. What is claimed is: 1. An electrostatic coating device comprising at least an electrostatic coating device, characterized in that a current limiting impedance is inserted between each semiconductor switch element of the semiconductor switch device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15122782U JPS5958057U (en) | 1982-10-05 | 1982-10-05 | electrostatic painting equipment |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15122782U JPS5958057U (en) | 1982-10-05 | 1982-10-05 | electrostatic painting equipment |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5958057U JPS5958057U (en) | 1984-04-16 |
JPS6334425Y2 true JPS6334425Y2 (en) | 1988-09-13 |
Family
ID=30335180
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP15122782U Granted JPS5958057U (en) | 1982-10-05 | 1982-10-05 | electrostatic painting equipment |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5958057U (en) |
-
1982
- 1982-10-05 JP JP15122782U patent/JPS5958057U/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS5958057U (en) | 1984-04-16 |
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